JP2003202355A - Current detection circuit - Google Patents

Current detection circuit

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JP2003202355A
JP2003202355A JP2002001703A JP2002001703A JP2003202355A JP 2003202355 A JP2003202355 A JP 2003202355A JP 2002001703 A JP2002001703 A JP 2002001703A JP 2002001703 A JP2002001703 A JP 2002001703A JP 2003202355 A JP2003202355 A JP 2003202355A
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Japan
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shunt
mos transistor
current
transistor
source terminal
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JP2002001703A
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Japanese (ja)
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Sadaaki Nakano
禎明 仲野
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Koyo Seiko Co Ltd
Original Assignee
Koyo Seiko Co Ltd
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Abstract

<P>PROBLEM TO BE SOLVED: To provide a current detection circuit by which a drain current flowing in a power MOS transistor can be detected satisfactorily. <P>SOLUTION: A drain terminal D and a gate terminal G of a shunt MOS transistor 12 are installed sharing those of the power MOS transistor 11. One end of a shunt detecting resistance 13 having a comparatively large resistance value is connected to a source terminal 12S of the transistor 12. The other end of the resistance 13 is connected to a collector terminal C of an npn transistor 14, and an emitter terminal E of the npn transistor 14 is connected to a negative-voltage power supply 15 used to generate a negative voltage (-VDD). A potential of the source terminal 12S of the transistor 12 is held at the same potential as a source terminal 11S of the transistor 11 by a function of a potential holding circuit 18. <P>COPYRIGHT: (C)2003,JPO

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】この発明は、パワーMOSト
ランジスタに流れるドレイン電流を検出するための電流
検出回路に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a current detection circuit for detecting a drain current flowing in a power MOS transistor.

【0002】[0002]

【従来の技術】たとえば、電動パワーステアリング装置
では、車両のステアリング機構に与えるべき操舵補助力
の発生源として電動モータが用いられており、この電動
モータに駆動電流を供給するためのモータ駆動回路に
は、2個のパワーMOSトランジスタの直列回路が電動
モータの相数と同じ数だけ並列接続された構成を有する
インバータ回路が採用されている。そして、ステアリン
グホイールに加えられた操舵トルクおよび車速に応じて
目標電流値が設定され、この設定された目標電流値に基
づいて、モータ駆動回路(電動モータ)がフィードバッ
ク制御される。
2. Description of the Related Art For example, in an electric power steering apparatus, an electric motor is used as a source of a steering assist force to be given to a steering mechanism of a vehicle, and a motor drive circuit for supplying a drive current to the electric motor. Adopts an inverter circuit having a configuration in which a series circuit of two power MOS transistors is connected in parallel by the same number as the number of phases of the electric motor. Then, a target current value is set according to the steering torque applied to the steering wheel and the vehicle speed, and the motor drive circuit (electric motor) is feedback-controlled based on the set target current value.

【0003】モータ駆動回路のフィードバック制御を実
現するためには、モータ駆動回路から電動モータに供給
される駆動電流を検出することが不可欠である。駆動電
流の検出は、たとえば、モータ駆動回路を構成している
各パワーMOSトランジスタに流れる電流を検出するこ
とにより達成できる。図4は、パワーMOSトランジス
タに流れる電流を検出するための回路構成を示す図であ
る。モータ駆動回路を構成するパワーMOSトランジス
タ91には大きな電流が流れ、その大きな電流を直接検
出するのは困難であるため、このパワーMOSトランジ
スタ91に流れる電流を検出するための回路は、パワー
MOSトランジスタ91に流れる電流(主電流)から所
定の分流比(たとえば、1/100)で分流させた電流
(分流電流)を検出する構成となっている。
In order to realize the feedback control of the motor drive circuit, it is essential to detect the drive current supplied from the motor drive circuit to the electric motor. The drive current can be detected, for example, by detecting the current flowing through each power MOS transistor that constitutes the motor drive circuit. FIG. 4 is a diagram showing a circuit configuration for detecting a current flowing through the power MOS transistor. A large current flows through the power MOS transistor 91 forming the motor drive circuit, and it is difficult to directly detect the large current. Therefore, the circuit for detecting the current flowing through the power MOS transistor 91 is a power MOS transistor. The current (main current) flowing in 91 is detected at a predetermined current division ratio (for example, 1/100).

【0004】すなわち、この電流検出回路には、パワー
MOSトランジスタ91に流れる主電流を分流させるた
めに、ドレイン端子Dおよびゲート端子GをパワーMO
Sトランジスタ91と共有する分流MOSトランジスタ
92が備えられている。パワーMOSトランジスタ91
のソース端子91Sは、アース93に接続されており、
分流MOSトランジスタ92のソース端子92Sは、分
流電流検出用抵抗94を介してアース93に接続されて
いる。
That is, in this current detection circuit, in order to divide the main current flowing through the power MOS transistor 91, the drain terminal D and the gate terminal G are connected to the power MO.
A shunt MOS transistor 92 shared with the S transistor 91 is provided. Power MOS transistor 91
The source terminal 91S of is connected to the ground 93,
The source terminal 92S of the shunt MOS transistor 92 is connected to the ground 93 via the shunt current detection resistor 94.

【0005】この構成により、パワーMOSトランジス
タ91および分流MOSトランジスタ92の共通のゲー
ト端子GにパワーMOSトランジスタ91のスレッショ
ルド電圧以上のゲート電圧を印加すると、パワーMOS
トランジスタ91および分流MOSトランジスタ92が
オンになり、パワーMOSトランジスタ91に主電流
(ドレイン電流)が流れるとともに、パワーMOSトラ
ンジスタ91と分流MOSトランジスタ92のオン抵抗
の比にほぼ等しい分流比で主電流に比例した分流電流が
分流MOSトランジスタ92に流れる。この分流電流
は、分流電流検出用抵抗94の両端間の電位差(分流M
OSトランジスタ92のソース端子92Sの電位)を電
圧検出回路で検出し、その検出した電位差を分流電流検
出用抵抗94の抵抗値(たとえば、100Ω)で除する
ことにより算出することができる。そして、その算出し
た分流電流を分流比で除することにより、パワーMOS
トランジスタ91に流れる主電流を算出することができ
る。
With this configuration, when a gate voltage higher than the threshold voltage of the power MOS transistor 91 is applied to the common gate terminal G of the power MOS transistor 91 and the shunt MOS transistor 92, the power MOS transistor 91
The transistor 91 and the shunt MOS transistor 92 are turned on, the main current (drain current) flows through the power MOS transistor 91, and the main current is supplied at a shunt ratio substantially equal to the on resistance ratio of the power MOS transistor 91 and the shunt MOS transistor 92. A proportional shunt current flows through the shunt MOS transistor 92. This shunt current is a potential difference (shunt M) between both ends of the shunt current detection resistor 94.
It can be calculated by detecting the potential of the source terminal 92S of the OS transistor 92 by a voltage detection circuit and dividing the detected potential difference by the resistance value (for example, 100Ω) of the shunt current detection resistor 94. Then, by dividing the calculated shunt current by the shunt ratio, the power MOS
The main current flowing through the transistor 91 can be calculated.

【0006】[0006]

【発明が解決しようとする課題】パワーMOSトランジ
スタ91は、大電流が流れた時の発熱量を小さく抑える
ためにオン抵抗が小さく設計されており、パワーMOS
トランジスタ91のオン状態でのソース−ドレイン間電
圧は、パワーMOSトランジスタ91に通電可能な最大
電流の通電時でも数百mV程度である。また、上述の回
路構成では、分流電流検出用抵抗94の両端間の電位差
が、パワーMOSトランジスタ91のオン状態でのソー
ス−ドレイン間電圧よりも大きくなることはない。した
がって、パワーMOSトランジスタ91に流れる主電流
が微弱な時には、分流電流検出用抵抗94の両端間の電
位差がごく小さくなってしまい、そのごく小さな電位差
を電圧検出回路で良好に検出できないために、主電流の
検出精度(分解能)が良くなかった。
The power MOS transistor 91 is designed to have a small on-resistance in order to suppress the amount of heat generated when a large current flows, and the power MOS transistor 91 has a small ON resistance.
The source-drain voltage of the transistor 91 in the ON state is about several hundred mV even when the maximum current that can be supplied to the power MOS transistor 91 is supplied. Further, in the above circuit configuration, the potential difference between both ends of the shunt current detection resistor 94 does not become larger than the source-drain voltage when the power MOS transistor 91 is in the ON state. Therefore, when the main current flowing through the power MOS transistor 91 is weak, the potential difference between both ends of the shunt current detection resistor 94 becomes very small, and the very small potential difference cannot be detected well by the voltage detection circuit. The current detection accuracy (resolution) was not good.

【0007】そこで、この発明の目的は、上述の技術的
課題を解決し、パワーMOSトランジスタに流れる電流
を良好に検出できる電流検出回路を提供することであ
る。
SUMMARY OF THE INVENTION An object of the present invention is to solve the above-mentioned technical problems and to provide a current detection circuit capable of satisfactorily detecting a current flowing through a power MOS transistor.

【0008】[0008]

【課題を解決するための手段および発明の効果】上記の
目的を達成するための請求項1記載の発明は、パワーM
OSトランジスタ(11)に流れるドレイン電流を検出
するために、そのパワーMOSトランジスタとドレイン
端子(D)およびゲート端子(G)が共通の分流MOS
トランジスタ(12)に流れる分流電流を検出するため
の回路であって、上記パワーMOSトランジスタのソー
ス電圧よりも予め定める大きさだけ低い電圧を発生する
補助電源(15)と、この補助電源に一端が接続されて
いて、他端が上記分流MOSトランジスタのソース端子
(12S)に接続される分流電流検出用抵抗(13;1
31)と、上記分流MOSトランジスタのソース端子の
電位を上記パワーMOSトランジスタのソース端子(1
1S)と同電位に保持するための電位保持回路(14,
181;141,142,191)とを含むことを特徴
とする電流検出回路である。
Means for Solving the Problems and Effects of the Invention The invention according to claim 1 for achieving the above object is a power M.
In order to detect the drain current flowing in the OS transistor (11), the power MOS transistor and the shunt MOS transistor in which the drain terminal (D) and the gate terminal (G) are common.
A circuit for detecting a shunt current flowing through a transistor (12), which is an auxiliary power supply (15) for generating a voltage lower than a source voltage of the power MOS transistor by a predetermined amount, and one end of the auxiliary power supply. A shunt current detecting resistor (13; 1) connected to the other end of which is connected to the source terminal (12S) of the shunt MOS transistor.
31) and the potential of the source terminal of the shunt MOS transistor, the source terminal (1
1S) potential holding circuit for holding the same potential (14,
181; 141, 142, 191) are included in the current detection circuit.

【0009】なお、括弧内の英数字は、後述の実施形態
における対応構成要素等を表す。以下、この項において
同じ。この発明によれば、分流電流検出用抵抗が補助電
源に接続されているから、その分流電流検出用抵抗で
は、最大で補助電源の発生電圧分の電圧降下が許容され
る。よって、分流電流検出用抵抗として抵抗値の大きな
ものを用いることができるから、パワーMOSトランジ
スタに流れるドレイン電流が小さく、分流電流検出用抵
抗に流れる分流電流が小さい場合であっても、その小さ
な分流電流によって分流電流検出用抵抗の両端間に大き
な電位差を生じる。ゆえに、パワーMOSトランジスタ
に流れるドレイン電流が小さくても、その小さなドレイ
ン電流を良好に検出することができる。
The alphanumeric characters in parentheses represent corresponding components in the embodiments described later. The same applies in this section below. According to the present invention, since the shunt current detecting resistor is connected to the auxiliary power supply, the shunt current detecting resistor allows a maximum voltage drop corresponding to the voltage generated by the auxiliary power supply. Therefore, since a resistor having a large resistance value can be used as the shunt current detecting resistor, even if the drain current flowing through the power MOS transistor is small and the shunt current flowing through the shunt current detecting resistor is small, the small shunt current will be used. The current causes a large potential difference across the shunt current detection resistor. Therefore, even if the drain current flowing through the power MOS transistor is small, the small drain current can be satisfactorily detected.

【0010】なお、複数個のパワーMOSトランジスタ
のソース端子が同電位であり、これらのパワーMOSト
ランジスタがすべて異なるタイミングでオンにされる場
合には、分流電流検出用抵抗の他端に、各パワーMOS
トランジスタに対応づけて設けられた分流MOSトラン
ジスタのソース端子を接続すれば、これらの分流MOS
トランジスタに流れる分流電流(複数個のパワーMOS
トランジスタ11に流れるドレイン電流)を共通の電流
検出回路で検出することができる。こうする場合には、
請求項3に記載のように、電流検出回路が、上記分流電
流検出用抵抗の他端に並列に接続されていて、それぞれ
異なる分流MOSトランジスタのソース端子に接続され
る複数の干渉防止用抵抗(22)をさらに含むことが好
ましい。
When the source terminals of a plurality of power MOS transistors are at the same potential and all of these power MOS transistors are turned on at different timings, the other end of the shunt current detecting resistor is connected to each power MOS transistor. MOS
If the source terminals of the shunt MOS transistors provided corresponding to the transistors are connected, these shunt MOSs can be connected.
Shunt current flowing through a transistor (a plurality of power MOS
The drain current flowing through the transistor 11) can be detected by the common current detection circuit. If you do this
As described in claim 3, a current detection circuit is connected in parallel to the other end of the shunt current detection resistor, and a plurality of interference prevention resistors (each connected to the source terminals of different shunt MOS transistors) 22) is preferably further included.

【0011】請求項2記載の発明は、上記パワーMOS
トランジスタのソース端子と上記分流MOSトランジス
タのソース端子との間に介装されて、上記パワーMOS
トランジスタのソース端子から上記分流MOSトランジ
スタのソース端子に向かう方向にのみ電流を通すダイオ
ード(21)をさらに含むことを特徴とする請求項1記
載の電流検出回路である。この発明によれば、より確実
に、分流MOSトランジスタのソース端子の電位をパワ
ーMOSトランジスタのソース端子と同電位に保持する
ことができる。
According to a second aspect of the present invention, the power MOS is provided.
The power MOS is interposed between the source terminal of the transistor and the source terminal of the shunt MOS transistor.
2. The current detection circuit according to claim 1, further comprising a diode (21) which passes a current only in a direction from the source terminal of the transistor to the source terminal of the shunt MOS transistor. According to the present invention, the potential of the source terminal of the shunt MOS transistor can be more reliably maintained at the same potential as the source terminal of the power MOS transistor.

【0012】請求項4記載の発明は、上記分流電流検出
用抵抗とは異なる抵抗値を有し、上記補助電源に一端が
接続されていて、他端が上記分流MOSトランジスタの
ソース端子に上記分流電流検出用抵抗と並列に接続され
る第2の分流電流検出用抵抗(132)と、分流電流を
上記分流電流検出用抵抗(131)または第2の分流電
流検出用抵抗に切り換えて流すための切換手段(19
2,193,195)とをさらに含むことを特徴とする
請求項1ないし3のいずれかに記載の電流検出回路であ
る。
According to a fourth aspect of the present invention, the shunt current detection resistor has a resistance value different from that of the shunt current detection resistor, one end of which is connected to the auxiliary power supply, and the other end of which is connected to the source terminal of the shunt MOS transistor. A second shunt current detecting resistor (132) connected in parallel with the current detecting resistor, and a shunt current for switching the shunt current to the shunt current detecting resistor (131) or the second shunt current detecting resistor. Switching means (19
2, 193, 195) is further included in the current detection circuit according to any one of claims 1 to 3.

【0013】この発明によれば、第2の分流電流検出用
抵抗は、第1の分流電流検出用抵抗とは異なる抵抗値を
有している。したがって、通常は、抵抗値の小さい方の
分流電流検出用抵抗に分流電流を流して、その分流電流
検出用抵抗の両端間の電位差に基づいてドレイン電流を
検出するようにし、分流電流が小さい場合には、その分
流電流を抵抗値の大きい方の分流電流検出用抵抗に流し
て、その分流電流検出用抵抗の両端間の電位差に基づい
て主電流を算出するようにすれば、パワーMOSトラン
ジスタのドレイン電流を広い範囲で良好に検出すること
ができる。
According to the present invention, the second shunt current detecting resistor has a resistance value different from that of the first shunt current detecting resistor. Therefore, normally, a shunt current is made to flow through the shunt current detection resistor with the smaller resistance value, and the drain current is detected based on the potential difference across the shunt current detection resistor. If the shunt current is made to flow through the shunt current detection resistor having the larger resistance value and the main current is calculated based on the potential difference across the shunt current detection resistor, the power MOS transistor The drain current can be satisfactorily detected in a wide range.

【0014】[0014]

【発明の実施の形態】以下では、この発明の実施の形態
を、添付図面を参照して詳細に説明する。図1は、この
発明の一実施形態に係る電流検出回路の構成を示す回路
図である。この電流検出回路は、たとえば、電動モータ
を駆動するためのモータ駆動回路に備えられているパワ
ーMOSトランジスタ11に流れる電流(主電流)を検
出するための回路であり、パワーMOSトランジスタ1
1に流れる電流から比較的小さな電流(分流電流)を分
流させるための分流MOSトランジスタ12を備えてい
る。この分流MOSトランジスタ12のスレッショルド
電圧は、パワーMOSトランジスタ11のスレッショル
ド電圧よりも低く設定されている。
Embodiments of the present invention will be described below in detail with reference to the accompanying drawings. FIG. 1 is a circuit diagram showing a configuration of a current detection circuit according to an embodiment of the present invention. The current detection circuit is, for example, a circuit for detecting a current (main current) flowing in a power MOS transistor 11 included in a motor drive circuit for driving an electric motor.
A shunt MOS transistor 12 is provided for shunting a relatively small current (shunt current) from the current flowing through the first transistor. The threshold voltage of the shunt MOS transistor 12 is set lower than the threshold voltage of the power MOS transistor 11.

【0015】分流MOSトランジスタ12は、パワーM
OSトランジスタ11と、ドレイン端子Dおよびゲート
端子Gを共有している。分流MOSトランジスタ12の
ソース端子12Sには、比較的大きな抵抗値(たとえ
ば、100Ω)を有する分流電流検出用抵抗13の一端
が接続されている。分流電流検出用抵抗13の他端は、
npnトランジスタ14のコレクタ端子Cに接続されて
おり、このnpnトランジスタ14のエミッタ端子E
は、負電圧(−VDD)を発生する負電圧電源15(補助
電源)に接続されている。また、パワーMOSトランジ
スタのソース端子11Sは、アース16に接続されてい
る。
The shunt MOS transistor 12 has a power M
The drain terminal D and the gate terminal G are shared with the OS transistor 11. The source terminal 12S of the shunt MOS transistor 12 is connected to one end of a shunt current detection resistor 13 having a relatively large resistance value (for example, 100Ω). The other end of the shunt current detection resistor 13 is
It is connected to the collector terminal C of the npn transistor 14, and the emitter terminal E of this npn transistor 14 is connected.
Is connected to a negative voltage power supply 15 (auxiliary power supply) that generates a negative voltage (-V DD ). The source terminal 11S of the power MOS transistor is connected to the ground 16.

【0016】この構成により、パワーMOSトランジス
タ11および分流MOSトランジスタ12の共通のゲー
ト端子に、パワーMOSトランジスタ11のスレッショ
ルド電圧以上のゲート電圧を印加すると、パワーMOS
トランジスタ11および分流MOSトランジスタ12が
オンになり、パワーMOSトランジスタ11に主電流
(ドレイン電流)が流れるとともに、npnトランジス
タ14がオン状態であれば、分流MOSトランジスタ1
2、分流電流検出用抵抗13およびnpnトランジスタ
14の直列回路に分流電流が流れる。ゆえに、このとき
の分流電流検出用抵抗13の両端間の電位差を電圧検出
回路17で検出すれば、その検出した電位差に基づい
て、分流電流検出用抵抗13を流れる分流電流を算出す
ることができる。
With this structure, when a gate voltage higher than the threshold voltage of the power MOS transistor 11 is applied to the common gate terminal of the power MOS transistor 11 and the shunt MOS transistor 12, the power MOS transistor 11 is applied.
When the transistor 11 and the shunt MOS transistor 12 are turned on, the main current (drain current) flows through the power MOS transistor 11, and the npn transistor 14 is turned on, the shunt MOS transistor 1
2. A shunt current flows in the series circuit of the shunt current detection resistor 13 and the npn transistor 14. Therefore, if the voltage detection circuit 17 detects the potential difference between both ends of the shunt current detecting resistor 13 at this time, the shunt current flowing through the shunt current detecting resistor 13 can be calculated based on the detected potential difference. .

【0017】主電流に対する分流電流の比(分流比)
は、パワーMOSトランジスタ11のソース端子11S
と分流MOSトランジスタ12のソース端子12Sとが
同電位であれば、パワーMOSトランジスタ11および
分流MOSトランジスタ12をそれぞれ構成している微
細トランジスタの個数の比(たとえば、1/100)に
一致する。したがって、パワーMOSトランジスタ11
のソース端子11Sと分流MOSトランジスタ12のソ
ース端子12Sとが同電位である場合には、分流電流検
出用抵抗13を流れる分流電流を分流比で除することに
より、パワーMOSトランジスタ11に流れる主電流を
算出することができる。
Ratio of shunt current to main current (shunt ratio)
Is the source terminal 11S of the power MOS transistor 11.
And the source terminal 12S of the shunt MOS transistor 12 have the same potential, the ratio is equal to the ratio (for example, 1/100) of the number of minute transistors forming the power MOS transistor 11 and the shunt MOS transistor 12, respectively. Therefore, the power MOS transistor 11
When the source terminal 11S and the source terminal 12S of the shunt MOS transistor 12 have the same potential, the main current flowing through the power MOS transistor 11 is divided by dividing the shunt current flowing through the shunt current detecting resistor 13 by the shunt ratio. Can be calculated.

【0018】そこで、この電流検出回路には、分流MO
Sトランジスタ12のソース端子12Sの電位をパワー
MOSトランジスタ11のソース端子11Sの電位(こ
の実施形態では、ソース端子11Sがアース16に接続
されているから零)に合わせるように保持するための電
位保持回路18が備えられている。電位保持回路18
は、パワーMOSトランジスタ11のソース端子11S
の電位と分流MOSトランジスタ12のソース端子12
Sの電位との差を増幅して出力するオペアンプ181
と、このオペアンプ181の出力端子と負電圧電源15
との間に直列に接続された2個の抵抗182,183と
を含む。オペアンプ181のプラス側入力端子には、パ
ワーMOSトランジスタ11のソース端子11Sが接続
され、オペアンプ181のマイナス側入力端子には、分
流MOSトランジスタ12のソース端子12Sが接続さ
れている。そして、このオペアンプ181および抵抗1
82,183の直列回路は、2個の抵抗182,183
の接続点でnpnトランジスタ14のベース端子Bに接
続されている。
Therefore, in this current detection circuit, the shunt MO
A potential holding for holding the potential of the source terminal 12S of the S-transistor 12 so as to match the potential of the source terminal 11S of the power MOS transistor 11 (zero in this embodiment because the source terminal 11S is connected to the ground 16). A circuit 18 is provided. Potential holding circuit 18
Is the source terminal 11S of the power MOS transistor 11.
Potential and source terminal 12 of shunt MOS transistor 12
Operational amplifier 181 that amplifies and outputs the difference from the potential of S
And the output terminal of the operational amplifier 181 and the negative voltage power supply 15
And two resistors 182 and 183 that are connected in series between and. The source terminal 11S of the power MOS transistor 11 is connected to the positive side input terminal of the operational amplifier 181, and the source terminal 12S of the shunt MOS transistor 12 is connected to the negative side input terminal of the operational amplifier 181. Then, the operational amplifier 181 and the resistor 1
The series circuit of 82 and 183 has two resistors 182 and 183.
Is connected to the base terminal B of the npn transistor 14.

【0019】この構成により、分流MOSトランジスタ
12のソース端子12Sの電位がパワーMOSトランジ
スタ11のソース端子11Sの電位よりも低くなると、
オペアンプ181の働きにより、npnトランジスタ1
4のベース電圧が上げられる。その結果、npnトラン
ジスタ14に流れるコレクタ電流が大きくなり、分流電
流検出用抵抗13の両端間に加わる電圧が大きくなっ
て、分流MOSトランジスタ12のソース端子12Sの
電位が上がる。一方、分流MOSトランジスタ12のソ
ース端子12Sの電位がパワーMOSトランジスタ11
のソース端子11Sの電位よりも高くなると、オペアン
プ181の働きにより、npnトランジスタ14のベー
ス電圧が下げられる。その結果、npnトランジスタ1
4に流れるコレクタ電流が小さくなり、分流電流検出用
抵抗13に加わる電圧が小さくなって、分流MOSトラ
ンジスタ12のソース端子12Sの電位が下がる。こう
して、分流MOSトランジスタ12のソース端子12S
の電位は、パワーMOSトランジスタ11のソース端子
11Sの電位と同電位に保たれる。
With this configuration, when the potential of the source terminal 12S of the shunt MOS transistor 12 becomes lower than the potential of the source terminal 11S of the power MOS transistor 11,
By the operation of the operational amplifier 181, the npn transistor 1
The base voltage of 4 is raised. As a result, the collector current flowing through the npn transistor 14 increases, the voltage applied across the shunt current detecting resistor 13 increases, and the potential of the source terminal 12S of the shunt MOS transistor 12 rises. On the other hand, the potential of the source terminal 12S of the shunt MOS transistor 12 is the power MOS transistor 11
When it becomes higher than the potential of the source terminal 11S, the base voltage of the npn transistor 14 is lowered by the operation of the operational amplifier 181. As a result, the npn transistor 1
The collector current flowing in 4 decreases, the voltage applied to the shunt current detecting resistor 13 decreases, and the potential of the source terminal 12S of the shunt MOS transistor 12 decreases. Thus, the source terminal 12S of the shunt MOS transistor 12
Is maintained at the same potential as the potential of the source terminal 11S of the power MOS transistor 11.

【0020】したがって、電圧検出回路17で検出した
分流電流検出用抵抗13の両端間の電位差に基づいて、
分流電流検出用抵抗13を流れる分流電流を算出し、こ
の算出した分流電流を分流比で徐することにより、パワ
ーMOSトランジスタ11に流れる主電流を算出するこ
とができる。また、この電流検出回路では、分流電流検
出用抵抗13がnpnトランジスタ14を介して負電圧
電源15に接続されているから、分流電流検出用抵抗1
3では、最大で負電圧電源15の発生電圧分の電圧降下
が許容される。よって、抵抗値の大きな抵抗を分流電流
検出用抵抗13として用いることができるから、パワー
MOSトランジスタ11に流れる主電流が小さく、分流
電流検出用抵抗13に流れる分流電流が小さい場合であ
っても、その小さな分流電流によって分流電流検出用抵
抗13の両端間に生じる電位差を電圧検出回路17で良
好に検出できる。ゆえに、この電流検出回路では、パワ
ーMOSトランジスタ11に流れる主電流が小さくて
も、その小さな主電流を良好に検出することができる。
Therefore, based on the potential difference between both ends of the shunt current detecting resistor 13 detected by the voltage detecting circuit 17,
The main current flowing through the power MOS transistor 11 can be calculated by calculating the shunt current flowing through the shunt current detection resistor 13 and gradually reducing the calculated shunt current by the shunt ratio. Further, in this current detection circuit, the shunt current detection resistor 13 is connected to the negative voltage power supply 15 via the npn transistor 14, so that the shunt current detection resistor 1
In 3, the maximum voltage drop corresponding to the generated voltage of the negative voltage power supply 15 is allowed. Therefore, since a resistor having a large resistance value can be used as the shunt current detecting resistor 13, even if the main current flowing through the power MOS transistor 11 is small and the shunt current flowing through the shunt current detecting resistor 13 is small, The voltage detection circuit 17 can satisfactorily detect the potential difference generated between both ends of the shunt current detection resistor 13 due to the small shunt current. Therefore, in this current detection circuit, even if the main current flowing through the power MOS transistor 11 is small, the small main current can be satisfactorily detected.

【0021】図2は、この発明の他の実施形態に係る電
流検出回路の構成を示す回路図である。この図2におい
て、図1に示す各部に相当する部分には、図1の場合と
同じ参照符号を付して示している。この実施形態に係る
電流検出回路では、分流MOSトランジスタ12のソー
ス端子12Sに、予め定める抵抗値(たとえば、1Ω)
を有する第1分流電流検出用抵抗131の一端と、この
第1分流電流検出用抵抗131よりも大きな抵抗値(た
とえば、100Ω)を有する第2分流電流検出用抵抗1
32の一端とが接続されている。第1分流電流検出用抵
抗131の他端は、npnトランジスタ141のコレク
タ端子に接続されており、このnpnトランジスタ14
1のエミッタ端子は、負電圧(−VDD)を発生する負電
圧電源15に接続されている。また、第2分流電流検出
用抵抗132の他端は、npnトランジスタ142のコ
レクタ端子に接続されており、このnpnトランジスタ
142のエミッタ端子は、負電圧(−VDD)を発生する
負電圧電源15に接続されている。すなわち、分流MO
Sトランジスタ12のソース端子12Sと負電圧電源1
5との間に、第1分流電流検出用抵抗131およびnp
nトランジスタ141の直列回路と、第2分流電流検出
用抵抗132およびnpnトランジスタ142の直列回
路とが並列に設けられている。
FIG. 2 is a circuit diagram showing the configuration of a current detection circuit according to another embodiment of the present invention. 2, parts corresponding to the respective parts shown in FIG. 1 are designated by the same reference numerals as in FIG. In the current detection circuit according to this embodiment, the source terminal 12S of the shunt MOS transistor 12 has a predetermined resistance value (for example, 1Ω).
And one end of the first shunt current detecting resistor 131, and the second shunt current detecting resistor 1 having a resistance value (for example, 100Ω) larger than that of the first shunt current detecting resistor 131.
One end of 32 is connected. The other end of the first shunt current detection resistor 131 is connected to the collector terminal of the npn transistor 141.
The emitter terminal of No. 1 is connected to a negative voltage power supply 15 that generates a negative voltage (-V DD ). The other end of the second shunt current detection resistor 132 is connected to the collector terminal of the npn transistor 142, and the emitter terminal of the npn transistor 142 has a negative voltage power supply 15 that generates a negative voltage (-V DD ). It is connected to the. That is, the shunt MO
Source terminal 12S of S transistor 12 and negative voltage power supply 1
5, the first shunt current detection resistor 131 and np
A series circuit of the n-transistor 141 and a series circuit of the second shunt current detection resistor 132 and the npn transistor 142 are provided in parallel.

【0022】また、この電流検出回路には、パワーMO
Sトランジスタ11のソース端子11Sの電位と分流M
OSトランジスタ12のソース端子12Sの電位との差
を増幅して出力するオペアンプ191が備えられてい
る。オペアンプ191のプラス側入力端子には、パワー
MOSトランジスタ11のソース端子11Sが接続さ
れ、オペアンプ191のマイナス側入力端子には、分流
MOSトランジスタ12のソース端子12Sが接続され
ている。
Further, this current detection circuit has a power MO.
The potential of the source terminal 11S of the S transistor 11 and the shunt M
An operational amplifier 191 that amplifies and outputs the difference from the potential of the source terminal 12S of the OS transistor 12 is provided. The source terminal 11S of the power MOS transistor 11 is connected to the positive input terminal of the operational amplifier 191, and the source terminal 12S of the shunt MOS transistor 12 is connected to the negative input terminal of the operational amplifier 191.

【0023】オペアンプ191の出力は、第1アンド回
路192の一方入力端子および第2アンド回路193の
一方入力端子に与えられるようになっている。第1アン
ド回路192の他方入力端子には、たとえば、図示しな
いマイクロコンピュータから出力される計測範囲切換信
号が与えられるようになっており、第1アンド回路19
2の出力信号は、トランジスタ194で増幅されて、n
pnトランジスタ141のベース端子に与えられるよう
になっている。また、第2アンド回路193の他方入力
端子には、計測範囲切換信号が反転回路195で反転さ
れて与えられるようになっており、この第2アンド回路
193の出力信号は、トランジスタ196で増幅され
て、npnトランジスタ142のベース端子に与えられ
るようになっている。
The output of the operational amplifier 191 is applied to one input terminal of the first AND circuit 192 and one input terminal of the second AND circuit 193. To the other input terminal of the first AND circuit 192, for example, a measurement range switching signal output from a microcomputer (not shown) is applied.
The output signal of 2 is amplified by the transistor 194,
It is adapted to be applied to the base terminal of the pn transistor 141. Further, the measurement range switching signal is inverted and given to the other input terminal of the second AND circuit 193 by the inverting circuit 195, and the output signal of the second AND circuit 193 is amplified by the transistor 196. And is applied to the base terminal of the npn transistor 142.

【0024】この構成により、計測範囲切換信号がハイ
レベルの時には、第1アンド回路192からオペアンプ
191の出力に応じた信号が出力され、npnトランジ
スタ141がオンになって、分流MOSトランジスタ1
2、第1分流電流検出用抵抗131およびnpnトラン
ジスタ141の直列回路に、パワーMOSトランジスタ
11に流れる主電流に所定の分流比で比例した分流電流
が流れる。したがって、第1分流電流検出用抵抗131
の両端間の電位差を電圧検出回路17(図1参照)で検
出すれば、分流電流を算出することができ、さらに、そ
の算出した分流電流に基づいて、パワーMOSトランジ
スタ11に流れる主電流を算出することができる。な
お、このとき、計測範囲切換信号を反転させたローレベ
ルの信号が第2アンド回路193に与えられ、この第2
アンド回路193からは信号が出力されないので、np
nトランジスタ142はオフに保たれ、第2分流電流検
出用抵抗132およびnpnトランジスタ142の直列
回路には分流電流は流れない。
With this configuration, when the measurement range switching signal is at a high level, the first AND circuit 192 outputs a signal corresponding to the output of the operational amplifier 191, the npn transistor 141 is turned on, and the shunt MOS transistor 1 is turned on.
2. A shunt current that is proportional to the main current flowing through the power MOS transistor 11 at a predetermined shunt ratio flows in the series circuit of the first shunt current detection resistor 131 and the npn transistor 141. Therefore, the first shunt current detection resistor 131
The shunt current can be calculated by detecting the potential difference between both ends of the voltage detection circuit 17 (see FIG. 1). Further, the main current flowing through the power MOS transistor 11 is calculated based on the calculated shunt current. can do. At this time, a low level signal obtained by inverting the measurement range switching signal is given to the second AND circuit 193, and
Since no signal is output from the AND circuit 193, np
The n-transistor 142 is kept off, and no shunt current flows in the series circuit of the second shunt-current detecting resistor 132 and the npn transistor 142.

【0025】一方、計測範囲切換信号がローレベルの時
には、第2アンド回路193からオペアンプ191の出
力に応じた信号が出力され、npnトランジスタ142
がオンになって、分流MOSトランジスタ12、第2分
流電流検出用抵抗132およびnpnトランジスタ14
2の直列回路に、パワーMOSトランジスタ11に流れ
る主電流に所定の分流比で比例した分流電流が流れる。
したがって、第2分流電流検出用抵抗132の両端間の
電位差を電圧検出回路17で検出すれば、分流電流を算
出することができ、さらに、その算出した分流電流に基
づいて、パワーMOSトランジスタ11に流れる主電流
を算出することができる。なお、このとき、第1アンド
回路193にローレベルの計測範囲切換信号が与えら
れ、第1アンド回路193からは信号が出力されないの
で、npnトランジスタ141はオフに保たれ、第1分
流電流検出用抵抗131およびnpnトランジスタ14
1の直列回路には分流電流は流れない。
On the other hand, when the measurement range switching signal is low level, the second AND circuit 193 outputs a signal corresponding to the output of the operational amplifier 191, and the npn transistor 142.
Is turned on, the shunt MOS transistor 12, the second shunt current detecting resistor 132 and the npn transistor 14 are turned on.
A shunt current, which is proportional to the main current flowing through the power MOS transistor 11 at a predetermined shunt ratio, flows through the two series circuits.
Therefore, if the voltage detection circuit 17 detects the potential difference across the second shunt current detecting resistor 132, the shunt current can be calculated, and the power MOS transistor 11 can be calculated based on the calculated shunt current. The main current flowing can be calculated. At this time, since the low level measurement range switching signal is given to the first AND circuit 193 and no signal is output from the first AND circuit 193, the npn transistor 141 is kept off, and the first shunt current detecting circuit is used. Resistor 131 and npn transistor 14
No shunt current flows in the series circuit of 1.

【0026】第2分流電流検出用抵抗132は、第1分
流電流検出用抵抗131よりも大きな抵抗値を有してい
る。したがって、第1分流電流検出用抵抗131および
npnトランジスタ141の直列回路に流れた時に、第
1分流電流検出用抵抗131の両端間にほとんど電位差
を生じないような微弱な分流電流であっても、第2分流
電流検出用抵抗132およびnpnトランジスタ142
の直列回路に流れると、その第2分流電流検出用抵抗1
32の両端間には電位差が生じる。
The second shunt current detecting resistor 132 has a resistance value larger than that of the first shunt current detecting resistor 131. Therefore, even if the shunt current is weak such that a potential difference is hardly generated between both ends of the first shunt current detecting resistor 131 when flowing through the series circuit of the first shunt current detecting resistor 131 and the npn transistor 141, Second shunt current detection resistor 132 and npn transistor 142
The second shunt current detecting resistor 1
A potential difference is generated between both ends of 32.

【0027】そこで、通常は、計測範囲切換信号をハイ
レベルにしておき、第1分流電流検出用抵抗131およ
びnpnトランジスタ141の直列回路に分流電流を流
して、第1分流電流検出用抵抗131の両端間の電位差
に基づいて主電流を算出するようにし、第1分流電流検
出用抵抗131の両端間の電位差が予め定める値以下と
なった場合に、計測範囲切換信号をローレベルに切り換
えて、第2分流電流検出用抵抗132およびnpnトラ
ンジスタ142の直列回路に分流電流を流し、第2分流
電流検出用抵抗132の両端間の電位差に基づいて主電
流を算出するようにすれば、主電流(分流電流)を広い
範囲で良好に検出することができる。
Therefore, normally, the measurement range switching signal is set to a high level, and a shunt current is caused to flow in the series circuit of the first shunt current detecting resistor 131 and the npn transistor 141, so that the first shunt current detecting resistor 131 is connected. The main current is calculated based on the potential difference between both ends, and when the potential difference between both ends of the first shunt current detection resistor 131 is equal to or less than a predetermined value, the measurement range switching signal is switched to a low level, If a shunt current is caused to flow in the series circuit of the second shunt current detection resistor 132 and the npn transistor 142, and the main current is calculated based on the potential difference between both ends of the second shunt current detection resistor 132, the main current ( The shunt current) can be satisfactorily detected in a wide range.

【0028】以上、この発明の2つの実施形態について
説明したが、この発明はさらに他の形態で実施すること
もできる。たとえば、図1に破線で示すように、パワー
MOSトランジスタ11のソース端子11Sと分流MO
Sトランジスタ12のソース端子12Sとを、ツェナー
ダイオードなどのダイオード21を介して接続すること
により、分流MOSトランジスタ12のソース端子12
Sがより確実にパワーMOSトランジスタ11のソース
端子11Sと同電位に保持されるようにしてもよい。
Although the two embodiments of the present invention have been described above, the present invention can be implemented in other forms. For example, as shown by a broken line in FIG. 1, the source terminal 11S of the power MOS transistor 11 and the shunt MO are connected.
The source terminal 12S of the shunt MOS transistor 12 is connected to the source terminal 12S of the S-transistor 12 via a diode 21 such as a Zener diode.
S may be more surely held at the same potential as the source terminal 11S of the power MOS transistor 11.

【0029】また、図3に示すように、複数個(図3で
は3個)のパワーMOSトランジスタ11のソース端子
11Sがアース16に接続されていて、これらのパワー
MOSトランジスタ11がすべて異なるタイミングでオ
ンにされる場合には、分流電流検出用抵抗13の一端
に、各パワーMOSトランジスタ11に対応づけて設け
られた分流MOSトランジスタ12のソース端子12S
を接続し、これらの分流MOSトランジスタ12に流れ
る分流電流(複数個のパワーMOSトランジスタ11に
流れる主電流)を共通の電流検出回路で検出するように
してもよい。
Further, as shown in FIG. 3, the source terminals 11S of a plurality (three in FIG. 3) of power MOS transistors 11 are connected to the ground 16, and these power MOS transistors 11 are all at different timings. When turned on, the source terminal 12S of the shunting MOS transistor 12 provided at one end of the shunting current detection resistor 13 in association with each power MOS transistor 11.
May be connected, and the shunt current flowing through these shunt MOS transistors 12 (main current flowing through the plurality of power MOS transistors 11) may be detected by a common current detection circuit.

【0030】この場合、各分流MOSトランジスタ12
のソース端子12Sを、それぞれ干渉防止用抵抗22を
介して分流電流検出用抵抗13に接続することが好まし
い。こうすることにより、たとえば、各分流MOSトラ
ンジスタ12のソース端子12Sに逆電位が印加された
場合の回り込み電流の影響を軽減することができる。そ
の他、特許請求の範囲に記載された事項の範囲で種々の
設計変更を施すことが可能である。
In this case, each shunt MOS transistor 12
It is preferable to connect the source terminals 12S of the above to the shunt current detecting resistor 13 via the interference preventing resistor 22, respectively. By doing so, for example, the influence of the sneak current when a reverse potential is applied to the source terminal 12S of each shunt MOS transistor 12 can be reduced. In addition, various design changes can be made within the scope of the matters described in the claims.

【図面の簡単な説明】[Brief description of drawings]

【図1】この発明の一実施形態に係る電流検出回路の構
成を示す回路図である。
FIG. 1 is a circuit diagram showing a configuration of a current detection circuit according to an embodiment of the present invention.

【図2】この発明の他の実施形態に係る電流検出回路の
構成を示す回路図である。
FIG. 2 is a circuit diagram showing a configuration of a current detection circuit according to another embodiment of the present invention.

【図3】複数個のパワーMOSトランジスタに流れる電
流を共通の電流検出回路で検出するようにした構成を示
す回路図である。
FIG. 3 is a circuit diagram showing a configuration in which currents flowing through a plurality of power MOS transistors are detected by a common current detection circuit.

【図4】パワー素子に流れる電流を検出するための従来
の回路構成を示す図である。
FIG. 4 is a diagram showing a conventional circuit configuration for detecting a current flowing through a power element.

【符号の説明】[Explanation of symbols]

11 パワーMOSトランジスタ 11S ソース端子 12 分流MOSトランジスタ 12S ソース端子 13 分流電流検出用抵抗 14 トランジスタ 15 負電圧電源 18 電位保持回路 181 オペアンプ 21 ダイオード 22 干渉防止用抵抗 141 トランジスタ 142 トランジスタ 191 オペアンプ 192 アンド回路 193 アンド回路 195 反転回路 D ドレイン端子 G ゲート端子 11 Power MOS transistor 11S source terminal 12 shunt MOS transistor 12S source terminal 13 Shunt current detection resistor 14 transistors 15 Negative voltage power supply 18 Potential holding circuit 181 operational amplifier 21 diode 22 Resistance to prevent interference 141 transistor 142 transistor 191 operational amplifier 192 AND circuit 193 AND circuit 195 Inversion circuit D drain terminal G gate terminal

フロントページの続き Fターム(参考) 2G035 AA01 AB02 AC01 AD02 AD03 AD08 AD10 AD20 AD27 AD28 5H410 BB05 CC02 DD02 DD03 EA11 EB37 EB39 FF05 5H550 AA16 CC01 EE08 GG05 GG10 HB03 KK01 LL14 LL22 LL53 MM02 MM09 Continued front page    F term (reference) 2G035 AA01 AB02 AC01 AD02 AD03                       AD08 AD10 AD20 AD27 AD28                 5H410 BB05 CC02 DD02 DD03 EA11                       EB37 EB39 FF05                 5H550 AA16 CC01 EE08 GG05 GG10                       HB03 KK01 LL14 LL22 LL53                       MM02 MM09

Claims (4)

【特許請求の範囲】[Claims] 【請求項1】パワーMOSトランジスタに流れるドレイ
ン電流を検出するために、そのパワーMOSトランジス
タとドレイン端子およびゲート端子が共通の分流MOS
トランジスタに流れる分流電流を検出するための回路で
あって、 上記パワーMOSトランジスタのソース電圧よりも予め
定める大きさだけ低い電圧を発生する補助電源と、 この補助電源に一端が接続されていて、他端が上記分流
MOSトランジスタのソース端子に接続される分流電流
検出用抵抗と、 上記分流MOSトランジスタのソース端子の電位を上記
パワーMOSトランジスタのソース端子と同電位に保持
するための電位保持回路とを含むことを特徴とする電流
検出回路。
1. A shunt MOS having a common power MOS transistor, drain terminal, and gate terminal for detecting a drain current flowing through the power MOS transistor.
A circuit for detecting a shunt current flowing through a transistor, an auxiliary power supply generating a voltage lower than the source voltage of the power MOS transistor by a predetermined amount, and one end of which is connected to the auxiliary power supply, A shunt current detecting resistor whose end is connected to the source terminal of the shunt MOS transistor, and a potential holding circuit for holding the potential of the source terminal of the shunt MOS transistor at the same potential as the source terminal of the power MOS transistor. A current detection circuit comprising:
【請求項2】上記パワーMOSトランジスタのソース端
子と上記分流MOSトランジスタのソース端子との間に
介装されて、上記パワーMOSトランジスタのソース端
子から上記分流MOSトランジスタのソース端子に向か
う方向にのみ電流を通すダイオードをさらに含むことを
特徴とする請求項1記載の電流検出回路。
2. The current is interposed between the source terminal of the power MOS transistor and the source terminal of the shunt MOS transistor, and the current flows only in the direction from the source terminal of the power MOS transistor to the source terminal of the shunt MOS transistor. The current detection circuit according to claim 1, further comprising a diode that passes through.
【請求項3】上記分流電流検出用抵抗の他端に並列に接
続されていて、それぞれ異なる分流MOSトランジスタ
のソース端子に接続される複数の干渉防止用抵抗をさら
に含むことを特徴とする請求項1または2記載の電流検
出回路。
3. A plurality of interference-preventing resistors, which are connected in parallel to the other end of the shunt current detecting resistor and are connected to the source terminals of different shunt MOS transistors, respectively. The current detection circuit described in 1 or 2.
【請求項4】上記分流電流検出用抵抗とは異なる抵抗値
を有し、上記補助電源に一端が接続されていて、他端が
上記分流MOSトランジスタのソース端子に上記分流電
流検出用抵抗と並列に接続される第2の分流電流検出用
抵抗と、 分流電流を上記分流電流検出用抵抗または第2の分流電
流検出用抵抗に切り換えて流すための切換手段とをさら
に含むことを特徴とする請求項1ないし3のいずれかに
記載の電流検出回路。
4. A resistor having a resistance value different from that of the shunt current detecting resistor, one end of which is connected to the auxiliary power source, and the other end of which is connected to the source terminal of the shunt MOS transistor in parallel with the shunt current detecting resistor. A second shunt current detecting resistor connected to the second shunt current, and switching means for switching the shunt current to the shunt current detecting resistor or the second shunt current detecting resistor. Item 5. The current detection circuit according to any one of Items 1 to 3.
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