JP2002521979A - テレビ会議インタフェース - Google Patents
テレビ会議インタフェースInfo
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N7/00—Television systems
- H04N7/14—Systems for two-way working
- H04N7/15—Conference systems
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N7/00—Television systems
- H04N7/14—Systems for two-way working
- H04N7/141—Systems for two-way working between two video terminals, e.g. videophone
- H04N7/148—Interfacing a video terminal to a particular transmission medium, e.g. ISDN
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Computer Networks & Wireless Communication (AREA)
- Two-Way Televisions, Distribution Of Moving Picture Or The Like (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
- Facsimiles In General (AREA)
Abstract
(57)【要約】
テレビ会議回路（１２）が、複数の映像入力装置の１つからの入力（２６）を受信するように構成されている。その後、前記映像信号が記憶され、圧縮され、例えばモデム（１８）のようなインタフェース回路によって転送される。遠隔地からの映像信号が、前記モデム（１８）から受信され、解凍され、記憶され、その後、複数の映像出力装置の１つに表示するために転送される。
Description
【０００１】 本出願は、１９９８年７月３０日に出願された、出願番号６０／０９４，６４
６の米国特許仮出願の特典を主張する。
６の米国特許仮出願の特典を主張する。
【０００２】
本発明は、テレビ会議システムに関し、特に、複数のビデオ入力装置のうちの
１つあるいは２以上のビデオ入力装置、また、複数の出力装置のうちの１つある
いは２以上の出力装置のインタフェースとなるシステムに関する。
１つあるいは２以上のビデオ入力装置、また、複数の出力装置のうちの１つある
いは２以上の出力装置のインタフェースとなるシステムに関する。
【０００３】
テレビ会議システムは、一般的に、１つの特定タイプのビデオ入力装置、例え
ばＮＴＳＣカメラ（「ＮＴＳＣ」は、北米および日本のアナログ・ビデオ標準を
意味する）、ＰＡＬカメラ（「ＰＡＬ」はヨーロッパのアナログ・ビデオ標準を
意味する）、ディジタル・カメラ、あるいは高速シリアル・インタフェース・カ
メラ（例えばファイア・ワイヤあるいはユニバーサル・シリアル・バス（ＵＳＢ
）カメラ）と共に使用されるために、設計されている。また、このようなのシス
テムは、一般的にも、一種の特定の出力デバイス、例えばＮＴＳＣあるいはＰＡ
Ｌビデオ・モニタ、テレビジョン・セット、液晶ディスプレイ（ＬＣＤ）スクリ
ーン、またはコンピュータ・モニタと共に使用されるために、設計されている。
ばＮＴＳＣカメラ（「ＮＴＳＣ」は、北米および日本のアナログ・ビデオ標準を
意味する）、ＰＡＬカメラ（「ＰＡＬ」はヨーロッパのアナログ・ビデオ標準を
意味する）、ディジタル・カメラ、あるいは高速シリアル・インタフェース・カ
メラ（例えばファイア・ワイヤあるいはユニバーサル・シリアル・バス（ＵＳＢ
）カメラ）と共に使用されるために、設計されている。また、このようなのシス
テムは、一般的にも、一種の特定の出力デバイス、例えばＮＴＳＣあるいはＰＡ
Ｌビデオ・モニタ、テレビジョン・セット、液晶ディスプレイ（ＬＣＤ）スクリ
ーン、またはコンピュータ・モニタと共に使用されるために、設計されている。
【０００４】 必要とされているよりも、テレビ会議システムのユーザもしくは製造者自らが
選択したビデオ入力装置および出力装置、あるいは、ある特定のテレビ会議アプ
リケーションの構成に必要なビデオ入力装置および出力装置を混在させることが
できる、テレビ会議システム用のインタフェースを有するシステムは、まだ知ら
れていない。つまり、現存しているシステムは、選択されたテレビ会議システム
のビデオ信号形式によって規定されたある特定のビデオ入力装置及びある特定の
出力装置を必要とするものだと考えられる。
選択したビデオ入力装置および出力装置、あるいは、ある特定のテレビ会議アプ
リケーションの構成に必要なビデオ入力装置および出力装置を混在させることが
できる、テレビ会議システム用のインタフェースを有するシステムは、まだ知ら
れていない。つまり、現存しているシステムは、選択されたテレビ会議システム
のビデオ信号形式によって規定されたある特定のビデオ入力装置及びある特定の
出力装置を必要とするものだと考えられる。
【０００５】
テレビ会議インタフェースは、優れた映像及び音声品質、高い圧縮率、大きな
柔軟性といった特徴を備え、かつ、これらの特徴をすべて低コストで実現する標
準ベースのテレビ会議システムの一部である。このインタフェースは、ハードウ
エア内に実現された演算・データ経路設計と、柔軟性のために標準プロセッサを
用いて開発された処理・制御との独特な調和を組み込んだ、特定用途向け集積回
路（ＡＳＩＣ）を包含する。
柔軟性といった特徴を備え、かつ、これらの特徴をすべて低コストで実現する標
準ベースのテレビ会議システムの一部である。このインタフェースは、ハードウ
エア内に実現された演算・データ経路設計と、柔軟性のために標準プロセッサを
用いて開発された処理・制御との独特な調和を組み込んだ、特定用途向け集積回
路（ＡＳＩＣ）を包含する。
【０００６】 前記開示されたシステムにおける使用できる演算および制御の“ハイブリッド
”方法は、それの「単一な解決方法」より優れており、つまり、専用ハードウエ
ア内のみに演算及び制御が実現される方法を凌駕する利点を提供する。専用ハー
ドウエアのみを用いた単一の方法は、ビット・レート制御の面において、比較的
に柔軟性を欠くことがある。また、前記開示されたシステムにおける演算および
制御の“ハイブリッド”方法は、ソフトウエアでプログラミングされたプロセッ
サのみを用いて、ハードウエアで実現された方法の速度の利点をあきらめる単一
の方法を凌駕する利点を提供する。
”方法は、それの「単一な解決方法」より優れており、つまり、専用ハードウエ
ア内のみに演算及び制御が実現される方法を凌駕する利点を提供する。専用ハー
ドウエアのみを用いた単一の方法は、ビット・レート制御の面において、比較的
に柔軟性を欠くことがある。また、前記開示されたシステムにおける演算および
制御の“ハイブリッド”方法は、ソフトウエアでプログラミングされたプロセッ
サのみを用いて、ハードウエアで実現された方法の速度の利点をあきらめる単一
の方法を凌駕する利点を提供する。
【０００７】 前記開示されたシステムは、ハードウエアを用いることにより、演算を実現す
るあるいは提供し、プロセッサのみの環境（つまりソフトウエア）において達成
し得る速度より速い速度で高速データ処理をするために、データ経路を提供する
。標準のソフトウエア・ベースのプロセッサは、制御の柔軟性を可能にし、よっ
て、それを用いたシステムをそれぞれ異なる構成に適合させることができる。し
かしながら、その結果は、ソフトウエア構成に起因する速度の低下を招くことに
なる。一方、ハードウエアを用いてより速い速度を達成するためには、必要な各
態様毎にとって別途のハードウエア構成が必要になり、よって、方法の実現に相
当なコストと複雑性がもたらされる。
るあるいは提供し、プロセッサのみの環境（つまりソフトウエア）において達成
し得る速度より速い速度で高速データ処理をするために、データ経路を提供する
。標準のソフトウエア・ベースのプロセッサは、制御の柔軟性を可能にし、よっ
て、それを用いたシステムをそれぞれ異なる構成に適合させることができる。し
かしながら、その結果は、ソフトウエア構成に起因する速度の低下を招くことに
なる。一方、ハードウエアを用いてより速い速度を達成するためには、必要な各
態様毎にとって別途のハードウエア構成が必要になり、よって、方法の実現に相
当なコストと複雑性がもたらされる。
【０００８】 例えば、一般的に、システム・インタフェースがビット・レートで映像を処理
するので、処理後映像の品質と映像が処理された速度との間に、適切なバランス
が得られるようにビット・レートを制御することが望ましい。例えば、一般的に
、処理される映像内に素早い動きが存在した場合、増大されたビット・レートで
操作することによって素早い動きが迅速に処理され、そして通信されることが望
ましい。しかしながら、高速に処理することは、映像の品質にマイナスの影響を
与える。一般的に、処理すべき映像が映像から映像へ（例えばフレームからフレ
ームへ）のような比較的静的な映像である場合には、引き下げられたビット・レ
ートで操作することによって映像の品質を向上させることが望ましい。ハードウ
エアのみの実現方法においては、より高い費用で、このような柔軟性が、システ
ムに物理的に組み込まなければならないか、あるいは、それを簡単に利用できな
い。ソフトウエアのみの実現方法においては、柔軟性が維持されるものの、引き
下げられた処理速度という犠牲を払うことになる。本発明は、これまで知られて
いない「ハイブリッド」アプローチを用いることにより、定着したハードウエア
及び定着したソフトウエアの両方の恩恵を確保する。
するので、処理後映像の品質と映像が処理された速度との間に、適切なバランス
が得られるようにビット・レートを制御することが望ましい。例えば、一般的に
、処理される映像内に素早い動きが存在した場合、増大されたビット・レートで
操作することによって素早い動きが迅速に処理され、そして通信されることが望
ましい。しかしながら、高速に処理することは、映像の品質にマイナスの影響を
与える。一般的に、処理すべき映像が映像から映像へ（例えばフレームからフレ
ームへ）のような比較的静的な映像である場合には、引き下げられたビット・レ
ートで操作することによって映像の品質を向上させることが望ましい。ハードウ
エアのみの実現方法においては、より高い費用で、このような柔軟性が、システ
ムに物理的に組み込まなければならないか、あるいは、それを簡単に利用できな
い。ソフトウエアのみの実現方法においては、柔軟性が維持されるものの、引き
下げられた処理速度という犠牲を払うことになる。本発明は、これまで知られて
いない「ハイブリッド」アプローチを用いることにより、定着したハードウエア
及び定着したソフトウエアの両方の恩恵を確保する。
【０００９】 前記説明された本発明の実施形態において、前記ＡＳＩＣがこのハイブリッド
・アプローチを実現する上での鍵となる。前記ＡＳＩＣは、演算及びデータ移動
に関する機能が物理的に組み込まれた実現方法を提供すると共に、プロセッサを
ベースにした処理及び制御に内在する柔軟性をも提供する。
・アプローチを実現する上での鍵となる。前記ＡＳＩＣは、演算及びデータ移動
に関する機能が物理的に組み込まれた実現方法を提供すると共に、プロセッサを
ベースにした処理及び制御に内在する柔軟性をも提供する。
【００１０】 前記ＡＳＩＣのほかに、このシステムには、圧縮時及び／又は表示時の映像情
報を記憶するメモリが組み込まれる。このシステムは、プロセッサ及び音声入出
力のための命令とデータを記憶するメモリ、電気的書換え可能読出し専用メモリ
（ＥＥＰＲＯＭ）と、電話／ネットワーク・インタフェース用の変調器／復調器
（モデム）とをも備える。（実際に構成要件によって、前記ＥＥＰＲＯＭ及びモ
デムについて自由選択が可能である。）
報を記憶するメモリが組み込まれる。このシステムは、プロセッサ及び音声入出
力のための命令とデータを記憶するメモリ、電気的書換え可能読出し専用メモリ
（ＥＥＰＲＯＭ）と、電話／ネットワーク・インタフェース用の変調器／復調器
（モデム）とをも備える。（実際に構成要件によって、前記ＥＥＰＲＯＭ及びモ
デムについて自由選択が可能である。）
【００１１】 また、前記ＡＳＩＣは、機能において柔軟性を持ついくつかのインタフェース
をも備えており、それによって最小限の修正あるいはコストへの影響を最小限に
していくつかの異なるシステム構成が可能になる。これらのインタフェースは、
映像入力、映像出力、及び高速直列インタフェースを備える。
をも備えており、それによって最小限の修正あるいはコストへの影響を最小限に
していくつかの異なるシステム構成が可能になる。これらのインタフェースは、
映像入力、映像出力、及び高速直列インタフェースを備える。
【００１２】
図１に示すように、従来のＡＳＩＣ１０は、回路ボード１２上に備えることが
できる。前記回路ボード１２は、メモリ制御３０に接続され、映像信号を保持す
る機能を提供するメモリ・モジュール１５を形成するメモリ１４を備える。メモ
リ１４は、ダイナミック・ランダム・アクセス・メモリ（ＤＲＡＭ）、スタティ
ック・ランダム・アクセス・メモリ（ＳＣＲＡＭ）、あるいは当業者に周知の他
の適切な記憶装置構成を用いて実現されることができる。
できる。前記回路ボード１２は、メモリ制御３０に接続され、映像信号を保持す
る機能を提供するメモリ・モジュール１５を形成するメモリ１４を備える。メモ
リ１４は、ダイナミック・ランダム・アクセス・メモリ（ＤＲＡＭ）、スタティ
ック・ランダム・アクセス・メモリ（ＳＣＲＡＭ）、あるいは当業者に周知の他
の適切な記憶装置構成を用いて実現されることができる。
【００１３】 前記回路ボード１２は、自由選択のＥＥＰＲＯＭモジュール１６を備えること
もできる。さらに、前記回路ボード１２は、協働して遠隔映像インタフェース回
路１９として機能する、音声入出力（Ｉ／Ｏ）モジュール２０（例えばマイクロ
フォンあるいはスピーカに接続される）を有する単独のプロセッサ・メモリ・モ
ジュール１８（例えばＳＣＲＡＭやＤＲＡＭなど）と、モデム及び／又はネット
ワーク・インタフェース（例えばＬＡＮ、つまりローカル・エリア・ネットワー
ク・インタフェース）モジュール２２とを備えることもできる。
もできる。さらに、前記回路ボード１２は、協働して遠隔映像インタフェース回
路１９として機能する、音声入出力（Ｉ／Ｏ）モジュール２０（例えばマイクロ
フォンあるいはスピーカに接続される）を有する単独のプロセッサ・メモリ・モ
ジュール１８（例えばＳＣＲＡＭやＤＲＡＭなど）と、モデム及び／又はネット
ワーク・インタフェース（例えばＬＡＮ、つまりローカル・エリア・ネットワー
ク・インタフェース）モジュール２２とを備えることもできる。
【００１４】 １つの稼動中の構成においては、映像入力回路構成要素２４が、単一あるいは
選択された映像信号ソースからディジタル映像信号２６を受信する。「Ｈ．２６
３」は、国際電気通信連合（ＩＴＵ）によって確立された映像圧縮／解凍標準で
ある。Ｈ．２６３符号化回路構成要素３４は、メモリ制御回路構成要素３０に対
し、映像メモリ・モジュール１５から送信された蓄積ディジタル映像データを転
送するように指示する。メモリ制御回路構成要素３０は、外部から受信した蓄積
映像データをメモリ・バス３２に沿って送出する。Ｈ．２６３符号化回路構成要
素３４は、自身が蓄積ディジタル映像データを符号化（つまり圧縮）する際に、
現在符号化されたディジタル映像データを、遠隔ステーション（図示せず）への
転送のために、モデムあるいはネットワーク・モジュール２２に渡し、遠隔ステ
ーションにおいては、ディジタル映像データが解読され、その後ユーザによって
、観察するために表示される。遠隔ステーションは、ここで説明された創意的な
テレビ会議インタフェースを備えることができる、あるいは従来のテレビ会議シ
ステム・インタフェースを備えることもできる。
選択された映像信号ソースからディジタル映像信号２６を受信する。「Ｈ．２６
３」は、国際電気通信連合（ＩＴＵ）によって確立された映像圧縮／解凍標準で
ある。Ｈ．２６３符号化回路構成要素３４は、メモリ制御回路構成要素３０に対
し、映像メモリ・モジュール１５から送信された蓄積ディジタル映像データを転
送するように指示する。メモリ制御回路構成要素３０は、外部から受信した蓄積
映像データをメモリ・バス３２に沿って送出する。Ｈ．２６３符号化回路構成要
素３４は、自身が蓄積ディジタル映像データを符号化（つまり圧縮）する際に、
現在符号化されたディジタル映像データを、遠隔ステーション（図示せず）への
転送のために、モデムあるいはネットワーク・モジュール２２に渡し、遠隔ステ
ーションにおいては、ディジタル映像データが解読され、その後ユーザによって
、観察するために表示される。遠隔ステーションは、ここで説明された創意的な
テレビ会議インタフェースを備えることができる、あるいは従来のテレビ会議シ
ステム・インタフェースを備えることもできる。
【００１５】 解読されたディジタル映像データが、モデムあるいはネットワーク２２を介し
て、遠隔ステーションあるいは別のステーションに、転送されるあるいは受信さ
れる。前記モデムあるいはネットワーク２２は、データの送受信を行う。モデム
が使用された場合には、信号が変調及び／又は復調され、電話回線あるいは電話
回線に同等な回線などの適切な回線を介して転送される。また、それに代わって
、映像信号の転送を提供するために構成されたネットワーク配線配置を介して、
信号を転送することもできる。
て、遠隔ステーションあるいは別のステーションに、転送されるあるいは受信さ
れる。前記モデムあるいはネットワーク２２は、データの送受信を行う。モデム
が使用された場合には、信号が変調及び／又は復調され、電話回線あるいは電話
回線に同等な回線などの適切な回線を介して転送される。また、それに代わって
、映像信号の転送を提供するために構成されたネットワーク配線配置を介して、
信号を転送することもできる。
【００１６】 モデム、ネットワークあるいはそのほかの何らかの実在を介して、遠隔地から
受信したデータは、プロセッサ回路構成要素４０を介して、バス制御回路構成要
素３６に送られる。バス制御回路構成要素３６は、このデータをデータ・バス３
８を介して、データうぃか意毒するためにＨ．２６３解読回路構成要素４２に渡
す。Ｈ．２６３解読回路構成要素４２は、ディジタル映像データを解読した後に
、解読済みディジタル映像データをＤＲＡＭ１４内に記憶されるために、メモリ
・バス３２を介してメモリ制御回路構成要素３０に転送する。それから、映像出
力回路構成要素４４はメモリ制御回路構成要素３０に対し、ＤＲＡＭ１４から記
憶済みディジタル映像データを引き出すように指示する。引き出されたデータが
、映像出力回路構成要素４４によってディジタル形式で出力され、映像出力回路
構成要素４４から映像信号を受信するように接続された、選択された映像表示装
置（図示せず）によって表示される。
受信したデータは、プロセッサ回路構成要素４０を介して、バス制御回路構成要
素３６に送られる。バス制御回路構成要素３６は、このデータをデータ・バス３
８を介して、データうぃか意毒するためにＨ．２６３解読回路構成要素４２に渡
す。Ｈ．２６３解読回路構成要素４２は、ディジタル映像データを解読した後に
、解読済みディジタル映像データをＤＲＡＭ１４内に記憶されるために、メモリ
・バス３２を介してメモリ制御回路構成要素３０に転送する。それから、映像出
力回路構成要素４４はメモリ制御回路構成要素３０に対し、ＤＲＡＭ１４から記
憶済みディジタル映像データを引き出すように指示する。引き出されたデータが
、映像出力回路構成要素４４によってディジタル形式で出力され、映像出力回路
構成要素４４から映像信号を受信するように接続された、選択された映像表示装
置（図示せず）によって表示される。
【００１７】 代わりになるべきものとして、詳細を後述するように、付属されているコンピ
ュータ・システムからの直列ディジタル映像データあるいは直列制御信号を、高
速直列インタフェース回路構成要素４６を介して、入力あるいは出力することが
できる。
ュータ・システムからの直列ディジタル映像データあるいは直列制御信号を、高
速直列インタフェース回路構成要素４６を介して、入力あるいは出力することが
できる。
【００１８】 サポート回路構成要素４８は、一定の「ハウスキーピング」及び制御機能を実
行する。サポート回路構成要素４８は、周知のＩ２Ｃバス５０を介してＥＥＰＲ
ＯＭモジュール１６と相互に作用し、割り込み信号ＩＮＴ及びリセット信号ＲＳ
Ｔを処理し、さらに、プログラマブルＩ／ＯピンＰＩＯ（図示せず）の配列のプ
ログラミングを行う。
行する。サポート回路構成要素４８は、周知のＩ２Ｃバス５０を介してＥＥＰＲ
ＯＭモジュール１６と相互に作用し、割り込み信号ＩＮＴ及びリセット信号ＲＳ
Ｔを処理し、さらに、プログラマブルＩ／ＯピンＰＩＯ（図示せず）の配列のプ
ログラミングを行う。
【００１９】 ＥＥＰＲＯＭモジュール１６は、プロセッサ回路構成要素４０の演算用のマシ
ン・コードを記憶するために、使用されることができる。前記マシン・コードは
、スタートアップ時に、プロセッサ回路構成要素４０による通常動作時の使用の
ために、比較的遅いＥＥＰＲＯＭモジュール１６から比較的速いプロセッサ・メ
モリ装置１８に転送されることができる。
ン・コードを記憶するために、使用されることができる。前記マシン・コードは
、スタートアップ時に、プロセッサ回路構成要素４０による通常動作時の使用の
ために、比較的遅いＥＥＰＲＯＭモジュール１６から比較的速いプロセッサ・メ
モリ装置１８に転送されることができる。
【００２０】 図２に示す本発明のシステムは、映像入力手段１１によって供給される複数の
映像入力オプションを組み込み、その出力は、入力映像信号２６として供給され
る。ここでは入力手段１１を、二つあるいはそれ以上の映像信号ソースを含むも
のとして示している。図２に示されたソースは、内部ディジタル・カメラ５２、
内部ＮＴＳＣあるいはＰＡＬビデオ・カメラ５６、外部ＮＴＳＣあるいはＰＡＬ
ビデオ・カメラ５８を含む。入力は外部高速直列カメラ６０からの入力であって
も良い。高速直列カメラ６０は、図２に入力手段１１から離して示されているが
、入力手段１１に組み込まれる、あるいはデータ・バス３８に入力信号を供給す
るように独立して適当な場所に配置されることができる。
映像入力オプションを組み込み、その出力は、入力映像信号２６として供給され
る。ここでは入力手段１１を、二つあるいはそれ以上の映像信号ソースを含むも
のとして示している。図２に示されたソースは、内部ディジタル・カメラ５２、
内部ＮＴＳＣあるいはＰＡＬビデオ・カメラ５６、外部ＮＴＳＣあるいはＰＡＬ
ビデオ・カメラ５８を含む。入力は外部高速直列カメラ６０からの入力であって
も良い。高速直列カメラ６０は、図２に入力手段１１から離して示されているが
、入力手段１１に組み込まれる、あるいはデータ・バス３８に入力信号を供給す
るように独立して適当な場所に配置されることができる。
【００２１】 「内部」カメラ５２は、そのレンズ及びインタフェース制御が本システムの囲
い込み（ｅｎｃｌｏｓｕｒｅ）の内部に取り付けられているカメラを意味し、「
外部」カメラは、映像解読器５４であり得るコネクタというインタフェースを介
して接続されるカメラを意味する。
い込み（ｅｎｃｌｏｓｕｒｅ）の内部に取り付けられているカメラを意味し、「
外部」カメラは、映像解読器５４であり得るコネクタというインタフェースを介
して接続されるカメラを意味する。
【００２２】 より具体的に説明すると、図２に示すように、ディジタル映像信号２６は、内
部ディジタル・カメラ５２によって生成されることができ、あるいは、内部ＮＴ
ＳＣまたはＰＡＬカメラ５６、もしくは外部ＮＴＳＣまたはＰＡＬカメラ５８か
らのアナログＮＴＳＣまたはＰＡＬ信号を、ディジタル映像信号２６に変換する
、映像解読器モジュール５４によって生成されることができる。代わりになるべ
きものとして、あるいはそれに加えて、ファイアワイヤあるいはＵＳＢポート等
の高速直列出力を有するディジタル・カメラ６０は、後続の処理及びデータ・バ
ス３８への転送のために、直列ディジタル映像信号を高速直列インタフェース４
６に出力することができる。
部ディジタル・カメラ５２によって生成されることができ、あるいは、内部ＮＴ
ＳＣまたはＰＡＬカメラ５６、もしくは外部ＮＴＳＣまたはＰＡＬカメラ５８か
らのアナログＮＴＳＣまたはＰＡＬ信号を、ディジタル映像信号２６に変換する
、映像解読器モジュール５４によって生成されることができる。代わりになるべ
きものとして、あるいはそれに加えて、ファイアワイヤあるいはＵＳＢポート等
の高速直列出力を有するディジタル・カメラ６０は、後続の処理及びデータ・バ
ス３８への転送のために、直列ディジタル映像信号を高速直列インタフェース４
６に出力することができる。
【００２３】 図２のＡＳＩＣ１０は、ＤＲＡＭ１４及びメモリ制御３０を有するメモリ手段
１５を備えるように構成される。メモリ制御回路構成要素３０は、メモリ・バス
３２からのディジタル映像信号２６を、記憶のためにＤＲＡＭ１４に転送し、ま
た、映像処理手段３５に処理される前に行う圧縮のためにＨ．２６３符号化モジ
ュール３４にも転送する。映像処理手段３５はプロセッサ４０と、サポート回路
４８と、バス制御３６とを備える。また、映像処理手段３５は、プロセッサ・メ
モリ１８と、必要に応じてＥＥＰＲＯＭ１６とをも備える。
１５を備えるように構成される。メモリ制御回路構成要素３０は、メモリ・バス
３２からのディジタル映像信号２６を、記憶のためにＤＲＡＭ１４に転送し、ま
た、映像処理手段３５に処理される前に行う圧縮のためにＨ．２６３符号化モジ
ュール３４にも転送する。映像処理手段３５はプロセッサ４０と、サポート回路
４８と、バス制御３６とを備える。また、映像処理手段３５は、プロセッサ・メ
モリ１８と、必要に応じてＥＥＰＲＯＭ１６とをも備える。
【００２４】 映像処理手段３５は、より具体的にプロセッサ回路構成要素４０は、符号化済
みディジタル映像データを遠隔インタフェース回路１９に転送するように指示す
る。遠隔インタフェース回路１９は、遠隔ソースとの間に、テレビ会議信号を送
受信する任意の適切な回路である。つまり、遠隔インタフェース回路１９は、映
像信号及び好ましくは音声信号を遠隔ソースから受信し、テレビ会議と呼ばれる
効果をもたらすように構成される。出て行く映像信号及び音声信号は、遠隔地に
送られ、理想的にその遠隔地には、前記ＡＳＩＣによって処理されるために、ま
た選択された映像表示あるいは出力装置に映像信号として表示されるために、同
様の映像信号及び音声信号が返される。ここで説明した遠隔インタフェース手段
１９はモデム２２と音声回路２０とを備える。
みディジタル映像データを遠隔インタフェース回路１９に転送するように指示す
る。遠隔インタフェース回路１９は、遠隔ソースとの間に、テレビ会議信号を送
受信する任意の適切な回路である。つまり、遠隔インタフェース回路１９は、映
像信号及び好ましくは音声信号を遠隔ソースから受信し、テレビ会議と呼ばれる
効果をもたらすように構成される。出て行く映像信号及び音声信号は、遠隔地に
送られ、理想的にその遠隔地には、前記ＡＳＩＣによって処理されるために、ま
た選択された映像表示あるいは出力装置に映像信号として表示されるために、同
様の映像信号及び音声信号が返される。ここで説明した遠隔インタフェース手段
１９はモデム２２と音声回路２０とを備える。
【００２５】 図２に示すように、図２の前記ＡＳＩＣ１０は、図１のすべての他の処理回路
構成要素を有するが、同時に重大な相違点は、複数の映像入力配置を、ソフトウ
エア及びハードウエアの結合を使用することにより処理速度及び柔軟性が促進さ
れる映像入力手段１１から、受け入れることができる。
構成要素を有するが、同時に重大な相違点は、複数の映像入力配置を、ソフトウ
エア及びハードウエアの結合を使用することにより処理速度及び柔軟性が促進さ
れる映像入力手段１１から、受け入れることができる。
【００２６】 図３に示す他の実施形態において、本発明のシステムは、ＮＴＳＣ／ＰＡＬ６
８、映像変調器６２、ＬＣＤ７２、ＲＧＢ７１を含むそれぞれの映像出力オプシ
ョンのいずれかと、高速直列インタフェース４６を介して導体７３に接続さる遠
隔装置とを統合することも可能である。
８、映像変調器６２、ＬＣＤ７２、ＲＧＢ７１を含むそれぞれの映像出力オプシ
ョンのいずれかと、高速直列インタフェース４６を介して導体７３に接続さる遠
隔装置とを統合することも可能である。
【００２７】 より具体的に説明すると、図３に示すように、映像出力回路構成要素４４のデ
ィジタル映像出力は、映像出力回路構成要素４４からのディジタル映像出力を変
調されたアナログ信号６４に変換するために、ここで示されるように映像変調器
モジュール６２を有する映像出力手段４３に供給されることが可能である。その
後、前記アナログ信号は、ＴＶチャンネル（例えばチャンネル「３」）からモニ
タ６８への出力とするために、ケーブル・マルチプレクサ・モジュール６６によ
って多重送信される。代わりになるべきものとして、映像出力回路構成要素４４
のディジタル映像出力は、映像符号器モジュール７０によって、モニタ６８の専
用ポートへの入力に適したＮＴＳＣあるいはＰＡＬアナログ・フォーマットに変
換されることが可能であり、あるいはＬＣＤスクリーン７２用のＬＣＤフォーマ
ット信号に変換されることも可能である。さらに、また別の選択肢として、映像
符号器モジュール７０は、映像出力回路構成要素４４からのディジタル映像出力
を、コンピュータ・モニタ（図示せず）に対する直接の適用に適したＲＧＢ信号
７１に変換することができる。
ィジタル映像出力は、映像出力回路構成要素４４からのディジタル映像出力を変
調されたアナログ信号６４に変換するために、ここで示されるように映像変調器
モジュール６２を有する映像出力手段４３に供給されることが可能である。その
後、前記アナログ信号は、ＴＶチャンネル（例えばチャンネル「３」）からモニ
タ６８への出力とするために、ケーブル・マルチプレクサ・モジュール６６によ
って多重送信される。代わりになるべきものとして、映像出力回路構成要素４４
のディジタル映像出力は、映像符号器モジュール７０によって、モニタ６８の専
用ポートへの入力に適したＮＴＳＣあるいはＰＡＬアナログ・フォーマットに変
換されることが可能であり、あるいはＬＣＤスクリーン７２用のＬＣＤフォーマ
ット信号に変換されることも可能である。さらに、また別の選択肢として、映像
符号器モジュール７０は、映像出力回路構成要素４４からのディジタル映像出力
を、コンピュータ・モニタ（図示せず）に対する直接の適用に適したＲＧＢ信号
７１に変換することができる。
【００２８】 本発明のシステムは、図３に示されていない別途の映像手段４７に接続される
高速直列インタフェース４６の特定な使用を通して、構成あるいは修正されるこ
とができる。前記映像手段４７（図４）は、映像入力及び／又は映像出力のため
に使用することができる。それに加えて、前記映像手段４７は周辺装置あるいは
遠隔装置として、本システムを別の調節器に連結するように使用されることがで
きる。この調節器は、例えばケーブル・ボックス、セットトップ・ボックス、パ
ーソナル・コンピュータ、あるいは任意数の汎用または特定タスク調節器装置と
することができる。同様に、その調節器によって、本システムを孤立している（
ｓｔａｎｄ−ａｌｏｎｅ）テレビ会議装置あるいはテレビ電話に直接かつ容易に
統合することも許される。
高速直列インタフェース４６の特定な使用を通して、構成あるいは修正されるこ
とができる。前記映像手段４７（図４）は、映像入力及び／又は映像出力のため
に使用することができる。それに加えて、前記映像手段４７は周辺装置あるいは
遠隔装置として、本システムを別の調節器に連結するように使用されることがで
きる。この調節器は、例えばケーブル・ボックス、セットトップ・ボックス、パ
ーソナル・コンピュータ、あるいは任意数の汎用または特定タスク調節器装置と
することができる。同様に、その調節器によって、本システムを孤立している（
ｓｔａｎｄ−ａｌｏｎｅ）テレビ会議装置あるいはテレビ電話に直接かつ容易に
統合することも許される。
【００２９】 より具体的に説明すると、図４に示すように、図示されたＡＳＩＣ１０は、直
列ディジタル映像データ７１を映像手段４７に出力する高速直列インタフェース
回路４６（例えばファイアワイヤあるいはＵＳＢポート）を有する。前記映像手
段４７は、電話システム７６あるいはモニタ６８のような別途のモニタとのイン
タフェースになるモデム付き調節器を有することができる。
列ディジタル映像データ７１を映像手段４７に出力する高速直列インタフェース
回路４６（例えばファイアワイヤあるいはＵＳＢポート）を有する。前記映像手
段４７は、電話システム７６あるいはモニタ６８のような別途のモニタとのイン
タフェースになるモデム付き調節器を有することができる。
【００３０】 図５に示すように、映像入力回路構成要素２４は、ディジタル映像信号２６及
びデータ・バス３８からの直列ディジタル映像データを受信する入力構成回路構
成要素７８を備える。バス制御回路構成要素３６（図２参照）によってセットさ
れる制御レジスタ回路構成要素８０は、入力構成回路構成要素７８に、信号２６
または４：２：２のＹＵＶフォーマットを有しかつデータ・バス３８からのデー
タのいずれかを、選択または出力させる。その後、ピクセル・デシメーション回
路構成要素８２は出力信号の「カラー」成分を減らし、その結果、４：１：１の
ＹＵＶフォーマットを有する信号を出力することによって信号のデータ密度が下
げられた。その後、メモリ・バス３２を介してメモリ手段１５に転送される前に
、先入れ先出し（ＦＩＦＯ）バッファ８４はこの出力信号を保持する。
びデータ・バス３８からの直列ディジタル映像データを受信する入力構成回路構
成要素７８を備える。バス制御回路構成要素３６（図２参照）によってセットさ
れる制御レジスタ回路構成要素８０は、入力構成回路構成要素７８に、信号２６
または４：２：２のＹＵＶフォーマットを有しかつデータ・バス３８からのデー
タのいずれかを、選択または出力させる。その後、ピクセル・デシメーション回
路構成要素８２は出力信号の「カラー」成分を減らし、その結果、４：１：１の
ＹＵＶフォーマットを有する信号を出力することによって信号のデータ密度が下
げられた。その後、メモリ・バス３２を介してメモリ手段１５に転送される前に
、先入れ先出し（ＦＩＦＯ）バッファ８４はこの出力信号を保持する。
【００３１】 図６に示すように、バス制御回路構成要素３６は、データ・バス３８（「バッ
クボーン」としても知られる）からのデータを受信するためのボーン・インタフ
ェース回路構成要素８６と、プロセッサ回路構成要素４０（図４参照）と通信す
るプロセッサ・インタフェース回路構成要素８８とを備える。仲裁及び制御回路
構成要素９０は、所定の時点で能動なインタフェース回路構成要素８６と８８の
うちのいずれかを選択し、ホスト・インタフェース回路構成要素９２は、選択さ
れたインタフェース回路構成要素８６あるいは８８との間にデータを内部的に送
受信する。ホスト・インタフェース回路構成要素９２からのデータは、データ・
インタフェース制御回路構成要素９４に移され、同時に、レジスタ情報は、レジ
スタ・インタフェース制御回路構成要素９６に移される。前記回路構成要素９４
及び９６のいずれも、ファイアワイヤあるいはＵＳＢ直列−並列回路構成要素の
ような第三者モジュール回路構成要素９８と通信を行う。
クボーン」としても知られる）からのデータを受信するためのボーン・インタフ
ェース回路構成要素８６と、プロセッサ回路構成要素４０（図４参照）と通信す
るプロセッサ・インタフェース回路構成要素８８とを備える。仲裁及び制御回路
構成要素９０は、所定の時点で能動なインタフェース回路構成要素８６と８８の
うちのいずれかを選択し、ホスト・インタフェース回路構成要素９２は、選択さ
れたインタフェース回路構成要素８６あるいは８８との間にデータを内部的に送
受信する。ホスト・インタフェース回路構成要素９２からのデータは、データ・
インタフェース制御回路構成要素９４に移され、同時に、レジスタ情報は、レジ
スタ・インタフェース制御回路構成要素９６に移される。前記回路構成要素９４
及び９６のいずれも、ファイアワイヤあるいはＵＳＢ直列−並列回路構成要素の
ような第三者モジュール回路構成要素９８と通信を行う。
【００３２】 図７に示すように、映像出力回路構成要素４４は、メモリ制御回路構成要素３
０（図１参照）に対し、映像メモリ・モジュール１４（図１参照）からの適宜な
シーケンスに従ってディジタル映像データを自分に供給するように指示するメモ
リ制御／シーケンサ回路構成要素１００を備える。その後、線記憶回路構成要素
１０２は、２本線の映像データが記憶されるまでに映像データを記憶するための
バッファとして作用する。その後、補間（インタポレ−タ）回路構成要素１０４
は、受信した各２本線の映像データの間を補間することによって、ピクセル・デ
シメーション回路構成要素８２（図５参照）の動作を逆転させる処理を行い、４
：２：２のＹＵＶ信号を生成する。次に、記憶ＦＩＦＯバッファ１０６は補間済
みの映像データを記憶し、さらに、バス制御回路構成要素３６（図１参照）によ
って制御される制御レジスタ回路構成要素１０８は、符号器制御回路構成要素１
１０に記憶済みの映像データを出力させるが、状況に応じてそれを行わないこと
もある。同時に、記憶済みの映像データは、高速直列インタフェース回路構成要
素４６（図１参照）による使用のために、データ・バス３８を介してバス・コン
トロール回路３６（図１参照）に供給される。
０（図１参照）に対し、映像メモリ・モジュール１４（図１参照）からの適宜な
シーケンスに従ってディジタル映像データを自分に供給するように指示するメモ
リ制御／シーケンサ回路構成要素１００を備える。その後、線記憶回路構成要素
１０２は、２本線の映像データが記憶されるまでに映像データを記憶するための
バッファとして作用する。その後、補間（インタポレ−タ）回路構成要素１０４
は、受信した各２本線の映像データの間を補間することによって、ピクセル・デ
シメーション回路構成要素８２（図５参照）の動作を逆転させる処理を行い、４
：２：２のＹＵＶ信号を生成する。次に、記憶ＦＩＦＯバッファ１０６は補間済
みの映像データを記憶し、さらに、バス制御回路構成要素３６（図１参照）によ
って制御される制御レジスタ回路構成要素１０８は、符号器制御回路構成要素１
１０に記憶済みの映像データを出力させるが、状況に応じてそれを行わないこと
もある。同時に、記憶済みの映像データは、高速直列インタフェース回路構成要
素４６（図１参照）による使用のために、データ・バス３８を介してバス・コン
トロール回路３６（図１参照）に供給される。
【００３３】 図２あるいは図３に示すシステムは、以下に述べる装置に限ったものではない
が、カメラあるいはテレビ会議用のＰＣ周辺装置；カメラあるいはテレビ会議用
のケーブル・ボックス周辺装置；及び監視システム用の遠隔カメラを備えるそれ
ぞれ異なる装置として、容易かつ廉価に構成されることが可能である。それに加
えて、図２あるいは図３の回路を有するシステムは、別のハードウエアに統合さ
せ、あるいは密に結合させることにより、以下に限ったものではないが、セット
トップ・ボックス・テレビ会議システム；ケーブル・ボックス・テレビ会議シス
テム；及びテレビ電話を備える別の装置を作り出すことが可能である。
が、カメラあるいはテレビ会議用のＰＣ周辺装置；カメラあるいはテレビ会議用
のケーブル・ボックス周辺装置；及び監視システム用の遠隔カメラを備えるそれ
ぞれ異なる装置として、容易かつ廉価に構成されることが可能である。それに加
えて、図２あるいは図３の回路を有するシステムは、別のハードウエアに統合さ
せ、あるいは密に結合させることにより、以下に限ったものではないが、セット
トップ・ボックス・テレビ会議システム；ケーブル・ボックス・テレビ会議シス
テム；及びテレビ電話を備える別の装置を作り出すことが可能である。
【００３４】 当然のことながら、図２〜図７に示されたシステムが、転送あるいは受信ステ
ーションであり、あるいは大部分のテレビ会議システムにおいてのより高い可能
性としてはその両者であり得ることを理解する必要がある。
ーションであり、あるいは大部分のテレビ会議システムにおいてのより高い可能
性としてはその両者であり得ることを理解する必要がある。
【００３５】 なお、ここに説明され又は記述された実施形態は、特許請求の範囲に定義され
る本発明の範囲を限定するものではない。
る本発明の範囲を限定するものではない。
【図１】 映像信号の処理における使用に適した従来技術の基本的なＡＳＩＣを示すブロ
ック図である。
ック図である。
【図２】 本発明の映像システムの一形態における使用に適したＡＳＩＣのブロック図で
ある。
ある。
【図３】 本発明の映像システムのもう一つの態様における使用に適したＡＳＩＣのブロ
ック図である。
ック図である。
【図４】 本発明の映像システムと共に使用される高速直列インタフェース回路を示すブ
ロック図である。
ロック図である。
【図５】 本発明の映像システムと共に使用されるＡＳＩＣの映像入力ブロックを示すブ
ロック図である。
ロック図である。
【図６】 本発明の映像システムと共に使用されるＡＳＩＣのバス制御ブロックを示すブ
ロック図である。
ロック図である。
【図７】 本発明の映像システムと共に使用されるＡＳＩＣの映像出力ブロックを示すブ
ロック図である。
ロック図である。
【手続補正書】特許協力条約第３４条補正の翻訳文提出書
【提出日】平成１２年８月２３日（２０００．８．２３）
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】特許請求の範囲
【補正方法】変更
【補正内容】
【特許請求の範囲】
【請求項３３】 前記高速直列データ・バス及び前記モデム付き制御器と通信す
るディジタル・ビデオ・カメラをさらに具備することを特徴とする請求項３１に
記載のテレビ会議システム。
るディジタル・ビデオ・カメラをさらに具備することを特徴とする請求項３１に
記載のテレビ会議システム。
【手続補正書】
【提出日】平成１３年８月２４日（２００１．８．２４）
【手続補正１】
【補正対象書類名】図面
【補正対象項目名】全図
【補正方法】変更
【補正内容】
【図１】
【図２】
【図３】
【図４】
【図５】
【図６】
【図７】
───────────────────────────────────────────────────── フロントページの続き (72)発明者 パークエス デーヴィッド アメリカ合衆国 ユタ州 84341 ノース ローガン 1536 イースト 200 ノー ス Ｆターム(参考） 5C064 AC04 AC12 AD01 AD08
Claims (24)
- 【請求項１】 複数の映像入力装置及び１つの映像出力装置と共に使用するため
のテレビ会議回路であって、 前記テレビ会議回路は 複数の映像信号生成装置の１つからの入力映像信号を提供するための映像入力
手段と、 遠隔インタフェース回路と、 映像出力装置と、 前記映像入力手段、前記映像出力装置、及び前記遠隔インタフェース回路に接
続される特定用途向け集積回路（ＡＳＩＣ）とを備え、 前記ＡＳＩＣは 前記複数の映像信号生成装置の１つからの映像入力信号を受信するように前記
映像入力手段に接続された映像入力回路と、 前記映像入力信号を受信するように前記映像入力回路に接続されたメモリ回路
であって、前記映像入力信号を記憶済みデータとして保有かつ転送するように構
成された前記メモリ回路と、 前記記憶済みデータを受信し、かつ、送出すべき圧縮済みデータを形成するた
めに符号化処理により前記記憶済みデータを圧縮するように前記メモリ回路に接
続されたデータ圧縮手段と、 前記送出すべき圧縮済みデータを受信するように接続され、かつ、前記送出す
べき圧縮済みデータを転送し、遠隔ステーションから到来する圧縮済みデータを
受信するように前記遠隔インタフェース回路に接続された映像処理手段であって
、その中に存在する映像信号のフローを制御するように、前記映像入力回路、前
記メモリ回路、前記映像解凍手段、前記映像受信手段、及び前記映像イメージ出
力手段にも接続された前記映像処理手段と、 前記到来する圧縮済みデータを受信するように前記映像処理手段に接続され、
かつ、前記到来する圧縮済みデータを解凍し、そして、前記到来する圧縮済みデ
ータを到来する記憶済みデータに変換するように構成されている前記メモリ回路
に転送するように構成された映像解凍手段と、 前記メモリ回路からの到来する記憶済みデータを受信し、かつ、前記到来する
記憶済みデータを映像イメージ信号として映像表示装置に転送するように接続さ
れた映像イメージ出力手段と、 を備えることを特徴とするテレビ会議回路。 - 【請求項２】 前記遠隔インタフェース回路はモデムを具備することを特徴とす
る請求項１に記載のテレビ会議回路。 - 【請求項３】 前記メモリ回路は、映像入力信号を記憶済みデータに変換し、か
つ、前記到来する圧縮済みデータを到来記憶済みデータに変換するためのメモリ
構造とメモリ制御回路とを具備することを特徴とする請求項１に記載のテレビ会
議回路。 - 【請求項４】 前記メモリ構造は、前記記憶済みデータ及び前記到来する記憶済
みデータを受信し、かつ記憶するように構成されたＤＲＡＭであることを特徴と
する請求項３に記載のテレビ会議回路。 - 【請求項５】 前記映像入力手段は、選択された映像信号を受信し、かつ、前記
選択された映像信号を入力映像信号に変換する映像解読器回路を具備することを
特徴とする請求項１に記載のテレビ会議回路。 - 【請求項６】 前記映像入力回路は、複数の映像入力信号を受信するように接続
された入力構成回路と、 そこからの制御信号を受信するように前記映像処理手段に接続され、かつ、入
力制御信号を供給するように、かつ、前記入力構成回路に前記複数の映像入力信
号の一つを前記映像入力信号として前記メモリ回路に供給する動作を行わせるよ
うに前記入力構成回路に接続された制御レジスタと、 を具備することを特徴とする請求項５に記載のテレビ会議回路。 - 【請求項７】 前記入力構成回路の前記出力は、前記出力信号の密度を低減する
ように動作しかつ映像である出力を記憶・転送するようにバッファに接続された
デシメーション回路に、供給されることを特徴とする請求項６に記載のテレビ会
議回路。 - 【請求項８】 それらの間に制御信号を転送するために、前記映像入力回路、前
記メモリ回路、前記符号化回路、前記解読回路及び前記映像出力回路の間を相互
に接続させるデータ・バスをさらに具備し、前記映像処理手段は、そこに前記制
御信号を供給するように前記データ・バスに接続されたバス制御回路を具備する
ことを特徴とする請求項１に記載のテレビ会議回路。 - 【請求項９】 前記バス制御回路は、前記データ・バスに接続されたボーン・イ
ンタフェース回路を具備し、前記ボーン・インタフェース回路は、前記制御信号
を生成し、生成した前記制御信号を前記データ・バスに供給するように構成され
たことを特徴とする請求項８に記載のテレビ会議回路。 - 【請求項１０】 前記映像処理手段は、 前記遠隔インタフェース回路に接続されたデータ・プロセッサと、 そこにデータを供給するように前記データ・プロセッサに接続されたプロセッ
サ・インタフェースと、 前記プロセッサ・インタフェース及び前記ボーン・インタフェース回路に接続
され、前記ボーン・インタフェース回路と前記プロセッサ・インタフェースのう
ちの一方を選択して能動にするように構成された仲裁及び制御回路と、 前記仲裁及び制御回路に接続されたホスト・インタフェース回路と を具備し、 前記ホスト・インタフェース回路は、前記プロセッサ・インタフェース及び前
記ボーン・インタフェース回路に、データを供給し、そこからデータを受信する
ように構成され、 前記仲裁及び制御回路は、映像イメージの獲得及び表示をするために、外部装
置に映像信号を供給し、そこから映像信号を受信するように接続されたことを特
徴とする請求項９に記載のテレビ会議回路。 - 【請求項１１】 複数の映像出力装置及び１つの映像入力装置と共に使用するた
めのテレビ会議回路であって、 前記テレビ会議回路は 複数の映像出力装置の１つに出力映像信号を提供するための映像出力手段と、 遠隔インタフェース回路と、 映像入力装置と、 前記映像入力装置、前記映像出力手段、及び前記遠隔インタフェース回路に接
続される特定用途向け集積回路（ＡＳＩＣ）とを備え、 前記ＡＳＩＣは 前記映像入力装置からの映像入力信号を受信するように前記映像入力装置に接
続された映像入力回路と、 前記映像入力信号を受信するように前記映像入力回路に接続されたメモリ回路
であって、前記映像入力信号を記憶済みデータとして保有かつ転送するように構
成された前記メモリ回路と、 前記記憶済みデータを受信し、かつ、送出すべき圧縮済みデータを形成するた
めに符号化処理により前記記憶済みデータを圧縮するように前記メモリ回路に接
続されたデータ圧縮手段と、 前記送出すべき圧縮済みデータを受信するように接続され、かつ、前記送出す
べき圧縮済みデータを転送し、遠隔ステーションから到来する圧縮済みデータを
受信するように前記遠隔インタフェース回路に接続された映像処理手段であって
、その中に存在する映像信号のフローを制御するように、前記映像入力回路、前
記メモリ回路、前記映像解凍手段、前記映像受信手段、及び前記映像イメージ出
力手段にも接続された前記映像処理手段と、 前記到来する圧縮済みデータを受信するように前記映像処理手段に接続され、
かつ、前記到来する圧縮済みデータを解凍し、そして、前記到来する圧縮済みデ
ータを到来する記憶済みデータに変換するように構成されている前記メモリ回路
に転送するように構成された映像解凍手段と、 前記メモリ回路からの到来する記憶済みデータを受信し、かつ、前記到来する
記憶済みデータを映像イメージ信号として前記映像出力手段の前記複数の映像出
力装置の１つに転送するように接続された映像イメージ出力回路と を備えることを特徴とするテレビ会議回路。 - 【請求項１２】 前記遠隔インタフェース回路はモデムを具備することを特徴と
する請求項１１に記載のテレビ会議回路。 - 【請求項１３】 前記メモリ回路は、映像入力信号を記憶済みデータに変換し、
かつ、前記到来する圧縮済みデータを到来記憶済みデータに変換するためのメモ
リ構造とメモリ制御回路とを具備することを特徴とする請求項１１に記載のテレ
ビ会議回路。 - 【請求項１４】 前記メモリ構造は、前記記憶済みデータ及び前記到来する記憶
済みデータを受信し、かつ記憶するように構成されたＤＲＡＭであることを特徴
とする請求項１３に記載のテレビ会議回路。 - 【請求項１５】 前記映像入力回路は、 前記映像入力信号を受信するように接続された入力構成回路と、 そこからの制御信号を受信するように前記映像処理手段に接続され、かつ、入
力制御信号を供給するように、かつ、前記入力構成回路に前記映像入力信号を前
記メモリ回路に供給する動作を行わせるように前記入力構成回路に接続された制
御レジスタと、 を具備することを特徴とする請求項１１に記載のテレビ会議回路。 - 【請求項１６】 前記入力構成回路の前記出力は、前記出力信号の密度を低減す
るように動作しかつ映像である出力を記憶・転送するようにバッファに接続され
たデシメーション回路に供給されることを特徴とする請求項１５に記載のテレビ
会議回路。 - 【請求項１７】 それらの間に制御信号を転送するために、前記映像入力回路、
前記メモリ回路、前記符号化回路、前記解読回路及び前記映像出力回路の間を相
互に接続させるデータ・バスをさらに具備し、前記映像処理手段は、そこに前記
制御信号を供給するように前記データ・バスに接続されたバス制御回路を具備す
ることを特徴とする請求項１１に記載のテレビ会議回路。 - 【請求項１８】 前記バス制御回路は、前記データ・バスに接続されたボーン・
インタフェース回路を具備し、前記ボーン・インタフェース回路は、前記制御信
号を生成し、生成した前記制御信号を前記データ・バスに供給するように構成さ
れたことを特徴とする請求項１７に記載のテレビ会議回路。 - 【請求項１９】 前記映像処理手段は、 前記遠隔インタフェース回路に接続されたデータ・プロセッサと、 そこにデータを供給するように前記データ・プロセッサに接続されたプロセッ
サ・インタフェースと、 前記プロセッサ・インタフェース及び前記ボーン・インタフェース回路に接続
され、前記ボーン・インタフェース回路と前記プロセッサ・インタフェースのう
ちの一方を選択して能動にするように構成された仲裁及び制御回路と、 前記仲裁及び制御回路に接続されたホスト・インタフェース回路と を具備し、 前記ホスト・インタフェース回路は、前記プロセッサ・インタフェース及び前
記ボーン・インタフェース回路に、データを供給し、そこからデータを受信する
ように構成され、 前記仲裁及び制御回路がさらに接続されたことを特徴とする請求項１８に記載
のテレビ会議回路。 - 【請求項２０】 前記映像イメージ出力回路は、 前記メモリ回路に接続されたメモリ制御シーケンサであって、前記メモリ回路
に、前記メモリ制御シーケンサに前記到来する記憶済みデータを供給させるため
に、命令を生成し、生成した命令を前記メモリ回路に送るように構成され、さら
に、出力として前記到来する記憶済みデータを供給するように構成された前記メ
モリ制御シーケンサと、 前記メモリ制御シーケンサからの前記到来する記憶済みデータを受信するよう
に接続されたライン・バッファであって、前記到来する記憶済みデータの一本の
映像ラインを第１の映像出力信号とし、かつ、前記記憶済み映像データのもう一
本の映像ラインを第２の映像出力信号として記憶するように構成された前記ライ
ン・バッファと、 前記第１の映像出力信号及び前記第２の映像出力信号を受信し、かつ、補間済
み映像信号を生成するように前記ライン・バッファに接続された補間回路と、 前記補間回路からの前記補間済み映像信号を受信するように前記補間回路に接
続されたバッファと、 前記映像処理制御からの制御信号を受信するように前記データ・バスに接続さ
れ、前記バッファに前記補間済み映像信号を供給させるために、信号を供給する
ように前記バッファに接続された制御レジスタと、 前記バッファからの前記補間済み映像信号を受信するように前記バッファに接
続され、前記補間済み映像信号を前記映像イメージ信号として、前記映像出力手
段の前記複数の映像出力装置の１つに供給させるために、信号を受信するように
前記制御レジスタに接続された符号器と、 を備えることを特徴とする請求項１１に記載のテレビ会議回路。 - 【請求項２１】 複数の映像出力装置及び１つの映像入力装置と共に使用するた
めのテレビ会議回路であって、 前記テレビ会議回路は 複数の映像出力装置の１つからの出力映像信号を提供するための映像出力手段
と、 遠隔インタフェース回路と、 複数の映像信号生成装置の１つからの入力映像信号を提供するための映像入力
手段と、 前記映像入力手段、前記映像出力手段及び前記遠隔インタフェース回路に接続
される特定用途向け集積回路（ＡＳＩＣ）とを備え、 前記ＡＳＩＣは 前記複数の映像信号生成装置の１つからの映像入力信号を受信するように前記
映像入力手段に接続された映像入力回路と、 前記映像入力信号を受信するように前記映像入力回路に接続されたメモリ回路
であって、前記映像入力信号を記憶済みデータとして保有かつ転送するように構
成された前記メモリ回路と、 前記記憶済みデータを受信し、かつ、送出すべき圧縮済みデータを形成するた
めに符号化処理により前記記憶済みデータを圧縮するように前記メモリ回路に接
続されたデータ圧縮手段と、 前記送出すべき圧縮済みデータを受信するように接続され、かつ、前記送出す
べき圧縮済みデータを転送し、遠隔ステーションから到来する圧縮済みデータを
受信するように前記遠隔インタフェース回路に接続された映像処理手段であって
、その中に存在する映像信号のフローを制御するように、前記映像入力回路、前
記メモリ回路、前記映像解凍手段、前記映像受信手段、及び前記映像イメージ出
力手段にも接続された前記映像処理手段と、 前記到来する圧縮済みデータを受信するように前記映像処理手段に接続され、
かつ、前記到来する圧縮済みデータを解凍し、そして、前記到来する圧縮済みデ
ータを到来する記憶済みデータに変換するように構成されている前記メモリ回路
に転送するように構成された映像解凍手段と、 前記メモリ回路からの到来する記憶済みデータを受信し、かつ、前記到来する
記憶済みデータを映像イメージ信号として前記映像出力手段の前記複数の映像出
力装置の１つに転送するように接続された映像イメージ出力回路と を備えることを特徴とするテレビ会議回路。 - 【請求項２２】 複数の映像入力装置及び複数の映像出力装置と共に使用するた
めのテレビ会議回路であって、 前記テレビ会議回路は 複数の映像信号生成装置の１つからの入力映像信号を提供するための映像入力
手段と、 遠隔インタフェース回路と、 複数の映像出力装置の１つに出力映像信号を提供するための映像出力手段と、 前記映像入力手段、前記映像出力装置及び前記遠隔インタフェース回路に接続
される特定用途向け集積回路（ＡＳＩＣ）とを備え、 前記ＡＳＩＣは 複数の単独の映像入力装置の１つからの単独の映像信号フォーマットを有する
前記入力映像信号を受信し、 前記受信したデータを記憶済みデータとして記憶し、 送出すべき圧縮済みデータを生成するために、符号化処理により前記記憶済み
データを圧縮し、 前記遠隔インタフェース回路を介して、前記送出すべき圧縮済みデータを遠隔
ステーションに出力し、 前記遠隔インタフェース回路を介して、遠隔ステーションから到来する圧縮済
みデータを受信し、 解読処理により、前記到来する圧縮済みデータを解凍し、 前記解凍済みデータを記憶し、 前記複数の映像出力装置の１つによる表示のために、前記解凍済みデータを前
記映像出力手段を通じて出力するように、 プログラム可能な手段を備えることを特徴とするテレビ会議回路。 - 【請求項２３】 前記遠隔インタフェース回路はモデムを具備することを特徴と
する請求項２２に記載のテレビ会議回路。 - 【請求項２４】 前記映像入力手段は、選択された映像信号を受信し、かつ、そ
れを入力映像信号に変換する映像解読器回路を具備することを特徴とする請求項
２３に記載のテレビ会議回路。
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