JP2002141807A - 可変長復号化器 - Google Patents
可変長復号化器Info
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- JP2002141807A JP2002141807A JP2000335647A JP2000335647A JP2002141807A JP 2002141807 A JP2002141807 A JP 2002141807A JP 2000335647 A JP2000335647 A JP 2000335647A JP 2000335647 A JP2000335647 A JP 2000335647A JP 2002141807 A JP2002141807 A JP 2002141807A
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- Compression Or Coding Systems Of Tv Signals (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Abstract
(57)【要約】
【課題】 ＤＶ及びＭＰＥＧフォーマットのビットスト
リームの可変長復号化を共通の回路により実現し、以て
双方向フォーマット変換システムの回路規模を低減す
る。 【解決手段】 入力ビットストリームから可変長符号を
切り出すためのバレルシフタ１１０及びバレルシフタ制
御器１６０と、ＤＶフォーマットとＭＰＥＧフォーマッ
トのＡＣ（交流）係数の復号化のための可変長復号化テ
ーブル１２０と、レベル０のランレングスを処理できる
ランレングスデコーダ１５０と、ＭＰＥＧフォーマット
専用のＥＳＣ（エスケープ）処理回路１７０と、各フォ
ーマット用のＤＣ（直流）処理回路１８０と、両フォー
マットのＥＯＢ（エンド・オブ・ブロック）コードをそ
れぞれ保持したＥＯＢ処理回路１９０とを設ける。
リームの可変長復号化を共通の回路により実現し、以て
双方向フォーマット変換システムの回路規模を低減す
る。 【解決手段】 入力ビットストリームから可変長符号を
切り出すためのバレルシフタ１１０及びバレルシフタ制
御器１６０と、ＤＶフォーマットとＭＰＥＧフォーマッ
トのＡＣ（交流）係数の復号化のための可変長復号化テ
ーブル１２０と、レベル０のランレングスを処理できる
ランレングスデコーダ１５０と、ＭＰＥＧフォーマット
専用のＥＳＣ（エスケープ）処理回路１７０と、各フォ
ーマット用のＤＣ（直流）処理回路１８０と、両フォー
マットのＥＯＢ（エンド・オブ・ブロック）コードをそ
れぞれ保持したＥＯＢ処理回路１９０とを設ける。
Description
【０００１】
【発明の属する技術分野】本発明は、互いに異なるフォ
ーマットで圧縮符号化された複数のビットストリームの
デコードに共通に用いられる可変長復号化器に関するも
のである。
ーマットで圧縮符号化された複数のビットストリームの
デコードに共通に用いられる可変長復号化器に関するも
のである。
【０００２】
【従来の技術】近年、デジタルビデオ圧縮技術の普及に
より、様々な記録メディアがデジタル化されている。
より、様々な記録メディアがデジタル化されている。
【０００３】磁気テープにビデオ情報を記録するビデオ
ムービー系の機器、例えばビデオカセットレコーダ（Ｖ
ＣＲ）、デジタルビデオカメラ（ＤＶＣ）では、ＤＣＴ
（離散コサイン変換）によるフレーム内の空間的な冗長
度の削減と、可変長符号化による符号量の削減とを組み
合わせた圧縮技術が採用されている。このような圧縮技
術を盛り込んだ規格の１つとして、１９９６年にＨＤデ
ジタルＶＣＲ協議会により制定されたＤＶ規格"Specifi
cations of Consumer-Use Digital VCRs Using6.3mm Ma
gnetic Tape"が知られている。そのほか、ＤＶＣ、ＤＶ
ＣＰＲＯ、ＤＶｃａｍ等の規格がある。本願では、これ
らビデオムービー系の規格に基づく圧縮符号化フォーマ
ットを総じて「ＤＶフォーマット」という。
ムービー系の機器、例えばビデオカセットレコーダ（Ｖ
ＣＲ）、デジタルビデオカメラ（ＤＶＣ）では、ＤＣＴ
（離散コサイン変換）によるフレーム内の空間的な冗長
度の削減と、可変長符号化による符号量の削減とを組み
合わせた圧縮技術が採用されている。このような圧縮技
術を盛り込んだ規格の１つとして、１９９６年にＨＤデ
ジタルＶＣＲ協議会により制定されたＤＶ規格"Specifi
cations of Consumer-Use Digital VCRs Using6.3mm Ma
gnetic Tape"が知られている。そのほか、ＤＶＣ、ＤＶ
ＣＰＲＯ、ＤＶｃａｍ等の規格がある。本願では、これ
らビデオムービー系の規格に基づく圧縮符号化フォーマ
ットを総じて「ＤＶフォーマット」という。
【０００４】光ディスクにビデオ情報を記録する蓄積メ
ディア系の機器、例えばデジタルビデオディスク（ＤＶ
Ｄ）では、動き補償によるフレーム間の時間的な冗長度
の削減と、ＤＣＴによるフレーム内の空間的な冗長度の
削減と、可変長符号化による符号量の削減とを組み合わ
せた圧縮技術が採用されている。このような圧縮技術を
盛り込んだ規格の１つとして、１９９４年に制定された
ＭＰＥＧ２規格ISO/IEC 13818-2 "Information Technol
ogy - Generic Coding of Moving Pictures and Associ
ated Audio"が知られている。そのほか、ＭＰＥＧ１等
の規格がある。本願では、これら蓄積メディア系の規格
に基づく圧縮符号化フォーマットを総じて「ＭＰＥＧフ
ォーマット」という。特開平１１−３１９７３号公報に
は、ＭＰＥＧエンコーダ及びＭＰＥＧデコーダの例が示
されている。
ディア系の機器、例えばデジタルビデオディスク（ＤＶ
Ｄ）では、動き補償によるフレーム間の時間的な冗長度
の削減と、ＤＣＴによるフレーム内の空間的な冗長度の
削減と、可変長符号化による符号量の削減とを組み合わ
せた圧縮技術が採用されている。このような圧縮技術を
盛り込んだ規格の１つとして、１９９４年に制定された
ＭＰＥＧ２規格ISO/IEC 13818-2 "Information Technol
ogy - Generic Coding of Moving Pictures and Associ
ated Audio"が知られている。そのほか、ＭＰＥＧ１等
の規格がある。本願では、これら蓄積メディア系の規格
に基づく圧縮符号化フォーマットを総じて「ＭＰＥＧフ
ォーマット」という。特開平１１−３１９７３号公報に
は、ＭＰＥＧエンコーダ及びＭＰＥＧデコーダの例が示
されている。
【０００５】ＤＶフォーマットとＭＰＥＧフォーマット
との間には、カラーコンポーネント形式、ＥＳＣ（エス
ケープ）処理の要否、ＤＣＴ係数中のＤＣ（直流）係数
の取り扱い等の種々の点において差異がある。したがっ
て、両者間のフォーマット変換が要望されている。
との間には、カラーコンポーネント形式、ＥＳＣ（エス
ケープ）処理の要否、ＤＣＴ係数中のＤＣ（直流）係数
の取り扱い等の種々の点において差異がある。したがっ
て、両者間のフォーマット変換が要望されている。
【０００６】特開平１０−３０４４０１号公報や特開平
１１−１１２９７３号公報には、ＤＶフォーマットから
ＭＰＥＧフォーマットへのデータ変換の例が示されてい
る。これらの例によれば、ＤＶフォーマットで圧縮符号
化されたビットストリームを一旦ＤＶデコーダでデコー
ドし、このデコードの結果をＭＰＥＧエンコーダで処理
することにより、ＭＰＥＧフォーマットで圧縮符号化さ
れたビットストリームを得る。
１１−１１２９７３号公報には、ＤＶフォーマットから
ＭＰＥＧフォーマットへのデータ変換の例が示されてい
る。これらの例によれば、ＤＶフォーマットで圧縮符号
化されたビットストリームを一旦ＤＶデコーダでデコー
ドし、このデコードの結果をＭＰＥＧエンコーダで処理
することにより、ＭＰＥＧフォーマットで圧縮符号化さ
れたビットストリームを得る。
【０００７】ＭＰＥＧフォーマットからＤＶフォーマッ
トへのデータ変換の場合には、ＭＰＥＧフォーマットで
圧縮符号化されたビットストリームを一旦ＭＰＥＧデコ
ーダでデコードし、このデコードの結果をＤＶエンコー
ダで処理することにより、ＤＶフォーマットで圧縮符号
化されたビットストリームが得られる。
トへのデータ変換の場合には、ＭＰＥＧフォーマットで
圧縮符号化されたビットストリームを一旦ＭＰＥＧデコ
ーダでデコードし、このデコードの結果をＤＶエンコー
ダで処理することにより、ＤＶフォーマットで圧縮符号
化されたビットストリームが得られる。
【０００８】
【発明が解決しようとする課題】上記従来技術によれ
ば、ＤＶフォーマットとＭＰＥＧフォーマットとの間の
相互変換を達成できるシステムを構築しようとすると、
ＤＶデコーダ及びＭＰＥＧデコーダを用意しなければな
らない。つまり、ＤＶフォーマットで圧縮符号化された
ビットストリームのデコードに用いられる可変長復号化
器と、ＭＰＥＧフォーマットで圧縮符号化されたビット
ストリームのデコードに用いられる可変長復号化器とを
別々に用意していたので、フォーマット変換システムの
回路規模が大きくなってしまうという課題があった。
ば、ＤＶフォーマットとＭＰＥＧフォーマットとの間の
相互変換を達成できるシステムを構築しようとすると、
ＤＶデコーダ及びＭＰＥＧデコーダを用意しなければな
らない。つまり、ＤＶフォーマットで圧縮符号化された
ビットストリームのデコードに用いられる可変長復号化
器と、ＭＰＥＧフォーマットで圧縮符号化されたビット
ストリームのデコードに用いられる可変長復号化器とを
別々に用意していたので、フォーマット変換システムの
回路規模が大きくなってしまうという課題があった。
【０００９】本発明の目的は、互いに異なるフォーマッ
トで圧縮符号化された複数のビットストリームのデコー
ドに共通に用いられる可変長復号化器を提供し、以て双
方向フォーマット変換システムの回路規模を低減するこ
とにある。
トで圧縮符号化された複数のビットストリームのデコー
ドに共通に用いられる可変長復号化器を提供し、以て双
方向フォーマット変換システムの回路規模を低減するこ
とにある。
【００１０】
【課題を解決するための手段】上記目的を達成するた
め、本発明は、各フォーマットで圧縮符号化された可変
長符号から、その符号長、ランレングス及びレベルを求
めるための可変長復号化テーブルと、レベル０のランレ
ングスを許容して、与えられたランレングスの数だけ０
を出力し、かつ与えられたレベルを出力することによ
り、前記可変長符号に対応した可変長復号化データを出
力するためのランレングスデコーダとを備えた可変長復
号化器の構成を採用したものである。
め、本発明は、各フォーマットで圧縮符号化された可変
長符号から、その符号長、ランレングス及びレベルを求
めるための可変長復号化テーブルと、レベル０のランレ
ングスを許容して、与えられたランレングスの数だけ０
を出力し、かつ与えられたレベルを出力することによ
り、前記可変長符号に対応した可変長復号化データを出
力するためのランレングスデコーダとを備えた可変長復
号化器の構成を採用したものである。
【００１１】また、各フォーマット用のＥＯＢ（エンド
・オブ・ブロック）コードのうちいずれかを選択し、か
つ与えられた可変長符号が前記選択したＥＯＢコードと
一致したときには前記ランレングスデコーダに対応ブロ
ックの最後まで０を出力させるように、ＥＯＢコード検
出信号を前記ランレングスデコーダへ供給するためのＥ
ＯＢ処理回路を更に備えることとする。
・オブ・ブロック）コードのうちいずれかを選択し、か
つ与えられた可変長符号が前記選択したＥＯＢコードと
一致したときには前記ランレングスデコーダに対応ブロ
ックの最後まで０を出力させるように、ＥＯＢコード検
出信号を前記ランレングスデコーダへ供給するためのＥ
ＯＢ処理回路を更に備えることとする。
【００１２】
【発明の実施の形態】図１は、本発明に係るワンチップ
可変長復号化器の構成例を示している。図１の可変長復
号化器５０は、ＤＶフォーマットで圧縮符号化されたビ
ットストリームのデコードと、ＭＰＥＧフォーマットで
圧縮符号化されたビットストリームのデコードとに共通
に用いられる可変長復号化器であって、可変長符号読み
出し器１００と、バレルシフタ１１０と、可変長復号化
テーブル１２０と、ランレングスセレクタ１３０と、レ
ベルセレクタ１４０と、ランレングスデコーダ１５０
と、バレルシフタ制御器１６０とを備えている。可変長
符号読み出し器１００は、メモリからビットストリーム
を読み出すものであり、ＤＶフォーマットで圧縮符号化
されたビットストリームと、ＭＰＥＧフォーマットで圧
縮符号化されたビットストリームとを当該可変長復号化
器５０へ入力することができる。バレルシフタ１１０
は、入力ビットストリームをシフトさせて得た可変長符
号を可変長復号化テーブル１２０へ供給する。シフト量
は、バレルシフタ制御器１６０からバレルシフタ１１０
に与えられる。可変長復号化テーブル１２０は、各フォ
ーマットで圧縮符号化された可変長符号から、その符号
長、ランレングス及びレベルを求めるためのテーブルで
あって、ＤＶ用テーブル１２１と、ＭＰＥＧ用テーブル
１２２とを有している。ランレングスはセレクタ１３０
を介して、レベルはセレクタ１４０を介してそれぞれラ
ンレングスデコーダ１５０に与えられる。ランレングス
デコーダ１５０は、基本的には、与えられたランレング
スの数だけ０を出力した後、与えられたレベルを出力す
ることにより、可変長符号に対応した可変長復号化デー
タを出力する。この可変長復号化データは、量子化され
たＤＣＴ係数であって、後段ＬＳＩにおいて逆量子化処
理及び逆ＤＣＴ処理の対象となるものである。バレルシ
フタ制御器１６０は、与えられた符号長に応じてバレル
シフタ１１０の動作を制御するものであって、符号長セ
レクタ１６１と、加算器１６２と、ＦＦ（フリップフロ
ップ）１６３とを備えている。加算器１６２とＦＦ１６
３とは、セレクタ１６１から出力される符号長を累算
し、その結果をバレルシフタ１１０へシフト量として与
える。
可変長復号化器の構成例を示している。図１の可変長復
号化器５０は、ＤＶフォーマットで圧縮符号化されたビ
ットストリームのデコードと、ＭＰＥＧフォーマットで
圧縮符号化されたビットストリームのデコードとに共通
に用いられる可変長復号化器であって、可変長符号読み
出し器１００と、バレルシフタ１１０と、可変長復号化
テーブル１２０と、ランレングスセレクタ１３０と、レ
ベルセレクタ１４０と、ランレングスデコーダ１５０
と、バレルシフタ制御器１６０とを備えている。可変長
符号読み出し器１００は、メモリからビットストリーム
を読み出すものであり、ＤＶフォーマットで圧縮符号化
されたビットストリームと、ＭＰＥＧフォーマットで圧
縮符号化されたビットストリームとを当該可変長復号化
器５０へ入力することができる。バレルシフタ１１０
は、入力ビットストリームをシフトさせて得た可変長符
号を可変長復号化テーブル１２０へ供給する。シフト量
は、バレルシフタ制御器１６０からバレルシフタ１１０
に与えられる。可変長復号化テーブル１２０は、各フォ
ーマットで圧縮符号化された可変長符号から、その符号
長、ランレングス及びレベルを求めるためのテーブルで
あって、ＤＶ用テーブル１２１と、ＭＰＥＧ用テーブル
１２２とを有している。ランレングスはセレクタ１３０
を介して、レベルはセレクタ１４０を介してそれぞれラ
ンレングスデコーダ１５０に与えられる。ランレングス
デコーダ１５０は、基本的には、与えられたランレング
スの数だけ０を出力した後、与えられたレベルを出力す
ることにより、可変長符号に対応した可変長復号化デー
タを出力する。この可変長復号化データは、量子化され
たＤＣＴ係数であって、後段ＬＳＩにおいて逆量子化処
理及び逆ＤＣＴ処理の対象となるものである。バレルシ
フタ制御器１６０は、与えられた符号長に応じてバレル
シフタ１１０の動作を制御するものであって、符号長セ
レクタ１６１と、加算器１６２と、ＦＦ（フリップフロ
ップ）１６３とを備えている。加算器１６２とＦＦ１６
３とは、セレクタ１６１から出力される符号長を累算
し、その結果をバレルシフタ１１０へシフト量として与
える。
【００１３】図１の可変長復号化器５０は、ＥＳＣ処理
回路１７０と、ＤＣ処理回路１８０と、ＥＯＢ処理回路
１９０とを更に備えている。ＥＳＣ処理回路１７０は、
ＭＰＥＧフォーマット専用であって、バレルシフタ１１
０から供給された可変長符号に基づいて符号長、ランレ
ングス及びレベルを出力する。ＤＣ処理回路１８０は、
各フォーマットに対応するようにＤＶ用ＤＣ処理回路１
８１と、ＭＰＥＧ用ＤＣ処理回路１８２とを有し、バレ
ルシフタ１１０から供給された可変長符号に基づいて符
号長及びレベルを出力するとともに、ＤＶフォーマット
の場合にはクラスナンバー（ｃ１，ｃ０）とＤＣＴモー
ド（ｍ０）とを更に出力する。ＥＯＢ処理回路１９０
は、各フォーマット用のＥＯＢコードのうちいずれかを
選択し、かつバレルシフタ１１０から供給された可変長
符号が前記選択したＥＯＢコードと一致したときにはラ
ンレングスデコーダ１５０に対応ブロックの最後まで０
を出力させるように、ＥＯＢコード検出信号をランレン
グスデコーダ１５０へ供給するための回路であって、Ｄ
Ｖ用ＥＯＢコード１９１と、ＭＰＥＧ用ＥＯＢコード１
９２とを有している。また、ＥＯＢ処理回路１９０は、
バレルシフタ制御器１６０に符号長を与える。
回路１７０と、ＤＣ処理回路１８０と、ＥＯＢ処理回路
１９０とを更に備えている。ＥＳＣ処理回路１７０は、
ＭＰＥＧフォーマット専用であって、バレルシフタ１１
０から供給された可変長符号に基づいて符号長、ランレ
ングス及びレベルを出力する。ＤＣ処理回路１８０は、
各フォーマットに対応するようにＤＶ用ＤＣ処理回路１
８１と、ＭＰＥＧ用ＤＣ処理回路１８２とを有し、バレ
ルシフタ１１０から供給された可変長符号に基づいて符
号長及びレベルを出力するとともに、ＤＶフォーマット
の場合にはクラスナンバー（ｃ１，ｃ０）とＤＣＴモー
ド（ｍ０）とを更に出力する。ＥＯＢ処理回路１９０
は、各フォーマット用のＥＯＢコードのうちいずれかを
選択し、かつバレルシフタ１１０から供給された可変長
符号が前記選択したＥＯＢコードと一致したときにはラ
ンレングスデコーダ１５０に対応ブロックの最後まで０
を出力させるように、ＥＯＢコード検出信号をランレン
グスデコーダ１５０へ供給するための回路であって、Ｄ
Ｖ用ＥＯＢコード１９１と、ＭＰＥＧ用ＥＯＢコード１
９２とを有している。また、ＥＯＢ処理回路１９０は、
バレルシフタ制御器１６０に符号長を与える。
【００１４】さて、フレーム内の情報のみを用いるイン
トラ・マクロブロックの場合、ＤＣＴの最初の係数をＤ
Ｃ係数と呼び、その他の係数をＡＣ（交流）係数と呼ん
で区別する。そして、ＤＣ係数とＡＣ係数とで異なる取
り扱いをする。フレーム間の情報を用いるインター・マ
クロブロックにはこの区別が存在せず、全てのＤＣＴ係
数をＡＣ係数として取り扱う。ＤＶフォーマットでは、
動き補償を行わないのでイントラ・マクロブロックしか
存在しない。動き補償を行うＭＰＥＧフォーマットで
は、イントラ・マクロブロックとインター・マクロブロ
ックとの両方が存在する。図１中の可変長復号化テーブ
ル１２０はＡＣ係数の可変長復号化を行うためのテーブ
ルであり、ＤＣ処理回路１８０はＤＣ係数の処理を行う
ための回路である。
トラ・マクロブロックの場合、ＤＣＴの最初の係数をＤ
Ｃ係数と呼び、その他の係数をＡＣ（交流）係数と呼ん
で区別する。そして、ＤＣ係数とＡＣ係数とで異なる取
り扱いをする。フレーム間の情報を用いるインター・マ
クロブロックにはこの区別が存在せず、全てのＤＣＴ係
数をＡＣ係数として取り扱う。ＤＶフォーマットでは、
動き補償を行わないのでイントラ・マクロブロックしか
存在しない。動き補償を行うＭＰＥＧフォーマットで
は、イントラ・マクロブロックとインター・マクロブロ
ックとの両方が存在する。図１中の可変長復号化テーブ
ル１２０はＡＣ係数の可変長復号化を行うためのテーブ
ルであり、ＤＣ処理回路１８０はＤＣ係数の処理を行う
ための回路である。
【００１５】図２は、ＤＶフォーマットにおける可変長
符号の定義範囲をハッチングで示した図である。図示の
とおり、ＤＶフォーマットの可変長符号には「レベル０
のランレングス」が存在する。しかも、ＤＶフォーマッ
トによれば、可変長符号の定義範囲外（非ハッチング部
分）では２つの可変長符号を組み合わせる。例えば、ラ
ンレングス（ｒｕｎ）が１０で、レベル（ａｍｐ）が１
０の場合、 （ｒｕｎ−１，０）＋（０，ａｍｐ）＝（９，０）＋
（０，１０） とするのである。ここに、（９，０）はまさに「レベル
０のランレングス」に該当する。
符号の定義範囲をハッチングで示した図である。図示の
とおり、ＤＶフォーマットの可変長符号には「レベル０
のランレングス」が存在する。しかも、ＤＶフォーマッ
トによれば、可変長符号の定義範囲外（非ハッチング部
分）では２つの可変長符号を組み合わせる。例えば、ラ
ンレングス（ｒｕｎ）が１０で、レベル（ａｍｐ）が１
０の場合、 （ｒｕｎ−１，０）＋（０，ａｍｐ）＝（９，０）＋
（０，１０） とするのである。ここに、（９，０）はまさに「レベル
０のランレングス」に該当する。
【００１６】一方、ＭＰＥＧフォーマットによれば、前
掲の特開平１１−３１９７３号公報にも示されていると
おり、可変長符号の定義範囲外ではＥＳＣコードを用い
る。このＥＳＣコードには、先頭に開始コード「０００
００１」が、その後に６ビットの固定長符号（ランレン
グス）と、１２ビットの固定長符号（レベル）とがそれ
ぞれ割り当てられる。例えば、ランレングスが１０で、
レベルが２０４７の場合の符号は、 ０００００１（開始コード） ００１０１０（ランレングス） ０１１１１１１１１１１１（レベル） となる。図１中のＥＳＣ処理回路１７０は、ＭＰＥＧフ
ォーマットで先頭に開始コード「０００００１」が与え
られた場合にのみ動作し、その後の６ビットをランレン
グスとして、その後の１２ビットをレベルとしてそれぞ
れ出力する。なお、ＭＰＥＧフォーマットには「レベル
０のランレングス」が存在しない。
掲の特開平１１−３１９７３号公報にも示されていると
おり、可変長符号の定義範囲外ではＥＳＣコードを用い
る。このＥＳＣコードには、先頭に開始コード「０００
００１」が、その後に６ビットの固定長符号（ランレン
グス）と、１２ビットの固定長符号（レベル）とがそれ
ぞれ割り当てられる。例えば、ランレングスが１０で、
レベルが２０４７の場合の符号は、 ０００００１（開始コード） ００１０１０（ランレングス） ０１１１１１１１１１１１（レベル） となる。図１中のＥＳＣ処理回路１７０は、ＭＰＥＧフ
ォーマットで先頭に開始コード「０００００１」が与え
られた場合にのみ動作し、その後の６ビットをランレン
グスとして、その後の１２ビットをレベルとしてそれぞ
れ出力する。なお、ＭＰＥＧフォーマットには「レベル
０のランレングス」が存在しない。
【００１７】図３は、図１中の可変長復号化テーブル１
２０のＶｅｒｉｌｏｇ−ＨＤＬによる記述例を示す図で
ある。図３によれば、可変長符号をアドレス（ａｄｄｒ
ｅｓｓ）としてｃａｓｅ文の入力に入れ、結果を符号長
とランレングスとレベルとの組（ｄａｔａ）で表現す
る。ｄａｔａ（１６：１２）が符号長に、ｄａｔａ（１
１：６）がランレングスに、ｄａｔａ（５：０）がレベ
ルにそれぞれ相当する。また、このｃａｓｅ文の単位
が、ＤＶフォーマット、ＭＰＥＧフォーマット毎に存在
することになる。
２０のＶｅｒｉｌｏｇ−ＨＤＬによる記述例を示す図で
ある。図３によれば、可変長符号をアドレス（ａｄｄｒ
ｅｓｓ）としてｃａｓｅ文の入力に入れ、結果を符号長
とランレングスとレベルとの組（ｄａｔａ）で表現す
る。ｄａｔａ（１６：１２）が符号長に、ｄａｔａ（１
１：６）がランレングスに、ｄａｔａ（５：０）がレベ
ルにそれぞれ相当する。また、このｃａｓｅ文の単位
が、ＤＶフォーマット、ＭＰＥＧフォーマット毎に存在
することになる。
【００１８】可変長復号化テーブル１２０の他のインプ
リメント方法としては、ＲＯＭテーブルを持ってもよい
し、ＲＡＭとして実装してもよい。ＲＡＭの場合には、
外部から書き込める機構を持つことにより、ＤＶフォー
マットとＭＰＥＧフォーマットとを共通テーブルにする
ことも可能である。
リメント方法としては、ＲＯＭテーブルを持ってもよい
し、ＲＡＭとして実装してもよい。ＲＡＭの場合には、
外部から書き込める機構を持つことにより、ＤＶフォー
マットとＭＰＥＧフォーマットとを共通テーブルにする
ことも可能である。
【００１９】図４は、図１中のランレングスデコーダ１
５０の概略構成例を示している。図４のランレングスデ
コーダ１５０は、ＤＶフォーマットとＭＰＥＧフォーマ
ットとに共用できるように「レベル０のランレングス」
を許容したものであって、０ラン発生器１５１と、セレ
クタ１５２とを備えている。０ラン発生器１５１は、ラ
ンレングスが入力されたとき、そのランレングスの数だ
け０を生成する。セレクタ１５２は、０ラン発生器１５
１により生成された０を全て選択出力した後に、与えら
れたレベルを選択出力することにより、可変長符号に対
応した可変長復号化データを出力する。また、図４のラ
ンレングスデコーダ１５０は、ＥＯＢコード検出信号の
入力を受けた場合には当該ブロックの最終係数まで０を
出力するように動作する。
５０の概略構成例を示している。図４のランレングスデ
コーダ１５０は、ＤＶフォーマットとＭＰＥＧフォーマ
ットとに共用できるように「レベル０のランレングス」
を許容したものであって、０ラン発生器１５１と、セレ
クタ１５２とを備えている。０ラン発生器１５１は、ラ
ンレングスが入力されたとき、そのランレングスの数だ
け０を生成する。セレクタ１５２は、０ラン発生器１５
１により生成された０を全て選択出力した後に、与えら
れたレベルを選択出力することにより、可変長符号に対
応した可変長復号化データを出力する。また、図４のラ
ンレングスデコーダ１５０は、ＥＯＢコード検出信号の
入力を受けた場合には当該ブロックの最終係数まで０を
出力するように動作する。
【００２０】次に、図１中のＤＣ処理回路１８０につい
て説明する。ＤＶフォーマットにおけるＤＣ係数は、９
ビットからなるレベル（ｂ８〜ｂ０）と、クラスナンバ
ー（ｃ１，ｃ０）と呼ばれる量子化係数のセットと、Ｄ
ＣＴのモード（ｍ０）を決定する値とで構成される。よ
って、ＤＶ用ＤＣ処理回路１８１は、ＤＣ係数のレベル
（ｂ８〜ｂ０）を出力するとともに、後段の逆量子化処
理及び逆ＤＣＴ処理のために、クラスナンバー（ｃ１，
ｃ０）とＤＣＴモード（ｍ０）とを出力する。一方、Ｍ
ＰＥＧフォーマットにおけるＤＣ係数は、輝度成分の差
分に係る可変長符号と固定長符号との対で構成される。
よって、ＭＰＥＧ用ＤＣ処理回路１８２は、これらの符
号をもとに符号長及びレベルを出力する。
て説明する。ＤＶフォーマットにおけるＤＣ係数は、９
ビットからなるレベル（ｂ８〜ｂ０）と、クラスナンバ
ー（ｃ１，ｃ０）と呼ばれる量子化係数のセットと、Ｄ
ＣＴのモード（ｍ０）を決定する値とで構成される。よ
って、ＤＶ用ＤＣ処理回路１８１は、ＤＣ係数のレベル
（ｂ８〜ｂ０）を出力するとともに、後段の逆量子化処
理及び逆ＤＣＴ処理のために、クラスナンバー（ｃ１，
ｃ０）とＤＣＴモード（ｍ０）とを出力する。一方、Ｍ
ＰＥＧフォーマットにおけるＤＣ係数は、輝度成分の差
分に係る可変長符号と固定長符号との対で構成される。
よって、ＭＰＥＧ用ＤＣ処理回路１８２は、これらの符
号をもとに符号長及びレベルを出力する。
【００２１】図５は、図１中のＥＯＢ処理回路１９０の
概略構成例を示している。図５のＥＯＢ処理回路１９０
は、ＤＶフォーマットとＭＰＥＧフォーマットとに共用
できるように、ＤＶ用ＥＯＢコード１９１と、ＭＰＥＧ
用ＥＯＢコード１９２とを有しており、ＤＶ／ＭＰＥＧ
の選択信号に応じて両ＥＯＢコード１９１，１９２のい
ずれかを第１のセレクタ１９３で選択する。そして、比
較器１９４により可変長符号と比較し、一致したところ
でＥＯＢコード検出信号を出力する。また、このとき第
２のセレクタ１９５から符号長を出力する。
概略構成例を示している。図５のＥＯＢ処理回路１９０
は、ＤＶフォーマットとＭＰＥＧフォーマットとに共用
できるように、ＤＶ用ＥＯＢコード１９１と、ＭＰＥＧ
用ＥＯＢコード１９２とを有しており、ＤＶ／ＭＰＥＧ
の選択信号に応じて両ＥＯＢコード１９１，１９２のい
ずれかを第１のセレクタ１９３で選択する。そして、比
較器１９４により可変長符号と比較し、一致したところ
でＥＯＢコード検出信号を出力する。また、このとき第
２のセレクタ１９５から符号長を出力する。
【００２２】
【発明の効果】以上のとおり、本発明によれば、複数の
圧縮フォーマットのために可変長復号化テーブルと、ラ
ンレングスデコーダと、ＥＯＢ処理回路とを共通化した
ので、双方向フォーマット変換システムの回路規模を低
減することができる。
圧縮フォーマットのために可変長復号化テーブルと、ラ
ンレングスデコーダと、ＥＯＢ処理回路とを共通化した
ので、双方向フォーマット変換システムの回路規模を低
減することができる。
【図１】本発明に係る可変長復号化器の構成例を示すブ
ロック図である。
ロック図である。
【図２】ＤＶフォーマットにおける可変長符号の定義範
囲を説明するための図である。
囲を説明するための図である。
【図３】図１中の可変長復号化テーブルの記述例を示す
図である。
図である。
【図４】図１中のランレングスデコーダの概略構成例を
示すブロック図である。
示すブロック図である。
【図５】図１中のＥＯＢ処理回路の概略構成例を示すブ
ロック図である。
ロック図である。
５０ 可変長復号化器 １００ 可変長符号読み出し器 １１０ バレルシフタ １２０ 可変長復号化テーブル １３０，１４０ セレクタ １５０ ランレングスデコーダ １６０ バレルシフタ制御器 １７０ ＥＳＣ処理回路 １８０ ＤＣ処理回路 １９０ ＥＯＢ処理回路
───────────────────────────────────────────────────── フロントページの続き Ｆターム(参考） 5C059 KK07 MA00 MA05 MA23 MC14 MC24 MC38 ME01 ME06 PP04 SS11 UA05 UA38 5J064 AA02 AA04 BA09 BA16 BC01 BC02 BC25 BD03
Claims (4)
- 【請求項１】 互いに異なるフォーマットで圧縮符号化
された複数のビットストリームのデコードに共通に用い
られる可変長復号化器であって、 各フォーマットで圧縮符号化された可変長符号から、そ
の符号長、ランレングス及びレベルを求めるための可変
長復号化テーブルと、 レベル０のランレングスを許容して、与えられたランレ
ングスの数だけ０を出力し、かつ与えられたレベルを出
力することにより、前記可変長符号に対応した可変長復
号化データを出力するためのランレングスデコーダとを
備えたことを特徴とする可変長復号化器。 - 【請求項２】 請求項１記載の可変長復号化器におい
て、 各フォーマット用のＥＯＢコードのうちいずれかを選択
し、かつ与えられた可変長符号が前記選択したＥＯＢコ
ードと一致したときには前記ランレングスデコーダに対
応ブロックの最後まで０を出力させるように、ＥＯＢコ
ード検出信号を前記ランレングスデコーダへ供給するた
めのＥＯＢ処理回路を更に備えたことを特徴とする可変
長復号化器。 - 【請求項３】 請求項２記載の可変長復号化器におい
て、 前記可変長復号化テーブル、ランレングスデコーダ及び
ＥＯＢ処理回路は、ＤＶフォーマットとＭＰＥＧフォー
マットとの双方に適合するように構成されたことを特徴
とする可変長復号化器。 - 【請求項４】 請求項３記載の可変長復号化器におい
て、 ＭＰＥＧフォーマット専用のＥＳＣ処理回路と、 ＤＶフォーマット及びＭＰＥＧフォーマットの各々に対
応したＤＣ処理回路と、 前記可変長復号化テーブル、ＥＳＣ処理回路、ＥＯＢ処
理回路及びＤＣ処理回路の各々へ可変長符号を供給する
ためのバレルシフタと、 与えられた符号長に応じて前記バレルシフタの動作を制
御するためのバレルシフタ制御器とを更に備えたことを
特徴とする可変長復号化器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000335647A JP2002141807A (ja) | 2000-11-02 | 2000-11-02 | 可変長復号化器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000335647A JP2002141807A (ja) | 2000-11-02 | 2000-11-02 | 可変長復号化器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2002141807A true JP2002141807A (ja) | 2002-05-17 |
Family
ID=18811355
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000335647A Pending JP2002141807A (ja) | 2000-11-02 | 2000-11-02 | 可変長復号化器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2002141807A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2005088840A1 (ja) * | 2004-03-12 | 2005-09-22 | Matsushita Electric Industrial Co., Ltd. | 可変長符号復号装置 |
| KR100556357B1 (ko) * | 2002-12-04 | 2006-03-03 | 엘지전자 주식회사 | 디지털 비디오 포맷을 지원하는 엠펙 비디오 디코딩 시스템 |
| CN100423453C (zh) * | 2005-03-10 | 2008-10-01 | 复旦大学 | 通过查表实现的算术编解码方法 |
-
2000
- 2000-11-02 JP JP2000335647A patent/JP2002141807A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100556357B1 (ko) * | 2002-12-04 | 2006-03-03 | 엘지전자 주식회사 | 디지털 비디오 포맷을 지원하는 엠펙 비디오 디코딩 시스템 |
| WO2005088840A1 (ja) * | 2004-03-12 | 2005-09-22 | Matsushita Electric Industrial Co., Ltd. | 可変長符号復号装置 |
| JPWO2005088840A1 (ja) * | 2004-03-12 | 2008-01-31 | 松下電器産業株式会社 | 可変長符号復号装置 |
| US7683807B2 (en) | 2004-03-12 | 2010-03-23 | Panasonic Corporation | Variable-length-code decoding device |
| JP4516068B2 (ja) * | 2004-03-12 | 2010-08-04 | パナソニック株式会社 | 可変長符号復号装置 |
| CN100423453C (zh) * | 2005-03-10 | 2008-10-01 | 复旦大学 | 通过查表实现的算术编解码方法 |
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