JP2002135118A - アナログ／デジタル信号変換方法および信号変換装置 - Google Patents
アナログ／デジタル信号変換方法および信号変換装置Info
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- JP2002135118A JP2002135118A JP2000319704A JP2000319704A JP2002135118A JP 2002135118 A JP2002135118 A JP 2002135118A JP 2000319704 A JP2000319704 A JP 2000319704A JP 2000319704 A JP2000319704 A JP 2000319704A JP 2002135118 A JP2002135118 A JP 2002135118A
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- Pending
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Abstract
(57)【要約】
【課題】 定格入力レンジを超えたアナログ入力を正確
に変換できるＡ／Ｄ信号変換装置を提供する。 【解決手段】 入力アナログ信号をデジタル信号に変換
するアナログ／デジタル信号変換装置において、アナロ
グ信号を入力するオペアンプ１と、そのアナログ入力信
号をデジタル信号に変換するＡ／Ｄコンバータ２と、デ
ジタル出力信号に１以下のゲインが掛かるようにＡ／Ｄ
コンバータのリファレンス電圧を調整し、規定した定格
入力レンジをα％超えるアナログ信号が入力されても飽
和することなくデジタル信号に変換できるように調整す
るオフセット／ゲイン調整回路４と、オフセット／ゲイ
ン調整回路のオフセット／ゲインを保持するオフセット
／ゲイン保持メモリ５と、その保持メモリのオフセット
／ゲイン値を基に計算してデジタル出力信号を入力アナ
ログ信号の大きさに復元するＣＰＵ３を備えた。
に変換できるＡ／Ｄ信号変換装置を提供する。 【解決手段】 入力アナログ信号をデジタル信号に変換
するアナログ／デジタル信号変換装置において、アナロ
グ信号を入力するオペアンプ１と、そのアナログ入力信
号をデジタル信号に変換するＡ／Ｄコンバータ２と、デ
ジタル出力信号に１以下のゲインが掛かるようにＡ／Ｄ
コンバータのリファレンス電圧を調整し、規定した定格
入力レンジをα％超えるアナログ信号が入力されても飽
和することなくデジタル信号に変換できるように調整す
るオフセット／ゲイン調整回路４と、オフセット／ゲイ
ン調整回路のオフセット／ゲインを保持するオフセット
／ゲイン保持メモリ５と、その保持メモリのオフセット
／ゲイン値を基に計算してデジタル出力信号を入力アナ
ログ信号の大きさに復元するＣＰＵ３を備えた。
Description
【０００１】
【発明の属する技術分野】本発明は、アナログ入力信号
をデジタル信号への変換（Ａ／Ｄ変換）および、アナロ
グ信号の異常データ検出の機能を持つプログラマブル・
コントローラ（以下、ＰＣと略す）のＡ／Ｄ変換モジュ
ールに関するものである。
をデジタル信号への変換（Ａ／Ｄ変換）および、アナロ
グ信号の異常データ検出の機能を持つプログラマブル・
コントローラ（以下、ＰＣと略す）のＡ／Ｄ変換モジュ
ールに関するものである。
【０００２】
【従来の技術】従来の、ＰＣを構成しているＩ／Ｏモジ
ュールの一つであるＡ／Ｄ変換モジュールでは、電流信
号あるいは電圧信号として与えられるアナログ入力信号
をデジタル信号に変換して、これをＰＣの演算処理部へ
送り、接続されているアナログ信号発生器の故障や、ケ
ーブル等の断線チェックを行っているが、その場合、そ
のモジュールの製品仕様で決められた定格入力レンジ以
内のアナログ信号しか、デジタル信号に変換されない。
ュールの一つであるＡ／Ｄ変換モジュールでは、電流信
号あるいは電圧信号として与えられるアナログ入力信号
をデジタル信号に変換して、これをＰＣの演算処理部へ
送り、接続されているアナログ信号発生器の故障や、ケ
ーブル等の断線チェックを行っているが、その場合、そ
のモジュールの製品仕様で決められた定格入力レンジ以
内のアナログ信号しか、デジタル信号に変換されない。
【０００３】
【発明が解決しようとする課題】しかしながら、上記従
来例では、少しでも入力レンジを超えるアナログ入力信
号が入力すると、そのデジタル変換データは最大値や最
小値に飽和してしまい、入力信号が入力レンジをオーバ
ーしているのか、入力レンジぎりぎりなのか判断できな
いという問題があった。更に、入力レンジを超える入力
信号は変換できないので、アナログ入力信号の異常を正
確に検出できないという問題があった。そこで、本発明
は、定格の入力レンジをオーバーしたアナログ信号が入
力されても、ある一定のレベルまでは正確にデジタル変
換を行う機能を有して、アナログ入力信号の異常検出が
可能なアナログ／デジタル信号変換方法および信号変換
装置を提供することを目的としている。
来例では、少しでも入力レンジを超えるアナログ入力信
号が入力すると、そのデジタル変換データは最大値や最
小値に飽和してしまい、入力信号が入力レンジをオーバ
ーしているのか、入力レンジぎりぎりなのか判断できな
いという問題があった。更に、入力レンジを超える入力
信号は変換できないので、アナログ入力信号の異常を正
確に検出できないという問題があった。そこで、本発明
は、定格の入力レンジをオーバーしたアナログ信号が入
力されても、ある一定のレベルまでは正確にデジタル変
換を行う機能を有して、アナログ入力信号の異常検出が
可能なアナログ／デジタル信号変換方法および信号変換
装置を提供することを目的としている。
【０００４】
【課題を解決するための手段】上記目的を達成するた
め、請求項１に記載の発明は、入力アナログ信号をデジ
タル信号に変換するアナログ／デジタル信号変換方法に
おいて、アナログ入力信号をデジタル信号に変換するＡ
／Ｄコンバータのデジタル出力に、１以下のゲインが掛
かるようにオフセット／ゲインを調整して実際のアナロ
グ信号よりも小さなデジタル信号を出力し、前記デジタ
ル出力信号をあらかじめ保持した前記オフセット／ゲイ
ンに対応する値を計算してアナログ信号に見合ったデジ
タルデータに復元することによって、規定した定格入力
レンジをα％（好ましくは１０％）超えるアナログ信号
が入力された場合においても、飽和することなくデジタ
ル信号に変換可能であることを特徴としている。また、
請求項２に記載の発明は、入力アナログ信号をデジタル
信号に変換するアナログ／デジタル信号変換装置におい
て、アナログ信号を入力するオペアンプと、前記アナロ
グ入力信号をデジタル信号に変換するＡ／Ｄコンバータ
と、前記デジタル出力信号に１以下のゲインが掛かるよ
うに前記Ａ／Ｄコンバータのリファレンス電圧を調整し
て、規定した定格入力レンジをα％（好ましくは１０
％）超えるアナログ信号が入力されても飽和することな
くデジタル信号に変換できるように調整するオフセット
／ゲイン調整回路と、前記オフセット／ゲイン調整回路
のオフセット／ゲインを保持するオフセット／ゲイン保
持メモリと、前記保持メモリのオフセット／ゲイン値を
基に計算して前記デジタル出力信号を前記入力アナログ
信号の大きさに復元するＣＰＵとを備えている。このア
ナログ／デジタル信号変換方法および信号変換装置によ
れば、Ａ／Ｄコンバータにおいて、α％（好ましくは１
０％）に相当する一定の倍率になるように、１以下のゲ
インを掛けアナログ入力信号を調整してデジタル信号に
変換した後、同倍率で伸長して元の入力アナログ信号の
大きさにデジタルデータを復元するので、定格入力レン
ジを一定倍率α％（好ましくは１０％）の範囲拡大し
て、定格を超えるアナログ入力を飽和することなく正確
にデジタル信号に変換することがでが可能になり、作業
者は定格レンジを超えた入力データも正確に確認して、
異常値を認識できる。また、入力レンジ拡大率α％（好
ましくは１０％）については、アナログ入力信号として
ＤＣ電圧チェック等を行うＰＣの異常チェックにおいて
は、例えば、正常値ＤＣ１０Ｖのチェックで１．０２４
倍程度を異常判定点として検出する例もあるような検査
レベルから、ＰＣの異常チェックには充分な倍率設定で
あるとして、必要以上の倍率設定によるＡ／Ｄ変換精
度、異常検出精度の低下を避けている。
め、請求項１に記載の発明は、入力アナログ信号をデジ
タル信号に変換するアナログ／デジタル信号変換方法に
おいて、アナログ入力信号をデジタル信号に変換するＡ
／Ｄコンバータのデジタル出力に、１以下のゲインが掛
かるようにオフセット／ゲインを調整して実際のアナロ
グ信号よりも小さなデジタル信号を出力し、前記デジタ
ル出力信号をあらかじめ保持した前記オフセット／ゲイ
ンに対応する値を計算してアナログ信号に見合ったデジ
タルデータに復元することによって、規定した定格入力
レンジをα％（好ましくは１０％）超えるアナログ信号
が入力された場合においても、飽和することなくデジタ
ル信号に変換可能であることを特徴としている。また、
請求項２に記載の発明は、入力アナログ信号をデジタル
信号に変換するアナログ／デジタル信号変換装置におい
て、アナログ信号を入力するオペアンプと、前記アナロ
グ入力信号をデジタル信号に変換するＡ／Ｄコンバータ
と、前記デジタル出力信号に１以下のゲインが掛かるよ
うに前記Ａ／Ｄコンバータのリファレンス電圧を調整し
て、規定した定格入力レンジをα％（好ましくは１０
％）超えるアナログ信号が入力されても飽和することな
くデジタル信号に変換できるように調整するオフセット
／ゲイン調整回路と、前記オフセット／ゲイン調整回路
のオフセット／ゲインを保持するオフセット／ゲイン保
持メモリと、前記保持メモリのオフセット／ゲイン値を
基に計算して前記デジタル出力信号を前記入力アナログ
信号の大きさに復元するＣＰＵとを備えている。このア
ナログ／デジタル信号変換方法および信号変換装置によ
れば、Ａ／Ｄコンバータにおいて、α％（好ましくは１
０％）に相当する一定の倍率になるように、１以下のゲ
インを掛けアナログ入力信号を調整してデジタル信号に
変換した後、同倍率で伸長して元の入力アナログ信号の
大きさにデジタルデータを復元するので、定格入力レン
ジを一定倍率α％（好ましくは１０％）の範囲拡大し
て、定格を超えるアナログ入力を飽和することなく正確
にデジタル信号に変換することがでが可能になり、作業
者は定格レンジを超えた入力データも正確に確認して、
異常値を認識できる。また、入力レンジ拡大率α％（好
ましくは１０％）については、アナログ入力信号として
ＤＣ電圧チェック等を行うＰＣの異常チェックにおいて
は、例えば、正常値ＤＣ１０Ｖのチェックで１．０２４
倍程度を異常判定点として検出する例もあるような検査
レベルから、ＰＣの異常チェックには充分な倍率設定で
あるとして、必要以上の倍率設定によるＡ／Ｄ変換精
度、異常検出精度の低下を避けている。
【０００５】
【発明の実施の形態】以下、本発明の実施の形態につい
て図を参照して説明する。図１は本発明の実施の形態に
係るアナログ／デジタル信号変換装置のブロック図であ
る。図２は図１に示すＡ／Ｄコンバータの処理の説明図
である。図１において、１はアナログ入力信号を入力す
るオペアンプ、２はアナログ／デジタル変換を行うＡ／
Ｄコンバータ、３は一定の倍率で圧縮変換した変換デジ
タル信号を演算して伸長し元のアナログ信号の大きさに
復元するＣＰＵ、４はＡ／Ｄコンバータ２に圧縮倍率と
してオフセット／ゲインを設定するオフセット／ゲイン
調整回路、５はオフセット／ゲインを保持しているオフ
セット／ゲイン保持メモリである。
て図を参照して説明する。図１は本発明の実施の形態に
係るアナログ／デジタル信号変換装置のブロック図であ
る。図２は図１に示すＡ／Ｄコンバータの処理の説明図
である。図１において、１はアナログ入力信号を入力す
るオペアンプ、２はアナログ／デジタル変換を行うＡ／
Ｄコンバータ、３は一定の倍率で圧縮変換した変換デジ
タル信号を演算して伸長し元のアナログ信号の大きさに
復元するＣＰＵ、４はＡ／Ｄコンバータ２に圧縮倍率と
してオフセット／ゲインを設定するオフセット／ゲイン
調整回路、５はオフセット／ゲインを保持しているオフ
セット／ゲイン保持メモリである。
【０００６】つぎに動作について説明する。先ず、オフ
セット／ゲイン調整回路４でＡ／Ｄコンバータ２のリフ
ァレンス電圧を調整して、Ａ／Ｄコンバータからのデジ
タル信号出力に１以下のゲインが掛かるようにして、α
％（好ましくは１０％）という一定倍率で圧縮すること
で、アナログ入力信号の入力レンジをα％（好ましくは
１０％）拡大できるようにする。従って、出力される変
換デジタル信号は、実際のアナログ入力信号より小さい
データとなる。そのデータにオフセット／ゲイン保持メ
モリ５に格納してあったモジュールのオフセット／ゲイ
ンを基に、ＣＰＵ３によりデータ復元率（この場合、変
換の時の１以下の値の逆数となり１以上の値となる）を
計算することによって、入力アナログ信号の大きさに見
合ったデジタル・データに復元される。以上の動作につ
いて、図２を参照して更に具体的に説明すると、例え
ば、入力アナログ信号が０〜１０Ｖレンジの１２ｂｉｔ
Ａ／Ｄ変換において、図２のＡに示すように、通常アナ
ログ信号１０Ｖ（ＤＣ１０Ｖ等）が入力されると、その
ままではデジタル変換データは“０ＦＦＦ”となるが、
本発明による変換では図２のＢに示すように、“ＦＦ
Ｆ”のように入力信号の大きさよりも小さくなる。この
データに、ＣＰＵ３内で１以上のゲインを掛けて、アナ
ログ入力信号の大きさに復元して正確なデジタル・デー
タ“０ＦＦＦ”に戻す。これより、Ａ／Ｄコンバータか
ら出力されるデジタル・データが“０ＦＦＦ”に達する
まで、つまりアナログ入力１０Ｖの時のデジタル出力は
“ＦＦＦ”であるから、それ以上の１０Ｖを超える定格
以上のアナログ入力も正確に変換できることになる。
セット／ゲイン調整回路４でＡ／Ｄコンバータ２のリフ
ァレンス電圧を調整して、Ａ／Ｄコンバータからのデジ
タル信号出力に１以下のゲインが掛かるようにして、α
％（好ましくは１０％）という一定倍率で圧縮すること
で、アナログ入力信号の入力レンジをα％（好ましくは
１０％）拡大できるようにする。従って、出力される変
換デジタル信号は、実際のアナログ入力信号より小さい
データとなる。そのデータにオフセット／ゲイン保持メ
モリ５に格納してあったモジュールのオフセット／ゲイ
ンを基に、ＣＰＵ３によりデータ復元率（この場合、変
換の時の１以下の値の逆数となり１以上の値となる）を
計算することによって、入力アナログ信号の大きさに見
合ったデジタル・データに復元される。以上の動作につ
いて、図２を参照して更に具体的に説明すると、例え
ば、入力アナログ信号が０〜１０Ｖレンジの１２ｂｉｔ
Ａ／Ｄ変換において、図２のＡに示すように、通常アナ
ログ信号１０Ｖ（ＤＣ１０Ｖ等）が入力されると、その
ままではデジタル変換データは“０ＦＦＦ”となるが、
本発明による変換では図２のＢに示すように、“ＦＦ
Ｆ”のように入力信号の大きさよりも小さくなる。この
データに、ＣＰＵ３内で１以上のゲインを掛けて、アナ
ログ入力信号の大きさに復元して正確なデジタル・デー
タ“０ＦＦＦ”に戻す。これより、Ａ／Ｄコンバータか
ら出力されるデジタル・データが“０ＦＦＦ”に達する
まで、つまりアナログ入力１０Ｖの時のデジタル出力は
“ＦＦＦ”であるから、それ以上の１０Ｖを超える定格
以上のアナログ入力も正確に変換できることになる。
【０００７】このように、入力レンジが拡大されるので
図２Ｃに示すように、例えば、アナログ入力信号定格以
上の１０．２Ｖが入力した時、Ａ／Ｄコンバータの小さ
い変換出力“ＦＦＦ”がＣＰＵ３の演算により“１ＦＦ
Ｆ”等と復元処理され、入力レンジの定格以上の入力も
正確にデジタル変換可能になる。これら検出データをＰ
Ｃ側へ送信して異常チェック用のデータに用いれば、こ
の場合に正常値のＤＣ１０Ｖをどの程度超えたか正確に
検出できるので、正確迅速に異常チェックを行うことが
できる。また、入力信号の異常判定はＰＣに頼らずに、
Ａ／Ｄ変換装置自身で行うことも可能で、警告表示等を
行うことも可能である。
図２Ｃに示すように、例えば、アナログ入力信号定格以
上の１０．２Ｖが入力した時、Ａ／Ｄコンバータの小さ
い変換出力“ＦＦＦ”がＣＰＵ３の演算により“１ＦＦ
Ｆ”等と復元処理され、入力レンジの定格以上の入力も
正確にデジタル変換可能になる。これら検出データをＰ
Ｃ側へ送信して異常チェック用のデータに用いれば、こ
の場合に正常値のＤＣ１０Ｖをどの程度超えたか正確に
検出できるので、正確迅速に異常チェックを行うことが
できる。また、入力信号の異常判定はＰＣに頼らずに、
Ａ／Ｄ変換装置自身で行うことも可能で、警告表示等を
行うことも可能である。
【０００８】
【発明の効果】以上説明したように、本発明によれば、
規定された定格を超えるアナログ信号が入力された場合
においても、定格の一定倍率範囲内であれば正確にデー
タ変換を行うことが可能となり、ＰＣ又はＡ／Ｄ変換モ
ジュールを使用している作業者が正確にデータを確認し
て異常をチェックできるという効果がある。
規定された定格を超えるアナログ信号が入力された場合
においても、定格の一定倍率範囲内であれば正確にデー
タ変換を行うことが可能となり、ＰＣ又はＡ／Ｄ変換モ
ジュールを使用している作業者が正確にデータを確認し
て異常をチェックできるという効果がある。
【図１】本発明の実施の形態に係るアナログ／デジタル
信号変換装置のブロック図である。
信号変換装置のブロック図である。
【図２】図１に示すＡ／Ｄコンバータの処理の説明図で
ある。
ある。
１ オペアンプ ２ Ａ／Ｄコンバータ ３ ＣＰＵ ４ オフセット／ゲイン調整回路 ５ オフセット／ゲイン保持メモリ
Claims (2)
- 【請求項１】 入力アナログ信号をデジタル信号に変換
するアナログ／デジタル信号変換方法において、 アナログ入力信号をデジタル信号に変換するＡ／Ｄコン
バータのデジタル出力に、１以下のゲインが掛かるよう
にオフセット／ゲインを調整して実際のアナログ信号よ
りも小さなデジタル信号を出力し、前記デジタル出力信
号をあらかじめ保持した前記オフセット／ゲインに対応
する値を計算してアナログ信号に見合ったデジタルデー
タに復元することによって、規定した定格入力レンジを
α％超えるアナログ信号が入力された場合においても、
飽和することなくデジタル信号に変換可能であることを
特徴とするアナログ／デジタル信号変換方法。 - 【請求項２】 入力アナログ信号をデジタル信号に変換
するアナログ／デジタル信号変換装置において、 アナログ信号を入力するオペアンプと、前記アナログ入
力信号をデジタル信号に変換するＡ／Ｄコンバータと、
前記デジタル出力信号に１以下のゲインが掛かるように
前記Ａ／Ｄコンバータのリファレンス電圧を調整して、
規定した定格入力レンジをα％超えるアナログ信号が入
力されても飽和することなくデジタル信号に変換できる
ように調整するオフセット／ゲイン調整回路と、前記オ
フセット／ゲイン調整回路のオフセット／ゲインを保持
するオフセット／ゲイン保持メモリと、前記保持メモリ
のオフセット／ゲイン値を基に計算して前記デジタル出
力信号を前記入力アナログ信号の大きさに復元するＣＰ
Ｕとを備えたことを特徴とするアナログ／デジタル信号
変換装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000319704A JP2002135118A (ja) | 2000-10-19 | 2000-10-19 | アナログ／デジタル信号変換方法および信号変換装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000319704A JP2002135118A (ja) | 2000-10-19 | 2000-10-19 | アナログ／デジタル信号変換方法および信号変換装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2002135118A true JP2002135118A (ja) | 2002-05-10 |
Family
ID=18798116
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000319704A Pending JP2002135118A (ja) | 2000-10-19 | 2000-10-19 | アナログ／デジタル信号変換方法および信号変換装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2002135118A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100820832B1 (ko) * | 2006-07-28 | 2008-04-10 | 엘지전자 주식회사 | 모니터의 화면 조정 장치 및 방법 |
| JP2011242232A (ja) * | 2010-05-18 | 2011-12-01 | Mitsubishi Electric Corp | 車載レーダ装置 |
| JP2018182717A (ja) * | 2017-04-03 | 2018-11-15 | エルエス産電株式会社Lsis Co., Ltd. | Ａｄコンバータ |
| JP7111913B1 (ja) * | 2021-07-30 | 2022-08-02 | ファナック株式会社 | 回路装置 |
-
2000
- 2000-10-19 JP JP2000319704A patent/JP2002135118A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100820832B1 (ko) * | 2006-07-28 | 2008-04-10 | 엘지전자 주식회사 | 모니터의 화면 조정 장치 및 방법 |
| JP2011242232A (ja) * | 2010-05-18 | 2011-12-01 | Mitsubishi Electric Corp | 車載レーダ装置 |
| JP2018182717A (ja) * | 2017-04-03 | 2018-11-15 | エルエス産電株式会社Lsis Co., Ltd. | Ａｄコンバータ |
| JP7111913B1 (ja) * | 2021-07-30 | 2022-08-02 | ファナック株式会社 | 回路装置 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20060324 |