JP2001231165A - 電流形能動フィルタ回路 - Google Patents
電流形能動フィルタ回路Info
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- Power Conversion In General (AREA)
- Inverter Devices (AREA)
Abstract
(57)【要約】
【課題】 小型・軽量化が可能な電流形能動フィルタ回
路を提供する。 【解決手段】 本発明の電流形能動フィルタ回路は、キ
ャパシタ素子Ｃ１およびインダクタ素子Ｌ１からなる直
列共振回路３と、インバータ１から商用電源２に流れる
電流を制御するNPNトランジスタＱ１と、商用電源２か
らインバータ１に流れる電流を制御するNPNトランジス
タＱ２と、インバータ１とNPNトランジスタＱ２のコレ
クタ端子との間に接続されたダイオードＤ１と、商用電
源２とNPNトランジスタＱ１のコレクタ端子との間に接
続されたダイオードＤ２とを備えている。インバータ１
と商用電源２との間に、直列共振回路３とは別個に主電
流回路を設け、インバータ１と商用電源２との間に流れ
る電流の大部分を主電流回路に流し、一部の電流だけを
直列共振回路３に流すため、直列共振回路３を構成する
キャパシタ素子Ｃ１の容量値とインダクタ素子Ｌ１の電
気的容量を小さくできる。
路を提供する。 【解決手段】 本発明の電流形能動フィルタ回路は、キ
ャパシタ素子Ｃ１およびインダクタ素子Ｌ１からなる直
列共振回路３と、インバータ１から商用電源２に流れる
電流を制御するNPNトランジスタＱ１と、商用電源２か
らインバータ１に流れる電流を制御するNPNトランジス
タＱ２と、インバータ１とNPNトランジスタＱ２のコレ
クタ端子との間に接続されたダイオードＤ１と、商用電
源２とNPNトランジスタＱ１のコレクタ端子との間に接
続されたダイオードＤ２とを備えている。インバータ１
と商用電源２との間に、直列共振回路３とは別個に主電
流回路を設け、インバータ１と商用電源２との間に流れ
る電流の大部分を主電流回路に流し、一部の電流だけを
直列共振回路３に流すため、直列共振回路３を構成する
キャパシタ素子Ｃ１の容量値とインダクタ素子Ｌ１の電
気的容量を小さくできる。
Description
【０００１】
【発明の属する技術分野】本発明は、交流回路の電流波
形歪みを低減する電流形能動フィルタ回路に関し、さら
に、複数端子の交流電源を系統連系する際の電流波形歪
みを低減する技術に関する。
形歪みを低減する電流形能動フィルタ回路に関し、さら
に、複数端子の交流電源を系統連系する際の電流波形歪
みを低減する技術に関する。
【０００２】
【従来の技術】近年のパワーエレクトロニクスの進歩に
より、ＵＰＳ(Uninterruptible PowerSupply)、太陽光
発電、および風力発電などで発生された電力を有効利用
する技術が実用化されつつある。
より、ＵＰＳ(Uninterruptible PowerSupply)、太陽光
発電、および風力発電などで発生された電力を有効利用
する技術が実用化されつつある。
【０００３】交流電流や交流電圧の波形は、正弦波に近
いほど望ましいが、実際には波形に歪みが生じてしま
う。
いほど望ましいが、実際には波形に歪みが生じてしま
う。
【０００４】例えば、太陽光発電装置や風力発電装置な
どで発生された電力を商用電源に逆潮流（系統連系）さ
せる場合を例に取ると、発生された電圧波形と商用電源
の電圧波形との間に位相や振幅のずれが生じ、回路内に
図６の実線Ｌ３に示すような回生電流が流れてしまう。
どで発生された電力を商用電源に逆潮流（系統連系）さ
せる場合を例に取ると、発生された電圧波形と商用電源
の電圧波形との間に位相や振幅のずれが生じ、回路内に
図６の実線Ｌ３に示すような回生電流が流れてしまう。
【０００５】図５はインバータ１と商用電源２とを系統
連系させる例を示す図である。また、図６の実線Ｌ１は
図５のインバータ１の両端電圧の電圧波形、点線Ｌ２は
商用電源２の両端電圧の電圧波形である。商用電源２の
電圧波形は一般に歪んでいるため、インバータ１の両端
電圧と商用電源２の両端電圧との間に位相や振幅のずれ
が生じ、インバータ１と商用電源２との間の経路では、
実線Ｌ３のように歪みの大きい回生電流が流れる。
連系させる例を示す図である。また、図６の実線Ｌ１は
図５のインバータ１の両端電圧の電圧波形、点線Ｌ２は
商用電源２の両端電圧の電圧波形である。商用電源２の
電圧波形は一般に歪んでいるため、インバータ１の両端
電圧と商用電源２の両端電圧との間に位相や振幅のずれ
が生じ、インバータ１と商用電源２との間の経路では、
実線Ｌ３のように歪みの大きい回生電流が流れる。
【０００６】太陽光発電装置などで発生された電力を買
い取る事業者にとっては、歪みのある電力を買い取る
と、需要者に対するサービスの低下になる。
い取る事業者にとっては、歪みのある電力を買い取る
と、需要者に対するサービスの低下になる。
【０００７】このため、一般住宅用の太陽光発電用イン
バータ１や風力発電用インバータ１などでは、パワー・
コンディショナーと呼ばれる装置を用いて、商用電源２
への回生電流波形歪みを少なくする制御を行っている。
バータ１や風力発電用インバータ１などでは、パワー・
コンディショナーと呼ばれる装置を用いて、商用電源２
への回生電流波形歪みを少なくする制御を行っている。
【０００８】図７はこの種のパワー・コンディショナー
１１を有する電力回生装置の概略構成を示すブロック図
である。パワー・コンディショナー１１は、太陽光を利
用して電力を発生するソーラーパネル１２と商用電源２
との間に接続される。ソーラーパネル１２から出力され
た直流電圧は、パワー・コンディショナー１１内のDC/A
Cインバータ１３に入力され、交流電圧に変換される。
パワー・コンディショナー１１内のコンピュータ１４
は、DC/ACインバータ１３から出力された交流電流をA/D
変換器１５を介して検出し、ソーラーパネル１２から商
用電源２に回生される電流に歪みが起きないようにDC/A
Cインバータ１３の制御を行う。
１１を有する電力回生装置の概略構成を示すブロック図
である。パワー・コンディショナー１１は、太陽光を利
用して電力を発生するソーラーパネル１２と商用電源２
との間に接続される。ソーラーパネル１２から出力され
た直流電圧は、パワー・コンディショナー１１内のDC/A
Cインバータ１３に入力され、交流電圧に変換される。
パワー・コンディショナー１１内のコンピュータ１４
は、DC/ACインバータ１３から出力された交流電流をA/D
変換器１５を介して検出し、ソーラーパネル１２から商
用電源２に回生される電流に歪みが起きないようにDC/A
Cインバータ１３の制御を行う。
【０００９】しかしながら、図７のようなパワー・コン
ディショナー１１を設けると、装置が複雑になり、コス
トの上昇という問題が起こる。
ディショナー１１を設けると、装置が複雑になり、コス
トの上昇という問題が起こる。
【００１０】
【発明が解決しようとする課題】一方、図８に示すよう
に、インバータ１と商用電源２との間に、キャパシタ素
子Ｃ１とインダクタ素子Ｌ１からなる直列共振回路３を
接続して回生電流波形の歪みを低減する回路がある。図
８の回路では、インバータ１の両端電圧の位相と商用電
源２の両端電圧の位相とが一致し、直列共振回路のフィ
ルタ効果により電流波形歪みが大幅に改善される。
に、インバータ１と商用電源２との間に、キャパシタ素
子Ｃ１とインダクタ素子Ｌ１からなる直列共振回路３を
接続して回生電流波形の歪みを低減する回路がある。図
８の回路では、インバータ１の両端電圧の位相と商用電
源２の両端電圧の位相とが一致し、直列共振回路のフィ
ルタ効果により電流波形歪みが大幅に改善される。
【００１１】図８の回路において、直列共振時の合成イ
ンピーダンスｒは、インダクタ素子の巻線抵抗ｒ1と、
コアの鉄損分の等価直列抵抗ｒ2とを用いると、ｒ＝ｒ1
＋ｒ2となる。
ンピーダンスｒは、インダクタ素子の巻線抵抗ｒ1と、
コアの鉄損分の等価直列抵抗ｒ2とを用いると、ｒ＝ｒ1
＋ｒ2となる。
【００１２】この合成インピーダンスｒの電圧降下を出
力電圧の１〜２％程度に保持することは比較的容易であ
る。また、直列共振時の合成インピーダンスｒは十分に
小さいため、インバータ１と商用電源２との位相差をき
わめて小さくすることができる。
力電圧の１〜２％程度に保持することは比較的容易であ
る。また、直列共振時の合成インピーダンスｒは十分に
小さいため、インバータ１と商用電源２との位相差をき
わめて小さくすることができる。
【００１３】このように、インバータ１と商用電源２と
の間に直列共振回路３を接続すると、歪みの少ない回生
電流を商用電源２側に流し込むことができる点で優れて
いる。
の間に直列共振回路３を接続すると、歪みの少ない回生
電流を商用電源２側に流し込むことができる点で優れて
いる。
【００１４】しかしながら、図８の直列共振回路３を例
えば出力１kW(100V,10A)、50Hzのインバータ１に適用す
る場合、約300〜400ボルト・アンペア（10〜13mH、10
Ａ）のチョークコイル（約0.15オームの巻線抵抗）と、
800〜1000マイクロファラッドの交流コンデンサが必要
になり、容積、重量および価格の面から、小型のパワー
エレクトロニクス機器に使用することは困難である。
えば出力１kW(100V,10A)、50Hzのインバータ１に適用す
る場合、約300〜400ボルト・アンペア（10〜13mH、10
Ａ）のチョークコイル（約0.15オームの巻線抵抗）と、
800〜1000マイクロファラッドの交流コンデンサが必要
になり、容積、重量および価格の面から、小型のパワー
エレクトロニクス機器に使用することは困難である。
【００１５】本発明は、このような点に鑑みてなされた
ものであり、その目的は、フィルタ特性を損なうことな
く、小型・軽量化が可能な電流形能動フィルタ回路を提
供することにある。
ものであり、その目的は、フィルタ特性を損なうことな
く、小型・軽量化が可能な電流形能動フィルタ回路を提
供することにある。
【００１６】
【課題を解決するための手段】上述した課題を解決する
ために、請求項１の発明は、第１の交流電源を第２の交
流電源に系統連系させる電流形能動フィルタ回路におい
て、直列接続されたキャパシタ素子およびインダクタ素
子からなる直列共振回路と、前記第１の交流電源から前
記第２の交流電源に流れる電流を制御する第１の電流増
幅素子と、前記第２の交流電源から前記第１の交流電源
に流れる電流を制御する第２の電流増幅素子と、前記第
１の交流電源と前記第１の電流制御素子のコレクタ端子
との間に接続された第１のダイオードと、前記第２の交
流電源と前記第２の電流制御素子のコレクタ端子との間
に接続された第２のダイオードと、前記第１の電流制御
素子のベース−エミッタ間に接続された第１のインピー
ダンス素子および第３のダイオードと、前記第２の電流
制御素子のベース−エミッタ間に接続された第２のイン
ピーダンス素子および第４のダイオードと、を備え、前
記第１の交流電源から前記第１のダイオードおよび前記
第１の電流増幅素子を介して前記第２の交流電源に流れ
る第１の電流経路と、前記第１の交流電源から前記第４
のダイオード、前記直列共振回路および前記第１のイン
ピーダンス素子を介して前記第２の交流電源に流れる第
２の電流経路と、前記第２の交流電源から前記第２のダ
イオードおよび前記第２の電流増幅素子を介して前記第
１の交流電源に流れる第３の電流経路と、前記第２の交
流電源から前記第３のダイオード、前記直列共振回路お
よび前記第２のインピーダンス素子を介して前記第１の
交流電源に流れる第４の電流経路と、が設けられる。
ために、請求項１の発明は、第１の交流電源を第２の交
流電源に系統連系させる電流形能動フィルタ回路におい
て、直列接続されたキャパシタ素子およびインダクタ素
子からなる直列共振回路と、前記第１の交流電源から前
記第２の交流電源に流れる電流を制御する第１の電流増
幅素子と、前記第２の交流電源から前記第１の交流電源
に流れる電流を制御する第２の電流増幅素子と、前記第
１の交流電源と前記第１の電流制御素子のコレクタ端子
との間に接続された第１のダイオードと、前記第２の交
流電源と前記第２の電流制御素子のコレクタ端子との間
に接続された第２のダイオードと、前記第１の電流制御
素子のベース−エミッタ間に接続された第１のインピー
ダンス素子および第３のダイオードと、前記第２の電流
制御素子のベース−エミッタ間に接続された第２のイン
ピーダンス素子および第４のダイオードと、を備え、前
記第１の交流電源から前記第１のダイオードおよび前記
第１の電流増幅素子を介して前記第２の交流電源に流れ
る第１の電流経路と、前記第１の交流電源から前記第４
のダイオード、前記直列共振回路および前記第１のイン
ピーダンス素子を介して前記第２の交流電源に流れる第
２の電流経路と、前記第２の交流電源から前記第２のダ
イオードおよび前記第２の電流増幅素子を介して前記第
１の交流電源に流れる第３の電流経路と、前記第２の交
流電源から前記第３のダイオード、前記直列共振回路お
よび前記第２のインピーダンス素子を介して前記第１の
交流電源に流れる第４の電流経路と、が設けられる。
【００１７】請求項１の発明では、第１および第２の交
流電源との間に第１〜第４の電流経路を設けるため、回
生電流の高調波電流抑制用に設けられる直列共振回路に
流れる電流が少なくなり、直列共振回路のサイズを小さ
くできる。
流電源との間に第１〜第４の電流経路を設けるため、回
生電流の高調波電流抑制用に設けられる直列共振回路に
流れる電流が少なくなり、直列共振回路のサイズを小さ
くできる。
【００１８】請求項２の発明では、市販されている電流
増幅用のNPNトランジスタを用いることにより、本来、
直列共振回路に流すべき電流の大部分をNPNトランジス
タ側に流すことができ、直列共振回路に流れる電流を数
10分の１に低減できる。
増幅用のNPNトランジスタを用いることにより、本来、
直列共振回路に流すべき電流の大部分をNPNトランジス
タ側に流すことができ、直列共振回路に流れる電流を数
10分の１に低減できる。
【００１９】請求項３の発明では、市販されている電流
増幅用のPNPトランジスタを用いることにより、本来、
直列共振回路に流すべき電流の大部分をPNPトランジス
タ側に流すことができ、直列共振回路に流れる電流を数
10分の１に低減できる。
増幅用のPNPトランジスタを用いることにより、本来、
直列共振回路に流すべき電流の大部分をPNPトランジス
タ側に流すことができ、直列共振回路に流れる電流を数
10分の１に低減できる。
【００２０】請求項４の発明は、第１の交流電源を第２
の交流電源に系統連系させる電流形能動フィルタ回路に
おいて、第１および第２のタップと、前記第１および第
２のタップの間に設けられる第３のタップとを有する巻
線と、直列接続されたキャパシタ素子およびインダクタ
素子からなる直列共振回路と、前記第１のタップから前
記第２のタップに流れる電流を制御する第１の電流増幅
素子と、前記第２のタップから前記第１のタップに流れ
る電流を制御する第２の電流増幅素子と、前記第１のタ
ップと前記第１の電流制御素子のコレクタ端子との間に
接続される第１のダイオードと、前記第２のタップと前
記第２の電流制御素子のコレクタ端子との間に接続され
る第２のダイオードと、前記第１の電流制御素子のベー
ス−エミッタ間に接続される第１のインピーダンス素子
および第３のダイオードと、前記第２の電流制御素子の
ベース−エミッタ間に接続される第２のインピーダンス
素子および第４のダイオードと、を備え、前記第１のタ
ップから前記第１のダイオードおよび前記第１の電流増
幅素子を介して前記第２のタップに流れる第１の電流経
路と、前記第１のタップから前記第４のダイオード、前
記直列共振回路および前記第１のインピーダンス素子を
介して前記第２のタップに流れる第２の電流経路と、前
記第２のタップから前記第２のダイオードおよび前記第
２の電流増幅素子を介して前記第１のタップに流れる第
３の電流経路と、前記第２のタップから前記第３のダイ
オード、前記直列共振回路および前記第２のインピーダ
ンス素子を介して前記第１のタップに流れる第４の電流
経路と、が設けられ、前記第１および第２の交流電源
は、前記第２および第３のタップの間に接続される。
の交流電源に系統連系させる電流形能動フィルタ回路に
おいて、第１および第２のタップと、前記第１および第
２のタップの間に設けられる第３のタップとを有する巻
線と、直列接続されたキャパシタ素子およびインダクタ
素子からなる直列共振回路と、前記第１のタップから前
記第２のタップに流れる電流を制御する第１の電流増幅
素子と、前記第２のタップから前記第１のタップに流れ
る電流を制御する第２の電流増幅素子と、前記第１のタ
ップと前記第１の電流制御素子のコレクタ端子との間に
接続される第１のダイオードと、前記第２のタップと前
記第２の電流制御素子のコレクタ端子との間に接続され
る第２のダイオードと、前記第１の電流制御素子のベー
ス−エミッタ間に接続される第１のインピーダンス素子
および第３のダイオードと、前記第２の電流制御素子の
ベース−エミッタ間に接続される第２のインピーダンス
素子および第４のダイオードと、を備え、前記第１のタ
ップから前記第１のダイオードおよび前記第１の電流増
幅素子を介して前記第２のタップに流れる第１の電流経
路と、前記第１のタップから前記第４のダイオード、前
記直列共振回路および前記第１のインピーダンス素子を
介して前記第２のタップに流れる第２の電流経路と、前
記第２のタップから前記第２のダイオードおよび前記第
２の電流増幅素子を介して前記第１のタップに流れる第
３の電流経路と、前記第２のタップから前記第３のダイ
オード、前記直列共振回路および前記第２のインピーダ
ンス素子を介して前記第１のタップに流れる第４の電流
経路と、が設けられ、前記第１および第２の交流電源
は、前記第２および第３のタップの間に接続される。
【００２１】請求項４に記載の発明では、第１〜第３の
タップをもつ巻線の第１および第２のタップ間に第１〜
第４の電流経路を設け、第２および第３のタップ間に第
１および第２の交流電源を接続するため、第１〜第４の
電流経路に流れる電流よりも多くの電流を第１および第
２の交流電源間に流すことができる。
タップをもつ巻線の第１および第２のタップ間に第１〜
第４の電流経路を設け、第２および第３のタップ間に第
１および第２の交流電源を接続するため、第１〜第４の
電流経路に流れる電流よりも多くの電流を第１および第
２の交流電源間に流すことができる。
【００２２】請求項５の発明は、第１の交流電源を第２
の交流電源に系統連系させる電流形能動フィルタ回路に
おいて、１個以上の一次巻線と、いずれの前記一次巻線
よりも巻数が多く前記一次巻線に磁気結合する二次巻線
とを有する電圧変成器と、直列接続されたキャパシタ素
子およびインダクタ素子からなる直列共振回路と、前記
一次巻線の一端から前記一次巻線の他端に流れる電流を
制御する第１の電流増幅素子と、前記一次巻線の他端か
ら前記一次巻線の一端に流れる電流を制御する第２の電
流増幅素子と、前記一次巻線の一端と前記第１の電流制
御素子のコレクタ端子との間に接続される第１のダイオ
ードと、前記一次巻線の他端と前記第２の電流制御素子
のコレクタ端子との間に接続される第２のダイオード
と、前記第１の電流制御素子のベース−エミッタ間に接
続される第１のインピーダンス素子および第３のダイオ
ードと、前記第２の電流制御素子のベース−エミッタ間
に接続される第２のインピーダンス素子および第４のダ
イオードと、を備え、前記一次巻線の一端から前記第１
のダイオードおよび前記第１の電流増幅素子を介して前
記一次巻線の他端に流れる第１の電流経路と、前記一次
巻線の一端から前記第４のダイオード、前記直列共振回
路および前記第１のインピーダンス素子を介して前記一
次巻線の他端に流れる第２の電流経路と、前記一次巻線
の他端から前記第２のダイオードおよび前記第２の電流
増幅素子を介して前記一次巻線の一端に流れる第３の電
流経路と、前記一次巻線の他端から前記第３のダイオー
ド、前記直列共振回路および前記第２のインピーダンス
素子を介して前記一次巻線の一端に流れる第４の電流経
路とが設けられ、前記第１および第２の交流電源は前記
一次巻線間に接続される。
の交流電源に系統連系させる電流形能動フィルタ回路に
おいて、１個以上の一次巻線と、いずれの前記一次巻線
よりも巻数が多く前記一次巻線に磁気結合する二次巻線
とを有する電圧変成器と、直列接続されたキャパシタ素
子およびインダクタ素子からなる直列共振回路と、前記
一次巻線の一端から前記一次巻線の他端に流れる電流を
制御する第１の電流増幅素子と、前記一次巻線の他端か
ら前記一次巻線の一端に流れる電流を制御する第２の電
流増幅素子と、前記一次巻線の一端と前記第１の電流制
御素子のコレクタ端子との間に接続される第１のダイオ
ードと、前記一次巻線の他端と前記第２の電流制御素子
のコレクタ端子との間に接続される第２のダイオード
と、前記第１の電流制御素子のベース−エミッタ間に接
続される第１のインピーダンス素子および第３のダイオ
ードと、前記第２の電流制御素子のベース−エミッタ間
に接続される第２のインピーダンス素子および第４のダ
イオードと、を備え、前記一次巻線の一端から前記第１
のダイオードおよび前記第１の電流増幅素子を介して前
記一次巻線の他端に流れる第１の電流経路と、前記一次
巻線の一端から前記第４のダイオード、前記直列共振回
路および前記第１のインピーダンス素子を介して前記一
次巻線の他端に流れる第２の電流経路と、前記一次巻線
の他端から前記第２のダイオードおよび前記第２の電流
増幅素子を介して前記一次巻線の一端に流れる第３の電
流経路と、前記一次巻線の他端から前記第３のダイオー
ド、前記直列共振回路および前記第２のインピーダンス
素子を介して前記一次巻線の一端に流れる第４の電流経
路とが設けられ、前記第１および第２の交流電源は前記
一次巻線間に接続される。
【００２３】請求項５に記載の発明では、電流変成器の
一次巻線間に第１〜第４の電流経路を設け、一次巻線間
に第１および第２の交流電源を接続するため、一次巻線
を複数設ければ、２相または３相の交流電源を系統連系
させる場合に、回生電流の高調波を抑制することができ
る。
一次巻線間に第１〜第４の電流経路を設け、一次巻線間
に第１および第２の交流電源を接続するため、一次巻線
を複数設ければ、２相または３相の交流電源を系統連系
させる場合に、回生電流の高調波を抑制することができ
る。
【００２４】
【発明の実施の形態】以下、本発明に係る電流形能動フ
ィルタ回路について、図面を参照しながら具体的に説明
する。
ィルタ回路について、図面を参照しながら具体的に説明
する。
【００２５】（第１の実施形態）図１は本発明に係る電
流形能動フィルタ回路の第１の実施形態の回路図であ
る。図１の電流形能動フィルタ回路は、インバータ１と
商用電源２とを系統連系させる例を示している。
流形能動フィルタ回路の第１の実施形態の回路図であ
る。図１の電流形能動フィルタ回路は、インバータ１と
商用電源２とを系統連系させる例を示している。
【００２６】図１の電流形能動フィルタ回路は、直列接
続されたキャパシタ素子Ｃ１およびインダクタ素子Ｌ１
からなる直列共振回路３と、インバータ１から商用電源
２に流れる電流を制御するNPNトランジスタ（第１の電
流増幅素子）Ｑ１と、商用電源２からインバータ１に流
れる電流を制御するNPNトランジスタ（第２の電流増幅
素子）Ｑ２と、インバータ１とNPNトランジスタＱ２の
コレクタ端子との間に接続されるダイオード（第１のダ
イオード）Ｄ１と、商用電源２とNPNトランジスタＱ１
のコレクタ端子との間に接続されるダイオード（第２の
ダイオード）Ｄ２と、NPNトランジスタＱ１のベース−
エミッタ間に接続された抵抗素子（第１のインピーダン
ス素子）Ｒ１およびダイオード（第３のダイオード）Ｄ
３と、NPNトランジスタＱ２のベース−エミッタ間に接
続された抵抗素子（第２のインピーダンス素子）Ｒ２お
よびダイオード（第４のダイオード）Ｄ４と、を備えて
いる。
続されたキャパシタ素子Ｃ１およびインダクタ素子Ｌ１
からなる直列共振回路３と、インバータ１から商用電源
２に流れる電流を制御するNPNトランジスタ（第１の電
流増幅素子）Ｑ１と、商用電源２からインバータ１に流
れる電流を制御するNPNトランジスタ（第２の電流増幅
素子）Ｑ２と、インバータ１とNPNトランジスタＱ２の
コレクタ端子との間に接続されるダイオード（第１のダ
イオード）Ｄ１と、商用電源２とNPNトランジスタＱ１
のコレクタ端子との間に接続されるダイオード（第２の
ダイオード）Ｄ２と、NPNトランジスタＱ１のベース−
エミッタ間に接続された抵抗素子（第１のインピーダン
ス素子）Ｒ１およびダイオード（第３のダイオード）Ｄ
３と、NPNトランジスタＱ２のベース−エミッタ間に接
続された抵抗素子（第２のインピーダンス素子）Ｒ２お
よびダイオード（第４のダイオード）Ｄ４と、を備えて
いる。
【００２７】図１の電流形能動フィルタ回路において、
インバータ１から商用電源２に流れる電流は、インバー
タ１からダイオードＤ１およびNPNトランジスタＱ１を
介して商用電源２に流れる第１の電流経路Ｉ１と、イン
バータ１からダイオードＤ４、直列共振回路３および抵
抗素子Ｒ１を介して商用電源２に流れる第２の電流経路
Ｉ２とを通って流れる。
インバータ１から商用電源２に流れる電流は、インバー
タ１からダイオードＤ１およびNPNトランジスタＱ１を
介して商用電源２に流れる第１の電流経路Ｉ１と、イン
バータ１からダイオードＤ４、直列共振回路３および抵
抗素子Ｒ１を介して商用電源２に流れる第２の電流経路
Ｉ２とを通って流れる。
【００２８】また、商用電源２から前記インバータ１に
流れる電流は、商用電源２からダイオードＤ２およびNP
NトランジスタＱ２を介してインバータ１に流れる第３
の電流経路Ｉ３と、商用電源２からダイオードＤ３、直
列共振回路３および抵抗素子Ｒ２を介してインバータ１
に流れる第４の電流経路Ｉ４と、を通って流れる。
流れる電流は、商用電源２からダイオードＤ２およびNP
NトランジスタＱ２を介してインバータ１に流れる第３
の電流経路Ｉ３と、商用電源２からダイオードＤ３、直
列共振回路３および抵抗素子Ｒ２を介してインバータ１
に流れる第４の電流経路Ｉ４と、を通って流れる。
【００２９】これら４つの電流経路のうち、NPNトラン
ジスタＱ１，Ｑ２を通って流れる第１および第３の電流
経路は主電流回路を構成し、直列共振回路３を通って流
れる第２および第４の電流経路は補助共振回路を構成し
ている。補助共振回路には、主電流回路の数10分の１の
電流が流れる。
ジスタＱ１，Ｑ２を通って流れる第１および第３の電流
経路は主電流回路を構成し、直列共振回路３を通って流
れる第２および第４の電流経路は補助共振回路を構成し
ている。補助共振回路には、主電流回路の数10分の１の
電流が流れる。
【００３０】図１において、インバータ１から商用電源
２に電力を回生される場合、NPNトランジスタＱ１を介
して第１の電流経路を通って流れる電流Ｉ1と、直列共
振回路３を介して第２の電流経路を通って流れる電流Ｉ
２との間には、（１）式の関係が成り立つ。
２に電力を回生される場合、NPNトランジスタＱ１を介
して第１の電流経路を通って流れる電流Ｉ1と、直列共
振回路３を介して第２の電流経路を通って流れる電流Ｉ
２との間には、（１）式の関係が成り立つ。
【００３１】Ｉ1／Ｉ２＝β’ …（１） （１）式のβ’は、NPNトランジスタＱ１の素子ばらつ
きを抑えるために、抵抗Ｒ１，Ｒ２，Ｒ３，Ｒ４の値に
より定まる負帰還量を加味してNPNトランジスタの電流
増幅率β（通常20〜100）を修正した等価電流増幅率で
ある。
きを抑えるために、抵抗Ｒ１，Ｒ２，Ｒ３，Ｒ４の値に
より定まる負帰還量を加味してNPNトランジスタの電流
増幅率β（通常20〜100）を修正した等価電流増幅率で
ある。
【００３２】（１）式より、電流Ｉ２＝Ｉ１／β’と表
すことができ、直列共振回路３に流れる電流Ｉ２は電流
Ｉ1に比べて非常に小さくなる。したがって、直列共振
回路３を構成するキャパシタ素子Ｃ１の容量とインダク
タ素子Ｌ１の電気的容量（ωＬＩ2／２）を小さくする
ことができ、小型・軽量化が可能になる。
すことができ、直列共振回路３に流れる電流Ｉ２は電流
Ｉ1に比べて非常に小さくなる。したがって、直列共振
回路３を構成するキャパシタ素子Ｃ１の容量とインダク
タ素子Ｌ１の電気的容量（ωＬＩ2／２）を小さくする
ことができ、小型・軽量化が可能になる。
【００３３】図１の電流形能動フィルタ回路は、電源周
波数50/60Hzまたは400Hz程度の低周波数で動作するた
め、NPNトランジスタＱ１，Ｑ２の具体的な品種とし
て、例えば2SDxxxxタイプの高電流増幅率のものを利用
できる。具体的には、トランジスタ単体の電流増幅率β
が100前後の品種を選択でき、素子ばらつきを低減する
ために負帰還回路を追加しても、等価電流増幅率β’を
30〜40に設定するのが容易になる。
波数50/60Hzまたは400Hz程度の低周波数で動作するた
め、NPNトランジスタＱ１，Ｑ２の具体的な品種とし
て、例えば2SDxxxxタイプの高電流増幅率のものを利用
できる。具体的には、トランジスタ単体の電流増幅率β
が100前後の品種を選択でき、素子ばらつきを低減する
ために負帰還回路を追加しても、等価電流増幅率β’を
30〜40に設定するのが容易になる。
【００３４】このように、電流形能動フィルタ回路を図
１のような回路構成にすれば、直列共振回路３を構成す
るキャパシタ素子Ｃ１の容量とインダクタ素子Ｌ１の電
気的容量を、図８に示した従来の直列共振回路３に比べ
て、1/30〜1/40に低減することができる。
１のような回路構成にすれば、直列共振回路３を構成す
るキャパシタ素子Ｃ１の容量とインダクタ素子Ｌ１の電
気的容量を、図８に示した従来の直列共振回路３に比べ
て、1/30〜1/40に低減することができる。
【００３５】また、直列共振回路３に流れる電流が0.5
アンペアの場合、NPNトランジスタＱ１，Ｑ２を流れる
電流は10アンペア程度になり、また、図１のダイオード
Ｄ１〜Ｄ４をすべてショトキーダイオードにすれば、フ
ィルタ回路の両端子間の動作電圧を２ボルト程度に維持
できることを実験により確認した。
アンペアの場合、NPNトランジスタＱ１，Ｑ２を流れる
電流は10アンペア程度になり、また、図１のダイオード
Ｄ１〜Ｄ４をすべてショトキーダイオードにすれば、フ
ィルタ回路の両端子間の動作電圧を２ボルト程度に維持
できることを実験により確認した。
【００３６】このように、本実施形態は、インバータ１
と商用電源２との間に、直列共振回路３とは別個に主電
流回路を設け、インバータ１と商用電源２との間に流れ
る電流の大部分を主電流回路に流し、一部の電流だけを
直列共振回路３に流すようにしたため、直列共振回路３
を構成するキャパシタ素子Ｃ１の容量値とインダクタ素
子Ｌ１の電気的容量を小さくすることができ、回路全体
を小型・軽量化することができる。
と商用電源２との間に、直列共振回路３とは別個に主電
流回路を設け、インバータ１と商用電源２との間に流れ
る電流の大部分を主電流回路に流し、一部の電流だけを
直列共振回路３に流すようにしたため、直列共振回路３
を構成するキャパシタ素子Ｃ１の容量値とインダクタ素
子Ｌ１の電気的容量を小さくすることができ、回路全体
を小型・軽量化することができる。
【００３７】また、図１の電流形能動フィルタ回路は、
図７のようなパワー・コンディショナー１１を設けて電
流波形の整形を行う場合に比べて、はるかに回路構成を
簡略化でき、また、スイッチング動作も行わないため、
高周波帯域での雑音が発生しなくなる。
図７のようなパワー・コンディショナー１１を設けて電
流波形の整形を行う場合に比べて、はるかに回路構成を
簡略化でき、また、スイッチング動作も行わないため、
高周波帯域での雑音が発生しなくなる。
【００３８】（第２の実施形態）第２の実施形態は、電
力増幅用のトランジスタとしてPNPトランジスタを用い
たものである。
力増幅用のトランジスタとしてPNPトランジスタを用い
たものである。
【００３９】図２は本発明に係る電流形能動フィルタ回
路の第２の実施形態の回路図である。図２では、図１と
共通する構成部分には同一符号を付しており、以下では
相違点を中心に説明する。
路の第２の実施形態の回路図である。図２では、図１と
共通する構成部分には同一符号を付しており、以下では
相違点を中心に説明する。
【００４０】図２の電流形能動フィルタ回路は、図１の
NPNトランジスタＱ１，Ｑ２の代わりにPNPトランジスタ
Ｑ１’，Ｑ２’を用いる点と、ダイオードＤ１〜Ｄ４の
接続方向を逆にする点以外は、図１の回路と同じであ
る。
NPNトランジスタＱ１，Ｑ２の代わりにPNPトランジスタ
Ｑ１’，Ｑ２’を用いる点と、ダイオードＤ１〜Ｄ４の
接続方向を逆にする点以外は、図１の回路と同じであ
る。
【００４１】したがって、第１の実施形態と同様に、直
列共振回路内のキャパシタ素子の容量値とインダクタ素
子の電気的容量とを小さくでき、小型・軽量化が図れ
る。
列共振回路内のキャパシタ素子の容量値とインダクタ素
子の電気的容量とを小さくでき、小型・軽量化が図れ
る。
【００４２】（第３の実施形態）第３の実施形態は、電
流増幅用トランジスタを流れる電流よりも多くの電流を
主回路に流せるようにしつつ、主回路の回生電流波形の
歪みを抑制するものである。
流増幅用トランジスタを流れる電流よりも多くの電流を
主回路に流せるようにしつつ、主回路の回生電流波形の
歪みを抑制するものである。
【００４３】図３は本発明に係る電流形能動フィルタ回
路の第３の実施形態の回路図である。図３では、図１と
共通する構成部分には同一符号を付しており、以下では
相違点を中心に説明する。
路の第３の実施形態の回路図である。図３では、図１と
共通する構成部分には同一符号を付しており、以下では
相違点を中心に説明する。
【００４４】図３の電流形能動フィルタ回路は、インバ
ータ１と商用電源２との間に、図１と同様に構成された
第１〜第４の電流経路Ｉ１〜Ｉ４をもつフィルタ部を接
続する点で図１の回路と共通する。
ータ１と商用電源２との間に、図１と同様に構成された
第１〜第４の電流経路Ｉ１〜Ｉ４をもつフィルタ部を接
続する点で図１の回路と共通する。
【００４５】図１の回路と異なるのは、３つのタップを
もつ単巻き型電流変成器ＴＲ１を備える点である。この
電流変成器ＴＲ１のタップ（第１のタップ）ａには、NP
NトランジスタＱ２のエミッタ端子が接続され、タップ
（第３のタップ）ｂには商用電源２が接続され、タップ
（第２のタップ）ｃにはNPNトランジスタＱ１のエミッ
タ端子とインバータ１が接続されている。
もつ単巻き型電流変成器ＴＲ１を備える点である。この
電流変成器ＴＲ１のタップ（第１のタップ）ａには、NP
NトランジスタＱ２のエミッタ端子が接続され、タップ
（第３のタップ）ｂには商用電源２が接続され、タップ
（第２のタップ）ｃにはNPNトランジスタＱ１のエミッ
タ端子とインバータ１が接続されている。
【００４６】タップｂ，ｃ間の巻数をｎ1、タップａ，
ｃ間の巻数をｎ2、タップｂ，ｃ間を流れる電流をｉ1、
タップａ，ｃ間を流れる電流をｉ2とすると、（２）式
が成り立つ。
ｃ間の巻数をｎ2、タップｂ，ｃ間を流れる電流をｉ1、
タップａ，ｃ間を流れる電流をｉ2とすると、（２）式
が成り立つ。
【００４７】ｉ１＝ｉ２×（ｎ2／ｎ1） …（２） （２）式に示すように、図３の電流形能動フィルタ回路
は、NPNトランジスタＱ１，Ｑ２や直列共振回路３に流
れる電流よりも多くの電流をインバータ１と商用電源２
との間に流すことができる。また、第１の実施形態と同
様に、直列共振回路３を構成するキャパシタ素子Ｃ１の
容量値やインダクタ素子Ｌ１の電気的容量を小さくでき
る。
は、NPNトランジスタＱ１，Ｑ２や直列共振回路３に流
れる電流よりも多くの電流をインバータ１と商用電源２
との間に流すことができる。また、第１の実施形態と同
様に、直列共振回路３を構成するキャパシタ素子Ｃ１の
容量値やインダクタ素子Ｌ１の電気的容量を小さくでき
る。
【００４８】（第４の実施形態）第４の実施形態は、第
２の実施形態の変形例であり、複巻きの電流変成器を設
けたものである。
２の実施形態の変形例であり、複巻きの電流変成器を設
けたものである。
【００４９】図４は本発明に係る電流形能動フィルタ回
路の第４の実施形態の回路図である。図４では、図１と
共通する構成部分には同一符号を付しており、以下では
相違点を中心に説明する。
路の第４の実施形態の回路図である。図４では、図１と
共通する構成部分には同一符号を付しており、以下では
相違点を中心に説明する。
【００５０】図４の電流形能動フィルタ回路は、共通の
コアに巻かれた一次巻線および二次巻線を有する複巻き
の電流変成器ＴＲ２を備えている。この変成器ＴＲ２の
二次巻線には、それぞれ異なるインバータ１が接続され
ている。一次巻線には、図１と同様に構成された第１〜
第４の電流経路Ｉ１〜Ｉ４をもつフィルタ部１０が接続
されている。
コアに巻かれた一次巻線および二次巻線を有する複巻き
の電流変成器ＴＲ２を備えている。この変成器ＴＲ２の
二次巻線には、それぞれ異なるインバータ１が接続され
ている。一次巻線には、図１と同様に構成された第１〜
第４の電流経路Ｉ１〜Ｉ４をもつフィルタ部１０が接続
されている。
【００５１】図４の回路は、複数のインバータ１と商用
電源２とを系統連系した場合に、各インバータ１に流れ
る電流を合成した回生電流の波形歪みを低減できるとい
う特徴を有する。また、第１および第２の実施形態と同
様に、直列共振回路を構成するキャパシタ素子の容量値
やインダクタ素子の電気的容量を小さくでき、回路全体
を小型化できる。
電源２とを系統連系した場合に、各インバータ１に流れ
る電流を合成した回生電流の波形歪みを低減できるとい
う特徴を有する。また、第１および第２の実施形態と同
様に、直列共振回路を構成するキャパシタ素子の容量値
やインダクタ素子の電気的容量を小さくでき、回路全体
を小型化できる。
【００５２】なお、図３および図４の回路においても、
図２と同様に、NPNトランジスタＱ１，Ｑ２の代わりにP
NPトランジスタＱ１’，Ｑ２’を接続してもよい。
図２と同様に、NPNトランジスタＱ１，Ｑ２の代わりにP
NPトランジスタＱ１’，Ｑ２’を接続してもよい。
【００５３】
【発明の効果】以上詳細に説明したように、本発明によ
れば、第１および第２の交流電源の間に、第１〜第４の
電流経路を設けるため、回生電流の波形歪みを抑制する
ために設けられる直列共振回路に流れる歪み電流を少な
くすることができ、直列共振回路を構成するキャパシタ
素子とインダクタ素子のサイズを小さくすることができ
る。したがって、本発明は、フィルタ特性を損なうこと
なく、小型・軽量化が図れ、また、交流電流を扱う各種
のパワーエレクトロニクス機器の電流波形歪みの改善に
広く適用可能である。
れば、第１および第２の交流電源の間に、第１〜第４の
電流経路を設けるため、回生電流の波形歪みを抑制する
ために設けられる直列共振回路に流れる歪み電流を少な
くすることができ、直列共振回路を構成するキャパシタ
素子とインダクタ素子のサイズを小さくすることができ
る。したがって、本発明は、フィルタ特性を損なうこと
なく、小型・軽量化が図れ、また、交流電流を扱う各種
のパワーエレクトロニクス機器の電流波形歪みの改善に
広く適用可能である。
【図１】本発明に係る電流形能動フィルタ回路の第１の
実施形態の回路図。
実施形態の回路図。
【図２】本発明に係る電流形能動フィルタ回路の第２の
実施形態の回路図。
実施形態の回路図。
【図３】本発明に係る電流形能動フィルタ回路の第３の
実施形態の回路図。
実施形態の回路図。
【図４】本発明に係る電流形能動フィルタ回路の第４の
実施形態の回路図。
実施形態の回路図。
【図５】インバータと商用電源とを系統連系させる例を
示す図。
示す図。
【図６】実線Ｌ１は図５のインバータの両端電圧の電圧
波形、点線Ｌ２は商用電源の両端電圧の電圧波形を示す
図。
波形、点線Ｌ２は商用電源の両端電圧の電圧波形を示す
図。
【図７】パワー・コンディショナーを有する電力回生装
置の概略構成を示すブロック図。
置の概略構成を示すブロック図。
【図８】インバータと商用電源との間に直列共振回路を
接続した従来の回路図。
接続した従来の回路図。
１ インバータ ２ 商用電源 ３ 直列共振回路 １０ フィルタ部 Ｑ１，Ｑ２ NPNトランジスタ Ｄ１〜Ｄ４ ダイオード
Claims (5)
- 【請求項１】第１の交流電源を第２の交流電源に系統連
系させる電流形能動フィルタ回路において、 直列接続されたキャパシタ素子およびインダクタ素子か
らなる直列共振回路と、 前記第１の交流電源から前記第２の交流電源に流れる電
流を制御する第１の電流増幅素子と、 前記第２の交流電源から前記第１の交流電源に流れる電
流を制御する第２の電流増幅素子と、 前記第１の交流電源と前記第１の電流制御素子のコレク
タ端子との間に接続された第１のダイオードと、 前記第２の交流電源と前記第２の電流制御素子のコレク
タ端子との間に接続された第２のダイオードと、 前記第１の電流制御素子のベース−エミッタ間に接続さ
れた第１のインピーダンス素子および第３のダイオード
と、 前記第２の電流制御素子のベース−エミッタ間に接続さ
れた第２のインピーダンス素子および第４のダイオード
と、を備え、 前記第１の交流電源から前記第１のダイオードおよび前
記第１の電流増幅素子を介して前記第２の交流電源に流
れる第１の電流経路と、 前記第１の交流電源から前記第４のダイオード、前記直
列共振回路および前記第１のインピーダンス素子を介し
て前記第２の交流電源に流れる第２の電流経路と、 前記第２の交流電源から前記第２のダイオードおよび前
記第２の電流増幅素子を介して前記第１の交流電源に流
れる第３の電流経路と、 前記第２の交流電源から前記第３のダイオード、前記直
列共振回路および前記第２のインピーダンス素子を介し
て前記第１の交流電源に流れる第４の電流経路と、が設
けられることを特徴とする電流形能動フィルタ回路。 - 【請求項２】前記第１の電流増幅素子のベース−コレク
タ間に接続された第３のインピーダンス素子と、 前記第２の電流増幅素子のベース−コレクタ間に接続さ
れた第４のインピーダンス素子と、を備え、 前記第１および第２の電流増幅素子は、ＮＰＮトランジ
スタであり、 前記第１の電流増幅素子のエミッタ端子には前記第２お
よび第３のダイオードのアノード端子が接続され、 前記第１の電流増幅素子のベース端子には前記第３のダ
イオードのカソード端子が接続され、 前記第２の電流増幅素子のエミッタ端子には前記第１お
よび第４のダイオードのアノード端子が接続され、 前記第２の電流増幅素子のベース端子には前記第４のダ
イオードのカソード端子が接続されることを特徴とする
請求項１に記載の電流形能動フィルタ回路。 - 【請求項３】前記第１の電流増幅素子のベース−コレク
タ間に接続された第３のインピーダンス素子と、 前記第２の電流増幅素子のベース−コレクタ間に接続さ
れた第４のインピーダンス素子と、を備え、 前記第１および第２の電流増幅素子は、ＰＮＰトランジ
スタであり、 前記第１の電流増幅素子のエミッタ端子には前記第２お
よび第３のダイオードのアノード端子が接続され、 前記第１の電流増幅素子のベース端子には前記第３のダ
イオードのカソード端子が接続され、 前記第２の電流増幅素子のエミッタ端子には前記第１お
よび第４のダイオードのアノード端子が接続され、 前記第２の電流増幅素子のベース端子には前記第４のダ
イオードのカソード端子が接続されることを特徴とする
請求項１に記載の電流形能動フィルタ回路。 - 【請求項４】第１の交流電源を第２の交流電源に系統連
系させる電流形能動フィルタ回路において、 第１および第２のタップと、前記第１および第２のタッ
プの間に設けられる第３のタップとを有する巻線と、 直列接続されたキャパシタ素子およびインダクタ素子か
らなる直列共振回路と、 前記第１のタップから前記第２のタップに流れる電流を
制御する第１の電流増幅素子と、 前記第２のタップから前記第１のタップに流れる電流を
制御する第２の電流増幅素子と、 前記第１のタップと前記第１の電流制御素子のコレクタ
端子との間に接続される第１のダイオードと、 前記第２のタップと前記第２の電流制御素子のコレクタ
端子との間に接続される第２のダイオードと、 前記第１の電流制御素子のベース−エミッタ間に接続さ
れる第１のインピーダンス素子および第３のダイオード
と、 前記第２の電流制御素子のベース−エミッタ間に接続さ
れる第２のインピーダンス素子および第４のダイオード
と、を備え、 前記第１のタップから前記第１のダイオードおよび前記
第１の電流増幅素子を介して前記第２のタップに流れる
第１の電流経路と、 前記第１のタップから前記第４のダイオード、前記直列
共振回路および前記第１のインピーダンス素子を介して
前記第２のタップに流れる第２の電流経路と、 前記第２のタップから前記第２のダイオードおよび前記
第２の電流増幅素子を介して前記第１のタップに流れる
第３の電流経路と、 前記第２のタップから前記第３のダイオード、前記直列
共振回路および前記第２のインピーダンス素子を介して
前記第１のタップに流れる第４の電流経路と、が設けら
れ、 前記第１および第２の交流電源は、前記第２および第３
のタップの間に接続されることを特徴とする電流形能動
フィルタ回路。 - 【請求項５】第１の交流電源を第２の交流電源に系統連
系させる電流形能動フィルタ回路において、 １個以上の一次巻線と、いずれの前記一次巻線よりも巻
数が多く前記一次巻線に磁気結合する二次巻線とを有す
る変圧器と、 直列接続されたキャパシタ素子およびインダクタ素子か
らなる直列共振回路と、 前記一次巻線の一端から前記一次巻線の他端に流れる電
流を制御する第１の電流増幅素子と、 前記一次巻線の他端から前記一次巻線の一端に流れる電
流を制御する第２の電流増幅素子と、 前記一次巻線の一端と前記第１の電流制御素子のコレク
タ端子との間に接続される第１のダイオードと、 前記一次巻線の他端と前記第２の電流制御素子のコレク
タ端子との間に接続される第２のダイオードと、 前記第１の電流制御素子のベース−エミッタ間に接続さ
れる第１のインピーダンス素子および第３のダイオード
と、 前記第２の電流制御素子のベース−エミッタ間に接続さ
れる第２のインピーダンス素子および第４のダイオード
と、を備え、 前記一次巻線の一端から前記第１のダイオードおよび前
記第１の電流増幅素子を介して前記一次巻線の他端に流
れる第１の電流経路と、 前記一次巻線の一端から前記第４のダイオード、前記直
列共振回路および前記第１のインピーダンス素子を介し
て前記一次巻線の他端に流れる第２の電流経路と、 前記一次巻線の他端から前記第２のダイオードおよび前
記第２の電流増幅素子を介して前記一次巻線の一端に流
れる第３の電流経路と、 前記一次巻線の他端から前記第３のダイオード、前記直
列共振回路および前記第２のインピーダンス素子を介し
て前記一次巻線の一端に流れる第４の電流経路とが設け
られ、 前記第１および第２の交流電源は前記二次巻線間に接続
されることを特徴とする電流形能動フィルタ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000039243A JP2001231165A (ja) | 2000-02-17 | 2000-02-17 | 電流形能動フィルタ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000039243A JP2001231165A (ja) | 2000-02-17 | 2000-02-17 | 電流形能動フィルタ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2001231165A true JP2001231165A (ja) | 2001-08-24 |
Family
ID=18562842
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000039243A Pending JP2001231165A (ja) | 2000-02-17 | 2000-02-17 | 電流形能動フィルタ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2001231165A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN110249495A (zh) * | 2017-01-25 | 2019-09-17 | 乌本产权有限公司 | 用于馈入交流电流的方法 |
-
2000
- 2000-02-17 JP JP2000039243A patent/JP2001231165A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN110249495A (zh) * | 2017-01-25 | 2019-09-17 | 乌本产权有限公司 | 用于馈入交流电流的方法 |
| CN110249495B (zh) * | 2017-01-25 | 2024-05-14 | 乌本产权有限公司 | 用于馈入交流电流的方法 |
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