JP2001203327A - 容量素子と抵抗素子とを有する電子部材の製造方法、半導体装置の製造方法、及び半導体装置 - Google Patents
容量素子と抵抗素子とを有する電子部材の製造方法、半導体装置の製造方法、及び半導体装置Info
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 36
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 28
- 239000000463 material Substances 0.000 claims abstract description 82
- 238000000034 method Methods 0.000 claims abstract description 45
- 230000008569 process Effects 0.000 claims abstract description 13
- 238000011282 treatment Methods 0.000 claims abstract description 9
- BPUBBGLMJRNUCC-UHFFFAOYSA-N oxygen(2-);tantalum(5+) Chemical compound [O-2].[O-2].[O-2].[O-2].[O-2].[Ta+5].[Ta+5] BPUBBGLMJRNUCC-UHFFFAOYSA-N 0.000 claims description 34
- 239000003990 capacitor Substances 0.000 claims description 32
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 claims description 29
- 229910001936 tantalum oxide Inorganic materials 0.000 claims description 27
- 229910052760 oxygen Inorganic materials 0.000 claims description 20
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims description 18
- 239000001301 oxygen Substances 0.000 claims description 18
- 238000012545 processing Methods 0.000 claims description 17
- 229910052757 nitrogen Inorganic materials 0.000 claims description 14
- 229910052715 tantalum Inorganic materials 0.000 claims description 8
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical group [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 claims description 8
- PBCFLUZVCVVTBY-UHFFFAOYSA-N tantalum pentoxide Inorganic materials O=[Ta](=O)O[Ta](=O)=O PBCFLUZVCVVTBY-UHFFFAOYSA-N 0.000 claims description 7
- 239000007789 gas Substances 0.000 claims description 5
- 229910052739 hydrogen Inorganic materials 0.000 claims description 3
- 238000002347 injection Methods 0.000 claims description 3
- 239000007924 injection Substances 0.000 claims description 3
- 239000007943 implant Substances 0.000 claims 1
- 238000001802 infusion Methods 0.000 claims 1
- 239000010408 film Substances 0.000 description 51
- 239000010410 layer Substances 0.000 description 21
- 239000011229 interlayer Substances 0.000 description 20
- 230000015572 biosynthetic process Effects 0.000 description 11
- 239000000758 substrate Substances 0.000 description 8
- QGZKDVFQNNGYKY-UHFFFAOYSA-N Ammonia Chemical compound N QGZKDVFQNNGYKY-UHFFFAOYSA-N 0.000 description 6
- OAKJQQAXSVQMHS-UHFFFAOYSA-N Hydrazine Chemical compound NN OAKJQQAXSVQMHS-UHFFFAOYSA-N 0.000 description 6
- 238000005121 nitriding Methods 0.000 description 6
- CBENFWSGALASAD-UHFFFAOYSA-N Ozone Chemical compound [O-][O+]=O CBENFWSGALASAD-UHFFFAOYSA-N 0.000 description 4
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 4
- 230000000694 effects Effects 0.000 description 4
- 229910052751 metal Inorganic materials 0.000 description 4
- 239000002184 metal Substances 0.000 description 4
- 230000003647 oxidation Effects 0.000 description 4
- 238000007254 oxidation reaction Methods 0.000 description 4
- 229910052710 silicon Inorganic materials 0.000 description 4
- 239000010703 silicon Substances 0.000 description 4
- 229910021529 ammonia Inorganic materials 0.000 description 3
- 238000005229 chemical vapour deposition Methods 0.000 description 3
- 238000011161 development Methods 0.000 description 3
- 239000003989 dielectric material Substances 0.000 description 3
- 230000006872 improvement Effects 0.000 description 3
- 230000001965 increasing effect Effects 0.000 description 3
- 230000010354 integration Effects 0.000 description 3
- MHAJPDPJQMAIIY-UHFFFAOYSA-N Hydrogen peroxide Chemical compound OO MHAJPDPJQMAIIY-UHFFFAOYSA-N 0.000 description 2
- GQPLMRYTRLFLPF-UHFFFAOYSA-N Nitrous Oxide Chemical compound [O-][N+]#N GQPLMRYTRLFLPF-UHFFFAOYSA-N 0.000 description 2
- 229910052581 Si3N4 Inorganic materials 0.000 description 2
- 229910004298 SiO 2 Inorganic materials 0.000 description 2
- 230000001747 exhibiting effect Effects 0.000 description 2
- 239000000203 mixture Substances 0.000 description 2
- 230000001590 oxidative effect Effects 0.000 description 2
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 2
- 229910018182 Al—Cu Inorganic materials 0.000 description 1
- 229910018523 Al—S Inorganic materials 0.000 description 1
- BSYNRYMUTXBXSQ-UHFFFAOYSA-N Aspirin Chemical compound CC(=O)OC1=CC=CC=C1C(O)=O BSYNRYMUTXBXSQ-UHFFFAOYSA-N 0.000 description 1
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- 229910000881 Cu alloy Inorganic materials 0.000 description 1
- 229910000676 Si alloy Inorganic materials 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 230000009471 action Effects 0.000 description 1
- CSDREXVUYHZDNP-UHFFFAOYSA-N alumanylidynesilicon Chemical compound [Al].[Si] CSDREXVUYHZDNP-UHFFFAOYSA-N 0.000 description 1
- 229910052782 aluminium Inorganic materials 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- WPPDFTBPZNZZRP-UHFFFAOYSA-N aluminum copper Chemical compound [Al].[Cu] WPPDFTBPZNZZRP-UHFFFAOYSA-N 0.000 description 1
- 230000008901 benefit Effects 0.000 description 1
- 229910052799 carbon Inorganic materials 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 239000001257 hydrogen Substances 0.000 description 1
- 125000004435 hydrogen atom Chemical class [H]* 0.000 description 1
- 238000002513 implantation Methods 0.000 description 1
- 239000012535 impurity Substances 0.000 description 1
- 230000001939 inductive effect Effects 0.000 description 1
- 238000002955 isolation Methods 0.000 description 1
- 239000001272 nitrous oxide Substances 0.000 description 1
- 230000003071 parasitic effect Effects 0.000 description 1
- 238000000059 patterning Methods 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 229920005591 polysilicon Polymers 0.000 description 1
- 230000001681 protective effect Effects 0.000 description 1
- 230000001603 reducing effect Effects 0.000 description 1
- 238000011160 research Methods 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 229910052814 silicon oxide Inorganic materials 0.000 description 1
- 150000003482 tantalum compounds Chemical class 0.000 description 1
- MZLGASXMSKOWSE-UHFFFAOYSA-N tantalum nitride Chemical compound [Ta]#N MZLGASXMSKOWSE-UHFFFAOYSA-N 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
- 230000001988 toxicity Effects 0.000 description 1
- 231100000419 toxicity Toxicity 0.000 description 1
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 1
- 229910001868 water Inorganic materials 0.000 description 1
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- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
- H01L27/06—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration
- H01L27/0611—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region
- H01L27/0641—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region without components of the field effect type
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- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
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- H01L21/316—Inorganic layers composed of oxides or glassy oxides or oxide based glass
- H01L21/3165—Inorganic layers composed of oxides or glassy oxides or oxide based glass formed by oxidation
- H01L21/31683—Inorganic layers composed of oxides or glassy oxides or oxide based glass formed by oxidation of metallic layers, e.g. Al deposited on the body, e.g. formation of multi-layer insulating structures
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L28/00—Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
- H01L28/20—Resistors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L28/00—Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
- H01L28/40—Capacitors
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
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- Condensed Matter Physics & Semiconductors (AREA)
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- Microelectronics & Electronic Packaging (AREA)
- Manufacturing & Machinery (AREA)
- Semiconductor Integrated Circuits (AREA)
- Fixed Capacitors And Capacitor Manufacturing Machines (AREA)
Abstract
(57)【要約】
【課題】 容量素子材料として優れ、それ以外の用途に
ついても好適な利用分野がある材料が見出せ、該材料に
より効率的に該双方の用途適性を発揮できる部材が得ら
れる技術を提供する。 【解決手段】 容量素子と抵抗素子とを有する電子部
材の製造方法で、同一材料からなる材料層(CVD酸化
タンタル膜等)に、窒化と酸化等、それぞれ異なる処理
を施すことにより容量素子と抵抗素子とを形成する。
容量素子と抵抗素子とを有する半導体装置の製造方法
で、同一材料からなる材料層にそれぞれ異なる処理を施
すことにより容量素子と抵抗素子とを形成する。容量
素子1と抵抗素子2とを有する半導体装置で、同一材料
からなる材料層をそれぞれ異なる処理で処理することに
より形成した容量素子と抵抗素子とを有する。
ついても好適な利用分野がある材料が見出せ、該材料に
より効率的に該双方の用途適性を発揮できる部材が得ら
れる技術を提供する。 【解決手段】 容量素子と抵抗素子とを有する電子部
材の製造方法で、同一材料からなる材料層(CVD酸化
タンタル膜等)に、窒化と酸化等、それぞれ異なる処理
を施すことにより容量素子と抵抗素子とを形成する。
容量素子と抵抗素子とを有する半導体装置の製造方法
で、同一材料からなる材料層にそれぞれ異なる処理を施
すことにより容量素子と抵抗素子とを形成する。容量
素子1と抵抗素子2とを有する半導体装置で、同一材料
からなる材料層をそれぞれ異なる処理で処理することに
より形成した容量素子と抵抗素子とを有する。
Description
【0001】
【発明の属する技術分野】本発明は、容量素子と抵抗素
子とを有する電子部材の製造方法、該製造方法を利用し
た半導体装置の製造方法、及び該半導体装置の製造方法
によって得られる半導体装置に関する。本発明は特に、
容量素子と抵抗素子との形成過程に改良を施したもので
あり、本発明はたとえば、金属等の電極の間に位置する
容量素子、及び金属等の電極の間に位置する抵抗素子を
備えた電子部材や半導体装置の分野で好適に利用するこ
とができる。
子とを有する電子部材の製造方法、該製造方法を利用し
た半導体装置の製造方法、及び該半導体装置の製造方法
によって得られる半導体装置に関する。本発明は特に、
容量素子と抵抗素子との形成過程に改良を施したもので
あり、本発明はたとえば、金属等の電極の間に位置する
容量素子、及び金属等の電極の間に位置する抵抗素子を
備えた電子部材や半導体装置の分野で好適に利用するこ
とができる。
【0002】
【従来の技術】従来より、容量素子を有する電子部材は
各種知られている。また、容量素子と抵抗素子とをとも
に有する電子部材も各種知られている。たとえば受動素
子として容量素子と抵抗素子とを有するLSI等の半導
体装置が知られている。
各種知られている。また、容量素子と抵抗素子とをとも
に有する電子部材も各種知られている。たとえば受動素
子として容量素子と抵抗素子とを有するLSI等の半導
体装置が知られている。
【0003】従来のこの種のものの一例を図10に示
す。基板3たとえばシリコン等の半導体基板上に層間絶
縁膜41,42を介して第1配線5が形成され、さらに
配線間層間絶縁膜7を介して第2配線8が形成されてい
る。
す。基板3たとえばシリコン等の半導体基板上に層間絶
縁膜41,42を介して第1配線5が形成され、さらに
配線間層間絶縁膜7を介して第2配線8が形成されてい
る。
【0004】ここで、図示従来例では、下層の層間絶縁
膜41上に抵抗素子2aが形成され、これは第1配線5
と同一層から形成された電極により接続されて、抵抗と
して機能している。また、上層の層間絶縁膜42上に誘
電体をなす容量素子1aが形成され、これは第1配線5
と第2配線6との間に挟まれて、つまり第1配線5が下
部電極となり第2配線6が上部電極となって、キャパシ
タを構成している。
膜41上に抵抗素子2aが形成され、これは第1配線5
と同一層から形成された電極により接続されて、抵抗と
して機能している。また、上層の層間絶縁膜42上に誘
電体をなす容量素子1aが形成され、これは第1配線5
と第2配線6との間に挟まれて、つまり第1配線5が下
部電極となり第2配線6が上部電極となって、キャパシ
タを構成している。
【0005】従来、容量素子1aと抵抗素子2aとは独
立に形成され、かつ図示のように、別層により構成され
ているのが通例である。
立に形成され、かつ図示のように、別層により構成され
ているのが通例である。
【0006】一方近年、LSI等の半導体装置では、一
層の高集積化の要請から、容量素子の高容量化を目的と
して、各種の高誘電率の誘電体材料の開発が行われてい
る。たとえば、Ta2 O5 やPZT,BST,STO等
を代表とする誘電体材料の開発が盛んに行われている。
その中でもTa2 O5 (五酸化タンタル)は実用段階に
あり、デバイスへの搭載も開始されている。
層の高集積化の要請から、容量素子の高容量化を目的と
して、各種の高誘電率の誘電体材料の開発が行われてい
る。たとえば、Ta2 O5 やPZT,BST,STO等
を代表とする誘電体材料の開発が盛んに行われている。
その中でもTa2 O5 (五酸化タンタル)は実用段階に
あり、デバイスへの搭載も開始されている。
【0007】ところで、従来の典型的な容量素子材料で
あるSiN(シリコンナイトライド)は、容量素子とし
ての用途以外にも、素子分離技術用材料や保護膜として
の用途があったため、設備投資に対する負荷率及びプロ
セス導入における付加価値は十分あったものと言える。
あるSiN(シリコンナイトライド)は、容量素子とし
ての用途以外にも、素子分離技術用材料や保護膜として
の用途があったため、設備投資に対する負荷率及びプロ
セス導入における付加価値は十分あったものと言える。
【0008】しかし上述した新材料の場合、すべてが必
ずしも容量素子材料以外の用途についても適するか否か
は不明である。容量素子材料として優れるものは、容量
素子の性能そのものがLSI等の付加価値を決定するた
とえばメモリー系LSI等については、たしかにそれだ
けで十分な付加価値となり得るが、容量素子が受動素子
の一部とみなされる電子部材、たとえばシステムLSI
やミックスシグナル系LSI、MMIC系等では、必ず
しもその開発が付加価値をもたらすとは限らない。この
ため、新材料の導入に際しては、プロセス及び設備導入
コストに対する容量素子性能向上も含めた総合的な付加
価値としては、慎重にならざるを得ない傾向が出るの
も、あながち理由の無いことではない。
ずしも容量素子材料以外の用途についても適するか否か
は不明である。容量素子材料として優れるものは、容量
素子の性能そのものがLSI等の付加価値を決定するた
とえばメモリー系LSI等については、たしかにそれだ
けで十分な付加価値となり得るが、容量素子が受動素子
の一部とみなされる電子部材、たとえばシステムLSI
やミックスシグナル系LSI、MMIC系等では、必ず
しもその開発が付加価値をもたらすとは限らない。この
ため、新材料の導入に際しては、プロセス及び設備導入
コストに対する容量素子性能向上も含めた総合的な付加
価値としては、慎重にならざるを得ない傾向が出るの
も、あながち理由の無いことではない。
【0009】このため本発明者は種々検討を重ね、容量
素子材料として優れる上、容量素子材料以外の用途につ
いても好適な利用分野がある材料を用いて、しかも容易
かつ適正にかかる材料を用いた技術を提供し得ないかど
うか研究を続けた。
素子材料として優れる上、容量素子材料以外の用途につ
いても好適な利用分野がある材料を用いて、しかも容易
かつ適正にかかる材料を用いた技術を提供し得ないかど
うか研究を続けた。
【0010】
【発明が解決しようとする課題】本発明は、上述した背
景でなされたもので、容量素子材料として優れ、かつ容
量素子材料以外の用途についても好適な利用分野がある
材料を見出すとともにこれを用いて、この材料により効
率的にその双方の用途適性を発揮できる部材が得られる
技術を提供することを目的とするものである。
景でなされたもので、容量素子材料として優れ、かつ容
量素子材料以外の用途についても好適な利用分野がある
材料を見出すとともにこれを用いて、この材料により効
率的にその双方の用途適性を発揮できる部材が得られる
技術を提供することを目的とするものである。
【0011】
【課題を解決するための手段】上記目的を達成するた
め、本発明においては、同一材料をそれぞれ異なる処理
で処理することにより容量素子を形成することも、抵抗
素子を形成することも可能である材料を採用する。
め、本発明においては、同一材料をそれぞれ異なる処理
で処理することにより容量素子を形成することも、抵抗
素子を形成することも可能である材料を採用する。
【0012】基本的に本発明は、容量素子材料として
も、容量素子材料以外の何らかの材料としても好適な材
料を見い出す過程において、同一材料を処理することで
上記のように複数の用途の材料となり得るものは無いか
を検討し、かつこの場合に、容量素子材料以外の用途と
して抵抗素子を形成することを想到して、本発明をなす
に至ったものである。本発明は本発明者による上記知見
に基づくものである。
も、容量素子材料以外の何らかの材料としても好適な材
料を見い出す過程において、同一材料を処理することで
上記のように複数の用途の材料となり得るものは無いか
を検討し、かつこの場合に、容量素子材料以外の用途と
して抵抗素子を形成することを想到して、本発明をなす
に至ったものである。本発明は本発明者による上記知見
に基づくものである。
【0013】本発明に係る容量素子と抵抗素子とを有す
る電子部材の製造方法は、容量素子と抵抗素子とを有す
る電子部材の製造方法であって、同一材料からなる材料
層にそれぞれ異なる処理を施すことにより前記容量素子
と前記抵抗素子とを形成することを特徴とするものであ
る。また、本発明に係る容量素子と抵抗素子とを有する
電子部材の製造方法は、容量素子と抵抗素子とを有する
電子部材の製造方法であって、酸化タンタル膜に、容量
素子領域には酸素を、抵抗素子領域には窒素をそれぞれ
分けて注入し、素子を分離形成することを特徴とするも
のである。
る電子部材の製造方法は、容量素子と抵抗素子とを有す
る電子部材の製造方法であって、同一材料からなる材料
層にそれぞれ異なる処理を施すことにより前記容量素子
と前記抵抗素子とを形成することを特徴とするものであ
る。また、本発明に係る容量素子と抵抗素子とを有する
電子部材の製造方法は、容量素子と抵抗素子とを有する
電子部材の製造方法であって、酸化タンタル膜に、容量
素子領域には酸素を、抵抗素子領域には窒素をそれぞれ
分けて注入し、素子を分離形成することを特徴とするも
のである。
【0014】本発明に係る半導体装置の製造方法は、容
量素子と抵抗素子とを有する半導体装置の製造方法であ
って、同一材料からなる材料層にそれぞれ異なる処理を
施すことにより前記容量素子と前記抵抗素子とを形成す
ることを特徴とするものである。また、本発明に係る半
導体装置の製造方法は、容量素子と抵抗素子とを有する
半導体装置の製造方法であって、酸化タンタル膜に、容
量素子領域には酸素を、抵抗素子領域には窒素をそれぞ
れ分けて注入し、素子を分離形成するものである。
量素子と抵抗素子とを有する半導体装置の製造方法であ
って、同一材料からなる材料層にそれぞれ異なる処理を
施すことにより前記容量素子と前記抵抗素子とを形成す
ることを特徴とするものである。また、本発明に係る半
導体装置の製造方法は、容量素子と抵抗素子とを有する
半導体装置の製造方法であって、酸化タンタル膜に、容
量素子領域には酸素を、抵抗素子領域には窒素をそれぞ
れ分けて注入し、素子を分離形成するものである。
【0015】本発明に係る半導体装置は、容量素子と抵
抗素子とを有する半導体装置であって、同一材料からな
る材料層をそれぞれ異なる処理で処理することにより形
成した容量素子と抵抗素子とを有することを特徴とする
ものである。
抗素子とを有する半導体装置であって、同一材料からな
る材料層をそれぞれ異なる処理で処理することにより形
成した容量素子と抵抗素子とを有することを特徴とする
ものである。
【0016】この発明によれば、同一材料からなる材料
層を処理することにより容量素子と抵抗素子とを形成す
るので、容量素子についてのみではなく、抵抗素子にも
その同一材料を用いることで、開発の付加価値を高める
ことができる。かつ、同一材料の材料層を処理すること
で容量素子と抵抗素子とを形成するので、効率のよい素
子形成を実現できる。
層を処理することにより容量素子と抵抗素子とを形成す
るので、容量素子についてのみではなく、抵抗素子にも
その同一材料を用いることで、開発の付加価値を高める
ことができる。かつ、同一材料の材料層を処理すること
で容量素子と抵抗素子とを形成するので、効率のよい素
子形成を実現できる。
【0017】たとえば、代表的には、高誘電体材料とし
て開発されているTa(タンタル)は、酸化により絶縁
性を持ち、窒化により抵抗として使用できる導電性を持
つという性質があるので、これを利用して、たとえば同
一レイヤーに容量素子と抵抗素子とを形成するするよう
にして、タンタル化合物層形成プロセス(Ta2 O5プ
ロセス)の付加価値(性能/コスト比)を高めることが
できる。さらにはこの場合、窒化タンタル抵抗体は従来
の抵抗体より比較的容易に高シート抵抗が得られるた
め、素子の縮小・小型化が可能であり、高集積化にも有
利と言える。
て開発されているTa(タンタル)は、酸化により絶縁
性を持ち、窒化により抵抗として使用できる導電性を持
つという性質があるので、これを利用して、たとえば同
一レイヤーに容量素子と抵抗素子とを形成するするよう
にして、タンタル化合物層形成プロセス(Ta2 O5プ
ロセス)の付加価値(性能/コスト比)を高めることが
できる。さらにはこの場合、窒化タンタル抵抗体は従来
の抵抗体より比較的容易に高シート抵抗が得られるた
め、素子の縮小・小型化が可能であり、高集積化にも有
利と言える。
【0018】そのほか上記と同様に、処理により容量素
子材料となり、あるいは抵抗素子材料となり得る材料を
用いて、同様な効果を得ることができる。
子材料となり、あるいは抵抗素子材料となり得る材料を
用いて、同様な効果を得ることができる。
【0019】なお特開平8−293949号公報には、
キャパシタ膜であるTa2 O5 膜が発熱抵抗体であるT
aN0 .8 膜の成膜と同時に成膜され、その後パターニ
ング及び陽極酸化でキャパシタ膜とされる旨の技術が記
載されているが、これは同一材料層をそれぞれ異なる処
理で処理することでキャパシタ膜と抵抗体とを得る技術
ではなく、本発明とは構成上の著差を有するものであ
る。
キャパシタ膜であるTa2 O5 膜が発熱抵抗体であるT
aN0 .8 膜の成膜と同時に成膜され、その後パターニ
ング及び陽極酸化でキャパシタ膜とされる旨の技術が記
載されているが、これは同一材料層をそれぞれ異なる処
理で処理することでキャパシタ膜と抵抗体とを得る技術
ではなく、本発明とは構成上の著差を有するものであ
る。
【0020】
【発明の実施の形態】以下、本発明の実施の形態につい
てさらに説明し、また、図面を参照して本発明の好まし
い実施の形態例を説明する。但し当然のことではある
が、本発明は以下の説明及び図示の形態例により限定を
受けるものではない。
てさらに説明し、また、図面を参照して本発明の好まし
い実施の形態例を説明する。但し当然のことではある
が、本発明は以下の説明及び図示の形態例により限定を
受けるものではない。
【0021】本発明の実施においては、同一材料からな
る材料層を酸化タンタル膜とし、容量素子を五酸化タン
タル、抵抗素子を酸窒化タンタルとすることができる。
る材料層を酸化タンタル膜とし、容量素子を五酸化タン
タル、抵抗素子を酸窒化タンタルとすることができる。
【0022】また、酸化タンタル膜に、容量素子領域に
は酸素を、抵抗素子領域には窒素をそれぞれ分けて注入
し、素子を分離形成する構成とすることができる。この
場合に、酸素及び窒素の注入に、プラズマドーピング法
を用いることができる。また、酸素の注入には、O2 ,
O3 ,N2 OまたはH2 O2 (任意の2以上の混合でも
よい)を用い、窒素の注入には、N2 ,NH3 またはN
2 H2 (任意の2以上の混合でもよい)のガスを用いる
ことができる。
は酸素を、抵抗素子領域には窒素をそれぞれ分けて注入
し、素子を分離形成する構成とすることができる。この
場合に、酸素及び窒素の注入に、プラズマドーピング法
を用いることができる。また、酸素の注入には、O2 ,
O3 ,N2 OまたはH2 O2 (任意の2以上の混合でも
よい)を用い、窒素の注入には、N2 ,NH3 またはN
2 H2 (任意の2以上の混合でもよい)のガスを用いる
ことができる。
【0023】本発明の実施において、容量素子と抵抗素
子とは受動素子である態様をとることができる。この場
合、受動素子である該容量素子と抵抗素子の形成は、能
動素子形成工程以降とすることが好ましい。
子とは受動素子である態様をとることができる。この場
合、受動素子である該容量素子と抵抗素子の形成は、能
動素子形成工程以降とすることが好ましい。
【0024】以下、同一レイヤーに可能な限り短工程で
容量素子と抵抗素子を形成すべく、これを可能とする材
料層を選択し、かつ、処理として酸化手段、及び窒化手
段を採用するとともに、該酸化手段、及び窒化手段の適
正な導出を試みてこれを実現した本発明の好ましい実施
の形態の具体例について、説明する。
容量素子と抵抗素子を形成すべく、これを可能とする材
料層を選択し、かつ、処理として酸化手段、及び窒化手
段を採用するとともに、該酸化手段、及び窒化手段の適
正な導出を試みてこれを実現した本発明の好ましい実施
の形態の具体例について、説明する。
【0025】実施の形態例1 この実施の形態例は、容量素子と抵抗素子とを有する電
子部材である半導体装置、特に微細化・集積化したLS
Iについて、本発明を適用した。特に本実施の形態例で
は、MIM構造(金属電極−誘電体である絶縁材−金属
電極)の容量素子を形成するとともに、併せて抵抗素子
を形成するようにしたもので、容量素子と抵抗素子は、
形成手順に差はあるが、同一レイヤー(同一成膜層)に
形成されるものである。両者(容量素子と抵抗素子)
は、たとえば第2電極のみを経て連結される構成をとり
得る。
子部材である半導体装置、特に微細化・集積化したLS
Iについて、本発明を適用した。特に本実施の形態例で
は、MIM構造(金属電極−誘電体である絶縁材−金属
電極)の容量素子を形成するとともに、併せて抵抗素子
を形成するようにしたもので、容量素子と抵抗素子は、
形成手順に差はあるが、同一レイヤー(同一成膜層)に
形成されるものである。両者(容量素子と抵抗素子)
は、たとえば第2電極のみを経て連結される構成をとり
得る。
【0026】すなわち本実施の形態例に係る半導体装置
は、図1に示すように、基板3たとえばシリコン等の半
導体基板上に層間絶縁膜4を介して第1配線5が形成さ
れ、さらに層間絶縁膜6及び配線間層間絶縁膜7を介し
て第2配線8が形成されている。誘電体をなす容量素子
1は、層間絶縁膜6に開設された開口をおおう形で形成
され、第1配線5と第2配線8との間に挟まれて、つま
り第1配線5が下部電極となり第2配線8が上部電極と
なる構成で、キャパシタを構成している。
は、図1に示すように、基板3たとえばシリコン等の半
導体基板上に層間絶縁膜4を介して第1配線5が形成さ
れ、さらに層間絶縁膜6及び配線間層間絶縁膜7を介し
て第2配線8が形成されている。誘電体をなす容量素子
1は、層間絶縁膜6に開設された開口をおおう形で形成
され、第1配線5と第2配線8との間に挟まれて、つま
り第1配線5が下部電極となり第2配線8が上部電極と
なる構成で、キャパシタを構成している。
【0027】抵抗素子2は層間絶縁膜6に形成され、こ
の抵抗素子2と上記誘電体をなす容量素子1とは、いず
れも第2配線8と接続され、すなわち本例では両者は第
2配線8のみを経て連結される構成をとっている。
の抵抗素子2と上記誘電体をなす容量素子1とは、いず
れも第2配線8と接続され、すなわち本例では両者は第
2配線8のみを経て連結される構成をとっている。
【0028】この抵抗素子2は、上記誘電体をなす容量
素子1と同一の材料層を処理して形成されたものであ
る。層間絶縁膜6を形成後、これをパターニングして容
量素子1用の開口を形成し、その後抵抗素子2及び容量
素子1形成用の材料層(本例ではCVD酸化タンタル
層)を形成し、一方は窒化処理をして抵抗素子2用に加
工し、他方は酸化処理をして容量素子1用に加工する。
具体的な形成方法は、次に述べる実施の形態例2の説明
において述べるので、それに準じて実施すればよい。
素子1と同一の材料層を処理して形成されたものであ
る。層間絶縁膜6を形成後、これをパターニングして容
量素子1用の開口を形成し、その後抵抗素子2及び容量
素子1形成用の材料層(本例ではCVD酸化タンタル
層)を形成し、一方は窒化処理をして抵抗素子2用に加
工し、他方は酸化処理をして容量素子1用に加工する。
具体的な形成方法は、次に述べる実施の形態例2の説明
において述べるので、それに準じて実施すればよい。
【0029】基本的には本実施の形態例では、素子形成
層の材料をCVD酸化タンタルとし、素子形成層成膜後
に、容量素子部には酸素を選択的に注入しさらに酸化さ
せることで五酸化タンタルとし、抵抗素子部には窒素を
選択的に注入し窒化させることで酸窒化タンタルとし
た。さらに、酸化タンタル材料層と上部電極(配線)と
の層間分離(本例ではシリコン酸化膜)の開口方法を工
夫して、性能/コスト比の向上を実現するようにした。
層の材料をCVD酸化タンタルとし、素子形成層成膜後
に、容量素子部には酸素を選択的に注入しさらに酸化さ
せることで五酸化タンタルとし、抵抗素子部には窒素を
選択的に注入し窒化させることで酸窒化タンタルとし
た。さらに、酸化タンタル材料層と上部電極(配線)と
の層間分離(本例ではシリコン酸化膜)の開口方法を工
夫して、性能/コスト比の向上を実現するようにした。
【0030】実施の形態例2 この実施の形態例も、実施の形態例1と同様な、容量素
子と抵抗素子とを有する電子部材である半導体装置、特
に微細化・集積化したLSIについて、本発明を適用し
たものである。
子と抵抗素子とを有する電子部材である半導体装置、特
に微細化・集積化したLSIについて、本発明を適用し
たものである。
【0031】すなわち本実施の形態例に係る半導体装置
の構造を、図2に示す。図示のように、本例において
は、基板3たとえばシリコン等の半導体基板上に層間絶
縁膜4が形成され、その上に抵抗素子2、及び第1配線
5が形成され、さらに配線間層間絶縁膜7を介して第2
配線8が形成されるとともに、誘電体をなす容量素子1
は第1配線5上において、配線間層間絶縁膜7に開設さ
れた開口を跨ぐ形で形成され、第1配線5と第2配線8
との間に挟まれて、つまり第1配線5が下部電極となり
第2配線8が上部電極となる構成で、キャパシタを構成
している。
の構造を、図2に示す。図示のように、本例において
は、基板3たとえばシリコン等の半導体基板上に層間絶
縁膜4が形成され、その上に抵抗素子2、及び第1配線
5が形成され、さらに配線間層間絶縁膜7を介して第2
配線8が形成されるとともに、誘電体をなす容量素子1
は第1配線5上において、配線間層間絶縁膜7に開設さ
れた開口を跨ぐ形で形成され、第1配線5と第2配線8
との間に挟まれて、つまり第1配線5が下部電極となり
第2配線8が上部電極となる構成で、キャパシタを構成
している。
【0032】この抵抗素子2は、上記誘電体をなす容量
素子1と同一の材料層を処理して形成されたものであ
る。本例の構造の形成方法を、以下図3ないし図9を参
照して詳述する。
素子1と同一の材料層を処理して形成されたものであ
る。本例の構造の形成方法を、以下図3ないし図9を参
照して詳述する。
【0033】本例の半導体装置においては容量素子と抵
抗素子とは受動素子であり、能動素子は、先に形成され
ている。
抗素子とは受動素子であり、能動素子は、先に形成され
ている。
【0034】すなわち図3に示すのは、能動素子(図示
せず)の形成が終了したのち、第1配線5の形成を行っ
たときの状態である。図示してあるのは、容量素子及び
抵抗素子を形成すべき部位の様子である。
せず)の形成が終了したのち、第1配線5の形成を行っ
たときの状態である。図示してあるのは、容量素子及び
抵抗素子を形成すべき部位の様子である。
【0035】次に、抵抗素子形成部の第1配線5を除去
する。さらに、酸化タンタル膜9を薄膜状に成膜する
(図4)。この時、酸化タンタル膜9は、CVD法で形
成される。
する。さらに、酸化タンタル膜9を薄膜状に成膜する
(図4)。この時、酸化タンタル膜9は、CVD法で形
成される。
【0036】その後、該酸化タンタル膜9を、容量素子
部91と抵抗素子部92を残して除去する。さらに容量
素子部91をレジスト10で保護する(図5)。
部91と抵抗素子部92を残して除去する。さらに容量
素子部91をレジスト10で保護する(図5)。
【0037】次に、抵抗素子を形成すべく、窒素を抵抗
素子部92に注入し、この抵抗素子部92における酸化
タンタル膜を酸窒化タンタル膜とする(図6)。この
時、容量素子部91をレジスト10で保護されているの
で、窒素は注入されない。窒素はラジカルの形で抵抗素
子部92における酸化タンタル膜をアタックすると考え
られる。
素子部92に注入し、この抵抗素子部92における酸化
タンタル膜を酸窒化タンタル膜とする(図6)。この
時、容量素子部91をレジスト10で保護されているの
で、窒素は注入されない。窒素はラジカルの形で抵抗素
子部92における酸化タンタル膜をアタックすると考え
られる。
【0038】次に、容量素子部91を保護するレジスト
10を除去し、その後、配線間層間絶縁膜7を形成する
(図7)。さらに、該配線間層間絶縁膜7の容量素子部
91に該当する部分を開口する。
10を除去し、その後、配線間層間絶縁膜7を形成する
(図7)。さらに、該配線間層間絶縁膜7の容量素子部
91に該当する部分を開口する。
【0039】該容量素子部91に酸素を注入し、容量素
子部91構成している酸化タンタル膜を五酸化タンタル
膜とする(図8)。酸素は上記配線間層間絶縁膜7の開
口からのみ注入されるので、容量素子部91だけがこの
酸素の注入で酸化され、配線間層間絶縁膜7に覆われて
いる抵抗素子部92には影響はない。酸素はラジカルの
形で容量素子部91における酸化タンタル膜をアタック
すると考えられる。この段階で、容量素子1と抵抗素子
2の形成は完了となる。
子部91構成している酸化タンタル膜を五酸化タンタル
膜とする(図8)。酸素は上記配線間層間絶縁膜7の開
口からのみ注入されるので、容量素子部91だけがこの
酸素の注入で酸化され、配線間層間絶縁膜7に覆われて
いる抵抗素子部92には影響はない。酸素はラジカルの
形で容量素子部91における酸化タンタル膜をアタック
すると考えられる。この段階で、容量素子1と抵抗素子
2の形成は完了となる。
【0040】次に第2配線8の形成を行って、図9の構
造を得る。これは図2に示した最終構造と対応するもの
である。
造を得る。これは図2に示した最終構造と対応するもの
である。
【0041】ここで、各素子1,2の元となる酸化タン
タル膜9は、一般的にCVD法で成膜されるが、膜質と
しては完全な五酸化タンタル膜ではなく、また成膜材料
中に含まれる炭素や水、水素といった不純物が少ない、
単に酸素が欠乏している酸化タンタル膜であることが望
ましい。
タル膜9は、一般的にCVD法で成膜されるが、膜質と
しては完全な五酸化タンタル膜ではなく、また成膜材料
中に含まれる炭素や水、水素といった不純物が少ない、
単に酸素が欠乏している酸化タンタル膜であることが望
ましい。
【0042】抵抗素子2形成のための窒化(図6)にお
いては、窒素(N2 )、アンモニア(NH3 )、ヒドラ
ジン(N2 H2 )のいずれか、または混合ガスを用いた
プラズマ照射処理で行うことが好ましい。一般的には窒
素、またはアンモニアを用いて好ましく実施できるが、
ヒドラジンを用いた場合、酸化タンタルに対する還元作
用と、窒化作用とが相まって、最も効率的に窒化を行う
ことができる。ただしヒドラジンには、毒性の問題があ
り、容易に取り扱えないと言う点があるので、留意を要
する。
いては、窒素(N2 )、アンモニア(NH3 )、ヒドラ
ジン(N2 H2 )のいずれか、または混合ガスを用いた
プラズマ照射処理で行うことが好ましい。一般的には窒
素、またはアンモニアを用いて好ましく実施できるが、
ヒドラジンを用いた場合、酸化タンタルに対する還元作
用と、窒化作用とが相まって、最も効率的に窒化を行う
ことができる。ただしヒドラジンには、毒性の問題があ
り、容易に取り扱えないと言う点があるので、留意を要
する。
【0043】プラズマ発生源としては、一般的な平行平
板型、ICP、TCP、ヘリコン等、方式は問わない。
高密度で、かつある程度バイアスがかけられる方式のも
のが効果的で、好ましい。
板型、ICP、TCP、ヘリコン等、方式は問わない。
高密度で、かつある程度バイアスがかけられる方式のも
のが効果的で、好ましい。
【0044】容量素子1形成のための酸化(図8)にお
いては、酸素(O2 )、オゾン(O 3 )、亜酸化窒素
(N2 O)、過酸化水素(H2 O2 )のいずれか、また
は混合ガスを用いたプラズマ照射処理で行うことが好ま
しい。ただしオゾンについては、それ自身活性であるた
め、単に照射するだけでも効果を得ることは可能であ
る。可能であれば、オゾン照射処理、もしくは酸素によ
る高密度プラズマ照射処理が好ましいと言える。
いては、酸素(O2 )、オゾン(O 3 )、亜酸化窒素
(N2 O)、過酸化水素(H2 O2 )のいずれか、また
は混合ガスを用いたプラズマ照射処理で行うことが好ま
しい。ただしオゾンについては、それ自身活性であるた
め、単に照射するだけでも効果を得ることは可能であ
る。可能であれば、オゾン照射処理、もしくは酸素によ
る高密度プラズマ照射処理が好ましいと言える。
【0045】具体的な実施の形態としては、CVD法で
酸化タンタル膜9を30nm成膜し(図4)、そのの
ち、平行平板型プラズマ処理装置によってアンモニアプ
ラズマを14分間照射する(図6)。これによって、C
VD成膜後ほとんど絶縁性を示していた膜が、おおむね
8〜10kΩ/□のシート抵抗を得ることができてい
る。また、同じ酸化タンタル膜にオゾン(O3 )照射処
理を10分間行うことで、単位容量7fF/μm2 、漏
れ電流密度1E−8A/cm2 (5Vにおける)を実現
している。なお各部形成に使用できる材料としては、各
層間絶縁膜としてプラズマTEOS−SiO2 (または
NSG)、PE−TEOS−SiO2 等を挙げることが
でき、第1,第2配線の材料としては、アルミニウム
(Al)、アルミニウム−シリコン合金(Al−S
i)、アルミニウム−銅合金(Al−Cu)等を挙げる
ことができる。これらは各部分における各材料について
の一般的な形成条件により作成することができる。
酸化タンタル膜9を30nm成膜し(図4)、そのの
ち、平行平板型プラズマ処理装置によってアンモニアプ
ラズマを14分間照射する(図6)。これによって、C
VD成膜後ほとんど絶縁性を示していた膜が、おおむね
8〜10kΩ/□のシート抵抗を得ることができてい
る。また、同じ酸化タンタル膜にオゾン(O3 )照射処
理を10分間行うことで、単位容量7fF/μm2 、漏
れ電流密度1E−8A/cm2 (5Vにおける)を実現
している。なお各部形成に使用できる材料としては、各
層間絶縁膜としてプラズマTEOS−SiO2 (または
NSG)、PE−TEOS−SiO2 等を挙げることが
でき、第1,第2配線の材料としては、アルミニウム
(Al)、アルミニウム−シリコン合金(Al−S
i)、アルミニウム−銅合金(Al−Cu)等を挙げる
ことができる。これらは各部分における各材料について
の一般的な形成条件により作成することができる。
【0046】上記詳述したように、本発明を実施するこ
とにより、酸化タンタル使用技術の付加価値が向上し、
特にたとえば酸化タンタルCVD技術の付加価値を向上
させることができる。これにより、容量素子材料として
優れ、かつ容量素子材料以外の用途である抵抗素子形成
が可能な材料についての付加価値が向上し、かかる材料
についての設備投資その他新材料の導入に関し、積極的
に対応できるようになる。また、従来の抵抗素子、たと
えばポリシリコン抵抗よりも、比較的に高抵抗な抵抗素
子を容易に形成できる。その結果、抵抗素子の専有面積
が縮小可能で、高集積化に有利となる。さらに抵抗素子
を、容量素子や誘導素子といった他の受動素子と同じ形
成層で素子形成することが可能となるため、寄生成分が
減少し、また、構成を単純化できることで、回路設計が
容易になるという利点ももたらされる。
とにより、酸化タンタル使用技術の付加価値が向上し、
特にたとえば酸化タンタルCVD技術の付加価値を向上
させることができる。これにより、容量素子材料として
優れ、かつ容量素子材料以外の用途である抵抗素子形成
が可能な材料についての付加価値が向上し、かかる材料
についての設備投資その他新材料の導入に関し、積極的
に対応できるようになる。また、従来の抵抗素子、たと
えばポリシリコン抵抗よりも、比較的に高抵抗な抵抗素
子を容易に形成できる。その結果、抵抗素子の専有面積
が縮小可能で、高集積化に有利となる。さらに抵抗素子
を、容量素子や誘導素子といった他の受動素子と同じ形
成層で素子形成することが可能となるため、寄生成分が
減少し、また、構成を単純化できることで、回路設計が
容易になるという利点ももたらされる。
【0047】
【発明の効果】上述したように、本発明によれば、容量
素子材料として優れ、かつ容量素子材料以外の用途につ
いても好適な利用分野がある材料を見出すことができ、
これを用いて、この材料により容量素子材料としても抵
抗素子材料としても、効率的にその双方の用途適性を発
揮できる部材が得られ、かかる材料の付加価値を高める
ことができ、新材料についての設備投資その他該材料の
導入に積極的に対応できるようになるという大きな効果
が得られ、またさらに上記例示説明したごとく、具体的
な数々の効果を発揮できるものである。
素子材料として優れ、かつ容量素子材料以外の用途につ
いても好適な利用分野がある材料を見出すことができ、
これを用いて、この材料により容量素子材料としても抵
抗素子材料としても、効率的にその双方の用途適性を発
揮できる部材が得られ、かかる材料の付加価値を高める
ことができ、新材料についての設備投資その他該材料の
導入に積極的に対応できるようになるという大きな効果
が得られ、またさらに上記例示説明したごとく、具体的
な数々の効果を発揮できるものである。
【図1】 本発明の実施の形態例1に係る電子部材(半
導体装置)の構造を示す断面図である。
導体装置)の構造を示す断面図である。
【図2】 本発明の実施の形態例2に係る電子部材(半
導体装置)の構造を示す断面図である。
導体装置)の構造を示す断面図である。
【図3】 本発明の実施の形態例2の処理工程を順に断
面図で示すものである(a)
面図で示すものである(a)
【図4】 本発明の実施の形態例2の処理工程を順に断
面図で示すものである(b)
面図で示すものである(b)
【図5】 本発明の実施の形態例2の処理工程を順に断
面図で示すものである(c)
面図で示すものである(c)
【図6】 本発明の実施の形態例2の処理工程を順に断
面図で示すものである(d)
面図で示すものである(d)
【図7】 本発明の実施の形態例2の処理工程を順に断
面図で示すものである(e)
面図で示すものである(e)
【図8】 本発明の実施の形態例2の処理工程を順に断
面図で示すものである(f)
面図で示すものである(f)
【図9】 本発明の実施の形態例2の処理工程を順に断
面図で示すものである(g)
面図で示すものである(g)
【図10】 従来例の構造を示す断面図である。
I・・・容量素子、2・・・抵抗素子、3・・・基板
(シリコン基板)、4・・・層間絶縁膜、5・・・第1
配線、6・・・層間絶縁膜、7・・・配線間層間絶縁
膜、8・・・第2配線、9・・・異なる処理を施すこと
により容量素子と抵抗素子とが形成できる材料(酸化タ
ンタル膜)、91・・・容量素子部、92・・・抵抗素
子部。
(シリコン基板)、4・・・層間絶縁膜、5・・・第1
配線、6・・・層間絶縁膜、7・・・配線間層間絶縁
膜、8・・・第2配線、9・・・異なる処理を施すこと
により容量素子と抵抗素子とが形成できる材料(酸化タ
ンタル膜)、91・・・容量素子部、92・・・抵抗素
子部。
Claims (14)
- 【請求項1】 容量素子と抵抗素子とを有する電子部材
の製造方法であって、 同一材料からなる材料層にそれぞれ異なる処理を施すこ
とにより前記容量素子と前記抵抗素子とを形成すること
を特徴とする容量素子と抵抗素子とを有する電子部材の
製造方法。 - 【請求項2】 前記同一材料からなる材料層を酸化タン
タル膜とし、前記容量素子を五酸化タンタル、前記抵抗
素子を酸窒化タンタルとすることを特徴とする請求項1
に記載の容量素子と抵抗素子とを有する電子部材の製造
方法。 - 【請求項3】 容量素子と抵抗素子とを有する電子部材
の製造方法であって、 酸化タンタル膜に、容量素子領域には酸素を、抵抗素子
領域には窒素をそれぞれ分けて注入し、素子を分離形成
することを特徴とする容量素子と抵抗素子とを有する電
子部材の製造方法。 - 【請求項4】 酸素及び窒素の注入に、プラズマドーピ
ング法を用いることを特徴とする請求項3に記載の容量
素子と抵抗素子とを有する電子部材の製造方法。 - 【請求項5】 酸素の注入には、O2 ,O3 ,N2 Oま
たはH2 O2 を用い、窒素の注入には、N2 ,NH3 ま
たはN2 H2 のガスを用いることを特徴とする請求項3
に記載の容量素子と抵抗素子とを有する電子部材の製造
方法。 - 【請求項6】 容量素子と抵抗素子とを有する半導体装
置の製造方法であって、 同一材料からなる材料層にそれぞれ異なる処理を施すこ
とにより前記容量素子と前記抵抗素子とを形成すること
を特徴とする半導体装置の製造方法。 - 【請求項7】 前記同一材料からなる材料層を酸化タン
タル膜とし、前記容量素子を五酸化タンタル、前記抵抗
素子を酸窒化タンタルとすることを特徴とする請求項6
に記載の半導体装置の製造方法。 - 【請求項8】 前記容量素子と抵抗素子とは受動素子で
あり、該容量素子と抵抗素子の形成は能動素子形成工程
以降とすることを特徴とする請求項6に記載の半導体装
置の製造方法。 - 【請求項9】 容量素子と抵抗素子とを有する半導体装
置の製造方法であって、 酸化タンタル膜に、容量素子領域には酸素を、抵抗素子
領域には窒素をそれぞれ分けて注入し、素子を分離形成
することを特徴とする半導体装置の製造方法。 - 【請求項10】 酸素及び窒素の注入に、プラズマドー
ピング法を用いることを特徴とする請求項9に記載の半
導体装置の製造方法。 - 【請求項11】 酸素の注入には、O2 ,O3 ,N2 O
またはH2 O2 を用い、窒素の注入には、N2 ,NH3
またはN2 H2 のガスを用いることを特徴とする請求項
9に記載の半導体装置の製造方法。 - 【請求項12】 容量素子と抵抗素子とを有する半導体
装置であって、 同一材料からなる材料層をそれぞれ異なる処理で処理す
ることにより形成した容量素子と抵抗素子とを有するこ
とを特徴とする半導体装置。 - 【請求項13】 前記同一材料からなる材料層は酸化タ
ンタル膜であり、前記容量素子は五酸化タンタルからな
り、前記抵抗素子は酸窒化タンタルからなることを特徴
とする請求項12に記載の半導体装置。 - 【請求項14】 前記容量素子と抵抗素子とは受動素子
であることを特徴とする請求項12に記載の半導体装
置。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000012740A JP2001203327A (ja) | 2000-01-21 | 2000-01-21 | 容量素子と抵抗素子とを有する電子部材の製造方法、半導体装置の製造方法、及び半導体装置 |
KR1020010002833A KR20010076330A (ko) | 2000-01-21 | 2001-01-18 | 용량소자와 저항소자를 갖는 전자부재의 제조방법, 반도체장치의 제조방법 및, 반도체 장치 |
US09/766,729 US6445027B2 (en) | 2000-01-21 | 2001-01-22 | Method of manufacturing electronic component having capacitor element and resistor element, method of manufacturing semiconductor device, and semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000012740A JP2001203327A (ja) | 2000-01-21 | 2000-01-21 | 容量素子と抵抗素子とを有する電子部材の製造方法、半導体装置の製造方法、及び半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2001203327A true JP2001203327A (ja) | 2001-07-27 |
Family
ID=18540420
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000012740A Pending JP2001203327A (ja) | 2000-01-21 | 2000-01-21 | 容量素子と抵抗素子とを有する電子部材の製造方法、半導体装置の製造方法、及び半導体装置 |
Country Status (3)
Country | Link |
---|---|
US (1) | US6445027B2 (ja) |
JP (1) | JP2001203327A (ja) |
KR (1) | KR20010076330A (ja) |
Families Citing this family (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE10039710B4 (de) * | 2000-08-14 | 2017-06-22 | United Monolithic Semiconductors Gmbh | Verfahren zur Herstellung passiver Bauelemente auf einem Halbleitersubstrat |
US6727140B2 (en) * | 2001-07-11 | 2004-04-27 | Micron Technology, Inc. | Capacitor with high dielectric constant materials and method of making |
FR2834387B1 (fr) * | 2001-12-31 | 2004-02-27 | Memscap | Composant electronique incorporant un circuit integre et un micro-condensateur |
KR101153978B1 (ko) | 2002-03-26 | 2012-06-14 | 카부시키카이샤 시.브이.리서어치 | 비결정질 금속 산화막의 제조 방법 및 비결정질 금속산화막을 가지는 커패시턴스 소자와 반도체 장치를제조하는 방법 |
US6818500B2 (en) * | 2002-05-03 | 2004-11-16 | Micron Technology, Inc. | Method of making a memory cell capacitor with Ta2O5 dielectric |
DE10341059B4 (de) * | 2003-09-05 | 2007-05-31 | Infineon Technologies Ag | Integrierte Schaltungsanordnung mit Kondensator und Herstellungsverfahren |
US20050287307A1 (en) * | 2004-06-23 | 2005-12-29 | Varian Semiconductor Equipment Associates, Inc. | Etch and deposition control for plasma implantation |
KR100689586B1 (ko) * | 2005-04-26 | 2007-03-02 | 매그나칩 반도체 유한회사 | 알에프 소자의 저항 및 이를 구비한 알에프 소자의제조방법 |
KR101146225B1 (ko) * | 2005-06-07 | 2012-05-15 | 매그나칩 반도체 유한회사 | 반도체 소자 제조방법 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3988824A (en) * | 1972-05-22 | 1976-11-02 | Hewlett-Packard Company | Method for manufacturing thin film circuits |
US4251326A (en) * | 1978-12-28 | 1981-02-17 | Western Electric Company, Inc. | Fabricating an RC network utilizing alpha tantalum |
US4344223A (en) * | 1980-11-26 | 1982-08-17 | Western Electric Company, Inc. | Monolithic hybrid integrated circuits |
US5514612A (en) * | 1993-03-03 | 1996-05-07 | California Micro Devices, Inc. | Method of making a semiconductor device with integrated RC network and schottky diode |
US5618749A (en) * | 1995-03-31 | 1997-04-08 | Yamaha Corporation | Method of forming a semiconductor device having a capacitor and a resistor |
-
2000
- 2000-01-21 JP JP2000012740A patent/JP2001203327A/ja active Pending
-
2001
- 2001-01-18 KR KR1020010002833A patent/KR20010076330A/ko not_active Application Discontinuation
- 2001-01-22 US US09/766,729 patent/US6445027B2/en not_active Expired - Fee Related
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---|---|
US20010041413A1 (en) | 2001-11-15 |
KR20010076330A (ko) | 2001-08-11 |
US6445027B2 (en) | 2002-09-03 |
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