JP2000175438A - 突入電流軽減回路 - Google Patents
突入電流軽減回路Info
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- JP2000175438A JP2000175438A JP10346487A JP34648798A JP2000175438A JP 2000175438 A JP2000175438 A JP 2000175438A JP 10346487 A JP10346487 A JP 10346487A JP 34648798 A JP34648798 A JP 34648798A JP 2000175438 A JP2000175438 A JP 2000175438A
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- Japan
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- inrush current
- transistor
- capacitors
- current reducing
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- Pending
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- Power Conversion In General (AREA)
Abstract
(57)【要約】
【課題】 電源効率が低下せず、効率悪化による発熱の
おそれを無くすことができる突入電流軽減回路を提供す
る。 【解決手段】 電源投入により複数のコンデンサに突入
する突入電流を軽減する突入電流軽減回路であって、突
入電流を分散させて値を小さくする電流軽減手段を有す
る。
おそれを無くすことができる突入電流軽減回路を提供す
る。 【解決手段】 電源投入により複数のコンデンサに突入
する突入電流を軽減する突入電流軽減回路であって、突
入電流を分散させて値を小さくする電流軽減手段を有す
る。
Description
【０００１】
【発明の属する技術分野】この発明は、突入電流軽減回
路に関し、特に、電源投入による突入電流を軽減する突
入電流軽減回路に関する。
路に関し、特に、電源投入による突入電流を軽減する突
入電流軽減回路に関する。
【０００２】
【従来の技術】従来、突入電流によって発生する電圧の
変動や部品の破損を防止することを目的とした、突入電
流防止回路が知られている。
変動や部品の破損を防止することを目的とした、突入電
流防止回路が知られている。
【０００３】このような、突入電流防止回路として、例
えば、特開平７−１４３７３６号公報に開示された容量
性負荷の突入電流抑制回路が知られている。この容量性
負荷の突入電流抑制回路は、入力電流が急に増大した
際、電源ラインに直列接続されたインダクタに起電力が
発生し、ＦＥＴ（ｆｉｅｌｄ ｅｆｆｅｃｔ ｔｒａｎ
ｓｉｓｔｏｒ）のゲートに接続されたトランジスタをオ
ンさせることにより、ＦＥＴ抵抗値を増大させて突入電
流を防止する手段を有している。
えば、特開平７−１４３７３６号公報に開示された容量
性負荷の突入電流抑制回路が知られている。この容量性
負荷の突入電流抑制回路は、入力電流が急に増大した
際、電源ラインに直列接続されたインダクタに起電力が
発生し、ＦＥＴ（ｆｉｅｌｄ ｅｆｆｅｃｔ ｔｒａｎ
ｓｉｓｔｏｒ）のゲートに接続されたトランジスタをオ
ンさせることにより、ＦＥＴ抵抗値を増大させて突入電
流を防止する手段を有している。
【０００４】
【発明が解決しようとする課題】しかしながら、この容
量性負荷の突入電流抑制回路においては、電源ラインに
直列にインダクタを入れていることから、通常動作を行
う際も、このインダクタを通って電源が供給されること
になるので、電源効率が低下するのが避けられない。
量性負荷の突入電流抑制回路においては、電源ラインに
直列にインダクタを入れていることから、通常動作を行
う際も、このインダクタを通って電源が供給されること
になるので、電源効率が低下するのが避けられない。
【０００５】また、ＦＥＴの抵抗値を上げることによっ
て電流を抑制していることから、ＦＥＴの抵抗値を上げ
ることにより損失が増大し、効率悪化による発熱が危惧
されるのでＦＥＴ自体の定格を大きいものとしなければ
ならなかった。そのため、小型機器における使用が困難
であった。
て電流を抑制していることから、ＦＥＴの抵抗値を上げ
ることにより損失が増大し、効率悪化による発熱が危惧
されるのでＦＥＴ自体の定格を大きいものとしなければ
ならなかった。そのため、小型機器における使用が困難
であった。
【０００６】この発明の目的は、電源効率が低下せず、
効率悪化による発熱のおそれを無くすことができる突入
電流軽減回路を提供することである。
効率悪化による発熱のおそれを無くすことができる突入
電流軽減回路を提供することである。
【０００７】
【課題を解決するための手段】上記目的を達成するた
め、この発明に係る突入電流軽減回路は、電源投入によ
り複数のコンデンサに突入する突入電流を軽減する突入
電流軽減回路であって、前記突入電流を分散させて値を
小さくする電流軽減手段を有することを特徴としてい
る。
め、この発明に係る突入電流軽減回路は、電源投入によ
り複数のコンデンサに突入する突入電流を軽減する突入
電流軽減回路であって、前記突入電流を分散させて値を
小さくする電流軽減手段を有することを特徴としてい
る。
【０００８】上記構成を有することにより、電流軽減手
段が突入電流を分散させて値を小さくし、電源投入によ
り複数のコンデンサに突入する突入電流を軽減する。こ
れにより、電源効率が低下せず、効率悪化による発熱の
おそれを無くすことが可能になる。
段が突入電流を分散させて値を小さくし、電源投入によ
り複数のコンデンサに突入する突入電流を軽減する。こ
れにより、電源効率が低下せず、効率悪化による発熱の
おそれを無くすことが可能になる。
【０００９】
【発明の実施の形態】以下、この発明の実施の形態につ
いて図面を参照して説明する。
いて図面を参照して説明する。
【００１０】図１は、この発明の実施の形態に係る突入
電流軽減回路の回路構成図である。図１に示すように、
突入電流軽減回路１０は、５個のトランジスタＴｒ１
１，Ｔｒ１２，Ｔｒ１３，Ｔｒ１４，Ｔｒ１５と、１個
の集積回路（ｉｎｔｅｇｒａｔｅｄ ｃｉｒｃｕｉｔ）
からなる制御部ＩＣ１６と、３個のコンデンサＣ１７，
Ｃ１８，Ｃ１９とを有する。トランジスタＴｒ１４は、
ＦＥＴ（ｆｉｅｌｄ ｅｆｆｅｃｔ ｔｒａｎｓｉｓｔ
ｏｒ）である。
電流軽減回路の回路構成図である。図１に示すように、
突入電流軽減回路１０は、５個のトランジスタＴｒ１
１，Ｔｒ１２，Ｔｒ１３，Ｔｒ１４，Ｔｒ１５と、１個
の集積回路（ｉｎｔｅｇｒａｔｅｄ ｃｉｒｃｕｉｔ）
からなる制御部ＩＣ１６と、３個のコンデンサＣ１７，
Ｃ１８，Ｃ１９とを有する。トランジスタＴｒ１４は、
ＦＥＴ（ｆｉｅｌｄ ｅｆｆｅｃｔ ｔｒａｎｓｉｓｔ
ｏｒ）である。
【００１１】３個のトランジスタＴｒ１１，Ｔｒ１２，
Ｔｒ１３は、各コンデンサＣ１７，Ｃ１８，Ｃ１９のＧ
ＮＤ（接地）とＧＮＤの間に挿入されている。ＩＣ１６
は、トランジスタＴｒ１４がオンしたことを検出して、
各トランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３のオン制
御を行う。
Ｔｒ１３は、各コンデンサＣ１７，Ｃ１８，Ｃ１９のＧ
ＮＤ（接地）とＧＮＤの間に挿入されている。ＩＣ１６
は、トランジスタＴｒ１４がオンしたことを検出して、
各トランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３のオン制
御を行う。
【００１２】即ち、ＩＣ１６は、トランジスタＴｒ１５
をオンさせるためのハイレベル信号を受け、トランジス
タＴｒ１４のオンした後に、トランジスタＴｒ１１，Ｔ
ｒ１２，Ｔｒ１３の順番でオンし、各コンデンサＣ１
７，Ｃ１８，Ｃ１９を有効にする。
をオンさせるためのハイレベル信号を受け、トランジス
タＴｒ１４のオンした後に、トランジスタＴｒ１１，Ｔ
ｒ１２，Ｔｒ１３の順番でオンし、各コンデンサＣ１
７，Ｃ１８，Ｃ１９を有効にする。
【００１３】また、トランジスタＴｒ１４がオフする
際、トランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３の電荷
の放電が行われるため、トランジスタＴｒ１４のコレク
タの電圧が予め設定した電圧まで低下したことをＩＣ１
６が検出し、検出した時点で各トランジスタＴｒ１１，
Ｔｒ１２，Ｔｒ１３をオフする。
際、トランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３の電荷
の放電が行われるため、トランジスタＴｒ１４のコレク
タの電圧が予め設定した電圧まで低下したことをＩＣ１
６が検出し、検出した時点で各トランジスタＴｒ１１，
Ｔｒ１２，Ｔｒ１３をオフする。
【００１４】上記構成を有する突入電流軽減回路１０の
動作について説明する。
動作について説明する。
【００１５】先ず、突入電流軽減回路１０がオフしてい
るとき、ＩＣ１６は、トランジスタＴｒ１１，Ｔｒ１
２，Ｔｒ１３をオフしている。ＩＣ１６は、トランジス
タＴｒ１５がオンする際に入力されるオン信号を検出し
て、トランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３を個々
にオンさせるように制御する。
るとき、ＩＣ１６は、トランジスタＴｒ１１，Ｔｒ１
２，Ｔｒ１３をオフしている。ＩＣ１６は、トランジス
タＴｒ１５がオンする際に入力されるオン信号を検出し
て、トランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３を個々
にオンさせるように制御する。
【００１６】これにより、トランジスタＴｒ１４がオン
したとき、コンデンサＣ１７，Ｃ１８，Ｃ１９の合成容
量に対して一気に電圧が加わるのではなく、個々のコン
デンサＣ１７，Ｃ１８，Ｃ１９に対して時間をずらして
電圧を加えることができる。即ち、時間差をつけて容量
を変化させることにより、突入電流を分散させて値を小
さくする。
したとき、コンデンサＣ１７，Ｃ１８，Ｃ１９の合成容
量に対して一気に電圧が加わるのではなく、個々のコン
デンサＣ１７，Ｃ１８，Ｃ１９に対して時間をずらして
電圧を加えることができる。即ち、時間差をつけて容量
を変化させることにより、突入電流を分散させて値を小
さくする。
【００１７】このとき、ＩＣ１６は、同じタイミングで
トランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３がオンしな
いように制御する。トランジスタＴｒ１１，Ｔｒ１２，
Ｔｒ１３は、コンデンサＣ１７，Ｃ１８，Ｃ１９の陰極
側とＧＮＤの間に接続されており、コンデンサＣ１７，
Ｃ１８，Ｃ１９の陰極側とＧＮＤの間の短絡、開放を行
う。
トランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３がオンしな
いように制御する。トランジスタＴｒ１１，Ｔｒ１２，
Ｔｒ１３は、コンデンサＣ１７，Ｃ１８，Ｃ１９の陰極
側とＧＮＤの間に接続されており、コンデンサＣ１７，
Ｃ１８，Ｃ１９の陰極側とＧＮＤの間の短絡、開放を行
う。
【００１８】この突入電流軽減回路１０がオフしている
ときのＩＣ１６の動作を説明する。トランジスタＴｒ１
４がオフすると、ＩＣ１６は、トランジスタＴｒ１４の
コレクタ電圧とＩＣ１６で設定した電圧との比較を開始
する。トランジスタＴｒ１４のコレクタ電圧が、ＩＣ１
６で設定した電圧より下がったとき、ＩＣ１６は、トラ
ンジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３をオフさせるた
め、コンデンサＣ１７，Ｃ１８，Ｃ１９の電荷を放電す
ることができる。
ときのＩＣ１６の動作を説明する。トランジスタＴｒ１
４がオフすると、ＩＣ１６は、トランジスタＴｒ１４の
コレクタ電圧とＩＣ１６で設定した電圧との比較を開始
する。トランジスタＴｒ１４のコレクタ電圧が、ＩＣ１
６で設定した電圧より下がったとき、ＩＣ１６は、トラ
ンジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３をオフさせるた
め、コンデンサＣ１７，Ｃ１８，Ｃ１９の電荷を放電す
ることができる。
【００１９】このように、突入電流軽減回路１０は、ト
ランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３と、トランジ
スタＴｒ１４がオンしたことを検出してトランジスタＴ
ｒ１１，Ｔｒ１２，Ｔｒ１３のオン制御を行うＩＣ１６
とを有し、このトランジスタＴｒ１１，Ｔｒ１２，Ｔｒ
１３及びＩＣ１６は、突入電流を分散させて値を小さく
する電流軽減手段として機能する。
ランジスタＴｒ１１，Ｔｒ１２，Ｔｒ１３と、トランジ
スタＴｒ１４がオンしたことを検出してトランジスタＴ
ｒ１１，Ｔｒ１２，Ｔｒ１３のオン制御を行うＩＣ１６
とを有し、このトランジスタＴｒ１１，Ｔｒ１２，Ｔｒ
１３及びＩＣ１６は、突入電流を分散させて値を小さく
する電流軽減手段として機能する。
【００２０】即ち、電源投入時にコンデンサに電荷が充
電される際の瞬間に流れる値の大きい電流を、トランジ
スタによる遅延回路で軽減することができる。
電される際の瞬間に流れる値の大きい電流を、トランジ
スタによる遅延回路で軽減することができる。
【００２１】従って、個々のコンデンサを時間差をつけ
て回路に接続できることから、突入電流は、固定接続さ
れたコンデンサに対して電圧が印加された場合よりも小
さくなる。これにより、電圧の落ち込みが抑えられ、回
路の誤動作を防止することができる。
て回路に接続できることから、突入電流は、固定接続さ
れたコンデンサに対して電圧が印加された場合よりも小
さくなる。これにより、電圧の落ち込みが抑えられ、回
路の誤動作を防止することができる。
【００２２】また、突入電流を防止するためのサーミス
タや抵抗部品が不必要になることから、効率の低下やそ
れらの部品の発熱を防ぐことができる。
タや抵抗部品が不必要になることから、効率の低下やそ
れらの部品の発熱を防ぐことができる。
【００２３】また、大電力を必要とする機器の場合、供
給側の容量は突入電流によりピーク値が決まってしまう
が、この発明に係る突入電流軽減回路１０を適用するこ
とにより突入電流を小さくできるため、供給側の容量も
小さくすることができる。
給側の容量は突入電流によりピーク値が決まってしまう
が、この発明に係る突入電流軽減回路１０を適用するこ
とにより突入電流を小さくできるため、供給側の容量も
小さくすることができる。
【００２４】なお、上記実施の形態では、コンデンサＣ
１７，Ｃ１８，Ｃ１９とそれに付随するトランジスタＴ
ｒ１１，Ｔｒ１２，Ｔｒ１３をそれぞれ３個としたが、
これに限るものではなく、トランジスタ及びコンデンサ
の数は任意とすることができる。
１７，Ｃ１８，Ｃ１９とそれに付随するトランジスタＴ
ｒ１１，Ｔｒ１２，Ｔｒ１３をそれぞれ３個としたが、
これに限るものではなく、トランジスタ及びコンデンサ
の数は任意とすることができる。
【００２５】
【発明の効果】以上説明したように、この発明によれ
ば、電流軽減手段が突入電流を分散させて値を小さく
し、電源投入により複数のコンデンサに突入する突入電
流を軽減するので、電圧の落ち込みが抑えられ、回路の
誤動作を防止することができ、また、突入電流を防止す
るためのサーミスタや抵抗部品が不必要になり、効率の
低下やそれらの部品の発熱を防ぐことができる。
ば、電流軽減手段が突入電流を分散させて値を小さく
し、電源投入により複数のコンデンサに突入する突入電
流を軽減するので、電圧の落ち込みが抑えられ、回路の
誤動作を防止することができ、また、突入電流を防止す
るためのサーミスタや抵抗部品が不必要になり、効率の
低下やそれらの部品の発熱を防ぐことができる。
【図１】この発明の実施の形態に係る突入電流軽減回路
の回路構成図である。
の回路構成図である。
１０ 突入電流軽減回路 Ｔｒ１１，Ｔｒ１２，Ｔｒ１３，Ｔｒ１４，Ｔｒ１５
トランジスタＩＣ１６ 制御部 Ｃ１７，Ｃ１８，Ｃ１９ コンデンサ
トランジスタＩＣ１６ 制御部 Ｃ１７，Ｃ１８，Ｃ１９ コンデンサ
Claims (6)
- 【請求項１】電源投入により複数のコンデンサに突入す
る突入電流を軽減する突入電流軽減回路であって、 前記突入電流を分散させて値を小さくする電流軽減手段
を有することを特徴とする突入電流軽減回路。 - 【請求項２】前記電流軽減手段は、前記各コンデンサに
対して時間をずらして電圧を加えることを特徴とする請
求項１に記載の突入電流軽減回路。 - 【請求項３】前記電流軽減手段は、前記各コンデンサの
陰極側とＧＮＤの間に接続されたトランジスタと、この
トランジスタのオン制御を行う制御部とを有することを
特徴とする請求項２に記載の突入電流軽減回路。 - 【請求項４】前記制御部は、オン信号の入力により、前
記各コンデンサに接続されたトランジスタが異なったタ
イミングでオンするように制御することを特徴とする請
求項３に記載の突入電流軽減回路。 - 【請求項５】オン動作により前記制御部に前記オン信号
を入力させるトランジスタを備えることを特徴とする請
求項４に記載の突入電流軽減回路。 - 【請求項６】前記制御部は、オフ信号の入力により、前
記各コンデンサに接続されたトランジスタをオフさせる
ため前記各コンデンサの電荷を放電するように制御する
ことを特徴とする請求項３〜５のいずれかに記載の突入
電流軽減回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10346487A JP2000175438A (ja) | 1998-12-07 | 1998-12-07 | 突入電流軽減回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10346487A JP2000175438A (ja) | 1998-12-07 | 1998-12-07 | 突入電流軽減回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000175438A true JP2000175438A (ja) | 2000-06-23 |
Family
ID=18383768
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10346487A Pending JP2000175438A (ja) | 1998-12-07 | 1998-12-07 | 突入電流軽減回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2000175438A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2007020692A1 (ja) * | 2005-08-18 | 2007-02-22 | Fujitsu Limited | 突入電流軽減回路および電源装置 |
| EP2835886B1 (en) * | 2013-03-28 | 2021-06-02 | Vertiv Corporation | Power supply module and soft start method |
-
1998
- 1998-12-07 JP JP10346487A patent/JP2000175438A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2007020692A1 (ja) * | 2005-08-18 | 2007-02-22 | Fujitsu Limited | 突入電流軽減回路および電源装置 |
| JPWO2007020692A1 (ja) * | 2005-08-18 | 2009-02-19 | 富士通株式会社 | 突入電流軽減回路および電源装置 |
| JP4662992B2 (ja) * | 2005-08-18 | 2011-03-30 | 富士通株式会社 | 突入電流軽減回路および電源装置 |
| EP2835886B1 (en) * | 2013-03-28 | 2021-06-02 | Vertiv Corporation | Power supply module and soft start method |
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Legal Events
| Date | Code | Title | Description |
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Free format text: JAPANESE INTERMEDIATE CODE: R250 |
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Free format text: JAPANESE INTERMEDIATE CODE: R250 |
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| EXPY | Cancellation because of completion of term | ||
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