JP2000014136A - Dc−dcコンバータ - Google Patents
Dc−dcコンバータInfo
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Abstract
コンバータを提供する。 【解決手段】 トランスの1次巻線に供給される直流電
流を周期的にオンオフするスイッチ回路と、トランスの
1次巻線に印加される電圧を制限すると共にスイッチ回
路がオフのときにトランスの1次巻線に消磁電流を流す
クランプ回路と、トランスの2次側から出力される複数
の周期電流をそれぞれ整流すると共にスイッチ回路がオ
フのときにトランスの2次巻線にそれぞれ消磁電流を流
す複数の同期整流回路と、同期整流回路の出力に対応し
てそれぞれ設けられた複数の巻線と共通の磁心からなる
カップルドインダクタを備え、複数の同期整流回路の出
力電圧をそれぞれ平滑する複数の平滑回路と、平滑回路
のいずれか1つの出力電圧を検出し、その出力電圧が所
定の一定電圧になるようにスイッチ回路に指令を与える
ことでループ制御を行う制御回路とを有する構成とす
る。
Description
から複数の安定化直流電圧を出力する多出力のDC−D
Cコンバータに関するものである。
成を示す回路図である。
タは、2次側から多出力(図3では2出力)が得られる
トランスT11と、トランスT11の1次巻線に接続さ
れる直流電圧源V11と、直流電圧源V11の出力電圧
を安定化させるコンデンサC11と、トランスT11の
1次巻線に流れる電流のスイッチングを行うスイッチン
グトランジスタQ11と、トランスT11の2次巻線か
ら出力される交流電圧を整流する第1の整流回路11及
び第2の整流回路12と、第1の整流回路11及び第2
の整流回路12の出力電圧をそれぞれ平滑化する第1の
平滑回路13及び第2の平滑回路14と、第1の平滑回
路13の出力電圧VO11を検出し、スイッチングトラ
ンジスタQ11を制御する制御回路15とによって構成
されている。なお、図3ではスイッチングトランジスタ
Q11としてMOSFETを用いた構成を示している。
2次側から出力される交流電圧を整流するための2つの
ダイオードD11、D12によって構成され、第1の平
滑回路13は、第1の整流回路11の出力電圧を平滑化
するインダクタL11−1及びコンデンサC12と負荷
である抵抗器RL11とによって構成されている。
T11の2次側から出力される交流電圧を整流するため
の2つのダイオードD13、D14によって構成され、
第2の平滑回路14は、第2の整流回路12の出力電圧
を平滑化するインダクタL1 1−2及びコンデンサC1
3と負荷である抵抗器RL12とによって構成されてい
る。なお、インダクタL11−1、L11−2は複数
(図3では2つ)の巻線と共通の磁心からなるカップル
ドインダクタである。
C−DCコンバータは、制御回路15によって第1の平
滑回路13の出力電圧VO11を検出し、第1の平滑回
路13の出力電圧VO11が一定になるようにスイッチ
ングトランジスタQ11のON/OFF(デューティ
比)を制御している(以下、ループ制御と称す)。この
とき、インダクタL11−1、L11−2がカップルド
インダクタであるため、ループ制御を行っていない第2
の平滑回路14の出力電圧VO12も同時に制御され
る。
ような従来のDC−DCコンバータでは、図4に示すよ
うに平滑用のインダクタL11−1に流れる電流i
L11が不連続であるため、第1の平滑回路の出力が無
負荷になると、スイッチングトランジスタQ11のON
時間(TON)が極端に狭くなってしまう。
負荷電流が流れると、スイッチングトランジスタQ11
のON時間を広げることができないため、第2の平滑回
路の出力電圧が著しく低下するという問題があった。
る問題点を解決するためになされたものであり、ループ
制御してない多出力のいずれかで負荷電流が増えた場合
でも、出力電圧の変動を抑制することができる高精度の
DC−DCコンバータを提供することを目的とする。
本発明のDC−DCコンバータは、直流電圧から他の複
数の直流電圧に変換する多出力のDC−DCコンバータ
であって、トランスの1次巻線に供給される直流電流を
周期的にオンオフするスイッチ回路と、前記トランスの
1次巻線に印加される電圧を制限すると共に前記スイッ
チ回路がオフのときに前記トランスの1次巻線に消磁電
流を流すクランプ回路と、前記トランスの2次側から出
力される複数の周期電流をそれぞれ整流すると共に前記
スイッチ回路がオフのときに前記トランスの2次巻線に
それぞれ消磁電流を流す複数の同期整流回路と、前記同
期整流回路の出力に対応してそれぞれ設けられた複数の
巻線と共通の磁心からなるカップルドインダクタを備
え、前記複数の同期整流回路の出力電圧をそれぞれ平滑
する複数の平滑回路と、前記平滑回路のいずれか1つの
出力電圧を検出し、該出力電圧が所定の一定電圧になる
ように前記スイッチ回路に指令を与えることでループ制
御を行う制御回路とを有するものである。
ンスの1次巻線と並列に接続される、前記スイッチ回路
がオンのときにオフし前記スイッチ回路がオフのときに
オンする第2のスイッチ回路及び前記第2のスイッチ回
路と直列に接続されるコンデンサを有するものであって
もよい。
構成されていてもよく、前記第2のスイッチ回路もMO
SFETで構成されていてもよい。
スの出力電流を整流する第1のMOSFETと、前記ト
ランスの2次巻線に消磁電流を流すための第2のMOS
FETと、を有していてもよく、前記同期整流回路は、
前記トランスの出力電流を整流するダイオードと、前記
トランスの2次巻線に消磁電流を流すための第3のMO
SFETと、を有していてもよい。
ータは、トランスの1次巻線に印加される電圧を制限す
ると共にスイッチ回路がオフのときにトランスの1次巻
線に消磁電流を流すクランプ回路と、トランスの2次側
から出力される複数の周期電流をそれぞれ整流すると共
にスイッチ回路がオフのときにトランスの2次巻線にそ
れぞれ消磁電流を流す複数の同期整流回路と、同期整流
回路の出力に対応してそれぞれ設けられた複数の巻線と
共通の磁心からなるカップルドインダクタを備え、複数
の同期整流回路の出力電圧をそれぞれ平滑する複数の平
滑回路と、平滑回路のいずれか1つの出力電圧を検出
し、その出力電圧が所定の一定電圧になるようにスイッ
チ回路に指令を与えることでループ制御を行う制御回路
とを有することで、トランスの2次巻線に励磁電流及び
消磁電流がそれぞれ流れるため、ループ制御された平滑
回路にはマイナス側にも電流が流れ、従来のように不連
続になることがない。
て説明する。
成を示す回路図であり、図2は図1に示したDC−DC
コンバータの動作の様子を示す波形図である。
ータは、2次側から多出力(図1では2出力)が得られ
るトランスT1と、トランスT1の1次巻線に接続され
る直流電圧源V1と、直流電圧源V1の出力電圧を安定
化させるコンデンサC1と、トランスT1の1次巻線に
流れる電流のスイッチングを行うスイッチングトランジ
スタQ1と、トランスT1の1次巻線に印加される電圧
を制限すると共にスイッチングトランジスタQ1がオフ
のときにトランスT1の1次巻線に消磁電流を流すアク
ティブクランプ回路6と、トランスT1の2次巻線から
出力される交流電圧を整流する第1の整流回路1及び第
2の整流回路2と、第1の整流回路1及び第2の整流回
路2の出力電圧をそれぞれ平滑化する第1の平滑回路3
及び第2の平滑回路4と、第1の平滑回路3の出力電圧
VO1を検出し、スイッチングトランジスタQ1を制御
する制御回路5とによって構成されている。なお、スイ
ッチングトランジスタQ1にはコンデンサC3が並列に
接続されている。
れたコンデンサC2及びリセット用トランジスタQ2に
よって構成されている。
の2次側から出力される交流電圧を整流するためのMO
SFETQ3、及びスイッチングトランジスタQ1がO
FFの時にトランスT1の2次巻線に消磁電流を流すM
OSFETQ4によって構成され、第1の平滑回路3
は、第1の整流回路1の出力電圧を平滑化するインダク
タL1−1及びコンデンサC4と負荷である抵抗器R
L1とによって構成されている。
1の2次側から出力される交流電圧を整流するためのM
OSFETQ5、及びスイッチングトランジスタQ1が
OFFの時にトランスT1の2次巻線に消磁電流を流す
MOSFETQ6によって構成され、第2の平滑回路4
は、第2の整流回路2の出力電圧を平滑化するインダク
タL1−2及びコンデンサC5と負荷である抵抗器R
L2とによって構成されている。なお、インダクタL
1−1、L1−2は複数の巻線(図1では2つ)と共通
の磁心からなるカップルドインダクタである。また、図
1ではスイッチングトランジスタQ1及びリセット用ト
ランジスタQ2としてそれぞれMOSFETを用いた構
成を示している。
C−DCコンバータの動作について説明する。
グトランジスタQ1がOFFの期間にリセット用トラン
ジスタQ2を介してトランスの1次巻線に消磁電流を流
すことでトランスコアをリセットする回路である。この
アクティブクランプ回路6によってスイッチングトラン
ジスタQ1のOFF時のフライバック電圧がほぼ一定に
クランプされるため、ドレイン・ソース間が低耐圧のM
OSFETをスイッチングトランジスタQ1として使用
することができる。また、このことによってトランスT
1の1次巻線に接続する直流電圧源V1の出力電圧が広
い範囲で変動する場合でも対応することができる。
の第1象限と第3象限の間を均等に振れるため、コアの
利用率が高くなり、ZVS(Zero-Voltage-Switching)
により、充放電ロスが低減され、低ノイズ化が図れると
いう効果もある。
第2の整流回路2は、一般に同期整流回路と呼ばれてい
る。同期整流回路は、整流用のMOSFET(図1では
Q3、Q5)と転流用のMOSFET(図1ではQ4、
Q6)とを備え、スイッチングトランジスタQ1がON
の時に整流用のMOSFETがONし、スイッチングト
ランジスタQ1がOFFの時に転流用のMOSFETが
ONするように動作する。
線に励磁電流及び消磁電流がそれぞれ流れるため、図2
に示すように平滑用のインダクタL1−1にはマイナス
側にも電流iL1が流れるようになる。
電流iL1が従来のように不連続にならないため、第1
の平滑回路3の出力が無負荷になってもスイッチングト
ランジスタQ1のON時間(TON)はある程度広がった
状態になっている。よって、このときに第2の平滑回路
4の出力に大きな負荷電流が流れても第2の平滑回路4
の出力電圧VO2の低下が抑制されるため、出力電圧の
精度が良好なDC−DCコンバータを得ることができ
る。
流用のMOSFETFETQ3及び第2の整流回路2の
整流用のMOSFETFETQ5はそれぞれ従来と同様
にダイオードであってもよい。また、スイッチングトラ
ンジスタQ1及びリセット用トランジスタQ2はスイッ
チ動作する素子であれば、MOSFETである必要はな
い。さらに、図1では2出力のDC−DCコンバータの
構成例を示しているが、3出力以上であっても同様の効
果を得ることができる。
いるので、以下に記載する効果を奏する。
限すると共にスイッチ回路がオフのときにトランスの1
次巻線に消磁電流を流すクランプ回路と、トランスの2
次側から出力される複数の周期電流をそれぞれ整流する
と共にスイッチ回路がオフのときにトランスの2次巻線
にそれぞれ消磁電流を流す複数の同期整流回路と、同期
整流回路の出力に対応してそれぞれ設けられた複数の巻
線と共通の磁心からなるカップルドインダクタを備え、
複数の同期整流回路の出力電圧をそれぞれ平滑する複数
の平滑回路と、平滑回路のいずれか1つの出力電圧を検
出し、その出力電圧が所定の一定電圧になるようにスイ
ッチ回路に指令を与えることでループ制御を行う制御回
路とを有することで、トランスの2次巻線に励磁電流及
び消磁電流がそれぞれ流れるため、ループ制御された平
滑回路にはマイナス側にも電流が流れ、従来のように不
連続になることがない。
出力が無負荷になってもスイッチ回路のON時間はある
程度広がった状態になる。よって、このときにループ制
御されていない他の平滑回路の出力に大きな負荷電流が
流れても出力電圧の低下が抑制され、出力電圧の精度が
良好なDC−DCコンバータを得ることができる。
路図である。
子を示す波形図である。
図である。
子を示す波形図である。
Claims (6)
- 【請求項1】 直流電圧から他の複数の直流電圧に変換
する多出力のDC−DCコンバータであって、 トランスの1次巻線に供給される直流電流を周期的にオ
ンオフするスイッチ回路と、 前記トランスの1次巻線に印加される電圧を制限すると
共に前記スイッチ回路がオフのときに前記トランスの1
次巻線に消磁電流を流すクランプ回路と、 前記トランスの2次側から出力される複数の周期電流を
それぞれ整流すると共に前記スイッチ回路がオフのとき
に前記トランスの2次巻線にそれぞれ消磁電流を流す複
数の同期整流回路と、 前記同期整流回路の出力に対応してそれぞれ設けられた
複数の巻線と共通の磁心からなるカップルドインダクタ
を備え、前記複数の同期整流回路の出力電圧をそれぞれ
平滑する複数の平滑回路と、 前記平滑回路のいずれか1つの出力電圧を検出し、該出
力電圧が所定の一定電圧になるように前記スイッチ回路
に指令を与えることでループ制御を行う制御回路と、を
有するDC−DCコンバータ。 - 【請求項2】 前記クランプ回路は、 前記トランスの1次巻線と並列に接続される、前記スイ
ッチ回路がオンのときにオフし前記スイッチ回路がオフ
のときにオンする第2のスイッチ回路及び前記第2のス
イッチ回路と直列に接続されるコンデンサを有する請求
項1記載のDC−DCコンバータ。 - 【請求項3】 前記スイッチ回路はMOSFETから成
る請求項1または2記載のDC−DCコンバータ。 - 【請求項4】 前記第2のスイッチ回路はMOSFET
から成る請求項1乃至3のいずれか1項記載のDC−D
Cコンバータ。 - 【請求項5】 前記同期整流回路は、 前記トランスの出力電流を整流する第1のMOSFET
と、 前記トランスの2次巻線に消磁電流を流すための第2の
MOSFETと、を有する請求項1乃至4のいずれか1
項記載のDC−DCコンバータ。 - 【請求項6】 前記同期整流回路は、 前記トランスの出力電流を整流するダイオードと、 前記トランスの2次巻線に消磁電流を流すための第3の
MOSFETと、を有する請求項1乃至5のいずれか1
項記載のDC−DCコンバータ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10168599A JP2000014136A (ja) | 1998-06-16 | 1998-06-16 | Dc−dcコンバータ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10168599A JP2000014136A (ja) | 1998-06-16 | 1998-06-16 | Dc−dcコンバータ |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2000014136A true JP2000014136A (ja) | 2000-01-14 |
Family
ID=15871051
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Country Status (1)
Country | Link |
---|---|
JP (1) | JP2000014136A (ja) |
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