ES2350565T3 - Procedimiento y aparato para realizar informes de estado de memoria intermedia (bsr). - Google Patents
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Abstract
Procedimiento para realizar informes de estado de memoria intermedia, denominados en lo sucesivo BSR, en un equipo de usuario, denominado en lo sucesivo UE, de un sistema de comunicaciones inalámbricas, comprendiendo el procedimiento: formar un control de acceso al medio, denominado en lo sucesivo MAC, una unidad de datos en paquetes, denominada en lo sucesivo PDU, comprendiendo la PDU de MAC bits de relleno con un número de bits mayor que el tamaño de un elemento de control de MAC de BSR (402); activar un procedimiento de BSR de relleno (404); informar de un elemento de control de MAC de BSR corto cuando los bits de relleno de la PDU de MAC no pueden dar cabida a un elemento de control de MAC de BSR largo (406); y caracterizado por el hecho de indicar el elemento de control de MAC de BSR corto activado por un procedimiento de BSR de relleno a través de una subcabecera correspondiente al elemento de control de MAC de BSR en la PDU de MAC (408).
Description
La presente invención se refiere a un procedimiento y un aparato para realizar informes de estado de memoria intermedia (BSR) en un equipo de usuario (UE) de un sistema de comunicaciones inalámbricas según los preámbulos de las reivindicaciones 1 y 8.
Un sistema de comunicaciones inalámbricas de evolución a largo plazo (sistema LTE), un sistema de comunicaciones inalámbricas avanzado de alta velocidad establecido en el sistema de telecomunicaciones móviles 3G, sólo soporta la transmisión por conmutación de paquetes, y tiende a implementar la capa de control de acceso al medio (MAC) y la capa de control de radioenlace (RLC) en un único sitio de comunicación, tal como en nodo B (NB) solamente en lugar de en NB y RNC (controlador de red de radio) respectivamente, para que la estructura del sistema llegue a ser simple.
En LTE, el MAC proporciona servicios de transmisión a través de una pluralidad de canales lógicos. Para gestionar recursos de enlace de subida, cuando un equipo de usuario (UE) realiza una transmisión de enlace de subida (UL), la red puede dividir o mapear canales lógicos del UE como mucho en cuatro grupos en base a prioridades, tipos, etcétera. Las prioridades corresponden a valores 1 a 8, y son asignadas por una capa más alta, la capa de control de recursos de radio. Además, el proyecto de asociación para la tercera generación, 3GPP, introduce un procedimiento de informes de estado de memoria intermedia (BSR) que se utiliza para proporcionar al NB de servicio (o NB mejorado) información sobre la cantidad de datos en las memorias intermedias de los UL del UE. En el procedimiento de BSR, el UE utiliza una PDU (unidad de datos de protocolo) de MAC para llevar un elemento de control de MAC del BSR con información sobre la cantidad de datos en las memorias intermedias de los UL a la red. Por lo tanto, la red puede determinar la cantidad total de datos disponibles a través de uno o todos los grupos de canales lógicos.
En una especificación actual, existen tres tipos de procedimientos de BSR para diferentes eventos de activación, un BSR regular, un BSR periódico y un BSR de relleno. El BSR regular se activa cuando los datos del UL llegan a la memoria intermedia de transmisión del UE y los datos del UL pertenecen a un canal lógico con una prioridad más alta que aquellos para los cuales ya existían datos en la memoria intermedia de transmisión del UE, o se activa cuando se produce un cambio de la celda de servicio. El BSR periódico se activa cuando expira un temporizador del BSR periódico. El BSR de relleno se activa cuando se han asignado los recursos del UL y una cantidad de bits de relleno es igual o mayor que el tamaño del elemento de control del MAC del BSR.
Además, de acuerdo con distintos requerimientos, los elementos de control del MAC del BSR pueden clasificarse en dos formatos: corto y largo. Un elemento de control del MAC del BSR corto tiene una longitud de 1 byte, y tiene 8 bits, en el que los primeros 2 bits indican un grupo del canal lógico cuyo estado de memoria intermedia está siendo informado, y los seis bits restantes indican la cantidad de datos de memoria intermedia disponibles a través del grupo de canales lógicos. Un elemento de control del MAC del BSR largo tiene una longitud de 3 bytes, y se utiliza para informar de la cantidad de datos de las memorias intermedias de UL de todos los grupos de canales lógicos.
Por otra parte, una cabecera de una PDU de MAC consiste en una o más subcabeceras, correspondiendo cada subcabecera a una unidad de datos de servicio (SDU) de MAC, un elemento de control de MAC o bien al relleno que lleva la PDU de MAC. Las subcabeceras de la PDU de MAC tienen el mismo orden que las correspondientes SDUs de MAC, elementos de control de MAC y relleno. Una subcabecera de la PDU de MAC correspondiente a un elemento de control de MAC consiste generalmente en dos bits reservados, un campo de extensión de 1 bit y un campo de identificador de canal lógico (LDID) de 5 bits. En la actual especificación, el formato del elemento de control del MAC de BSR puede identificarse mediante valores de LCID, por ejemplo se utiliza “11101” y “11110” para indicar el elemento de control de MAC de BSR corto y el elemento de control de MAC de BSR largo, respectivamente. Puede encontrarse una descripción detallada de las subcabeceras de la PDU de MAC en especificaciones de protocolo relacionadas, y que aquí no se han descrito.
Para el procedimiento de BSR regular y periódico, el formato del elemento de control de MAC de BSR viene determinado por el UE según si hay más de un grupo de canales lógicos con datos de memoria intermedia del enlace de subida en el UE cuando se transmite el BSR. Si hay solamente un grupo de canales lógicos con datos de memoria intermedia de enlace de subida, se informa del elemento de control de MAC de BSR corto. A la inversa, si hay más de un grupo de canales lógicos con datos de memoria intermedia de enlace de subida, se informa del elemento de control de MAC de BSR largo.
Para el procedimiento de BSR de relleno, el formato del elemento de control de BSR viene determinado según el número de bits de relleno que quedan en la PDU de MAC. Si el número de bits de relleno es igual o mayor que el tamaño del elemento de control de MAC de BSR corto pero menor que el tamaño del elemento de control de MAC de BSR largo, se utiliza el elemento de control de MAC de BSR corto para informar sobre la cantidad de datos en la memoria intermedia de enlace de subida de un grupo de canales lógicos de una prioridad más alta. A la inversa, si el número de bits de relleno es igual o mayor que el tamaño del elemento de control de MAC de BSR largo, se utiliza el elemento de control de MAC de BSR largo para informar de la cantidad de datos en la memoria intermedia de enlace de subida de todos los grupos de canales lógicos.
En este caso, cuando hay más de un grupo de canales lógicos con datos de memoria intermedia de enlace de subida pero el número de bits de relleno de la PDU de MAC no puede tener cabida para el elemento de control de MAC de BSR largo, en base a las especificaciones relacionadas, el UE todavía informaría del elemento de control de MAC de BSR corto para aumentar la eficacia de planificación del sistema. Sin embargo, puesto que la técnica anterior no describe cómo indicar que el elemento de control de MAC de BSR corto transmitido por el UE es activado por el procedimiento de BSR regular y periódico o por el procedimiento de BSR de relleno, la red no puede determinar si hay solamente un grupo de canales lógicos con datos de memoria intermedia de UL en el UE. Es posible que la red pueda realizar una decisión equivocada, tal como proporcionar una concesión de enlace de subida incorrecta para el UE.
El documento 3GPP TS 36.321, “E-UTRA MAC protocol specification”, V8.1.0 describe un procedimiento para realizar un BSR en un UE de un sistema de comunicaciones inalámbricas formando una PDU de MAC que comprende bits de relleno con un número de bits mayor que el tamaño de un elemento de control de MAC de BSR. Al activar un proceso de BSR de relleno se informará de un elemento de control de MAC de BSR corto si los bits de relleno de la PDU de MAC no pueden dar cabida a un elemento de control de MAC de BSR largo.
El documento Nokia, “criteria for short and long BSR”, documento de debate, 11 a 18 de Enero de 2008 describe una estructura de una cabecera de un elemento de control de MAC de BSR. Existe un campo LCID para identificar el tipo de elemento de control de MAC de BSR, un campo L que indica la longitud de una SDU, un campo F para indicar el tamaño del campo de longitud L anterior y un campo de extensión E para indicar la presencia de otros campos en el elemento de control de MAC de BSR. Finalmente, existen unos bits reservados.
Teniendo esto en cuenta, la presente invención tiene como objetivo disponer un procedimiento y un aparato para indicar un formato de un elemento de control de MAC de BSR mediante una subcabecera de una PDU de MAC correspondiente al elemento de control de MAC de BSR en un equipo de usuario (UE) de un sistema de comunicaciones inalámbricas.
Esto se consigue mediante un procedimiento y un aparato para realizar informes de estado de memoria intermedia (BSR) en un equipo de usuario (UE) de un sistema de comunicaciones inalámbricas según el preámbulo de las reivindicaciones 1 y 8. Las reivindicaciones dependientes pertenecen a otros desarrollos y mejoras correspondientes.
Tal como se apreciará más claramente a continuación a partir de la descripción detallada, se describe procedimiento reivindicado para realizar informes de estado de memoria intermedia (BSR) en un equipo de usuario (UE) de un sistema de comunicaciones inalámbricas. El procedimiento incluye las etapas de formar una unidad de datos en paquetes (PDU) de un control de acceso al medio (MAC), incluyendo la PDU de MAC bits de relleno con una cantidad de bits mayor que el tamaño de un elemento de control de MAC de BSR, activar un procedimiento de BSR de relleno, informar de un elemento de control de MAC de BSR corto cuando los bits de relleno de la PDU del MAC no pueden dar cabida a un elemento de control de MAC de BSR largo, e
indicar el elemento de control de MAC de BSR corto activado por el
procedimiento de BSR de relleno a través de una subcabecera
correspondiente al elemento de control del MAC de BSR en la PDU del MAC.
A continuación, la invención se ilustra adicionalmente a modo de ejemplo, con
referencia a los dibujos que se adjuntan, en los cuales:
La figura 1 es un diagrama esquemático de un sistema de comunicaciones
inalámbricas;
La figura 2 es un diagrama de bloques de función de un dispositivo de
comunicaciones inalámbricas;
La figura 3 es un diagrama del código de programa de la figura 2;
La figura 4 es un diagrama de flujo de un proceso según una realización de la
presente invención.
Se hace referencia a la figura 1, que ilustra un diagrama esquemático de un
sistema de comunicaciones inalámbricas 1000. El sistema de comunicaciones
inalámbricas 1000 es preferiblemente un sistema de LTE (evolución a largo
plazo), y brevemente está compuesto por una red y una pluralidad de UEs.
En la figura 1, la red y los UEs se utilizan simplemente para ilustrar la
estructura del sistema de comunicaciones inalámbricas 1000. En la práctica,
la red puede comprender una pluralidad de estaciones base (nodos B),
controladores de red de radio, etc según las demandas reales, y los UEs
pueden ser dispositivos tales como teléfonos móviles, sistemas informáticos,
etc.
Se hace referencia a la figura 2, que es un diagrama de bloques funcional de
un dispositivo de comunicaciones 100 en un sistema de comunicaciones
inalámbricas. Por motivos de brevedad, la figura 2 solamente muestra un
dispositivo de entrada 102, un dispositivo de salida 104, un circuito de control
106, una unidad central de proceso (CPU) 108, una memoria 110, un código
de programa 112, y un transceptor 114 del dispositivo de comunicaciones
100. En el dispositivo de comunicaciones 100, el circuito de control 106 ejecuta el código de programa 112 en la memoria 110 a través de la CPU 108, controlando así una operación del dispositivo de comunicaciones 100. El dispositivo de comunicaciones 100 puede recibir señales entradas por un usuario a través del dispositivo de entrada 102, tal como un teclado, y puede enviar imágenes y sonidos a través del dispositivo de salida 104, tal como un monitor o altavoces. El transceptor 114 se utiliza para recibir y transmitir señales de manera inalámbrica, enviando las señales recibidas al circuito de control 106, y enviando de manera inalámbrica las señales generadas por el circuito de control 106. Desde una perspectiva de un marco de protocolo de comunicaciones, el transceptor 114 puede verse como parte de capa 1, y el circuito de control 106 puede utilizarse para realizar funciones de capa 2 y capa 3.
Se sigue haciendo referencia a la figura 3, que es un diagrama del código de programa 112 mostrado en la figura 2. El código de programa 112 incluye una capa de aplicación 200, una capa 3 202, y una capa 2 206, y está conectado a una capa 1 218. La capa 3 202 realiza el control de los recursos de radio. La capa 2 206 comprende una capa de RLC y una capa de MAC, y realiza el control de enlace. La capa 1 218 realiza conexiones físicas.
En LTE, la capa del MAC de la capa 2 206 puede realizar un procedimiento de informe de estado de memoria intermedia (BSR) para ofrecer información sobre la cantidad de datos en las memorias intermedias de UL a la red a través de un elemento de control de MAC de BSR. Por lo tanto, la red puede determinar la cantidad total de datos disponibles a través de uno o todos los grupos de canales lógicos. En tal situación, la realización de la presente invención dispone un código de programa de BSR 220 para indicar que un elemento de control de MAC de BSR corto es activado por un procedimiento de BSR de relleno o por un procedimiento de BSR regular y periódico, para evitar que la red se confunda.
Se hace referencia a la figura 4, que ilustra un diagrama esquemático de un procedimiento 40. El procedimiento 40 se utiliza para realizar un BSR en un UE del sistema de comunicaciones inalámbricas 1000 para decidir un formato del elemento de control de BSR. El procedimiento 40 comprende las siguientes etapas:
Etapa 400: Inicio
Etapa 402: Formar una unidad de datos en paquetes (PDU) de MAC,
incluyendo la PDU de MAC bits de relleno con una cantidad de bits mayor
que el tamaño de un elemento de control de MAC de BSR.
Etapa 404: Activar un procedimiento de BSR de relleno.
Etapa 406: Informar de un elemento de control de MAC de BSR corto cuando
los bits de relleno de la PDU de MAC no pueden dar cabida a un elemento de
control de MAC de BSR largo.
Etapa 408: Indicar el elemento de control de MAC de BSR corto activado por
el procedimiento de BSR de relleno a través de una subcabecera
correspondiente al elemento de control de MAC de BSR en la PDU de MAC.
Etapa 410: Fin.
De acuerdo con el proceso 40, cuando la PDU de MAC está formada por el
UE, si el número de bits de relleno de la PDU de MAC es mayor que el
tamaño del elemento de control del MAC de BSR, el procedimiento de BSR
de relleno se activa. Si los bits de relleno de la PDU de MAC no pueden dar
cabida a un elemento de control de MAC de BSR largo, el UE informará de un
elemento de control de MAC de BSR corto, e indicará a la red que el
elemento de control de MAC de BSR corto es generado por el procedimiento
de BSR de relleno a través de una subcabecera correspondiente al elemento
de control del MAC de BSR en la PDU del MAC.
En tal situación, el elemento de control de MAC de BSR corto indica la
cantidad de datos en una memoria intermedia de enlace de subida de un
grupo de canales lógicos del UE de una prioridad más alta. Además, el
elemento de control de MAC de BSR corto tiene una longitud de 1 byte,
mientras que el elemento de control de BSR de formato largo tiene una
longitud de 3 bytes.
Por lo tanto, en la realización de la presente invención, la subcabecera de la
PDU de MAC correspondiente al elemento de control de MAC de BSR se
utiliza para indicar a la red que el elemento de control de MAC de BSR corto
transmitido por el UE es generado por el procedimiento de BSR de relleno o
por el procedimiento de BSR regular y periódico, para evitar que la red se
confunda al no poder determinar si hay solamente un grupo de canales
lógicos con datos de memoria intermedia de UL en el UE.
Tal como se ha descrito en la técnica anterior, una subcabecera de la PDU de
MAC correspondiente a un elemento de control de MAC consiste
generalmente en dos bits reservados, un campo de extensión de 1 bit y un
campo de identificador de canal lógico (LCID) de 5 bits. De este modo, la realización de la presente invención puede utilizar los dos bits reservados de la subcabecera para indicar que el elemento de control de MAC de BSR corto es generado por el procedimiento de BSR de relleno o bien por el procedimiento de BSR regular y periódico, por ejemplo los dos bits reservados “01” y “10” pueden utilizarse para indicar el procedimiento de BSR de relleno y el procedimiento de BSR regular y periódico, respectivamente. Además, el elemento de control de MAC de BSR largo y corto pueden identificarse por valores específicos de LCID. Así, cuando la red reciba un elemento de control de MAC de BSR corto con los dos bits reservados como “01”, que indica que el elemento de control de MAC de BSR corto transmitido por el UE es activado por el procedimiento de BSR de relleno, la red puede determinar entonces que puede existir más de un canal lógico que tenga datos de memoria intermedia de enlace de subida en el UE. A la inversa, cuando la red recibe un elemento de control de MAC de BSR corto con los dos bits reservados como “10”, que indica que el elemento de control de MAC de BSR corto transmitido por el UE es activado por el procedimiento de BSR regular y periódico, la red puede entonces determinar que hay solamente un canal lógico con datos de memoria intermedia de enlace de subida en el UE.
En otra realización de la presente invención, el campo de LCID puede utilizarse sin duda también para indicar el elemento de control de MAC de BSR corto activado por el procedimiento de BSR de relleno. En tal situación, la realización de la presente invención puede utilizar otro valor de LCID para indicar el elemento de control de MAC de BSR corto activado por el BSR de relleno, mientras que el elemento de control de MAC de BSR corto y largo activados por el procedimiento de BSR regular y periódico son identificados por valores de “11101” y “11110”, respectivamente. Dicha variación también pertenece al alcance de la presente invención.
En resumen, la realización de la presente invención utiliza la subcabecera de la PDU de MAC correspondiente al elemento de control del MAC de BSR para indicar a la red que el elemento de control de MAC de BSR corto transmitido por el UE es activado por el procedimiento de BSR de relleno o por el procedimiento de BSR regular y periódico, para evitar que la red se confunda al no poder determinar si hay solamente un grupo de canales lógicos con datos de memoria intermedia de UL en el UE.
Claims (8)
- Reivindicaciones1. Procedimiento para realizar informes de estado de memoria intermedia, denominados en lo sucesivo BSR, en un equipo de usuario, denominado en lo sucesivo UE, de un sistema de comunicaciones inalámbricas, comprendiendo el procedimiento:formar un control de acceso al medio, denominado en lo sucesivo MAC, una unidad de datos en paquetes, denominada en lo sucesivo PDU, comprendiendo la PDU de MAC bits de relleno con un número de bits mayor que el tamaño de un elemento de control de MAC de BSR (402); activar un procedimiento de BSR de relleno (404); informar de un elemento de control de MAC de BSR corto cuando los bits de relleno de la PDU de MAC no pueden dar cabida a un elemento de control de MAC de BSR largo (406); ycaracterizado por el hecho de indicar el elemento de control de MAC de BSR corto activado por un procedimiento de BSR de relleno a través de una subcabecera correspondiente al elemento de control de MAC de BSR en la PDU de MAC (408).
-
- 2.
- Procedimiento según la reivindicación 1, caracterizado por el hecho de que el elemento de control de MAC de BSR corto indica la cantidad de datos en un memoria intermedia del enlace de subida de un grupo de canales lógicos del UE de una prioridad más alta.
-
- 3.
- Procedimiento según la reivindicación 1, caracterizado por el hecho de que el elemento de control de MAC de BSR corto tiene una longitud de 1 byte mientas que el elemento de control de MAC de BSR largo tiene una longitud de 3 bytes.
-
- 4.
- Procedimiento según la reivindicación 1, caracterizado por el hecho de que la subcabecera comprende dos bits reservados, un campo de extensión de 1 bit y un campo de identificador de canal lógico de 5 bits, denominado en lo sucesivo LCID.
-
- 5.
- Procedimiento según la reivindicación 4, caracterizado por el hecho de que indicar el elemento de control de MAC de BSR corto activado por el procedimiento de BSR de relleno a través de la subcabecera correspondiente al elemento de control del MAC de BSR en la PDU de MAC (408) comprende:
indicar el elemento de control de MAC de BSR corto activado por el procedimiento de BSR de relleno a través de los dos bits reservados de la subcabecera. -
- 6.
- Procedimiento según la reivindicación 4, caracterizado por el hecho de que indicar el elemento de control de MAC de BSR corto activado por el procedimiento de BSR de relleno a través de la subcabecera correspondiente al elemento de control del MAC de BSR en la PDU de MAC (408) comprende:
indicar el elemento de control de MAC de BSR corto activado por el procedimiento de BSR de relleno a través del campo LCID de la subcabecera. -
- 7.
- Procedimiento según la reivindicación 1, caracterizado por el hecho de que más de un grupo de canales lógicos del UE tiene datos de memoria intermedia de enlace de subida.
-
- 8.
- Dispositivo de comunicaciones (100) para realizar un informe de estado de memoria intermedia, denominado en lo sucesivo BSR, en un equipo de usuario, denominado en lo sucesivo UE, de un sistema de comunicaciones inalámbricas (100), comprendiendo el dispositivo de comunicaciones:
un procesador (108) para ejecutar un código del programa (112); y una memoria (110) conectada al procesador (108) para almacenar el código de programa (112); estando caracterizado el código de programa (112) por el hecho de que cuando el código de programa(112) está cargado en el procesador (108) el procesador programado(108) constituye un aparato que, a su vez, es capaz de realizar el procedimiento de acuerdo con una de las reivindicaciones anteriores.
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