ES2220955T3 - Procedimiento para el reconocimiento de una pista de una trayectoria o de una trayectoria de una seccion en señales sdh. - Google Patents
Procedimiento para el reconocimiento de una pista de una trayectoria o de una trayectoria de una seccion en señales sdh.Info
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Abstract
LA INVENCION SE REFIERE A UN PROCEDIMIENTO PARA RECONOCIMIENTO SEGURO Y ESTABLE DE UNA TRAZA-VIA O DE UNA TRAZA-SECCION, DONDE SE RECONOCEN TAMBIEN LAS SITUACIONES DE PASO POSIBLES ANTES Y DESPUES DE INTERRUPCION DE SEÑAL, DE TAL MODO QUE SE EVITA EL DISPARO DE UNA ALARMA DE FALLO Y CON ELLO LA SEÑALIZACION DE FALLO UNIDA.
Description
Procedimiento para el reconocimiento de una pista
de una trayectoria o de una trayectoria de una sección en señales
SDH.
Una jerarquía digital SDH integrada en una red de
comunicaciones permite el transporte de diferentes secuencias de
señales identificadas a través de diferentes velocidades binarias y
estructuras, sin que haya que reconfigurar en cada caso toda la red
de comunicaciones. Ha sido posible una transmisión de secuencias de
señales con diferentes velocidades binarias o estructuras por medio
de una subforma de la señal. Esta subforma de la señal se configura
a través de los llamados Contenedores Virtuales (VC). Los
contenedores virtuales son transportados a través de módulos de
transporte síncronos (STM) a través de los nodos de la red de
comunicaciones, Un contenedor virtual está constituido por una parte
de cabecera de la trayectoria (Path - Overhead) POH y por un
contenedor (C). Un contenedor virtual está identificado por la pista
de la trayectoria (Path - Trace). La posta de la trayectoria es
transmitida en la cabecera de la trayectoria (Byte J1) y está
asociada al contenedor después de la recepción de la señal útil y
permanece en ésta hasta la demultiplexión de la carga útil. En
general, una trayectoria comprende más de una sección de
transmisión. En la jerarquía digital síncrona, estas secciones de
transmisión son designadas como sección múltiple o sección del
regenerador, que están identificadas en cada caso por una pista de
la sección, que está marcada en la cabecera de cuadros de la sección
(Section - Overhead). La cabecera de la sección es parte de un
cuadro STM. Las Recomendaciones G.708, G.709 y G.783 describen la
identificación de un contenedor virtual y de una sección del
regenerador. Las funciones de funcionamiento, de administración y de
mantenimiento se basan, entre otros, en una evaluación de la
cabecera de la trayectoria o de la cabecera de la sección. Además,
según CCITT está previsto un byte de una cabecera de la sección
(byte J0), que establece la transmisión de una pista de la sección
en los módulos de transporte síncrono.
Para ambos tipos de pistas -trayectoria/sección-
se pretende un formato de transmisión, que está constituido por una
secuencia de 16 bytes. La transmisión de los bytes se realiza en 16
cuadros consecutivos en el tiempo en el byte de cabecera
respectivo.
La corrección de la pista es supervisada en los
elementos de la red de la jerarquía digital síncrona de la red de
comunicaciones en los puntos terminales en el lado de recepción de
una sección de transmisión así como en puntos de observación
internos posibles en aparatos múltiples y conectores cruzados. Esta
supervisión se lleva a cabo a través de la comparación de la pista
recibida con la pista previsible respectiva, que es predeterminada
por el operador de los aparatos durante la configuración de los
elementos individuales de la red. En el caso de no coincidencia, se
genera una alarma, siendo transmitida, en lugar de la señal útil
recibida, una Señal de Indicación de Alarma Señal AIS en la
dirección de transmisión así como una indicación FERF -Fallo de
recepción en el extremo distante-, en sentido contrario a la
dirección de la transmisión.
A partir de los documentos JO 05 110 584 y GB 2
286 745 se puede encontrar un estado relevante de la técnica.
El cometido de la invención es indicar otro
procedimiento para el reconocimiento de una pista de la trayectoria
y de una pista de la sección en el caso de una transmisión de
señales SDH.
El cometido se soluciona según la invención por
medio de las características mencionadas en la reivindicación 1 de
la patente.
Por medio de las medidas según la invención se
consigue la ventaja de un reconocimiento seguro y estable de una
pista correcta.
El procedimiento implica, además, la ventaja de
que se evitan las falsas alarmas durante o bien inmediatamente
después del restablecimiento de una interrupción de la señal en el
caso de una pista todavía desconocida.
El procedimiento lleva consigo, además, la
ventaja de que se requiere un gasto de cálculo reducido para el
apoyo o bien para la evaluación de una pista.
Otras configuraciones ventajosas de la invención
se indican en las reivindicaciones dependientes.
Otras particularidades de la invención se deducen
a partir de la explicación detallada siguiente de un ejemplo de
realización con la ayuda de dibujos esquemáticos.
En este caso:
La figura 1 muestra un diagrama de bloques.
Las figura 2 muestra un diagrama de flujo para el
cálculo del estado del rastro.
La figura 3 muestra un diagrama de flujo para
decidir si se puede determinar la trayectoria.
La figura 4 muestra un diagrama de flujo para
decidir si debe confirmarse la trayectoria anterior o debe
determinarse una trayectoria nueva.
La figura 5 muestra un diagrama de flujo para la
determinación de una trayectoria nueva
La figura 6 muestra un diagrama de flujo para la
confirmación de una trayectoria existente, y
La figura 7 muestra un diagrama de flujo para
decidir su debe compararse la trayectoria actual con la trayectoria
esperada.
En el procedimiento según la invención se
investigan, bajo el control de microprocesador, los bytes de la
pista de la trayectoria/sección, seleccionados por un módulo ASIC
integrado específico del usuario, de la corriente de datos con
respecto a un reconocimiento seguro y estable de una pista. En el
caso de una presencia segura de una disparidad de la pista se
activa, bajo el control de un microprocesador, una superposición de
una señal AIS (señal de indicación de alarma- en la dirección de
recepción así como una señalización FERF -Fallo de recepción en el
extremo distante- en sentido contrario a la dirección de
recepción.
El procedimiento siguiente se basa en un
algoritmo, que se puede configurar para una ejecución en hardware y
software.
La función del hardware del módulo ASIC consiste
en extraer el byte de la pista (J1/J0) de la señal SDH respectiva en
cuadros STM consecutivos y en memorizarlo en une memoria intermedia
de datos RAM orientada a bytes (ver la figura 1). A tal fin se puede
utilizar, por ejemplo, una memoria intermedia RAM de 3 x 16 bytes de
tamaño, para posibilitar de una manera sencilla una verificación de
la recuperación (verificación de la persistencia), que se describe a
continuación. Además, el módulo ASIUC posee sensores de supervisión
para el reconocimiento de interrupciones de las señales dentro de
una trayectoria o de una sección del regenerador. Estos sensores de
supervisión señalizan una LOS -Pérdida de señal-, LOF -Pérdida de
cuadro-, MS-AIS - AIS de sección múltiple, LOP
-Pérdida de puntero-, y AU-AIS, además, de
conformidad con los procedimientos de programación, se generan una
señal de control para la representación de la indicación de alarma
AIS y una señal de control para la representación de la señal FERF
Fallo de recepción en el extremo distante (sólo en la caso de una
trayectoria). Los sensores de supervisión así como el contenido de
la memoria de pistas son consultados a través de un procesador.
La figura 1 describe una estructura de orden
superior del algoritmo con la ayuda de bloques funcionales y el
flujo de datos que tiene lugar entre los bloques funcionales. Los
sensores de supervisión TAD sirven para el reconocimiento de las
interrupciones de la señal indicadas anteriormente. Éstas son
consultadas de forma cíclica por un procesador no representado de
forma explícita, con un primer intervalo de consulta T1 y las
interrupciones de la señal registradas son memorizadas en un
registro de estado defectuoso DSR. Además, se lee un estado de
alarma todavía existente TRC-DISPAR
TRC-MM desde una memoria de estado SM y se memoriza
igualmente en el registro de estado defectuoso DSR. El contenido del
registro de estado defectuoso DSR es procesado adicionalmente en el
bloque funcional o módulo TSE -evaluación de estado del rastro-. En
este bloque funcional se determina el estado de alarma
TRC-DISPAR TRC-MM y se controla
también la representación de la señal AIS a través de la variable de
estado SET-AIS. Además el módulo TSE -Evaluación
del estado del rastro- proporciona las siguientes variables de
estado TRL-AV y
TRC-RX-ST, que sirven para el
control de los ciclos en el bloque funcional TE -evaluación de la
pista-.
TRL-AV: estado de la vía de
transmisión considerada (Trayectoria/Sección), estando identificada
ésta como "disponible" (available) o "no disponible"
(unavailable).
TRC-RX-ST: estado
de recepción de la pista. Ésta puede adoptar los valores
"confirmado", "no confirmado" o "desconocido".
El bloque funcional TE -evaluación de la pista-
representa el núcleo del algoritmo de evaluación para la pista
(Trayectoria/Sección). Este módulo TE es activado por el procesador
igualmente de forma cíclica, pero asíncrona con respecto al primer
intervalo de consulta en el bloque funcional TSE "Evaluación del
estado del rastro" con un segundo intervalo de consulta T2. En
virtud del gasto de cálculo mayor, es conveniente que este módulo
Bloque TE sea activado con menor frecuencia en comparación con el
primer intervalo de consulta (T2 > T1). El módulo TE ejerce
igualmente una influencia sobre las señales de estado
TRC-RX-ST y sobre la señal de alarma
TRC-DISPAR. El módulo TE proporciona, además, la
pista reconocida en la corriente de datos.
Los módulos TSE "Evaluación del estado del
rastro" y TE "Evaluación de la pista" se describen en
detalle en los apartados siguientes.
El ciclo del programa representado en la figura 2
del módulo TSE "Evaluación del estado del rastro" verifica en
primer lugar la disponibilidad de la sección de transmisión con la
ayuda de los defectos señalizados sobre el trayecto de
transmisión:
- LOS (pérdida de la señal, para la
disponibilidad de la sección y la trayectoria)
- LOF (pérdida de cuadro, para la disponibilidad
de la sección y la trayectoria)
- MS-AIS (AIS de sección
múltiple, solamente para la disponibilidad de la trayectoria).
La disponibilidad de una sección de regeneración
existe también a la recepción de MS-AIS; para la
Sección Pista se aplica en este caso según ITU-T,
que los bytes de la pista correspondientes se emplean nuevos en cada
sección del regenerador.
- -
- LOP (pérdida de puntero, sólo para la disponibilidad de la trayectoria)
- -
- AU-AIS (sólo para la disponibilidad de la trayectoria)
En el caso de que al menos uno de los defectos
señalados se encuentre en una sección de transmisión considerada, se
realizan las siguientes acciones:
- -
- La variable de estado TRL-AV se coloca en "falsa" (la sección de transmisión no está disponible) para bloquear de esta manera la evaluación de la pista en el módulo o bloque funcional "evaluación de la pista".
- -
- La variable de estado TRC-RX-ST se coloca en "desconocida" para iniciar una nueva determinación de la pista después de la desaparición del defecto.
- -
- Las variables de estado TRC-DISPAR y SET-AIS se colocan en "falsas" para evitar una generación de falsa alarma y una representación AIS/FERF, especialmente en el tiempo de transición después de la desaparición de los defectos mencionados anteriormente, si no se ha podido realizar todavía una nueva determinación de la pista.
En el caso de que ninguno de estos defectos, que
se refieren a la sección de transmisión considerada, esté presente
en este momento, se realizan las acciones siguientes:
- -
- La variable de estado TRL-AV se coloca en "verdadera" (la sección de estado está disponible), para liberar de esta manera la evaluación de la pista en el bloque funcional "Evaluación de la pista".
- -
- En el caso de que la variable de estado TRC-DISPAR posea el valor "verdadero" y esté liberada la representación de AIS/FERF para este caso a través de un parámetro de configuración ajustado por el operador del aparato, entonces de inicia AIS/FERF a través de la colocación de la variable de estado SET-AIS.
En las etapas del programa del módulo TE
Evaluación de la pista que están representadas en la figura 3 se
consulta en primer lugar la disponibilidad momentánea de la sección
de transmisión con la ayuda de la señal de estado
TRL-AV, cuyo valor ha sido determinado en el bloque
funcional "Evaluación del estado del rastro". En el caso de no
disponibilidad, no se llevan a cabo otras acciones y todas las
variables de partida mantienen sus valores actuales.
En el caso de disponibilidad de la sección de
transmisión se ejecutan de forma sucesiva los subprogramas
"Búsqueda de la pista" y "Detección de la disparidad de la
pista". Las etapas del programa realizadas allí conducen a la
determinación de las variables de estado
``TRC-DISPAR,
TRC-RX-ST y de la pista actual
TRC-RC.
En la figura 4 se representa el módulo del
programa SFT Búsqueda de la pista. Este módulo del programa controla
la determinación de la pista actual, siendo realizado esto de una
manera diferente según el valor actual de las variables de estado
TRC-RX-ST.
Para TRC RX ST = desconocido (pista
desconocida):
En este estado se llama el bloque funcional
"Hallar nueva pista" para la determinación por primera vez o
para una nueva determinación de la pista. En el caso de la
determinación con éxito, se memoriza el nuevo valor hallado
TRC-NUEVO como pista actual en la variable
TRC-RX y se coloca la variable de estado
TRC-RX-ST en "confirmada".
Cuando la determinación no ha tenido éxito, se mantiene el estado
actual, de manera que se intenta de nuevo la determinación con la
siguiente llamada del algoritmo.
Para TRC RX ST = "confirmada".
En este estado, se parte de que durante la
llamada previa del algoritmo o bien ha sido hallada o confirmada la
pista actual TRC-RX. Por lo tanto, se llama el
bloque funcional "Confirmar la pista actual", con la esperanza
de confirmar el valor actual. Para la confirmación se utiliza un
criterio menos estricto que para la nueva determinación (ver la
descripción de la figura 6). Cuando la confirmación se ha realizado
con éxito, se mantiene el estado actual.
Cuando la confirmación no se ha realizado con
éxito, entonces se coloca la variable de estado
TRC-RX-ST en "no confirmado",
pero la pista actual se continúa considerando, sin embargo, como
válida y, por lo tanto, se mantiene inalterada.
Para TRC RX ST = "no confirmado":
En este estado se parte de que en la llamada
anterior del algoritmo no ha sido confirmada la pista actual
TRC-RX. Se llama de nuevo el bloque funcional
"Confirmar pista actual", con la esperanza de que esta vez sea
confirmado el valor actual. Cuando la confirmación de ha realizado
con éxito, entonces se coloca la variable de estado
TRC-RX-ST en "confirmada" y
continúa siendo válida la pista actual. Si la confirmación no se ha
realizado con éxito, entonces se coloca la variable de estado
TRC-RX-ST en "desconocida" y,
por lo tanto, se declara como no válida la pista actual, de manera
que se inicia una nueva determinación durante la llamada siguiente
del algoritmo.
Por medio de esta supervisión controlada por el
estado de la pista se inicia la nueva determinación de la pista al
comienzo o bien después del reconocimiento de interrupciones de la
señal, en cambio durante el funcionamiento sin interrupciones, se
inicia una nueva determinación ya después de que ha producido dos
veces una ausencia de confirmación de la pista actual. De esta
manera, se obtiene un comportamiento robusto con la pista perturbada
en el caso de ráfagas cortas de errores binarios así como en el caso
de frecuencias estadísticas de errores hasta
10E-3.
En la figura 5 se representa el ciclo del
programa del módulo del programa -Hallar pista nueva-, en el que se
realizan las siguientes etapas del procedimiento para la nueva
determinación de la pista:
- -
- En la memoria de pistas del ASIC se inscriben 48 bytes de pistas de cuadros consecutivos en el tiempo de la señal SDH. A continuación, se lee la memoria de pistas del ASIC por el microprocesador en forma de bloques de datos de 3 x 16 bytes, cada uno de los cuales contiene la pista en el caso normal, pero en una posición de las fases todavía desconocida.
- -
- Se lleva a cabo una verificación de la persistencia sobre los 3 bloques de datos, con la condición de que los bytes correspondientes entre sí de cada bloque de datos sean exactamente iguales. Si falla la verificación de la persistencia, entonces se considera que ha pista no ha sido hallada.
- -
- Si la verificación de la persistencia ha sido realizada con éxito, entonces se extrae a partir de los 3 bloques de datos un bloque discrecional para el procesamiento posterior.
- -
- En el bloque de datos extraído se trata de hallar el byte con MSB = 1 como el byte de inicio de la pista (Byte 1 en la Tabla 1). Si no se consigue, entonces se considera que la pista no ha sido hallada, en otro caso se considera la secuencia de 16 bytes con el byte de inicio reconocido como la nueva pista hallada.
La evaluación de los bits CRC establecidos por la
Norma, que están contenidos en el byte de inicio es superflua debido
a la verificación de la recuperación (verificación de la
persistencia) sobre los bloques de datos de 3 x 16 bytes, puesto que
de esta manera se consigue ya un comportamiento muy estable en el
caso de errores binarios de la transmisión con las siguientes
propiedades:
- -
- Con una frecuencia de errores binarios de 10^{-3} en la sección de transmisión considerada, se produce el reconocimiento de una pista falsa (la pista aparente reconocida no coincide con la pista que está presente en la señal) con la probabilidad 8,7 x 10^{-8}.
- -
- Con una frecuencia de errores binarios de 10^{-3} en la sección de transmisión considerada, se reconoce la pista presente en la señal con una probabilidad de 0,68.
En el módulo mostrado en la figura 6 CCT
-Confirmar la pista actual- se reproduce la confirmación de una
pista ya conocida según el procedimiento siguiente:
- -
- En la memoria de pistas del ASCI se inscriben 48 bytes de pistas de cuadros consecutivos en el tiempo de la señal SDH. A continuación, se lee la memoria de pistas del ASIC por el microprocesador en forma de bloques de datos de 3 x 16 bytes, y cada uno de los cuales contiene la pista en el caso normal, pero en una posición de las fases todavía desconocida.
- -
- En un bucle con el índice numérico i = 1, ..., 3 se extrae en cada caso el bloque de datos i de 16 bytes y se intenta hallar el byte con MSB = 1 como el byte de inicio de la pista. Si no se consigue, entonces se extrae el siguiente bloque de datos (i + 1) y se actúa de forma correspondiente. Si se halla el byte de inicio, entonces se considera la secuencia de 16 bytes con el byte de inicio reconocido como la pista hallada y se compara con la pista TRC-RX conocida hasta ahora. En caso de coincidencia, se considera que la pista actual ha sido confirmada, en caso de no coincidencia, se extrae el bloque de datos (i + 1) y se procede de una manera correspondiente.
No hay que realizar la verificación del bit CRC
con una prueba CRC-7, puesto que ésta ya ha sido
tenida en cuenta durante la confirmación de la pista actual
TRC-RX.
- -
- Si no se encuentra una pista en ninguno de los bloques de datos de 3 x 16 bytes, que coincida con el valor actual TRC-RC, entonces se considera que la pista no ha sido confirmada.
En combinación con el bloque funcional
"Búsqueda de pista" se procede de la siguiente manera en el
caso de errores binarios de transmisión:
- -
- Con una frecuencia de errores binarios de 10^{-3} en la sección de transmisión considerada, se produce una no confirmación consecutiva doble de la pista actual con una probabilidad de 3 x 10^{-6} (esto conduce, a través de la colocación de TRC-RX-ST = "desconocido", al estado de una pista desconocida y se inicia una nueva determinación).
En el módulo TMD -Detección de disparidad de la
pista- reproducido en la figura 7 se determina el valor de las
variables de estado TRC-DISPAR de la siguiente
manera:
- -
- En el caso de que la supervisión de la pista esté liberada a través de un parámetro de configuración ajustado por el operador del aparato, entonces se ejecutan todavía las siguientes consultas, en otro caso se coloca la variable de estado TRC-DISPAR en "falsa" (alarma desconectada).
- -
- Si la variable de estado TRC-RX-ST posee el valor "desconocido" (pista actual desconocida), entonces se coloca TRC-DISPAR en "verdadero" (alarma conectada).
- -
- Si la variable de estado TRC-RX-ST posee el valor "confirmado" (pista actual desconocida), entonces se compara la pista actual con la pista esperada (configurada por el operador del aparato) y en caso de coincidencia o bien en caso de no coincidencia se coloca la variable de estado TRC-DISPAR en "falsa" (alarma desconectada) o bien en "verdadera" (alarma conectada). La comparación se puede limitar a los bytes 2 a 16 de la pista, puesto que los bits CRC son también iguales en el caso de coincidencia.
Las probabilidades de error indicadas en las
descripciones anteriores de las figuras son calculadas de acuerdo
con las fórmulas siguientes:
A continuación se derivan las fórmulas de cálculo
para las probabilidades de error que se indican en los bloques
funcionales "Hallar pista nueva" y "Confirmar pista
actual". Se supone que N es el número de los bits, a partir de
los cuales está constituida la Pista. Aquí en este ejemplo de
realización es N = 8 x 16 = 128, p es la probabilidad de un error
binario de transmisión, suponiendo aquí que el valor límite es p =
10^{-3}. En el caso de errores binarios estadísticamente
independientes, se obtiene el número de los bits falsificados de la
pista de una distribución binominal.
Para el reconocimiento de la pista, de acuerdo
con el bloque funcional, que ha sido descrito con referencia a la
figura 5, debería realizarse una verificación de la persistencia
sobre tres bloques de pista recibidos. En el supuesto de que cada
bloque sea perturbado exactamente por el mismo patrón de errores
binarios, se puede obtener el reconocimiento de una pista falsa. Si
se consideran aquí todos los n patrones de errores binarios con un
solo bit perturbado (éste es el caso "más probable"), entonces
se aplica para la probabilidad de reconocimiento P_{1}:
(1)P_{1}=N[p(1-p)^{N-1}]^{3}=8,7
\text{*} 10^{-8}
El reconocimiento de la pista correcta se realiza
con la recepción de 3 bloques de pistas libres de errores. A tal
fin, se aplica la probabilidad de reconocimiento P_{2}:
(2)P_{2} = (1
- p)^{3N} =
0,68
Se realiza una ausencia de confirmación por dos
veces según el bloque funcional, que se ha representado en la figura
6 cuando se reciben 6 bloques de pistas perturbados patrones de
errores binarios discrecionales. A tal fin, se aplica la
probabilidad P_{3}:
(3)P_{3}=[1-(1-p)^{N}]^{6}=3
\text{*}
10^{-6}
El procedimiento está diseñado especialmente para
una ejecución cada en hardware y software, como aparecen en las
formas de realización habituales en la técnica SDH; no obstante,
también es concebible una pura ejecución en hardware. En el caso de
ejecución asistida con software, es especialmente ventajoso que se
pueda prescindir de la evaluación intensiva de cálculo del
CRC-7.
Claims (9)
1. Procedimiento para el reconocimiento de datos
de pistas, que pertenecen a un módulo de transporte síncrono o a un
contenedor virtual, estando formados los datos de las pistas del
módulo de transporte síncrono por una Pista de Sección JO y estando
formados los datos de pistas del Contenedor Virtual por una Pista de
Trayectoria J1, que se transmiten dentro de una estructura de
cuadros predeterminada de la jerarquía digital síncrona, de forma
abreviada SDH, en una red de comunicaciones, caracterizado
porque a partir de la cabecera (Overhead) del módulo de transporte
síncrono o bien del contenedor virtual se seleccionan datos de
pistas J0 y J1 y mensajes de interferencias, por ejemplo LOS, LOF,
MS-AIS, LOP y AU-AIS y se memorizan
temporalmente, en un primer módulo del programa (TSE) se verifica la
disponibilidad de una sección de transmisión con la ayuda de los
mensajes de interferencia seleccionados, y se proporcionan desde
este primer módulo del programa (TSE) las variables de estado
(TRL-AV, TRC-RX-ST)
con relación a esta disponibilidad, y en el caso de disponibilidad
de una sección de transmisión, se alimentan los datos de pistas J0 y
J1 seleccionados a un segundo módulo del programa (TE) y de
conformidad con los procedimientos de los subprogramas (SFT, TMD),
en función de las variables de estado (TRL-AV,
TRC-RX-ST) con relación a la
disponibilidad de una sección de transmisión, se determinan los
datos de pistas actuales así como sus variables de estado
(TRC-RX-ST, TRC-MM,
TRC-RX).
2. Procedimiento según la reivindicación 1,
caracterizado porque de acuerdo con el primer módulo del
programa (TSE), se leen y se evalúan los mensajes de interferencias
seleccionados, porque se determina un estado de alarma
(TRC-MM) y se inicia la representación de una señal
de alarma (AIS) en virtud de una variable de estado de alarma
(SET-AIS), porque se memorizan temporalmente las
variables de estado (TRC-RX-ST,
TRC-MM, TRC-RX) para el control de
los procedimientos de los subprogramas (SFT, TDM) que están
asociados al segundo módulo del programa (TE), en una unidad de
memoria de estado (SM).
3. Procedimiento según la reivindicación 1,
caracterizado porque en el segundo módulo del programa (TE)
se verifica en una primera etapa del programa la disponibilidad de
la sección con la ayuda de una primera variable de estado
(TRL-AV), porque en el caso de no disponibilidad de
la primera variable de estado (TRL-AV) no se llevan
a cabo etapas adicionales del programa y todas las variables de
salida del segundo módulo del programa (TE) mantienen sus valores
como hasta ahora, porque en el caso de disponibilidad de la primera
variable de estado (TRL-AV) se ejecuta un primero y
un segundo procedimiento de subprograma (SFT, TDM), siendo
determinadas las variables de estado
(TRC-RX-ST, TRC-MM,
TRC-RX) y siendo memorizadas temporalmente en una
unidad de memoria de estado (SM).
4. Procedimiento según una de las
reivindicaciones anteriores, caracterizado porque un primer
procedimiento del subprograma (SFT), a partir del valor actual de
una variable de estado (TRC-RX-ST)
correspondiente, que indica el estado de recepción de una pista,
determina los datos de pistas actuales.
5. Procedimiento según una de las
reivindicaciones anteriores, caracterizado porque en el caso
de que no se localice una variable de estado, que indica la pista
actual, se dispara una alarma (TRC-MM) a través de
un segundo procedimiento del subprograma (TMD), porque en el caso de
que se conozcan otras variables de estado
(TRC-RX-ST), éstas son comparadas
con una pista esperada y en el caso de coincidencia se admite la
variable de estado (TRC-MM) que ha disparado la
alarma o se activa una alarma en caso de disconformidad.
6. Procedimiento según una de las
reivindicaciones anteriores, caracterizado porque se lleva a
cabo una comparación con los datos de pistas previsibles en cada
caso y los datos de pistas asignados a un aparato, siendo emitida,
en el caso de no coincidencia, una señal de alarma (AIS) en la
dirección de transmisión.
7. Disposición de circuito para el reconocimiento
de datos de pistas, que pertenecen a un módulo de transporte
síncrono o a un contenedor virtual, estando formados los datos de
las pistas del módulo de transporte síncrono por una Pista de
Sección JO y estando formados los datos de pistas del Contenedor
Virtual por una Pista de Trayectoria J1, que se transmiten dentro de
una estructura de cuadros predeterminada de la jerarquía digital
síncrona, de forma abreviada SDH, en una red de comunicaciones,
caracterizada porque está prevista una unidad de memoria (TB)
para la memorización temporal de los datos de pistas J0 o J1 que
están indicados en la cabecera del módulo de transporte síncrono o
bien del contenedor virtual, están previstos sensores de supervisión
(TAD) para la selección de mensajes de interferencias, por ejemplo
LOS, LOF, MS-AIS, LOP y AU-AIS, está
prevista una unidad de memoria intermedia (DSR) para la memorización
temporal de los mensajes de interferencias seleccionados y están
previstos un primer módulo (TSE) y un segundo módulo (TE), porque el
primer módulo (TSE) está configurado de tal forma que éste verifica
la disponibilidad de una sección de transmisión con la ayuda de los
mensajes de interferencias seleccionados y genera una variable de
estado (TRL-AV,
TRC-RX-ST) con relación a esta
disponibilidad. Y porque el segundo módulo (TE) está diseñado de tal
forma que, en el caso de disponibilidad de una sección de
transmisión, se alimentan a este módulo los datos de pistas J0 y J1
seleccionados y de conformidad con los procedimientos de los
subprogramas (SFT, TMD), en función de las variables de estado
(TRL-AV, TRC-RX-ST)
con relación a la disponibilidad de una sección de transmisión, se
determinan los datos de pistas actuales así como sus variables de
estado (TRC-RX-ST,
TRC-MM, TRC-RX).
8. Disposición de circuito según la
reivindicación 7, caracterizada porque el primer módulo (TSE)
lee y evalúa los mensajes de interferencias seleccionado,
determinando un estado de alarma (TRC-MM) e
iniciando la representación de una señal de alarma (AIS) en virtud
de su variable de estado de alarma (SET-AIS) y
siendo memorizadas temporalmente las variables de estado
(TRC-RX-ST, TRC-MM,
TRC-RX) para el control del segundo módulo (TE) en
una unidad de memoria de estado (SM).
9. Disposición de circuito según la
reivindicación 7 u 8, caracterizado porque el segundo módulo
(TE) está configurado de tal forma que se verifica la disponibilidad
de la sección con la ayuda de una primera variable de estado
(TRL-AV), porque en el caso de no disponibilidad de
la primera variable de estado (TRL-AV) no se llevan
a cabo etapas adicionales del programa y todas las variables de
salida del segundo módulo del programa (TE) mantienen sus valores
como hasta ahora, porque en el caso de disponibilidad de la primera
variable de estado (TRL-AV) se ejecuta un primero y
un segundo procedimiento de subprograma (SFT, TDM), siendo
determinadas las variables de estado
(TRC-RX-ST, TRC-MM,
TRC-RX) y siendo memorizadas temporalmente en una
unidad de memoria de estado (SM).
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