DE3882175T2 - Fehlerkorrektur-Kode für einen B-bit-pro-Chip-Speicher mit verminderten Redundanz. - Google Patents
Fehlerkorrektur-Kode für einen B-bit-pro-Chip-Speicher mit verminderten Redundanz.Info
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Claims (4)
1. Fehlerprüf- und -korrektur code (ECC) mit verringerter
Redundanz in einem B-Bit-pro-Chip-Speichersystem, erhältlich
durch
a) Festlegen der Paritätsprüfmatrix H der allgemeinen Form
des entsprechenden SSC-DSD-Codes für
Einzelsymbolkorrektur und Doppelsymbolerkennung mit der Symbollänge
b', der Codelänge b'N für N Chips und einer Anzahl von
r Prüfbits;
b) Transformieren der Matrix H der allgemeinen Form aus
Schritt a) in die Matrix H(s) der Standardform, bei der
die erste ungleich Null Untermatrix b'xb' jeder der N
b'-Spaltengruppen der Matrix gleich der
b'xb'-Einheitsmatrix ist;
c) Erstellen des neuen Codes aus H(s) durch:
i) zunächst Löschen stets des gleichen
e-Spaltensatzes aus jeder b'-Spaltengruppe der Matrix H(s),
wobei e die Anzahl der reduzierten Bits aus dem
SSC-DSD-Code der allgemeinen Matrix H darstellt,
ii) anschließendes Löschen der e nur Nullen
enthaltenden Zeilen aus der in Schritt c) i) gebildeten
Matrix, um eine resultierende Matrix H(r) mit der
Symbollänge (b'-e) = b und der Codelänge (b'-e)N
und einer Anzahl von r-e Prüfbits zu erzeugen.
2. ECC-Code nach Anspruch 1 mit b=4, N=20, einer Codelänge
von 80 und einer Anzahl von 14 Prüfbits, bei dem die
Matrix H1 zur Erzeugung des Codes ist:
und die Matrix zur Fehlerkorrektur und -erkennung ist:
3. ECC-Code nach Anspruch 1, bei dem e gleich eins ist.
4. Chipfehlerkorrektur- und -erkennungscode in einem
4-Bitpro-Chip-Speicher mit N Chips, der erhalten wird durch
erstens Schaffen einer bekannten Fehlerkorrekturcodematrix
mit einer Symbollänge von 5 Bit für N Chips und einer
Codewortlänge von 5N,
zweitens Umordnen der im ersten Schritt erzeugten
Codematrix, so daß die erste nur aus Nullen bestehende
5·5-Untermatrix jeder der N 5-Spaltengruppen der Matrix gleich
der 5·5-Einheitsmatrix ist,
drittens Löschen derselben 1-Spaltengruppen aus jeder 5-
Spaltengruppe der im zweiten Schritt erzeugten Matrix, und
abschließend Löschen einer nur aus Nullen bestehenden
Zeile aus der im dritten Schritt erzeugten Matrix, um eine
resultierende Matrix mit der Symbollänge 4 und der
Codelänge 4N zu erzeugen.
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SG76501A1 (en) * | 1996-02-28 | 2000-11-21 | Sun Microsystems Inc | Error detection and correction method and apparatus for computer memory |
US6430722B1 (en) | 1998-01-23 | 2002-08-06 | Hughes Electronics Corporation | Forward error correction scheme for data channels using universal turbo codes |
US6370669B1 (en) | 1998-01-23 | 2002-04-09 | Hughes Electronics Corporation | Sets of rate-compatible universal turbo codes nearly optimized over various rates and interleaver sizes |
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