DE19758547B4 - Halbleiterbaustein - Google Patents
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Abstract
Die Erfindung betrifft einen Halbleiterbaustein mit einem Substrat, das einen integrierten Schaltkreischip trägt, der über Bonddrähte mit entsprechenden Lötkugeln elektrisch verbunden ist, die sich auf der dem Schaltkreischip abgewandten Seite des Substrats befinden, das mit Durchtrittsöffnungen versehen ist, die auf der Seite der Lötkugeln mit einem metallischen, mit der zugehörigen Lötkugel verlöteten Kragen versehen und mit dem Lot der Lötkugeln gefüllt sind, wobei die Durchtrittsöffnungen auf der den Schaltkreischip tragenden Seite des Substrats von metallischen, mit dem Lot der jeweiligen Lötkugel verlöteten Kappen abgedeckt sind, wobei die Bonddrähte mit den Kappen verlötet sind.
Description
- Die Erfindung betrifft einen Halbleiterbaustein (BGA) nach dem Oberbegriff des Anspruch 1, wie er aus der
JP 05144995 A - Die Veröffentlichung "Ball Grid Array Technology" von John H. Lau, McGraw-Hill-Verlag, 1995, beschreibt die wachsende Verwendung der Kugelmatrixtechnik unter Angabe der zahlreichen Vorteile beispielsweise gegenüber der Stiftmatrixtechnik, vgl. z.B. Seiten xiii bis xvi. Zu diesen Vorteilen gehören verringerte Koplanaritätsprobleme (keine Leiter), verringerte Plazierungsprobleme (Selbstzentrierung), verringerte Pastendruckprobleme, verringerte Handhabungsprobleme (keine beschädigten Leiter), geringes Profil (kleinere Abmessung), besseres elektrisches Verhalten, besseres thermisches Verhalten, bessere Packungsausbeute, bessere Platinenausbeute, höhere Verdrahtungsdichte, Hohlraumaufwärts- oder -abwärtsoptionen, Mehrlagenverdrahtungsoptionen, höhere Anzahl von Eingängen/Ausgängen für eine gegebene Abmessung, kürzere Bonddrähte, leichtere Erstreckbarkeit auf Multichipmodule und schnellerer Konstruktions/Produktionszyklus.
- In einer typischen kunststoffumhüllten Kugelmatrixkomponente wird als Substrat eine gedruckte Schaltungsplatine aus einem Material wie Triazinbismaleimid-(BT)-Harz oder Keramik (Al2O3). Ein integrierter Siliciumschaltkreis-(IC)-Chip ist auf einer Seite eines solchen Substrats vorgesehen, während sich auf der entgegengesetzten Seite desselben Lotkugeln befinden, wobei der IC-Chip durch eine Vergußgasse eingekapselt ist.
- Eine elektrische Verbindung vom Chip zu den Lotkugeln erfolgt mittels Bonddrähten, die den Chip mit Leitern auf der Oberfäche des Substrats, von den Leitern zu Spuren und dann durch Durchkontaktierungen zur entgegengesetzten Seite des Substrats, an der andere Spuren vorgesehen sind, und dann mit den Lotkugeln verbinden.
- Gegenwärtig wird die BGA-Technik bei der Herstellung hauptsächlich solcher Bausteinen eingesetzt, die eine große Zahl von Eingängen und Ausgängen aufweisen. Beispielsweise sind BGA-Bausteinen in der Halbleiterindustrie erhältlich, die 119, 169, 225, 256, 313, 352, 420 oder 625 Kugeln aufweisen. Obwohl Bausteinen mit einer niedrigeren Anzahl von Eingängen und Ausgängen die große Masse der gegenwärtigen Halbleiterproduktion ausmachen, hat sich die Herstellung solcher Bausteinen in BGA-Technik als teuer erwiesen. Wenn BT verwendet wird, entfällt ein großer Teil dieser Kosten, beispielsweise vielleicht 50% der Materialkosten der gesamten Bausteine, auf das BT-Substrat.
- Typischerweise wird BT oder Keramik in Form einzelner Elemente mit Abmessungen von beispielsweise 45 × 187,5 mm vorgesehen. Es obliegt dann dem Hersteller der BGA-Bausteinen, solche Bausteinen so auszulegen, daß die maximale Fläche des Elements ausgenutzt wird. Dann werden die fertiggestellten Bausteine vereinzelt, wobei das Überschußmaterial abgetrennt wird.
- Ein erheblicher Teil des Ausgangselements bei der Herstellung des Bausteins bleibt unbenutzt und wird somit verschwendet. Beim gegenwärtigen Stand wird tatsächlich nur 60 bis 80% der Fläche eines solchen Ausgangselementes bei der Herstellung von Bausteinen ausgenutzt, während der Rest weggeworfen werden muß.
- Da das Material des Substrats einen erheblichen Teil der Kosten des Bausteins ausmacht, wäre es deshalb vorteilhaft, jenen Teil des Ausgangselements minimal zu halten, der nicht tatsächlich für die Fabrikation von BGA-Bausteinen ausgenutzt wird, so daß die Gesamtkosten verrringert werden können, um eine Produktion von Bausteinen mit niedriger Anzahl von Eingängen und Ausgängen zu ermöglichen.
- Aus
EP 0 702 404 A2 ,1A ,1B , ist ein Halbleiterbaustein der eingangs genannten Art bekannt, bei dem ein mehrschichtiges Substrat aus einer Trägerfolie, einer metallischen Verdrahtungsfolie und einer damit verklebten Verstärkungsplatte vorgesehen ist, wobei ein Halbleiterchip, in einer Ausnehmung der Verstärkungsplatte angeordnet, einerseits an einem mit der Verstärkungsplatte verklebten Wärmeableiter befestigt und andererseits über seine Rückseite mit der Verdrahtungsfolie elektrisch verbunden ist. Hierbei sind matrixartig Lotkugeln auf der dem Halbleiterchip abgekehrten Seite der Trägerfolie vorgesehen. In der Trägerfolie befinden sich Durchtrittsöffnungen, die mittels der Verdrahtungsfolien plattiert sind, die auf der dem Halbleiterchip abgewandten Seite der Trägerfolie Kragen bildet. Die gesamte Verdrahtungsfolie ist goldplattiert, wobei das Lot der Lotkugeln sich in plattierte Durchtrittsöffnungen in der Trägerfolie erstreckt und mit der Plattierung und dem Kragen zur Sicherstellung der elektrischen Kontaktierung verlötet ist. Derartige Halbleiterbausteine besitzen einen sehr komplizierten Aufbau, der zudem relativ viel Gold benötigt. - Aus der
JP 03262186 A - In Durchlochungen einer Platine eingesetzte metallische Zylinder sind auch aus der
US 5 275 330 bekannt. Die Zylinder werden von einer Seite mit Lot gefüllt und ein Halbleiterbaustein, der an seiner der Platine zugewandten Oberfläche Lötkugeln aufweist, wird auf aus den Zylindern überstehendes Lot aufgesetzt. - Schließlich ist aus der
US 4 830 264 eine Platine mit einer auf einer Oberfläche davon angeordneten Leiterbahn bekannt, die zu einem auf der Oberfläche angeordneten Halbleiterbaustein geführt ist und durch deren kreisscheibenförmig gebildetes freies Ende sich eine Durchlochung bis zur gegenüberliegenden Oberfläche der Platine erstreckt. In die Durchlochung ist ein metallischer Zylinder eingesetzt, der mit Lot gefüllt ist und an dessen der Leiterbahn abgewandter Oberfläche eine Lötkugel zum Aufsetzen auf eine weitere Platine vorgesehen ist. - Der Erfindung liegt die Aufgabe zugrunde, einen Halbleiterbaustein nach dem Oberbegriff des Anspruchs 1 zu schaffen, der bei durch ein Substrat zu Höckern hindurchgeführten Verbindungen einen einfacheren Aufbau aufweist.
- Diese Aufgabe wird entsprechend den Merkmalen des Anspruchs 1 gelöst und gleichzeitig Platz eingespart.
- Weitere Ausgestaltungen der Erfindung sind den Unteransprüchen zu entnehmen.
- Die Erfindung wird nachstehend anhand von in den beigefügten Abbildungen dargestellten Ausführungsbeispielen näher erläutert. Hierbei zeigen die
6 bis13 Durchtrittsöffnungen gemäß Anspruch 1. -
1 zeigt eine Draufsicht auf ein Substrat mit BGA-Bausteinen, die darauf ausgebildet sind. -
2 zeigt einen Schnitt gemäß der Linie 4-4 von1 zur Darstellung eines Bausteins mit Kugeln und einem integrierten Schaltkreischip auf einander abgekehrten Seiten des Substrats. -
3 zeigt einen Schnitt eines Bausteins ähnlich dem von2 , jedoch unter Verwendung von gestapelten Substraten. -
4 zeigt einen Schnitt eines Bausteins, der Kugeln und einen integrierten Schaltkreischip auf derselben Seite des Substrats trägt. -
5 zeigt einen Schnitt eines Bausteins mit einem Substrat und einem Leiterrahmen. -
6 zeigt einen Schnitt eines Bausteins mit Darstellung der Verbindung von Kugeln und integriertem Schaltkreischip mittels dargestellten Durchgangsöffnungen im Substrat. -
7 zeigt eine Draufsicht auf eine Platte, die aus Substraten für Bausteine nach6 besteht. -
8 zeigt eine detaillierte Ansicht einer Ausführungsform der Kugelstruktur des Bausteins nach6 . -
9 zeigt eine Kugelstruktur des Bausteins alternativ zur6 . -
10 und11 illustrieren ein Verfahren zur Bildung einer Kugelmatrixanordnung nach8 . -
12 und13 illustrieren ein Verfahren zur Bildung der Kugelmatrixanordnung nach9 . - Eine Platte
20 aus Substratmaterial, beispielsweise aus BT oder Keramik (Al2O3) weist, wie in1 dargestellt, V-Nuten22 auf, die die Platte20 in Substrate24 von BGA-Bausteinen26 von im wesentlichen gleicher Größe unterteilen. Gemäß2 befindet sich auf jedem Substrat24 ein integrierter Schaltkreischip28 , der über Bonddrähte29 über entsprechende leitende Spuren und Durchkontaktierungen mit Lotkugeln30 auf dem Substrat24 verbunden ist, wobei sich die Lotkugeln30 auf der dem Schaltungschip28 abgekehrten Seite des Substrats24 befinden. Der Schaltkreischip28 und die Bonddrähte29 sind durch Vergußmaterial32 eingekapselt. - Die BGA-Bausteine
26 können ohne weiteres voneinander getrennt werden, indem die Platte20 längs der V-Nuten22 gebrochen wird, da letzere Sollbruchstellen darstellen. Die Platte20 kann stattdessen auch mit anderen Sollbruchstellen versehen werden, beispielsweise mit Durchbrüchen in der Platte20 . - Durch Bemessen jedes Substrats
24 derart, daß es im wesentlichen den Abmessungen des herzustellenden BGA-Bausteins26 entspricht, und durch Vorsehen einer Platte20 , deren Abmessungen durch die Vielzahl solcher Substrate24 bestimmt ist, wird sichergestellt, daß im wesentlichen die gesamte Platte20 , die einen relativ teuren Teil der resultierenden Bausteine26 darstellt, für die Fabrikation von BGA-Bausteinen ausgenutzt wird. Somit verbleibt kein Abfall an Substratmaterial nach Vereinzeln der BGA-Bausteinen26 . - Die Platte
20 kann eine sehr viel größere Anzahl als die in1 gezeigten vier Substrate24 ebenso wie eine wesentlich größere Anzahl an Lotkugeln30 pro Substrat24 aufweisen. - Der BGA-Bausteine
40 von3 umfaßt eine Platte42 , in diesem Falle aus zwei Rücken an Rücken liegenden Platten43 ,44 bestehend, welche jeweils mit V-Nuten46 bzw.48 versehen sind. Die V-Nuten46 ,48 begrenzen einzelne zweischichtige Substrate50 eines BGA-Bausteins52 . Der Schaltkreischip54 befindet sich auf einer Seite des Substrats50 , während sich die Kugeln56 des BGA-Bausteins52 auf der dem Schaltkreischip54 abgekehrten Seite des Substrats50 befinden. In diesem Falle können Durchkontaktierungen und zusätzliche Schichten von Spuren vorgesehen werden, wobei die Schaltkreischips54 mit Vergußmasse58 verkapselt werden. Die BGA-Bausteine52 können ohne weiteres vereinzelt werden, d.h. ohne weiteres durch Brechen der Platte42 längs der V-Nuten46 ,48 voneinander getrennt werden. - Bei dem BGA-Baustein von
4 wird ein Substrat62 verwendet, das aus einem Abschnitt einer Platte64 aus Substratmaterial besteht. In diesem Falle befinden sich jedoch die Lotkugeln66 und der Halbleiterchip68 auf derselben Seite des Substrats62 . - Gemäß
5 werden Leiterrahmen70 als Segmente einer Platte verwendet, wobei die Leiterrahmen70 auf einer Lotmaske72 mit benach barten Lotkugeln74 mit entsprechenden V-Nuten76 zur Vereinzelung einzelner BGA-Bausteine78 angeordnet sind. - Der BGA-Baustein
80 , vgl.6 und7 , umfaßt ein Substrat82 , durch das sich eine Mehrzahl von Durchbrüchen84 von einer Seite zur anderen erstreckt. Das Substrat82 nimmt die Stelle eines Leiterrahmens ein. Leiterspuren86 sind auf einer Seite des Substrats82 vorgesehen, über denen sich ein Dielektrikum88 befindet, während ein Schaltkreischip90 auf dem Dielektrikum88 angeordnet ist. Metallisierungskappen92 liegen über den entsprechenden Durchbrüchen84 . Bonddrähte94 verbinden den Schaltkreischip90 mit den Metallisierungskappen92 . Die Durchbrüche84 können entweder durch Durchplattieren oder durch Füllen der Durchbrüche mit leitender Paste leitend gemacht sein. Das Substrat82 ist wiederum Teil einer großen Platte96 (7 ), die entsprechend der Größe der einzelnen Substrate82 begrenzt und dimensioniert ist. - Gemäß
8 befindet sich eine leitende Auskleidung98 in dem Durchbruch84 , die einen radialen Kragen100 aufweist, der sich längs einer Oberfläche des Substrat82 erstreckt. Eine leitende Ringstruktur102 ist auf der entgegengesetzten Seite des Substrats82 angeordnet, und auf einer solchen leitenden Ringstruktur102 befindet sich die Metallisierungskappe92 . Lot104 füllt die Bohrung106 der Auskleidung98 , befindet sich auf der äußeren Oberfläche des radialen Kragens100 der Auskleidung98 und erstreckt sich in Kontakt mit der Metallisierungskappe92 . Die Substrate82 können auf diese Weise vor Beginn der weiteren Fügung eines BGA-Bausteins mit Höckern versehen werden. - Bei der in
9 dargestellten Ausführungsform fehlt die Auskleidung, aber ein radialer Kragen110 ist vorgesehen. In diesem Falle wird die Metallisierungskappe92' in das Substrat82' eingebettet, und wiederum erstreckt sich das Lot112 durch den Durchbruch84' des Substrats82 und in Kontakt mit der Metallisierungskappe92' , und das Lot bildet auf der Seite des Substrat82' gegenüber der Metallisierungskappe92' einen Lothöcker. - Die Lotfüllung und die Höcker von
8 können entsprechend10 und11 gebildet werden, wobei ein Korpus aus erstarrtem Lot120 nahe einem Ende des jeweiligen Durchbruchs84 vorgesehen wird (d.h. nahe einem Ende des Kragens100 der Auskleidung98 ), der dann aufgeschmolzen wird. Der Durchbruch84 und die Bohrung106 der Auskleidung98 sind so klein, daß infolge Kapillarwirkung das aufgeschmolzene Lot in die Bohrung106 und in Kontakt mit der Metallisierungskappe92 gesogen wird. Luftblasen122 bewegen sich in entgegengesetzter Richtung, wenn das Lot die Bohrung106 füllt. In ähnlicher Weise können die Füllung und der Höcker gemäß9 , wo keine Auskleidung vorgesehen ist, durch Aufschmelzen eines erstarrten Lotkorpus123 an einem Ende des Durchbruchs84' gebildet werden, wobei wiederum Kapillarwirkung das aufgeschmolzene Lot direkt in den Durchbruch84' sowie in Kontakt mit der Metallisierungskappe92' saugt (12 und13 ). - Danach werden Leiterspuren und eine Oxidschicht aufgebracht, der Schaltkreischip wird plaziert und mit den bondbaren Metallisierungskappen, die in Kontakt mit dem leitenden Lot in den Durchbrüchen stehen, drahtgebondet. Die Überschichtung kann durch Siebdruck aufgebracht, mit konventionellen Formungsverfahren eingekapselt oder in gewünschter Dicke mit einer entsprechenden haftungsfreien Form aufgegossen werden. Die vorgeformten Höcker sind ausgelegt, um den Aufschmelz-/Beschichtungsbedingungen und -temperaturen standzuhalten. Die Formen können mit Aussparungen für die vorgeformten Höcker konstruiert werden. Die Dielektrikums-, Isolator- und Substratoberflächenmerkmale können so gewählt werden, daß maximale Adhäsion der Gießverbindung an dem Substrat erzielt wird. Nach Anbringen und Anhaften der Beschichtung werden die Substrate vereinzelt, indem zwischen den vorgeformten Höckern hindurch gesägt wird. Die Baugruppe kann vor der Vereinzelung beispielsweise durch Kontakt mit den vorgeformten Höckern getestet werden.
- Man erzielt eine Platzersparnis, da Verbindungen anstatt peripher um das Substrat herum durch das Substrat hindurch zu den Höckern erfolgen.
Claims (5)
- Halbleiterbaustein mit einem Substrat (
82 ), das einen integrierten Schaltkreischip (90 ) trägt, der über Bonddrähte (94 ) mit entsprechenden Lötkugeln elektrisch verbunden ist, die sich auf der dem Schaltkreischip (90 ) abgewandten Seite des Substrats (82 ) befinden, das mit Durchtrittsöffnungen (84 ) versehen ist, die auf der Seite der Lötkugeln mit einem metallischen, mit der zugehörigen Lötkugel verlöteten Kragen (100 ,110 ) versehen und mit dem Lot (104 ,112 ) der Lötkugeln gefüllt sind, dadurch gekennzeichnet, daß die Durchtrittsöffnungen (84 ) auf der den Schaltkreischip (90 ) tragenden Seite des Substrats (82 ) von metallischen, mit dem Lot (104 ,112 ) der jeweiligen Lötkugel verlöteten Kappen (92 ,92' ) abgedeckt sind, wobei die Bonddrähte (94 ) mit den Kappen (92 ,92' ) verlötet sind. - Halbleiterbaustein nach Anspruch 1, dadurch gekennzeichnet, daß die Durchtrittsöffnungen (
84 ) eine leitende Auskleidung (98 ) aufweisen. - Halbleiterbaustein nach Anspruch 1 oder 2, dadurch gekennzeichnet, daß die Kappe (
92' ) im Substrat (82 ) eingebettet ist. - Halbleiterbaustein nach Anspruch 1 oder 2, dadurch gekennzeichnet, daß die Kappe (
92 ) auf einen die Durchtrittsöffnung (84 ) umgebenden metallischen Kragen (102 ) auf der dem Schaltkreischip (90 ) zugewandten Seite des Substrats (82 ) aufgelötet ist. - Halbleiterbaustein nach einem der Ansprüche 1 bis 4, dadurch gekennzeichnet, daß das Substrat (
82 ) aus Keramik oder Triazinbismaleimidharz besteht.
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Application Number | Title | Priority Date | Filing Date |
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Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4830264A (en) * | 1986-10-08 | 1989-05-16 | International Business Machines Corporation | Method of forming solder terminals for a pinless ceramic module |
JPH03262186A (ja) * | 1990-03-13 | 1991-11-21 | Matsushita Electric Ind Co Ltd | 印刷配線基板 |
US5275330A (en) * | 1993-04-12 | 1994-01-04 | International Business Machines Corp. | Solder ball connect pad-on-via assembly process |
EP0702404A2 (de) * | 1994-09-14 | 1996-03-20 | Nec Corporation | Halbleiteranordnung |
-
1997
- 1997-05-13 DE DE19758547A patent/DE19758547B4/de not_active Expired - Fee Related
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4830264A (en) * | 1986-10-08 | 1989-05-16 | International Business Machines Corporation | Method of forming solder terminals for a pinless ceramic module |
JPH03262186A (ja) * | 1990-03-13 | 1991-11-21 | Matsushita Electric Ind Co Ltd | 印刷配線基板 |
US5275330A (en) * | 1993-04-12 | 1994-01-04 | International Business Machines Corp. | Solder ball connect pad-on-via assembly process |
EP0702404A2 (de) * | 1994-09-14 | 1996-03-20 | Nec Corporation | Halbleiteranordnung |
Non-Patent Citations (2)
Title |
---|
"Ball Grid Array Technology", LAU John H., Mc Graw-Hill Verlag 1995, pp.xiii-xvi * |
JP 05144995 A in Patent Abstracts of Japan * |
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