DE102014201166A1 - Verfahren zum Herstellen einer Flip-Chip-Schaltungsanordnung und Flip-Chip-Schaltungsanordnung - Google Patents
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Abstract
Die Erfindung betrifft ein Verfahren zum Herstellen einer Flip-Chip- Schaltungsanordnung (3), mit mindestens folgenden Schritten: Herstellen oder Bereitstellen eines Schaltungsträgers (1) mit einer ersten Oberfläche (4) und darauf aufgebrachten Kontaktierflächen (7) sowie eines Halbleiter- Bauelementes (2) mit einer zweiten Oberfläche (5) und darauf aufgebrachten Kontaktstellen (6) (St0), Aufbringen von ersten Kontaktmitteln (8.1, 8.2) auf die Kontaktierflächen (7) (St1), Aufbringen von den ersten Kontaktmitteln (8.1, 8.2) zugeordneten zweiten Kontaktmitteln (15.1, 15.2) auf die Kontaktstellen (6) (St1.1), Planarisieren der ersten Kontaktmittel (8.1, 8.2) derartig, dass Kontaktoberflächen (10.1, 10.2) der ersten Kontaktmittel (8.1, 8.2) innerhalb einer ersten Toleranz (20) eine gemeinsame erste Kontaktebene (11) definieren (St2), Aufbringen eines Klebemittels (18) auf die ersten Kontaktmittel (8.1, 8.2) und/oder die zweiten Kontaktmittel (15.1, 15.2) (St3), Verpressen des Halbleiter-Bauelementes (2) mit dem Schaltungsträger (1) zum Ausbilden einer elektrischen Verbindung zwischen den ersten und den zweiten Kontaktmitteln (8.1, 8.2, 15.1, 15.2) (St4), und Aushärten des Klebemittels (18) zum Herstellen einer mechanischen Verbindung zwischen Halbleiter-Bauelement (2) und Schaltungsträger (1) (St5).
Description
- Die Erfindung betrifft ein Verfahren zum Herstellen einer Flip-Chip- Schaltungsanordnung und eine entsprechende Flip-Chip-Schaltungsanordnung.
- Stand der Technik
- Bei Flip-Chip-Montagetechniken wird ein beispielsweise monolithisches Halbleiter-Bauelement (Chip, Die) mit seiner aktiven Kontaktierungsseite direkt auf einen Schaltungsträger, z. B. ein Substrat oder eine Leiterplatte, montiert und kontaktiert. Somit werden Kontaktstellen des Halbleiter-Bauelementes ohne Anschlussdrähte (Drahtbonds) mit Kontaktierflächen, z.B. Leiterbahnen, auf dem Schaltungsträger kontaktiert. Hierdurch ist ein geringer Flächenbedarf erreichbar.
- Auf die Kontaktstellen des Halbleiter-Bauelementes werden z.B. aus Gold gebildete Stud-Bumps aufgebracht, wobei der Stud-Bump dem Ballbond aus einem herkömmlichen Ball-Wedge-Verfahren entspricht, und nachfolgend auf die Leiterbahnen des Schaltungsträgers aufgelegt. Dann wird das Halbleiter- Bauelement auf den Schaltungsträger gepresst, so dass unter teilweiser Verformung der Leiterbahnen und der Stud-Bumps eine elektrische Verbindung ausgebildet wird. Bei Flip-Chip-Verfahren mit nicht leitfähigem Klebstoff (NCA, non conductive adhesive) wird vor oder nach dem Verpressen Klebstoff zwischen den Chip und den Schaltungsträger eingebracht, der anschließend ausgehärtet wird.
- Insbesondere im Falle einer unebenen Oberfläche des Schaltungsträgers, die sich auf die Oberflächen der Leiterbahnen überträgt, kann es beim Aufpressen der Stud-Bumps zu unzuverlässigen elektrischen Kontakten kommen, da aufgrund der Unebenheiten lokal unterschiedliche Anpresskräfte wirken. Dadurch können die Leiterbahnen aufgrund ihrer geringen Höhe leicht zerstört bzw. mechanisch verformt und auch der darunterliegende Schaltungsträger plastisch verformt werden. Zudem können einzelne, herausstehende Bereiche zu Beschädigungen oder mechanischen Verspannungen führen.
- Dazu ist in der
WO 02/056345 A2 - Offenbarung der Erfindung
- Erfindungsgemäß ist vorgesehen, einen Schaltungsträger, insbesondere einen spritzgegossenen Schaltungsträger (MID, molded interconnect device), und ein vorzugsweise monolithisches Halbleiter-Bauelement (Chip, DIE) in einem Flip- Chip-Verfahren miteinander zu verbinden und zu kontaktieren, wobei mit dem Schaltungsträger verbundene und planarisierte erste Kontaktmittel gegen auf dem Halbleiter-Bauelement aufgetragene zweite Kontaktmittel verpresst werden und zusätzlich ein beide Kontaktmittel zumindest teilweise umgebendes Klebemittel ausgehärtet wird, um die beiden gegeneinander verpressten Kontaktmittel dauerhaft zu verbinden. Hierdurch wird eine Flip-Chip-Schaltungsanordnung ausgebildet.
- Die ersten und zweiten Kontaktmittel sind dabei vorzugsweise als Goldklumpen bzw. Goldkugeln, sog. Stud-Bumps ausgeführt, die vergleichbar zu den Ballbonds in einem Ball-Wedge-Bonding-Verfahren auf Kontaktstellen auf dem Halbleiter-Bauelement und auf Kontakierflächen, z.B. galvanisierten Leiterbahnen aus einem Galvanikaufbau, z.B. Kupfer, Nickel/Phosphor und Gold, auf dem Schaltungsträger aufgebracht werden.
- Hierdurch können bereits einige Vorteile erreicht werden:
So wird durch die Verwendung von Stud-Bumps auf beiden zu kontaktierenden Elementen erreicht, dass die zwischen dem Schaltungsträger und den Stud- Bumps angeordneten, z.B. als Leiterbahnen dienenden Kontaktierflächen beim Verpressen weniger stark beansprucht werden. Denn durch die auf den Leiterbahnen aufgebrachten Stud-Bumps wird die „Verformungsebene“ beim Verpressen von den Leiterbahnen vorzugsweise nach oben in den Stud-Bump verschoben und somit die wirkenden Flächenlasten von dem Schaltungsträger und den Leiterbahnen nach oben verlegt, so dass beim Verpressen hauptsächlich Kräfte auf die Kontaktoberfläche des Stud-Bumps wirken und nur geringe, durch den Stud-Bump übertragene Kräfte auf die Leiterbahnen. Hierdurch können beispielsweise Spitzen in der Flächenlast, die zu einer Beeinträchtigung des Schaltungsträgers und der Leiterbahnen führen können, stark reduziert und somit eine Verformung der Leiterbahnen und des aus Kunststoff hergestellten Schaltungsträgers vermieden werden; die Zuverlässigkeit der Kontakte wird verbessert. - Weiterhin können durch die Planarisierung der ersten Kontaktmittel Unebenheiten auf der Oberfläche des Schaltungsträgers, die in der Größenordnung von 10–20µm liegen können, ausgeglichen werden. Das hat im Flip-Chip- Herstellungsprozess den Vorteil, dass eine Zerstörung von Kontaktmitteln durch einzelne, weiter abstehende Kontaktmittel beim Verpressen verhindert werden kann.
- Unter Planarisieren oder auch Einebnen wird hierbei im Rahmen der Erfindung verstanden, dass Kontaktoberflächen der ersten Kontaktmittel zumindest teilweise angeglichen werden, d.h. innerhalb einer Toleranz in einer ersten Kontaktebene liegen. Dies kann beispielsweise mechanisch, z.B. durch einen auf die Kontaktoberflächen aufgesetzten Stempel, oder aber durch Materialabtragung, z.B. durch Laserablation, gewährleistet werden. Es sind aber auch andere Verfahren denkbar, die die Kontaktoberflächen in eine Ebene bzw. Kontaktebene verschieben. Beim Einebnen wird vorzugsweise auch die Fläche der Kontaktoberflächen geringfügig vergrößert, da beim Einebnen das Kontaktmaterial teilweise auch zur Seite weggedrückt wird. Die Toleranzen sind dabei insbesondere fertigungsbedingte Toleranzen, z.B. aufgrund der Rauigkeit des Stempels oder weiterer, im Planarisierungsprozess auftretender Prozessungenauigkeiten, die im Bereich von einigen hundert Nanometern liegen können.
- Im Gegensatz zu dem in der
WO 02/056345 A2 - Hierdurch kann vorteilhafterweise der Herstellungsaufwand gering gehalten werden, da bei der Herstellung kein zusätzlicher Verfahrensschritt, wie z.B. die Behandlung mit Ultraschall, nötig ist. Zudem kann durch das Weglassen der Ultraschallbehandlung eine zusätzliche Beanspruchung der Kontaktmittel und der gesamten Flip-Chip-Schaltungsanordnung vermieden werden.
- Das Klebemittel wird bevorzugt vor dem Verpressen so auf den Schaltungsträger aufgebracht, dass das Klebemittel die ersten Kontaktmittel und auch die Kontaktoberflächen vorzugsweise vollständig bedeckt, wobei das Klebemittel auch auf den unmittelbar angrenzenden Kontaktierflächen (Leiterbahnen) verteilt sein kann. Die Menge des Klebemittels wird dabei beispielsweise so gewählt, dass das Klebemittel nach dem Verpressen der beiden Kontaktmittel den Zwischenraum zwischen dem Schaltungsträger und dem Halbleiter-Bauelement vollständig ausfüllt, d.h. an den Oberflächen des Schaltungsträgers und des Halbleiber- Bauelementes im Wesentlichen vollständig anliegt, um die Stabilität der mechanischen Verbindung beider Elemente nach dem Aushärten zu erhöhen. Der mechanische Zusammenhalt wird hierbei vorzugsweise lediglich dadurch erreicht, dass das Klebemittel das Halbleiter-Bauelement mit dem Schaltungsträger verbindet bzw. verklebt und somit die Kontaktmittel aneinandergehalten werden. Grundsätzlich ist es auch möglich, das Klebemittel zusätzlich oder stattdessen auf die Oberfläche des Halbleiter-Bauelementes aufzubringen.
- Anschließend werden die zweiten Kontaktmittel des Halbleiter-Bauelementes, die innerhalb einer fertigungsbedingten Toleranz eine zweite Kontaktebene bilden, relativ zu den ersten Kontaktmitteln ausgerichtet und aneinander angenähert, bis sich diese berühren, wobei die erste und die zweite Kontaktebene parallel zueinander liegen. Daraufhin werden die zweiten Kontaktmittel auf die ersten Kontaktmittel aufgedrückt, so dass das Klebemittel zur Seite verdrängt wird uns sich seitlich um die Kontaktmittel, auch im Bereich der Kontaktoberflächen legt. Die Kontaktoberflächen beider Kontaktmittel stehen somit in elektrischem Kontakt zueinander, d.h. das Klebemittel wurde nahezu vollständig aus dem Zwischenraum zwischen den Kontaktoberflächen verdrängt.
- Das Klebemittel ist dabei beispielsweise ein elektrisch nicht leitender Kleber (NCA, non conductive adhesive), um vorteilhafterweise zu verhindern, dass über das Klebemittel nebeneinanderliegende Kontaktierflächen und Stud-Bumps elektrisch miteinander verbunden werden. Es ist auch denkbar, zusätzlich ein leitendes Klebemittel, z.B. Silberleitkleber, zu verwenden, das beispielsweise lediglich lokal im Bereich der Kontaktoberflächen aufgetragen wird, vorzugsweise bevor das nicht leitende Klebemittel aufgebracht wird. Beim Verpressen wird zunächst das nicht leitende Klebemittel verdrängt bis beide Kontaktmittel das leitende Klebemittel berühren und dieses ebenfalls verdrängen, wobei das leitende Klebemittel dann zumindest teilweise auch im Zwischenraum zwischen den Kontaktoberflächen verbleiben kann, um beispielsweise geringe Toleranzen auszugleichen. Zudem kann der elektrische Übergang verbessert werden, da Einschlüsse von nicht leitendem Klebemittel zwischen den Kontaktoberflächen verringert bzw. vermieden werden können.
- Zum Aushärten des Klebemittels wird dieses vorzugsweise erhitzt. Dazu wird je nach Klebemittel eine Temperatur von ca. 250° eingestellt. Unterstützend werden durch die Temperaturerhöhung auch die Kontaktmittel erwärmt, wodurch diese weicher und somit leichter verformbar werden. Eine Diffusion von Kontaktmaterial, d.h. ein Zusammenschweißen der Kontaktmittel, wird dadurch vorzugsweise nicht erreicht.
- Durch die Erwärmung der Kontaktmittel kann vorteilhafterweise auch eine Anpassung der unterschiedlich geformten Kontaktoberflächen aneinander erreicht werden. Beim Verpressen werden hierbei z.B. einzelne, herausstehende Bereiche der einen Kontaktoberfläche mechanisch so verformt, dass sie an die dieser gegenüberliegenden Kontaktoberfläche angeglichen werden und somit der elektrische Übergang verbessert wird.
- Die Herstellungsschritte können dabei variieren. So ist das Aufbringen der zweiten Kontaktmittel beispielsweise unabhängig von dem Aufbringen und dem Planarisieren der ersten Kontaktmittel, kann also zeitlich davor oder danach geschehen.
- Kurze Beschreibung der Zeichnungen
-
1 zeigt eine schematische Ansicht eines Schaltungsträgers und eines Halbleiter-Bauelementes vor dem Kontaktieren, -
2 den Schaltungsträger gemäß1 mit aufgebrachten Kontaktierflächen, -
3 den Schaltungsträger gemäß2 mit auf die Kontaktierflächen aufgebrachten ersten Kontaktmitteln, -
4 den Schritt des Planarisierens der ersten Kontaktmittel, -
5 eine Flip-Chip-Schaltungsanordnung vor dem Kontaktieren, -
6 eine kontaktierte Flip-Chip-Schaltungsanordnung, und -
7 ein Flussdiagramm des erfindungsgemäßen Verfahrens. - Beschreibung der Ausführungsformen
- Zur Ausbildung einer in der
6 gezeigten Flip-Chip-Schaltungsanordnung3 werden zunächst gemäß1 ein Schaltungsträger1 , z. B. eine Leiterplatte, insbesondere ein spritzgegossener Schaltungsträger (MID, molded interconnect device), und ein monolithisches Halbleiter-Bauelement2 bzw. Chip oder Die bereitgestellt. Der Schaltungsträger1 ist aus einem nichtleitenden Material, vorzugsweise Kunststoff, gefertigt und weist eine unebene Oberfläche4 auf, wobei die Unebenheiten bei der Herstellung und durch eine zusätzliche Oberflächenbehandlung (Laserbehandlung) entstehen können. Der Chip2 weist eine Oberfläche5 auf, auf der mehrere voneinander isolierte Kontaktstellen6 , z.B. Kontaktpads, angeordnet sind, die z.B. mit einem integrierten Schaltkreis im Chip2 verbunden sind. - Zum Verbinden des Schaltungsträgers
1 mit dem Chip2 ist zunächst vorgesehen, Kontaktierflächen7 , z.B. Leiterbahnen und/oder Kontaktpads, auf den Schaltungsträger1 aufzubringen oder ein Schaltungsträger1 mit bereits prozessierten Kontaktierflächen7 bereitzustellen. Dazu wird gemäß2 auf die oberflächenbehandelte Oberfläche4 eine leitfähige Schicht, z.B. aus einem entsprechenden Galvanikaufbau aus Kupfer, Nickel/Phosphor und Gold, aufgebracht, z.B. in einem Galvanisierungsprozess, so dass möglichst defektfreie Kontaktierflächen7 ausgebildet werden. Die Kontaktierflächen7 bilden dabei einen Schaltplan, der sich auf der Oberfläche4 im Wesentlichen in der x- und y-Richtung erstreckt, wobei die y-Richtung in den Figuren senkrecht zur Zeichenebene ausgerichtet ist. Die Höhe, d.h. die Ausdehnung in z-Richtung, der über die Oberfläche4 verteilten Kontaktierflächen7 ist in etwa identisch und beträgt ca. 10 bis 20µm. - Aufgrund der Unebenheiten des Schaltungsträgers
1 sind die Kontaktierflächen7 in z-Richtung zueinander versetzt, d.h. die relativen Positionen in z-Richtung variieren; die Unebenheiten auf der Oberfläche4 werden somit auch auf die Kontaktierflächen7 übertragen. - Um diese Versetzung auszugleichen, ist im erfindungsgemäßen Verfahren insbesondere vorgesehen, erste Kontaktmittel
8.1 ,8.2 auf die Kontaktierflächen7 aufzubringen (St1). Die ersten Kontaktmittel8.1 ,8.2 sind dabei als sog. Stud Bumps ausgeführt. Diese werden in einem Bond-Verfahren, das beispielsweise Teil des herkömmlichen Ball-Wedge-Bondens ist, auf die Kontaktierflächen7 aufgebracht. - Dazu wird eine Spitze eines Ball-Wedge-Bonders über die Kontaktierflächen
7 gebracht und anschließend ein aus der Spitze hinausragender Golddraht erhitzt, so dass das Gold schmilzt und durch die Oberflächenspannung eine Kugel (Ball) gebildet wird. Diese Kugel wird mit einem kurzen Ultraschallpuls auf die Kontaktierflächen7 angedrückt bzw. gebondet, so dass eine elektrische Verbindung zwischen Kontaktierflächen7 und Kugel entsteht. Anschließend wird der Golddraht knapp oberhalb der Kugel abgeschert. Die Kugel und der abgescherte Golddraht bilden den Stud-Bump, das erste Kontaktmittel8.1 ,8.2 . Eine Höhe9.1 ,9.2 der Stud-Bumps beträgt dabei in etwa 50µm und kann eine fertigungsbedingte Toleranz von ca. 1–2µm aufweisen. - Nach dem Aufbringen der ersten Kontaktmittel
8.1 ,8.2 sind diese weiterhin in z-Richtung zueinander versetzt, da die Unebenheiten der Oberfläche4 über die Kontaktierflächen7 auch auf die Stud-Bumps8.1 ,8.2 übertragen werden, wie insbesondere in3 zu sehen ist. Die fertigungsbedinge Toleranz der Stud-Bumps kann weitestgehend unberücksichtigt bleiben, da diese gegenüber den Unebenheiten auf der Oberfläche4 , die im Bereich von 10–20µm liegen können, vernachlässigbar ist. - Um diese Unebenheiten auszugleichen, werden die ersten Kontaktmittel
8.1 ,8.2 in einem folgenden Schritt St2 planarisiert, d.h. deren Höhen9.1 ,9.2 werden so angepasst, dass Kontaktoberflächen10.1 ,10.2 aller ersten Kontaktmittel8.1 ,8.2 mit einer ersten Toleranz20 in einer gemeinsamen ersten Kontaktebene11 liegen, die gemäß4 in der x-y-Richtung ausgedehnt ist. - Zum Planarisieren wird dabei gemäß dieser Ausführung ein Stempel
12 mit einer ebenen Unterseite13 verwendet, der über den gesamten Schaltungsträger1 ausgedehnt ist oder beim Auflegen auf diesen zumindest einen Bereich abdeckt, in dem die zu planarisierenden ersten Kontaktmittel8.1 ,8.2 auf dem Schaltungsträger1 angeordnet sind. Die Position des Stempels12 bzw. der Unterseite13 kann in allen drei Raumrichtungen z.B. von einem über eine Steuereinrichtung12.1 gesteuerten Verstellmotor12.2 eingestellt werden. - Der Stempel
12 wird dazu vom Verstellmotor12.2 von oben an die ersten Kontaktmittel8.1 ,8.2 angenähert und so ausgerichtet, dass die Unterseite13 parallel zu der vorher festgelegten ersten Kontaktebene11 liegt. Anschließend wird die Unterseite13 so weit nach unten verfahren, bis diese einzelne, abstehende erste Kontaktmittel8.1 ,8.2 bzw. deren Kontaktoberflächen10.1 ,10.2 berührt. Daraufhin wird der Stempel12 mit einer gleichmäßigen Kraft in eine Verpressrichtung R auf die Kontaktoberflächen10.1 ,10.2 aufgedrückt, so dass die ersten Kontaktmittel8.1 ,8.2 mechanisch verformt werden, wodurch sich deren Höhen9.1 ,9.2 verringern und die Kontaktoberflächen10.1 ,10.2 jedes Kontaktmittels8.1 ,8.2 eingeebnet werden und somit deren Flächen geringfügig vergrößert werden. Der Stempel12 wird in etwa so weit aufgedrückt, bis die Unterseite13 auf allen Kontaktmitteln8.1 ,8.2 aufliegt und somit auch das am nächsten an der Oberfläche4 liegende Kontaktmittel8.1 ,8.2 berührt. Insgesamt wird der Stempel12 so stark in die Verpressrichtung R verstellt, bis alle Kontaktoberflächen10.1 ,10.2 innerhalb einer fertigungsbedingten ersten Toleranz20 in der ersten Kontaktebene11 liegen und weiterhin jede Kontaktoberfläche10.1 ,10.2 eingeebnet ist. - Durch die Planarisierung wird somit eine erste Kontaktebene
11 geschaffen, auf die auf dem Halbleiter-Bauelement2 angeordnete zweite Kontaktmittel15.1 ,15.2 aufgebracht werden können. Die zweiten Kontaktmittel15.1 ,15.2 sind dabei gemäß5 ebenfalls als Stud-Bumps ausgeführt, die auf die Kontaktstellen6 aufgebracht werden, z.B. in einem Schritt St1.1 zusammen mit dem Aufbringen der Stud-Bumps auf die Kontaktierflächen7 . Die zweiten Kontaktmittel15.1 ,15.2 definieren mit ihren Kontaktoberflächen16.1 ,16.2 eine zweite Kontaktebene17 , die fertigungsbedingt mit einer zweiten Toleranz21 von 1–2 µm behaftet sein kann. - Vor dem Aufbringen der zweiten Kontaktmittel
15.1 ,15.2 auf die ersten Kontaktmittel8.1 ,8.2 wird in einem Schritt St3 ein Klebemittel18 , z.B. ein elektrisch nicht leitender Epoxy-Kleber (NCA, non-conductive adhesive), auf die Oberfläche4 des Schaltungsträgers1 so aufgebracht, dass die ersten Kontaktmittel8.1 ,8.2 und auch die umliegenden Bereiche vollständig bedeckt sind, so wie insbesondere in5 dargestellt. Zusätzlich kann vor dem Aufbringen des nicht leitenden Klebemittels18 ein leitendes Klebemittel18.1 lokal auf die Kontaktoberflächen10.1 ,10.2 aufgetragen werden, ohne dass dadurch zwei benachbarte erste Kontaktmittel8.1 ,8.2 miteinander kontaktiert werden. Anschließend wird das Halbleiter-Bauelement2 gegenüber dem Schaltungsträger1 so ausgerichtet, dass die den ersten Kontaktmitteln8.1 ,8.2 zugeordneten zweiten Kontaktmittel15.1 ,15.2 übereinander positioniert sind und die Ebenen11 und17 parallel zueinander liegen. Daraufhin wird in einem Schritt St4 das Halbleiter-Bauelement2 an den Schaltungsträger1 angenähert, bis die zweiten Kontaktmittel15.1 ,15.2 die ersten Kontaktmittel8.1 ,8.2 berühren, und so gegeneinander verpresst, dass das Klebemittel18 zur Seite verdrängt wird und sich um beide Kontaktmittel8.1 ,8.2 ,15.1 ,15.2 legt und diese bevorzugt vollständig umschließt. Hierbei wird der Zwischenraum zwischen dem Schaltungsträger1 und dem Halbleiber-Bauelement2 vorzugsweise vollständig mit dem Klebemittel18 ausfüllt, wie in6 gezeigt. Das leitende Klebemittel18.1 wird ebenfalls zur Seite verdrängt, verbleibt aber zumindest teilweise im Zwischenraum zwischen den Kontaktoberflächen10.1 ,10.2 ,16.1 ,16.2 . - Um die beiden Kontaktmittel
8.1 ,8.2 ,15.1 ,15.2 dauerhaft miteinander zu verbinden, wird das Klebemittel18 in einem folgenden Schritt St5 ausgehärtet; dabei kann sich das Klebemittel18 geringfügig zusammenziehen, so dass das Halbleiter-Bauelement2 an den Schaltungsträger1 gezogen wird. Das Klebemittel18 sorgt somit dafür, dass die beiden Kontaktmittel8.1 ,8.2 ,15.1 ,15.2 zusammengehalten werden. Der mechanische Zusammenhalt wird somit vorzugsweise hauptsächlich durch das Klebemittel18 erreicht, das das Halbleiter-Bauelement2 an dem Schaltungsträger1 hält. Zum Aushärten wird zumindest der Bereich um die Kontaktoberflächen8.1 ,8.2 ,15.1 ,15.2 erhitzt, wobei die Temperatur je nach Klebemittel18 auf bis zu 250° eingestellt wird. - Durch das Erhitzen werden unterstützend auch die Kontaktoberflächen
10.1 ,10.2 ,16.1 ,16.2 weicher, so dass sich diese beim Verpressen durch mechanische Verformung aneinander anpassen können, d.h. kleine Unebenheiten in den Kontaktoberflächen10.1 ,10.2 ,16.1 ,16.2 . und fertigungsbedingte Toleranzen können zusätzlich ausgeglichen werden. Nach dem Aushärten des Klebemittels18 ist die Flip-Chip-Schaltungsanordnung3 gemäß6 fertiggestellt. - ZITATE ENTHALTEN IN DER BESCHREIBUNG
- Diese Liste der vom Anmelder aufgeführten Dokumente wurde automatisiert erzeugt und ist ausschließlich zur besseren Information des Lesers aufgenommen. Die Liste ist nicht Bestandteil der deutschen Patent- bzw. Gebrauchsmusteranmeldung. Das DPMA übernimmt keinerlei Haftung für etwaige Fehler oder Auslassungen.
- Zitierte Patentliteratur
-
- WO 02056345 A2 [0005, 0011]
Claims (16)
- Verfahren zum Herstellen einer Flip-Chip-Schaltungsanordnung (
3 ), mit mindestens folgenden Schritten: Herstellen oder Bereitstellen eines Schaltungsträgers (1 ) mit einer ersten Oberfläche (4 ) und darauf aufgebrachten Kontaktierflächen (7 ) sowie eines Halbleiter-Bauelementes (2 ) mit einer zweiten Oberfläche (5 ) und darauf aufgebrachten Kontaktstellen (6 ) (St0), Aufbringen von ersten Kontaktmitteln (8.1 ,8.2 ) auf die Kontaktierflächen (7 ) (St1), Aufbringen von den ersten Kontaktmitteln (8.1 ,8.2 ) zugeordneten zweiten Kontaktmitteln (15.1 ,15.2 ) auf die Kontaktstellen (6 ) (St1.1), Planarisieren der ersten Kontaktmittel (8.1 ,8.2 ) derartig, dass Kontaktoberflächen (10.1 ,10.2 ) der ersten Kontaktmittel (8.1 ,8.2 ) innerhalb einer ersten Toleranz (20 ) eine gemeinsame erste Kontaktebene (11 ) definieren (St2), Aufbringen eines Klebemittels (18 ) auf die ersten Kontaktmittel (8.1 ,8.2 ) und/oder die zweiten Kontaktmittel (15.1 ,15.2 ) (St3), Verpressen des Halbleiter-Bauelementes (2 ) mit dem Schaltungsträger (1 ) zum Ausbilden einer elektrischen Verbindung zwischen den ersten und den zweiten Kontaktmitteln (8.1 ,8.2 ,15.1 ,15.2 ) (St4), und Aushärten des Klebemittels (18 ) zum Herstellen einer mechanischen Verbindung zwischen Halbleiter-Bauelement (2 ) und Schaltungsträger (1 ) (St5). - Verfahren nach Anspruch 1, dadurch gekennzeichnet, dass die zweiten Kontaktmittel (
15.1 ,15.2 ) vor dem Verpressen an den diesen zugeordneten ersten Kontaktmitteln (8.1 ,8.2 ) ausgerichtet werden. - Verfahren nach Anspruch 2, dadurch gekennzeichnet, dass die erste Kontaktebene (
11 ) beim Ausrichten in etwa parallel zu einer von den Kontaktoberflächen (16.1 ,16.2 ) der zweiten Kontaktmittel (15.1 ,15.2 ) innerhalb einer zweiten Toleranz (21 ) definierten zweiten Kontaktebene (17 ) eingestellt wird. - Verfahren nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass das Klebemittel (
18 ) so auf den Schaltungsträger (1 ) aufgetragen wird, dass die ersten und/oder zweiten Kontaktmittel (8.1 ,8.2 ,15.1 ,15.2 ) vollständig bedeckt sind und das Klebemittel (18 ) nach dem Verpressen an der ersten Oberfläche (4 ) und der zweiten Oberfläche (5 ) anliegt. - Verfahren nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass das Klebemittel (
18 ) ein elektrisch nicht leitender Kleber ist und das Halbleiter-Bauelement (2 ) mit dem Schaltungsträger (1 ) so verpresst wird, dass das Klebemittel (18 ) aus einem Zwischenraum zwischen den Kontaktoberflächen (10.1 ,10.2 ) der ersten Kontaktmittel (8.1 ,8.2 ) und Kontaktoberflächen (16.1 ,16.2 ) der zweiten Kontaktmittel (15.1 ,15.2 ) zumindest teilweise verdrängt wird. - Verfahren nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass vor dem Aufbringen des Klebemittels (
18 ) zusätzlich ein leitendes Klebemittel (18.1 ) lokal auf die Kontaktoberflächen (10.1 ,10.2 ) der ersten Kontaktmittel (8.1 ,8.2 ) und/oder Kontaktoberflächen (16.1 ,16.2 ) der zweiten Kontaktmittel (8.1 ,8.2 ) aufgebracht wird. - Verfahren nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass das Klebemittel (
18 ) zum Aushärten erhitzt wird. - Verfahren nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass der Schritt des Planarisierens mechanisch durchgeführt wird.
- Verfahren nach Anspruch 8, dadurch gekennzeichnet, dass das Planarisieren mit einem Stempel (
12 ) mit einer ebenen Unterseite (12 ) durchgeführt wird, wobei der Stempel (12 ) an die Kontaktoberflächen (10.1 ,10.2 ) der ersten Kontaktmittel (8.1 ,8.2 ) angenähert und anschließend mit konstanter Kraft so in eine Verpressrichtung (R) verfahren wird, dass sich die ersten Kontaktmittel (8.1 ,8.2 ) verformen. - Verfahren nach einem der vorhergehenden Ansprüche, dadurch ge- kennzeichnet, dass die ersten und/oder zweiten Kontaktmittel (
8.1 ,8.2 ,15.1 ,15.2 ) durch Ball-Bonding aufgebracht werden zum Ausbilden von Stud-Bumps. - Verfahren nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass als Schaltungsträger (
1 ) ein spritzgegossener Schaltungsträger aus Kunststoff, z.B. ein MID (molded interconnect device), und als Halbleiter-Bauelement (2 ) ein monolithisches Bauelement verwendet werden. - Flip-Chip-Schaltungsanordnung (
3 ), mindestens aufweisend: einen Schaltungsträger (1 ) mit mehreren Kontaktierflächen (7 ), auf denen erste Kontaktmittel (8.1 ,8.2 ) aufgetragen sind, ein Halbleiter-Bauelement (2 ) mit Kontaktstellen (6 ), auf denen jeweils zweite Kontaktmittel (15.1 ,15.2 ) aufgetragen sind, wobei die ersten Kontaktmittel (8.1 ,8.2 ) Kontaktoberflächen (10.1 ,10.2 ) aufweisen, die innerhalb einer ersten Toleranz (20 ) in einer ersten Kontaktebene (11 ) liegen und die mit den zweiten Kontaktmitteln (15.1 ,15.2 ) kontaktiert sind, wobei die ersten Kontaktmittel (8.1 ,8.2 ) und die zweiten Kontaktmittel (8.1 ,8.2 ) durch ein zumindest die ersten und die zweiten Kontaktmittel (8.1 ,8.2 ,15.1 ,15.2 ) umgebendes Klebemittel (18 ) mechanisch miteinander verbunden sind. - Flip-Chip-Schaltungsanordnung (
3 ) nach Anspruch 12, dadurch gekennzeichnet, dass die ersten und die zweiten Kontaktmittel (8.1 ,8.2 ,15.1 ,15.2 ) lediglich durch das Klebemittel (18 ) mechanisch miteinander verbunden sind, wobei das Klebemittel (18 ) an einer ersten Oberfläche (4 ) des Schaltungsträgers (1 ) und an einer zweiten Oberfläche (5 ) des Halbleiter-Bauelements (2 ) anliegt. - Flip-Chip-Schaltungsanordnung (
3 ) nach Anspruch 12 oder 13, dadurch gekennzeichnet, dass der Schaltungsträger (1 ) ein spritzgegossener Schaltungsträger aus Kunststoff, z.B. ein MID (molded interconnect device), ist. - Flip-Chip-Schaltungsanordnung (
3 ) nach einem der Ansprüche 12 bis 14, dadurch gekennzeichnet, dass die ersten und/oder die zweiten Kontaktmittel (8.1 ,8.2 ,15.1 ,15.2 ) Stud-Bumps sind. - Flip-Chip-Schaltungsanordnung (
3 ) nach einem der Ansprüche 12 bis 15, dadurch gekennzeichnet, dass das Klebemittel (18 ) ein elektrisch nicht-leitender Kleber ist, und im Bereich der Kontaktoberflächen (10.1 ,10.2 ,16.1 ,16.2 ) zusätzlich ein leitendes Klebemittel (18.1 ) angeordnet ist.
Priority Applications (2)
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Citations (1)
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---|---|---|---|---|
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CN1312741C (zh) * | 2003-01-21 | 2007-04-25 | 颀邦科技股份有限公司 | 消除晶片及芯片上金属凸块的高度差异的方法 |
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---|---|---|---|---|
WO2002056345A2 (en) | 2001-01-15 | 2002-07-18 | Teledyne Technologies, Incorporated | Flip chip package semiconductor device having double stud bumps and method of forming same |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE102020114669A1 (de) | 2020-06-02 | 2021-12-02 | OSRAM Opto Semiconductors Gesellschaft mit beschränkter Haftung | Elektrische vorrichtung |
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