DE10109542B4 - Anordung zur Verbindung eines auf einer Leiterplatte angebrachten Bauelementes mit einer flexiblen Schichtanordnung - Google Patents
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Abstract
Anordnung zur elektrischen Verbindung eines auf einer Leiterplatte angebrachten Bauelementes (4) mit einer flexiblen Schichtanordnung(2),
– wobei in der Schichtanordnung (2) umgeben von elektrisch isolierenden Schichten (11) mindestens eine elektrisch leitfähige Schicht mit einer Vielzahl nebeneinander liegender Leiterbahnen (6) aufgenommen ist,
– wobei die flexible Schichtanordnung (2) zur Ausbildung eines festen Abschnitts (1) mit mindestens einer das Bauelement (4) aufweisenden Leiterplatte (8) fest verbunden ist, und
– wobei zur Kontaktierung der Leiterbahnen (6) im Bereich des festen Abschnitts (1) eine die Leiterplatte (8) durchgreifende, bis zu den Leiterbahnen (6) reichende Ausnehmung (5) vorgesehen ist.
– wobei in der Schichtanordnung (2) umgeben von elektrisch isolierenden Schichten (11) mindestens eine elektrisch leitfähige Schicht mit einer Vielzahl nebeneinander liegender Leiterbahnen (6) aufgenommen ist,
– wobei die flexible Schichtanordnung (2) zur Ausbildung eines festen Abschnitts (1) mit mindestens einer das Bauelement (4) aufweisenden Leiterplatte (8) fest verbunden ist, und
– wobei zur Kontaktierung der Leiterbahnen (6) im Bereich des festen Abschnitts (1) eine die Leiterplatte (8) durchgreifende, bis zu den Leiterbahnen (6) reichende Ausnehmung (5) vorgesehen ist.
Description
- Die Erfindung betrifft eine Anordnung zur Verbindung eines auf einer Leiterplatte angebrachten Bauelementes mit einer flexiblen Schichtanordnung, die insbesondere zur Verbindung eines Detektormoduls eines Röntgen-Computertomographen mit einer nachgeschalteten Auswertelektronik geeignet ist.
- Eine solche Anordnung ist aus der
DE 196 17 055 C1 bekannt. Die bekannte Anordnung eignet sich nicht zur Herstellung einer Vielzahl von Kontakten auf engstem Raum. Das herkömmliche bonding-Verfahren zur Kontaktierung kann bei einer derartigen Anordnung nicht verwendet werden. - Nach dem Stand der Technik sind Anordnungen bekannt, bei denen zwei feste Abschnitte über einen flexiblen Abschnitt beweglich miteinander verbunden sind. Solche Anordnungen werden z.B. zum Aufbau von Detektormodulen für Röntgen-Computertomographen verwendet. Dabei ist auf dem einen festen Abschnitt ein Photodiodenarray aufgenommen. Die einzelnen Photodioden des Photodiodenarrays sind über im flexiblen Abschnitt aufgenommene Leiterbahnen mit einem auf dem anderen festen Abschnitt montierten Stecker verbunden. Der Stecker wiederum dient zum Anschluss des Detektormoduls an eine nachgeschaltete digitalisierende Elektronik.
- Der flexible Abschnitt besteht üblicherweise aus einer Mehrzahl an Schichten. Dabei besteht zumindest eine der Schichten aus einer Vielzahl nebeneinander liegender Leiterbahnen, welche mit einer elektrisch isolierenden Schicht umgehen sind. Diese Schicht kann nach Art einer Sandwichstruktur beidseitig mit elektrisch leitenden Abschirmschichten überdeckt sein, welche wiederum von einer elektrisch isolierenden Schicht umgeben sind. Zur Bildung der festen Abschnitte ist der vor beschriebene flexible Schichtaufbau durch an dessen Ober- und/oder Unterseite aufgeklebte Leiterplatten versteift. Auf den Leiterplatten sind die jeweiligen Bauelemente montiert. Deren Anschlüsse sind mittels die Leiterplatten durchdringenden Durchkontaktierungen mit den Leiterbahnen verbunden. Wegen der relativ geringen Breite der festen Abschnitte ist es zur Schaffung einer geeigneten flächigen Anordnung der Durchkontaktierungen bereits bei einem 16 Photodiodenaufweisenden Photodiodenarray erforderlich, eine relativ langgestreckte Leiterbahnstruktur auf der Leiterplatte aufzubringen. Das Vorsehen einer solchen langgestreckten Leiterbahnenstruktur ist der Abschirmung abträglich.
- Detektormodule für moderne Röntgen-Computertomographen mit mehrzeiligen Detektoren benötigen Photodiodenarrays mit z.B. 16 × 16 Photodioden. Die Herstellung der 16-fachen Anzahl herkömmlicher Durchkontaktierungen würde zumindest das 16-fache der für die Verbindung der Durchkontaktierungen mit den Anschlüssen notwendigen Fläche für die Leiterbahnstruktur erfordern. Eine vorgegebene Baugröße für das Detektormodul könnte nicht mehr eingehalten werden. Außerdem führt eine derartig große Fläche einer die Durchkontaktierung ermöglichenden Leiterbahnstruktur zu erheblichen Abschirmungsproblemen.
- Die
DE 36 06 621 A1 beschreibt eine Anordnung, welche aus einer Schichtabfolge von elektrisch isolierenden und elektrisch leitfähigen Schichten gebildet ist. - Aus der WO 83/03943 A1 ist ein Verfahren zur Herstellung einer Leiterplattenanordnung zur Herstellung von "bubble memories" beschrieben. Dabei ist auf einem festen Substrat eine aus isolierenden und leitfähigen Schichten bestehende Schichtanordnung angebracht. Eine Kontaktierung durchgreift die Schichtanordnung und reicht bis zur Oberfläche der Leiterplatte. Eine Vielzahl von Kontakten kann mit dem bekannten Verfahren nicht auf engstem Raum erzielt werden.
- Die WO 00/79845 A1 betrifft eine Multilayer-Schaltung, die aus einer Vielzahl übereinander gestapelter Chips besteht. Innerhalb der Multilayer-Schaltung ist eine Ausnehmung vorgesehen, in welcher die Kontaktierung der Chips untereinander sich befindet.
- Die
DE 35 02 744 C2 betrifft eine flexible Leiterplatte mit Bereichen unterschiedlicher Flexibilität, wobei ein Bereich geringerer Flexibilität dadurch entsteht, dass in diesem Bereich die elektrisch leitende Schicht fehlt. Zwischen Bereichen geringer und hoher Flexibilität liegt ein Übergangsbereich, in dem die Dicke der elektrisch leitenden Schicht kontinuierlich abnimmt. - Aufgabe der Erfindung ist es, die Nachteile nach dem Stand der Technik zu beseitigen. Es soll insbesondere eine Anordnung zur Verbindung eines auf einer Leiterplatte angebrachten Bauelementes mit einer flexiblen Schichtanordnung angegeben werden, mit der eine große Zahl von in einem flexiblen Abschnitt aufgenommenen Leiterbahnen auf einer möglichst kleinen Fläche kontaktiert werden kann.
- Diese Aufgabe wird durch die Merkmale des Anspruchs 1 gelöst. Zweckmäßige Ausgestaltungen ergeben sich aus den Merkmalen der Ansprüche 2 bis 11.
- Nach der Erfindung wird diese Aufgabe durch die Merkmale des kennzeichnenden teils des Patentandspruches
1 gelöst. – Das Vorsehen einer bis zu den Leiterbahnen reichenden Ausnehmung ermöglicht eine unmittelbare Kontaktierung des Bauelements mit den Leiterbahnen. Die Kontaktierung kann z.B. mittels herkömmlicher bonding-Technik erfolgen. Damit wird in vorteilhafter Weise erreicht, dass eine Vielzahl an Leiterbahnen auf einer relativ kleinen Fläche kontaktierbar ist. Die bei der Herstellung einer großen Anzahl herkömmlicher Durchkon taktierungen entstehenden Abschirmungsprobleme werden vermieden. - Nachfolgend wird ein Ausführungsbeispiel der Erfindung anhand der Zeichnung näher erläutert. Hierin zeigen:
-
1 eine Draufsicht auf eine erfindungsgemäße Anordnung zur Verbindung eines auf einer Leiterplatte angebrachten Bauelementes mit einer flexiblen Schichtanordnung, -
2 eine Teilquerschnittsansicht nach1 und -
3 eine Teilquerschnittsansicht einer weiteren erfindungsgemäß Anordnung zur Verbindung eines auf einer Leiterplatte angebrachten Bauelementes mit einer flexiblen Schichtanordnung. -
1 zeigt eine Draufsicht auf eine erfindungsgemäße Anordnung. Ein erster fester Abschnitt1 ist mittels einer flexiblen Schichtanordnung2 mit einem zweiten festen Abschnitt3 beweglich verbunden. Auf dem ersten festen Abschnitt1 ist ein aus 16 × 16 Photodioden gebildetes Photodiodenarray4 aufgenommen. Der erste 1 und der zweite feste Abschnitt3 sind durch Aufkleben einer herkömmlichen Leiterplatte auf die flexible Schichtanordnung2 gebildet. Eine im ersten festen Abschnitt1 vorgesehene Rusnehmung5 durchgreift die Leiterplatte und reicht bis in die flexible Schichtanordnung, und zwar bis zu einer darin aus einer Vielzahl nebeneinander liegender Leiterbahnen6 gebildeten Schicht. Die Leiterbahnen6 reichen bis zum zweiten festen Abschnitt3 . Dort ist auf einer weiteren Leiterplatte ein Stecker7 montiert. Die Kontakte des Steckers7 sind mittels herkömmlicher Durchkontaktierungen mit den Leiterbahnen6 verbunden (hier nicht gezeigt). Es ist aber auch möglich, die Kontakte des Steckers7 mittels einer weiteren Ausnehmung unmittelbar mit den Leiterbahnen6 zu kontaktieren. -
2 zeigt eine Teilquerschnittsansicht der Anordnung nach1 . Die flexible Schichtanordnung2 weist eine aus mehreren aus nebeneinander liegenden Leiterbahnen6 gebildete Schicht auf. Diese Schicht ist durch Zwischenschaltung bzw. Umgeben mit elektrisch isolierenden Schichten11 gegenüber der Umgebung elektrisch isoliert. Die elektrisch isolierenden Schichten11 können z.B. aus Polyamid, die Leiterbahnen6 in herkömmlicher Weise aus Kupfer, Silber oder dgl. hergestellt sein. Zur Bildung eines festen Abschnitts1 der Anordnung ist die flexible Schichtanordnung2 beidseitig mit einer herkömmlichen Leiterplatte8 , z.B. mittels Kleben, fest verbunden. Die Leiterplatten8 weisen an ihrer zur Umgebung weisenden Außenseite jeweils eine zu Abschirmzwecken dienende Metallisierung9 auf. Die Metallisierungen9 der Leiterplatten8 sind mittels einer herkömmlichen Durchkontaktierung10 elektrisch leitend miteinander verbunden. Die Metallisierungen9 sind in herkömmlicher Weise mit einem elektrisch isolierenden Lack (hier nicht gezeigt) überdeckt. - Die Ausnehmung
5 durchgreift die Leiterplatte8 und die darunter befindliche oberste elektrisch isolierende Schicht11 der flexiblen Schichtanordnung2 ; sie reicht bis zu den in der flexiblen Schichtanordnung2 aufgenommenen Leiterbahnen6 . Die Leiterbahnen6 sind mit einer Kontaktierung12 unmittelbar mit dem Photodiodenarray4 elektrisch leitend verbunden. Die Kontaktierung12 wird zweckmäßigerweise mittels bonding-Technik hergestellt. Die Ausnehmung5 kann nach der Herstellung der Kontaktierung12 mit einer elektrisch isolierenden Vergussmasse13 verfüllt werden. - Bei dem in
3 gezeigten Ausführungsbeispiel ist die Ausnehmung5 stufenförmig ausgebildet. Durch diese besondere Ausbildung der Ausnehmung5 können mehrere übereinander liegende Schichten an Leiterbahnen6 unmittelbar mittels bonding-Technik kontaktiert werden. - Die in der Schichtanordnung
2 aufgenommenen Schichten können eine Dicke im Bereich von 50 bis 500 μm aufweisen. Bei den zur Herstellung der festen Abschnitte1 ,3 benutzen Leiterplatten kann es sich um herkömmliches Leiterplattenmaterial, z.B. FR4, handeln. - Nach einer weiteren vorteilhaften, in der Zeichnung nicht dargestellten, Ausgestaltung ist auf der bauelementseitigen Oberseite der Leiterplatte
8 eine Metallschicht aufgebracht. Sofern als Bauelement ein Photodiodenarray verwendet wird, kann jeweils einer der Kontakte jeder Photodiode mit der Metallschicht verbunden werden. Die Metallschicht ist mit der Masse verbunden. Der andere Kontakt kann dann unmittelbar mittels bonding-Technik mit einer in der Ausnehmung5 freigelegten Leiterbahn6 verbunden werden. - Die Ausnehmung
5 muss nicht unbedingt im Bereich der Leiterplatte6 vorgesehen sein. Es ist auch denkbar, das Bauelement4 in der Nähe des einen Endes des festen Abschnitts1 ,3 zu montieren. In diesem Fall kann die Ausnehmung5 in der flexiblen Schichtanordnung2 vorgesehen sein. Die Kontaktierung12 wird in diesem Fall vom auf dem festen Abschnitt montierten Bauelement5 zu der Ausnehmung5 geführt, welche in der flexiblen Schichtanordnung2 in der Nähe des festen Abschnitts1 ,3 vorgesehen ist.
Claims (11)
- Anordnung zur elektrischen Verbindung eines auf einer Leiterplatte angebrachten Bauelementes (
4 ) mit einer flexiblen Schichtanordnung (2 ), – wobei in der Schichtanordnung (2 ) umgeben von elektrisch isolierenden Schichten (11 ) mindestens eine elektrisch leitfähige Schicht mit einer Vielzahl nebeneinander liegender Leiterbahnen (6 ) aufgenommen ist, – wobei die flexible Schichtanordnung (2 ) zur Ausbildung eines festen Abschnitts (1 ) mit mindestens einer das Bauelement (4 ) aufweisenden Leiterplatte (8 ) fest verbunden ist, und – wobei zur Kontaktierung der Leiterbahnen (6 ) im Bereich des festen Abschnitts (1 ) eine die Leiterplatte (8 ) durchgreifende, bis zu den Leiterbahnen (6 ) reichende Ausnehmung (5 ) vorgesehen ist. - Leiterplattenanordnung nach Anspruch 1, wobei in der flexiblen Schichtanordnung (
2 ) mehrere übereinander angeordnete und durch elektrisch isolierende Schichten (11 ) voneinander getrennte, elektrisch leitfähige Schichten aufgenommen sind. - Leiterplattenanordnung nach Anspruch 2, wobei die Ausnehmung (
5 ) stufenartig ausgebildet ist, so dass die Leiterbahnen (6 ) jeder Schicht kontaktierbar sind. - Leiterplattenanordnung nach einem der vorhergehenden Ansprüche, wobei die den Oberflächen der flexiblen Schichtanordnung (
2 ) am nächsten gelegenen elektrisch leitfähigen Schichten als Abschirmschichten ausgebildet sind. - Leiterplattenanordnung nach einem der vorhergehenden Ansprüche, wobei die elektrisch isolierende Schicht (
11 ) aus Polyamid hergestellt ist. - Leiterplattenanordnung nach einem der vorhergehenden Ansprüche, wobei das Bauelement (
4 ) eine Vielzahl von Photodioden aufweist. - Leiterplattenanordnung nach Anspruch 6, wobei jeweils einer der beiden Kontakte der Photodioden mit einer auf dem festen Abschnitt (
1 ) aufgebrachten Metallschicht verbunden ist. - Leiterplattenanordnung nach Anspruch 6 oder 7, wobei der andere Kontakt der Photodioden jeweils mit einer dafür vorgesehenen Leiterbahn (
6 ) verbunden ist. - Leiterplattenanordnung nach einem der Ansprüche 6 bis 8, wobei die Kontaktierung (
12 ) mittels bonding-Technik unmittelbar zwischen dem anderen Kontakt der Photodiode und der Leiterbahn (6 ) hergestellt ist. - Leiterplattenanordnung nach einem der vorhergehenden Ansprüche, wobei die Ausnehmung (
5 ) und die darin befindliche Kontaktierung (12 ) mit einer Vergussmasse (13 ), vorzugsweise einem Kunststoff, verfüllt ist. - Verwendung einer Leiterplattenanordnung nach einem der vorhergehenden Ansprüche in einem Detektormodul für einen Röntgen-Computertomographen.
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JP2004219318A (ja) * | 2003-01-16 | 2004-08-05 | Hamamatsu Photonics Kk | 放射線検出器 |
TWI228804B (en) * | 2003-07-02 | 2005-03-01 | Lite On Semiconductor Corp | Chip package substrate having flexible printed circuit board and method for fabricating the same |
DE10336634B3 (de) * | 2003-08-08 | 2005-02-03 | Siemens Ag | Elektronisches Gerät |
US7489516B2 (en) * | 2004-11-24 | 2009-02-10 | General Electric Company | Digital CT detector module methods and apparatus |
DE102006052459A1 (de) * | 2006-11-07 | 2008-06-05 | Siemens Ag | Elektronikgehäuse mit Standardinterface |
JP5370714B2 (ja) * | 2007-05-31 | 2013-12-18 | ソニー株式会社 | 光導波路、および信号処理装置 |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO1983003943A1 (en) * | 1982-05-03 | 1983-11-10 | Motorola, Inc. | Improved bonding means and methods for polymer coated devices |
DE3606621A1 (de) * | 1985-03-01 | 1986-09-04 | Rogers Corp., Rogers, Conn. | Loetstellenfreie verbindungsvorrichtung und verfahren zur herstellung einer loetstellenfreien verbindung unter verwendung einer derartigen vorrichtung |
DE3502744C2 (de) * | 1984-06-27 | 1989-06-08 | Nippon Mektron, Ltd., Tokio/Tokyo, Jp | |
DE19617055C1 (de) * | 1996-04-29 | 1997-06-26 | Semikron Elektronik Gmbh | Halbleiterleistungsmodul hoher Packungsdichte in Mehrschichtbauweise |
WO2000079845A1 (en) * | 1999-06-17 | 2000-12-28 | Telefonaktiebolaget Lm Ericsson (Publ) | An arrangement for mounting chips in multilayer printed circuit boards |
Family Cites Families (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4931134A (en) * | 1989-08-15 | 1990-06-05 | Parlex Corporation | Method of using laser routing to form a rigid/flex circuit board |
US5004639A (en) * | 1990-01-23 | 1991-04-02 | Sheldahl, Inc. | Rigid flex printed circuit configuration |
US5121297A (en) * | 1990-12-31 | 1992-06-09 | Compaq Computer Corporation | Flexible printed circuits |
US5689091A (en) * | 1996-09-19 | 1997-11-18 | Vlsi Technology, Inc. | Multi-layer substrate structure |
US6292529B1 (en) * | 1999-12-15 | 2001-09-18 | Analogic Corporation | Two-dimensional X-ray detector array for CT applications |
US6465882B1 (en) * | 2000-07-21 | 2002-10-15 | Agere Systems Guardian Corp. | Integrated circuit package having partially exposed conductive layer |
US6658082B2 (en) * | 2000-08-14 | 2003-12-02 | Kabushiki Kaisha Toshiba | Radiation detector, radiation detecting system and X-ray CT apparatus |
DE10116222A1 (de) * | 2001-03-30 | 2002-10-17 | Siemens Ag | Detektor für Röntgen-Computertomograph |
-
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Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO1983003943A1 (en) * | 1982-05-03 | 1983-11-10 | Motorola, Inc. | Improved bonding means and methods for polymer coated devices |
DE3502744C2 (de) * | 1984-06-27 | 1989-06-08 | Nippon Mektron, Ltd., Tokio/Tokyo, Jp | |
DE3606621A1 (de) * | 1985-03-01 | 1986-09-04 | Rogers Corp., Rogers, Conn. | Loetstellenfreie verbindungsvorrichtung und verfahren zur herstellung einer loetstellenfreien verbindung unter verwendung einer derartigen vorrichtung |
DE19617055C1 (de) * | 1996-04-29 | 1997-06-26 | Semikron Elektronik Gmbh | Halbleiterleistungsmodul hoher Packungsdichte in Mehrschichtbauweise |
WO2000079845A1 (en) * | 1999-06-17 | 2000-12-28 | Telefonaktiebolaget Lm Ericsson (Publ) | An arrangement for mounting chips in multilayer printed circuit boards |
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