CN218526228U - 一种用于并联dc-dc转换器的均流电路 - Google Patents
一种用于并联dc-dc转换器的均流电路 Download PDFInfo
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Abstract
一种用于并联DC‑DC转换器的均流电路,包括多个并联的调整电路,每个调整电路与一个DC‑DC转换器一一对应串联,调整电路包括第一电容、第二电容、第三电容、第一电阻、第二电阻、第三电阻、第四电阻、第五电阻、第一三极管和UC2907DWG4芯片,以UC2907DWG4芯片为主的最大电流自动均流法的工作方式,实现并联均流,使并联的各DC‑DC转换器均匀地承担负载功率,提高电源系统可靠性。
Description
技术领域
本实用新型涉及DC-DC转换器技术领域,具体说的是一种用于并联DC-DC转换器的均流电路。
背景技术
随着电力电子技术的不断发展,对输出电流的要求越来越大,单个DC-DC转换器已经无法满足大电流的负载要求,需要多个DC-DC转换器并联使用来满足大电流的要求。并联均流技术可以降低电流应力,提高系统的可靠性。
并联工作的各个DC-DC转换器特性不可能完全一致,采用如图3所示的典型均流电路,如不采取措施会导致某个转换器承受较大的电流压力,引起该转换器甚至整个电源系统的故障。
实用新型内容
为解决上述技术问题,本实用新型提供一种用于并联DC-DC转换器的均流电路,从而使各DC-DC转换器均匀地承担负载功率,提高电源系统可靠性。
为实现上述技术目的,所采用的技术方案是:一种用于并联DC-DC转换器的均流电路,包括多个并联的调整电路,每个调整电路与一个DC-DC转换器一一对应串联,所述的调整电路包括第一电容、第二电容、第三电容、第一电阻、第二电阻、第三电阻、第四电阻、第五电阻、第一三极管和UC2907DWG4芯片,第一电容的一端、第三电容的一端、UC2907DWG4芯片的 VCC脚、第一电阻的一端、输出端口OUT和对应连接的DC-DC转换器的+VOUT脚连接,第一电阻的另一端、第一三极管的C脚连接DC-DC转换器的+s脚,UC2907DWG4芯片的-SENSE脚接DC-DC转换器的-s脚,第三电阻的一端接DC-DC转换器的-VOUT脚,第二电阻与第三电阻并联,第三电阻的另一端和第一电容的另一端接在OUT输出端口上,第一三极管的B脚分别接第二电容的一端、UC2907DWG4芯片的ADJ_OUT脚,第一三极管的E脚分别接第四电阻的一端和第五电阻的一端,第二电容的另一端分别接UC2907DWG4芯片的 ARTIFICIAL_GROUNI脚、第五电阻的另一端和第三电容的另一端,第四电阻的另一端接UC2907DWG4芯片的VREF脚,UC2907DWG4芯片的CURRENT_SHARE_BUS脚接share_bus脚。
本实用新型有益效果是:适用于多个DC-DC转换器并联均流的电路,通过以UC2907DWG4芯片为主的最大电流自动均流法的工作方式,实现并联均流,此电路可靠性高,在开关电源实际应用中有着广泛的应用前景。
附图说明
图1为本实用新型的两个两个DC-DC转换器并联后使用的均流电路图;
图2为本实用新型的UC2907DWG4芯片内部原理框图;
图3为典型的均流电路图。
具体实施方式
下面结合附图给出实用新型的较佳实施例,以详细说明本实用新型的技术方案。这里,将给出相应附图对本实用新型进行详细说明。需要特别说明的是,这里所描述的优选实施例子仅用于说明和解释本实用新型,并不用于限制或限定本实用新型。此外,术语“第一”、“第二”仅用于区别类似的对象,而不能理解为特定的顺序或先后次序,应该理解这样的使用在适当情况下可以互换。
一种用于并联DC-DC转换器的均流电路,包括多个并联的调整电路,每个调整电路与一个DC-DC转换器一一对应串联,即每个DC-DC转换器连接一个调整电路,每个调整电路均包括第一电容、第二电容、第三电容、第一电阻、第二电阻、第三电阻、第四电阻、第五电阻、第一三极管和UC2907DWG4芯片,第一电容的一端、第三电容的一端、UC2907DWG4芯片的VCC脚、第一电阻的一端、输出端口OUT和对应连接的DC-DC转换器的+VOUT脚连接,第一电阻的另一端、第一三极管的C脚连接DC-DC转换器的+s脚,UC2907DWG4芯片的-SENSE脚接DC-DC转换器的-s脚,第三电阻的一端接DC-DC转换器的-VOUT脚,第二电阻与第三电阻并联,第三电阻的另一端和第一电容的另一端接在OUT输出端口上,第一三极管的B脚分别接第二电容的一端、UC2907DWG4芯片的ADJ_OUT脚,第一三极管的E脚分别接第四电阻的一端和第五电阻的一端,第二电容的另一端分别接UC2907DWG4芯片的 ARTIFICIAL_GROUNI脚、第五电阻的另一端和第三电容的另一端,第四电阻的另一端接UC2907DWG4芯片的VREF脚,UC2907DWG4芯片的CURRENT_SHARE_BUS脚接share_bus脚。
如图2所示,UC2907DWG4就是最大电流自动均流法的16引脚均流控制器,它提供了多个DC-DC转换器并联均流所需的功能,VCC脚为芯片提供偏置电源,VREF脚为内部电源基准,-SENSE脚为电压负检测端,CURRENT SHARE BUS脚为均流母线,ADJ OUT脚为调节放大器的输出端。
如图1所示,以两个并联的DC-DC转换器为例,DC-DC转换器N1的+VIN脚和-VIN脚、DC-DC转换器N2的的+VIN脚和-VIN脚共同接输入端口+28VIN,DC-DC转换器N1的+VOUT脚分别接电容C1的a脚、电容C3的a脚、N2的 VCC脚、电阻R1的b脚和输出端口OUT,DC-DC转换器N1的+s脚分别接电阻R1的a脚、三极管V1的C脚,DC-DC转换器N1的-s脚接N2的-SENSE脚,DC-DC转换器N1的-VOUT脚分别接电阻R2的a脚、电阻R3的a脚,电阻R2的b脚分别接电阻R3的b脚、电容C1的b脚和OUT输出端口,三极管V1的B脚分别接电容C2的a脚、N2的ADJ_OUT脚,三极管V1的E脚分别接电阻R4的b脚和电阻R5的a脚,电容C2的b脚分别接N2的 ARTIFICIAL_GROUNI脚、电阻R5的b脚和电容C3的b脚,电阻R4的a脚接N2的VREF脚,N2的CURRENT_SHARE_BUS脚接share_bus脚,DC-DC转换器N3的+VOUT脚分别接分别接电容C4的a脚、电容C6的a脚、N4的VCC脚、电阻R6的b脚和输出端口OUT,DC-DC转换器N3的+s脚分别接电阻R6的a脚、三极管V2的C脚,DC-DC转换器N3的-s脚接N4的-SENSE脚,DC-DC转换器N3的-VOUT脚分别接电阻R7的a脚、电阻R8的a脚,电阻R7的b脚分别接电阻R7的b脚、电容C4的b脚和OUT输出端口,三极管V2的B脚分别接电容C5的a脚、N4的ADJ_OUT脚,三极管V2的E脚分别接电阻R9的b脚和电阻R10的a脚,电容C5的b脚分别接N2的 ARTIFICIAL_GROUNI脚、电阻R10的b脚和电容C6的b脚,电阻R9的a脚接N2的VREF脚,N4的CURRENT_SHARE_BUS脚接share_bus脚。
当两个调整电路与均流母线share_bus脚连接后,UC2907DWG4芯片会自动选出输出电流最大的一路作为主DC-DC转换器(设定为N1),DC-DC转换器N1输出电流稍高,此路UC2907DWG4(N2)调整的三极管V1截止, DC-DC转换器N1输出电压维持不变;而在输出电流较小的其他路DC-DC转换器(设定为N3)中,UC2907DWG4(N4)调整的三极管V2导通情况,三极管V2发射极有一个电阻R10到地,此时通过三极管V2的电流即为VOUT+/R6,有此附加的电流流经R6后,R6上的电压降会增大,从而从DC-DC转换器的+SENSE端遥测电压会降低,该路DC-DC转换器则会抬高其输出电压(跟随主DC-DC转换器输出电压)从而承担更多的负载电流,以达到均流的目的。
本文方案采用最大电流自动均流法的工作方式,利用UC2907DWG4芯片内部电流检测放大器、误差放大器和外部电流检测电阻,配合带有+/-Sense端的DC-DC转换器,能够高效可靠地完成多个DC-DC转换器均流。用户可根据具体的并联系统,只需调整检测电阻RS、调整电阻R1取值即可。该方案外围电路简单、成本低、使用灵活、精度高,为带有+/-Sense端的DC-DC转换器并联运行提供了一种全新的解决思路。
Claims (1)
1.一种用于并联DC-DC转换器的均流电路,其特征在于:包括多个并联的调整电路,每个调整电路与一个DC-DC转换器一一对应串联,所述的调整电路包括第一电容、第二电容、第三电容、第一电阻、第二电阻、第三电阻、第四电阻、第五电阻、第一三极管和UC2907DWG4芯片,第一电容的一端、第三电容的一端、UC2907DWG4芯片的 VCC脚、第一电阻的一端、输出端口OUT和对应连接的DC-DC转换器的+VOUT脚连接,第一电阻的另一端、第一三极管的C脚连接DC-DC转换器的+s脚,UC2907DWG4芯片的-SENSE脚接DC-DC转换器的-s脚,第三电阻的一端接DC-DC转换器的-VOUT脚,第二电阻与第三电阻并联,第三电阻的另一端和第一电容的另一端接在OUT输出端口上,第一三极管的B脚分别接第二电容的一端、UC2907DWG4芯片的ADJ_OUT脚,第一三极管的E脚分别接第四电阻的一端和第五电阻的一端,第二电容的另一端分别接UC2907DWG4芯片的 ARTIFICIAL_GROUNI脚、第五电阻的另一端和第三电容的另一端,第四电阻的另一端接UC2907DWG4芯片的VREF脚,UC2907DWG4芯片的CURRENT_SHARE_BUS脚接share_bus脚。
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