CN207250494U - 一种封装结构 - Google Patents
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Abstract
本实用新型提供一种封装结构,所述封装结构包括:重新布线层,所述重新布线层包括第一面以及与所述第一面相对的第二面,所述重新布线层包括介质层以及金属布线层;金属凸块,所述金属凸块形成于所述重新布线层第一面上;CMOS图像传感器芯片与逻辑芯片,所述CMOS图像传感器芯片及所述逻辑芯片正面具有金属焊点,所述金属焊点装设于所述重新布线层第二面上与所述重新布线层实现相互之间的电连接;封装材料,形成于所述重新布线层的第二面上,所述CMOS图像传感器芯片背面裸露于所述封装材料;本实用新型封装结构具有封装体积小,组装工艺简单,封装费用低,且不需要外部连线从而提高结构的稳定性,同时提高最终器件结构的成品率。
Description
技术领域
本实用新型涉及一种半导体封装领域,特别是涉及一种集成CMOS图像传感器与逻辑芯片的晶圆级封装结构。
背景技术
CMOS(Complementary Metal-Oxide Semiconductor)中文的全称为互补氧化金属半导体,是用于记录光线变化的元件,是最常用的感光器件之一,CMOS被称之为数码相机的大脑。
数码相机的本质,从专业的角度来看,就是把光能转化为信息储存起来。大致分为以下三个流程:成像→光电转换→记录,即镜头拍摄主体反射的光线通过镜头进入相机后聚焦,形成清晰图像,图像落在CMOS光电器材上,通过光电转换形成电信号,然后把信号记录在磁带或储存卡上。而光电转换的核心部件是传感器,传感器的作用就是把传到它身上的不同强度的光线进行光电转换,转换成电压信息最终生成我们想要的数字图片。
CMOS图像传感器(CMOS image sensor)分正面照明类型和背面照明类型两种。背面照明类型最大的优化之处在于将元件内部的结构改变了,其将感光层的元件调转方向,让光能从背面直射进去,避免了传统CMOS图像传感器结构中,光线会受到微透镜和光电二极管之间的电路和晶体管的影响,从而显著提高光的效能,大大改善低光照条件下的拍摄效果。
因此,CMOS图像传感器芯片,通常需要搭配逻辑芯片集成使用,现有的制作方法是将单独封装好的CMOS图像传感器芯片通过外部连线与逻辑芯片进行电性连接。这种封装方法使得器件的体积较大,组装工艺过程较为复杂,单独封装费用高,且需要外部连线使得结构的稳定性大大降低,严重影响最终器件结构的成品率。
基于以上所述,提供一种可以有效集成CMOS图像传感器芯片及逻辑芯片,并有效降低封装结构体积、简化封装工艺、降低成本以及提高器件稳定性,且具有高成品率的封装结构实属必要。
实用新型内容
鉴于以上所述现有技术的缺点,本实用新型的目的在于提供一种封装结构,用于解决现有技术中CMOS图像传感器芯片及逻辑芯片的封装体积较大,器件稳定性低以及产品良率较低的问题。
为实现上述目的及其他相关目的,本实用新型提供一种封装结构,所述封装结构包括:
重新布线层,所述重新布线层包括第一面以及与所述第一面相对的第二面,所述重新布线层包括介质层以及金属布线层;
金属凸块,所述金属凸块形成于所述重新布线层第一面上;
CMOS图像传感器芯片与逻辑芯片,所述CMOS图像传感器芯片及所述逻辑芯片正面具有金属焊点,所述金属焊点装设于所述重新布线层第二面上与所述重新布线层实现相互之间的电连接;
封装材料,形成于所述重新布线层的第二面上,所述CMOS图像传感器芯片背面裸露于所述封装材料。
优选地,所述介质层的材料包括环氧树脂、硅胶、氧化硅、磷硅玻璃,含氟玻璃中的一种或两种以上组合,所述金属布线层的材料包括铜、铝、镍、金、银、钛中的一种或两种以上组合。
优选地,所述重新布线层包括N层金属布线层,N≥1。
优选地,所述金属凸块包括焊料凸点;或者所述金属凸块包括金属柱以及位于金属柱上方的焊料凸点。
优选地,所述金属柱的材料包括铜、镍中的一种,所述焊料凸点的材料包括铜、镍、锡及银中的一种或包含上述任意一种焊料金属的合金。
优选地,所述CMOS图像传感器芯片包括前照式、背照式CMOS图像传感器芯片中的一种或两种以上组合。
优选地,所述背照式CMOS图像传感器芯片自上而下包括玻璃层、微透镜、彩色滤光镜、光电二极管和电路层。
优选地,所述金属焊点的材料包括铜、镍、锡及银中的一种或包含上述任意一种焊料金属的合金。
优选地,所述CMOS图像传感器芯片和所述逻辑芯片均与所述重新布线层之间具有间隙,所述间隙中形成有保护层,所述保护层填充所述间隙,所述保护层的材料包括聚酰亚胺、硅胶以及环氧树脂中的一种。
优选地,所述封装材料包括聚酰亚胺、硅胶以及环氧树脂中的一种。
如上所述,本实用新型的一种封装结构,具有以下有益效果:本实用新型在一次封装过程中得到多个集成所述CMOS图像传感器芯片及所述逻辑芯片的封装结构;采用重新布线层实现所述CMOS图像传感器芯片及所述逻辑芯片与所述重新布线层之间的电连接;该封装结构具有封装体积小,组装工艺简单,封装费用低,且不需要外部连线从而提高结构的稳定性,同时提高最终器件结构的成品率。
附图说明
图1~图6显示为一种制造本实用新型的集成CMOS图像传感器芯片及逻辑芯片结构的封装方法各步骤所呈现的结构示意图。
元件标号说明
100 晶圆级硅衬底
200 重新布线层
201 介质层
202 金属布线层
300 CMOS图像传感器芯片
400 逻辑芯片
500 金属焊点
600 封装材料
700 金属凸块
具体实施方式
以下通过特定的具体实例说明本实用新型的实施方式,本领域技术人员可由本说明书所揭露的内容轻易地了解本实用新型的其他优点与功效。本实用新型还可以通过另外不同的具体实施方式加以实施或应用,本说明书中的各项细节也可以基于不同观点与应用,在没有背离本实用新型的精神下进行各种修饰或改变。
请参阅图1~图6。需要说明的是,本实施例中所提供的图示仅以示意方式说明本实用新型的基本构想,遂图式中仅显示与本实用新型中有关的组件而非按照实际实施时的组件数目、形状及尺寸绘制,其实际实施时各组件的型态、数量及比例可为一种随意的改变,且其组件布局型态也可能更为复杂。
实施例一
本实施例提供一种封装结构,如图6所示,所述封装结构包括:重新布线层200、金属凸块700、CMOS图像传感器芯片300与逻辑芯片400及封装材料600,其中:所述重新布线层200包括第一面以及与所述第一面相对的第二面,所述重新布线层200包括介质层201以及金属布线层202;所述金属凸块700形成于所述重新布线层200第一面上;所述CMOS图像传感器芯片300及所述逻辑芯片400正面具有金属焊点500,所述金属焊点500装设于所述重新布线层200第二面上与所述重新布线层200实现相互之间的电连接;所述封装材料600形成于所述重新布线层200的第二面上,所述CMOS图像传感器芯片300背面裸露于所述封装材料600。
具体的,所述介质层201的材料包括环氧树脂、硅胶、氧化硅、磷硅玻璃,含氟玻璃中的一种或两种以上组合,所述金属布线层202的材料包括铜、铝、镍、金、银、钛中的一种或两种以上组合。在本实施例中,所述介质层201选用为氧化硅。
具体的,所述重新布线层200包括N层金属布线层202,N≥1。依据连线需求,通过对各介质层201进行图形化或者制作通孔实现各层金属布线层202之间的互连,以实现不同功能的连线需求。
具体的,所述金属凸块700包括焊料凸点;或者所述金属凸块包括金属柱以及位于金属柱上方的焊料凸点。
具体的,所述金属柱的材料包括铜、镍中的一种,所述焊料凸点的材料包括铜、镍、锡及银中的一种或包含上述任意一种焊料金属的合金。在本实施例中,所述金属凸块700选用为焊料凸点锡球。
具体的,所述CMOS图像传感器芯片300包括前照式、背照式CMOS图像传感器芯片中的一种或两种以上组合。
具体的,所述背照式CMOS图像传感器芯片自上而下包括玻璃层、微透镜、彩色滤光镜、光电二极管和电路层。
在本实施例中,所述CMOS图像传感器芯片300选用为背照式CMOS图像传感器芯片。背照式CMOS图像传感器芯片较之前照式CMOS图像传感器芯片其光电二极管可以接收到更多光线(开口率更大),使CMOS图像传感器具有更高灵敏度和信噪比,改善成像质量;配套电路无需再和光电二极管争抢面积,更大规模的电路有助于提高速度,实现超高速连拍、超高清短片拍摄等功能。
具体的,所述金属焊点500的材料包括铜、镍、锡及银中的一种或包含上述任意一种焊料金属的合金。
具体的,所述CMOS图像传感器芯片300与所述逻辑芯片400均与所述重新布线层200之间具有间隙,所述间隙中形成有保护层,所述保护层填充所述间隙,所述保护层的材料包括聚酰亚胺、硅胶以及环氧树脂中的一种。
具体的,所述封装材料600包括聚酰亚胺、硅胶以及环氧树脂中的一种。
本实用新型的封装结构集成CMOS图像传感器芯片及逻辑芯片;采用重新布线层实现CMOS图像传感器芯片及逻辑芯片与重新布线层之间的电连接;该封装结构具有封装体积小且不需要外部连线从而提高结构的稳定性,同时提高最终器件结构的成品率。
实施例二
下面将详述一种制造本实用新型的封装结构的方法,如图1~图6所示,所述封装方法包括步骤:
如图1所示,首先进行步骤1),提供晶圆级硅衬底100。
如图2所示,进行步骤2),于所述晶圆级硅衬底100上形成重新布线层200,所述重新布线层200包括介质层201以及金属布线层202。
作为示例,步骤2)中制作所述重新布线层200包括步骤:
进行步骤2-1),采用化学气相沉积工艺或物理气相沉积工艺于所述晶圆级硅衬底100表面形成介质层201,并对所述介质层201进行刻蚀形成图形化的介质层201。
作为示例,所述介质层201的材料包括环氧树脂、硅胶、氧化硅、磷硅玻璃、含氟玻璃中的一种或两种以上组合。在本实施例中,所述介质层201选用为氧化硅。
进行步骤2-2),采用化学气相沉积工艺、蒸镀工艺、溅射工艺、电镀工艺或化学镀工艺于所述图形化介质层201表面形成金属层,并对所述金属层进行刻蚀形成图形化的金属布线层202。
作为示例,所述金属布线层202的材料包括铜、铝、镍、金、银、钛中的一种或两种以上组合。在本实施例中,所述金属布线层202的材料选用为铜。
作为示例,所述重新布线层200包括N层金属布线层202,N≥1。依据连线需求,通过对各介质层201进行图形化或者制作通孔实现各层金属布线层202之间的互连,以实现不同功能的连线需求。
如图3所示,进行步骤3),提供CMOS图像传感器芯片300及逻辑芯片400,所述CMOS图像传感器芯片300及所述逻辑芯片400正面具有金属焊点500。
作为示例,所述CMOS图像传感器芯片300包括前照式、背照式CMOS图像传感器芯片中的一种或两种以上组合。在本实施例中,所述CMOS图像传感器芯片300选用为背照式CMOS图像传感器芯片。背照式CMOS图像传感器芯片较之前照式CMOS图像传感器芯片其光电二极管可以接收到更多光线(开口率更大),使CMOS图像传感器具有更高灵敏度和信噪比,改善成像质量;配套电路无需再和光电二极管争抢面积,更大规模的电路有助于提高速度,实现超高速连拍、超高清短片拍摄等功能。
作为示例,所述正面具有金属焊点的背照式CMOS图像传感器芯片制作步骤包括:
①提供晶圆级感应芯片及衬底,将所述晶圆级感应芯片固定于所述衬底上;
②于所述晶圆级感应芯片中形成光电二极管并减薄所述晶圆级感应芯片;
③于所述晶圆级感应芯片上表面形成彩色滤光镜及微透镜;
④于所述微透镜上方形成玻璃层;
⑤去除所述晶圆级衬底;
⑥于背照式CMOS图像传感器芯片晶圆正面形成金属焊点;
⑦切割步骤⑥中产生的晶圆级芯片,得到所述具有金属焊点的背照式CMOS图像传感器芯片。
作为示例,步骤①中所述晶圆级感应芯片背面涂覆有起粘合作用的金属薄膜或金属粘合胶,包括紫外固化胶,所述晶圆级感应芯片通过所述金属薄膜或金属粘合胶临时粘贴于所述衬底上。步骤④中于所述微透镜上方形成玻璃层的方法包括粘合及焊接。其他步骤为本领域常规技术手段此处不再赘述。
作为示例,所述金属焊点500包括铜、镍、锡及银中的一种或包含上述任意一种焊料金属的合金。本实施例中,所述金属焊点500选用为锡球。
具体的,具有金属焊点500的所述逻辑芯片400制作方法包括步骤:
步骤a)采用电镀法于逻辑芯片晶圆背面形成锡球;
步骤b)采用高温回流工艺形成所述金属焊点500;
步骤c)对具有金属焊点500的逻辑芯片晶圆进行切割,形成所述具有金属焊点500的所述逻辑芯片400。
如图3所示,接着进行步骤4),将所述CMOS图像传感器芯片300及所述逻辑芯片400正面朝下粘附于所述重新布线层200第二面上。
具体的,步骤4)还包括填充保护层于所述CMOS图像传感器芯片300及所述逻辑芯片400与所述重新布线层200之间的间隙的步骤,所述保护层填充所述间隙。
具体的,所述保护层材料包括聚酰亚胺、硅胶以及环氧树脂中的一种。包括点胶或者模压的方式形成于所述CMOS图像传感器芯片300及所述逻辑芯片400与所述重新布线层200之间的间隙。所述保护层可有效保护所述CMOS图像传感器芯片300及所述逻辑芯片400,例如,可以防止水汽等进入所述CMOS图像传感器芯片300及所述逻辑芯片400,同时,可以作为如撞击等的缓冲结构。本实施例中,采用后续填充的封装材料填充所述间隙,起到保护层的作用。
如图4所示,接着进行步骤5),采用封装材料600对所述CMOS图像传感器芯片300及所述逻辑芯片400进行封装,所述CMOS图像传感器芯片300背面裸露于所述封装材料600。
具体的,所述封装材料600包括聚酰亚胺、硅胶以及环氧树脂中的一种。采用封装材料600封装所述CMOS图像传感器芯片300及所述逻辑芯片400的方法包括压缩成型、传递模塑成型、液封成型、真空层压及旋涂中的一种
如图5所示,接着进行步骤6),去除所述晶圆级硅衬底100。
具体的,去除所述晶圆级硅衬底100的方法为研磨方式。露出所述重新布线层200第一面的金属布线层201。所述研磨的具体方法为本领域技术人员所熟知,此处不再赘述。
如图6所示,接着进行步骤7),于所述重新布线层200第一面的金属布线层201上形成金属凸块700。
具体的,所述金属凸块700包括焊料凸点;或者所述金属凸块700包括金属柱以及位于金属柱上方的焊料凸点。所述金属柱的材料包括铜、镍中的一种,所述焊料凸点的材料包括铜、镍、锡及银中的一种或包含上述任意一种焊料金属的合金。
具体的,步骤7)所述金属凸块700的制作方法包括步骤:
a)采用电镀法于所述金属布线层201表面形成所述焊料凸点或形成金属柱及焊料凸点;
b)采用高温回流工艺形成所述金属凸块700。
如图6所示,接着进行步骤8)切割所述步骤7)中产生的晶圆级封装结构,得到多个集成有所述CMOS图像传感器芯片300及所述逻辑芯片400的封装结构。
具体的,所述切割的具体方法为本领域技术人员所熟知,此处不再赘述。
上述封装方法在一次封装过程中得到多个集成CMOS图像传感器芯片与逻辑芯片的封装结构;采用重新布线层实现CMOS图像传感器芯片及逻辑芯片与重新布线层之间的电连接;该封装方法组装工艺简单且封装费用低。
综上所述,本实用新型的一种封装结构具有以下有益效果:本实用新型在一次封装过程中得到多个集成所述CMOS图像传感器芯片与所述逻辑芯片的封装结构;采用重新布线层实现所述CMOS图像传感器芯片及所述逻辑芯片与所述重新布线层之间的电连接;该封装结构具有封装体积小,组装工艺简单,封装费用低,且不需要外部连线从而提高结构的稳定性,同时提高最终器件结构的成品率。所以,本实用新型有效克服了现有技术中的种种缺点而具高度产业利用价值。
上述实施例仅例示性说明本实用新型的原理及其功效,而非用于限制本实用新型。任何熟悉此技术的人士皆可在不违背本实用新型的精神及范畴下,对上述实施例进行修饰或改变。因此,举凡所属技术领域中具有通常知识者在未脱离本实用新型所揭示的精神与技术思想下所完成的一切等效修饰或改变,仍应由本实用新型的权利要求所涵盖。
Claims (10)
1.一种封装结构,其特征在于,所述封装结构包括:
重新布线层,所述重新布线层包括第一面以及与所述第一面相对的第二面,所述重新布线层包括介质层以及金属布线层;
金属凸块,所述金属凸块形成于所述重新布线层第一面上;
CMOS图像传感器芯片与逻辑芯片,所述CMOS图像传感器芯片及所述逻辑芯片正面具有金属焊点,所述金属焊点装设于所述重新布线层第二面上与所述重新布线层实现相互之间的电连接;
封装材料,形成于所述重新布线层的第二面上,所述CMOS图像传感器芯片背面裸露于所述封装材料。
2.根据权利要求1所述的封装结构,其特征在于:所述介质层的材料包括环氧树脂、硅胶、氧化硅、磷硅玻璃,含氟玻璃中的一种或两种以上组合,所述金属布线层的材料包括铜、铝、镍、金、银、钛中的一种或两种以上组合。
3.根据权利要求1所述的封装结构,其特征在于:所述重新布线层包括N层金属布线层,N≥1。
4.根据权利要求1所述的封装结构,其特征在于:所述金属凸块包括焊料凸点;或者所述金属凸块包括金属柱以及位于金属柱上方的焊料凸点。
5.根据权利要求4所述的封装结构,其特征在于:所述金属柱的材料包括铜、镍中的一种,所述焊料凸点的材料包括铜、镍、锡及银中的一种或包含上述任意一种焊料金属的合金。
6.根据权利要求1所述的封装结构,其特征在于:所述CMOS图像传感器芯片包括前照式、背照式CMOS图像传感器芯片中的一种或两种以上组合。
7.根据权利要求6所述的封装结构,其特征在于:所述背照式CMOS图像传感器芯片自上而下包括玻璃层、微透镜、彩色滤光镜、光电二极管和电路层。
8.根据权利要求1所述的封装结构,其特征在于:所述金属焊点的材料包括铜、镍、锡及银中的一种或包含上述任意一种焊料金属的合金。
9.根据权利要求1所述的封装结构,其特征在于:所述CMOS图像传感器芯片和所述逻辑芯片均与所述重新布线层之间具有间隙,所述间隙中形成有保护层,所述保护层填充所述间隙,所述保护层的材料包括聚酰亚胺、硅胶以及环氧树脂中的一种。
10.根据权利要求1所述的封装结构,其特征在于:所述封装材料包括聚酰亚胺、硅胶以及环氧树脂中的一种。
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CN109659282A (zh) * | 2017-10-11 | 2019-04-19 | 中芯长电半导体(江阴)有限公司 | 一种封装结构及封装方法 |
CN111405144A (zh) * | 2019-01-02 | 2020-07-10 | 格科微电子(上海)有限公司 | 摄像头模组的制造方法以及终端处理设备 |
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Legal Events
Date | Code | Title | Description |
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GR01 | Patent grant | ||
GR01 | Patent grant | ||
CP03 | Change of name, title or address |
Address after: No.78 Changshan Avenue, Jiangyin City, Wuxi City, Jiangsu Province (place of business: No.9 Dongsheng West Road, Jiangyin City) Patentee after: Shenghejing micro semiconductor (Jiangyin) Co.,Ltd. Address before: No.78 Changshan Avenue, Jiangyin City, Wuxi City, Jiangsu Province Patentee before: SJ Semiconductor (Jiangyin) Corp. |
|
CP03 | Change of name, title or address |