CN203616748U - 一种解决不同优先级dma传输竞争问题的接口电路 - Google Patents
一种解决不同优先级dma传输竞争问题的接口电路 Download PDFInfo
- Publication number
- CN203616748U CN203616748U CN201320829669.2U CN201320829669U CN203616748U CN 203616748 U CN203616748 U CN 203616748U CN 201320829669 U CN201320829669 U CN 201320829669U CN 203616748 U CN203616748 U CN 203616748U
- Authority
- CN
- China
- Prior art keywords
- time sequence
- sequence conversion
- circuit
- conversion circuit
- rapidio
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 230000005540 biological transmission Effects 0.000 title claims abstract description 62
- 238000006243 chemical reaction Methods 0.000 claims abstract description 68
- 238000013500 data storage Methods 0.000 claims description 11
- 238000013519 translation Methods 0.000 claims description 4
- 238000004891 communication Methods 0.000 description 4
- 238000013461 design Methods 0.000 description 4
- 238000012546 transfer Methods 0.000 description 4
- 238000005516 engineering process Methods 0.000 description 3
- 238000000034 method Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 1
Images
Landscapes
- Bus Control (AREA)
Abstract
本实用新型提供一种解决不同优先级DMA传输竞争问题的接口电路，可使芯片内部解决FC-ASM总线到RapidIO总线的两类不同优先级DMA传输竞争问题得到彻底的解决。该接口电路，包括第一时序转换电路、第二时序转换电路以及仲裁电路，第一时序转换电路连接高优先级的DMA请求及响应信号，第二时序转换电路连接低优先级的DMA请求及响应信号，仲裁电路连接第一时序转换电路和第二时序转换电路。能够解决不同总线的两类不同优先级DMA传输竞争问题，而且，可使芯片内部解决FC-ASM总线到RapidIO总线的两类不同优先级DMA传输竞争问题得到彻底的解决，增强了主机接口和总线协议单元的可复用性。
Description
技术领域
本实用新型属于计算机硬件技术领域，具体涉及一种解决不同优先级DMA传输竞争问题的接口电路。
背景技术
在嵌入式计算机系统中的RapidIO与FC-ASM总线的总线接口中，FC-ASM总线经常需要作为两个主设备驱动RapidIO总线做DMA操作，并按照DMA操作发送的顺序分别对得到的响应进行处理，但由于RapidIO总线与FC总线对请求和响应的处理方法不同，造成接口电路难以达到此要求。
发明内容
为了解决背景技术中提及的上述问题，本实用新型提供一种解决不同优先级DMA传输竞争问题的接口电路，可使芯片内部解决FC-ASM总线到RapidIO总线的两类不同优先级DMA传输竞争问题得到彻底的解决。
本实用新型的解决方案是：
一种解决不同优先级DMA传输竞争问题的接口电路，其特殊之处在于：包括第一时序转换电路、第二时序转换电路以及仲裁电路，第一时序转换电路连接高优先级的DMA请求及响应信号，第二时序转换电路连接低优先级的DMA请求及响应信号，仲裁电路与连接第一时序转换电路互相连接，仲裁电路与第二时序转换电路互相连接。
上述第一时序转换电路包括数据存储电路、地址自增电路以及RapidIO时序转换电路；数据存储电路将收到的64位数据送入RapidIO时序转换电路，地址自增电路用于将每发送64位数据地址自增4后的地址发送给RapidIO时序转换电路，RapidIO时序转换电路负责将输入的数据和地址转换为RapidIO接口要求的时序。
上述第二时序转换电路包括包括数据存储电路、地址自增电路以及RapidIO时序转换电路；数据存储电路将收到的64位数据送入RapidIO时序转换电路，地址自增电路用于将每发送64位数据地址自增4后的地址发送给RapidIO时序转换电路，RapidIO时序转换电路负责将输入的数据和地址转换为RapidIO接口要求的时序。
本实用新型的优点在于：
（1）本实用新型提供的解决不同优先级DMA传输竞争问题的接口电路，该接口电路中的仲裁电路可以根据第一时序转换电路和第二时序转换电路发送的DMA传输请求，结合规定的DMA请求优先级判断规则，决定当前的DMA操作，从而能够解决不同总线的两类不同优先级DMA传输竞争问题，而且，可使芯片内部解决FC-ASM总线到RapidIO总线的两类不同优先级DMA传输竞争问题得到彻底的解决，从而增强了主机接口和总线协议单元的可复用性，大大简化了RapidIO总线与FC-ASM总线接口的设计与集成。
（2）该接口电路设计简单、通信效率高、移植性强的通用数据接口，能够完成不同总线之间的通信。
附图说明
图1为本实用新型的接口电路的电路框图；
图2为本实用新型第一时序转换电路和第二时序转换电路的具体电路图。
具体实施方式
下面结合附图和具体实施例进一步说明本实用新型的技术方案，请参阅图1。
本实用新型提供一种解决不同优先级DMA传输竞争问题的接口电路，包括第一时序转换电路、第二时序转换电路以及仲裁电路，其中，第一时序转换电路连接高优先级的DMA请求及响应信号，第二时序转换电路连接低优先级的DMA请求及响应信号，仲裁电路与连接第一时序转换电路互相连接，仲裁电路与第二时序转换电路互相连接。
第一时序转换电路，如图2，用于高优先级DMA传输，主要作用是是将外部的高优先级DMA传输请求转换为RapidIO总线的高优先级DMA传输请求。
第一时序转换电路包括数据存储电路、地址自增电路以及RapidIO时序转换电路。数据存储电路负责存储发送进此电路的数据，每收到64位数据后将此数据送入RapidIO时序转换电路，数据存储电路每发送64位数据后，地址自增电路将地址自增4，RapidIO时序转换电路负责将输入的参数转换为RapidIO时序。
当第一时序转换电路收到外部DMA传输请求时，首先向仲裁电路发送DMA传输请求，若仲裁电路要求传输立即进行，则第一时序转换电路通知FC_ASM总线传输开始，并将数据、地址、传输长度等关键参数转换为RapidIO总线时序，并将其送至RapidIO总线；若仲裁电路要求传输等待，则第一时序转换电路通知FC_ASM总线传输等待，直到仲裁电路要求传输立即开始。
第二时序转换电路，电路结构与第一时序转换电路相同，用于低优先级DMA传输，主要作用是是将外部的低优先级DMA传输请求转换为RapidIO总线的低优先级DMA传输请求；
当第二时序转换电路收到DMA传输请求时，首先向仲裁电路发送DMA传输请求，若仲裁电路要求传输立即进行，则第二时序转换电路通知FC_ASM总线传输开始，并将数据、地址、传输长度等关键参数转换为RapidIO总线时序，并将其送至RapidIO总线；若仲裁电路要求传输等待，则第二时序转换电路通知FC_ASM总线传输等待，直到仲裁电路要求传输立即开始。
仲裁电路，用于高低优先级DMA传输竞争处理，主要作用是仲裁高优先级的DMA请求和低优先级的DMA请求对RapidIO总线的占用情况，可以采用现有技术实现。
仲裁电路随时监控RapidIO总线的使用情况，当总线空闲时接到第一时序转换电路的传输请求时，通知第一时序转换电路传输立即开始；当总线空闲时接到第二时序转换电路的传输请求时，通知第二时序转换电路传输立即开始；当低优先级的DMA传输正在进行时接到第一时序转换电路的传输请求时，待低优先级的DMA传输发送完一个完整的帧，通知第一时序转换电路传输立即开始，低优先级的DMA传输等待，待高优先级的DMA传输进行完成后，低优先级的DMA传输继续进行；当高优先级的DMA传输正在进行时接到第二时序转换电路的传输请求时，通知第二时序转换电路等待待高优先级的DMA传输进行完成后，低优先级的DMA传输立即进行。
本发明提供的解决不同优先级DMA传输竞争问题的接口电路，该接口电路中的仲裁电路可以根据第一时序转换电路和第二时序转换电路发送的DMA传输请求，结合规定的DMA请求优先级判断规则，决定当前的DMA操作，从而能够解决不同总线的两类不同优先级DMA传输竞争问题，而且，可使芯片内部解决FC-ASM总线到RapidIO总线的两类不同优先级DMA传输竞争问题得到彻底的解决，从而增强了主机接口和总线协议单元的可复用性，大大简化了RapidIO总线与FC-ASM总线接口的设计与集成。该接口电路设计简单、通信效率高、移植性强的通用数据接口，能够完成不同总线之间的通信。
Claims (3)
1.一种解决不同优先级DMA传输竞争问题的接口电路，其特征在于：包括第一时序转换电路、第二时序转换电路以及仲裁电路，仲裁电路与连接第一时序转换电路互相连接，仲裁电路与第二时序转换电路互相连接。
2.根据权利要求1所述的解决不同优先级DMA传输竞争问题的接口电路，其特征在于：第一时序转换电路包括数据存储电路、地址自增电路以及RapidIO时序转换电路；数据存储电路将收到的64位数据送入RapidIO时序转换电路，地址自增电路用于将每发送64位数据地址自增4后的地址发送给RapidIO时序转换电路，RapidIO时序转换电路负责将输入的数据和地址转换为RapidIO接口要求的时序。
3.根据权利要求1或2所述的解决不同优先级DMA传输竞争问题的接口电路，其特征在于：第二时序转换电路包括数据存储电路、地址自增电路以及RapidIO时序转换电路；数据存储电路将收到的64位数据送入RapidIO时序转换电路，地址自增电路用于将每发送64位数据地址自增4后的地址发送给RapidIO时序转换电路，RapidIO时序转换电路负责将输入的数据和地址转换为RapidIO接口要求的时序。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201320829669.2U CN203616748U (zh) | 2013-12-14 | 2013-12-14 | 一种解决不同优先级dma传输竞争问题的接口电路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201320829669.2U CN203616748U (zh) | 2013-12-14 | 2013-12-14 | 一种解决不同优先级dma传输竞争问题的接口电路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| CN203616748U true CN203616748U (zh) | 2014-05-28 |
Family
ID=50769378
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| CN201320829669.2U Expired - Lifetime CN203616748U (zh) | 2013-12-14 | 2013-12-14 | 一种解决不同优先级dma传输竞争问题的接口电路 |
Country Status (1)
| Country | Link |
|---|---|
| CN (1) | CN203616748U (zh) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN107395525A (zh) * | 2017-07-27 | 2017-11-24 | 中国船舶重工集团公司第七二四研究所 | 一种VPX交换板的rapidIO网络交换方法 |
-
2013
- 2013-12-14 CN CN201320829669.2U patent/CN203616748U/zh not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN107395525A (zh) * | 2017-07-27 | 2017-11-24 | 中国船舶重工集团公司第七二四研究所 | 一种VPX交换板的rapidIO网络交换方法 |
| CN107395525B (zh) * | 2017-07-27 | 2021-03-09 | 中国船舶重工集团公司第七二四研究所 | 一种VPX交换板的rapidIO网络交换方法 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| CN108107827B (zh) | 一种基于zynq平台软核的srio控制方法 | |
| KR101725536B1 (ko) | Pcie 프로토콜 스택을 이용하는 저전력 phy의 동작을 위한 디바이스, 방법 및 시스템 | |
| EP2676204B1 (en) | Serial interface | |
| CN108132897B (zh) | 一种基于zynq平台软核的srio控制器 | |
| EP2761386B1 (en) | Managing sideband segments in on-die system fabric | |
| JP2016076257A5 (zh) | ||
| CN102819512A (zh) | 一种基于spi的全双工通信装置及其方法 | |
| US20130132625A1 (en) | Methods and devices for extending usb 3.0-compliant communication | |
| CN108255776B (zh) | 一种兼容apb总线的i3c主设备、主从系统及通信方法 | |
| CN103617138A (zh) | 多主机仲裁方法及多主机通信系统 | |
| CN103136163B (zh) | 可配置实现fc-ae-asm和fc-av协议的协议处理器芯片 | |
| CN102073611B (zh) | 一种i2c总线控制系统及方法 | |
| CN101937413B (zh) | 一种i2c总线的通信方法 | |
| CN111177065A (zh) | 一种多芯片互联方法和装置 | |
| WO2014134947A1 (zh) | 控制信息的收发装置和方法 | |
| KR20180019593A (ko) | 확장된 메시지 시그널링된 인터럽트들 (msi) 메시지 데이터 | |
| CN204256732U (zh) | 基于PCI-Express接口的高速数据传输装置 | |
| CN103607360A (zh) | 一种报文处理方法、线卡及交换设备 | |
| CN105718396B (zh) | 一种大数据主设备传输的i2c总线装置及其通讯方法 | |
| CN203616748U (zh) | 一种解决不同优先级dma传输竞争问题的接口电路 | |
| CN103885910B (zh) | 多设备在主模式下进行iic通信的方法 | |
| CN105512005A (zh) | 控制/远程节点与总线监控节点同步工作的电路及方法 | |
| CN108521416B (zh) | 一种ecn板卡 | |
| CN103248679A (zh) | 一种网络消息传递方法 | |
| CN104850517A (zh) | 一种dma传输报文数据的方法及装置 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| C14 | Grant of patent or utility model | ||
| GR01 | Patent grant | ||
| TR01 | Transfer of patent right | ||
| TR01 | Transfer of patent right |
Effective date of registration: 20221209 Address after: Room S303, Innovation Building, No. 25, Gaoxin 1st Road, Xi'an, Shaanxi 710075 Patentee after: XI'AN XIANGTENG MICROELECTRONICS TECHNOLOGY Co.,Ltd. Address before: No.15, Jinye 2nd Road, Xi'an, Shaanxi 710119 Patentee before: 631ST Research Institute OF AVIC |
|
| CX01 | Expiry of patent term | ||
| CX01 | Expiry of patent term |
Granted publication date: 20140528 |