CN202712186U - 集成有肖特基二极管的功率器件 - Google Patents
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Abstract
提出了一种集成有肖特基二极管的功率器件。根据本实用新型实施例的功率器件包括功率晶体管、肖特基二极管以及沟槽阻隔体，其中所述功率晶体管具有漏区，所述肖特基二极管形成于所述漏区中，所述沟槽阻隔体形成于所述肖特基二极管附近，可以用于降低所述肖特基二极管的反向泄漏电流。根据本实用新型实施例的功率器件具有良好的单向导通电流性能，并且反向泄漏电流较小。另外，根据本实用新型实施例的功率器件还可以消除或者至少降低由寄生BJT引起的载流子注入衬底的问题。再者，根据本实用新型实施例的功率器件还可以具有改善的反向击穿电压，并且尺寸也可能减小。
Description
技术领域
本实用新型的实施例涉及半导体器件，尤其涉及集成有肖特基二极管的高压晶体管器件。
背景技术
在电源管理电路中经常需要用到这样的功率器件，其包括功率晶体管以及与该功率晶体管集成一体的肖特基二极管。图1A简要示意出一种功率转换电路100，该功率转换电路100基于包含有功率晶体管101以及与该功率晶体管串联的肖特基二极管103的功率器件PT而构建，用于将输入电压Vin转换为输出电压Vo。其中，功率器件101可以包括，例如：结型场效应晶体管（JFET），其具有栅极（G），该栅极G连接至电气地。因此，无需再为JFET的栅极提供复杂的控制电路。然而，JFET是“常开”器件，其可以双向导通电流，即其既可以从漏极（D）到源极（S）导通电流，也可以从源极（S）到漏极（D）导通电流。因此，如果没有肖特基二极管103，当输出电压Vo大于输入电压Vin时，将有电流反向地从输出Vo灌入输入Vin，而这种从输出Vo到输入Vin的电流反灌是需要避免的。肖特基二极管103正是用于阻止这种从输出Vo到输入Vin的电流反灌。
图1B示出了流经肖特基二极管103和JFET 101的电流IIN与输入电压Vin的关系曲线示意图，在JFET 101的栅极G和源极S均接电气地的情况下。由图1B可见，当输入电压Vin高于肖特基二极管103的正向导通电压VF时，电流IIN从输入Vin经由正向偏置的肖特基二极管103以及常开的JFET 101流向输出Vo。当Vin进一步增大，例如，增大到JFET 101的夹断电压VP，则JFET 101将被夹断，从而使得电流IIN几乎保持稳定，不再随Vin的增大而增大。在典型应用中，输出Vo并不一定接电气地，而是通常连接到下级电路，以为下级电路提供能量。在这种情况下，Vo将随着Vin增大而增大，直到Vin增大到JFET 101的夹断电压VP，Vo将几乎保持稳定不变。因此，JFET 101用于从输入Vin向下级电路提供能量，同时可以保护下级电路不受高压损坏，例如，输入电压Vin高于VP时，即便输入电压Vin继续增大，提供给下级电路的输出电压Vo也不再随输入电压增大而增大。当然，若输入电压增大到超过JFET 101的正向击穿电压VBF时，将有很大的电流从Vin流向JFET 101的栅极和/或Vo。由图1B还可见，若输入电压Vin相对于输出电压Vo为负值，即Vin小于Vo时，流经肖特基二极管103和JFET 101的电流IIN变成一个从输出Vo流向输入Vin的泄漏电流IOFF。当输入电压Vin相对于输出电压Vo负的值超过肖特基二极管103的击穿电压VBR时，将有很大的电流从Vo流向Vin。
图2示出了现有技术中的功率器件200的纵向剖面示意图。该功率器件200集成有JFET 202和肖特基二极管204。该功率器件200形成于P型衬底206上。N型阱区208形成于P型衬底206中。JFET 202和肖特基二极管204共用该P型衬底206及N型阱区208。P型掺杂区210形成于N型阱区208中，用作JFET 202的栅区；P+重掺杂区212形成于P型掺杂区210中，用作栅区210的欧姆接触。图2所示的功率器件200中，N型阱区208的位于栅区210左侧的部分形成JFET 202的漏区，N型阱区208的位于栅区210右侧的部分形成JFET 202的源区。N+重掺杂区214形成于N型阱区208的位于栅区210右侧的部分中，用作JFET 202源区的欧姆接触。漏极金属216、栅极金属218以及源极金属220形成于功率器件200的上表面上，并且分别与JFET 202的漏区、P+重掺杂区212以及N+重掺杂区214耦接，分别用作功率器件200的漏电极D、栅电极G和源电极S。
肖特基二极管204包括阴极208和阳极216，分别与JFET 202共用N型阱区208和漏极金属216。肖特基二极管204还进一步包括P+重掺杂区222，形成于肖特基二极管204的左右两侧。P+重掺杂区222用于形成融合肖特基二极管（merged Schottky Diode），从而降低肖特基二极管204的反向泄漏电流。若没有P+重掺杂区222，肖特基二极管204的反向泄漏电流将较高而不能被接受。
然而，P+重掺杂区222可能在功率器件200的导通状态及肖特基二极管204正向导通的情况下引起一些问题。事实上，功率器件200中存在寄生的双极型结型晶体管（BJT），该BJT分别以P+重掺杂区222、N型阱区208和P型衬底206为发射极、基极和集电极。在较大的正向导通电流下，P+重掺杂区222和N型阱区208之间的结可能正向偏置，使得该寄生BJT导通。在这种情况下，载流子将可能注入衬底206中，对与功率器件200共同集成在衬底206上的其它电路造成影响，这是所不希望的。
实用新型内容
针对现有技术中的一个或多个问题，本实用新型的实施例提供一种功率器件及其制造方法。
在本实用新型的一个方面，提出了一种功率器件，包括：半导体衬底以及形成于所述半导体衬底上的功率晶体管、沟槽阻隔体和肖特基二极管。其中，所述功率晶体管形成于所述半导体衬底中，并且包括漏区、源区、栅区以及耦接所述漏区的漏极金属；所述沟槽阻隔体，形成于所述功率晶体管的漏区中，并且包括第一沟槽和第二沟槽，所述第一沟槽和第二沟槽由所述漏区的一部分隔开；所述肖特基二极管，形成于所述第一沟槽和第二沟槽之间，具有阳极和阴极，所述的阳极包括所述漏极金属，所述阴极包括所述漏区的一部分。
根据本实用新型的实施例，所述第一沟槽和第二沟槽采用导电材料填充，所述导电材料通过介电材料与所述功率晶体管的漏区隔离。
根据本实用新型的实施例，所述漏极金属与所述第一沟槽和第二沟槽中填充的所述导电材料接触。
根据本实用新型的实施例，所述第一沟槽和第二沟槽的底部和侧壁覆盖有所述介电材料。
在本实用新型的另一方面，提出了一种功率器件，包括：半导体衬底，具有第一导电类型；阱区，形成于所述半导体衬底中，并且具有与所述第一导电类型相反的第二导电类型；栅区，形成于所述阱区中，并且具有所述的第一导电类型；第一沟槽和第二沟槽，形成于位于所述栅区一侧的所述阱区中，并且由所述阱区的一部分隔开；以及漏极金属，与将所述第一沟槽和第二沟槽隔开的那部分阱区接触，形成金属半导体接触。
根据本实用新型的实施例，所述第一沟槽和第二沟槽采用导电材料填充，所述导电材料通过介电材料与所述阱区隔离。
根据本实用新型的实施例，所述漏极金属与所述第一沟槽和第二沟槽中填充的所述导电材料接触。
根据本实用新型的实施例，所述第一沟槽和第二沟槽均具有底部和侧壁，并且所述第一沟槽和第二沟槽的底部和侧壁覆盖有所述介电材料。
根据本实用新型的实施例，所述阱区包括漏区和源区，其中，所述栅区位于所述漏区和所述源区之间。
根据本实用新型的实施例，所述功率器件进一步包括：栅欧姆接触区，形成于所述栅区中，并具有所述的第一导电类型；及源欧姆接触区，形成于位于所述栅区另一侧的所述阱区中，并且具有所述的第二导电类型。
根据本实用新型的实施例，所述第一沟槽和第二沟槽到所述栅区之间的距离大于所述栅区到所述源欧姆接触区之间的距离。
利用上述方案，根据本实用新型实施例的功率器件至少具有以下的一个或多个优点：具有良好的单向导通电流性能，即可以在需要导通电流的方向上（正向）允许电流流通，而在不希望导通电流的方向上（反向）阻止电流流通，并且反向泄漏电流较小；可以消除或者至少降低由寄生BJT引起的载流子注入衬底的问题，从而在应用过程中，降低了对与该功率器件集成于同一衬底上的其它电路造成的影响；可以具有改善的反向击穿电压，并且尺寸也可能减小；可以具有不对称的截止特性，也就是说，根据本实用新型实施例的功率器件从漏区到源区和/或栅区的方向上可以承受的电压大于从源区和/或栅区到漏区的方向上可以承受的电压。
附图说明
下面的附图有助于更好地理解接下来对本实用新型不同实施例的描述。这些附图并非按照实际的特征、尺寸及比例绘制，而是示意性地示出了本实用新型一些实施方式的主要特征。这些附图和实施方式以非限制性、非穷举性的方式提供了本实用新型的一些实施例。为简明起见，不同附图中具有相同功能的相同或类似的组件或结构采用相同的附图标记。
图1A示出了现有技术中一种功率转换电路100的示意图；
图1B示出了对应于图1A中所示功率转换电路100的电流与输入电压关系曲线示意图；
图2示出了现有技术中集成有JFET和融合肖特基二极管的功率器件200的纵向剖面示意图；
图3A示出了根据本实用新型一个实施例的功率器件300的纵向剖面示意图；
图3B示出了采用图3A中所示的功率器件300构建将输入电压Vin转换为输出电压Vo的转换电路的一种示例性实施方式；
图4A-4C示出了根据本实用新型一个实施例的功率器件的制造过程的示意图。
具体实施方式
下面将详细说明本实用新型的一些实施例。在接下来的说明中，一些具体的细节，例如实施例中的具体电路结构、器件结构、工艺步骤以及这些电路、器件和工艺的具体参数，都用于对本实用新型的实施例提供更好的理解。本技术领域的技术人员可以理解，即使在缺少一些细节或者其他方法、元件、材料等结合的情况下，本实用新型的实施例也可以被实现。
在本实用新型的说明书及权利要求书中，若采用了诸如“左、右、内、外、前、后、上、下、顶、之上、底、之下”等一类的词，均只是为了便于描述，而不表示组件/结构的必然或永久的相对位置。本领域的技术人员应该理解这类词在合适的情况下是可以互换的，例如，以使得本实用新型的实施例可以在不同于本说明书描绘的方向下仍可以运作。此外，“耦接”一词意味着以直接或者间接的电气的或者非电气的方式连接。“一个/这个/那个”并不用于特指单数，而可能涵盖复数形式。“在……内”可能涵盖“在……内/上”。“在一个实施例中/根据本实用新型的一个实施例”的用法并不用于特指同一个实施例中，当然也可能是同一个实施例中。除非特别指出，“或”可以涵盖“和/或”的意思。本领域技术人员应该理解以上对各用词的说明仅仅提供一些示例性的用法，并不用于限定这些词。
本实用新型的实施例公开了一种集成有功率晶体管和具有沟槽的肖特基二极管的功率器件。根据本实用新型的一个实施例，该功率器件包括：半导体衬底；形成于所述半导体衬底上的功率晶体管，其中所述功率晶体管包括漏区、源区、栅区以及耦接所述漏区的漏极金属；形成于所述功率晶体管漏区中的沟槽阻隔体，其中所述沟槽阻隔体包括第一沟槽和第二沟槽，所述第一沟槽和第二沟槽被所述漏区的一部分隔开；以及形成于所述第一沟槽和第二沟槽之间的肖特基二极管，其中所述肖特基二极管具有阳极和阴极，所述阳极包括所述漏极金属，所述阴极包括所述功率晶体管的所述第一沟槽和第二沟槽隔开的漏区部分。
根据本实用新型的一个实施例，所述第一沟槽和第二沟槽采用导电材料填充，所述导电材料通过介电材料与所述功率晶体管的漏区隔离。
根据本实用新型的一个实施例，所述第一沟槽和第二沟槽均具有底部和侧墙，其中所述第一沟槽和第二沟槽的底部和侧墙覆有介电材料。
根据本实用新型的一个实施例，所述功率晶体管的漏区金属与所述第一沟槽和第二沟槽中填充的导电材料接触。
根据本实用新型各实施例的功率器件，其中具有沟槽阻隔体的肖特基二极管的反向泄漏电流很小，该肖特基二极管可以阻止电流在所述功率器件中朝不希望的方向流通，而在该功率器件希望导通电流的方向上施加的电压稍大于所述肖特基二极管的正向导通电压（例如，0.3V）时，该肖特基二极管正向导通并允许电流在该功率器件希望导通电流的方向上流通。因而，根据本实用新型各实施例的集成有肖特基二极管的功率器件，具有良好的单向导通电流性能，即可以在需要导通电流的方向上（正向）允许电流流通，而在不希望导通电流的方向上（反向）阻止电流流通，并且反向泄漏电流较小。另外，与图1中示意出的现有技术中的功率器件PT不同，根据本实用新型各实施例的功率器件中不包含寄生的双极型结型晶体管BJT。因此，根据本实用新型实施例的集成有功率晶体管和具有沟槽阻隔体的肖特基二极管的功率器件可以消除或者至少降低由寄生BJT引起的载流子注入衬底的问题，从而在应用过程中，降低了对与该功率器件集成于同一衬底上的其它电路造成的影响。
图3A示出了根据本实用新型一个实施例的功率器件300的纵向剖面示意图。在图3A中所示的示例性实施例中，该功率器件300包括：结型场效应晶体管（JFET）301、肖特基二极管303和沟槽阻隔体305。根据本实用新型的图3A所示的示例性实施例，功率器件300具有P型衬底307，该P型衬底307可能包括P+型重掺杂衬底部分和P-型轻掺杂外延层部分。功率器件300还可以进一步包括形成于P型衬底307上的N型阱区309，以及形成于N型阱区309中的P型掺杂区311。本领域的普通技术人员应该可以理解，所述P型掺杂区311可以作为JFET 301的栅区，所述N型阱区309的位于所述P型掺杂区311左侧的部分可以作为JFET 301的漏区，而所述N型阱区309的位于所述P型掺杂区311右侧的部分可以作为JFET 301的源区。
根据本实用新型的一个示例性实施例，所述功率器件300还可以进一步包括N+型重掺杂区313，该N+型重掺杂区313形成于所述N型阱区309的位于所述P型掺杂区311右侧的部分中，并且接近其上表面A1。所述N+型重掺杂区313可以用作JFET 301的源区欧姆接触。根据本实用新型的一个示例性实施例，所述功率器件300还可以进一步包括P+型重掺杂区315，该P+型重掺杂区315形成于所述P型掺杂区311中，并且接近其上表面A1。所述P+型重掺杂区315可以用作JFET 301栅区的欧姆接触。根据本实用新型的一个示例性实施例，所述功率器件300还可以进一步包括漏极金属317、栅极金属319和源极金属321，它们分别用作功率器件300的漏电极D、栅电极G和源电极S，并且分别与所述JFET 301的漏区（所述N型阱区309的位于所述P型掺杂区311左侧的部分）、栅区（P型掺杂区311）和源区（所述N型阱区309的位于所述P型掺杂区311右侧的部分）耦接。根据本实用新型的一个实施例，所述栅极金属319通过与所述P+型重掺杂区315接触而耦接至所述栅区。类似地，所述源极金属321通过与所述N+型重掺杂区313接触而耦接至所述源区。
根据本实用新型的一个示例性实施例，JFET 301和肖特基二极管303共用P型衬底307以及N型阱区309。肖特基二极管303包括阴极和阳极，其中所述阴极包括所述N型阱区309，所述阳极包括所述漏极金属317，从而形成金属半导体接触。
根据本实用新型的一个示例性实施例，沟槽阻隔体305邻近所述肖特基二极管303而形成，用于阻挡肖特基二极管303的反向泄漏电流。根据本实用新型的一个示例性实施例，沟槽阻隔体305包括第一沟槽305T1和第二沟槽305T2，该第一沟槽305T1和第二沟槽305T2形成于所述N型阱区309的用作所述JFET 301的漏区的部分中，并且被JFET 301的漏区的一部分隔开，从而该第一沟槽305T1和第二沟槽305T2分别位于所述肖特基二极管303的左侧和右侧。根据本实用新型的一个示例性实施例，所述的第一沟槽305T1和第二沟槽305T2均具有底部和侧壁，并且它们的底部和侧壁覆盖有介电材料层305D，该第一沟槽305T1和第二沟槽305T2由导电材料305C填充。其中所述导电材料305C耦接所述漏极金属317。根据本实用新型的一个实施例，所述导电材料305C与所述漏极金属317部分接触。
根据本实用新型的一个示例性实施例，所述介电材料层305D可以包括二氧化硅。根据本实用新型的一个示例性实施例，所述导电材料305C可以包括掺杂的多晶硅。
图3B示出了采用图3A中所示的功率器件300构建将输入电压Vin转换为输出电压Vo的转换电路的一种示例性实施方式。如图3B所示，漏极金属317耦接输入电压Vin，栅极金属319耦接至电气地，源极金属321耦接输出端用于输出电压Vo。当输入电压Vin大于肖特基二极管303的正向导通电压时，功率器件300开始导通，电流从JFET 301的漏区流向JFET 301的源区（也就是从Vin流向Vo）。由于沟槽阻隔体305形成于所述第一沟槽305T1和第二沟槽305T2中，并且填充所述第一沟槽305T1和第二沟槽305T2的导电材料305C被介电材料层305D与所述N型阱区309隔离，因此，消除或者至少减小了在功率器件300中形成寄生双极性结型晶体管（BJT）的可能性。更进一步的，介电材料层305D阻止了从导电材料305C向N型阱区309的载流子注入，从而消除或者至少减小了由寄生BJT引起的载流子注入衬底307的问题。因此，根据本实用新型实施例的功率器件300，其集成有JFET 301和具有沟槽阻隔体305的肖特基二极管303，该功率器件300在导通状态及肖特基二极管303正向偏置（导通）的情况下，载流子注入衬底307的可能性被消除或者至少降低了。
在另一方面，当输出电压Vo大于输入电压Vin时，肖特基二极管303从正向偏置转变为反向偏置。由于只有电子参与形成电流，肖特基二极管303的反向恢复时间很短。当肖特基二极管303的阴极到阳极的电压随着Vo的增大而不断增大时，在所述第一沟槽305T1和第二沟槽305T2周围的N型阱区309中将开始形成耗尽区323。根据本实用新型的一个示例性实施方式，所述第一沟槽305T1和第二沟槽305T2的距离被设置为使得在所述第一沟槽305T1和第二沟槽305T2周围分别形成的耗尽区323在相对较低的肖特基二极管303反向偏置电压（例如：1V~10V）下融合。在所述第一沟槽305T1和第二沟槽305T2周围分别形成的耗尽区323相互融合后，肖特基二极管阴极（309）到阳极（317）的电压基本保持稳定，从而使肖特基二极管303受蔽护而不受输出电压Vo继续增大将对其造成的损害。
因此，根据本实用新型实施例的功率器件300中，沟槽阻隔体305不仅有益于降低所述肖特基二极管303的反向泄漏电流，而且有助于使所述肖特基二极管303在具有相对较小的阴极区域的情况下，便可以具有较高的反向击穿电压。因而也有助于提高功率器件300的击穿电压，并降低功率器件300的尺寸。另一方面，沟槽阻隔体305还有助于消除或者至少减小在功率器件300中形成寄生BJT的可能性，从而消除或者至少在很大程度上减小了不必要的载流子向功率器件300的衬底307注入的可能性。
根据本实用新型的一个示例性实施例，功率器件300具有不对称的截止特性，也就是说，功率器件300从漏电极317到源电极321和/或栅电极319的方向上可以承受的电压大于从源电极321和/或栅电极319到漏电极317的方向上可以承受的电压。为了实现这种不对称的截止特性，根据本实用新型的一个示例性实施例，位于沟槽阻隔体305到栅区311之间的N型阱区309部分的宽度（例如：图3A中的W1）大于位于栅区311到源区欧姆接触313之间的N型阱区309部分的宽度（例如：图3A中的W2），W1>W2。
以上基于图3A和图3B对根据本实用新型各实施例的功率器件300进行了说明，虽然在上述说明中，功率器件300示例性地包括JFET 301，与肖特基二极管303和沟槽隔离体305集成。然而上述对本实用新型各实施例的示例性说明并不用于对本实用新型进行限定，根据本实用新型的变形实施例及实施方式，功率器件300还可能包括其它类型的功率晶体管，例如金属氧化物半导体场效应晶体管（MOSFET）、双极型结型晶体管（BJT）等代替前述各实施例中的JFET 301与所述肖特基二极管303及沟槽阻隔体305集成。
根据本实用新型各实施例及其变形实施方式的功率器件的有益效果不应该被认为仅仅局限于以上所述的。根据本实用新型各实施例的这些及其它有益效果可以通过阅读本实用新型的详细说明及研究各实施例的附图被更好地理解。
图4A-4C示出了根据本实用新型一个实施例的制造集成有功率晶体管和沟槽阻隔肖特基二极管的功率器件的制造过程的示意图。
首先，如图4A所示，提供半导体衬底402，并在接下来的步骤中在所述半导体衬底402上形成功率晶体管404。根据本实用新型的一个示例性实施例，所述半导体衬底402可以包括P型半导体衬底。根据本实用新型的一个示例性实施例，所述半导体衬底402可以包括P+重掺杂半导体衬底层和形成于该P+重掺杂半导体衬底层上的P-轻掺杂半导体外延层。根据本实用新型的一个示例性实施例，所述功率晶体管404可以包括N沟道JFET。形成所述N沟道JFET 404的步骤可以包括：在所述半导体衬底402上形成N型阱区406；以及在所述N型阱区406中形成P型栅区408。根据本实用新型的一个示例性实施例，形成所述N沟道JFET 404的步骤可以进一步包括：在所述P型栅区408中形成P+重掺杂区410；以及在位于所述栅区408任一侧的所述N型阱区406的部分中形成N+重掺杂区412（例如：图4A中示意为在位于所述栅区408右侧的所述N型阱区406的部分中形成N+重掺杂区412）。
接下来，如图4B所示，在所述N型阱区406中形成沟槽阻隔体414。根据本实用新型的一个示例性实施例，形成所述沟槽阻隔体414的步骤包括：在位于所述栅区408没有形成N+重掺杂区412那一侧的所述N型阱区406的部分中形成第一沟槽406T1-和第二沟槽406T2；在所述第一沟槽406T1-和第二沟槽406T2的底部和侧壁上均形成覆盖介电材料层418；以及采用导电材料420填充所述第一沟槽406T1-和第二沟槽406T2。根据本实用新型的一个示例性实施例，所述介电材料层418包括二氧化硅。根据本实用新型的一个示例性实施例，所述导电材料420包括掺杂的多晶硅。
下一步，如图4C所示，在所述N型阱区406上形成介电层422，并且对该介电层422进行刻蚀以露出所述功率晶体管404栅区408的一部分（例如：所述P+重掺杂区410）、所述功率晶体管404源区的一部分（例如：所述N+重掺杂区412）、位于所述第一沟槽406T1-和第二沟槽406T2之间的N型阱区406部分、以及所述第一沟槽406T1-和第二沟槽406T2中的导电材料420的一部分。接着，在所述介电层422上形成金属层424并将该金属层424刻蚀形成漏极金属424D、栅极金属424G和源极金属424S，分别用作功率晶体管404的漏电极、栅电极以及源电极，并分别耦接露出的N型阱区406部分和导电材料420部分、露出的所述栅区408部分和露出的所述源区部分。根据本实用新型的示例性实施例，所述漏极金属424D、栅极金属424G和源极金属424S分别与露出的N型阱区406部分和导电材料420部分、露出的P+重掺杂区410和露出的N+重掺杂区412接触。在这一步中，同时也形成了肖特基二极管428，位于所述所述第一沟槽406T1-和第二沟槽406T2之间，所述漏极金属424D用作该肖特基二极管428的阳极，所述N型阱区406用作该肖特基二极管428的阴极。
以上基于图4A-4C对根据本实用新型实施例的制造集成有功率晶体管404和具有沟槽阻隔（406）的肖特基二极管428的功率器件400的制造过程的说明，并不用于将本实用新型限制在如上所描述的各具体实施方式中。根据本实用新型的变形实施例，所述半导体衬底402可以包括N型半导体衬底，所述功率晶体管404可以包括P沟道JFET。根据本实用新型另外的变形实施例，所述功率晶体管404可以包括其它类型的功率晶体管（例如MOSFET、BJT等），而不仅仅局限于JFET。
虽然本说明书中以集成有N沟道JFET和肖特基二极管的功率器件为例对根据本实用新型各实施例的集成有功率晶体管和肖特基二极管的功率器件及其制造过程进行了示意与描述，但这并不意味着对本实用新型的限定，本领域的普通技术人员应该理解这里给出的结构及原理同样适用于该功率器件中集成的功率晶体管为P沟道JFET、N沟道/沟道MOSFET、功率BJT、DMOS等高压晶体管器件及其它类型的半导体材料及半导体器件的情形。
虽然根据本实用新型的某些实施例，选用掺杂的多晶硅来填充沟槽阻隔体的第一沟槽和第二沟槽，然而这并不用于限定填充沟槽阻隔体的第一沟槽和第二沟槽的导电材料为掺杂的多晶硅。本领域的技术人员应该理解，填充沟槽阻隔体的第一沟槽和第二沟槽的导电材料可能包括与器件制造工艺相兼容的其它导电材料（例如：金属、其它半导体、半金属、和/或它们的组合物）。因此，这里的“掺杂的多晶硅”意味着涵盖了硅及除硅以外的其它导电材料及其组合物。
因此，上述本实用新型的说明书和实施方式仅仅以示例性的方式对本实用新型实施例的功率器件及其制造过程进行了说明，并不用于限定本实用新型的范围。对于公开的实施例进行变化和修改都是可能的，其他可行的选择性实施例和对实施例中元件的等同变化可以被本技术领域的普通技术人员所了解。本实用新型所公开的实施例的其他变化和修改并不超出本实用新型的精神和保护范围。
Claims (11)
1.一种功率器件，包括：
半导体衬底；
功率晶体管，形成于所述半导体衬底中，其中所述功率晶体管包括漏区、源区、栅区以及耦接所述漏区的漏极金属；
沟槽阻隔体，形成于所述功率晶体管的漏区中，其中所述沟槽阻隔体包括第一沟槽和第二沟槽，所述第一沟槽和第二沟槽由所述漏区的一部分隔开；以及
肖特基二极管，形成于所述第一沟槽和第二沟槽之间，其中所述肖特基二极管具有阳极和阴极，所述的阳极包括所述漏极金属，所述阴极包括所述漏区的一部分。
2.如权利要求1所述的功率器件，其特征在于，所述第一沟槽和第二沟槽采用导电材料填充，所述导电材料通过介电材料与所述功率晶体管的漏区隔离。
3.如权利要求2所述的功率器件，其特征在于，所述漏极金属与所述第一沟槽和第二沟槽中填充的所述导电材料接触。
4.如权利要求2所述的功率器件，其特征在于所述第一沟槽和第二沟槽的底部和侧壁覆盖有所述介电材料。
5.一种功率器件，包括：
半导体衬底，具有第一导电类型；
阱区，形成于所述半导体衬底中，并且具有与所述第一导电类型相反的第二导电类型；
栅区，形成于所述阱区中，并且具有所述的第一导电类型；
第一沟槽和第二沟槽，形成于位于所述栅区一侧的所述阱区中，并且由所述阱区的一部分隔开；以及
漏极金属，与将所述第一沟槽和第二沟槽隔开的那部分阱区接触，形成金属半导体接触。
6.如权利要求5所述的功率器件，其特征在于所述第一沟槽和第二沟槽采用导电材料填充，所述导电材料通过介电材料与所述阱区隔离。
7.如权利要求6所述的功率器件，其特征在于所述漏极金属与所述第一沟槽和第二沟槽中填充的所述导电材料接触。
8.如权利要求6所述的功率器件，其特征在于，所述第一沟槽和第二沟槽均具有底部和侧壁，并且所述第一沟槽和第二沟槽的底部和侧壁覆盖有所述介电材料。
9.如权利要求5所述的功率器件，其特征在于所述阱区包括漏区和源区，其中，所述栅区位于所述漏区和所述源区之间。
10.如权利要求5所述的功率器件，其特征在于进一步包括：
栅欧姆接触区，形成于所述栅区中，并具有所述的第一导电类型；及
源欧姆接触区，形成于位于所述栅区另一侧的所述阱区中，并且具有所述的第二导电类型。
11.如权利要求10所述的功率器件，其特征在于所述沟槽阻隔体到所述栅区之间的距离大于所述栅区到所述源欧姆接触区之间的距离。
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Legal Events
| Date | Code | Title | Description |
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| C14 | Grant of patent or utility model | ||
| GR01 | Patent grant | ||
| CF01 | Termination of patent right due to non-payment of annual fee |
Granted publication date: 20130130 Termination date: 20180704 |
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