CN202217260U - 一种多屏幕显示控制器 - Google Patents
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Abstract
本实用新型提供了一种多屏幕显示控制器，包括一CPU、一存储器、复数个屏幕、一显示控制器，所述显示控制器包括一控制信息处理模块、一数据读取控制电路、一图层缓存阵列、一图层通路选择器、m个图层叠加处理模块，所述m为任意自然数；所述CPU与控制信息处理模块连接，所述存储器、数据读取控制电路、图层缓存阵列、图层通路选择器顺次连接；所述图层通路选择器分别与m个图层叠加处理模块相连，所述每个图层叠加处理模块分别连接一屏幕。本实用新型可以支持多个屏幕同时显示不同的内容，又能在实际应用中没有用到设计最大屏幕数时，将所有可用资源进行复用，达到效率的最大化。
Description
【技术领域】
本实用新型涉及一种显示控制器，特别涉及一种多屏幕显示控制器。
【背景技术】
视觉是人类获取信息最重要的渠道，特别是在电子设备与用户进行人机交互时，直观的显示输出是最方便、最直观的交互方式。
随着当前显示技术和硬件水平的高速发展，用户对多屏幕同时显示的需求越来越大，有的用户需要多个屏幕联合显示一个巨大的图像以得到单个屏幕不能到达的清晰度；有的用户需要手持设备在连接电视或者电脑等终端时可以在手持设备和电视、电脑上同时显示不同的内容。总之，现在用户对单一设备需要支持多屏幕同时显示不同内容的需求越来越大。
而现有的技术中，如果需要支持多个屏幕显示，通常需要设计多个显示控制器，但是如果实际应用中没有用到设计支持的最大屏幕数量时，没有被用到的屏幕显示控制器都被闲置，造成资源的浪费。
【发明内容】
本实用新型要解决的技术问题，在于提供一种多屏幕显示控制器，其实现了多屏幕显示，且可根据需要灵活配置每个屏幕需要的图层数，将所有可用资源进行复用，达到效率最大化。
本实用新型是这样实现的：一种多屏幕显示控制器，包括一CPU、一存储器、复数个屏幕、一显示控制器，所述显示控制器包括一控制信息处理模块、一数据读取控制电路、一图层缓存阵列、一图层通路选择器、m个图层叠加处理模块，所述m为任意自然数；所述CPU与控制信息处理模块连接，所述存储器、数据读取控制电路、图层缓存阵列、图层通路选择器顺次连接；所述图层通路选择器分别与m个图层叠加处理模块相连，所述每个图层叠加处理模块分别连接一屏幕。
进一步地，所述图层缓存阵列包括n个图层缓存区，所述n为任意自然数；所述图层通路选择器包括与所述m个图层叠加处理模块一一对应连接的m组通路开关组，所述每一组通路开关组包括n个通路开关，所述每一个通路开关均分别对应连接一图层缓存区和一图层叠加处理模块。
本实用新型可以支持多个屏幕同时显示不同的内容，又能在实际应用中没有用到设计最大屏幕数时，将所有可用资源进行复用，达到效率的最大化。在多屏幕显示时，可以根据需要灵活配置每个屏幕需要的图层数，每个图层叠加处理模块最多可以处理全部图层的缓存资源。
【附图说明】
下面参照附图结合实施例对本实用新型作进一步的说明。
图1是本实用新型的结构示意图。
图2是本实用新型中图层通路选择器的结构示意图。
图3是本实用新型实施例1的结构示意图。
图4是本实用新型实施例2的结构示意图。
图5是本实用新型实施例3的结构示意图。
【具体实施方式】
如图1至图2所示，一种多屏幕显示控制器，包括CPU、存储器1、一显示控制器2、第一屏幕至第m屏幕，所述m为任意自然数，所述显示控制器2包括一控制信息处理模块21、一数据读取控制电路22、一图层缓存阵列23、一图层通路选择器24、m个图层叠加处理模块25，所述m为任意自然数；所述CPU与控制信息处理模块21连接，所述存储器1、数据读取控制电路22、图层缓存阵列23、图层通路选择器24顺次连接。所述图层通路选择器24分别与m个图层叠加处理模块25相连。所述每个图层叠加处理模块25分别和一屏幕相连。
如图2所示，所述图层缓存阵列23包括n个图层缓存区231，所述n为任意自然数；所述图层通路选择器24包括与所述m个图层叠加处理模块25一一对应连接的m组通路开关组241，所述每一组通路开关组241包括n个通路开关2411，所述每一个通路开关2411均分别对应连接一图层缓存区231和一图层叠加处理模块25。
所述CPU，负责对所述显示控制器2进行配置，配置的信息包括：需要支持的屏幕的个数，每个屏幕的大小和控制时序信息，每个屏幕所需要使用的图层缓存阵列23中的图层缓存区231、每个图层在存储器1中的地址。
所述存储器1，负责存储待显示的图像数据。
所述显示控制器2中的控制信息处理模块21，负责接收并存储CPU的配置信息，并将该配置信息传递到各个内部单元。
所述数据读取控制电路22，负责从存储器1读取所有图层的数据，并将数据存储到图层缓存阵列23里对应的图层缓存区231中，每个图层缓存区231存储一个图层数的数据。
所述通路选择器24，负责根据CPU的配置信息将对应的图层缓存区231和图层叠加处理模块25相连接。根据控制信息处理模块21中存储的1比特的开关控制位控制每一个通路开关2411的接通或断开，每个图层叠加处理模块25都由n比特的开关控制位控制。m个图层叠加处理模块25就需要m*n个通路开关2411和与之对应的开关控制位。
下面举3个具体实施例说明在不同的应用场景中实现灵活配置每个屏幕需要显示的图层数，待显示的图像数据分别缓存在8个图层缓存区。
实施例1，如图3所示，使用第一屏幕和第二屏幕同时显示，两个屏幕的负载平衡，第一屏幕显示图层缓存区1至图层缓存区4的图像数据，第二屏幕显示缓存区5至图层缓存区8的图像数据。图层通路选择器24中，第一组通路开关组241中，第1～4个通路开关2411接通，其余开关断开，第二组通路开关组241中，第1～4个通路开关2411断开，第5～8个通路开关2411接通。
实施例2，如图4所示，使用第一屏幕和第二屏幕同时显示，第一屏幕显示图层缓存区1至图层缓存区2的图像数据，第二屏幕显示图层缓存区3至图层缓存区8的图像数据，其中第一屏幕的显示内容较简单，第二屏幕的显示内容较复杂。图层通路选择器24中，第一组通路开关组241的第1～2个通路开关2411接通，其余开关断开，第二组通路开关组241中，第1～2个通路开关2411断开，第3～8个通路开关2411接通。
实施例3，如图5所示，只使用第一屏幕显示，所有的图层资源都通过第一屏幕显示。图层通路选择器24中，第一组通路开关组241的第1～8个通路开关2411全部接通，第二组通路开关组241全部关闭。
在其它的实施例中，可以根据需求通过控制图层通路选择器24中各个通路开关的接通与关闭达到相应的显示效果。
以上所述，仅为本实用新型较佳实施例而已，故不能依此限定本实用新型实施的范围，即依本实用新型专利范围及说明书内容所作的等效变化与修饰，皆应仍属本实用新型涵盖的范围内。
Claims (2)
1.一种多屏幕显示控制器，包括一CPU、一存储器、复数个屏幕，其特征在于：还包括一显示控制器，所述显示控制器包括一控制信息处理模块、一数据读取控制电路、一图层缓存阵列、一图层通路选择器、m个图层叠加处理模块，所述m为任意自然数；所述CPU与控制信息处理模块连接，所述存储器、数据读取控制电路、图层缓存阵列、图层通路选择器顺次连接；所述图层通路选择器分别与m个图层叠加处理模块相连，所述每个图层叠加处理模块分别连接一屏幕。
2.根据权利要求1所述的一种多屏幕显示控制器，其特征在于：所述图层缓存阵列包括n个图层缓存区，所述n为任意自然数；所述图层通路选择器包括与所述m个图层叠加处理模块一一对应连接的m组通路开关组，所述每一组通路开关组包括n个通路开关，所述每一个通路开关均分别对应连接一图层缓存区和一图层叠加处理模块。
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Address after: 350000 Fuzhou Gulou District, Fujian, software Avenue, building 89, No. 18 Patentee after: FUZHOU ROCKCHIP ELECTRONICS CO., LTD. Address before: 350000 Fuzhou Gulou District, Fujian, software Avenue, building 89, No. 18 Patentee before: Fuzhou Rockchip Semiconductor Co., Ltd. |
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| CP01 | Change in the name or title of a patent holder |
Address after: 350000 building, No. 89, software Avenue, Gulou District, Fujian, Fuzhou 18, China Patentee after: Ruixin Microelectronics Co., Ltd Address before: 350000 building, No. 89, software Avenue, Gulou District, Fujian, Fuzhou 18, China Patentee before: Fuzhou Rockchips Electronics Co.,Ltd. |
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