CN114579071A - 一种基于多个jpeg图层的叠加显示电路及其实现方法 - Google Patents

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Abstract

本发明提供一种基于多个JPEG图层的叠加显示电路及其方法,该电路包括接收模块、JPEG图像解压模块、Blending图像处理模块、存储器以及显示单元,接收模块用于接收多个压缩图像,并将多个压缩图像数据传输至JPEG图像解压模块,JPEG图像解压模块根据待解压缩图像的数量,通过分时复用方式分别解压各个压缩图像的一个block数据,并将解压出来的一个block数据作为一个图层块放到对应的存储器中,在同时解压完多个图层块后,把多个图层块通过Blending图像处理模块做Blending图像叠加处理,Blending图像处理模块将叠加处理后的图像信息传输至显示单元进行实时显示。应用本发明可以解决现有技术中存在的问题,可以实现方案硬件电路和存储资源消耗少,且图像处理显示速度快的目的。

Description

一种基于多个JPEG图层的叠加显示电路及其实现方法
技术领域
本发明涉及电子与信息技术领域,具体涉及一种基于多个JPEG图层的叠加显示电路以及应用该电路的实现方法。
背景技术
人机交互界面UI显示,是系统和用户之间进行交互和信息交换的桥梁。为了追求显示的多样丰富性,以便于人员对芯片的操作与理解,通常会用到Alpha-Blending叠加技术。所谓的Alpha-Blending叠加技术,是按照“Alpha”混合向量值混合源图层和目标图层的一种图像处理技术。
同时为了释放芯片里的CPU处理图像的算力,以便于芯片里的CPU可以实时处理更多突发任务和事件,需要由专门的硬件电路实现多图层的叠加图像处理工作,并把处理完的图像送到显示接口。
目前,现有的一种技术方案通过多个jpeg解压电路同时解压对应图像,并把实时解压的图像进行叠加处理并送显。不过由于该技术需要消耗的电路资源比较大,造成的成本较高。
另外,现有的另一种技术方案是通过一个JPEG解压电路同时解压多个图像,并把多个图像数据实时的存在存储器中,等到每个图像的一帧数据都解压完并存储起来之后,再从存储器里把多个图像的数据进行叠加处理并送显。然而,该技术需要很大的存储空间,消耗很大的存储资源,并且图像处理速度不能实时,从而影响最终的送显速度。
发明内容
为了克服现有技术的不足,本发明的目的在于提供一种基于多个JPEG图层的叠加显示电路及其方法,该系统和方法可以解决现有技术中成本高、消耗存储资源、实时性差等问题,可以实现方案硬件电路和存储资源消耗少,且图像处理显示速度快的目的。
为解决上述问题,本发明所采用的技术方案如下:
一种基于多个JPEG图层的叠加显示电路,包括:接收模块、JPEG图像解压模块、Blending图像处理模块、存储器以及显示单元,所述接收模块用于接收多个压缩图像,并将多个压缩图像数据传输至所述JPEG图像解压模块,所述JPEG图像解压模块根据待解压缩图像的数量,通过分时复用方式分别解压各个压缩图像的一个block数据,并将解压出来的一个block数据作为一个图层块放到对应的存储器中,在同时解压完多个图层块后,把多个图层块通过所述Blending图像处理模块做Blending图像叠加处理,所述Blending图像处理模块将叠加处理后的图像信息传输至所述显示单元进行实时显示。
进一步的方案是,所述接收模块包括FIFO寄存器、控制器以及输出控制模块,所述控制器分别与所述FIFO寄存器、输出控制模块连接。
更进一步的方案是,所述显示单元包括接口送显模块以及显示屏,所述Blending图像处理模块与所述接口送显模块连接,所述接口送显模块与所述显示屏连接。
一种基于多个JPEG图层的叠加显示电路的实现方法,该系统应用于上述的一种基于多个JPEG图层的叠加显示电路进行控制,该方法包括;选定有至少两个图层块相互叠加的区域;通过接收模块接收多个压缩图像,并将多个压缩图像数据传输至JPEG图像解压模块,JPEG图像解压模块通过分时复用方式分别解压各个压缩图像的一个block数据,并将解压出来的一个block数据作为一个图层块放到对应的存储器中,待同时解压完N个图层块后,把N个图层块通过Blending图像处理模块做Blending图像叠加处理,得到N个图层块叠加融合后的一个图层块数据,并将叠加融合后的图层进行叠加显示。
进一步的方案是,所述Blending图像叠加处理包括将每个图层按照对应比例因子值Alpha1-AlphaN做乘加运算,即layer1*Alpha1+layer2*Alpha2…layerN*AlphaN,以上数据经过Blending图像处理模块后得到N个图层叠加融合后的一个图层块YUV数据。
更进一步的方案是,所述接收模块包括以下工作状态:idle:空闲状态,状态机初始默认状态;send_addr:发送取数据地址命令;rcv_data:接收数据状态,只有处于该状态,才能响应数据接收;wait_read_buff:该状态下,FIFO寄存器已满,等待JPEG图像解压模块读取数据,同时向总线发送full信号。
更进一步的方案是,在接收模块开始工作之前,通过config配置好送显模式,以及压缩图像地址后,发送开始接收数据命令start,接收模块的状态机从idle状态跳转到send_addr状态;在向总线发送取数据地址命令后直接跳到rcv_data状态,开始接收总线从存储器发送来的压缩图像数据并写入到FIFO寄存器中。
更进一步的方案是,在接收数据时,若收到接收完一个block数据的结束信号则切换到另一个压缩图像的存储器地址,并通过JPEG图像解压模块把图像解压到相应的图层块中;然后,发送update_addr命令返回send_addr状态,并向总线发送full握手信号以停止发送数据;若FIFO寄存器已满,则发送prefull命令,并跳转到wait_read_buff状态;若此时图像一帧已经传送完毕,则发送framend命令,并跳转到idle状态;在wait_read_buff状态下,不再接收总线发来的数据;当buff处于空或者半满状态,则跳转到send_addr状态。
更进一步的方案是,所述update_addr命令的产生包括:当多个图层块做Blending图像叠加处理时,则在接收到restart mark标记和image end标记时,发送update_addr命令,并在接收到第一个image end标记时,把image end标记信息给丢弃掉;当一个图层块与一个YUV数据做Blending图像叠加处理时,则当接收到的buff满时,发送update_addr命令,开始接收另一个图层块的数据。
更进一步的方案是,所述Blending图像叠加处理使用alpha-blending算法实现,其表示为公式(1):
Result image=(layer A*AR+layer B*BR+layer C*CR+…layer N*NR)>>8 (1)
其中,AR是A层图像的8bit的alpha值,通过配置config得到,NR为N层图像的8bit的alpha值,layer N则由YUV数据3个8bit图像像素点组成。
因此,相比现有技术,本发明具有以下有益效果:
1、基于JPEG图像块的blending处理,以实现图层叠加处理,从而减少存储器的开销。
2、采用分时复用一个JPEG图像解压模块,可以实现多个JPEG压缩图像同时解压并处理目的,以减少硬件电路的开销。
3、实时显示性更高,无需CPU介入,可以完成由硬件电路实现边解压JPEG图像边按块blending,并把blending处理完成图像图层块按行扫描的方式实时送显。
所以,本发明可以有效降低芯片设计的制造成本,减少设计电路的面积以及内置存储器的开销,从而提高芯片的竞争力。
下面结合附图和具体实施方式对本发明作进一步详细说明。
附图说明
图1是本发明一种基于多个JPEG图层的叠加显示电路实施例的原理图。
图2是本发明一种基于多个JPEG图层的叠加显示电路实施例中接收模块的原理图。
图3是本发明一种基于多个JPEG图层的叠加显示电路的实现方法实施例中接收模块的接收控制状态机的原理图。
图4是本发明一种基于多个JPEG图层的叠加显示电路的实现方法实施例中接收控制关键信号的时序图。
图5是本发明一种基于多个JPEG图层的叠加显示电路的实现方法实施例中alpha-blending算法的实现原理图。
具体实施方式
一种基于多个JPEG图层的叠加显示电路实施例:
参见图1,一种基于多个JPEG图层的叠加显示电路,包括:接收模块10、JPEG图像解压模块20、Blending图像处理模块30、存储器以及显示单元,接收模块10用于接收多个压缩图像,并将多个压缩图像数据传输至JPEG图像解压模块20,JPEG图像解压模块20根据待解压缩图像的数量,通过分时复用方式分别解压各个压缩图像的一个block数据,并将解压出来的一个block数据作为一个图层块放到对应的存储器中,在同时解压完多个图层块后,把多个图层块通过Blending图像处理模块30做Blending图像叠加处理,Blending图像处理模块30将叠加处理后的图像信息传输至显示单元进行实时显示。
如图2所示,接收模块10包括FIFO寄存器、控制器以及输出控制模块,控制器分别与FIFO寄存器、输出控制模块连接。
在本实施例中,显示单元包括接口送显模块40以及显示屏,Blending图像处理模块30与接口送显模块40连接,接口送显模块40与显示屏连接。
一种基于多个JPEG图层的叠加显示电路的实现方法实施例:
一种基于多个JPEG图层的叠加显示电路的实现方法,该系统应用于上述的一种基于多个JPEG图层的叠加显示电路进行控制,该方法包括;
首先,选定有至少两个图层块相互叠加的区域。
然后,通过接收模块10接收多个压缩图像,并将多个压缩图像数据传输至JPEG图像解压模块20,JPEG图像解压模块20通过分时复用方式分别解压各个压缩图像的一个block数据,并将解压出来的一个block数据作为一个图层块放到对应的存储器中,待同时解压完N个图层块后,把N个图层块通过Blending图像处理模块30做Blending图像叠加处理,得到N个图层块叠加融合后的一个图层块数据,并将叠加融合后的图层进行叠加显示。
在本实施例中,Blending图像叠加处理包括将每个图层按照对应比例因子值Alpha1-AlphaN做乘加运算,即layer1*Alpha1+layer2*Alpha2…layerN*AlphaN,以上数据经过Blending图像处理模块30后得到N个图层叠加融合后的一个图层块YUV数据。
具体的,当接收模块10时分从存储器中把压缩图像数据搬到JPEG图像解压模块20,JPEG图像解压模块20通过分时复用方式,分别解压各个压缩图像的一个block数据,并将解压出来的一个block数据作为一个图层块放到对应的存储器中。其中,一个图层块大小为8*8*2=128B YUV数据,比起要完全解压完一帧的压缩图像数据(1024*768*2=1572864BYUV)要少了上万倍的存储空间。
等同时解压完N块图层之后,把N块图层做blending图像叠加处理:处理公式为每块图层按照对应比例因子值Alpha1、Alpha2…AlphaN做乘加运算,即layer1*Alpha1+layer2*Alpha2…layerN*AlphaN经过Blending图像处理模块30后得到N个图层叠加融合后的一个图层块YUV数据(128B)。然后,通过接口送显模块40接收到该数据后根据接口时序要求把数据送到显示屏中,进行实时显示。
在本实施例中,接收模块10包括FIFO寄存器、控制器以及输出控制模块,控制器的接收控制状态机如图3所示,其包括以下工作状态:
idle:空闲状态,状态机初始默认状态;
send_addr:发送取数据地址命令;
rcv_data:接收数据状态,只有处于该状态,才能响应数据接收;
wait_read_buff:该状态下,FIFO寄存器已满(buff已经满了不能再接收数据,),只能等待JPEG图像解压模块20读取数据,同时向总线发送full信号。
在接收模块10开始工作之前,通过config配置好送显模式,以及压缩图像地址后,发送开始接收数据命令start,接收模块10的状态机从idle状态跳转到send_addr状态。
在向总线发送取数据地址命令后直接跳到rcv_data状态,开始接收总线从存储器发送来的压缩图像数据并写入到FIFO寄存器中。
在接收数据时,若收到接收完一个block数据的结束信号则切换到另一个压缩图像的存储器地址,并通过JPEG图像解压模块20把图像解压到相应的图层块中;然后,发送update_addr命令返回send_addr状态,并向总线发送full握手信号以停止发送数据。
若FIFO寄存器已满,则发送prefull命令,并跳转到wait_read_buff状态;若此时图像一帧已经传送完毕,则发送framend命令,并跳转到idle状态;
在wait_read_buff状态下,不再接收总线发来的数据;当buff处于空或者半满状态(具体由软件配置决定),则跳转到send_addr状态。
在本实施例中,如图4所示,update_addr命令的产生包括:
当多个图层块做Blending图像叠加处理时,则在接收到restart mark标记和image end标记时,发送update_addr命令,并在接收到第一个image end标记时,把imageend标记信息给丢弃掉。
当一个图层块与一个YUV数据做Blending图像叠加处理时,则当接收到的buff满时,发送update_addr命令,开始接收另一个图层块的数据,如此反复交替。
当收到image_ack,receive_valid拉高,此时开始接收数据,当收到image_last信号或者pre_full信号时,停止接收数据,receive_valid拉低。
如图5所示,Blending图像叠加处理使用alpha-blending算法实现,其表示为公式(1):
Result image=(layer A*AR+layer B*BR+layer C*CR+…layer N*NR)>>8 (1)
其中,AR是A层图像的8bit的alpha值,通过配置config得到,依次类推NR为N层图像的8bit的alpha值,layer N则由YUV数据3个8bit图像像素点组成。
因此,相比现有技术,本发明具有以下有益效果:
1、基于JPEG图像块的blending处理,以实现图层叠加处理,从而减少存储器的开销。
2、采用分时复用一个JPEG图像解压模块20,可以实现多个JPEG压缩图像同时解压并处理目的,以减少硬件电路的开销。
3、实时显示性更高,无需CPU介入,可以完成由硬件电路实现边解压JPEG图像边按块blending,并把blending处理完成图像图层块按行扫描的方式实时送显。
所以,本发明可以有效降低芯片设计的制造成本,减少设计电路的面积以及内置存储器的开销,从而提高芯片的竞争力。
上述实施方式仅为本发明的优选实施方式,不能以此来限定本发明保护的范围,本领域的技术人员在本发明的基础上所做的任何非实质性的变化及替换均属于本发明所要求保护的范围。

Claims (10)

1.一种基于多个JPEG图层的叠加显示电路,其特征在于,包括:
接收模块、JPEG图像解压模块、Blending图像处理模块、存储器以及显示单元,所述接收模块用于接收多个压缩图像,并将多个压缩图像数据传输至所述JPEG图像解压模块,所述JPEG图像解压模块根据待解压缩图像的数量,通过分时复用方式分别解压各个压缩图像的一个block数据,并将解压出来的一个block数据作为一个图层块放到对应的存储器中,在同时解压完多个图层块后,把多个图层块通过所述Blending图像处理模块做Blending图像叠加处理,所述Blending图像处理模块将叠加处理后的图像信息传输至所述显示单元进行实时显示。
2.根据权利要求1所述的叠加显示电路,其特征在于:
所述接收模块包括FIFO寄存器、控制器以及输出控制模块,所述控制器分别与所述FIFO寄存器、输出控制模块连接。
3.根据权利要求1所述的叠加显示电路,其特征在于:
所述显示单元包括接口送显模块以及显示屏,所述Blending图像处理模块与所述接口送显模块连接,所述接口送显模块与所述显示屏连接。
4.一种基于多个JPEG图层的叠加显示电路的实现方法,其特征在于,该方法应用于如权利要求1至3任一项所述的一种基于多个JPEG图层的叠加显示电路进行控制,该方法包括:
选定有至少两个图层块相互叠加的区域;
通过接收模块接收多个压缩图像,并将多个压缩图像数据传输至JPEG图像解压模块,JPEG图像解压模块通过分时复用方式分别解压各个压缩图像的一个block数据,并将解压出来的一个block数据作为一个图层块放到对应的存储器中,待同时解压完N个图层块后,把N个图层块通过Blending图像处理模块做Blending图像叠加处理,得到N个图层块叠加融合后的一个图层块数据,并将叠加融合后的图层进行叠加显示。
5.根据权利要求4所述的方法,其特征在于:
所述Blending图像叠加处理包括将每个图层按照对应比例因子值Alpha1-AlphaN做乘加运算,即layer1*Alpha1+layer2*Alpha2…layerN*AlphaN,以上数据经过Blending图像处理模块后得到N个图层叠加融合后的一个图层块YUV数据。
6.根据权利要求4所述的方法,其特征在于:
所述接收模块包括以下工作状态:
idle:空闲状态,状态机初始默认状态;
send_addr:发送取数据地址命令;
rcv_data:接收数据状态,只有处于该状态,才能响应数据接收;
wait_read_buff:该状态下,FIFO寄存器已满,等待JPEG图像解压模块读取数据,同时向总线发送full信号。
7.根据权利要求6所述的方法,其特征在于:
在接收模块开始工作之前,通过config配置好送显模式,以及压缩图像地址后,发送开始接收数据命令start,接收模块的状态机从idle状态跳转到send_addr状态;
在向总线发送取数据地址命令后直接跳到rcv_data状态,开始接收总线从存储器发送来的压缩图像数据并写入到FIFO寄存器中。
8.根据权利要求7所述的方法,其特征在于:
在接收数据时,若收到接收完一个block数据的结束信号则切换到另一个压缩图像的存储器地址,并通过JPEG图像解压模块把图像解压到相应的图层块中;然后,发送update_addr命令返回send_addr状态,并向总线发送full握手信号以停止发送数据;
若FIFO寄存器已满,则发送prefull命令,并跳转到wait_read_buff状态;若此时图像一帧已经传送完毕,则发送framend命令,并跳转到idle状态;
在wait_read_buff状态下,不再接收总线发来的数据;当buff处于空或者半满状态,则跳转到send_addr状态。
9.根据权利要求8所述的方法,其特征在于:
所述update_addr命令的产生包括:
当多个图层块做Blending图像叠加处理时,则在接收到restart mark标记和imageend标记时,发送update_addr命令,并在接收到第一个image end标记时,把image end标记信息给丢弃掉;
当一个图层块与一个YUV数据做Blending图像叠加处理时,则当接收到的buff满时,发送update_addr命令,开始接收另一个图层块的数据。
10.根据权利要求4至9任一项所述的方法,其特征在于:
所述Blending图像叠加处理使用alpha-blending算法实现,其表示为公式(1):
Result image=(layer A*AR+layer B*BR+layer C*CR+…layer N*NR)>>8 (1)
其中,AR是A层图像的8bit的alpha值,通过配置config得到,NR为N层图像的8bit的alpha值,layer N则由YUV数据3个8bit图像像素点组成。
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Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20050268226A1 (en) * 2004-05-28 2005-12-01 Lipsky Scott E Method and system for displaying image information
CN202217260U (zh) * 2011-09-08 2012-05-09 福州瑞芯微电子有限公司 一种多屏幕显示控制器
CN104134432A (zh) * 2014-08-04 2014-11-05 浪潮(北京)电子信息产业有限公司 一种车载lcd控制装置及方法
US20160247306A1 (en) * 2015-02-24 2016-08-25 Samsung Electronics Co., Ltd. Apparatus and method for controlling display in electronic device having processors

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20050268226A1 (en) * 2004-05-28 2005-12-01 Lipsky Scott E Method and system for displaying image information
CN202217260U (zh) * 2011-09-08 2012-05-09 福州瑞芯微电子有限公司 一种多屏幕显示控制器
CN104134432A (zh) * 2014-08-04 2014-11-05 浪潮(北京)电子信息产业有限公司 一种车载lcd控制装置及方法
US20160247306A1 (en) * 2015-02-24 2016-08-25 Samsung Electronics Co., Ltd. Apparatus and method for controlling display in electronic device having processors

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