CN202058415U - 一种单色硅基oled显示器的驱动电路 - Google Patents

Abstract

本实用新型公开了一种单色硅基OLED显示器的驱动电路，包括：像素单元电路矩阵、行驱动器电路、列驱动器电路、分频分流器电路、Vcom反转开关电路和OLED发光层；其中列驱动器电路分为镜像对称的上下两组电路，分别驱动奇偶数据线；其中，所述行扫描驱动器位于驱动电路的左部，具有606个驱动单元，依照帧触发时钟和扫描时钟脉冲同步控制，依次驱动；其中，所述列驱动器电路包括垂直移位寄存器、第一级锁存器、第二级锁存器和选择传输器。

Description

一种单色硅基OLED显示器的驱动电路

技术领域

本申请涉及微电子显示技术，更具体地，本申请涉及一种单色硅基OLED显示器的驱动电路。 

背景技术

有机发光二极管(Organic Light Emitting Diode，OLED)为电流驱动器件，要求背板电路能提供精确、稳定的电流控制。早期的有源背板采用的是非晶硅(amorphous silicon，a-Si)TFT技术，但是由于非晶硅的迁移率较低及阈值电压的不稳定等原因，使其没有获得成功。相比非晶硅而言，低温多晶硅(Low Temperature Poly-Silicon，LTPS)TFT的迁移率要高得多，但是阈值电压仍存在均匀性不一致的问题，所以需要在像素电路的设计中进行一定的电路补偿，目前已有的OLED显示器大部分采用的都是LTPS TFT背板技术。而在大尺寸OLED量产方面，LTPS的制造技术尚不成熟，没有统一的标准生产线，要制备LTPS TFT背板必须投巨资建造专用生产线。 

硅基OLED微型显示器件采用单晶硅CMOS基板技术，相比其他基板技术而言，单晶硅具有载流子迁移率高、阈值电压稳定等优点，可以将像素矩阵及周边驱动电路等都集成在显示屏上，大大减小整个显示系统的体积及成本，同时成熟的CMOS集成电路工艺也为硅基OLED微型显示器件的基板制作提供了便利，且单晶硅CMOS基板生产工艺流程标准化，仅需支付小额的加工费用就可 以在任何一家标准的单晶硅CMOS基板生产线上制备基板；同时硅基OLED基板上的每个像素面积可以做得很小，利于显示分辨率的提高。在单晶硅CMOS基板芯片的设计上，主要考虑的是如何精确控制流过OLED的电流，从而实现良好的灰度图象显示。同时芯片功耗也非常重要，因为硅基OLED微型显示器件也就可以用于便携式近眼显示，由普通手机电池供电，低功耗电路可延长电池的使用寿命。 

实用新型内容

为精确控制OLED的电流并且降低电路功耗，克服上述的现有LTPS TFT背板像素电路存在的缺陷，本申请提供一种基于单晶硅CMOS基板技术的一种硅基OLED显示屏和驱动电路。 

根据本申请的一个方面，提供一种单色硅基OLED显示器的驱动电路，包括：像素单元电路矩阵、行驱动器电路、列驱动器电路、分频分流器电路、Vcom反转开关电路和OLED发光层；其中列驱动器电路分为镜像对称的上下两组电路，分别驱动奇偶数据线；其特征在于，所述行扫描驱动器位于驱动电路的左部，具有606个驱动单元，依照帧触发时钟和扫描时钟脉冲同步控制，依次驱动；其中，所述列驱动器电路包括垂直移位寄存器、第一级锁存器、第二级锁存器和选择传输器。 

行驱动器电路和列驱动器电路都采用电平移位器，通过标准3.3V低电压逻辑控制实现5V高压输出，驱动象素显示矩阵工作。 

所述行驱动器电路包括水平移位寄存器、电平移位器和扫描缓冲驱动器；所述水平移位寄存器是单相输入的606位移位寄存器；电平移位器接收扫描信 号，产生扫描电平，并通过扫描缓冲驱动器增强驱动能力，来寻址每一行中的864个象素单元电路。 

所述分频分流器电路用于实现32组数据并行输入到像素单元显示矩阵；所述像素单元电路矩阵包括多个像素单元电路，所述像素单元电路包括4个PMOS管，用于向OLED发光层提供驱动脉冲电流；所述像素单元电路通过电流脉冲宽度的累积来实现灰度调制。 

所述电平移位器电路包括电平转移电路和驱动缓冲电路，用于实现信号电压从低电平向高电平的位移。 

所述分频分流器电路包括分频电路和分流电路，分频电路将显示时钟的频率减半，分流电路内置两级锁存器，对应于该减半频率来对串行输入的两位数据实现同步并行输入。 

所述Vcom反转开关电路包括反转信号输入电路、电平位移电路和输出缓存电路，输出电压值为0V和5V，最大驱动电流值约300mA。 

综上所述，通过应用本实用新型，可以减少整机空间的尺寸，降低整机功耗。 

附图说明

图1示出根据本实用新型的显示屏区域示意图； 

图2示出时分脉宽调制帧周期的示意图； 

图3示出显示屏的功能结构示意图； 

图4示出像素单元电路的示意图； 

图5示出行扫描器电路的示意图； 

图6示出列扫描器电路的示意图； 

图7示出电平移位器电路的示意图； 

图8示出分频分流器电路的示意图； 

图9示出Vcom反转开关电路的示意图； 

图10示出图3所示结构的版图布图； 

图11示出图4所示的像素电路的详细结构。 

具体实施方式

下面结合附图和具体实施例对本实用新型提供的一种单色硅基OLED显示器的驱动电路进行详细描述。 

对于本申请所述的单色OLEDoS显示芯片(SVGA)的规格，其一般特征包括：单色硅基OLED(OLEDoS)显示芯片拥有864×606像素分辨率，按照时分脉宽调制模式实现灰度显示，以备近眼显示应用。输入该芯片的视频数字信号为16b子场数据流，即按照子场数目从1-8的不同设置，灰度可实现2-256级灰度显示。OLEDoS芯片可输入的数字信号的低电位为V_L，可以取0V，高电位为V_H，可以取3.3V。 

总的来说，本申请的显示芯片具有的特征包括：适合于单色显示用途的SVGA像素分辨率；根据接口电路输入信号子场设置可进行2-256级灰度显示；采用CMOS工艺实现OLED发光层负载驱动；像素单元中OELD发光层驱动管的工作状态可自由外置；对OLED发光层实现了脉冲驱动模式；无固定像素时钟设置要求，形成视频数据传输通道；OLEDoS芯片上集成行列驱动器，其中包括输入信号缓存电路模块、电压分配电路模块、接口静电防护电路模块，分频器电路模块，行存储器模块等；显示图像可跟随输入数据输入方式进行对称镜面转换。 

图1示出显示屏区域的规划图，如图1所示，该区域包括切割区和布图区，布图区中包括焊盘区、密封区以及设计像素区，设计像素区域也就是显示区域。图中所示尺寸为设计的最优尺寸，但这并不是对于本申请功能区划的限制，在 实际的布图设计中，可以根据显示需要进行调整，并且根据电子功能的划分，可以改变布图区和切割区的尺寸设计。 

在图1所示的实施例中，该布图区由切割区四周围绕，焊盘区位于布图区的左侧，焊盘区在布图区中所占面积小，沿着左侧的切割区成竖条状，焊盘区与左侧的切割区直接相邻。设计像素区占到布图区的大部分面积，设计像素区的四周由密封区围绕，将设计像素区和焊盘区以及切割区隔离。密封区在右侧和切割区直接相邻。密封区在左侧位于焊盘区和设计像素区之间。 

在优选的实施例中，芯片类型为双阱CMOS工艺芯片；功能类型为全数字式；应用途径为时分脉宽调制模式硅基OLED微型显示器；驱动负载为OLED有机发光薄膜层；设计像素区的像素数为864×606(523,584个像素)；像素间距：15μm×15μm；显示面积：12.96mm H×9.09mm V(0.62英寸)；总的芯片面积：17.00mm H×13.00mm V(0.84英寸)。 

本申请的OLEDoS显示芯片采用时分脉宽调制灰度显示模式，其基本原理是运用人眼视网膜在视觉暂略时间范围内对亮度感觉具有类似于时间积分的物理效应，将每帧图像数据划分成n(n＝1-8)个子场(Sub-Fields)，每个子场像素的点亮时间对应不同权值，通过OLEDoS显示芯片像素单元电路的调制驱动过程，将每个像素区内的OLED发光区域控制在“亮”和“暗”两种状态，可采用二进制表示，这样就组合成2ⁿ灰度级数。 

每个二进制的灰度值的每一位对应一段基二权重的时间段，并按对应时间被显示出来，因此人眼视网膜所接收到的是一系列的光脉冲。因为光脉冲是微秒级，远小于视觉暂略时间(约20ms)，人眼视网神经不能区分出每个光脉冲，视网神经所感受的光强度是这些光脉冲积分后的结果。 

图2示出时分脉宽调制帧周期，如图2所示，一个值为10110的二进制32灰度级数的像素显示值，其中1代表开态，0代表关态；假设最低位对应的显示时间间隔为1，那么从右到左的第二、三、四、五位的时间间隔分别是2、4、8、16，开态显示的时间为：16+0+4+2+0＝22，因此人眼感受到的光强度是全亮态强度的22/(16+8+4+2+1)＝22/31。 

假设n＝8，则可以实现256灰度级数，这里指每帧图像分成8个子场，各子场发光时间与数据比特位的权值比重相对应，即得到公式(1)： 

SF8∶SF7∶SF6∶SF5∶SF4∶SF3∶SF2∶SF1＝27∶26∶25∶24∶23∶22∶21∶20(1) 

按灰度级数2n来分割每场的像素有效发光时间Teff，则第n个子场SFn的显示时间tn遵循公式(2)： 

$t^n=\frac{2^{n-1}}{2^n-1}\mathrm{Teff}$

那么，对于每帧图像中个像素的亮态时间Tp遵循公式(3)： 

$\mathrm{Tp}={\left({\mathrm{\Σ}}_{n=8}{B2}^{n-1}\right)}^{\frac{\mathrm{Teff}}{2^8-1}}$

其中B为比特位位置，该位数值为0、1，分别确定在SFn内像素处于暗态还是亮态。 

8位时分脉宽调制灰度显示模式估算 

在假设OLED响应时间为零的理想情况下，800×600分辨率8位时分模式时序中，75Hz对应于13.333ms，即13333μs，1μs写入1行，写满一场用600μs，一幅图的写入时间为600×8＝4800μs。有效显示时间为13333-4800＝8533μs，分割为255份，每份8533/255＝33μs，有效发光时间占空比为8533/13333＝64％。考虑到逐行写入模式，重新计算有效时间为13333-8＝13325μs，分为255份为13325/255＝52μs，有效发光时间占空比为13324/13333＝99.9％。实际应用中考 虑到OLED的寿命等因素，加入电位反转黑场，将8个子场增加到9个子场。 

外部并行16位数据输入频率为50M，考虑到实际物理像素为864×606，插入黑场后，实际时序如下： 

写入1行所用时间：864×20ns/16＝1.08μs 

写满1场所用时间：1.08μs×606＝655μs 

有效显示时间：13333μs-(655μs×9)＝7438μs 

分割为255份：7438μs/255＝29.169μs调整为：28μs 

黑场显示时间：7438μs-(28×255)μs＝298μs 

有效发光时间占空比：(7438μs-298μs)/13333μs＝53.6％ 

各分场的周期：28×128＝3584μs；28×64＝1792μs；28×32＝896μs；28×16＝448μs；28×8＝224μs；28×4＝112μs；28×2＝56μs；28μs；黑场＝298μs。 

图3是根据本实用新型的显示器的驱动电路的示意图，如图3所示，其中OLEDoS显示芯片采用双阱CMOS硅器件工艺，输入视频数字处理电路和像素单元OLED发光层驱动阵列同基底集成。根据前面显示性能的要求，图3示意了整个OLEDoS芯片的电路结构，包括：像素单元电路矩阵、行驱动器电路、列驱动器电路、分频分流器电路、Vcom反转开关电路和OLED发光层测试区。 

为了降低芯片工作频率，不仅把列驱动器分为电学结构镜像对称的上下两组电路，分别驱动奇偶数据线，而且采用分频分流器电路实现32组数据并行输入像素单元显示矩阵的方式。另外，这种电路结构可以使芯片面积变小，显示效果均衡。 

像素单元电路矩阵包括多个像素单元电路，其中图4示出一个像素单元电 路。像素单元电路包括4个PMOS管(图4中的P2\P3\P4\P5)，用于向OLED发光层提供驱动脉冲电流，通过电流脉冲宽度的累积实现灰度调制。 

如图4所示，P2用作OLED发光层的驱动管，P3为像素单元矩阵寻址开关管，P4为驱动开关管，P5为像素单元电路保护管，C1为存储电容器，SV与SVB为一对互不交叠得到扫描寻址信号，VD为数字视频位信号，其中VDH为“暗”信号，VDL为“亮”信号，Vcom为-3V的公共电位。配置VD的低电平VDL为4V-4.5V，使得PMOS管P1和P2导通时工作在亚阈值区，从而得到几十纳安的微电流驱动OLED发光层，同时可以通过微调VDL值控制显示像素的绝对亮度。 

采用PMOS管P5的保护作用达到采用5V芯片工艺实现8V驱动大的目的。 

其中，P2的漏极连接电源VCC，P2的栅极和VCC之间连接电容C1，P2的源级连接P4的漏极。P2的栅极连接P3的漏极，P3的源级连接VD，P3的栅极连接扫描寻址信号SV。P4的栅极连接扫描寻址信号SVB，P4的源级连接到OLED发光层到Vcom。P4的源级还连接P5的栅极和源级，P5的漏极接地。 

当扫描寻址信号SV为低电平时，P3管导通，VD对C1进行充放电，当充入VDH电位时，P2驱动管工作在截止状态，即不向OLED发光层提供驱动电流；当充入VDL电位时，P2驱动管工作在亚阈值状态，即向OLED发光层提供几十纳安的微驱动电流。 

在P3导通期间，P4截止，从而防止在P2驱动管工作状态发生变化时产生的瞬变电流激发OLED发光层出现意外闪烁现象。P3从VD取样截止后，P4立即导通；PMOS管P5用作像素单元电路的保护管，当P4管的输出电位低于0V时，P5开始导通，从而可以保持P1\P2\P3\P4施加电位差为5V。透过OLED发光层Vcom公共电极接入-3V电位，最终能够施加到OLED发光层上的最大电压为8V，从而达 到了使用低电压CMOS工艺芯片驱动高电压(比如8V)OLED发光层的目的。 

图5示出行扫描器电路的电路结构。显示芯片电路的行扫描驱动器位于芯片左边，它有606个驱动单元，依照帧触发时钟Vs和扫描时钟脉冲RCK同步控制，它们从第一行到最后一个行依次驱动。 

如图5所示，行驱动器电路由水平移位寄存器，电平移位器和扫描缓冲驱动器组成。水平移位寄存器是一个单相输入的606位移位寄存器，在水平移位脉冲RCK和帧触发时钟Vs的作用下，依次产生从第1行到第606行的扫描信号。扫描信号通过电平移位器的作用，产生VL＝0V/VH＝5V的扫描电平，进一步由扫描缓冲驱动器增强驱动能力，用于寻址每一行中的864个象素单元电路。具体地说，水平移位寄存器扫描到第i行时，通过该行扫描缓冲驱动器的作用，象素矩阵中与第i条扫描电极连接的864个PMOS开关管导通。因为是逐行扫描，这时其它扫描电极皆为5V电位，其余的PMOS开关管均截止。随着水平移位脉冲RCK的作用，被选取的扫描电极将依次改变。 

图6示出列扫描器电路的电路结构。并行输入的16位视频信号分成两个16组，向列扫描器串行输入数字视频信号，在串入并出的垂直移位寄存器作用下，依次存入第1级锁存器。第1级锁存器在读入数据前，把所存数据写入第2级锁存器，然后第1级锁存器在读入数据时，第2级锁存器同时通过电平移位器向存储信号数值的选择传输器(STG)写出数据，这两组锁存器实现边读入边写出的功能。第2级锁存器存满一行后在读出信号作用下，配合行扫描信号，同时输入到各列数值的选择传输器，则每列的1位数字信号同步转换成一个调控电压信号(VH/VL)作用到象素上，而整体效应则是串行数字视频信号转化成并行视频。调控电压信号，逐行写入每个像素矩阵，驱动其间的4个PMOS管协同工作。 

图7示出电平移位器电路的结构。其中，无论行驱动器还是列驱动器的电路结构中都采用了电平移位器，其目的是通过标准3.3V低电压逻辑控制实现5V高压输出，驱动象素显示矩阵工作，这样做可以降低芯片中逻辑处理部分电路55％的功耗。 

图7中，P1、P2为由低压器件组成的反相器，用于产生反相输入信号 

HVP1-4和HVN1-4采用高压CMOS工艺制作，这些高压器件组成电平转移和驱动缓冲两个电路。电平位移电路工作原理：当in＝5V时，HVN2和HVP1导通，HVN1和HVP2截止，out＝HVDD；相反，in＝0V时，out＝0V。可见，该电路结构实现了信号电压从低电平向高电平的位移。 

图8示出分频分流器电路的结构。如图8所示，该电路模块由分频电路和分流电路两部分构成。分频电路将显示时钟pck的频率减半，从而使得整个显示芯片的工作频率减半。分流电路内置两级锁存器，完成对串行输入的两位数据实现同步并行输入，配合了工作频率减半的设置。 

图9示出Vcom反转开关电路的结构。反转开关电路包括反转信号输入电路、电平位移电路、输出缓存电路三部分。Vcom的输出电压值为0V和5V。应当注意的是，由于采用的是5V_CMOS制备工艺，故该开关有效转换电压为0V到5V之间，若Vcom使用-3V，则需外接转换开关。 

图10为版图布图的示意。其中，OLEDoS芯片电路由50余万个MOS晶体管组成，采用一维布图样式来合理地放置这些PMOS与NMOS，单元版图包括p型和p型两排水平扩散条，PMOS晶体管位于P型条，NMOS晶体管位于n型条。 

共栅的PMOS管和NMOS管垂直对齐放置，共用一条多晶栅，这样一对PMOS管和NMOS管称为一个晶体管对，而不共栅但垂直对齐放置的一对PMOS管和NMOS 管也称为一个晶体管对。 

电路中相连MOS管的源漏区如相邻，则用扩散区相连，称为源漏共用，多个连续排列且源漏共用的MOS管称为扩散链，由于MOS管常常P、N成对排列，所以扩散链又称晶体管对链。电源/地线平行地布于两排水平条以外。电源/地线以外的线网布在P型和N型水平条之间。 

芯片版图结构应具有如下特征：PMOS像素驱动矩阵可视为一个象素单元的版图作864×606的阵列展开；周边驱动电路也具有一维高度重复性，即各行扫描驱动器电路结构完全一致，各列也是电路结构完全一致。因此，对于PMOS显示矩阵只要设计出一个象素对称重复单元体，然后按二维平面布图则可；周边驱动电路按照一维布图样式布局出一列或一行的版图，然后相邻行或列作镜相复制，这样可以使相邻的行或列共用电源线或地线，则能设计出最紧凑的版图。 

设计行或列的版图采用核心生长法。首先将像素驱动矩阵安置在芯片的中部，然后以这些单元为核心放置行或列的相关单元，接着是时钟树和输入数据线，逐渐向芯片的四周扩展和生长，直至单元全部安置完毕。另外，显示芯片对PAD的位置没有限制，则引出接点的位置可取决于芯片内部单元的安置结果。最后再考虑放置陪管、测试点、测试电路以及Vcom公共电极的预留空间。 

图11示出详细的硅基OLED显示芯片像素电路结构。其中，该硅基OLED显示芯片像素电路结构包括：至少由读入PMOS管源极以及读入PMOS(P-channel Metal Oxide Semiconductor，P型沟道金属氧化物半导体)管栅极以及读入PMOS管漏极构成的读入PMOS管、至少由PIP电容器低阻多晶硅上电极以及PIP电容器高阻多晶硅下电极构成的PIP(Poly Si-insulator-Poly si，多晶硅-绝缘层-多晶硅)电容器、至少由驱动PMOS管源极以及驱动PMOS管栅极以及驱动PMOS管漏极 构成的驱动PMOS管、至少由写出PMOS管源极以及写出PMOS管栅极以及写出PMOS管漏极构成的写出PMOS管、至少由地线保护PMOS管源极以及地线保护PMOS管栅极以及地线保护PMOS管漏极构成的地线保护PMOS管、通过读入PMOS管源极连线与所述读入PMOS管源极相连接的视频数据串行位线、同时连接PIP上电极连线和驱动PMOS管源极连线的电源线、通过地线保护PMOS管漏极连线与所述地线保护PMOS管漏极相连接的0V地线、通过读入PMOS管栅极连线与所述读入PMOS管栅极相连接的正相行选通线、通过写出PMOS管栅极连线与所述写出PMOS管栅极相连接的负相行选通线、与驱动电极连接线相连接的OLED发光层驱动电极。 

所述PIP上电极连线连接到所述PIP电容器低阻多晶硅上电极，所述驱动PMOS管源极连线连接到所述驱动PMOS管源极；所述PIP电容器高阻多晶硅下电极通过PIP下电极连线连接到把所述读入PMOS管漏极与所述驱动PMOS管栅极连通的漏栅极连接线上；所述驱动PMOS管漏极与所述写出PMOS管源极通过源漏极连接线相连通；所述地线保护PMOS管栅极、所述地线保护PMOS管源极、所述写出PMOS管漏极分别通过地线保护PMOS管栅极连线、地线保护PMOS管源极连线、写出PMOS管漏极连线与所述驱动电极连接线相连接；所述电源线、所述正相行选通线、所述负相行选通线、所述0V地线沿水平方向设置，且互不相交连通；所述视频数据串行位线沿垂直方向设置，且与所述电源线、所述正相行选通线、所述负相行选通线、所述0V地线互不连通。 

所述OLED发光层驱动电极由金属或金属合金制成，常用的金属为铝、铜、金、银等，但不限于这几种，为提高OLED稳定性和增强表面发射率，金属电极表面可采用化学机械抛光法(CMP)进行抛光处理。所述OLED发光层驱动电极覆盖的面积不超过所述硅基OLED显示芯片像素电路结构面积的90％。所述电 源线上承载不低于3.3V的恒定电位值；所述视频数据串行位线中交替承载高电位信号和低电位信号，且所述高电位信号数值不低于所述电源线上承载的不低于3.3V的恒定电位值，所述低电位信号数值不高于比所述高电位信号数值低0.5V的数值；所述正相选通线和所述负相选通线上承载的信号为互不交叠反相电压信号；所述一种硅基OLED显示芯片像素电路结构采用PMOS制程工艺在N型单晶硅衬底上生产实现。 

最后应说明的是，以上实施例仅用以描述本实用新型的技术方案而不是对本技术方法进行限制。 

Claims (7)

1.一种单色硅基OLED显示器的驱动电路，包括：像素单元电路矩阵、行驱动器电路、列驱动器电路、分频分流器电路、Vcom反转开关电路和OLED发光层；其中列驱动器电路分为镜像对称的上下两组电路，分别驱动奇偶数据线；其特征在于，所述行扫描驱动器位于驱动电路的左部，具有606个驱动单元，依照帧触发时钟和扫描时钟脉冲同步控制，依次驱动；其中，所述列驱动器电路包括垂直移位寄存器、第一级锁存器、第二级锁存器和选择传输器。

2.根据权利要求1所述的驱动电路，其特征在于，行驱动器电路和列驱动器电路都采用电平移位器，通过标准3.3V低电压逻辑控制实现5V高压输出，驱动象素显示矩阵工作。

3.根据权利要求1所述的驱动电路，其特征在于，所述行驱动器电路包括水平移位寄存器、电平移位器和扫描缓冲驱动器；所述水平移位寄存器是单相输入的606位移位寄存器；电平移位器接收扫描信号，产生扫描电平，并通过扫描缓冲驱动器增强驱动能力，来寻址每一行中的864个象素单元电路。

4.根据权利要求1所述的驱动电路，其特征在于，所述分频分流器电路用于实现32组数据并行输入到像素单元显示矩阵；所述像素单元电路矩阵包括多个像素单元电路，所述像素单元电路包括4个PMOS管，用于向OLED发光层提供驱动脉冲电流；所述像素单元电路通过电流脉冲宽度的累积来实现灰度调制。

5.根据权利要求2所述的驱动电路，其特征在于，所述电平移位器电路包括电平转移电路和驱动缓冲电路，用于实现信号电压从低电平向高电平的位移。

6.根据权利要求1所述的驱动电路，其特征在于，所述分频分流器电路包 括分频电路和分流电路，分频电路将显示时钟的频率减半，分流电路内置两级锁存器，对应于该减半频率来对串行输入的两位数据实现同步并行输入。

7.根据权利要求1所述的驱动电路，其特征在于，所述Vcom反转开关电路包括反转信号输入电路、电平位移电路和输出缓存电路，输出电压值为0V和5V，最大驱动电流值约300mA。 

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