CN1499492A - 记录媒体的再现方法、再现控制电路及再现装置 - Google Patents

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Abstract

一种记录媒体的再现方法，在以具有多个规定长度的帧的块单位来记录数据的同时、记录所述块的位置信息的记录媒体的再现方法包含以下步骤：从所述记录媒体中取得所述数据与所述块的位置信息；根据取得的所述块的位置信息，预测所述块内的每个所述帧的记录位置；根据取得的所述数据，以所述帧单位取得同步；根据预测到的所述记录位置，确定取得的所述数据存储到存储器的存储部位；和将取得的所述数据存储在确定的所述存储器的所述存储部位中。可以实现即便在再现信号的质量由于记录媒体的缺陷等而恶化的情况下也可确保稳定的再现性能，并减少伴随不同步的数据丢失。

Description

记录媒体的再现方法、再现控制电路及再现装置
技术领域
本发明涉及一种再现记录在数字化信息后并记录的记录媒体中的信息的方法及装置，尤其涉及再现以与所述位置信息相关联且具有多个规定帧单位的块为单位来记录在事先记录位置信息的记录媒体中的数据的方法及装置。另外，本发明涉及从磁记录媒体或光盘等纠错编码数据且分割成多个帧来记录的记录媒体中再现数据的再现方法、再现控制电路及再现装置。
背景技术
随着信息化社会的发展，探索信息传输高速化且大容量化的一个途径，期望记录、存储信息的记录媒体也愈加高速化、大容量化。
一般在数字化信息后并记录的记录媒体中，以由规定字节长度构成的块单位来记录/再现/管理数据。作为记录的数据，包含：
1、音频/视频/计算机数据等的应记录信息经数字化后的用户数据、
2、读出时用于检测或纠正数据错误的纠错码(奇偶码)、
3、用于识别数据的记录位置的数据ID等冗余数据。在将这些数据变换为适于记录媒体的记录再现信号特性的调制码后，作为码系列进行记录。另外，在每个变换为调制码的码系列的规定周期，多以编码同步信号后插入的形式进行记录。
同步信号起到在读出数据时适当取得数据同步的作用。再现装置取得帧同步后读出数据ID，在识别数据的记录位置后，解调、纠错必要的记录数据，得到最初的用户数据。
作为配置编码同步信号的方法，已知在规定字节长度单位的帧的开头配置特定图案(编码)的方法。作为该特定图案，采用调制码系列中不存在的图案。另外，设同步信号为(特定图案+种类识别符)的组合，若解码1帧的同步信号、或连续数帧同步信号中的种类识别符，则可特定块中的帧位置。
在最近实用化的记录媒体中，采用作为多用途型光盘的DVD(＝DigitalVersatile Discs)的物理格式为例。调制码系列使用将标记长度及间隙长度限制为从3T到11T(T为沟道比特周期)的运行长度限制码，帧形状的同步信号包含不存在于上述调制码系列中的14T，作为特定图案。由包含2048字节用户数据的26个连续帧来构成1个扇区，在每个扇区中附加用于识别数据的数据ID。并且，由16个连续的扇区构成1个块，以1个块为单位来进行纠错码的编码/解码。另外，在作为特定图案的14T的前面配置8种种类识别符中任一来构成帧开头的同步信号。这8种同步信号被称为SY0、SY1、SY2、SY3、SY4、SY5、SY6、SY7。在各扇区开头的帧中包含配置SY0的同步信号的数据ID，在以后的25个帧中配置SY1到SY7之一。
结果，在再现上述光盘的装置中，若读出SY0，则可特定为扇区的开头帧，读取数据ID，则可识别数据的记录位置，并进行检索动作。另外，即便不是SY0，但若正确读取连续3个帧的种类识别符，则可特定扇区中的帧位置。
另外，在用户可写入信息的记录媒体(记录型光盘等)中，在进行数据记录的轨道中，以与记录数据(记录膜的相变等)不同的形式(沟形状的变化等)事先记录固有的序号信息。通常，与事先记录的序号信息相关联，事先确定序号信息的记录位置与记录数据的相对位置。在对这种记录媒体进行信息写入的装置中，参照所述固有的序号信息来进行数据记录。
因此，以前，在DVD等光盘中，为了纠正媒体缺陷或盘面上附着的尘埃或伤痕引起的错误，使用Reed-Solomon码等纠错码。
纠错码中，当设码的最小距离为d时，纠正个数t一般有关系
d≥2×t+1。
并且，在进行纠正处理时，在事先知道错误位置的情况下，可进行使用所谓已知错误位置信息、即消失指针的消失纠正，通过进行消失纠正，可将纠正个数最大提高到2倍。
若设消失纠正个数为e，则有关系
d≥2×t+e+1，例如，在最小距离d＝33的码全部进行消失纠正的情况下，具有最大32个纠正的纠正能力(t＝0、e＝32)。
为了进行以上消失纠正，必需事先特定错误位置，提议各种错误位置特定用方法。
例如，在光盘等将纠错编码数据的编码数据分割成规定长度的多个帧数据、将在调制所述帧数据的调制帧数据的开头附加规定同步信号的帧记录在记录媒体中的、具有帧结构的记录媒体中，从同步信号的检测结果中检测比特流的发生，特定错误发生位置，由此提高纠正能力(例如参照专利文献2)。
另外，有时不仅同步信号的检测结果、而且将脉冲检错用的纠正能力较高的码与订正能力低但冗余度低的码组合(例如参照非专利文献1和2、专利文献3)。由此，在同步信号之间构成两个码，将纠正能力高的码的纠正结果与同步信号的检测结果组合后使用，特定纠正能力低的码的消失纠正用的消失位置。
如上所述，以前提议通过将同步信号的检测结果用于消失纠错时的错误位置的特定、即消失指针的生成来使纠正能力提高的方式。
专利文献1：特开平11-176081号公报
专利文献2：特开昭63-157372号公报(第3页、第3图)
专利文献3：特表2001-515642号公报(第10-11页、第2图)
非专利文献1：槽原立也等7人，“对于数字视频记录的光盘系统(OpticalDisc System for Digital Video Recording)”，エスピ-ァィィ-(SPIE)，光存储器及光数据存储装置国际座谈会1999(Part of the Joint International Symposium on OpticalMemory and Optical Data Storage 1999)，1999年7月，第3864卷，p.50
非专利文献2：槽原立也等2人，“对于数字视频记录系统的错误模型与纠错码的性能分析(Error Modeling and Performance Analysis of Error CorrectingCodes for the Digital Video Recording System)”，エスピ-ァィィ-(SPIE)，光存储器及光数据存储装置国际座谈会1999(Part of the Joint International Symposium onOptical Memory and Optical Data Storage 1999)，1999年7月，第3864卷，p.340
但是，在现有例说明的方法中，存在几个问题。
首先，作为第1问题，例如通过包含于与数据一起记录的同步信号中的特定图案来取得数据再现时的同步，通过读取数据ID来进行检索动作。例如，若不能识别某个扇区开头帧中的同步信号(DVD的情况下为SY0的同步信号)，则不能读出数据ID，不能稳定进行数据的检索动作。
另外，若即便在扇区开头以外读取连续的多个帧的同步信号，虽可特定扇区中的帧位置，但在数据质量不好的情况下，同步的确定花费时间，产生不能确定同步的问题。
并且，在能检索数据后，读取必要部位的记录数据，若在进行解调、纠错的情况下也在数据质量不好时产生同步错位，则不能识别同步信号的种类。若同步错位的状态在数帧中继续，则即便引起帧越过也无法识别。从这种状态复原，并读取同步信号，也为了特定帧的位置，还必需读取多个帧的同步信号，有可能增大数据错误。
另一方面，为了将上述同步信号的检测结果用于消失纠错时的消失指针的生成，存在以下问题。
第1问题在于由于执行同步信号检测的电路块与用检测结果执行纠错的电路块不同，所以必需与解调的解调数据同步地将同步信号的检测结果发送给用于纠错的电路块。
第2问题在于由于生成同步信号的检测结果的时刻与执行纠错的时刻不同，所以在执行纠错之前，必需保存同步信号的检测结果。同步信号的检测在解调再现信号之前为了事先取得帧同步，在执行解码动作之前执行检测动作。另一方面，将解调后的解调数据暂时存储在DRAM等存储器中、并在存储构成纠错码的全部帧后进行纠错的情况较多。因此，生成同步信号的检测结果的时刻与执行纠错的时刻不同，在执行纠错之前，必需保存同步信号的检测结果。
发明内容
因此，本发明的第1目的在于即便在再现信号的质量由于记录媒体的缺陷等而恶化的情况下也可确保稳定的再现性能，并减少伴随不同步的数据丢失。
另外，本发明的第2目的在于能在纠错时在使用解调数据的同时，使用与之对应的同步检测的检测结果。
根据本发明的记录媒体的再现方法，在以具有多个规定长度的帧的块单位来记录数据的同时，记录所述块的位置信息，其特征在于：包含以下步骤从所述记录媒体中取得所述数据与所述块的位置信息；根据取得的所述块的位置信息，预测所述块内的每个所述帧的记录位置；根据取得的所述数据，以所述帧单位取得同步；根据预测到的所述记录位置，确定取得的所述数据存储到存储器的存储部位；和将取得的所述数据存储在确定的所述存储器的所述存储部位中。
另外，最好还包含如下步骤：判断是否取得所述数据的所述帧单位的同步；和在未得到所述帧单位的同步的情况下，再次检测所述帧单位的同步复原，在检测所述帧单位的同步复原的情况下，根据预测的所述帧的记录位置，确定所述数据存储到所述存储器的存储部位。
另外，本发明的记录媒体的再现控制电路，在以具有多个规定长度的帧的块单位来记录数据的同时，记录所述块的位置信息，其特征在于：包含信号读取部件，从所述记录媒体中取得所述数据与所述块的位置信息；记录位置预测部件，根据取得的所述块的位置信息，预测所述块内的帧单位的记录位置；同步部件，根据取得的所述数据，以所述帧单位取得同步；存储器，存储所述数据；和控制部件，根据预测到的所述记录位置，确定所述数据存储到所述存储器的存储部位。
另外，最好还包含同步检测部件，检测是否取得所述数据的所述帧单位的同步，同时，在未得到所述帧单位的同步的情况下，再次检测帧单位的同步复原，所述控制部件在由所述同步检测部件检测到帧单位的同步复原的情况下，根据由所述记录位置预测部件预测到的所述记录位置，确定取得的所述数据存储到所述存储器的存储部位。
另外，本发明的再现装置的特征在于包含所述再现控制电路。
本发明的记录媒体的再现方法，将纠错编码数据的编码数据分割成规定长度的多个帧数据，从记录调制后的调制帧数据与附加在所述调制帧数据开头的规定同步信号的记录媒体中，再现所述数据，其特征在于：包含信号取得步骤，从所述记录媒体中取得信号；同步信号检测步骤，通过从取得的所述信号中检测所述各帧的同步信号，得到同步信号检测结果；帧同步步骤，根据得到的所述同步信号检测结果，补正所述帧的同步；同步信号检测结果信息生成步骤，生成以规定规则编码所述各同步信号检测结果的同步信号检测结果信息；解调步骤，解调所述各帧的调制帧数据，生成解调帧数据；和同步信号检测结果附加步骤，使所述帧的所述同步信号检测结果信息对应并附加在所述各解调帧数据上。
另外，最好还包含：消失指针生成步骤，对于所述各解调帧数据，使用对应的所述同步信号检测结果信息，生成用于消失纠正的消失指针；和纠错步骤，使用对应于所述解调帧数据的所述消失指针，进行所述多个由所述解调帧数据构成的纠错码的消失纠正。
另外，还包含存储器存储步骤，将所述同步信号检测结果信息与对应的所述解调帧数据彼此关联，存储在存储器的不同区域中。
并且，也可将经编码的所述同步信号检测结果信息，至少区分成，当正常检测出所述同步信号情况下的“正常检测”、未检测出所述同步信号的“未检测”、以及在脱离了根据所检测的前一同步信号检测结果的时刻而预测的时刻的时刻检测出新的同步信号的情况的“脱离同步检测”，的3种检测结果。
另外，也可在所述帧同步步骤中，在补正比根据之前检测的同步信号检测结果时刻所预测的时刻还早地检测新同步信号的同步延迟、且所述同步延迟不到1帧的情况下，在所述存储器存储步骤中，将存储到存储器的存储位置补正为越过相当所述同步延迟的补正大小的位置后，将同步延迟补正之后的所述帧数据存储在所述存储器中。
并且，也可在所述帧同步步骤中，在补正比根据之前检测的同步信号检测结果时刻所预测的时刻还早地检测新同步信号的同步延迟、且所述同步延迟为大于1帧的同步延迟的情况下，在所述存储器存储步骤中，将存储到存储器的存储位置补正为越过相当所述同步延迟的补正大小的位置后，分别将同步延迟补正之后的所述同步信号检测结果信息和所述帧数据存储在所述存储器中，同时，在所述消失指针生成步骤中，将越过后未存储在所述存储器中的同步信号检测结果信息视为“未检测”，生成消失指针。
根据本发明的再现控制电路，将纠错编码数据的编码数据分割成规定长度的多个帧数据，从记录调制后的调制帧数据与附加在所述调制帧数据开头的规定同步信号的记录媒体中，再现所述数据，其特征在于：配备帧同步部件，根据通过从记录媒体取得的再现信号中检测所述各帧的同步信号所得到的同步信号检测结果，补正所述帧的同步；同步信号检测结果信息生成部件，生成分别以规定规则编码所述各同步信号检测结果的同步信号检测结果信息；解调部件，解调所述各帧的调制帧数据，生成解调帧数据；同步信号检测结果附加部件，将所述帧的所述同步信号检测结果信息附加在所述各解调帧数据的开头；存储器，存储所述同步信号检测结果信息和所述各解调帧数据；和存储器存储部件，将所述同步信号检测结果信息和所述各解调帧数据存储在所述存储器中。
并且，最好还包含：消失指针生成部件，使用所述同步信号检测结果信息，生成用于消失纠正的消失指针；和纠错部件，对由所述解调帧数据构成的纠错码，使用所述消失指针来进行消失纠正。
另外，也可将经编码的同步信号检测结果信息，至少区分成，当正常检测出所述同步信号情况下的“正常检测”、未检测出所述同步信号的“未检测”、以及在脱离了根据所检测的前一同步信号检测结果的时刻而预测的时刻的时刻检测出新的同步信号的情况的“脱离同步检测”，的3种检测结果。
另外，也可在用所述帧同步部件补正比根据之前检测的同步信号所预测的时刻还早地检测新同步信号的同步延迟、且所述同步延迟不到1帧的情况下，所述存储器存储部件将所述同步延迟补正之后的下一所述帧数据存储到所述存储器的存储位置补正为越过相当所述同步延迟的补正大小的位置后，将所述帧数据存储在所述存储器中。
并且，也可在用所述帧同步部件补正比根据之前检测的同步信号所预测的时刻还早地检测新同步信号的同步延迟、且所述同步延迟为大于1帧的同步延迟的情况下，所述存储器存储部件将所述同步延迟补正之后的下一所述同步信号检测结果信息和所述帧数据存储到所述存储器的存储位置补正为越过相当所述同步延迟的补正大小的存储位置后，将所述帧数据存储在所述存储器中，同时，所述消失指针生成部件将越过后未存储在所述存储器中的帧所对应的同步信号检测结果信息视为“未检测”，生成消失指针。
另外，根据本发明的记录媒体的再现装置的特征在于包含所述再现控制电路。
如上面实施形态中详细说明的那样，在本发明的再现方法、再现控制电路及再现装置中，设置根据事先记录的位置信息来预测记录数据的位置的部件，可较稳定地保证帧同步。即便伴随伤痕或尘埃记录数据的质量暂时恶化，也可快速取得帧再同步。另外，本发明的再现方法及再现装置通过将解调后的数据向缓冲存储器的存储设为帧单位，可快速补正从不同步复原后的数据的存储位置。由此，即便在记录数据的质量因记录媒体的伤痕或尘埃、反复记录等而下降的情况下，也可将解调数据的丢失抑制到最低限度，将纠错码的效果发挥到最大限度。因此，本发明的再现装置及再现方法若应用于大容量的影碟记录器中，可发挥极大的效果。
另外，本发明对于以帧结构记录的记录数据的再现，将各帧的开头的同步信号的同步信号检测结果信息与解调帧数据一起发送到纠错电路块，并存储和保存在存储器的不同的区域中，可用纠错执行时发送的同步信号的检测结果来进行消失纠正。结果，可使纠错能力提高，实现可靠性高的数据再现。
附图说明
图1是表示根据本发明实施形态1的记录媒体结构例的示意图。
图2是表示根据实施形态1的再现装置的结构例的框图。
图3是表示存储器控制部件205的内部结构一例的框图。
图4是表示根据实施形态1的缓冲存储器206的存储位图一例的示意图。
图5是表示本发明实施形态1中的帧丢失发生时的内部信号变化一例的时序图。
图6是表示本发明实施形态1中的帧插入发生时的内部信号变化一例的时序图。
图7是表示本发明实施形态1中帧越过发生时的缓冲存储器存储控制流程的流程图。
图8是表示本发明实施形态1中记录媒体的记录数据格式结构例的图。
图9是说明实施形态1的记录媒体位置信息结构例的模式图。
图10是表示本发明实施形态2中帧数据结构的示意图。
图11是表示本发明实施形态2中光盘结构的示意图。
图12是说明实施形态2的再现方法的流程图。
图13是表示实施形态2中的再现方法的同步信号检测结果为正常检测的情况的实施例1中的数据结构示意图。
图14是说明图13中存储同步信号检测结果信息与解调帧数据的状态的图。
图15是实施形态2的再现方法中同步信号检测结果为未检测的情况的实施例2的数据结构示意图。
图16是说明图15中存储同步信号检测结果信息与解调帧数据的状态的图。
图17是实施形态2的再现方法中同步信号检测结果为脱离同步检测的情况的第1例的实施例3的数据结构示意图。
图18是说明图17中存储同步信号检测结果信息与解调帧数据的状态的图。
图19是实施形态2的再现方法中同步信号检测结果为脱离同步检测的情况的第2例的实施例4的数据结构示意图。
图20是说明图19中存储同步信号检测结果信息与解调帧数据的状态的图。
图21是实施形态2的再现方法中同步信号检测结果为脱离同步检测的情况的第3例的实施例5的数据结构示意图。
图22是说明图21中存储同步信号检测结果信息与解调帧数据的状态的图。
图23是实施形态2的再现方法中同步信号检测结果为脱离同步检测的情况的第4例的实施例6的数据结构示意图。
图24是说明图23中存储同步信号检测结果信息与解调帧数据的状态的图。
图25是说明实施形态2的再现方法中消失指针生成的示意图。
图26是表示实施形态3的再现控制电路结构的框图。
图27是表示实施形态4的光盘再现装置的结构框图。
具体实施方式
下面，作为本发明的记录媒体，以光盘媒体为例，参照附图来说明本发明的实施形态。
(实施形态1)
下面说明根据本发明实施形态1的记录媒体的再现方法、再现控制电路及再现装置。图1是光盘媒体11的示意图。如图1所示，在光盘媒体11的记录面中以螺旋状形成引导沟(下面称为槽)。由该槽来构成信息轨道12。将由规定长度的多个帧构成的记录块13作为单位，将记录数据记录在信息轨道12内。另外，在信息轨道12中，事先按照摆动(wobbled)槽等槽的形状变化来记录记录块13的位置信息。另外，虽未图示，但在记录媒体11的记录面中形成相变记录膜，通过由记录装置会聚激光的束斑并照射在上述记录膜上，可产生局部温度上升，引起结晶(晶体)、非晶(非晶体)的相变，可记录信息。
在位置信息中包含特定作为记录数据的单位的记录块13的位置用的信息，在再现光盘媒体的装置中，通过再现信息轨道12并读取位置信息，可特定记录块13的位置。
另外，以记录块13为单位，将记录数据记录在事先形成的槽上。该记录块13由规定长度的多个帧14构成，在各帧14的开头配置同步信号15。
图8中示出调制后的1个扇区的记录数据结构的一例。由26个连续的帧构成1个扇区，每个帧的数据字节数为91字节，共计字节数为2366字节。这除2048字节的用户数据外，还包含数据ID或纠错码的奇偶字节等冗余数据。通过调制，将二进制8比特变换为16沟道比特，结果，91字节的二进制数据变为1456沟道比特的调制码系列。并且，向开头提供由32沟道比特长度构成的同步信号，形成1帧的记录数据。即，1帧为1488沟道比特长度。
如图8所示，按扇区中的各帧的位置，将同步信号分成8种。分配(14T+4T)的标志/间隙构成的特定图案，并在其之前为了识别种类而分别分配各个图案。将各扇区的相当于第1个的第1帧的同步信号称为SY0，将第2个帧的同步信号称为SY5，之后，从第3到第26，按其顺及奇数序号或偶数序号不同，配置从SY1到SY7的各图案。由此，例如在读取连续的3帧的同步信号为{SY5、SY1、SY5}的情况下，可识别为在从扇区开头起经过第4个帧后，在读取连续的3帧的同步信号为{SY5、SY1、SY6}的情况下，可识别为从扇区开头起经过第12个帧后。
图9中示出位置信息的记录方法一例。使事先形成的作为引导沟的槽以规定的空间步骤(这里为186沟道比特周期)蛇行(摆动)，在槽41与槽41的沟之间(脊)，通过是否在每个规定周期单位(这里为摆动8周期，即相当于1帧)配置凹坑来记录位置信息。将记录在脊中的凹坑称为脊预置凹坑43。将使用该预置凹坑43来事先记录的位置信息称为预置凹坑地址。如图1中示为信息轨道12和记录块13那样，事先对预置凹坑地址和记录块13规定对应关系。事先规定对流关系意味着规定个数的预置凹坑地址与记录块13边保持规定的相对位置关系边1对1对应。在本例的情况下，每个作为记录数据的单位的1个记录块13中包含两个预置凹坑地址，将连续的两个设为1组的预置凹坑地址与各记录块1对1对应。
接着，简单说明事先由脊预置凹坑形成的位置信息与相变记录的数据的位置关系。在记录装置中，当记录数据时，使脊预置凹坑的信息单位的开头与作为记录数据的帧开头的同步信号的记录位置大致一致，或保持规定的相位位置关系。由此，在再现装置中，当再现数据时，通过读取数据，可预测数据的记录位置。
下面，具体说明边读取位置信息边预测数据的记录位置的方法。作为位置信息而取得有含义的值的间隔、即更新预置凹坑地址的间隔如上所述，每个ECC块(记录块)仅两次。因此，通过仅读取位置信息，不能以扇区单位或帧单位等细微单位来预测数据的记录位置。
因此，为了细微预测数据的记录位置，使用预测计数器。预测计数器由测量1帧长度的计数器FLCNT、勘定帧数的计数器FRCNT和勘定扇区数的计数器SCNT构成。为了减少预测计数器的误差，最好至少测量1帧长度的计数器FLCNT使用从摆动中抽取的沟道块。
计数器FLCNT是以11沟道比特从0增加到1931、再返回0的环路计数器。计数器FRCNT是以5沟道比特从0增加到25、再返回0的环路计数器。计数器SCNT是以4沟道比特从0增加到15、再返回0的环路计数器。并且，各计数器可在读取脊预置凹坑的位置信息的时刻预设各计数值。由此，可在考虑读取电路的处理延迟的同时，与相当于读取脊预置凹坑的位置信息时刻的记录数据的预测位置的计数值一致。本例中所谓记录数据的预测位置指用{扇区数、帧数、沟道比特数}来表示以1ECC块的开头为基点的相对位置。
这样，在先伴随位置信息的读取来预设预测计数器后，可通过各计数器的环路计数动作来预测记录数据位置。只要不脱离光束的跟踪，或从摆动抽取的沟道块与摆动的相位同步不完全脱离，就可高精度进行记录数据位置的预测。
下面，说明根据由沟形状事先记录的位置信息来预测记录数据位置的优点。位置信息的也就是作为载波的摆动槽的周期一般是调制码系列的平均T(平均标志、间隙长度)的至少10倍左右，最大T(最长标志、间隙长度)的2倍以上。这是为了避免记录数据与摆动在频率上干涉，再现信号的质量恶化。这样，摆动的频率低于记录数据的频带，所以当媒体记录面上有伤痕时丢失的信息量与记录数据相比，摆动一方小。因此，认为在摆动边缘进行相位比较的PLL与在记录数据的边缘进行相位比较的PLL相比，对于媒体的缺陷或尘埃等耐性强。换言之，认为从摆动信号得到的时钟信号与从记录数据得到的时钟信号相比，额外稳定。
图2是表示根据本实施形态1的再现装置的结构框图。说明该再现装置的动作。首先，信号读取部件21向记录媒体11照射光束，并从其反射光中读取信号。为了读取所述摆动及脊预置凹抗信号，根据公知的推挽法，得到再现跟踪方向信号的信号RF1。另外，为了读取记录数据，得到将反射率变化作为信号再现的信号RF2。
将信号RF1发送到位置信息再现部件22，抽取摆动信号成分，并使用锁相环(PLL)等技术，得到沟道时钟。另外，位置信息再现部件22从RF1中抽取脊预置凹抗的信号成分，由脊预置凹抗信号来再现位置信息并进行解码。由内置的摆动信号PLL(未图示)得到相位锁定的沟道时钟，在由脊预置凹抗信号正确解码位置信息后，预测计时器(未图示)开始动作，输出表示记录数据的预测位置的计数值。作为计数值，最好始终输出扇区计数结果SP、帧计数结果FP、沟道计数结果CP。
另一方面，将信号RF2发送到同步部件23，抽取记录数据的信号成分，并使用锁相环(PLL)等技术，得到沟道时钟及沟道数据。并且，由沟道数据来检测同步信号中的特定图案(14T+4T)，并输出同步信号(同步信号)SY。同步信号SY出于对特定图案的检测可靠性等的考虑，必要时也可连续数帧进行检测后输出。另外，同步部件23最好必要时内置测定同步信号检测间隔的部件或生成同步信号检测预测窗口的部件等。由此，防止以错误的检测间隔输出模拟同步信号SY，在同步信号未检测时，根据当前的检测结果在内部插入同步信号SY后输出。
作为同步信号未检测时的同步信号SY内插输出方法，考虑基于再现PLL同步时钟的内插方法。例如，设置将之前检测的同步信号的检测时作为起点、计数相当于1个帧长度的沟道时钟数(在本例的情况下为1488沟道比特)的计数器，使用该计数器的输出来进行内插输出。上述计数器可同时用作测量上述同步信号的检测间隔的部件或检测预测窗口的部件。
另外，同步部件23除同步信号中的特定图案外，还进行种类识别，输出同步信号(synchronization code)种类检测信号SYID。例如，在图8所示记录格式的情况下，同步信号的种类为SY0-SY7这8种，所以对应于SY0～SY7的检测，输出SYID＝0～7之一，在同步信号中产生再现错误，不能识别种类的情况下，设SYID＝8。
并且，同步部件23对应于帧同步的检测状态输出同步状态信号LOCK。例如，在帧同步正常状态的情况下，设为同步状态信号LOCK＝1，在帧同步异常状态、即帧不同步的状态的情况下，设为同步状态信号LOCK＝0。具体而言，在连续规定帧数未检测到同步信号的情况下，设为LOCK＝0，通知处于不同步状态。
将同步信号SY发送到解调部件24，用作从沟道数据到奇偶数据的解调开始时刻。解调部件24将解调结果、解调数据DEMDT及数据选通信号DTEN发送到存储器控制部件25。数据选通信号DTEN被用作解调数据DEMDT的更新时刻。
存储器控制部件25起到将解调数据DEMDT正确存储到缓冲存储器26中的作用。另外，从同步部件23向存储器控制部件25发送同步信号SY、同步信号种类检测信号SYID、同步状态信号LOCK，从位置信息再现部件22向存储器控制部件25发送记录数据预测位置SP、FP。使用这些信号，控制解调数据DEMDT的存储位置。
缓冲存储器26可根据存储器地址MADR来指定数据的存储部位(写入或读出的字节位置)，存储器控制部件25通过控制缓冲存储器26的存储器地址MADR，可控制解调数据DEMDT的存储部位。
图3是表示存储器控制部件25的内部结构一例的框图。帧序号识别部件301是使用来自同步部件23的同步信号SY及同步信号种类检测信号SYID来识别从扇区开头开始的帧序号的部件。具体而言，在同步信号SY的时刻取入同步信号种类检测信号SYID，输出根据过去数帧的同步信号种类SYID特定的帧序号FRNUM。例如若依照图8所示记录数据格式，则在过去3帧的同步信号种类检测信号SYID变为{SY5、SY1、SY5}的情况下，FRNUM＝3，在变为{SY5、SY1、SY6}的情况下，FRNUM＝11，如此对应于从扇区开头开始的帧数，设为FRNUM＝0～25任一值。另外，在变为同步信号种类检测信号SYID＝8(种类不清)或也不适于任一规定的组合的情况下，设为FRNUM＝26(帧序号不清)。
字节数计数器32是计数每个帧的字节数的计数器，用来自同步部件23的同步信号SY清零计数值BC＝0，在每次来自解调部件24的数据选通信号DTEN＝1时，将计数值BC加1，若达到BC＝91，则保持计数动作，直到下一同步信号SY清零BC＝0。
帧数计数器33是计数1扇区中的帧数的计数器，若由来自帧序号识别部件31的帧序号FRNUM＝0等检测扇区的开头，则清零，作为计数值FC＝0，由来自同步部件23的同步信号SY将计数值FC加1，若达到FC＝25，则由下一同步信号清零FC＝0。另外，也可根据帧越过检测部件35的控制，将计数值补正为规定值。另外，计数值FC以基于之前检测的同步信号SY的时钟进行计数，通过检测下一同步信号SY，增大FC。另一方面，在未检测到下一同步信号SY的情况下，也以最初的时钟继续计数，并增大FC。
扇区数计数器34是计数1ECC块中的扇区数的计数器，在ECC块的开头清零扇区数计数值SC＝0，帧数计数器33从计数值FC＝25返回0，同时，将计数值SC加1，若达到SC＝15、FC＝25，则由下一同步信号SY清零SC＝0。另外，也可根据帧越过检测部件35的控制，将计数值补正为规定值。另外，由基于之前检测的同步信号SY的时钟来计数计数值SC，通过检测规定数的同步信号SY，增大SC。另一方面，在未检测到同步信号SY的情况下，也由原来的时钟继续计数，在规定时刻增加SC。
帧越过检测部件35发现同步状态信号LOCK的变化，检测从不同步恢复，同时，比较记录数据预测位置SP、FP、扇区数计数值SC、帧数计数值FC的值，由此检测有无帧越过。
另外，在未检测到同步信号的情况下，也如上所述，根据同步于再现PLL的沟时钟来内插输出同步信号SY，所以字节数计数器32、帧数计数器33及扇区数计数器进行以上说明的动作，而不管检测/未检测同步信号。
地址变换部件36使用字节数计数值BC、帧数计数值FC、扇区数计数值SC等，将缓冲存储器26的存储部位变换为指定的存储器地址MADR后输出。
FIFO37是将解调数据DEMDT保持规定时间并输出的先进先出形式(First InFirst Out)存储器。所述地址变换部件36考虑在输出存储器地址MADR之前所需的处理延迟，使解调数据DEMDT延迟规定时间后，作为存储器存储数据DATA输出。由此，将存储器地址MADR与存储器存储数据DATA同时输出到缓冲存储器26，可将解调后的数据存储在正确的存储部位。
图4中示出了根据本实施形态的缓冲存储器26的存储位图的一例。横行是可存储记录在1帧中的数据量的字节数，图中表现为m字节。纵向是相当于1ECC块的帧数的行数，图中表现为n帧。图8说明的记录数据格式的情况下，m＝91、n＝416即可。通过用以上说明的存储位图来管理缓冲存储器26，可将1ECC块的数据按解调的顺序存储在帧单位中。
通常，在将作为标的的ECC块中的解调数据存储在缓冲存储器26中的情况下，通过解码记录数据中的数据ID，检索标的ECC块，从开头开始顺序存储在缓冲存储器26中。通过同步信号的种类识别结果及数据ID的解码结果来找到ECC块的开头，由同步信号SY来控制各帧的解调数据的开头存储。
因此，考虑记录数据的再现信号质量暂时恶化、在数帧或1扇区中不能检测同步信号或解码数据ID的情况。在这种情况下，内置在同步部件32中的再现PLL有可能引起不同步。因为记录数据中混杂调制码系列不同的标志、间隙长度的信号，所以在不能连续检测同步信号的情况下，不能容易判断PLL自身是否产生不同步。
另一方面，如上所述，由RF1得到的摆动信号的周期与由RF2得到的记录信号的周期相比足够大，所以内置在位置信息再现部件22中的摆动信号PLL与再现PLL相比，相对信号对媒体的伤痕或尘埃等的恶化稳定。因此，在上述情况下也引起不同步的可能性小。另外，即便假设引起不同步，在得到摆动信号本身作为接近将规定频率设为载波的单一周期的信号的情况下，仅通过进行摆动信号与PLL时钟的相位比较，也可容易判断摆动信号PLL是否产生不同步。
因此，即便在因记录数据质量恶化而使同步信号检测处于不能状态时，尽管相位锁定比再现PLL稳定的摆动信号PLL，但通过位置信息再现部件22确定的记录数据预测位置，可判断再现装置解调当前ECC块中的第几帧。
例如，在将某个ECC块中的解调数据存储在缓冲存储器26中的情况下，如上所述，位置信息再现部件22将记录数据预测位置指定为扇区预测位置SPx(SPx是大于0小于15的整数)、帧预测位置FPx(FPx是大于0小于25的整数)的情况下，可求出应存储该数据的缓冲存储器的存储部位的第nx行(nx为大于0小于415的整数)，作为
nx＝SPx×FPx。
这样，通过使用位置信息的再现结果及摆动信号PLL的同步时钟，可始终实时预测ECC块中的记录数据的位置。另外，通过利用记录数据的预测位置，可用块单位来控制解调后数据向缓冲存储器的存储位置。因此，即便记录数据中的同步信号连续并继续未检测状态，也可适当将解调后的数据存储到缓冲存储器中。
下面，具体说明伴随记录数据的质量恶化达到帧丢失的情况下的缓冲存储器存储控制。
首先，以如下情况为例，再现PLL在频率变低的方向上产生不同步，时间上继续7帧同步信号的未检测状态，结果，产生1帧越过(丢失)。
图5中示出1帧丢失的时序图。若再现PLL产生不同步，则如图所示，在本来应检测同步信号的时刻未进行图案检测，基于PLL同步时钟的内插功能动作，沿时间上延迟的方向输出内插同步信号SY。另外，此时为同步信号种类检测信号SYID＝8(种类不清)、帧序号FRNUM＝26(帧序号不清)。
在图例中，当同步状态信号LOCK＝1(正常同步状态)时，在连续4帧以上同步信号的未检测状态继续时，产生不同步，为LOCK＝0(不同步状态)。另外，在同步状态信号LOCK＝0(不同步状态)时，连续2帧检测同步信号时，为LOCK＝1(正常同步状态)。
并且，在同步状态信号LOCK从0变到1的时刻(即从不同步复原的时刻)，比较确认记录位置预测信号SP、FP、和扇区数计数值SC、帧数计数值FC，若(SP＝SC且FP＝FC)，则认为产生帧越过，以帧单位使帧数据向缓冲存储器26的存储位置移动。
在本例的情况下，具体说明时，在从LOCK＝0变到1的时刻，有SP＝2、FP＝5、SC＝2、FC＝4，帧数计数值FC的值为比记录位置预测信号FP小1的值，判断为在不同步期间中产生1帧丢失。因此，将帧数计数值FC从当前的4补正到5。由此，地址变换部件36的输出存储器地址MADR也可自动变更以指示正确的存储位置。因此，在从不同步复原后，可马上将数据记录在存储器的正确存储位置中。
另外，在本例中，记录位置预测信号与表示缓冲存储器的存储位置的计数值比较到帧单位，但即便更细地比较到字节单位也无妨。其中，由于两者的相对关系因记录装置中的记录位置变动或再现装置中的PLL跳动而些许变动，所以在事先考虑变动量上，期望作为比较单位，设为误差不会成问题的单位。
接着，以如下情况为例，即再现PLL在频率变高的方向上产生不同步，时间上继续10帧同步信号的未检测状态，结果，产生2帧越过(丢失)。
图6中示出插入2帧的时序图。如图所示，再现PLL产生不同步，在本来应检测同步信号的时刻未进行图案检测，基于PLL同步时钟的内插功能动作，沿时间上加快的方向输出内插同步信号SY。
在本例中，同步状态信号LOCK的转变条件与图5的实例相同。在作为从不同步复原的时刻的同步状态信号LOCK＝0变到1的时刻，记录位置预测信号为SP＝3、FP＝7，此时的扇区数计数值SC＝3，帧数计数值FC＝9，可判断为在不同步期间中产生错误数据插入，多余2帧存储在缓冲存储器中。因此，将帧数计数值FC从当前的9补正到7。由此，地址变换部件36的输出存储器地址MADR也可自动变更以指示正确的存储位置。因此，在从不同步复原后，可马上将数据记录在存储器的正确存储位置中。
图7在存储器控制部件25的缓冲存储器的存储控制的观点上在流程图中示出上面用图5和图6来在时序图中示出的处理流程。下面，说明图7的流程图。
(a)开始标的ECC块的数据再现处理。首先，正常设定表示有无不同步的同步状态信号LOCK(LOCK＝1)。
(b)取得数据及块的位置信息(S01)。
(c)判断是否检测同步信号SY(S02)。在未检测到同步信号SY的情况下，对下一帧，返回取得数据的步骤S01。另外，在未检测到同步信号SY的情况下，判断为处于不同步的状态，LOCK＝0。此时，如上所述，根据之前检测到的同步信号，内插输出同步信号SY。另一方面，在检测到同步信号SY的情况下，判断为处于正常同步的状态，LOCK＝1。
(d)根据位置信息来更新预测块内各扇区的记录位置的扇区数计数器SP与预测扇区内各帧的记录位置的帧数计数器FP。另外，根据检测或内插输出的同步信号SY，更新扇区数计数器SC与帧数计数器FC(S03)。
(e)判断是否复原帧同步、即是否从同步状态信号LOCK＝0变为1(S04)。因此，在从不同步状态(LOCK＝0)变到正常同步状态(LOCK＝10的情况下，作为同步复原，分支到YES。另一方面，在正常同步不变(维持LOCK＝1)的情况下，分支到NO。
(f)比较记录数据预测位置SP、FP、与扇区数计数值SC、帧数计数值FC(s05)。若两者一致，则判断为未产生帧越过，分支到YES。
(g)另一方面，若两者不一致，则视为产生帧越过，将扇区位置预测信号SP的值代入扇区数计数值SC。另外，将帧位置预测信号FP的值代入帧数计数值FC(S06)。
(h)将数据记录在对应于SC值、FC值的存储器的存储部位中(S07)。
(i)之后，进行结束判断(S08)，并在继续的情况下，移动到数据及位置信息取得步骤(S01)。在结束的情况下，之后进行结束处理。
通过以上流程图说明的流程来进行处理，在产生帧越过的情况下，可在从帧越过复原的时刻快速补正缓冲存储器的存储位置。
尤其是，与以来自与来自记录数据的读取信息不同类(摆动槽及脊预置凹坑)的信息进行记录位置的预测，并进行帧越过的判断及补正处理，由此仅用来自记录数据的读取信息来进行的方法相比，可更快更确实地进行记录位置的补正处理。另外，通过可由帧单位补正缓冲存储器的存储单位，不会复杂化缓冲存储器的管理，可将伴随帧越过的数据丢失限制到最小限度。
如上所述，通过本实施形态所示方法及装置，可能始终根据事先由沟形状形成的摆动槽及脊预置凹坑来预测记录数据的位置，在由于再现PLL的不同步产生帧越过的情况下，在从不同步复原的时刻，通过比较预测的记录数据的位置与解调数据的缓冲存储器的存储位置，可判断是否产生帧越过，并且通过帧越过的产生使缓冲存储器的存储部位错位，在此情况下，可用记录数据的预测位置来进行控制，将以后的解调数据存储在正确的部位。
另外，在本实施形态中，帧越过的检测及缓冲存储器的存储部位补正全部由记录位置预测信号来进行，但即便与找到记录数据的数据ID或同步信号种类(排列一致)的方法合用也无妨。例如，在帧越过的发生前后，摆动信号PLL也产生不同步，脊预置凹坑的质量差，记录数据位置预测困难的状况下，合用记录数据的数据ID或同步信号种类(排列一致)的方法是有效的。
另外，在本实施形态中，作为记录媒体的实例，说明光盘媒体，但不限于此。如本实施形态所示摆动槽及脊预置凹坑那样，在1个记录媒体上有记录用户数据的沟道和单独的沟道，两沟道在再现装置中基本可同时读取，将来自单独沟道的信息与用户数据的记录位置关联，因此，若根据来自单独沟道的读取信息能预测用户数据记录沟道的信息存储位置，则可实现发明目的。并且，只要单独沟道比用户数据记录沟道更有耐性(robustness)(对媒体的缺陷或伤痕或尘埃等具有耐错误性)即可。
另外，在本实施形态中，将缓冲存储器的存储位图设为单纯的帧单位，但不限于此。对应于纠错码的结构(积码、交织方法等)，通过装置中的编码、解码处理进行适当配置。例如，通过由纠错码的数据字节相当部分与奇偶字节相当部分在存储器空间上形成其它区域，可效率化纠正处理。另外，在将解调数据存储在缓冲存储器中的同时，去交织，可高速化处理。无论如何，只要变更提供给缓冲存储器的存储器地址的变换部件的内部结构，则可对应，则关于这种缓冲存储器的存储位图的细节差异不直接影响本发明的实质。
(实施形态2)
下面说明根据本发明实施形态2的再现方法。图10(a)～(c)是表示本实施形态2中的帧数据结构的示意图。图10(a)表示扇区的纠错码结构。各纠错码101对128字节的数据102附加16字节的奇偶位103。由8个纠错码101来构成扇区。各纠错码101的编码方向沿列方向进行编码，通过沿行方向进行记录，可提供对选通错误的纠正能力，实施交织。
各纠错码101由公知的Reed-Solomon码进行编码，通过16字节的奇偶位103，具有到8字节的纠错能力。并且，通过进行消失纠正，可进行最大到16字节的纠错。通过8个纠错码101来构成1K字节的扇区，以1扇区为最小单位来实施记录或再现。
图10(b)表示向每行分割以上纠错码的帧数据的结构，构成上述扇区的8个纠错码101在实施交织的同时，分割成由8字节构成1帧的帧数据104。
图10(c)表示帧结构，各帧数据104调制后，变为调制帧数据105。并且，在各调制帧数据105的开头附加同步信号106。这里，调制方法是DVD等使用的(8、16)调制的实例，将8比特变换为16比特，8字节的帧数据104被变换为8×16＝128比特的调制帧数据105。同步信号106由(8、16)调制中未出现的规定的特定图案与帧序号构成，具有32比特长度。1帧由32+128＝160比特构成，1扇区由共计144帧构成。另外，同步信号的结构未必为上述结构，例如，使用多个特定图案，使各帧的同步信号不同，通过检测多个帧的同步信号的特定图案的排列，特定各帧的序号。
在光盘中，一般使用上述帧结构，在由于媒体的伤痕或缺陷等产生比特越过等的情况下，通过检测各帧开头的同步信号并进行再同步，进行同步补正。
图11是表示光盘结构的示意图，表示图10的扇区被记录在光盘201上的状态。图11中，作为记录再现最小单位的扇区202分割成144帧后记录在光盘201上，各帧由32比特的同步信号204、128比特的调制帧数据203构成。
图12是说明实施形态2的再现方法的流程图，进行图10和图11所示光盘的再现。下面说明该流程图。
(a)首先，通过从来自盘的再现信号中检测同步信号，对各帧进行帧同步。该步骤是帧同步步骤301。因为同步信号由规定图案进行记录，所以通过检测与再现信号一致，进行同步信号的检测。这里，所谓帧同步是指根据再现信号来特定各帧的序号与各帧的开头，并特定各调制帧数据的开头。
(b)对各调制帧数据，形成对同步信号的检测结果进行编码的同步信号检测结果信息311。该同步信号检测结果信息生成步骤302。作为同步信号的检测结果，设定正常检测、脱离同步检测、未检测等3种同步信号检测结果，对各结果生成用2比特来编码为00、10、01的同步信号检测结果信息311。
i)正常检测
在检测同步信号时，还计数从上个帧的同步信号检测开始的比特数。这里，1帧为160比特，所以在160比特后的时刻正确检测出下一帧的同步信号的情况下，在从上一帧到该帧期间，不产生脱离同步等异常，同步信号检测结果309为正常检测。
ii)脱离同步检测
另外，在从上一帧开头开始偏离160比特的时刻检测出的情况下，以新检测到的同步信号为基准，重新进行更正帧同步的同步补正。帧同步的结果，根据特定的开头位置，对128比特的调制帧数据308实施后述的解调处理。此时，同步信号检测结果309为脱离同步检测。另外，作为该脱离同步，包含同步滞后和同步超前。
iii)未检测
另外，在未检测同步信号的情况下，继续进行当前同步，同步信号检测结果309为未检测。
另外，如后所述，同步信号检测结果信息311由8比特＝1字节构成，可由其它的6比特来特定帧的序号。另外，同步信号检测结果信息311的比特数、编码方法不限于上述情况，例如也可增加比特数来完全特定帧序号。
(c)帧同步的结果，根据特定的开头位置，对128比特的调制帧数据308实施解调处理。该步骤是解调步骤303，解调各调制帧数据，生成解调帧数据310。
(d)向解调后的各解调帧数据的开头附加同步信号检测结果信息311，发送到纠错电路块。该步骤是同步信号检测结果信息附加步骤304。
(e)分别将传输的各解调帧数据和各同步信号检测结果信息311存储在DRAM等存储器的不同区域中。该步骤是存储器存储步骤305。
(f)根据存储在存储器中的各同步信号检测结果信息311，在消失纠正时，生成特定错误位置的消失指针。这里，仅由各同步信号检测结果信息311来生成消失指针，但也可与能推测其它错误位置的部件组合。该步骤是消失指针生成步骤306。
(g)用消失指针来进行消失纠正。该步骤是纠错步骤307。通过进行消失纠正，可得到最大2倍的纠正能力。
下面，用图13～图24进行从帧同步步骤301至存储器存储步骤305的各步骤的详细说明。
(实施例1)
图13、图14是表示同步信号检测结果为正常检测的实施例1的图。图13(a)是表示帧同步步骤301中输入的再现信号的数据结构的示意图，图13(b)是表示从同步信号检测结果步骤304发送到存储器存储步骤305的解调帧数据和同步信号检测结果信息的数据结构的示意图。
图13中，第m+1帧的同步信号402是根据第m个同步信号401的检测时刻以128+32比特的时刻正确检测的实例。即，通过时钟计数从第m帧的同步信号401的检测时刻推测的第m+1帧的同步时刻与实际上检测同步信号402的时刻一致的实例。
此时，基于帧同步步骤301的同步信号检测结果为正常检测00，由同步信号检测结果信息生成步骤302生成的第m+1帧的同步信号检测结果信息406的下位2比特为00。另外，同步信号检测结果信息由1字节＝8比特构成，虽未图示，但由上位比特(6比特)存储帧序号的下位6比特。例如由同步信号检测结果信息406来存储第m+1的下位6比特。
另外，根据帧同步步骤301的帧步骤，调制帧数据404由解调步骤303解调后，生成解调帧数据408。在本实施形态2中，用(8、16)调制，所以将128比特的调制帧数据变换为8字节的解调帧数据。
通过同步信号检测结果附加步骤304，在各解调帧数据的开头附加各同步信号检测结果信息，之后发送到纠错电路块的存储器存储步骤305。如上所述，因为在各解调帧数据中附加与之对应的同步信号检测结果信息，所以可容易将各解调帧数据与同步信号检测结果进行对应。
图14表示将在图13的各解调帧数据的开头附加各同步信号检测结果信息后的送出数据存储在存储器中的状态。图14中，将同步信号检测结果信息与解调帧数据存储在存储器的不同区域中。另外，对不同区域的存储既可在单一存储器中仅存储区域不同，也可使用不同存储器来分别设定存储区域。
在各区域中，按各帧序号来将同步信号检测结果信息和解调帧数据存储在规定地址中。例如，第m+1帧的同步信号检测结果信息502的下位2比特为00，被存储在规定的m+1位置上。另外，第m+1帧的解调帧数据503同样存储在规定的m+1位置上。将解调帧数据与同其对应的同步信号检测结果信息彼此对应来存储。
(实施例2)
图15、图16是表示同步信号检测结果是未检测的实施例2的图。图15(a)是表示帧同步步骤301中输入的再现信号的数据结构的示意图，图15(b)是表示从同步信号检测结果附加步骤304发送到存储器存储步骤305的解调帧数据和同步信号检测结果信息的数据结构的示意图。
图15中，第m+1帧的同步信号602是因媒体伤痕等而未检测到的实例。此时，帧同步步骤301的同步信号检测结果为未检测，由同步信号检测结果信息生成步骤302生成的第m+1帧的同步信号检测结果信息606的下位2比特变为01。另外，同步信号检测结果信息由1字节＝8比特构成，虽未图示，但在上位比特中存储帧序号的下位6比特。例如，在同步信号检测结果信息606中存储第m+1下位6比特。
在帧同步步骤301中，因为同步信号601未检测，所以从第m帧的同步信号601的检测时刻开始由时钟计数推测的时刻为同步时刻。但此时的可靠性低。
接着，根据帧同步步骤301的帧同步，调制帧数据604通过解调步骤303解调后，生成解调帧数据608。在本实施形态2中由于使用(8、16)调制，所以将128比特的调制帧数据变换为8字节的解调帧数据。
通过同步信号检测结果附加步骤304向各解调帧数据的开头附加各同步信号检测结果信息，发送到纠错电路块中的存储器存储步骤305。如上所述，因为向各解调帧数据附加与之对应的同步信号检测结果信息，所以可容易将各解调帧数据与同步信号检测结果相对应。由此，同步信号检测结果信息可容易特定未检测的解调帧数据。
图16表示在图15的各解调帧数据的开头附加了各同步信号检测结果信息后的送出数据被存储在存储器中的状态。图16中，将同步信号检测结果信息与解调帧数据存储在存储器的不同区域中。
在各区域中，按各帧序号将同步信号检测结果信息和解调帧数据存储在规定地址中。例如，第m+1帧的同步信号检测结果信息702的下位2比特为01，存储在规定的m+1的位置上。另外，第m+1帧的解调帧数据703同样存储在规定的m+1的位置上。另外，将解调帧数据和与之对应的同步信号检测结果信息彼此对应地存储。
(实施例3)
图17、图18是在不同于根据之前检测的同步信号的检测结果时刻预测的时刻的时刻检测到新的同步信号的情况，是同步信号检测结果为脱离同步检测情况的实施例3。此时必需同步补正。图17(a)是表示帧同步步骤301中输入的再现信号的数据结构的示意图，图17(b)是表示从同步信号检测结果附加步骤304发送到存储器存储步骤305的解调帧数据和同步信号检测结果信息的数据结构的示意图。
图17中，此时的第m+1帧的同步信号802从第m同步信号801的检测时刻开始本应在32+128比特的时刻检测，但由于PLL脱离等，产生时钟频率下降，在32+112比特的时刻、即与本来的时刻相比，产生同步延迟。
此时，帧同步步骤301的同步信号检测结果为同步补正，由同步信号检测结果信息生成步骤302生成的第m+1帧的同步信号检测结果信息806的下位2比特变为10。
在帧同步步骤301中，因为同步信号802在不同于由时钟预测的时刻的时刻下检测，所以在重新检测同步信号802的时刻补正同步。
接着，根据帧同步步骤301的帧同步，调制帧数据804通过解调步骤303解调后，生成解调帧数据808。在本实施形态2中由于使用(8、16)调制，所以将128比特的调制帧数据变换为8字节的解调帧数据。另一方面，帧m的解调帧数据807由于比特数不足，所以这里为7字节。
通过同步信号检测结果附加步骤304向各解调帧数据的开头附加各同步信号检测结果信息，发送到纠错电路块的存储器存储步骤305。如上所述，因为向各解调帧数据附加与之对应的同步信号检测结果信息，所以可容易将各解调帧数据与同步信号检测结果相对应。由此，同步信号检测结果信息可容易特定同步补正的解调帧数据。
图18表示在图17的各解调帧数据的开头附加了各同步信号检测结果信息后的送出数据被存储在存储器中的状态。图18中，将同步信号检测结果信息与解调帧数据存储在存储器的不同区域中。另外，将解调帧数据和与之对应的同步信号检测结果信息彼此对应地存储。
在各区域中，按各帧序号将同步信号检测结果信息和解调帧数据存储在规定地址中。例如，第m+1帧的同步信号检测结果信息902的下位2比特为10，存储在规定的m+1的位置上。另外，第m+1帧的解调帧数据903同样存储在规定的m+1的位置上。另外，将解调帧数据和与之对应的同步信号检测结果信息彼此对应地存储。
另外，第m帧的解调帧数据903仅存储7字节，越过1字节大小后存储第m+1的解调帧数据904。可知例如通过单独设置在从同步信号检测结果附加步骤304向存储器存储步骤305传输时、区别与传输数据一起传输的数据是同步信号检测结果信息或解调帧数据的控制信号，可容易实现这种越过。
以上脱离同步检测的第1例是同步补正相当于1字节大小的同步延迟的实例，但不到1帧的同步延迟补正的情况也一样。
(实施例4)
图19、图20是与上述一样在不同于根据之前检测的同步信号的检测结果时刻预测的时刻的时刻检测到新的同步信号的情况，是表示同步信号检测结果为脱离同步检测的第2例的实施例4的图。实施例4中，与第1例的情况相反，是补正不到1帧的同步提前的情况一实例。
图19(a)是表示帧同步步骤301中输入的再现信号的数据结构的示意图，图19(b)是表示从同步信号检测结果附加步骤304发送到存储器存储步骤305的解调帧数据和同步信号检测结果信息的数据结构的示意图。图19中，此时的第m+1帧的同步信号802从第m同步信号801的检测时刻开始本应在32+128比特的时刻检测，但由于PLL脱离等，产生时钟频率上升，在32+144比特的时刻、即与本来的时刻相比，产生同步提前。
此时，帧同步步骤301的同步信号检测结果为脱离同步检测10。因此，通过同步信号检测结果信息生成步骤302，第m+1帧的同步信号检测结果信息1006的下位2比特变为10。
帧同步步骤301中，因为同步信号1002在不同于由时钟预测的时刻的时刻下检测，所以在重新检测的同步信号1002的时刻补正同步。
接着，根据帧同步步骤301的帧同步，调制帧数据1004通过解调步骤303解调后，生成解调帧数据1008。另一方面，帧m的解调帧数据807的比特数多余，但由于1个解调帧数据最大为8字节，所以仅传输开头的8字节。
通过同步信号检测结果附加步骤304向各解调帧数据的开头附加各同步信号检测结果信息，发送到纠错电路块的存储器存储步骤305。如上所述，因为向各解调帧数据附加与之对应的同步信号检测结果信息，所以可容易将各解调帧数据与同步信号检测结果相对应。由此，同步信号检测结果信息可特定同步补正的对应的解调帧数据。
图20表示图19所示各解调帧数据的开头附加了各同步信号检测结果信息后的送出数据被存储在存储器中的状态。图20中，将同步信号检测结果信息与解调帧数据存储在存储器的不同区域中。另外，将解调帧数据和与之对应的同步信号检测结果信息彼此对应地存储。
在各区域中，按各帧序号将同步信号检测结果信息和解调帧数据存储在规定地址中。例如，第m+1帧的同步信号检测结果信息1102的下位2比特为10，存储在规定的m+1的位置上。另外，第m+1帧的解调帧数据1103同样存储在规定的m+1的位置上。
(实施例5)
图21、图22是同步信号检测结果同样在不同于由基于上次检测的同步信号的时钟预测的时刻的时刻检测同步信号的情况，是表示必需同步补正的第3例的实施例5的图。实施例5中，与第1和第2例不同，是补正大于1帧的同步延迟的情况的实例。
图21(a)是表示帧同步步骤301中输入的再现信号的数据结构的示意图，图21(b)是表示从同步信号检测结果附加步骤304发送到存储器存储步骤305的解调帧数据和同步信号检测结果信息的数据结构的示意图。图21中，第m+3的同步信号1202是在第m同步信号801的检测之后检测的实例。此时本应检测第m+1同步信号，但由于PLL脱离等，产生时钟频率急剧上升，与本来的时刻相比，产生1帧以上的同步延迟。
此时，帧同步步骤301的同步信号检测结果为脱离同步检测10。因此，通过同步信号检测结果信息生成步骤302，第m+3帧的同步信号检测结果信息1206的下位2比特变为10。
帧同步步骤301中，因为同步信号1202在不同于由时钟预测的时刻的时刻下检测同步信号，所以在重新检测的同步信号1202的时刻补正同步。
接着，根据帧同步步骤301的帧同步，调制帧数据1204通过解调步骤303解调后，生成解调帧数据1208。
通过同步信号检测结果附加步骤304向各解调帧数据的开头附加各同步信号检测结果信息，发送到纠错电路块的存储器存储步骤305。如上所述，因为向各解调帧数据附加与之对应的同步信号检测结果信息，所以可容易将各解调帧数据与同步信号检测结果相对应。由此，同步信号检测结果信息可容易特定同步补正的解调帧数据。
图22表示图21所示各解调帧数据的开头附加了各同步信号检测结果信息后的送出数据被存储在存储器中的状态。图22中，将同步信号检测结果信息与解调帧数据存储在存储器的不同区域中。另外，将解调帧数据和与之对应的同步信号检测结果信息彼此对应地存储。
在各区域中，按各帧序号将同步信号检测结果信息和解调帧数据存储在规定地址中。例如，第m+3帧的同步检测结果信息1302的下位2比特为10，存储在规定的m+3的位置上。另外，第m+3帧的解调帧数据1303同样存储在规定的m+3的位置上。
另外，为了不传输第m+1和第m+2帧的同步信号检测结果信息和解调帧数据，越过上述信息和数据后变为未存储。另外，这些越过可通过参照存储在同步信号检测结果信息的上位比特中的帧序号来容易实现。
作为更期望的实施形态，在检测这种越过时，最好在越过的同步信号检测结果信息中存储同步信号未检测情况下的代码01。这里，将代码01存储在第m+1、和第m+2的同步信号检测结果信息中。通过存储代码01，如后所述，可对越过的解调帧数据生成消失指针。
这里，说明在正常检测的帧之后产生1帧以上同步延迟的实例，但例如在多个帧中产生同步信号未检测后，从最后检测到同步信号的帧开始计数时钟的帧与重新检测到的同步信号错位1帧以上的情况等也可同样处理。
(实施例6)
图23、图24是表示同步信号与上述情况一样在不同于由基于时钟预测的时刻的时刻下被检测、必需同步补正的第4例的实施例6的图。实施例6中，与实施例5相反，是补正大于1帧的同步提前的情况的实例。图23(a)是表示帧同步步骤301中输入的再现信号的数据结构的示意图，(b)是表示从同步信号检测结果附加步骤304发送到存储器存储步骤305的解调帧数据和同步信号检测结果信息的数据结构的示意图。
图23中，第m的同步信号1402是在第m同步信号1401的检测之后再次检测的实例。在本应检测第m+1同步信号，但最初的第m同步信号1401为假的检测的情况、或在多个帧中产生同步信号未检测后、从最后检测到同步信号的帧开始计数时钟的帧与重新检测到的同步信号错位1帧以上的情况等也可同样处理。
此时，帧同步步骤301的同步信号检测结果为脱离同步检测10。因此，通过同步信号检测结果信息生成步骤302，第m帧的同步信号检测结果信息1406的下位2比特变为10。
帧同步步骤301中，因为同步信号1402在不同于由时钟预测的时刻的时刻下检测，所以在重新检测的同步信号1402的时刻补正同步。
接着，根据帧同步步骤301的帧同步，调制帧数据1404通过解调步骤303解调后，生成解调帧数据1408。
通过同步信号检测结果附加步骤304向各解调帧数据的开头附加各同步信号检测结果信息，发送到纠错电路块的存储器存储步骤305。如上所述，因为向各解调帧数据附加与之对应的同步信号检测结果信息，所以可容易将各解调帧数据与同步信号检测结果相对应。由此，同步信号检测结果信息可容易特定为脱离同步检测的解调帧数据。
图24是表示图23所示各解调帧数据的开头附加了各同步信号检测结果信息后的送出数据被存储在存储器中的状态示意图。图24中，将同步信号检测结果信息与解调帧数据存储在存储器的不同区域中。另外，将解调帧数据和与之对应的同步信号检测结果信息彼此对应地存储。
在各区域中，按各帧序号将同步信号检测结果信息和解调帧数据存储在规定地址中。例如，第m帧的同步检测结果信息1502的下位2比特为10，存储在规定的m的位置上。另外，第m帧的解调帧数据1503同样存储在规定的m的位置上。
共计传输两次第m帧的同步信号检测结果信息和解调帧数据，但后传输的信息和数据覆盖先传输的信息和数据。另外，这种覆盖动作也与越过一样，可通过参照存储在同步信号检测结果信息的上位比特中的帧序号来容易实现。
下面，通过图13～图24进行了同步信号的检测及同步补正的详细说明，但作为更期望的实施形态，通过取得设置限制检测同步信号的范围的窗口，并使该窗口的大小取决于同步信号的未检测的连续或检测的连续等并使其变化的结构，可对假的同步信号检测实现较强的耐性。
接着，用图25来进行消失指针生成步骤306的详细说明。图25图示根据存储在存储器中的同步检测结果信息来对存储在不同区域中的解调帧数据生成消失指针。图25中，(a)是同步信号检测结果信息，(b)是构成扇区的纠错码的解调帧数据，按与图10(a)相同的结构那样，列方向的码长度128+16字节的码由8个构成，对行方向的帧数据单位、即图25中对1行的8字节单位生成消失指针。
如上所述，同步信号检测结果信息存在正常检测00、未检测01、脱离同步检测10这3种。
(a)正常检测00的情况下，对对应的解调帧数据不生成消失指针。
(b)在未检测01的情况下(1606)，因为该帧的解调帧数据1608仅以之前的同步信号检测结果开始的时钟计数来进行同步处理，所以判断为可靠性低，对该解调帧数据1608生成消失指针1604。
(c)在脱离同步检测10的情况下(1607)，在该帧的同步检测时，由于进行了同步补正，所以该帧的1个当前的解调帧数据1609判断为可靠性低，对该帧的1个当前的解调帧数据1609生成消失指针1605。
将这些消失指针置于列方向的码的错误位置上，进行消失纠正。通过进行消失纠正，每个码的纠正个数最大提高到2倍。另外，消失指针的生成可通过在纠错电路在消失纠错时可参照的寄存器等中保存存储该解调帧数据的行序号等来实现。
如上所述，在本发明实施形态2的再现方法中，将同步信号检测结果信息与解调帧数据一起发送到纠错电路块，用这些信息与数据来生成消失指针，由此可进行消失纠正。结果，可实现可靠性高的数据再现。
(实施形态3)
实施形态3是本发明的再现控制电路的一实施例，是实施形态2的再现方法的电路结构例。图26是实施形态3的再现控制电路的结构图，具备解调电路块1701和纠错电路块1702。解调电路块1701具备帧同步电路1703、同步信号检测结果信息生成电路1705、解调电路1704、同步信号检测结果附加电路1706。另外，纠错电路块1702具备纠错电路1710、消失指针生成电路1709等，使用外部存储器1708来执行纠错。
下面说明该再现控制电路的动作。
(a)将从光盘再现的再现信号1713输入帧同步电路1703。
(b))帧同步电路1703检测各帧的开头的同步信号，进行帧同步。帧同步的结果，将同步信号检测结果1715送到同步信号检测结果信息生成电路1705。另外，将调制帧数据1714送到解调电路1704。帧同步电路1703可由图案比较电路或计数器等容易构成。
(c)解调电路1704解调调制帧数据1714，送出解调帧数据1716。这里，由公知的(8、16)调制方式的解调电路构成。
(d)同步信号检测结果信息生成电路1705以规定的规则来编码同步信号检测结果1715。这里，正常检测为00，未检测为01，脱离同步检测为10。并且，同步信号检测结果信息生成电路1705与帧序号的下位6比特一致，生成1字节的同步信号检测结果信息1717。同步信号检测结果信息生成电路1705可由逻辑电路等容易构成。
(e)同步信号检测结果附加电路1706在各帧的解调帧数据1716的开头附加同步信号检测结果信息1717，送出到纠错电路块1702。并且，同步信号检测结果附加电路1706将送出数据1719与用于区别同步信号检测结果信息和解调帧数据的控制信号1721合在一起发送。同步信号检测结果附加电路1706由选择器等构成。
(f)由分离电路1707来分离送出的同步信号检测结果信息与解调帧数据。分离时，使用区别各信息与数据的控制信号1721。经总线控制电路1711，将分离后的同步信号检测结果信息与解调帧数据存储在存储器1708的各不相同的区域中。分离电路1707可由两个独立的地址生成电路等容易构成。另外，省略其细节。
(g)消失指针生成电路1709根据存储在存储器1708中的同步检测结果信息，生成消失指针，并存储在纠错电路1710可参照的寄存器中。消失指针生成电路1709可由微处理器等构成。
(h)纠错电路1710对由存储在存储器中的解调帧数据构成的纠错码，实施使用消失指针的消失纠正。纠错电路1710可由公知的Reed-Solomon码的纠正电路构成。
(i)I/F控制电路1712将存储在执行纠错的存储器1708中的再现数据1720发送到例如MPEG解调电路等。I/F控制电路也可是与ATAPI或SCSI协议控制电路的接口电路。
(j)总线控制电路1711进行内部总线1718的控制和对存储器1808的记录再现。
如上所述，在本发明实施形态3的再现控制电路中，将同步信号检测结果信息与解调帧数据一起发送到纠错电路块，并用这些信息与数据来生成消失指针，由此可进行消失纠正。结果，可实现可靠性高的数据再现。另外，帧同步或同步信号检测结果信息、消失指针的生成等细节与实施形态2一样，所以省略。
(实施形态4)
实施形态4是本发明的再现装置的一实施例，是包含实施形态3的再现控制电路1814的光盘再现装置的构成例。图27是表示从记录压缩图像数据的光盘1801中再现该数据的光盘再现装置的结构框图。该再现装置除实施形态3的再现控制电路1814外，还具备由半导体激光器或光学元件构成的光头1802、2值化模拟再现信号后生成数字再现信号的再现电路1808及进行再现装置整体的控制的控制CPU1809。主要部1814具备解调电路块1804、纠错电路块1805、存储器1806。
下面说明上述结构的光盘再现装置的动作。
从光头1802的半导体激光器照射的激光变为由形成在光盘1801的记录面上的凹坑或浓淡点调制的反射光，返回光头1802。调制后的反射光通过光电元件被变换为电信号，作为模拟的再现信号1810，输入再现电路1803。再现电路1803进行从模拟到数字的变换，形成数字的再现信号后，发送到再现控制电路1814。
再现控制电路1814如实施形态3中说明的那样，进行帧同步、解调和使用由同步检测结果信息生成的消失指针的消失纠正。详细动作与实施形态3一样，所以省略。
MPEG解码电路1807对执行纠错后被纠错的再现数据1811进行MPEG解码。DA变换电路1808对扩展后的再现数据1812进行模拟变换，作为声音或图像信号1813发送到TV监视器等。
由控制CPU1809进行这些光盘再现装置整体的控制。另外，在本结构图中，省略控制信号或聚焦、跟踪等所用的伺服电路等。
在上述结构的实施形态4的光盘再现装置中，将同步信号检测结果信息附加到对应的解调帧数据上后，发送到纠错电路块，并用这些信息与数据来生成消失指针，由此可特定对应的解调帧数据，可地对应的解调帧数据进行消失纠正。结果，可实现可靠性高的数据再现。
另外，本实施形态中说明的任何具体结构、具体数值的示例不限定本发明的规定。本发明仅在专利请求的范围内规定。

Claims (23)

1、一种记录媒体的再现方法，在以具有多个规定长度的帧的块单位来记录数据的同时，记录所述块的位置信息，其特征在于：包含以下步骤：
从所述记录媒体中取得所述数据与所述块的位置信息；
根据取得的所述块的位置信息，预测所述块内的每个所述帧的记录位置；
根据取得的所述数据，以所述帧单位取得同步；
根据预测到的所述记录位置，确定取得的所述数据存储到存储器的存储部位；以及
将取得的所述数据存储在确定的所述存储器的所述存储部位中。
2、根据权利要求1所述的记录媒体的再现方法，其特征在于：
还包含如下步骤：
判断是否取得所述数据的所述帧单位的同步；和
在未得到所述帧单位的同步的情况下，再次检测所述帧单位的同步复原，
在检测所述帧单位的同步复原的情况下，根据预测的所述帧的记录位置，确定所述数据存储到所述存储器的存储部位。
3、根据权利要求1所述的记录媒体的再现方法，其特征在于：
以所述帧为最小单位来确定所述数据存储到所述存储器的存储部位。
4、根据权利要求1所述的记录媒体的再现方法，其特征在于：
所述记录媒体按与所述数据不同的形态来记录所述块的位置信息。
5、根据权利要求1所述的记录媒体的再现方法，其特征在于：
还包含：
同步信号检测结果信息生成步骤，生成以规定规则来编码所述帧单位的同步信号检测结果的同步信号检测结果信息；
解调步骤，解调所述各帧的数据，生成解调帧数据；以及
同步信号检测结果附加步骤，使所述帧的所述同步信号检测结果信息对应并附加在所述各解调帧数据上。
6、根据权利要求1所述的记录媒体的再现方法，其特征在于：
还包含：根据取得的所述位置信息来得到所述帧单位下的同步的步骤。
7、一种再现控制电路，是在以具有多个规定长度的帧的块单位来记录数据的同时，记录所述块的位置信息的记录媒体的再现控制电路，其特征在于：包含：
从所述记录媒体中取得所述数据与所述块的位置信息的信号读取部件；
根据取得的所述块的位置信息，预测所述块内的帧单位的记录位置的记录位置预测部件；
根据取得的所述数据，以所述帧单位取得同步的同步部件；
存储所述数据的存储器；以及
根据预测到的所述记录位置，确定所述数据存储到所述存储器的存储部位的控制部件。
8、根据权利要求7所述的再现控制电路，其特征在于：
还包含：同步检测部件，检测是否取得所述数据的所述帧单位的同步，同时，在未得到所述帧单位的同步的情况下，再次检测帧单位的同步复原，
所述控制部件，在由所述同步检测部件检测到帧单位的同步复原的情况下，根据由所述记录位置预测部件预测到的所述记录位置，确定取得的所述数据存储到所述存储器的存储部位。
9、根据权利要求7所述的再现控制电路，其特征在于：
以所述帧为最小单位来确定所述数据存储到所述缓冲存储器的存储部位。
10、一种再现装置，其特征在于：包含权利要求7～9之一所述的再现控制电路。
11、一种再现方法，将纠错编码数据的编码数据分割成规定长度的多个帧数据，从记录有调制后的调制帧数据和附加在所述调制帧数据开头的规定同步信号的记录媒体中，再现所述数据，其特征在于：包含：
信号取得步骤，从所述记录媒体中取得信号；
同步信号检测步骤，通过从取得的所述信号中检测所述各帧的同步信号，得到同步信号检测结果；
帧同步步骤，根据得到的所述同步信号检测结果，补正所述帧的同步；
同步信号检测结果信息生成步骤，生成以规定规则编码所述各同步信号检测结果的同步信号检测结果信息；
解调步骤，解调所述各帧的调制帧数据，生成解调帧数据；以及
同步信号检测结果附加步骤，使所述帧的所述同步信号检测结果信息对应并附加在所述各解调帧数据上。
12、根据权利要求11所述的再现方法，其特征在于：
还包含：消失指针生成步骤，对于所述各解调帧数据，使用对应的所述同步信号检测结果信息，生成用于消失纠正的消失指针；和
纠错步骤，使用对应于所述解调帧数据的所述消失指针，进行所述多个由所述解调帧数据构成的纠错码的消失纠正。
13、根据权利要求11所述的再现方法，其特征在于：
还包含：存储器存储步骤，将所述同步信号检测结果信息与对应的所述解调帧数据彼此关联，存储在存储器的不同区域中。
14、根据权利要求11～13之一所述的再现方法，其特征在于：
经编码的所述同步信号检测结果信息，至少被区分成，当正常检测出所述同步信号情况下的“正常检测”、未检测出所述同步信号的“未检测”、以及在脱离了根据所检测的前一同步信号检测结果的时刻而预测的时刻的时刻检测出新的同步信号的情况的“脱离同步检测”，的3种检测结果。
15、根据权利要求11～14之一所述的再现方法，其特征在于：
在所述帧同步步骤中，当补正比根据所检测的前一同步信号检测结果时刻而预测的时刻还早地检测出新同步信号的同步延迟、且所述同步延迟不到1帧的情况下，
在所述存储器存储步骤中，将向存储器的存储位置补正为越过相当所述同步延迟的补正量的位置后，将同步延迟补正之后的下一所述帧数据存储在所述存储器中。
16、根据权利要求15所述的再现方法，其特征在于：
在所述帧同步步骤中，当补正比根据所检测的前一同步信号检测结果时刻而预测的时刻还早地检测出新同步信号的同步延迟、且所述同步延迟为大于1帧的同步延迟的情况下，
在所述存储器存储步骤中，将向存储器的存储位置补正为越过相当所述同步延迟的补正量的位置后，分别将同步延迟补正之后的下一所述同步信号检测结果信息和所述帧数据存储在所述存储器中，同时，
在所述消失指针生成步骤中，将越过后未存储在所述存储器中的同步信号检测结果信息，视为“未检测”，生成消失指针。
17、一种再现控制电路，将纠错编码数据的编码数据分割成规定长度的多个帧数据，从记录有调制后的调制帧数据与附加在所述调制帧数据开头的规定同步信号的记录媒体中，再现所述数据，其特征在于：具备：
帧同步部件，根据通过从记录媒体取得的再现信号中检测所述各帧的同步信号所得到的同步信号检测结果，补正所述帧的同步；
同步信号检测结果信息生成部件，生成分别以规定规则编码所述各同步信号检测结果的同步信号检测结果信息；
解调部件，解调所述各帧的调制帧数据，生成解调帧数据；
同步信号检测结果附加部件，将所述帧的所述同步信号检测结果信息附加在所述各解调帧数据的开头；
存储器，存储所述同步信号检测结果信息和所述各解调帧数据；以及
存储器存储部件，将所述同步信号检测结果信息和所述各解调帧数据存储在所述存储器中。
18、根据权利要求17所述的再现控制电路，其特征在于：
还具备：消失指针生成部件，使用所述同步信号检测结果信息，生成用于消失纠正的消失指针；和
纠错部件，对由所述解调帧数据构成的纠错码，使用所述消失指针来进行消失纠正。
19、根据权利要求17或18所述的再现控制电路，其特征在于：
所述存储器存储部件将所述同步信号检测结果信息与解调帧数据存储在存储器的不同区域中。
20、根据权利要求17～19之一所述的再现控制电路，其特征在于：
经编码的同步信号检测结果信息，至少被区分成，当正常检测出所述同步信号情况下的“正常检测”、未检测出所述同步信号的“未检测”、以及在脱离了根据所检测的前一同步信号检测结果的时刻而预测的时刻的时刻检测出新的同步信号的情况的“脱离同步检测”，的3种检测结果。
21、根据权利要求17～20之一所述的再现控制电路，其特征在于：
当用所述帧同步部件补正比根据所检测的前一同步信号而预测的时刻还早地检测出新同步信号的同步延迟、且所述同步延迟不到1帧的情况下，
所述存储器存储部件，将所述同步延迟补正之后的下一所述帧数据存储到所述存储器的存储位置补正为越过相当所述同步延迟的补正量的位置后，将所述帧数据存储在所述存储器中。
22、根据权利要求21所述的再现控制电路，其特征在于：
当用所述帧同步部件补正比根据所检测的前一同步信号而预测的时刻还早地检测出新同步信号的同步延迟、且所述同步延迟为大于1帧的同步延迟的情况下，
所述存储器存储部件，将所述同步延迟补正之后的下一所述同步信号检测结果信息和所述帧数据存储到所述存储器的存储位置，补正为越过相当所述同步延迟的补正量的存储位置后，将所述帧数据存储在所述存储器中，同时，
所述消失指针生成部件，将越过后未存储在所述存储器中的帧所对应的同步信号检测结果信息视为“未检测”，生成消失指针。
23、一种再现装置，其特征在于：包含权利要求17～22之一所述的再现控制电路。
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