CN117612467A - 显示面板 - Google Patents

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Abstract

提供了显示面板。显示面板包括：基础层，布置在基础层上并且包括第一驱动电路、第二驱动电路和多个像素电路的电路层，以及布置在电路层上并且包括多个发光元件的发光元件层，多个发光元件中的每个电连接到多个像素电路中的对应的一个。在第一方向上，第一驱动电路和第二驱动电路中的每个被布置在多个像素电路之间。

Description

显示面板
技术领域
本文中的本公开涉及具有改进的显示质量并且具有扩展的显示区的显示面板。
背景技术
诸如电视、移动电话、平板电脑、计算机、导航系统单元和游戏机的多媒体电子装置配备有用于显示图像的显示面板。
显示面板包括发光元件和用于驱动发光元件的电路。显示面板中的发光元件根据从电路施加的电压发射光并且生成图像。为了提高显示面板的可靠性，正在对发光元件和电路的连接进行研究。
发明内容
本公开提供了具有改善的显示质量和窄边框的显示面板。
根据本公开的实施方式，显示面板可以包括：基础层，布置在基础层上并且包括第一驱动电路、第二驱动电路和多个像素电路的电路层，以及布置在电路层上并且包括多个发光元件的发光元件层，多个发光元件中的每个电连接到多个像素电路中的对应的一个。第一驱动电路和第二驱动电路中的每个可以在第一方向上被布置在多个像素电路之间。
在实施方式中，第一驱动电路可以是扫描驱动电路，并且第二驱动电路可以是发射控制驱动电路。
在实施方式中，多个发光元件可以包括在平面视图中与第一驱动电路和第二驱动电路重叠的第一发光元件组以及在平面视图中与多个像素电路重叠的第二发光元件组。
在实施方式中，第一发光元件组中的多个发光元件中的每个可以通过连接线电连接到多个像素电路中的相邻的一个。
在实施方式中，第一发光元件组中的多个发光元件中的每个可以包括布置在电路层上的第一电极，布置在第一电极上的发光层，以及布置在发光层上的第二电极。第一电极可以电连接到连接线。
在实施方式中，多个像素电路中的每个可以电连接到第一驱动电路和第二驱动电路。
在实施方式中，电路层还可以包括与第一驱动电路和第二驱动电路间隔开的第三驱动电路。第二驱动电路可以在第一方向上介于第一驱动电路与第三驱动电路之间。
在实施方式中，多个像素电路中的每个可以电连接到第二驱动电路以及第一驱动电路和第三驱动电路中的更近的一个。
在实施方式中，多个发光元件可以包括在平面视图中与第一驱动电路、第二驱动电路和第三驱动电路重叠的第一发光元件组以及在平面视图中与多个像素电路重叠的第二发光元件组。第一发光元件组中的多个发光元件中的每个可以通过连接线电连接到多个像素电路中的相邻的一个。
在实施方式中，电路层还可以包括在第一方向上布置在第二驱动电路与第三驱动电路之间的第四驱动电路。
在实施方式中，多个像素电路中的每个可以电连接到第一驱动电路和第三驱动电路中的更近的一个以及第二驱动电路和第四驱动电路中的更近的一个。
在实施方式中，多个发光元件可以包括在平面视图中与第一驱动电路、第二驱动电路、第三驱动电路和第四驱动电路重叠的第一发光元件组以及在平面视图中与多个像素电路重叠的第二发光元件组。第一发光元件组中的多个发光元件中的每个可以通过连接线电连接到多个像素电路中的相邻的一个。
在实施方式中，第一驱动电路和第二驱动电路中的每个可以在与第一方向相交的第二方向上延伸。
根据本公开的实施方式，显示面板可以包括：包括显示区和被布置成与显示区相邻的非显示区的基础层，布置在基础层上并且包括布置在显示区中的第一驱动电路、在第一方向上与第一驱动电路间隔开的第二驱动电路以及多个像素电路的电路层，以及布置在电路层上并且包括布置在显示区中的多个发光元件的发光元件层，多个发光元件中的每个电连接到多个像素电路中的对应的一个。在第一方向上，多个像素电路中的至少一个可以被布置在第一驱动电路与第二驱动电路之间。
在实施方式中，多个像素电路中的每个可以电连接到第一驱动电路和第二驱动电路。
在实施方式中，多个发光元件可以包括在平面视图中与第一驱动电路和第二驱动电路重叠的第一发光元件组以及在平面视图中与多个像素电路重叠的第二发光元件组。第一发光元件组中的多个发光元件中的每个可以通过连接线电连接到多个像素电路中的相邻的一个。
在实施方式中，电路层还可以包括与第一驱动电路和第二驱动电路间隔开的第三驱动电路。第二驱动电路在第一方向上介于第一驱动电路与第三驱动电路之间。多个像素电路中的每个可以电连接到第二驱动电路以及第一驱动电路和第三驱动电路中的更近的一个。
在实施方式中，多个发光元件可以包括在平面视图中与第一驱动电路、第二驱动电路和第三驱动电路重叠的第一发光元件组以及在平面视图中与多个像素电路重叠的第二发光元件组。第一发光元件组中的多个发光元件中的每个可以通过连接线电连接到多个像素电路中的相邻的一个。
在实施方式中，电路层还可以包括在第一方向上布置在第二驱动电路与第三驱动电路之间的第四驱动电路，并且多个像素电路中的每个可以电连接到第一驱动电路和第三驱动电路中的更近的一个以及第二驱动电路和第四驱动电路中的更近的一个。
在实施方式中，多个发光元件可以包括在平面视图中与第一驱动电路、第二驱动电路、第三驱动电路和第四驱动电路重叠的第一发光元件组以及在平面视图中与多个像素电路重叠的第二发光元件组。第一发光元件组中的多个发光元件中的每个可以通过连接线电连接到多个像素电路中的相邻的一个。
附图说明
包含附图来提供对本公开的进一步理解，并且附图被并入本说明书中并且构成本说明书的一部分。附图图示了本公开的实施方式，并且与描述一起用于说明本公开的原理。在附图中：
图1A是根据本公开的实施方式的电子装置的示意性框图；
图1B是根据本公开的实施方式的像素的等效电路的示意图；
图2是示意性地图示根据本公开的实施方式的显示面板的平面视图；
图3A是示意性地图示根据本公开的实施方式的显示面板的平面视图；
图3B是示意性地图示根据本公开的实施方式的显示面板的分解透视图；
图3C是根据本公开的实施方式的显示面板的局部区的放大平面视图；
图3D是根据本公开的实施方式的显示面板的局部区的放大平面视图；
图3E是根据本公开的实施方式的显示面板的局部区的放大平面视图；
图4A是根据本公开的实施方式的显示面板的示意性剖视图；
图4B是根据本公开的实施方式的显示面板的示意性剖视图；
图5是示意性地图示根据本公开的实施方式的显示面板的平面视图；并且
图6是示意性地图示根据本公开的实施方式的显示面板的平面视图。
具体实施方式
当元件或层被称为“在”另一元件或层“上”、“连接到”或“耦接到”另一元件或层时，其可以直接在另一元件或层上、直接连接到或耦接到另一元件或层，或者可以存在居间元件或层。然而，当元件或层被称为“直接在”另一元件或层“上”、“直接连接到”或“直接耦接到”另一元件或层时，不存在居间元件或层。为此，术语“连接”可以是指具有或不具有居间元件的物理连接、电气连接和/或流体连接。
相同的附图标记指代相同的元件。此外，在附图中，为了有效地描述技术内容，夸大了元件的厚度、比率和尺寸。
将理解，虽然在本文中可以使用“第一”、“第二”等的术语来描述各种元件，但是这些元件不应受这些术语限制。这些术语仅用于将一个元件与另一元件区分开。例如，在不背离本公开的权利范围的情况下，第一元件可以被称为第二元件，并且第二元件也可以以类似的方式被称为第一元件。单数形式的术语可以包括复数形式，除非上下文另有明确指示。
为了描述性的目的，在本文中可以使用诸如“下面”、“下方”、“之下”、“下面的”、“上方”、“上面的”、“之上”、“较高”、“侧”(例如，如在“侧壁”中)等的空间相对术语，并且由此来描述如附图中图示的一个元件与另一(些)元件的关系。空间相对术语旨在包含设备在使用时、在操作时和/或在制造时除附图中描绘的方位以外的不同方位。例如，如果附图中的设备被翻转，则被描述为在其它元件或特征“下方”或“下面”的元件将被定向为在其它元件或特征“上方”。因此，例如，术语“下方”能够包含上方和下方两种方位。此外，设备可以以其它方式被定向(例如，旋转90度或处于其它方位)，并且因此，在本文中使用的空间相对描述词可以被相应地解释。
应理解，术语“包括”或“具有”旨在指定本公开中的所陈述的特征、整体、步骤、操作、元件、组件或它们的组合的存在，但是不排除一个或多个其它特征、整体、步骤、操作、元件、组件或它们的组合的存在或附加。
在说明书和权利要求书中，出于其含义和解释的目的，短语“……中的至少一个”旨在包括“从……的组中选择的至少一个”的含义。例如，“A和B中的至少一个”可以被理解为意味着“A、B、或A和B”。在说明书和权利要求书中，出于其含义和解释的目的，术语“和/或”旨在包括术语“和”和“或”的任意组合。例如，“A和/或B”可以被理解为意味着“A、B、或A和B”。术语“和”和“或”可以在结合或分离的意义上使用，并且可以被理解为等同于“和/或”。
除非本文中另有限定或暗示，否则使用的所有术语(包括技术术语和科学术语)具有与由本公开所属领域的技术人员所通常理解的含义相同的含义。将进一步理解，诸如在常用字典中限定的那些术语应被解释为具有与它们在相关领域的上下文中的含义一致的含义，并且不应以理想化或过于正式的意义来解释，除非在本说明书中明确地限定。
在下文中，将参考附图描述本公开的实施方式。
图1A是根据本公开的实施方式的电子装置的示意性框图。根据本公开的电子装置可以是包括至少一个半导体的半导体装置。电子装置可以包括时序控制单元TC、扫描驱动电路SDC、数据驱动电路DDC、发射控制驱动电路EDC和显示面板DP。显示面板DP可以根据电信号显示图像。
在说明书中，显示面板DP被描述为有机发光显示面板。然而，本公开不限于此，并且显示面板DP可以包括各种实施方式。
时序控制单元TC可以接收输入图像信号(未示出)，并且转换输入图像信号的数据格式以将接口规格与数据驱动电路DDC匹配，从而生成图像数据D-RGB。时序控制单元TC可以输出图像数据D-RGB和各种控制信号，诸如数据控制信号DCS、扫描控制信号SCS和发射控制信号ECS。
扫描驱动电路SDC可以从时序控制单元TC接收扫描控制信号SCS。扫描控制信号SCS可以包括用于开始扫描驱动电路SDC的操作的垂直开始信号、用于确定多个信号的输出时序的时钟信号等。
扫描驱动电路SDC可以生成扫描信号，并且将扫描信号顺序地输出到扫描线SL1、SL2、SL3、……和SLn，其中n是大于0的整数。
发射控制驱动电路EDC可以从时序控制单元TC接收发射控制信号ECS。发射控制驱动电路EDC可以响应于发射控制信号ECS而生成多个发射驱动信号，并且将发射驱动信号输出到发射控制线EL1、EL2、EL3、……和ELn。
在本公开中，扫描信号和发射驱动信号可以被划分并且分别从扫描驱动电路SDC和发射控制驱动电路EDC输出，但是不限于此，发射控制驱动电路EDC可以被省略，并且扫描信号和发射驱动信号可以从扫描驱动电路SDC输出。
数据驱动电路DDC可以从时序控制单元TC接收数据控制信号DCS和图像数据D-RGB。数据驱动电路DDC可以将图像数据D-RGB转换为数据信号，并且将数据信号输出到数据线DL1、DL2、……和DLm，其中m是大于0的整数。数据信号可以是与图像数据D-RGB的灰度值相对应的模拟电压。
显示面板DP可以包括扫描线SL1、SL2、SL3、……和SLn、发射控制线EL1、EL2、EL3、……和ELn、数据线DL1、DL2、……和DLm以及多个像素PX。扫描线SL1、SL2、SL3、……和SLn可以在第一方向DR1上延伸，并且可以被设置在与第一方向DR1相交的第二方向DR2上。
发射控制线EL1、EL2、EL3、……和ELn中的每条可以被设置成与扫描线SL1、SL2、SL3、……和SLn当中的对应的扫描线平行。数据线DL1、DL2、……和DLm可以与扫描线SL1、SL2、SL3、……和SLn相交，并且可以与扫描线SL1、SL2、SL3、……和SLn绝缘。
多个像素PX中的每个可以连接到扫描线SL1、SL2、SL3、……和SLn当中的对应的扫描线、发射控制线EL1、EL2、EL3、……和ELn当中的对应的发射控制线以及数据线DL1、DL2、……和DLm当中的对应的数据线。
多个像素PX中的每个可以接收第一电源电压ELVDD和具有比第一电源电压ELVDD的电平低的电平的第二电源电压ELVSS。多个像素PX中的每个可以连接到其上施加有第一电源电压ELVDD的第一驱动电源线PL1和其上施加有第二电源电压ELVSS的第二驱动电源线PL2。
根据本公开的实施方式，多个像素PX中的每个可以电连接到三条扫描线。如图1A中所示，第二像素行上的像素可以连接到扫描线SL1、SL2和SL3。
显示面板DP还可以包括多条虚设扫描线。显示面板DP可以包括连接到第一像素行的多个像素PX的第一虚设扫描线和连接到第n像素行的多个像素PX的第二虚设扫描线。多个像素(例如，像素列的多个像素)PX可以连接到数据线DL1、DL2、……和DLm当中的数据线。然而，本公开不限于此，并且多个像素PX的连接关系可以进行各种设计。
多个像素PX中的每个可以包括发光元件ED(参见图1B)以及控制发光元件ED的发光的像素电路PC(参见图1B)。像素电路PC可以包括至少一个薄膜晶体管和电容器。
在实施方式中，扫描驱动电路SDC、发射控制驱动电路EDC和数据驱动电路DDC中的至少一个可以包括通过与像素电路PC的工艺相同的工艺形成的驱动晶体管。在实施方式中，扫描驱动电路SDC、发射控制驱动电路EDC和数据驱动电路DDC可以以芯片形式来配置，并且被安装在显示面板DP上。在实施方式中，扫描驱动电路SDC、发射控制驱动电路EDC和数据驱动电路DDC中的两个可以以芯片形式来配置并且被安装在显示面板DP上，并且其剩余的一个可以被提供在独立于显示面板DP的单独的电路板上并且连接到显示面板DP。
图1B是根据本公开的实施方式的像素的等效电路的示意图。
参考图1B，根据实施方式，像素PX可以包括发光元件ED和像素电路PC。发光元件ED可以是包含在图4A的发光元件层EDL中的组件，并且像素电路PC可以是包含在图4A的电路层CL中的组件。
像素电路PC可以包括多个薄膜晶体管T1至T7以及存储电容器Cst。薄膜晶体管T1至T7以及存储电容器Cst可以电连接到信号线(例如，图1B中所示的SL1、SL2、SLp、SLd、ELm和DLm)、第一初始化电压线VL1、第二初始化电压线VL2(或阳极初始化电压线)以及第一驱动电源线PL1和第二驱动电源线PL2。
薄膜晶体管T1至T7可以包括驱动薄膜晶体管T1(或第一晶体管)、开关薄膜晶体管T2(或第二晶体管)、补偿薄膜晶体管T3(或第三晶体管)、第一初始化薄膜晶体管T4(或第四晶体管)、操作控制薄膜晶体管T5(或第五晶体管)、发射控制薄膜晶体管T6(或第六晶体管)和第二初始化薄膜晶体管T7(或第七晶体管)。
发光元件ED可以包括第一电极(例如，阳极电极或像素电极)和第二电极(例如，阴极电极或公共电极)。根据实施方式，发光元件ED的第一电极可以通过发射控制薄膜晶体管T6电连接到驱动薄膜晶体管T1并且被提供有驱动电流ILD，并且发光元件ED的第二电极可以电连接到第二驱动电源线PL2并且被提供有第二电源电压ELVSS。发光元件ED可以发射与驱动电流ILD相对应的亮度的光。
薄膜晶体管T1至T7中的一些薄膜晶体管可以是n沟道MOSFET(NMOS)，并且其剩余薄膜晶体管可以是p沟道MOSFET(PMOS)。在实施方式中，薄膜晶体管T1至T7中的补偿薄膜晶体管T3和第一初始化薄膜晶体管T4可以是n沟道MOSFET(NMOS)，并且其剩余薄膜晶体管可以是p沟道MOSFET(PMOS)。然而，本公开不限于此。
根据本公开的实施方式，薄膜晶体管T1至T7中的补偿薄膜晶体管T3、第一初始化薄膜晶体管T4和第二初始化薄膜晶体管T7可以是NMOS，并且其剩余薄膜晶体管可以是PMOS。根据本公开的实施方式，薄膜晶体管T1至T7中的仅一个薄膜晶体管可以是NMOS，并且其剩余薄膜晶体管可以是PMOS。根据本公开的实施方式，薄膜晶体管T1至T7中的全部薄膜晶体管可以是NMOS，或者可以是PMOS。
信号线可以包括传输第一扫描信号Sn的第一电流扫描线SL1'、传输第二扫描信号Sn'的第二电流扫描线SL2'、将先前扫描信号Sn-1传输到第一初始化薄膜晶体管T4的先前扫描线SLp、将发射驱动信号En传输到操作控制薄膜晶体管T5以及传输到发射控制薄膜晶体管T6的发射控制线ELm、将下一扫描信号Sn+1传输到第二初始化薄膜晶体管T7的下一扫描线SLd以及与第一电流扫描线SL1'交叉并且传输数据信号Dm的数据线DLm。
第一驱动电源线PL1可以将第一电源电压ELVDD传输到驱动薄膜晶体管T1，并且第一初始化电压线VL1可以传输将驱动薄膜晶体管T1和发光元件ED的第一电极初始化的初始化电压Vint1。
驱动薄膜晶体管T1的栅极可以连接到存储电容器Cst，驱动薄膜晶体管T1的源极可以经由操作控制薄膜晶体管T5连接到第一驱动电源线PL1，并且驱动薄膜晶体管T1的漏极可以经由发射控制薄膜晶体管T6电连接到发光元件ED的第一电极。驱动薄膜晶体管T1可以根据开关薄膜晶体管T2的开关操作接收数据信号Dm，并且将驱动电流ILD供给到发光元件ED。
开关薄膜晶体管T2的栅极可以连接到传输第一扫描信号Sn的第一电流扫描线SL1'，开关薄膜晶体管T2的源极可以连接到数据线DLm，并且开关薄膜晶体管T2的漏极可以连接到驱动薄膜晶体管T1的源极，并且经由操作控制薄膜晶体管T5连接到第一驱动电源线PL1。开关薄膜晶体管T2可以根据通过第一电流扫描线SL1'接收的第一扫描信号Sn而被导通，并且执行将通过数据线DLm传输的数据信号Dm传输到驱动薄膜晶体管T1的源极的开关操作。
补偿薄膜晶体管T3的栅极可以连接到第二电流扫描线SL2'。补偿薄膜晶体管T3的漏极可以连接到驱动薄膜晶体管T1的漏极，并且经由发射控制薄膜晶体管T6连接到发光元件ED的第一电极。补偿薄膜晶体管T3的源极可以连接到存储电容器Cst的第一电容器电极CE10并且连接到驱动薄膜晶体管T1的栅极。补偿薄膜晶体管T3的源极也可以连接到第一初始化薄膜晶体管T4的漏极。
补偿薄膜晶体管T3可以根据通过第二电流扫描线SL2'接收的第二扫描信号Sn'而被导通，并且电连接驱动薄膜晶体管T1的栅极和其漏极，以将驱动薄膜晶体管T1进行二极管连接。
第一初始化薄膜晶体管T4的栅极可以连接到先前扫描线SLp。第一初始化薄膜晶体管T4的源极可以连接到第一初始化电压线VL1。第一初始化薄膜晶体管T4的漏极可以连接到存储电容器Cst的第一电容器电极CE10、补偿薄膜晶体管T3的源极和驱动薄膜晶体管T1的栅极。第一初始化薄膜晶体管T4可以根据通过先前扫描线SLp接收的先前扫描信号Sn-1而被导通，并且通过将初始化电压Vint1传输到驱动薄膜晶体管T1的栅极来执行将驱动薄膜晶体管T1的栅极的电压初始化的初始化操作。
操作控制薄膜晶体管T5的栅极可以连接到发射控制线ELm，操作控制薄膜晶体管T5的源极可以连接到第一驱动电源线PL1，并且操作控制薄膜晶体管T5的漏极可以连接到驱动薄膜晶体管T1的源极并且连接到开关薄膜晶体管T2的漏极。
发射控制薄膜晶体管T6的栅极可以连接到发射控制线ELm，发射控制薄膜晶体管T6的源极可以连接到驱动薄膜晶体管T1的漏极并且连接到补偿薄膜晶体管T3的漏极，并且发射控制薄膜晶体管T6的漏极可以电连接到第二初始化薄膜晶体管T7的漏极并且电连接到发光元件ED的第一电极。
操作控制薄膜晶体管T5和发射控制薄膜晶体管T6可以根据通过发射控制线ELm接收的发射驱动信号En而同时被导通，使得第一电源电压ELVDD可以被传输到发光元件ED以将驱动电流ILD传输到发光元件ED。
第二初始化薄膜晶体管T7的栅极可以连接到下一扫描线SLd，第二初始化薄膜晶体管T7的漏极可以连接到发射控制薄膜晶体管T6的漏极并且连接到发光元件ED的第一电极，并且第二初始化薄膜晶体管T7的源极可以连接到第二初始化电压线VL2，以被提供有阳极初始化电压Vint2。第二初始化薄膜晶体管T7可以根据通过下一扫描线SLd接收的下一扫描信号Sn+1而被导通，并且将发光元件ED的第一电极初始化。
在另一实施方式中，第二初始化薄膜晶体管T7的栅极可以连接到发射控制线ELm，并且根据发射驱动信号En而被驱动。根据晶体管的类型(p型或n型)，源极的位置和漏极的位置是可互换的。
存储电容器Cst可以包括第一电容器电极CE10和第二电容器电极CE20。存储电容器Cst的第一电容器电极CE10可以连接到驱动薄膜晶体管T1的栅极，并且存储电容器Cst的第二电容器电极CE20可以连接到第一驱动电源线PL1。在存储电容器Cst中，可以存储与驱动薄膜晶体管T1的栅极的电压和第一电源电压ELVDD之间的电压差相对应的电荷。
升压电容器Cbs可以包括第一电容器电极CE11和第二电容器电极CE21。升压电容器Cbs的第一电容器电极CE11可以连接到存储电容器Cst的第一电容器电极CE11，并且升压电容器Cbs的第二电容器电极CE21可以被提供有第一扫描信号Sn。升压电容器Cbs可以在第一扫描信号Sn的供给被停止时增大驱动薄膜晶体管T1的栅极的电压，从而补偿栅极的电压降。
将描述根据实施方式的每个像素PX的具体操作。
在初始化时段期间，在通过先前扫描线SLp供给先前扫描信号Sn-1的情况下，第一初始化薄膜晶体管T4可以响应于先前扫描信号Sn-1而被导通，并且驱动薄膜晶体管T1可以通过从第一初始化电压线VL1供给的初始化电压Vint1被初始化。
在数据编程时段期间，在分别通过第一电流扫描线SL1'和第二电流扫描线SL2'供给第一扫描信号Sn和第二扫描信号Sn'的情况下，开关薄膜晶体管T2和补偿薄膜晶体管T3可以分别响应于第一扫描信号Sn和第二扫描信号Sn'而被导通。驱动薄膜晶体管T1可以是通过导通的补偿薄膜晶体管T3被连接的二极管，并且可以在正方向上被偏置。
从数据线DLm供给的数据信号Dm中减去了驱动薄膜晶体管T1的阈值电压Vth的补偿电压Dm+Vth(其中Vth是(-)的值)可以被施加到驱动薄膜晶体管T1的栅极。
第一电源电压ELVDD和补偿电压Dm+Vth可以被施加到存储电容器Cst的两端，并且在存储电容器Cst中，可以存储与存储电容器Cst的两端之间的电压差相对应的电荷。
在发光时段期间，操作控制薄膜晶体管T5和发射控制薄膜晶体管T6可以通过从发射控制线ELm供给的发射驱动信号En而被导通。生成与驱动薄膜晶体管T1的栅极的电压和第一电源电压ELVDD之间的电压差相对应的驱动电流ILD，并且驱动电流ILD通过发射控制薄膜晶体管T6被供给到发光元件ED。
在实施方式中，薄膜晶体管T1至T7中的至少一个可以包括包含氧化物的半导体层，并且其剩余薄膜晶体管可以包括包含硅的半导体层。
在实施方式中，影响电子装置的亮度的驱动薄膜晶体管T1可以包括由具有高可靠性的多晶硅制成的半导体层，通过该半导体层可以实现高分辨率电子装置。
由于氧化物半导体具有高载流子迁移率和低泄漏电流，因此在驱动时间长的情况下，电压降可能不大。由于即使在低频驱动期间也不会由于电压降而存在图像的颜色的显著变化，因此低频驱动可以是可能的。
由于氧化物半导体具有如上所述的低泄漏电流的优点，因此连接到驱动薄膜晶体管T1的栅极的补偿薄膜晶体管T3、第一初始化薄膜晶体管T4和第二初始化薄膜晶体管T7中的至少一个可以被配置为氧化物半导体，以防止可能流到栅极的泄漏电流并且降低功耗。
图2是示意性地图示根据本公开的实施方式的显示面板的平面视图。
在下文中，基本垂直于由第一方向DR1和第二方向DR2限定的平面的方向被限定为第三方向DR3。在本公开中，“在平面视图中”可以被限定为在第三方向DR3上的视图。
显示面板DP的厚度方向可以是与作为相对于由第一方向DR1和第二方向DR2限定的平面的法线方向的第三方向DR3平行的方向。在本公开中，“厚度”可以是在第三方向DR3上测量的数值，并且“宽度”可以是在作为水平方向的第一方向DR1或第二方向DR2上测量的数值。
参考图2，显示面板DP可以包括数据驱动电路DDC、第一驱动电路DC1、第二驱动电路DC2和多个像素电路PC。此外，显示面板DP可以包括显示区DAA和外围区DPA。外围区DPA可以被布置成与显示区DAA相邻。在实施方式中，外围区DPA被图示为具有围绕显示区DAA的形状。然而，本公开不限于此，并且外围区DPA可以被省略。
第一驱动电路DC1、第二驱动电路DC2和像素电路PC可以被布置在显示区DAA中。由于第一驱动电路DC1和第二驱动电路DC2被布置在显示区DAA中，因此可以减小外围区DPA中由第一驱动电路DC1和第二驱动电路DC2占据的面积。因此，可以减小外围区DPA的面积，使得可以实现具有窄边框的电子装置。
数据驱动电路DDC可以被布置在外围区DPA中。例如，在平面视图中，数据驱动电路DDC可以在第二方向DR2上被布置在显示区DAA下方。然而，本公开不限于此，并且数据驱动电路DDC可以被布置在显示区DAA中。数据驱动电路DDC、第一驱动电路DC1和第二驱动电路DC2可以在同一工艺中形成。然而，本公开不限于此。根据本公开的实施方式，数据驱动电路DDC可以被提供为独立于显示面板DP的单独的电路板，并且连接到显示面板DP。
在显示区DAA中，第一驱动电路DC1和第二驱动电路DC2可以彼此间隔开。在实施方式中，第一驱动电路DC1和第二驱动电路DC2可以在第一方向DR1上彼此间隔开。
第一驱动电路DC1和第二驱动电路DC2可以彼此相同或不同。例如，第一驱动电路DC1和第二驱动电路DC2可以彼此不同。在实施方式中，第一驱动电路DC1可以是向像素电路PC提供扫描信号的扫描驱动电路，并且第二驱动电路DC2可以是向像素电路PC提供发射驱动信号的发射控制驱动电路。然而，本公开不限于此。
在第一方向DR1上，第一驱动电路DC1和第二驱动电路DC2中的每个可以被布置在多个像素电路PC之间。在实施方式中，第一驱动电路DC1和第二驱动电路DC2中的每个可以在第二方向DR2上延伸。然而，本公开不限于此。
像素电路PC可以根据布置有像素电路PC的区被划分为多个组。例如，在平面视图中，像素电路PC可以被划分为布置在第一驱动电路DC1的左侧上的第一像素电路组PCG1、布置在第一驱动电路DC1与第二驱动电路DC2之间的第二像素电路组PCG2以及布置在第二驱动电路DC2的右侧上的第三像素电路组PCG3。在图2中，右侧可以是第一方向DR1，并且左侧可以是与第一方向DR1相反的方向。例如，第一像素电路组PCG1和第二像素电路组PCG2可以在第一方向DR1上彼此间隔开。第一驱动电路DC1可以介于第一像素电路组PCG1与第二像素电路组PCG2之间。第二像素电路组PCG2和第三像素电路组PCG3可以在第一方向DR1上彼此间隔开。第二驱动电路DC2可以介于第二像素电路组PCG2与第三像素电路组PCG3之间。
第一驱动电路DC1可以向第一像素电路组PCG1、第二像素电路组PCG2和第三像素电路组PCG3中的多个像素电路PC提供第一信号SS1，并且第二驱动电路DC2可以向第一像素电路组PCG1、第二像素电路组PCG2和第三像素电路组PCG3中的多个像素电路PC提供第二信号SS2。第一信号SS1可以是扫描信号和发射驱动信号中的一个，并且第二信号SS2可以是扫描信号和发射驱动信号中的另一个。
图3A是示意性地图示根据本公开的实施方式的显示面板的平面视图。图3A图示了根据本公开的实施方式的显示面板DP的发光元件层EDL(参见图3B)。
一起参考图2和图3A，显示区DAA可以被划分为第一区AA1和第二区AA2。第一区AA1可以是其中布置有第一驱动电路DC1和第二驱动电路DC2的区，并且第二区AA2可以是其中布置有像素电路PC的区。
第一区AA1和第二区AA2可以各自被提供为多个。第一区AA1可以包括其中布置有第一驱动电路DC1的第1-1区AA1-1以及其中布置有第二驱动电路DC2的第1-2区AA1-2。第二区AA2可以包括其中布置有第一像素电路组PCG1的第2-1区AA2-1、其中布置有第二像素电路组PCG2的第2-2区AA2-2以及其中布置有第三像素电路组PCG3的第2-3区AA2-3。
发光元件可以包括发射第一光的第一发光元件ED_R、发射第二光的第二发光元件ED_G和发射第三光的第三发光元件ED_B。第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B可以构成发光元件单元EDU。在实施方式中，发光元件单元EDU可以与像素相对应，并且第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B中的每个可以与子像素相对应，但是本公开不限于此。
第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B可以根据其中布置有第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B的区被划分为多个组。例如，第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B可以被划分为布置在第一区AA1中的第一发光元件组EG1和布置在第二区AA2中的第二发光元件组EG2。例如，第一发光元件组EG1可以在平面视图中与第一驱动电路DC1和第二驱动电路DC2重叠，并且第二发光元件组EG2可以在平面视图中与像素电路PC重叠。在平面视图中，第一发光元件组EG1的面积和第二发光元件组EG2的面积可以彼此相同或不同。在图3A中，第一发光元件组EG1的面积被图示为小于第二发光元件组EG2的面积，但是本公开不限于此。
在平面视图中，第一发光元件组EG1可以与第一驱动电路DC1和第二驱动电路DC2中的每个的前表面重叠。为了驱动，第一发光元件组EG1可以通过连接线连接到像素电路PC当中的相邻的像素电路PC。
图3B是示意性地图示根据本公开的实施方式的显示面板的分解透视图。图3C是根据本公开的实施方式的显示面板的局部区的放大平面视图。
图3B图示了显示面板DP的第1-1区AA1-1、第2-1区AA2-1的一部分以及第2-2区AA2-2的一部分。在图3B中分别图示了包括发光元件单元EDU的发光元件层EDL和包括像素电路单元PCU的电路层CL。像素电路单元PCU可以连接到发光元件单元EDU当中的对应的发光元件单元EDU，并且驱动所连接的发光元件单元EDU。像素电路单元PCU可以被布置在显示区DAA中。像素电路单元PCU可以包括分别连接到第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B的第一像素晶体管T_R、第二像素晶体管T_G和第三像素晶体管T_B。第一像素晶体管T_R、第二像素晶体管T_G和第三像素晶体管T_B可以与上面参考图1B描述的发射控制薄膜晶体管T6相对应。
为了便于描述，图3B图示了2行和10列的发光元件单元EDU以及与其相对应的2行和10列的像素电路单元PCU。然而，本公开不限于此。
如图3B中所示，发光元件单元EDU当中的布置在第1-1区AA1-1中的发光元件单元EDU(即，包含在第一发光元件组EG1中的发光元件单元EDU(参见图3A))可以在平面视图中与第一驱动电路DC1重叠，并且可以与像素电路单元PCU不重叠。发光元件单元EDU当中的布置在第2-1区AA2-1和第2-2区AA2-2中的发光元件单元EDU(即，包含在第二发光元件组EG2中的发光元件单元EDU(参见图3A))可以在平面视图中与第一驱动电路DC1不重叠(即，非重叠)，并且可以与像素电路单元PCU重叠。
图3C图示了发光元件单元EDU以及与其连接的像素电路单元PCU。
在实施方式中，发光元件单元EDU中的第一发光元件ED_R和第二发光元件ED_G可以在第二方向DR2上被设置，并且第三发光元件ED_B可以被布置成在第一方向DR1上与第一发光元件ED_R和第二发光元件ED_G相邻。在实施方式中，在第一方向DR1上观察，第三发光元件ED_B可以具有与第一发光元件ED_R和第二发光元件ED_G中的每个重叠的尺寸。然而，本公开不限于此，并且第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B的形状或布置或者构成发光元件单元EDU的发光元件的数量可以被不同地选择。
第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B被设置的顺序可以根据所需的显示质量以各种组合被提供。第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B的面积不限于图3C中图示的面积。
图3D和图3E各自是根据本公开的实施方式的显示面板的局部区的放大平面视图。
在实施方式中，如图3D中所示，发光元件单元EDU-1可以具有其中第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B在第一方向DR1上按顺序设置的条纹(stripe)像素结构。第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B的面积可以相同，但是本公开不限于此。
在实施方式中，如图3E中所示，在发光元件单元EDU-2中，第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B可以被设置成PENTILETM形式。例如，发光元件单元EDU-2可以具有其中一个第一发光元件ED_R、两个第二发光元件ED_G和一个第三发光元件ED_B形成菱形形状的布置形式。在实施方式中，在平面视图中，第二发光元件ED_G的面积可以小于第一发光元件ED_R和第三发光元件ED_B的面积，但是本公开不限于此。
返回参考图3C，像素电路单元PCU可以包括分别驱动第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B的第一像素电路PC_R、第二像素电路PC_G和第三像素电路PC_B。第一像素电路PC_R、第二像素电路PC_G和第三像素电路PC_B可以在第一方向DR1上被设置。第一像素电路PC_R、第二像素电路PC_G和第三像素电路PC_B可以分别包括分别连接到第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B的第一像素晶体管T_R、第二像素晶体管T_G和第三像素晶体管T_B。
在实施方式中，发光元件单元EDU在第一方向DR1上的宽度WH可以大于与其相对应的像素电路单元PCU在第一方向DR1上的宽度WH_C。为了便于描述，发光元件单元EDU在第二方向DR2上的长度WV被图示为与像素电路单元PCU的长度WV相同，但是本公开不限于此。
通过将像素电路单元PCU的宽度WH_C设计成小于发光元件单元EDU的宽度WH，被设置成行的发光元件单元EDU可以连接到布置在同一行中的像素电路单元PCU，使得可以向用户提供更大的显示区域。
例如，本公开的显示面板DP可以通过提供具有比由电路层CL所占据的面积大的面积的显示区DAA来实现窄边框。
返回参考图3A和图3B，布置在第一区AA1中的发光元件单元EDU可以连接到布置在第二区AA2中的相邻的像素电路单元PCU以用于驱动。例如，布置在与第2-1区AA2-1相邻的第1-1区AA1-1中的第一发光元件(例如，第一红色发光元件ED_R1)可以连接到布置在最邻近第一驱动电路DC1的第2-1区AA2-1中的第一像素晶体管(例如，第一红色像素晶体管T_R1)。布置在与第2-2区AA2-2相邻的第1-1区AA1-1中的第一发光元件(例如，第二红色发光元件ED_R2)可以连接到布置在最邻近第一驱动电路DC1的第2-2区AA2-2中的第一像素晶体管(例如，第二红色像素晶体管T_R2)。
在实施方式中，布置在第二区AA2中的发光元件单元EDU可以连接到布置在第二区AA2中的像素电路单元PCU。例如，布置在第2-1区AA2-1中的第一发光元件(例如，第三红色发光元件ED_R3)可以连接到布置在第2-1区AA2-1中的对应的第一像素晶体管(例如，第三红色像素晶体管T_R3)。布置在第2-2区AA2-2中的第一发光元件(例如，第四红色发光元件ED_R4)可以连接到布置在第2-2区AA2-2中的对应的第一像素晶体管(例如，第四红色像素晶体管T_R4)。
在平面视图中与第一驱动电路DC1重叠的发光元件单元EDU的描述可以同样地应用于在平面视图中与第二驱动电路DC2重叠的发光元件单元EDU。
根据本公开的实施方式，与第一驱动电路DC1和第二驱动电路DC2重叠的发光元件单元EDU可以通过连接线连接到被布置成与第一驱动电路DC1和第二驱动电路DC2相邻的像素电路单元PCU。由于第一驱动电路DC1和第二驱动电路DC2中的每个被布置在多个像素电路单元PCU之间，因此连接线的长度可以减小到最小。
图4A是根据本公开的实施方式的显示面板的示意性剖视图。
参考图4A，根据实施方式，显示面板DP可以包括基础层BS、布置在基础层BS上的电路层CL以及布置在电路层CL上的发光元件层EDL。
基础层BS可以是提供其上布置有电路层CL的基础表面的构件。基础层BS可以是玻璃衬底、金属衬底、聚合物衬底等。然而，本公开不限于此，并且基础层BS可以是无机层、有机层或复合材料层。
基础层BS可以具有多层结构。例如，基础层BS可以包括第一合成树脂层、布置在第一合成树脂层上的氧化硅(SiOx)层、布置在氧化硅层上的非晶硅(a-Si)层以及布置在非晶硅层上的第二合成树脂层。氧化硅层和非晶硅层可以是基础阻挡层。
在实施方式中，第一合成树脂层和第二合成树脂层中的每个可以包括聚酰亚胺类树脂。在实施方式中，第一合成树脂层和第二合成树脂层中的每个可以包括丙烯酸类树脂、甲基丙烯酸类树脂、聚异戊二烯类树脂、乙烯基类树脂、环氧类树脂、聚氨酯类树脂、纤维素类树脂、硅氧烷类树脂、聚酰胺类树脂或苝类树脂中的至少一种。在本公开中，“～”类树脂意味着包括“～”的官能团。
电路层CL可以被布置在基础层BS上。电路层CL可以包括绝缘层、半导体图案、导电图案、信号线等。绝缘层、半导体层和导电层可以通过涂布、沉积等方法形成在基础层BS上方，并且绝缘层、半导体层和导电层可以通过多次执行光刻工艺被选择性地图案化。可以形成包含在电路层CL中的半导体图案、导电图案和信号线。
图4A图示了显示面板DP的组件。在实施方式中，在电路层CL中，驱动晶体管TP和第一初始化电压线VL1可以被布置在第1-1区AA1-1中，并且第一红色像素晶体管T_R1和第三红色像素晶体管T_R3可以被布置在第2-1区AA2-1中。
驱动晶体管TP可以是包含在第一驱动电路DC1中的晶体管。图4A中图示了仅一个晶体管。然而，本公开不限于此，并且显示面板可以包括两个或更多个晶体管。第一初始化电压线VL1可以被布置在第二绝缘层20上。布置在第三绝缘层30上的导电线Ci可以穿过第三绝缘层30连接到第一初始化电压线VL1，并且可以延伸到像素电路PC(参见图1B)，从而向像素电路PC提供初始化电压Vint1(参见图1B)。
第一红色像素晶体管T_R1和第三红色像素晶体管T_R3可以与图3B中的连接到第一红色发光元件ED_R1和第三红色发光元件ED_R3中的每个的第一像素晶体管T_R相对应。
电路层CL可以包括多个导电图案(例如，第一连接电极CNE1、第二连接电极CNE2和连接线TWL)以及绝缘层(例如，第一绝缘层10至第六绝缘层60)。
第一绝缘层10可以被布置在基础层BS上。第一绝缘层10可以是无机层。例如，第一绝缘层10可以包括氧化铝、氧化钛、氧化硅、氮化硅、氧氮化硅、氧化锆和氧化铪中的至少一种。第一绝缘层10可以包括多个层。多层无机层可以构成阻挡层和/或缓冲层。
驱动晶体管TP以及第一红色像素晶体管T_R1和第三红色像素晶体管T_R3可以各自包括栅电极GE和半导体图案SP。半导体图案SP可以被布置在第一绝缘层10上。在实施方式中，半导体图案SP可以包括氧化物半导体。然而，本公开不限于此。在实施方式中，半导体图案SP可以包括非晶硅、低温多晶硅或多晶硅。
第二绝缘层20可以共同地与多个像素重叠，并且可以覆盖半导体图案SP。第二绝缘层20可以是无机层和/或有机层，并且可以具有单层或多层结构。第二绝缘层20可以包括氧化铝、氧化钛、氧化硅、氮化硅、氧氮化硅、氧化锆和氧化铪中的至少一种。在实施方式中，第二绝缘层20可以是单层氧化硅层。
栅电极GE可以被布置在第二绝缘层20上。栅电极GE可以被布置在半导体图案SP上。然而，本公开不限于此，并且栅电极GE可以被布置在半导体图案SP的下侧上。
半导体图案SP可以包括根据导电程度划分的源极AS、漏极AD和沟道AC。在平面视图中，沟道AC可以是与栅电极GE重叠的部分。源极AS和漏极AD可以是被布置成与介于其间的沟道AC相邻的部分。在半导体图案SP是氧化物半导体的情况下，源极AS和漏极AD可以各自是还原区(reduced region)。因此，与沟道AC相比，源极AS和漏极AD可以具有相对高的还原金属含量。在半导体图案SP是多晶硅的情况下，源极AS和漏极AD可以各自是被掺杂到高浓度的区。
与沟道AC相比，源极AS和漏极AD可以具有相对高的电导率。源极AS可以与第一红色像素晶体管T_R1和第三红色像素晶体管T_R3的源电极相对应，并且漏极AD可以与第一红色像素晶体管T_R1和第三红色像素晶体管T_R3的漏电极相对应。然而，本公开不限于此。第一红色像素晶体管T_R1和第三红色像素晶体管T_R3还可以被提供有分别连接到源极AS和连接到漏极AD的源电极和漏电极。
根据实施方式，第一连接电极CNE1可以被布置在第四绝缘层40上。第一连接电极CNE1可以经由第一通孔CN1连接到下电极BML，并且经由第二通孔CN2连接到源极AS。例如，第一连接电极CNE1可以电连接下电极BML和源极AS。
下电极BML可以被布置在第一红色像素晶体管T_R1和第三红色像素晶体管T_R3以及驱动晶体管TP的下侧上，并且可以在平面视图中与第一红色像素晶体管T_R1和第三红色像素晶体管T_R3以及驱动晶体管TP重叠。下电极BML可以阻止由基础层BS的极化引起的电势影响第一红色像素晶体管T_R1和第三红色像素晶体管T_R3以及驱动晶体管TP。在下电极BML与基础层BS之间，还可以布置有无机阻挡层和缓冲层中的至少一种。
下电极BML可以包括反射金属。例如，下电极BML可以包括钛(Ti)、钼(Mo)、包含钼的合金、铝(Al)、包含铝的合金、氮化铝(AlN)、钨(W)、氮化钨(WN)、铜(Cu)等。在另一实施方式中，下电极BML可以以与另一电极或另一线隔离的形式被提供。
根据实施方式，第二连接电极CNE2可以被布置在第五绝缘层50上。第二连接电极CNE2可以经由第三通孔CN3连接到第一连接电极CNE1。第三红色发光元件ED_R3的阳极电极AT可以经由第四通孔CN4连接到第二连接电极CNE2。例如，第三红色像素晶体管T_R3可以通过第二连接电极CNE2电连接到第三红色发光元件ED_R3。
在实施方式中，连接线TWL可以被布置在第五绝缘层50上。连接线TWL可以经由第五通孔CN5连接到第一连接电极CNE1。连接线TWL可以从第1-1区AA1-1延伸到第2-1区AA2-1。连接线TWL可以经由第2-1区AA2-1中的第五通孔CN5连接到第一红色像素晶体管T_R1，并且可以经由形成在第1-1区AA1-1中的第六通孔CN6连接到下面要描述的第一红色发光元件ED_R1的阳极电极AT。例如，通过连接线TWL，布置在第1-1区AA1-1中的第一红色发光元件ED_R1可以连接到布置在第2-1区AA2-1中的第一红色像素晶体管T_R1。
在第四绝缘层40上，第五绝缘层50和第六绝缘层60可以在第三方向DR3上被顺序地布置。第五绝缘层50和第六绝缘层60可以各自是有机层。在实施方式中，第五绝缘层50和第六绝缘层60可以各自包括诸如苯并环丁烯(BCB)、聚酰亚胺、六甲基二硅氧烷(HMDSO)、聚甲基丙烯酸甲酯(PMMA)、聚苯乙烯(PS)的通用聚合物、具有酚基团的聚合物衍生物、丙烯酸聚合物、酰亚胺类聚合物、芳基醚类聚合物、酰胺类聚合物、氟类聚合物、对二甲苯类聚合物、乙烯醇类聚合物、它们的混合物等。
发光元件层EDL可以被布置在第六绝缘层60上。发光元件层EDL可以包括上面参考图3B描述的第一红色发光元件ED_R1和第三红色发光元件ED_R3以及第七绝缘层70。第七绝缘层70可以被布置在第六绝缘层60上，并且可以具有开口OP。开口OP可以暴露第一红色发光元件ED_R1和第三红色发光元件ED_R3的阳极电极AT的至少一部分。第一红色发光元件ED_R1和第三红色发光元件ED_R3的发光区可以基本与由开口OP暴露的阳极电极AT的形状相对应。
第七绝缘层70可以具有光吸收特性或光阻挡特性。例如，第七绝缘层70可以是黑色的。第七绝缘材料70可以包括黑色着色剂。黑色着色剂可以包括黑色染料或黑色颜料。黑色着色剂可以包括炭黑、诸如铬的金属或其氧化物。
第一红色发光元件ED_R1和第三红色发光元件ED_R3可以各自包括阳极电极AT、第一公共层HL、发光层EML、第二公共层EL和阴极电极CT。阳极电极AT可以是半透反射电极、透射电极或反射电极。根据本公开的实施方式，阳极电极AT可以包括由银(Ag)、镁(Mg)、铝(Al)、铂(Pt)、钯(Pd)、金(Au)、镍(Ni)、钕(Nd)、铱(Ir)、铬(Cr)、它们的化合物等形成的反射层以及形成在反射层上的透明或半透明电极层。透明或半透明电极层可以包括选自由氧化铟锡(ITO)、氧化铟锌(IZO)、氧化铟镓锌(IGZO)、氧化锌(ZnO)、氧化铟(In2O3)和掺杂铝的氧化锌(AZO)组成的组中的至少一种。例如，阳极电极AT可以包括ITO/Ag/ITO的层压结构。
阳极电极AT可以分别经由第四通孔CN4和第六通孔CN6连接到第一红色像素晶体管T_R1和第三红色像素晶体管T_R3。图4A图示了如针对每个像素图案化的阳极电极AT，但是本公开不限于此。在实施方式中，阳极电极可以被形成为单个主体。
发光层EML可以被布置在阳极电极AT上。发光层EML可以被布置在与开口OP相对应的区中。例如，发光层EML可以分别形成在多个像素中的每个上。在发光层EML单独形成在多个像素中的每个中的情况下，多个发光层EML中的每个可以发射蓝色、红色或绿色的光。然而，本公开不限于此，并且可以共同地提供发光层EML。发光层EML可以发射蓝光或白光。
阴极电极CT可以被布置在发光层EML上。阴极电极CT可以被共同地布置在多个像素中。
第一公共层HL可以被布置在阳极电极AT与发光层EML之间。第一公共层HL可以包括空穴注入层、空穴传输层和电子阻挡层中的至少一个。在实施方式中，第一公共层HL可以被布置在开口OP中。然而，本公开不限于此，并且第一公共层HL可以被形成为与多个像素重叠。
第二公共层EL可以被布置在发光层EML与阴极电极CT之间。第二公共层EL可以包括电子注入层、电子传输层和空穴阻挡层中的至少一个。
图4A图示了布置在第1-1区AA1-1中的第一红色发光元件ED_R1，但是第一红色发光元件ED_R1的描述可以同样地应用于包含在第一发光元件组EG1中的第一发光元件ED_R、第二发光元件ED_G和第三发光元件ED_B。
在本公开的显示面板DP中，第一驱动电路DC1和第二驱动电路DC2可以被布置在显示区中，使得外围区的面积可以减小。由于第一驱动电路DC1和第二驱动电路DC2被布置在多个像素电路PC之间，因此布置在第一驱动电路DC1和第二驱动电路DC2上的发光元件ED可以具有到对应的像素电路PC的减小的距离，并且由于提高的连接可靠性，可以提高显示质量。
然而，本公开的显示面板DP不限于此。
图3B和图4A图示了其中一个发光元件单元EDU连接到一个像素电路单元PCU的结构。然而，本公开不限于此。在实施方式中，两个或更多个发光元件单元EDU可以连接到一个像素电路单元PCU。
图4B是根据本公开的实施方式的显示面板的示意性剖视图。在图4B中图示的组件当中，相同的描述应用于上面参考图4A描述的组件，并且其详细描述将被省略。
根据实施方式，在图4B的显示面板DP-a中，两个发光元件(即，第一红色发光元件ED_R1和第三红色发光元件ED_R3)可以连接到一个第一像素晶体管(即，第三红色像素晶体管T_R3)。例如，第三红色像素晶体管T_R3可以通过第一连接电极CNE1和连接线TWL连接到第三红色发光元件ED_R3的阳极电极AT。第三红色像素晶体管T_R3可以通过第一连接电极CNE1和连接线TWL连接到第一红色发光元件ED_R1的阳极电极AT。例如，使用连接线TWL，布置在第2-1区AA2-1中的第三红色像素晶体管T_R3可以驱动布置在第2-1区AA2-1中的第三红色发光元件ED_R3和布置在第1-1区AA1-1中的第一红色发光元件ED_R1。因此，上面参考图4A描述的第一红色像素晶体管T_R1可以被省略。
图5是示意性地图示根据本公开的实施方式的显示面板的平面视图。
参考图5，根据实施方式，与上面参考图2描述的显示面板DP相比，显示面板DP-1还可以包括第三驱动电路DC3。在实施方式中，第三驱动电路DC3可以与第一驱动电路DC1和第二驱动电路DC2间隔开。第二驱动电路DC2可以在第一方向DR1上介于第一驱动电路DC1与第三驱动电路DC3之间。在第一方向DR1上，第一驱动电路DC1、第二驱动电路DC2和第三驱动电路DC3可以彼此间隔开，其中像素电路PC介于其间。
在实施方式中，第一驱动电路DC1和第三驱动电路DC3可以相同。在实施方式中，第二驱动电路DC2可以与第一驱动电路DC1和第三驱动电路DC3不同。在实施方式中，第一驱动电路DC1和第三驱动电路DC3可以是向像素电路PC提供扫描信号的扫描驱动电路，并且第二驱动电路DC2可以是向像素电路PC提供发射驱动信号的发射控制驱动电路。在另一实施方式中，第一驱动电路DC1和第三驱动电路DC3可以是向像素电路PC提供发射驱动信号的发射控制驱动电路，并且第二驱动电路DC2可以是向像素电路PC提供扫描信号的扫描驱动电路。
像素电路PC可以根据其中布置有像素电路PC的区被划分为多个组。例如，在平面视图中，像素电路PC可以被划分为布置在第一驱动电路DC1的左侧上的第一像素电路组PCGa、布置在第一驱动电路DC1与第二驱动电路DC2之间的第二像素电路组PCGb、布置在第二驱动电路DC2与第三驱动电路DC3之间的第三像素电路组PCGc以及布置在第三驱动电路DC3的右侧上的第四像素电路组PCGd。例如，第一像素电路组PCGa和第二像素电路组PCGb可以在第一方向DR1上彼此间隔开，其中第一驱动电路DC1介于其间。例如，第二像素电路组PCGb和第三像素电路组PCGc可以在第一方向DR1上彼此间隔开，其中第二驱动电路DC2介于其间。例如，第三像素电路组PCGc和第四像素电路组PCGd可以在第一方向DR1上彼此间隔开，其中第三驱动电路DC3介于其间。
多个像素电路PC中的每个可以连接到第一驱动电路DC1和第三驱动电路DC3中的更近的一个，并且连接到第二驱动电路DC2，以接收信号。例如，第一驱动电路DC1可以向包含在第一像素电路组PCGa和第二像素电路组PCGb中的像素电路PC提供第一信号SS1，第三驱动电路DC3可以向包含在第三像素电路组PCGc和第四像素电路组PCGd中的像素电路PC提供第一信号SS1，并且第二驱动电路DC2可以向包含在第一像素电路组PCGa、第二像素电路组PCGb、第三像素电路组PCGc和第四像素电路组PCGd中的像素电路PC提供第二信号SS2。第一信号SS1可以是扫描信号和发射驱动信号中的一个，并且第二信号SS2可以是扫描信号和发射驱动信号中的另一个。
上面参考图3B和图4A提供的第一发光元件ED_R的描述可以同样地应用于被布置成与第一驱动电路DC1、第二驱动电路DC2和第三驱动电路DC3重叠的发光元件。例如，被布置成与第一驱动电路DC1、第二驱动电路DC2和第三驱动电路DC3重叠的发光元件可以通过连接线TWL连接到相邻的像素电路PC(参见图4A)。
然而，本公开不限于此。在实施方式中，第二像素电路组PCGb可以被布置在第一像素电路组PCGa与第一驱动电路DC1之间，并且第一驱动电路DC1和第二驱动电路DC2可以被布置成彼此相邻。在另一实施方式中，第三像素电路组PCGc可以被布置在第四像素电路组PCGd与第三驱动电路DC3之间，并且第二驱动电路DC2和第三驱动电路DC3可以被布置成彼此相邻。
图6是示意性地图示根据本公开的实施方式的显示面板的平面视图。
参考图6，根据实施方式，与上面参考图5描述的显示面板DP-1相比，显示面板DP-2还可以包括第四驱动电路DC4。在实施方式中，第四驱动电路DC4可以在第一方向DR1上被布置在第二驱动电路DC2与第三驱动电路DC3之间。
在第一方向DR1上，第一驱动电路DC1、第二驱动电路DC2、第三驱动电路DC3和第四驱动电路DC4可以彼此间隔开，其中像素电路PC介于其间。
在实施方式中，第一驱动电路DC1和第三驱动电路DC3可以相同，并且第二驱动电路DC2和第四驱动电路DC4可以相同。例如，第一驱动电路DC1和第三驱动电路DC3可以与第二驱动电路DC2和第四驱动电路DC4不同。在实施方式中，第一驱动电路DC1和第三驱动电路DC3可以是向像素电路PC提供扫描信号的扫描驱动电路，并且第二驱动电路DC2和第四驱动电路DC4可以是向像素电路PC提供发射驱动信号的发射控制驱动电路。在另一实施方式中，第一驱动电路DC1和第三驱动电路DC3可以是向像素电路PC提供发射驱动信号的发射控制驱动电路，并且第二驱动电路DC2和第四驱动电路DC4可以是向像素电路PC提供扫描信号的扫描驱动电路。
像素电路PC可以根据其中布置有像素电路PC的区被划分为多个组。例如，在平面视图中，像素电路PC可以被划分为布置在第一驱动电路DC1的左侧上的第一像素电路组PCGe、布置在第一驱动电路DC1与第二驱动电路DC2之间的第二像素电路组PCGf、布置在第二驱动电路DC2与第四驱动电路DC4之间的第三像素电路组PCGg、布置在第四驱动电路DC4与第三驱动电路DC3之间的第四像素电路组PCGh以及布置在第三驱动电路DC3的右侧上的第五像素电路组PCGi。例如，第一像素电路组PCGe和第二像素电路组PCGf可以在第一方向DR1上彼此间隔开，其中第一驱动电路DC1介于其间。例如，第二像素电路组PCGf和第三像素电路组PCGg可以在第一方向DR1上彼此间隔开，其中第二驱动电路DC2介于其间。例如，第三像素电路组PCGg和第四像素电路组PCGh可以在第一方向DR1上彼此间隔开，其中第四驱动电路DC4介于其间。例如，第四像素电路组PCGh和第五像素电路组PCGi可以在第一方向DR1上彼此间隔开，其中第三驱动电路DC3介于其间。
多个像素电路PC中的每个可以连接到第一驱动电路DC1和第三驱动电路DC3中的更近的一个，并且连接到第二驱动电路DC2和第四驱动电路DC4中的更近的一个，以接收信号。例如，第一驱动电路DC1可以向包含在第一像素电路组PCGe和第二像素电路组PCGf中的像素电路PC以及向第三像素电路组PCGg的更靠近第一驱动电路DC1的像素电路PC提供第一信号SS1，并且第三驱动电路DC3可以向包含在第四像素电路组PCGh和第五像素电路组PCGi中的像素电路PC以及向第三像素电路组PCGg的更靠近第三驱动电路DC3的像素电路PC提供第一信号SS1。从包含在图6中图示的第三像素电路组PCGg中的像素电路PC到第一驱动电路DC1和到第三驱动电路DC3的距离是相同的，并且因此，被图示为从第一驱动电路DC1接收第一信号SS1。然而，本公开不限于此，并且包含在第三像素电路组PCGg中的像素电路PC可以从第三驱动电路DC3接收第一信号SS1。在另一实施方式中，在包含在第三像素电路组PCGg中的多个像素电路PC中的两个或更多个在第一方向DR1上被设置的情况下，多个像素电路PC中的每个可以从第一驱动电路DC1和第三驱动电路DC3中的更近的一个接收第一信号SS1。
第二驱动电路DC2可以向包含在第一像素电路组PCGe和第二像素电路组PCGf中的像素电路PC以及向第三像素电路组PCGg的更靠近第二驱动电路DC2的像素电路PC提供第二信号SS2，并且第四驱动电路DC4可以向包含在第四像素电路组PCGh和第五像素电路组PCGi中的像素电路PC以及向第三像素电路组PCGg的更靠近第四驱动电路DC4的像素电路PC提供第二信号SS2。从包含在图6中图示的第三像素电路组PCGg中的像素电路PC到第二驱动电路DC2和到第四驱动电路DC4的距离是相同的，并且因此，被图示为从第四驱动电路DC4接收第二信号SS2。然而，本公开不限于此，并且包含在第三像素电路组PCGg中的像素电路PC可以从第二驱动电路DC2接收第二信号SS2。在另一实施方式中，在包含在第三像素电路组PCGg中的多个像素电路PC中的两个或更多个在第一方向DR1上被设置的情况下，多个像素电路PC中的每个可以从第二驱动电路DC2和第四驱动电路DC4中的更近的一个接收第二信号SS2。
第一信号SS1可以是扫描信号和发射驱动信号中的一个，并且第二信号SS2可以是扫描信号和发射驱动信号中的另一个。
上面参考图3B和图4A提供的第一发光元件ED_R的描述可以同样地应用于被布置成与第一驱动电路DC1、第二驱动电路DC2、第三驱动电路DC3和第四驱动电路DC4重叠的发光元件。例如，被布置成与第一驱动电路DC1、第二驱动电路DC2、第三驱动电路DC3和第四驱动电路DC4重叠的发光元件可以通过连接线TWL连接到相邻的像素电路PC(参见图4A)。
然而，本公开不限于此。在实施方式中，第二像素电路组PCGf可以被布置在第一像素电路组PCGe与第一驱动电路DC1之间，并且第一驱动电路DC1和第二驱动电路DC2可以被布置成彼此相邻。在另一实施方式中，第三像素电路组PCGg可以被布置在第二像素电路组PCGf与第二驱动电路DC2之间，并且第二驱动电路DC2和第四驱动电路DC4可以被布置成彼此相邻。在另一实施方式中，第四像素电路组PCGh可以被布置在第三驱动电路DC3与第五像素电路组PCGi之间，并且第三驱动电路DC3和第四驱动电路DC4可以被布置成彼此相邻。
图5和图6图示了显示装置包括三个或四个驱动电路。然而，本公开不限于此，并且显示装置可以包括五个驱动电路。
参考图5和图6，本公开的显示面板DP-1和DP-2提供了供给相同信号的两个或更多个驱动电路，并且因此，可以减少施加到驱动电路的输出的负载。由于像素电路PC连接到两个驱动电路之间的最接近的驱动电路，因此可以减小像素电路PC与驱动电路之间的连接线的长度，并且可以减小在信号传输中产生的噪声。
在本公开的显示面板DP、DP-1和DP-2中，第一驱动电路DC1和第二驱动电路DC2可以被布置在显示区中，使得可以减小外围区的面积，并且可以增大显示区。由于第一驱动电路DC1和第二驱动电路DC2被布置在多个像素电路PC之间，因此布置在第一驱动电路DC1和第二驱动电路DC2上的发光元件可以具有到对应的像素电路PC的减小的距离，并且由于提高的连接可靠性，可以提高显示质量。布置在显示区DAA的外周上的发光元件ED也可以具有到像素电路PC的减小的距离，使得可以提高连接可靠性并且可以提高图像质量。因此，具有窄边框的显示面板DP、DP-1和DP-2可以稳定地提供高显示质量。
实施方式的显示面板可以具有扩展的显示区，并且可以提高显示区的显示质量。
上面的描述是本公开的技术特征的示例，并且本公开所属领域的技术人员将能够做出各种修改和改变。因此，上面描述的本公开的实施方式可以单独实现或彼此组合实现。
因此，在本公开中公开的实施方式不旨在限制本公开的技术精神，而是旨在描述本公开的技术精神，并且本公开的技术精神的范围不受这些实施方式限制。本公开的保护范围应由所附的权利要求来解释，并且应被解释为等效范围内的所有技术精神都包含在本公开的范围中。

Claims (20)

1.一种显示面板，包括：
基础层；
电路层，布置在所述基础层上并且包括第一驱动电路、第二驱动电路和多个像素电路；以及
发光元件层，布置在所述电路层上并且包括多个发光元件，所述多个发光元件中的每个电连接到所述多个像素电路中的对应的一个，
其中，所述第一驱动电路和所述第二驱动电路中的每个在第一方向上被布置在所述多个像素电路之间。
2.根据权利要求1所述的显示面板，其中，
所述第一驱动电路是扫描驱动电路，并且
所述第二驱动电路是发射控制驱动电路。
3.根据权利要求1所述的显示面板，其中，所述多个发光元件包括在平面视图中与所述第一驱动电路和所述第二驱动电路重叠的第一发光元件组以及在平面视图中与所述多个像素电路重叠的第二发光元件组。
4.根据权利要求3所述的显示面板，其中，所述第一发光元件组中的多个发光元件中的每个通过连接线电连接到所述多个像素电路中的相邻的一个。
5.根据权利要求4所述的显示面板，其中，
所述第一发光元件组中的所述多个发光元件中的每个包括：
布置在所述电路层上的第一电极；
布置在所述第一电极上的发光层；以及
布置在所述发光层上的第二电极，并且
所述第一电极电连接到所述连接线。
6.根据权利要求1所述的显示面板，其中，所述多个像素电路中的每个电连接到所述第一驱动电路和所述第二驱动电路。
7.根据权利要求1所述的显示面板，其中，
所述电路层还包括与所述第一驱动电路和所述第二驱动电路间隔开的第三驱动电路，并且
所述第二驱动电路在所述第一方向上介于所述第一驱动电路与所述第三驱动电路之间。
8.根据权利要求7所述的显示面板，其中，所述多个像素电路中的每个电连接到所述第二驱动电路以及所述第一驱动电路和所述第三驱动电路中的更近的一个。
9.根据权利要求7所述的显示面板，其中，
所述多个发光元件包括在平面视图中与所述第一驱动电路、所述第二驱动电路和所述第三驱动电路重叠的第一发光元件组以及在平面视图中与所述多个像素电路重叠的第二发光元件组，并且
所述第一发光元件组中的多个发光元件中的每个通过连接线电连接到所述多个像素电路中的相邻的一个。
10.根据权利要求7所述的显示面板，其中，所述电路层还包括在所述第一方向上布置在所述第二驱动电路与所述第三驱动电路之间的第四驱动电路。
11.根据权利要求10所述的显示面板，其中，所述多个像素电路中的每个电连接到所述第一驱动电路和所述第三驱动电路中的更近的一个以及所述第二驱动电路和所述第四驱动电路中的更近的一个。
12.根据权利要求10所述的显示面板，其中，
所述多个发光元件包括在平面视图中与所述第一驱动电路、所述第二驱动电路、所述第三驱动电路和所述第四驱动电路重叠的第一发光元件组以及在平面视图中与所述多个像素电路重叠的第二发光元件组，并且
所述第一发光元件组中的多个发光元件中的每个通过连接线电连接到所述多个像素电路中的相邻的一个。
13.根据权利要求1所述的显示面板，其中，所述第一驱动电路和所述第二驱动电路中的每个在与所述第一方向相交的第二方向上延伸。
14.一种显示面板，包括：
基础层，包括显示区和被布置成与所述显示区相邻的非显示区；
电路层，所述电路层被布置在所述基础层上并且包括：
布置在所述显示区中的第一驱动电路；
在第一方向上与所述第一驱动电路间隔开的第二驱动电路；以及
多个像素电路；以及
发光元件层，布置在所述电路层上并且包括布置在所述显示区中的多个发光元件，所述多个发光元件中的每个电连接到所述多个像素电路中的对应的一个，
其中，在所述第一方向上，所述多个像素电路中的至少一个被布置在所述第一驱动电路与所述第二驱动电路之间。
15.根据权利要求14所述的显示面板，其中，所述多个像素电路中的每个电连接到所述第一驱动电路和所述第二驱动电路。
16.根据权利要求14所述的显示面板，其中，
所述多个发光元件包括在平面视图中与所述第一驱动电路和所述第二驱动电路重叠的第一发光元件组以及在平面视图中与所述多个像素电路重叠的第二发光元件组，并且
所述第一发光元件组中的多个发光元件中的每个通过连接线电连接到所述多个像素电路中的相邻的一个。
17.根据权利要求14所述的显示面板，其中，
所述电路层还包括与所述第一驱动电路和所述第二驱动电路间隔开的第三驱动电路，
所述第二驱动电路在所述第一方向上介于所述第一驱动电路与所述第三驱动电路之间，并且
所述多个像素电路中的每个电连接到所述第二驱动电路以及所述第一驱动电路和所述第三驱动电路中的更近的一个。
18.根据权利要求17所述的显示面板，其中，
所述多个发光元件包括在平面视图中与所述第一驱动电路、所述第二驱动电路和所述第三驱动电路重叠的第一发光元件组以及在平面视图中与所述多个像素电路重叠的第二发光元件组，并且
所述第一发光元件组中的多个发光元件中的每个通过连接线电连接到所述多个像素电路中的相邻的一个。
19.根据权利要求17所述的显示面板，其中，
所述电路层还包括在所述第一方向上布置在所述第二驱动电路与所述第三驱动电路之间的第四驱动电路，并且
所述多个像素电路中的每个电连接到所述第一驱动电路和所述第三驱动电路中的更近的一个以及所述第二驱动电路和所述第四驱动电路中的更近的一个。
20.根据权利要求19所述的显示面板，其中，
所述多个发光元件包括在平面视图中与所述第一驱动电路、所述第二驱动电路、所述第三驱动电路和所述第四驱动电路重叠的第一发光元件组以及在平面视图中与所述多个像素电路重叠的第二发光元件组，并且
所述第一发光元件组中的多个发光元件中的每个通过连接线电连接到所述多个像素电路中的相邻的一个。
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