CN117478227B - 一种高速光通信连接器和服务器 - Google Patents

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Abstract

本发明实施例提供了一种高速光通信连接器和服务器，涉及数据传输技术领域，通过使第一信号引脚实现模块低速信号MODSEL和负时钟信号的复用，以及，使第二信号引脚实现光模块复位信号或正时钟信号的复用，使包含第一信号引脚和第二信号引脚的高速光通信连接器能够同时兼容光信号数据传输和PCIe协议信号传输，实现了PCIE总线数据的能够基于现有的光纤网络进行远距离数据传输，提升了PCIE总线数据的传输效率，避免了现有网络基建的资源浪费。

Description

一种高速光通信连接器和服务器
技术领域
本发明涉及数据传输技术领域，特别是涉及一种高速光通信连接器和服务器。
背景技术
QSFP28 是一种高速光纤传输模块，是现代通信网络中常用的光纤接口标准，QSFP28 标准定义了一种具有高性能的光纤传输模块，其物理接口采用了一个嵌入式的接口结构。这种接口结构可以支持高达 28个通道的数据传输，每个通道的传输速率可以达到25 Gbit/s。因此，QSFP28模块可以实现高达700Gbit/s的总体传输速率。
现今100G光纤网络端口现在已经运用越来越广泛，100G端口模块有多种封装形式，包括CFP/CFP2/CFP4，CXP和QSFP28。在这些不同的100G封装形式中，QSFP28光模块因其具有端口密度高、功耗低和成本低等优势，所以成为100G网络的主要封装方式。QSFP28采用4*25 Gbps通道实现，此外，QSFP28光模块具有升级的电口，可支持高达28G的信号，并达到最高可能的速率为4×28 Gbit / s。100G QSFP28封装大小比CXPCFP4光模块更小，可以在交换机上具有更高的端口密度。
PCI-Express(peripheral component interconnect express）是一种高速串行计算机扩展总线标准，PCIe属于高速串行点对点双通道高带宽传输，所连接的设备分配独享通道带宽，不共享总线带宽，主要支持主动电源管理，错误报告，端对端的可靠性传输，热插拔以及服务质量（QOS）等功能。
然而，当前的QSFP28接口无法兼容PCIe协议，从而造成了PCIE总线数据的传输效率低下，并造成了网络基建的资源浪费。
发明内容
本发明实施例是提供一种高速光通信连接器和服务器，以克服上述问题或者至少部分地解决上述问题。
本发明实施例公开了一种高速光通信连接器QSFP28-PCIE，所述高速光通信连接器QSFP28-PCIE用于使主机设备和光模块设备连接，或，用于使主机设备和非易失性存储器标准NVMe设备连接；所述主机设备用于生成模块低速信号MODSEL和光模块复位信号，或用于生成负时钟信号CLK_N和正时钟信号CLK_P，所述高速光通信连接器QSFP28-PCIE包括：
针对所述模块低速信号MODSEL或所述负时钟信号CLK_N的第一信号引脚；
针对所述光模块复位信号或所述正时钟信号CLK_P的第二信号引脚；
所述第一信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述模块低速信号MODSEL传输至所述光模块设备；
所述第一信号引脚用于当所述主机设备和所述非易失性存储器标准NVMe设备时，将由所述主机设备发送的所述负时钟信号CLK_N传输至所述非易失性存储器标准NVMe设备；
所述第二信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述光模块复位信号传输至所述光模块设备；
所述第二信号引脚用于当所述主机设备和所述非易失性存储器标准NVMe设备时，将由所述主机设备发送的所述正时钟信号CLK_P传输至所述非易失性存储器标准NVMe设备。
可选地，所述主机设备设置有现场可编辑门阵列FPGA，所述现场可编辑门阵列FPGA用于接收由所述光模块设备或所述非易失性存储器标准NVMe设备生成的在位检测输入信号MODPRSL，并当接收到所述在位检测输入信号MODPRSL，基于所述在位检测输入信号MODPRSL构建所述主机设备和所述光模块设备的连接关系，或，基于所述在位检测输入信号MODPRSL构建所述主机设备和所述非易失性存储器标准NVMe设备的连接关系。
可选地，所述高速光通信连接器QSFP28-PCIE包括：
提供信号接收电源电压VCCRX的第三信号引脚；
提供信号发送电源电压VCCTX的第四信号引脚；
提供低速信号电源电压VCC1的第五信号引脚。
可选地，所述主机设备用于生成线偏振模式信号LPMODE或对端设备复位信号，所述高速光通信连接器QSFP28-PCIE包括：
针对所述线偏振模式信号LPMODE或所述对端设备复位信号的第六信号引脚；
所述第六信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述线偏振模式信号LPMODE传输至所述光模块设备；
所述第六信号引脚用于当所述主机设备和所述非易失性存储器标准NVMe设备时，将由所述主机设备发送的所述对端设备复位信号传输至所述非易失性存储器标准NVMe设备。
可选地，所述主机设备用于生成终端告警信号INTC或唤醒信号WAKE，所述高速光通信连接器QSFP28-PCIE包括：
针对所述终端告警信号INTC或所述唤醒信号WAKE的第七信号引脚；
所述第七信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述终端告警信号INTC传输至所述光模块设备；
所述第七信号引脚用于当所述主机设备和所述非易失性存储器标准NVMe设备时，将由所述主机设备发送的所述唤醒信号WAKE传输至所述非易失性存储器标准NVMe设备。
可选地，所述光模块设备和所述高速光通信连接器QSFP28-PCIE包括：
针对所述在位检测输入信号MODPRSL的第八信号引脚；
所述第八信号引脚用于向所述主机设备传输所述在位检测输入信号MODPRSL。
可选地，所述主机设备包括时钟模块，以及基板管理控制器BMC；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器QSFP28-PCIE连接，所述高速光通信连接器QSFP28-PCIE通过高速串行计算机扩展总线与所述现场可编辑门阵列FPGA连接，所述基板管理控制器BMC与所述现场可编辑门阵列FPGA连接；
所述时钟模块用于生成所述负时钟信号CLK_N和所述正时钟信号CLK_P，并基于所述高速串行计算机扩展总线向所述高速光通信连接器QSFP28-PCIE发送所述负时钟信号CLK_N和所述正时钟信号CLK_P。
可选地，所述主机设备包括时钟模块、基板管理控制器BMC以及中央处理器CPU；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器QSFP28-PCIE连接，所述中央处理器CPU与所述高速光通信连接器QSFP28-PCIE通过高速串行计算机扩展总线连接，所述基板管理控制器BMC与所述高速光通信连接器QSFP28-PCIE连接；
所述时钟模块用于生成所述负时钟信号CLK_N和所述正时钟信号CLK_P，并基于所述高速串行计算机扩展总线向所述高速光通信连接器QSFP28-PCIE发送所述负时钟信号CLK_N和所述正时钟信号CLK_P。
可选地，所述非易失性存储器标准NVMe设备为，设置有支持所述非易失性存储器标准NVMe的固态硬盘的其他存储服务器。
可选地，所述非易失性存储器标准NVMe设备为，支持所述非易失性存储器标准NVMe且支持热插拔功能的移动固态硬盘。
本发明实施例还公开了一种服务器，所述服务器配置有高速光通信连接器QSFP28-PCIE，所述高速光通信连接器QSFP28-PCIE用于使服务器和光模块设备连接，或，用于使所述服务器和非易失性存储器标准NVMe设备连接；所述服务器用于生成模块低速信号MODSEL和光模块复位信号，或用于生成负时钟信号CLK_N和正时钟信号CLK_P，所述高速光通信连接器QSFP28-PCIE包括：
针对所述模块低速信号MODSEL或所述负时钟信号CLK_N的第一信号引脚；
针对所述光模块复位信号或所述正时钟信号CLK_P的第二信号引脚；
所述第一信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述模块低速信号MODSEL传输至所述光模块设备；
所述第一信号引脚用于当所述服务器和所述非易失性存储器标准NVMe设备时，将由所述服务器发送的所述负时钟信号CLK_N传输至所述非易失性存储器标准NVMe设备；
所述第二信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述光模块复位信号传输至所述光模块设备；
所述第二信号引脚用于当所述服务器和所述非易失性存储器标准NVMe设备时，将由所述服务器发送的所述正时钟信号CLK_P传输至所述非易失性存储器标准NVMe设备。
可选地，所述服务器设置有现场可编辑门阵列FPGA，所述现场可编辑门阵列FPGA用于接收由所述光模块设备或所述非易失性存储器标准NVMe设备生成的在位检测输入信号MODPRSL，并当接收到所述在位检测输入信号MODPRSL，基于所述在位检测输入信号MODPRSL构建所述服务器和所述光模块设备的连接关系，或，基于所述在位检测输入信号MODPRSL构建所述服务器和所述非易失性存储器标准NVMe设备的连接关系。
可选地，所述高速光通信连接器QSFP28-PCIE包括：
提供信号接收电源电压VCCRX的第三信号引脚；
提供信号发送电源电压VCCTX的第四信号引脚；
提供低速信号电源电压VCC1的第五信号引脚。
可选地，所述服务器用于生成线偏振模式信号LPMODE或对端设备复位信号，所述高速光通信连接器QSFP28-PCIE包括：
针对所述线偏振模式信号LPMODE或所述对端设备复位信号的第六信号引脚；
所述第六信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述线偏振模式信号LPMODE传输至所述光模块设备；
所述第六信号引脚用于当所述服务器和所述非易失性存储器标准NVMe设备时，将由所述服务器发送的所述对端设备复位信号传输至所述非易失性存储器标准NVMe设备。
可选地，所述服务器用于生成终端告警信号INTC或唤醒信号WAKE，所述高速光通信连接器QSFP28-PCIE包括：
针对所述终端告警信号INTC或所述唤醒信号WAKE的第七信号引脚；
所述第七信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述终端告警信号INTC传输至所述光模块设备；
所述第七信号引脚用于当所述服务器和所述非易失性存储器标准NVMe设备时，将由所述服务器发送的所述唤醒信号WAKE传输至所述非易失性存储器标准NVMe设备。
可选地，所述光模块设备和所述高速光通信连接器QSFP28-PCIE包括：
针对所述在位检测输入信号MODPRSL的第八信号引脚；
所述第八信号引脚用于向所述服务器传输所述在位检测输入信号MODPRSL。
可选地，所述服务器包括时钟模块，以及基板管理控制器BMC；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器QSFP28-PCIE连接，所述高速光通信连接器QSFP28-PCIE通过高速串行计算机扩展总线与所述现场可编辑门阵列FPGA连接，所述基板管理控制器BMC与所述现场可编辑门阵列FPGA连接；
所述时钟模块用于生成所述负时钟信号CLK_N和所述正时钟信号CLK_P，并基于所述高速串行计算机扩展总线向所述高速光通信连接器QSFP28-PCIE发送所述负时钟信号CLK_N和所述正时钟信号CLK_P。
可选地，所述服务器包括时钟模块、基板管理控制器BMC以及中央处理器CPU；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器QSFP28-PCIE连接，所述中央处理器CPU与所述高速光通信连接器QSFP28-PCIE通过高速串行计算机扩展总线连接，所述基板管理控制器BMC与所述高速光通信连接器QSFP28-PCIE连接；
所述时钟模块用于生成所述负时钟信号CLK_N和所述正时钟信号CLK_P，并基于所述高速串行计算机扩展总线向所述高速光通信连接器QSFP28-PCIE发送所述负时钟信号CLK_N和所述正时钟信号CLK_P。
可选地，所述非易失性存储器标准NVMe设备为，设置有支持所述非易失性存储器标准NVMe的固态硬盘的其他存储服务器。
可选地，所述非易失性存储器标准NVMe设备为，支持所述非易失性存储器标准NVMe且支持热插拔功能的移动固态硬盘。
本发明实施例包括以下优点：
本发明实施例，通过使第一信号引脚实现模块低速信号MODSEL和负时钟信号的复用，以及，使第二信号引脚实现光模块复位信号或正时钟信号的复用，使包含第一信号引脚和第二信号引脚的高速光通信连接器能够同时兼容光信号数据传输和PCIe协议信号传输，实现了PCIE总线数据的能够基于现有的光纤网络进行远距离数据传输，提升了PCIE总线数据的传输效率，避免了现有网络基建的资源浪费。
附图说明
图1是本发明实施例中提供的一种高速光通信连接器的结构示意图；
图2是本发明实施例中提供的另一种高速光通信连接器的结构示意图；
图3是本发明实施例中提供的一种本端主机设备和对端设备的结构示意图；
图4是本发明实施例中提供的另一种本端主机设备和对端设备的结构示意图；
图5是本发明实施例中提供的又一种本端主机设备和对端设备的结构示意图。
具体实施方式
为使本发明的上述目的、特征和优点能够更加明显易懂，下面结合附图和具体实施方式对本发明作进一步详细的说明。
在实际应用中，固态硬盘（Solid State Disk或Solid State Drive，简称SSD）,采用闪存作为存储介质，读取速度相对机械硬盘更快，以其所带来的高效的存储性能优势和节约的能耗成本将使其是未来存储领域中数据中心和云计算的首选配置。固态硬盘接口类型按照协议分为SATA总线接口和依托于PCIE总线的NVMe协议总线接口。NVMe ( Non-Volatile Memory Express，即非易失性存储器标准）专为PCle 接口固态硬盘设计的行业级标准，运用PCIe总线的高带宽低延迟 ,替代传统SATA、SAS接口SSD的存储架构，读写速率更快、延迟更低，并提供更低功耗，已经成为未来存储行业的主流发展方向。固态硬盘连接主板PCIE接口的连接器形态有U.2和M.2等多种接口形态，多是专门为存储提供的专用接口，很少能同时复用为其他功能。
在瞬息万变的大数据网络时代，数据的实时性占比将越来越高，有时候主机需要进行更多的网络交互，增加网络带宽，网络带宽增加后同样会涉及更多的数据存储空间，但是网络带宽和数据存储并非是相等的关系，可能某个阶段需要将网络数据存储，这就需要非常大的存储空间，但是存储的数据有效期较短一段时间后存储空间即可被释放，即，不再需要大的存储空间，从而存在有时存储应用优先，有时网络带宽需求优先的情况。面对这种情况，PC主机或服务器系统需要配备更多的网络接口，交换机和存储接口，甚至部署大规模的分布式网络。
若作为两个支柱业的高速光通信接口和PCIe接口能够实现兼容设计，使网络和存储在接口上实现交集将会出现一种新的应用方式，为PC主机提供任意的网络扩展或存储扩展，即插即用无需开机维护和更换接口。
所以，本发明实施例提出了一种支持PCIe协议的高速光通信连接器QSFP28-PCIE，让当下主流的100G QSFP28网络接口兼容PCIe接口，使网络接口和NVNe的硬盘接口可以实现兼容同一物理接口，从而进一步推进网络和存储在接口上实现融合，联通光通信和PCIe协议两个支柱数据传输技术实现在不同应用场景下的自由切换。
参照图1，示出了本发明实施例中提供的一种高速光通信连接器的结构示意图：
在实际应用中，主机设备可以为服务器或是个人计算机PC。
在具体实现中，高速光通信连接器可以用于使主机设备和光模块设备连接，或，用于使主机设备和非易失性存储器标准设备连接。示例性地，光模块设备可以是光接口交换机等通过光信号传输数据的设备，非易失性存储器标准设备可以是配置有固态硬盘SSD等符合非易失性存储器标准的设备。
当主机设备和光模块设备连接时，主机设备可以用于生成模块低速信号MODSEL和光模块复位信号RESET。
当主机设备和非易失性存储器标准设备连接时，主机设备可以用于生成负时钟信号CLK_N和正时钟信号CLK_P。
在实际应用中，PCIE接口和光通信接口的主要差别在于PCIE接口一般需要一对外部100Mhz参考时钟信号，本发明实施例可以将高速光通信连接器的MODSEL和RESET信号复用为参考时钟输出信号，为NVMe硬盘提供100MHz参考时钟。
本发明实施例的高速光通信连接器可以包括：
针对模块低速信号MODSEL或负时钟信号CLK_N的第一信号引脚101；
针对所述光模块复位信号RESTE或正时钟信号CLK_P的第二信号引脚102。
第一信号引脚101可以用于当主机设备和所述光模块设备连接时，将由主机设备发送的模块低速信号MODSEL传输至光模块设备；
第二信号引脚102可以用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述光模块复位信号RESET传输至所述光模块设备；
第一信号引脚101可以用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述负时钟信号传输至所述非易失性存储器标准设备；
所述第二信号引脚102可以用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述正时钟信号传输至所述非易失性存储器标准设备。
在具体实现中，本发明实施例可以采用QSFP28或QSFP56等设备作为初始高速光通信连接器，在该初始高速光通信连接器的基础上增加的PCIE X4接口的相关信号定义，从而实现物理接口兼容，为使本领域技术人员更好地理解本发明实施例，以下采用QSFP28-PCIE作为高速光通信连接器示例进行说明。
如图1所示的高速光通信连接器QSFP28-PCIE，根据光信号的输入输出模式考虑兼容PCIE接口的输入输出模式，可以重新定义了一个兼容的PCIE接口信号定义，其中，针对高速信号线、I2C总线和电源跟大部分信号定义与用法，QSFP28与PCIE可以是相同的，接口电平标准也几乎一致，例如，QSFP28和PCIE接口的信号线全部为高速串行总线，分为四组单向的输入RX[1:4]差分总线和四组单向的输出TX[1:4]差分总线，总线规格可以与QSFP28接口一致。
QSFP28高速连接器支持接口线速最高可达28G信号速率，可以向下兼容到PCIE4.0接口的16G信号，高速连接器信号形态可用，主机端或交换机端应用重新定义接口即可实现协议兼容，可以由现场可编辑门阵列FPGA实现引脚协议内容的定义，从而接口应用由现场可编辑门阵列FPGA自由选择，可以实现无缝兼容设计，例如，现场可编辑门阵列FPGA可以定义高速光通信连接器QSFP28-PCIE支持光口协议和PCIE协议在同一物理端口中的自由切换，其中，可以包括定义高速光通信连接器QSFP28-PCIE的第一信号引脚实现模块低速信号或负时钟信号复用，以及第二信号引脚实现光模块复位信号或正时钟信号的复用，该过程可以在现场可编辑门阵列FPGA主芯片内部实现。
示例性地，针对光模块设备和非易失性存储器标准设备的通道选择，可以通过两种方法实现：
一、通过硬件选通，即用电阻或电容器件进行信号选通，或者是通过高速模拟开关进行信号选通；
二、通过CPU芯片或FPGA芯片内部信号做兼容性选择，具体地，FPGA作为可编程器件在CPU尚未开发该功能的情况下具有更大的优势，FPGA器件可根据需要将高速信号通道定义成是PCIe接口通道还是光口以太网高速信号通道，从而只需要将连接器上的高速信号线接入FPGA高速信号通道，然后由FPGA根据实际应用定义该接口是高速网络接口还是PCIE总线接口即可。
当然，上述例子仅作为示例，本领域技术人员可以采用其他任意方式实现针对QSFP28接口和PCIE接口的通道选择，对此，本发明实施例不作限定。
当判定主机设备和光模块设备连接时，模块低速信号MODSEL与光模块复位信号RESET信号相对于光模块而言为输入信号，示例性地，可以通过上拉电阻上拉到光模块的VCC电源，当主机输出给光模块低电平时，选中或复位光模块。
当判定主机设备和非易失性存储器标准设备连接时，高速光通信连接器QSFP28-PCIE可以接收来自主机的参考时钟信号CLK_N（负时钟信号）/CLK_P（正时钟信号），CLK_N（负时钟信号）/CLK_P（正时钟信号）对于NVMe SSD硬盘而言同样为输入信号。
由上可知，无论本发明实施例的高速光通信连接器QSFP28-PCIe外部是连接光模块还是NVMe硬盘，CLK_N/MODSEL与 CLK_P/RESET信号对于外部设备而言都是输入信号，对于具有本发明实施例的高速光通信连接器QSFP28-PCIe的主板而言都是输出信号，从而不论应用功能是PCIE总线还是光口信号模式外接任一接口都不会对彼此造成损坏。
本发明实施例，通过使第一信号引脚实现模块低速信号MODSEL和负时钟信号的复用，以及，使第二信号引脚实现光模块复位信号或正时钟信号的复用，使包含第一信号引脚和第二信号引脚的高速光通信连接器能够同时兼容光信号数据传输和PCIe协议信号传输，实现了PCIE总线数据的能够基于现有的光纤网络进行远距离数据传输，提升了PCIE总线数据的传输效率，避免了现有网络基建的资源浪费。
在上述实施例的基础上，提出了上述实施例的变型实施例，在此需要说明的是，为了使描述简要，在变型实施例中仅描述与上述实施例的不同之处。
在本发明的一个可选地实施例中，所述主机设备设置有现场可编辑门阵列，所述现场可编辑门阵列用于接收由所述光模块设备或所述非易失性存储器标准设备生成的在位检测输入信号，并当接收到所述在位检测输入信号，基于所述在位检测输入信号构建所述主机设备和所述光模块设备的连接关系，或，基于所述在位检测输入信号构建所述主机设备和所述非易失性存储器标准设备的连接关系。
在实际应用中，FPGA（Field Programmable Gate Array）是在PAL （可编程阵列逻辑）、GAL（通用阵列逻辑）等可编程器件的基础上进一步发展的产物。它是作为专用集成电路（ASIC）领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。
由上可知，可编程阵列逻辑FPGA作为可编程器件在CPU尚未开发通道选择功能的情况下具有更大的优势，FPGA器件可根据需要将高速信号通道定义成是PCIe接口通道或是光口以太网高速信号通道，从而只需要将连接器上的高速信号线接入现场可编辑门阵列FPGA高速信号通道，然后由现场可编辑门阵列FPGA根据实际应用定义该接口是高速网络接口还是PCIE总线接口即可。
具体地，当光模块设备或非易失性存储器标准设备生成的在位检测输入信号MODPRSL时，现场可编辑门阵列FPGA可以接收该在位检测输入信号MODPRSL，若当前与主机设备连接的是光模块设备，则可以在位检测输入信号MODPRSL可以在光模块设备中接地，通过主机设备上拉，连接现场可编辑门阵列FPGA的输入输出IO，以确定在位设备为光模块设备，若当前与主机设备连接的是非易失性存储器标准设备，则可以在位检测输入信号MODPRSL可以在非易失性存储器标准设备中接地，通过主机设备上拉，连接现场可编辑门阵列FPGA的输入输出IO，以确定在位设备为非易失性存储器标准设备，从而实现两种传输协议的兼容。
进一步地，主机设备端的输入输出IO信号模拟输出，可由FPGA选择实现时钟和MODSEL与RESET信号的兼容（CLK_N/MODSEL与 CLK_P/RESET)。由于对于光模块MODSEL与RESET为输入信号，即使在FPGA配置为PCIE接口状态时，输出的时钟信号被接入光模块，也不会对光模块或现场可编辑门阵列FPGA造成损坏。
本发明实施例，通过为所述主机设备设置现场可编辑门阵列，所述现场可编辑门阵列用于接收由所述光模块设备或所述非易失性存储器标准设备生成的在位检测输入信号，并当接收到所述在位检测输入信号，基于所述在位检测输入信号构建所述主机设备和所述光模块设备的连接关系，或，基于所述在位检测输入信号构建所述主机设备和所述非易失性存储器标准设备的连接关系，从而提升了针对光模块设备和非易失性存储器标准设备的通道选择效率，更进一步地提升了数据传输效率。
在本发明的一个可选地实施例中，所述高速光通信连接器包括：
针对所述在位检测输入信号的第八信号引脚；
所述第八信号引脚用于向所述主机设备传输所述在位检测输入信号。
参考图2，图2是本发明实施例中提供的另一种高速光通信连接器的结构示意图；
在具体实现中，本发明实施例可以通过现场可编辑门阵列FPGA定义第八信号引脚103，使针对光模块设备的在位检测输入信号，和针对非易失性存储器标准设备的在位检测输入信号，能够在第八信号引脚103上复用，以使针对光模块设备的在位检测输入信号，和针对非易失性存储器标准设备的在位检测输入信号都能通过第八信号引脚103传输至主机设备，节省了对高速光通信连接器的引脚占用，从而更进一步地提升了数据传输效率。
在本发明的一个可选地实施例中，所述高速光通信连接器包括：
提供信号接收电源电压的第三信号引脚；
提供信号发送电源电压的第四信号引脚；
提供低速信号电源电压的第五信号引脚。
在实际应用中，I2C总线是一种简单、双向二线制同步串行总线。它只需要两根线即可在连接于总线上的器件之间传送信息。主器件用于启动总线传送数据，并产生时钟以开放传送的器件，此时任何被寻址的器件均被认为是从器件．在总线上主和从、发和收的关系不是恒定的，而取决于此时数据传送方向。如果主机要发送数据给从器件，则主机首先寻址从器件，然后主动发送数据至从器件，最后由主机终止数据传送；如果主机要接收从器件的数据，首先由主器件寻址从器件．然后主机接收从器件发送的数据，最后由主机终止接收过程。在这种情况下．主机负责产生定时时钟和终止数据传送。
固态硬盘（Solid State Disk或Solid State Drive，简称SSD），又称固态驱动器，是用固态电子存储芯片阵列制成的硬盘。
在具体实现中，主机设备为光模块设备提供电源分为接收电源电压VCCRX，发送电源电压VCCTX和低速信号电源电压VCC1三个3.3V电源，供电范围3.3V±5%，功率为1.5-10W。非易失性存储器标准设备供电可复用此三路电源作为固态硬盘的供电，SSD硬盘的电源需求也是3.3V±5%，根据不同容量和速率SSD硬盘的功耗一般是在2-10W左右；I2C总线SCL（Serial Clock Line，串行时钟线）/SDA（Serial Data Line，串行数据线）信号应用方式相同，接口电平均为3.3V，协议标准均为I2C协议通用标准，均可实现通过FPGA模拟I2C总线读取光模块信息或NVMe SSD硬盘信息，即I2C总线信号完全可实现兼容使用。
参考图2，图2是本发明实施例中提供的另一种高速光通信连接器的结构示意图；
高速光通信连接器可以包括提供信号接收电源电压VCCRX的第三信号引脚104；提供信号发送电源电压VCCTX的第四信号引脚105；提供低速信号电源电压VCC1的第五信号引脚106，从而实现针对光模块设备和非易失性存储器标准设备的供电引脚复用，节省了高速光通信连接器的引脚占用，更进一步地提升了数据传输效率。
在本发明的一个可选地实施例中，所述主机设备用于生成线偏振模式信号或对端设备复位信号，所述高速光通信连接器包括：
针对所述线偏振模式信号或所述对端设备复位信号的第六信号引脚；
所述第六信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述线偏振模式信号传输至所述光模块设备；
所述第六信号引脚用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述对端设备复位信号传输至所述非易失性存储器标准设备。
在实际应用中，光模块设备的偏振模式信号LPMODE复用作为PCIE接口的对端设备复位信号RESET，可以由CPU或FPGA输出复位信号给NVMe SSD硬盘，当主机设备与光模块设备连接时，CPU/FPGA作为输出信号给光模块选择光模块工作模式，该信号无论是作为线偏振模式信号LPMODE还是对端设备复位信号RESET，对于本发明实施例的QSFP28-PCIe接口主板而言都是输出信号，不会因为功能不同差错而对彼此造成损坏。
参考图2，图2是本发明实施例中提供的另一种高速光通信连接器的结构示意图；
本发明实施例可以通过现场可编辑门阵列FPGA定义第六信号引脚107，使光模块的线偏振模式信号LPMODE与PCIE接口的对端设备复位信号RESET在第六信号引脚107上复用，以实现在主机设备和光模块设备连接时，将由主机设备发送的线偏振模式信号通过第六信号引脚107传输至光模块设备；并在主机设备和非易失性存储器标准设备时，将由主机设备发送的对端设备复位信号通过第六信号引脚107输至非易失性存储器标准设备。
本发明实施例，通过使高速光通信连接器配置针对所述线偏振模式信号或所述对端设备复位信号的第六信号引脚；所述第六信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述线偏振模式信号传输至所述光模块设备；所述第六信号引脚用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述对端设备复位信号传输至所述非易失性存储器标准设备，实现了使光模块的线偏振模式信号LPMODE与PCIE接口的对端设备复位信号RESET在第六信号引脚107上复用，从而节省了针对高速光通信连接器的引脚占用，更进一步地提升了数据传输效率。
在本发明的一个可选地实施例中，所述主机设备用于生成终端告警信号或唤醒信号，所述高速光通信连接器包括：
针对所述终端告警信号或所述唤醒信号的第七信号引脚；
所述第七信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述终端告警信号传输至所述光模块设备；
所述第七信号引脚用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述唤醒信号传输至所述非易失性存储器标准设备。
在实际应用中，光模块设备的终端告警信号INTC在光模块设备内部为OD输出信号，在PCIE模块的告警信号同样也是OD输出信号，该终端告警信号INTC/唤醒信号WAKE复用连接CPU/FPGA，作为光模块的告警信号和WAKE唤醒信号使用。
参考图2，图2是本发明实施例中提供的另一种高速光通信连接器的结构示意图；
本发明实施例可以通过现场可编辑门阵列FPGA定义第七信号引脚108，使光模块的终端告警信号INTC与PCIE接口的唤醒信号WAKE在第七信号引脚108上复用，以实现在主机设备和光模块设备连接时，将由主机设备发送的终端告警信号INTC通过第七信号引脚108传输至光模块设备；并在主机设备和非易失性存储器标准设备时，将由主机设备发送的唤醒信号WAKE通过第七信号引脚108输至非易失性存储器标准设备。
本发明实施例，通过使高速光通信连接器配置针对所述终端告警信号或所述唤醒信号的第七信号引脚；所述第七信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述终端告警信号传输至所述光模块设备；所述第七信号引脚用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述唤醒信号传输至所述非易失性存储器标准设备，实现了使光模块的终端告警信号INTC与唤醒信号WAKE在第七信号引脚108上复用，从而节省了针对高速光通信连接器的引脚占用，更进一步地提升了数据传输效率。
在本发明的一个可选地实施例中，所述主机设备包括时钟模块，以及基板管理控制器；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器连接，所述高速光通信连接器通过高速串行计算机扩展总线与所述现场可编辑门阵列连接，所述基板管理控制器与所述现场可编辑门阵列连接；
所述时钟模块用于生成所述负时钟信号和所述正时钟信号，并基于所述高速串行计算机扩展总线向所述高速光通信连接器发送所述负时钟信号和所述正时钟信号。
基板管理控制器（baseboard management controller，BMC）是一个专门的服务处理机，它利用传感器来监视一台计算机、网络服务器，或者是其他硬件驱动设备的状态。
参考图3，图3是本发明实施例中提供的一种本端主机设备和对端设备的结构示意图。
对端设备301可以是常规 100G QSFP28光接口交换机，或QSFP28-PCIe接口交换机，或光通信设备，或PCIE交换机，或远端PCIE接口设备，或NVME接口硬盘，或存储服务器，或常规100G QSFP28光接口交换机。
对端设备301可以配置有高速光通信连接器（QSFP28-PCIe接口）3011。
可选地，当对端设备为非易失性存储器标准设备时，该非易失性存储器标准设备为设置有支持非易失性存储器标准的固态硬盘的其他存储服务器。
主机设备302可以包括时钟模块3021，以及基板管理控制器3022，时钟模块3021与高速光通信连接器（QSFP28-PCIe接口）303连接，高速光通信连接器（QSFP28-PCIe接口）303通过包含低速信号线和高速信号线的高速串行计算机扩展总线与现场可编辑门阵列FPGA3023连接，基板管理控制器3022与现场可编辑门阵列FPGA3023通过低速信号线连接，以实现通过基板管理控制器3022对现场可编辑门阵列FPGA3023的监测。
对端设备301和主机设备302之间可以设置有PCIe光模块304，对端设备301和主机设备302之间可以通过高速光通信连接器（QSFP28-PCIe接口）303、高速光通信连接器（QSFP28-PCIe接口）3011和PCIe光模块304进行数据传输。
主机设备302可以通过现场可编辑门阵列FPGA3023与高速光通信连接器，实现与对端设备301进行PCIe或以太网Ethernet的数据交互。
时钟模块3021用于生成负时钟信号和所述正时钟信号，并基于高速串行计算机扩展总线向高速光通信连接器（QSFP28-PCIe接口）303发送负时钟信号和正时钟信号（PCIeRefclk，参考时钟）。
中央处理器（Central Processing Unit，简称CPU）作为计算机系统的运算和控制核心，是信息处理、程序运行的最终执行单元。CPU自产生以来，在逻辑结构、运行效率以及功能外延上取得了巨大发展。
现场可编辑门阵列FPGA3023与中央处理器CPU3024之间通过PCIe4.0 x8 数据总线连接。
时钟模块3021用于向中央处理器CPU3024发送 SYS Refclk系统参考时钟信号。
在实际应用中，本发明实施例用Agilex FPGA芯片代替以太网PHY芯片实现PCIE转以太的功能，同时采用本发明的 QSFP28-PCIE接口，可以兼容实现PCIE数据总线通道，Agilex FPGA芯片的高速IO数据总线可以实现同一接口兼容PCIE总线和以太网总写协议，这就实现了QSFP28-PCIE接口的高速总线硬件兼容设计，采用本发明实施例的QSFP28-PCIE接口，既可以兼容常规的以太网接口设计，还可以通过FPGA作为桥梁，实现直接通过PCIE总线连接远端设备，这样可以解决PCIE总线传输距离近的缺点，从而实现FPGA端的功能切换，并使QSFP28接口兼容性设计，同时，可以支持PCIE协议的QSFP28光模块的设计。
在本发明的一个可选地实施例中，所述主机设备包括时钟模块、基板管理控制器以及中央处理器；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器连接，所述中央处理器与所述高速光通信连接器通过高速串行计算机扩展总线连接，所述基板管理控制器与所述高速光通信连接器连接；
所述时钟模块用于生成所述负时钟信号和所述正时钟信号，并基于所述高速串行计算机扩展总线向所述高速光通信连接器发送所述负时钟信号和所述正时钟信号。
参考图4，图4是本发明实施例中提供的另一种本端主机设备和对端设备的结构示意图；
对端设备401可以是常规 100G QSFP28光接口交换机，或QSFP28-PCIe接口交换机，或光通信设备，或PCIE交换机，或远端PCIE接口设备，或NVME接口硬盘，或存储服务器，或常规100G QSFP28光接口交换机。
对端设备401可以配置有高速光通信连接器（QSFP28-PCIe接口）4011。
可选地，当对端设备为非易失性存储器标准设备时，该非易失性存储器标准设备为设置有支持非易失性存储器标准的固态硬盘的其他存储服务器。
主机设备402可以包括时钟模块4021，以及中央处理器CPU4023，时钟模块4021与高速光通信连接器（QSFP28-PCIe接口）403连接，高速光通信连接器（QSFP28-PCIe接口）403通过包含PCIe4.0 x4 高速数据线的高速串行计算机扩展总线与中央处理器CPU4023连接，基板管理控制器4022与高速光通信连接器（QSFP28-PCIe接口）403通过低速信号线连接，以实现通过基板管理控制器4022对高速光通信连接器（QSFP28-PCIe接口）403的监测。
对端设备401和主机设备402之间可以设置有PCIe光模块404，对端设备401和主机设备402之间可以通过高速光通信连接器（QSFP28-PCIe接口）403、高速光通信连接器（QSFP28-PCIe接口）4011和PCIe光模块404进行数据传输。
时钟模块4021用于生成负时钟信号和正时钟信号，并基于高速串行计算机扩展总线向高速光通信连接器（QSFP28-PCIe接口）403发送负时钟信号和正时钟信号（PCIeRefclk，参考时钟）。
时钟模块4021用于向中央处理器CPU4023发送 SYS Refclk系统参考时钟信号。
在具体实现中，本发明实施例可以简化FPGA的PHY转换功能，采用CPU自己的PCIE接口直接通过本发明的QSFP28-PCIE接口实现PCIE总线的远距离传输，可以大大减少的数据读写延迟，直接采用PCIE总线通信，免去了中间PCIE转以太网的电路，大大降低了设计成本。
在本发明的一个可选地实施例中，所述非易失性存储器标准设备为，支持所述非易失性存储器标准且支持热插拔功能的移动固态硬盘。
参考图5，图5是本发明实施例中提供的又一种本端主机设备和对端设备的结构示意图。
对端设备可以为支持非易失性存储器标准且支持热插拔功能的移动固态硬盘SSD501，直接采用QSFP28模块的物理结构，将SSD固态移动硬盘插口的物理结构设计成兼容高速光通信连接器（QSFP28-PCIe接口）502，由上可知，非易失性存储器标准设备供电可复用此三路电源作为固态硬盘的供电，SSD硬盘的电源需求也是3.3V±5%，而本发明实施例的高速光通信连接器（QSFP28-PCIe接口）502可以包括提供信号接收电源电压的第三信号引脚；提供信号发送电源电压的第四信号引脚；提供低速信号电源电压的第五信号引脚，即，本发明实施例的高速光通信连接器（QSFP28-PCIe接口）502提供了接收电源电压VCCRX，发送电源电压VCCTX和低速信号电源电压VCC1三个3.3V电源，在电源兼容的前提下，可以在移动固态硬盘SSD501上增加热插拔器件，即可实现 QSFP28-SSD硬盘的带电热插拔，然后在通过系统软件重新训练和枚举PCIE特定通道，即可实现SSD固态硬盘的带电热插拔和即插即用功能，从而实现了一种新式的移动SSD硬盘接口形态和硬盘形态。
示例性地，图1和图2中的接口A和接口B可以为同一接口，A体现了标准四线高速光纤传输模块接口定义，即，该接口在标准四线高速光纤传输模块接口定义下通过引脚与其他设备进行数据交互，B体现了兼容高速串行计算机扩展总线标准PCIe X4接口的四线高速光纤传输模块接口定义，即该接口在兼容高速串行计算机扩展总线标准PCIe X4定义下通过引脚与其他设备进行数据交互，该接口可以左边的19个引脚可以由上至下按序排列，右边的19个引脚可以由下至上按序排列，共有38个引脚，38个引脚可以用1-38号引脚标记，在实际应用中，TX信号为差分总线输出信号，RX信号为差分总线输入信号，P（positive）为正，N（negative）为负。
其中，按序排列的第1-7，11-26，32-38个引脚可以针对相同的信号，按序排列的第2个引脚为针对TX2N信号的引脚，按序排列的第3个引脚为针对TX2P信号的引脚，按序排列的第5个引脚为针对TX4N信号的引脚，按序排列的第6个引脚为针对TX4P信号的引脚，按序排列的第8个引脚（第一引脚101）为复用MODSEL信号和CLK N信号的引脚，按序排列的第9个引脚（第二引脚102）为复用RESET信号和CLK P信号的引脚，按序排列的第10个引脚（第三信号引脚104）为针对VCCRX信号的引脚，按序排列的第11个引脚为针对SCL信号的引脚，按序排列的第12个引脚为针对SDA信号的引脚，按序排列的第14个引脚为针对RX3P信号的引脚，按序排列的第15个引脚为针对RX3N信号的引脚，按序排列的第17个引脚为针对RX1P信号的引脚，按序排列的第18个引脚为针对RX1N信号的引脚，按序排列的第21个引脚为针对RX2N信号的引脚，按序排列的第22个引脚为针对RX2P信号的引脚，按序排列的第24个引脚为针对RX4N信号的引脚，按序排列的第25个引脚为针对RX4P信号的引脚，按序排列的第27个引脚（第八信号引脚103）为针对MODPRS信号的引脚，按序排列的第28（第七信号引脚108）个引脚为针对INTC信号和WAKE信号的引脚，按序排列的第29个引脚（第四信号引脚105）为针对VCCTX信号的引脚，按序排列的第30个引脚（第五信号引脚106）为针对VCC1信号的引脚，按序排列的第31个引脚（第六信号引脚107）为复用LPMODE信号和RESET信号的引脚，按序排列的第33个引脚为针对TX3P信号的引脚，按序排列的第34个引脚为针对TX3N信号的引脚，按序排列的第36个引脚为针对TX1P信号的引脚，按序排列的第37个引脚为针对TX1N信号的引脚。
本发明实施例还公开了一种服务器，所述服务器配置有高速光通信连接器QSFP28-PCIE，所述高速光通信连接器QSFP28-PCIE用于使服务器和光模块设备连接，或，用于使所述服务器和非易失性存储器标准NVMe设备连接；所述服务器用于生成模块低速信号MODSEL和光模块复位信号，或用于生成负时钟信号CLK_N和正时钟信号CLK_P，所述高速光通信连接器QSFP28-PCIE包括：
针对所述模块低速信号MODSEL或所述负时钟信号CLK_N的第一信号引脚；
针对所述光模块复位信号或所述正时钟信号CLK_P的第二信号引脚；
所述第一信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述模块低速信号MODSEL传输至所述光模块设备；
所述第一信号引脚用于当所述服务器和所述非易失性存储器标准NVMe设备时，将由所述服务器发送的所述负时钟信号CLK_N传输至所述非易失性存储器标准NVMe设备；
所述第二信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述光模块复位信号传输至所述光模块设备；
所述第二信号引脚用于当所述服务器和所述非易失性存储器标准NVMe设备时，将由所述服务器发送的所述正时钟信号CLK_P传输至所述非易失性存储器标准NVMe设备。
可选地，所述服务器设置有现场可编辑门阵列FPGA，所述现场可编辑门阵列FPGA用于接收由所述光模块设备或所述非易失性存储器标准NVMe设备生成的在位检测输入信号MODPRSL，并当接收到所述在位检测输入信号MODPRSL，基于所述在位检测输入信号MODPRSL构建所述服务器和所述光模块设备的连接关系，或，基于所述在位检测输入信号MODPRSL构建所述服务器和所述非易失性存储器标准NVMe设备的连接关系。
可选地，所述高速光通信连接器QSFP28-PCIE包括：
提供信号接收电源电压VCCRX的第三信号引脚；
提供信号发送电源电压VCCTX的第四信号引脚；
提供低速信号电源电压VCC1的第五信号引脚。
可选地，所述服务器用于生成线偏振模式信号LPMODE或对端设备复位信号，所述高速光通信连接器QSFP28-PCIE包括：
针对所述线偏振模式信号LPMODE或所述对端设备复位信号的第六信号引脚；
所述第六信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述线偏振模式信号LPMODE传输至所述光模块设备；
所述第六信号引脚用于当所述服务器和所述非易失性存储器标准NVMe设备时，将由所述服务器发送的所述对端设备复位信号传输至所述非易失性存储器标准NVMe设备。
可选地，所述服务器用于生成终端告警信号INTC或唤醒信号WAKE，所述高速光通信连接器QSFP28-PCIE包括：
针对所述终端告警信号INTC或所述唤醒信号WAKE的第七信号引脚；
所述第七信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述终端告警信号INTC传输至所述光模块设备；
所述第七信号引脚用于当所述服务器和所述非易失性存储器标准NVMe设备时，将由所述服务器发送的所述唤醒信号WAKE传输至所述非易失性存储器标准NVMe设备。
可选地，所述光模块设备和所述高速光通信连接器QSFP28-PCIE包括：
针对所述在位检测输入信号MODPRSL的第八信号引脚；
所述第八信号引脚用于向所述服务器传输所述在位检测输入信号MODPRSL。
可选地，所述服务器包括时钟模块，以及基板管理控制器BMC；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器QSFP28-PCIE连接，所述高速光通信连接器QSFP28-PCIE通过高速串行计算机扩展总线与所述现场可编辑门阵列FPGA连接，所述基板管理控制器BMC与所述现场可编辑门阵列FPGA连接；
所述时钟模块用于生成所述负时钟信号CLK_N和所述正时钟信号CLK_P，并基于所述高速串行计算机扩展总线向所述高速光通信连接器QSFP28-PCIE发送所述负时钟信号CLK_N和所述正时钟信号CLK_P。
可选地，所述服务器包括时钟模块、基板管理控制器BMC以及中央处理器CPU；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器QSFP28-PCIE连接，所述中央处理器CPU与所述高速光通信连接器QSFP28-PCIE通过高速串行计算机扩展总线连接，所述基板管理控制器BMC与所述高速光通信连接器QSFP28-PCIE连接；
所述时钟模块用于生成所述负时钟信号CLK_N和所述正时钟信号CLK_P，并基于所述高速串行计算机扩展总线向所述高速光通信连接器QSFP28-PCIE发送所述负时钟信号CLK_N和所述正时钟信号CLK_P。
可选地，所述非易失性存储器标准NVMe设备为，设置有支持所述非易失性存储器标准NVMe的固态硬盘的其他存储服务器。
可选地，所述非易失性存储器标准NVMe设备为，支持所述非易失性存储器标准NVMe且支持热插拔功能的移动固态硬盘。
对于服务器实施例而言，由于其与高速光通信连接器实施例基本相似，所以描述的比较简单，相关之处参见高速光通信连接器实施例的部分说明即可。
尽管已描述了本发明实施例的优选实施例，但本领域内的技术人员一旦得知了基本创造性概念，则可对这些实施例做出另外的变更和修改。所以，所附权利要求意欲解释为包括优选实施例以及落入本发明实施例范围的所有变更和修改。
最后，还需要说明的是，在本文中，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者终端设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者终端设备所固有的要素。在没有更多限制的情况下，由语句“包括一个……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者终端设备中还存在另外的相同要素。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以权利要求的保护范围为准。

Claims (18)

1.一种高速光通信连接器，其特征在于，所述高速光通信连接器用于使主机设备和光模块设备连接，或，用于使所述主机设备和非易失性存储器标准设备连接；所述主机设备用于生成模块低速信号和光模块复位信号，或用于生成负时钟信号和正时钟信号，所述高速光通信连接器包括：
针对所述模块低速信号或所述负时钟信号的第一信号引脚；
针对所述光模块复位信号或所述正时钟信号的第二信号引脚；
所述第一信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述模块低速信号传输至所述光模块设备；
所述第一信号引脚用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述负时钟信号传输至所述非易失性存储器标准设备；
所述第二信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述光模块复位信号传输至所述光模块设备；
所述第二信号引脚用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述正时钟信号传输至所述非易失性存储器标准设备；
所述主机设备用于生成线偏振模式信号或对端设备复位信号，所述高速光通信连接器包括：
针对所述线偏振模式信号或所述对端设备复位信号的第六信号引脚；
所述第六信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述线偏振模式信号传输至所述光模块设备；
所述第六信号引脚用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述对端设备复位信号传输至所述非易失性存储器标准设备。
2.根据权利要求1所述的高速光通信连接器，其特征在于，所述主机设备设置有现场可编辑门阵列，所述现场可编辑门阵列用于接收由所述光模块设备或所述非易失性存储器标准设备生成的在位检测输入信号，并当接收到所述在位检测输入信号，基于所述在位检测输入信号构建所述主机设备和所述光模块设备的连接关系，或，基于所述在位检测输入信号构建所述主机设备和所述非易失性存储器标准设备的连接关系。
3.根据权利要求1所述的高速光通信连接器，其特征在于，所述高速光通信连接器包括：
提供信号接收电源电压的第三信号引脚；
提供信号发送电源电压的第四信号引脚；
提供低速信号电源电压的第五信号引脚。
4.根据权利要求1所述的高速光通信连接器，其特征在于，所述主机设备用于生成终端告警信号或唤醒信号，所述高速光通信连接器包括：
针对所述终端告警信号或所述唤醒信号的第七信号引脚；
所述第七信号引脚用于当所述主机设备和所述光模块设备连接时，将由所述主机设备发送的所述终端告警信号传输至所述光模块设备；
所述第七信号引脚用于当所述主机设备和所述非易失性存储器标准设备时，将由所述主机设备发送的所述唤醒信号传输至所述非易失性存储器标准设备。
5.根据权利要求2所述的高速光通信连接器，其特征在于，所述高速光通信连接器包括：
针对所述在位检测输入信号的第八信号引脚；
所述第八信号引脚用于向所述主机设备传输所述在位检测输入信号。
6.根据权利要求5所述的高速光通信连接器，其特征在于，所述主机设备包括时钟模块，以及基板管理控制器；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器连接，所述高速光通信连接器通过高速串行计算机扩展总线与所述现场可编辑门阵列连接，所述基板管理控制器与所述现场可编辑门阵列连接；
所述时钟模块用于生成所述负时钟信号和所述正时钟信号，并基于所述高速串行计算机扩展总线向所述高速光通信连接器发送所述负时钟信号和所述正时钟信号。
7.根据权利要求1所述的高速光通信连接器，其特征在于，所述主机设备包括时钟模块、基板管理控制器以及中央处理器；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器连接，所述中央处理器与所述高速光通信连接器通过高速串行计算机扩展总线连接，所述基板管理控制器与所述高速光通信连接器连接；
所述时钟模块用于生成所述负时钟信号和所述正时钟信号，并基于所述高速串行计算机扩展总线向所述高速光通信连接器发送所述负时钟信号和所述正时钟信号。
8.根据权利要求6或7任一项所述的高速光通信连接器，其特征在于，所述非易失性存储器标准设备为，设置有支持非易失性存储器标准的固态硬盘的其他存储服务器。
9.根据权利要求6或7任一项所述的高速光通信连接器，其特征在于，所述非易失性存储器标准设备为，支持所述非易失性存储器标准且支持热插拔功能的移动固态硬盘。
10.一种服务器，其特征在于，所述服务器配置有高速光通信连接器，所述高速光通信连接器用于使所述服务器和光模块设备连接，或，用于使所述服务器和非易失性存储器标准设备连接；所述服务器用于生成模块低速信号和光模块复位信号，或用于生成负时钟信号和正时钟信号，所述高速光通信连接器包括：
针对所述模块低速信号或所述负时钟信号的第一信号引脚；
针对所述光模块复位信号或所述正时钟信号的第二信号引脚；
所述第一信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述模块低速信号传输至所述光模块设备；
所述第一信号引脚用于当所述服务器和所述非易失性存储器标准设备时，将由所述服务器发送的所述负时钟信号传输至所述非易失性存储器标准设备；
所述第二信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述光模块复位信号传输至所述光模块设备；
所述第二信号引脚用于当所述服务器和所述非易失性存储器标准设备时，将由所述服务器发送的所述正时钟信号传输至所述非易失性存储器标准设备；
所述服务器用于生成线偏振模式信号或对端设备复位信号，所述高速光通信连接器包括：
针对所述线偏振模式信号或所述对端设备复位信号的第六信号引脚；
所述第六信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述线偏振模式信号传输至所述光模块设备；
所述第六信号引脚用于当所述服务器和所述非易失性存储器标准设备时，将由所述服务器发送的所述对端设备复位信号传输至所述非易失性存储器标准设备。
11.根据权利要求10所述的服务器，其特征在于，所述服务器设置有现场可编辑门阵列，所述现场可编辑门阵列用于接收由所述光模块设备或所述非易失性存储器标准设备生成的在位检测输入信号，并当接收到所述在位检测输入信号，基于所述在位检测输入信号构建所述服务器和所述光模块设备的连接关系，或，基于所述在位检测输入信号构建所述服务器和所述非易失性存储器标准设备的连接关系。
12.根据权利要求10所述的服务器，其特征在于，所述高速光通信连接器包括：
提供信号接收电源电压的第三信号引脚；
提供信号发送电源电压的第四信号引脚；
提供低速信号电源电压的第五信号引脚。
13.根据权利要求10所述的服务器，其特征在于，所述服务器用于生成终端告警信号或唤醒信号，所述高速光通信连接器包括：
针对所述终端告警信号或所述唤醒信号的第七信号引脚；
所述第七信号引脚用于当所述服务器和所述光模块设备连接时，将由所述服务器发送的所述终端告警信号传输至所述光模块设备；
所述第七信号引脚用于当所述服务器和所述非易失性存储器标准设备时，将由所述服务器发送的所述唤醒信号传输至所述非易失性存储器标准设备。
14.根据权利要求11所述的服务器，其特征在于，所述高速光通信连接器包括：
针对所述在位检测输入信号的第八信号引脚；
所述第八信号引脚用于向所述服务器传输所述在位检测输入信号。
15.根据权利要求14所述的服务器，其特征在于，所述服务器包括时钟模块，以及基板管理控制器；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器连接，所述高速光通信连接器通过高速串行计算机扩展总线与所述现场可编辑门阵列连接，所述基板管理控制器与所述现场可编辑门阵列连接；
所述时钟模块用于生成所述负时钟信号和所述正时钟信号，并基于所述高速串行计算机扩展总线向所述高速光通信连接器发送所述负时钟信号和所述正时钟信号。
16.根据权利要求10所述的服务器，其特征在于，所述服务器包括时钟模块、基板管理控制器以及中央处理器；所述时钟模块通过高速串行计算机扩展总线与所述高速光通信连接器连接，所述中央处理器与所述高速光通信连接器通过高速串行计算机扩展总线连接，所述基板管理控制器与所述高速光通信连接器连接；
所述时钟模块用于生成所述负时钟信号和所述正时钟信号，并基于所述高速串行计算机扩展总线向所述高速光通信连接器发送所述负时钟信号和所述正时钟信号。
17.根据权利要求15或16任一项所述的服务器，其特征在于，所述非易失性存储器标准设备为，设置有支持非易失性存储器标准的固态硬盘的其他存储服务器。
18.根据权利要求15或16任一项所述的服务器，其特征在于，所述非易失性存储器标准设备为，支持所述非易失性存储器标准且支持热插拔功能的移动固态硬盘。
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