CN116486742A - 一种显示面板及其驱动方法、显示装置 - Google Patents

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Abstract

本申请实施例提供一种显示面板及其驱动方法、显示装置，显示面板包括多行像素电路；像素电路中，驱动晶体管用于产生发光驱动电流，数据写入模块的输入端与数据信号线电连接、输出端与驱动晶体管的第一极电连接，阈值抓取模块的输入端与驱动晶体管的第二极电连接、输出端与驱动晶体管的栅极电连接；存储电容的第一极板与驱动晶体管的栅极电连接、第二极板与电源电压信号线电连接；数据稳定开关的第一端与驱动晶体管的第一极电连接；其中，第n行中像素电路的数据稳定开关的第二端与第n+j行中像素电路的存储电容的第一极板电连接，n≥1，j≥2。本申请可以提高显示面板高频显示时的充电时间，提升显示面板高频显示时的低灰阶品味。

Description

一种显示面板及其驱动方法、显示装置
【技术领域】
本申请涉及显示技术领域，尤其是涉及一种显示面板及其驱动方法、显示装置。
【背景技术】
有机发光二极管(organic light-emitting diode，OLED)显示面板具有功耗低、自发光、宽视角、宽温度特性及响应速度快等优点，在市场上具有广泛的应用。其中，用于控制发光元件发光的像素电路是OLED显示面板的核心技术内容，具有重要的研究意义。
在像素电路向发光元件提供发光驱动电流之前，通常需要对像素电路中驱动晶体管的栅极进行充电，但在现有的像素电路中，当显示面板高频显示时，驱动晶体管栅极的充电时长较小，导致显示面板低灰阶显示时的亮度均一性较差，影响显示品质。
【申请内容】
有鉴于此，本申请实施例提供了一种显示面板及其驱动方法、显示装置，以解决上述问题。
第一方面，本申请实施例提供一种显示面板，包括多行像素电路；像素电路包括驱动晶体管、数据写入模块、阈值抓取模块、存储电容和数据稳定开关；驱动晶体管用于产生发光驱动电流，数据写入模块的输入端与数据信号线电连接、输出端与驱动晶体管的第一极电连接，阈值抓取模块的输入端与驱动晶体管的第二极电连接、输出端与驱动晶体管的栅极电连接；存储电容包括第一极板和第二极板，第一极板与驱动晶体管的栅极电连接，第二极板与电源电压信号线电连接；数据稳定开关的第一端与驱动晶体管的第一极电连接，数据稳定开关用于稳定驱动晶体管的第一极电位；其中，第n行中像素电路的数据稳定开关的第二端与第n+j行中像素电路的存储电容的第一极板电连接，n≥1，j≥2。
在第一方面的一种实现方式中，像素电路的一个工作周期包括依次进行的复位阶段和数据写入阶段；在复位阶段，数据写入模块和数据稳定开关开启，数据写入模块向驱动晶体管的第一极传输数据电压；在数据写入阶段，数据稳定开关和阈值抓取模块开启。
在第一方面的一种实现方式中，像素电路还包括第一复位模块，第一复位模块的输入端与第一复位信号线电连接、输出端与驱动晶体管的栅极电连接、控制端与第一扫描线电连接；在复位阶段，第一复位模块开启。
在第一方面的一种实现方式中，数据写入模块的控制端与第一扫描线电连接，第一扫描线传输的信号控制数据写入模块与第一复位模块的开关状态相同。
在第一方面的一种实现方式中，数据写入模块包括第一晶体管，第一晶体管的第一极与数据信号线电连接、第二极与驱动晶体管的第一极电连接、栅极与第一扫描线电连接；第一复位模块包括第二晶体管，第二晶体管的第一极与第一复位信号线电连接、第二极与驱动晶体管的栅极电连接、栅极与第一扫描线电连接；其中，第一晶体管与第二晶体管的沟道类型相同。
在第一方面的一种实现方式中，显示面板包括发光元件，像素电路还包括第二复位模块，第二复位模块的输入端与第二复位信号线电连接、输出端与发光元件的第一极电连接、控制端与第二扫描线电连接；数据稳定开关的控制端与第二扫描线电连接，第二扫描线传输的信号控制数据稳定开关和第二复位模块的开关状态相同。
在第一方面的一种实现方式中，数据稳定开关包括第三晶体管，第三晶体管的第一极与数据稳定开关的第一端电连接、第二极与数据稳定开关的第二端电连接、栅极与数据稳定开关的控制端电连接；第二复位模块包括第四晶体管，第四晶体管的第一极与第二复位模块的输入端电连接、第二极与第二复位模块的输出端电连接、栅极与第二复位模块的控制端电连接；其中，第三晶体管和第四晶体管的沟道类型相同
在第一方面的一种实现方式中，阈值抓取模块包括第五晶体管，第五晶体管的第一极与阈值抓取模块的输入端电连接、第二极与阈值抓取模块的输出端电连接、栅极与第三扫描线电连接。
在第一方面的一种实现方式中，在数据写入阶段，阈值抓取模块关闭的时刻不晚于数据稳定开关关闭的时刻。
第二方面，本申请实施例提供一种显示面板的驱动方法，用于驱动如第一方面提供的显示面板，显示面板中的像素电路的一个工作周期包括依次进行的复位阶段和数据写入阶段；驱动方法包括：
在复位阶段，数据写入模块和数据稳定开关开启，数据写入模块向驱动晶体管的第一极传输数据电压；
在数据写入阶段，数据稳定开关和阈值抓取模块开启。
在第二方面的一种实现方式中，像素电路还包括第一复位模块，第一复位模块的输入端与第一复位信号线电连接、输出端与驱动晶体管的栅极电连接、控制端与第一扫描线电连接；驱动方法还包括：
在复位阶段，第一复位模块开启。
第三方面，本申请实施例提供一种显示装置，包括如第一方面提供的显示面板。
本申请实施例中，在像素电路中设置数据稳定开关与驱动晶体管的第一极、存储电容电连接，则可以利用存储电容的稳压作用稳定驱动晶体管第一极的电位，从而可以先将数据信号线上的数据电压存储至驱动晶体管的第一极，然后再开启阈值抓取模块将数据电压和驱动晶体管的阈值电压传输至驱动晶体管的栅极。
当数据电压存储在驱动晶体管的第一极之后，阈值抓取模块在开启之前则无需考虑预留前置时间，并且在关断之后也无需考虑预留后置时间，从而有利于提高阈值抓取模块开启的时长，即有利于提高驱动晶体管栅极的充电时长，进而有利于改善显示面板在低灰阶显示时容易出现的残影以及亮度均一性较差的问题，提高显示品质。
而且，设置第n行中像素电路的数据稳定开关与第n+j行中像素电路的存储电容Cst电连接，n≥1，j≥2。则在可以避免第n行中像素电路与第n+j行中像素电路的工作过程相互影响的情况下，无需在显示面板中额外设置稳压电容，有利于降低显示面板的制备成本。
【附图说明】
为了更清楚地说明本申请实施例的技术方案，下面将对实施例中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其它的附图。
图1为本申请实施例提供的一种显示面板的示意图；
图2为图1中像素电路的一种原理图；
图3为图2所示像素电路的一种示意图；
图4为图3所示像素电路的一种时序图；
图5为图3所示像素电路的又一种时序图；
图6为本申请相关的一种相邻三行像素电路的时序图；
图7为本申请实施例提供的又一种像素电路的示意图；
图8为图7所示像素电路的一种时序图；
图9为本申请实施例提供的一种显示面板的驱动方法流程图；
图10为本申请实施例提供的一种显示装置的示意图。
【具体实施方式】
为了更好的理解本申请的技术方案，下面结合附图对本申请实施例进行详细描述。
应当明确，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其它实施例，都属于本申请保护的范围。
在本申请实施例中使用的术语是仅仅出于描述特定实施例的目的，而非旨在限制本申请。在本申请实施例和所附权利要求书中所使用的单数形式的“一种”、“所述”和“该”也旨在包括多数形式，除非上下文清楚地表示其他含义。
应当理解，本文中使用的术语“和/或”仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况。另外，本文中字符“/”，一般表示前后关联对象是一种“或”的关系。
本说明书的描述中，需要理解的是，本申请权利要求及实施例所描述的“基本上”、“近似”、“大约”、“约”、“大致”“大体上”等词语，是指在合理的工艺操作范围内或者公差范围内，可以大体上认同的，而不是一个精确值。
应当理解，尽管在本申请实施例中可能采用术语第一、第二等来描述方向、晶体管、扫描线等，但这些方向、晶体管、扫描线等不应限于这些术语。这些术语仅用来将方向、晶体管、扫描线等彼此区分开。例如，在不脱离本申请实施例范围的情况下，第一方向也可以被称为第二方向，类似地，第二方向也可以被称为第一方向。
本案申请人通过细致深入研究，对于现有技术中所存在的问题，而提供了一种解决方案。
图1为本申请实施例提供的一种显示面板的示意图，图2为图1中像素电路的一种原理图，图3为图2所示像素电路的一种示意图。
本申请实施例提供一种显示面板01，如图1所示，包括多行像素电路10和多个发光元件20，像素电路10用于为发光元件20提供发光驱动电流。显示面板01还包括多条沿第一方向X排布的数据信号线DL1，数据信号线DL1沿第二方向Y延伸，至少部分沿第二方向Y排布的像素电路10与同一数据信号线DL1电连接。第一方向X可以是显示面板01中的行方向，第二方向Y可以是显示面板01中的列方向。
如图2和图3所示，像素电路10包括驱动晶体管Md、数据写入模块101、阈值抓取模块102、存储电容Cst和数据稳定开关103。
驱动晶体管Md用于产生发光驱动电流；数据写入模块101的输入端1011与数据信号线DL1电连接、输出端1012与驱动晶体管Md的第一极电连接，数据写入模块101可用于向驱动晶体管Md的第一极传输数据电压Vdata；阈值抓取模块102的输入端1021与驱动晶体管Md的第二极电连接、输出端1022与驱动晶体管Md的栅极电连接，阈值抓取模块102可用于抓取驱动晶体管Md的阈值电压Vth，驱动晶体管Md的第一极可以为其源极、第二极可以为其漏极；数据稳定开关103的第一端1031与驱动晶体管Md的第一极电连接，数据稳定开关103用于稳定驱动晶体管Md的第一极电位。
存储电容Cst包括第一极板C1和第二极板C2，第一极板C1与驱动晶体管Md的栅极电连接，第二极板C2与电源电压信号线DY1电连接，存储电容Cst可以稳定驱动晶体管Md的栅极电位。
其中，第n行中像素电路10的数据稳定开关103的第二端1032与第n+j行中像素电路10的存储电容Cst的第一极板C1电连接，n≥1,j≥2。
也就是说，第n+j行中像素电路10的存储电容Cst除了可以稳定该行像素电路10中驱动晶体管Md的栅极电位之外，还可以通过第n行中像素电路10的数据稳定开关103稳定第n行像素电路10中驱动晶体管Md的第一极电位。
在传统的像素电路中，通常设置数据写入模块101与阈值抓取模块102开启的时段相同，以便将数据电压Vdata和阈值电压Vth写入驱动晶体管Md的栅极，对驱动晶体管Md的栅极进行充电。但在显示面板进行高频显示时，数据写入模块101与阈值抓取模块102开启的时长会受到压缩，导致驱动晶体管Md栅极的充电时间减小，驱动晶体管Md的栅极电位达不到预设值，从而导致显示面板在低灰阶显示时容易出现残影及亮度均一性较差的问题。
本申请发明人经过研究发现，传统像素电路中，在数据信号线DL1向数据写入模块101传输数据电压Vdata的过程中，为了保证该数据写入模块101接收到准确的数据电压Vdata，并将其传输至驱动晶体管Md，通常会在数据写入模块101开启之前预留一定的前置时间，以便数据信号线DL1上的数据电压Vdata从上一阶段的电压值变为本阶段所需的电压值。而且，为了保证数据写入模块101由开启状态变为关闭状态的过程中不会向驱动晶体管Md传输下一阶段的数据电压Vdata，通常还会在数据写入模块101关闭之后预留一定的后置时间，在数据写入模块101关闭之后，数据信号线DL1上的数据电压Vdata才从本阶段所需的电压值向下一阶段所需的电压值转变。那么，在显示面板高频显示时，减小上述的前置时间或后置时间以增加驱动晶体管Md栅极的充电时间便成了一种解决方案。
本申请实施例中，在像素电路10中设置数据稳定开关103与驱动晶体管Md的第一极、存储电容Cst电连接，则可以利用存储电容Cst的稳压作用稳定驱动晶体管Md第一极的电位，从而可以先将数据信号线DL1上的数据电压Vdata存储至驱动晶体管Md的第一极，然后再开启阈值抓取模块102将数据电压Vdata和阈值电压Vth传输至驱动晶体管Md的栅极。
当数据电压Vdata存储在驱动晶体管Md的第一极之后，阈值抓取模块102在开启之前则无需考虑预留前置时间，并且在关断之后也无需考虑预留后置时间，从而有利于提高阈值抓取模块102开启的时长，即有利于提高驱动晶体管Md栅极的充电时长，进而有利于改善显示面板01在低灰阶显示时容易出现的残影以及亮度均一性较差的问题，提高显示品质。
而且，设置第n行中像素电路10的数据稳定开关103与第n+j行中像素电路10的存储电容Cst电连接，n≥1，j≥2。则在可以避免第n行中像素电路10与第n+j行中像素电路10的工作过程相互影响的情况下，无需在显示面板01中额外设置稳压电容，有利于降低显示面板01的制备成本。
图4为图3所示像素电路的一种时序图。
在本申请的一个实施例中，结合图3和图4所示，像素电路10的一个工作周期Z包括依次进行的复位阶段E1和数据写入阶段E2，数据写入阶段E2在复位阶段E1之后进行。
在复位阶段E1，数据写入模块101和数据稳定开关103开启，数据写入模块101向驱动晶体管Md的第一极传输数据电压Vdata。同时，驱动晶体管Md的第一极通过数据稳定开关103与存储电容Cst电连接，驱动晶体管Md的第一极电位可以维持在数据电压Vdata。
在数据写入阶段E2，数据稳定开关103和阈值抓取模块102开启。存储在驱动晶体管Md第一极的数据电压Vdata可以通过驱动晶体管Md、阈值抓取模块102传输至驱动晶体管Md的栅极，完成对驱动晶体管Md栅极的充电。
同时，驱动晶体管Md的第一极继续通过数据稳定开关103与存储电容Cst电连接，驱动晶体管Md的第一极电位可以维持在数据电压Vdata，以保证传输至驱动晶体管Md栅极的数据电压Vdata的准确性。
进一步地，请继续结合图3和图4，像素电路10还包括第一复位模块104，第一复位模块104的输入端1041与第一复位信号线SL1电连接、输出端1042与驱动晶体管Md的栅极电连接、控制端1043与第一扫描线SP1电连接。
在复位阶段E1，第一复位模块104开启。
具体地，在复位阶段E1，第一扫描线SP1传输有效信号控制第一复位模块104开启，第一复位信号线SL1传输第一复位电压Vref1，第一复位电压Vref1通过开启的第一复位模块104传输至驱动晶体管Md的栅极，完成对驱动晶体管Md栅极的复位。
本申请实施例中，在复位阶段E1，既设置第一复位模块104向驱动晶体管Md的栅极传输第一复位电压Vref1；同时，又设置数据写入模块101将数据电压Vdata传输至驱动晶体管Md的第一极，并通过数据稳定开关103将驱动晶体管Md的第一极与存储电容Cst电连接，利用存储电容Cst的稳压作用将驱动晶体管Md的第一极电位维持在数据电压Vdata。有利于减小像素电路10的一个工作周期Z的时长，进而有利于实现显示面板01的高频显示。
请参考图2和图3，在本申请的一个实施例中，数据写入模块101的控制端1013与第一扫描线SP1电连接，第一扫描线SP1传输的信号控制数据写入模块101与第一复位模块104的开关状态相同。
可选地，如图3所示，数据写入模块101包括第一晶体管M1，第一晶体管M1的第一极与数据信号线DL1电连接、第二极与驱动晶体管Md的第一极电连接、栅极与第一扫描线SP1电连接。第一复位模块104包括第二晶体管M2，第二晶体管M2的第一极与第一复位信号线SL1电连接、第二极与驱动晶体管Md的栅极电连接、栅极与第一扫描线SP1电连接。
其中，第一晶体管M1与第二晶体管M2的沟道类型相同。
本申请实施例中，第一复位模块104和数据写入模块101均与第一扫描线SP1电连接，有利于减小像素电路10所电连接的扫描线的数量，从而有利于降低为像素电路10提供扫描信号的外围驱动电路的数量，进而有利于降低显示面板01的制备成本。
在本申请的一个实施例中，结合图1-图3所示，显示面板01包括发光元件20，像素电路10还包括第二复位模块105，第二复位模块105的输入端1051与第二复位信号线SL2电连接、输出端1052与发光元件20的第一极电连接、控制端1053与第二扫描线SP2电连接，第二复位模块105用于将第二复位信号线SL2上的第二复位电压Vref2传输至发光元件20的第一极，对发光元件20的第一极进行复位。
数据稳定开关103的控制端1033与第二扫描线SP2电连接，第二扫描线SP2传输的信号控制数据稳定开关103和第二复位模块105的开关状态相同。
也就是说，在复位阶段E1和数据写入阶段E2，数据稳定开关103开启的同时，第二复位模块105也开启，第二复位信号线SL2上的第二复位电压Vref2可以通过第二复位模块105传输至发光元件20的第一极，完成对发光元件20第一极的复位。
可选地，如图3所示，数据稳定开关103包括第三晶体管M3，第三晶体管M3的第一极与数据稳定开关103的第一端1031电连接、第二极与数据稳定开关103的第二端1032电连接、栅极与数据稳定开关103的控制端1033电连接。即第n行中像素电路10的第三晶体管M3的第一极与该像素电路10中驱动晶体管Md的第一极电连接、第二极与第n+j行中像素电路10的存储电容Cst的第一极板C1电连接、栅极与第二扫描线SP2电连接。
第二复位模块105包括第四晶体管M4，第四晶体管M4的第一极与第二复位模块105的输入端1051电连接、第二极与第二复位模块105的输出端1052电连接、栅极与第二复位模块105的控制端1053电连接。即第四晶体管M4的第一极与第二复位信号线SL2电连接、第二极与发光元件20的第一极电连接、栅极与第二扫描线SP2电连接。
其中，第三晶体管M3与第四晶体管M4的沟道类型相同。
本申请实施例中，数据稳定开关103和第二复位模块105均与第二扫描线SP2电连接，有利于进一步减小像素电路10所电连接的扫描线的数量，从而有利于进一步降低为像素电路10提供扫描信号的外围驱动电路的数量，进而有利于进一步降低显示面板01的制备成本。
请继续参考图2和图3，在本申请的一个实施例中，阈值抓取模块102的控制端1023与第三扫描线SP3电连接，在数据写入阶段E2，第三扫描线SP3传输有效信号控制阈值抓取模块102开启，对驱动晶体管Md的栅极进行充电。
如图3所示，阈值抓取模块102包括第五晶体管M5，第五晶体管M5的第一极与阈值抓取模块102的输入端1021电连接、第二极与阈值抓取模块102的输出端1022电连接、栅极与第三扫描线SP3电连接。即阈值抓取模块102可以仅包括一个第五晶体管M5，第五晶体管M5的第一极与驱动晶体管Md的第二极电连接、第二极与驱动晶体管Md的栅极电连接。
此外，结合图2和图3所示，像素电路10还包括电源电压写入模块106和发光控制模块107，电源电压写入模块106的输入端1061与电源电压信号线DY1电连接、输出端1062与驱动晶体管Md的第一极电连接、控制端1063与发光控制信号线EM电连接。发光控制模块107的输入端1071与驱动晶体管Md的第二极电连接、输出端1072与发光元件20的第一极电连接、控制端1073与发光控制信号线EM电连接。
电源电压写入模块106可以包括第六晶体管M6，第六晶体管M6的第一极与电源电压信号线DY1电连接、第二极与驱动晶体管Md的第一极电连接、栅极与发光控制信号线EM电连接。发光控制模块107可以包括第七晶体管M7，第七晶体管M7的第一极与驱动晶体管Md的第二极电连接、第二极与发光元件20的第一极电连接、栅极与发光控制信号线EM电连接。
为了将本申请技术方案阐述的更加清楚，下面结合图3和图4对图3所示像素电路10的工作过程进行说明。
需要说明的是，以下以第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6和第七晶体管M7为P型晶体管为例进行说明。当然，第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6和第七晶体管M7中的任意一者也可以为N型晶体管。
像素电路10的一个工作周期Z包括依次进行的复位阶段E1、数据写入阶段E2和发光阶段E3。
在复位阶段E1，第一扫描线SP1和第二扫描线SP2传输低电平开启信号，第一晶体管M1、第二晶体管M2、第三晶体管M3和第四晶体管M4开启；第三扫描线SP3和发光控制信号线EM传输高电平关闭信号，第五晶体管M5、第六晶体管M6和第七晶体管M7关闭。同时，第一复位信号线SL1传输第一复位电压Vref1，第一复位电压Vref1通过开启的第二晶体管M2传输至驱动晶体管Md的栅极，完成对驱动晶体管Md栅极的复位；数据信号线DL1传输数据电压Vdata，数据电压Vdata通过开启的第一晶体管M1传输至驱动晶体管M1的第一极，驱动晶体管Md的第一极通过开启的第三晶体管M3与存储电容Cst电连接，数据电压Vdata可以存储在驱动晶体管Md的第一极。
同时，第二复位信号线SL2传输第二复位电压Vref2，第二复位电压Vref2通过开启的第四晶体管M4传输至发光元件20的第一极，完成对发光元件20的复位。可选地，发光元件20包括有机发光二极管，第二复位电压Vref2通过开启的第四晶体管M4对有机发光二极管的阳极进行复位。
在数据写入阶段E2，第一扫描线SP1和发光控制信号线EM传输高电平关闭信号，第一晶体管M1、第二晶体管M2、第六晶体管M6和第七晶体管M7关闭；第二扫描线SP2和第三扫描线SP3传输低电平开启信号，第三晶体管M3、第四晶体管M4和第五晶体管M5开启。在数据写入阶段E2的起始点，驱动晶体管Md的栅极电位为第一复位电压Vref1，驱动晶体管Md的第一极电位为数据电压Vdata，驱动晶体管Md的第一极与栅极之间的电位差为(Vdata-Vref1)，两者的电位差大于0，因此，驱动晶体管Md开启，数据电压Vdata通过开启的驱动晶体管Md和第五晶体管M5传输至驱动晶体管Md的栅极；同时，驱动晶体管Md的阈值电压Vth通过开启的第五晶体管M5传输至驱动晶体管Md的栅极，对驱动晶体管Md的栅极进行充电。当驱动晶体管Md的栅极电位等于(Vdata-∣Vth∣)时，驱动晶体管Md关闭。
而且，驱动晶体管Md的第一极继续通过开启的第三晶体管M3与存储电容Cst电连接，以保证驱动晶体管Md第一极电位的稳定性。
同时，第二复位信号线SL2传输的第二复位电压Vref2可以继续通过开启的第四晶体管M4传输至发光元件20的第一极，对发光元件20进行复位。
在发光阶段E3，第一扫描线SP1、第二扫描线SP2和第三扫描线SP3传输高电平关闭信号，第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4和第五晶体管M5关闭；发光控制信号线EM传输低电平开启信号，第六晶体管M6和第七晶体管M7开启。同时，电源电压信号线DY1传输电源电压VDD，即驱动晶体管Md的第一极电位为电源电压VDD。由于电源电压VDD的电位大于数据电压Vdata的电位，则驱动晶体管Md产生发光驱动电流并通过第七晶体管M7传输至发光元件20，控制发光元件20发光。
其中，为了保证像素电路10所接收数据电压Vdata的准确性，在第一扫描线SP1传输有效信号控制第一晶体管M1开启的时段之前预留了前置时间，并且在第一晶体管M1开启的时段之后预留了后置时间。而第五晶体管M5开启的时段无需考虑预留前置时间和后置时间，从而可以设置第五晶体管M5开启的时长大于第一晶体管M1开启的时长，以增加驱动晶体管Md栅极的充电时间。
图5为图3所示像素电路的又一种时序图。
在本申请的一个实施例中，在数据写入阶段E2，阈值抓取模块102关闭的时刻不晚于数据稳定开关103关闭的时刻。
也就是说，在数据写入阶段E2，阈值抓取模块102开启的时段位于数据稳定开关103开启的时段内。
可选地，结合图3和图4所示，在数据写入阶段E2，阈值抓取模块102关闭的时刻与数据稳定开关103关闭的时刻相同。
可选地，结合图3和图5所示，在数据写入阶段E2，阈值抓取模块102关闭的时刻早于数据稳定开关103关闭的时刻。
本申请实施例中，在阈值抓取模块102开启的时段，驱动晶体管Md的第一极通过数据稳定开关103与存储电容Cst电连接，可以保证驱动晶体管Md第一极电位为数据电压Vdata的稳定性，有利于保证阈值抓取模块102向驱动晶体管Md的栅极传输的数据电压Vdata的准确性。
图6为本申请相关的一种相邻三行像素电路的时序图。
本申请实施例中，设置第n行中像素电路10的数据稳定开关103的第二端1032与第n+j行中像素电路10的存储电容Cst的第一极板C1电连接，n≥1,j≥2。则在利用第n+j行中像素电路10的存储电容Cst稳定第n行中像素电路10的驱动晶体管Md第一极电位的同时，可以避免第n行中像素电路10的工作过程与第n+j行中像素电路10的工作过程相互影响。
例如，如图6所示，当j＝2时，第n+2行像素电路10开始执行复位阶段E1时，第n行像素电路10已完成复位阶段E1和数据写入阶段E2，第n行像素电路10中的数据稳定开关103已关闭，从而可以避免第n行中像素电路10的工作过程与第n+2行中像素电路10的工作过程相互影响。
图7为本申请实施例提供的又一种像素电路的示意图，图8为图7所示像素电路的一种时序图。
图7所示像素电路10与图3所示像素电路10的区别在于：第二晶体管M2和第五晶体管M5为包括金属氧化物有源层的N型晶体管，第二晶体管M2的栅极与第四扫描线SP4电连接。
相较于图4所示的时序，图8所示的时序变化在于：第四扫描线SP4传输高电平信号控制第二晶体管M2开启，传输低电平信号控制第二晶体管M2关闭。第三扫描线SP3传输的开启信号为高电平信号，关闭信号为低电平信号。
在图7所示的像素电路10中，第二晶体管M2和第五晶体管M5可以均包括氧化铟镓锌(indium gallium zinc oxide，IGZO)有源层。由于氧化物半导体晶体管的关态漏电流低，则可以减小通过第二晶体管M2或第五晶体管M5的漏电流对驱动晶体管Md栅极电位的影响，有利于保持驱动晶体管Md栅极电位的稳定性，从而有利于提高像素电路10产生发光驱动电流的稳定性。
图9为本申请实施例提供的一种显示面板的驱动方法流程图。
本申请实施例还提供一种显示面板01的驱动方法，用于驱动如上述实施例提供的显示面板01。显示面板01的结构可以如图1所示，其所包括的像素电路10的结构可以如图2、图3、图7所示。对于驱动方法可以结合上述像素电路10的工作过程加以理解。
显示面板01中像素电路10的一个工作周期Z包括依次进行的复位阶段E1和数据写入阶段E2，如图9所示，驱动方法包括：
步骤B1：在复位阶段E1，数据写入模块101和数据稳定开关103开启，数据写入模块101向驱动晶体管Md的第一极传输数据电压Vdata。
步骤B2：在数据写入阶段E2，数据稳定开关103和阈值抓取模块102开启。
在本申请实施例提供的驱动方法中，先将数据信号线DL1上的数据电压Vdata存储至驱动晶体管Md的第一极，并通过数据稳定开关103将驱动晶体管Md的第一极与存储电容Cst电连接，利用存储电容Cst的稳压作用将驱动晶体管Md的第一极电位维持在数据电压Vdata，然后再开启阈值抓取模块102将数据电压Vdata和阈值电压Vth传输至驱动晶体管Md的栅极。
当数据电压Vdata存储在驱动晶体管Md的第一极之后，阈值抓取模块102在开启之前则无需考虑预留前置时间，并且在关断之后也无需考虑预留后置时间，从而有利于提高阈值抓取模块102开启的时长，即有利于提高驱动晶体管Md栅极的充电时长，进而有利于改善显示面板01在低灰阶显示时容易出现的残影以及亮度均一性较差的问题，提高显示品质。
而且，设置第n行中像素电路10的数据稳定开关103与第n+j行中像素电路10的存储电容Cst电连接，n≥1，j≥2。则在可以避免第n行中像素电路10与第n+j行中像素电路10的工作过程相互影响的情况下，无需在显示面板01中额外设置稳压电容，有利于降低显示面板01的制备成本。
在本申请的一个实施例中，如图2、图3、图7所示，像素电路10还包括第一复位模块104，第一复位模块104的输入端1041与第一复位信号线SL1电连接、输出端1042与驱动晶体管Md的栅极电连接、控制端1043与第一扫描线SP1电连接。请继续参考图9，驱动方法的步骤B1中还包括：
在复位阶段E1，第一复位模块104开启。
具体地，在复位阶段E1，第一扫描线SP1传输有效信号控制第一复位模块104开启，第一复位信号线SL1传输第一复位电压Vref1，第一复位电压Vref1通过开启的第一复位模块104传输至驱动晶体管Md的栅极，完成对驱动晶体管Md栅极的复位。
本申请实施例中，在复位阶段E1，既设置第一复位模块104向驱动晶体管Md的栅极传输第一复位电压Vref1；同时，又设置数据写入模块101将数据电压Vdata传输至驱动晶体管Md的第一极，并通过数据稳定开关103将驱动晶体管Md的第一极与存储电容Cst电连接，利用存储电容Cst的稳压作用将驱动晶体管Md的第一极电位维持在数据电压Vdata。有利于减小像素电路10的一个工作周期Z的时长，进而有利于实现显示面板01的高频显示。
图10为本申请实施例提供的一种显示装置的示意图。
本申请实施例还提供一种显示装置02，如图10所示，显示装置02包括如上述实施例提供的显示面板01。示例性地，显示装置02可以是手机、电脑、电视、可穿戴电子装置等电子设备，本申请不做具体限定。
显示装置02中，在像素电路10中设置数据稳定开关103与驱动晶体管Md的第一极、存储电容Cst电连接，则可以利用存储电容Cst的稳压作用稳定驱动晶体管Md第一极的电位，从而可以先将数据信号线DL1上的数据电压Vdata存储至驱动晶体管Md的第一极，然后再开启阈值抓取模块102将数据电压Vdata和阈值电压Vth传输至驱动晶体管Md的栅极。
当数据电压Vdata存储在驱动晶体管Md的第一极之后，阈值抓取模块102在开启之前则无需考虑预留前置时间，并且在关断之后也无需考虑预留后置时间，从而有利于提高阈值抓取模块102开启的时长，即有利于提高驱动晶体管Md栅极的充电时长，进而有利于改善显示装置02在低灰阶显示时容易出现的残影以及亮度均一性较差的问题，提高显示品质。
而且，设置第n行中像素电路10的数据稳定开关103与第n+j行中像素电路10的存储电容Cst电连接，n≥1，j≥2。则在可以避免第n行中像素电路10与第n+j行中像素电路10的工作过程相互影响的情况下，无需在显示装置02中额外设置稳压电容，有利于降低显示装置02的制备成本。
以上所述仅为本申请的较佳实施例而已，并不用以限制本申请，凡在本申请的精神和原则之内，所做的任何修改、等同替换、改进等，均应包含在本申请保护的范围之内。

Claims (12)

1.一种显示面板，其特征在于，包括多行像素电路，所述像素电路包括：
驱动晶体管，用于产生发光驱动电流；
数据写入模块，所述数据写入模块的输入端与数据信号线电连接、输出端与所述驱动晶体管的第一极电连接；
阈值抓取模块，所述阈值抓取模块的输入端与所述驱动晶体管的第二极电连接、输出端与所述驱动晶体管的栅极电连接；
存储电容，包括第一极板和第二极板，所述第一极板与所述驱动晶体管的栅极电连接，所述第二极板与电源电压信号线电连接；
数据稳定开关，所述数据稳定开关的第一端与所述驱动晶体管的第一极电连接，所述数据稳定开关用于稳定所述驱动晶体管的第一极电位；
其中，第n行中所述像素电路的数据稳定开关的第二端与第n+j行中所述像素电路的存储电容的第一极板电连接，n≥1，j≥2。
2.根据权利要求1所述的显示面板，其特征在于，所述像素电路的一个工作周期包括依次进行的复位阶段和数据写入阶段；
在所述复位阶段，所述数据写入模块和所述数据稳定开关开启，所述数据写入模块向所述驱动晶体管的第一极传输数据电压；
在所述数据写入阶段，所述数据稳定开关和所述阈值抓取模块开启。
3.根据权利要求2所述的显示面板，其特征在于，所述像素电路还包括第一复位模块，所述第一复位模块的输入端与第一复位信号线电连接、输出端与所述驱动晶体管的栅极电连接、控制端与第一扫描线电连接；
在所述复位阶段，所述第一复位模块开启。
4.根据权利要求3所述的显示面板，其特征在于，所述数据写入模块的控制端与所述第一扫描线电连接，所述第一扫描线传输的信号控制所述数据写入模块与所述第一复位模块的开关状态相同。
5.根据权利要求4所述的显示面板，其特征在于，所述数据写入模块包括第一晶体管，所述第一晶体管的第一极与所述数据信号线电连接、第二极与所述驱动晶体管的第一极电连接、栅极与所述第一扫描线电连接；
所述第一复位模块包括第二晶体管，所述第二晶体管的第一极与第一复位信号线电连接、第二极与所述驱动晶体管的栅极电连接、栅极与所述第一扫描线电连接；
其中，所述第一晶体管与所述第二晶体管的沟道类型相同。
6.根据权利要求2所述的显示面板，其特征在于，所述显示面板包括发光元件，所述像素电路还包括第二复位模块，所述第二复位模块的输入端与第二复位信号线电连接、输出端与所述发光元件的第一极电连接、控制端与第二扫描线电连接；
所述数据稳定开关的控制端与所述第二扫描线电连接，所述第二扫描线传输的信号控制所述数据稳定开关和所述第二复位模块的开关状态相同。
7.根据权利要求6所述的显示面板，其特征在于，所述数据稳定开关包括第三晶体管，所述第三晶体管的第一极与所述数据稳定开关的第一端电连接、第二极与所述数据稳定开关的第二端电连接、栅极与所述数据稳定开关的控制端电连接；
所述第二复位模块包括第四晶体管，所述第四晶体管的第一极与所述第二复位模块的输入端电连接、第二极与所述第二复位模块的输出端电连接、栅极与所述第二复位模块的控制端电连接；
其中，所述第三晶体管和所述第四晶体管的沟道类型相同。
8.根据权利要求1所述的显示面板，其特征在于，所述阈值抓取模块包括第五晶体管，所述第五晶体管的第一极与所述阈值抓取模块的输入端电连接、第二极与所述阈值抓取模块的输出端电连接、栅极与第三扫描线电连接。
9.根据权利要求2所述的显示面板，其特征在于，在所述数据写入阶段，DD223357I
所述阈值抓取模块关闭的时刻不晚于所述数据稳定开关关闭的时刻。
10.一种显示面板的驱动方法，其特征在于，用于驱动如权利要求1-9任意一项所述的显示面板，所述显示面板中的像素电路的一个工作周期包括依次进行的复位阶段和数据写入阶段；所述驱动方法包括：
在所述复位阶段，所述数据写入模块和所述数据稳定开关开启，所述数据写入模块向所述驱动晶体管的第一极传输数据电压；
在所述数据写入阶段，所述数据稳定开关和所述阈值抓取模块开启。
11.根据权利要求10所述的驱动方法，其特征在于，所述像素电路还包括第一复位模块，所述第一复位模块的输入端与第一复位信号线电连接、输出端与所述驱动晶体管的栅极电连接、控制端与第一扫描线电连接；所述驱动方法还包括：
在所述复位阶段，所述第一复位模块开启。
12.一种显示装置，其特征在于，包括如权利要求1-9任意一项所述的显示面板。
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