CN116486738B - 像素复用方法、数据传输系统以及显示屏控制系统和方法 - Google Patents

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Abstract

像素复用方法、数据传输系统以及显示屏控制系统和方法，涉及像素倍增显示技术领域，解决了传统像素倍增渲染算法下锐利边缘颜色失真的问题。复用方法具体为：将像素倍增排布结构中奇数行中任意两个相邻子像素与相邻偶数行的三个相邻子像素组成的等腰梯形结构作为一个显示单元，使该奇数行的每个子像素被四个显示单元复用，相邻偶数行每个子像素被六个显示单元复用，所有显示单元组成矩阵显示结构；确定各子像素与图像源像素点的映射关系，奇数行中的每个子像素的显示数据为图像源中对应像素点中对应子像素显示数据的不加权平均值；相邻偶数行中的每个子像素的显示数据为图像源中对应像素点中对应子像素显示数据的加权平均值。

Description

像素复用方法、数据传输系统以及显示屏控制系统和方法
技术领域
本发明涉及像素倍增显示技术领域，具体涉及一种像素复用方法、数据传输系统以及显示屏控制系统和方法。
背景技术
像素复用技术是LED显示器的感知分辨率提升技术中的一种重要技术，它将每一个亚像素的灯点被周围的若干个虚拟的像素点所共用，以类似于将原本的视频图像数据做平滑滤波然后降采样的方法，实现在LED显示器上显示出超出显示器物理分辨率的图像，以增大感知分辨率，增强显示效果。
在像素复用的实现过程中，数据处理是必不可少的过程，将原来的数据量减少以实现在同面积的更少灯点的显示模块上显示出相同分辨率的视频源图像。在发送卡的前端实现像素倍增算法的方法，要比在接收卡上实现的方法节省了发送和接收上的带宽，以及发送卡的带载能力和接收卡的数据处理能力，这些都会使得像素倍增技术的实现成本更低。但是，不论是在发送卡前端实现还是在接收卡上实现像素倍增技术，由于像素排布和复用算法（不加权平均），都会导致锐利边缘的颜色失真问题，最严重的就是单像素直线，会直接变色。
例如，中国专利文献《像素倍增显示屏的数据传输系统、控制系统、方法和装置》（公开号为CN115132133A，公开日为2022年9月30日）中公开了采用GB-BR-RG像素排列方式显示屏的像素倍增数据处理步骤，将可重复的像素基元GB-BR-RG分作两个BGR的像素数据，处理前后的像素数据格式没有改变，依然是BGR-888格式的24bit数据，在输出端以实像素的形式输出，让接收卡以实像素的显示方式达到虚拟像素的显示效果，以此节省了接收卡的数据处理能力。但是，由于子像素的分散排列以及对应的复用算法，这种显示屏在显示时会出现锐利边缘颜色失真的问题，严重影响显示效果，尤其是高频信号的竖直边缘。传统的复用算法如图1所示，按像素排列和传统复用规则，例如白色背景下的黑色单像素竖线，会呈现出紫色、黄色或者青色。具体如图2所示， A、B和C分别对应画面显示白色背景下的三条单像素黑色竖线，其中A竖线以绿灯亚像素为中心，由于复用算法的加持，导致本应是0亮度值的绿亚像素两侧的红蓝亚像素此时的亮度值为半白色的亮度值，因此这条本应是黑色的单像素的竖线A显示成了紫色。同理B和C竖线分别显示成了黄色和青色。
综上，采用传统的倍增渲染算法的GB-BR-RG像素排布显示屏，其显示画面中锐利边缘会出现颜色失真的问题，严重影响显示效果。
发明内容
为了解决传统像素倍增渲染算法下GB-BR-RG像素排布显示中锐利边缘颜色失真的问题，本发明提出了一种新的像素复用方法、数据传输系统以及显示屏控制系统和方法。
本发明的技术方案具体如下：
一种基于像素倍增排布的像素复用方法，所述像素倍增排布具体为：同一行相邻两个子像素间隔一个基本单位，同一列的子像素水平方向上相互交错半个基本单位，任意方向相邻的子像素均为不同基色，所述像素复用方法具体为：
将所述像素倍增排布结构中奇数行中任意两个相邻子像素与相邻偶数行的三个相邻子像素组成的等腰梯形结构作为一个显示单元，使得该奇数行中的每个子像素被四个所述显示单元复用，相邻行偶数中的每个子像素被六个所述显示单元复用，所有显示单元组成矩阵显示结构；
确定各子像素与图像源像素点的映射关系，所述奇数行中的每个子像素的显示数据为图像源中对应像素点中对应子像素显示数据的不加权平均值；所述相邻偶数行中的每个子像素的显示数据为图像源中对应像素点中对应子像素显示数据的加权平均值，其中中间列、前一列和后一列像素点中对应子像素显示数据的权数为2:1:1。
本发明还提供了一种像素倍增显示屏的数据传输系统，所述像素倍增显示屏应用上述基于像素倍增排布的像素复用方法，所述数据传输系统包括上位机、HDMI解码芯片、HDMI编码芯片、数据处理模块和发送卡，所述上位机用于将待显示的HDMI视频信号发送至所述HDMI解码芯片；所述HDMI解码芯片用于将所述HDMI视频信号解码，并将解码之后的数据发送至所述数据处理模块；所述数据处理模块包含像素倍增数据处理单元，用于对每帧数据进行像素倍增的数据处理；所述像素倍增数据处理单元内部包含两个FIFO存储器和9个数据寄存器，用于在每一帧数据到来以后对数据进行动态存储和读出，形成数据矩阵，再根据像素倍增数据处理算法对9个寄存器的数据进行计算得到单色像素数据，并将单色像素数据发送至HDMI编码芯片重新编码成HDMI视频信号输出至发送卡。
优选地，所述数据处理模块还包括DDR存储芯片和同步信号生成单元，所述DDR存储芯片用于对处理后的数据进行帧缓存，所述同步信号生成单元用于生成显示数据需要的行同步信号、场同步信号和使能信号，并且将从DDR存储芯片中读出的数据与生成的信号同步。
优选地，所述解码之后的数据包括行同步信号、场同步信号、使能信号和RGB灰度数据。
优选地，所述数据处理模块为FPGA处理器。
本发明还提供了一种显示屏控制系统，包括接收卡、驱动IC、以及如上所述的数据传输系统，所述接收卡用于接收经过所述数据传输系统中的发送卡分箱后的有效视频信号，做电光转换和亮色度校正后传送给驱动IC以驱动显示屏显示。
本发明还提供了一种显示屏控制方法，所述控制方法应用如上所述的显示屏控制系统，所述控制方法包括以下步骤：
S1、上位机将待显示的HDMI视频信号发送至HDMI解码芯片；
S2、HDMI解码芯片对HDMI视频信号进行解码，解码之后的数据包括行同步信号、场同步信号、使能信号和RGB灰度数据，然后发送至数据处理模块；
S3、数据处理模块中的像素倍增数据处理单元对数据进行像素倍增的数据处理，处理后的数据经DDR存储芯片进行帧缓存，然后发送至HDMI编码芯片重新编码成HDMI视频信号输出至发送卡；
S4、发送卡对视频数据进行解码、截取和分箱，将有效像素数据截取之后，将有效视频信号分箱打包发送至接收卡，然后接收卡再对数据做电光转换和亮色度校正并传送至驱动IC以驱动显示屏显示。
优选地，在像素倍增的数据处理之前，对24bit的RGB灰度数据进行gamma变换，展开成RGB亮度数据；在像素倍增的数据处理之后，将处理后的亮度数据进行gamma逆变换恢复成灰度数据。
优选地，所述像素倍增的数据处理的具体步骤为：
SS1、在一帧数据来到以后，先利用一个FIFO存储器暂存第一行的数据，第二行数据输入时存储在第二个FIFO存储器中，同时读取在第一个FIFO存储器里缓存的第一行数据，用6个寄存器存储当前两行的当前时刻和上一个时钟周期以及上上个时钟周期的数据；
SS2、第三行数据来到时，利用9个寄存器存储两个FIFO存储器读出和当前输入数据的当前时刻的数据和上一个时钟周期和上上个时钟周期的数据，构成一个3×3的数据窗；
SS3、设置一个计算操作的标志信号，当偶数行的列计数器计数到3k-2和3k-1（k为正整数）时将计算操作标志信号拉高，进行计算操作和赋值操作，其余时刻将计算操作标志信号拉低，将相应位数的0赋值给输出数据。
优选地，所述像素倍增显示屏的分辨率为m×n，在一帧数据来到以后，根据使能信号对行和列进行计数，在使能信号为1的时候，每个像素时钟上升时对列计数器进行加一操作，当列记满m-1时对行计数器进行加一操作，并将列计数器归零，代表着一行数据处理的结束，对下一行进行同样操作，当行计数器记满n-1时计数器全部归零，代表着一帧数据处理结束。
与现有技术相比，本发明的具体有益效果为：
本发明针对GB-BR-RG排布下传统像素倍增方案出现的彩线的问题，提供了一种新的像素复用方法，以五个子像素为一个复用显示单元，行内相邻两个虚拟像素之间存在三个重叠的子像素，由于复用显示单元中的中心子像素会被同一行的三列虚拟像素所复用，本发明通过控制中间列、前一列和后一列的复用比，使得到的单像素的线中五列亚像素线的亮度基本一致，使原本锐利的过渡变得平滑起来，有效消除甚至减轻彩色边缘，解决各类场景下的显示边缘偏色问题，优化文字等高频信息的彩色边缘问题；配合所述数据传输系统，不仅能够解决彩边显示问题，还能够节省发送卡到接收卡之间的传输带宽、发送卡带载以及接收卡的数据处理能力，从而大幅度降低了成本，降低短路风险且装置易于维修。
附图说明
图1为GB-BR-RG排布方式的传统像素复用方法；
图2为传统像素复用方法下单像素竖线颜色不收敛原理示意图；
图3为本申请提供的GB-BR-RG排布下的像素复用方法示意图；
图4为采用本申请像素复用方法渲染的单像素线示意图；
图5为实施例9中所述数据处理方法原理示意图。
具体实施方式
为使本发明的技术方案更加清楚，下面将结合本发明的说明书附图，对本发明实施例中的技术方案进行清楚、完整地描述，需要说明的是，以下实施例仅用于更好地理解本发明的技术方案，而不应理解为对本发明的限制。
实施例1.
本实施例提供了一种基于像素倍增排布的像素复用方法，所述像素倍增排布具体为：同一行相邻两个子像素间隔一个基本单位，同一列的子像素水平方向上相互交错半个基本单位，任意方向相邻的子像素均为不同基色，所述像素复用方法具体为：
将所述像素倍增排布结构中奇数行中任意两个相邻子像素与相邻偶数行的三个相邻子像素组成的等腰梯形结构作为一个显示单元，使得该奇数行中的每个子像素被四个所述显示单元复用，相邻偶数行中的每个子像素被六个所述显示单元复用，所有显示单元组成矩阵显示结构；
确定各子像素与图像源像素点的映射关系，所述奇数行中的每个子像素的显示数据为图像源中对应像素点中对应子像素显示数据的不加权平均值；所述相邻偶数行中的每个子像素的显示数据为图像源中对应像素点中对应子像素显示数据的加权平均值，其中中间列、前一列和后一列像素点中对应子像素显示数据的权数为2:1:1。
应用本实施例所述复用方法所渲染出的竖直单像素线如图4所示，本实施例以五个子像素为一个复用显示单元，行内相邻两个虚拟像素之间存在三个重叠的子像素，由于复用显示单元中的中心子像素会被同一行的三列虚拟像素所复用，本实施例控制中间列、前一列和后一列的复用比，使得到的单像素的线中五列亚像素线的亮度基本一致；并且，单像素线或者图形竖直边缘的宽度与传统复用方式相比增大了一倍，使得单像素线两边的显示单元间距变大，使原本锐利的过渡变得平滑起来，根据空间混色原理，能够极大程度地削弱颜色不收敛的现象，解决传统算法带来彩线问题，从而提升显示屏观感。
实施例2.
本实施例提供了一种像素倍增显示屏的数据传输系统，所述像素倍增显示屏应用实施例1所述基于像素倍增排布的像素复用方法，所述数据传输系统包括上位机、HDMI解码芯片、HDMI编码芯片、数据处理模块和发送卡，所述上位机用于将待显示的HDMI视频信号发送至所述HDMI解码芯片；所述HDMI解码芯片用于将所述HDMI视频信号解码，并将解码之后的数据发送至所述数据处理模块；所述数据处理模块包含像素倍增数据处理单元，用于对每帧数据进行像素倍增的数据处理；所述像素倍增数据处理单元内部包含两个FIFO存储器和9个数据寄存器，用于在每一帧数据到来以后对数据进行动态存储和读出，形成数据矩阵，再根据像素倍增数据处理算法计算单色像素数据，并将数据发送至HDMI编码芯片重新编码成HDMI视频信号输出至发送卡。
本实施例提供的像素倍增显示屏的数据传输系统，应用实施例1所述的像素复用方法，不仅解决了传统算法带来彩线问题，还做到了在上位机到发送卡之间的传输路径上实现数据的虚拟处理，节省发送卡到接收卡之间的传输带宽、发送卡带载以及接收卡的数据处理能力，降低系统对发送卡和接收卡的要求，从而大幅度降低了成本；还减少了对应的显示屏控制装置中发送卡和接收卡之间的走线数量，使得装置箱体内部走线规整，降低短路风险且装置易于维修。
实施例3.
本实施例为对实施例2的进一步举例说明，所述数据处理模块还包括DDR存储芯片和同步信号生成单元，所述DDR存储芯片用于对处理后的数据进行帧缓存，所述同步信号生成单元用于生成显示数据需要的行同步信号、场同步信号和使能信号，并且将从DDR存储芯片中读出的数据与生成的信号同步。
实施例4.
本实施例为对实施例2的进一步举例说明，所述解码之后的数据包括行同步信号、场同步信号、使能信号和RGB灰度数据。
实施例5.
本实施例为对实施例2的进一步举例说明，所述数据处理模块为FPGA处理器。
实施例6.
本实施例提供了一种显示屏控制系统，包括接收卡、驱动IC、以及如实施例2至5中任一项所述的数据传输系统，所述接收卡用于接收经过所述数据传输系统中的发送卡分箱后的有效视频信号，做电光转换和亮色度校正后传送给驱动IC以驱动显示屏显示。
实施例7.
本实施例提供了一种显示屏控制方法，所述控制方法应用如实施例6所述的像素倍增显示屏控制系统，所述控制方法包括以下步骤：
S1、上位机将待显示的HDMI视频信号发送至HDMI解码芯片；
S2、HDMI解码芯片对HDMI视频信号进行解码，解码之后的数据包括行同步信号、场同步信号、使能信号和RGB灰度数据，然后发送至数据处理模块；
S3、数据处理模块中的像素倍增数据处理单元对数据进行像素倍增的数据处理，处理之后得到的一帧数据的有效数据量变为处理之前的1/3，但是它们的排布是松散的，分散在每帧图像中，无效数据部分赋值为0；
为了把分散的图像数据集中化，以真正实现数据的减少，将处理后的数据经DDR存储芯片进行帧缓存，这样以1/3的有效数据量缓存至DDR之中，以分辨率为1080P为例，在DDR3读取的时候，利用一个同步信号生成单元生成显示数据需要的同步信号（行场同步和使能），然后根据使能信号进行列计数，产生前1280列前540行有效的DDR读取FIFO的读使能信号，在这些时间内将处理得到的1/3帧数据读取出来与同步信号生成单元生成的同步信号同步，一帧中其余时刻的信号即无效信号依然赋值为0，然后发送至HDMI编码芯片重新编码成HDMI视频信号输出至发送卡；
S4、发送卡对视频数据进行解码、截取和分箱，将有效像素数据截取之后，将有效视频信号分箱打包发送至接收卡，然后接收卡再对数据做电光转换和亮色度校正并传送至驱动IC以驱动显示屏显示。
实施例8.
本实施例为对实施例7的进一步举例说明，在像素倍增的数据处理之前，对24bit的RGB灰度数据进行gamma变换，展开成RGB亮度数据；在像素倍增的数据处理之后，将处理后的亮度数据进行gamma逆变换恢复成灰度数据。
本实施例所述展开成RGB亮度数据的位数是靠LED显示终端的gamma表来决定的，Gamma表可以针对不同的显示器做不同的改变，展开之后的bit数也会有所改变，通常是在36bit到66bit之间。
实施例9.
本实施例为对实施例8的进一步举例说明，所述像素倍增的数据处理的具体步骤为：
SS1、在一帧数据来到以后，先利用一个FIFO存储器暂存第一行的数据，第二行数据输入时存储在第二个FIFO存储器中，同时读取在第一个FIFO存储器里缓存的第一行数据，用6个寄存器存储当前两行的当前时刻和上一个时钟周期以及上上个时钟周期的数据；
SS2、第三行数据来到时，利用9个寄存器存储两个FIFO存储器读出和当前输入数据的当前时刻的数据和上一个时钟周期和上上个时钟周期的数据，构成一个3×3的数据窗；
SS3、设置一个计算操作的标志信号，当偶数行的列计数器计数到3k-2和3k-1（k为正整数）时将计算操作标志信号拉高，进行计算操作和赋值操作，其余时刻将计算操作标志信号拉低，将相应位数的0赋值给输出数据。
下面对本实施例提供的数据处理方法进行详细举例说明。如图5所示，对于①中的子像素，上方的G子像素仅需要视频源像素点11中的G数据，B子像素需要的是视频源像素点11和21的B分量数据的不加权平均，而R子像素则需要视频源像素点11、12、21和22的绿色分量数据的不加权平均值，因此这三个亚像素点需要的视频源数据是视频源像素点11、12、21和22的四个数据，缓存一行之后，在读出FIFO1里面第一行数据的同时，第二行第二列数据到来的这个时钟周期，对现存数据的4个寄存器里面的数据进行计算，然后赋值给输出，就得到像素倍增显示器的①内的RGB数据；
对于②中的子像素，左上角的B子像素需要11、12的蓝色分量的不加权平均值，右上方的R子像素则需要12、13的R分量做平均，而下方的G子像素则是需要11、12、13、21、22和23六个视频源像素位数据的G分量做平均，由于此处有6个视频源像素点数据，而12和22视频源像素点距离亚像素点比其它四个视频源像素点更近，因此对于这个G子像素来说，本实施例采取加权平均的算法来做复用，加权算法具体为：
G0=0.125G11+0.25G12+0.125G13+0.125G21+0.25G22+0.125G23，
其中G0代表②中的绿色亚像素需要的赋值，而G11、G12、G13、G21、G22和G23分别代表视频源第一行第一列、第一行第二列、第一行第三列、第二行第一列、第二行第二列和第二行第三列像素点数据的绿色分量；
在缓存一行之后，在读出FIFO1里面第一行数据的同时，第二行第三列数据到来的这个时钟周期，对现存数据的6个寄存器里面的数据进行计算，然后赋值给输出，就得到像素倍增显示器的②内的RGB数据；
对于③内的子像素，左上角的B子像素需要21、22、31和32四个数据的B分量做均值，右上角的R子像素则需要22、23、32、33四个视频源像素位的R分量做平均，而下方的G子像素则是需要31、32、33、41、42和43六个视频源像素位数据的G分量做均值，与上述②中的绿色亚像素同理，32和42视频源像素点距离亚像素点比其它四个视频源像素点更近，因此对于这个G子像素来说，本实施例同样采取加权平均的算法来做复用；因此这三个亚像素点所需要的视频源数据是21、22、23、31、32、33、41、42、43这九个数据，在FIFO1和FIFO2分别缓存了第2、3行数据之后，在读出FIFO1和FIFO2里面第2、3行数据的同时，第四行第二列数据到来的这个时钟周期，对现存数据的9个寄存器里面的数据进行计算，然后赋值给输出，就得到像素倍增显示器的③内的RGB数据；
依此类推，在每一个计算标志信号为高电平的时候只需要根据本实施例算法对本时刻的9个寄存器内的数值作相应的处理，然后将处理得到的数据赋值输出，一直到最后一行的最后一列数据到来之际，一帧数据的计算结束，数据处理模块的功能完成。
实施例10.
本实施例为对实施例9的进一步举例说明，所述像素倍增显示屏的分辨率为m×n，在一帧数据来到以后，根据使能信号对行和列进行计数，在使能信号为1的时候，每个像素时钟上升时对列计数器进行加一操作，当列记满m-1时对行计数器进行加一操作，并将列计数器归零，代表着一行数据处理的结束，对下一行进行同样操作，当行计数器记满n-1时计数器全部归零，代表着一帧数据处理结束。

Claims (10)

1.一种基于像素倍增排布的像素复用方法，所述像素倍增排布具体为：同一行相邻两个子像素间隔一个基本单位，同一列的子像素水平方向上相互交错半个基本单位，任意方向相邻的子像素均为不同基色，其特征在于，所述像素复用方法具体为：
将所述像素倍增排布结构中奇数行中任意两个相邻子像素与相邻偶数行的三个相邻子像素组成的等腰梯形结构作为一个显示单元，使得该奇数行中的每个子像素被四个所述显示单元复用，相邻偶数行中的每个子像素被六个所述显示单元复用，所有显示单元组成矩阵显示结构；
确定各子像素与图像源像素点的映射关系，所述奇数行中的每个子像素的显示数据为图像源中对应像素点中对应子像素显示数据的不加权平均值；所述相邻偶数行中的每个子像素的显示数据为图像源中对应像素点中对应子像素显示数据的加权平均值，其中中间列、前一列和后一列像素点中对应子像素显示数据的权数为2:1:1。
2.一种像素倍增显示屏的数据传输系统，其特征在于，所述像素倍增显示屏应用权利要求1所述基于像素倍增排布的像素复用方法，所述数据传输系统包括上位机、HDMI解码芯片、HDMI编码芯片、数据处理模块和发送卡，所述上位机用于将待显示的HDMI视频信号发送至所述HDMI解码芯片；所述HDMI解码芯片用于将所述HDMI视频信号解码，并将解码之后的数据发送至所述数据处理模块；所述数据处理模块包含像素倍增数据处理单元，用于对每帧数据进行像素倍增的数据处理；所述像素倍增数据处理单元内部包含两个FIFO存储器和9个数据寄存器，用于在每一帧数据到来以后对数据进行动态存储和读出，形成数据矩阵，再根据像素倍增数据处理算法对9个寄存器的数据进行计算得到单色像素数据，并将单色像素数据发送至HDMI编码芯片重新编码成HDMI视频信号输出至发送卡。
3.根据权利要求2所述的像素倍增显示屏的数据传输系统，其特征在于，所述数据处理模块还包括DDR存储芯片和同步信号生成单元，所述DDR存储芯片用于对处理后的数据进行帧缓存，所述同步信号生成单元用于生成显示数据需要的行同步信号、场同步信号和使能信号，并且将从DDR存储芯片中读出的数据与生成的信号同步。
4.根据权利要求2所述的像素倍增显示屏的数据传输系统，其特征在于，所述解码之后的数据包括行同步信号、场同步信号、使能信号和RGB灰度数据。
5.根据权利要求2所述的像素倍增显示屏的数据传输系统，其特征在于，所述数据处理模块为FPGA处理器。
6.一种显示屏控制系统，其特征在于，包括接收卡、驱动IC、以及如权利要求2至5中任一项所述的数据传输系统，所述接收卡用于接收经过所述数据传输系统中的发送卡分箱后的有效视频信号，做电光转换和亮色度校正后传送给驱动IC以驱动显示屏显示。
7.一种显示屏控制方法，其特征在于，所述控制方法应用如权利要求6所述的显示屏控制系统，所述控制方法包括以下步骤：
S1、上位机将待显示的HDMI视频信号发送至HDMI解码芯片；
S2、HDMI解码芯片对HDMI视频信号进行解码，解码之后的数据包括行同步信号、场同步信号、使能信号和RGB灰度数据，然后发送至数据处理模块；
S3、数据处理模块中的像素倍增数据处理单元对数据进行像素倍增的数据处理，处理后的数据经DDR存储芯片进行帧缓存，然后发送至HDMI编码芯片重新编码成HDMI视频信号输出至发送卡；
S4、发送卡对视频数据进行解码、截取和分箱，将有效像素数据截取之后，将有效视频信号分箱打包发送至接收卡，然后接收卡再对数据做电光转换和亮色度校正并传送至驱动IC以驱动显示屏显示。
8.根据权利要求7所述的显示屏控制方法，其特征在于，在像素倍增的数据处理之前，对24bit的RGB灰度数据进行gamma变换，展开成RGB亮度数据；在像素倍增的数据处理之后，将处理后的亮度数据进行gamma逆变换恢复成灰度数据。
9.根据权利要求8所述的显示屏控制方法，其特征在于，所述像素倍增的数据处理的具体步骤为：
SS1、在一帧数据来到以后，先利用一个FIFO存储器暂存第一行的数据，第二行数据输入时存储在第二个FIFO存储器中，同时读取在第一个FIFO存储器里缓存的第一行数据，用6个寄存器存储当前两行的当前时刻和上一个时钟周期以及上上个时钟周期的数据；
SS2、第三行数据来到时，利用9个寄存器存储两个FIFO存储器读出和当前输入数据的当前时刻的数据和上一个时钟周期和上上个时钟周期的数据，构成一个3×3的数据窗；
SS3、设置一个计算操作的标志信号，当偶数行的列计数器计数到3k-2和3k-1（k为正整数）时将计算操作标志信号拉高，进行计算操作和赋值操作，其余时刻将计算操作标志信号拉低，将相应位数的0赋值给输出数据。
10.根据权利要求9所述的显示屏控制方法，其特征在于，所述像素倍增显示屏的分辨率为m×n，在一帧数据来到以后，根据使能信号对行和列进行计数，在使能信号为1的时候，每个像素时钟上升时对列计数器进行加一操作，当列记满m-1时对行计数器进行加一操作，并将列计数器归零，代表着一行数据处理的结束，对下一行进行同样操作，当行计数器记满n-1时计数器全部归零，代表着一帧数据处理结束。
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