CN116259271A - 像素电路及其驱动方法、显示面板和显示装置 - Google Patents

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Abstract

本发明实施例公开了一种像素电路及其驱动方法、显示面板和显示装置。像素电路包括驱动模块和电压写入模块，像素电路的驱动方法包括：在第一阶段，控制电压写入模块导通，以通过电压写入模块将重置电压传输至驱动模块的第一端或控制端；在第二阶段，控制电压写入模块导通，以通过电压写入模块将重置电压传输至驱动模块的第一端。其中，至少一个第二阶段及其相邻的第一阶段或第二阶段的间隔时长为第一时长，任意一个第二阶段及其相邻的第一阶段或第二阶段的间隔时长为第二时长，在至少部分显示周期中：第一时长与写入帧的总时长不同，第二时长与写入帧的总时长之差的绝对值小于或等于预设时长。本发明的技术方案，有助于改善显示面板的闪烁问题。

Description

像素电路及其驱动方法、显示面板和显示装置
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种像素电路及其驱动方法、显示面板和显示装置。
背景技术
随着显示技术的不断发展，人们对于显示面板的性能要求越来越高。现有显示面板在不同显示模式下，可以采用不同的刷新率进行显示。目前，当显示面板以较低刷新率进行显示时，显示画面容易出现闪烁的问题。
发明内容
本发明实施例提供了一种像素电路及其驱动方法、显示面板和显示装置，以改善显示面板的闪烁问题。
第一方面，本发明实施例提供了一种像素电路的驱动方法，所述像素电路包括：驱动模块和电压写入模块；所述驱动模块用于在显示周期驱动发光元件，所述显示周期包括写入帧和保持帧；所述电压写入模块连接所述驱动模块的第一端，所述电压写入模块的工作阶段包括至少一个第一阶段和至少一个第二阶段，所述第一阶段位于所述写入帧，所述第二阶段位于所述保持帧；
所述像素电路的驱动方法包括：
在所述第一阶段，控制所述电压写入模块导通，以通过所述电压写入模块将重置电压传输至所述驱动模块的第一端或控制端；
在所述第二阶段，控制所述电压写入模块导通，以通过所述电压写入模块将所述重置电压传输至所述驱动模块的第一端；
其中，至少一个所述第二阶段及其相邻的所述第一阶段或所述第二阶段的间隔时长为第一时长，任意一个所述第二阶段及其相邻的所述第一阶段或所述第二阶段的间隔时长为第二时长，在至少部分所述显示周期中：所述第一时长与所述写入帧的总时长不同，所述第二时长与所述写入帧的总时长之差的绝对值小于或等于预设时长。
可选地，所述第一阶段包括数据写入阶段，所述第二阶段包括偏置阶段，所述重置电压包括数据电压和偏置电压；所述电压写入模块的控制端接入第一扫描信号，所述电压写入模块的第一端连接重置电压端，所述电压写入模块的第二端连接所述驱动模块的第一端；
在所述第一阶段，控制所述电压写入模块导通，以通过所述电压写入模块将重置电压传输至所述驱动模块的第一端或控制端，包括：
在所述数据写入阶段，向所述重置电压端提供数据电压，以控制所述电压写入模块响应所述第一扫描信号导通，将所述数据电压传输至所述驱动模块的控制端；
在所述第二阶段，控制所述电压写入模块导通，以通过所述电压写入模块将所述重置电压传输至所述驱动模块的第一端，包括：
在所述偏置阶段，向所述重置电压端提供偏置电压，以控制所述电压写入模块响应所述第一扫描信号导通，将所述偏置电压传输至所述驱动模块的第一端。
可选地，所述第一阶段包括第一偏置阶段，所述第二阶段包括第二偏置阶段，所述重置电压包括偏置电压；所述电压写入模块的控制端接入第一扫描信号，所述电压写入模块的第一端接入所述偏置电压，所述电压写入模块的第二端连接所述驱动模块的第一端；
在所述第一阶段，控制所述电压写入模块导通，以通过所述电压写入模块将重置电压传输至所述驱动模块的第一端或控制端，包括：
在所述第一偏置阶段，控制所述电压写入模块响应所述第一扫描信号导通，以将所述偏置电压传输至所述驱动模块的第一端；
在所述第二阶段，控制所述电压写入模块导通，以通过所述电压写入模块将所述重置电压传输至所述驱动模块的第一端，包括：
在所述第二偏置阶段，控制所述电压写入模块响应所述第一扫描信号导通，以在所述第二偏置阶段将所述偏置电压传输至所述驱动模块的第一端。
可选地，所述电压写入模块的控制端接入第一扫描信号，所述第一扫描信号包括至少两个第一导通电平，所述第一导通电平用于控制所述电压写入模块导通；
在至少部分所述显示周期中：所述第一扫描信号中的至少一个所述第一导通电平及其相邻的所述第一导通电平的间隔时长与所述写入帧的总时长不同，所述第一扫描信号中的任意一个所述第一导通电平及其相邻的所述第一导通电平的间隔时长与所述写入帧的总时长之差的绝对值小于或等于所述预设时长。
可选地，每个所述显示周期中的所述写入帧位于所述保持帧之前，至少一个所述第一导通电平位于所述写入帧，且至少一个所述第一导通电平位于所述保持帧；
在至少部分所述显示周期中：至少一个位于所述保持帧的所述第一导通电平及其前一个所述第一导通电平的间隔时长与所述写入帧的总时长不同。
可选地，所述至少部分所述显示周期包括刷新率为目标低频的所述显示周期；
所述显示周期对应的刷新率包括预设低频，所述目标低频为低于所述预设低频的刷新率，在所述目标低频对应的所述显示周期中，所述保持帧的总时长为所述写入帧的总时长的非整数倍。
可选地，所述像素电路还包括发光控制模块，所述发光控制模块、所述驱动模块和所述发光元件串联于第一电源端和第二电源端之间，所述发光控制模块的控制端接入发光控制信号，所述发光控制模块响应所述发光控制信号而导通或关断；
所述发光控制信号包括多个第二导通电平，所述第二导通电平用于控制所述发光控制模块导通，在所述目标低频对应的所述显示周期中：位于所述写入帧的所述第二导通电平的数量为n个，位于所述保持帧的所述第二导通电平的数量为m个，其中，n为大于或等于2的正整数，m为n的非整数倍。
可选地，在至少部分所述显示周期中：
发光控制信号包括位于所述写入帧的n个电平组和位于所述保持帧的m个电平组，每个所述电平组均包括第二导通电平和关断电平，所述关断电平用于控制所述发光控制模块关断；
第一扫描信号中的第一导通电平与所述发光控制信号中的所述关断电平的时序相交叠，至少一个位于所述保持帧的所述第一导通电平及其前一个所述第一导通电平的间隔时长，与n个所述电平组中的所述第二导通电平和所述关断电平的总时长不同，任意一个所述第一导通电平及其相邻的所述第一导通电平的间隔时长，与n个所述电平组中的所述第二导通电平和所述关断电平的总时长之差的绝对值小于或等于所述预设时长。
可选地，所述预设时长满足：所述第一扫描信号中相邻的所述第一导通电平的间隔时长引起的闪烁程度为人眼无法识别的闪烁程度。
可选地，n包括2和2的正整数倍，所述预设时长包括所述写入帧的总时长的0.25倍。
可选地，预设低频包括60Hz，目标低频包括24Hz，所述发光控制信号包括位于所述写入帧的4个所述电平组和位于所述保持帧的6个所述电平组；
在所述目标低频对应的所述显示周期中：
所述第一扫描信号包括位于所述写入帧的一个所述第一导通电平，以及位于所述保持帧的一个所述第一导通电平，位于所述写入帧的所述第一导通电平与位于所述写入帧的第一个所述电平组中的所述关断电平的时序相交叠，位于所述保持帧的所述第一导通电平与位于所述保持帧的第二个所述电平组中的所述关断电平的时序相交叠。
可选地，预设低频包括60Hz，目标低频包括17Hz，所述发光控制信号包括位于所述写入帧的4个所述电平组和位于所述保持帧的10个所述电平组；
在所述目标低频对应的所述显示周期中：
所述第一扫描信号包括位于所述写入帧的一个所述第一导通电平，以及位于所述保持帧的两个所述第一导通电平，位于所述写入帧的所述第一导通电平与位于所述写入帧的第一个所述电平组中的所述关断电平的时序相交叠，位于所述保持帧的第一个所述第一导通电平与位于所述保持帧的第一个所述电平组中的所述关断电平的时序相交叠，位于所述保持帧的第二个所述第一导通电平与位于所述保持帧的第六个所述电平组中的所述关断电平的时序相交叠。
第二方面，基于同一发明构思，本发明实施例提供了一种像素电路，包括：
驱动模块，用于在显示周期驱动发光元件，所述显示周期包括写入帧和保持帧；
电压写入模块，连接所述驱动模块的第一端，所述电压写入模块的工作阶段包括至少一个第一阶段和至少一个第二阶段，所述第一阶段位于所述写入帧，所述第二阶段位于所述保持帧，所述电压写入模块用于在所述第一阶段将重置电压传输至所述驱动模块的第一端或控制端，在所述第二阶段将所述重置电压传输至所述驱动模块的第一端；
其中，至少一个所述第二阶段及其相邻的所述第一阶段或所述第二阶段的间隔时长为第一时长，任意一个所述第二阶段及其相邻的所述第一阶段或所述第二阶段的间隔时长为第二时长，在至少部分所述显示周期中：所述第一时长与所述写入帧的总时长不同，所述第二时长与所述写入帧的总时长之差的绝对值小于或等于预设时长。
可选地，所述第一阶段包括数据写入阶段，所述第二阶段包括偏置阶段，所述重置电压包括数据电压和偏置电压；
所述电压写入模块的控制端接入第一扫描信号，所述电压写入模块的第一端连接重置电压端，所述重置电压端在所述数据写入阶段接入所述数据电压，所述重置电压端在所述偏置阶段接入所述偏置电压，所述电压写入模块的第二端连接所述驱动模块的第一端；
所述电压写入模块用于响应所述第一扫描信号在所述数据写入阶段导通，以将所述数据电压传输至所述驱动模块的控制端，并响应所述第一扫描信号在所述偏置阶段导通，以将所述偏置电压传输至所述驱动模块的第一端。
可选地，所述第一阶段包括第一偏置阶段，所述第二阶段包括第二偏置阶段，所述重置电压包括偏置电压；
所述电压写入模块的控制端接入第一扫描信号，所述电压写入模块的第一端接入所述偏置电压，所述电压写入模块的第二端连接所述驱动模块的第一端；
所述电压写入模块用于响应所述第一扫描信号在所述第一偏置阶段和所述第二偏置阶段导通，以在所述第一偏置阶段和所述第二偏置阶段分别将所述偏置电压传输至所述驱动模块的第一端。
第三方面，基于同一发明构思，本发明实施例提供了一种显示面板，包括第二方面所述的像素电路。
第四方面，基于同一发明构思，本发明实施例提供了一种显示装置，包括第三方面所述的显示面板。
本发明实施例提供的像素电路及其驱动方法、显示面板和显示装置，在每一显示周期的写入帧中的第一阶段，控制电压写入模块将重置电压传输至驱动模块的第一端或控制端，以调节驱动模块的电压状态，在每一显示周期的保持帧中的第二阶段，控制电压写入模块将重置电压传输至驱动模块的第一端，以调节驱动模块的电压状态，通过在至少部分显示周期中，设置至少一个第二阶段与其相邻的第一阶段或第二阶段的间隔时长，即第一时长，与写入帧的总时长不同，且每一个第二阶段与其相邻的第一阶段或第二阶段的间隔时长，即第二时长，与写入帧的总时长之差的绝对值小于或等于预设时长，在预设时长较短的情况下，能够使至少部分显示周期中相邻的第一阶段和第二阶段之间的时间间隔，以及相邻的两个第二阶段之间的时间间隔均相近甚至相同，也即电压写入模块每一次对驱动模块的电压状态进行调节的时间间隔相近甚至相同，有助于避免驱动模块的电压状态变化的时间间隔差距过大而导致的闪烁现象，从而优化显示效果。
应当理解，本部分所描述的内容并非旨在标识本发明的实施例的关键或重要特征，也不用于限制本发明的范围。本发明的其它特征将通过以下的说明书而变得容易理解。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是相关技术中的一种像素电路的结构示意图；
图2是图1中的像素电路的驱动时序示意图；
图3是本发明实施例提供的一种像素电路的结构示意图；
图4是本发明实施例提供的一种像素电路的驱动时序示意图；
图5是本发明实施例提供的一种像素电路的驱动方法的流程示意图；
图6是本发明实施例提供的另一种像素电路的驱动方法的流程示意图；
图7是本发明实施例提供的另一种像素电路的结构示意图；
图8是本发明实施例提供的另一种像素电路的驱动时序示意图；
图9是本发明实施例提供的另一种像素电路的驱动方法的流程示意图；
图10是本发明实施例提供的另一种像素电路的驱动时序示意图；
图11是本发明实施例提供的另一种像素电路的驱动时序示意图；
图12是本发明实施例提供的另一种像素电路的结构示意图；
图13是本发明实施例提供的另一种像素电路的结构示意图；
图14是本发明实施例提供的一种显示面板的结构示意图；
图15是本发明实施例提供的一种显示装置的结构示意图。
具体实施方式
为了使本技术领域的人员更好地理解本发明方案，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分的实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都应当属于本发明保护的范围。
需要说明的是，本发明的说明书和权利要求书及上述附图中的术语“第一”、“第二”等是用于区别类似的对象，而不必用于描述特定的顺序或先后次序。应该理解这样使用的数据在适当情况下可以互换，以便这里描述的本发明的实施例能够以除了在这里图示或描述的那些以外的顺序实施。此外，术语“包括”和“具有”以及他们的任何变形，意图在于覆盖不排他的包含，例如，包含了一系列步骤或单元的过程、方法、系统、产品或设备不必限于清楚地列出的那些步骤或单元，而是可包括没有清楚地列出的或对于这些过程、方法、产品或设备固有的其它步骤或单元。在不脱离本发明的精神或范围的情况下，在本发明中能进行各种修改和变化，这对于本领域技术人员来说是显而易见的。因而，本发明意在覆盖落入所对应权利要求(要求保护的技术方案)及其等同物范围内的本发明的修改和变化。需要说明的是，本发明实施例所提供的实施方式，在不矛盾的情况下可以相互组合。
正如背景技术所述，当显示面板以较低刷新率进行显示时，显示画面容易出现闪烁问题。经发明人研究发现，出现上述问题的原因具体如下：
现有显示面板进行低频显示时，通常采用插帧(Frame skip)的方式进行降频，例如，当显示面板以较低刷新率工作时，设置每一显示帧均包括写入帧和写入帧之后的保持帧，不同刷新率下的写入帧的时长相同，通过调节保持帧的时长，使实际显示效果满足相应的刷新率。一般情况下，降频插帧时设置保持帧的时长为写入帧时长的整数倍，然而在部分刷新率下，保持帧的时长为写入帧时长的非整数倍，使得显示画面存在闪烁问题。
图1是相关技术中的一种像素电路的结构示意图；图2是图1中的像素电路的驱动时序示意图。下面结合图1和图2，以显示面板工作于24Hz刷新率下的情况为例进行说明。每一显示周期P均包括写入帧P1和保持帧P2，当写入帧P1的时长为60Hz下每一显示帧的时长时，24Hz下的保持帧P2的时长为写入帧P1时长的非整数倍，也即1.5倍。像素电路包括驱动晶体管M0、第一晶体管M1、第二晶体管M2、第三晶体管M3和发光元件D0。第一晶体管M1分别在写入帧P1和保持帧P2调节驱动晶体管M0的电压状态：在写入帧P1，第一晶体管M1响应于扫描信号端sp的信号，将第一电压端Source接入的数据电压V1写入驱动晶体管M0；在保持帧P2，第一晶体管M1响应于扫描信号端sp的信号，将第一电压端Source接入的偏置电压V2写入驱动晶体管M0，以调节其偏置状态。
图2中分别示出了像素电路中的扫描信号端sp和发光控制信号端em可接入的两组信号。在显示面板的第一种工作情况下，扫描信号端sp接入扫描信号sp1，发光控制信号端em接入发光控制信号em1。扫描信号sp1在前一显示周期P的写入帧P1和保持帧P2中的低电平脉冲间隔，为发光控制信号em1的4个电平组(相邻的一个高电平和一个低电平为一电平组)的时长；扫描信号sp1在前一显示周期P的保持帧P2和后一显示周期P的写入帧P1中的低电平脉冲间隔，为发光控制信号em1的6个电平组的时长。可见，第一晶体管M1对驱动晶体管M0的电压状态进行调节的时间间隔不同，而驱动晶体管M0的电压状态决定发光元件D0的亮度，因此，会导致闪烁问题。
在显示面板的第二种工作情况下，扫描信号端sp接入扫描信号sp2，发光控制信号端em接入发光控制信号em2。扫描信号sp2在保持帧P2中的两个低电平脉冲之间的时间间隔，为发光控制信号em2的4个电平组的时长；扫描信号sp2在保持帧P2的第二个低电平脉冲至后一显示周期P的第一个低电平脉冲之间的时间间隔，为发光控制信号em2的2个电平组的时长。可见，第一晶体管M1对驱动晶体管M0的电压状态进行调节的时间间隔不同，而驱动晶体管M0的电压状态决定发光元件D0的亮度，因此，同样会导致闪烁问题。
针对上述问题，本发明实施例提供了一种像素电路的驱动方法，用于驱动像素电路工作，该方法可以由本发明任意实施例中的像素电路执行。图3是本发明实施例提供的一种像素电路的结构示意图；图4是本发明实施例提供的一种像素电路的驱动时序示意图；图5是本发明实施例提供的一种像素电路的驱动方法的流程示意图。结合图3和图4，该像素电路包括：驱动模块10和电压写入模块20。驱动模块10用于在显示周期F驱动发光元件D1，显示周期F包括写入帧F1和保持帧F2。电压写入模块20连接驱动模块10的第一端，电压写入模块20的工作阶段包括至少一个第一阶段t1和至少一个第二阶段t2，第一阶段t1位于写入帧F1，第二阶段t2位于保持帧F2。参见图5，像素电路的驱动方法具体包括如下步骤：
S110、在第一阶段，控制电压写入模块导通，以通过电压写入模块将重置电压传输至驱动模块的第一端或控制端。
S120、在第二阶段，控制电压写入模块导通，以通过电压写入模块将重置电压传输至驱动模块的第一端。
其中，至少一个第二阶段t2及其相邻的第一阶段t1或第二阶段t2的间隔时长为第一时长N1，任意一个第二阶段t2及其相邻的第一阶段t1或第二阶段t2的间隔时长为第二时长N2，在至少部分显示周期F中：第一时长N1与写入帧F1的总时长不同，第二时长N2与写入帧F1的总时长之差的绝对值小于或等于预设时长。
结合图3和图4，具体地，发光元件D1可以是有机发光二极管(Organic Light-Emitting Diode，OLED)或微米级发光二极管(Micro-LED)等。每一显示周期F可理解为一显示帧，在显示面板工作的部分刷新率下，每一显示周期F均包括写入帧F1和保持帧F2。写入帧F1又称为“刷新帧”或“数据帧”，在写入帧F1中，驱动模块10的控制端G的电压发生变化，驱动模块10根据自身控制端G的电压产生驱动电流，驱动发光元件D1发光。在保持帧F2中，驱动模块10的控制端G的电压保持不变，驱动模块10仍可根据自身控制端G的电压产生驱动电流，驱动发光元件D1发光。
写入帧F1和保持帧F2均包括发光阶段和非发光阶段，第一阶段t1位于写入帧F1的非发光阶段中，第二阶段t2位于保持帧F2的非发光阶段中。在每一显示周期F的写入帧F1的第一阶段t1和保持帧F2的第二阶段t2中，分别通过电压写入模块20调节驱动模块10的电压状态。具体地，在第一阶段t1，控制电压写入模块20导通，以通过电压写入模块20将重置电压传输至驱动模块10的第一端或驱动模块10的控制端G，实现对驱动模块10的第一端或驱动模块10的控制端G的电压进行重置，以调节驱动模块10的电压状态；在第二阶段t2，控制电压写入模块20导通，以通过电压写入模块20将重置电压传输至驱动模块10的第一端，实现对驱动模块10的第一端的电压进行重置，以调节驱动模块10的电压状态。
保持帧F2中可包括多个第二阶段t2，图4仅示意性地示出了保持帧F2包括一个第二阶段t2的情况。与第二阶段t2相邻的第一阶段t1，可以是与第二阶段t2在同一显示周期F中的第一阶段t1，或者是下一显示周期F中的第一阶段t1。与第二阶段t2相邻的第二阶段t2，可以是同一显示周期F中的两个第二阶段t2。在至少部分显示周期F中，至少存在一个第二阶段t2与其相邻的第一阶段t1或第二阶段t2的间隔时长，即第一时长N1，与写入帧F1的总时长不同，且每一个第二阶段t2与其相邻的第一阶段t1或第二阶段t2的间隔时长，即第二时长N2，均与写入帧F1的总时长之差的绝对值小于或等于预设时长。预设时长的大小，可以根据具体需求进行设置。
示例性地，在图4所示的两个显示周期F中，每一个第二阶段t2与其相邻的第一阶段t1的间隔时长均相同，即第一时长N1与第二时长N2相同，且第一时长N1和第二时长N2均与写入帧F1的总时长不同，第一时长N1与写入帧F1的总时长之差的绝对值小于或等于预设时长，第二时长N2与写入帧F1的总时长之差的绝对值小于或等于预设时长。这样设置的好处在于，能够使电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔相近甚至相同，也即图4中每相邻的两个第一阶段t1和第二阶段t2之间的时间间隔均相同，而驱动模块10的电压状态决定发光元件D1的亮度，因此，本实施例的技术方案，有助于避免驱动模块10的电压状态发生变化的时间间隔差距过大而导致闪烁现象。
综上，本发明实施例的技术方案，在每一显示周期的写入帧中的第一阶段，控制电压写入模块将重置电压传输至驱动模块的第一端或控制端，以调节驱动模块的电压状态，在每一显示周期的保持帧中的第二阶段，控制电压写入模块将重置电压传输至驱动模块的第一端，以调节驱动模块的电压状态，通过在至少部分显示周期中，设置至少一个第二阶段与其相邻的第一阶段或第二阶段的间隔时长，即第一时长，与写入帧的总时长不同，且每一个第二阶段与其相邻的第一阶段或第二阶段的间隔时长，即第二时长，与写入帧的总时长之差的绝对值小于或等于预设时长，在预设时长较短的情况下，能够使至少部分显示周期中相邻的第一阶段和第二阶段之间的时间间隔，以及相邻的两个第二阶段之间的时间间隔均相近甚至相同，也即电压写入模块每一次对驱动模块的电压状态进行调节的时间间隔相近甚至相同，有助于避免驱动模块的电压状态变化的时间间隔差距过大而导致的闪烁现象，从而优化显示效果。
适用于本发明的像素电路结构有多种，下面以其中的几种为例进行具体说明。在一种实施例中，参见图3，电压写入模块20的控制端接入第一扫描信号S1，电压写入模块20的第一端连接重置电压端，重置电压端接入的重置电压包括数据电压Data和偏置电压DVH，电压写入模块20的第二端连接驱动模块10的第一端。相应地，第一阶段包括数据写入阶段，第二阶段包括偏置阶段。图6是本发明实施例提供的另一种像素电路的驱动方法的流程示意图。参见图6，该方法具体包括如下步骤：
S210、在数据写入阶段，向重置电压端提供数据电压，以控制电压写入模块响应第一扫描信号导通，将数据电压传输至驱动模块的控制端。
结合图3和图4，可选地，像素电路还包括补偿模块30和存储模块40。补偿模块30的控制端接入第二扫描信号S2(图4中未示出第二扫描信号S2)，补偿模块30连接于驱动模块10的第二端和控制端G之间，补偿模块30用于对驱动模块10的阈值电压进行补偿。存储模块40连接驱动模块10的控制端G，用于对驱动模块10的控制端G的电压进行存储。
第一阶段t1可以是数据写入阶段，在写入帧F1的发光阶段之前的第一阶段t1，重置电压端S0接入的重置电压为数据电压Data，电压写入模块20响应第一扫描信号S1导通，补偿模块30响应第二扫描信号S2导通，以通过电压写入模块20和补偿模块30将数据电压Data传输至驱动模块10的控制端G，同时通过补偿模块30对驱动模块10的阈值电压进行补偿，并通过存储模块40对驱动模块10的控制端G的电压进行存储，使得驱动模块10在发光阶段能够根据存储模块40存储的电压驱动发光元件D1发光。
S220、在偏置阶段，向重置电压端提供偏置电压，以控制电压写入模块响应第一扫描信号导通，将偏置电压传输至驱动模块的第一端。
第二阶段t2可以是偏置阶段，在保持帧F2的发光阶段之前的第二阶段t2，重置电压端S0接入的重置电压为偏置电压DVH，电压写入模块20响应第一扫描信号S1导通，将偏置电压DVH传输至驱动模块10的第一端，实现对驱动模块10的第一端的电压进行重置，以调节驱动模块10的偏置状态，使得驱动模块10处于导通-偏置(On-bias，OBS)状态，有助于提升显示均一性。
本实施例的技术方案，设置第一阶段t1为数据写入阶段，第二阶段t2为偏置阶段，在第一阶段t1，通过电压写入模块20将数据电压Data传输至驱动模块10的控制端G，在第二阶段t2，通过电压写入模块20将偏置电压DVH传输至驱动模块10的第一端，由于存在至少一个第二阶段t2与其相邻的第一阶段t1或第二阶段t2的间隔时长，即第一时长N1，与写入帧F1的总时长不同，且每一个第二阶段t2与其相邻的第一阶段t1或第二阶段t2的间隔时长，即第二时长N2，与写入帧F1的总时长之差的绝对值小于或等于预设时长，在预设时长较短的情况下，能够使至少部分显示周期F中相邻的第一阶段t1和第二阶段t2之间的时间间隔，以及相邻的两个第二阶段t2之间的时间间隔均相近，也即电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔相近。尤其是在本实施例的技术方案中，每相邻的两个第一阶段t1和第二阶段t2之间的时间间隔均相同，电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔也相同，因此有助于避免驱动模块10的电压状态发生变化的时间间隔差距过大而导致闪烁现象。
图7是本发明实施例提供的另一种像素电路的结构示意图；图8是本发明实施例提供的另一种像素电路的驱动时序示意图。结合图7和图8，可选地，重置电压包括偏置电压DVH；电压写入模块20的控制端接入第一扫描信号S1，电压写入模块20的第一端接入偏置电压DVH，电压写入模块20的第二端连接驱动模块10的第一端。相应地，第一阶段t1包括第一偏置阶段，第二阶段t2包括第二偏置阶段。图9是本发明实施例提供的另一种像素电路的驱动方法的流程示意图。参见图9，该方法具体包括如下步骤：
S310、在第一偏置阶段，控制电压写入模块响应第一扫描信号导通，以将偏置电压传输至驱动模块的第一端。
结合图7和图8，可选地，像素电路还包括数据写入模块50，数据写入模块50的控制端接入第三扫描信号S3，数据写入模块50连接驱动模块10，用于将数据电压Data写入驱动模块10的控制端G。
第一阶段t1可以是第一偏置阶段，写入帧F1还包括数据写入阶段，数据写入阶段位于第一阶段t1之前，且数据写入阶段和第一阶段t1均位于写入帧F1的发光阶段之前。在数据写入阶段，控制数据写入模块50响应第三扫描信号S3导通，补偿模块30响应第二扫描信号S2导通，以通过数据写入模块50和补偿模块30将数据电压Data传输至驱动模块10的控制端G。在第一阶段t1，控制电压写入模块20响应第一扫描信号S1导通，以将偏置电压DVH传输至驱动模块20的第一端，实现对驱动模块10的第一端的电压进行重置，以调节驱动模块10的偏置状态，使得驱动模块10处于OBS状态，有助于提升显示均一性。
S320、在第二偏置阶段，控制电压写入模块响应第一扫描信号导通，以在第二偏置阶段将偏置电压传输至驱动模块的第一端。
第二阶段t2可以是第二偏置阶段，在保持帧F2的发光阶段之前的第二阶段t2，控制电压写入模块20响应第一扫描信号S1导通，将偏置电压DVH传输至驱动模块10的第一端，实现对驱动模块10的第一端的电压进行重置，以调节驱动模块10的偏置状态，使得驱动模块10处于OBS状态，有助于提升显示均一性。
本实施例的技术方案，设置第一阶段t1为第一偏置阶段，第二阶段t2为第二偏置阶段，在第一阶段t1和第二阶段t2，分别通过电压写入模块20将偏置电压DVH传输至驱动模块10的第一端，由于存在至少一个第二阶段t2与其相邻的第一阶段t1或第二阶段t2的间隔时长，即第一时长N1，与写入帧F1的总时长不同，且每一个第二阶段t2与其相邻的第一阶段t1或第二阶段t2的间隔时长，即第二时长N2，与写入帧F1的总时长之差的绝对值小于或等于预设时长，在预设时长较短的情况下，能够使至少部分显示周期F中相邻的第一阶段t1和第二阶段t2之间的时间间隔，以及相邻的两个第二阶段t2之间的时间间隔均相近，也即电压写入模块20每一次对驱动模块10的偏置状态进行调节的时间间隔相近。尤其是在本实施例的技术方案中，每相邻的两个第一阶段t1和第二阶段t2之间的时间间隔均相同，电压写入模块20每一次对驱动模块10的偏置状态进行调节的时间间隔也相同，因此有助于避免驱动模块10的偏置状态发生变化的时间间隔差距过大而导致闪烁现象。
结合图3和图4，或者图7和图8，在上述各实施例的基础上，第一扫描信号S1包括至少两个第一导通电平，第一导通电平用于控制电压写入模块20导通。在至少部分显示周期F中：第一扫描信号S1中的至少一个第一导通电平及其相邻的第一导通电平的间隔时长与写入帧F1的总时长不同，第一扫描信号S1中的任意一个第一导通电平及其相邻的第一导通电平的间隔时长与写入帧F1的总时长之差的绝对值小于或等于预设时长。
具体地，电压写入模块20可以由薄膜晶体管构成，当电压写入模块20由P型晶体管构成时，第一导通电平为低电平，当电压写入模块20由N型晶体管构成时，第一导通电平为高电平，图4和图8均以第一扫描信号S1中的第一导通电平是低电平为例进行示意。当电压写入模块20的控制端接入第一导通电平时，电压写入模块20导通，以通过电压写入模块20将数据电压Data传输至驱动模块10的控制端，以对驱动模块10的电压状态进行调节，或者通过电压写入模块20将偏置电压DVH传输至驱动模块10的第一端，以对驱动模块10的电压状态进行调节。
第一扫描信号S1中的第一导通电平及其相邻的第一导通电平的间隔时长，决定电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔，通过设置第一扫描信号S1中至少存在一个第一导通电平及其相邻的第一导通电平的间隔时长与写入帧F1的总时长不同，且每一个第一导通电平及其相邻的第一导通电平的间隔时长与写入帧F1的总时长之差的绝对值小于或等于预设时长，在预设时长较短的情况下，能够使第一扫描信号S1中至少部分相邻的第一导通电平间隔时长相近，也即电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔相近。图4和图8均示出了第一扫描信号S1中每相邻的两个第一导通电平的间隔时长相同的情况，使得电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔也相同，因此有助于避免驱动模块10的电压状态发生变化的时间间隔差距过大而导致闪烁现象。
结合图3和图4，或者图7和图8，进一步地，每个显示周期F中的写入帧F1位于保持帧F2之前，至少一个第一导通电平位于写入帧F1，且至少一个第一导通电平位于保持帧F2。在至少部分显示周期F中：至少一个位于保持帧F2的第一导通电平及其前一个第一导通电平的间隔时长与写入帧F1的总时长不同。
具体地，在实际应用中，可以根据每个显示周期F中的写入帧F1的总时长和保持帧F2的总时长，来设置第一扫描信号S1中的第一导通电平的数量，并调节保持帧F2中的第一导通电平的时序。示例性地，如图4或图8所示，当保持帧F2的总时长为写入帧F1的总时长的1.5倍时，可以设置第一扫描信号S1包括位于写入帧F1的一个第一导通电平以及位于保持帧F2的一个第一导通电平，通过调节保持帧F2的第一导通电平的时序，使同一显示周期F内的保持帧F2的第一导通电平与写入帧F1的第一导通电平的间隔时长为写入帧F1的总时长的1.5倍，也即与写入帧F1的总时长不同，能够使第一扫描信号S1中每相邻的两个第一导通电平的间隔时长相同，使得电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔也相同，因此有助于避免驱动模块10的电压状态发生变化的时间间隔差距过大而导致闪烁现象。
参见图4或图8，可选地，至少部分显示周期F包括刷新率为目标低频的显示周期F，显示周期F对应的刷新率包括预设低频，目标低频为低于预设低频的刷新率，在目标低频对应的显示周期F中，保持帧F2的总时长为写入帧F1的总时长的非整数倍。
在一种实施例中，预设低频包括60Hz，目标低频为低于60Hz的刷新率，且在目标低频对应的显示周期F中，保持帧F2的总时长为写入帧F1的总时长的非整数倍。示例性地，当预设低频为60Hz时，目标低频的写入帧F1的总时长为60Hz下每一显示帧的总时长，且目标低频的保持帧F2的总时长为写入帧F1的总时长的非整数倍。图4和图8所示的驱动时序对应的刷新率均为目标低频，且该目标低频为24Hz。当显示面板的刷新率为24Hz时，可以设置24Hz的写入帧F1的总时长为60Hz下每一显示帧的总时长，且保持帧F2的总时长为写入帧F1的总时长的1.5倍，以使每个显示周期F的总时长能够满足24Hz下每一显示帧的总时长。
在其他实施例中，预设低频不限于60Hz，且目标低频也不限于24Hz，目标低频满足为低于预设低频的刷新率，且目标低频的写入帧F1的总时长为预设低频下每一显示帧的总时长，保持帧F2的总时长为写入帧F1的总时长的非整数倍即可。
结合图3和图4，或者图7和图8，可选地，像素电路还包括发光控制模块60，发光控制模块60、驱动模块10和发光元件D1串联于第一电源端和第二电源端之间，发光控制模块60的控制端接入发光控制信号EM，发光控制模块60响应发光控制信号EM而导通或关断。发光控制信号EM包括多个第二导通电平，第二导通电平用于控制发光控制模块60导通，在目标低频对应的显示周期F中：位于写入帧F1的第二导通电平的数量为n个，位于保持帧F2的第二导通电平的数量为m个，其中，n为大于或等于2的正整数，m为n的非整数倍。
具体地，第一电源端接入第一电源电压PVDD，第二电源端接入第二电源电压PVEE，在写入帧F1和保持帧F2的发光阶段中，发光控制模块60响应发光控制信号EM导通，使第一电源端和第二电源端之间形成导电通路，以通过驱动模块10根据自身控制端G的电压产生驱动电流，驱动发光元件D1发光。在写入帧F1和保持帧F2的非发光阶段中，发光控制模块60响应发光控制信号EM关断，使第一电源端和第二电源端之间无法形成导电通路，驱动模块10停止驱动发光元件D1发光。
发光控制模块60可以由薄膜晶体管构成，当发光控制模块60由P型晶体管构成时，第二导通电平为低电平，当发光控制模块60由N型晶体管构成时，第二导通电平为高电平，图4和图8均以发光控制信号EM中的第二导通电平是低电平为例进行示意。每一显示周期F的发光控制信号EM中的第二导通电平的数量，决定了发光元件D1的发光时长，当预设低频为60Hz时，在目标低频对应的显示周期F中，写入帧F1中的发光控制信号EM的第二导通电平的数量n，与60Hz下每一显示帧中的发光控制信号EM的第二导通电平的数量一致，且位于保持帧F2中的发光控制信号EM的第二导通电平的数量为m为n的非整数倍。示例性地，60Hz下每一显示帧中的发光控制信号EM的第二导通电平的数量为4个，在24Hz的目标低频对应的显示周期F中，n＝4，m＝1.5。
结合图3和图4，或者图7和图8，进一步地，在至少部分显示周期F中：发光控制信号EM包括位于写入帧F1的n个电平组和位于保持帧F2的m个电平组，每个电平组均包括第二导通电平和关断电平，关断电平用于控制发光控制模块60关断。第一扫描信号S1中的第一导通电平与发光控制信号EM中的关断电平的时序相交叠，至少一个位于保持帧F2的第一导通电平及其前一个第一导通电平的间隔时长，与n个电平组中的第二导通电平和关断电平的总时长不同，任意一个第一导通电平及其相邻的第一导通电平的间隔时长，与n个电平组中的第二导通电平和关断电平的总时长之差的绝对值小于或等于预设时长。
其中，第二导通电平和关断电平中的一者为高电平，另一者为低电平。一个显示周期F中的写入帧F1的总时长，等于n个电平组中的第二导通电平和关断电平的总时长。
当显示面板以低于预设低频的刷新率进行显示时，采用插帧的方式进行降频，也即在每一显示周期的写入帧之后插入保持帧，对于低于预设低频的部分刷新率，插入的保持帧对应的时长为写入帧对应的时长的整数倍。例如，在预设低频为60Hz，显示面板当前的刷新率为15Hz的情况下，每个显示周期的写入帧的总时长为60Hz下每一显示周期的总时长，且写入帧之后插入有保持帧，保持帧的总时长为写入帧总时长的3倍。
当显示面板以低于预设低频的目标低频进行显示时，每一显示周期F中插入的保持帧F2对应的时长为写入帧F1对应的时长的非整数倍。示例性地，预设低频下的每个显示周期F中的发光控制信号EM包括n个电平组，每个显示周期的时长即为n个电平组对应的时长，若显示面板当前的刷新率为目标低频，那么每个显示周期F的写入帧F1中的发光控制信号EM包括n个电平组，在写入帧F1的基础上，通过longV的方式增加发光控制信号EM中的电平组的数量，也即在写入帧F1之后插入保持帧F2，并设置保持帧F2中的发光控制信号EM包括m个电平组，m为n的非整数倍，也就是说，保持帧F2对应的时长为写入帧F1对应的时长的非整数倍。
示例性地，参见图4或图8，显示面板当前的刷新率为目标低频，目标低频为24Hz，预设低频为60Hz。若60Hz下每个显示周期F中的发光控制信号EM包括4个电平组，那么24Hz下每个显示周期F的写入帧F1中的发光控制信号EM包括4个电平组，保持帧F2中的发光控制信号EM包括6个电平组，保持帧F2对应的时长为写入帧F1对应的时长的非整数倍。在此基础上，通过设置第一扫描信号S1中的第一导通电平与发光控制信号EM中的关断电平的时序相交叠，能够使第一阶段t1和第二阶段t2均在非发光阶段进行，通过设置第一扫描信号S1中的至少一个位于保持帧F2的第一导通电平及其前一个第一导通电平的间隔时长，与n个电平组中的第二导通电平和关断电平的总时长不同，也即满足第一时长N1与写入帧F1的总时长不同，通过设置第一扫描信号S1中的任意一个第一导通电平及其相邻的第一导通电平的间隔时长，与n个电平组中的第二导通电平和关断电平的总时长之差的绝对值小于或等于预设时长，也即满足第二时长N2与写入帧F1的总时长之差的绝对值小于或等于预设时长。
在上述各实施例的基础上，可选地，预设时长满足：第一扫描信号S1中相邻的第一导通电平的间隔时长引起的闪烁程度为人眼无法识别的闪烁程度。
在现有技术中，结合图1和图2，扫描信号sp中相邻的低电平脉冲的间隔时长包括发光控制信号em的2个电平组的时长、4个电平组的时长及6个电平组时长，使得相邻的低电平脉冲的间隔时长差异较大，造成第一晶体管M1对驱动晶体管M0的电压状态进行调节的时间间隔不同，从而导致闪烁问题。与现有技术相比，本实施例的技术方案，通过设置第一扫描信号S1中的任意一个第一导通电平及其相邻的第一导通电平的间隔时长，与写入帧F1的总时长之差的绝对值小于或等于预设时长，且预设时长满足：第一扫描信号S1中相邻的第一导通电平的间隔时长引起的闪烁程度为人眼无法识别的闪烁程度，能够使电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔相近甚至相同，从而改善驱动模块10的电压状态发生变化的时间间隔差距过大而导致闪烁现象。
可选地，n包括2和2的正整数倍，预设时长包括写入帧F1的总时长的0.25倍。示例性地，当n＝2时，预设低频下的每个显示周期F中的发光控制信号EM包括2个电平组，目标低频下的每个显示周期F的写入帧F1的总时长对应为2个电平组的总时长，预设时长为2个电平组的总时长的0.25倍，即0.5个电平组的总时长；当n＝4时，预设低频下的每个显示周期F中的发光控制信号EM包括4个电平组，目标低频下的每个显示周期F的写入帧F1的总时长对应为4个电平组的总时长，预设时长为4个电平组的总时长的0.25倍，即1个电平组的总时长。当n取其他数值时，预设时长的计算方法可按此类推。
结合图3和图4，或者图7和图8，在一种实施例中，预设低频包括60Hz，目标低频包括24Hz，发光控制信号EM包括位于写入帧F1的4个电平组和位于保持帧F2的6个电平组。在目标低频对应的显示周期F中：第一扫描信号S1包括位于写入帧F1的一个第一导通电平，以及位于保持帧F2的一个第一导通电平，位于写入帧F1的第一导通电平与位于写入帧F1的第一个电平组中的关断电平的时序相交叠，位于保持帧F2的第一导通电平与位于保持帧F2的第二个电平组中的关断电平的时序相交叠。
本实施例中，在60Hz的预设低频的基础上，以longV的方式进行插帧降频，以满足24Hz的目标低频的显示要求。其中，写入帧F1的总时长对应为发光控制信号EM的4个电平组的总时长，在保持帧F2中，通过设置第一扫描信号S1的第一导通电平与发光控制信号EM的第二个电平组中的关断电平的时序相交叠，使得第一扫描信号S1中每相邻的两个第一导通电平的间隔时长均为发光控制信号EM的5个电平组的总时长，且第一扫描信号S1中每相邻的两个第一导通电平的间隔时长与写入帧F1的总时长之差均为1个电平组的总时长，即预设时长为1个电平组的总时长，使得电压写入模块20在第一阶段t1和第二阶段t2交替对驱动模块10的电压状态进行调节，且电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔相同，从而改善驱动模块10的电压状态发生变化的时间间隔差距过大而导致闪烁现象。
图10是本发明实施例提供的另一种像素电路的驱动时序示意图，适用于驱动图3所示的像素电路；图11是本发明实施例提供的另一种像素电路的驱动时序示意图，适用于驱动图7所示的像素电路。结合图3和图10，或者图7和图11，在另一种实施例中，预设低频包括60Hz，目标低频包括17Hz，发光控制信号EM包括位于写入帧F1的4个电平组和位于保持帧F2的10个电平组。在目标低频对应的显示周期F中：第一扫描信号S1包括位于写入帧F1的一个第一导通电平，以及位于保持帧F2的两个第一导通电平，位于写入帧F1的第一导通电平与位于写入帧F1的第一个电平组中的关断电平的时序相交叠，位于保持帧F2的第一个第一导通电平与位于保持帧F2的第一个电平组中的关断电平的时序相交叠，位于保持帧F2的第二个第一导通电平与位于保持帧F2的第六个电平组中的关断电平的时序相交叠。
示例性地，在60Hz的预设低频的基础上，以longV的方式进行插帧降频，以满足17Hz的目标低频的显示要求。其中，60Hz下每个显示周期F的总时长对应为发光控制信号EM的4个电平组的总时长，17Hz下每个显示周期F的写入帧F1的总时长对应为发光控制信号EM的4个电平组的总时长，保持帧F2的总时长对应为发光控制信号EM的10个电平组的总时长，保持帧F2的总时长为写入帧F1的总时长的非整数倍。在保持帧F2中，通过设置第一扫描信号S1的第一个第一导通电平与发光控制信号EM的第一个电平组中的关断电平的时序相交叠，第一扫描信号S1的第二个第一导通电平与发光控制信号EM的第六个电平组中的关断电平的时序相交叠，使得第一扫描信号S1中一部分相邻的第一导通电平的间隔时长均为发光控制信号EM的5个电平组的总时长，另一部分相邻的第一导通电平的间隔时长均为发光控制信号EM的4个电平组的总时长，当预设时长为1个电平组的总时长时，第一扫描信号S1中每相邻的两个第一导通电平的间隔时长与写入帧F1的总时长之差均小于或等于1个电平组的总时长，使得电压写入模块20每一次对驱动模块10的电压状态进行调节的时间间隔相近，从而改善驱动模块10的电压状态发生变化的时间间隔差距过大而导致闪烁现象。
需要说明的是，图4、图8、图10和图11分别以显示面板的刷新率为24Hz和17Hz的情况为例进行示意，在实际应用中，本发明的技术方案所适用的刷新率可包括多种，包括但不限于任意低于预设低频的目标低频，且保持帧的总时长为写入帧的总时长的非整数倍的目标低频。
本发明实施例还提供了一种像素电路，该像素电路可以由本发明任意实施例提供的像素电路的驱动方法进行驱动。结合图3和图4，该像素电路包括：
驱动模块10，用于在显示周期F驱动发光元件D1，显示周期F包括写入帧F1和保持帧F2；
电压写入模块20，连接驱动模块10的第一端，电压写入模块20的工作阶段包括至少一个第一阶段t1和至少一个第二阶段t2，第一阶段t1位于写入帧F1，第二阶段t2位于保持帧F2，电压写入模块20用于在第一阶段t1将重置电压传输至驱动模块10的第一端或控制端G，在第二阶段t2将重置电压传输至驱动模块10的第一端；
其中，至少一个第二阶段t2及其相邻的第一阶段t1或第二阶段t2的间隔时长为第一时长N1，任意一个第二阶段t2及其相邻的第一阶段t1或第二阶段t2的间隔时长为第二时长N2，在至少部分显示周期F中：第一时长N1与写入帧F1的总时长不同，第二时长N2与写入帧F1的总时长之差的绝对值小于或等于预设时长。
本发明实施例的技术方案，在每一显示周期的写入帧中的第一阶段，控制电压写入模块将重置电压传输至驱动模块的第一端或控制端，以调节驱动模块的电压状态，在每一显示周期的保持帧中的第二阶段，控制电压写入模块将重置电压传输至驱动模块的第一端，以调节驱动模块的电压状态，通过在至少部分显示周期中，设置至少一个第二阶段与其相邻的第一阶段或第二阶段的间隔时长，即第一时长，与写入帧的总时长不同，且每一个第二阶段与其相邻的第一阶段或第二阶段的间隔时长，即第二时长，与写入帧的总时长之差的绝对值小于或等于预设时长，在预设时长较短的情况下，能够使至少部分显示周期中相邻的第一阶段和第二阶段之间的时间间隔，以及相邻的两个第二阶段之间的时间间隔均相近甚至相同，也即电压写入模块每一次对驱动模块的电压状态进行调节的时间间隔相近甚至相同，有助于避免驱动模块的电压状态变化的时间间隔差距过大而导致的闪烁现象，从而优化显示效果。
结合图3和图4，在一种实施例中，可选地，第一阶段t1包括数据写入阶段，第二阶段t2包括偏置阶段，重置电压包括数据电压Data和偏置电压DVH。电压写入模块20的控制端接入第一扫描信号S1，电压写入模块20的第一端连接重置电压端，重置电压端在数据写入阶段接入数据电压Data，重置电压端S0在偏置阶段接入偏置电压DVH，电压写入模块20的第二端连接驱动模块10的第一端。电压写入模块20用于响应第一扫描信号S1在数据写入阶段导通，以将数据电压Data传输至驱动模块10的控制端G，并响应第一扫描信号S1在偏置阶段导通，以将偏置电压DVH传输至驱动模块10的第一端。
图12是本发明实施例提供的另一种像素电路的结构示意图。参见图12，在上述实施例的基础上，可选地，像素电路还包括补偿模块30、存储模块40、发光控制模块60、第一初始化模块70和第二初始化模块80。
其中，补偿模块30的控制端接入第二扫描信号S2，补偿模块30连接于驱动模块10的第二端和控制端G之间，用于对驱动模块10的阈值电压进行补偿。存储模块40的第一端连接驱动模块10的控制端G，存储模块40的第二端接入固定电压，存储模块40用于对驱动模块10的控制端G的电压进行存储。发光控制模块60、驱动模块10和发光元件D1串联于第一电源端和第二电源端之间，发光控制模块60的控制端接入发光控制信号EM，发光控制模块60响应发光控制信号EM而导通或关断。第一初始化模块70的控制端接入第四扫描信号S4，第一初始化模块70的第一端接入第一初始化电压Vref1，第一初始化模块70的第二端连接驱动模块10的控制端G，第一初始化模块70用于将第一初始化电压Vref1写入驱动模块10的控制端G。第二初始化模块80的控制端接入第三扫描信号S3，第二初始化模块80的第一端接入第二初始化电压Vref2，第二初始化模块80的第二端连接发光元件D1的第一极，第二初始化模块80用于将第二初始化电压Vref2写入发光元件D1的第一极。
进一步地，驱动模块10包括驱动晶体管DT，电压写入模块20包括第一晶体管T1，补偿模块30包括第二晶体管T2，发光控制模块60包括第三晶体管T3和第四晶体管T4，第一初始化模块70包括第五晶体管T5，第二初始化模块80包括第六晶体管T6，存储模块40包括存储电容Cst。其中，第一晶体管T1的栅极接入第一扫描信号S1，第一晶体管T1的第一极连接重置电压端，第一晶体管T1的第二极连接驱动晶体管DT的第一极。第二晶体管T2的栅极接入第二扫描信号S2，第二晶体管T2的第一极连接驱动晶体管DT的第二极，第二晶体管T2的第二极连接驱动晶体管DT的栅极。第三晶体管T3的栅极和第四晶体管T4的栅极均接入发光控制信号EM，第三晶体管T3连接于第一电源端和驱动晶体管DT的第一极之间，第四晶体管T4连接于驱动晶体管DT的第二极和发光元件D1的第一极之间。第五晶体管T5的栅极接入第四扫描信号S4，第五晶体管T5的第一极接入第一初始化电压Vref1，第五晶体管T5的第二极连接驱动晶体管DT的栅极。第六晶体管T6的栅极接入第三扫描信号S3，第六晶体管T6的第一极接入第二初始化电压Vref2，第六晶体管T6的第二极连接发光元件D1的第一极。存储电容Cst的第一极连接驱动晶体管DT的栅极，存储电容Cst的第二极接入固定电压，例如，存储电容Cst的第二极连接第一电源端，以接入第一电源电压PVDD。
结合图7和图8，在另一种实施例中，可选地，第一阶段t1包括第一偏置阶段，第二阶段t2包括第二偏置阶段，重置电压包括偏置电压DVH。电压写入模块20的控制端接入第一扫描信号S1，电压写入模块20的第一端接入偏置电压DVH，电压写入模块20的第二端连接驱动模块10的第一端。电压写入模块20用于响应第一扫描信号S1在第一偏置阶段和第二偏置阶段导通，以在第一偏置阶段和第二偏置阶段分别将偏置电压DVH传输至驱动模块10的第一端。
进一步地，像素电路还包括数据写入模块50，数据写入模块50的控制端接入第三扫描信号S3，数据写入模块50的第一端接入数据电压Data，数据写入模块50的第二端连接驱动模块10，数据写入模块50用于将数据电压Data写入驱动模块10的控制端G。图7示出了数据写入模块50的第二端连接驱动模块10的第一端，以通过数据写入模块50和补偿模块30将数据电压Data写入驱动模块10的控制端G的情况，在其他实施例中，还可以设置数据写入模块50的第二端连接驱动模块10的控制端G，以通过数据写入模块50直接将数据电压Data写入驱动模块10的控制端G。
图13是本发明实施例提供的另一种像素电路的结构示意图。参见图13，在上述实施例的基础上，可选地，驱动模块10包括驱动晶体管DT，电压写入模块20包括第一晶体管T1，数据写入模块50包括第七晶体管T7。其中，第一晶体管T1的栅极接入第一扫描信号S1，第一晶体管T1的第一极接入偏置电压DVH，第一晶体管T1的第二极连接驱动晶体管DT的第一极。第七晶体管T7的栅极接入第三扫描信号S3，第七晶体管T7的第一极接入数据电压Data，第七晶体管T7的第二极连接驱动晶体管DT的第一极或栅极。图13所示的像素电路中的其他模块及模块中的晶体管的结构与图12所示的像素电路相似，具体可参照上述实施例进行理解。
本发明实施例还提供了一种显示面板，包括本发明任意实施例中的像素电路。图14是本发明实施例提供的一种显示面板的结构示意图。参见图14，该显示面板中可包括多行像素电路100。该显示面板可以是OLED显示面板或Micro-LED显示面板等。本发明实施例提供的显示面板，包括本发明任意实施例中的像素电路，具有像素电路相应的功能模块及有益效果，这里不再赘述。
本发明实施例还提供了一种显示装置。图15是本发明实施例提供的一种显示装置的结构示意图。参见图15，本发明实施例提供的显示装置200，包括上述任意实施例中的显示面板，因此具备显示面板中相应的功能结构及有益效果，这里不再赘述。该显示装置200可以是手机，或者也可以为任何具有显示功能的电子产品，包括但不限于以下类别：电视机、笔记本电脑、桌上型显示器、平板电脑、数码相机、智能手环、智能眼镜、车载显示器、医疗设备、工控设备、触摸交互终端等，本发明实施例对此不作特殊限定。
应该理解，可以使用上面所示的各种形式的流程，重新排序、增加或删除步骤。例如，本发明中记载的各步骤可以并行地执行也可以顺序地执行也可以不同的次序执行，只要能够实现本发明的技术方案所期望的结果，本文在此不进行限制。
上述具体实施方式，并不构成对本发明保护范围的限制。本领域技术人员应该明白的是，根据设计要求和其他因素，可以进行各种修改、组合、子组合和替代。任何在本发明的精神和原则之内所作的修改、等同替换和改进等，均应包含在本发明保护范围之内。

Claims (17)

1.一种像素电路的驱动方法，其特征在于，所述像素电路包括：驱动模块和电压写入模块；所述驱动模块用于在显示周期驱动发光元件，所述显示周期包括写入帧和保持帧；所述电压写入模块连接所述驱动模块的第一端，所述电压写入模块的工作阶段包括至少一个第一阶段和至少一个第二阶段，所述第一阶段位于所述写入帧，所述第二阶段位于所述保持帧；
所述像素电路的驱动方法包括：
在所述第一阶段，控制所述电压写入模块导通，以通过所述电压写入模块将重置电压传输至所述驱动模块的第一端或控制端；
在所述第二阶段，控制所述电压写入模块导通，以通过所述电压写入模块将所述重置电压传输至所述驱动模块的第一端；
其中，至少一个所述第二阶段及其相邻的所述第一阶段或所述第二阶段的间隔时长为第一时长，任意一个所述第二阶段及其相邻的所述第一阶段或所述第二阶段的间隔时长为第二时长，在至少部分所述显示周期中：所述第一时长与所述写入帧的总时长不同，所述第二时长与所述写入帧的总时长之差的绝对值小于或等于预设时长。
2.根据权利要求1所述的像素电路的驱动方法，其特征在于，所述第一阶段包括数据写入阶段，所述第二阶段包括偏置阶段，所述重置电压包括数据电压和偏置电压；所述电压写入模块的控制端接入第一扫描信号，所述电压写入模块的第一端连接重置电压端，所述电压写入模块的第二端连接所述驱动模块的第一端；
在所述第一阶段，控制所述电压写入模块导通，以通过所述电压写入模块将重置电压传输至所述驱动模块的第一端或控制端，包括：
在所述数据写入阶段，向所述重置电压端提供数据电压，以控制所述电压写入模块响应所述第一扫描信号导通，将所述数据电压传输至所述驱动模块的控制端；
在所述第二阶段，控制所述电压写入模块导通，以通过所述电压写入模块将所述重置电压传输至所述驱动模块的第一端，包括：
在所述偏置阶段，向所述重置电压端提供偏置电压，以控制所述电压写入模块响应所述第一扫描信号导通，将所述偏置电压传输至所述驱动模块的第一端。
3.根据权利要求1所述的像素电路的驱动方法，其特征在于，所述第一阶段包括第一偏置阶段，所述第二阶段包括第二偏置阶段，所述重置电压包括偏置电压；所述电压写入模块的控制端接入第一扫描信号，所述电压写入模块的第一端接入所述偏置电压，所述电压写入模块的第二端连接所述驱动模块的第一端；
在所述第一阶段，控制所述电压写入模块导通，以通过所述电压写入模块将重置电压传输至所述驱动模块的第一端或控制端，包括：
在所述第一偏置阶段，控制所述电压写入模块响应所述第一扫描信号导通，以将所述偏置电压传输至所述驱动模块的第一端；
在所述第二阶段，控制所述电压写入模块导通，以通过所述电压写入模块将所述重置电压传输至所述驱动模块的第一端，包括：
在所述第二偏置阶段，控制所述电压写入模块响应所述第一扫描信号导通，以在所述第二偏置阶段将所述偏置电压传输至所述驱动模块的第一端。
4.根据权利要求1所述的像素电路的驱动方法，其特征在于，所述电压写入模块的控制端接入第一扫描信号，所述第一扫描信号包括至少两个第一导通电平，所述第一导通电平用于控制所述电压写入模块导通；
在至少部分所述显示周期中：所述第一扫描信号中的至少一个所述第一导通电平及其相邻的所述第一导通电平的间隔时长与所述写入帧的总时长不同，所述第一扫描信号中的任意一个所述第一导通电平及其相邻的所述第一导通电平的间隔时长与所述写入帧的总时长之差的绝对值小于或等于所述预设时长。
5.根据权利要求4所述的像素电路的驱动方法，其特征在于，每个所述显示周期中的所述写入帧位于所述保持帧之前，至少一个所述第一导通电平位于所述写入帧，且至少一个所述第一导通电平位于所述保持帧；
在至少部分所述显示周期中：至少一个位于所述保持帧的所述第一导通电平及其前一个所述第一导通电平的间隔时长与所述写入帧的总时长不同。
6.根据权利要求1所述的像素电路的驱动方法，其特征在于，所述至少部分所述显示周期包括刷新率为目标低频的所述显示周期；
所述显示周期对应的刷新率包括预设低频，所述目标低频为低于所述预设低频的刷新率，在所述目标低频对应的所述显示周期中，所述保持帧的总时长为所述写入帧的总时长的非整数倍。
7.根据权利要求6所述的像素电路的驱动方法，其特征在于，所述像素电路还包括发光控制模块，所述发光控制模块、所述驱动模块和所述发光元件串联于第一电源端和第二电源端之间，所述发光控制模块的控制端接入发光控制信号，所述发光控制模块响应所述发光控制信号而导通或关断；
所述发光控制信号包括多个第二导通电平，所述第二导通电平用于控制所述发光控制模块导通，在所述目标低频对应的所述显示周期中：位于所述写入帧的所述第二导通电平的数量为n个，位于所述保持帧的所述第二导通电平的数量为m个，其中，n为大于或等于2的正整数，m为n的非整数倍。
8.根据权利要求1-7中任一所述的像素电路的驱动方法，其特征在于，在至少部分所述显示周期中：
发光控制信号包括位于所述写入帧的n个电平组和位于所述保持帧的m个电平组，每个所述电平组均包括第二导通电平和关断电平，所述关断电平用于控制所述发光控制模块关断；
第一扫描信号中的第一导通电平与所述发光控制信号中的所述关断电平的时序相交叠，至少一个位于所述保持帧的所述第一导通电平及其前一个所述第一导通电平的间隔时长，与n个所述电平组中的所述第二导通电平和所述关断电平的总时长不同，任意一个所述第一导通电平及其相邻的所述第一导通电平的间隔时长，与n个所述电平组中的所述第二导通电平和所述关断电平的总时长之差的绝对值小于或等于所述预设时长。
9.根据权利要求8所述的像素电路的驱动方法，其特征在于，所述预设时长满足：所述第一扫描信号中相邻的所述第一导通电平的间隔时长引起的闪烁程度为人眼无法识别的闪烁程度。
10.根据权利要求9所述的像素电路的驱动方法，其特征在于，n包括2和2的正整数倍，所述预设时长包括所述写入帧的总时长的0.25倍。
11.根据权利要求8所述的像素电路的驱动方法，其特征在于，预设低频包括60Hz，目标低频包括24Hz，所述发光控制信号包括位于所述写入帧的4个所述电平组和位于所述保持帧的6个所述电平组；
在所述目标低频对应的所述显示周期中：
所述第一扫描信号包括位于所述写入帧的一个所述第一导通电平，以及位于所述保持帧的一个所述第一导通电平，位于所述写入帧的所述第一导通电平与位于所述写入帧的第一个所述电平组中的所述关断电平的时序相交叠，位于所述保持帧的所述第一导通电平与位于所述保持帧的第二个所述电平组中的所述关断电平的时序相交叠。
12.根据权利要求8所述的像素电路的驱动方法，其特征在于，预设低频包括60Hz，目标低频包括17Hz，所述发光控制信号包括位于所述写入帧的4个所述电平组和位于所述保持帧的10个所述电平组；
在所述目标低频对应的所述显示周期中：
所述第一扫描信号包括位于所述写入帧的一个所述第一导通电平，以及位于所述保持帧的两个所述第一导通电平，位于所述写入帧的所述第一导通电平与位于所述写入帧的第一个所述电平组中的所述关断电平的时序相交叠，位于所述保持帧的第一个所述第一导通电平与位于所述保持帧的第一个所述电平组中的所述关断电平的时序相交叠，位于所述保持帧的第二个所述第一导通电平与位于所述保持帧的第六个所述电平组中的所述关断电平的时序相交叠。
13.一种像素电路，其特征在于，包括：
驱动模块，用于在显示周期驱动发光元件，所述显示周期包括写入帧和保持帧；
电压写入模块，连接所述驱动模块的第一端，所述电压写入模块的工作阶段包括至少一个第一阶段和至少一个第二阶段，所述第一阶段位于所述写入帧，所述第二阶段位于所述保持帧，所述电压写入模块用于在所述第一阶段将重置电压传输至所述驱动模块的第一端或控制端，在所述第二阶段将所述重置电压传输至所述驱动模块的第一端；
其中，至少一个所述第二阶段及其相邻的所述第一阶段或所述第二阶段的间隔时长为第一时长，任意一个所述第二阶段及其相邻的所述第一阶段或所述第二阶段的间隔时长为第二时长，在至少部分所述显示周期中：所述第一时长与所述写入帧的总时长不同，所述第二时长与所述写入帧的总时长之差的绝对值小于或等于预设时长。
14.根据权利要求13所述的像素电路，其特征在于，所述第一阶段包括数据写入阶段，所述第二阶段包括偏置阶段，所述重置电压包括数据电压和偏置电压；
所述电压写入模块的控制端接入第一扫描信号，所述电压写入模块的第一端连接重置电压端，所述重置电压端在所述数据写入阶段接入所述数据电压，所述重置电压端在所述偏置阶段接入所述偏置电压，所述电压写入模块的第二端连接所述驱动模块的第一端；
所述电压写入模块用于响应所述第一扫描信号在所述数据写入阶段导通，以将所述数据电压传输至所述驱动模块的控制端，并响应所述第一扫描信号在所述偏置阶段导通，以将所述偏置电压传输至所述驱动模块的第一端。
15.根据权利要求13所述的像素电路，其特征在于，所述第一阶段包括第一偏置阶段，所述第二阶段包括第二偏置阶段，所述重置电压包括偏置电压；
所述电压写入模块的控制端接入第一扫描信号，所述电压写入模块的第一端接入所述偏置电压，所述电压写入模块的第二端连接所述驱动模块的第一端；
所述电压写入模块用于响应所述第一扫描信号在所述第一偏置阶段和所述第二偏置阶段导通，以在所述第一偏置阶段和所述第二偏置阶段分别将所述偏置电压传输至所述驱动模块的第一端。
16.一种显示面板，其特征在于，包括权利要求13-15中任一所述的像素电路。
17.一种显示装置，其特征在于，包括权利要求16所述的显示面板。
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