CN115641813A - 像素驱动电路及显示面板 - Google Patents

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Abstract

本发明提供一种像素驱动电路及一种显示面板。像素驱动电路包括幅值调控模块和脉宽调制模块，通过使幅值调控模块和脉宽调制模块均与第一节点电性连接，以分别利用脉宽调制模块和幅值调控模块配合第一数据信号和第二数据信号实现对驱动发光器件发光的驱动电流信号的有效脉冲的脉冲宽度和幅值的调节，使得驱动电流信号的有效脉冲在对应不同灰阶状态下所具有的幅值不同，且驱动电流信号的有效脉冲在对应不同灰阶状态下所具有的脉冲宽度不同，以使发光器件对应不同灰阶状态下的发光亮度和发光时长均不同，以提升发光器件的发光效率及发光均一性，可使显示画面实现显示灰阶差异。

Description

像素驱动电路及显示面板
技术领域
本发明涉及显示技术领域，具体涉及一种像素驱动电路及一种显示面板。
背景技术
在显示面板中，利用发光二极管作为子像素可以实现画面的显示。但在实现低灰阶显示时，会存在发光效率较低，亮度均一性较差的问题。
发明内容
本发明实施例提供一种像素驱动电路及一种显示面板，以改善低灰阶显示时存在的发光效率较低、亮度均一性较差的问题。
本发明实施例提供一种像素驱动电路，包括幅值调控模块和脉宽调制模块。所述脉宽调制模块与第一数据线、第一节点及调制信号源电性连接，以用于控制驱动发光器件发光的驱动电流信号的有效脉冲的脉冲宽度。所述幅值调控模块与第二数据线及所述第一节点电性连接，以用于控制所述驱动电流信号的所述有效脉冲的幅值。其中，所述驱动电流信号的所述有效脉冲在对应不同灰阶状态下所具有的所述脉冲宽度不同，且所述驱动电流信号的所述有效脉冲在对应不同灰阶状态下所具有的所述幅值不同。
本发明还提供一种显示面板，包括任一上述的像素驱动电路。
本发明提供一种像素驱动电路及一种显示面板。像素驱动电路包括幅值调控模块和脉宽调制模块。通过使幅值调控模块和脉宽调制模块均与第一节点电性连接，以分别利用脉宽调制模块和幅值调控模块配合第一数据信号和第二数据信号实现对驱动发光器件发光的驱动电流信号的有效脉冲的脉冲宽度和幅值的调节，使得驱动电流信号的有效脉冲在对应不同灰阶状态下所具有的幅值不同，且驱动电流信号的有效脉冲在对应不同灰阶状态下所具有的脉冲宽度不同，以使发光器件对应不同灰阶状态下的发光亮度和发光时长均不同，以提升发光器件的发光效率及发光均一性，可使显示画面实现显示灰阶差异。显示面板包括像素驱动电路。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1A是发光器件的发光效率随电流变化的曲线图；
图1B是现有技术的像素驱动电路结构示意图；
图2A～图2F是本发明实施例提供的像素驱动电路的结构示意图；
图3是本发明实施例提供的驱动时序图；
图4是本发明实施例提供的显示面板的结构示意图；
图5A～图5D是本发明实施例提供的像素驱动电路的结构示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。此外，应当理解的是，此处所描述的具体实施方式仅用于说明和解释本发明，并不用于限制本发明。在本发明中，在未作相反说明的情况下，使用的方位词如“上”和“下”通常是指装置实际使用或工作状态下的上和下，具体为附图中的图面方向；而“内”和“外”则是针对装置的轮廓而言的。
具体地，如图1A是发光器件的发光效率随电流变化的曲线图。由图1A可知，在低驱动电流下，发光器件的发光效率会迅速降低。因而为实现需求的发光效率就需提高驱动电流，由此会增大功耗；且低驱动电流下的亮度均一性也会更加恶化，会引起显示画面均一性较差的问题。
图1B是现有技术的像素驱动电路结构示意图，像素驱动电路包括驱动晶体管Tdr、数据写入晶体管Tda和电容C。通过控制数据线DaL传输的数据信号Data的电压伏值即可改变驱动晶体管Tdr的栅极与源极之间的压差，从而实现对驱动电流大小的控制，以此改变发光器件D的发光亮度，实现显示的灰阶差异。但采用图1B所示的像素驱动电路驱动发光器件D发光时，对应低灰阶状态下的驱动电流仍为较低的电流，因而仍无法避免出现发光效率低、亮度均一性较差的问题。
图2A～图2F是本发明实施例提供的像素驱动电路的结构示意图，本发明提供一种像素驱动电路，包括脉宽调制模块100及幅值调控模块200。
脉宽调制模块100与第一数据线DL1、第一节点Q1及调制信号源Sweep电性连接，以用于根据调制信号源Sweep生成的调制信号Sw与第一数据线DL1传输的第一数据信号Data1之间的伏值差异控制驱动发光器件D发光的驱动电流信号Id的有效脉冲的脉冲宽度。幅值调控模块200与第二数据线DL2及第一节点Q1电性连接，以用于根据第二数据线DL2传输的第二数据信号Data2控制驱动电流信号Id的有效脉冲的幅值。
通过利用幅值调控模块200使驱动电流信号Id的有效脉冲在对应不同灰阶状态下所具有的幅值不同，利用脉宽调制模块100使驱动电流信号Id的有效脉冲在对应不同灰阶状态下所具有的脉冲宽度不同，以使发光器件D在对应不同灰阶状态下的发光亮度和发光时长均不同，以提升发光器件D的发光效率及发光均一性。
可选地，幅值调控模块200和脉宽调制模块100串联于第一电源端Vdd和发光器件D之间。如脉宽调制模块100电性连接于第一电源端Vdd和第一节点Q1之间，幅值调控模块200电性连接于第一节点Q1和发光器件D的阳极之间，发光器件D的阴极与第二电源端Vss电性连接，如图2A所示；或如幅值调控模块200电性连接于第一电源端Vdd和第一节点Q1之间，脉宽调制模块100电性连接于第一节点Q1和发光器件D的阳极之间，发光器件D的阴极与第二电源端Vss电性连接，如图2B所示。
可选地，请继续参阅图2A～图2F，脉宽调制模块100包括数据转化单元101。数据转化单元101与第二节点Q2、第三节点Q3电性连接，以用于根据调制信号Sw与第一数据信号Data1之间的伏值差异生成电流驱动控制信号，并将电流驱动控制信号传输至第三节点Q3。
可选地，数据转化单元101包括电流镜单元1011。电流镜单元1011与第二节点Q2、第四节点Q4、第五节点Q5及调制信号源Sweep电性连接，以用于根据调制信号源Sweep生成的调制信号Sw与第二节点Q2接收的第一数据信号Data1之间的伏值差异输出电流脉宽调制信号，并将电流脉宽调制信号输出至第五节点Q5。
可选地，电流镜单元1011包括：第一晶体管T1、第二晶体管T2、第三晶体管T3以及第四晶体管T4。
第一晶体管T1的栅极与调制信号源Sweep电性连接，第一晶体管T1的源极和漏极电性连接于第四节点Q4和第五节点Q5之间。第二晶体管T2的栅极与第二节点Q2电性连接，第二晶体管T2的源极和漏极中的一个与第四节点Q4电性连接。第三晶体管T3的栅极与第二晶体管T2的源极和漏极中的另一个电性连接，第三晶体管T3的源极和漏极电性连接于第二晶体管T2的源极和漏极中的另一个与第三电源端Switch_L之间。第四晶体管T4的栅极与第二晶体管T2的源极和漏极中的另一个电性连接，第四晶体管T4的源极和漏极电性连接于第五节点Q5与第三电源端Switch_L之间。
可选地，第四节点Q4可接入恒定电源。可选地，数据转化单元101还包括电流源单元1012，电流源单元1012与第四节点Q4电性连接。
可选地，电流源单元包括第五晶体管T5，第五晶体管T5的栅极与第四电源端Vs电性连接，第五晶体管T5的源极和漏极电性连接于第五电源端Switch_H和第四节点Q4之间，第五晶体管T5用于将第五电源端Switch_H传输的第五电源信号传输至第四节点Q4。
可选地，第五晶体管T5为P型晶体管或N型晶体管。第五晶体管T5为硅晶体管或氧化物晶体管。进一步地，第五晶体管T5为P型晶体管。由于第五晶体管T5的栅极与源极电压差即为第四电源端Vs传输的第四电源信号与第五电源端Switch_H传输的第五电源信号之差，因而流经第五节点Q5处的电流较为稳定，有利于像素驱动电路工作。
可选地，数据转化单元101还包括信号修正单元1013。信号修正单元1013与第五节点Q5、第三节点Q3电性连接，以用于根据电流脉宽调制信号生成电流驱动控制信号，并将电流驱动控制信号传输至第三节点Q3。
可选地，信号修正单元1013包括第六晶体管T6和第七晶体管T7。第六晶体管T6的栅极与第五节点Q5电性连接，第六晶体管T6的源极和漏极电性连接于第三电源端Switch_L和第三节点Q3之间，以用于根据电流脉宽调制信号将第三电源端Switch_L传输的第三电源信号传输至第三节点Q3。第七晶体管T7的栅极与第五节点Q5电性连接，第七晶体管T7的源极和漏极电性连接于第六电源端Inv_H和第三节点Q3之间，以用于根据电流脉宽调制信号将第六电源端Inv_H传输的第六电源信号传输至第三节点Q3。第六晶体管T6和第七晶体管T7在电流脉宽调制信号的作用下，配合第三电源信号和第六电源信号生成电流驱动控制信号。
可选地，请继续参阅图2A～图2F，脉宽调制模块100还包括第一数据写入单元102，第一数据写入单元102与第一数据线DL1和第二节点Q2电性连接，以用于将第一数据信号Data1传输至第二节点Q2。
可选地，第一数据写入单元102包括第八晶体管T8，第八晶体管T8的栅极与第一控制线PWL1电性连接，第八晶体管T8的源极和漏极电性连接于第二节点Q2和第一数据线DL1之间，第八晶体管T8用于根据第一控制线PWL1传输的第一控制信号PWM(n)将第一数据线DL1传输的第一数据信号Data1传输至第二节点Q2。
可选地，第一数据写入单元还包括第一电容C1，第一电容C1串联于第二节点Q2和第二电源端Vss之间，以用于维持第二节点Q2的电位。
可选地，脉宽调制模块100还包括第一电流驱动单元103，第一电流驱动单元103与第三节点Q3、第一节点Q1及发光器件D电性连接，如图2B所示；或第一电流驱动单元103与第三节点Q3、第一节点Q1及第一电源端Vdd电性连接，如图2A所示。
可选地，第一电流驱动单元103包括第九晶体管T9，第九晶体管T9的栅极与第三节点Q3电性连接，第九晶体管T9的源极和漏极的电性连接于第一节点Q1和发光器件D之间，如图2C和图2E所示；或第九晶体管T9的源极和漏极的电性连接于第一节点Q1及第一电源端Vdd之间，如图2D和图2F所示。
可选地，请继续参阅图2A～图2F，幅值调控模块200包括第二数据写入单元201、第二电流驱动单元202、阈值电压补偿单元203、存储单元204、第一复位单元205及开关单元。
第二数据写入单元201与第二数据线DL2及第六节点Q6电性连接，用于将第二数据线DL2传输的第二数据信号Data2传输至第六节点Q6。可选地，第二数据写入单元201包括第十晶体管T10，第十晶体管T10的栅极与第二控制线PAL1电性连接，第十晶体管T10的源极和漏极电性连接于第二数据线DL2和第六节点Q6之间。第十晶体管T10用于根据第二控制线PAL1传输的第二控制信号PAM(n)将第二数据线DL2传输的第二数据信号Data2传输至第六节点Q6。
第二电流驱动单元202与第六节点Q6、第七节点Q7及第八节点Q8电性连接，用于根据第二数据信号Data2控制驱动电流信号Id的幅值。可选地，第二电流驱动单元202包括第十一晶体管T11，第十一晶体管T11的栅极与第八节点Q8电性连接，第十一晶体管T11的源极和漏极电性连接于第六节点Q6和第七节点Q7之间。
阈值电压补偿单元203与第七节点Q7和第八节点Q8电性连接，以用于将具有补偿阈值电压作用的第二数据信号Data2传输至第八节点Q8。可选地，阈值电压补偿单元203包括第十二晶体管T12，第十二晶体管T12的栅极与第二控制线PAL1电性连接，第十二晶体管T12的源极和漏极电性连接于第七节点Q7和第八节点Q8之间。
存储单元204电性连接于第一电源端Vdd和第八节点Q8之间，如图2B所示；或存储单元204电性连接于第一节点Q1和第八节点Q8之间，如图2A所示，以用于维持第八节点Q8的电位。
可选地，存储单元204包括第二电容C2，第二电容C2串联于第一电源端Vdd和第八节点Q8之间，如图2C和图2E所示；或第二电容C2串联于第一节点Q1和第八节点Q8之间，如图2D和图2F所示。
开关单元包括第一开关单元2061和第二开关单元2062。第一开关单元2061电性连接于第一电源端Vdd和第六节点Q6之间，第二开关单元2062电性连接于第七节点Q7和第一节点Q1之间，如图2B所示；或第一开关单元2061电性连接于第一节点Q1和第六节点Q6之间，第二开关单元2062电性连接于第七节点Q7和发光器件D之间，如图2A所示。
可选地，第一开关单元2061包括第十三晶体管T13，第十三晶体管T13的栅极与发光控制线EML电性连接，第十三晶体管T13的源极和漏极电性连接于第一电源端Vdd和第六节点Q6之间，如图2C和图2E所示；或第十三晶体管T13的源极和漏极电性连接于第一节点Q1和第六节点Q6之间，如图2D和图2F所示。其中，相较于第十三晶体管T13的源极和漏极电性连接于第一节点Q1和第六节点Q6之间的设计，将第十三晶体管T13的源极和漏极电性连接于第一电源端Vdd和第六节点Q6之间，可使第十一晶体管T11的栅极和源极之间的电压差更稳定，有利于实现电性的均一性设计。
第二开关单元2062包括第十四晶体管T14，第十四晶体管T14的栅极与发光控制线EML电性连接，第十四晶体管T14的源极和漏极电性连接于第七节点Q7和第一节点Q1之间，如图2C和图2E所示；或第十四晶体管T14的源极和漏极电性连接于第七节点Q7和发光器件D的阳极之间，如图2D和图2F所示。第十三晶体管T13、第十四晶体管T14及第九晶体管T9分别在发光控制信号Em(n)和电流驱动控制信号的作用下，使第一电源端Vdd至第二电源端Vss的通路中生成驱动电流信号Id。
第一复位单元205电性连接于第一复位线VL和第八节点Q8之间，以用于根据第一复位线VL传输的第一复位信号VI对第八节点Q8进行复位。可选地，第一复位单元205包括第十五晶体管T15，第十五晶体管T15的栅极与第三控制线PAL2电性连接，第十五晶体管T15的源极和漏极电性连接于第一复位线VL和第八节点Q8之间，第十五晶体管T15用于将第一复位线VL传输的第一复位信号VI传输至第八节点Q8。
可选地，像素驱动电路还包括第二复位单元300，第二复位单元300与发光器件D的阳极电性连接，以用于对发光器件D的阳极电位进行复位。
可选地，如图2E～图2F，第二复位单元300包括第十六晶体管T16，第十六晶体管T16的栅极与第一控制线PWL1电性连接，第十六晶体管T16的源极和漏极电性连接于第一节点Q1和第二电源端Vss之间。
可选地，第一电源端Vdd、第二电源端Vss、第三电源端Switch_L、第四电源端Vs、第五电源端Switch_H、第六电源端Inv_H均为直流电源端，第一复位信号VI为直流信号。其中，第一电源端Vdd传输的第一电源信号的伏值大于第二电源端Vss传输的第二电源信号的伏值，第五电源端Switch_H传输的第五电源信号的伏值大于第三电源端Switch_L传输的第三电源信号的伏值，第六电源端Inv_H传输的第六电源信号的伏值大于第三电源端Switch_L传输的第三电源信号的伏值，以使像素驱动电路可正常工作。
可选地，调制信号Sw为三角波信号。相应地，随调制信号Sw的变动，会出现第一数据信号Data1大于调制信号Sw，或第一数据信号Data1等于调制信号Sw，或第一数据信号Data1小于调制信号Sw的情况。而流经第一晶体管T1、第四晶体管T4的支路电流和流经第二晶体管T2、第三晶体管T3的支路电流分别由调制信号Sw和第二节点Q2的电位确定。因而若第一晶体管T1和第二晶体管T2均为P型晶体管，在第二节点Q2的电位大于调制信号Sw时，流经第一晶体管T1、第四晶体管T4的支路电流大于流经第二晶体管T2、第三晶体管T3的支路电流。因第一晶体管T1、第四晶体管T4所在支路和第二晶体管T2、第三晶体管T3所在支路的电阻及第三电源端Switch_L传输的第三电源信号固定，故在流经第一晶体管T1、第四晶体管T4的支路电流增大时，第四晶体管T4的源极和漏极两端的电压降增大，从而使得第五节点Q5的电位升高，第六晶体管T6随第五节点Q5的电位的升高而导通，第三电源端Switch_L传输的第三电源信号被传输至第三节点Q3。反之，在第二节点Q2的电位小于调制信号Sw时，流经第一晶体管T1、第四晶体管T4的支路电流小于流经第二晶体管T2、第三晶体管T3的支路电流。因第一晶体管T1、第四晶体管T4所在支路和第二晶体管T2、第三晶体管T3所在支路的电阻及第三电源端Switch_L传输的第三电源信号固定，故在流经第一晶体管T1、第四晶体管T4的支路电流减小时，第四晶体管T4的源极和漏极两端的电压降低，从而使得第五节点Q5的电位降低，第七晶体管T7随第五节点Q5的电位的降低而导通，第六电源端Inv_H传输的第六电源信号被传输至第三节点Q3。相应的，在第一时长内，调制信号Sw的伏值小于第一数据信号Data1的伏值，则驱动电流信号Id的有效脉冲的脉冲宽度等于第一时长。
可以理解的，若第一晶体管T1和第二晶体管T2均为N型晶体管时，则在第二节点Q2的电位小于调制信号Sw时，流经第一晶体管T1、第四晶体管T4的支路电流大于流经第二晶体管T2、第三晶体管T3的支路电流，从而使得第五节点Q5的电位升高，第六晶体管T6随第五节点Q5的电位的升高而导通，第三电源端Switch_L传输的第三电源信号被传输至第三节点Q3。在第二节点Q2的电位大于调制信号Sw时，流经第一晶体管T1、第四晶体管T4的支路电流小于流经第二晶体管T2、第三晶体管T3的支路电流，从而使得第五节点Q5的电位降低，第七晶体管T7随第五节点Q5的电位的降低而导通，第六电源端Inv_H传输的第六电源信号被传输至第三节点Q3。相应的，在第二时长内，调制信号Sw的伏值大于第一数据信号Data1的伏值，则驱动电流信号Id的有效脉冲的脉冲宽度等于第二时长。
可选地，在高灰阶状态下，驱动电流信号Id具有多个第一有效脉冲；在低灰阶状态下，驱动电流信号Id具有多个第二有效脉冲。其中，第一有效脉冲的脉冲宽度大于第二有效脉冲的脉冲宽度，第一有效脉冲的幅值小于第二有效脉冲的幅值，以使得对应高灰阶状态下的发光器件D的发光时长要长于对应低灰阶状态下的发光器件D的发光时长，且对应高灰阶状态下的发光器件D的发光亮度小于对应低灰阶状态下的发光器件D的发光亮度，从而改善低灰阶显示时存在的发光效率较低、亮度均一性较差的问题。
可选地，第一晶体管T1～第十六晶体管T16为P型晶体管或N型晶体管。第一晶体管T1～第十六晶体管T16为硅晶体管或氧化物晶体管。
图3是本发明实施例提供的驱动时序图。以第一晶体管T1、第二晶体管T2、第七晶体管T7～第十五晶体管T15均为P型晶体管，第三晶体管T3～第六晶体管T6为N型晶体管为例，对图2C所示的像素驱动电路的工作原理进行说明。其中，V1～V6分别对应表示第一电源信号～第六电源信号的伏值，V7表示第一复位信号VI的伏值；V8表示高电位，V9表示低电位；TB和TD均表示脉冲宽度；Vsh表示调制信号Sw的最大值，Vsl表示调制信号Sw的最小值。
在第一帧Frame1内，第三控制线PAL2传输的第三控制信号PAM(n-1)为低电位，第二控制线PAL1传输的第二控制信号PAM(n)、第一控制线PWL1传输的第一控制信号PWM(n)及发光控制线EML传输的发光控制信号Em(n)均为高电位时，第十五晶体管T15导通，第一复位线VL传输的第一复位信号VI被传输至第八节点Q8，以利用第一复位信号VI对第八节点Q8进行复位。
在第二控制信号PAM(n)为低电位，第三控制信号PAM(n-1)、第一控制信号PWM(n)及发光控制信号Em(n)均为高电位时，第十晶体管T10、第十一晶体管T11及第十二晶体管T12导通，第二数据线DL2传输的第二数据信号Data2(第二数据信号Data2对应具有第一电压伏值VA)经第十晶体管T10、第十一晶体管T11及第十二晶体管T12被传输至第八节点Q8。
在第一控制信号PWM(n)为低电位，第三控制信号PAM(n-1)、第二控制信号PAM(n)及发光控制信号Em(n)均为高电位时，第八晶体管T8导通，第一数据线DL1传输的第一数据信号Data1(第一数据信号Data1对应具有第二电压伏值VB)被传输至第二节点Q2。
在发光控制信号Em(n)为低电位，第三控制信号PAM(n-1)、第二控制信号PAM(n)及第一控制信号PWM(n)均为高电位时，若第二节点Q2的电位大于调制信号Sw，则流经第一晶体管T1、第四晶体管T4的支路电流大于流经第二晶体管T2、第三晶体管T3的支路电流。因第一晶体管T1、第四晶体管T4所在支路和第二晶体管T2、第三晶体管T3所在支路的电阻及第三电源端Switch_L传输的第三电源信号固定，故在流经第一晶体管T1、第四晶体管T4的支路电流增大时，第四晶体管T4的源极和漏极两端的电压降增大，从而使得第五节点Q5的电位升高，第六晶体管T6随第五节点Q5的电位的升高而导通，第三电源端Switch_L传输的第三电源信号被传输至第三节点Q3，第九晶体管T9导通，从而使得驱动电流信号Id具有有效脉冲，且在驱动电流信号Id的有效脉冲的脉冲宽度TB对应的时段内，发光器件D进入发光状态。在第二节点Q2的电位小于调制信号Sw时，流经第一晶体管T1、第四晶体管T4的支路电流小于流经第二晶体管T2、第三晶体管T3的支路电流。因第一晶体管T1、第四晶体管T4所在支路和第二晶体管T2、第三晶体管T3所在支路的电阻及第三电源端Switch_L传输的第三电源信号固定，因而在流经第一晶体管T1、第四晶体管T4的支路电流减小时，第四晶体管T4的源极和漏极两端的电压降低，从而使得第五节点Q5的电位降低，第七晶体管T7随第五节点Q5的电位的降低而导通，第六电源端Inv_H传输的第六电源信号被传输至第三节点Q3，第九晶体管T9截止，从而使得驱动电流信号Id具有无效脉冲，且在驱动电流信号Id的无效脉冲对应的时段内，发光器件D进入不发光状态。直至发光控制信号Em(n)由低电位变为高电位之前，发光器件D的发光状态随调制信号Sw与第二节点Q2的电位之间所具有的差异进入循环状态。
在第二帧Frame2内，第三控制信号PAM(n-1)为低电位，第二控制信号PAM(n)、第一控制信号PWM(n)及发光控制信号Em(n)均为高电位时，第十五晶体管T15导通，第一复位线传输的第一复位信号被传输至第八节点Q8，以利用第一复位信号对第八节点Q8进行复位。
在第二控制信号PAM(n)为低电位、第三控制信号PAM(n-1)、第一控制信号PWM(n)及发光控制信号Em(n)均为高电位时，第十晶体管T10、第十一晶体管T11及第十二晶体管T12导通，第二数据线DL2传输的第二数据信号Data2(第二数据信号Data2对应具有与第一电压伏值VA不同的第三电压伏值VC)经第十晶体管T10、第十一晶体管T11及第十二晶体管T12被传输至第八节点Q8。
在第一控制信号PWM(n)为低电位、第三控制信号PAM(n-1)、第二控制信号PAM(n)及发光控制信号Em(n)均为高电位时，第八晶体管T8导通，第一数据线DL1传输的第一数据信号Data1(第一数据信号Data1对应具有与第二电压伏值VB不同的第四电压伏值VD)被传输至第二节点Q2。
在发光控制信号Em(n)为低电位，第三控制信号PAM(n-1)、第二控制信号PAM(n)及第一控制信号PWM(n)均为高电位时，若第二节点Q2的电位大于调制信号Sw，则流经第一晶体管T1、第四晶体管T4的支路电流大于流经第二晶体管T2、第三晶体管T3的支路电流，使得第五节点Q5的电位升高，第六晶体管T6随第五节点Q5的电位的升高而导通，第三电源端Switch_L传输的第三电源信号被传输至第三节点Q3，第九晶体管T9导通，从而使得驱动电流信号Id具有有效脉冲，且在驱动电流信号Id的有效脉冲的脉冲宽度TD对应的时段内，发光器件D进入发光状态。在第二节点Q2的电位小于调制信号Sw时，流经第一晶体管T1、第四晶体管T4的支路电流小于流经第二晶体管T2、第三晶体管T3的支路电流，从而使得第五节点Q5的电位降低，第七晶体管T7随第五节点Q5的电位的降低而导通，第六电源端Inv_H传输的第六电源信号被传输至第三节点Q3，第九晶体管T9截止，从而使得驱动电流信号Id具有无效脉冲，且在驱动电流信号Id的无效脉冲对应的时段内，发光器件D进入不发光状态。直至发光控制信号Em(n)由低电位变为高电位之前，发光器件D的发光状态随调制信号Sw与第二节点Q2的电位之间所具有的差异进入循环状态。
通过在不同帧内控制第一数据线DL1所传输的第一数据信号Data1的电压伏值和第二数据线DL2所传输的第二数据信号Data2的电压伏值，可以使驱动电流信号Id的有效脉冲在不同的帧内具有不同的脉冲宽度和幅值，使得发光器件D在对应不同灰阶状态下所具有的发光时长和发光亮度均不同，从而可以实现显示灰阶差异。
可选地，对应第一帧Frame1内的灰阶状态为高灰阶状态，对应第二帧Frame2内的灰阶状态为低灰阶状态，驱动电流信号Id在第一帧Frame1内具有多个第一有效脉冲，在第二帧Frame2内具有多个第二有效脉冲。第一有效脉冲的脉冲宽度为TB，第二有效脉冲的脉冲宽度为TD，第一有效脉冲的幅值为I_A，第二有效脉冲的幅值为I_C，则TB>TD，I_A<I_C，以使得对应高灰阶状态下的发光器件D的发光时长要长于对应低灰阶状态下的发光器件D的发光时长，且对应高灰阶状态下的发光器件D的发光亮度小于对应低灰阶状态下的发光器件D的发光亮度。由于发光器件D的发光亮度正比于时间与驱动电流Id的乘积，因而使对应高灰阶状态下的发光器件D的发光时长要长于对应低灰阶状态下的发光器件D的发光时长，且对应高灰阶状态下的发光器件D的发光亮度小于对应低灰阶状态下的发光器件D的发光亮度，可以调节高灰阶和低灰阶的亮度差异，从而改善低灰阶显示时存在的发光效率较低、亮度均一性较差的问题。
此外，由于在发光控制信号Em(n)有效阶段，发光器件D会随调制信号Sw与第一节点Q1的电位之间所具有的差异进入发光状态和不发光状态的循环状态，因而，可以改善发光器件D在长时间内持续发光时存在的亮度衰减问题，还可以改善闪烁问题。其中，发光控制信号Em(n)有效阶段指可以使第十三晶体管T13和第十四晶体管T14导通的阶段。
可以理解的，在对应不同灰阶状态时，可通过调整第一控制信号PWM(n)的占空比对应调整驱动电流信号Id的有效脉冲作用时间。如在对应高灰阶状态时，将第一控制信号PWM(n)的占空比设置较高，以增大驱动电流信号Id的有效脉冲作用时间；在对应低灰阶状态时，将第一控制信号PWM(n)的占空比设置较低，以降低驱动电流信号Id的有效脉冲作用时间。可以理解的，调制信号Sw的频率、幅值均可根据实际需求进行设置。
第十六晶体管T16于第一控制线PWL1控制第八晶体管T8导通的阶段内导通，以将第二电源端Vss传输的第二电源信号传输至发光器件D的阳极，以对发光器件D的阳极电位进行复位。
图2D～图2F所示的像素驱动电路的工作原理与图2C所示的像素驱动电路的工作原理相似，在此不再进行赘述。
本发明还提供一种显示面板，包括任一上述的像素驱动电路。
图4是本发明实施例提供的显示面板的结构示意图，本发明还提供一种显示面板，包括多个像素驱动电路和多个发光器件D，多个像素驱动电路和多个发光器件D电性连接。
可选地，发光器件D的阳极与第一电源端Vdd电性连接，像素驱动电路电性连接于对应的发光器件D的阴极和第二电源端Vss之间；或，发光器件D的阴极与第二电源端Vss电性连接，像素驱动电路电性连接于对应的发光器件D的阳极和第一电源端Vdd之间。可选地，发光器件D包括有机发光二极管、次毫米发光二极管及微型发光二极管。
图5A～图5D是本发明实施例提供的像素驱动电路的结构示意图，至少一像素驱动电路包括：第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7、第八晶体管T8、第九晶体管T9、第十晶体管T10、第十一晶体管T11、第十二晶体管T12、第十三晶体管T13、第十四晶体管T14、第十五晶体管T15、第一电容C1以及第二电容C2。
第一电容C1串联于第二节点Q2和第二电源端Vss之间。第一晶体管T1的栅极与调制信号源Sweep电性连接，第一晶体管T1的源极和漏极电性连接于第四节点Q4和第五节点Q5之间；第二晶体管T2的栅极与第二节点Q2电性连接，第二晶体管T2的源极和漏极中的一个与第四节点Q4电性连接；第三晶体管T3的栅极与第二晶体管T2的源极和漏极中的另一个电性连接，第三晶体管T3的源极和漏极电性连接于第二晶体管T2的源极和漏极中的另一个与第三电源端Switch_L之间；第四晶体管T4的栅极与第二晶体管T2的源极和漏极中的另一个电性连接，第四晶体管T4的源极和漏极电性连接于第五节点Q5与第三电源端Switch_L之间；第五晶体管T5的栅极与第四电源端Vs电性连接，第五晶体管T5的源极和漏极电性连接于第五电源端Switch_H和第四节点Q4之间；第六晶体管T6的栅极与第五节点Q5电性连接，第六晶体管T6的源极和漏极电性连接于第三电源端Switch_L和第三节点Q3之间；第七晶体管T7的栅极与第五节点Q5电性连接，第七晶体管T7的源极和漏极电性连接于第六电源端Inv_H和第三节点Q3之间；第八晶体管T8的栅极与第一控制线PWL1电性连接，第八晶体管T8的源极和漏极电性连接于第二节点Q2和第一数据线DL1之间。
可选地，第九晶体管T9的栅极与第三节点Q3电性连接，第九晶体管T9的源极和漏极的电性连接于第一节点Q1和对应的发光器件D之间，如图5A和图5C所示；或第九晶体管T9的源极和漏极的电性连接于第一节点Q1和第一电源端Vdd之间，如图5B和图5D所示。
第十晶体管T10的栅极与第二控制线PAL1电性连接，第十晶体管T10的源极和漏极电性连接于第二数据线DL2和第六节点Q6之间；第十一晶体管T11的栅极与第八节点Q8电性连接，第十一晶体管T11的源极和漏极电性连接于第六节点Q6和第七节点Q7之间；第十二晶体管T12的栅极与第二控制线PAL1电性连接，第十二晶体管T12的源极和漏极电性连接于第七节点Q7和第八节点Q8之间；第十五晶体管T15的栅极与第三控制线PAL2电性连接，第十五晶体管T15的源极和漏极电性连接于第一复位线VL和第八节点Q8之间。
可选地，第十三晶体管T13的栅极和第十四晶体管T14的栅极均与发光控制线EML电性连接，第十三晶体管T13的源极和漏极电性连接于第一电源端Vdd和第六节点Q6之间，第十四晶体管T14的源极和漏极电性连接于第七节点Q7和第一节点Q1之间，第二电容C2串联于第一电源端Vdd和第八节点Q8之间，如图5A和图5C所示；或第十三晶体管T13的源极和漏极电性连接于第一节点Q1和第六节点Q6之间，第十四晶体管T14的源极和漏极电性连接于第七节点Q7和对应的发光器件D之间，第二电容C2串联于第一节点Q1和第八节点Q8之间，如图5B和图5D所示。
可选地，至少一像素驱动电路还包括第十六晶体管T16，第十六晶体管T16的栅极与第一控制线PWL1电性连接，第十六晶体管T16的源极和漏极电性连接于第一节点Q1和第二电源端Vss之间，如图5C～图5D所示。
可选地，多个发光器件D包括发光颜色不同的第一发光器件、第二发光器件和第三发光器件，多个像素驱动电路包括用于驱动第一发光器件发光的第一像素驱动电路、用于驱动第二发光器件发光的第二像素驱动电路和用于驱动第三发光器件发光的第三像素驱动电路。通过分别使与第一像素驱动电路、第二像素驱动电路和第三像素驱动电路电性连接的第一数据线DL1和第二数据线DL2传输的第一数据信号和第二数据信号具有不同的电压伏值，可使得对应同一灰阶状态下的所述第一发光器件、所述第二发光器件和所述第三发光器件的发光时长发光亮度均不同，从而可实现显示灰阶差异，改善低灰阶显示时存在的发光效率较低、亮度均一性较差的问题。
本发明还提供一种显示装置，显示装置包括任一上述的驱动电路或任一上述的显示面板。可以理解地，显示装置包括可移动显示装置(如笔记本电脑、手机等)、固定终端(如台式电脑、电视等)、测量装置(如运动手环、测温仪等)等。
本文中应用了具体个例对本发明的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本发明的方法及其核心思想；同时，对于本领域的技术人员，依据本发明的思想，在具体实施方式及应用范围上均会有改变之处，综上，本说明书内容不应理解为对本发明的限制。

Claims (15)

1.一种像素驱动电路，其特征在于，包括：
脉宽调制模块，与第一数据线、第一节点及调制信号源电性连接，用于控制驱动发光器件发光的驱动电流信号的有效脉冲的脉冲宽度；以及
幅值调控模块，与第二数据线及所述第一节点电性连接，用于控制所述驱动电流信号的所述有效脉冲的幅值；
其中，所述驱动电流信号的所述有效脉冲在对应不同灰阶状态下所具有的所述脉冲宽度不同，且所述驱动电流信号的所述有效脉冲在对应不同灰阶状态下所具有的所述幅值不同。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述调制信号源生成的调制信号为三角波信号。
3.根据权利要求2所述的像素驱动电路，其特征在于，在第一时长内，所述调制信号的伏值小于所述第一数据线传输的第一数据信号的伏值；
其中，所述脉冲宽度等于所述第一时长。
4.根据权利要求1所述的像素驱动电路，其特征在于，
在高灰阶状态下，所述驱动电流信号具有多个第一有效脉冲；在低灰阶状态下，所述驱动电流信号具有多个第二有效脉冲；
其中，所述第一有效脉冲的所述脉冲宽度大于所述第二有效脉冲的所述脉冲宽度，所述第一有效脉冲的所述幅值小于所述第二有效脉冲的所述幅值。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述幅值调控模块电性连接于第一电源端和所述第一节点之间，所述脉宽调制模块电性连接于所述第一节点和所述发光器件的阳极之间，所述发光器件的阴极与第二电源端电性连接。
6.根据权利要求5所述的像素驱动电路，其特征在于，所述脉宽调制模块包括：
第一数据写入单元，与所述第一数据线、第二节点电性连接，用于将所述第一数据线传输的第一数据信号传输至所述第二节点；
数据转化单元，与所述第二节点、第三节点电性连接，用于生成电流驱动控制信号，并将所述电流驱动控制信号传输至所述第三节点；以及
第一电流驱动单元，与所述第三节点、所述第一节点及所述发光器件电性连接，用于控制所述驱动电流信号的所述有效脉冲的所述脉冲宽度。
7.根据权利要求6所述的像素驱动电路，其特征在于，所述数据转化单元包括：
第一晶体管，所述第一晶体管的栅极与所述调制信号源电性连接，所述第一晶体管的源极和漏极电性连接于第四节点和第五节点之间；
第二晶体管，所述第二晶体管的栅极与所述第二节点电性连接，所述第二晶体管的源极和漏极中的一个与所述第四节点电性连接；
第三晶体管，所述第三晶体管的栅极与所述第二晶体管的所述源极和所述漏极中的另一个电性连接，所述第三晶体管的源极和漏极电性连接于所述第二晶体管的所述源极和所述漏极中的另一个与第三电源端之间；
第四晶体管，所述第四晶体管的栅极与所述第二晶体管的所述源极和所述漏极中的另一个电性连接，所述第四晶体管的源极和漏极电性连接于所述第五节点与所述第三电源端之间；
第五晶体管，所述第五晶体管的栅极与第四电源端电性连接，所述第五晶体管的源极和漏极电性连接于第五电源端和所述第四节点之间；
第六晶体管，所述第六晶体管的栅极与所述第五节点电性连接，所述第六晶体管的源极和漏极电性连接于第三电源端和所述第三节点之间；以及
第七晶体管，所述第七晶体管的栅极与所述第五节点电性连接，所述第七晶体管的源极和漏极电性连接于第六电源端和所述第三节点之间；
其中，所述第一电源端传输的第一电源信号的伏值大于所述第二电源端传输的第二电源信号的伏值，所述第三电源端传输的第三电源信号的伏值小于所述第五电源端传输的第五电源信号的伏值，所述第六电源端传输的第六电源信号的伏值大于所述第三电源端传输的第三电源信号的伏值。
8.根据权利要求7所述的像素驱动电路，其特征在于，所述第五晶体管为P型晶体管。
9.根据权利要求6所述的像素驱动电路，其特征在于，所述第一数据写入单元包括第八晶体管及第一电容；所述第八晶体管的栅极与第一控制线电性连接，所述第八晶体管的源极和漏极电性连接于所述第二节点和所述第一数据线之间；所述第一电容串联于所述第二节点和所述第二电源端之间；
所述第一电流驱动单元包括第九晶体管，所述第九晶体管的栅极与所述第三节点电性连接，所述第九晶体管的源极和漏极的电性连接于所述第一节点和所述发光器件之间。
10.根据权利要求1所述的像素驱动电路，其特征在于，所述幅值调控模块包括：
第二数据写入单元，与所述第二数据线、第六节点电性连接，用于将所述第二数据线传输的第二数据信号传输至所述第六节点；
第二电流驱动单元，与所述第六节点、第七节点及第八节点电性连接，用于控制所述驱动电流信号的所述有效脉冲的所述幅值；
阈值电压补偿单元，与所述第七节点和所述第八节点电性连接；
存储单元，电性连接于第一电源端和所述第八节点之间；
第一开关单元，电性连接于所述第一电源端和所述第六节点之间；
第二开关单元，电性连接于所述第七节点和所述第一节点之间；以及
第一复位单元，电性连接于第一复位线和所述第八节点之间。
11.根据权利要求10所述的像素驱动电路，其特征在于，
所述第二数据写入单元包括第十晶体管，所述第十晶体管的栅极与第二控制线电性连接，所述第十晶体管的源极和漏极电性连接于所述第二数据线和所述第六节点之间；
所述第二电流驱动单元包括第十一晶体管，所述第十一晶体管的栅极与所述第八节点电性连接，所述第十一晶体管的源极和漏极电性连接于所述第六节点和所述第七节点之间；
所述存储单元包括第二电容，所述第二电容串联于所述第一电源端和所述第八节点之间；
所述阈值电压补偿单元包括第十二晶体管，所述第十二晶体管的栅极与所述第二控制线电性连接，所述第十二晶体管的源极和漏极电性连接于所述第七节点和所述第八节点之间；
所述第一开关单元包括第十三晶体管，所述第十三晶体管的栅极与发光控制线电性连接，所述第十三晶体管的源极和漏极电性连接于所述第一电源端和所述第六节点之间；
所述第二开关单元包括第十四晶体管，所述第十四晶体管的栅极与所述发光控制线电性连接，所述第十四晶体管的源极和漏极电性连接于所述第七节点和所述第一节点之间；
所述第一复位单元包括第十五晶体管，所述第十五晶体管的栅极与第三控制线电性连接，所述第十五晶体管的源极和漏极电性连接于所述第一复位线和所述第八节点之间。
12.根据权利要求1所述的像素驱动电路，其特征在于，还包括：
第二复位单元，包括第十六晶体管，所述第十六晶体管的栅极与第一控制线电性连接，所述第十六晶体管的源极和漏极电性连接于所述第一节点和第二电源端之间。
13.根据权利要求1所述的像素驱动电路，其特征在于，所述脉宽调制模块电性连接于第一电源端和所述第一节点之间，所述幅值调控模块电性连接于所述第一节点和所述发光器件的阳极之间，所述发光器件的阴极与第二电源端电性连接。
14.一种显示面板，其特征在于，包括多个像素驱动电路和多个发光器件，多个像素驱动电路和多个所述发光器件电性连接，至少一所述像素驱动电路包括：
第一晶体管，所述第一晶体管的栅极与调制信号源电性连接，所述第一晶体管的源极和漏极电性连接于第四节点和第五节点之间；
第二晶体管，所述第二晶体管的栅极与第二节点电性连接，所述第二晶体管的源极和漏极中的一个与所述第四节点电性连接；
第三晶体管，所述第三晶体管的栅极与所述第二晶体管的所述源极和所述漏极中的另一个电性连接，所述第三晶体管的源极和漏极电性连接于所述第二晶体管的所述源极和所述漏极中的另一个与第三电源端之间；
第四晶体管，所述第四晶体管的栅极与所述第二晶体管的所述源极和所述漏极中的另一个电性连接，所述第四晶体管的源极和漏极电性连接于所述第五节点与所述第三电源端之间；
第五晶体管，所述第五晶体管的栅极与第四电源端电性连接，所述第五晶体管的源极和漏极电性连接于第五电源端和所述第四节点之间；
第六晶体管，所述第六晶体管的栅极与所述第五节点电性连接，所述第六晶体管的源极和漏极电性连接于第三电源端和第三节点之间；
第七晶体管，所述第七晶体管的栅极与所述第五节点电性连接，所述第七晶体管的源极和漏极电性连接于第六电源端和所述第三节点之间；
第八晶体管，所述第八晶体管的栅极与第一控制线电性连接，所述第八晶体管的源极和漏极电性连接于所述第二节点和第一数据线之间；
第九晶体管，所述第九晶体管的栅极与所述第三节点电性连接，所述第九晶体管的源极和漏极的电性连接于第一节点和对应的所述发光器件之间；
第十晶体管，所述第十晶体管的栅极与第二控制线电性连接，所述第十晶体管的源极和漏极电性连接于第二数据线和第六节点之间；
第十一晶体管，所述第十一晶体管的栅极与第八节点电性连接，所述第十一晶体管的源极和漏极电性连接于所述第六节点和第七节点之间；
第十二晶体管，所述第十二晶体管的栅极与所述第二控制线电性连接，所述第十二晶体管的源极和漏极电性连接于所述第七节点和所述第八节点之间；
第十三晶体管，所述第十三晶体管的栅极与发光控制线电性连接，所述第十三晶体管的源极和漏极电性连接于第一电源端和所述第六节点之间；
第十四晶体管，所述第十四晶体管的栅极与所述发光控制线电性连接，所述第十四晶体管的源极和漏极电性连接于所述第七节点和所述第一节点之间；
第十五晶体管，所述第十五晶体管的栅极与第三控制线电性连接，所述第十五晶体管的源极和漏极电性连接于第一复位线和所述第八节点之间；
第一电容，串联于所述第二节点和第二电源端之间；以及
第二电容，串联于所述第一电源端和所述第八节点之间。
15.根据权利要求14所述的显示面板，其特征在于，至少一所述像素驱动电路还包括：
第十六晶体管，所述第十六晶体管的栅极与所述第一控制线电性连接，所述第十六晶体管的源极和漏极电性连接于所述第一节点和第二电源端之间。
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