CN115223483A - 长脉冲生成电路、显示面板以及电子设备 - Google Patents

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CN115223483A CN202210905440.6A CN202210905440A CN115223483A CN 115223483 A CN115223483 A CN 115223483A CN 202210905440 A CN202210905440 A CN 202210905440A CN 115223483 A CN115223483 A CN 115223483A
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Abstract

本申请公开了一种长脉冲生成电路、显示面板以及电子设备，长脉冲生成电路包括：短脉冲生成模块，短脉冲生成模块用于输出多个短脉冲信号；短脉冲信号依时序逐一开启，且相邻开启的两个短脉冲信号的开启时段部分重叠；长脉冲生成模块，长脉冲生成模块用于基于高电平的输入信号，在短脉冲生成模块输出短脉冲信号时，持续输出长脉冲信号。本申请技术方案能够基于高电平的输入信号，在短脉冲生成模块输出短脉冲信号时，持续输出长脉冲信号，从而可以复用控制芯片输出的短脉冲信号生成所需长脉冲信号，能够降低对控制芯片信号输出引脚数量的需求。

Description

长脉冲生成电路、显示面板以及电子设备
技术领域
本申请涉及电子设备技术领域，更具体的说，涉及一种长脉冲生成电路、显示面板以及电子设备。
背景技术
随着科学技术的不断进步，越来越多的电子设备被广泛的应用于人们的日常生活以及工作当中，为人们的日常生活以及工作带来了巨大的便利，成为当今人们不可或缺的重要工具。
现有的电子设备中，为了满足人们日益增长的性能需求，需要集成多种传感器，以通过所述传感器检测对应参数，控制电子设备执行设定功能。传感器所连接的电路需要输入设定长度的脉冲信号，以控制传感器的工作状态。
由于电子设备集成度的不断提高，导致电子设备中控制芯片的信号输出引脚数量紧张，无法满足所有传感器所连接电路的脉冲信号输入需求。
发明内容
有鉴于此，本申请提供了一种长脉冲生成电路、显示面板以及电子设备，方案如下：
一种显示面板的长脉冲生成电路，包括：
短脉冲生成模块，短脉冲生成模块用于输出多个短脉冲信号；短脉冲信号依时序逐一开启，且相邻开启的两个短脉冲信号的开启时段部分重叠；
长脉冲生成模块，长脉冲生成模块用于基于高电平的输入信号，在短脉冲生成模块输出短脉冲信号时，持续输出长脉冲信号。
本申请还提供了一种显示面板，包括：
光感电路，具有第一控制端口、参考信号端口、低电平信号端口、光电信号输出端口以及多个第二控制端口；
多个上述长脉冲生成电路，第二控制端口以及第一控制端口均对应连接一长脉冲生成电路；第一控制端口输入长脉冲信号的开启时段大于第二控制端口输入长脉冲信号的开启时段；各第二控制端口依时序输入长脉冲信号，时序相邻的两个长脉冲信号不交叠；
长脉冲生成电路包括：短脉冲生成模块，短脉冲生成模块用于输出多个短脉冲信号，短脉冲信号依时序逐一开启，且相邻开启的两个短脉冲信号的开启时段部分重叠；长脉冲生成模块，长脉冲生成模块用于基于高电平的输入信号，在短脉冲生成模块输出短脉冲信号时，持续输出长脉冲信号；
其中，光感电路在第一控制端口输入的控制信号处于开启时段，且有长脉冲信号输入的时段，输出光电信号。
本申请还提供了一种电子设备，包括上述显示面板。
通过上述描述可知，本申请技术方案提供的长脉冲生成电路、显示面板以及电子设备中，长脉冲生成电路包括短脉冲生成模块和长脉冲生成模块，长脉冲生成模块能够基于高电平的输入信号，在短脉冲生成模块输出短脉冲信号时，持续输出长脉冲信号，从而可以复用控制芯片输出的短脉冲信号生成所需长脉冲信号，能够降低对控制芯片信号输出引脚数量的需求。
附图说明
为了更清楚地说明本申请实施例或相关技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据提供的附图获得其他的附图。
本说明书附图所绘示的结构、比例、大小等，均仅用以配合说明书所揭示的内容，以供熟悉此技术的人士了解与阅读，并非用以限定本申请可实施的限定条件，故不具技术上的实质意义，任何结构的修饰、比例关系的改变或大小的调整，在不影响本申请所能产生的功效及所能达成的目的下，均应仍落在本申请所揭示的技术内容得能涵盖的范围内。
图1为本申请实施例提供的一种显示面板中长脉冲生成电路的结构示意图；
图2为本申请实施例提供的一种长脉冲生成电路中长脉冲生成模块的电路图；
图3为本申请实施例提供的一种长脉冲生成模块中晶体管的布局方式示意图；
图4为本申请实施例提供的一种长脉冲生成电路中短脉冲生成模块的电路图；
图5为本申请实施例提供的另一种显示面板中长脉冲生成电路的结构示意图；
图6为本申请实施例提供的一种长脉冲生成电路的时序图；
图7为本申请实施例提供的又一种显示面板中长脉冲生成电路的结构示意图；
图8为本申请实施例提供的另一种长脉冲生成电路的时序图；
图9为本申请实施例提供的一种显示面板的结构示意图；
图10为本申请实施例提供的一种光感电路输入信号的时序图；
图11为本申请实施例提供的一种电子设备的结构示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请中的实施例进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
为使本申请的上述目的、特征和优点能够更加明显易懂，下面结合附图和具体实施方式对本申请作进一步详细的说明。
参考图1所示，图1为本申请实施例提供的一种显示面板中长脉冲生成电路的结构示意图，所示长脉冲生成电路包括：
短脉冲生成模块11，短脉冲生成模块11用于输出多个短脉冲信号SP；短脉冲信号SP依时序逐一开启，且相邻开启的两个短脉冲信号SP的开启时段部分重叠；
长脉冲生成模块12，长脉冲生成模块12用于基于高电平VGH的输入信号，在短脉冲生成模块11输出短脉冲信号SP时，持续输出长脉冲信号LP。
如图1所示，长脉冲生成模块12具有两个输入端，长脉冲生成模块12的一个输入端连接短脉冲生成模块11的输入端，以输入短脉冲信号SP，长脉冲生成模块12的另一个输入端用于输入高电平VGH的输入信号，输出端output用输出长脉冲信号LP。
可见，长脉冲生成电路包括短脉冲生成模块11和长脉冲生成模块12，长脉冲生成模块12能够基于高电平VGH的输入信号，在短脉冲生成模块11输出短脉冲信号SP时，持续输出长脉冲信号LP，从而可以复用控制芯片输出的短脉冲信号SP生成所需长脉冲信号LP，能够降低对控制芯片信号输出引脚数量的需求。
本申请实施例中，可以通过多个并行的薄膜晶体管(TFT)实现长脉冲生成模块12。此时，长脉冲生成模块12可以如图2所示。
参考图2所示，图2为本申请实施例提供的一种长脉冲生成电路中长脉冲生成模块的电路图，长脉冲生成模块12包括：多个晶体管T；
晶体管T的栅极用于输入短脉冲信号SP，不同晶体管T的栅极连接不同短脉冲信号SP的输出端；
晶体管T的第一极连接第一端口，第一端口用于接入输入信号；
晶体管T的第二极连接第二端口，第二端口为输出端output，用于输出长脉冲信号LP。
其中，晶体管T的第一极和第二极中一者为晶体管T的源极，另一者为晶体管T的漏极。
结合图1和图2所示，短脉冲生成模块11能够输出N个短脉冲信号SP，该N个短脉冲信号SP依次为短脉冲信号SP1-短脉冲信号SPN。短脉冲信号SP1-短脉冲信号SPN与长脉冲生成模块12中晶体管T的栅极一一对应连接。
长脉冲生成模块12中各个晶体管T能够依次响应短脉冲信号SP1-短脉冲信号SPN的控制，基于输入的输入信号，输出长脉冲信号LP。
本申请实施例中，通过多个并联的晶体管T实现长脉冲生成模块12，通过短脉冲生成模块11输出的多个短脉冲SP驱动并联的多个晶体管T，可以保持输出端长时间持续输出高电平VGH作为长脉冲信号LP，可以用于延迟要求小，脉冲波形稳定要求较低的传感器所连接电路。对于需要低电平VGL的长脉冲信号LP使用需求，可以以低电平VGL作为长脉冲生成模块12的输入信号，从而能够，输出低电平VGL作为长脉冲信号LP。
如图2所示长脉冲生成模块12中，将多个并联的晶体管T的第一极连接至同一节点，即各个晶体管T的第一极均连接第一端口，用于输入高电平VGH的输入信号；将多个并联的晶体管T的第二极连接至另一节点，即各个晶体管T的第二极均连接第二端口。第一端口作为长脉冲生成模块12的一个输入端，以输入高电平VGH的输入信号，第二端作为长脉冲生成模块12的输出端，以输出长脉冲LP。
参考图3所示，图3为本申请实施例提供的一种长脉冲生成模块中晶体管的布局方式示意图，显示面板中包括像素电路P，像素电路P包括多个晶体管。像素电路与显示面板的子像素连接，用于控制显示面板中子像素进行图像显示。图3中未示出像素电路中晶体管以及所连接的子像素。其中，长脉冲生成模块12中的晶体管T与像素电路中的晶体管不同，且同层设置。显示面板具有显示区AA和包围显示区AA的边框区BB。像素电路P和子像素位于显示区AA。长脉冲生成模块12位于边框区BB。
本申请实施例中，设置长脉冲生成模块12中的晶体管T与像素电路P中的晶体管不同，且同层设置，这样，无需增加制作工序，在制作像素电路P的晶体管的同时，制备长脉冲生成模块12中晶体管T，制作工艺简单，制作成本低。
显示面板可以为OLED面板或是LCD面板。如果采用OLED面板，像素电路可以为包括7个晶体管和1个存储电容的7T1C电路结构，或是8个晶体管和1个存储电容的8T1C电路结构。如果采用LCD面板，像素电路包括一个晶体管，该晶体管的栅极连接栅极扫描线，源极连接像素电极，漏极连接数据线。本申请实施例中，可以基于需求选择显示面板的类型及其像素电路，对应显示面板及其像素电路不做具体限定。
为了便于图示，图3中仅是简单示意了长脉冲生成模块12中的一个晶体管T，长脉冲生成模块12的具体电路结构可以参见图2所示。
本申请实施例中，可以通过多个并行输出的移位寄存器分别输出一个短脉冲信号SP，此时，短脉冲生成模块11可以如图4所示。
参考图4，图4为本申请实施例提供的一种长脉冲生成电路中短脉冲生成模块的电路图，短脉冲生成模块11包括多个短脉冲生成单元111，短脉冲生成单元111用于输出短脉冲信号SP。
在图4所示方式中，示出了短脉冲生成模块11中具有N个短脉冲生成单元111，N为大于1的正整数。可以基于需求设置短脉冲生成模块11中短脉冲生成单元111的数量为任意多个。
通过多个短脉冲生成单元111，可以依时序为长脉冲生成模块12输入多个短脉冲信号SP，短脉冲生成模块11结构简单，控制时序简单。短脉冲生成单元111的输出端与长脉冲生成模块12中晶体管T的栅极一一对应连接。
如图4所示，设置短脉冲生成单元111为移位寄存器VSR，如设定短脉冲生成模块11具有N个短脉冲生成单元111，则对应的具有N个移位寄存器VSR，该N个移位寄存器VSR依次为移位寄存器VSR1-VSRN，依次输出短脉冲信号SP1至SPN，对于图2所示长脉冲生成模块12，短脉冲生成单元111中各个移位寄存器VSR的输出端与长脉冲生成模块12中晶体管T的栅极一一对应连接。N为大于1的正整数。
参考图5所示，图5为本申请实施例提供的另一种显示面板中长脉冲生成电路的结构示意图，图5所示长脉冲生成电路中，具有如图2所示的长脉冲生成模块12以及图4所示短脉冲生成单元111。短脉冲生成模块11中N个短脉冲生成单元111能够依时序输出短脉冲信号SP1至SP4，用于控制长脉冲生成模块12中N个晶体管T的开关状态，以控制N个晶体管T依时序开启，基于输入信号，输出长脉冲信号LP。
参考图6所示，图6为本申请实施例提供的一种长脉冲生成电路的时序图，以图5所示电路结构为例，设定短脉冲生成单元111具有四个短脉冲生成单元111，输出的短脉冲信号依次为短脉冲信号SP1至SP4，长脉冲生成模块12能够输出长脉冲信号LP。时序上相邻的两个短脉冲信号SP之间部分交叠，如图6所示，时序上任意相邻的两个短脉冲信号SP之间存在交叠时段t，以便于形成时序上持续的长脉冲信号LP。
本申请实施例中，如图6所示，各个移位寄存器VSR输出的是短脉冲信号SP，时序上任意相邻的两个短脉冲信号SP之间存在交叠时段t，长脉冲生成电路的输出端output输出信号在SP1至SPN输出时间段内，总是处于高电平VGH，以连续输出的高电平VGH作为长脉冲信号LP。当最后一个移位寄存器VSR关闭，长脉冲生成模块12中对应的最后一个晶体管T关闭，输出端output不再有晶体管T传输高电平VGH，故输出端output将处于关闭状态，即输出电位是低电平VGL。从短脉冲生成模块11中第一个移位寄存器VSR开启至最后一个移位寄存器VSR关闭的时段内，输出端output的输出信号都是为高电平VGH。
利用移位寄存器VSR作为短脉冲生成单元111输出短脉冲信号SP，电路结构简单。而且可以和现有电路板中已有移位寄存器的制作工艺具有较高的兼容性，简化显示面板制作工艺，降低制作成本。
基于短脉冲信号SP的输出先后时序，如图5所示，设定短脉冲生成模块11中N个短脉冲生成单元111依次为第1移位寄存器VSR1-第N移位寄存器VSRN，分别对应输出第1短脉冲信号SP1-第N短脉冲信号SPN。其中，第i-1短脉冲信号SPi-1开启时刻位于第i短脉冲信号SPi开启时刻之后，i为大于1，且不大于N的正整数。
本申请实施例中，移位寄存器VSR的电路结构与常规移位寄存器的电路结构相同，本申请实施例不再赘述。
如图3所示，显示面板包括：像素电路P；扫描电路13，扫描电路13用于为像素电路P提供扫描信号；扫描电路13包括多个移位寄存器，图3中未示出扫描电路13中的移位寄存器；其中，扫描电路13中移位寄存器与作为短脉冲生成单元111的移位寄存器不同，且同层设置。扫描电路13位于边框区BB，通过栅极线gate与像素电路P连接。
基于边框区BB中的布线空间，可以设置扫描电路13中移位寄存器与作为短脉冲生成单元111的移位寄存器为显示面板的同侧边框区BB或是不同侧边框区BB，本申请实施例对此不作具体限定。
本申请实施例中，设置扫描电路13中移位寄存器与作为短脉冲生成单元111的移位寄存器不同，且同层设置，这样，无需增加制作工序，在制作设置扫描电路13中的移位寄存器的同时，制备作为短脉冲生成单元111的移位寄存器，制作工艺简单，制作成本低。
一种方式中，本申请实施例可以通过在显示面板中增加额外移位寄存器作为短脉冲生成单元111，为长脉冲生成模块12输入多个短脉冲信号SP。
为了降低边框区宽度，还可以设置短脉冲生成模块11复用扫描电路13中的部分移位寄存器作为短脉冲生成单元111，如是可以减少边框区BB中移位寄存器的数量，从而能够降低边框区BB的宽度，边缘电子设备实现窄边框设计。
显示面板中，为了便于走线布局和/或为了便于实现所需的显示驱动时序，设置扫描电路13具有至少一级虚拟移位寄存器，虚拟移位寄存器的输出端不连接栅极线gate。本申请实施例中，设置短脉冲生成模块11至少复用一级虚拟移位寄存器作为短脉冲生成单元111。这样，能够避免扫描电路13中移位寄存器同时作为短脉冲生成模块11中短脉冲生成单元111以及为像素电路P提供扫描信号，对显示驱动响应速度的影响，保证显示效果。
本申请实施例中，显示面板可以为OLED面板、LCD面板或是微型LED面板中的任一种，本申请实施例对于显示面板的类型不进行限定。
本申请实施例提供的长脉冲生成电路结构简单，可以通过拆解样品显示面板，查看样品显示面板中所采用本申请提供的长脉冲生成电路电。
上述长脉冲生成电路中，短脉冲生成模块11以及长脉冲生成模块12的实现方式不局限于本申请实施例所提供的方式，可以在本申请发明构思下进行合理的变形，如增加静电防护电路和/或补偿电路等，均属于本申请技术方案保护范围。
在上述方式中，短脉冲生成模块11输出高电平脉冲作为短脉冲信号SP，此时，适配的长脉冲生成模块12中晶体管T为NMOS，能够响应高电平脉冲控制，输出长脉冲信号LP。该方式中，适用于以NMOS构成像素电路的显示面板，显示面板中复用扫描电路13的移位寄存器VSR能够输出高电平脉冲，从而能够在制备像素电路NMOS的同时制备长脉冲生成模块12中晶体管T；而且能够复用扫描电路13的移位寄存器VSR作为短脉冲生成模块11，或是在制备扫描电路13的移位寄存器VSR的同时制备新的移位寄存器作为短脉冲生成模块11。
其他方式中，还可以如图7和图8所示，设置短脉冲生成模块11输出低电平脉冲作为短脉冲信号SP，此时，适配的长脉冲生成模块12中晶体管T为PMOS，能够响应低电平脉冲控制，输出长脉冲信号LP。该方式中，适用于以PMOS构成像素电路的显示面板，显示面板中复用扫描电路13的移位寄存器VSR能够输出低电平脉冲，从而能够在制备像素电路PMOS的同时制备长脉冲生成模块12中晶体管T；而且能够复用扫描电路13的移位寄存器VSR作为短脉冲生成模块11，或是在制备扫描电路13的移位寄存器VSR的同时制备新的移位寄存器作为短脉冲生成模块11。
参考图7和图8所示，图7为本申请实施例提供的又一种显示面板中长脉冲生成电路的结构示意图，图8为本申请实施例提供的另一种长脉冲生成电路的时序图。在图7和图8所示方式中，短脉冲生成模块11输出低电平脉冲作为短脉冲信号SP，长脉冲生成模块12中晶体管T为PMOS，短脉冲信号SP和长脉冲信号LP如图8所示。
通过上述描述可知，本申请实施例提供的长脉冲生成电路中，长脉冲生成电路包括短脉冲生成模块11和长脉冲生成模块12，长脉冲生成模块12能够基于高电平VGH的输入信号，在短脉冲生成模块11输出短脉冲信号SP时，持续输出长脉冲信号LP，从而可以复用控制芯片输出的短脉冲信号SP生成所需长脉冲信号LP，能够降低对控制芯片信号输出引脚数量的需求。例如，当显示面板中集成感光元件时，能够解决控制芯片中输出时钟信号的引脚不足以支持感光元件全部驱动需求的问题。
基于上述长脉冲生成电路实施例的描述，本申请另一实施例还提供了一种显示面板，显示面板可以如图9所示。
参考图9，图9为本申请实施例提供的一种显示面板的结构示意图，所示显示面板包括：
光感电路21，光感电路21具有第一控制端口SUP、参考信号端口、低电平信号端口、光电信号输出端口以及多个第二控制端口；图9中示出了四个第二控制端口，该四个第二控制端口依次为STEP1至STEP4；
多个如上述实施例任一种方式所述的长脉冲生成电路22，能够输出长脉冲信号LP，第二控制端口以及第一控制端口SUP均对应连接一长脉冲生成电路22；第一控制端口SUP输入长脉冲信号LP的开启时段大于第二控制端口输入长脉冲信号LP的开启时段；各第二控制端口依时序输入长脉冲信号LP，时序相邻的两个长脉冲信号LP不交叠；
长脉冲生成电路22包括：短脉冲生成模块11，短脉冲生成模块11用于输出多个短脉冲信号SP，短脉冲信号SP依时序逐一开启，且相邻开启的两个短脉冲信号SP的开启时段部分重叠；长脉冲生成模块12，长脉冲生成模块12用于基于高电平VGH的输入信号，在短脉冲生成模块11输出短脉冲信号SP时，持续输出长脉冲信号LP；
其中，光感电路21在第一控制端口SUP输入的控制信号处于开启时段，且有长脉冲信号LP输入的时段，输出光电信号。
显示面板还具有控制芯片，图9中未示出控制芯片。控制芯片位于边框BB。控制芯片和显示面板的扫描电路13连接，用于控制扫描电路13中各级移位寄存器依时序为各栅极线gate提供扫描信号。显示面板中，具有多条平行排布的栅极线gate，每条栅极线gate对应连接一行子像素所连接的像素电路。图9中未示出子像素和像素电路。
显示面板中栅极线gate的数量可以基于需求设定，图9中示出了前5行子像素所连接的栅极线gate1至gate5，依次对应连接扫描电路13中的第1级移位寄存器gate VSR1至第5级移位寄存器gate VSR5。本申请实施例对于显示面板中子像素的行数以及对应栅极线gate的条数不作限定。
需要说明的是，光感电路21的电路实现方式可以基于需求设定，本申请实施例对此不作限定。本申请实施例的发明点在于采用上述实施例中的长脉冲生成电路22为光感电路21提供所需脉冲长度的长脉冲信号，对于光感电路21的具体电路构架不作具体限定。
显示面板采用上述实施例提供的长脉冲生成电路22，能够利用显示面板中已有短脉冲信号SP生成长脉冲信号LP，从而驱动光感电路21，电路结构简单，简化了显示面板电路结构，并降低了制作成本。
本申请实施例提供的显示面板，采用上述实施例提供的长脉冲生成电路22，能够利用短脉冲信号SP生成长脉冲信号LP，具体的，能够复用控制芯片输出的短脉冲信号SP生成所需长脉冲信号LP，能够降低对控制芯片信号输出引脚数量的需求。
参考图10所示，图10为本申请实施例提供的一种光感电路输入信号的时序图，以光感电路21具有四个第二控制端口，该四个第二控制端口依次为STEP1至STEP4，该第二控制端口、第一控制端口SUP以及用输入低电平VGL的低电平信号端口时序如图10所示，在第一控制端口SUP的输入信号处于高电平VGH的开启时段，基于时序先后顺序，STEP1至STEP4依次开启，为所连接的第二控制端口输入高电平信号VGH。时序上任意相邻的两个第二控制端口的输入信号不交叠。
本申请实施例中，短脉冲生成模块11包括多个短脉冲生成单元111，短脉冲生成单元111用于输出短脉冲信号SP；短脉冲生成单元111为移位寄存器VSR。第一控制端口SUP所连接的长脉冲生成电路22具有第一数量的移位寄存器；所有第二端口所连接的长脉冲生成电路具有第二数量的移位寄存器；其中，第一数量不小于第二数量，以便于形成如图10所示的时序信号。
可以设定第一数量为8，第二数量为2，如图8所示，第二控制端口所连接的长脉冲生成电路22都是具有两个短脉冲生成单元111，即具有两个移位寄存器作为两个短脉冲生成单元111，此时第一数量为8，即第一控制端口SUP所连接的长脉冲生成电路22都是具有8个短脉冲生成单元111，即具有8个移位寄存器作为两个短脉冲生成单元111。
本申请实施例中，设置第二端口所连接的长脉冲生成电路22均具有第三数量的移位寄存器；其中，第一数量至少是第三数量的n倍，n为所述第二控制端口的数量，n是大于1的正整数。具体的，当各个第二控制端口所连接的长脉冲生成电路22具有相同数量的移位寄存器时，如果具有4个第二控制端口，则第一数量是第三数量的4倍，以便于形成如图10所示的时序图，控制光感电路21的正常工作。
需要说明的是，本申请实施例中，第一数量和第三数量的比值不局限于为上述2:8，还可以为3：12，即各个第二控制端口所连接的长脉冲生成电路22均具有3个移位寄存器，第一控制端口SUP所连接的长脉冲生成电路22具有12个移位寄存器，或上述比值可以为4:16，即各个第二控制端口所连接的长脉冲生成电路22均具有4个移位寄存器，第一控制端口SUP所连接的长脉冲生成电路22具有16个移位寄存器。可以基于需求设定该比值，只需要满足第一数量不小于第三数量的四倍即可。如果各个第二控制端口所连接的长脉冲生成电路22具有不同数量的移位寄存器，此时只需要所有第二端口所连接的长脉冲生成电路22中移位寄存器数量不大于第一控制端口SUP口所连接的长脉冲生成电路22中移位寄存器数量。
可选的，显示面板中，各个长脉冲生成电路22以及扫描电路13的移位寄存器可以同时输入控制信号STV，控制信号STV为扫描电路13的一帧画面的扫描启示信号。这样，短脉冲生成模块11中移位寄存器能够复用控制信号STV进行输出控制，无需单独增加短脉冲生成模块11中移位寄存器的开启控制信号。
显示面板中，光感电路21包括用于检测环境光的感光元件。显示面板通过控制芯片，能够对光感电路21光电信号输出端输出的光检测信号进行数据处理，基于该光检测信号确定环境光亮度，以执行与当前环境光亮度适配的功能，如自动调节屏幕亮度或是成像效果等，本申请实施例对于该功能不作限定。
基于上述实施例，本申请另一实施例还提供了一种电子设备，该电子设备可以如图11所示。
参考图11所示，图11为本申请实施例提供的一种电子设备的结构示意图，所示电子设备包括上述实施例提供的显示面板31。
电子设备可以为智能手机、平板电脑以及智能穿戴设备中的任一种具有显示功能的设备，本申请实施例对于电子设备的具体实现方式不作限定。
本申请实施例中，电子设备采用上述实施例提供的显示面板31，能够利用短脉冲信号SP生成长脉冲信号LP，具体的，能够复用控制芯片输出的短脉冲信号SP生成所需长脉冲信号LP，能够降低对控制芯片信号输出引脚数量的需求。
本说明书中各个实施例采用递进、或并列、或递进和并列结合的方式描述，每个实施例重点说明的都是与其他实施例的不同之处，各个实施例之间相同相似部分互相参见即可。对于实施例公开的显示面板和电子设备而言，由于其与实施例公开的长脉冲生成电路相对应，所以描述的比较简单，相关之处参见长脉冲生成电路对应部分说明即可。
需要说明的是，在本申请的描述中，需要理解的是，幅图和实施例的描述是说明性的而不是限制性的。贯穿说明书实施例的同样的幅图标记标识同样的结构。另外，处于理解和易于描述，幅图可能夸大了一些层、膜、面板、区域等厚度。同时可以理解的是，当诸如层、膜、区域或基板的元件被称作“在”另一元件“上”时，该元件可以直接在其他元件上或者可以存在中间元件。另外，“在…上”是指将元件定位在另一元件上或者另一元件下方，但是本质上不是指根据重力方向定位在另一元件的上侧上。
术语“上”、“下”、“顶”、“底”、“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本申请和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。当一个组件被认为是“连接”另一个组件，它可以是直接连接到另一个组件或者可能同时存在居中设置的组件。
还需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括一个……”限定的要素，并不排除在包括上述要素的物品或者设备中还存在另外的相同要素。
对所公开的实施例的上述说明，使本领域专业技术人员能够实现或使用本申请。对这些实施例的多种修改对本领域的专业技术人员来说将是显而易见的，本文中所定义的一般原理可以在不脱离本申请的精神或范围的情况下，在其它实施例中实现。因此，本申请将不会被限制于本文所示的这些实施例，而是要符合与本文所公开的原理和新颖特点相一致的最宽的范围。

Claims (13)

1.一种显示面板的长脉冲生成电路，其特征在于，包括：
短脉冲生成模块，所述短脉冲生成模块用于输出多个短脉冲信号；所述短脉冲信号依时序逐一开启，且相邻开启的两个所述短脉冲信号的开启时段部分重叠；
长脉冲生成模块，所述长脉冲生成模块用于基于高电平的输入信号，在所述短脉冲生成模块输出所述短脉冲信号时，持续输出长脉冲信号。
2.根据权利要求1所述的长脉冲生成电路，其特征在于，所述长脉冲生成模块包括：多个晶体管；
所述晶体管的栅极用于输入所述短脉冲信号，不同所述晶体管的栅极连接不同所述短脉冲信号的输出端；
所述晶体管的第一极连接第一端口，所述第一端口用于接入所述输入信号；
所述晶体管的第二极连接第二端口，所述第二端口用于输出所述长脉冲信号。
3.根据权利要求2所述的长脉冲生成电路，其特征在于，所述显示面板包括像素电路，所述像素电路包括多个晶体管；
其中，所述长脉冲生成电路中的晶体管与所述像素电路中的晶体管不同，且同层设置。
4.根据权利要求1所述的长脉冲生成电路，其特征在于，所述短脉冲生成模块包括多个短脉冲生成单元，所述短脉冲生成单元用于输出短脉冲信号。
5.根据权利要求4所述的长脉冲生成电路，所述短脉冲生成单元为移位寄存器。
6.根据权利要求5所述的长脉冲生成电路，其特征在于，所述显示面板包括：像素电路；扫描电路，所述扫描电路用于为所述像素电路提供扫描信号；所述扫描电路包括多个移位寄存器；
其中，所述扫描电路中移位寄存器与作为所述短脉冲生成单元的移位寄存器不同，且同层设置。
7.根据权利要求5所述的长脉冲生成电路，其特征在于，所述显示面板包括：像素电路；扫描电路，所述扫描电路用于为所述像素电路提供扫描信号；所述扫描电路包括多个移位寄存器；
其中，所述短脉冲生成模块复用所述扫描电路中的部分移位寄存器作为所述短脉冲生成单元。
8.根据权利要求7所述的长脉冲生成电路，其特征在于，所述扫描电路包括至少一级虚拟移位寄存器；
其中，所述短脉冲生成模块至少复用一级所述虚拟移位寄存器作为所述短脉冲生成单元。
9.一种显示面板，其特征在于，包括：
光感电路，具有第一控制端口、参考信号端口、低电平信号端口、光电信号输出端口以及多个第二控制端口；
多个如权利要求1-8任一项所述的长脉冲生成电路，第二控制端口以及所述第一控制端口均对应连接一所述长脉冲生成电路；所述第一控制端口输入长脉冲信号的开启时段大于所述第二控制端口输入长脉冲信号的开启时段；各所述第二控制端口依时序输入长脉冲信号，时序相邻的两个所述长脉冲信号不交叠；
所述长脉冲生成电路包括：短脉冲生成模块，所述短脉冲生成模块用于输出多个短脉冲信号，所述短脉冲信号依时序逐一开启，且相邻开启的两个所述短脉冲信号的开启时段部分重叠；长脉冲生成模块，所述长脉冲生成模块用于基于高电平的输入信号，在所述短脉冲生成模块输出所述短脉冲信号时，持续输出长脉冲信号；
其中，所述光感电路在所述第一控制端口输入的控制信号处于开启时段，且有所述长脉冲信号输入的时段，输出所述光电信号。
10.根据权利要求9所述的显示面板，其特征在于，所述短脉冲生成模块包括多个短脉冲生成单元，所述短脉冲生成单元用于输出短脉冲信号；所述短脉冲生成单元为移位寄存器；
所述第一控制端口所连接的长脉冲生成电路具有第一数量的移位寄存器；
所有所述第二端口所连接的长脉冲生成电路具有第二数量的移位寄存器；
其中，所述第一数量不小于所述第二数量。
11.根据权利要求9所述的显示面板，其特征在于，所述第二端口所连接的长脉冲生成电路均具有第三数量的移位寄存器；
其中，所述第一数量至少是所述第三数量的n倍，n为所述第二控制端口的数量。
12.根据权利要求9所述的显示面板，其特征在于，所述光感电路包括用于检测环境光的感光元件。
13.一种电子设备，其特征在于，包括如权利要求9-12任一项所述的显示面板。
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