CN115132875A - 一种用于减少电容的Si-PIN探测装置及方法 - Google Patents
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Abstract
本申请公开了一种用于减少电容的Si‑PIN探测装置及方法,主要涉及Si‑PIN探测技术领域,用以解决现有的Si‑PIN探测装置的等效电容影响探测装置信噪比和能量分辨率的问题。方法包括:半导体基底、第一P+区、第一N+区、PN节区;第一P+区及第一N+区都设置于半导体基底第一面;其中,第一P+区及第一N+区都为条状区域;且第一P+区及第一N+区互相嵌套;PN节区设置于半导体基底第二面。本申请通过上述方法实现了在保持原有电容面积不变的情况下,降低探测装置的有效电容,提高探测装置的能量分辨率。
Description
技术领域
本申请涉及Si-PIN探测装置技术领域,尤其涉及一种用于减少电容的Si-PIN探测装置及方法。
背景技术
Si-PIN探测装置既可用于带电粒子(电子、质子、α粒子)的探测,也可以通过射线与探测装置灵敏介质或辐射转换靶的相互作用产生次级带电粒子的探测,实现对γ射线、X射线等的探测。
目前,Si-PIN探测装置的结构一般从上到下依次为P层、I层、N层组成,正面P层为灵敏面,灵敏面周围设计P型保护环(N型基底),或者从上到下依次为N层、I层、P层组成,正面N层为灵敏面,灵敏面周围设计N型保护环(P型基底)。
但是,现有的Si-PIN探测装置:受结构限制,想要提高探测装置能量分辨率的方法主要依靠于电容中P区或N区的面积,亟需一种用于减少电容的Si-PIN探测装置及方法,以在保持原有P区或N区的面积不变的情况下,提高探测装置的能量分辨率。
发明内容
针对现有技术的上述不足,本发明提供一种用于减少电容的Si-PIN探测装置及方法,以解决上述技术问题。
第一方面,本申请实施例提供了一种用于减少电容的Si-PIN探测装置,装置包括:半导体基底、第一P+区、第一N+区、PN节区;第一P+区及第一N+区都设置于半导体基底第一面;其中,第一P+区及第一N+区都为条状区域;且第一P+区及第一N+区互相嵌套;PN节区设置于半导体基底第二面。
进一步地,PN节区为第二P+区;半导体基底第一面的第一N+区为信号输出电极。
进一步地,装置还包括:电极;电极用于施加偏转电压。
进一步地,PN节区为第二N+区;半导体基底第一面的第一P+区为信号输出电极。
进一步地,装置还包括:保护环;保护环,环绕第一P+区及第一N+区设置于半导体基底第一面。
第二方面,本申请实施例提供了一种用于减少电容的Si-PIN探测装置的方法,其特征在于,方法包括:Si-PIN探测装置包括半导体基底、第一P+区、第一N+区;其中,第一P+区和第一N+区设置于半导体基底第一面;方法包括:通过调整第一P+节区的第一面积与第一N+区的第二面积之间的比值,以获取适合的Si-PIN探测装置等效电容值;确定第一P+节区的第一形状和第一N+区的第二形状;其中,第一P+节区与第一N+区互相嵌套;根据第一形状和第二形状的大小,确定第一面积和第二面积的比值。
进一步地,Si-PIN探测装置还包括电极、第二P+区、第二N+区;其中,第二P+区或第二N+区设置于半导体基底第二面;方法还包括:当第二P+区设置于半导体基底第二面时,通过电极施加偏转电压,将半导体基底中的空穴驱赶到第一P+区;当第二N+区设置于半导体基底第二面时,通过电极施加偏转电压,将半导体基底中的电子驱赶到第一N+区。
本领域技术人员能够理解的是,本发明至少具有如下有益效果:
(1)通过将第一P+区与第一N+区互相嵌套设置在半导体基底第一面,可以明显的降低探测装置的等效电容,在同等面积的情况下,改进后的探测装置等效电容是原结构探测装置芯片的一半,因此,可以明显的提高探测装置的信噪比,提高探测装置的能量分辨率。
(2)通过控制第一P+区与第一N+区之间的面积比值,实现了根据具体需求调整面积比例,以获得需要的任意电容的探测装置。
附图说明
下面参照附图来描述本公开的部分实施例,附图中:
图1是本发明具体实施方式的剖面结构示意图。
图2是本发明具体实施方式的梳型栅极结构的结构示意图。
图3是本发明具体实施方式的同心圆型栅极结构的结构示意图。
图4是本发明具体实施方式的螺旋型栅极结构的结构示意图。
图5是本发明具体实施方式的螺旋型栅极结构的结构示意图。
图6是本发明具体实施方式的方法流程图。
附图标记列表:1、半导体基底;2、第一P+区;3、第一N+区;4、PN节区;5、保护环。
具体实施方式
本领域技术人员应当理解的是,下文所描述的实施例仅仅是本公开的优选实施例,并不表示本公开仅能通过该优选实施例实现,该优选实施例仅仅是用于解释本公开的技术原理,并非用于限制本公开的保护范围。基于本公开提供的优选实施例,本领域普通技术人员在没有付出创造性劳动的情况下所获得的其它所有实施例,仍应落入到本公开的保护范围之内。
还需要说明的是,术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含,从而使得包括一系列要素的过程、方法、商品或者设备不仅包括那些要素,而且还包括没有明确列出的其他要素,或者是还包括为这种过程、方法、商品或者设备所固有的要素。在没有更多限制的情况下,由语句“包括一个……”限定的要素,并不排除在包括要素的过程、方法、商品或者设备中还存在另外的相同要素。
下面通过附图对本申请实施例提出的技术方案进行详细的说明。
需要说明的是图2-图5均为第一P+区2及第一N+区3可行形状的列举,并不涉及实现效果的具体详述。
本申请实施例提供的一种用于减少电容的Si-PIN探测装置。本申请实施例提供的装置,主要包括:半导体基底1、第一P+区2、第一N+区3、PN节区4。
需要说明的是,半导体基底1可以为N型基底或P型基底。第一P+区2及第一N+区3都设置于半导体基底1第一面。PN节区4设置于半导体基底1第二面。其中,PN节区4可以具体为:示例一、半导体基底1为N型基底,PN节区4为N+区,半导体基底1第一面的第一P+区2为信号输出电极;示例二、半导体基底1为P型基底,PN节区4为P+区,半导体基底1第一面的第一N+区3为信号输出电极。
此外,第一P+区2及第一N+区3都为条状区域,例如,附图2中的条状区域构成的梳型的第一P+区2及第一N+区3、附图3中的条状区域构成的同心圆型的第一P+区2及第一N+区3、附图4中的条状区域构成的螺旋型的第一P+区2及第一N+区3、附图5中的条状区域构成的螺旋型的第一P+区2及第一N+区3。
此外,本实施例公开的用于减少电容的Si-PIN探测装置还可以包括:电极;电极用于施加偏转电压。
此外,本实施例公开的用于减少电容的Si-PIN探测装置还可以包括:保护环5,该保护环5,环绕第一P+区2及第一N+区3设置于半导体基底第一面。
基于前文的描述可知,本领域技术人员能够理解的是,本实施例通过将第一P+区2及第一N+区3互相嵌套设置在半导体基底1第一面,可以明显的降低探测装置的等效电容,在同等面积的情况下,改进后的探测装置等效电容是原结构探测装置芯片的一半,因此,可以明显的提高探测装置的信噪比,提高探测装置的能量分辨率。
除此之外,本申请实施例还提供了一种用于减少电容的Si-PIN探测装置的方法,其中,Si-PIN探测装置包括半导体基底、第一P+区、第一N+区;其中,第一P+区和第一N+区设置于半导体基底第一面。如图6所示,本申请实施例提供的制造方法,主要包括以下步骤:
步骤210、通过调整第一P+节区的第一面积与第一N+区的第二面积之间的比值,以获取Si-PIN探测装置等效电容值。
需要说明的是,电容值与标准比值之间的对应关系可由本领域技术人员经过多次试验获得。
步骤220、确定第一P+节区的第一形状和第一N+区的第二形状;其中,第一P+节区与第一N+区互相嵌套。
步骤230、根据第一形状和第二形状的大小,确定第一面积和第二面积的比值。
此外,本实施例公开的Si-PIN探测装置还包括电极以及第二P+区、第二N+区;其中,第二P+区或第二N+区设置于半导体基底第二面。本实施离还可以通过向第二P+区或第二N+区施加电压,以控制半导体基底中空穴或电子的移动。
作为实例地,Si-PIN探测装置还包括电极、第二P+区、第二N+区;其中,第二P+区或第二N+区设置于半导体基底第二面;当第二P+区设置于半导体基底第二面时,通过电极施加偏转电压,将半导体基底中的空穴驱赶到第一P+区;当第二N+区设置于半导体基底第二面时,通过电极施加偏转电压,将半导体基底中的电子驱赶到第一N+区。
基于前文的描述可知,本领域技术人员能够理解的是,本实施例通过控制第一P+节区与第一N+节区之间的面积比值,实现了根据具体需求调整面积比例,以获得需要的任意电容的探测装置。
至此,已经结合前文的多个实施例描述了本公开的技术方案,但是,本领域技术人员容易理解的是,本公开的保护范围并不仅限于这些具体实施例。在不偏离本公开技术原理的前提下,本领域技术人员可以对上述各个实施例中的技术方案进行拆分和组合,也可以对相关技术特征作出等同的更改或替换,凡在本公开的技术构思和/或技术原理之内所做的任何更改、等同替换、改进等都将落入本公开的保护范围之内。
Claims (7)
1.一种用于减少电容的Si-PIN探测装置,其特征在于,所述装置包括:半导体基底、第一P+区、第一N+区、PN节区;
所述第一P+区及所述第一N+区都设置于所述半导体基底第一面;其中,第一P+区及第一N+区都为条状区域;且第一P+区及第一N+区互相嵌套;
所述PN节区设置于半导体基底第二面。
2.根据权利要求1所述的用于减少电容的Si-PIN探测装置,其特征在于,
所述PN节区为第二P+区;
半导体基底第一面的第一N+区为信号输出电极。
3.根据权利要求1所述的用于减少电容的Si-PIN探测装置,其特征在于,所述装置还包括:电极;
所述电极用于施加偏转电压。
4.根据权利要求1所述的用于减少电容的Si-PIN探测装置,其特征在于,
所述PN节区为第二N+区;
半导体基底第一面的第一P+区为信号输出电极。
5.根据权利要求1所述的用于减少电容的Si-PIN探测装置,其特征在于,所述装置还包括:保护环;
所述保护环,环绕第一P+区及第一N+区设置于半导体基底第一面。
6.一种用于减少电容的Si-PIN探测装置的方法,其特征在于,所述方法包括:所述Si-PIN探测装置包括半导体基底、第一P+区、第一N+区;其中,第一P+区和第一N+区设置于半导体基底第一面;
所述方法包括:
通过调整第一P+节区的第一面积与第一N+区的第二面积之间的比值,以获取Si-PIN探测装置等效电容值;
确定第一P+节区的第一形状和第一N+区的第二形状;其中,所述第一P+节区与所述第一N+区互相嵌套;
根据所述第一形状和所述第二形状的大小,确定第一面积和第二面积的比值。
7.根据权利要求6所述的用于减少电容的Si-PIN探测装置的方法,其特征在于,所述Si-PIN探测装置还包括电极、第二P+区、第二N+区;其中,第二P+区或第二N+区设置于半导体基底第二面;
所述方法还包括:
当第二P+区设置于半导体基底第二面时,
通过电极施加偏转电压,将半导体基底中的空穴驱赶到第一P+区;
当第二N+区设置于半导体基底第二面时,
通过电极施加偏转电压,将半导体基底中的电子驱赶到第一N+区。
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