CN115035863A - 发光面板的栅极驱动电路、发光面板 - Google Patents

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Abstract

本发明公开了一种发光面板的栅极驱动电路、发光面板。栅极驱动电路包括多个电路结构相同的移位寄存器；每个移位寄存器包括移位输入端、移位输出端和至少一个内部节点；栅极驱动电路包括多组栅极信号端，栅极信号端用于向一行像素电路提供栅极驱动信号；在每组栅极信号端中，第一扫描信号输出端连接一移位寄存器的一移位输出端，第二扫描信号输出端连接一移位寄存器的一移位输出端，发光控制信号端连接一移位寄存器的内部节点，其中，发光控制信号端的脉冲占用时段，完全包含第一扫描信号输出端的脉冲占用时段及第二扫描信号输出端的脉冲占用时段。本发明能够降低栅极驱动电路的电路复杂度，降低对信号的需求。

Description

发光面板的栅极驱动电路、发光面板
技术领域
本发明涉及显示技术领域，尤其涉及一种发光面板的栅极驱动电路、发光面板。
背景技术
发光面板，如显示面板和背光面板等在现代显示技术领域有着重要的应用。发光面板中通常包含栅极驱动电路，利用栅极驱动电路为发光面板中的像素电路提供栅极驱动信号。
然而，现有的发光面板中栅极驱动电路的电路结构比较复杂，信号需求比较高。
发明内容
本发明提供了一种发光面板的栅极驱动电路、发光面板，以降低栅极驱动电路的电路复杂度，降低对信号的需求。
根据本发明的一方面，提供了一种发光面板的栅极驱动电路，所述栅极驱动电路包括多个电路结构相同的移位寄存器；
每个所述移位寄存器包括移位输入端、移位输出端和至少一个内部节点，所述内部节点的脉冲与所述移位输出端的脉冲的极性相反，且所述内部节点的脉冲占用时段，完全包含所述移位输入端的脉冲占用时段及所述移位输出端的脉冲占用时段；
所述栅极驱动电路包括多组栅极信号端，所述栅极信号端用于向一行像素电路提供栅极驱动信号；在每组栅极信号端中，第一扫描信号输出端连接一移位寄存器的一移位输出端，第二扫描信号输出端连接一移位寄存器的一移位输出端，发光控制信号端连接一移位寄存器的内部节点，其中，所述发光控制信号端的脉冲占用时段，完全包含所述第一扫描信号输出端的脉冲占用时段及所述第二扫描信号输出端的脉冲占用时段。
根据本发明的另一方面，提供了一种发光面板，所述发光面板包括发光区和至少部分围绕所述发光区的非发光区，所述非发光区中设置有栅极驱动电路，所述栅极驱动电路为上述的栅极驱动电路；所述发光区中设置有多行像素电路，所述栅极信号端与对应行的像素电路电连接。
本发明实施例的技术方案，采用的栅极驱动电路中均采用相同结构的移位寄存器，利用相应移位寄存器的内部节点输出发光控制信号，相应移位寄存器的移位输出端输出扫描信号，便可以满足像素电路的栅极驱动信号的需求，从而可以使得栅极驱动电路仅采用一种移位寄存器，极大地降低了栅极驱动电路的复杂度，对信号的需求也较少。。
应当理解，本部分所描述的内容并非旨在标识本发明的实施例的关键或重要特征，也不用于限制本发明的范围。本发明的其它特征将通过以下的说明书而变得容易理解。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明实施例提供的一种发光面板的结构示意图；
图2为本发明实施例提供的一种像素电路的电路结构示意图；
图3为本发明实施例提供的一种像素电路的时序图；
图4为本发明实施例提供的一种栅极驱动电路的电路结构示意图；
图5为本发明实施例提供的一种移位寄存器的电路结构示意图；
图6为本发明实施例提供的一种移位寄存器的时序图；
图7为本发明实施例提供的又一种移位寄存器的电路结构示意图；
图8为本发明实施例提供的一种栅极驱动电路的电路结构示意图；
图9为图8的时序图；
图10为本发明实施例提供的又一种移位寄存器的电路结构示意图；
图11为本发明实施例提供的又一种栅极驱动电路的电路结构示意图；
图12为图11的时序图；
图13为本发明实施例提供的又一种发光面板的结构示意图；
图14为本发明实施例提供的又一种发光面板的结构示意图。
具体实施方式
为了使本技术领域的人员更好地理解本发明方案，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分的实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都应当属于本发明保护的范围。
需要说明的是，本发明的说明书和权利要求书及上述附图中的术语“第一”、“第二”等是用于区别类似的对象，而不必用于描述特定的顺序或先后次序。应该理解这样使用的数据在适当情况下可以互换，以便这里描述的本发明的实施例能够以除了在这里图示或描述的那些以外的顺序实施。此外，术语“包括”和“具有”以及他们的任何变形，意图在于覆盖不排他的包含，例如，包含了一系列步骤或单元的过程、方法、系统、产品或设备不必限于清楚地列出的那些步骤或单元，而是可包括没有清楚地列出的或对于这些过程、方法、产品或设备固有的其它步骤或单元。
正如背景技术中提到的现有的发光面板中栅极驱动电路存在电路复杂度较高，对信号的需求也较高的问题。发明人经过仔细研究发现，产生此技术问题的原因在于：发光面板中的像素电路需要扫描信号和发光控制信号两种栅极驱动信号，而这两种栅极驱动信号需要两种栅极驱动电路分别提供，也即需要两种不同的移位寄存器，从而导致现有的栅极驱动电路的电路结构较为复杂，需要的信号也比较多。
针对上述技术问题，本发明提出如下解决方案：
首先对本实施例所涉及到的发光面板的结构进行介绍，图1为本发明实施例提供的一种发光面板的结构示意图，图2为本发明实施例提供的一种像素电路的电路结构示意图，图3为本发明实施例提供的一种像素电路的时序图。像素电路包括：数据写入模块101、驱动模块102、存储模块103、发光模块104、第一发光控制模块105、第二发光控制模块106、阈值补偿模块107、第一初始化模块108和第二初始化模块109。数据写入模块101的第一端接入数据电压Vdata，数据写入模块101的第二端与驱动模块102的第一端电连接，数据写入模块101的控制端接入第二扫描信号S2。第一发光控制模块105的第一端接入第一电压信号PVDD，第一发光控制模块105的第二端与驱动模块102的第一端电连接，第一发光控制模块105的控制端接入发光控制信号Emit。第二发光控制模块106的第一端与驱动模块102的第二端电连接，第二发光控制模块106的第二端与发光模块104的第一端电连接，第二发光控制模块106的控制端接入发光控制信号Emit。发光模块104的第二端接入第二电压信号PVEE。存储模块105的第一端与第一发光控制模块105的第一端电连接，存储模块105的第二端与驱动模块102的控制端电连接。阈值补偿模块107的第一端与驱动模块102的第二端电连接，阈值补偿模块107的第二端与驱动模块102的控制端电连接，阈值补偿模块107的控制端接入第二扫描信号S2。第一初始化模块108的第一端接入初始化信号Vref，第一初始化模块108的第二端与驱动模块102的控制端电连接，第一初始化模块108的控制端接入第一扫描信号S1。第二初始化模块109的第一端接入初始化信号Vref，第二初始化模块109的第二端与发光模块104的第一端电连接，第二初始化模块109的控制端接入第一扫描信号S1。数据写入模块101包括第一晶体管T1，第一晶体管T1的第一极作为数据写入模块101的第一端，第一晶体管T1的第二极作为数据写入模块101的第二端，第一晶体管T1的控制极作为数据写入模块101的控制极。驱动模块102包括第二晶体管T2，第二晶体管T2的第一极作为驱动模块102的第一端，第二晶体管T2的第二极作为驱动模块102的第二端，第二晶体管T2的控制极作为驱动模块102的控制极。第一发光控制模块105包括第三晶体管T3，第三晶体管T3的第一极作为第一发光控制模块105的第一端，第三晶体管T3的第二极作为第一发光控制模块105的第二端，第三晶体管T3的控制极作为第一发光控制模块105的控制端。第二发光控制模块106包括第四晶体管T4，第四晶体管T4的第一极作为第二发光控制模块106的第一极，第四晶体管T4的第二极作为第二发光控制模块106的第二极，第四晶体管T4的控制极作为第二发光控制模块106的控制极。发光模块104可以是OLED(有机发光二极管)、Mini-LED(迷你发光二极管)或者Micro-LED(微型发光二极管)等。存储模块103包括第一电容C1，第一电容C1的第一端作为存储模块103的第一端，第一电容C1的第二端作为存储模块103的第二端。阈值补偿模块107包括第五晶体管T5，第五晶体管T5的第一极作为阈值补偿模块107的第一端，第五晶体管T5的第二极作为阈值补偿模块107的第二端，第五晶体管T5的控制极作为阈值补偿模块107的控制端。第一初始化模块108包括第六晶体管T6，第六晶体管T6的第一极作为第一初始化模块108的第一端，第六晶体管T6的第二极作为第一初始化模块108的第二端，第六晶体管T6的控制极作为第一初始化模块108的控制端。第二初始化模块109包括第七晶体管T7，第七晶体管T7的第一极作为第二初始化模块109的第一端，第七晶体管T7的第二极作为第二初始化模块109的第二端，第七晶体管T7的控制极作为第二初始化模块109的控制端。上述的晶体管可以是N型晶体管，也可以是P型晶体管，本实施例均以P型晶体管为例进行说明。晶体管的第一极和第二极中的一个为源极，另一个为漏极，晶体管的控制极为栅极。
像素电路的驱动过程包括初始化阶段t1，数据写入阶段t2和发光阶段t3。
在初始化阶段t1，第一扫描信号S1为低电平，第二扫描信号S2和发光控制信号Emit为高电平；第六晶体管T6和第七晶体管T7导通，初始化信号Vref对发光模块104以及第二晶体管T2的控制极进行初始化，既能够避免上一帧残留信号的影响，又能够保证下一阶段第二晶体管T2能够开启。
在数据写入阶段t2，第二扫描信号S2为低电平，第一扫描信号S1和发光控制信号Emit为高电平；第六晶体管T6和第七晶体管T7关闭；第一晶体管T1、第二晶体管T2以及第五晶体管T5导通，数据电压Vdata通过第一晶体管T1、第二晶体管T2和第五晶体管T5后写入第二晶体管T2的控制极，当第二晶体管T2的控制极电压与第二极电压之差为Vth时，第二晶体管T2关闭，完成数据写入过程。其中，Vth为第二晶体管T2的阈值电压。此时第二晶体管T2控制极的电压为Vdata-Vth，该电压由第一电容C1存储。
在发光阶段t3，第一扫描信号S1和第二扫描信号S2均为高电平，发光控制信号Emit为低电平，第三晶体管T3和第四晶体管T4导通，第二晶体管T2根据其控制端的电压生成驱动电流。该驱动电流为K(PVDD-Vdata)^2，其中，K为常数。
发光面板可包括横纵交错的栅极驱动信号线(GL1-GLk，EM1-EMk)与数据线(DL1-DLn)，栅极驱动信号线用于提供对应的第一扫描信号S1、第二扫描信号S2以及发光控制信号Emit。数据驱动电路20与数据线连接，用于提供数据电压。栅极驱动信号线与本实施例提供的栅极驱动电路连接。
图4为本发明实施例提供的一种栅极驱动电路的电路结构示意图，参考图4，栅极驱动电路包括多个电路结构相同的移位寄存器201；每个移位寄存器201包括移位输入端(图中未示出)、移位输出端Gout和至少一个内部节点N1，内部节点N1的脉冲与移位输出端Gout的脉冲的极性相反，且内部节点的脉冲占用时段，完全包含移位输入端的脉冲占用时段以及移位输出端的脉冲占用时段；栅极驱动电路包括多组栅极信号端202，栅极信号端202用于向一行像素电路提供栅极驱动信号；在每组栅极信号端202中，第一扫描信号输出端连接一移位寄存器的一移位输出端，第二扫描信号输出端连接一移位寄存器的移位输出端，发光控制信号端连接一移位寄存器的内部节点，其中，发光控制信号端的脉冲占用时段，完全包含第一扫描信号输出端的脉冲占用时段以及第二扫描信号输出端的脉冲占用时段。
具体地，本实施例的栅极驱动电路中所有移位寄存器201的电路结构均相同，也即所有移位寄存器201中包含的元器件的种类、个数以及连接关系相同。移位寄存器201能够将其移位输入端输入的信号移位后经其移位输出端输出。内部节点位于移位寄存器的内部，既不是移位输入端，也不是移位输出端。内部节点的脉冲与移位输出端的脉冲的极性相反，也即若内部节点的脉冲为高电平，则移位输出端的脉冲为低电平；若内部节点的脉冲为低电平，则移位输出端的脉冲为高电平。内部节点的脉冲占用时段，完全包含移位输入端的脉冲占用时段以及移位输出端的脉冲占用时段，其含义为移位输入端的脉冲持续时间以及移位输出端的脉冲持续时间完全包含在内部节点的脉冲持续时间内。
在每组栅极信号端202中，第一扫描信号输出端用于输出第一扫描信号S1，第二扫描信号输出端用于输出第二扫描信号S2，发光控制信号输出端用于输出发光控制信号Emit。本实施例可以利用一个移位寄存器的内部节点N1输出发光控制信号，利用一个移位寄存器的移位输出端输出第一扫描信号S1，利用一个移位寄存器的移位输出端输出第二扫描信号S2，从而利用相同的移位寄存器便可以既输出扫描信号，又输出发光控制信号。不必再设计两套移位寄存器，从而可以极大地降低栅极驱动电路的复杂度，对信号的需求也比较少。
本实施例的技术方案，采用的栅极驱动电路中均采用相同结构的移位寄存器，利用相应移位寄存器的内部节点输出发光控制信号，相应移位寄存器的移位输出端输出扫描信号，便可以满足像素电路的栅极驱动信号的需求，从而可以使得栅极驱动电路仅采用一种移位寄存器，极大地降低了栅极驱动电路的复杂度，对信号的需求也较少。
从上述分析可知，本实施例的移位寄存器中，内部节点N1的脉冲占用时段需要完全包含所述移位输入端的脉冲占用时段及所述移位输出端的脉冲占用时段。以下，将对满足这一条件的几种移位寄存器做简要介绍。
图5为本发明实施例提供的一种移位寄存器的电路结构示意图，参考图5，移位寄存器包括：移位输入端IN、移位输出端Gout、第一输出模块2011、第一节点N1、第二节点N2b以及节点控制模块2012；第一输出模块2011用于根据第一节点N1的电位将第一电源信号VGH输出至移位输出端Gout，根据第二节点N2b的电位将第一时钟信号OUT输出至移位输出端Gout；移位输入端IN、第一节点N1及第二节点N2均与节点控制模块2012连接，节点控制模块2012用于控制第一节点N1及第二节点N2b的电位；其中，内部节点为第一节点N1。需要说明的是，图5中的移位输入端IN需要通过一个控制模块(例如后续描述的扫描控制模块)连接到第三节点N2a，本实施例仅用于描述出第一输出模块2011、第一节点N1、第二节点N2b以及节点控制模块2012之间的关系。
具体地，图6为本发明实施例提供的一种移位寄存器的时序图，图6与图5对应，结合图5和图6，第一输出模块2011包括第八晶体管T8和第九晶体管T9；节点控制模块2012包括第十晶体管T10、第十一晶体管T11和第十二晶体管T12；移位寄存器还包括第二电容C2、第三电容C3以及第十三晶体管T13。移位寄存器中各元件的连接关系为：第八晶体管T8的第一极接入第一电源信号VGH，第八晶体管T8的第二极与移位输出端Gout电连接，第八晶体管T8的控制极与第一节点N1电连接；第九晶体管T9的第一极接入第一时钟信号OUT，第九晶体管T9的第二极与移位输出端Gout电连接，第九晶体管T9的控制极与第二节点N2b电连接。第二电容C2的第一端与第八晶体管T8的第一端电连接，第二电容C2的第二端与第八晶体管T8的控制极电连接。第三电容C3的第一端与移位输出端Gout电连接，第三电容C3的第二端与第九晶体管T9的控制极电连接。第十晶体管T10的第一极与移位输入端IN电连接，第十晶体管T10的第二极与第八晶体管T8的第一极电连接，第十晶体管T10的控制极与第一节点N1电连接。第十一晶体管T11的第一极与第八晶体管T8的第一极电连接，第十一晶体管T11的第二极与第一节点N1电连接，第十一晶体管T11的控制极与第三节点N2a电连接。其中，第三节点N2a与移位输入端IN电连接。第十二晶体管T12的第一极与第三节点N2a电连接，第十二晶体管T12的第二极与第二节点N2b电连接，第十二晶体管T12的控制极接入第二电源信号VGL。第十三晶体管T13的第一极接入第二电源信号VGL，第十三晶体管T13的第二极与第一节点N1电连接，第十三晶体管T13的控制极接入复位时钟信号CLK。在第一阶段a1，移位输入端IN输入低电平信号，第二节点N2b和第三节点N2a被置低，同时第十一晶体管T11导通，使得第一节点N1置高。在第二阶段a2，移位输入端IN输入高电平信号，移位输入端IN的信号被控制模块(扫描控制模块，图5中未示出)关断，无法输入到第三节点N2a，同时由于第三电容C3两端电压不能突变，在第一阶段a1时C3两端电压为高电平的Gout与低电平的IN之差，在第二阶段a2时，Gout变为低电平，第二节点N2b被进一步拉低，使得第九晶体管T9导通程度加深，更有利于移位输出端Gout输出低电平信号。在第三阶段a3，复位时钟信号CLK(图6中为RSTF)为低电平，使得第十三晶体管T13导通，从而将第一节点N1拉低。
从图6的时序图中可以看出，在移位输入端IN的信号跳变为低电平时，第一节点N1跳变为高电平；在移位输出端Gout跳变为高电平后，第一节点N1跳变为低电平。也即第一节点N1的脉冲占用时段，完全包含了移位输入端IN的脉冲占用时段以及移位输出端的脉冲占用时段。也即图5所示的移位寄存器可以满足本实施例所描述的栅极驱动电路的需求。
进一步地，图7为本发明实施例提供的又一种移位寄存器的电路结构示意图，参考图7，移位输入端包括正扫输入端S<N-1>和反扫输入端S<N+1>，移位寄存器还包括：扫描控制模块，移位输入端通过扫描控制模块与节点控制模块连接，扫描控制模块用于响应正扫输入端的导通电平，将正扫控制信号端的信号U2D提供给第二节点N2b，以及响应反扫输入端的导通电平，将反扫控制信号端D2U的信号提供给第二节点N2b；复位模块，用于响应单级复位信号的导通电平，对第一节点N1进行复位，并响应全局复位信号的导通电平，对移位输出端S<N>复位。
具体地，扫描控制模块可包括第十四晶体管T14、第十五晶体管T15、第十六晶体管T16以及第十七晶体管T17；复位模块包括第十八晶体管T18、第十九晶体管T19以及第二十晶体管T20；第十四晶体管T14的第一极与第三节点N2a电连接，第十四晶体管T14的第二极与正扫控制信号端U2D电连接，第十四晶体管T14的控制极与正扫输入端电连接。第十五晶体管T15的第一极与第三节点N2a电连接，第十五晶体管T15的第二极与反扫控制信号端D2U电连接，第十五晶体管T15的控制极与反扫输入端电连接。第十六晶体管T16的第一极与第十三晶体管T13的控制极电连接，第十六晶体管T16的第二极接入第二时钟信号RSTF，第十六晶体管T16的控制极与正扫控制信号端U2D电连接。第十七晶体管T17的第一极与第十三晶体管T13的控制极电连接，第十七晶体管T17的第二极接入第三时钟信号RSTB，第十七晶体管T17的控制极与反扫控制信号端D2U电连接。第十八晶体管T18的第一极接入第一电源信号VGH，第十八晶体管T18的第二极与第一节点N1电连接，第十八晶体管T18的控制极接入单级复位信号GAS。第十九晶体管T19的第一极接入第二电源信号VGL，第十九晶体管T19的第二极与第二十晶体管T20的第一极电连接，且第十九晶体管T19的第二极连接到移位输出端S<N>，第十九晶体管T19的控制极接入单级复位信号GAS。第二十晶体管T20的第二极接入第一电源信号VGH，第二十晶体管T20的控制极接入全局复位信号GRESET。本实施例的移位寄存器增加了正扫功能和反扫功能，通过扫描控制模块实现正扫和反扫。移位寄存器正扫和反扫的具体工作过程为本领域技术人员所熟知，在此不再赘述。
在上述的移位寄存器中，每个移位寄存器均包括一个移位输入端和一个移位输出端；级联方式可以如图8所示，图8为本发明实施例提供的一种栅极驱动电路的电路结构示意图；在每组栅极信号端中，第一扫描信号输出端为级联的两级移位寄存器中，前一级移位寄存器的移位输出端；第二扫描信号输出端为级联的两级移位寄存器中，后一级移位寄存器的移位输出端；发光控制信号端为预设移位寄存器的内部节点。在本实施例中，级联的两级移位寄存器对应的输出信号为移位关系，因此可以作为第一扫描信号S1和第二扫描信号S2，预设移位寄存器为栅极驱动电路中内部节点的脉冲满足对应的栅极信号端中发光控制信号端的脉冲需求。
示例性地，如图8所示，栅极驱动电路包括第一移位寄存器组和第二移位寄存器组，第一移位寄存器组中级联的多个移位寄存器设为第一移位寄存器201a，第二移位寄存器组中级联的多个移位寄存器设为第二移位寄存器组201b。在第k组栅极信号端中，第一扫描信号端为第一移位寄存器组中第k级移位寄存器的移位输出端；第二扫描信号端为第一移位寄存器组中第k+1级移位寄存器的移位输出端；发光控制信号输出端为第二移位寄存器组中第k+1级移位寄存器的内部节点；k≥1。
具体地，在每组移位寄存器组中，第一级移位寄存器的移位输入端用于输入触发脉冲STV；第m级移位寄存器的移位输出端Gout与第m+1级移位寄存器的移位输入端电连接。图9为图8的时序图，结合图8和图9，栅极驱动电路的时钟信号分别由第一时钟信号线CKV1至第八时钟信号线CKV8提供；第一移位寄存器组中，第4n-3个移位寄存器的RSTB端与第一时钟信号线CKV1电连接，第4n-3个移位寄存器的OUT端与第二时钟信号线CKV2电连接，第4n-3个移位寄存器的RSTF端与第三时钟信号线CKV3电连接。第4n-2个移位寄存器的RSTB端与第二时钟信号线CKV2电连接，第4n-2个移位寄存器的OUT端与第三时钟信号线CKV3电连接，第4n-2个移位寄存器的RSTF端与第四时钟信号线CKV4电连接。第4n-1个移位寄存器的RSTB端与第三时钟信号线CKV3电连接，第4n-1个移位寄存器的OUT端与第四时钟信号线CKV4电连接，第4n-1个移位寄存器的RSTF端与第一时钟信号线CKV1电连接。第4n个移位寄存器的RSTB端与第四时钟信号线CKV4电连接，第4n个移位寄存器的OUT端与第一时钟信号线CKV1电连接，第4n个移位寄存器的RSTF端与第二时钟信号线CKV2电连接。
第二移位寄存器组中，第4n-3个移位寄存器的RSTB端与第五时钟信号线CKV5电连接，第4n-3个移位寄存器的OUT端与第六时钟信号线CKV6电连接，第4n-3个移位寄存器的RSTF端与第七时钟信号线CKV7电连接。第4n-2个移位寄存器的RSTB端与第六时钟信号线CKV6电连接，第4n-2个移位寄存器的OUT端与第七时钟信号线CKV7电连接，第4n-2个移位寄存器的RSTF端与第八时钟信号线CKV8电连接。第4n-1个移位寄存器的RSTB端与第七时钟信号线CKV7电连接，第4n-1个移位寄存器的OUT端与第八时钟信号线CKV8电连接，第4n-1个移位寄存器的RSTF端与第五时钟信号线CKV5电连接。第4n个移位寄存器的RSTB端与第八时钟信号线CKV8电连接，第4n个移位寄存器的OUT端与第五时钟信号线CKV5电连接，第4n个移位寄存器的RSTF端与第六时钟信号线CKV6电连接。在以上所述中，n为大于等于1的整数。
在上述实施例中，第一移位寄存器组用于输出扫描信号，第二移位寄存器组用于输出发光控制信号。且第一移位寄存器组和第二移位寄存器组中各级移位寄存器的结构均相同。第二组移位寄存器中，第一级移位寄存器的内部节点输出为dum1，也即不用于输出发光控制信号；从第二级移位寄存器开始，每级移位寄存器的内部节点均作为一个栅极信号端中的发光控制信号输出端。
可选地，在移位寄存器中，内部节点的脉冲起始时刻与移位输入端的脉冲起始时刻相同；移位寄存器还包括多个用于输入时钟信号的时钟信号输入端；在同一帧时间内，第二移位寄存器组中第m级移位寄存器的时钟信号输入端的时钟信号的起始时刻，早于第一移位寄存器组中第m级移位寄存器对应时钟信号输入端的时钟信号的起始时刻；m大于等于1。
具体地，在图7所示的移位寄存器中，第一节点N1的电位受移位输入端的控制，当移位输入端的脉冲起始时刻到来时，第一节点N1的脉冲起始时刻也到来；在本实施例中，通过上述的时钟先后顺序的设置，可以使得第二组移位寄存器中第一节点N1的脉冲到来时刻，早于对应的第一移位寄存器组中移位寄存器的移位输出端的脉冲到来时刻。也即在图8中，Emit1的脉冲起始时刻，要早于第一扫描信号S1的脉冲起始时刻，这样设置，在第一扫描信号S1、第二扫描信号S2和发光控制信号Emit1组成的一组栅极控制信号中，发光控制信号Emit1先跳变，第一扫描信号S1后跳变，从而保证像素电路中初始化阶段到来时，发光模块已经被完全关断。
进一步地，在移位寄存器中，移位寄存器包括用于输入第一时钟信号的第一时钟端和用于输入第二时钟信号的第二时钟端。在同一帧内，第一时钟信号的结束时刻，与移位寄存器的移位输出端的结束时刻相同；内部节点的脉冲结束时刻，与第二时钟信号的脉冲起始时刻相同。在同一帧时间内，第一移位寄存器组的第n级移位寄存器中第一时钟信号的结束时刻，早于第二移位寄存器组中第n级移位寄存器中第二时钟信号的起始时刻。
具体地，在图7所示的移位寄存器中，第一时钟端也即OUT，第二时钟端在正扫时为RSTF，第二时钟端在反扫时为RSTB。内部节点N1的脉冲结束时刻受第二时钟信号的控制，也即当第二时钟信号的脉冲到来时，内部节点的脉冲结束。此时可设置第一移位寄存器组的第n级移位寄存器中第一时钟信号的结束时刻，早于第二移位寄存器组中第n级移位寄存器中第二时钟信号的起始时刻，可以保证发光控制信号的脉冲结束时刻，晚于对应的第二扫描信号的脉冲结束时刻，也即可以保证像素电路中数据写入阶段结束之后发光阶段才会进行，保证数据电压能够充分写入。
可选地，在另外一些实施方式中，还可以采用一个移位输入端，两个移位输出端的移位寄存器实现本发明所描述的栅极驱动电路。如图10所示，图10为本发明实施例提供的又一种移位寄存器的电路结构示意图，与图7中所示结构不同的是，图10中除包含由第八晶体管T8和第九晶体管T9组成的第一输出模块外，还包括由第二十二晶体管T22和第二十三晶体管T23组成的第二输出模块；与图7相同的是还包括节点控制模块、扫描控制模块以及复位模块，节点控制模块、扫描控制模块以及复位模块包括的晶体管以及连接关系参考关于图7的描述，在此不再赘述。需要说明的是，从输出结果来说，第二移位输出端G<N+1>输出的移位信号也是第一移位输出端G<N>输出的移位信号的移位。第九晶体管T9的第一极接时钟信号OUT1，第二十三晶体管T23的第一极接时钟信号OUT2，在一帧时间内，OUT2滞后于OUT1。移位寄存器还包括第二十一晶体管T21和第四电容C4。第二十二晶体管T22的第一极接入第一电源信号VGH，第二十二晶体管T22的第二极与第二移位输出端G<N+1>电连接，第二十二晶体管T22的控制极与第一节点N1电连接。第二十三晶体管T23的第二极与第二移位输出端G<N+1>电连接，第二十三晶体管T23的控制极与第二节点N2b电连接。第二十一晶体管T21的第一极与第三节点N2a电连接，第二十一晶体管T21的第二极与第二节点N2b电连接，第二十一晶体管T21的控制极接入第二电源电压VGL。第四电容C4的第一端与第二移位输出端G<N+1>电连接，第四电容C4的第二端与第二十三晶体管T23电连接。
图11为本发明实施例提供的又一种栅极驱动电路的电路结构示意图，图11中的移位寄存器201为图10中所示的移位寄存器。图12为图11的时序图，结合图10至图12，其级联关系为第m级移位寄存器的第二移位输出端与第m+1级移位寄存器的移位输入端电连接。第2n-1级移位寄存器的RSTB端与第一时钟信号线CKV1电连接，第2n-1级移位寄存器的OUT1端与第二时钟信号线CKV2电连接，第2n-1级移位寄存器的OUT2端与第三时钟信号线CKV3电连接，第2n-1级移位寄存器的RSTF端与第四时钟信号线CKV4电连接。第2n级移位寄存器的RSTB端与第三时钟信号线CKV3电连接，第2n级移位寄存器的OUT1端与第四时钟信号线CKV4电连接，第2n级移位寄存器的OUT2端与第一时钟信号线CKV1电连接，第2n级移位寄存器的RSTF端与第二时钟信号线CKV1电连接。在每级移位寄存器中，第一节点N1的脉冲起始时刻为移位输入端的脉冲起始时刻，第一节点N1的脉冲结束时刻为RSTF端脉冲的起始时刻，第一移位输出端输出脉冲为OUT1的脉冲，第二移位输出端的脉冲为OUT2的脉冲。从上述分析可知，本实施例的每级移位寄存器均可以输出一组栅极驱动信号。
本发明实施例还提供了一种发光面板，如图1所示，发光面板包括发光区AA和至少部分围绕发光区的非发光区NAA。非发光区设置有栅极驱动电路30，栅极驱动电路为本发明任意实施例所述的栅极驱动电路；发光区中设置有多行像素电路，栅极信号端与对应行的像素电路电连接。本实施例提供的发光面板包括本发明任意实施例提供的栅极驱动电路，因而也具有相同的有益效果，在此不再赘述。发光面板例如可以是显示面板或者背光面板等。需要说明的是，当发光面板为显示面板时，像素电路用于驱动对应的发光模块进行显示，发光模块此时可以是OLED、Micro-LED或者Mini-LED等。当发光面板为背光面板时，像素电路用于驱动对应的发光模块发光，此时发光模块可以是Mini-LED，背光面板可以和液晶面板共同组成显示面板，背光面板用于为液晶面板提供背光。
可选地，图13为本发明实施例提供的又一种发光面板的结构示意图，参考图13，第一移位寄存器组中级联的多个移位寄存器201a沿第一方向X依次排列；第二移位寄存器组中级联的多个移位寄存器201b沿第一方向依次排列。发光面板可以包括位于发光区AA两侧的第一非发光区和第二非发光区。可以在第一非发光区中设置一组第一移位寄存器组和第二移位寄存器组，并且在第二非发光区中同样设置一组第一移位寄存器组和第二移位寄存器组，并且两个非发光区中相同移位寄存器组中同一级移位寄存器的移位输出端电连接，从而可以降低栅极驱动信号线上的压降。保证发光面板发光的均匀性。
优选地，在上述实施例中，在同一非发光区内，第二移位寄存器组中第m级移位寄存器设置在第一移位寄存器组中第m级移位寄存器与第m+1级移位寄存器之间。这样设置，可以降低布线难度，并且有利于减小边框。
或者，图14为本发明实施例提供的又一种发光面板的结构示意图，参考图14，第一移位寄存器组设置于第一非发光区，第二移位寄存器组设置于第二非发光区。这样设置，可以使得两个非发光区中移位寄存器的数量均较少，更有利于减小两个非发光区的大小，从而有利于减小发光面板的边框。需要说明的是，在上述发光面板中，图13和图14中的S1与图2中的第一扫描信号S1对应；图13和图14中的S2与图2中的第二扫描信号S2对应；图13和图14中的Emit与图2中的发光控制信号Emit对应。
应该理解，可以使用上面所示的各种形式的流程，重新排序、增加或删除步骤。例如，本发明中记载的各步骤可以并行地执行也可以顺序地执行也可以不同的次序执行，只要能够实现本发明的技术方案所期望的结果，本文在此不进行限制。
上述具体实施方式，并不构成对本发明保护范围的限制。本领域技术人员应该明白的是，根据设计要求和其他因素，可以进行各种修改、组合、子组合和替代。任何在本发明的精神和原则之内所作的修改、等同替换和改进等，均应包含在本发明保护范围之内。

Claims (14)

1.一种发光面板的栅极驱动电路，其特征在于，所述栅极驱动电路包括多个电路结构相同的移位寄存器；
每个所述移位寄存器包括移位输入端、移位输出端和至少一个内部节点，所述内部节点的脉冲与所述移位输出端的脉冲的极性相反，且所述内部节点的脉冲占用时段，完全包含所述移位输入端的脉冲占用时段及所述移位输出端的脉冲占用时段；
所述栅极驱动电路包括多组栅极信号端，所述栅极信号端用于向一行像素电路提供栅极驱动信号；在每组栅极信号端中，第一扫描信号输出端连接一移位寄存器的一移位输出端，第二扫描信号输出端连接一移位寄存器的一移位输出端，发光控制信号端连接一移位寄存器的内部节点，其中，所述发光控制信号端的脉冲占用时段，完全包含所述第一扫描信号输出端的脉冲占用时段及所述第二扫描信号输出端的脉冲占用时段。
2.根据权利要求1所述的发光面板的栅极驱动电路，其特征在于，所述移位寄存器包括一个移位输出端；在每组栅极信号端中，第一扫描信号输出端为级联的两级移位寄存器中，前一级移位寄存器的移位输出端；第二扫描信号输出端为级联的两级移位寄存器中，后一级移位寄存器的移位输出端；发光控制信号输出端为预设移位寄存器的内部节点。
3.根据权利要求2所述的发光面板的栅极驱动电路，其特征在于，所述栅极驱动电路包括第一移位寄存器组和第二移位寄存器组，每个第一移位寄存器组和第二移位寄存器组分别包括级联的多个移位寄存器；
在第k组栅极信号端中，第一扫描信号输出端为第一移位寄存器组中第k级移位寄存器的移位输出端；第二扫描信号输出端为第一移位寄存器组中第k+1级移位寄存器的移位输出端；发光控制信号输出端为第二移位寄存器组中第k+1级移位寄存器的内部节点；k≥1。
4.根据权利要求3所述的发光面板的栅极驱动电路，其特征在于，在所述移位寄存器中，所述内部节点的脉冲起始时刻与所述移位输入端的脉冲起始时刻相同；
所述移位寄存器还包括多个用于输入时钟信号的时钟信号输入端；在同一帧时间内，第二移位寄存器组中第m级移位寄存器时钟信号输入端的时钟信号的起始时间，早于第一移位寄存器组中第m级移位寄存器对应时钟信号输入端的时钟信号的起始时间；m≥1。
5.根据权利要求3所述的发光面板的栅极驱动电路，其特征在于，所述移位寄存器包括用于输入第一时钟信号的第一时钟端和用于输入第二时钟信号的第二时钟端；在同一帧时间内，所述第一时钟信号的结束时刻，与所述移位寄存器的移位输出端的脉冲结束时刻相同；所述内部节点的脉冲结束时刻，与所述第二时钟信号的起始时刻相同；
在同一帧时间内，第一移位寄存器组的第n级移位寄存器中第一时钟信号的结束时刻，早于第二移位寄存器组的第n级移位寄存器中第二时钟信号的起始时刻。
6.根据权利要求2所述的发光面板的栅极驱动电路，其特征在于，所述移位寄存器包括：
第一输出模块、第一节点、第二节点及节点控制模块；
所述第一输出模块用于根据第一节点的电位将第一电源信号输出至所述移位输出端，根据第二节点的电位将第一时钟信号输出至所述移位输出端；
所述移位输入端、所述第一节点及所述第二节点均与所述节点控制模块连接，所述节点控制模块用于控制所述第一节点及所述第二节点的电位；
其中，所述内部节点为所述第一节点。
7.根据权利要求6所述的发光面板的栅极驱动电路，其特征在于，所述移位输入端包括正扫输入端和反扫输入端，所述移位寄存器还包括：
扫描控制模块，所述移位输入端通过所述扫描控制模块与所述节点控制模块连接，所述扫描控制模块用于响应正扫输入端的导通电平，将正扫控制信号端的信号提供给所述第二节点，以及响应反扫输入端的导通电平，将反扫控制信号端的信号提供给所述第二节点；
复位模块，用于响应单级复位信号的导通电平，对所述第一节点复位；并响应全局复位信号的导通电平，对所述移位输出端复位。
8.根据权利要求1所述的发光面板的栅极驱动电路，其特征在于，所述移位寄存器的移位输出端包括第一移位输出端和第二移位输出端，所述第二移位输出端的脉冲起始时刻晚于所述第一移位输出端的脉冲起始时刻；
每组栅极信号端对应一个移位寄存器，且第一扫描信号输出端与所述移位寄存器的第一移位输出端电连接，第二扫描信号输出端与所述移位寄存器的第二移位输出端电连接，发光控制信号输出端与所述移位寄存器的内部节点电连接。
9.根据权利要求8所述的发光面板的栅极驱动电路，其特征在于，所述移位寄存器包括：
第一输出模块、第二输出模块、第一节点、第二节点及节点控制模块；
所述第一输出模块用于根据第一节点的电位将第一电源信号输出至所述第一移位输出端，根据第二节点的电位将第一时钟信号输出至所述第一移位输出端；
所述第二输出模块用于根据第一节点的电位将第一电源信号输出至所述第二移位输出端，根据第二节点的电位将第二时钟信号输出至所述第二移位输出端；
所述移位输入端、所述第一节点及所述第二节点均与所述节点控制模块连接，所述节点控制模块用于控制所述第一节点及所述第二节点的电位；
其中，所述内部节点为所述第一节点。
10.一种发光面板，所述发光面板包括发光区和至少部分围绕所述发光区的非发光区，所述非发光区中设置有栅极驱动电路，所述栅极驱动电路为权利要求1-9任一项所述的栅极驱动电路；所述发光区中设置有多行像素电路，所述栅极信号端与对应行的像素电路电连接。
11.根据权利要求10所述的发光面板，其特征在于，所述栅极驱动电路包括第一移位寄存器组和第二移位寄存器组，每个第一移位寄存器组和第二移位寄存器组分别包括级联的多个移位寄存器；在第k组栅极信号端中，第一扫描信号输出端为第一移位寄存器组中第k级移位寄存器的移位输出端；第二扫描信号输出端为第一移位寄存器组中第k+1级移位寄存器的移位输出端；发光控制信号输出端为第二移位寄存器组中第k+1级移位寄存器的内部节点；k≥1；
第一移位寄存器组中级联的多个移位寄存器沿第一方向依次排列；第二移位寄存器组中级联的多个移位寄存器沿所述第一方向依次排列。
12.根据权利要求11所述的发光面板，其特征在于，所述发光面板包括位于所述发光区相对两侧的第一非发光区和第二非发光区；
所述第一移位寄存器组设置于所述第一非发光区，所述第二移位寄存器组设置于所述第二非发光区；
或者，所述发光面板包括两组第一移位寄存器组和两组第二移位寄存器组，所述第一非发光区中设置有一组第一移位寄存器组和一组第二移位寄存器组，所述第二非发光区中设置有另一组第一位寄存器组和另一组第二移位寄存器组；不同非发光区中，同级移位寄存器的移位输出端连接。
13.根据权利要求10所述的发光面板，其特征在于，所述像素电路包括：数据写入模块、驱动模块、发光控制模块、发光模块和复位模块；所述驱动模块用于产生驱动电流，所述发光模块用于响应所述驱动电流发光；所述复位模块用于复位所述驱动模块和所述发光模块中的至少一个，所述复位模块的控制端与对应的第一扫描信号输出端连接；所述数据写入模块的控制端与对应的第二扫描信号输出端连接，所述数据写入模块用于将数据信号写入所述驱动模块；所述发光控制模块的控制端与对应的发光控制信号输出端连接，所述发光控制模块用于控制所述驱动模块与所述发光模块之间的电流通路。
14.根据权利要求10所述的发光面板，其特征在于，所述发光面板为显示面板或者背光面板。
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