CN114974160A - 扫描驱动电路、显示面板和显示装置 - Google Patents

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CN114974160A CN202210681278.4A CN202210681278A CN114974160A CN 114974160 A CN114974160 A CN 114974160A CN 202210681278 A CN202210681278 A CN 202210681278A CN 114974160 A CN114974160 A CN 114974160A
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Abstract

本申请实施例公开一种扫描驱动电路，包括第一组扫描驱动单元、第二组扫描驱动单元和第三组扫描驱动单元，三组扫描驱动单元分别输出扫描信号至对应的三个显示区域以控制设置于显示区域内的像素单元执行图像显示。第一组扫描驱动单元中的每个扫描驱动单元包括至少一个第一开关管，第二组扫描驱动单元中每个扫描驱动单元包括至少一个第二开关管，第三组扫描驱动单元中每个扫描驱动单元包括至少一个第三开关管，第一开关管、第二开关管和第三开关管的导电沟道的宽度依次减小。通过对不同组中扫描驱动单元包含的开关管导电沟道宽度的设置，补偿了时钟信号的衰减以使扫描信号输出更加稳定。本申请还公开包括前述扫描驱动电路的显示面板和显示装置。

Description

扫描驱动电路、显示面板和显示装置
技术领域
本申请涉及显示技术领域，尤其涉及应用于扫描驱动电路、显示面板和显示装置。
背景技术
较少栅极驱动器技术(Gate Driver Less，GDL)是运用液晶显示面板的原有阵列制程将水平扫描线的驱动电路制作在显示区周围的基板上，使之能替代外接集成电路板(Integrated Circuit，IC)来完成水平扫描线的驱动。GDL技术能减少外接IC的焊接工序，可以使液晶显示面板更适合制作窄边框或无边框的显示产品。
目前，在大尺寸的显示面板中，时序信号线在显示面板两侧走线较长，此时通过时序控制器输出的时钟信号在显示面板不同的位置受到的阻抗不同，导致在显示面板的不同区域内，时钟信号的波形存在差异，从而影响扫描驱动电路输出的扫描信号的波形存在差异，进而导致显示面板出现显示不均匀的问题。
发明内容
鉴于上述现有技术的不足，本申请提供一种输出稳定的扫描驱动电路。
一种扫描驱动电路，包括沿着并级联的n个扫描驱动单元，n为大于或等于1的整数，n个扫描驱动单元包括第一组扫描驱动单元、第二组扫描驱动单元和第三组扫描驱动单元，第一组扫描驱动单元用于输出扫描信号至显示区域的第一显示区域，第二组扫描驱动单元用于输出扫描信号至显示区域的第二显示区域，第三组扫描驱动单元用于输出扫描信号至显示区域的第三显示区域，其中，第一显示区域、第二显示区域和第三显示区域沿着第一方向依次排列，第一方向为数据信号输出传输的方向，扫描信号用于输出至显示区域中的扫描线并控制对应连接于扫描线的像素单元接收数据信号以执行图像显示。第一组扫描驱动单元中每个扫描驱动单元包括至少一个用于输出扫描信号的第一开关管，第二组扫描驱动单元中每个扫描驱动单元包括至少一个用于输出扫描信号的第二开关管，第三组扫描驱动单元中每个扫描驱动单元包括至少一个输出扫描信号的第三开关管，第一开关管、第二开关管和第三开关管的导电沟道的宽度依次减小。
可选地，n个扫描驱动单元沿着第一方向依次排列设置。第一开关管的导电沟道宽度为第一预设宽度，第二开关管的导电沟道具有第二预设宽度，第三开关管的导电沟道具有第三预设宽度，第一预设宽度与第二预设宽度之差等于第二预设宽度与第三预设宽度之差。
可选地，第一开关管、第二开关管和第三开关管为薄膜晶体管，扫描驱动单元包括第一输出模块和第二输出模块，第一输出模块和第二输出模块分别控制一个扫描信号输出，在第一组扫描驱动单元中，每一个扫描驱动单元中的第一输出模块和第二输出模块分别至少包括一个第一开关管，在第二组扫描驱动单元中，每一个扫描驱动单元中的第一输出模块和第二输出模块分别至少包括一个第二开关管，在第三组扫描驱动单元中，每一个扫描驱动单元中的第一输出模块和第二输出模块分别至少包括一个第三开关管。
可选地，包括M个时钟信号，第J扫描驱动单元包括第一输出控制节点和第二输出控制节点，第一输出模块接入第i时钟信号并连接第一输出控制节点，当第一输出控制节点的电压为第一节点电位时，第一输出模块接收第i时钟信号并输出第j扫描信号，其中，1≤i＜M，1≤J≤n，j＝2J-1；第二输出模块接入第i+1时钟信号并连接第二输出控制节点，当第二输出控制节点的电压为第一节点电位时，第二输出模块接收i+1时钟信号并输出第j+1扫描信号。
可选地，当第J个扫描驱动单元在第一组扫描驱动单元内时，第一输出模块包括两个第一开关管，两个第一开关管的源极接入第i时钟信号、漏极连接扫描信号的输出端、栅极连接第一输出控制节点，当第一输出控制节点的电压为第一节点电位时，两个第一开关管分别自源极接收第i时钟信号并自漏极输出第j扫描信号和第j级传信号。第二输出模块包括两个第一开关管，两个第一开关管的源极接入第i+1时钟信号、漏极连接扫描信号的输出端、栅极连接第二输出控制节点，当第二输出节点的电压为第一节点电位时，两个第一开关管分别自源极接收第i+1时钟信号并自漏极输出第j+1扫描信号和第j+1级传信号。
可选地，第一输出控制节点的电压为第二节点电位时，第一输出模块停止接收第i时钟信号并停止输出第j扫描信号和第j级传信号，第二输出控制节点的电压为第二节点电位时，第二输出模块停止接收第i+1时钟信号并停止输出第j+1扫描信号和第j+1级传信号。
可选地，第J个扫描驱动单元与第J-2个扫描驱动单元级联，第J个扫描驱动单元还包括第一上拉控制模块和第二上拉控制模块，第一上拉控制模块连接第一输出控制节点，第一上拉控制模块接收第J-2个扫描驱动单元输出的第j-4级传信号，以控制第一输出控制节点的电压位于第一节点电位，第二上拉控制模块连接第二输出控制节点，第二上拉控制模块接收第J-2个扫描驱动单元输出的第j-3级传信号，以控制第二输出控制节点的电压位于第一节点电位。
可选地，第一组扫描驱动单元中的每个扫描驱动单元内的所有晶体管为第一开关管，第二组扫描驱动单元中每个扫描驱动单元内的所有晶体管为第二开关管，第三组扫描驱动单元中每个扫描驱动单元内的所有晶体管为第三开关管。
本申请实施例还公开一种显示面板，包括设置于非显示区域的数据驱动电路、显示控制电路和设置于显示区域且呈矩阵排布的多个像素单元以及前述的扫描驱动电路，扫描驱动电路依据显示控制电路输出的栅极输出控制信号，配合数据驱动电路依据显示控制电路输出的源极输出控制信号而沿第一方向输出的数据信号驱动像素单元进行图像显示。
本申请还公开一种显示装置，包括支撑框架、电源模组和前述的显示面板，电源模组为显示面板进行图像显示提供电源电压，显示面板与电源模组固定于支撑框架。
相较于现有技术，通过本申请提供的扫描驱动电路，对控制不同显示区域的扫描驱动单元内的晶体管导电沟道的宽度进行设置，补偿了时钟信号由于阻抗而导致的波形衰减，使输出至不同显示区域的扫描信号更加稳定，使得图像显示更加均匀。
附图说明
为了更清楚地说明本申请实施例中的技术方案，下面将对实施例中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图是本申请的一些实施例，对于本领普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本申请第一实施例提供的一种显示装置的结构示意图；
图2为本申请第二实施例中如图1所示的显示模组的侧面结构示意图；
图3为图2中显示模组的平面布局结构示意图；
图4为本申请第三实施例中如图3所示的扫描驱动电路的结构示意图；
图5为图4中GOA单元的级联示意图；
图6为图4中GOA单元的等效电路图；
图7为图3中显示面板的显示区域划分示意图；
图8a为第一开关管的剖面结构示意图；
图8b为第二开关管的剖面结构示意图；
图8c为第三开关管的剖面结构示意图；
图9为图7中不同显示区域对应输出扫描信号波形示意图。
附图标记说明：显示装置-100、显示模组-10、电源模组-20、支撑框架30、数据驱动电路-11、扫描驱动电路-12、显示面板-13、显示区域-13a、非显示区域-13b、显示控制电路-14、像素单元-15、背光模组-17、阵列基板-131、液晶层-132、彩膜基板-133、第一方向-F1、第二方向-F2、数据线-S1～Sm、扫描线-G1～G2n、时钟信号-CLK、GOA单元-140、启动信号-STV、复位信号-R、第j级传信号-C(j)、第j扫描信号-G(j)、扫描驱动单元-GOA单元、扫描信号输出子单元-GDL单元、第一GDL单元-GDL1、第二GDL单元-GDL2、第一上拉控制模块-141、第一输出模块-142、第一下拉控制模块-143A、第二下拉控制模块-143B、第一下拉模块-144、第一下拉维持模块-145、第一节点-Q(j)、第二节点-Qb(j)、第二上拉控制模块-151、第二输出模块-152、第三下拉控制模块-153A、第四下拉控制模块-153B、第二下拉模块-154、第二下拉维持模块-155、第三节点-Q(j+1)、第四节点-Qb(j+1)、第一低压电位-Vss1、第二低压电位-Vss2、十一晶体管-T11、第二十一晶体管T-21、第二十二晶体管-T22、第一电容-C1、第三十一晶体管-T31、第三十二晶体管-T32、第三十三晶体管-T33、第三十四晶体管-T34、第三十五晶体管-T35、第三十六晶体管-T36、第三十七晶体管-T37、第四十一晶体管-T41、第四十二晶体管-T42、第四十三晶体管-T43、第四十四晶体管-T44、第五十一晶体管-T51、第五十二晶体管-T52、第五十三晶体管-T53、第六十一晶体管-T61、第七十一晶体管-T71、第七十二晶体管-T72、第二电容-C2、第八十一晶体管-T81、第八十二晶体管-T82、第八十三晶体管-T83、第八十四晶体管-T84、第八十五晶体管-T85、第八十六晶体管-T86、第八十七晶体管-T87、第九十一晶体管-T91、第九十二晶体管-T92、第九十三晶体管-T93、第九十四晶体管-T94、九十五晶体管-T95、第九十六晶体管-T96、第九十七晶体管-T97、第一显示区域-X1、第二显示区域-X2、第三显示区域-X3、第一距离-D1、第二距离-D2、第三距离-D3、第一预设宽度-W1、第二预设宽度-W2、第三预设宽度-W3。
具体实施方式
为了便于理解本申请，下面将参照相关附图对本申请进行更全面的描述。附图中给出了本申请的较佳实施方式。但是，本申请可以以许多不同的形式来实现，并不限于本文所描述的实施方式。相反地，提供这些实施方式的目的是使对本申请的公开内容理解的更加透彻全面。
以下各实施例的说明是参考附加的图示，用以例示本申请可用以实施的特定实施例。本文中为部件所编序号本身，例如“第一”、“第二”等，仅用于区分所描述的对象，不具有任何顺序或技术含义。而本申请所说“连接”、“联接”，如无特别说明，均包括直接和间接连接(联接)。本申请中所提到的方向用语，例如，“上”、“下”、“前”、“后”、“左”、“右”、“内”、“外”、“侧面”等，仅是参考附加图式的方向，因此，使用的方向用语是为了更好、更清楚地说明及理解本申请，而不是指示或暗指所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。
在本申请的描述中，需要说明的是，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解，例如，可以是固定连接，也可以是可拆卸地连接，或者一体地连接；可以是机械连接；可以是直接相连，也可以通过中间媒介间接相连，可以是两个元件内部的连通。对于本领域的普通技术人员而言，可以具体情况理解上述术语在本申请中的具体含义。需要说明的是，本申请的说明书和权利要求书及附图中的术语“第一”、“第二”等是用于区别不同对象，而不是用于描述特定顺序。
此外，本申请中使用的术语“包括”、“可以包括”、“包含”、或“可以包含”表示公开的相应功能、操作、元件等的存在，并不限制其他的一个或多个更多功能、操作、元件等。此外，术语“包括”或“包含”表示存在说明书中公开的相应特征、数目、步骤、操作、元素、部件或其组合，而并不排除存在或添加一个或多个其他特征、数目、步骤、操作、元素、部件或其组合，意图在于覆盖不排他的包含。此外，当描述本申请的实施方式时，使用“可”表示“本申请的一个或多个实施方式”。并且，用语“示例性的”旨在指代示例或举例说明。
除非另有定义，本文所使用的所有的技术和科学术语与属于本申请的技术领域的技术人员通常理解的含义相同。本文中在本申请的说明书中所使用的术语只是为了描述具体的实施方式的目的，不是旨在于限制本申请。
请参阅图1，图1为本申请第一实施例提供的一种显示装置100的结构示意图。显示装置100包括显示模组10、电源模组20和支撑框架30，显示模组10与电源模组20固定于支撑框架30，电源模组20设置于显示模组10的背面也即是显示模组10的非显示面。电源模组20用于为显示模组10进行图像显示提供电源电压，支撑框架30为显示模组10和电源模组20提供固定与保护作用。
请参阅图2，图2为本申请第二实施例提供的如图1中显示模组10的侧面结构示意图。
其中，显示模组10包括显示面板13和背光模组17(Back light Module,BM)，其中，背光模组17用于提供显示用的光线至显示面板13的显示区域13a，显示面板13依据待显示的图像信号出射相应的光线以执行图像显示。也即是电源模组20可用于为显示面板13进行图像显示提供电源电压，支撑框架30为显示面板13和电源模组20提供固定与保护作用。
其中，显示模组10还包括其他元件或者组件，例如还包括信号处理器模组和信号感测模组等。
在示例性实施例中，显示面板13可以为液晶显示面板，也可以为其他类型的显示面板，本申请不做限制。
以液晶显示面板为例，显示面板13包括有阵列基板(Array substrate,AS)131与彩膜基板(Color film substrate,CF)133，以及夹设于阵列基板131与彩膜基板133之间的液晶层132。阵列基板131与彩膜基板133上设置驱动元件依据数据信号Data产生相应的电场，从而驱动液晶层132中液晶分子旋转的角度以出射相应亮度的光线，以执行图像显示。
请一并参阅图2-图3，图3为图2中显示模组10的平面布局结构示意图。
如图3所示，显示模组10还包括数据驱动电路11、扫描驱动电路12和显示控制电路14。数据驱动电路11、扫描驱动电路12和显示控制电路14设置于显示面板13的非显示区域13b。
在显示面板13的显示区域13a设置有互相呈网格状设置的多条数据线(Sourceline)S1～Sm和多条扫描线(Gate line)G1～G2n。其中，多条数据线S1～Sm沿着第一方向F1延伸，多条扫描线G1～G2n沿着第二方向F2延伸。其中，第一方向F1与第二方向F2相互垂直。
多条扫描线G1～G2n和数据线S1～Sm的交叉部均对应设置像素单元15。本实施例中，像素单元15可分别表示为P11～P1m，P21～P2m，……，P2n1～P2nm。
扫描线G1～G2n连接扫描驱动电路12，自扫描驱动电路12接收扫描信号，数据线S1～Sm连接数据驱动电路11，用于接收数据驱动电路11提供的以灰阶值形式保存并传输的数据信号Data。
像素单元15在扫描线G1～G2n的控制下在预定时间段接收数据线S1～Sm提供的对应数据信号Data中灰阶值的数据电压，并据此驱动液晶层132偏转相应的角度，从而将接收的背光按照偏转的相应角度出射相应亮度的光线，以达到依据图像信号出射相应亮度的光线进行图像显示。
显示控制电路14从外部信号源接收表示图像信息的图像信号、取得同步用的时钟信号CLK、水平同步信号Hsyn及垂直同步信号Vsyn，并输出供控制扫描驱动电路12使用的栅极输出控制信号Cg、供控制数据驱动电路11使用的源极输出控制信号Cs及表示图像信息的数据信号Data。本实施例中，显示控制电路14对原数据信号进行数据调整处理后获得数据信号Data，并且将数据信号Data传输至数据驱动电路11。
扫描驱动电路12接收显示控制电路14输出的栅极输出控制信号Cg，向各扫描线G1～G2n输出扫描信号。数据驱动电路11接收显示控制电路14输出的源极输出控制信号Cs，并向各数据线S1～Sm输出在显示区域13a中各个像素单元15中驱动元件执行图像显示用的数据信号Data。其中，提供到显示面板13中数据信号Data为模拟形式的灰阶电压。扫描驱动电路12输出扫描信号控制像素单元15接收数据驱动电路11输出数据信号Data，以控制像素单元15显示对应图像。
请参阅图4，图4为本申请第三实施例中如图3所示的扫描驱动电路12的结构示意图。如图4所示，扫描驱动电路12包括n个级联的扫描驱动单元140、M个时钟信号CLK1-CLKM、启动信号STV、复位信号R、第一低压电位Vss1和第二低压电位Vss2，其中n、M为大于或等于1的整数。为便于说明后文中扫描驱动单元140用GOA单元表示。
在示例性实施例中，扫描驱动电路12还可以根据具体需要，将时钟信号设置为任意数量进行控制，本申请不做限制。
在本实施例中以八个时钟信号为例，也即是第一时钟信号CLK1至第八时钟信号CLK8。其中，扫描驱动电路12包括n个GOA单元，每一个GOA单元对应输出两个扫描信号至显示区域13a中的两条扫描线中，在一帧图像显示过程中，n个GOA单元对应输出2n个扫描信号，分别为G(1)～G(2n)。
在示例性实施例中，扫描线的数量可以依据显示面板的实际分辨率进行设定，本申请不做限制。
八个时钟信号CLK1-CLK8用于为GOA单元输出扫描信号提供扫描驱动时序。启动信号STV为第一GOA单元GOA1的始能启动信号，其他GOA单元140通过级联GOA单元输出的级传信号作为启动信号。第一低压电位Vss1和第二低压电位Vss2用于为GOA单元中各节点提供低电压。
请参阅图5，图5为图4中GOA单元的级联示意图。如图5所示，以第K个GOA单元为例，其中，2≤K≤n，第K个GOA单元输出第2K-1级传信号C(2K-1)和第2K级传信号C(2K)用于上拉第K+2个GOA单元中的两个节点电压，以控制第K+2个GOA单元中两个扫描信号的输出，同时下拉第K-2个GOA单元中两个节点的电压，以控制第K-2个GOA单元中两个扫描信号停止输出。
以第4个GOA单元GOA4为例，第4个GOA单元GOA4输出第7级传信号和第8级传信号，第7级传信号和第8级传信号用于上拉第6个GOA单元GOA6中的节点电压，以控制第6个GOA单元GOA6中两个扫描信号的输出，同时用于下拉第2个GOA单元GOA2中的节点电压，以控制第2个GOA单元GOA2中两个扫描信号停止输出。
同时，第K-2个GOA单元输出的第2K-5级传信号C(2K-5)和第2K-4级传信号C(2K-4)用于上拉第K个GOA单元中的两个节点电压，以控制第K个GOA单元中的第2K-1扫描信号和第2K扫描信号输出。第K+2个GOA单元输出第2K+3级传信号C(2K+3)和第2K+4级传信号C(2K+4)用于下拉第K个GOA单元中的节点电压，以控制第K个GOA单元中的第2K-1扫描信号和第2K扫描信号停止输出。
例如，第2个GOA单元输出的第3级传信号C(3)和第4级传信号C(4)用于上拉第4个GOA单元GOA4中的节点电压，以控制第4个GOA单元GOA4中的第7扫描信号和第8扫描信号的输出。第6个GOA单元GOA6输出的第11级传信号和第12级传信号用于下拉第4个GOA单元GOA4中的节点电压，以控制第4个GOA单元中的第3扫描信号和第4扫描信号停止输出。
请参阅图6，图6为图5中GOA单元的等效电路图。如图6所示，GOA单元包括两个扫描信号输出子单元，分别为第一扫描信号输出子单元和第二扫描信号输出子单元，为便于后文说明，扫描信号输出子单元用GDL单元代替，即第一扫描信号输出子单元为第一GDL单元GDL1，第二扫描信号输出子单元为第二GDL单元GDL2。
以第J个GDL单元为例，其中，1≤J≤n。第J个GOA单元包括第一GDL单元GDL1和第二GDL单元GDL2，第一GDL单元GDL1输出第j级传信号C(j)和第j扫描信号G(j)，第二GDL单元GDL2输出第j+1级传信号C(j+1)和第j+1扫描信号G(j+1)，j＝2J-1。
其中，第一GDL单元GDL1包括第一上拉控制模块141、第一输出模块142、第一下拉控制模块143A、第二下拉控制模块143B、第一下拉模块144、第一下拉维持模块145、第一节点Q(j)和第二节点Qb(j)，其中第一节点Q(j)为第一输出控制节点。
第二GDL单元GDL2包括第二上拉控制模块151、第二输出模块152、第三下拉控制模块153A、第四下拉控制模块153B、第二下拉模块154、第二下拉维持模块155、第三节点Q(j+1)和第四节点Qb(j+1)，其中第三节点Q(j+1)为第二输出控制节点。
具体地，在第一GDL单元GDL1中，第一上拉控制模块141连接第一节点Q(j)同时接收第J-2个GOA单元输出的第j-4级传信号C(j-4)。利用第j-4级传信号C(j-4)对第一节点Q(j)进行预充电并将第一节点Q(j)由第二节点电位上拉至第一节点电位，即第一节点电位高于第二节点电位。
第一输出模块142接入第i时钟信号CLKi(1≤i＜M)和第一节点Q(j)，用于在第i时钟信号CLKi的控制下，当第一节点Q(j)的电压为第一节点电位时，接收第i时钟信号并输出第j级传信号C(j)和第j扫描信号G(j)。当第一节点Q(j)为第二节点电位时，停止接收第i时钟信号并停止输出第j级传信号C(j)和第j扫描信号G(j)。第j级传信号C(j)用于控制第J+2个GOA单元中第一GDL单元GDL1输出第j+4级传信号C(j+4)和第j+4级扫描信号G(j+4)，同时控制第J-2个GOA单元中第一GDL单元GDL1停止输出第j-4级传信号C(j-4)和停止输出第j-4扫描信号G(j-4)。
第一下拉控制模块143A连接第一节点Q(j)、第二节点Qb(j)和第一低压电位Vss1，同时，接收第J+2个GOA单元输出的第j+4级传信号C(j+4)、第一复位信号R1。利用第J+2个GOA单元输出的第j+4级传信号C(j+4)下拉第一节点Q(j)的电位至第二节点电位。在每一帧图像显示时，利用第一复位信号R1下拉第一节点Q(j)和第二节点Qb(j)的电位至第二节点电位，即第一低压电位Vss1，避免电路漏电聚集。通过第一节点和第二节点的设置，能够通过级传信号控制第一节点和第二节点的电压，从而有效控制第一GDL单元中扫描信号和级传信号的输出和停止输出。
第一下拉模块144连接第j级传信号C(j)的输出端(未标识)、第j条扫描信号G(j)的输出端(未标识)、第二节点Qb(j)、第三节点Q(j+1)、第一低压电位Vss1和第二低压电位Vss2。当第二节点Qb(j)为第一节点电位时，将第j级传信号C(j)下拉至第一低压电位Vss1，停止输出第j级传信号C(j)，同时将第j扫描信号下拉至第二低压电位Vss2，控制第j条扫描信号G(j)停止输出。
第一下拉维持模块145连接第一节点Q(j)、第二节点Qb(j)、第三节点Q(j+1)和第一低压电位Vss1，同时接收第J-2个GOA单元中第一GDL单元输出的第j-4级传信号C(j-4)。利用第j-4级传信号C(j-4)维持第一节点Q(j)和第二节点Qb(j)电平。其中，当第一节点Q(j)为第一节点电位时，下拉第二节点Qb(j)的电位至第一低压电位Vss1也即是第二节点电位，且在第一节点Q(j)为第一节点电位的时段内，维持第二节点Qb(j)的第二节点电位。当第三节点Q(j+1)为第一节点电位时，控制所述第二节点Qb(j)停止接收电源电压VDD，并下拉第二节点Qb(j)的电位至第一低压电位Vss1且在第三节点Q(j+1)为第一节点电位时的时段内，维持第二节点Qb(j)的第二节点电位状态。当第一节点Q(j)和/或第三节点Q(j+1)为第二节点电位时，第二节点Qb(j)接收电源电压VDD并保持第一节点电位。其中，第一接节点电位为高电平，第二节点电位为低电平。
在第二GDL单元GDL2中，第二上拉控制模块151连接第三节点Q(j+1)同时接收第J-2个GOA单元输出的第j-3级传信号C(j-3)。利用第j-3级传信号C(j-3)为第三节点Q(j+1)进行预充电将第三节点Q(j+1)的电位自第二节点电位上拉至第一节点电位。
第二输出模块152接入第i+1时钟信号CLK(i+1)和第三节点Q(j+1)。用于在第i+1时钟信号CLK(i+1)的控制下，当第三节点Q(j+1)的电位为第一节点电位时，输出第j+1级传信号C(j+1)和第j+1扫描信号G(j+1)。当第三节点Q(j+1)的电位为第二节点电位时，停止接收第i+1时钟信号并停止输出第j+1级传信号C(j+1)和第j+1扫描信号G(j+1)。第j+1级传信号C(j+1)用于控制第J+2级GOA单元中第二GDL单元GDL2输出第j+5级传信号C(j+5)和第j+5扫描信号G(j+5)，同时控制第J-3个GOA单元中第二GDL单元GDL2停止输出第j-5级传信号C(j-5)和第j-5扫描信号G(j-5)。
第三下拉控制模块153A第三节点Q(j+1)、第四节点Qb(j+1)和第一低压电位Vss1，同时接收第二复位信号R2和第J+2个GOA单元输出的第j+5级传信号C(j+5)。利用第j+5级传信号C(j+5)下拉第三节点Q(j+1)的电位至第二节点电位。利用第二复位信号R2下拉第三节点Q(j+1)和第四节点Qb(j+1)的电位。通过第三下拉控制模块153A下拉第三节点Q(j+1)至第一低压电位Vss1。
第四下拉控制模块153B电性连接于电源电压VDD、第三节点Q(j+1)和第四节点Qb(j+1)。当第三节点Q(j+1)为第一节点电位时，第四下拉控制模块153B控制第四节点Qb(j+1)接入第一低压电位Vss1，当第三节点Q(j+1)为第二节点电位时，控制第四节点Qb(j+1)接入电源电压VDD。通过第三节点Q(j+1)和第四节点Qb(j+1)的设置，能够通过级传信号控制第三节点和第四节点的电压，从而有效控制第二GDL单元中扫描信号和级传信号的输出和停止输出。
第二下拉模块154连接第j+1级传信号C(j+1)的输出端(未标识)、第j+1扫描信号G(j+1)的输出端(未标识)、第四节点Qb(j+1)、第一低压电位Vss1和第二低压电位Vss2。当第四节点Qb(j+1)为第一节点电位时，将第j+1级传信号C(j+1)下拉至第一低压电位Vss1，停止输出第j+1级传信号C(j+1)。第j+1扫描信号G(j+1)的输出端接收第二低压电位Vss2，并停止输出第j+1条扫描信号G(j+1)。
第二下拉维持模块155连接第一节点Q(j)、第三节点Q(j+1)、第四节点Qb(j+1)和第一低压电位Vss1，同时接收第J-2个GOA单元中第二GDL单元GDL2输出的第j-3级传信号C(j-3)。利用第j-3级传信号和处于第一节点电位的第三节点Q(j+1)，控制第四节点Qb(j+1)接入第一低压电位Vss1，并维持此时段第四节点Qb(j+1)的第一低压电位Vss1。当第一节点Q(j)为第一节点电位时，下拉第四节点Qb(j+1)的电位至第一低压电位Vss1，并在第一节点Q(j)为第一节点电位的时段内，维持第四节点Qb(j+1)的第一低压电位Vss1。通过设置第二下拉维持模块，使第一节点和第三节点在第二节点电位时，控制第四节点处于关停状态，维持第一GDL单元和/或第二GDL单元的扫描信号稳定输出，避免第四节点的电压波动影响当前扫描信号的输出。
更为具体地，第一上拉控制模块141包括第十一晶体管T11。第十一晶体管T11的栅极和源极接入第j-4级传信号C(j-4)的输入端(未标识)，漏极电性连接于第一节点Q(j)。
第一输出模块142包括第二十一晶体管T21、第二十二晶体管T22和第一电容C1，第二十一晶体管T21为第一级传信号输出晶体管，第二十二晶体管T22为第一扫描信号输出晶体管。其中，第二十一晶体管T21的源极接入第i时钟信号CLK(i)，栅极电性连接于第一节点Q(j)，漏极电性连接于第j级传信号C(j)的输出端(未标识)。第二十二晶体管T22源极接入第i时钟信号CLK(i)，栅极电性连接于第一节点Q(j)，漏极电性连接于第j条扫描信号G(j)的输出端(未标识)，第一电容C1连接第二十二晶体管T22的栅极与第j条扫描信号G(j)的输出端之间，也即是连接于第一节点Q(j)与第j条扫描信号G(j)的输出端之间。第一下拉控制模块143A包括第三十一晶体管T31，第三十二晶体管T32，第三十三晶体管T33和第三十四晶体管T34。其中，第三十一晶体管T31的栅极接入第一复位信号R1，源极电性连接于第一节点Q(j)，漏极电性连接于第一低压端以接收第一低压电位Vss1。第三十二晶体管T32的栅极电性连接于第二节点Qb(j)，源极电性连接于第一节点Q(j)，漏极电性连接于第一低压端以接收第一低压电位Vss1。第三十三晶体管T33的栅极接入第j+4级传信号C(j+4)，源极电性连接于第一节点Q(j)，漏极电性连接于第一低压端以接收第一低压电位Vss1。第三十四晶体管T34的栅极电性连接于第四节点Qb(j+1)，源极电性连接于第一节点Q(j)，漏极电性连接于第一低压端以接收第一低压电位Vss1。
第二下拉控制模块143B包括第三十五晶体管T35、第三十六晶体管T36和第三十七晶体管T37。第三十五晶体管T35源极和栅极电性连接于电源电压VDD，漏极与第三十六晶体管T36的栅极、第三十七晶体管T37的源极电性连接。第三十六晶体管T36的源极电性连接于电源电压VDD，漏极电性连接于第二节点Qb(j)。第三十七晶体管T37的栅极电性连接于第一节点Q(j)，漏极电性连接于第一低压端以接收第一低压电位Vss1。
第一下拉模块144包括第四十一晶体管T41、第四十二晶体管T42、第四十三晶体管T43、第四十四晶体管T44。其中，第四十一晶体管T41的栅极电性连接于第二节点Qb(j)，源极接入第j级传信号C(j)的输出端，漏极电性连接于第一低压端以接收第一低压电位Vss1。第四十二晶体管T42的栅极电性连接于第二节点Qb(j)，源极接入第j条扫描信号G(j)的输出端，漏极电性连接于第二低压端以接收第二低压电位Vss2。第四十三晶体管T43的栅极电性连接于第四节点Qb(j+1)，源极接入第j条扫描信号G(j)的输出端，漏极电性连接于第二低压端以接收第二低压电位Vss2。第四十四晶体管T44的栅极电性连接于第四节点Qb(j+1)，源极接入第j级传信号C(j)的输出端，漏极电性连接于第二低压端以接收第二低压电位Vss2。
第一下拉维持模块145包括第五十一晶体管T51、第五十二晶体管T52和第五十三晶体管T53。其中，第五十一晶体管T51栅极接入第一节点Q(j)，源极电性连接于第二节点Qb(j)，漏极电性连接于第一低压端以接收第一低压电位Vss1。第五十二晶体管T52的栅极接入第j-4级传信号C(j-4)的输入端(未标识)，漏极电性连接于第一低压端以接收第一低压电位Vss1，源极电性连接于第二节点Qb(j)。第五十三晶体管T53栅极电性连接于第三节点Q(j+1)，源极电性连接于第三十五晶体管T35的漏极，漏极电性连接于第一低压端以接收第一低压电位Vss1。
第二上拉控制模块151包括第六十一晶体管T61。第六十一晶体管T61的栅极和源极接入第j-3级传信C(j-3)的输入端(未标识)，漏极电性连接于第三节点Q(j+1)。
第二输出模块152包括第七十一晶体管T71、第七十二晶体管T72和第二电容C2，第七十一晶体管T71为第二级传信号输出晶体管，第七十二晶体管T72为第二扫描信号输出晶体管。其中，第七十一晶体管T71的源极接入第i+1时钟信号CLK(i+1)，栅极电性连接于第三节点Q(j+1)，漏极电性连接于第j+1级传信号C(j+1)的输出端。第七十二晶体管T72源极接入第i+1时钟信号CLK(i+1)，栅极电性连接于第三节点Q(j+1)，漏极电性连接于第j+1条扫描信号G(j+1)的输出端，第二电容C2连接于第七十二晶体管T72的栅极与第j+1条扫描信号G(j+1)的输出端之间，也即是连接于第三节点Q(j+1)与第j+1条扫描信号G(j+1)的输出端之间。通过第一电容C1与第二电容C2的设置，使得扫描信号输出更加稳定。
第三下拉控制模块153A包括第八十一晶体管T81，第八十二晶体管T82，第八十三晶体管T83和第八十四晶体管T84。其中，第八十一晶体管T81的栅极接入第二复位信号R2，源极电性连接于第三节点Q(j+1)，漏极电性连接于第一低压端以接收第一低压电位Vss1。第八十二晶体管T82的栅极电性连接于第四节点Qb(j+1)，源极电性连接于第三节点Q(j+1)，漏极电性连接于第一低压端以接收第一低压电位Vss1。第八十三晶体管T83的栅极接入第j+5级传信号C(j+5)的输入端(未标识)，源极电性连接于第三节点Q(j+1)，漏极电性连接于第一低压端以接收第一低压电位Vss1。第八十四晶体管T84的栅极电性连接于第五节点Qb(j+2)，源极电性连接于第三节点Q(j+1)，漏极电性连接于第一低压端以接收第一低压电位Vss1。
第四下拉控制模块153B包括第八十五晶体管T85、第八十六晶体管T86和第八十七晶体管T87。其中第八十五晶体管T85的源极和栅极电性连接于电源电压VDD，漏极与第八十六晶体管T86的栅极和第八十七晶体管T87的源极电性连接。第八十六晶体管T86的源极电性连接于电源电压VDD，漏极电性连接于第四节点Qb(j+1)。第八十七晶体管T87的栅极电性连接于第三节点Q(j+1)，漏极电性连接于第一低压端以接收第一低压电位Vss1。
第二下拉模块154包括第九十一晶体管T91、第九十二晶体管T92、第九十三晶体管T93、第九十四晶体管T94。其中，第九十一晶体管T91的栅极电性连接于第四节点Qb(j+1)，源极接入第j+1级传信号C(j+1)的输出端，漏极电性连接于第一低压端以接收第一低压电位Vss1。第九十二晶体管T92的栅极电性连接于第四节点Qb(j+1)，源极接入第j+2条扫描信号G(j+2)的输出端，漏极电性连接于第二低压端以接收第二低压电位Vss2。第九十三晶体管T93的栅极电性连接于第五节点Qb(j+2)，源极电性连接于第j+2条扫描信号G(j+2)的输出端，漏极电性连接于第二低压电位Vss2。第九十四晶体管T94的栅极电性连接于第五节点Qb(j+2)，源极接入第j+1级传信号C(j+1)的输出端，漏极电性连接于第二低压端以接收第二低压电位Vss2。
第二下拉维持模块155包括第九十五晶体管T95、第九十六晶体管T96和第九十七晶体管T97。其中，第九十五晶体管T95的栅极电性连接于第三节点Q(j+1)，源极电性连接于第四节点Qb(j+1)，漏极电性连接于第一低压端以接收第一低压电位Vss1。第九十六晶体管T96的栅极接入第j-3级传信号C(j-3)的输入端，源极电性连接于第四节点Qb(j+1)，漏极电性连接于第一低压端以接收第一低压电位Vss1。第九十七晶体管T97的栅极电性连接于第一节点Q(j)，源极电性连接于第八十五晶体管T85的漏极，漏极电性连接于第一低压端以接收第一低压电位Vss1。
请参阅图7，图7为图3中显示面板13的显示区域划分示意图。如图7所示，n个GOA单元沿第一方向F1依次排列，以4K(3840×2160)显示屏为例，即显示面板13的显示区域13a沿第一方向F1设置有2160行像素单元，扫描线S1～S2160输出对应的扫描信号至2160行像素单元15以控制像素单元15接收数据信号进行图像显示。
其中，自数据驱动电路11沿第一方向F1设置的第1-720行像素单元15为第一显示区域X1，即第1扫描线G1至第720扫描线G720对应控制的像素单元15为第一显示区域X1，第1扫描线G1至第720扫描线G720对应接收第一组GOA单元即第一个GOA单元GOA1至第360个GOA单元GOA360输出的扫描信号。
第721行至第1440行像素单元15为第二显示区域X2，即第721扫描线G721至第1440扫描线G1440控制的像素单元15为第二显示区域X2，第721扫描线G721至第1440扫描线G1440接收第二组GOA单元即第361个GOA单元GOA361至第720个GOA单元GOA720输出的扫描信号。
第1441行像素单元至2160行像素单元15为第三显示区域X3，即第1441扫描线G1441至第2160扫描线对应控制的像素单元15为第三显示区域X3，第1441扫描线G1441至第2160扫描线接收第三组GOA单元即第721个GOA单元GOA721至第1080个GOA单元GOA1080输出的扫描信号。其中，第一显示区域X1与数据驱动电路11的数据信号的输出端(未图示)间隔第一距离D1，第二显示区域X2与数据驱动电路11的数据信号的输出端间隔第二距离D2，第三显示区域X3与数据驱动电路11的数据信号的输出端间隔第三距离D3，第一距离D1、第二距离D2和第三距离D3，依次增大。
在示例性实施例中，还可以根据具体需要，将划分为其他数量的显示区域，本申请不做限制。
请参阅图8a-图8c，图8a为第一开关管的剖面结构示意图，如图8a所示，第一开关管为薄膜晶体管包括源极(s)、漏极(d)和栅极(g)，源极(s)与漏极(d)之间设置有第一预设宽度W1的导电沟道(channel)，用于在栅极(g)的控制下将源极(s)和漏极(d)导通。第一组GOA单元即第1个GOA单元GOA1至第360个GOA单元GOA360中，每个GOA单元至少包括一个第一开关管。其中，可以设置第一输出模块142中第二十二晶体管T22或第二输出模块152中第七十二晶体管T72为第一开关管，其导电沟道宽度为第一预设宽度W1。可选地，还可以设置第一输出模块142中第二十一晶体管T21和第二十二晶体管T22以及第二输出模块152中第七十一晶体管T71和第七十二晶体管T72均为第一开关管。
以第J个GOA单元为例，第二十一晶体管T21和第二十二晶体管T22的源极接入第i时钟信号、漏极连接扫描信号的输出端、栅极连接第一输出控制节点，当第一输出控制节点的电压为第一节点电位时，两个第一开关管即第二十一晶体管T21和第二十二晶体管T22分别自源极接收第i时钟信号并自漏极输出第j扫描信号和第j级传信号。
第七十一晶体管T71和第七十二晶体管T72源极接入第i+1时钟信号、漏极连接扫描信号的输出端、栅极连接第二输出控制节点，当第二输出节点的电压为第一节点电位时，两个第一开关管即第七十一晶体管T71和第七十二晶体管T72分别自源极接收第i+1时钟信号并自漏极输出第j+1扫描信号和第j+1级传信号。
图8b为第二开关管的剖面结构示意图，如图8b所示，第二开关管为薄膜晶体管包括源极(s)、漏极(d)和栅极(g)，源极(s)与漏极(d)之间设置有第二预设宽度W2的导电沟道(channel)，用于在栅极(g)的控制下将源极(s)和漏极(d)导通。第二组GOA单元即第361个GOA单元GOA361至第720个GOA单元GOA720中，每个GOA单元中至少包括一个第二开关管。其中，可以设置第一输出模块142中第二十二晶体管T22或第二输出模块152中第七十二晶体管T72为第二开关管，其导电沟道宽度为第二预设宽度W2。可选地，还可以设置第一输出模块142中的第二十一晶体管T21和第二十二晶体管T22以及第二输出模块152中的第七十一晶体管T71和第七十二晶体管T72均为第二开关管。
图8c为第三开关管的剖面结构示意图，如图8c所示，第三开关管为薄膜晶体管包括源极(s)、漏极(d)和栅极(g)，源极(s)与漏极(d)之间设置有第三预设宽度W3的导电沟道(channel)，用于在栅极(g)的控制下将源极(s)和漏极(d)导通。第三组GOA单元即第721个GOA单元GOA721至第1080个GOA单元GOA1080中，每一个GOA单元至少包括一个第三开关管。其中，可以设置第一输出模块142中第二十二晶体管T22或第二输出模块152中第七十二晶体管T72为第三开关管，其导电沟道宽度为第三预设宽度W3。可选地，还可以设置第一输出模块142中第二十一晶体管T21和第二十二晶体管T22以及第二输出模块152中第七十一晶体管T71和第七十二晶体管T72均为第三开关管。
其中，可以设置第一预设宽度W1、第二预设宽度W2和第三预设宽度W3呈梯度下降，使第一预设宽度W1与第二预设宽度W2之差等于第二预设宽度W2与第三预设宽度W3之差。具体地，可以将第一预设宽度W1、第二预设宽度W2和第三预设宽度W3分别设置为5um、4.8um和4.6um。当然还可以根据具体需要设置为其他差值的梯度下降，本申请不做限制。
通过对不同显示区域对应的扫描驱动单元中的晶体管导电沟道宽度设置，使时钟信号CLK由于传输距离的增加而导致的信号波形的变化得到补偿，从而使得显示面板13的图像显示更加均匀。
在示例性实施例中第一预设宽度W1、第二预设宽度W2和第三预设宽度W3还可以根据具体需要设置为其他值以及其他比例关系，本申请不做限制。
在一种实施例中，对应控制第一显示区域X1进行图像显示的第一组GOA单元中的每个GOA单元中所有晶体管均为第一开关管，对应控制第二显示区域X2进行图像显示的第二组GOA单元中的每个GOA单元中所有晶体管均为第二开关管，对应控制第三显示区域X3进行图像显示的第三组GOA单元中的每个GOA单元中所有晶体管均为第三开关管。
请参阅图9，图9为图7中不同显示区域对应输出扫描信号波形示意图。如图9所示，显示控制电路14输出时钟信号CLK至扫描驱动电路中的1080个GOA单元中，以控制2160个扫描信号的输出。由于自第一个GOA单元GOA1至第1080个GOA单元GOA1080距离显示控制电路14的距离逐渐增加，使得时钟信号CLK的信号传输距离增加，同时信号传输过程中受到的阻抗也逐渐增加，使得时钟信号CLK由于受到得阻抗不同而导致GOA单元接收的时钟信号CLK不同，进而导致扫描信号的输出波形不同，影响显示面板13的图像显示质量。通过将第一显示区域X1、第二显示区域X2和第三显示区域X3对应的GOA单元中控制扫描信号输出的晶体管的导电沟道宽度分别设置为逐渐减小，使得晶体管的导电能力提升，从而补偿时钟信号CLK由于阻抗增加而导致的信号衰减，降低了第一显示区域X1、第二显示区域X2和第三显示区域X3对应的GOA单元输出的扫描信号波形差异，使不同显示区域扫描信号输出更加稳定，从而使得显示面板13图像显示更加均匀。
应当理解的是，本发明的应用不限于上述的举例，对本领域普通技术人员来说，可以根据上述说明加以改进或变换，所有这些改进和变换都应属于本发明所附权利要求的保护范围。

Claims (10)

1.一种扫描驱动电路，包括沿着并级联的n个扫描驱动单元，n为大于或等于1的整数，其特征在于，n个所述扫描驱动单元包括第一组扫描驱动单元、第二组扫描驱动单元和第三组扫描驱动单元，所述第一组扫描驱动单元用于输出扫描信号至显示区域的第一显示区域，所述第二组扫描驱动单元用于输出所述扫描信号至所述显示区域的第二显示区域，所述第三组扫描驱动单元用于输出扫描信号至所述显示区域的第三显示区域，其中，所述第一显示区域、所述第二显示区域和所述第三显示区域沿着第一方向依次排列，所述第一方向为数据信号输出并传输的方向，所述扫描信号用于输出至所述显示区域中的扫描线并控制对应连接于所述扫描线的像素单元接收所述数据信号以执行图像显示；
所述第一组扫描驱动单元中每个所述扫描驱动单元包括至少一个用于输出所述扫描信号的第一开关管，所述第二组扫描驱动单元中每个所述扫描驱动单元包括至少一个用于输出所述扫描信号的第二开关管，所述第三组扫描驱动单元中每个所述扫描驱动单元包括至少一个输出所述扫描信号的第三开关管，所述第一开关管、所述第二开关管和所述第三开关管的导电沟道的宽度依次减小。
2.如权利要求1所述的扫描驱动电路，其特征在于，n个所述扫描驱动单元沿着所述第一方向依次排列设置；
所述第一开关管的导电沟道宽度为第一预设宽度，所述第二开关管的导电沟道具有第二预设宽度，所述第三开关管的导电沟道具有第三预设宽度，所述第一预设宽度与所述第二预设宽度之差等于所述第二预设宽度与所述第三预设宽度之差。
3.如权利要求2所述的扫描驱动电路，其特征在于，所述第一开关管、所述第二开关管和所述第三开关管为薄膜晶体管，所述扫描驱动单元包括第一输出模块和第二输出模块，所述第一输出模块和所述第二输出模块分别控制一个所述扫描信号输出；
在所述第一组扫描驱动单元中，每一个所述扫描驱动单元中的所述第一输出模块和所述第二输出模块分别至少包括一个所述第一开关管；
在所述第二组扫描驱动单元中，每一个所述扫描驱动单元中的所述第一输出模块和所述第二输出模块分别至少包括一个所述第二开关管；
在所述第三组扫描驱动单元中，每一个所述扫描驱动单元中的所述第一输出模块和所述第二输出模块分别至少包括一个所述第三开关管。
4.如权利要求3所述的扫描驱动电路，其特征在于，包括M个时钟信号，第J扫描驱动单元包括第一输出控制节点和第二输出控制节点，所述第一输出模块接入第i时钟信号并连接所述第一输出控制节点，当所述第一输出控制节点的电压为第一节点电位时，所述第一输出模块接收所述第i时钟信号并输出第j扫描信号，其中，1≤i＜M，1≤J≤n，j＝2J-1；所述第二输出模块接入第i+1时钟信号并连接所述第二输出控制节点，当所述第二输出控制节点的电压为所述第一节点电位时，所述第二输出模块接收所述i+1时钟信号并输出第j+1扫描信号。
5.如权利要求4所述的扫描驱动电路，其特征在于，当所述第J个扫描驱动单元在所述第一组扫描驱动单元内时，所述第一输出模块包括两个所述第一开关管，两个所述第一开关管的源极接入所述第i时钟信号、漏极连接所述扫描信号的输出端、栅极连接所述第一输出控制节点，当所述第一输出控制节点的电压为所述第一节点电位时，两个所述第一开关管分别自源极接收所述第i时钟信号并自漏极输出所述第j扫描信号和第j级传信号；
所述第二输出模块包括两个所述第一开关管，两个所述第一开关管的源极接入所述第i+1时钟信号、漏极连接所述扫描信号的输出端、栅极连接所述第二输出控制节点，当所述第二输出控制节点的电压为所述第一节点电位时，两个所述第一开关管分别自源极接收所述第i+1时钟信号并自漏极输出所述第j+1扫描信号和第j+1级传信号。
6.如权利要求5所述的扫描驱动电路，其特征在于，所述第一输出控制节点的电压为第二节点电位时，所述第一输出模块停止接收所述第i时钟信号并停止输出所述第j扫描信号和第j级传信号，所述第二输出控制节点的电压为所述第二节点电位时，所述第二输出模块停止接收所述第i+1时钟信号并停止输出所述第j+1扫描信号和第j+1级传信号。
7.如权利要求4-6任意一项所述的扫描驱动电路，其特征在于，所述第J个扫描驱动单元与第J-2个扫描驱动单元级联，所述第J个扫描驱动单元还包括第一上拉控制模块和第二上拉控制模块，所述第一上拉控制模块连接所述第一输出控制节点，所述第一上拉控制模块接收所述第J-2个扫描驱动单元输出的第j-4级传信号，以控制所述第一输出控制节点的电压位于所述第一节点电位；
所述第二上拉控制模块连接所述第二输出控制节点，所述第二上拉控制模块接收所述第J-2个扫描驱动单元输出的第j-3级传信号，以控制所述第二输出控制节点的电压位于所述第一节点电位。
8.如权利要求1或2所述的扫描驱动电路，其特征在于，所述第一组扫描驱动单元中的每个所述扫描驱动单元内的所有晶体管为所述第一开关管，所述第二组扫描驱动单元中每个所述扫描驱动单元内的所有晶体管为所述第二开关管，所述第三组扫描驱动单元中每个所述扫描驱动单元内的所有晶体管为所述第三开关管。
9.一种显示面板，其特征在于，包括设置于显示区域且呈矩阵排布的多个像素单元、设置于非显示区域的数据驱动电路、显示控制电路以及如权利要求1-8中任意一项所述的扫描驱动电路，所述扫描驱动电路依据所述显示控制电路输出的栅极输出控制信号，配合所述数据驱动电路依据所述显示控制电路输出的源极输出控制信号而沿着所述第一方向输出的数据信号驱动所述像素单元进行图像显示。
10.一种显示装置，其特征在于，包括支撑框架、电源模组和如权利要求9所述的显示面板，所述电源模组为所述显示面板进行图像显示提供电源电压，所述显示面板与所述电源模组固定于所述支撑框架。
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