CN114696621A - 可配置控制回路布置 - Google Patents

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Abstract

一种用于形成DC‑DC转换器的控制回路的可配置控制回路布置，该可配置控制回路布置被配置成生成用于控制所述DC‑DC转换器的控制信号，所述可配置控制回路布置包括：数模转换器；比较器；定时器，所述定时器被配置成提供用于控制以下各项中的一个或多个的定时信号：所述比较器确定所述比较信号；将所述比较信号施加到可配置事件生成逻辑模块；以及操作所述可配置事件生成逻辑模块；其中所述可配置事件生成逻辑模块包括触发器电路，并且其中当在所述控制回路中实施时，所述可配置事件生成逻辑模块被配置成基于所述比较信号、所述定时信号和所述触发器电路的选定模式来提供所述控制信号的生成，并且其中所述控制信号用于施加到所述DC‑DC转换器的一个或多个开关。

Description

可配置控制回路布置
技术领域
本公开涉及一种可配置控制回路布置。具体地，可配置控制回路布置可以不同方式配置以提供用于不同DC-DC转换器的控制回路。
背景技术
多年来，DC-DC转换器控制回路的实施基本上是模拟的。模拟控制回路可能很复杂、笨重且不灵活。对于任何新的控制方法和应用(例如对于服务器电源和D类无线充电器)来说，可能有利的是待开发的数字解决方案。然而，这可能会导致将产品推向市场的重大延迟。
发明内容
根据本公开的第一方面，提供一种用于形成DC-DC转换器的控制回路的可配置控制回路布置，所述可配置控制回路布置被配置成生成用于控制所述DC-DC转换器的控制信号，所述可配置控制回路布置包括：
数模转换器，所述数模转换器被配置成接收指示来自所述DC-DC转换器的次级侧的输出电压与基准电压之间的差的第一数字参数，并且基于所述第一数字参数输出模拟转换器输出控制信号；
比较器，所述比较器被配置成在第一端接收所述模拟转换器输出控制信号并且在第二端接收监视参数，所述比较器被配置成基于所述转换器输出控制信号与所述监视参数之间的差来输出比较信号，其中所述第二端被配置成耦合到所述DC-DC转换器的初级侧以接收所述监视参数，所述监视参数指示在所述DC-DC转换器的初级侧的组件处流动的电压或电流中的一个；
定时器，所述定时器被配置成提供用于控制以下各项中的一个或多个的定时信号：所述比较器确定所述比较信号；将所述比较信号施加到可配置事件生成逻辑模块；以及操作所述可配置事件生成逻辑模块；
其中所述可配置事件生成逻辑模块包括：触发器电路，所述触发器电路包括触发器单元和模式控制电路系统，所述模式控制电路系统被配置成使所述触发器单元能够以包括多个模式中的一个模式的选定模式进行操作，所述选定模式是基于在所述模式控制电路系统的端处接收到的配置信号而选择的，其中当在所述控制回路中实施时，所述可配置事件生成逻辑模块被配置成基于所述比较信号、所述定时信号和所述触发器电路的所述选定模式来提供所述控制信号的生成，并且其中所述控制信号用于施加到所述DC-DC转换器的一个或多个开关。
因此，所述DAC可以被配置成从与所述可配置控制回路布置一起形成所述控制回路的部分的基于软件的模块接收所述第一数字参数。
在一个或多个实施例中，所述第二端被配置成接收以下之一作为所述监视参数：
所述DC-DC转换器的初级变压器绕组中的电流的测量值；以及
第一电容器电压，其中所述DC-DC转换器的所述初级侧包括LLC布置，其中所述LLC布置包括与所述DC-DC转换器的第二电感器和初级变压器绕组的并联布置串联的第一电感器和第一电容器。
在一个或多个实施例中，所述可配置事件生成逻辑模块包括与或反相模块，所述与或反相模块包括可基于与或反相控制信号采用至少第一配置和第二配置中的任一个的可配置逻辑门的布置，其中
所述与或反相模块被配置成至少接收所述比较信号和所述定时信号，并基于当前采用所述至少第一和第二配置中的哪一个来提供对应第一组值或不同的对应第二组值作为输出，所述第一组值和所述第二组值包括不同组值，这些不同组值包括所述比较信号、所述定时信号、应用了逻辑运算的所述比较信号以及应用了逻辑运算的所述定时信号，并且其中所述输出被提供给所述触发器电路。
在一个或多个例子中，所述布置包括PWM发生器，所述PWM发生器被配置成基于所述控制信号来生成用于控制所述DC-DC转换器的开关的PWM信号，并且其中所述与或反相模块还被配置成接收所述PWM信号，并且取决于所述第一配置或第二配置而输出所述PWM信号或应用了逻辑运算的所述PWM信号。
在一个或多个例子中，所述与或反相模块包括被配置成接收持续逻辑高信号的逻辑高端和被配置成接收持续逻辑低信号的逻辑低端，并且其中所述与或反相模块被配置成另外基于所述逻辑高和逻辑低信号而在所述第一配置和所述第二配置中的一者或两者中提供所述逻辑运算。
在一个或多个实施例中，所述逻辑运算包括至少应用于所述比较信号和所述定时信号的逻辑与、逻辑非和逻辑或或它们的组合中的一个或多个。
在一个或多个实施例中，所述模式控制电路系统被配置成控制施加到所述触发器单元的信号，从而将所述触发器单元配置成以所述多个模式操作，所述多个模式包括具有作为以下触发器中的至少两者操作的所述触发器单元的模式：
置位-复位触发器；
延迟触发器；
D锁存触发器；
T触发器；以及
JK触发器。
在一个或多个实施例中，所述触发器单元包括具有D输入、C输入、Q输出和Q互补输出的延迟型触发器，并且所述模式控制电路系统被配置成在所述多个模式中的一个模式下将所述Q互补输出提供给所述D输入，并且在所述多个模式中的不同模式下将对所述触发器电路的输入提供给所述触发器单元，所述输入是基于所述定时信号或所述比较信号之一。
在一个或多个实施例中，所述可配置事件生成逻辑模块包括计数器，所述计数器被配置成从所述可配置事件生成逻辑模块接收时钟信号和所述控制信号，所述计数器可被配置成测量表示所述控制信号的状态的持续时间的时间段，并且在从所述控制信号的所述状态改变的时间点起经过所述测得的时间段后，向所述触发器电路提供输入，以提供对所述控制信号的控制。
在一个或多个实施例中，所述可配置控制回路布置包括以下项中的一个或多个：
GPIO输入，所述GPIO输入被配置成接收指示对在操作期间所述控制回路与外部事件同步或对安全关机的请求的信令；
ADC输入，所述ADC输入被配置成接收指示对过热限制关机的请求的信令；
PWM输入，所述PWM输入被配置成接收PWM信号，所述PWM信号包括所述控制信号的脉冲宽度调制版本。
在一个或多个实施例中，所述可配置控制回路布置包括至少第一多路复用器布置，所述第一多路复用器布置具有多个输入端和多个输出端并且包括多个多路复用器，其中每个多路复用器与所述多个输出端中的相应一个输出端相关联；
其中所述多个多路复用器各自被配置成接收在所述多个输入端处接收到的多个信号，所述多个多路复用器各自可被独立地配置成基于多路复用选择信号将由此接收到的所述多个信号中的一个引导到其相关联的输出端；
其中在所述多个输入端处接收到的所述多个信号包括所述比较信号，并且所述多个输出端耦合到所述与或反相模块。
在一个或多个例子中，所述布置包括PWM发生器，所述PWM发生器被配置成基于所述控制信号生成用于控制所述DC-DC转换器的开关的PWM信号，并且其中所述第一多路复用器还被配置成接收所述PWM信号并将所述PWM信号输出到所述与或反相模块和所述触发器电路中的一个或两个。
在一个或多个实施例中，在所述第一多路复用器布置的所述多个输入端处接收到的所述多个信号包括被配置成基于所述控制信号生成PWM信号的PWM发生器的输出。
在一个或多个实施例中，所述第一多路复用器的所述多个输入信号包括所述定时信号，并且所述多个输出端中的至少一个耦合到所述比较器以使得能够控制所述确定所述比较信号。
在一个或多个实施例中，所述可配置控制回路布置包括至少第二多路复用器布置，所述第二多路复用器布置具有多个输入端和多个输出端并且包括多个多路复用器，其中每个多路复用器与所述多个输出端中的相应一个输出端相关联；
其中所述多个多路复用器各自被配置成接收在所述多个输入端处接收到的多个信号，所述多个多路复用器各自能被独立地配置成基于第二多路复用选择信号将由此接收到的所述多个信号中的一个引导到所述相关联的输出端；
其中在所述多个输入端处接收到的所述多个信号包括所述触发器电路的输出。
在一个或多个实施例中，所述第二多路复用器的所述多个输出端耦合到第二与或反相模块和脉冲宽度调制PWM发生器，所述第二与或反相模块被配置成将逻辑运算应用于施加到其上的输入信号，所述PWM发生器被配置成基于来自所述第二多路复用器的所述输出端的所述信号来生成一个或多个PWM信号。
在一个或多个实施例中，所述可配置控制回路布置包括脉冲宽度调制PWM发生器，所述PWM发生器被配置成至少基于由所述触发器电路生成的所述控制信号来生成一个或多个PWM信号，所述PWM信号包括用于所述DC-DC转换器的开关的开关模式。
在一个或多个实施例中，所述可配置控制回路布置可被配置成用于相移全桥、PSFB、DC-DC转换器和半桥LLC DC-DC转换器中的至少一个的控制回路。
根据本公开的另一方面，提供一种由DC-DC转换器供电的装置，所述装置具有根据第一方面所述的被配置成为所述DC-DC转换器提供控制回路的可配置控制回路布置。在一个或多个例子中，所述装置包括用于计算装置的无线充电器或电源。
虽然本公开容许各种修改和替代形式，但是已经借助于例子在图式中示出其特殊性且将进行详细描述。然而，应理解，超出所描述的特定实施例的其它实施例也是可能的。也涵盖落在所附权利要求书的精神和范围内的所有修改、等效物和替代实施例。
以上论述并非旨在表示当前或未来权利要求集的范围内的每个示例实施例或每个实施方案。附图和之后的具体实施方式还举例说明了各种示例性实施例。考虑以下结合附图的详细描述可以更全面地理解各种示例实施例。
附图说明
现将仅借助于例子参考附图来描述一个或多个实施例，在附图中：
图1示出DC-DC转换器的可配置控制回路布置的示例实施例；
图2示出包括与或反相模块的可配置事件生成逻辑模块的一部分的示例实施例；
图3示出触发器电路和模式控制电路系统的示例实施例；
图4A-图4D示出基于模式控制电路系统在不同选定模式下的触发器电路的示例表示；
图5示出示例PWM发生器；
图6示出DC-DC转换器的控制回路的第二示例实施例；
图7示出用于将在对应多个输入端处接收到的多个输入信号中的每一个路由到一组输出端中的特定输出端以提供可配置控制回路的多路复用器布置的示例实施例；
图8示出可配置控制回路布置的示例实施例，所述可配置控制回路布置呈提供包括相移全桥(PSFB)的DC-DC转换器控制回路的配置；
图9示出图8的示例控制回路的各种信号的示例定时图；
图10示出可配置控制回路布置的示例实施例，所述可配置控制回路布置呈提供包括半桥LLC转换器的DC-DC转换器控制回路的配置；
图11示出图10的控制回路的更详细的示例实施例；
图12示出操作可配置控制回路布置的计数器的示例定时图。
具体实施方式
本公开的例子呈现了用于实施DC-DC转换器的控制回路的可配置控制回路布置。因此，在以下实施例中描述的硬件组件是可配置的，从而可以形成控制回路以控制DC-DC转换器。例如，本文所述的可配置控制回路布置可以接收信令，以使可配置控制回路布置将自身配置成用作相移全桥DC-DC转换器的控制回路。可替换的是，不同的信令可以使可配置控制回路布置将自身配置成用作半桥LLC转换器DC-DC转换器的控制回路。应理解，需要DC-DC转换器的控制回路来接收表示DC-DC转换器的工作状态的信号并提供控制信号(所述控制信号可以包括一个或多个分量信号)以控制DC-DC转换器的开关的工作。例如，控制信号可以用于控制DC-DC转换器的初级侧的一个或多个开关，例如控制向DC-DC转换器的初级绕组施加功率的开关。
特定DC-DC转换器类型的控制可能需要不同的测得信号或在形成可配置控制回路布置的硬件组件的不同端处接收到的信号的不同组合。因此，可配置控制回路布置可以包括用于修改输入信号并将输入信号路由到触发器电路的组件，其中触发器电路被配置成生成控制信号。
硬件组件中的一个或多个由软件配置成采用这样的配置：实施所需控制回路和/或一旦被配置成与特定DC-DC转换器一起使用就控制可配置控制回路布置的操作。
可配置控制回路布置包括可配置事件生成逻辑模块(或简称为CEVTG模块)，所述模块在硬件上包括触发器电路和模式控制电路系统，以提供对DC-DC转换器的有效控制。可配置控制回路布置还包括模拟比较器和数模转换器(DAC)以及可编程定时器，如下文的例子所示，它们为所述CEVTG模块提供输入，用于确定控制DC-DC转换器的控制信号。已经发现可配置控制回路布置硬件的这种布置提供了不同的期望控制回路的特别有效的实施方案。此外，使用可配置控制回路布置实施的控制回路可以克服在软件中或作为专用集成电路实施等效控制回路时可能遇到的处理限制。
一般来说，CEVTG模块包括触发器电路，所述触发器电路可以从可选的多路复用器布置接收用于确定控制信号的信令，所述可选的多路复用器布置被配置成提供由CEVTG模块接收的信号的路由。CEVTG模块可以进一步包括用于将逻辑运算应用于输入信号和/或形成输入信号的逻辑组合的与或反相(AOI)布尔逻辑模块。因此，AOI模块能够创建触发器电路所需的信号，以生成无论实施任何控制回路都适用的控制信号。触发器电路包括触发器单元和模式控制电路系统，以使触发器单元作为不同类型的触发器来操作。模式控制电路系统可以由软件导出的配置信号来配置，所述信号将触发器电路配置成用作J-K触发器、D触发器、R-S锁存触发器、T触发器。软件导出的配置信号还可以配置与或反相(AOI)布尔逻辑模块和/或第一多路复用器布置。
可配置控制回路布置可以使用可配置硬件块(可通过可从基于软件的过程导出的配置信号来配置)来构建控制回路，所述控制回路可以在软件参与减少的情况下进行操作。在一个或多个例子中，由可配置控制回路布置形成的控制回路支持各种操作模式，例如DC-DC转换器功率转换应用中的软启动和突发模式。
现在参考附图，图1示出用于DC-DC转换器101的控制回路100。示意性地示出DC-DC转换器101以简单地示出总体结构。DC-DC转换器101可以包括开关模式电源，例如相移全桥转换器或半桥LLC转换器。如本领域技术人员将知道的，此类转换器通常包括用于接收和切换输入电压的初级侧102，以及可选地由变压器104隔开的提供转换器的输出电压的次级侧103。初级侧通常具有一个或多个开关，用于切换输入电压以控制初级侧102的一个或多个组件的充电。本文公开的可配置控制回路布置100可以提供用于生成控制信号的组件/模块的有利布置，在某种程度上与转换器类型无关。
可配置控制回路布置100被配置成在输出109处生成控制DC-DC转换器101的控制信号。控制信号可以提供对DC-DC转换器的一个或多个开关的控制。例如，控制信号可以在开关在非导通与导通状态之间切换的定时方面提供对开关的所述控制。应了解，可能存在本领域技术人员已知的其它方式来控制DC-DC转换器。
可配置控制回路布置100包括使得能够形成控制回路的多个组件。
可配置控制回路布置100包括数模转换器110，用于接收指示DC-DC转换器的操作的第一参数，当配置时，由可配置控制回路布置100提供的控制是基于所述第一参数。可配置控制回路布置100另外包括模拟比较器111、定时器112和CEVTG模块108。这一组核心组件110、111、112、108可以提供用于形成各种不同控制回路阵列的布置。在以下例子中，除了组件110、111、112、108外，还描述了其它组件，这些组件可以进一步增加可配置控制回路布置100的灵活性。
数模转换器110被配置成基于来自DC-DC转换器101的次级侧103的输出电压而在端116处接收第一数字参数。在一个或多个例子中，第一数字参数指示DC-DC转换器101的输出电压与基准电压之间的差。在一个或多个例子中，所述第一数字参数由软件实施的模块来确定，所述模块不在本公开的范围之内。
数模转换器110被配置成基于第一数字参数而在端117处输出模拟转换器输出控制信号。端117形成数模转换器110的输出以及模拟比较器111的第一输入端。
模拟比较器111被配置成接收模拟转换器输出控制信号。比较器111的另一个第二端118被配置成接收监视参数。比较器111被配置成基于转换器输出控制信号与输出端120处的监视参数之间的差来输出比较信号。监视参数指示DC-DC转换器的初级侧的属性，或更具体地，初级侧102的组件的属性，例如DC-DC转换器101的初级侧102的组件上的电压或流向或流自所述组件的电流中的一者。
因此，在一个或多个例子中，可配置控制回路布置100可以被配置成“电流控制”控制回路，并且监视参数包括DC-DC转换器101的初级变压器绕组中的电流的测量值。在另一个例子中，转换器101可以是LLC谐振类型的，并且监视参数可以包括第一电容器电压，其中所述DC-DC转换器的初级侧102包括LLC布置，其中LLC布置包括与并联布置串联的第一电感器和第一电容器，所述并联布置包括与DC-DC转换器的初级变压器绕组并联的第二电感器。
定时器112被配置成提供一个或多个定时信号以用于生成控制信号。在一个或多个例子中，在确定比较信号时，使用定时信号来控制比较器111。具体地，定时信号可以用于定义所述比较器111在其中提供比较信号120的时间窗口。如果监视参数包括电流，则这可能是有利的，因为本领域技术人员将知道DC-DC转换器的开关闭合会产生振铃，并且不希望比较器在发生所述振铃时进行比较。因此，定时器112允许在可配置控制回路布置的一些配置中对比较器111进行窗口操作。
通常，由定时器112生成的定时信号可以被配置成控制比较器确定比较信号；控制将比较信号应用于可配置事件生成逻辑模块；以及控制可配置事件生成逻辑模块的操作；以及其它目的。
来自比较器111在端120处的输出作为输入提供给CEVTG模块108。
CEVTG模块108也可以被配置成在端121接收通用输入输出信号，并在端122处接收ADC信号。
GPIO输入端121可以配置成接收指示对在操作期间控制回路与外部事件同步或对安全关机的请求的信令。例如，出于安全原因，本文中未描述的用于控制DC-DC转换器101的其它组件可以请求关闭DC-DC转换器。
ADC输入端122可以被配置成接收指示对过热限制关机的请求的信令。
CEVTG模块108包括触发器电路114(在图3中更详细地示出)。触发器电路114包括可配置触发器单元和模式控制电路系统，将在下面更详细地描述。
触发器电路114的模式控制电路系统被配置成使触发器电路能够以包括多个模式之一的选定模式进行操作，其中所述选定模式是基于由控制回路100接收的配置信号来选择的。取决于可配置控制回路布置100的配置，这使得触发器电路能够像是多种不同的触发器类型一样操作。配置信号可以包括用于配置布置100的各种组件的多个分量信号，以使得可配置控制回路布置100被配置成形成期望的控制回路。因此，模式控制电路系统配置信号可以是配置信号的一部分，特别是用于配置模式控制电路系统和触发器电路114。
CEVTG模块108被配置成基于来自120的比较信号、来自定时器112的定时信号和选定模式来提供控制信号的生成。CEVTG模块108可以另外被配置成另外基于GPIO信号121和ADC信号122以及在123处接收到的PWM信号中的一个或多个提供控制信号的生成。
CEVTG模块108可以包括与或反相模块113，所述与或反相模块113包括可配置逻辑门的布置，其可以采用基于与或反相控制信号的至少第一配置和第二配置中的任一个。与或反相控制信号可以是使可配置控制回路布置100被配置成形成期望的控制回路的信令的一部分。与或反相控制信号可以是使布置100形成期望的控制回路的配置信号之一。与或反相控制信号可以由软件控制的过程生成。
与或反相模块113可以被配置成至少在端120处接收比较信号和从定时器112接收定时信号，并且基于当前至少采用第一和第二配置中的哪一个来提供对应的第一组值或不同的对应第二组值作为输出，第一组值和第二组值包括不同组值，所述不同组值包括应用了不同逻辑运算的比较信号和定时信号。在一个或多个例子中，与或反相模块113另外接收GPIO信号121和ADC信号122以及在123处接收的PWM信号。
逻辑运算包括至少应用于比较信号和定时信号(以及施加于所述信号的任何其它输入信号)的逻辑与、逻辑反相(非)和逻辑或中的一个或多个。与或反相模块113可以被配置成应用逻辑运算的组合。例如，在第一例子中，223处的输出可以由软件配置成包括输入201与输入204+(201处的输入+(输入202与输入203))。在另一个例子中，多路复用器的配置可以得出223处的输出＝(201处的输入+203处的输入)&(202处的反相输入+204处的反相输入)。
应理解，控制信号的生成需要触发器电路114根据由可配置控制回路布置100实施的控制回路来接收不同的信号。那些不同的信号包括比较信号和定时信号以及可选地GPIO信号121、ADC信号122和PWM信号123。在一个或多个例子中，控制信号的生成可能需要触发器电路接收所述比较信号和定时信号的逻辑组合或逻辑变化以及可选地GPIO信号121、ADC信号122和PWM信号123。与或反相模块113为触发器电路114提供所述信号和/或那些信号的逻辑组合。因此，与或反相模块113提供了灵活的块，用于通过可配置控制回路布置100实施不同控制回路。
图2示出与或反相模块113的示例实施例。与或反相模块包括针对输入到其上的N个信号中的每一者的多个输入201、202、203、204(第一、第二、第三、第四、……、第N输入)。因此，与或反相模块113可以被配置成接收比较信号和定时信号以及可选地GPIO信号121、ADC信号122和PWM信号123中的一个或多个。应了解，如果需要输入信号的另外的逻辑组合，则一些实施例可以包括多个与或反相模块。多个与或反相模块可以彼此串联或并联实施。
在这个例子中，与或反相模块113包括被配置成接收持续逻辑高信号的逻辑高端225和被配置成接收持续逻辑低信号的逻辑低端224。
与或反相模块包括多个反相与布置205、206、207和208。在这个例子中，存在与N个输入相对应的N个反相与布置，但是也可以更多或更少。每个反相与布置205-208接收N个输入信号中的每一个。每个反相与布置包括N个选择器210、211、212、213(为简单起见仅针对反相与布置205示出)，所述N个选择器可以体现为N个多路复用器。每个选择器210、211、212、213被配置成借助于反相器214、215、216和217接收N个输入信号中的一个以及一个反相版本。持续逻辑高和逻辑低信号也提供给选择器210-213中的每一个。因此，可以控制每个反相与布置205-208的第一选择器210以传递输入201处的信号或传递第一输入201处的信号的反相版本，即逻辑0或逻辑1，或持续逻辑高信号或持续逻辑低信号中的一个。同样，可以控制每个反相与布置205-208的第二选择器211以传递第二输入202处的信号或传递第二输入202处的信号的反相版本，即逻辑0或逻辑1，或持续逻辑高信号或持续逻辑低信号中的一个。同样，可以控制每个反相与布置205-208的第三选择器212以传递第三输入203处的信号或传递第三输入203处的信号的反相版本，即逻辑0或逻辑1，或持续逻辑高信号或持续逻辑低信号中的一个。类似地，可以控制每个反相与布置205-208的第四选择器213以传递第四输入204处的信号或传递第四输入204处的信号的反相版本，即逻辑0或逻辑1，或持续逻辑高信号或持续逻辑低信号中的一个，等，当然，可以存在许多N个输入和反相与布置。在一般情况下，存在至少两个、至少三个或至少四个输入和反相与布置205-208。
每个反相与布置205-208包括逻辑与218、219、220和221，所述逻辑与218、219、220和221被配置成接收其相应的第一到第四(或第N)选择器210-213的(选定)输出并输出其逻辑与组合。
与或反相模块113另外包括逻辑或222，所述逻辑或222被配置成从每个反相与布置205-208的逻辑与218、219、220和221中的每一个接收输出。逻辑或222在端223处输出其输入的逻辑或。
选择器210-213由与或反相控制信号单独控制，所述信号可以是软件导出的。
因此，总而言之，与或反相模块被配置成执行包括逻辑与、逻辑或和/或逻辑非及其组合的任伺N进1出布尔运算。与或反相模块还可以被配置成另外基于第一配置和第二配置中的一个或两个中的所述持续逻辑高和逻辑低信号来提供所述逻辑运算。
作为一个例子，在AOI模块113中，可以配置成通过软件提供各种布尔运算。在图2中，选择器210可以接收表示为PT0_AC的与或反相控制信号，选择器211可以接收与或反相控制信号PT0_BC，选择器212可以接收与或反相控制信号PT0_CC，并且选择器213可以接收与或反相控制信号PT0_DC。
在一个或多个例子中，与或反相控制信号“00”可以迫使选择器的输出为逻辑零。与或反相控制信号“01”可以使输入信号通过。与或反相控制信号“10”可以使输入信号的互补信号通过。与或反相控制信号“11”可以迫使选择器的输出为逻辑一。
例如，如果与或反相控制信号设置PT0_AC＝01、PT0_BC＝10；PT0_CC＝10；以及PT0_DC＝01，则端210处的输出等于201处的输入；选择器211的输出是202处的输入的反相版本；选择器212的输出是203处的输入的反相版本；选择器213的输出等于输入204处的信号。因此，逻辑与218的输出为(使用端的参考数字来参考在任何一次施加到其上的信号)201&(～202)&(～203)&204。
应了解，在随后的图8和图11的例子中提供的所有逻辑门是由AOI模块113(或根据需要由另外的AOI模块)生成的。
因此，总而言之，与或反相模块可以被配置成输出包括一个、两个或三个或更多个未修改的输入信号的输入信号的逻辑组合、输入信号的逻辑非版本、两个或更多个输入信号的逻辑与组合、三个或更多个输入信号或其逻辑修改的逻辑与组合，以及一个或多个输入信号的逻辑或或其逻辑版本/组合。
因此，作为一个例子，如果在201处接收到信号A，在202处接收到信号B，在203处接收到信号C，在204处接收到信号D，则与或反相模块113可以将任何逻辑组合形式化，下表中示出其中一些：
事件输出表达 PT0 PT1 PT2 PT3
A&B A&B 0 0 0
A&B&C A&B&C 0 0 0
(A&B&C)+D A&B&C D 0 0
A+B+C+D A B C D
(A&～B)+(～A&B) A&～B ～A&B 0 0
PT0、PT1、PT2和PT3分别表示在逻辑与218、219、220、221的输出处的每一个反相与布置的输出。
图3示出触发器电路114的示例实施例。触发器电路包括触发器单元300和包围触发器单元300的模式控制电路系统301。在这个例子中，图3示出触发器电路114接收来自两个与或反相模块113的输入。
模式控制电路系统301包括第一输入302，所述第一输入302被配置成接收来自与或反相模块113中的第一与或反相模块的输出。模式控制电路系统301包括第二输入303，所述第二输入303被配置成接收来自与或反相模块113中的第二与或反相模块的输出。通常，与或反相模块113仅可以接收输入302、303中的一个，其中另一个可以包括定时信号和比较信号中的一个。第一输入和第二输入可以分别通过可选的滤波器304、305。
第一输入302和第二输入303处的信号分别耦合到第一输出多路复用器306和第二输出多路复用器307。第一输出多路复用器306和第二输出多路复用器307每个接收另外的信号。第一输出多路复用器306从触发器单元300接收第一Q输出308。第二输出多路复用器307从触发器单元300接收第二
Figure BDA0002874512120000151
输出(Q-互补输出)308。因此，第一输出多路复用器306被配置成选择触发器电路114的第一输入302或第一Q输出308作为第一输出端311处的第一输出。因此，第二输出多路复用器307被配置选择触发器电路114的第二输入303或第二
Figure BDA0002874512120000152
输出310作为第二输出端311的第二输出。311和312处的第一和第二输出包括控制回路100的控制信号(在这个例子中经过PWM处理)。
触发器单元300包括延迟触发器，但是，通过模式控制电路系统301的作用，触发器电路114可以用作置位-复位触发器、延迟触发器、T触发器和JK触发器中的任一个。
触发器单元300在C输入端314处从输入303接收第二信号。D输入端313耦合到组合逻辑块315的输出。组合逻辑块315将来自302的第一信号或第二
Figure BDA0002874512120000153
输出310提供给D输入端。组合逻辑块315对第一D输入端313的输入的选择可以至少部分地确定触发器电路114的模式。组合逻辑块315的配置可以由软件导出的组合逻辑块配置信号置位。
触发器单元300的复位输入316是基于第一输入302和RS模式信号319的逻辑与321组合，以及可选地来自端317的异步复位信号的逻辑或322和逻辑与块321的输出。RS模式信号319和异步复位信号317的提供可以由软件控制。
触发器单元300的置位输入318是基于逻辑与323中的第二输入303与RS模式信号320的组合。RS模式信号320可以由软件控制。
在图3中，示出Q输出310被反馈到反馈超驰块330，所述反馈超驰块330可被配置成选择性地将触发器单元300的Q输出提供给与或反相模块113。
(由组合逻辑块配置信号确定的)组合逻辑块315的动作、319处的RS模式信号和319处的RS模式信号可以定义触发器电路114的模式。因此，组合逻辑块315的动作、319处的RS模式信号和319处的RS模式信号将可配置控制回路布置100配置成用作特定的控制回路。
图4A到图4D的例子示出多个实施例，示出模式控制电路系统301的配置如何使触发器单元300以多个不同模式操作，从而使触发器单元300作为多个不同触发器中的任何一个进行操作。图4A示出复位置位触发器400。图4B示出D触发器401。图4C示出D锁存触发器402且图4D示出T触发器403。触发器电路114还可以用作JK触发器。
返回图1，在一个或多个例子中，由触发器电路114生成的控制信号经由脉冲宽度调制PWM发生器115施加到DC-DC转换器101。因此，可以通过由PWM发生器115生成的PWM信令基于来自触发器电路114的输出的控制信号来控制DC-DC转换器的开关。
PWM发生器115被配置成基于由触发器电路114生成的控制信号来生成一个或多个PWM信号，所述PWM信号被配置成向DC-DC转换器的开关应用开关模式。因此，初级侧102的开关可以接收所述一个或多个PWM信号。
PWM发生器可以包括PWM子模块，每个子模块都设置为控制单个半桥功率级。
PWM发生器可以包括故障通道支持。此PWM发生器可以被配置成基于控制信号来产生各种开关模式，包括高度复杂的波形。它可用于控制不同的开关模式电源(SMPS)。
图5示出PWM发生器115包括第一部分501和第二部分502。第一部分501可以被配置成控制DC-DC转换器的第一高开关和第一低开关。第二部分502可以被配置成控制DC-DC转换器的第二高开关和第二低开关。第一部分501可以基于固定的占空比生成控制信号。第二部分502可以被配置成从触发器电路生成控制信号的PWM版本。
图6示出第二示例实施例。许多部分与图1的例子中所示的部分类似，因此已对相似的部分使用相似的附图标记。
第二实施例的不同之处在于，CEVTG模块108包括具有多个多路复用器的第一多路复用器布置601。第一多路复用器布置601被配置成将在多个输入端处接收到的一个或多个信号路由到相同或更多数量的输出端，其中，多路复用器布置601是可重新配置的，因为在输入端和输出端之间形成的连接是可重新配置的。第一多路复用器布置601就可配置控制回路布置100的灵活性而言可以是有利的。能够灵活地将比较信号和定时信号引导到不同的硬件组件113、114、115使得布置100更能灵活配置以采用所选控制回路配置。
第二实施例的不同之处还在于，CEVTG模块108包括具有多个多路复用器的第二多路复用器布置602。第二多路复用器布置602被配置成将在多个输入端处接收到的一个或多个信号路由到相同或更多数量的输出端，其中，多路复用器布置602是可重新配置的，使得在输入端和输出端之间形成的连接是可重新配置的。能够将来自触发器电路114的输出灵活地引导到不同的硬件组件603、115使得布置100更能灵活配置以采用所选控制回路配置。
第一多路复用器布置601被配置成接收120处的比较信号、来自定时器112的定时信号，以及可选地来自ADC 122的信号、来自GPIO 121的信号、来自PWM发生器114的PWM信号、来自第二多路复用器布置602的输出，以及来自计数器1100的输出(随后将描述)。来自第一多路复用器布置601的输出被提供给与或反相模块113。
定时器112可以被配置成为AOI模块113、603生成指导信号。AOI模块113、603可以被配置成根据出现的定时信号的信号状态来执行不同的逻辑方程。
第二多路复用器布置602被配置成接收来自触发器电路114的输出。来自第二多路复用器布置602的输出被提供给PWM发生器115和第二与或反相模块603。第二与或反相模块模块603与第一与或反相模块113基本相同。因此，第二与或反相模块603被配置成在其输出(在图6中总体上示为109)处提供在其输入处提供的信号的逻辑组合。
来自第二与或反相模块603的输出包括同步整流器控制信号。然而，并非在可配置控制回路布置100被配置成实施特定控制回路的所有实施方案中都需要这种信号。
PWM发生器115的输出包括用于控制DC-DC转换器101的开关的控制信号。
图7示出第一多路复用器布置601或第二多路复用器布置602中的任一个的示例实施例。多路复用器布置601、602的优点在于，它们被配置成取决于控制信号而将在输入处接收到的信号路由到多个输出中的任何一个。这可以使可配置控制回路布置100具有更大的可配置性，因为可以路由在输入701处接收到的信号，并且可以可选地复制所述信号从而在多个输出端处提供相同的输入信号。
多路复用器布置601、602包括多个输入端701，在这个例子中为四个。多路复用器布置601、602包括相同数量或更多数量的输出端702，在这个例子中为五个。多路复用器布置601、602包括与输出端702的数量相对应的多个多路复用器703-707。
多个多路复用器703-707中的每一个被配置成从输入端701接收所有输入信号。然而，在其它例子中，将理解，一些多路复用器可能不需要接收所有输入信号。输入端处的所述输入信号可以包括所述比较信号。多个多路复用器可被配置成基于多路复用选择信号将多个输入信号引导到预定输出端。因此，在多路复用器布置的输出与另一组件耦合的情况下，多路复用器布置能够将在其任何输入处接收到的信号路由到其任何输出以供另一组件以及因此由另一组件的不同端接收。因此，例如，在需要触发器电路114或与或反相模块113对不同的输入信号执行操作的情况下，多路复用器布置601、602可以将适当的信号引导到触发器电路114或与或反相模块113的适当端，使得可以执行操作。
多个多路复用器703-707中的每一个从接口708接收多路复用选择信号，所述多路复用选择信号定义了每个多路复用器703-707被配置成将输入信号中的哪一个传递到其对应输出端702。接口708可以接收提供所述多路复用选择信号的软件生成的多路复用器控制信令。多路复用器控制信令可以是使得可配置控制回路布置100被配置成形成期望的控制回路的信令的一部分。
图8示出可配置控制回路布置100，所述可配置控制回路布置100已被配置成用作相移全桥(PSFB)类型的DC-DC转换器的控制回路。因此，将包括所述DAC 110、定时器112、比较器111、所述多路复用器布置601、602、与或反相模块113、603、触发器电路114在内的硬件组件设置为使它们呈现在图8的例子中所示的电路的配置。已对相似的部分使用相同的附图标记。
在PSFB应用中，DAC 110耦合到软件实施的元件801，所述软件实施的元件801为DAC 110提供第一数字参数。元件801在802处耦合到DC-DC转换器100的次级侧，并且基于DC-DC转换器100的次级侧的输出电压来生成第一数字参数。块801示出第一数字参数，包括次级侧输出的电压与基准电压之间的差。在一个或多个例子中，DAC从块803接收斜率控制信号。本领域技术人员将理解，斜率控制块803可以通过控制来自DAC 110的输出以按照软件编程的斜率逐渐减小来自DAC 110的输出来提供电流回路的稳定性。
比较器111在其输入117处接收来自DAC 110的输出，并且在第二输入端118处接收监视参数。在可配置控制回路布置100的此实施方案中，第二输入端118被耦合成经由可选信号归一化块805在804处接收在转换器101的初级侧中流动的电流的测量值，用于将电流测量值归一化。
定时器112被配置成(可选地借助于第一多路复用器601的作用)基于由PWM发生器115生成的控制信号来接收信号。定时器112还在806处从PWM发生器115接收PWM信号。使用来自定时器的定时信号来控制比较器111何时提供比较信号。本领域技术人员将知道，在DC-DC转换器的电源开关断开和闭合时会发生振铃，并且定时信号可用于提供比较信号的窗口确定，以减轻确定比较信号时振铃的影响。
第一多路复用器601的输入端被配置成从PWM发生器115接收比较信号和PWM信号。具体地，接收到的PWM信号控制转换器101的并且分别被称为Q1A和Q1B的高和低第一开关806、807。
第一多路复用器601的输出端耦合到与或反相模块113并提供信令以控制触发器电路114。第一多路复用器601的输入端也耦合到PWM发生器115并接收两个信号PWM_fSet820和PWM_fClear 821。PWM_fSet和PWM_fClear可以包括软件定义的信号，这些信号强制置位SR触发器单元114，并强制清除SR触发器单元114。
因此，第一多路复用器601将来自PWM发生器115的两个信号PWM_fSet 820和PWM_fClear 821路由到AOI 113。第一多路复用器601的输入端之一接收来自111和601的比较信号并将所述比较信号路由到AOI 113。如果比较器117生成脉冲(在图9中示出为911)，则AOI113将所述脉冲发送到CEVTG中的RS触发器114。否则，将信号PWM_fSet 902和PWM_fClear 903馈送到CEVTG中的R-S触发器114，如将结合图9的示例定时图进行描述的。
因此，与或反相模块113的输出为触发器电路114提供置位信号和复位信号。在此实施例中，模式控制电路系统将触发器单元配置成用作置位-复位触发器。第一多路复用器306被配置成在PWM发生器115的顶部提供Q输出308、311，以生成控制信号的PWM版本。
可能需要也可能不需要第二多路复用器布置602来将PWM控制信号施加到转换器101的高和低第二开关808、809。将理解，术语PWM控制信号涵盖用于控制转换器的各个开关的其离散分量信号。
PWM发生器115还将PWM控制信号(例如，其分量信号)提供给转换器101的高和低第一开关806、807。应理解，所述分量信号可以引起高和低第一开关806、807以50％/50％的占空比工作。
总而言之，由可配置控制回路布置100形成的控制回路根据电流基准来操纵DC-DC转换器的变压器的初级侧绕组电流，所述电流基准是调压器的PI(比例积分)控制器810的输出。调压器的PI控制器包括ADC 811，所述ADC 811包括由软件实施的外部电压控制回路的一部分。
为了精确地控制DC-DC转换器101的电流，电流回路计算速率必须与PWM脉冲生成速率相同，以便实现逐周期控制。这很难通过软件实现。使用可配置控制回路布置100的可配置组件110、111、112、114以及可选地601、113和115是有利的，因为它允许创建可以在没有软件干预正常操作的情况下操作的硬件数字反馈控制回路。
详细操作如下所述。在这个例子中，PWM发生器115包括子模块0812，所述子模块控制高和低第一开关808、809(表示为Q1A和Q1B)，其中通过内部脉冲发生器施加固定的50％占空比互补波形(波形见图9)。高和低第二开关808、809(表示为Q2A和Q2B)是由PWM子模块1813控制的开关。子模块1基于触发器电路114输出的控制信号生成互补波形，所述触发器电路114在这个例子中被配置成RS触发器。
图9示出定时图901，其中：
902示出PWM_fSet，线820上的信号，从PWM发生器115到第一多路复用器601。
903示出PWM_fClear，线821上的信号，从PWM发生器115到第一多路复用器601。
904示出DC-DC转换器的第一高开关Q1A 806的切换。
905示出DC-DC转换器的第一低开关Q1B 807的切换。
906示出DC-DC转换器的第二高开关Q1B 808的切换。
907示出DC-DC转换器的第二低开关的切换。
908示出DC-DC转换器的初级绕组两端的电压。
909示出DAC 110的输出。
910示出流过DC-DC转换器的初级绕组的电流。
911示出在120处比较器111的输出。
912示出在114处包括AOI模块113的输出到触发器电路的S输入318的信号“置位”。AOI使用以下布尔方程式来生成此信号：PWM_fSet |(Q1A开关806的状态和比较信号)
913示出在114处包括AOI模块113的输出到触发器电路的S输入316的信号“清除”。AOI使用以下布尔方程式来生成此信号：PWM_fClear(Q1B开关807和比较信号)
应注意，在定时图中，忽略了失效时间插入，以使定时图更清晰。
在级920，控制回路系统处于空闲级，在所述空闲级没有到负载的输出。
在启动级921、922、923，由PWM_fSet(PWM力置位的简称)和PWM_fClear(PWM力清除的简称)信号控制的开关Q2A和Q2B由子模块0812生成，这些信号与Q1A和Q1B控制信号同步。两个信号都通过第一多路复用器601在820、821处馈送到与或反相模块603。然后，通过这两个信号来置位和清除Q2A电源开关。Q2B信号与Q2A互补。失效时间插入后，PWM_fSet脉冲将Q2A接通，其互补信号将Q2B断开；失效时间插入后，PWM_fClear将Q2A断开，其互补信号将Q2B接通。在启动级，软件会逐渐增加相对于Q1A上升沿的PWM_fSet延迟，直到达到最大延迟为止。应理解，在图6中，在123处的信号是PWM_fSet和PWM_fClear。由于存在延迟，从Vin->Q1A->初级变压绕组->Q2B->接地以及可替换地Vin->Q2A->初级变压绕组->Q1B->接地来建立DC-DC转换器的初级变压器绕组(或称为绕组)中的电流。由于PWM_fSet延迟相对于Q1A上升沿逐渐增加，因此由于向变压器施加了更长的电压脉冲而逐渐增加初级绕组中的电流。
在级924，软件确定在804处的电流达到目标值，并且控制回路可以进入级925。在级924的末尾，软件控制将PWM_fSet延迟相对于Q1A上升沿的增加提供至预定最大值。如果使用模拟比较器111和DAC 110的逐周期控制失败，则此预定最大延迟还将提供最大功率传输周期限制。还启用DAC斜率补偿803以生成基准电流。
在阶段925，电流回路100无需软件干预即可完全控制DC-DC转换器。因此，DAC110、比较器111、触发器电路114和PWM模块115的硬件块提供控制回路的功能。比较器111的输出(CMP_OUT)用于接通/断开开关Q2A和Q2B。为了确保Q2A和Q2B与Q1A和Q1B同步，仅当Q1A已经接通时才能接通Q2A；仅当Q1A已经断开(或Q1B接通，因为Q1A和Q1B是互补对)时才能断开Q2A。可配置事件生成逻辑模块执行逻辑运算，并使用以下逻辑来接通/断开从属半桥(阶段B)。
·置位＝PWM_fSet|(Q1A&CMP_OUT)
·复位＝PWM_fClear|(Q1B&CMP_OUT)
在上述触发条件下，硬件电流回路100通过在级920、921、922、923和924调整PWM_fSet位置和PWM_fClear位置来平滑地执行初级电流软启动操作。在级924，电流比较器111开始正常工作，在比较器状态已通过软件确认之后，PWM_fSet和PWM_fClear将分别移至正能量传输周期的末尾和负能量传输周期的末尾(相对于Q1A上升沿的最大延迟)。这使转换器进入电流控制模式。在电流控制模式中，PWM_fSet和PWM_fClear充当能量传输周期边界的末尾(应了解，如果信号911失效，则PWM_fSet和PWM_fClear仅充当能量传输周期边界的末尾)。在每个能量传输周期边界，如果控制目标无法满足，则这两个触发信号之一将强制从属半桥切换。在级925，达到控制目标，CMP_OUT信号在第一能量传输周期(Vin->Q1A->初级变压绕组->Q2B->接地)触发置位-复位触发器置位，并且CMP_OUT信号在第二能量传输周期(Vin->Q2A->初级变压绕组->Q1B->接地)触发触发器复位。置位-复位触发器114的这些触发信号完成从软启动到电流控制模式的初级电流控制。
当Q1A或Q1B接通时，接通的瞬间可能引起电流振铃(如上所述)，此振铃可能导致振铃出现在模拟比较器111输出的比较信号中。为避免此问题，使用触发后的定时器112创建短的空白窗口(大约200ns)，在所述窗口中抑制比较信号输出。
Q1A和Q1B的上升沿也会复位DAC 110的输出，以开始对其输出进行新的斜降(这种斜降称为斜率补偿)。DAC斜率补偿的斜率是基于负载特性预先定义的。斜率补偿生成自动运行。通过软件基于电压回路输出的计算来设置DAC 110输出的峰值。
总而言之，此混合信号控制回路100利用可配置与或反相模块113、603和可配置触发器单元300来实施软启动和峰值电流控制模式PSFB转换器操纵序列。所述混合信号控制回路100可以被配置成执行所有全桥调制模式，包括重复正向导通、从属半桥过渡、正向续流、主半桥过渡、反向导通、从属半桥过渡、反向续流和主半桥过渡。
图10示出例子，其中可配置控制回路布置100已经被配置用于形成半桥LLC型DC-DC转换器101的控制回路。图10的例子示出DAC 110接收指示来自DC-DC转换器的输出电压的输入。在这个例子中，在1000处，比较器111接收转换器输出控制信号以及监视参数，所述监视参数包括谐振电容器电压。定时器112将定时信号提供给比较器111(例如经由第一多路复用器601)以及提供给可配置事件生成逻辑模块，尤其是提供给触发器电路114(例如经由第一多路复用器601)。此实施例包括第二比较器1001，所述第二比较器1001被配置成提供“过流检测”，并向可配置事件生成逻辑模块提供过流检测信号。
图11的例子示出图10的可配置控制回路布置100的更详细视图。触发器电路114借助于模式控制电路系统被配置成J-K触发器。与或反相模块113表示为比较器111与触发器电路114之间的逻辑。第一多路复用器601未示出，但是如上所述，提供了图11所示的组件之间的连接。在此实施例中，可配置控制回路布置包括计数器1100，所述计数器1100被配置成接收时钟信号和“方向”信号。方向信号是从触发器电路114的输出中导出的，即施加到PWM发生器115之前的控制信号。
在这个例子中，“控制目标”是被称为Vcr 1000的谐振电容器电压。控制回路100可以被配置成执行软启动、突发模式和脉冲频率调制(PFM)模式。电荷控制的LLC通过谐振电容器电压Vcr的变化来调节转换器功率。
第一数字参数指示来自DC-DC转换器次级侧的输出电压Vout，并通过DAC 110提供。在每个开关周期开始时，高侧开关QH 1101接通，将谐振电容器1103的电压vcr与从DAC输出的转换器输出控制信号进行比较，并且当vcr大于DAC输出时，高侧开关QH断开。在失效时间延迟之后，低侧开关QL 1102接通。低侧开关QL 1102的导通时间(持续时间)应等于高侧开关QH 1101，以防止变压器磁芯饱和。在低侧开关QL断开之后，高侧开关QH再次接通以进行下一个周期操作。
在此控制方案中，开关频率由可配置控制回路布置管理，所述可配置控制回路布置包括DAC 110、比较器111、可配置事件生成逻辑模块108和PWM发生器115。
现在，我们转向计数器1100的操作。计数器在高侧开关QH和低侧开关QL之间提供自动占空比互锁机制。这确保了相等的占空比。应了解，开关频率限制对于平衡磁通量至关重要。
CEVTG 108中的J-K触发器114的Q输出通过PWM发生器115中的半桥控制器来控制高侧开关1101和低侧开关1102。当J-K触发器114的输出置位时，高侧开关接通，当J-K触发器输出清除时，在预定的失效时间之后，高侧开关断开且低侧开关接通。
计数器1100执行相等的占空比跟踪。所述计数器1100被配置成递增/递减计数器，以对给定时钟(例如100Mhz时钟)进行计数。
·当高侧开关QH 1101接通时，计数器1100被配置成递增计数。
·当高侧开关QH 1101断开(QL接通，因为QH和QL是互补对)时，计数器1100递减计数。
当计数器1100的计数器值达到零时，所述计数器1100被配置成生成脉冲。此脉冲将J-K触发器114的Q输出置位为高状态，所述高状态将接通高侧开关QH 1101并断开低侧开关QL 1102。它还将RS触发器1104的输出Q复位到低状态。这样就完成了一个开/关周期。应了解，触发器电路114提供了RS触发器1104的功能。
图12示出了示例定时图。迹线1200示出DC-DC转换器101的高侧开关的状态。计数器的方向由高侧开关1101的状态控制。
迹线1201示出了计数器向上和向下计数。迹线1202示出当计数器1100达到零计数值时的输出。箭头1203示出如何使用来自计数器1100的脉冲来控制高侧开关QH 1101的接通。
迹线1204示出从定时器112输出的定时信号。在这个例子中，存在第二定时器1212。
定时器112用于限制最大PWM频率。QH 1101接通信号触发定时器112输出低状态。低状态的持续时间是QH 1101的最小接通时间，因为小于最小接通时间会损坏QH晶体管。此低状态是逻辑与(通过与或反相模块113的作用)与RS触发器1104的Q输出相组合，以确保在1000处的Vcr上升太快的情况下，QH 1101的接通时间不少于最小接通时间。
第二定时器1212用于限制最小PWM频率(或最大QH 1101接通时间)。在QH 1101接通沿处将所述第二定时器1212复位以输出低状态。如果延迟经过时间到期，则其输出高状态脉冲，所述脉冲将J-K触发器114的Q输出置位为低状态，如果QH 1101仍然为接通，则强制其断开。
类似于PSFB应用的示例实施例，可配置控制回路布置100还可以包括DAC斜率补偿函数803和比较器输出开窗。
除非明确陈述特定次序，否则可以任何次序执行上图中的指令和/或流程图步骤。并且，本领域的技术人员将认识到，虽然已经论述一个示例性指令集/方法，但是在本说明书中的材料可以多种方式组合从而还产生其它例子，并且应在此详细描述提供的情境内来进行理解。
在一些示例实施例中，上文所描述的指令集/方法步骤实施为体现为可执行指令集的功能和软件指令，所述可执行指令集在计算机或以所述可执行指令编程和控制的机器上得以实现。此类指令被加载用于在处理器(例如一个或多个CPU)上执行。术语处理器包括微处理器、微控制器、处理器模块或子系统(包括一个或多个微处理器或微控制器)，或其它控制或计算装置。处理器可指代单个组件或多个组件。
在其它例子中，本文示出的指令集/方法以及与其相关联的数据和指令存储于相应存储装置中，所述存储装置被实施为一个或多个非暂时性机器或计算机可读或计算机可用存储介质。这类一个或多个计算机可读或计算机可用存储介质被视为物品(或制品)的部分。物品或制品可指任何制造的单个组件或多个组件。如本文所定义的非暂时性机器或计算机可用介质不包括信号，但这类介质能够接收并处理来自信号和/或其它非暂时性介质的信号。
本说明书中论述的材料的示例实施例可整体或部分地经由网络、计算机或基于数据的装置和/或服务实施。这些可包括云、互联网、内联网、移动装置、台式计算机、处理器、查找表、微控制器、消费者设备、基础架构，或其它启用装置和服务。如本文和权利要求书中可以使用，提供以下非排他性定义。
在一个例子中，使本文中论述的一个或多个指令或步骤自动化。术语自动的或自动地(和其类似变型)意指使用计算机和/或机械/电气装置来控制设备、系统和/或过程的操作，而不需要人类干预、观测、努力和/或决策。
应了解，被称为耦合的任何组件可直接或间接耦合或连接。在间接耦合的情况下，另外的组件可以位于据称将耦合的两个组件之间。
在本说明书中，已经依据选定的详细内容集合而呈现示例实施例。然而，本领域的普通技术人员将理解，可以实践包括这些细节的不同所选择集合的许多其它实例实施例。希望所附权利要求书涵盖所有可能的示例实施例。

Claims (10)

1.一种用于形成DC-DC转换器的控制回路的可配置控制回路布置，所述可配置控制回路布置被配置成生成用于控制所述DC-DC转换器的控制信号，其特征在于，所述可配置控制回路布置包括：
数模转换器，所述数模转换器被配置成接收指示来自所述DC-DC转换器的次级侧的输出电压与基准电压之间的差的第一数字参数，并且基于所述第一数字参数输出模拟转换器输出控制信号；
比较器，所述比较器被配置成在第一端接收所述模拟转换器输出控制信号并且在第二端接收监视参数，所述比较器被配置成基于所述转换器输出控制信号与所述监视参数之间的差来输出比较信号，其中所述第二端被配置成耦合到所述DC-DC转换器的初级侧以接收所述监视参数，所述监视参数指示在所述DC-DC转换器的初级侧的组件处的电压或流动的电流中的一个；
定时器，所述定时器被配置成提供用于控制以下各项中的一个或多个的定时信号：所述比较器确定所述比较信号；将所述比较信号施加到可配置事件生成逻辑模块；以及操作所述可配置事件生成逻辑模块；
其中所述可配置事件生成逻辑模块包括：触发器电路，所述触发器电路包括触发器单元和模式控制电路系统，所述模式控制电路系统被配置成使所述触发器单元能够以包括多个模式中的一个模式的选定模式进行操作，所述选定模式是基于在所述模式控制电路系统的端处接收到的配置信号而选择的，其中当在所述控制回路中实施时，所述可配置事件生成逻辑模块被配置成基于所述比较信号、所述定时信号和所述触发器电路的所述选定模式来提供所述控制信号的生成，并且其中所述控制信号用于施加到所述DC-DC转换器的一个或多个开关。
2.根据权利要求1所述的可配置控制回路布置，其特征在于，所述第二端被配置成接收以下之一作为所述监视参数：
所述DC-DC转换器的初级变压器绕组中的电流的测量值；以及
第一电容器电压，其中所述DC-DC转换器的所述初级侧包括LLC布置，其中所述LLC布置包括与所述DC-DC转换器的第二电感器和初级变压器绕组的并联布置串联的第一电感器和第一电容器。
3.根据权利要求1或权利要求2所述的可配置控制回路布置，其特征在于，所述可配置事件生成逻辑模块包括与或反相模块，所述与或反相模块包括能基于与或反相控制信号采用至少第一配置和第二配置中的任一个的可配置逻辑门的布置，其中
所述与或反相模块被配置成至少接收所述比较信号和所述定时信号，并基于当前采用所述至少第一和第二配置中的哪一个来提供对应第一组值或不同的对应第二组值作为输出，所述第一组值和所述第二组值包括不同组值，不同组值包括所述比较信号、所述定时信号、应用了逻辑运算的所述比较信号以及应用了逻辑运算的所述定时信号，并且其中所述输出被提供给所述触发器电路。
4.根据在前的任一项权利要求所述的可配置控制回路布置，其特征在于，所述触发器单元包括具有D输入、C输入、Q输出和Q互补输出的延迟型触发器，并且所述模式控制电路系统被配置成在所述多个模式中的一个模式下将所述Q互补输出提供给所述D输入，并且在所述多个模式中的不同模式下将对所述触发器电路的输入提供给所述触发器单元，所述输入是基于所述定时信号或所述比较信号之一。
5.根据在前的任一项权利要求所述的可配置控制回路布置，其特征在于，所述可配置事件生成逻辑模块包括计数器，所述计数器被配置成从所述可配置事件生成逻辑模块接收时钟信号和所述控制信号，所述计数器能被配置成测量表示所述控制信号的状态的持续时间的时间段，并且在从所述控制信号的所述状态改变的时间点起经过所述测得的时间段后，向所述触发器电路提供输入，以提供对所述控制信号的控制。
6.根据在前的任一项权利要求所述的可配置控制回路布置，其特征在于，所述控制回路包括：
GPIO输入，所述GPIO输入被配置成接收指示对在操作期间所述控制回路与外部事件同步或对安全关机的请求的信令；
ADC输入，所述ADC输入被配置成接收指示对过热限制关机的请求的信令；
PWM输入，所述PWM输入被配置成接收PWM信号，所述PWM信号包括所述控制信号的脉冲宽度调制版本。
7.根据权利要求3所述的可配置控制回路布置，其特征在于，包括至少第一多路复用器布置，所述第一多路复用器布置具有多个输入端和多个输出端并且包括多个多路复用器，其中每个多路复用器与所述多个输出端中的相应一个输出端相关联；
其中所述多个多路复用器各自被配置成接收在所述多个输入端处接收到的多个信号，所述多个多路复用器各自能被独立地配置成基于多路复用选择信号将由此接收到的所述多个信号中的一个引导到其相关联的输出端；
其中在所述多个输入端处接收到的所述多个信号包括所述比较信号，并且所述多个输出端耦合到所述与或反相模块。
8.根据权利要求7所述的可配置控制回路布置，其特征在于，在所述第一多路复用器布置的所述多个输入端处接收到的所述多个信号包括被配置成基于所述控制信号生成PWM信号的PWM发生器的输出。
9.根据在前的任一项权利要求所述的可配置控制回路布置，其特征在于，包括至少第二多路复用器布置，所述第二多路复用器布置具有多个输入端和多个输出端并且包括多个多路复用器，其中每个多路复用器与所述多个输出端中的相应一个输出端相关联；
其中所述多个多路复用器各自被配置成接收在所述多个输入端处接收到的多个信号，所述多个多路复用器各自能被独立地配置成基于第二多路复用选择信号将由此接收到的所述多个信号中的一个引导到所述相关联的输出端；
其中在所述多个输入端处接收到的所述多个信号包括所述触发器电路的输出。
10.根据权利要求9所述的可配置控制回路布置，其特征在于，所述第二多路复用器的所述多个输出端耦合到第二与或反相模块和脉冲宽度调制PWM发生器，所述第二与或反相模块被配置成将逻辑运算应用于施加到其上的输入信号，所述PWM发生器被配置成基于来自所述第二多路复用器的所述输出端的所述信号来生成一个或多个PWM信号。
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