CN114598354B - 非整数倍采样率下的跳频系统连续相位保持方法及装置 - Google Patents

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CN114598354B CN202210275658.8A CN202210275658A CN114598354B CN 114598354 B CN114598354 B CN 114598354B CN 202210275658 A CN202210275658 A CN 202210275658A CN 114598354 B CN114598354 B CN 114598354B
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Abstract

本发明公开了一种非整数倍采样率下的跳频系统连续相位保持方法、装置、设备及存储介质，该方法包括在利用系统时钟生成目标跳频时钟信号时，获取频率控制信息；基于目标跳频时钟信号和频率控制信息，确定当前时刻相对于前一时刻的频差、当前时刻的待补偿相位值以及系统时钟在当前时刻的钟差；根据频差和钟差，生成当前时刻的相位补偿值，进而获得跳频相位值。本发明通过在系统时钟驱动下，采取和一般整数倍采样率跳频系统一致的方法生成相位的同时，进行钟差计算和跳频点的判断，通过钟差计算值求出在频点发生跳变的时刻需要补偿的相位量，将补偿量叠加至原相位上完成跳频系统的相位补偿，能够实现保持跳频系统在非整数倍采样率下的相位连续。

Description

非整数倍采样率下的跳频系统连续相位保持方法及装置
技术领域
本发明涉及数字信号技术领域，尤其涉及到一种非整数倍采样率下的跳频系统连续相位保持方法、装置、设备及存储介质。
背景技术
跳频通信是扩频通信的一个重要分支，它通过伪码序列控制跳频图案发生器在多个频点中进行选择，从而产生跳频信号，具有很强的抗干扰性能，适用于复杂的电子战通信环境。
然而，跳频系统在采用非整数倍采样率时，会引起跳频周期采样误差，造成每跳末相位无法归零的问题，进而造成该相位误差经过时间累计，最恶劣情况可能导致180度的相位翻转。因此，如何保持跳频系统在非整数倍采样率下的相位连续，是一个亟需解决的技术问题。
上述内容仅用于辅助理解本发明的技术方案，并不代表承认上述内容是现有技术。
发明内容
本发明的主要目的在于提供一种非整数倍采样率下的跳频系统连续相位保持方法、装置、设备及存储介质，旨在解决目前跳频系统在非整数倍采样率下无法实现连续相位保的技术问题。
为实现上述目的，本发明提供一种非整数倍采样率下的跳频系统连续相位保持方法，所述方法包括以下步骤：
在利用系统时钟生成目标跳频时钟信号时，获取所述目标跳频时钟信号对应的频率控制信息；其中，所述频率控制信息包括频率控制字和累加值；
基于所述目标跳频时钟信号，确定当前时刻相对于前一时刻的频差和当前时刻的待补偿相位值；
基于所述频率控制字和所述累加值，确定系统时钟在当前时刻的钟差；
根据所述频差和所述钟差，生成当前时刻的相位补偿值，并利用所述相位补偿值和所述待补偿相位值，获得跳频相位值。
可选的，所述基于所述目标跳频时钟信号，确定当前时刻相对于前一时刻的频差和当前时刻的待补偿相位值步骤，具体包括：
基于所述目标跳频时钟信号，确定当前时刻的第一频点和上一时刻的第二频点；
利用所述第一频点和所述第二频点对应的频率，计算频差；
根据所述第一频点对应的相位控制字，计算当前时刻累计获得的待补偿相位值。
可选的，所述确定当前时刻的第一频点和上一时刻的第二频点采用查表法获得。
可选的，所述待补偿相位值的表达式为：
Figure GDA0004115880000000021
/>
K1＝F1/fclk；
其中，
Figure GDA0004115880000000022
为当前时刻的待补偿相位值，/>
Figure GDA0004115880000000023
为前一时刻的待补偿相位值，K1为第一频点对应的相位控制字，F1为第一频点对应的频率，fclk为系统时钟的频率。
可选的，所述系统时钟在当前时刻的钟差的表达式为：
Figure GDA0004115880000000024
其中，Δt为钟差，K为累加值，K10k为频率控制字，n为频率控制字累加器位数。
可选的，所述当前时刻的相位补偿值的表达式为：
Figure GDA0004115880000000025
其中，
Figure GDA0004115880000000026
为相位补偿值，Δt为钟差，ΔF为频差。
可选的，所述跳频相位值的表达式为：
Figure GDA0004115880000000031
其中，
Figure GDA0004115880000000032
为跳频相位值，/>
Figure GDA0004115880000000033
为当前时刻的待补偿相位值，/>
Figure GDA0004115880000000034
为相位补偿值。
此外，为了实现上述目的，本发明还提供了一种非整数倍采样率下的跳频系统连续相位保持装置，所述非整数倍采样率下的跳频系统连续相位保持装置包括：
获取模块，用于在利用系统时钟生成目标跳频时钟信号时，获取所述目标跳频时钟信号对应的频率控制信息；其中，所述频率控制信息包括频率控制字和累加值；
第一确定模块，用于基于所述目标跳频时钟信号，确定当前时刻相对于前一时刻的频差和当前时刻的待补偿相位值；
第二确定模块，用于基于所述频率控制字和所述累加值，确定系统时钟在当前时刻的钟差；
生成模块，用于根据所述频差和所述钟差，生成当前时刻的相位补偿值，并利用所述相位补偿值和所述待补偿相位值，获得跳频相位值。
此外，为了实现上述目的，本发明还提供了一种非整数倍采样率下的跳频系统连续相位保持设备，所述设备包括：存储器、处理器及存储在所述存储器上并可在所述处理器上运行的非整数倍采样率下的跳频系统连续相位保持方法程序，所述非整数倍采样率下的跳频系统连续相位保持方法程序被所述处理器执行时实现上述的非整数倍采样率下的跳频系统连续相位保持方法的步骤。
此外，为了实现上述目的，本发明还提供了一种存储介质，所述存储介质上存储有非整数倍采样率下的跳频系统连续相位保持方法程序，所述非整数倍采样率下的跳频系统连续相位保持方法程序被处理器执行时实现上述的非整数倍采样率下的跳频系统连续相位保持方法的步骤。
本发明实施例提出的一种非整数倍采样率下的跳频系统连续相位保持方法、装置、设备及存储介质，该方法包括在利用系统时钟生成目标跳频时钟信号时，获取所述目标跳频时钟信号对应的频率控制信息；基于所述目标跳频时钟信号，确定当前时刻相对于前一时刻的频差和当前时刻的待补偿相位值；基于所述频率控制信息，确定系统时钟在当前时刻的钟差；根据所述频差和所述钟差，生成当前时刻的相位补偿值，并利用所述相位补偿值和所述待补偿相位值，获得跳频相位值。本发明通过在系统时钟驱动下，采取和一般整数倍采样率跳频系统一致的方法生成相位的同时，进行钟差计算和跳频点的判断，通过钟差计算值求出在频点发生跳变的时刻需要补偿的相位量，将补偿量叠加至原相位上完成跳频系统的相位补偿，能够实现保持跳频系统在非整数倍采样率下的相位连续。
附图说明
图1为本发明实施例中一种非整数倍采样率下的跳频系统连续相位保持设备的结构示意图；
图2为本发明实施例中一种非整数倍采样率下的跳频系统连续相位保持方法的流程示意图；
图3为本发明实施例中非整数倍采样率下的跳频系统连续相位保持方法的原理示意图；
图4为本发明实施例中未经相位补偿的跳频系统相位示意图；
图5为本发明实施例中经过相位补偿的跳频系统相位示意图；
图6为本发明实施例中一种非整数倍采样率下的跳频系统连续相位保持装置的结构框图。
本发明目的的实现、功能特点及优点将结合实施例，参照附图做进一步说明。
具体实施方式
应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
跳频通信是扩频通信的一个重要分支，它通过伪码序列控制跳频图案发生器在多个频点中进行选择，从而产生跳频信号，具有很强的抗干扰性能，适用于复杂的电子战通信环境。然而，跳频系统在采用非整数倍采样率时，会引起跳频周期采样误差，造成每跳末相位无法归零的问题，进而造成该相位误差经过时间累计，最恶劣情况可能导致180度的相位翻转。因此，如何保持跳频系统在非整数倍采样率下的相位连续，是一个亟需解决的技术问题。
为了解决这一问题，提出本发明的非整数倍采样率下的跳频系统连续相位保持方法的各个实施例。本发明提供的非整数倍采样率下的跳频系统连续相位保持方法通过在系统时钟驱动下，采取和一般整数倍采样率跳频系统一致的方法生成相位的同时，进行钟差计算和跳频点的判断，通过钟差计算值求出在频点发生跳变的时刻需要补偿的相位量，将补偿量叠加至原相位上完成跳频系统的相位补偿，能够实现保持跳频系统在非整数倍采样率下的相位连续。
参照图1，图1为本发明实施例方案涉及的非整数倍采样率下的跳频系统连续相位保持设备的结构示意图。
设备可以是移动电话、智能电话、笔记本电脑、数字广播接收器、个人数字助理(PDA)、平板电脑(PAD)等用户设备(User Equipment，UE)、手持设备、车载设备、可穿戴设备、计算设备或连接到无线调制解调器的其它处理设备、移动台(Mobile station，MS)等。设备可能被称为用户终端、便携式终端、台式终端等。
通常，设备包括：至少一个处理器301、存储器302以及存储在所述存储器上并可在所述处理器上运行的非整数倍采样率下的跳频系统连续相位保持方法程序，所述非整数倍采样率下的跳频系统连续相位保持方法程序配置为实现如前所述的非整数倍采样率下的跳频系统连续相位保持方法的步骤。
处理器301可以包括一个或多个处理核心，比如4核心处理器、8核心处理器等。处理器301可以采用DSP(Digital Signal Processing，数字信号处理)、FPGA(Field－Programmable Gate Array，现场可编程门阵列)、PLA(Programmable Logic Array，可编程逻辑阵列)中的至少一种硬件形式来实现。处理器301也可以包括主处理器和协处理器，主处理器是用于对在唤醒状态下的数据进行处理的处理器，也称CPU(CentralProcessingUnit，中央处理器)；协处理器是用于对在待机状态下的数据进行处理的低功耗处理器。在一些实施例中，处理器301可以在集成有GPU(Graphics Processing Unit，图像处理器)，GPU用于负责显示屏所需要显示的内容的渲染和绘制。处理器301还可以包括AI(Artificial Intelligence，人工智能)处理器，该AI处理器用于处理有关非整数倍采样率下的跳频系统连续相位保持方法操作，使得非整数倍采样率下的跳频系统连续相位保持方法模型可以自主训练学习，提高效率和准确度。
存储器302可以包括一个或多个计算机可读存储介质，该计算机可读存储介质可以是非暂态的。存储器302还可包括高速随机存取存储器，以及非易失性存储器，比如一个或多个磁盘存储设备、闪存存储设备。在一些实施例中，存储器302中的非暂态的计算机可读存储介质用于存储至少一个指令，该至少一个指令用于被处理器301所执行以实现本申请中方法实施例提供的非整数倍采样率下的跳频系统连续相位保持方法。
在一些实施例中，终端还可选包括有：通信接口303和至少一个外围设备。处理器301、存储器302和通信接口303之间可以通过总线或信号线相连。各个外围设备可以通过总线、信号线或电路板与通信接口303相连。具体地，外围设备包括：射频电路304、显示屏305和电源306中的至少一种。
通信接口303可被用于将I/O(Input/Output，输入/输出)相关的至少一个外围设备连接到处理器301和存储器302。通信接口303通过外围设备用于接收用户上传的多个移动终端的移动轨迹以及其他数据。在一些实施例中，处理器301、存储器302和通信接口303被集成在同一芯片或电路板上；在一些其他实施例中，处理器301、存储器302和通信接口303中的任意一个或两个可以在单独的芯片或电路板上实现，本实施例对此不加以限定。
射频电路304用于接收和发射RF(Radio Frequency，射频)信号，也称电磁信号。射频电路304通过电磁信号与通信网络以及其他通信设备进行通信，从而可获取多个移动终端的移动轨迹以及其他数据。射频电路304将电信号转换为电磁信号进行发送，或者，将接收到的电磁信号转换为电信号。可选地，射频电路304包括：天线系统、RF收发器、一个或多个放大器、调谐器、振荡器、数字信号处理器、编解码芯片组、用户身份模块卡等等。射频电路304可以通过至少一种无线通信协议来与其它终端进行通信。该无线通信协议包括但不限于：城域网、各代移动通信网络(2G、3G、4G及5G)、无线局域网和/或WiFi(WirelessFidelity，无线保真)网络。在一些实施例中，射频电路304还可以包括NFC(Near FieldCommunication，近距离无线通信)有关的电路，本申请对此不加以限定。
显示屏305用于显示UI(User Interface，用户界面)。该UI可以包括图形、文本、图标、视频及其它们的任意组合。当显示屏305是触摸显示屏时，显示屏305还具有采集在显示屏305的表面或表面上方的触摸信号的能力。该触摸信号可以作为控制信号输入至处理器301进行处理。此时，显示屏305还可以用于提供虚拟按钮和/或虚拟键盘，也称软按钮和/或软键盘。在一些实施例中，显示屏305可以为一个，电子设备的前面板；在另一些实施例中，显示屏305可以为至少两个，分别设置在电子设备的不同表面或呈折叠设计；在再一些实施例中，显示屏305可以是柔性显示屏，设置在电子设备的弯曲表面上或折叠面上。甚至，显示屏305还可以设置成非矩形的不规则图形，也即异形屏。显示屏305可以采用LCD(LiquidCrystal Display，液晶显示屏)、OLED(Organic Light-Emitting Diode,有机发光二极管)等材质制备。
电源306用于为电子设备中的各个组件进行供电。电源306可以是交流电、直流电、一次性电池或可充电电池。当电源306包括可充电电池时，该可充电电池可以支持有线充电或无线充电。该可充电电池还可以用于支持快充技术。
本领域技术人员可以理解，图1中示出的结构并不构成对非整数倍采样率下的跳频系统连续相位保持设备的限定，可以包括比图示更多或更少的部件，或者组合某些部件，或者不同的部件布置。
本发明实施例提供了一种非整数倍采样率下的跳频系统连续相位保持方法，参照图2，图2为本发明非整数倍采样率下的跳频系统连续相位保持方法的第一实施例的流程示意图。
本实施例中，所述非整数倍采样率下的跳频系统连续相位保持方法包括以下步骤：
步骤S100，在利用系统时钟生成目标跳频时钟信号时，获取所述目标跳频时钟信号对应的频率控制信息；其中，所述频率控制信息包括频率控制字和累加值。
具体而言，跳频系统可根据系统时钟生成目标跳频时钟信号，此时，获取目标跳频时钟信号在跳频系统中对应的频率控制信息，利用该频率控制信息，可用于计算后续当前时刻的钟差。为了更清楚的解释本方案，下面举例说明跳频系统在系统时钟下生成目标跳频时钟信号的过程。
需要说明的是，在本实施例中，系统时钟为121.3333MHz，频率控制字累加器位数为48bit，跳频周期为10KHz，系统载波频率在频点20.47MHz和频点10KHz间不断跳变。
进一步的，在系统时钟的驱动下，生成10K跳频时钟信号，生成该信号的频率控制字为K10k＝23198493464，累加值记为K。
步骤S200，基于所述目标跳频时钟信号，确定当前时刻相对于前一时刻的频差和当前时刻的待补偿相位值。
具体而言，在生成目标跳频时钟信号后，需根据该目标跳频时钟信号，确定频差和待补偿相位值。
容易理解的，根据目标调频时钟信号确定频差和待补偿相位值，通过基于所述目标跳频时钟信号，确定当前时刻的第一频点和上一时刻的第二频点；利用所述第一频点和所述第二频点对应的频率，计算频差；根据所述第一频点对应的相位控制字，计算当前时刻累计获得的待补偿相位值。
需要说明的是，在本实施例中，在上述10K跳频时钟信号驱动下，可通过查找表生成当前时刻的第一频点F1和上一时刻的第二频点F2，以及当前时刻对应的相位控制字K1。
需要说明的是，本实施例中，当前时刻和上一时刻均指系统钟时刻，跳频频率为10KHz，在一个跳频周期内，每个系统钟时刻的频点值保持一致。
在此之后，利用寄存器记录生成的当前时刻的频点F1和F2，并根据记录的频点F1和F2计算频差，该值在非调频点时刻保持为零。
进一步的，频差的表达式为：
ΔF＝F1-F2
在本实施例中，频差仅在跳频点时刻有值，而跳频周期内为零。
进一步的，待补偿相位值的表达式为：
Figure GDA0004115880000000081
K1＝F1/fclk；
Figure GDA0004115880000000091
为当前时刻的待补偿相位值，/>
Figure GDA0004115880000000092
为前一时刻的待补偿相位值，K1为第一频点对应的相位控制字，F1为第一频点对应的频率，fclk为系统时钟的频率，fclk为系统时钟的频率。
步骤S300，基于所述频率控制字和所述累加值，确定系统时钟在当前时刻的钟差。
具体而言，在生成相位补偿值时，需获取当前时刻的钟差，此时，可利用前序步骤获得的频率控制信息，即频率控制字和累加值，确定系统时钟在当前时刻的钟差。
进一步的，系统时钟在当前时刻(即调频点)的钟差的表达式为：
Figure GDA0004115880000000093
其中，Δt为钟差，K为累加值，K10k为频率控制字，n为频率控制字累加器位数，本实施例为48。
步骤S400，根据所述频差和所述钟差，生成当前时刻的相位补偿值，并利用所述相位补偿值和所述待补偿相位值，获得跳频相位值。
具体而言，在获得频差和钟差后，可利用频差和钟差生成当前时刻的相位补偿值，进而计算跳频相位值，以保持跳频系统在非整数倍采样率下的相位连续。
进一步的，当前时刻的相位补偿值的表达式为：
Figure GDA0004115880000000094
其中，
Figure GDA0004115880000000095
为相位补偿值，Δt为钟差，ΔF为频差。
在本实施例中，计算得到的相位补偿量仅在调频点时刻有值，而跳频周期内为零。
该相位补偿值在寄存器内不断累计，并利用该相位补偿值和前序步骤获得的待补偿相位值，进行最终跳频相位值的计算。
进一步的，跳频相位值的表达式为：
Figure GDA0004115880000000096
其中，
Figure GDA0004115880000000097
为跳频相位值，/>
Figure GDA0004115880000000098
为当前时刻的待补偿相位值，/>
Figure GDA0004115880000000099
为相位补偿值。
在本实施例中，如图3所示，在系统时钟驱动下，在采取和一般整数倍采样率跳频系统一致的方法生成相位的同时，进行钟差计算和跳频点的判断，通过钟差计算值求出在频点发生跳变的时刻需要补偿的相位量，补偿量可正可负，将补偿量叠加至原相位上完成跳频系统的相位补偿。
在本实施例中，针对相位补偿需要在每个系统时钟进行的需求，利用寄存器将补偿量进行存储和累加，以实现每个系统钟的相位补偿。在实际工程中，可以对跳频时刻进行预判，根据判断结果仅在跳频点时刻进行补偿相位值的计算，以释放实时硬件资源。
如图4和如图5所示，分别给出了未经相位补偿和经过相位补偿的跳频系统相位示意图，从图中可以看出，未经相位补偿的跳频系统，在每跳末相位无法归零，该相位误差经过时间累积，最恶劣情况可能导致180度的相位翻转；而经过相位补偿的系统则能够保持每跳末相位归零，保证相位的连续性。
在本实施例中，通过算法补偿，可以有效解决跳频系统中因小数倍采样率而造成的相位不连续问题；同时，能够自动检测误差相位，兼容整数/非整数采样率跳频/非跳频系统，灵活性高，适用范围广。本发明提出的基于整数倍采样系统/非跳频系统架构，相位补偿算法复杂度低，工程实现简单，可移植性高，改造成本低。
参照图6，图6为本发明非整数倍采样率下的跳频系统连续相位保持装置实施例的结构框图。
如图6所示，本发明实施例提出的非整数倍采样率下的跳频系统连续相位保持装置包括：
获取模块10，用于在利用系统时钟生成目标跳频时钟信号时，获取所述目标跳频时钟信号对应的频率控制信息；其中，所述频率控制信息包括频率控制字和累加值；
第一确定模块20，用于基于所述目标跳频时钟信号，确定当前时刻相对于前一时刻的频差和当前时刻的待补偿相位值；
第二确定模块30，用于基于所述频率控制字和所述累加值，确定系统时钟在当前时刻的钟差；
生成模块40，用于根据所述频差和所述钟差，生成当前时刻的相位补偿值，并利用所述相位补偿值和所述待补偿相位值，获得跳频相位值。
本发明非整数倍采样率下的跳频系统连续相位保持装置的其他实施例或具体实现方式可参照上述各方法实施例，此处不再赘述。
此外，本发明实施例还提出一种存储介质，所述存储介质上存储有非整数倍采样率下的跳频系统连续相位保持方法程序，所述非整数倍采样率下的跳频系统连续相位保持方法程序被处理器执行时实现如上文所述的非整数倍采样率下的跳频系统连续相位保持方法的步骤。因此，这里将不再进行赘述。另外，对采用相同方法的有益效果描述，也不再进行赘述。对于本申请所涉及的计算机可读存储介质实施例中未披露的技术细节，请参照本申请方法实施例的描述。确定为示例，程序指令可被部署为在一个计算设备上执行，或者在位于一个地点的多个计算设备上执行，又或者，在分布在多个地点且通过通信网络互连的多个计算设备上执行。
本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程，是可以通过计算机程序来指令相关的硬件来完成，上述的程序可存储于一计算机可读取存储介质中，该程序在执行时，可包括如上述各方法的实施例的流程。其中，上述的存储介质可为磁碟、光盘、只读存储记忆体(Read-Only Memory，ROM)或随机存储记忆体(Random AccessMemory，RAM)等。
另外需说明的是，以上所描述的装置实施例仅仅是示意性的，其中所述作为分离部件说明的单元可以是或者也可以不是物理上分开的，作为单元显示的部件可以是或者也可以不是物理单元，即可以位于一个地方，或者也可以分布到多个网络单元上。可以根据实际的需要选择其中的部分或者全部模块来实现本实施例方案的目的。另外，本发明提供的装置实施例附图中，模块之间的连接关系表示它们之间具有通信连接，具体可以实现为一条或多条通信总线或信号线。本领域普通技术人员在不付出创造性劳动的情况下，即可以理解并实施。
通过以上的实施方式的描述，所属领域的技术人员可以清楚地了解到本发明可借助软件加必需的通用硬件的方式来实现，当然也可以通过专用硬件包括专用集成电路、专用CPU、专用存储器、专用元器件等来实现。一般情况下，凡由计算机程序完成的功能都可以很容易地用相应的硬件来实现，而且，用来实现同一功能的具体硬件结构也可以是多种多样的，例如模拟电路、数字电路或专用电路等。但是，对本发明而言更多情况下软件程序实现是更佳的实施方式。基于这样的理解，本发明的技术方案本质上或者说对现有技术做出贡献的部分可以以软件产品的形式体现出来，该计算机软件产品存储在可读取的存储介质中，如计算机的软盘、U盘、移动硬盘、只读存储器(ROM，Read-Only Memory)、随机存取存储器(RAM，Random Access Memory)、磁碟或者光盘等，包括若干指令用以使得一台计算机设备(可以是个人计算机，服务器，或者网络设备等)执行本发明各个实施例所述的方法。

Claims (6)

1.一种非整数倍采样率下的跳频系统连续相位保持方法，其特征在于，所述方法包括以下步骤：
在利用系统时钟生成目标跳频时钟信号时，获取所述目标跳频时钟信号对应的频率控制信息；其中，所述频率控制信息包括频率控制字和累加值；
基于所述目标跳频时钟信号，确定当前时刻的第一频点和上一时刻的第二频点；
利用所述第一频点和所述第二频点对应的频率，计算频差；
根据所述第一频点对应的相位控制字，计算当前时刻累计获得的待补偿相位值；所述待补偿相位值的表达式为：
Figure FDA0004115879990000011
K1＝F1/fclk；
其中，
Figure FDA0004115879990000012
为当前时刻的待补偿相位值，/>
Figure FDA0004115879990000013
为前一时刻的待补偿相位值，K1为第一频点对应的相位控制字，F1为第一频点对应的频率，fclk为系统时钟的频率；
所述系统时钟在当前时刻的钟差的表达式为：
Figure FDA0004115879990000014
其中，Δt为钟差，K为累加值，K10k为频率控制字，n为频率控制字累加器位数；
所述当前时刻的相位补偿值的表达式为：
Figure FDA0004115879990000015
其中，
Figure FDA0004115879990000016
为相位补偿值，Δt为钟差，ΔF为频差；
基于所述频率控制字和所述累加值，确定系统时钟在当前时刻的钟差；
根据所述频差和所述钟差，生成当前时刻的相位补偿值，并利用所述相位补偿值和所述待补偿相位值，获得跳频相位值。
2.如权利要求1所述的非整数倍采样率下的跳频系统连续相位保持方法，其特征在于，所述确定当前时刻的第一频点和上一时刻的第二频点采用查表法获得。
3.如权利要求1所述的非整数倍采样率下的跳频系统连续相位保持方法，其特征在于，所述跳频相位值的表达式为：
Figure FDA0004115879990000021
其中，
Figure FDA0004115879990000022
为跳频相位值，/>
Figure FDA0004115879990000023
为当前时刻的待补偿相位值，/>
Figure FDA0004115879990000024
为相位补偿值。
4.一种非整数倍采样率下的跳频系统连续相位保持装置，其特征在于，所述非整数倍采样率下的跳频系统连续相位保持装置包括：
获取模块，用于在利用系统时钟生成目标跳频时钟信号时，获取所述目标跳频时钟信号对应的频率控制信息；其中，所述频率控制信息包括频率控制字和累加值；
第一确定模块，用于基于所述目标跳频时钟信号，确定当前时刻的第一频点和上一时刻的第二频点；利用所述第一频点和所述第二频点对应的频率，计算频差；根据所述第一频点对应的相位控制字，计算当前时刻累计获得的待补偿相位值；所述待补偿相位值的表达式为：
Figure FDA0004115879990000025
/>
K1＝F1/fclk；
其中，
Figure FDA0004115879990000026
为当前时刻的待补偿相位值，/>
Figure FDA0004115879990000027
为前一时刻的待补偿相位值，K1为第一频点对应的相位控制字，F1为第一频点对应的频率，fclk为系统时钟的频率；
所述系统时钟在当前时刻的钟差的表达式为：
Figure FDA0004115879990000028
其中，Δt为钟差，K为累加值，K10k为频率控制字，n为频率控制字累加器位数；
所述当前时刻的相位补偿值的表达式为：
Figure FDA0004115879990000029
其中，
Figure FDA00041158799900000210
为相位补偿值，Δt为钟差，ΔF为频差；
第二确定模块，用于基于所述频率控制字和所述累加值，确定系统时钟在当前时刻的钟差；
生成模块，用于根据所述频差和所述钟差，生成当前时刻的相位补偿值，并利用所述相位补偿值和所述待补偿相位值，获得跳频相位值。
5.一种非整数倍采样率下的跳频系统连续相位保持设备，其特征在于，所述非整数倍采样率下的跳频系统连续相位保持设备包括：存储器、处理器及存储在所述存储器上并可在所述处理器上运行的非整数倍采样率下的跳频系统连续相位保持方法程序，所述非整数倍采样率下的跳频系统连续相位保持方法程序被所述处理器执行时实现如权利要求1至3中任一项所述的非整数倍采样率下的跳频系统连续相位保持方法的步骤。
6.一种存储介质，其特征在于，所述存储介质上存储有非整数倍采样率下的跳频系统连续相位保持方法程序，所述非整数倍采样率下的跳频系统连续相位保持方法程序被处理器执行时实现如权利要求1至3中任一项所述的非整数倍采样率下的跳频系统连续相位保持方法的步骤。
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