CN114488019A - 多通道数据采集方法、装置、采集设备以及采集系统 - Google Patents

多通道数据采集方法、装置、采集设备以及采集系统 Download PDF

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CN114488019A
CN114488019A CN202111600655.9A CN202111600655A CN114488019A CN 114488019 A CN114488019 A CN 114488019A CN 202111600655 A CN202111600655 A CN 202111600655A CN 114488019 A CN114488019 A CN 114488019A
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廖学聪
刘宗是
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Guangzhou Chenchuang Technology Development Co ltd
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Abstract

本申请适用于数据采集技术领域，提供了一种多通道数据采集方法、装置、采集设备以及采集系统，该方法包括可编辑逻辑单元获取触发请求，可编辑逻辑单元响应于所述触发请求，从多通道数据采集器获取多通道数字信号，可编辑逻辑单元对多通道数字信号进行时序同步调整，可编辑逻辑单元对时序同步调整后的多通道数字信号进行缓存，可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器。可见，本申请利用可编辑逻辑单元内部硬件并行的优势，提高对多通道数据采集器采集的多通道数字信号的程序执行效率，提高采集效率。

Description

多通道数据采集方法、装置、采集设备以及采集系统
技术领域
本申请属于数据采集技术领域，尤其涉及一种多通道数据采集方法、装置、采集设备以及采集系统。
背景技术
随着现代高科技的飞速发展，雷达这项定位跟踪技术不仅应用在军事领域，在一些民用安防领域也有越来越广泛的应用。但是随着雷达信号处理的复杂度越来越高，需要采用多通道的数据采集方式对雷达信号进行处理，但是现有技术中多通道的数据采集方式效率较低。
发明内容
本申请实施例提供了一种多通道数据采集方法、装置、采集设备以及采集系统，可以解决现有技术中对雷达信号的数据采集方式效率较低的问题。
第一方面，本申请实施例提供了一种多通道数据采集方法，包括：
可编辑逻辑单元获取触发请求；
所述可编辑逻辑单元响应于所述触发请求，从多通道数据采集器获取多通道数字信号；其中，所述可编辑逻辑单元与所述多通道数据采集器连接；
所述可编辑逻辑单元对所述多通道数字信号进行时序同步调整；
所述可编辑逻辑单元对时序同步调整后的多通道数字信号进行缓存；
所述可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器。
在第一方面的一种可能的实现方式中，所述可编辑逻辑单元对所述多通道数字信号进行时序同步调整，包括：
所述可编辑逻辑单元确定所述多通道数字信号中每个通道对应的解串因子个数；
所述可编辑逻辑单元基于预设的串并行转换模块以及预设的时钟信号，根据多通道数字信号中每个通道的数字信号对应的解串因子个数，将所述多通道数字信号中每个通道的数字信号同步到同一时钟域。
在第一方面的一种可能的实现方式中，所述可编辑逻辑单元对时序同步调整后的多通道数字信号进行缓存，包括：
所述可编辑逻辑单元对时序同步调整后的多通道数字信号进行数字正交变换，从所述多通道数字信号的中频信号中提取基带信息；
所述可编辑逻辑单元基于波门脉冲控制，根据所述基带信息，将所述多通道数字信号缓存至预设的缓存器。
在第一方面的一种可能的实现方式中，所述可编辑逻辑单元与数字信号处理器连接；
所述可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器之前，还包括：
所述可编辑逻辑单元将所述多通道数字信号传输至数字信号处理器，以指示所述数字信号处理器对所述多通道数字信号进行可信度量；
接收所述数字信号处理器返回的可信度量结果。
在第一方面的一种可能的实现方式中，所述可编辑逻辑器与切换开关连接；
所述可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器，包括：
若所述可信度量结果为可信，则所述可编辑逻辑单元向切换开关发送导通信号，以指示所述切换开关导通所述可编辑逻辑单元与所述存储器之间的信号传输接口。
第二方面，本申请实施例提供了一种多通道数据采集装置，包括：
获取模块，用于获取触发请求；
响应模块，用于响应于所述触发请求，从多通道数据采集器获取多通道数字信号；
调整模块，用于对所述多通道数字信号进行时序同步调整；
缓存模块，用于对时序同步调整后的多通道数字信号进行缓存；
存储模块，用于将缓存后的多通道数字信号按预设存储顺序存储至存储器。
在第二方面的一种可能实现的方式中，所述调整模块包括：
确定子模块，用于确定所述多通道数字信号中每个通道对应的解串因子个数；
同步子模块，用于基于预设的串并行转换模块以及预设的时钟信号，根据多通道数字信号中每个通道的数字信号对应的解串因子个数，将所述多通道数字信号中每个通道的数字信号同步到同一时钟域。
在第二方面的一种可能实现的方式中，所述缓存模块包括：
提取子模块，用于对时序同步调整后的多通道数字信号进行数字正交变换，从所述多通道数字信号的中频信号中提取基带信息；
缓存子模块，用于单元基于波门脉冲控制，根据所述基带信息，将所述多通道数字信号缓存至预设的缓存器。
在第二方面的一种可能实现的方式中，所述可编辑逻辑单元与数字信号处理器连接；
所述装置还包括：
传输模块，用于将所述多通道数字信号传输至数字信号处理器，以指示所述数字信号处理器对所述多通道数字信号进行可信度量；
接收模块，用于接收所述数字信号处理器返回的可信度量结果。
在第二方面的一种可能实现的方式中，所述可编辑逻辑器与切换开关连接；
所述存储模块包括：
存储子单元，用于若所述可信度量结果为可信，则向切换开关发送导通信号，以指示所述切换开关导通所述可编辑逻辑单元与所述存储器之间的信号传输接口。
第三方面，本申请实施例提供了一种采集设备，包括存储器、处理器、可编辑逻辑单元以及存储在所述存储器中并可在所述可编辑逻辑单元上运行的计算机程序，所述可编辑逻辑单元执行所述计算机程序时实现如上述第一方面所述的方法。
第四方面，本申请实施例提供了一种多通道数据采集系统，包括：
多通道信号采集器，用于采集雷达信号，对所述雷达信号进行模数转换，得到多通道数字信号，发送所述多通道数字信号至可编辑逻辑单元；
与所述多通道信号采集器连接的可编辑逻辑单元，用于获取触发请求，响应于所述触发请求，从多通道数据采集器获取多通道数字信号，对所述多通道数字信号进行时序同步调整，对时序同步调整后的多通道数字信号进行缓存，将缓存后的多通道数字信号按预设存储顺序存储至存储器。
在第四方面的一种可能的实现方式中，所述可编辑逻辑单元，具体用于：
确定所述多通道数字信号中每个通道对应的解串因子个数；
基于预设的串并行转换模块以及预设的时钟信号，根据多通道数字信号中每个通道的数字信号对应的解串因子个数，将所述多通道数字信号中每个通道的数字信号同步到同一时钟域；
对时序同步调整后的多通道数字信号进行数字正交变换，从所述多通道数字信号的中频信号中提取基带信息；
基于波门脉冲控制，根据所述基带信息，将所述多通道数字信号缓存至预的缓存器。
在第四方面的一种可能的实现方式中，所述多通道数据采集系统还包括：与所述可编辑逻辑单元连接的数字信号处理器，用于接收所述可编辑逻辑单元传输的多通道数字信号，对所述多通道数字信号进行可信度量，返回所述可信度量结果至所述可编辑逻辑单元；
所述多通道数据采集系统还包括与所述可编辑逻辑单元、多通道数据采集器以及存储器连接的切换开关，用于根据可编辑逻辑单元传输的导通信号，导通所述可编辑逻辑单元与所述存储器之间的信号传输接口；
所述可编辑逻辑单元还具体用于：
若所述可信度量结果为可信，则所述可编辑逻辑单元生成导通信号，向所述切换开关发送导通信号，以指示所述切换开关导通所述可编辑逻辑单元与所述存储器之间的信号传输接口。
本申请实施例与现有技术相比存在的有益效果是：
本申请实施例中，可编辑逻辑单元获取触发请求，可编辑逻辑单元响应于所述触发请求，从多通道数据采集器获取多通道数字信号，可编辑逻辑单元对所述多通道数字信号进行时序同步调整，可编辑逻辑单元对时序同步调整后的多通道数字信号进行缓存，可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器。可见，本申请利用可编辑逻辑单元内部硬件并行的优势，提高对多通道数据采集器采集的多通道数字信号的程序执行效率，提高采集效率。
附图说明
为了更清楚地说明本申请实施例中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动性的前提下，还可以根据这些附图获得其他的附图。
图1是本申请一实施例提供的多通道数据采集系统的一种结构示意图；
图2是本申请一实施例提供的多通道数据采集系统的另一种结构示意图；
图3是本申请一实施例提供的多通道数据采集方法的流程示意图；
图4是本申请一实施例提供的多通道数据采集装置的结构示意图；
图5是本申请一实施例提供的采集设备的结构示意图。
具体实施方式
以下描述中，为了说明而不是为了限定，提出了诸如特定系统结构、技术之类的具体细节，以便透彻理解本申请实施例。然而，本领域的技术人员应当清楚，在没有这些具体细节的其它实施例中也可以实现本申请。在其它情况中，省略对众所周知的系统、装置、电路以及方法的详细说明，以免不必要的细节妨碍本申请的描述。
应当理解，当在本申请说明书和所附权利要求书中使用时，术语“包括”指示所描述特征、整体、步骤、操作、元素和/或组件的存在，但并不排除一个或多个其它特征、整体、步骤、操作、元素、组件和/或其集合的存在或添加。
还应当理解，在本申请说明书和所附权利要求书中使用的术语“和/或”是指相关联列出的项中的一个或多个的任何组合以及所有可能组合，并且包括这些组合。
如在本申请说明书和所附权利要求书中所使用的那样，术语“如果”可以依据上下文被解释为“当...时”或“一旦”或“响应于确定”或“响应于检测到”。类似地，短语“如果确定”或“如果检测到[所描述条件或事件]”可以依据上下文被解释为意指“一旦确定”或“响应于确定”或“一旦检测到[所描述条件或事件]”或“响应于检测到[所描述条件或事件]”。
另外，在本申请说明书和所附权利要求书的描述中，术语“第一”、“第二”、“第三”等仅用于区分描述，而不能理解为指示或暗示相对重要性。
在本申请说明书中描述的参考“一个实施例”或“一些实施例”等意味着在本申请的一个或多个实施例中包括结合该实施例描述的特定特征、结构或特点。由此，在本说明书中的不同之处出现的语句“在一个实施例中”、“在一些实施例中”、“在其他一些实施例中”、“在另外一些实施例中”等不是必然都参考相同的实施例，而是意味着“一个或多个但不是所有的实施例”，除非是以其他方式另外特别强调。术语“包括”、“包含”、“具有”及它们的变形都意味着“包括但不限于”，除非是以其他方式另外特别强调。
下面将通过具体实施例对本申请实施例提供的技术方案进行介绍。
实施例一
参见图1，为本申请实施例提供的多通道数据采集系统的一种结构示意图，该系统应用于采集设备，该系统可以包括多通道信号采集器11，与所述多通道信号采集器连接的可编辑逻辑单元12以及与所述可编辑逻辑单元连接的存储器13。
多通道信号采集器用于采集雷达信号，对所述雷达信号进行模数转换，得到多通道数字信号，发送所述多通道数字信号至可编辑逻辑单元。
其中，多通道信号采集器优选的是八通道的ADC芯片，数据转换速率最高可达500MSPS。
可编辑逻辑单元用于获取触发请求，响应于所述触发请求，从多通道数据采集器获取多通道数字信号，对所述多通道数字信号进行时序同步调整，对时序同步调整后的多通道数字信号进行缓存，将缓存后的多通道数字信号按预设存储顺序存储至存储器。
其中，可编辑逻辑单元优选的是可编程逻辑器件(FGPA)。
存储器用于存储所述多通道数字信号。
其中，存储器优选为快闪存储器(flash EPROM)。
在一种可选的实施方式中，所述可编辑逻辑单元，具体用于：
确定所述多通道数字信号中每个通道对应的解串因子个数；
基于预设的串并行转换模块以及预设的时钟信号，根据多通道数字信号中每个通道的数字信号对应的解串因子个数，将所述多通道数字信号中每个通道的数字信号同步到同一时钟域。
在一种可选的实施方式中，所述可编辑逻辑单元，具体用于：
对时序同步调整后的多通道数字信号进行数字正交变换，从所述多通道数字信号的中频信号中提取基带信息；
基于波门脉冲控制，根据所述基带信息，将所述多通道数字信号缓存至预的缓存器。
本申请实施例中，多通道数据采集系统包括多通道信号采集器，与多通道信号采集器连接的可编辑逻辑单元以及与可编辑逻辑单元连接的存储器。可见，本申请利用可编辑逻辑单元内部硬件并行的优势，提高对多通道数据采集器采集的多通道数字信号的程序执行效率，提高采集效率。
实施例二
优选的，如图2所示，为本申请实施例提供的多通道数据采集系统的另一种结构示意图，所述多通道数据采集系统还包括与所述可编辑逻辑单元、所述存储器连接的切换开关15，以及与所述可编辑逻辑单元连接的数字信号处理器14。
数字信号处理器用于接收所述可编辑逻辑单元传输的多通道数字信号，对所述多通道数字信号进行可信度量，返回所述可信度量结果至所述可编辑逻辑单元。
其中，数字处理器优选为DSP芯片。
所述多通道数据采集系统还包括与所述可编辑逻辑单元以及存储器连接的切换开关，用于根据可编辑逻辑单元传输的导通信号，导通所述可编辑逻辑单元与所述存储器之间的信号传输接口。
其中，切换开关为硬件开关。
所述可编辑逻辑单元还具体用于：若所述可信度量结果为可信，则所述可编辑逻辑单元生成导通信号，向所述切换开关发送导通信号，以指示所述切换开关导通所述可编辑逻辑单元与所述存储器之间的信号传输接口。
其中，信号传输接口为串行外设接口(SPI)。
本申请实施例中，多通道数据采集系统还包括与可编辑逻辑单元连接的数字信号处理器以及与可编辑逻辑单元连接的切换开关。可见，本申请还利用数字信号处理器的高速运算能力，对可编辑逻辑单元处理的多通道数字信号进行可信度量提高数据合法性，然后可编辑逻辑单元根据可信度量结果控制切换开关将多通道数字信号从可编辑逻辑单元存储至存储器。
实施例三
参见图3，为本申请实施例提供的多通道数据采集方法的流程示意图，作为示例而非限定，该方法可以应用于采集设备，该方法包括以下步骤：
步骤S301、可编辑逻辑单元获取触发请求。其中，触发请求包括外部输入或软触发的触发信号。
其中，可编辑逻辑单元优选的是可编程逻辑器件(FGPA)。
步骤S302、可编辑逻辑单元响应于触发请求，从多通道数据采集器获取多通道数字信号。
其中，可编辑逻辑单元与多通道数据采集器连接，多通道信号采集器优选的是八通道的ADC芯片，数据转换速率最高可达500MSPS，多通道数字信号为多通道信号采集器采集雷达信号，对雷达信号进行模数转换得到的。优选的，雷达信号可以是指相控阵雷达产生的雷达信号。
步骤S303、可编辑逻辑单元对多通道数字信号进行时序同步调整。
具体应用中，可编辑逻辑单元对多通道数字信号进行时序同步调整，包括：
步骤S303-1、可编辑逻辑单元确定多通道数字信号中每个通道对应的解串因子个数。
步骤S303-2、可编辑逻辑单元基于预设的串并行转换模块以及预设的时钟信号，根据多通道数字信号中每个通道的数字信号对应的解串因子个数，将多通道数字信号中每个通道的数字信号同步到同一时钟域。
其中，预设的串并行转换模块为LVDS串并行转换模块，预设的时钟信号为多通道数据采集器的随路时钟。
可以理解的是，本申请实施例中的可编辑逻辑单元利用内部的LVDS串并行转换模块的recevier模式，结合多通道数据采集器的随路时钟，保证逻辑正确综合的将多通道数字信号中每个通道的数字信号同步到同一时钟域。
步骤S304、可编辑逻辑单元对时序同步调整后的多通道数字信号进行缓存。
具体应用中，可编辑逻辑单元对时序同步调整后的多通道数字信号进行缓存，包括：
步骤S304-1、可编辑逻辑单元对时序同步调整后的多通道数字信号进行数字正交变换，从所述多通道数字信号的中频信号中提取基带信息。
步骤S304-2、可编辑逻辑单元基于波门脉冲控制，根据基带信息，将多通道数字信号缓存至预设的缓存器。
其中，预设的缓存器为FIFO缓存器。
步骤S305、可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器。
其中，预设存储顺序为先入先出顺序。
优选的，可编辑逻辑单元与数字信号处理器连接。其中，数字信号处理器优选为DSP芯片。
所述可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器之前，还包括：
步骤S305-1、可编辑逻辑单元将多通道数字信号传输至数字信号处理器，以指示数字信号处理器对多通道数字信号进行可信度量。
其中，可信度量为签名查询，签名是指数字签名，即只有信息的发送者才能产生的被人无法伪造的一段数字串，该数字串同时也是对信息的发送者发送信息真实性的一个有效证明。具体应用中，可编程逻辑单元启用预设权限例如root权限，输入查询指令例如keytool指令，进行查询多通道数字信号是否合法。
步骤S305-2、接收数字信号处理器返回的可信度量结果。
具体应用中，可编辑逻辑单元与存储器之间设有切换开关。其中，切换开关为硬件开关。
可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器，包括：
若可信度量结果为可信，则可编辑逻辑单元向切换开关发送导通信号，以指示切换开关导通可编辑逻辑单元与存储器之间的信号传输接口。
其中，信号传输接口为串行外设接口(SPI)。
可以理解的是，本申请实施例还利用数字信号处理器的高速运算能力，对可编辑逻辑单元处理的多通道数字信号进行可信度量提高数据合法性，然后可编辑逻辑单元根据可信度量结果控制切换开关将多通道数字信号从可编辑逻辑单元存储至存储器
本申请实施例中，可编辑逻辑单元获取触发请求，可编辑逻辑单元响应于所述触发请求，从多通道数据采集器获取多通道数字信号，可编辑逻辑单元对所述多通道数字信号进行时序同步调整，可编辑逻辑单元对时序同步调整后的多通道数字信号进行缓存，可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器。可见，本申请利用可编辑逻辑单元内部硬件并行的优势，提高对多通道数据采集器采集的多通道数字信号的程序执行效率，提高采集效率。
应理解，上述实施例中各步骤的序号的大小并不意味着执行顺序的先后，各过程的执行顺序应以其功能和内在逻辑确定，而不应对本申请实施例的实施过程构成任何限定。
实施例四
对应于上文实施例所述的方法，图4示出了本申请实施例提供的多通道数据采集装置的结构框图，为了便于说明，仅示出了与本申请实施例相关的部分。
参照图4，该装置包括：
获取模块41，用于获取触发请求；
响应模块42，用于响应于所述触发请求，从多通道数据采集器获取多通道数字信号；
调整模块43，用于对所述多通道数字信号进行时序同步调整；
缓存模块44，用于对时序同步调整后的多通道数字信号进行缓存；
存储模块45，用于将缓存后的多通道数字信号按预设存储顺序存储至存储器。
在一种可能实现的方式中，所述调整模块包括：
确定子模块，用于确定所述多通道数字信号中每个通道对应的解串因子个数；
同步子模块，用于基于预设的串并行转换模块以及预设的时钟信号，根据多通道数字信号中每个通道的数字信号对应的解串因子个数，将所述多通道数字信号中每个通道的数字信号同步到同一时钟域。
在一种可能实现的方式中，所述缓存模块包括：
提取子模块，用于对时序同步调整后的多通道数字信号进行数字正交变换，从所述多通道数字信号的中频信号中提取基带信息；
缓存子模块，用于单元基于波门脉冲控制，根据所述基带信息，将所述多通道数字信号缓存至预设的缓存器。
在一种可能实现的方式中，所述可编辑逻辑单元与数字信号处理器连接；
所述装置还包括：
传输模块，用于将所述多通道数字信号传输至数字信号处理器，以指示所述数字信号处理器对所述多通道数字信号进行可信度量；
接收模块，用于接收所述数字信号处理器返回的可信度量结果。
在一种可能实现的方式中，所述可编辑逻辑器与切换开关连接；
所述存储模块包括：
存储子单元，用于若所述可信度量结果为可信，则向切换开关发送导通信号，以指示所述切换开关导通所述可编辑逻辑单元与所述存储器之间的信号传输接口。
需要说明的是，上述装置/单元之间的信息交互、执行过程等内容，由于与本申请方法实施例基于同一构思，其具体功能及带来的技术效果，具体可参见方法实施例部分，此处不再赘述。
实施例五
图5为本申请一实施例提供的采集设备的结构示意图。如图5所示，该实施例的采集设备5包括：至少一个处理器50、存储器51、可编程逻辑单元53以及存储在所述存储器51中并可在所述至少一个可编程逻辑单元53上运行的计算机程序52，所述可编程逻辑单元53执行所述计算机程序52时实现上述任意各个方法实施例中的步骤。
该采集设备可包括，但不仅限于，处理器50、存储器51。本领域技术人员可以理解，图5仅仅是采集设备5的举例，并不构成对采集设备5的限定，可以包括比图示更多或更少的部件，或者组合某些部件，或者不同的部件，例如还可以包括输入输出设备、网络接入设备等。
所称处理器50可以是中央处理单元(Central Processing Unit，CPU)，该处理器50还可以是其他通用处理器、数字信号处理器(Digital Signal Processor，DSP)、专用集成电路(Application Specific Integrated Circuit，ASIC)、现成可编程门阵列(Field-Programmable Gate Array，FPGA)或者其他可编程逻辑器件、分立门或者晶体管逻辑器件、分立硬件组件等。通用处理器可以是微处理器或者该处理器也可以是任何常规的处理器等。
所述存储器51在一些实施例中可以是所述采集设备5的内部存储单元，例如采集设备5的硬盘或内存。所述存储器51在另一些实施例中也可以是所述采集设备5的外部存储设备，例如所述采集设备5上配备的插接式硬盘，智能存储卡(Smart Media Card,SMC)，安全数字(Secure Digital,SD)卡，闪存卡(Flash Card)等。进一步地，所述存储器51还可以既包括所述采集设备5的内部存储单元也包括外部存储设备。所述存储器51用于存储操作系统、应用程序、引导装载程序(BootLoader)、数据以及其他程序等，例如所述计算机程序的程序代码等。所述存储器51还可以用于暂时地存储已经输出或者将要输出的数据。
所属领域的技术人员可以清楚地了解到，为了描述的方便和简洁，仅以上述各功能单元、模块的划分进行举例说明，实际应用中，可以根据需要而将上述功能分配由不同的功能单元、模块完成，即将所述装置的内部结构划分成不同的功能单元或模块，以完成以上描述的全部或者部分功能。实施例中的各功能单元、模块可以集成在一个处理单元中，也可以是各个单元单独物理存在，也可以两个或两个以上单元集成在一个单元中，上述集成的单元既可以采用硬件的形式实现，也可以采用软件功能单元的形式实现。另外，各功能单元、模块的具体名称也只是为了便于相互区分，并不用于限制本申请的保护范围。上述系统中单元、模块的具体工作过程，可以参考前述方法实施例中的对应过程，在此不再赘述。
所述集成的单元如果以软件功能单元的形式实现并作为独立的产品销售或使用时，可以存储在一个计算机可读取存储介质中。基于这样的理解，本申请实现上述实施例方法中的全部或部分流程，可以通过计算机程序来指令相关的硬件来完成，所述的计算机程序可存储于一计算机可读存储介质中，该计算机程序在被处理器执行时，可实现上述各个方法实施例的步骤。其中，所述计算机程序包括计算机程序代码，所述计算机程序代码可以为源代码形式、对象代码形式、可执行文件或某些中间形式等。所述计算机可读介质至少可以包括：能够将计算机程序代码携带到采集设备的任何实体或装置、记录介质、计算机存储器、只读存储器(ROM，Read-Only Memory)、随机存取存储器(RAM，Random Access Memory)、电载波信号、电信信号以及软件分发介质。例如U盘、移动硬盘、磁碟或者光盘等。在某些司法管辖区，根据立法和专利实践，计算机可读介质不可以是电载波信号和电信信号。
在上述实施例中，对各个实施例的描述都各有侧重，某个实施例中没有详述或记载的部分，可以参见其它实施例的相关描述。
本领域普通技术人员可以意识到，结合本文中所公开的实施例描述的各示例的单元及算法步骤，能够以电子硬件、或者计算机软件和电子硬件的结合来实现。这些功能究竟以硬件还是软件方式来执行，取决于技术方案的特定应用和设计约束条件。专业技术人员可以对每个特定的应用来使用不同方法来实现所描述的功能，但是这种实现不应认为超出本申请的范围。
在本申请所提供的实施例中，应该理解到，所揭露的装置/网络设备和方法，可以通过其它的方式实现。例如，以上所描述的装置/网络设备实施例仅仅是示意性的，例如，所述模块或单元的划分，仅仅为一种逻辑功能划分，实际实现时可以有另外的划分方式，例如多个单元或组件可以结合或者可以集成到另一个系统，或一些特征可以忽略，或不执行。另一点，所显示或讨论的相互之间的耦合或直接耦合或通讯连接可以是通过一些接口，装置或单元的间接耦合或通讯连接，可以是电性，机械或其它的形式。
所述作为分离部件说明的单元可以是或者也可以不是物理上分开的，作为单元显示的部件可以是或者也可以不是物理单元，即可以位于一个地方，或者也可以分布到多个网络单元上。可以根据实际的需要选择其中的部分或者全部单元来实现本实施例方案的目的。
以上所述实施例仅用以说明本申请的技术方案，而非对其限制；尽管参照前述实施例对本申请进行了详细的说明，本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例技术方案的精神和范围，均应包含在本申请的保护范围之内。

Claims (10)

1.一种多通道数据采集方法，其特征在于，包括：
可编辑逻辑单元获取触发请求；
所述可编辑逻辑单元响应于所述触发请求，从多通道数据采集器获取多通道数字信号；其中，所述可编辑逻辑单元与所述多通道数据采集器连接；
所述可编辑逻辑单元对所述多通道数字信号进行时序同步调整；
所述可编辑逻辑单元对时序同步调整后的多通道数字信号进行缓存；
所述可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器。
2.如权利要求1所述的多通道数据采集方法，其特征在于，所述可编辑逻辑单元对所述多通道数字信号进行时序同步调整，包括：
所述可编辑逻辑单元确定所述多通道数字信号中每个通道对应的解串因子个数；
所述可编辑逻辑单元基于预设的串并行转换模块以及预设的时钟信号，根据多通道数字信号中每个通道的数字信号对应的解串因子个数，将所述多通道数字信号中每个通道的数字信号同步到同一时钟域。
3.如权利要求1所述的多通道数据采集方法，其特征在于，所述可编辑逻辑单元对时序同步调整后的多通道数字信号进行缓存，包括：
所述可编辑逻辑单元对时序同步调整后的多通道数字信号进行数字正交变换，从所述多通道数字信号的中频信号中提取基带信息；
所述可编辑逻辑单元基于波门脉冲控制，根据所述基带信息，将所述多通道数字信号缓存至预设的缓存器。
4.如权利要求1至3任一项所述的多通道数据采集方法，其特征在于，所述可编辑逻辑单元与数字信号处理器连接；
所述可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器之前，还包括：
所述可编辑逻辑单元将所述多通道数字信号传输至数字信号处理器，以指示所述数字信号处理器对所述多通道数字信号进行可信度量；
接收所述数字信号处理器返回的可信度量结果。
5.如权利要求4所述的多通道数据采集方法，其特征在于，所述可编辑逻辑单元与所述存储器之间设有切换开关；
所述可编辑逻辑单元将缓存后的多通道数字信号按预设存储顺序存储至存储器，包括：
若所述可信度量结果为可信，则所述可编辑逻辑单元向切换开关发送导通信号，以指示所述切换开关导通所述可编辑逻辑单元与所述存储器之间的信号传输接口。
6.一种多通道数据采集装置，其特征在于，包括：
获取模块，用于获取触发请求；
响应模块，用于响应于所述触发请求，从多通道数据采集器获取多通道数字信号；
调整模块，用于对所述多通道数字信号进行时序同步调整；
缓存模块，用于对时序同步调整后的多通道数字信号进行缓存；
存储模块，用于将缓存后的多通道数字信号按预设存储顺序存储至存储器。
7.一种采集设备，包括存储器、处理器、可编辑逻辑单元以及存储在所述存储器中并可在所述可编辑逻辑单元上运行的计算机程序，其特征在于，所述可编辑逻辑单元执行所述计算机程序时实现如权利要求1至5任一项所述的方法。
8.一种多通道数据采集系统，其特征在于，包括：
多通道信号采集器，用于采集雷达信号，对所述雷达信号进行模数转换，得到多通道数字信号，发送所述多通道数字信号至可编辑逻辑单元；
与所述多通道信号采集器连接的可编辑逻辑单元，用于获取触发请求，响应于所述触发请求，从多通道数据采集器获取多通道数字信号，对所述多通道数字信号进行时序同步调整，对时序同步调整后的多通道数字信号进行缓存，将缓存后的多通道数字信号按预设存储顺序存储至存储器。
9.如权利要求8所述的多通道数据采集系统，其特征在于，所述可编辑逻辑单元，具体用于：
确定所述多通道数字信号中每个通道对应的解串因子个数；
基于预设的串并行转换模块以及预设的时钟信号，根据多通道数字信号中每个通道的数字信号对应的解串因子个数，将所述多通道数字信号中每个通道的数字信号同步到同一时钟域；
对时序同步调整后的多通道数字信号进行数字正交变换，从所述多通道数字信号的中频信号中提取基带信息；
基于波门脉冲控制，根据所述基带信息，将所述多通道数字信号缓存至预的缓存器。
10.如权利要求8或9任一项所述的多通道数据采集系统，所述多通道数据采集系统还包括：与所述可编辑逻辑单元连接的数字信号处理器，用于接收所述可编辑逻辑单元传输的多通道数字信号，对所述多通道数字信号进行可信度量，返回所述可信度量结果至所述可编辑逻辑单元；
所述多通道数据采集系统还包括与所述可编辑逻辑单元以及存储器连接的切换开关，用于根据可编辑逻辑单元传输的导通信号，导通所述可编辑逻辑单元与所述存储器之间的信号传输接口；
所述可编辑逻辑单元还具体用于：
若所述可信度量结果为可信，则所述可编辑逻辑单元生成导通信号，向所述切换开关发送导通信号，以指示所述切换开关导通所述可编辑逻辑单元与所述存储器之间的信号传输接口。
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* Cited by examiner, † Cited by third party
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CN115017066A (zh) * 2022-06-16 2022-09-06 西安索唯光电技术有限公司 一种多通道数据记录系统及方法
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