CN114093296A - 扫描电路及其驱动方法、显示面板 - Google Patents

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Abstract

本发明公开了一种扫描电路及其驱动方法、显示面板。扫描电路包括：输入模块、第一控制模块、第二控制模块、节点互控模块和输出模块。输出模块用于响应第一节点的控制将第一电平信号输出，或者响应第二节点的控制将第一时钟信号输出；第一控制模块用于在第一电平信号输出阶段，响应第二时钟信号的控制将第二电平信号传输至第三节点；第二控制模块用于在第一时钟信号输出阶段，响应输入信号和第一时钟信号，控制第一节点与第三节点之间的导通状态不同于第一控制模块；以及在第一电平信号输出阶段，控制第一节点与第三节点之间导通，将第二电平信号传输至第一节点。本发明实施例可以提高扫描电路的稳定性，提升显示面板的显示效果。

Description

扫描电路及其驱动方法、显示面板
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种扫描电路及其驱动方法、显示面板。
背景技术
现有技术中，在显示面板中设置有像素电路和扫描电路；扫描电路输出扫描信号，以驱动显示面板中的像素电路，进而驱动发光器件进行发光显示。因此，扫描电路的稳定性影响着显示面板的显示品质；但现有的扫描电路的稳定性并不能满足人们对显示效果越来越高的要求。
发明内容
本发明实施例提供了一种扫描电路及其驱动方法、显示面板，以提高扫描电路的稳定性，提升显示面板的显示效果。
为实现上述技术目的，本发明实施例提供了如下技术方案：
一种扫描电路，包括：
输出模块，用于响应第一节点的控制将第一电平信号输出，或者响应第二节点的控制将第一时钟信号输出；
节点互控模块，用于在所述第一电平信号输出阶段，响应所述第一节点的控制将所述第一电平信号传输至所述第二节点；以及在所述第一时钟信号输出阶段，响应输入信号或所述第二节点的控制，将所述第一电平信号传输至所述第一节点；
输入模块，用于在所述第一时钟信号输出阶段，响应所述输入信号的控制将第二电平信号传输至所述第二节点，以控制所述第一时钟信号输出；
第一控制模块，用于在所述第一电平信号输出阶段，响应第二时钟信号的控制将所述第二电平信号传输至第三节点；
第二控制模块，用于在所述第一时钟信号输出阶段，响应所述输入信号和所述第一时钟信号，控制所述第一节点与所述第三节点之间的导通状态不同于所述第一控制模块；以及在所述第一电平信号输出阶段，控制所述第一节点与所述第三节点之间导通，将所述第二电平信号传输至所述第一节点。
可选地，所述第二控制模块包括：
输入控制单元，所述输入控制单元的控制端接入所述输入信号，所述输入控制单元的输入端接入所述第一电平信号，所述输入控制单元的输出端与第四节点电连接；
时钟控制单元，所述时钟控制单元的控制端接入所述第一时钟信号，所述时钟控制单元的输入端接入所述第二电平信号，所述时钟控制单元的输出端与所述第四节点电连接；
中间控制单元，所述中间控制单元的控制端与所述第四节点电连接，所述中间控制单元的输入端与所述第三节点电连接，所述中间控制单元的输出端与所述第一节点电连接；
第一存储单元，所述第一存储单元的第一端接入所述第一电平信号，所述第一存储单元的第二端与所述第四节点电连接。
可选地，所述输入控制单元包括：第一晶体管；所述第一晶体管的控制极作为所述输入控制单元的控制端，所述第一晶体管的第一极作为所述输入控制单元的输入端，所述第一晶体管的第二极作为所述输入控制单元的输出端。
可选地，所述时钟控制单元包括：第二晶体管；所述第二晶体管的控制极作为所述时钟控制单元的控制端，所述第二晶体管的第一极作为所述时钟控制单元的输入端，所述第二晶体管的第二极作为所述时钟控制单元的输出端。
可选地，所述中间控制单元包括：第三晶体管；所述第三晶体管的控制极作为所述中间控制单元的控制端，所述第三晶体管的第一极作为所述中间控制单元的输入端，所述第三晶体管的第二极作为所述中间控制单元的输出端。
可选地，所述第一存储单元包括：第一电容；所述第一电容的第一端作为所述第一存储单元的第一端，所述第一电容的第二端作为所述第一存储单元的第二端。
可选地，所述扫描电路还包括：第一保护模块；所述第一保护模块的控制端接入所述第二电平信号，所述第一保护模块的第一端与所述第二节点电连接，所述第一保护模块的第二端与所述输出模块电连接；
优选地，所述第一保护模块包括：第四晶体管；所述第四晶体管的控制极作为所述第一保护模块的控制端，所述第四晶体管的第一极作为所述第一保护模块的第一端，所述第四晶体管的第二极作为所述第一保护模块的第二端。
可选地，所述扫描电路还包括：第二保护模块；所述第二保护模块的控制端接入所述第二电平信号，所述第二保护模块的第一端与所述第一控制模块电连接，所述第二保护模块的第二端与所述第三节点电连接；
优选地，所述第二保护模块包括：第五晶体管；所述第五晶体管的控制极作为所述第二保护模块的控制端，所述第五晶体管的第一极作为所述第二保护模块的第一端，所述第五晶体管的第二极作为所述第二保护模块的第二端。
相应地，本发明实施例还提供了一种显示面板，包括：级联连接的多级如本发明任意实施例所提供的扫描电路。
相应地，本发明实施例还提供了一种扫描电路的驱动方法，包括：
第一时钟信号输出阶段，所述输入模块响应输入信号的控制将第二电平信号传输至第二节点；所述第二控制模块响应所述输入信号和第一时钟信号，控制第一节点与第三节点之间的导通状态不同于所述第一控制模块；所述节点互控模块响应所述输入信号或所述第二节点的控制，将第一电平信号传输至所述第一节点；所述输出模块响应所述第二节点的控制将所述第一时钟信号输出；
第一电平信号输出阶段，所述第一控制模块响应第二时钟信号的控制将所述第二电平信号传输至所述第三节点；所述第二控制模块控制所述第一节点与所述第三节点之间导通，将所述第二电平信号传输至所述第一节点；所述节点互控模块响应所述第一节点的控制将所述第一电平信号传输至所述第二节点；所述输出模块响应所述第一节点的控制将所述第一电平信号输出。
本发明实施例提供了一种新的扫描电路，具体设置有输入模块、第一控制模块、第二控制模块、节点互控模块和输出模块。在第一时钟信号输出阶段，通过第二控制模块控制第一节点与第三节点之间的导通状态不同于第一控制模块的导通状态，始终切断第二电平信号向第一节点传输的路径，使第一节点在节点互控模块的作用下，保持与第二节点不同的电平，以保证输出模块准确输出。在第一电平信号输出阶段，通过第二控制模块控制第一节点与第三节点之间的导通，使第二电平信号可靠传输至第一节点，以保证输出模块准确输出。因此，与现有技术相比，本发明实施例可以保证各阶段输出模块的控制信号准确有效，提高扫描电路的稳定性，提升显示面板的显示效果。
附图说明
图1是本发明实施例提供的一种扫描电路的结构示意图；
图2是本发明实施例提供的一种扫描电路的驱动时序示意图；
图3是本发明实施例提供的另一种扫描电路的结构示意图；
图4是本发明实施例提供的又一种扫描电路的结构示意图；
图5是本发明实施例提供的又一种扫描电路的结构示意图；
图6是本发明实施例提供的一种扫描电路的仿真波形图；
图7是本发明实施例提供的扫描电路中设置保护结构与不设置保护结构时的仿真波形对比示意图；
图8是本发明实施例提供的又一种扫描电路的结构示意图；
图9是本发明实施例提供的一种显示面板的结构示意图；
图10是本发明实施例提供的一种扫描电路的驱动方法的流程示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
本发明实施例提供了一种扫描电路。图1是本发明实施例提供的一种扫描电路的结构示意图。参见图1，该扫描电路100包括：输入模块10、第一控制模块20、第二控制模块30、节点互控模块40和输出模块50。
其中，输出模块50用于响应第一节点N1的控制将第一电平信号VGH输出，或者响应第二节点N2的控制将第一时钟信号SCK1输出。节点互控模块40用于在第一电平信号VHG输出阶段，响应第一节点N1的控制将第一电平信号VGH传输至第二节点N2；以及在第一时钟信号SCK1输出阶段，响应输入信号SIN或第二节点N2的控制，将第一电平信号VGH传输至第一节点N1。图1中示例性地示出了节点互控模块40的第一端41与输入信号SIN电连接，响应输入信号SIN的控制，将第一电平信号VGH传输至第一节点N1。
输入模块10用于在第一时钟信号SCK1输出阶段，响应输入信号SIN的控制将第二电平信号VGL传输至第二节点N2，以控制输出模块50输出第一时钟信号SCK1。第一控制模块20用于在第一电平信号VGH输出阶段，响应第二时钟信号SCK2的控制将第二电平信号VGL传输至第三节点N3。第二控制模块30用于在第一时钟信号SCK1输出阶段，响应输入信号SIN和第一时钟信号SCK1，控制第一节点N1与第三节点N3之间的导通状态不同于第一控制模块20；以及在第一电平信号VGH输出阶段，控制第一节点N1与第三节点N3之间导通，将第二电平信号VGL传输至第一节点N1。
下面结合电路时序对各模块的工作过程进行具体说明。图2是本发明实施例提供的一种扫描电路的驱动时序示意图。结合图1和图2，示例性地，以第一电平信号VGH为高电平、第二电平信号VGL为低电平、各控制信号均为低电平有效为例，该扫描电路100的驱动过程包括：第一时钟信号输出阶段T1和第一电平信号输出阶段T2。
第一时钟信号输出阶段T1具体可分为第一子阶段T11和第二子阶段T12。第一子阶段T11中，输入信号SIN为低电平，第一时钟信号SCK1为高电平，第二时钟信号SCK2为低电平；第二子阶段T12中，输入信号SIN为高电平，第一时钟信号SCK1为低电平，第二时钟信号SCK2为高电平。
在第一子阶段T11，输入模块10响应输入信号SIN的控制将第二电平信号VGL传输至第二节点N2；输出模块50响应第二节点N2的控制，将第一时钟信号SCK1作为扫描信号SOUT输出。由于第一时钟信号SCK1为高电平，输出模块50输出高电平。第一控制模块20响应第二时钟信号SCK2的控制而导通，第二控制模块30响应输入信号SIN的控制，其输入端35和输出端36之间断开，以使第二控制模块30响应输入信号SIN和第一时钟信号SCK1，控制第一节点N1与第三节点N3之间的导通状态不同于第一控制模块20。节点互控模块40响应输入信号SIN的控制，将第一电平信号VGH传输至第一节点N1。
在第二子阶段T12，输出模块50输出的第一时钟信号SCK1变为低电平，实现对输入信号SIN低电平的移位输出。第一控制模块20响应第二时钟信号SCK2的控制断开，第二控制模块30响应第一时钟信号SCK1的控制，其输入端35和输出端36之间导通，以使第二控制模块30控制第一节点N1与第三节点N3之间的导通状态不同于第一控制模块20。
第一电平信号输出阶段T2具体可分为交替进行的第三子阶段T21和第四子阶段T22。第三子阶段T21中，第一时钟信号SCK1为高电平，第二时钟信号SCK2为低电平；第四子阶段T22中，第一时钟信号SCK1为低电平，第二时钟信号SCK2为高电平。
在第三子阶段T21，第一控制模块20响应第二时钟信号SCK2的控制而导通，同时由于第二控制模块30的具有保持功能，其输入端35和输出端36之间仍维持上阶段的导通状态，以使第二电平信号VGL传输至第一节点N1。输出模块50响应第一节点N1的低电平而导通，将第一电平信号VGH的高电平输出。节点互控模块40响应第一节点N1的控制，将第一电平信号VGH传输至第二节点N2。
在第四子阶段T22，第一节点N1保持上阶段的低电平，输出模块50输出高电平。第一控制模块20响应第二时钟信号SCK2的控制而断开，第二控制模块30响应第一时钟信号SCK1的控制，其输入端35和输出端36之间导通。节点互控模块40响应第一节点N1的控制，将第一电平信号VGH传输至第二节点N2。
本发明实施例提供了一种新的扫描电路100，具体设置有输入模块10、第一控制模块20、第二控制模块30、节点互控模块40和输出模块50。在第一时钟信号输出阶段T1，通过第二控制模块30控制第一节点N1与第三节点N3之间的导通状态不同于第一控制模块20的导通状态，始终切断第二电平信号VGL向第一节点N1传输的路径，使第一节点N1在节点互控模块40的作用下，保持与第二节点N2不同的电平，以保证输出模块50准确输出。在第一电平信号输出阶段T2，通过第二控制模块30控制第一节点N1与第三节点N3之间的导通，使第二电平信号VGL可靠传输至第一节点N1，以保证输出模块50准确输出。因此，与现有技术相比，本发明实施例可以保证各阶段输出模块50的控制信号准确有效，提高扫描电路100的稳定性，提升显示面板的显示效果。
继续参见图1，在一种实施方式中，可选地，扫描电路100中各模块的具体连接方式为：输入模块10的控制端11接入输入信号SIN，输入端12接入第二电平信号VGL，输出端13与第二节点N2电连接。第一控制模块20的控制端21接入第二时钟信号SCK2，输入端21接入第二电平信号VGL，输出端23与第三节点N3电连接。第二控制模块30的第一控制端31接入输入信号SIN，第二控制端32接入第一时钟信号SCK1，第一输入端33接入第一电平信号VGH，第二输入端34接入第二电平信号VGL，第三输入端35与第三节点N3电连接，输出端36与第一节点N1电连接。节点互控模块40的第一端41接入输入信号SIN或与第二节点N2电连接(此处以接入输入信号SIN为例)，第二端接入第一电平信号VGH，第三端43与第一节点N1电连接，第四端44与第二节点N2电连接。输出模块50的第一控制端51与第一节点N1电连接，第二控制端52与第二节点N2电连接，第一输入端53接入第一电平信号VGH，第二输入端54接入第一时钟信号SCK1，输出端55输出扫描信号SOUT。
在上述各实施例中，各模块的设置方式有多种，下面进行具体说明，但不作为对本发明的限定。图3是本发明实施例提供的另一种扫描电路的结构示意图。参见图3，在上述各实施方式的基础上，可选地，第二控制模块30包括：输入控制单元310、时钟控制单元320、中间控制单元330和第一存储单元340。
其中，输入控制单元310的控制端接入输入信号SIN，输入端接入第一电平信号VGH，输出端与第四节点N4电连接。时钟控制单元320的控制端接入第一时钟信号SCK1，输入端接入第二电平信号VGL，输出端与第四节点N4电连接。中间控制单元330的控制端与第四节点N4电连接，输入端与第三节点N3电连接，输出端与第一节点N1电连接。第一存储单元340的第一端接入第一电平信号VGH，第二端与第四节点N4电连接。
下面结合图2和图3，对第二控制模块30的工作过程进行说明：
在第一子阶段T11，输入信号SIN为低电平，第一时钟信号SCK1为高电平，第二时钟信号SCK2为低电平。时钟控制单元320在第一时钟信号SCK1的控制下断开；输入控制单元310响应输入信号SIN的控制，将第一电平信号VGH传输至第四节点N4；中间控制单元330在第四节点N4的控制下断开，第一节点N1和第三节点N3之间不导通。同时，第一控制模块20响应第二时钟信号SCK2的控制导通。
在第二子阶段T12，第一时钟信号SCK1为低电平，输入信号SIN为高电平，第二时钟信号SCK2为高电平。输入控制单元310在输入信号SIN的控制下断开；时钟控制单元320响应第一时钟信号SCK1的控制，将第二电平信号VGL传输至第四节点N4；中间控制单元330响应第四节点N4的控制导通，第一节点N1和第三节点N3之间导通；第一存储单元340维持第四节点N4的低电平。同时，第一控制模块20在第二时钟信号SCK2的控制下断开。因此，在第一时钟信号输出阶段T1，第一控制模块20和中间控制单元330交替导通。
在第三子阶段T21，第一时钟信号SCK1和输入信号SIN均为高电平，第二时钟信号SCK2为低电平。输入控制单元310断开；时钟控制单元320断开；在第一存储单元340的作用下，第四节点N4维持上一子阶段的低电平；中间控制单元330响应第四节点N4的控制导通，第一节点N1和第三节点N3之间导通。
在第四子阶段T22，第一时钟信号SCK1为低电平，输入信号SIN为高电平，第二时钟信号SCK2为高电平。第二控制模块30中的各单元的动作过程与在第二子阶段T12中相同，不再赘述。此阶段第一节点N1和第三节点N3之间导通。
本发明实施例中，第一存储单元340的设置使得输入控制单元310和时钟控制单元320均断开时，第四节点N4的电平可以维持上一子阶段的状态，以保证中间控制单元340的可靠动作；同时，第一存储单元340可以维持第四节点N4的电位，避免中间控制单元330因受到较大电压应力而受损。
图4是本发明实施例提供的又一种扫描电路的结构示意图。参见图4，在上述各实施方式的基础上，可选地，输入控制单元310包括：第一晶体管M1。第一晶体管M1的控制极作为输入控制单元310的控制端，接入输入信号SIN；第一晶体管M1的第一极作为输入控制单元310的输入端，接入第一电平信号VGH；第一晶体管M1的第二极作为输入控制单元310的输出端，与第四节点N4电连接。本实施例设置输入控制单元310仅包括一个晶体管，使电路结构简单，易于实现。
继续参见图4，在上述各实施方式的基础上，可选地，时钟控制单元320包括：第二晶体管M2。第二晶体管M2的控制极作为时钟控制单元320的控制端，接入第一时钟信号SCK1；第二晶体管M2的第一极作为时钟控制单元320的输入端，接入第二电平信号VGL；第二晶体管M2的第二极作为时钟控制单元320的输出端，与第四节点N4电连接。本实施例设置时钟控制单元320仅包括一个晶体管，使电路结构简单，易于实现。
继续参见图4，在上述各实施方式的基础上，可选地，中间控制单元330包括：第三晶体管M3。第三晶体管M3的控制极作为中间控制单元330的控制端，与第四节点N4电连接；第三晶体管M3的第一极作为中间控制单元330的输入端，与第三节点N3电连接；第三晶体管M3的第二极作为中间控制单元330的输出端，与第一节点N1电连接。本实施例设置中间控制单元330仅包括一个晶体管，使电路结构简单，易于实现。
继续参见图4，在上述各实施方式的基础上，可选地，第一存储单元340包括：第一电容C1。第一电容C1的第一端作为第一存储单元340的第一端，接入第一电平信号VGH；第一电容C1的第二端作为第一存储单元340的第二端，与第四节点N4电连接。本实施例中，第一电容C1作为稳压电容，可以稳定第三晶体管M3的栅极电位(即第四节点N4的电位)，减小第三晶体管M3的栅绝缘层被击穿的风险。
继续参见图4，在上述各实施方式的基础上，可选地，输入模块10包括：第六晶体管M6；第六晶体管M6的控制极接入输入信号SIN，第一极接入第二电平信号VGL，第二极与第二节点N2电连接。本实施例设置输入模块10仅包括一个晶体管，使电路结构简单，易于实现。
继续参见图4，在上述各实施方式的基础上，可选地，第一控制模块20包括：第七晶体管M7。第七晶体管M7的控制极接入第二时钟信号SCK2，第一极接入第二电平信号VGL，第二极与第三节点N3电连接。本实施例设置第一控制模块20仅包括一个晶体管，使电路结构简单，易于实现。
继续参见图4，在上述各实施方式的基础上，可选地，节点互控模块40包括：第八晶体管M8和第九晶体管M9。第八晶体管M8的控制极接入输入信号SIN，第一极接入第一电平信号VGH，第二极与第一节点N1电连接；第九晶体管M9的控制极与第一节点N1电连接，第二极接入第一电平信号VGH，第二极与第二节点N2电连接。本实施例设置节点互控模块40仅包括两个晶体管，使电路结构简单，易于实现。
继续参见图4，在上述各实施方式的基础上，可选地，输出模块50包括：第十晶体管M10、第十一晶体管M11、第二电容C2和第三电容C3。第十晶体管M10的控制极分别与第一节点N1和第二电容C2的第二端电连接；第十晶体管M10的第一极与第二电容C2的第一端电连接，并接入第一电平信号VGH；第十晶体管M10的第二极与第十一晶体管M11的第二极电连接，并作为扫描电路100的输出端；第十一晶体管M11的控制极分别与第二节点N2和第三电容C3的第二端电连接；第十一晶体管M11的第一极接入第一时钟信号SCK1，第十一晶体管M11的第二极与第三电容C3的第一端电连接。
本实施例中，第二电容C2用于维持第一节点N1的电位；第三电容C3用于维持第二节点N2的电位。第十一晶体管M11与第三电容C3构成下拉电路，使得在第二子阶段第十一晶体管M11的栅极可以达到超低电位，避免输出的扫描信号SOUT受第十一晶体管M11阈值电压的影响。
图5是本发明实施例提供的又一种扫描电路的结构示意图。参见图5，在上述各实施方式的基础上，可选地，扫描电路100还包括：第一保护模块60。第一保护模块60的控制端接入第二电平信号VGL，第一端与第二节点N2电连接，第二端与输出模块50电连接。定义输出模块50的第二控制端(即第十一晶体管M11的控制极)为第五节点N5，那么，本发明实施例在第二节点N2和第五节点N5之间增设第一保护模块60，可以抑制第五节点N5由于第三电容C3的自举效应带来的电位大幅度变化向第二节点N2传输，降低第六晶体管M6和第九晶体管M9的栅绝缘层被击穿的概率，改善扫描电路100的稳定性。
在上述各实施方式的基础上，可选地，第一保护模块60包括：第四晶体管M4。第四晶体管M4的控制极作为第一保护模块60的控制端，接入第二电平信号VGL；第四晶体管M4的第一极作为第一保护模块60的第一端，与第二节点N2电连接；第四晶体管M4的第二极作为第一保护模块60的第二端，与第五节点N5电连接。
其中，第四晶体管M4的保护原理为：第四晶体管M4在第二电平信号VGL的控制下导通，当第五节点N5的电位因第三电容C3的自举效应而大幅降低时，第四晶体管M4的源极(即第二节点N2)的电位会被逐渐拉低；但由于晶体管自身特性，当第四晶体管M4的栅源电压差到达阈值电压时，第四晶体管M4截止，其上不再有电流流动，可以防止第二节点N2被拉至过低电位，从而实现对第六晶体管M6和第九晶体管M9的保护。
继续参见图5，在上述各实施方式的基础上，可选地，扫描电路100还包括：第二保护模块70。第二保护模块70的控制端接入第二电平信号VGL，第一端与第一控制模块20电连接，第二端与第三节点N3电连接。本发明实施例在第一控制模块20和第三节点N3之间增设第二保护模块70，可以抑制由第一控制模块20带来的过大的电压应力向第三节点N3传输。
在上述各实施方式的基础上，可选地，第二保护模块70包括：第五晶体管M5。第五晶体管M5的控制极作为第二保护模块70的控制端，接入第二电平信号VGL；第五晶体管M5的第一极作为第二保护模块70的第一端，与第七晶体管M7的第二极电连接；第五晶体管M5的第二极作为第二保护模块70的第二端，与第三节点N3电连接。第五晶体管M5的具体作用与第四晶体管M4类似，此处不再赘述。
综上所述，本发明实施例提供了11T3C结构的扫描电路100，可实现输入信号SIN的移位输出。示例性地，各个晶体管均可以是采用低温多晶硅技术(Low Temperature Poly-silicon，LTPS)制备的P型晶体管。下面结合图5的具体电路和图2的时序图，以各晶体管均为P型晶体管为例，对扫描电路100的驱动过程进行说明。示例性地，扫描电路100的驱动过程包括：
在第一子阶段T11，第二时钟信号SCK2和输入信号SIN均为低电平，第一时钟信号SCK1为高电平。第二晶体管M2断开，第一晶体管M1、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和第八晶体管M8均导通。第二电平信号VGL经过第六晶体管M6和第四晶体管M4传输至第五节点N5；第二电平信号VGL经过第五晶体管M5和第七晶体管M7传输至第三节点N3；第一电平信号VGH经过第一晶体管M1传输至第四节点N4，控制第三晶体管M3断开；第一电平信号VGH经过第八晶体管M8传输至第一节点N1，控制第九晶体管M10和第十晶体管M10断开；第五节点N5的低电平控制第十一晶体管M11导通，第一时钟信号SCK1的高电平经过第十一晶体管M11输出。示例性地，第一时钟信号CK1在高电平时的电压值可以等于第一电平信号VGH的电压值。
在第二子阶段T12，第一时钟信号SCK1为低电平，第二时钟信号SCK2和输入信号SIN均为高电平。第一晶体管M1、第六晶体管M6、第七晶体管M7和第八晶体管M8均断开，第二晶体管M2、第四晶体管M4和第五晶体管M5均导通。由于第二电容C2的存储作用，第一节点N1维持上一子阶段的高电平，第九晶体管M9和第十晶体管M10保持断开。第一时钟信号SCK1由高电平跳变至低电平，由于第三电容C3的自举效应，第五节点N5的电位被拉低至一超低电位，第十一晶体管M11保持导通，第一时钟信号SCK1的低电平经过第十一晶体管M11输出。示例性地，第一时钟信号CK1在低电平时的电压值可以等于第二电平信号VGL的电压值。此时，第二电平信号VGL经过第二晶体管M2传输至第四节点N4，控制第三晶体管M3开启，为下一子阶段第二电平信号VGL写入第一节点N1做准备。
在第三子阶段T21，第二时钟信号SCK2为低电平，第一时钟信号SCK1和输入信号SIN均为高电平。第一晶体管M1、第二晶体管M2、第六晶体管M6和第八晶体管M8均断开，第四晶体管M4、第五晶体管M5和第七晶体管M7均导通。由于第一电容C1的存储作用，第四节点N4维持上一子阶段的低电平，控制第三晶体管M3导通；第二电平信号VGL经过第七晶体管M7、第五晶体管M5和第三晶体管M3传输至第一节点N1，控制第九晶体管M9和第十晶体管M10导通；第一电平信号VGH经过第九晶体管M9和第四晶体管M4传输至第五节点N5，控制第十一晶体管M11断开；第一电平信号VGH经过第十晶体管M10输出。
在第四子阶段T22，第一时钟信号SCK1为低电平，第二时钟信号SCK2和输入信号SIN均为高电平。第一晶体管M1、第六晶体管M6、第七晶体管M7和第八晶体管M8均断开，第二晶体管M2、第四晶体管M4和第五晶体管M5均导通。由于第二电容C2的存储作用，第一节点N1维持上一子阶段的低电平，第九晶体管M9和第十晶体管M10保持导通。第一电平信号VGH经过第九晶体管M9和第四晶体管M4传输至第五节点N5，控制第十一晶体管M11断开；第一电平信号VGH经过第十晶体管M10输出。同时，第二电平信号VGL经过第二晶体管M2传输至第四节点N4，控制第三晶体管M3开启，为下一子阶段的信号传输做准备。
后续阶段重复第三子阶段T21和第四子阶段T22，直至输入信号SIN再次变为低电平后，重新执行第一子阶段T11的过程。
发明人对图5所示结构的扫描电路100的驱动过程进行了仿真验证。图6是本发明实施例提供的一种扫描电路的仿真波形图。参见图6，可以明显看出，扫描信号SOUT的波形相较于输入信号SIN的波形向右平移，且波形效果好。即，该扫描电路100实现了输入信号SIN的移位输出，输出信号的稳定性和可靠性较好。
需要说明的是，如图5所示扫描电路100，第一保护模块60、第二保护模块70和第一存储单元340共同作为扫描电路100的保护结构，可以减小第二节点N2、第三节点N3和第四节点N4的电压变化，防止与上述三个节点连接的晶体管受到较大电压应力而造成晶体管栅绝缘层的击穿，整体上提高扫描电路100的抗毁性，从而提高扫描电路100的可靠性。
发明人对图5所示结构的扫描电路100设置保护结构(即第四晶体管M4、第五晶体管M5和第一电容C1)与不设置保护结构的驱动过程分别进行了仿真验证。图7是本发明实施例提供的扫描电路中设置保护结构与不设置保护结构时的仿真波形对比示意图。参见图7，电压V21表示有保护结构时第二节点的电位，电压V22表示无保护结构时第二节点的电位；电压V31表示有保护结构时第三节点的电位，电压V32表示无保护结构时第三节点的电位；电压V41表示有保护结构时第四节点的电位，电压V42表示无保护结构时第四节点的电位。无保护结构时，第二节点的电位V22最低为-18V，最高为7V；第三节点的电位V32最低为-12V，最高为7.5V；第四节点的电位V42最低为-14.5V，最高为7V。而有保护结构时，第二节点的电位V21最低为-6V，最高为7V；第三节点的电位V31最低为-6V，最高为7V；第四节点的电位V41最低为-7V，最高为7V。可以看出，设置保护结构使得第二节点、第三节点和第四节点的最低电位的绝对值明显减小，即，保护结构有效限制了三个节点的最低电位，避免了节点电位过低对晶体管的影响；且三个节点电位的峰峰值明显下降，即，保护结构有效限制了节点电位的变化范围，避免了节点电位剧变对晶体管的影响。
综上，该扫描电路不仅输出信号稳定，而且其内部晶体管承受的电压差较小，从而进一步提升了本发明实施例运行的可靠性。
上述各实施方式示例性地给出了第八晶体管M8的栅极接入输入信号SIN，但不作为对本发明的限定。图8是本发明实施例提供的又一种扫描电路的结构示意图，参见图8，在一种实施方式中，可选地，第八晶体管M8的栅极与第二节点N2电连接。那么，图8所示扫描电路100与图5中扫描电路100的驱动过程不同的是，在第二子阶段，第二节点N2的低电平控制第八晶体管M8导通，使第一电平信号VGH经过第八晶体管M8传输至第一节点N1。这样，可以确保第一节点N1在第二子阶段中为高电平，保证M10可靠断开，进一步提高电路可靠性。
需要说明的是，在上述各实施例中，以各晶体管均为P型晶体管为例进行说明，并非对本发明的限定。在其他实施例中，还可以设置各晶体管均为N型晶体管，或者部分晶体管为P型晶体管，另外部分晶体管为N型晶体管。其中，当各晶体管均为N型晶体管时，相应地，还需要将第一电平信号和第二电平信号的电压互换。
本发明实施例还提供了一种显示面板，包括级联连接的多级如本发明任意实施例所提供的扫描电路，具有相应的有益效果。图9是本发明实施例提供的一种显示面板的结构示意图。参见图9，示例性地，显示面板1可以是有源矩阵有机发光二极体面板(ActiveMatrix Organic Light Emitting Diode，AMOLED)、液晶显示面板(Liquid CrystalDisplay，LCD)或微发光二极管显示面板(Micro LED)等类型的显示面板。扫描电路100可以采用双端驱动的结构，每级扫描电路100连接一行像素电路200。像素电路200例如可以是7T1C结构的像素电路，可以补偿驱动晶体管的阈值电压差异造成的显示不均，保证显示效果。
继续参见图9，在上述各实施方式的基础上，可选地，显示面板1还包括：第一电平信号线71、第二电平信号线72、输入信号线73、第一时钟信号线74和第二时钟信号线75。每级扫描电路100均与第一电平信号线71和第二电平信号线72电连接。第1级扫描电路100与输入信号线73电连接；每级扫描电路100的输出的扫描信号作为下一级扫描电路100的输入信号。每级扫描电路100与第一时钟信号线74和第二时钟信号线75交替连接；即，第一时钟信号线74传输的信号作为第2n-1级扫描电路100的第一时钟信号，第二时钟信号线75传输的信号作为第2n-1级扫描电路100的第二时钟信号；并且，第一时钟信号线74传输的信号作为第2n级扫描电路100的第二时钟信号，第二时钟信号线75传输的信号作为第2n级扫描电路100的第一时钟信号；其中，n为正整数。这样设置，使得显示面板1中，一级扫描电路100驱动一行像素电路200，以保证屏幕点亮时扫描信号的逐行写入。
本发明实施例还提供了一种扫描电路的驱动方法，可用于驱动本发明任意实施例提供的扫描电路，具有相应的有益效果。图10是本发明实施例提供的一种扫描电路的驱动方法的流程示意图。参见图10，该驱动方法包括：
S110、第一时钟信号输出阶段，输入模块响应输入信号的控制将第二电平信号传输至第二节点；第二控制模块响应输入信号和第一时钟信号，控制第一节点与第三节点之间的导通状态不同于第一控制模块；节点互控模块响应输入信号或第二节点的控制，将第一电平信号传输至第一节点；输出模块响应第二节点的控制将第一时钟信号输出。
其中，该阶段具体包括第一子阶段和第二子阶段。第一子阶段中，第一时钟信号为高电平；第二子阶段中，第一时钟信号为低电平。因此，第一子阶段中，扫描电路输出的扫描信号为高电平；第二子阶段中，扫描信号为低电平。
S120、第一电平信号输出阶段，第一控制模块响应第二时钟信号的控制将第二电平信号传输至第三节点；第二控制模块控制第一节点与第三节点之间导通，将第二电平信号传输至第一节点；节点互控模块响应第一节点的控制将第一电平信号传输至第二节点；输出模块响应第一节点的控制将第一电平信号输出。
其中，该阶段具体包括交替进行的第三子阶段和第四子阶段。由于第一电平信号始终保持高电平，那么，第三子阶段和第四子阶段中，扫描电路输出的扫描信号也均为高电平。
本发明实施例提供的扫描电路的驱动方法中，在第一时钟信号输出阶段，通过第二控制模块控制第一节点与第三节点之间的导通状态不同于第一控制模块的导通状态，始终切断第二电平信号向第一节点传输的路径，使第一节点在节点互控模块的作用下，保持与第二节点不同的电平，以保证输出模块准确输出。在第一电平信号输出阶段，通过第二控制模块控制第一节点与第三节点之间的导通，使第二电平信号可靠传输至第一节点，以保证输出模块准确输出。因此，本发明实施例可以有效提高扫描电路的稳定性，从而提升显示效果。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种扫描电路，其特征在于，包括：
输出模块，用于响应第一节点的控制将第一电平信号输出，或者响应第二节点的控制将第一时钟信号输出；
节点互控模块，用于在所述第一电平信号输出阶段，响应所述第一节点的控制将所述第一电平信号传输至所述第二节点；以及在所述第一时钟信号输出阶段，响应输入信号或所述第二节点的控制，将所述第一电平信号传输至所述第一节点；
输入模块，用于在所述第一时钟信号输出阶段，响应所述输入信号的控制将第二电平信号传输至所述第二节点，以控制所述第一时钟信号输出；
第一控制模块，用于在所述第一电平信号输出阶段，响应第二时钟信号的控制将所述第二电平信号传输至第三节点；
第二控制模块，用于在所述第一时钟信号输出阶段，响应所述输入信号和所述第一时钟信号，控制所述第一节点与所述第三节点之间的导通状态不同于所述第一控制模块；以及在所述第一电平信号输出阶段，控制所述第一节点与所述第三节点之间导通，将所述第二电平信号传输至所述第一节点。
2.根据权利要求1所述的扫描电路，其特征在于，所述第二控制模块包括：
输入控制单元，所述输入控制单元的控制端接入所述输入信号，所述输入控制单元的输入端接入所述第一电平信号，所述输入控制单元的输出端与第四节点电连接；
时钟控制单元，所述时钟控制单元的控制端接入所述第一时钟信号，所述时钟控制单元的输入端接入所述第二电平信号，所述时钟控制单元的输出端与所述第四节点电连接；
中间控制单元，所述中间控制单元的控制端与所述第四节点电连接，所述中间控制单元的输入端与所述第三节点电连接，所述中间控制单元的输出端与所述第一节点电连接；
第一存储单元，所述第一存储单元的第一端接入所述第一电平信号，所述第一存储单元的第二端与所述第四节点电连接。
3.根据权利要求2所述的扫描电路，其特征在于，所述输入控制单元包括：第一晶体管；所述第一晶体管的控制极作为所述输入控制单元的控制端，所述第一晶体管的第一极作为所述输入控制单元的输入端，所述第一晶体管的第二极作为所述输入控制单元的输出端。
4.根据权利要求2所述的扫描电路，其特征在于，所述时钟控制单元包括：第二晶体管；所述第二晶体管的控制极作为所述时钟控制单元的控制端，所述第二晶体管的第一极作为所述时钟控制单元的输入端，所述第二晶体管的第二极作为所述时钟控制单元的输出端。
5.根据权利要求2所述的扫描电路，其特征在于，所述中间控制单元包括：第三晶体管；所述第三晶体管的控制极作为所述中间控制单元的控制端，所述第三晶体管的第一极作为所述中间控制单元的输入端，所述第三晶体管的第二极作为所述中间控制单元的输出端。
6.根据权利要求2所述的扫描电路，其特征在于，所述第一存储单元包括：第一电容；所述第一电容的第一端作为所述第一存储单元的第一端，所述第一电容的第二端作为所述第一存储单元的第二端。
7.根据权利要求1所述的扫描电路，其特征在于，还包括：第一保护模块；所述第一保护模块的控制端接入所述第二电平信号，所述第一保护模块的第一端与所述第二节点电连接，所述第一保护模块的第二端与所述输出模块电连接；
优选地，所述第一保护模块包括：第四晶体管；所述第四晶体管的控制极作为所述第一保护模块的控制端，所述第四晶体管的第一极作为所述第一保护模块的第一端，所述第四晶体管的第二极作为所述第一保护模块的第二端。
8.根据权利要求1所述的扫描电路，其特征在于，还包括：第二保护模块；所述第二保护模块的控制端接入所述第二电平信号，所述第二保护模块的第一端与所述第一控制模块电连接，所述第二保护模块的第二端与所述第三节点电连接；
优选地，所述第二保护模块包括：第五晶体管；所述第五晶体管的控制极作为所述第二保护模块的控制端，所述第五晶体管的第一极作为所述第二保护模块的第一端，所述第五晶体管的第二极作为所述第二保护模块的第二端。
9.一种显示面板，其特征在于，包括：级联连接的多级如权利要求1-8中任一项所述的扫描电路。
10.一种扫描电路的驱动方法，其特征在于，所述扫描电路包括：输入模块、第一控制模块、第二控制模块、节点互控模块和输出模块；
所述扫描电路的驱动方法包括：
第一时钟信号输出阶段，所述输入模块响应输入信号的控制将第二电平信号传输至第二节点；所述第二控制模块响应所述输入信号和第一时钟信号，控制第一节点与第三节点之间的导通状态不同于所述第一控制模块；所述节点互控模块响应所述输入信号或所述第二节点的控制，将第一电平信号传输至所述第一节点；所述输出模块响应所述第二节点的控制将所述第一时钟信号输出；
第一电平信号输出阶段，所述第一控制模块响应第二时钟信号的控制将所述第二电平信号传输至所述第三节点；所述第二控制模块控制所述第一节点与所述第三节点之间导通，将所述第二电平信号传输至所述第一节点；所述节点互控模块响应所述第一节点的控制将所述第一电平信号传输至所述第二节点；所述输出模块响应所述第一节点的控制将所述第一电平信号输出。
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