CN112735340A - 一种数据电流产生电路、驱动方法、驱动芯片和显示面板 - Google Patents
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Abstract
本发明公开了一种数据电流产生电路、驱动方法、驱动芯片和显示面板,其中,数据电流产生电路的阈值抓取模块连接于第一晶体管的栅极和第二极之间,用于抓取第一晶体管的阈值电压;数据电压产生模块用于产生数据电压;数据电压传输模块连接于数据电压产生模块和阈值电压获取和叠加模块之间,用于在导通时将数据电压产生模块产生的数据电压传输至阈值电压获取和叠加模块;阈值电压获取和叠加模块,用于获取第一晶体管的阈值电压,并将数据电压传输模块传输的数据电压与阈值电压叠加之后传输至第一晶体管的栅极;第一晶体管的第二极作为数据电流产生电路的输出端。本发明提供的技术方案,可提高显示面板的均一性。
Description
技术领域
本发明涉及显示技术领域,尤其涉及一种数据电流产生电路、驱动方法、驱动芯片和显示面板。
背景技术
电流型像素驱动电路包括为像素电路提供数据电流的像素驱动电流产生电路。像素驱动电流产生电路可以将数据电压转换为数据电流,为像素电路提供数据电流。
在像素驱动电流产生电路将数据电压转换为数据电流的过程中,由于产生数据电流的晶体管具有阈值电压,使得转换后的数据电流相对于数据电压会有一定的偏差,造成显示面板的均一性比较差。
发明内容
本发明实施例提供了一种数据电流产生电路、驱动方法、驱动芯片和显示面板,以提高显示面板的均一性。
第一方面,本发明实施例提供了一种数据电流产生电路,包括:阈值抓取模块、数据电压产生模块、数据电压传输模块、阈值电压获取和叠加模块,以及第一晶体管;
所述阈值抓取模块连接于所述第一晶体管的栅极和第二极之间,用于抓取所述第一晶体管的阈值电压;
所述数据电压产生模块用于产生数据电压;
所述数据电压传输模块连接于所述数据电压产生模块和所述阈值电压获取和叠加模块之间,用于在导通时将所述数据电压产生模块产生的数据电压传输至所述阈值电压获取和叠加模块;
所述阈值电压获取和叠加模块,连接所述第一晶体管的栅极和所述第一晶体管的第一极,用于获取所述第一晶体管的阈值电压,并将所述数据电压传输模块传输的数据电压与所述阈值电压叠加之后传输至所述第一晶体管的栅极;
所述第一晶体管的第二极作为所述数据电流产生电路的输出端,用于根据所述第一晶体管的栅极的电压输出数据电流。
第二方面,本发明实施例提供了一种数据电流驱动芯片,所述数据电流驱动芯片包括本发明任意实施例提供的数据电流产生电路。
第三方面,本发明实施例还提供了一种显示面板,包括显示区和非显示区;所述显示区设置有多个像素电路,所述非显示区设置有本发明任意实施例提供的数据电流产生电路;
所述像素电路通过数据线和开关模块与所述数据电流产生电路电连接;所述数据电流产生电路通过所述数据线和所述开关模块为所述像素电路提供数据电流。
第四方面,本发明实施例还提供了一种数据电流产生电路的驱动方法,用于驱动本发明任意实施例提供的数据电流产生电路,包括:
在初始化阶段,控制所述数据电流产生电路的数据电压产生模块输出数据电压至数据电压传输控制模块,同时控制补偿控制模块将数据电流产生电路的第一晶体管的阈值电压关联至所述第一晶体管的栅极;
在编程阶段,控制所述数据电压传输控制模块输出所述数据电压至所述第一晶体管的栅极;所述第一晶体管根据所述栅极的电压输出数据电流。
本发明中,数据电流产生电路包括阈值抓取模块、数据电压产生模块、数据电压传输模块、阈值电压获取和叠加模块,以及第一晶体管,在数据电流产生电路工作的过程中,阈值抓取模块连于第一晶体管的栅极和第二极之间,以抓取第一晶体管的阈值电压,数据电压产生模块可产生数据电压,并通过数据电压传输控制模块将数据电压传输至阈值电压获取和叠加模块,阈值电压获取和叠加模块能够将第一晶体管的阈值电压和数据电压叠加后输出至第一晶体管的栅极,第一晶体管的第二极作为数据电流产生电路的输出端,并根据栅极的电压输出数据电流。本实施例中,用于输出数据电流的第一晶体管的栅极电压与第一晶体管的阈值电压相关,当第一晶体管输出数据电流时,该栅极电压能够补偿第一晶体管的阈值电压对数据电流的影响,从而可以提高数据电压与数据电流的匹配程度,进而提高了显示面板的均一性。
附图说明
图1是现有技术中的一种数据电流产生电路为像素电路提供数据电流的结构示意图。;
图2是本发明实施例提供的一种数据电流产生电路的结构示意图;
图3是本发明实施例提供的另一种数据电流产生电路的结构示意图;
图4是本发明实施例提供的一种驱动时序图;
图5是发明实施例提供的一种使用电流产生电路驱动像素电路工作的示意图。
图6是本发明实施例提供的一种显示面板的结构示意图
图7是本发明实施例提供的另一种显示面板的结构示意图
图8是本发明实施例提供的另一种驱动时序图;、
图9是本发明实施例提供的一种数据电流产生电路的驱动方法的流程示意图
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是,此处所描述的具体实施例仅仅用于解释本发明,而非对本发明的限定。另外还需要说明的是,为了便于描述,附图中仅示出了与本发明相关的部分而非全部结构。
图1是现有技术中的一种数据电流产生电路为像素电路提供数据电流的结构示意图。如图1所示,数据电流产生电路1’包括源极驱动运算放大器(Source OperationalAmplifier,SOP)、第一N型晶体管N1和第二N型晶体管N4。数据电流产生电路1’通过数据线D’与像素电路2’连接。在数据线D’上,还包括用于开关作用的第三N型晶体管N2,以及用于复位的第四N型晶体管N3。参考图1,在驱动像素电路工作的过程中,SOP的输入端输入数模转换器(Digital to Analog Converter,DAC)输出的第一电平和第二电平。DAC的输入端输入gamma电压。当gamma电压包括65个电压值时,第一电平和第二电平为DAC根据数据DATA<7:0>中的DATA<7:2>选择的gamma电压GAMMA<65:1>中相邻的两个gamma电压。其中,DATA<7:0>为8bit的数字信号,DATA<7:2>为DATA<7:0>中的高6bit。SOP根据数据DATA<1:0>将第一电平和第二电平电压内插出灰阶对应的数据电压V_DATA,并输出至第二N型晶体管N4。其中,DATA<1:0>为DATA<7:0>中的低2bit。SOP可以是多位的内插电路,也可以是单位增益的buffer电路,本实施对此不进行限定。
数据电流产生电路1’的具体工作过程如下:在驱动像素电路2’工作的复位阶段Reset,复位控制信号输入端SA’输入的复位控制信号为高电平,开关控制输入端SB’输入的开关控制信号为低电平,SOP输出的数据电压V_DATA通过第二N型晶体管N4输入第一N型晶体管N1的栅极和电容C’,并通过电容C’保持,同时复位信号VREF_RST通过第四N型晶体管N3写如像素电路2’;在驱动像素电路2’工作的数据写入阶段Program,复位控制信号输入端SA’输入的复位控制信号为低电平,开关控制输入端SB’输入的开关控制信号为高电平,第一N型晶体管N1根据栅极的数据电压V_DATA输出数据电流,通过第三N型晶体管N2输入至像素电路2’;在驱动像素电路2’工作的发光阶段t3,复位控制信号输入端SA’输入的复位控制信号为高电平,开关控制输入端SB’输入的开关控制信号为低电平,像素电路2’输出数据电流驱动发光器件OLED发光。同时第二N型晶体管N4和第四N型晶体管N3导通,为下一帧输出数据电压V_DATA做准备。由上述驱动像素电路2’的工作过程可知,第一N型晶体管N1将数据电压V_DATA转换成数据电流为像素电路2’提供数据电流I_DATA。第一N型晶体管N1产生的数据电流I_DATA与第一N型晶体管N1阈值电压相关。由于工艺等原因,不同的第一N型晶体管N1的阈值电压会有所偏差,使得在相同的数据电压V_DATA下,不同第一N型晶体管N1转换后的数据电流具有一定的偏差,从而导致不同的数据电流产生电路1’输出的数据电流I_DATA不同,造成发光器件D0’的发光亮度不同,使得显示面板的均一性比较差。
为解决上述问题,本发明实施例提供了一种数据电流产生电路,如图2所示,图2是本发明实施例提供的一种数据电流产生电路的结构示意图,数据电流产生电路包括:阈值抓取模块14、数据电压产生模块11、数据电压传输模块12、阈值电压获取和叠加模块13,以及第一晶体管T1;
阈值抓取模块14连接于第一晶体管T1的栅极和第二极VND之间,用于抓取第一晶体管T1的阈值电压;
数据电压产生模块11用于产生数据电压;
数据电压传输模块12连接于数据电压产生模块11和阈值电压获取和叠加模块13之间,用于在导通时将数据电压产生模块11产生的数据电压传输至阈值电压获取和叠加模块13;
阈值电压获取和叠加模块13,连接第一晶体管T1的栅极VNG和第一晶体管T1的第一极VNS,用于获取第一晶体管T1的阈值电压,并将数据电压传输模块12传输的数据电压与阈值电压叠加之后传输至第一晶体管T1的栅极;
第一晶体管T1的第二极作为数据电流产生电路的输出端OUT,用于根据第一晶体管T1的栅极的电压输出数据电流。
本发明实施例中,数据电流产生电路包括阈值抓取模块、数据电压产生模块、数据电压传输模块、阈值电压获取和叠加模块,以及第一晶体管,在数据电流产生电路工作的过程中,阈值抓取模块连于第一晶体管的栅极和第二极之间,以抓取第一晶体管的阈值电压,数据电压产生模块可产生数据电压,并通过数据电压传输控制模块将数据电压传输至阈值电压获取和叠加模块,阈值电压获取和叠加模块能够将第一晶体管的阈值电压和数据电压叠加后输出至第一晶体管的栅极,第一晶体管的第二极作为数据电流产生电路的输出端,并根据栅极的电压输出数据电流。本实施例中,由于阈值电压获取和叠加模块将第一晶体管的阈值电压和数据电压叠加后输出至第一晶体管的栅极,能够对第一晶体管的阈值电压进行补偿,第一晶体管输出数据电流时与第一晶体管的阈值电压无关,进而提高了显示面板的均一性。而且阈值电压获取和叠加模块还能够存储第一晶体管的阈值电压,在行扫描期间将对应的数据电压和阈值电压叠加后提供给第一晶体管的栅极。在一帧的时间内,不需要每行都进行阈值抓取,一帧内阈值补偿的时间,相对于现有技术中在一帧内每行都进行阈值抓取,本发明实施例提供的技术方案可以节省阈值抓取和补偿的时间,降低一行扫描所需时间。
图3是本发明实施例提供的另一种数据电流产生电路的电路图。参考图3,可选的,数据电压传输模块12可以包括:第二晶体管T2;第二晶体管T2的栅极与第一控制信号输入端S2电连接,第二晶体管T2的第一极与数据电压产生模块11电连接,第二晶体管T2的第二极与阈值电压获取和叠加模块13电连接。
阈值电压获取和叠加模块13可以包括第三晶体管T3、第四晶体管T4、第一电容C1和运算放大器SOP;第一电容C1的第一极连接数据电压传输模块12,第一电容C1的第二极连接运算放大器SOP的第一输入端,运算放大器SOP的第二输入端连接其输出端;第三晶体管T3的第一极连接运算放大器SOP的第一输入端,第三晶体管T3的第二极连接运算放大器SOP的输出端,第三晶体管T3的栅极与第二控制信号输入端XS2电连接;第四晶体管T4的第一极连接第一电容C1的第一极,第四晶体管T4的第二极连接第一晶体管T1的第一极并接入参考电压VINT1,第四晶体管T4的栅极与第二控制信号输入端XS2电连接。
可选的,阈值抓取模块14可以包括第五晶体管T5和第六晶体管T6;第五晶体管T5的第二极连接第一电平输入端VDD,第五晶体管T5的第一极连接第一晶体管T1的栅极,第五晶体管T5的栅极连接第三控制信号输入端S0;第六晶体管T6的第一极连接第一晶体管T1的栅极,第六晶体管T6的第二极连接第一晶体管T1的第二极,第六晶体管T6的栅极连接第四控制信号输入端S1。在本实施例中,只需向第一晶体管T1的第一极VNS提供一固定电压即可,输入至第一晶体管T1的第一极VNS的参考电压VINT1可以是预设的固定电压,只要该电压能够保证第一晶体管T1工作于饱和状态,提供数据电流即可。可选的,第一晶体管T1的第一极VNS可以接地。
图4是本发明实施例提供的一种驱动时序图,可应用于应图3所示的数据电流产生电路。下面结合图3和图4,以第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5为N型晶体管为例,说明本发明实施例提供的数据电流产生电路的工作原理。其中,第一控制信号输入端S2和第二控制信号输入端XS2的电压互为反向电压,换句话说,第一控制信号输入端S2的电压为高电平,则第二控制信号输入端XS2的电压为低电平;第一控制信号输入端S2的电压为低电平,则第二控制信号输入端XS2的电压为高电平。需要说明的是高电平和低电平是相对而言的,例如对于第二晶体管T2,只要栅极的信号能够控制其导通即为高电平,控制其关断即为低电平。数据电流产生电路的工作包括阈值抓取阶段,在阈值抓取阶段,第一控制信号输入端S2的电压为低电平,第二晶体管关断;第二控制信号输入端XS2的电压为高电平,第三晶体管和第四晶体管导通。为方便表示,以VDD表示第一电压输入端VDD的电压,为高电平电压,GND表示接地端的电压,为零。阈值抓取阶段包括第一阶段和第二阶段。
在第一阶段,第三控制信号输入端S0的电压为高电平,第四控制信号输入端S1的电压为低电平,第五晶体管T5导通,第六晶体管T6关断。则第一晶体管T1的栅极电压为VDD,第一电容C1的第二极VIP的电压为VDD,第一晶体管第二极VND的电压等于GND。
在第二阶段,第三控制信号输入端S0的电压为低电平,第五晶体管T5关断,第四控制信号输入端S1的电压为高电平,第六晶体管T6导通。由于没有电流通路,第一晶体管T1的栅极VNG和第一电容C1的第二极VIP的电压逐渐降低,最终第一晶体管T1的栅极电压和源极(第一极)电压差等于第一晶体管的阈值电压VTHN。由于源极接地,源极电压为零,则第一晶体管T1的栅极电压等于其阈值电压VTHN,也即第一电容C1两端的电压差为VTHN,如此将第一晶体管T1的阈值电压VTHN的大小保存在第一电容C1两端。
当需电流产生电路输出相应的数据电流时,控制第一控制信号输入端S2的电压为高电平,第二晶体管T2导通,数据电压产生电路11产生的数据电压VDATA传输至第一电容C1的第一极VCB。第一电容C1第一极VCB和第二极VIP两端电压在前一态分别是VCB=GND,VIP=VTHN。当第二晶体管T2导通后,第一电容C1第一极VCB的电压变为数据电压VDATA,则第一电容C1第二极VIP的电压变为VTHN+VDATA。经过运算放大器SOP,第一晶体管T1栅极的电压VNG等于第一电容C1第二极VIP的电压,等于VTHN+VDATA。则流过第一晶体管T1的电流
可以看出在数据电压(灰阶电压)VDATA相同的情况下,数据电流产生电路产生的电流只和第一晶体管T1的迁移率、氧化层厚度、宽长比有关,第一晶体管T1的这些因素都不随工艺剧烈变化。可以降低工艺造成对不同第一晶体管T1产生电流的影响,提高显示均一性。并且第一晶体管T1的阈值电压VTHN被存在第一电容C1两端,随着数据电压VDATA的变化不会变化,因此在改变VDATA后,不需要再进行阈值电压的抓取。本发明实施例提供的技术方案可以节省阈值抓取和补偿的时间,降低一行扫描所需时间。
图5是发明实施例提供的一种使用电流产生电路驱动像素电路工作的示意图。本发明实施例提供的数据电流产生电路1可以驱动任意的像素电路2工作,只要在该像素电路2编程阶段,将数据电流产生电路1产生的数据电流输入至像素电路即可,配合该像素电路的工作时序驱动像素电路发光显示。
本发明实施例还提供一种数据电流驱动芯片,包括本发明任意实施例提供的数据电流产生电路。因此具有本发明任意实施例提供的数据电流产生电路的全部技术特征,从而具有本发明任意实施例提供的数据电流产生电路的有益效果,此处不再赘述。
本发明实施例还提供一种显示面板。图6是本发明实施例提供的一种显示面板的结构示意图,包括显示区AA和非显示区NA;显示区AA设置有多个像素电路2,非显示区NA设置有本发明任意实施例提供的数据电流产生电路1;
像素电路2通过数据线和开关模块221与数据电流产生电路1电连接;数据电流产生电路1通过数据线和开关模块221为像素电路2提供数据电流。
具体地,显示区AA还包括位于非显示区NA的栅极驱动电路,栅极驱动电路通过扫描线(WS1、WS2、WS3、WS4等)为像素电路2提供扫描信号,数据电流产生电路可以集成与芯片中,通过与芯片连接的数据线(D1、D2、D3、D4等)为像素电路2提供数据电流。像素电路2在扫描信号的作用下,连通与之对应的数据线(D1、D2、D3、D4等)。在开关模块导通时,图中开关模块包括第八晶体管T8,数据线(D1、D2、D3、D4等)通过从电流产生电路1获取数据电流,并传输至像素电路2,像素电路依此实现发光,进而实现显示面板的显示。
如图6所示,本发明实施例提供的电显示面板包括本发明任意实施例的数据电流产生电路1。显示面板可以为如图6中所示的手机的显示面板,也可以为电脑、电视机、智能穿戴设备等电子设备的显示面板,本实施例对此不作特殊限定。
可选的,显示面板还可以包括第七晶体管T7;开关模块221包括第八晶体管T8;第七晶体管T7的栅极与复位控制信号输入端SA电连接,第七晶体管T7的第一极通过数据线与像素电路2的数据电流输入端IN1电连接,第七晶体管T7的第二极与复位信号输入端RST电连接;第八晶体管T8的栅极与第五控制信号输入端SB电连接,第八晶体管T8的第一极与数据电流产生电路1的第一晶体管T1的第二极电连接,第八晶体管T8的第二极通过数据线与像素电路2的数据电流输入端IN1电连接。
可选的,参考图5,像素电路2可以包括第九晶体管T9、第十晶体管T10、第十一晶体管T11、第十二晶体管T12、第二电容C2和发光器件D0;第九晶体管T9的第一极和第十晶体管T10的第二极与像素电路2的数据电流输入端IN1电连接,第九晶体管T9的第二极与第十一晶体管T11的栅极和第二电容C2的第一极电连接,第九晶体管T9的栅极和第十晶体管T10的栅极均与像素电路2的扫描信号输入端WS电连接,第十晶体管T10的第一极与第十一晶体管T11的第二极电连接,第十一晶体管T11的第一极与像素电路2的第一电源信号输入端ELVDD电连接;第二电容C2的第二极与像素电路2的第二参考电压输入端VREF电连接,第十一晶体管T11的第二极与第十二晶体管T12的第一极电连接,第十二晶体管T12的栅极与像素电路2的发光控制信号输入端EMIT电连接,第十二晶体管T12的第二极与发光器件D0的阳极电连接,发光器件D0的阴极与像素电路2的第二电源信号输入端ELVSS电连接。
图7是本发明实施例提供的另一种显示面板的结构示意图,该显示面板示例性地包括n行像素电路,图8是本发明实施例提供的另一种驱动时序图,现结合图7和图8,说明电流产生电路1和像素电路2配合工作的原理。图8中的时序以两帧为示例,Frame1表示第一帧,Frame2表示第二帧。WS<n>表示第n行的扫描线,也表示第n行的像素电路的扫描信号输入端的信号,EMIT<n>表示第n行的发光控制信号线,也表示第n行的像素电路的发光控制信号端的信号。
在每行扫描阶段包括初始化阶段、编程阶段和发光阶段;Reset表示复位阶段,Program表示编程阶段,Emitting表示发光阶段。
第一行扫描阶段:
数据电压产生模块向输出第一行的数据电压VDATA1,第一电容C1第一极VCB的电压等于第一行的VDATA1,则第一电容C1第二极VIP=VDATA1+VTHN,经过运算放大器SOP和第一晶体管T1,产生的数据电流
在复位阶段,复位控制信号输入端SA首先为高电平,第五控制信号输入端SB为低电平,第七晶体管T7导通,第八晶体管T8关断。扫描信号输入端WS<1>为低电平,第九晶体管T9、第十晶体管T10和第十二晶体管T12导通,复位电压RST经过导通的第七晶体管T7和第九晶体管T9写入第十一晶体管T11的栅极和第二电容C2的第一极;对第十一晶体管T11的栅极以及第二电容C2进行复位,复位电压RST经过导通的第十晶体管T10和第十二晶体管T12写入发光器件D0的阳极。复位阶段还存在复位控制信号输入端SA由高电平转换为低电平过程,与此同时,当SA由高电平转换为低电平,EMIT则由低电平转换为高电平的时刻,第七晶体管T7和第十二晶体管T12由导通变为关闭,发光器件D0停止接收复位信号。
在编程阶段,复位控制信号输入端SA为低电平,第五控制信号输入端SB为高电平,第七晶体管T7关断,第八晶体管T8导通。数据电流产生电路产生的电流经过数据线(D1、D2、……、Dn)输入第一行像素电路,具体通过导通的第八晶体管T8和第九个晶体管T9对第二电容C2的电压进行编程。
在发光阶段,发光控制信号输入端EMIT为低电平,第十二晶体管T12导通,第十一晶体管T11根据第二电容C2存储的电压产生驱动电流驱动发光器件D0发光。完成第一行的发光动作。
第二行扫描阶段;
数据电压产生模块向输出第二行的数据电压VDATA2,第一电容C2第一极VCB的电压等于第二行的VDATA2,则第一电容C1第二极VIP=VDATA2+VTHN,经过运算放大器SOP和第一晶体管T1,产生的数据电流
在复位阶段,复位控制信号输入端SA首先为高电平,第五控制信号输入端SB为低电平,第二行像素电路中的第七晶体管T7导通,第八晶体管T8关断。扫描信号输入端WS2为低电平,第九晶体管T9、第十晶体管T10和第十二晶体管T12导通,复位电压RST经过导通的第七晶体管T7和第九晶体管T9写入第十一晶体管T11的栅极和第二电容C2的第一极;对第十一晶体管T11的栅极以及第二电容C2进行复位,复位电压RST经过导通的第十晶体管T10和第十二晶体管T12写入发光器件D0的阳极。复位阶段还存在复位控制信号输入端SA由高电平转换为低电平过程,与此同时,当SA由高电平转换为低电平,EMIT则由低电平转换为高电平的时刻,第七晶体管T7和第十二晶体管T12由导通变为关闭,发光器件D0停止接收复位信号。
在编程阶段,复位控制信号输入端SA为低电平,第五控制信号输入端SB为高电平,第七晶体管T7关断,第八晶体管T8导通。数据电流产生电路产生的电流经过数据线(D1、D2、……、Dn)输入像素电路,具体通过导通的第八晶体管T8和第九个晶体管T9对第二电容C2的电压进行编程。
在发光阶段,发光控制信号输入端EMIT为低电平,第十二晶体管T12导通,第十一晶体管T11根据第二电容C2存储的电压产生驱动电流驱动发光器件D0发光。完成第二行的发光动作;
逐行扫描,直至整帧显示区扫描完成。
本发明实施例提供的技术方案,显示面板在进行画面显示时可以包括显示时间和非显示时间;数据电流产生电路在非显示时间执行阈值抓取阶段。由于阈值抓取阶段执行完成后,第一晶体管T1的阈值电压被存储在第一电容C1的两端,可以在显示时间使用第一电容C1存储的阈值电压对第一晶体管进行补偿,使第一晶体管产生与阈值电压无关的数据电流。也就是说阈值抓取阶段不占用显示时间,易于提高刷新频率,提高显示效果。
非显示时间可以为每相邻两个帧扫描周期之间的间隙时间;或者,非显示时间为显示面板的息屏时间或关机时间。如图8所示,阈值抓取阶段Porch在每一帧的第一行的扫描阶段之前,也就是在相邻两帧扫描周期之间的间隙时间。
在本发明实施例提供另一种实施方式中,显示面板在进行画面显示时可以包括显示时间和非显示时间;在显示时间内,数据电流产生电路每隔多行扫描后执行一次阈值抓取阶段。图8所示的驱动时序中,每一帧的第一行的扫描阶段之前进行一次阈值抓取,也可以每个若干行进行一次阈值抓取,以防第一电容的漏电造成存储的阈值电压发生变化,降低漏电对存储的阈值电压的影响,保证显示效果。其中,相邻两次阈值抓取之间的间隔的行数的扫描阶段可以根据具体的显示面板进行适应调整,本发明实施例不作具体限定。相对于现有技术每一行扫描阶段均要进行阈值抓取,本发明实施例提供的技术方案明显可以节省阈值抓取时间,降低一行扫描所需时间,利于实现高刷新频率显示。
基于同一构思,本发明实施例还提供一种数据电流产生电路的驱动方法。图9是本发明实施例提供的一种数据电流产生电路的驱动方法的流程示意图,如图9所示,本实施例的方法包括如下步骤:
步骤S110、在阈值抓取阶段,控制阈值抓取模块抓取数据电流产生电路的第一晶体管的阈值电压,并将阈值电压存入阈值电压获取和叠加模块。
步骤S120、在编程阶段,控制数据电流产生电路的数据电压产生模块通过数据电压传输控制模块输出数据电压至阈值电压获取和叠加模块,并控制阈值电压获取和叠加模块将数据电压与阈值电压叠加之后传输至第一晶体管的栅极,使得第一晶体管根据栅极的电压输出数据电流。
本发明实施例,数据电流产生电路包括阈值抓取模块、数据电压产生模块、数据电压传输模块、阈值电压获取和叠加模块,以及第一晶体管,在数据电流产生电路工作的过程中,阈值抓取模块连于第一晶体管的栅极和第二极之间,以抓取第一晶体管的阈值电压,数据电压产生模块可产生数据电压,并通过数据电压传输控制模块将数据电压传输至阈值电压获取和叠加模块,阈值电压获取和叠加模块能够将第一晶体管的阈值电压和数据电压叠加后输出至第一晶体管的栅极,第一晶体管的第二极作为数据电流产生电路的输出端,并根据栅极的电压输出数据电流。本实施例中,用于输出数据电流的第一晶体管的栅极电压与第一晶体管的阈值电压相关,当第一晶体管输出数据电流时,该栅极电压能够补偿第一晶体管的阈值电压对数据电流的影响,从而可以提高数据电压与数据电流的匹配程度,进而提高了显示面板的均一性。
可选的,显示面板在进行画面显示时可以包括显示时间和非显示时间;数据电流产生电路在非显示时间执行阈值抓取阶段。
可选的,非显示时间可以为每相邻两个帧扫描周期之间的间隙时间;或者,非显示时间为显示面板的息屏时间或关机时间。也就是说阈值抓取可以不占用显示时间,即不占用扫描阶段的时间,利于实现高刷新频率显示,提高显示效果。
可选的,显示面板在进行画面显示时可以包括显示时间和非显示时间;在显示时间内,数据电流产生电路每隔多行扫描后执行一次阈值抓取阶段。
在本发明实施例中,可以在每一帧的第一行的扫描阶段之前进行一次阈值抓取,也可以每个若干行进行一次阈值抓取,以防第一电容的漏电造成存储的阈值电压发生变化,降低漏电对存储的阈值电压的影响,保证显示效果。其中,相邻两次阈值抓取之间的建行的行数的扫描阶段可以根据具体的显示面板进行适应调整,本发明实施例不作具体限定。相对于现有技术每一行扫描阶段均要进行阈值抓取,本发明实施例提供的技术方案明显可以节省阈值抓取时间,降低一行扫描所需时间,利于实现高刷新频率显示。
注意,上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解,本发明不限于这里所述的特定实施例,对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此,虽然通过以上实施例对本发明进行了较为详细的说明,但是本发明不仅仅限于以上实施例,在不脱离本发明构思的情况下,还可以包括更多其他等效实施例,而本发明的范围由所附的权利要求范围决定。
Claims (13)
1.一种数据电流产生电路,其特征在于,包括:阈值抓取模块、数据电压产生模块、数据电压传输模块、阈值电压获取和叠加模块,以及第一晶体管;
所述阈值抓取模块连接于所述第一晶体管的栅极和第二极之间,用于抓取所述第一晶体管的阈值电压;
所述数据电压产生模块用于产生数据电压;
所述数据电压传输模块连接于所述数据电压产生模块和所述阈值电压获取和叠加模块之间,用于在导通时将所述数据电压产生模块产生的数据电压传输至所述阈值电压获取和叠加模块;
所述阈值电压获取和叠加模块,连接所述第一晶体管的栅极和所述第一晶体管的第一极,用于获取所述第一晶体管的阈值电压,并将所述数据电压传输模块传输的数据电压与所述阈值电压叠加之后传输至所述第一晶体管的栅极;
所述第一晶体管的第二极作为所述数据电流产生电路的输出端,用于根据所述第一晶体管的栅极的电压输出数据电流。
2.根据权利要求1所述的数据电流产生电路,其特征在于,所述数据电压传输模块包括:第二晶体管;
所述第二晶体管的栅极与第一控制信号输入端电连接,所述第二晶体管的第一极与所述数据电压产生模块电连接,所述第二晶体管的第二极与所述阈值电压获取和叠加模块电连接。
3.根据权利要求1所述的数据电流产生电路,其特征在于,所述阈值电压获取和叠加模块包括第三晶体管、第四晶体管、第一电容和运算放大器;
所述第一电容的第一极连接所述数据电压传输模块,所述第一电容的第二极连接所述运算放大器的第一输入端,所述运算放大器的第二输入端连接其输出端;
所述第三晶体管的第一极连接所述运算放大器的第一输入端,所述第三晶体管的第二极连接所述运算放大器的输出端,所述第三晶体管的栅极与第二控制信号输入端电连接;
所述第四晶体管的第一极连接所述第一电容的第一极,所述第四晶体管的第二极连接所述第一晶体管的第一极并接入参考电压,所述第四晶体管的栅极与所述第二控制信号输入端电连接。
4.根据权利要求3所述的数据电流产生电路,其特征在于,
所述第一晶体管的第一极接地。
5.根据权利要求1所述的数据电流产生电路,其特征在于,所述阈值抓取模块包括第五晶体管和第六晶体管;
所述第五晶体管的第二极连接第一电平输入端,所述第五晶体管的第一极连接所述第一晶体管的栅极,所述第五晶体管的栅极连接第三控制信号输入端;
所述第六晶体管的第一极连接所述第一晶体管的栅极,所述第六晶体管的第二极连接所述第一晶体管的第二极,所述第六晶体管的栅极连接第四控制信号输入端。
6.一种数据电流驱动芯片,其特征在于,包括权利要求1-5任一项所述的数据电流产生电路。
7.一种显示面板,其特征在于,包括显示区和非显示区;所述显示区设置有多个像素电路,所述非显示区设置有权利要求1-5任一项所述的数据电流产生电路;
所述像素电路通过数据线和开关模块与所述数据电流产生电路电连接;所述数据电流产生电路通过所述数据线和所述开关模块为所述像素电路提供数据电流。
8.根据权利要求7所述的显示面板,其特征在于,还包括第七晶体管;所述开关模块包括第八晶体管;
所述第七晶体管的栅极与复位控制信号输入端电连接,所述第七晶体管的第一极通过所述数据线与所述像素电路的数据电流输入端电连接,所述第七晶体管的第二极与复位信号输入端电连接;
所述第八晶体管的栅极与第五控制信号输入端电连接,所述第八晶体管的第一极与所述数据电流产生电路的第一晶体管的第二极电连接,所述第八晶体管的第二极通过所述数据线与所述像素电路的数据电流输入端电连接。
9.根据权利要求7所述的显示面板,其特征在于,所述像素电路包括第九晶体管、第十晶体管、第十一晶体管、第十二晶体管、第二电容和发光器件;
所述第九晶体管的第一极和所述第十晶体管的第二极与所述像素电路的数据电流输入端电连接,所述第九晶体管的第二极与所述第十一晶体管的栅极和所述第二电容的第一极电连接,所述第九晶体管的栅极和所述第十晶体管的栅极均与所述像素电路的扫描信号输入端电连接,所述第十晶体管的第一极与所述第十一晶体管的第二极电连接,所述第十一晶体管的第一极与所述像素电路的第一电源信号输入端电连接;所述第二电容的第二极与所述像素电路的第二参考电压输入端电连接,所述第十一晶体管的第二极与所述第十二晶体管的第一极电连接,所述第十二晶体管的栅极与所述像素电路的发光控制信号输入端电连接,所述第十二晶体管的第二极与所述发光器件的阳极电连接,所述发光器件的阴极与所述像素电路的第二电源信号输入端电连接。
10.一种数据电流产生电路的驱动方法,其特征在于,用于驱动权利要求1-5任一项所述的数据电流产生电路,包括:
在阈值抓取阶段,控制所述阈值抓取模块抓取所述数据电流产生电路的第一晶体管的阈值电压,并将所述阈值电压存入所述阈值电压获取和叠加模块;
在编程阶段,控制所述数据电流产生电路的数据电压产生模块通过数据电压传输控制模块输出数据电压至所述阈值电压获取和叠加模块,并控制所述阈值电压获取和叠加模块将所述数据电压与所述阈值电压叠加之后传输至所述第一晶体管的栅极,使得所述第一晶体管根据所述栅极的电压输出数据电流。
11.根据权利要求10所述的数据电流产生电路的驱动方法,其特征在于,显示面板在进行画面显示时包括显示时间和非显示时间;
所述数据电流产生电路在所述非显示时间执行所述阈值抓取阶段。
12.根据权利要求11所述的数据电流产生电路的驱动方法,其特征在于,所述非显示时间为每相邻两个帧扫描周期之间的间隙时间;或者,
所述非显示时间为所述显示面板的息屏时间或关机时间。
13.根据权利要求10所述的数据电流产生电路的驱动方法,其特征在于,显示面板在进行画面显示时包括显示时间和非显示时间;
在所述显示时间内,所述数据电流产生电路每隔多行扫描后执行一次所述阈值抓取阶段。
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