CN112530369B - 一种显示面板、显示装置以及驱动方法 - Google Patents

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Abstract

本发明公开了一种显示面板、显示装置以及驱动方法。该显示面板包括：向显示基板传输控制和数据信号的驱动芯片，设置有多条数据线和多行像素电路的显示基板；显示基板还包括导电部，数据线与导电部形成寄生电容；显示面板在预写入阶段和目标数据写入阶段向对应的像素电路写入数据信号；驱动芯片还包括电压补偿模块，电压补偿模块根据预写入阶段的数量获取各行像素电路的补偿电压值；像素电路包括存储电容和驱动晶体管，配置为在预写入阶段响应于预扫描信号将寄生电容存储的预写入电压写入驱动晶体管的栅极，在目标数据写入阶段响应于目标扫描信号将寄生电容存储的目标写入电压写入驱动晶体管的栅极，预写入电压和目标写入电压包括补偿电压值。

Description

一种显示面板、显示装置以及驱动方法
技术领域
本发明涉及显示技术领域，特别是涉及一种显示面板、显示装置以及驱动方法。
背景技术
目前，有机发光二极管(Organic Light-Emitting Diode，OLED)显示基板与传统的液晶显示基板(Liquid Crystal Display，LCD)相比，具有自发光、广色域、高对比度、轻薄等优点，目前已广泛应用在智能手机、穿戴设备、笔记本电脑、电视、虚拟现实设备(Virtual Reality，VR)等诸多设备上。
现有技术中，有机发光二极管显示基板常采用多脉冲驱动的方式以提高显示面板的响应时间，然而，现有的多脉冲驱动使得显示面板的显示不均，尤其是显示面板最后几行出现显示亮度不足的问题。
发明内容
为了解决上述问题至少之一，本发明第一个实施例提供一种显示面板，包括显示基板和驱动芯片，
所述驱动芯片向所述显示基板传输控制信号和数据信号；
所述显示基板中设置有多条数据线和多行像素电路，所述像素电路包括存储电容和驱动晶体管，所述存储电容连接在所述驱动晶体管的栅极与第一电源端之间，所述像素电路与所述数据线电连接，所述显示基板还包括与所述数据线绝缘间隔的导电部，所述数据线与所述导电部形成寄生电容；
所述显示面板配置为在至少一个预写入阶段和目标数据写入阶段向对应的像素电路写入所述数据信号；
所述驱动芯片还包括电压补偿模块，所述电压补偿模块配置为根据所述预写入阶段的数量获取各行像素电路的补偿电压值；
所述像素电路配置为：在预写入阶段响应于预扫描信号将所述寄生电容存储的预写入电压写入所述驱动晶体管的栅极，在目标数据写入阶段响应于目标扫描信号将所述寄生电容存储的目标写入电压写入所述驱动晶体管的栅极，其中，所述预写入电压和目标写入电压包括所述补偿电压值。
进一步的，所述电压补偿模块进一步配置为根据所述预写入阶段的数量确定：
需进行电压补偿的像素电路的行的数量为：A＝(2Q-1)+1；
需进行电压补偿的像素电路的行的范围为：N-(2Q-1)到N；
其中，A为所述显示面板需进行电压补偿的像素电路的行的数量，Q为所述预写入阶段的数量，Q为大于等于1的自然数；N为所述显示面板的像素的行数量，N为大于等于2的自然数；
所述电压补偿模块进一步配置为根据所述像素电路所在的行的位置和预写入阶段的数量获取各行像素电路的补偿电压值：
ΔV(n-a)＝V(n-2Q)-V(n-a)；
其中，n为小于等于N的整数；a为大于等于0且小于A的整数，V(N-2Q)为无需像素补偿的行的写入电压，V(N-a)为需要像素补偿的行的写入电压。
进一步的，所述显示基板的多条数据线分为多个数据线组，每个数据线组包括至少两条数据线和与各数据线一一对应的数据选择器，每个数据线组配置为分别响应于各数据选择器的选通将接入该数据线组的由所述驱动芯片输出的数据信号接入对应的数据线。
进一步的，所述像素电路包括输入晶体管、阈值补偿晶体管、驱动晶体管、使能晶体管、存储电容和发光器件，所述输入晶体管、阈值补偿晶体管、驱动晶体管和使能晶体管均包括栅极、第一极和第二极，所述存储电容包括第一极和第二极，所述发光器件包括第一极和第二极，其中，
所述存储电容的第一极接入第一电源信号，所述存储电容的第二极与所述驱动晶体管的栅极电连接；
所述输入晶体管的栅极接入所述预扫描信号和所述目标扫描信号，所述输入晶体管的第一极与数据线电连接，所述输入晶体管的第二极与所述驱动晶体管的第一极电连接，所述输入晶体管配置为响应于所述预扫描信号和所述目标扫描信号中的任意一个将所述数据线与所述驱动晶体管的第一极导通；
所述阈值补偿晶体管的栅极接入所述预扫描信号和所述目标扫描信号，所述阈值补偿晶体管的第一极与所述驱动晶体管的第二极电连接，所述阈值补偿晶体管的第二极与所述驱动晶体管的栅极电连接，所述阈值补偿晶体管配置为响应于所述预扫描信号和所述目标扫描信号中的任意一个将所述驱动晶体管的第二极和栅极导通；
所述使能晶体管的栅极接入使能信号，所述使能晶体管的第一极与所述驱动晶体管的第二极电连接，所述使能晶体管的第二极与所述发光器件的第一极电连接，所述使能晶体管配置为响应于所述使能信号将所述驱动晶体管的第二级和所述发光器件的第一极导通；
所述发光器件的第二极接入第二电源信号。
进一步的，所述显示基板还包括栅极驱动电路，所述栅极驱动电路配置为向第n行像素电路输出所述目标扫描信号的同时根据所述预写入阶段的数量向对应的像素电路输出所述预扫描信号，其中，n为小于等于N的整数。
进一步的，所述栅极驱动电路为单边栅极驱动电路或双边栅极驱动电路。
本发明第二个实施例提供一种显示装置，包括如上述的显示面板。
本发明第三个实施例提供一种利用上述显示面板的进行驱动的方法，包括：
驱动芯片的电压补偿模块根据显示面板的预写入阶段的数量获取各行像素电路的补偿电压值；
所述像素电路在预写入阶段响应于预扫描信号将所述寄生电容存储的预写入电压写入所述驱动晶体管的栅极，所述预写入电压包括所述补偿电压值；
所述像素电路在目标数据写入阶段响应于目标扫描信号将所述寄生电容存储的目标写入电压写入所述驱动晶体管的栅极，所述目标写入电压包括所述补偿电压值。
进一步的，所述驱动芯片的电压补偿模块根据显示面板的预写入阶段的数量获取各行像素电路的补偿电压值进一步包括：
所述电压补偿模块根据所述预写入阶段的数量确定：
需进行电压补偿的像素电路的行的数量为：A＝(2Q-1)+1；
需进行电压补偿的像素电路的行的范围为：N-(2Q-1)到N；
其中，A为所述显示面板需进行电压补偿的像素电路的行的数量，Q为所述预写入阶段的数量，Q为大于等于1的自然数；N为所述显示面板的像素的行数量，N为大于等于2的自然数；
所述电压补偿模块根据所述像素电路所在的行的位置和预写入阶段的数量获取各行像素电路的补偿电压值：
ΔV(n-a)＝V(n-2Q)-V(n-a)；
其中，n为小于等于N的整数；a为大于等于0且小于A的整数，V(N-2Q)为无需像素补偿的行的写入电压，V(N-a)为需要像素补偿的行的写入电压。
进一步的，所述显示基板的多条数据线分为多个数据线组，每个数据线组包括至少两条数据线和与各数据线一一对应的数据选择器，所述驱动方法还包括：
所述数据线响应于对应的数据选择器的选通接入与该数据线组电连接的由所述驱动芯片输出的数据信号。
本发明的有益效果如下：
本发明针对目前现有的问题，制定一种显示面板，通过电压补偿模块对各行像素的像素电路接收的电压值进行补偿，即将电压补偿值直接写入数据信号，从而实现写入每行像素的像素电路的驱动晶体管的电压值一致，即，预写入阶段输入至每行像素电路的预写入电压一致，以及目标数据写入阶段输入至每行像素电路的目标写入电压一致；从而解决现有技术中利用多脉冲进行驱动时后几行像素亮度不足的问题，即通过电压补偿值对亮度不足的后几行像素电路进行补偿，使得像素电路驱动发光单元的驱动电压一致，实现显示面板的各像素行的发光亮度一致，从而提高了显示面板的显示均匀性，具有广泛的应用前景。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1a示出现有技术中显示基板的结构示意图；
图1b示出现有技术中显示基板的像素电路的结构示意图；
图1c示出现有技术为图1a的像素电路时各信号端的一个具体示例的驱动时序示意图；
图1d示出现有技术为图1a的像素电路时各信号端的一个具体示例的驱动时序示意图；
图1e示出现有技术中多行像素电路的电路示意图；
图1f示出现有技术为多行像素电路时的驱动时序示意图；
图2示出本发明的一个实施提出的显示面板的结构示意图；
图3示出本发明的一个实施提出的显示面板的像素电路的结构示意图；
图4示出本发明的一个实施提出的显示面板的多数据选择器的结构示意图；
图5a和5b示出本发明的一个实施提出的显示面板单边栅极驱动电路和双边栅极驱动电路的结构示意图；
图6示出本发明的另一个实施例显示面板的流程示意图。
具体实施方式
为了更清楚地说明本发明，下面结合优选实施例和附图对本发明做进一步的说明。附图中相似的部件以相同的附图标记进行表示。本领域技术人员应当理解，下面所具体描述的内容是说明性的而非限制性的，不应以此限制本发明的保护范围。
需要说明的是，本文中所述诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括一个……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
图1a为现有技术中显示基板的局部示意图，如图1a所示，该显示基板1包括多个阵列排布的像素电路11与多条数据线Data连接，数据线Data与显示基板上的其他导电结构形成寄生电容C1，利用数据选择器Mux1、Mux2(即图1a中的选通晶体管Tm1、Tm2)可以在不同时刻将数据信号输入端Source的信号分别提供给不同的数据线Data。
图1b为图1a中像素电路结构示意图，如图1b所示，每个像素电路11包括：存储电容C2、驱动晶体管Td、扫描端Gate、输入晶体管T1、发光器件(未示出)和复位端Reset(未示出)。
对显示基板进行驱动时，以其中一行像素电路为例，如图1c所示，在复位阶段，为该行像素电路11的复位端Reset提供复位控制信号；之后，依次为选通端Mux1、Mux2提供有效的数据信号，从而使得数据选择器的选通晶体管Tm1和Tm2依次开启，当选通晶体管Tm1开启时，数据信号输入端Source的信号存储至选通晶体管Tm1连接数据线所对应的寄生电容C1，当选通晶体管Tm2开启时，数据信号输入端Source的信号存储至选通晶体管Tm2连接的数据线所对应的寄生电容C1。在数据写入阶段，为像素电路的扫描端Gate提供扫描信号，从而使得寄生电容C1中存储的电压写入驱动晶体管Td的栅极。在发光控制阶段，为发光器件的发光控制端EM提供发光控制信号，从而使发光器件的发光控制晶体管T3开启，进而驱动发光器件发光。
现有技术中，为进一步加快显示基板驱动的响应时间，现有技术中利用多脉冲预写入的方式进行驱动。如图1d所示，每行像素电路11的工作阶段包括多次复位阶段、多次预写入阶段和目标数据写入阶段。在每次复位阶段，为像素电路11提供复位信号，对驱动晶体管Td的栅极进行复位；在每一次预写入阶段，为像素电路11提供预扫描信号，从而向驱动晶体管Td的栅极提供预写入电压；在目标写入阶段，为像素电路11的扫描端Gate提供目标扫描信号，从而向驱动晶体管Td的栅极提供目标写入电压。但是这样的驱动时序会引起扫描最后几行亮度发暗问题。
针对上述问题，发明人经大量研究和实验发现，产生这种问题的原因为：
如图1e所示，以显示面板包括2个数据选择器Mux、共n+4行像素电路为例，第n+4行像素电路为显示最后一行，如图1f所示，当显示面板以多脉冲的方式驱动时，向扫描端Gate输入的预扫描信号或目标扫描信号以同一周期频率输出，且相隔一行的两像素电路的扫描端Gate均同时输入预扫描信号或目标扫描信号。例如，第n+3行像素电路的Gate端输入信号时，第n-1行和第n+1行像素电路的Gate端同时输入信号。
并且，多脉冲驱动时，相邻两行像素电路之间处于同一驱动阶段时，靠近数据信号输入端Source的像素电路处于该驱动阶段的时间延后一个周期，例如：如图1f所示，当第n-1行像素电路在第一周期1t内处于第一次预写入阶段1Y时，与其相邻且靠近数据信号输入端Source的第n行像素电路在下一周期2t内进入第一次预写入阶段1Y，与第n行像素电路相邻且靠近数据信号输入端Source的第n+1行像素电路在下一周期3t内进入第一次预写入阶段1Y，此时，在该第3t周期内，预扫描信号同时输入第n-1行像素电路使得第n-1行像素电路进入第二次预写入阶段2Y。进一步的，第n-1行像素电路在第5t周期内，Gate端输入扫描信号，第n-1行像素电路进入第一次目标数据写入阶段1Z，此时，第n+1行像素电路处于第二次预扫描阶段2Y，第n+3行像素电路处于第一次预扫描阶段1Y。
以预写入阶段的数量为2，第n行像素电路处于第一次目标数据写入阶段1Z(n≤N-4，N为显示总行数)为例，此时，寄生电容C1中存储的电压写入第n行驱动晶体管Td的栅极，同时第n+2处于第二次预写入阶段2Y，第n+4行像素电路处于第一次预写入阶段1Y，寄生电容C1中存储的电压同样写入第n+2和n+4行驱动晶体管Td的栅极，此时，每条数据线data上相当于有三个存储电容C2并联后与寄生电容C1分压，因此，写入第n行驱动晶体管Td栅极的电压为：
Figure BDA0002860296230000071
其中，Cdata为寄生电容C1的电容值，Vdata为寄生电容C1存储的电压值，Vth为驱动晶体管Td的阈值电压，Cst为存储电容C2的电容值。
当第n+2行处于第一次目标数据写入阶段1Z时(图1f中间的框图，即，向第n+2行像素电路提供目标扫描信号时)，寄生电容C1存储的电压写入第n+2行像素电路11的驱动晶体管Td的栅极。同时，第n+4行像素电路处于第二次预写入阶段2Y，第n+4行像素电路接收到预扫描信号，使寄生电容C1存储的电压写入第n+4行像素电路11的驱动晶体管Td的栅极。此时，相当于有两个存储电容C2并联后与寄生电容C1进行分压，写入第n+2行像素电路11中驱动晶体管Td栅极的电压为
Figure BDA0002860296230000072
当最后一行像素电路，第n+4行像素电路进入第一次目标数据写入阶段1Z时，前述第n行和第n+2行像素电路已经完成目标数据写入，因此，此时只有一个存储电容C2与寄生电容C1分压，写入第n+4行像素电路中驱动晶体管Td栅极的电压为：
Figure BDA0002860296230000073
因此，从第n行像素电路到第n+4行像素电路，写入驱动晶体管Td栅极的电压增加，后几行像素电路写入驱动晶体管Td栅极的电压差异较大，在亮画面下可有明显的亮度发暗问题。
第n-1行、n+1行和第n+3行均同理，第n+1行处于目标数据写入阶段时，写入第n+1行与写入第n+2行驱动晶体管Td栅极的电压相同，为:
Figure BDA0002860296230000074
第n+3行像素电路处于数据信号写入阶段时，写入第n+3与第(n+4)行驱动晶体管Td栅极的电压相同，为：
Figure BDA0002860296230000075
可见，对于显示基板的最后几行像素电路，其驱动晶体管Td的栅极在目标数据写入阶段写入的电压并不相同。这样将导致显示基板的最后几行像素单元与其他区域的显示不一致。
基于上述发现，发明人提出一种显示面板、显示装置以及驱动方法以解决上述问题。
如图2和图3所示，本发明的第一个实施例提出一种显示面板，包括显示基板1和驱动芯片2，
所述驱动芯片2向所述显示基板1传输控制信号和数据信号；
所述显示基板1中设置有多条数据线Data和多行像素电路11，所述像素电路11包括存储电容C2和驱动晶体管Td，所述存储电容C2连接在所述驱动晶体管Td的栅极与第一电源端V1之间，所述像素电路11与所述数据线Data电连接，所述显示基板还包括与所述数据线绝缘间隔的导电部，所述数据线与所述导电部形成寄生电容C1；
所述显示面板配置为在至少一个预写入阶段和目标数据写入阶段向对应的像素电路写入所述数据信号；
所述驱动芯片2还包括电压补偿模块21，所述电压补偿模块配置为根据所述预写入阶段的数量获取各行像素电路11的补偿电压值；
所述像素电路配置为：在预写入阶段响应于预扫描信号将所述寄生电容C1存储的预写入电压写入所述驱动晶体管Td的栅极，在目标数据写入阶段响应于目标扫描信号将所述寄生电容C1存储的目标写入电压写入所述驱动晶体管Td的栅极，其中，所述预写入电压和目标写入电压包括所述补偿电压值。
通过电压补偿模块对各行像素的像素电路接收的电压值进行补偿，即将电压补偿值直接写入数据信号，从而实现写入每行像素的像素电路的驱动晶体管的电压值一致，即，预写入阶段输入至每行像素电路的预写入电压一致，以及目标数据写入阶段输入至每行像素电路的目标写入电压一致；从而解决现有技术中利用多脉冲进行驱动时后几行像素亮度不足的问题，即通过电压补偿值对亮度不足的后几行像素电路进行补偿，使得像素电路驱动发光单元的驱动电压一致，实现显示面板的各像素行的发光亮度一致，从而提高了显示面板的显示均匀性，具有广泛的应用前景。
在本实施例中，在数据线Data接收到预扫描信号或目标扫描信号后，数据线Data与导电部之间形成寄生电容C1。本发明实施例利用该寄生电容C1存储电压，并在像素电路11的预写入阶段，将寄生电容C1所存储的电压作为预写入电压输出至像素电路11，以及在像素电路11的目标数据写入阶段，将寄生电容C1所存储的电压作为目标写入电压输出至像素电路11。
在预写入阶段，预写入电压能够用于使驱动晶体管Td在进入目标数据写入阶段之前导通，从而改善驱动晶体管Td的磁滞效应。因此，本实施例通过至少一个预写入阶段以改善驱动晶体管Td的磁滞效应，提高扫描效率。在目标写入阶段，目标写入电压能够驱动与像素电路11电连接的发光器件12达到目标亮度。
在本实施例中，所述预写入电压和目标写入电压均包括补偿电压值，从而实现写入每行像素电路的驱动晶体管的电压值一致，即，预写入阶段输入至每行像素电路的预写入电压一致，以及目标数据写入阶段输入至每行像素电路的目标写入电压一致，实现全部像素电路受驱动发光时亮度一致，提高了显示面板的显示均匀性，具有广泛的应用前景。
可以理解的是，在本发明实施例中，预写入电压和目标写入电压仅仅是根据该电压功能的不同而进行的划分，在实际应用过程中，由于在一个脉冲扫描周期中，多行像素电路11同时与数据线Data导通，因此，第一行像素电路11接收的目标写入电压和其他行像素电路11接收的预写入电压的大小可以相同。
还值得说明的是，本实施例的预写入阶段的数量为至少一个，本领域技术人员能够根据实际需要选择预写入阶段的数量，以改善驱动晶体管Td的磁滞效应和加快驱动速度实现最大化效果为设计准则。
考虑到由于预写入阶段的不同，需进行电压补偿的像素电路的行的数量也不同。
根据前述第n-1行～第n+4行像素电路中驱动晶体管栅极的电压变化，得出：当Gate端采用M个脉冲扫描驱动时，各行驱动晶体管Td栅极写入的电压为：
Figure BDA0002860296230000091
Figure BDA0002860296230000092
……
Figure BDA0002860296230000093
其中a为大于等于0的整数。
在一个可选的实施例中，所述电压补偿模块进一步配置为根据所述预写入阶段的数量确定：
需进行电压补偿的像素电路的行的数量为：A＝(2Q-1)+1；
需进行电压补偿的像素电路的行的范围为：N-(2Q-1)到N；
其中，A为所述显示面板需进行电压补偿的像素电路的行的数量，Q为所述预写入阶段的数量，Q为大于等于1的自然数；N为所述显示面板的像素的行数量，N为大于等于2的自然数。
在本实施例中，发明人通过大量的研究和实验确定预写入阶段数量和需进行电压补偿的像素电路的数量，实现以不同脉冲驱动时电压补偿模块进行不同数量的像素电路的补偿，具有实时匹配性，提高电压补偿模块的适应性，能够解决现有技术中利用多脉冲进行驱动时后几行像素显示亮度不均的问题，提高显示面板的显示效果，具有广泛地应用前景。
在一个具体示例中，以预写入阶段的数量为2个(即Q＝2)为例，则M＝3时，3脉冲的驱动阶段包括2个预写入阶段和1个目标数据扫描阶段(M＝Q+1)。则需要进行电压补偿的像素电路的行的数量A＝4，如图1f所示，若第n+4行为最后一行(即N＝n+4)，则需进行电压补偿的像素电路的行的范围为n+1～n+4，第n+1行、第n+2行、第n+3行以及第n+4行，这4行需像素电路进行电压补偿。
由前述可知，在需进行电压补偿的像素电路的行中，每一行的像素电路所在的行的预写入电压或者目标写入电压并不相同，因此，每一行像素电路对应的补偿电压值并不相同。
在一个可选的实施例中，所述电压补偿模块进一步配置为根据所述像素电路所在的行的位置和预写入阶段的数量获取各行像素电路的补偿电压值：
ΔV(n-a)＝V(n-2Q)-V(n-a)；
其中，n为小于等于N的整数；a为大于等于0且小于A的整数，V(N-2Q)为无需像素补偿的行的写入电压，V(N-a)为需要像素补偿的行的写入电压。
仍以前述Q＝2，N＝n+4为例，此时，A＝4，需对第n+1行、第n+2行、第n+3行以及第n+4行这四行分别获取各自像素电路的补偿电压值。
例如，a＝0时，第n+4行需补偿的补偿电压值位：
ΔV((n+4)-0)＝V((n+4)-2*2)-V((n+4)-0)；
即ΔV(n+4)＝V(n)-V(n+4)。
又如，a＝1时，第n+3行需补偿的补偿电压值为：
ΔV((n+4)-1)＝V((n+4)-2*2)-V((n+4)-1)；
即ΔV(n+3)＝V(n)-V(n+3)。
在本实施例中，在根据预写入阶段数量确定需要进行电压补偿的像素电路数量的基础上，以无需电压补偿的V(n-2Q)为基础，精确确定了每一行需电压补偿的像素电路的电压补偿值，对每一行像素电路进行不同的电压补偿，从而实现所有需补偿像素电路的电压补偿，使得需补偿像素电路在驱动发光时亮度一致，提高亮度均匀性，并提高整体的显示均匀性。
在一个可选的实施例，所述显示基板的多条数据线分为多个数据线组，每个数据线组包括至少两条数据线和与各数据线一一对应的数据选择器，每个数据线组配置为分别响应于各数据选择器的选通将接入该数据线组的由所述驱动芯片输出的数据信号接入对应的数据线。
在一个具体示例中，如图4所示的显示基板1中包括3个数据线组以及与这3个数据线组一一对应的3个数据选择器Mux1～3，数据选择器的输入端与数据信号输入端Source电连接，数据选择器配置为在每个行扫描周期，将数据信号输入端Source依次与相应数据线组中的每条数据线Data导通，以依次对每条数据线Data对应的寄生电容C1充电。在另一个具体示例中，如图1a所示的显示基板中包括2个数据线组以及与这2个数据线组一一对应的2个数据选择器Mux1～2。本实施例中，通过多个数据线组和与其连接的数据选择器，实现将由驱动芯片输出的数据信号接入与选通的数据选择器对应的数据线内，该布局设置能够减小信号输入端Source端的走线空间，从而简化显示基板的布线空间。
在一个可选的实施例中，如图5a和5b所示，所述显示基板还包括栅极驱动电路3，所述栅极驱动电路配置为向第n行像素电路输出所述目标扫描信号的同时根据所述预写入阶段的数量向对应的像素电路输出所述预扫描信号，其中，n为小于等于N的整数。
本实施例中，以图5a为例，驱动芯片2通过栅极驱动电路3向所述显示基板1传输控制信号和数据信号，以自远离电压补偿模块一侧为起点对每行像素电路进行扫描，在扫描过程中，电压补偿模块根据所述预写入阶段的数量获取各行像素电路的补偿电压值，并将该补偿电压值通过数据信号输入至对应的需补偿的像素电路中，实现像素电路的发光亮度一致。
并且，在一个脉冲扫描周期中，多行像素电路11同时通过栅极驱动电路3与数据线Data导通。在该过程中，相邻行的像素电路之间所在的驱动阶段并不相同，在一个具体示例中，以预写入阶段的数量为2个为例，则整个驱动阶段包括两个预写入阶段和一个目标数据扫描阶段。进一步的，以如图1e所示的第n行像素电路处于图1f所示的目标数据写入阶段为例，此时，第n+2行以及第n+4行像素电路同时通过栅极驱动电路与数据线Data导通，第n+2行像素电路处于第二次预写入阶段，第n+4行像素电路处于第一次预写入阶段。在该状态下，栅极驱动电路向第n行像素电路输出目标扫描信号，同时栅极驱动电路还向第n+2行和第n+4行像素电路输出所述预扫描信号。在电压补偿模块对第n行、第n+2行和第n+4行像素电路输入的目标写入电压以及预写入电压进行补偿的基础上，写入目标扫描信号和预扫描信号的电压值一致，从而实现像素电路的发光亮度一致。
在一个可选的实施例中，所述栅极驱动电路3为如图5a所示的单边栅极驱动电路或如图5b所示的双边栅极驱动电路。本领域技术人员根据实际应用选择栅极驱动电路的结构，在此不再赘述。
在一个可选的实施例中，如图3所示，像素电路11包括输入晶体管T1、阈值补偿晶体管T2、驱动晶体管Td、使能晶体管T3、存储电容C2和发光器件12，所述输入晶体管T1、阈值补偿晶体管T2、驱动晶体管Td和使能晶体管T3均包括栅极、第一极和第二极，所述存储电容C2包括第一极和第二极，所述发光器件12包括第一极和第二极，其中，
所述存储电容C2的第一极接入第一电源信号V1，所述存储电容C2的第二极与所述驱动晶体管Td的栅极电连接；
所述输入晶体管T1的栅极接入所述预扫描信号和所述目标扫描信号，所述输入晶体管T1的第一极与数据线Data电连接，所述输入晶体管T1的第二极与所述驱动晶体管Td的第一极电连接，所述输入晶体管T1配置为响应于所述预扫描信号和所述目标扫描信号中的任意一个将所述数据线Data与所述驱动晶体管Td的第一极导通；
所述阈值补偿晶体管T2的栅极接入所述预扫描信号和所述目标扫描信号，所述阈值补偿晶体管T2的第一极与所述驱动晶体管Td的第二极电连接，所述阈值补偿晶体管T2的第二极与所述驱动晶体管Td的栅极电连接，所述阈值补偿晶体管T2配置为响应于所述预扫描信号和所述目标扫描信号中的任意一个将所述驱动晶体管Td的第二极和栅极导通；
所述使能晶体管T3的栅极接入使能信号，所述使能晶体管T3的第一极与所述驱动晶体管Td的第二极电连接，所述使能晶体管T3的第二极与所述发光器件12的第一极电连接，所述使能晶体管T3配置为响应于所述使能信号将所述驱动晶体管Td的第二级和所述发光器件12的第一极导通；
所述发光器件12的第二极接入第二电源信号V2。
在本实施例中，如图3所示，输入晶体管T1的第一极与数据线Data电连接，输入晶体管T1的第二极与驱动晶体管Td的第一极电连接，驱动晶体管Td的栅极与Gate端连接，用于接入所述预扫描信号和所述目标扫描信号。驱动晶体管Td的第二极与使能晶体管T3的第一极电连接，驱动晶体管Td的栅极与阈值补偿晶体管T2的第二极电连接，并与存储电容C2的第二极电连接。存储电容C2的第一极接入第一电源信号V1。阈值补偿晶体管T2的栅极与Gate端连接，用于接入所述预扫描信号和所述目标扫描信号。使能晶体管T3的第二极与发光器件12的第一极电连接，使能晶体管T3的栅极与发光控制端EM电连接。发光器件12的第二端接入第二电源信号V2。
在本实施例中，在目标写入阶段，目标扫描信号通过Gate端输入至阈值补偿晶体管T2以及输入晶体管T1的栅极，阈值补偿晶体管T2和输入晶体管T1导通，输入晶体管T1导通将存储在寄生电容C1上的目标写入电压传输至驱动晶体管Td的第一极，阈值补偿晶体管T2导通将驱动晶体管Td的第二极和栅极连接在一起，将三极管驱动晶体管Td形成二极管，存储电容C2保持驱动晶体管Td的栅极电压为Vdata+Vth，当EM信号有效则使能晶体管T3导通，发光器件12发光。
值得说明的是，在预写入阶段，预扫描信号通过Gate端输入至阈值补偿晶体管T2以及输入晶体管T1的栅极，阈值补偿晶体管T2、驱动晶体管Td、输入晶体管T1以及使能晶体管T3的驱动导通过程与上述目标写入过程一致，在此不再赘述。
在一个具体示例中，利用本实施例的显示面板进行驱动的过程为：
首先，所述数据线响应于对应的数据选择器的选通接入与该数据线组电连接的由所述驱动芯片输出的数据信号。
如图4所示，信号输入端Source接入驱动芯片输出的数据信号，数据选择器Mux1、数据选择器Mux2和数据选择器Mux3依次被选通，与数据选择器连接的数据线组分别将该数据信号输入至对应的像素电路，例如，如图1e所示，该数据信号从第n行像素电路输入至第n+2行和第n+4行像素电路。
然后，驱动芯片的电压补偿模块根据显示面板的预写入阶段的数量获取各行像素电路的补偿电压值。
由于一个扫描周期内存在预写入阶段以及目标写入阶段，电压补偿模块根据显示面板的预写入阶段的数量获取各行像素电路的补偿电压值。在一个具体示例中，电压补偿模块根据所述预写入阶段的数量先确定需进行电压补偿的像素电路的行的数量以及范围，进一步的，电压补偿模块根据所述像素电路所在的行的位置和预写入阶段的数量获取各行像素电路的补偿电压值，从而确定每一行需要补偿的像素电路的补偿电压值。
进一步的，所述像素电路在预写入阶段响应于预扫描信号将所述寄生电容存储的预写入电压写入所述驱动晶体管的栅极。
预写入电压包括电压补偿模块输出的补偿电压值，经补偿后的预写入电压写入驱动晶体管的栅极，使驱动晶体管Td在进入目标数据写入阶段之前导通，从而改善驱动晶体管Td的磁滞效应。
再然后，所述像素电路在目标数据写入阶段响应于目标扫描信号将所述寄生电容存储的目标写入电压写入所述驱动晶体管的栅极，所述目标写入电压包括所述补偿电压值。
当同一行像素电路在预写入阶段后进入目标数据写入阶段，经补偿后的目标写入电压写入驱动晶体管的栅极，驱动与像素电路电连接的发光单元达到目标亮度，使得最后几行像素电路形成亮度补偿，实现显示面板的亮度均匀显示。
本实施例通过电压补偿模块在驱动时对电压较低的像素电路输入的预写入电压和目标写入电压进行补偿，将补偿后的预写入电压和目标写入电压输入驱动晶体管的栅极，使得每一像素电路中驱动晶体管的电压值保持一致，从而实现每一像素电路中的发光单元的驱动电压一致，进一步实现显示面板的驱动时的显示均匀性，有效提高显示性能，具有广泛应用前景。
与上述实施例提供的显示面板相对应，如图6所示，本申请的一个实施例还提供一种利用上述显示面板的驱动方法，包括：
S1、驱动芯片的电压补偿模块根据显示面板的预写入阶段的数量获取各行像素电路的补偿电压值；
S2、所述像素电路在预写入阶段响应于预扫描信号将所述寄生电容存储的预写入电压写入所述驱动晶体管的栅极，所述预写入电压包括所述补偿电压值；
S3、所述像素电路在目标数据写入阶段响应于目标扫描信号将所述寄生电容存储的目标写入电压写入所述驱动晶体管的栅极，所述目标写入电压包括所述补偿电压值。
在一个可选的实施例中，所述驱动芯片的电压补偿模块根据显示面板的预写入阶段的数量获取各行像素电路的补偿电压值进一步包括：
所述电压补偿模块根据所述预写入阶段的数量确定：
需进行电压补偿的像素电路的行的数量为：A＝(2Q-1)+1；
需进行电压补偿的像素电路的行的范围为：N-(2Q-1)到N；
其中，A为所述显示面板需进行电压补偿的像素电路的行的数量，Q为所述预写入阶段的数量，Q为大于等于1的自然数；N为所述显示面板的像素的行数量，N为大于等于2的自然数；
所述电压补偿模块根据所述像素电路所在的行的位置和预写入阶段的数量获取各行像素电路的补偿电压值：
ΔV(n-a)＝V(n-2Q)-V(n-a)；
其中，n为小于等于N的整数；a为大于等于0且小于A的整数，V(N-2Q)为无需像素补偿的行的写入电压，V(N-a)为需要像素补偿的行的写入电压。
在一个可选的实施例中，所述显示基板的多条数据线分为多个数据线组，每个数据线组包括至少两条数据线和与各数据线一一对应的数据选择器，所述驱动方法还包括：
所述数据线响应于对应的数据选择器的选通接入与该数据线组电连接的由所述驱动芯片输出的数据信号。
本实施例利用上述显示面板进行驱动的过程中，通过电压补偿模块在驱动时对电压较低的像素电路输入的预写入电压和目标写入电压进行补偿，将补偿后的预写入电压和目标写入电压均输入驱动晶体管的栅极，使得每一像素电路中驱动晶体管的电压值保持一致，从而实现每一像素电路中的发光单元的驱动电压一致，进一步实现显示面板的驱动时的显示均匀性，有效提高显示性能，具有广泛应用前景。
由于本申请实施例提供的显示面板驱动方法与上述几种实施例提供的显示面板相对应，因此在前实施方式也适用于本实施例提供的液晶屏测试方法，在本实施例中不再详细描述。
本发明的另一个实施例提供了一种显示装置，包括上述显示面板，并且所述显示装置为液晶显示装置或电致发光二极管显示装置。所述显示装置可以为手机、平板电脑、电视机、显示器、笔记本电脑、数码相框或导航仪等任何具有显示功能的产品或部件。
显然，本发明的上述实施例仅仅是为清楚地说明本发明所作的举例，而并非是对本发明的实施方式的限定，对于所属领域的普通技术人员来说，在上述说明的基础上还可以做出其它不同形式的变化或变动，这里无法对所有的实施方式予以穷举，凡是属于本发明的技术方案所引伸出的显而易见的变化或变动仍处于本发明的保护范围之列。

Claims (7)

1.一种显示面板，包括显示基板和驱动芯片，其特征在于，
所述驱动芯片向所述显示基板传输控制信号和数据信号；
所述显示基板中设置有多条数据线和多行像素电路，所述像素电路包括存储电容和驱动晶体管，所述存储电容连接在所述驱动晶体管的栅极与第一电源端之间，所述像素电路与所述数据线电连接，所述显示基板还包括与所述数据线绝缘间隔的导电部，所述数据线与所述导电部形成寄生电容；
所述显示面板配置为在至少一个预写入阶段和目标数据写入阶段向对应的像素电路写入所述数据信号；
所述驱动芯片还包括电压补偿模块，所述电压补偿模块配置为根据所述预写入阶段的数量获取各行像素电路的补偿电压值；
所述像素电路配置为：在预写入阶段响应于预扫描信号将所述寄生电容存储的预写入电压写入所述驱动晶体管的栅极，在目标数据写入阶段响应于目标扫描信号将所述寄生电容存储的目标写入电压写入所述驱动晶体管的栅极，其中，所述预写入电压和目标写入电压包括所述补偿电压值；
其中， 所述电压补偿模块进一步配置为根据所述预写入阶段的数量确定：
需进行电压补偿的像素电路的行的数量为：A=（2Q-1）+1；
需进行电压补偿的像素电路的行的范围为：N-（2Q-1）到N；
其中，A为所述显示面板需进行电压补偿的像素电路的行的数量，Q为所述预写入阶段的数量，Q为大于等于1的自然数；N为所述显示面板的像素的行数量，N为大于等于2的自然数；
所述电压补偿模块进一步配置为根据所述像素电路所在的行的位置和预写入阶段的数量获取各行像素电路的补偿电压值：
∆V（n-a）=V（n-2Q）-V（n-a）；
其中，n为小于等于N的整数；a为大于等于0且小于A的整数，V（n-2Q）为无需像素补偿的行的写入电压，V（n-a）为需要像素补偿的行的写入电压。
2.根据权利要求1所述的显示面板，其特征在于，所述显示基板的多条数据线分为多个数据线组，每个数据线组包括至少两条数据线和与各数据线一一对应的数据选择器，每个数据线组配置为分别响应于各数据选择器的选通将接入该数据线组的由所述驱动芯片输出的数据信号接入对应的数据线。
3.根据权利要求1所述的显示面板，其特征在于，所述像素电路包括输入晶体管、阈值补偿晶体管、驱动晶体管、使能晶体管、存储电容和发光器件，所述输入晶体管、阈值补偿晶体管、驱动晶体管和使能晶体管均包括栅极、第一极和第二极，所述存储电容包括第一极和第二极，所述发光器件包括第一极和第二极，其中，
所述存储电容的第一极接入第一电源信号，所述存储电容的第二极与所述驱动晶体管的栅极电连接；
所述输入晶体管的栅极接入所述预扫描信号和所述目标扫描信号，所述输入晶体管的第一极与数据线电连接，所述输入晶体管的第二极与所述驱动晶体管的第一极电连接，所述输入晶体管配置为响应于所述预扫描信号和所述目标扫描信号中的任意一个将所述数据线与所述驱动晶体管的第一极导通；
所述阈值补偿晶体管的栅极接入所述预扫描信号和所述目标扫描信号，所述阈值补偿晶体管的第一极与所述驱动晶体管的第二极电连接，所述阈值补偿晶体管的第二极与所述驱动晶体管的栅极电连接，所述阈值补偿晶体管配置为响应于所述预扫描信号和所述目标扫描信号中的任意一个将所述驱动晶体管的第二极和栅极导通；
所述使能晶体管的栅极接入使能信号，所述使能晶体管的第一极与所述驱动晶体管的第二极电连接，所述使能晶体管的第二极与所述发光器件的第一极电连接，所述使能晶体管配置为响应于所述使能信号将所述驱动晶体管的第二级和所述发光器件的第一极导通；
所述发光器件的第二极接入第二电源信号。
4.根据权利要求1-3中任一项所述的显示面板，其特征在于，所述显示基板还包括栅极驱动电路，所述栅极驱动电路配置为向第n行像素电路输出所述目标扫描信号的同时根据所述预写入阶段的数量向对应的像素电路输出所述预扫描信号，其中，n为小于等于N的整数。
5.根据权利要求4所述的显示面板，其特征在于，所述栅极驱动电路为单边栅极驱动电路或双边栅极驱动电路。
6.一种显示装置，其特征在于，包括如权利要求1-5中任一项所述的显示面板。
7.一种显示面板的驱动方法，其特征在于，应用于权利要求1-5中任一项所述的显示面板。
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