CN112346091B - 一种基于数字重采样的非同源数据接收调制装置 - Google Patents
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Abstract
本发明公开了一种基于数字重采样的非同源数据接收调制装置,涉及卫星数据传输领域。其包括符号映射器、成形滤波器、数字重采样器、DA、时钟源、模拟正交调制器和载波源。符号映射器对输入数据进行正交符号映射,产生两路正交信号传给成形滤波器,成形滤波器输出的基带信号输入数字重采样器,数字重采样器通过内部速率匹配,自动调整数字重采样器输出基带信号的采样率,从而达到将非同源输入数据速率与DA采样速率进行匹配的目的,数字重采样器输出的两路基带信号传给DA进行数模转换,DA输出的两路模拟正交信号传给模拟正交调制器,模拟正交调制器使用载波源产生的载波信号对输入的两路模拟正交信号进行正交混频后,输出中频模拟调制信号。
Description
技术领域
本发明涉及卫星数据传输领域,特别是指一种基于数字重采样的非同源数据接收调制装置,可用于卫星通信站数据发射分系统中通信调制信号的产生。
背景技术
卫星通信站数据发射子系统主要用于发射通信信号,并通过卫星转发实现远距离卫星通信,调制装置接收编码器或保密机对输出的通信信号,经过符号映射、成形滤波和正交变频等处理后输出给后端模拟变频单元。
目前,现有技术中的同源数据接收调制装置需要采用额外的同源处理硬件, 硬件实现规模与成本较高。现有的同源数据接收调制装置在对外部非同源数据进行调制的过程中,调制装置的调制传输效率较低,对调制信号传输信道带宽的要求较高。相应地,解调装置还需要对空帧进行识别与处理,增加了解调装置的实现难度。
发明内容
本发明的目的在于避免上述背景技术中的不足之处而提供一种基于数字重采样的非同源数据接收调制装置,其具有实现可靠性高、稳定度高、实现复杂度低等特点。
为了实现上述目的,本发明采用的技术方案为:
一种基于数字重采样的非同源数据接收调制装置,其包括符号映射器1、第一成形滤波器2-1、第二成形滤波器2-2、数字重采样器3、第一DA 4-1、第二DA 4-2、时钟源5、模拟正交调制器6和载波源7;
符号映射器1接收外部输入的待调制数据与待调制数据伴随时钟信号,并使用待调制数据伴随时钟信号作为符号映射器1内部时序处理时钟,对接收的待调制数据进行符号映射处理,产生两路符号映射信号,并将第一路符号映射信号输出给第一成形滤波器2-1,将第二路符号映射信号输出给第二成形滤波器2-2;
第一成形滤波器2-1接收外部输入的待调制数据伴随时钟信号与符号映射器1输入的第一路符号映射信号,并使用待调制数据伴随时钟信号作为第一成形滤波器2-1的内部时序处理时钟,对接收的第一路符号映射信号进行成形滤波处理,产生第一路2倍采样的基带信号,并将该信号输出给数字重采样器3;
第二成形滤波器2-2接收外部输入的待调制数据伴随时钟信号与符号映射器1输入的第二路符号映射信号,并使用待调制数据伴随时钟信号作为第二成形滤波器2-2的内部时序处理时钟,对接收的第二路符号映射信号进行成形滤波处理,产生第二路2倍采样的基带信号,并将该信号输出给数字重采样器3;
数字重采样器3根据外部输入的调制信号符号速率设置参数,使用外部输入的待调制数据伴随时钟信号与第一 DA 4-1传来的DA采样时钟信号作为数字重采样器3的两个内部时序处理时钟,对第一路2倍采样的基带信号与第二路2倍采样的基带信号分别进行数字重采样处理,产生两路数字重采样基带信号,并将第一路数字重采样基带信号传给第一DA 4-1,将第二路数字重采样基带信号传给第二DA 4-2;
时钟源5产生DA采样时钟信号,并分别传给第一DA 4-1、第二DA(4-2)和数字重采样器3;
第一DA 4-1接收时钟源5产生的DA采样时钟信号,对数字重采样器3输入的第一路数字重采样基带信号进行数模转换,产生并输出第一路模拟基带信号;此外,第一DA 4-1还将接收到的DA采样时钟信号输出给数字重采样器3;
第二DA 4-2接收时钟源5产生的DA采样时钟信号,对数字重采样器3输入的第二路数字重采样基带信号进行数模转换,产生并输出第二路模拟基带信号;
载波源7产生载波信号并输出给模拟正交调制器6;
模拟正交调制器6使用载波源7输出的载波信号,对第一DA 4-1与第二DA 4-2传来的模拟基带信号进行正交混频,然后输出中频模拟调制信号。
进一步的,所述数字重采样器3包括第一数据缓冲器8-1、第二数据缓冲器8-2、数据高位截位器9、数据低位截位器10、累加器11、第一数据循环存储器12-1、第二数据循环存储器12-2、滤波器系数存储器13、第一加权求和器14-1、第二加权求和器14-2、速率匹配器15和累加步进调节器16;其中,
第一数据缓冲器8-1使用待调制数据伴随时钟信号作为其内部时序处理时钟,接收第一成形滤波器2-1输出的数字信号,并以当前输入信号为起始,依次将相邻的3个已输入信号进行组合,产生4个输入信号为一组的组合信号,并将组合信号输出给第一数据循环存储器12-1;
第二数据缓冲器12-2使用待调制数据伴随时钟信号作为其内部时序处理时钟,接收第二低通滤波器2-2输出的数字信号,并以当前输入信号为起始,依次将相邻的3个已输入信号进行组合,产生4个输入信号为一组的组合信号,并将组合信号输出给第二数据循环存储器12-2;
第一数据循环存储器12-1与第二数据循环存储器12-2使用待调制数据伴随时钟信号,对存储空间进行循环写入,从而使第一数据缓冲器8-1与第二数据缓冲器8-2输出的组合信号分别完成循环存储;此外,第一数据循环存储器12-1与第二数据循环存储器12-2使用DA采样时钟信号,接收数据高位截位器9输入的数据读取地址,并输出当前接收到的数据读取地址所对应的已存储的组合信号,第一数据循环存储器12-1输出的组合信号给第一加权求和器14-1,第二数据循环存储器12-2输出的组合信号给第二加权求和器14-2;
滤波器系数存储器13使用DA采样时钟信号接收数据低位截位器10输出的数据读取地址,并将当前接收到的数据读取地址所对应的滤波器组合系数分别输出给第一加权求和器14-1与第二加权求和器14-2;
第一加权求和器14-1使用DA采样时钟信号接收第一数据循环存储器12-1输出的组合信号与滤波器系数存储器13输出的滤波器组合系数,并将滤波器组合系数中的4个滤波器系数依次当做组合信号中4个数据的加权值,完成滤波器组合系数与组合信号的加权求和运算,并将结果输出给第一DA 4-1;
第二加权求和器14-2使用DA采样时钟信号接收第二数据循环存储器12-2输出的组合信号与滤波器系数存储器13输出的滤波器组合系数,并将滤波器组合系数中的4个滤波器系数依次当做组合信号中4个数据的加权值,完成滤波器组合系数与组合信号的加权求和运算,并将结果输出给第二DA 4-2;
累加步进调节器16使用DA采样时钟信号接收速率匹配器15输出的地址信息输出控制信号,当地址信息输出控制信号有效时,累加步进调节器16向累加器11输出第一累加步进值,当地址信息输出控制信号无效时,累加步进调节器16向累加器11输出第二累加步进值;所述预先设置的第一个累加步进值大于预先设置的第二个累加步进值;
累加器11使用DA采样时钟信号接收累加步进调节器16输出的累加步进值以及外部输入的调制信号符号速率设置参数,将其相加后作为新的累加步进值并进行累加计算,产生地址信息并输出给数据高位截位器9与数据低位截位器10;
数据高位截位器9使用DA采样时钟信号接收累加器11输出的地址信息,并将高位地址信息截取处理后输出给第一数据循环存储器12-1与第二数据循环存储器12-2;
数据低位截位器10使用DA采样时钟信号接收累加器11输出的地址信息,并将低位地址信息截取处理后输出给滤波器系数存储器13;
速率匹配器15使用使用DA采样时钟信号接收第二数据缓冲器8-2输出的数据累计缓冲总量数据信号与数据高位截位器9输出的地址高位累计总量数据信号,并对接收的两路数据进行数值比对,产生地址信息输出控制信号并将地址信息输出控制信号输出给累加步进调节器16。
本发明与背景技术相比具有如下优点:
1、本发明采用了数字重采样器对输入DA的正交基带信号采样率进行数字化的动态调整,实现了将接收数据速率与DA采样速率相匹配的功能,避免了加入额外的同源处理硬件,降低了硬件实现规模与成本,同时提高了设备的可靠性。
2、本发明避免产生了在对外部非同源数据进行调制的过程中,由于匹配接收数据速率与DA采样速率,而额外在调制装置内部产生并与输入待调制数据一起进行调制的空帧,从而提高了调制装置的调制传输效率,也降低了对调制信号传输信道带宽的要求,同时避免了解调装置对空帧的识别与处理,降低了解调装置相应的实现难度。
3、本发明采用数字方式实现了接收数据速率与DA采样速率相匹配的功能,结构简单,可移植性强。由于目前主流FPGA中都集成有ROM、查找表、乘法器和加法器等单元,本发明可通过嵌入式软件的方式实现,具有较强的推广应用价值。
附图说明
图1是本发明实施例的电路原理框图。
图2是图1中数字重采样器的电路原理框图。
具体实施方式
下面结合附图对本发明的技术方案做进一步的说明。
参照图1,一种基于数字重采样的非同源数据接收调制装置,其包括符号映射器1、成形滤波器2-1和成形滤波器2-2、数字重采样器3、DA 4-1和DA 4-2、时钟源5、模拟正交调制器6和载波源7组成。其中:
符号映射器1对输入的待调制数据进行正交符号映射,这里符号映射器使用外部输入的待调制数据伴随时钟信号进行时序逻辑运算,符号映射器1完成正交符号映射处理后,将映射产生的两路正交信号分别输入成形滤波器2-1与成形滤波器2-2;
成形滤波器2-1与成形滤波器2-2接收符号映射器1输入的正交信号,并按照2倍采样率对输入的正交信号进行成形滤波处理,成形滤波器2-1与成形滤波器2-2使用外部输入的待调制数据伴随时钟信号进行时序逻辑运算,成形滤波器2-1与成形滤波器2-2输出的基带信号输入数字重采样器3;
数字重采样器3根据输入的调制信号符号速率设置参数,对输入的2倍采样正交符号基带信号进行数字重采样处理,数字重采样器3使用待调制数据伴随时钟信号和DA采样处理时钟信号进行局部时序逻辑运算,并通过内部速率匹配,自动调整数字重采样器输出基带信号的采样率,从而达到将非同源数据速率与DA采样速率进行匹配的目的,数字重采样器3输出的两路基带信号分别输入DA 4-1和DA 4-2;
时钟源5产生DA采样时钟信号,并将DA采样时钟信号输入DA 4-1与DA 4-2;
DA 4-1与DA 4-2接收时钟源5产生的DA采样时钟信号,对数字重采样器3输入的两路基带信号进行数模转换,输出模拟正交信号;此外,DA 4-1和DA 4-2还将DA采样时钟信号输出,其中,DA 4-1输出的DA采样时钟信号传给数字重采样器3,DA 4-2输出的DA采样时钟信号不做使用;
载波源7产生载波信号并输出;
模拟正交调制器6接收DA 4-1与DA 4-2输出的模拟正交信号,模拟正交调制器6接收并使用载波源7输出的载波信号,对DA 4-1与DA 4-2输入的模拟正交信号进行正交混频后,输出中频模拟调制信号。
图2是数字重采样器的原理方框图,实施例按图2连接线路。数字重采样器3包括数据缓冲器8-1和数据缓冲器8-2、数据高位截位器9、数据低位截位器10、累加器11、数据循环存储器12-1和数据循环存储器12-2、滤波器系数存储器13、加权求和器14-1和加权求和器14-2、速率匹配器15和累加步进调节器16。其中:
数据缓冲器8-1使用待调制数据伴随时钟信号进行时序逻辑处理,数据缓冲器8-1接收成形滤波器2-1输出的数字信号,并以当前输入信号为起始,依次将相邻的3个已输入信号进行组合,产生4个输入信号为一组的组合信号,并将组合信号输出给数据循环存储器12-1;
数据缓冲器8-2使用待调制数据伴随时钟信号进行时序逻辑处理,数据缓冲器8-2接收低通滤波器2-2输出的数字信号,并以当前输入信号为起始,依次将相邻的3个已输入信号进行组合,产生4个输入信号为一组的组合信号,并将组合信号输出给数据循环存储器12-2;
数据循环存储器12-1与数据循环存储器12-2使用待调制数据伴随时钟信号对存储空间进行循环写入,从而使数据缓冲器8-1与数据缓冲器8-2输出的组合信号分别完成循环存储;同时,数据循环存储器12-1与数据循环存储器12-2使用DA采样处理时钟信号接收数据高位截位器9产生并输出的数据读取地址,并使用DA采样处理时钟信号输出当前接收到的数据读取地址对应的已存储的组合信号;数据循环存储器12-1与数据循环存储器12-2输出的组合信号分别输入加权求和器14-1与加权求和器14-2;
滤波器系数存储器13使用DA采样时钟信号接收数据低位截位器10输出的数据读取地址,并输出当前接收到的数据读取地址对应的滤波器组合系数,每组输出的滤波器组合系数均包含4个滤波器系数;
加权求和器14-1使用DA采样处理时钟信号进行时序逻辑处理,加权求和器14-1接收数据循环存储器12-1输出的组合信号与滤波器系数存储器13输出的滤波器组合系数,并将滤波器组合系数中的4个滤波器系数依次当做组合信号中4个数据的加权值,完成滤波器组合系数与组合信号的加权求和运算,并将结果输出给DA 4-1;
加权求和器14-2使用DA采样处理时钟信号进行时序逻辑处理,加权求和器14-2接收数据循环存储器12-2输出的组合信号与滤波器系数存储器13输出的滤波器组合系数,并将滤波器组合系数中的4个滤波器系数依次当做组合信号中4个数据的加权值,完成滤波器组合系数与组合信号的加权求和运算,并将结果输出给DA 4-2;
累加步进调节器16使用DA采样处理时钟信号接收速率匹配器15输出的地址信息输出控制信号,当地址信息输出控制信号有效时,累加步进调节器16输出大的累加步进,当地址信息输出控制信号无效时,累加步进调节器16输出小的累加步进,累加步进调节器16将累加步进信号输入累加器11;
累加器11使用DA采样时钟信号接收累加步进调节器16输出的累加步进信号与调制信号符号速率设置参数,将其合并后作为新的累加步进值进行累加计算,产生地址信息并输出给数据高位截位器9与数据低位截位器10;
数据高位截位器9使用DA采样时钟信号接收累加器11输出的地址信息,并将高位地址信息截取处理后输出给数据循环存储器12-1与数据循环存储器12-2;
数据低位截位器10使用DA采样处理时钟信号进行时序逻辑处理,数据低位截位器10接收累加器11输出的地址信息,并将低位地址信息截取处理后输出给滤波器系数存储器13;
速率匹配器15使用DA采样处理时钟信号进行时序逻辑处理,速率匹配器15接收数据缓冲器8-2输出的数据累计缓冲总量数据信号与数据高位截位器9输出的地址高位累计总量数据信号,并对接收的两路数据进行数值比对,产生地址信息输出控制信号并输。
本发明工作时,符号映射器1对输入的待调制数据进行正交符号映射,这里符号映射器使用外部输入的待调制数据伴随时钟信号进行时序逻辑运算,符号映射器1完成正交符号映射处理后,将映射产生的两路正交信号分别输入成形滤波器2-1与成形滤波器2-2;成形滤波器2-1与成形滤波器2-2接收符号映射器1输入的正交信号,并按照2倍采样率对输入的正交信号进行成形滤波处理,成形滤波器2-1与成形滤波器2-2使用外部输入的待调制数据伴随时钟信号进行时序逻辑运算,成形滤波器2-1与成形滤波器2-2输出的基带信号输入数字重采样器3;数字重采样器3根据输入的调制信号符号速率设置参数,对输入的2倍采样正交符号基带信号进行数字重采样处理,数字重采样器3使用待调制数据伴随时钟信号和DA采样处理时钟信号进行局部时序逻辑运算,并通过内部速率匹配,自动调整数字重采样器输出基带信号的采样率,从而达到将非同源数据速率与DA采样速率进行匹配的目的,数字重采样器3输出的两路基带信号分别输入DA 4-1和DA 4-2;时钟源5产生DA采样时钟信号,并将DA采样时钟信号输入DA 4-1与DA 4-2;DA 4-1与DA 4-2接收时钟源5产生的DA采样时钟信号,对数字重采样器3输入的两路基带信号进行数模转换,DA 4-1将DA采样时钟信号输入数字重采样器3,DA 4-1与DA 4-2输出模拟正交信号;载波源7产生载波信号并输出;模拟正交调制器6接收DA 4-1与DA 4-2输出的模拟正交信号,模拟正交调制器6接收并使用载波源7输出的载波信号,对DA 4-1与DA 4-2输入的模拟正交信号进行正交混频后,输出中频模拟调制信号。
该装置可对非同源数据进行接收并调制。相对于传统的同源数据接收调制装置,本装置由于采用了数字重采样器对输入DA的正交基带信号采样率进行数字化的动态调整,实现了将接收数据速率与DA采样速率相匹配的功能,避免了加入额外的同源处理硬件,降低了硬件实现规模与成本,同时提高了设备的可靠性。此外,本发明还避免产生了在对外部非同源数据进行调制的过程中,由于匹配接收数据速率与DA采样速率,而额外在调制装置内部产生并与输入待调制数据一起进行调制的空帧,从而提高了调制装置的调制传输效率,降低了对调制信号传输信道带宽的要求,同时避免了解调装置对空帧的识别与处理,降低了解调装置相应的实现难度。
Claims (2)
1.一种基于数字重采样的非同源数据接收调制装置,其特征在于,包括符号映射器(1)、第一成形滤波器(2-1)、第二成形滤波器(2-2)、数字重采样器(3)、第一DA(4-1)、第二DA(4-2)、时钟源(5)、模拟正交调制器(6)和载波源(7);
符号映射器(1)接收外部输入的待调制数据与待调制数据伴随时钟信号,并使用待调制数据伴随时钟信号作为符号映射器(1)内部时序处理时钟,对接收的待调制数据进行符号映射处理,产生两路符号映射信号,并将第一路符号映射信号输出给第一成形滤波器(2-1),将第二路符号映射信号输出给第二成形滤波器(2-2);
第一成形滤波器(2-1)接收外部输入的待调制数据伴随时钟信号与符号映射器(1)输入的第一路符号映射信号,并使用待调制数据伴随时钟信号作为第一成形滤波器(2-1)的内部时序处理时钟,对接收的第一路符号映射信号进行成形滤波处理,产生第一路2倍采样的基带信号,并将该信号输出给数字重采样器(3);
第二成形滤波器(2-2)接收外部输入的待调制数据伴随时钟信号与符号映射器(1)输入的第二路符号映射信号,并使用待调制数据伴随时钟信号作为第二成形滤波器(2-2)的内部时序处理时钟,对接收的第二路符号映射信号进行成形滤波处理,产生第二路2倍采样的基带信号,并将该信号输出给数字重采样器(3);
数字重采样器(3)根据外部输入的调制信号符号速率设置参数,使用外部输入的待调制数据伴随时钟信号与第一 DA(4-1)传来的DA采样时钟信号作为数字重采样器(3)的两个内部时序处理时钟,对第一路2倍采样的基带信号与第二路2倍采样的基带信号分别进行数字重采样处理,产生两路数字重采样基带信号,并将第一路数字重采样基带信号传给第一DA(4-1),将第二路数字重采样基带信号传给第二DA(4-2);
时钟源(5)产生DA采样时钟信号,并分别传给第一DA(4-1)、第二DA(4-2)和数字重采样器(3);
第一DA(4-1)接收时钟源(5)产生的DA采样时钟信号,对数字重采样器(3)输入的第一路数字重采样基带信号进行数模转换,产生并输出第一路模拟基带信号;此外,第一DA(4-1)还将接收到的DA采样时钟信号输出给数字重采样器(3);
第二DA(4-2)接收时钟源(5)产生的DA采样时钟信号,对数字重采样器(3)输入的第二路数字重采样基带信号进行数模转换,产生并输出第二路模拟基带信号;
载波源(7)产生载波信号并输出给模拟正交调制器(6);
模拟正交调制器(6)使用载波源(7)输出的载波信号,对第一DA(4-1)与第二DA(4-2)传来的模拟基带信号进行正交混频,然后输出中频模拟调制信号。
2.根据权利要求1所述的一种基于数字重采样的非同源数据接收调制装置,其特征在于,所述数字重采样器(3)包括第一数据缓冲器(8-1)、第二数据缓冲器(8-2)、数据高位截位器(9)、数据低位截位器(10)、累加器(11)、第一数据循环存储器(12-1)、第二数据循环存储器(12-2)、滤波器系数存储器(13)、第一加权求和器(14-1)、第二加权求和器(14-2)、速率匹配器(15)和累加步进调节器(16);其中,
第一数据缓冲器(8-1)使用待调制数据伴随时钟信号作为其内部时序处理时钟,接收第一成形滤波器(2-1)输出的数字信号,并以当前输入信号为起始,依次将相邻的3个已输入信号进行组合,产生4个输入信号为一组的组合信号,并将组合信号输出给第一数据循环存储器(12-1);
第二数据缓冲器(12-2)使用待调制数据伴随时钟信号作为其内部时序处理时钟,接收第二低通滤波器(2-2)输出的数字信号,并以当前输入信号为起始,依次将相邻的3个已输入信号进行组合,产生4个输入信号为一组的组合信号,并将组合信号输出给第二数据循环存储器(12-2);
第一数据循环存储器(12-1)与第二数据循环存储器(12-2)使用待调制数据伴随时钟信号,对存储空间进行循环写入,从而使第一数据缓冲器(8-1)与第二数据缓冲器(8-2)输出的组合信号分别完成循环存储;此外,第一数据循环存储器(12-1)与第二数据循环存储器(12-2)使用DA采样时钟信号,接收数据高位截位器(9)输入的数据读取地址,并输出当前接收到的数据读取地址所对应的已存储的组合信号,第一数据循环存储器(12-1)输出的组合信号给第一加权求和器(14-1),第二数据循环存储器(12-2)输出的组合信号给第二加权求和器(14-2);
滤波器系数存储器(13)使用DA采样时钟信号接收数据低位截位器(10)输出的数据读取地址,并将当前接收到的数据读取地址所对应的滤波器组合系数分别输出给第一加权求和器(14-1)与第二加权求和器(14-2);
第一加权求和器(14-1)使用DA采样时钟信号接收第一数据循环存储器(12-1)输出的组合信号与滤波器系数存储器(13)输出的滤波器组合系数,并将滤波器组合系数中的4个滤波器系数依次当做组合信号中4个数据的加权值,完成滤波器组合系数与组合信号的加权求和运算,并将结果输出给第一DA(4-1);
第二加权求和器(14-2)使用DA采样时钟信号接收第二数据循环存储器(12-2)输出的组合信号与滤波器系数存储器(13)输出的滤波器组合系数,并将滤波器组合系数中的4个滤波器系数依次当做组合信号中4个数据的加权值,完成滤波器组合系数与组合信号的加权求和运算,并将结果输出给第二DA(4-2);
累加步进调节器(16)使用DA采样时钟信号接收速率匹配器(15)输出的地址信息输出控制信号,当地址信息输出控制信号有效时,累加步进调节器(16)向累加器(11)输出预先设置的第一累加步进值,当地址信息输出控制信号无效时,累加步进调节器(16)向累加器(11)输出预先设置的第二累加步进值;所述预先设置的第一累加步进值大于预先设置的第二累加步进值;
累加器(11)使用DA采样时钟信号接收累加步进调节器(16)输出的累加步进值以及外部输入的调制信号符号速率设置参数,将其相加后作为新的累加步进值并进行累加计算,产生地址信息并输出给数据高位截位器(9)与数据低位截位器(10);
数据高位截位器(9)使用DA采样时钟信号接收累加器(11)输出的地址信息,并将高位地址信息截取处理后输出给第一数据循环存储器(12-1)与第二数据循环存储器(12-2);
数据低位截位器(10)使用DA采样时钟信号接收累加器(11)输出的地址信息,并将低位地址信息截取处理后输出给滤波器系数存储器(13);
速率匹配器(15)使用使用DA采样时钟信号接收第二数据缓冲器(8-2)输出的数据累计缓冲总量数据信号与数据高位截位器(9)输出的地址高位累计总量数据信号,并对接收的两路数据进行数值比对,产生地址信息输出控制信号并将地址信息输出控制信号输出给累加步进调节器(16)。
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