CN112086046B - 显示装置及其驱动方法 - Google Patents

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Abstract

公开了一种显示装置及其驱动方法。显示装置接收针对供应给显示面板的脉冲信号的反馈信号,感测扫描信号的脉冲宽度,并且响应于反馈信号的脉冲宽度,针对显示面板的每个屏幕位置改变移位时钟的脉冲宽度和移位时钟的脉冲电压中的一个或两个。

Description

显示装置及其驱动方法
相关申请的交叉引用
本申请要求于2019年6月13日提交的韩国专利申请No.10-2019-0070173的优先权和权益,通过引用将该韩国专利申请的全部公开内容并入本文中。
技术领域
本公开涉及一种被配置为感测驱动元件的电特性并补偿电特性的偏差或改变的显示装置及其驱动方法。
背景技术
电致发光显示器根据发光层的材料被分类为无机发光显示装置和有机发光显示装置。有源矩阵型有机发光显示装置包括有机发光二极管(OLED),该有机发光二极管自身发光,并且具有响应速率快、发光效率高、亮度高以及视角大的优点。有机发光显示装置具有形成在像素中的OLED。有机发光显示装置可以表现出黑色灰度级作为完美的黑色,并且具有快速的响应速率、高发光效率、高亮度和大视角,并且因此具有优异的对比度和色域。
有机发光显示装置不需要背光单元,并且可以在柔性塑料基板、薄玻璃基板或金属基板上实施。因此,柔性显示器可以被实施为有机发光显示装置。
柔性显示器可以具有通过缠绕、折叠或弯曲显示面板而实现的尺寸和形式可变的屏幕。柔性显示器可以被实施为可卷曲显示器、可弯曲显示器、可折叠显示器、可滑动显示器等。除了诸如智能电话和平板PC的移动装置之外,这种柔性显示装置还可以应用于电视、车辆显示器、可穿戴装置等,并且应用领域正在扩大。
有机发光显示装置的像素包括OLED、用于通过根据栅极-源极电压Vgs调节流过OLED的电流来驱动OLED的驱动元件、用于维持驱动元件的栅极电压的存储电容器等。
驱动元件可以被实施为晶体管。为了使有机发光显示装置的整个屏幕的图像质量均匀,驱动元件可以对于每个像素具有均匀的电特性。由于在显示面板的制造工艺中引起的工艺偏差和器件特性偏差,像素的驱动元件的电特性之间可能存在差异,并且这些差异可能随着像素的驱动时间的流逝而增加。为了补偿像素的驱动元件的电特性偏差,可以将内部补偿技术或外部补偿技术应用于有机发光显示装置。
发明内容
内部补偿技术使用嵌入在每个像素中的内部补偿电路来感测每个子像素的驱动元件的阈值电压,并补偿驱动元件的栅极-源极电压Vgs的阈值电压。
外部补偿技术使用外部补偿电路来感测根据驱动元件的电特性而改变的驱动元件的电流或电压。外部补偿技术通过经由针对每个像素感测到的驱动元件的电特性偏差(改变)来调制输入图像的像素数据(数字数据),来补偿每个像素的驱动元件的电特性的偏差(改变)。
为了驱动有机发光显示装置的像素,将诸如像素驱动电压VDD和低电位电源电压VSS之类的电压共同施加到像素。然而,这些电压VDD和VSS具有的电压降量根据IR降在屏幕中的位置而变化。当VDD改变时,驱动OLED的驱动元件的栅极-源极电压Vgs和漏极-源极电流Ids改变,因此可能发生像素的亮度改变。
在内部补偿技术的情况下,所有像素应具有相同的感测周期,在该感测周期中感测驱动元件的阈值电压。然而,当栅极信号的导通时间根据像素而变化时,感测周期改变。栅极信号的导通时间可以根据栅极信号的脉冲宽度来确定。栅极信号的导通时间可以根据施加到栅极驱动电路的移位时钟线的电阻器-电容器(RC)延迟而变化。例如,可以在移位时钟线的RC延迟大的位置处减小像素中的感测周期。在显示面板中,通过其施加时钟或模拟电压的线可以具有RC延迟。当感测信号根据像素而变化时,不能准确地感测驱动元件的阈值电压。
根据实验测量,在有机发光显示装置的情况下,IR降的影响被改变,该IR降导致像素数据的每个灰度级的亮度波动。对于高灰度级,流过OLED的电流量高,因此IR降的量高。IR降的量随着像素和驱动IC之间的距离增加而增加。对于低灰度级,由于流过OLED的电流量小,因此IR降的量小。根据实验结果,在低灰度级的情况下,由于感测周期的减小而导致的亮度下降大于由于IR降而导致的亮度下降。
本公开旨在解决前述需求和/或问题。
本公开提供了一种能够减小由于感测周期偏差而引起的像素之间的亮度差异的显示装置及其驱动方法。
应当注意,本公开的目的不限于上述目的,并且根据以下描述,本文中未描述的其他目的对于本领域技术人员将是显而易见的。
根据本公开的实施例,提供了一种显示装置,其包括:显示面板,其中数据线和栅极线彼此相交,并且其中像素以矩阵形式设置;栅极驱动单元,其形成在显示面板上,并被配置为将扫描信号供应给栅极线;移位时钟线,其形成在显示面板上,并配置为将移位时钟供应给栅极驱动单元;感测装置,其被配置为接收供应给显示面板的反馈信号并感测扫描信号的脉冲宽度;以及驱动装置,其被配置为向数据线供应数据电压并生成移位时钟。
驱动装置响应于由感测装置感测到的反馈信号的脉冲宽度,针对显示面板的每个屏幕位置改变移位时钟的脉冲宽度和移位时钟的脉冲电压中的一者或两者。
根据本公开的另一实施例,提供了一种显示装置的驱动方法,该驱动方法包括:接收针对供应给显示面板的脉冲信号的反馈信号,并感测扫描信号的脉冲宽度;以及响应于感测到的反馈信号的脉冲宽度,针对显示面板的每个屏幕位置改变移位时钟的脉冲宽度和移位时钟的脉冲电压中的一者或两者。
附图说明
通过参考附图详细描述本公开的示例性实施例,本公开的上述和其他目的、特征和优点对于本领域普通技术人员将变得更加显而易见,在附图中:
图1是示出根据本公开的实施例的显示装置的框图;
图2是示出pentile像素布置的示例的示图;
图3是示出实际像素布置的示例的示图;
图4是示出图1所示的驱动集成电路(IC)构造的框图;
图5是示意性地示出栅极驱动单元中的移位寄存器的电路构造的示图;
图6A和图6B是示意性示出传输门电路和边缘触发电路的示图;
图7是示出图6所示的第N级的Q节点电压、QB节点电压和输出电压的波形图;
图8是示出根据本公开的实施例的栅极驱动单元中的一级电路的电路图;
图9是示出图8所示的电路的输入/输出波形的波形图;
图10是示意性地示出本公开的像素电路的示图;
图11和图12是具体示出图10所示的像素电路的电路图;
图13A至图15B是一步一步地示出图11中所示的像素电路的操作的示图;
图16A至图18B是一步一步地示出图15中所示的像素电路的操作的示图;
图19是示出屏幕上的基于灰度的亮度测量位置的示图;
图20是示出在图19中所示的测量位置处测量的基于灰度的亮度值的示图;
图21是示出与屏幕中的位置对应的感测周期的示图;
图22是示出根据屏幕中的位置和灰度级测量的驱动元件的栅极-源极电压的改变的示图;
图23是示出根据本公开的第一实施例的感测装置的示图;
图24是具体示出图23所示的栅极驱动单元中的第N级的电路图;
图25和图26是根据存在或不存在图24中所示的第九晶体管来比较感测操作的示图;
图27是示出可连接到本公开的感测装置的显示面板上的AP检查电路的示图;
图28是示出根据本公开的第二实施例的感测装置的示图;
图29是示出连接在像素阵列和感测单元之间的多路复用器的示图;
图30是具体示出一个帧周期中的垂直消隐周期和有效间隔的示图;
图31是示出针对屏幕中的每个位置的感测周期的感测方法的波形图;
图32是示出用于减小屏幕的所有像素中的感测周期的偏差的移位时钟的脉冲宽度调制方法的示例的波形图;
图33和图34是示出使用查找表和感测单元来对移位时钟的脉冲宽度进行调制的装置的示图;
图35是示出具有在一个帧周期期间针对屏幕中的每个位置进行调制的脉冲宽度的移位时钟的示例的波形图;
图36是示出针对屏幕中每个位置的感测周期和施加到像素的移位时钟的波形图;
图37是示出沿时间轴施加于显示面板的栅极导通电压的改变的波形图;
图38A是示出在电平移位器的输出节点处测量的移位时钟的波形图;
图38B是示出当如图38A所示的移位时钟施加于显示面板上的移位时钟线时,其中反映了电阻器-电容器(RC)延迟的移位时钟的波形的波形图;
图39和图40是示出使用查找表和感测单元来对移位时钟的栅极导通电压进行调制的装置的示图;
图41和图42是示出具有对于屏幕中的每个位置都不的同电压电平的栅极导通电压的示图;
图43是示出像素驱动电压根据灰度级而变化的示例的示图;
图44是示出当以与本公开的实施例相同的方式对像素驱动电压和栅极导通电压进行调制时,对处于较高灰度级的屏幕的亮度均匀性的改善的亮度测量结果的示图;
图45是示出当以与本公开的实施例相同的方式对像素驱动电压和栅极导通电压进行调制时,对处于较低灰度级的屏幕的亮度均匀性的改善的亮度测量结果的示图;以及
图46是示出屏幕上的亮度测量位置的示图。
具体实施方式
通过下面参考附图详细描述的实施例,本公开的优点、特征及其实施方式将变得清楚。然而,本公开不限于以下实施例并且将以各种形式来实施。本公开的示例性实施例使本公开的公开内容更加透彻并且被提供以使得本公开的范围被完全传达给本领域技术人员。因此,本公开将由所附权利要求的范围来限定。
在附图中公开的用于描述本公开的实施例的图形、尺寸、比率、角度、数量等仅是例示性的,并且不限于本公开中所示的内容。在整个本公开中,类似的附图标记指代类似的元件。此外,在描述本公开时,当确定众所周知的技术可能不必要地使本公开内容的主旨模糊时,将省略对这些技术的详细描述。这里使用的诸如“包括”和“具有”之类的术语旨在允许添加其他元件,除非该术语与术语“仅”一起使用。除非另有明确说明,否则对单数的任何提及均可以包括复数。
即使没有明确的描述,也将部件解释为包括普通误差范围。
在描述位置关系时,例如,当将两个部分的位置关系描述为“在...上”、“在...上方”、“在...下方”以及“在...旁边”等时,除非在表述中使用术语“立即”或“直接”,否则一个或多个部分可能插入这两个部分之间。
在描述实施例时,诸如第一、第二等的术语用于描述各种元件,但是这些元件不受这些术语的限制。这些术语仅用于区分一个元件和另一个元件。因此,在不脱离本公开的教导的情况下,下面讨论的第一元件可以被称为第二元件。
在整个本公开中,类似的附图标记指代类似的元件。
各个实施例的特征可以部分或全部彼此结合或组合。实施例可以在技术上以各种方式互操作和执行,并且可以彼此独立或关联地执行。
本公开的显示装置中的栅极驱动单元和像素电路中的每个可以包括多个晶体管。每个晶体管可以被实施为包括氧化物半导体的氧化物薄膜晶体管(TFT)、包括LTPS的低温多晶硅(LTPS)TFT等。每个晶体管可以被实施为具有p沟道或n沟道金属氧化物半导体场效应晶体管(MOSFET)结构的晶体管。将集中于其中像素电路的晶体管被实施为p沟道晶体管的示例来描述以下实施例,但是本公开不限于此。
晶体管是三电极元件,包括栅极、源极和漏极。源极是电极,通过该电极将载流子供应给晶体管。在晶体管中,载流子开始从源极流出。漏极是电极,载流子通过该电极离开晶体管。晶体管中的载流子从源极流到漏极。在n沟道晶体管的情况下,载流子是电子。因此,源极电压低于漏极电压,使得电子可以从源极流向漏极。在n沟道晶体管中,电流从漏极流到源极。在p沟道晶体管的情况下,载流子是空穴。因此,源极电压高于漏极电压,使得空穴可以从源极流向漏极。由于p沟道晶体管中的空穴从源极流到漏极,因此电流从源极流到漏极。应当注意,晶体管的源极和漏极不是固定的。例如,可以根据施加的电压来改变源极和漏极。因此,本公开不受晶体管的源极和漏极的限制。在下面的描述中,将晶体管的源极和漏极分别称为第一电极和第二电极。
栅极信号在栅极导通电压和栅极截止电压之间摆动。栅极导通电压被设置为高于晶体管的阈值电压的电压,并且栅极截止电压被设置为低于晶体管的阈值电压的电压。响应于栅极导通电压而使晶体管接通,而响应于栅极截止电压而使晶体管关断。在n沟道晶体管的情况下,栅极导通电压可以是栅极高电压VGH/VEH,并且栅极截止电压可以是栅极低电压VGL/VEL。在p沟道晶体管的情况下,栅极导通电压可以是栅极低电压VGL/VEL,并且栅极截止电压可以是栅极高电压VGH/VEH。
本公开的每个像素包括发光元件、被配置为根据栅极-源极电压而调节流过发光元件的电流的驱动元件、以及内部补偿电路,该内部补偿电路被配置为在由扫描信号的脉冲限定的感测周期感测驱动元件的阈值电压,并将阈值电压供应给电容器。内部补偿电路包括:电容器,其连接至驱动元件的栅极;以及一个或多个开关元件,其被配置为将电容器连接至驱动元件和发光元件。内部补偿电路可以包括多个开关元件和如图11和图12所示的电容器。
本公开的显示装置包括:感测装置,其被配置为接收针对供应给显示面板的脉冲的反馈信号,并感测扫描信号的脉冲宽度;以及驱动装置,其被配置为向数据线供应数据电压并生成移位时钟。响应于由感测装置实时感测到的反馈信号的脉冲宽度,驱动装置基于显示面板的屏幕位置来改变移位时钟的脉冲宽度和移位时钟的脉冲电压中的一者或两者。
在以下实施例中,将驱动装置描述为驱动集成电路(IC)。另外,在以下实施例中,反馈信号可以是针对供应给连接到栅极驱动单元的移位时钟线的移位时钟的反馈信号,或者是针对施加到测试数据线的脉冲的反馈信号。
在下文中,将参考附图详细描述本公开的各种实施例。
参考图1至图4,本公开的显示装置包括显示面板100以及显示面板驱动单元120和300。
显示面板驱动单元120和300将输入图像的像素数据写入屏幕的像素并在屏幕上显示图像。显示面板驱动单元120和300包括:栅极驱动单元120,其被配置为向显示面板100的栅极线GL1和GL2供应栅极信号;数据驱动单元306,其被配置为将像素数据转换为数据信号的电压,并通过激活的数据输出通道将电压供应给数据线;以及时序控制器303,其被配置为控制数据驱动单元306和栅极驱动单元120的操作时序。数据驱动单元306和时序控制器303可以集成到驱动IC 300中。驱动IC 300可以被称为“驱动单元”300。
显示面板100的屏幕包括数据线DL1至DL6、与数据线DL1至DL6相交的栅极线GL1和GL2以及其中像素P以矩阵形式布置的像素阵列。像素P以由数据线DL1至DL6以及栅极线GL1和GL2限定的矩阵形式布置在像素阵列中。
对于颜色表示,像素P中的每个包括具有不同颜色的子像素。子像素包括红色子像素RED(以下称为“R子像素”)、绿色子像素GREEN(以下称为“G子像素”)和蓝色子像素BLUE(以下称为“B子像素”)。尽管未示出,但是每个所述像素可以还包括白色子像素。子像素以由数据线DL1至DL6以及栅极线GL1和GL2限定的矩阵形式布置。在下文中,像素可以被解释为子像素。
子像素中的每个可以包括内部补偿电路,该内部补偿电路被配置为感测驱动元件的电特性,例如阈值电压,并且补偿驱动元件的栅极电压。
像素P可以以实际颜色像素或pentile像素的形式布置。通过使用预设的pentile像素渲染算法,如图2所示,通过将具有不同颜色的两个子像素作为一个像素P来驱动,pentile像素可以实施比实际颜色像素更高的分辨率。pentile像素渲染算法用相邻像素P中发出的光的颜色补偿每个像素P中的颜色的缺乏。
对于实际颜色像素,如图3所示,一个像素P由R、G和B子像素组成。
当像素阵列的分辨率为N*M时,像素阵列包括N个像素列COLUMN和与像素列相交的M个像素行。像素列包括沿y轴方向布置的像素。像素行包括沿x轴方向布置的像素。在图2和图3中,#1和#2指示像素行号。一个水平周期1H是通过将一个帧周期除以M(像素行的数量)而获得的时间周期。栅极驱动单元120可以通过以从第一像素行到第M像素行的顺序输出栅极信号来以一条线为单位逐步扫描像素。一个像素行中的像素可以在一个水平周期内操作用于初始化、感测和数据写入。
显示面板100的像素阵列可以形成在玻璃基板、金属基板或塑料基板上。通过在塑料基板上形成像素阵列,可以将塑料OLED面板实施为柔性面板。塑料OLED面板具有在粘附到背板上的有机薄膜上形成的像素阵列。触摸传感器阵列可以形成在像素阵列上方。
背板可以是聚对苯二甲酸乙二酯(PET)基板。有机薄膜形成在背板上。像素阵列和触摸传感器阵列可以形成在有机薄膜上。背板阻止水分渗透到有机薄膜中,从而使像素阵列不暴露于湿气。有机薄膜可以是聚酰亚胺(PI)薄膜基板。多层缓冲膜可以形成在有机薄膜上并且可以由绝缘材料(未示出)形成。可以在有机薄膜上形成用于供应电力或施加到像素阵列和触摸传感器阵列的信号的线。
栅极驱动单元120可以与像素阵列一起安装在显示面板100的基板上。直接形成在显示面板100的基板上的栅极驱动单元120被称为面板内栅极(GIP)电路。
栅极驱动单元120可以设置在显示面板100的左和右边框BEZEL之一处,从而以单馈方式将栅极信号供应给栅极线GL1和GL2。在这种情况下,图1中所示的两个栅极驱动单元120之一是不需要的。
栅极驱动单元120可以设置在显示面板100的左和右边框处,从而以双馈方式将栅极信号供应给栅极线GL1和GL2。在双馈方式中,可以将栅极信号同时施加到一条栅极线的两端。
使用移位寄存器根据从驱动IC 300供应的栅极时序信号来驱动栅极驱动单元120,以将栅极信号GATE1和GATE2顺序供应给栅极线GL1和GL2。移位寄存器可以通过对栅极信号GATE1和GATE2进行移位来将栅极信号GATE1和GATE2顺序供应给栅极线GL1和GL2。栅极信号GATE1和GATE2可以包括扫描信号SCAN1、SCAN2、SCAN(N-1)和SCAN(N)、发射控制信号EM和EM(N)等,如图11和图12所示。在下面的描述中,发射控制信号被称为EM信号。
驱动IC 300通过数据输出通道连接到数据线DL1至DL6,以将数据信号的电压(以下称为“数据电压”)供应给数据线DL1至DL6。驱动IC 300可以通过栅极时序信号输出通道输出用于控制栅极驱动单元120的栅极时序信号。
如图4所示,驱动IC 300可以连接到主机系统200、第一存储器301和显示面板100。驱动IC 300可以包括数据接收和计算单元308、时序控制器303和数据驱动单元306。驱动IC300还可以包括伽马补偿电压生成单元305、电源单元304、第二存储器302、电平移位器307等。驱动IC 300还可以包括连接在时序控制器303和显示面板100的反馈线52之间的感测单元230。
时序控制器303将从主机系统200接收的输入图像的像素数据提供给数据驱动单元306。时序控制器303可以生成用于控制栅极驱动单元120的栅极时序信号和用于控制数据驱动单元306的源极时序信号,以控制栅极驱动单元120和数据驱动单元306的操作时序。
感测单元230基于通过反馈线52接收的反馈信号来感测针对屏幕的每个位置的感测周期。感测周期由扫描信号的脉冲宽度定义。可以以与输入到栅极驱动单元120的移位时钟GCLK的脉冲相同的脉冲宽度和电压来生成扫描信号的脉冲。感测单元230通过从用于单独脉冲信号或移位时钟GCLK的脉冲的反馈信号中针对屏幕的每个位置测量脉冲的电阻器-电容器(RC)延迟,来感测针对屏幕的每个位置的像素的感测周期。反馈信号通过形成在显示面板100上的反馈线52反馈到感测单元230。
时序控制器303可以考虑到由感测单元230针对屏幕的每个位置实时感测的像素P的感测周期偏差,来改变施加到栅极驱动电路的移位时钟的脉冲宽度或电压。结果,通过精确地感测具有移位时钟线的RC延迟的平滑的显示面板的所有像素中的驱动元件的电特性,可以在整个屏幕上实现均匀的图像质量。
驱动IC 300可以生成用于通过电平移位器307和时序控制器303驱动栅极驱动单元120的栅极时序信号。栅极时序信号包括诸如起始脉冲VST、移位时钟GCLK等的栅极时序信号以及诸如栅极导通电压VGL/VEL和栅极截止电压VGH/VEH的栅极电压。起始脉冲VST和移位时钟GCLK在栅极导通电压VGL/VEL和栅极截止电压VGH/VEH之间摆动。
数据接收和计算单元308包括:接收单元,其被配置为从主机系统200接收作为数字信号输入的输入数据;以及数据计算单元,其被配置为使用预设图像质量算法对通过接收单元输入的输入图像信号的像素数据进行调制以改善图像质量。数据计算单元可以包括:数据恢复单元,其被配置为通过对压缩的像素数据进行解码来执行恢复;光学补偿单元,其被配置为向像素数据添加预设光学补偿值;等等。光学补偿值可以被设置为用于基于屏幕的亮度补偿每块像素数据的亮度的值,该屏幕的亮度是基于在制造工艺中捕获的相机图像测量的。
数据驱动单元306使用数模转换器(以下称为“DAC”)将从时序控制器303接收的像素数据(数字信号)转换为伽马补偿电压,并输出数据信号DATA1至DATA6的电压(以下称为数据电压)。从数据驱动单元306输出的数据电压通过连接至驱动IC 300的数据通道的输出缓冲器(源极AMP)被供应至像素阵列的数据线DL1至DL6。
伽马补偿电压生成单元305通过经由分压器电路将从电源单元304接收到的伽马参考电压进行分压,从而为每个灰度级生成伽马补偿电压。伽马补偿电压是其中为像素数据的每个灰度级设置电压的模拟电压。从伽马补偿电压生成单元305输出的伽马补偿电压被提供给数据驱动单元306。
电平移位器307将从时序控制器303接收的栅极时序信号的低电平电压转换为栅极导通电压VGL/VEL,并将栅极时序信号的高电平电压转换为栅极截止电压VGH/VEH。电平移位器307通过栅极时序信号输出通道输出栅极时序信号和栅极电压VGH/VEH和VGL/VEL,并将栅极时序信号和栅极电压VGH和VGL供应给栅极驱动单元120。
电源单元304使用DC-DC转换器生成驱动驱动IC 300、栅极驱动单元120和显示面板100的像素阵列所需的功率。DC-DC转换器可以包括电荷泵、调节器、降压转换器、升压转换器等。电源单元304可以通过调节从主机系统200接收的DC输入电压而生成DC电压,诸如伽马参考电压、栅极导通电压VGL/VEL、栅极截止电压VGH/VEH、像素驱动电压VDD、低电位电源电压ELVSS、初始化电压Vini、参考电压Vref等。伽马参考电压被供应给伽马补偿电压生成单元305。栅极导通电压VGL和栅极截止电压VGH分别供应给电平移位器307和栅极驱动单元120。诸如像素驱动电压VDD、低电位电源电压ELVSS以及初始化电压Vini和Vref的像素电源电压被共同地供应给像素P。
栅极电压VGH/VEH和VGL/VEL可以设置为8V和-7V,并且像素电源电压VDD、VSS和Vini(或Vref)可以设置为4.6V、-2V至-3V和-3V至-4V,但是本公开不限于此。数据电压Vdata可以设置为3V至6V,但是本公开不限于此。
电源单元304可以在时序控制器303的控制下改变栅极导通电压VGL。例如,栅极导通电压VGL可以在-7.5V和-8.0V的范围内改变,如图41所示。
Vini或Vref低于VDD并且被设置为低于发光元件(OLED)的阈值电压的DC电压,以抑制发光元件(OLED)的发光。
当向驱动IC 300输入功率时,第二存储器302存储从第一存储器301接收到的补偿值、寄存器设置数据等。补偿值可以施加到各种算法以改善图像质量。补偿值可以包括光学补偿值。
寄存器设置数据定义数据驱动单元306、时序控制器303、伽马补偿电压生成单元305等的操作。第一存储器301可以包括闪存。第二存储器302可以包括静态RAM(SRAM)。
主机系统200可以是电视(TV)系统、机顶盒、导航系统、个人计算机(PC)、家庭影院系统、移动系统和可穿戴系统中的任何一个。
在移动系统中,主机系统200可以被实施为应用处理器(AP)。主机系统200可以通过移动工业处理器接口(MIPI)将输入图像的像素数据发送到驱动IC。主机系统200可以通过柔性印刷电路板(例如,柔性印刷电路(FPC)310)连接到驱动IC 300。
图5是示意性示出栅极驱动单元中的移位寄存器的电路构造的示图。图6A和图6B是示意性示出传输门电路和边缘触发电路的示图。图7是示出图6所示的第N级的Q节点电压、QB节点电压和输出电压的波形图。
参考图5,栅极驱动单元120的移位寄存器包括级联连接的级ST(n-1)至ST(n+2)。移位寄存器接收起始脉冲VST或从上一级接收的进位信号CAR1至CAR4作为起始脉冲,并与移位时钟GCLK1至GCLK4的上升沿同步地生成输出Gout(n-1)至Gout(n+2)。移位时钟GCLK1至GCLK4通过移位时钟线51输入到级ST(n-1)至ST(n+2)。在图11和图12中,移位寄存器的输出信号Gout(n-1)至Gout(n+2)可以是栅极信号SCAN1、SCAN2、SCAN(N-1)、SCAN(N)、EM和EM(N)。
移位寄存器的每一级可以被实施为如图6A所示的传输门电路或如图6B所示的边缘触发电路。
在传输门电路中,时钟GCLK被输入到上拉晶体管Tup,该上拉晶体管Tup根据Q节点的电压而接通或关断。相反,栅极导通电压VGL被供应给边缘触发电路的上拉晶体管Tup,并且起始脉冲VST和移位时钟GCLK至GCLK4被输入到上拉晶体管Tup。下拉晶体管Tdn根据QB节点的电压而接通或关断。在传输门电路中,当Q节点的电压根据起始脉冲改变为栅极导通电压VGL时,Q节点浮置。当在Q节点浮置的同时将移位时钟GCLK施加到上拉晶体管Tup时,Q节点的电压通过自举而改变为比图7所示的栅极导通电压VGL高的2VGL,如图7所示,并且因此上拉晶体管Tup接通。在这种情况下,输出信号Gout(n)的电压改变为栅极导通电压VGL。
由于边缘触发电路与时钟GCLK的边缘同步,从而将输出信号Gout(n)的电压改变为起始脉冲的电压,因此以与起始脉冲具有相同相位的波形生成输出信号Gout(n)。当起始脉冲波形改变时,输出信号的波形也随之改变。在边缘触发电路中,输入信号可以与输出信号重叠。
图8是示出根据本公开的实施例的栅极驱动单元120中的一级电路的电路图。图9是示出图8所示的电路的输入/输出波形的波形图。栅极驱动单元120的电路不限于图8所示的电路。
参考图8和图9,栅极驱动单元120包括多个晶体管M1至M7以及多个电容器CQ和CQB。
第一晶体管M1a或M1b根据供应了第二移位时钟GCLK2的第二GCLK节点的栅极导通电压VGL而接通,以将施加到VST节点的信号的电压施加到Q’节点。从上一级接收到的进位信号或起始脉冲VST被供应给VST节点。从第一晶体管M1a或M1b施加的栅极导通电压VGL对Q’节点和Q节点充电。当第八晶体管M8接通时,Q节点连接到Q’节点。
第一晶体管M1a或M1b可以包括以双栅极结构彼此连接的两个晶体管M1a和M1b,以便减小泄漏电流。第一a晶体管M1a包括连接至第二GCLK节点的栅极、连接至VST节点的第一电极、以及连接至第一b晶体管M1b的第二电极。第一b晶体管M1b包括连接到第二GCLK节点的栅极、连接到第一a晶体管M1a的第二电极的第一电极、以及连接到Q’节点的第二电极。
第二晶体管M2根据施加了第一移位时钟GCLK1的第一GCLK节点的栅极导通电压VGL而接通。第三晶体管M3根据QB节点的栅极导通电压VGL而接通。当QB节点的电压是栅极导通电压VGL并且第一GCLK节点的电压是栅极导通电压VGL时,第二晶体管M2和第三晶体管M3接通。在这种情况下,Q节点和Q’节点连接到VGH节点,因此Q节点和Q’节点被栅极截止电压VGH充电。栅极截止电压VGH被供应给VGH节点。第二晶体管M2包括连接至第一GCLK节点的栅极、连接至Q’节点的第一电极以及连接至第三晶体管M3的第一电极的第二电极。第三晶体管M3包括连接至QB节点的栅极、连接至第二晶体管M2的第二电极的第一电极以及连接至VGH节点的第二电极。
第四晶体管M4根据第二GCLK节点的栅极导通电压VGL而接通,以将VGL节点连接至QB节点,并将QB节点的电压放电至VGL。栅极导通电压VGL被供应给VGL节点。第四晶体管M4包括连接至第二GCLK节点的栅极、连接至VGL节点的第一电极以及连接至QB节点的第二电极。
第五晶体管M5根据Q’节点的栅极导通电压VGL而接通,以将第二GCLK节点连接到QB节点。第五晶体管M5包括连接至Q’节点的栅极、连接至第二GCLK节点的第一电极以及连接至QB节点的第二电极。当第四晶体管M4的栅极电压是栅极导通电压VGL并且第三晶体管M3的栅极电压是栅极截止电压VGL时,VGL节点和QB节点可能被短路。在这种情况下,第五晶体管M5被接通以将第四晶体管M4的栅极节点连接至VGH节点。因此,通过关断第四晶体管M4,防止VL节点和QB节点的短路。
第六晶体管M6是上拉晶体管,当通过自举使Q节点的电压改变为高于栅极导通电压VGL的电压(2VGL)时,第六晶体管M6接通,从而输出信号Gout(n)的电压改变为栅极导通电压VGL。第六晶体管M6包括连接至Q节点的栅极、连接至第一GCLK节点的第一电极和连接至输出节点的第二电极。输出节点连接到与像素连接的栅极线。
第七晶体管M7是下拉晶体管,当QB节点的电压为栅极导通电压VGL时,第七晶体管M7接通,从而将输出信号Gout(n)的电压改变为栅极截止电压VGH。第七晶体管M7包括连接至QB节点的栅极、连接至输出节点的第一电极和连接至VGH节点的第二电极。
第八晶体管M8根据VGL节点的栅极导通电压VGL而接通,以将Q’节点连接到Q节点。第八晶体管M8包括连接至VGL节点的栅极、连接至QB节点的第一电极以及连接至Q节点的第二电极。当Q’节点的电压为VGL并且Q节点的电压为2VGL时,第八晶体管M8关断以将Q’节点和Q节点分开。
第一电容器CQ形成在Q节点和输出节点之间。第一电容器CQ是用于Q节点的自举的电容器。第一电容器CQ通过电容器耦合而将输出节点和Q节点连接以使Q节点升压,使得当输出节点的电压由移位时钟GCLK的VGL充电时,Q节点由2VGL充电。第二电容器CQB形成在QB节点和VGH节点之间。当第七晶体管M7接通时,第二电容器CQB将QB节点的电压维持在栅极导通电压VGL,使得输出节点的电压维持在栅极截止电压。
第二移位时钟GCLK2可以被生成为具有与第一移位时钟GCLK2的相位相反的相位的时钟。从图9中可以看出,当第二移位时钟GCLK2是栅极导通电压VGL时,图8中所示的栅极驱动单元120的电路将Q节点和QB节点的电压改变为栅极导通电压VGL。当Q’节点的电压是栅极导通电压VGL时,第四晶体管M4和第五晶体管M5接通,因此,QB节点的电压改变为栅极导通电压VGL。
当Q节点的电压是栅极导通电压VGL并且第一移位时钟GCLK改变为栅极导通电压VGL时,Q节点的电压Q改变为2VGL,并且输出信号Gout(n)的电压改变为栅极导通电压VGL。随后,当第二移位时钟GCLK2改变为栅极导通电压VGL时,QB节点的电压改变为栅极导通电压VGL,Q节点、QB节点和输出节点的电压改变为栅极截止电压VGH。
图10是示意性示出本公开的像素电路的示图。
参考图10,像素电路可以包括第一至第三电路单元10、20和30以及第一至第三连接单元12、23和13。一个或多个元件可以从像素电路中省略或添加到像素电路中。
第一电路单元10将像素驱动电压VDD供应给驱动元件DT。驱动元件DT可以被实施为包括栅极DRG、源极DRS和漏极DRD的晶体管。第二电路单元20对连接至驱动元件DT的栅极DRG的电容器CST进行充电,并在一个帧周期期间维持电容器CST的电压。第三电路单元30将从像素驱动电压VDD通过驱动元件DT供应的电流提供给发光元件EL,以将电流转换成光。第一连接单元12连接第一电路单元10和第二电路单元20。第二连接单元23连接第二电路单元20和第三电路单元30。第三连接单元13连接第三电路单元30和第一电路单元10。
该像素电路可以被实施为图11或图12所示的像素电路。
图11和图12是具体示出图10所示的像素电路的电路图。图11和图12所示的像素电路是属于第N像素行的任何子像素电路。像素电路可以包括内部补偿电路,该内部补偿电路被配置为感测驱动元件DT的阈值电压Vth并且用驱动元件DT的栅极电压补偿阈值电压Vth。
如图11和图12所示,显示面板可以还包括:第一电源线61,其用于将像素驱动电压VDD供应给像素P;第二电源线62,其用于将低电位电源电压VSS供应给像素P;以及第三电源线63,其用于将用于初始化像素电路的初始化/参考电压Vini和Vref供应给像素P。电源线61、62和63连接到电源单元304的输出通道。
参考图11,根据本公开的第一实施例的像素电路包括发光元件EL、多个晶体管T1至T5和DT、电容器CST等。
晶体管T1至T5和DT可以被实施为P沟道晶体管。晶体管T1至T5和DT包括开关元件T1至T5和驱动元件DT。
发光元件EL可以用OLED来实施。OLED包括形成在阳极和阴极之间的有机化合物层。有机化合物层可以包括空穴注入层HIL、空穴传输层HTL、发光层EML、电子传输层ETL、电子注入层EIL等,但是本公开不限于此。OLED的阳极通过第四节点N4连接到第四和第五开关元件T4和T5。OLED的阴极连接到第二电源线62,通过第二电源线62施加低电位电源电压VSS。驱动元件DT通过根据栅极-源极电压Vgs调节流过发光元件EL的电流量来驱动发光元件EL。可以通过第四开关元件T4来开关流过发光元件EL的电流。
电容器CST连接在第一节点n1和第二节点n2之间。第一节点n1连接到第一开关元件T1的第二电极、第三开关元件T3的第一电极和电容器CST的第一电极。第二节点n2连接到电容器CST的第二电极、驱动元件DT的栅极和第二开关元件T2的第一电极。电容器CST被数据电压Vdata充电,驱动元件DT的阈值电压Vth被该数据电压Vdata补偿。
第一开关元件T1响应于第二扫描信号SCAN2将数据电压Vdata供应给第一节点n1。第一开关元件T1包括连接至第二栅极线122的栅极、连接至数据线131的第一电极以及连接至第一节点n1的第二电极。
第二扫描信号SCAN2通过第二栅极线122供应给像素P。第二扫描信号SCAN2被生成为栅极导通电压VGL的脉冲。第二扫描信号SCAN2的脉冲定义感测周期Ts。第二扫描信号SCAN2的脉冲宽度可以被设置为大约一个水平周期1H。第二扫描信号SCAN2晚于第一扫描信号SCAN1被改变为栅极导通电压VGL,并且与第一扫描信号SCAN1同时被改变为栅极截止电压VGH。第二扫描信号SCAN2的脉冲宽度可以被设置为小于第一扫描信号SCAN1的脉冲宽度。在初始化周期Ti和发射周期Tem期间,第二扫描信号SCAN2的电压维持在栅极截止电压VGH。
第二开关元件T2连接驱动元件DT的栅极和驱动元件DT的第二电极,以使驱动元件DT能够响应于第一扫描信号SCAN1而作为二极管操作。第二开关元件T2包括连接至第一栅极线121的栅极、连接至第二节点n2的第一电极以及连接至第三节点N3的第二电极。
第一扫描信号SCAN1通过第一栅极线121被供应给像素P。第一扫描信号SCAN1可以被生成为栅极导通电压VGL的脉冲。第一扫描信号SCAN1的脉冲定义初始化周期Ti和感测周期Ts。在发射周期Tem期间,第一扫描信号SCAN1的电压维持在栅极截止电压VGH。
第三开关元件T3响应于EM信号EM(N)向第一节点n1供应预定的参考电压Vref。参考电压Vref通过第三电源线63供应给像素P。第三开关元件T3包括连接至第三栅极线123的栅极、连接至第一节点n1的第一电极以及连接至第三电源线63的第二电极。EM信号EM(N)定义发光元件EL的开/关时间。
在感测周期Ts期间,可以生成EM信号EM(N)的脉冲作为栅极截止电压VGH,以便阻挡第一节点n1和第三电源线63之间的电流路径,并且阻挡发光元件EL的电流路径。当第二扫描信号SCAN2被反相为栅极导通电压VGL时,EM信号EM(N)可以被反相为栅极截止电压VGH,并且在第一扫描信号SCAN1和第二扫描信号SCAN2被反相为栅极截止电压VGH之后,EM信号EM(N)可以被反相为栅极导通电压VGL。为了精确表示低灰度亮度,在发射周期Tem期间,EM信号EM(N)可以以预定的占空比在栅极导通电压VGL和栅极截止电压VGH之间摆动。
第四开关元件T4响应于EM信号EM(N)来开关发光元件EL的电流路径。第四开关元件T4具有连接到第三栅极线123的栅极。第四开关元件T4具有连接到第三节点N3的第一电极和连接到第四节点N4的第二电极。
第五开关元件T5根据第一扫描信号SCAN1的栅极导通电压VGL而接通,以在初始化周期Ti和感测周期Ts期间将参考电压Vref供应给第四节点N4。在初始化周期Ti和感测周期Ts期间,发光元件EL的阳极电压被放电到参考电压Vref。在这种情况下,由于阳极和阴极之间的电压小于发光元件EL的阈值电压,因此发光元件EL不发光。第五开关元件T5包括连接至第一栅极线121的栅极、连接至第三电源线63的第一电极以及连接至第四节点N4的第二电极。
驱动元件DT通过根据栅极-源极电压Vgs调整流过发光元件EL的电流来驱动发光元件EL。驱动元件DT包括连接至第二节点n2的栅极、连接至第一电源线61的第一电极以及连接至第三节点N3的第二电极。像素驱动电压VDD通过第一电源线61供应给像素P。
参考图12,根据本公开的第二实施例的像素电路包括发光元件EL、多个晶体管T11至T16和DT、电容器CST等。
晶体管T11至T16和DT中的每个可以被实施为P沟道晶体管,但是不限于此。晶体管T11至T16和DT包括开关元件T11至T16和驱动元件DT。
施加到该像素电路的栅极信号包括第(N-1)扫描信号SCAN(N-1)、第N扫描信号SCAN(N)和EM信号EM(N)。第(N-1)扫描信号SCAN(N-1)与第(N-1)像素行的数据电压Vdata同步。第N扫描信号SCAN(N)与第N像素行的数据电压Vdata同步。以与第(N-1)扫描信号SCAN(N-1)的脉冲相同的脉冲宽度生成第N扫描信号SCAN(N)的脉冲,并且在第(N-1)扫描信号SCAN(N-1)的脉冲之后生成第N扫描信号SCAN(N)的脉冲。
电容器CST连接在第一节点n11和第二节点n12之间。像素驱动电压VDD通过第一电源线61供应给像素电路。第一节点n11连接到第一电源线61、第三开关元件T13的第一电极和电容器CST的第一电极。
第二节点n12连接到电容器CST的第二电极、驱动元件DT的栅极、第一开关元件T11的第一电极和第五开关元件T15的第一电极。
第一开关元件T11根据第N扫描信号SCAN(N)的栅极导通电压VGL而接通,以连接驱动元件DT的栅极和第二电极。第一开关元件T11包括连接至第二栅极线125的栅极、连接至第二节点n12的第一电极以及连接至第三节点n13的第二电极。第N扫描信号SCAN(N)通过第二栅极线125供应给像素P。第三节点n13连接至驱动元件DT的栅极、第一开关元件T11的第二电极和第四开关元件T14的第一电极。
第二开关元件T12根据第N扫描信号SCAN(N)的栅极导通电压VGL而接通,以将数据电压Vdata施加到驱动元件DT的第一电极。第二开关元件T12包括连接至第二栅极线125的栅极、连接至第五节点n15的第一电极以及连接至数据线131的第二电极。第五节点n15连接至驱动元件DT的第一电极、第二开关元件T12的第一电极和第三开关元件T13的第二电极。
第三开关元件T13响应于EM信号EM(N)将像素驱动电压VDD供应给驱动元件DT的第一电极。第三开关元件T13包括连接至第三栅极线126的栅极、连接至第一电源线61的第一电极、以及连接至第五节点n15的第二电极。EM信号EM(N)通过第三栅极线126供应给像素P。
第四开关元件T14根据EM信号EM(N)的栅极导通电压VGL而接通,以连接驱动元件DT的第二电极和发光元件EL的阳极。第四开关元件T14具有连接到第三栅极线126的栅极。第四开关元件T14具有连接到第三节点n13的第一电极和连接到第四节点n14的第二电极。第四节点n14连接至发光元件EL的阳极、第四开关元件T14的第二电极和第六开关元件T16的第二电极。
第五开关元件T15根据第(N-1)扫描信号SCAN(N-1)的栅极导通电压VGL而接通,以将第二节点n12连接至第三电源线63,从而在初始化周期Ti期间,驱动元件DT的栅极和电容器CST被初始化。第五开关元件T15包括连接至第一栅极线124的栅极、连接至第二节点n12的第一电极以及连接至第三电源线63的第二电极。
第(N-1)扫描信号SCAN(N-1)通过第一栅极线124供应给像素P。初始化电压Vini通过第三电源线63供应给像素P。
第六开关元件T16根据第(N-1)扫描信号SCAN(N-1)的栅极导通电压VGL而接通,以在初始化周期Ti期间将第三电源线63连接至发光元件EL的阳极。在初始化周期Ti期间,发光元件EL的阳极电压通过第六开关元件T16放电到初始化电压Vini。在这种情况下,由于阳极和阴极之间的电压小于发光元件EL的阈值电压,因此发光元件EL不发光。第六开关元件T16包括连接至第一栅极线124的栅极、连接至第三电源线63的第一电极、以及连接至第四节点n14的第二电极。
驱动元件DT通过根据栅极-源极电压Vgs调节流过发光元件EL的电流来驱动发光元件EL。驱动元件DT包括连接至第二节点n12的栅极、连接至第五节点n15的第一电极以及连接至第三节点n13的第二电极。
图13A至图15B是一步一步地示出图11中所示的像素电路的操作的示图。图13A是示出在初始化周期Ti期间流过像素电路的电流的路径的示图。图14A是示出在感测周期Ts期间流过像素电路的电流的路径的示图。图15A是示出在发射周期Tem期间流过像素电路的电流的路径的示图。在图13A、图14A和图15A中被淡淡示出的晶体管是截止的。图13B、图14B和图15B是示出施加到图11所示的像素电路的栅极信号的波形图。
参考图13A和图13B,在初始化周期Ti期间EM信号EM(N)和第一扫描信号SCAN1的电压是栅极导通电压VGL。第二至第五开关元件T2至T5在初始化周期Ti期间接通,以将第一节点n1、第二节点n2和第四节点N4的电压放电至参考电压Vref。结果,在初始化周期Ti期间,电容器CST、驱动元件DT的栅极电压和发光元件EL的阳极电压被初始化为参考电压Vref。
参考图14A和图14B,在感测周期Ts期间第一扫描信号SCAN1和第二扫描信号SCAN2的电压是栅极导通电压VGL。第一、第二和第五开关元件T1、T2和T5在感测周期Ts期间接通。在这种情况下,数据电压Vdata被施加到第一节点n1,并且第二节点n2的电压被改变为VDD+Vth。结果,在感测周期Ts期间,感测驱动元件DT的阈值电压Vth,并且第二节点n2被阈值电压Vth充电。电容器CST被数据电压Vdata充电,在感测周期Ts期间驱动电压DT的阈值电压Vth被数据电压Vdata补偿。
参考图15A和图15B,在发射周期Tem期间EM信号EM(N)的电压是栅极导通电压VGL。在发射周期Tem期间,第三开关元件T3和第四开关元件T4接通。在这种情况下,第一节点n1的电压改变为参考电压Vref,并且第二节点n2的电压改变为Vref-Vdata+VDD+Vth。在发射周期Tem期间,由于通过驱动元件DT流过发光元件EL的电流,发光元件EL可以发光。
可以根据驱动元件DT的栅极-源极电压Vgs来调节流过发光元件EL的电流。在发射周期Tem期间,驱动元件DT的栅极-源极电压Vgs为Vref-Vdata+Vth。
图16A至图18B是一步一步地示出图12所示的像素电路的操作的示图。图16A是示出在初始化周期Ti期间流过像素电路的电流的路径的示图。图17A是示出在感测周期Ts期间流过像素电路的电流的路径的示图。图18A是示出在发射周期Tem期间流过像素电路的电流的路径的示图。在图16A、图17A和图18A中淡淡地示出的晶体管是截止的。图16B、图17B和图18B是示出施加到图12所示的像素电路的栅极信号的波形图。
参考图16A和图16B,在初始化周期Ti期间第(N-1)扫描信号SCAN(N-1)的电压是栅极导通电压VGL。第四和第五开关元件T14和T15在初始化周期Ti期间接通,使得第二和第四节点n12和n14的电压被放电到初始化电压Vini。结果,在初始化周期Ti期间,电容器CST、驱动元件DT的栅极电压和发光元件EL的阳极电压被初始化为初始化电压Vini。
参考图17A和图17B,在感测周期Ts期间第N扫描信号SCAN(N)的电压是栅极导通电压VGL。第一开关元件T11和第二开关元件T12在感测周期Ts期间接通。在这种情况下,数据电压Vdata被施加到第五节点n15,并且第二节点n12的电压被改变为Vdata+Vth。结果,在感测周期Ts期间,驱动元件DT的阈值电压Vth被感测,并且第二节点n12被阈值电压Vth充电。电容器CST被数据电压Vdata充电,在感测周期Ts期间驱动电压DT的阈值电压Vth被数据电压Vdata补偿。
参考图18A和图18B,在发射周期Tem期间EM信号EM(N)的电压是栅极导通电压VGL。第三开关元件T13和第四开关元件T14在发射周期Tem期间接通。由于在发射周期Tem期间通过驱动元件DT而流过发光元件EL的电流,发光元件EL可以发光。
可以根据驱动元件DT的栅极-源极电压Vgs调节流过发光元件EL的电流。在发射周期Tem期间,驱动元件DT的栅极-源极电压Vgs为Vdata+Vth-VDD。
本发明人根据显示面板100的屏幕中的位置在相同的灰度级下测量到有机发光显示装置的不同亮度值,并揭示了其原因。将结合图19至图22进行描述。
图19是示出根据本公开的实施例的显示面板100的屏幕AA上的亮度测量位置的示图。图20示出了在图19所示的位置“Top”、“Middle”和“Bottom”处测量的基于灰度的亮度值。在图20中,255G指示像素数据的灰度值255。127G指示像素数据的灰度值277,而31G指示像素数据的灰度值31。
参考图19和图20,根据屏幕AA的位置Top、Middle和Bottom,从驱动IC 300输出的移位时钟GCLK的电压和像素驱动电压VDD可以被改变IR降。像素驱动电压VDD和移位时钟GCLK影响驱动元件DT的栅极-源极电压Vgs和漏极-源极电压Vdas。移位时钟GCLK影响由供应给像素P的栅极线的扫描信号所定义的感测周期Ts。
本实验中使用的样本是有机发光显示装置,其中从驱动IC 300输出的VDD和GCLK是固定的。由于位置Bottom靠近驱动IC 300,因此IR降的量较小。由于位置Top远离驱动IC300,因此IR降的量最大。亮度测量结果是在高灰度级(255G)的情况下,像素P的电流I较大。因此,由于IR降的量的差异,亮度在朝向位置Top的方向上降低。然而,在低灰度级(31G)的情况下,像素P的电流较小。因此,由于其他原因,IR降的影响减小,并且亮度倾向于在远离驱动IC 300的方向上增加。在图20中,在靠近驱动IC 300的位置Bottom处测量的低灰度级(31G)的亮度为4.80[nit],而在远离驱动IC 300的位置Top处测量的较低灰度级(31G)的亮度反而增加到6.20[nit]。
本发明人证实,在低灰度级的情况下,感测周期Ts的差异对亮度不均匀的影响大于VDD的IR降的影响。感测周期Ts由扫描信号的脉冲宽度定义。然而,由于输入到栅极驱动单元120的移位时钟GCLK(n)的RC延迟,因此移位时钟波形的延迟导致扫描信号的延迟。结果,在低灰度级,驱动元件的栅极-源极电压Vgs在远离驱动IC 300的像素中增加,因此,亮度在远离驱动IC 300的像素中增加的量比在靠近驱动IC 300的像素中增加的量更多。
参考图21,供应给屏幕AA上的位置Top和位置Bottom的栅极线的扫描信号SCAN(Top)和SCAN(Bottom)的波形具有不同的RC延迟。由于移位时钟线51的电阻和寄生电容在位置Top处较大,因此移位时钟GCLK(n)的RC延迟增加。因此,在位置Top处供应给栅极线的扫描信号SCAN(Top)的波形延迟增加。结果,实际施加到位置Top处的像素的感测周期Ts(Top)小于在位置Bottom处的感测周期Ts(Bottom)。
图22是示出根据屏幕中的位置和灰度级测量的驱动元件的栅极-源极电压的改变的示图。
参考图22,对于高灰度级HIGH GRAY,流过像素P的电流的量大,因此VDD的IR降的量在远离驱动IC 300的方向上增加到最大值。因此,对于高灰度级HIGH GRAY,由于感测周期Ts的减小,亮度的减小大于亮度的增加,因此,测量结果表明,亮度在远离位置Top的方向上减小。
对于低灰度级LOW GRAY,流过像素P的电流的量小,因此VDD的IR降被最小化。对于低灰度级LOW GRAY,由于感测周期Ts的减小而导致的亮度增加大于由于VDD在远离驱动IC300的方向上的IR降而导致的亮度减小。在图20所示的亮度测量结果中,可以证实亮度倾向于朝着远离驱动IC 300的位置Top的方向增加。因此,尽管在应用内部补偿技术的屏幕AA中将VDD的IR降的影响最小化,在低灰度级处,在远离驱动IC 300的像素中亮度可以增加。
根据本公开,考虑到移位时钟GCLK(n)的RC延迟感测结果,实时地根据屏幕AA中的位置改变移位时钟GCLK(n)的脉冲电压和/或脉冲宽度,即栅极导通电压VGL。定义感测信号的扫描信号的脉冲宽度和电压与移位时钟GCLK的脉冲宽度和电压基本上相同。根据本公开,通过改变栅极导通电压VGL或移位时钟GCLK的脉冲宽度来改变扫描信号的脉冲宽度或电压。
根据本公开,通过针对屏幕AA中的每个位置调制移位时钟GCLK(n)的脉冲电压和/或脉冲宽度,执行控制以使得整个屏幕的像素的感测周期都相等。结果,根据本公开,可以解决仅使用补偿像素驱动电压VDD的IR降的技术不能解决的在低灰度级处的亮度不均匀的问题。
图23是示出根据本公开的第一实施例的感测装置的示图。
参考图23,感测装置包括连接到栅极驱动单元120的反馈晶体管M9、连接到反馈晶体管M9的反馈线52和感测单元230。
栅极驱动单元120包括级联连接的级ST1至ST(n)。
反馈晶体管M9连接至级ST1至ST(n)中的每一个,或者连接至彼此隔开预定距离的至少两级。如图24所示,反馈晶体管M9根据Q节点的栅极导通电压VGL而接通,以将移位时钟线51连接至反馈线52。例如,如图18和图24所示,反馈晶体管M9可以连接至在位置Top处连接至栅极线的级,并且连接至在位置Bottom处连接至栅极线的级。
感测单元230将反馈线52中的反馈信号或反馈电压GCLKOFB和GCLKEFB与预定参考电压REF进行比较,并且从反馈电压GCLKOFB和GCLKEFB中检测具有小于或等于参考电压REF的电压的电压间隔作为脉冲宽度。
每当在用栅极导通电压VGL对Q节点充电的同时将移位时钟GCLK(n)输入到移位时钟线51时,感测单元230可以在相应的位置测量移位时钟的反馈信号或反馈电压GCLKOFB和GCLKEFB的脉冲宽度,并感测移位时钟GCLK(n)的RC延迟。因此,感测单元230可以针对屏幕AA中的每个位置实时感测移位时钟GCLK(n)的RC延迟的量。换言之,通过反馈线52接收的反馈信号基于输入到移位时钟线51的移位时钟GCLK(n)。
时序控制器303可以使用感测单元230的输出信号(即,实际施加到屏幕AA的栅极线的移位时钟GCLK(n)的脉冲宽度)来确定施加于屏幕AA中的每个位置的实际感测周期Ts。时序控制器303可以通过基于从感测单元230输入的每个位置的移位时钟GCLK(n)的脉冲宽度针对屏幕AA中的每个位置改变移位时钟GCLK(n)的脉冲电压VGL和/或脉冲宽度来执行控制,以使得屏幕AA的所有像素的感测周期TS相等。
图24是具体示出图23所示的栅极驱动单元中的第N级的电路图。
参考图24,反馈晶体管M9根据在相应级的Q节点的栅极导通电压VGL而接通,以将移位时钟线51连接到反馈线52。
反馈晶体管M9在相应级与第六晶体管M6共享Q节点,以便感测实际施加于栅极线的移位时钟Gout(n)的脉冲宽度。反馈晶体管M9包括连接到Q节点的栅极、连接到移位时钟线51的第一电极和连接到反馈线52的第二电极。
反馈晶体管M9应该连接到与所述级的输出节点分开的单独的反馈线52,以使所述级的输出节点不短路。
图25和图26是根据存在或不存在图24中所示的第九晶体管来比较感测操作的示图。
参考图25,仅当Q节点的电压是栅极导通电压VGL时,反馈晶体管M9接通以将移位时钟GCLK(n)的电压供应给反馈线52。在其他级,因为Q节点的电压是栅极截止电压VGH,所以在其他位置处连接到其他级的反馈晶体管M9是截止的。例如,当连接至第一级ST1的反馈晶体管M9接通以将输入至第一级STA的移位时钟GCLK的电压供应给反馈线52时,连接至其他级ST2至ST(n)的反馈晶体管M9是截止的。
为了防止通过反馈线52从级ST1至ST(n)输出栅极信号Gout(n)所通过的输出节点短路,反馈晶体管M9应连接至与输出节点分开的反馈线52。使用反馈晶体管M9的感测装置可以在有效间隔(见图30)中实时感测移位时钟GCLK(n)的RC延迟,在该有效间隔中输入图像被显示在屏幕AA上。
如图26所示,当反馈晶体管M9与第六晶体管M6共享输出节点时,在图26中,与反馈晶体管M9连接的所有级的输出节点通过反馈线52短路,因此栅极信号不能依次输出。
本公开的感测装置可以使用形成在显示面板100上的像素阵列检查电路。自动探针检查过程可以通过在安装驱动IC 300的工艺之前,使用形成在显示面板100上的AP检查电路对像素阵列的线执行电检查来检查基板的信号线缺陷或薄膜图案缺陷。根据本公开,可以使用其上安装了驱动IC 300的显示面板100中的AP检查电路实时感测与移位时钟GCLK(n)相对应的使能信号的RC延迟。
图27是示出可连接到本公开的感测装置的显示面板上的AP检查电路的示图。
参考图27,AP检查电路可以设置在显示面板100的边框区域中,该边框区域存在于显示图像的屏幕AA外部。在图27中,“DL”指示连接到像素P的数据线。
AP检查电路包括AP焊盘(APPAD)、AP线271至274和AP开关元件APTR。
AP线包括使能线271、第一测试数据线272、第二测试数据线273和第三测试数据线274。AP焊盘APPAD和AP开关元件APTR可以设置在彼此的相对侧,并且屏幕AA在显示面板100上显示图像。例如,AP焊盘APPAD可以设置得更靠近驱动IC 300。在这种情况下,AP开关元件APTR可以设置在远离驱动IC 300的安装位置的上边框区域中。
AP开关元件APTR可以包括第一晶体管MA1、第二晶体管MA2和第三晶体管MA3。晶体管MA1、MA2和MA3可以被实施为诸如构成像素阵列的晶体管T1至T16(参见图11和图12)的P沟道TFT。第一晶体管MA1包括连接至使能线271的栅极、连接至第一测试数据线272的第一电极以及连接至第一数据线的第二电极。第一数据线可以连接到红色子像素。第二晶体管MA2包括连接至使能线271的栅极、连接至第二测试数据线273的第一电极和连接至第二数据线的第三电极。第二数据线可以连接到绿色子像素。第三晶体管MA3包括连接到使能线271的栅极、连接到第三测试数据线274的第一电极和连接到第三数据线的第二电极。第三数据线可以连接到蓝色子像素。
在自动探针检查过程中,第一晶体管MAl响应于使能信号EN将第一测试数据信号供应给第一数据线。在自动探针检查过程中,可以通过检查设备的针将第一测试数据信号供应给第一测试数据线272。第二晶体管MA2响应于使能信号EN将第二测试数据信号供应给第二数据线DL。在自动探针检查过程中,通过检查设备的针将第二测试数据信号供应给第二测试数据线273。第三晶体管MA3响应于使能信号EN将第三测试数据信号供应给第三数据线DL。在自动探针检查过程中,通过检查设备的针将第三测试数据信号供应给第三测试数据线274。
检查设备可以通过AP焊盘APPAD供应使能信号和RGB测试数据信号,并且可以通过栅极焊盘(未示出)向栅极线供应栅极测试信号。在自动探针检查过程中,可以在不将驱动IC(DIC)安装在显示面板100上的情况下检查像素阵列是否具有缺陷。
如图28所示,当驱动IC 300安装在显示面板100上时,本公开的感测装置可以连接到AP检查电路。
参考图28和图29,感测装置包括通过多路复用器MUX连接到数据线的感测单元230。
当从数据驱动单元306输出数据电压Vdata时,即在图30的有效间隔AT期间,多路复用器MUX将数据驱动单元306的输出缓冲器AMP连接到数据线DL。多路复用器MUX在消隐周期期间(例如,在图30的垂直消隐周期VB期间)将感测单元230连接到数据线DL,在消隐周期期间,数据电压Vdata不从数据驱动单元306输出。
驱动IC 300在有效间隔AT期间将像素数据的数据电压Vdata供应给数据线DL。驱动IC 300在垂直消隐周期VB期间将从时序控制器303输出的信号以脉冲信号的形式供应给使能线271和测试数据线272至274。用于使AP开关元件MA1至MA3接通的栅极导通电压VGL的脉冲信号被作为使能信号EN而施加到使能线271,并且脉冲信号被施加到测试数据线272至274。这些脉冲信号像移位时钟GCLK(n)一样,可以作为在栅极导通电压VGL和栅极截止电压VGH之间摆动的脉冲信号而生成。这些脉冲信号通过时序控制器303和电平移位器307供应给使能线271和测试数据线272至274。
在垂直消隐周期VB期间,根据使能信号EN的栅极导通电压VGL接通AP开关元件MA1至MA3,以将测试数据线272至274连接至数据线DL。结果,针对在垂直消隐周期VB期间施加到测试数据线272至274的脉冲信号的反馈信号通过数据线DL供应给感测单元230。换言之,通过数据线DL接收的反馈信号基于施加到测试数据线272至274脉冲信号。
感测单元230将在垂直消隐周期VB期间通过数据线DL接收的反馈信号中的每者的电压与预定参考电压REF进行比较,并且检测小于或等于数据参考电压REF的反馈信号的电压的电压周期或间隔作为脉冲宽度。
时序控制器303在垂直消隐周期VB期间接收从感测单元230输出的原始数据。时序控制器303通过利用寄存器设置值来知道供应给测试数据线272至274的脉冲信号的脉冲宽度。从感测单元230输出的原始数据指示通过反映由于测试数据线272至274的电阻和寄生电容引起的RC延迟而延迟的脉冲宽度值。因此,时序控制器303可以比较在垂直消隐周期VB期间生成的脉冲信号的脉冲宽度和通过数据线DL接收并且反映了RC延迟的反馈信号的脉冲宽度,并且可以确定屏幕AA上的脉冲信号的RC延迟偏差。
从时序控制器303输出的脉冲信号没有RC延迟,而由感测单元230接收的反馈信号具有最大的RC延迟量。为了补偿屏幕AA上的脉冲信号的RC延迟偏差,时序控制器303在朝向最远离驱动IC 300的位置Top的方向上逐渐增大移位时钟GCLK(n)的脉冲宽度或逐渐减小移位时钟GCLK(n)的脉冲电压。因此,在垂直消隐周期VB期间,时序控制器303可以执行控制,使得通过基于从脉冲信号的反馈信号感测到的屏幕AA的RC延迟偏差来调制移位时钟GCLK(n)的脉冲电压和/或脉冲宽度,屏幕AA的所有像素的感测周期相等。移位时钟GCLK(n)的脉冲电压是栅极导通电压VGL。
因为感测装置使用AP检查电路,图28和图29中所示的感测装置可以测量移位时钟Gout(n)的RC延迟而无需单独的设计改变。特别地,该感测装置实时地在每一帧测量移位时钟Gout(n)的RC延迟,因此可以实时地补偿显示面板100的条件变化,例如像素劣化。
图30是具体示出一个帧周期中的垂直消隐周期和有效间隔的示图。
参考图30,一个帧周期分为输入像素数据的有效间隔和不输入像素数据的垂直消隐周期VB。
在有效间隔AT期间,与将被写入显示面板100的屏幕AA上的所有像素的一帧相对应的像素数据被驱动IC 300接收并被写入像素P。
垂直消隐周期VB是在第(N-1)帧周期(N是自然数)的有效间隔AT和第N帧周期的有效间隔AT之间的消隐周期,并且在该周期中,驱动IC300不接收像素数据。垂直消隐周期VB包括垂直同步时间VS、垂直前沿FP和垂直后沿BP。
垂直消隐周期VB是从在第(N-1)帧周期期间接收到的数据使能信号DE中的最后一个脉冲的下降沿到在第N帧周期期间接收到的数据使能信号DE中的第一脉冲的上升沿的时间周期。第N帧周期的起始点是数据使能信号DE的第一脉冲的上升时序。
垂直同步信号VSYNC定义一个帧周期。水平同步信号HSYNC定义一个水平周期(1H)。数据使能信号DE定义包括要在屏幕上显示的像素数据的有效数据周期。数据使能信号DE的脉冲与要写入显示面板100的像素的像素数据同步。数据使能信号DE的一个脉冲周期是一个水平周期(1H)。
图31是示出针对屏幕中的每个位置的感测周期的感测方法的波形图。
参考图31,扫描信号SCAN(Top)和SCAN(Bottom)定义像素的感测周期TS(Top)和TS(Bottom)。根据移位时钟GCLK的脉冲宽度来确定扫描信号SCAN(Top)和SCAN(Bottom)的脉冲宽度。
根据移位时钟线51上的位置,由于移位时钟线51的电阻和寄生电容而延迟了移位时钟GCLK的波形。取决于屏幕AA中的位置,将移位时钟GCLK施加到显示面板100上的移位时钟线51导致扫描信号SCAN(Top)和SCAN(Bottom)的波形的延迟。因此,移位时钟GCLK的RC延迟偏差导致屏幕AA中的位置之间的感测周期TS(Top)和TS(Bottom)的差异。
感测单元230通过显示面板100上的线接收移位时钟GCLK作为反馈输入或信号,并将接收到的移位时钟GCLK与预定参考电压REF进行比较。感测单元230可以通过模数转换器(以下称为“ADC”)输出作为数字数据的原始数据。
感测单元230通过ADC将小于或等于参考电压REF的反馈输入电压(即,反馈信号电压)的低电平间隔转换为第一逻辑值,并且将高于参考电压REF的反馈输入电压(即,反馈信号电压)的高电平间隔转换为第二逻辑值,以生成指示脉冲宽度的一位信号。第一逻辑值可以是HIGH(=1)或LOW(=0),并且第二逻辑值可以与第一逻辑值相反。
感测单元230可以通过将低电平逻辑间隔计数为一位信号中的时钟CLK,来将由移位时钟GCLK的RC延迟引起的脉冲宽度的偏差转换为数字数据。因此,感测单元230可以在时钟CLK周期中针对每个屏幕位置精确地量化移位时钟GCLK的脉冲宽度偏差。
根据本公开,针对屏幕AA中的每个位置的移位时钟GCLK的RC延迟被实时感测,并且基于感应结果自动调节移位时钟GCLK的电压和/或脉冲。因此,根据本公开,尽管诸如环境温度和显示面板100的元件劣化之类的条件改变,也可以适应于显示面板100的条件改变而对感测周期TS(Top)和TS(Bottom)执行自补偿。
图32至图36是示出根据本公开的第一实施例的基于屏幕位置的感测周期控制方法的示图。
图32是示出用于减小屏幕AA的像素P中的每个中的感测周期Ts的偏差的移位时钟GCLK的脉冲宽度调制方法的示例的波形图。
参考图32,时序控制器303可以从感测单元230接收原始数据,并且确定屏幕AA中的位置的感测周期TS之间的差异。
时序控制器303可以基于通过实时感测感测周期Ts获得的结果来改变供应给像素的扫描信号的脉冲宽度。响应于从感测单元230接收的原始数据,时序控制器303将与供应给靠近驱动IC 300的像素的扫描信号同步的移位时钟GCLK的脉冲宽度减小到小于与供应给远离驱动IC 300的像素的扫描信号同步的移位时钟GCLK的脉冲宽度。
具有最小感测周期Ts的像素的位置可以距驱动IC 300最远,并且可以是屏幕AA的位置Top,在该位置中移位时钟GCLK的RC延迟最大。相反,具有最大感测周期Ts的像素的位置可以最靠近驱动IC 300,并且可以是屏幕AA的位置Bottom,在该位置中移位时钟GCLK的RC延迟最小。时序控制器303在从屏幕AA的位置Top到屏幕AA的位置Bottom的方向上逐渐减小移位时钟GCLK的脉冲宽度。移位时钟GCLK的脉冲宽度定义了感测周期Ts。因此,时序控制器303可以通过接收从感测单元230输入的感测周期的感测结果并改变移位时钟GCLK的脉冲宽度来执行控制,以使得屏幕AA的所有像素的感测周期TS相等。。
电平移位器307将从时序控制器303输入的移位时钟GCLK的低电平电压转换为栅极导通电压VGL,将移位时钟GCLK的高电平电压转换为栅极截止电压VGH,并且将移位时钟GCLK供应给移位时钟线51。当通过移位时钟线51输入移位时钟GCLK时,栅极驱动单元120向栅极线输出栅极信号。栅极信号包括定义感测周期Ts的扫描信号。
时序控制器303可以使用查找表(LUT)来改变移位时钟GCLK的脉冲宽度。
图33和图34是示出使用查找表LUT和感测单元230来调制移位时钟GCLK的脉冲宽度的装置的示图。
参考图33和图34,时序控制器303可以包括查找表LUT。
从感测单元230输出的原始数据指示其中反映了RC延迟的移位时钟GCLK的脉冲宽度。在图34中,“SENSING”表示感测单元230的输入和输出。x轴表示屏幕位置,并且y轴表示从感测单元230输出的原始数据。
原始数据在位置Top处具有最小值,因为移位时钟GCLK的低电平间隔在RC延迟最大的位置Top处最小。由于移位时钟GCLK的低电平间隔在RC延迟最小的位置Bottom处最大,因此原始数据在位置Bottom处具有最大值。因此,由于原始数据远离驱动IC 300,从传感单元230输入到查找表LUT的原始数据具有较小值。
如图34所示,查找表LUT从感测单元230接收原始数据并输出补偿脉冲宽度。在定义查找表LUT的输入和输出的曲线图中,x轴表示输入到查找表LUT的原始数据,并且y轴表示从查找表LUT输出的补偿脉冲宽度。
当从感测单元230输入原始数据时,查找表LUT输出由原始数据的值指示的补偿脉冲宽度。由于移位时钟GCLK的脉冲具有与扫描信号SCAN基本相同的脉冲宽度,所以像素P的感测周期TS被感测到。因此,响应于由感测单元230实时感测的像素P的感测周期TS,查找表LUT输出用于执行控制的补偿脉冲宽度,以使得屏幕AA的所有像素P的感测周期TS相等。时序控制器303可以利用从查找表LUT输出的补偿脉冲宽度来生成移位时钟GCLK。
图35是示出具有在一个帧周期期间针对屏幕中的每个位置进行调制的脉冲宽度的移位时钟的示例的波形图。
参考图35,在定义一个帧周期中的屏幕AA的垂直周期的有效间隔AT期间,时序控制器303改变移位时钟GCLK的脉冲宽度,使得像素P的感测周期TS相等。移位时钟GCLK在远离驱动IC 300的方向上增加。例如,移位时钟GCLK的脉冲宽度在位置Bottom处最小,并且在朝向位置Top的方向上增加,如图32和图35所示。
图36是示出屏幕AA中的位置的感测周期A、B和C以及施加到像素P的移位时钟GCLK的波形图。在图36中,上部波形是在没有RC延迟的电平移位器307的输出节点处测量的移位时钟GCLK的输出波形。下部波形是被施加到移位时钟线51并且其中反映了RC延迟的移位时钟GCLK的波形。A、B和C指示与移位时钟GCLK的脉冲宽度的改变相对应的屏幕位置的感测周期TS。
如在图36中可以看到的,根据本公开,通过基于实时感测反馈信号的结果来自适应地改变移位时钟GCLK的脉冲宽度,可以执行控制以使得即使在显示面板100上移位时钟GCLK的RC延迟偏差较大,屏幕AA的所有像素P的感测周期A、B和C基本相等。因此,根据本公开,可以减少在屏幕AA中的远离驱动IC 300的方向上的亮度增加。
通过基于实时感测反馈信号的结果来改变移位时钟GCLK的栅极导通电压VGL,即使感测周期TS不足,时序控制器303也可以在屏幕AA的所有像素P中准确地感测驱动元件DT的阈值电压Vth。
图37至图42是示出根据本公开的第二实施例的基于屏幕位置的感测周期控制方法的示图。
图37是示出沿时间轴施加到显示面板100的栅极导通电压VGL的改变的波形图。图37的波形指示输入到电平移位器307的栅极导通电压VGL。
参考图37,当移位时钟GCLK的栅极导通电压VGL减小时,开关元件T2和T11的导通电流增大,如图14A和图17A所示。结果,在图14A和17A中,第二节点n2和n12的电压迅速达到驱动元件DT的阈值电压Vth,因此即使感测周期Ts不足,也可以感测驱动元件DT的阈值电压Vth。此外,当移位时钟GCLK的栅极导通电压VGL减小时,上升沿时间(其是达到栅极导通电压VGL所花费的时间)减小,因此感测周期Ts可以增加。因此,根据本公开,通过减小移位时钟GCLK的栅极导通电压VGL,即使屏幕AA中的每个位置的感测周期Ts有偏差,在感测周期Ts内,也可以感测屏幕AA的所有像素的驱动元件DT的阈值电压Vth。
时序控制器303在一个帧周期内逐渐减小(或增大)移位时钟GCLK的栅极导通电压VGL。移位时钟GCLK的RC延迟的量增加,并且因此感测周期在远离驱动IC 300的方向上减小。因此,栅极导通电压VGL可以是在位置Top处的最低电压V1。由于在最靠近驱动IC 300的位置处没有移位时钟GCLK的RC延迟,因此栅极导通电压VGL可以在位置Bottom处是最高电压V2。在该示例中,输入到电平移位器307的栅极导通电压VGL的电压差ΔVGL在一个帧周期内是V2-V1的最大值。
根据屏幕AA的扫描方向,栅极导通电压VGL可以在一个帧周期内逐渐上升或下降。当从位置Bottom到位置Top扫描屏幕AA的像素时,如图37所示,栅极导通电压VGL可以在一个帧周期期间从V2逐渐减小到V1,并且可以在每一帧以相同的方式进行改变。当从位置Top到位置Bottom扫描屏幕AA的像素时,栅极导通电压VGL可以在一个帧周期期间从V1逐渐增加到V2,并且可以在每一帧以相同的方式进行改变。
图38A是示出在电平移位器307的输出节点处测量的移位时钟GCLK的波形图。图38B是示出当如图38A所示的移位时钟GCLK施加到显示面板100的移位时钟线51时,其中反映了RC延迟的移位时钟GCLK的波形图。
参考图38A和图38B,时序控制器303可以从感测单元230接收原始数据,并且针对屏幕AA中的位置确定感测周期TS之间的差异。
时序控制器303执行控制,以使得基于实时感测感测周期Ts的结果,与供应给具有最小感测周期Ts的像素的扫描信号同步的移位时钟GCLK的栅极导通电压VGL为最低电压。时序控制器303执行控制,以使得与供应给具有大感测周期Ts的像素的扫描信号同步的移位时钟GCLK的栅极导通电压VGL是相对高的电压。
具有最小感测周期Ts的像素的位置可以距驱动IC 300最远,并且可以是屏幕AA的位置Top,其中移位时钟GCLK的RC延迟最大。相反,具有最大感测周期Ts的像素的位置可以最靠近驱动IC 300,并且可以是屏幕AA的位置Bottom,其中移位时钟GCLK的RC延迟最小。时序控制器303在从屏幕AA的位置Bottom到屏幕AA的位置Top的方向上逐渐减小移位时钟GCLK的栅极导通电压VGL。时序控制器303接收感测从感测单元230输入的感测周期的结果,并且改变移位时钟GCLK的栅极导通电压VGL。结果,可以在感测周期Ts内感测驱动元件DT的阈值电压Vth,并且屏幕AA的所有像素的感测周期TS可以相等,如图38B所示。
时序控制器303可以使用查找表LUT和DAC来改变移位时钟GCLK的栅极导通电压VGL。
图39和图40是示出使用查找表和感测单元调制移位时钟的栅极导通电压的装置的示图。
参考图39和图40,驱动IC 300还可以包括连接在时序控制器303和电平移位器307之间的DAC。时序控制器303可以包括查找表LUT。
感测单元230通过ADC将通过反馈线52接收的反馈信号转换为数字数据并输出原始数据。从感测单元230输出的原始数据指示其中反映了RC延迟的移位时钟GCLK的脉冲宽度。原始数据在位置Top处具有最小值,因为移位时钟GCLK的低电平间隔在其中RC延迟最大的位置Top处最小。原始数据在位置Bottom处具有最大值,因为移位时钟GCLK的低电平间隔在其中RC延迟最小的位置Bottom处最大。因此,由于原始数据远离驱动IC 300,从感测单元230输入到查找表LUT的原始数据具有较小值。
由于移位时钟GCLK的脉冲具有与扫描信号SCAN基本上相同的脉冲宽度,因此定义了像素P的感测周期TS。
如图40所示,查找表LUT从感测单元230接收原始数据,并且输出定义了栅极导通电压VGL的电压电平的VGL数据。在定义图40所示的查找表LUT的输入和输出的曲线图中,x轴表示从感测单元230输入到查找表LUT的原始数据,并且y轴表示从查找表LUT输出的VGL数据。当从感测单元230输入原始数据时,查找表LUT输出由原始数据的值指示的VGL数据。
DAC将从查找表LUT输入的VGL数据转换为模拟电压。模拟电压包括高电平电压和低于高电平电压的低电平电压。低电平电压具有处于与从查找表输出的VGL数据的数据范围相对应的电压范围内的电压电平。
电平移位器307将从DAC接收的输入电压的低电平电压转换为可变的栅极导通电压VGL。当输入电压的低电平电压较低时,电平移位器307输出接近V1的电压,而当输入电压的低电平电压较高时,电平移位器307输出接近V2的电压。电平移位器307将输入电压的高电平电压转换成高于V2的栅极截止电压VGH,并将栅极截止电压VGH供应给移位时钟线51。当通过移位时钟线51输入移位时钟GCLK时,栅极驱动单元120向栅极线输出栅极信号。栅极信号包括定义感测周期Ts的扫描信号。
图41和图42是示出具有根据屏幕位置而变化的电压电平的栅极导通电压的示图。在图41中,左列的垂直计数表示垂直分辨率的像素行数。
参考图41和图42,A、B和C是屏幕中的位置的感测周期TS。施加到像素P的扫描信号的栅极导通电压VGL根据屏幕AA中的位置而变化。扫描信号的栅极导通电压VGL与移位时钟GCLK的栅极导通电压VGL基本相同。根据本公开,通过根据感测周期改变移位时钟GCLK的栅极导通电压VGL,其中该感测周期是基于反馈信号针对屏幕AA的每个位置实时感测到的,扫描信号的脉冲宽度和栅极导通电压VGL被改变。
施加到距驱动IC 300最远的位置Top处的像素的栅极导通电压VGL是最低电压V1。施加到最靠近驱动IC 300的位置Bottom处的像素的栅极导通电压VGL是相对较高的电压V2。扫描信号的栅极导通电压VGL可以在从屏幕AA的位置Bottom到屏幕AA的位置Top的方向上逐渐减小。在图41中,V1和V2可以分别是-8.00V和-7.50V。然而,本公开不限于此。
根据本公开,通过基于实时感测反馈信号的结果来自适应地改变移位时钟GCLK的栅极导通电压VGL,即使移位时钟GCLK的RC延迟偏差在显示面板100上显著很大,也可以最小化屏幕AA的所有像素P的感测周期A、B和C的偏差。因此,根据本公开,可以在远离屏幕AA中的驱动IC 300的方向上减少亮度的增加。
根据本公开的另一实施例,通过根据灰度级改变像素驱动电压VDD以及针对屏幕AA中的每个位置改变扫描信号或移位时钟的电压和/或脉冲宽度,可以进一步改善亮度均匀性。
图43是示出像素驱动电压VDD根据灰度级而变化的示例的示图。
参考图43,在有机发光显示装置中的255G的高灰度级的情况下,由于流过像素P的电流量大,所以VDD的IR降的量增加。在255G的高灰度级中,VDD的IR降的量在朝向距驱动IC300最远的位置Top的方向上增加。在255G的高灰度级中,屏幕AA上的IR降的量的偏差大。
为了补偿VDD的IR降的量的偏差,电源单元304在时序控制器303的控制下在朝向位置Top的方向上增加电压VDD,如图43的上部曲线图所示。时序控制器303可以通过使用VDD的增益来控制从电源单元304输出的电压。时序控制器303可以通过增加被乘以VDD的增益来增加电压VDD,并且可以通过减小增益来减少电压VDD。
在127G的中间灰度级中,VDD的IR降的量在朝向距驱动IC 300最远的位置Top的方向上增加。屏幕AA上的IR降的量的偏差在127G的中间灰度级中比在255G的高灰度级中更小。为了补偿VDD的IR降的量的偏差,电源单元304在时序控制器303的控制下在朝向位置Top的方向上增加电压VDD,如图43的中间曲线图所示。时序控制器303可以通过使用VDD的增益来控制从电源单元304输出的电压。增益的可变范围设置为在127G的中间灰度级中比在255G的高灰度级中更小。
在255G的高灰度级和127G的中间灰度级中,从电源单元304输出的VDD在一个帧周期内变化。因此,在255G的高灰度级和127G的中间灰度级中,用于调节电压VDD的增益在一个帧周期内变化。
在有机发光显示装置中的0G的低灰度级的情况下,由于流过像素P的电流量较小,VDD的IR降的量较小。特别是在灰度级0(0G)的情况下,VDD的IR降被最小化。在0G的低灰度级中,从电源单元304输出的VDD不变。因此,在0G的低灰度级的情况下,增益固定在特定值。
图44是亮度测量结果的示图,其示出了当以与本公开的实施例相同的方式调制像素驱动电压(VDD)和栅极导通电压(VGL)时,在较高灰度级处屏幕的亮度均匀性的改善。图45是亮度测量结果的示图,其示出了当以与本公开的实施例相同的方式调制像素驱动电压(VDD)和栅极导通电压(VGL)时,在较低灰度级处屏幕的亮度均匀性的改善。图46是在屏幕上示出图44和图45的亮度测量位置的示图。在图44和图45中,x和y是xy颜色坐标值。
参考图44至图46,本发明人在屏幕的九个位置P1至P9处测量了第一和第二目标样本的亮度(NIT)和颜色坐标。
在图44和图45中,“VDD&VGL固定”表示第一目标样本(比较样本)。“VDD+VGL调制”表示第二目标样本(应用本公开的样本)。第一和第二目标样本是有机发光显示装置的显示面板。图44示出了当在屏幕上显示255G的高灰度级的白色图像图案时,在九个位置P1至P9处测量的亮度和颜色坐标。图44示出了当在屏幕上显示255G的高灰度级的图像图案时,在九个位置P1至P9处测量的亮度和颜色坐标。图45示出了当在屏幕上显示31G的低灰度级的图像图案时,在九个位置P1至P9处测量的亮度和颜色坐标。
对于第一目标样本,扫描信号的栅极导通电压VGL和像素驱动电压VDD是固定的,而与屏幕的位置和灰度无关。
对于第二目标样本,像素驱动电压VDD取决于屏幕AA中的位置和灰度级而变化,如图43所示。同样,对于第二目标样本,扫描信号的栅极导通电压VGL以与图37至图42所示相同的方式取决于屏幕AA中的位置和灰度级而变化。在要用于亮度测量的样本的九个位置P1至P6处测量亮度。
从图44可以看出,在高灰度级(VDD&VGL固定)的比较示例的情况下,屏幕AA的亮度均匀性为85.30%。另一方面,在本公开(VDD+VGL调制)的情况下,亮度均匀性增加到95.02%。亮度均匀性是通过将最小亮度值MIN除以最大亮度值MAX而获得的值。
从图45可以看出,在低灰度级(VDD&VGL固定)的比较示例的情况下,屏幕AA的亮度均匀性为71.39%。另一方面,在本公开(VDD+VGL调制)的情况下,亮度均匀性增加到95.05%。特别地,根据本公开,可以获得亮度均匀性对于各灰度级几乎相似的图像增强效果。
根据本公开的显示装置及其驱动方法可以描述如下。
本公开的显示装置包括:显示面板,其中数据线和栅极线彼此相交,并且像素以矩阵形式设置;栅极驱动单元,其形成在显示面板上,并被配置为将扫描信号供应给栅极线;移位时钟线,其形成在显示面板上,并被配置为将移位时钟供应给栅极驱动单元;感测装置,其被配置为接收针对供应给显示面板的脉冲信号的反馈信号并感测扫描信号的脉冲宽度;以及驱动装置,其被配置为向数据线供应数据电压并生成移位时钟。驱动装置响应于由感测装置实时感测的反馈信号的脉冲宽度,针对显示面板的每个屏幕位置改变移位时钟的脉冲宽度和移位时钟的脉冲电压中的一者或两者。
移位时钟的脉冲电压和扫描信号的脉冲电压是相同的栅极导通电压。每个所述像素包括根据栅极导通电压而接通的一个或多个像素开关元件。
供应给显示面板的脉冲信号包括供应给移位时钟线的移位时钟。
感测装置包括连接到栅极驱动单元的反馈线,并且包括感测单元,该感测单元被配置为将通过反馈线输入的反馈信号与预定参考电压进行比较,从反馈信号检测具有小于或等于参考电压的电压的电压间隔作为反馈信号的脉冲宽度,并输出指示反馈信号的脉冲宽度的数字数据。
栅极驱动单元包括移位寄存器,该移位寄存器被配置为接收起始脉冲和移位时钟并依次移位并输出扫描信号。移位寄存器包括级联连接的级。这些级包括上拉晶体管,该上拉晶体管根据Q节点的电压而接通,并且被配置为利用栅极导通电压对连接至栅极线的输出节点进行充电。像素包括根据栅极导通电压而接通的一个或多个像素开关元件。
感测装置还包括根据Q节点的电压而接通并且被配置为将移位时钟线连接到反馈线的反馈晶体管。
反馈晶体管连接到每个级或者连接到彼此隔开预定距离的至少两个级。
显示面板还包括:被配置为从驱动单元接收使能信号的使能线;以及测试数据线,其被配置为从驱动单元接收脉冲信号;以及开关元件,其响应于使能信号而接通并且被配置为将脉冲信号供应给数据线之一。
供应给显示面板的脉冲信号包括供应给测试数据线的脉冲信号。
感测装置包括数据线,通过该数据线通过开关元件供应脉冲信号,并且感测装置包括感测单元,该感测单元被配置为将通过数据线输入的脉冲信号与预定参考电压进行比较,从反馈信号中检测具有小于或等于参考电压的电压的电压间隔作为反馈信号的脉冲宽度,并输出指示反馈信号的脉冲宽度的数字数据。
驱动装置包括时序控制器,该时序控制器被配置为响应于从感测装置接收的数字数据而将与供应给靠近驱动装置的像素的扫描信号同步的移位时钟的脉冲宽度减小为小于与供应给远离驱动装置的像素的扫描信号同步的移位时钟的脉冲宽度。
驱动装置包括电平移位器,其被配置为将从时序控制器输出的移位时钟的脉冲电压转换为栅极导通电压。像素包括根据栅极导通电压而接通的一个或多个像素开关。
驱动装置使用查找表来改变移位时钟的脉冲宽度,在该查找表中定义了与从感测装置接收的数字数据的脉冲宽度值相对应的补偿脉冲宽度。
驱动装置响应于从感测装置接收到的数字数据而将与供应给靠近驱动装置的像素的扫描信号同步的移位时钟的电压降低为低于与供应给远离驱动装置的像素的扫描信号同步的移位时钟的电压。
驱动装置包括时序控制器,该时序控制器被配置为响应于从感测装置接收到的数字数据,输出根据像素的位置改变移位时钟的脉冲电压的数字数据。
驱动装置包括:数模转换器,其被配置为将从时序控制器接收的数字数据转换为模拟电压;以及电平移位器,其被配置为将从数模转换器接收的电压转换为栅极导通电压。像素包括根据栅极导通电压而接通的一个或多个像素开关。
每个像素包括发光元件、被配置为根据栅极-源极电压调节流过发光元件的电流的驱动元件、以及内部补偿电路,该内部补偿电路被配置为在由扫描信号的脉冲限定的感测周期中感测驱动元件的阈值电压并且被配置为将阈值电压供应给电容器。
内部补偿电路包括连接到驱动元件的栅极的电容器,并且包括被配置为连接电容器、驱动元件和发光元件的一个或多个开关元件。开关元件根据扫描信号的脉冲电压而接通。
驱动装置根据像素的位置改变像素驱动电压。
在写入到像素的像素数据的高灰度级和中间灰度级中,驱动装置将供应给远离驱动装置的像素的像素驱动电压增加并输出为大于供应给靠近驱动装置的像素的像素驱动电压。
在写入像素的像素数据的低灰度级中,驱动装置将供应给远离驱动装置的像素的像素驱动电压输出为等于供应给靠近驱动装置的像素的像素驱动电压。
一种显示装置的驱动方法,所述显示装置包括:显示面板,其中数据线和栅极线彼此相交,并且像素以矩阵形式设置;栅极驱动单元,其形成在显示面板上,并被配置为将扫描信号供应给栅极线;移位时钟线,其形成在显示面板上,并被配置为将移位时钟供应给栅极驱动单元,所述方法包括:接收针对供应给显示面板的脉冲信号的反馈信号,并实时感测扫描信号的脉冲宽度;以及响应于实时感测到的反馈信号的脉冲宽度,针对显示面板的每个屏幕位置改变移位时钟的脉冲宽度和移位时钟的脉冲电压中的一者或两者。
驱动方法还包括:在写入到像素的像素数据的高灰度级和中间灰度级中,将像素驱动电压供应给像素,以及将供应给远离驱动装置的像素的像素驱动电压增大为大于供应给靠近驱动装置的像素的像素驱动电压。
驱动方法还包括:在写入到像素的像素数据的低灰度级中,使供应给远离驱动装置的像素的像素驱动电压等于供应给靠近驱动装置的像素的像素驱动电压。
本公开的显示装置实时感测针对施加到屏幕的脉冲的反馈信号的脉冲宽度,并根据感测结果改变移位时钟的脉冲电压和脉冲宽度中的一者或两者。结果,通过精确地感测具有移位时钟线的RC延迟的平滑的显示面板的所有像素中的驱动元件的电特性,可以在整个屏幕上实现均匀的图像质量。
应注意,本公开的有利效果不限于上述效果,并且根据以下权利要求,对于本领域技术人员而言,本文中未描述的其他效果将是显而易见的。
尽管上面已经参考附图详细描述了本公开的实施例,但是本公开不限于这些实施例,并且可以在不脱离本公开的技术精神的情况下进行各种改变和修改。因此,本文公开的实施例应被认为是描述性的,而不是限制本公开的技术精神,并且本公开的技术精神的范围不受实施例的限制。因此,应当理解,上述实施例在所有方面都是示例性的而不是限制性的。本公开的范围应由所附权利要求来解释,并且在其等同物的范围内的所有技术精神应被解释为包括在本公开的范围内。

Claims (20)

1.一种显示装置,包括:
显示面板,其中数据线和栅极线彼此相交并且像素以矩阵形式设置;
栅极驱动单元,其形成在所述显示面板上并被配置为将扫描信号供应给所述栅极线;
移位时钟线,其形成在所述显示面板上并配置为将移位时钟供应给所述栅极驱动单元;
感测装置,其被配置为接收供应给所述显示面板的反馈信号并感测所述扫描信号的脉冲宽度;以及
驱动装置,其被配置为将数据电压供应给所述数据线并生成所述移位时钟,
其中,所述驱动装置响应于所述感测装置感测到的所述反馈信号的脉冲宽度,针对所述显示面板的每个屏幕位置改变所述移位时钟的脉冲宽度和所述移位时钟的脉冲电压中的一者或两者。
2.根据权利要求1所述的显示装置,其中
所述移位时钟的所述脉冲电压和所述扫描信号的脉冲电压是相同的栅极导通电压,并且
每个所述像素包括根据所述栅极导通电压而接通的一个或多个像素开关元件。
3.根据权利要求1所述的显示装置,其中,供应给所述显示面板的脉冲信号包括供应给所述移位时钟线的所述移位时钟。
4.根据权利要求3所述的显示装置,其中,所述感测装置包括:
反馈线,其连接到所述栅极驱动单元;以及
感测单元,其被配置为将通过所述反馈线输入的所述反馈信号与预定参考电压进行比较,从所述反馈信号中检测具有小于或等于所述参考电压的电压的电压间隔作为所述反馈信号的所述脉冲宽度,并输出指示所述反馈信号的所述脉冲宽度的数字数据。
5.根据权利要求4所述的显示装置,其中
所述栅极驱动单元包括移位寄存器,所述移位寄存器被配置为接收起始脉冲和所述移位时钟,并且依次移位并输出所述扫描信号,
所述移位寄存器包括级联连接的级,
所述级包括上拉晶体管,所述上拉晶体管根据Q节点的电压而接通并且被配置为利用栅极导通电压对连接至所述栅极线的输出节点进行充电,并且
所述像素包括根据所述栅极导通电压而接通的一个或多个像素开关元件。
6.根据权利要求5所述的显示装置,其中,所述感测装置还包括:反馈晶体管,所述反馈晶体管根据所述Q节点的所述电压而接通,并且被配置为将所述移位时钟线连接到所述反馈线。
7.根据权利要求6所述的显示装置,其中,所述反馈晶体管连接到每个所述级或者连接到彼此隔开预定距离的至少两个级。
8.根据权利要求1所述的显示装置,其中,所述显示面板还包括:
使能线,其被配置为从所述驱动单元接收使能信号;
测试数据线,其被配置为从所述驱动单元接收脉冲信号;以及
开关元件,其响应于所述使能信号而接通并且被配置为将所述脉冲信号供应给所述数据线中的一个。
9.根据权利要求8所述的显示装置,其中,供应给所述显示面板的所述脉冲信号包括供应给所述测试数据线的所述脉冲信号。
10.根据权利要求9所述的显示装置,其中,所述感测装置包括:
所述数据线,通过所述数据线通过所述开关元件供应所述脉冲信号;以及
感测单元,其被配置为将通过所述数据线输入的所述脉冲信号与预定参考电压进行比较,从所述反馈信号中检测具有小于或等于所述参考电压的电压的电压间隔作为所述反馈信号的所述脉冲宽度,并且输出指示所述反馈信号的所述脉冲宽度的数字数据。
11.根据权利要求1所述的显示装置,其中,所述驱动装置包括时序控制器,所述时序控制器被配置为响应于从所述感测装置接收到的数字数据而将与供应给靠近所述驱动装置的像素的所述扫描信号同步的所述移位时钟的所述脉冲宽度减小为小于供应给远离所述驱动装置的像素的所述扫描信号同步的所述移位时钟的所述脉冲宽度。
12.根据权利要求11所述的显示装置,其中
所述驱动装置包括电平移位器,所述电平移位器被配置为将从所述时序控制器输出的所述移位时钟的所述脉冲电压转换为栅极导通电压,并且
所述像素包括根据所述栅极导通电压而接通的一个或多个像素开关。
13.根据权利要求12所述的显示装置,其中,所述驱动装置使用查找表来改变所述移位时钟的所述脉冲宽度,在所述查找表中,定义了与从所述感测装置接收到的所述数字数据的脉冲宽度值相对应的补偿脉冲宽度。
14.根据权利要求1所述的显示装置,其中,所述驱动装置响应于从所述感测装置接收到的数字数据而将与供应给靠近所述驱动装置的像素的所述扫描信号同步的所述移位时钟的电压降低为低于与供应给远离所述驱动装置的像素的所述扫描信号同步的所述移位时钟的电压。
15.根据权利要求14所述的显示装置,其中,所述驱动装置包括时序控制器,所述时序控制器被配置为响应于从所述感测装置接收到的所述数字数据而输出根据所述像素的位置改变所述移位时钟的所述脉冲电压的数字数据。
16.根据权利要求15所述的显示装置,其中
所述驱动装置还包括:
数模转换器,其被配置为将从所述时序控制器接收的所述数字数据转换为模拟电压;以及
电平移位器,其被配置为将从所述数模转换器接收的电压转换为栅极导通电压,并且
所述像素包括根据所述栅极导通电压而接通的一个或多个像素开关。
17.根据权利要求1所述的显示装置,其中
每个所述像素包括:
发光元件;
驱动元件,其被配置为根据栅极-源极电压来调节流过所述发光元件的电流;以及
内部补偿电路,其被配置为在由所述扫描信号的脉冲定义的感测周期中感测所述驱动元件的阈值电压,并将所述阈值电压供应给电容器,
所述内部补偿电路包括:
电容器,其连接到所述驱动元件的栅极;以及
一个或多个开关元件,其被配置为连接所述电容器、所述驱动元件和所述发光元件,并且
所述开关元件根据所述扫描信号的所述脉冲电压而接通。
18.根据权利要求17所述的显示装置,其中,在写入到所述像素的像素数据的高灰度级和中间灰度级中,所述驱动装置将供应给远离所述驱动装置的像素的像素驱动电压增大并输出为大于供应给靠近所述驱动装置的像素的像素驱动电压。
19.根据权利要求18所述的显示装置,其中,在写入到所述像素的像素数据的低灰度级中,所述驱动装置将供应给远离所述驱动装置的所述像素的所述像素驱动电压输出为等于供应给靠近所述驱动装置的所述像素的所述像素驱动电压。
20.一种显示装置的驱动方法,所述显示装置包括:显示面板,其中数据线和栅极线彼此相交并且像素以矩阵形式设置;栅极驱动单元,其形成在所述显示面板上并被配置为将扫描信号供应给所述栅极线;以及移位时钟线,其形成在所述显示面板上并被配置为将移位时钟供应给所述栅极驱动单元,所述驱动方法包括:
接收针对供应给所述显示面板的脉冲信号的反馈信号,并感测所述扫描信号的脉冲宽度;以及
响应于所述反馈信号的脉冲宽度,针对所述显示面板的每个屏幕位置改变所述移位时钟的脉冲宽度和所述移位时钟的脉冲电压中的一者或两者。
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