CN1118940C - 一种锁相环路的环路滤波器 - Google Patents

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Abstract

在锁相环路PLL中的有源滤波器包括一个无源积分电路,以连接倒相运算放大器的输入端和输出端。因此,充电泵产生的快速脉冲直接移向放大器。根据本发明,在同相运算放大器(52)之前放置一个无源积分电路,它将充电泵的脉冲短路到地,在运算放大器之前不再需要附加的低通滤波器。这样,无源积分电路可以包括更多的低通滤波器。通过移位运算放大器(52)输入端的DC电平使增益A>1,从而扩展VCO调谐电压区域。

Description

一种锁相环路的环路滤波器
技术领域
本发明涉及到锁相环路,尤其涉及到其中使用的环路滤波器。
背景技术
用作频率合成器的锁相环路包括图1中示出的各部分。输入频率在数字相位/频率检波器2中进行比较,其中一种频率是基准频率fref,在基准分频器1中除以因子R,另一种是输出频率fvco,在环路分频器6中除以因子N。相位比较器2产生U(上行)和D(下行)脉冲,脉冲宽度正比于输入信号的频率和/或相位差。充电泵3将U和D脉冲转换成双极脉冲,其极性指示频率和/或相位差的方向,其宽度指示该差值的幅度。充电泵提供的脉冲在环路滤波器4中合成,从该滤波器获取的直流电压Vt是压控振荡器VCO 5的控制电压,它控制VCO以使相位比较器的输入信号的频率和/或相位差最小。
第一代的充电泵有一电压输出,而现在绝大多数包含PLL电路部分的IC电路的充电泵都有电流输出。最先提到的充电泵是三态电压输出:输出连接正向电源电压VDD,输出连接负向电源电压VSS(经常是地),或保持断开。在滤波器(积分电路)中使用偏置电阻将输出电压转换成积分电路(滤波器)的电流激励。当相位比较器输入信号的相位差较小时,充电泵的输出窄脉冲并且该充电泵大部分时间保持断开。这样,积分电路通过一个比偏置电阻大得多的电阻供电,也就是说,从电流源供电。然而,电源电流的值取决于滤波器的输出电压,也就是说,VCO调谐电压Vt,电源电流只有在Vt恰等于VDD/2的情况下才是对称的,当然要求Vss=0。否则,它取决于相位差的符号。
图2示出了一种典型的无源环路滤波器。滤波器21包括一个积分电容C2,一个阻尼电阻R2和一个平滑电容C3。充电泵3产生的脉冲(图1和2)是该滤波器的输出。通常使用一个附加的无源低通滤波器以减少噪音和可能穿过滤波器21的基准频率信号。电阻R1是一个偏置电阻。以上示出的第一代充电泵和无源滤波器的缺陷是充电泵的输出电流取决于该滤波器的输出电压Vt
众所周知,为了使积分电路的输入电流与它的输出电压Vt和相位差的符号无关,使用图3所示的带有运算放大器的有源滤波器(积分电路)来代替无源滤波器。在理想情况下,运算放大器31将保持输入端口上的电压相等。这样,如果在它正输入极施加的电压是VDD/2,在它负输入极也将施加相等的电压,通过偏置电阻R1的电流也将与相位差的符号无关。
有源滤波器的一个普遍存在的问题是运算放大器非常慢,它无法由数字电路所产生的快速脉冲供电。实际上,由充电泵提供的脉冲直接通过图3中反馈通路中的电容C33,到达运算放大器的输入端,导致运算放大器激励过度,其中,图3中所示的该反馈通路包括电容C23、C33以及电阻R23。当环路处于稳定状态时,因为噪音不断引起相位比较器输入信号的相位差,充电泵也产生脉冲。在最坏的情况下,这些脉冲会防碍环路到达稳定状态,使环路在稳定状态附近振荡。因为这些脉冲到达运算放大器1的输出端而没有倒相,而放大器本身正对低频进行倒相,所以上述情况就有可能发生。这样,这些脉冲在环路中产生了正反馈,增加了相位抖动。并且,在脉冲消失之后,运算放大器需要一些时间从过激励状态中恢复。然后,它尝试恢复C33中的电荷。因此,放大器输入端一些毫微秒脉冲会干扰放大器运算几微秒。
众所周知,为了解决使用图3所示电路所引起的上述问题,在放大器之前使用预滤波。这在图4中示出,其中适当地使用了与图3相同的参考数字。一系列电阻连接R1a和R1b替代了运算放大器31的负输入极的偏置电阻,这些电阻间的电容C13接地,电压Vdd/2现在施加在电阻R1a和R1b之间。电容C13平滑充电泵3的脉冲,以使运算放大器能够跟踪它们。因为运算放大器31的DC输入电流在理想情况下是零,施加在电容C13上的电压处于稳定状态,与运算放大器输入极的电压相等,也就是,VDD/2。
使用图4所示的预滤波,可以获得相当纯的调谐电压。然而,一个缺陷是,如果目标是短稳定时间,低噪音和基准频率信号调谐电压的漏泻可以忽略,均衡就要照顾到几个方面并且非常困难。这是因为低通滤波器的限制和选择了电阻R1a和R1b所引起的。根据图4选择所知的有源滤波器的组件值也很困难:对噪音而言,图3中的有源积分电路可以看作是增益为1的同相放大器。在图4的电路中,如果没有C3,高频增益是(R2+R1b)/R1b。这样,电容C13的存在大大地增加了噪音,R1b也就不能太小。另一方面,R1a也不能太小,因为R1a如果太小,充电泵的输出电流将变得太大。输出电流有一个很大的容差范围,它对正和负相位误差往往是不同的。所有这些产生了不可预测的效果,这在大规模生产中不能容忍。如果C33存在,高频时噪音将减少,但需要减少电容C13的值以保持短的稳定时间。这增加了放大器输入端的充电泵脉冲的变化率,因而放大器可能饱和。
图4所示电路的另一个缺陷是减少了输出电流,也就是,如果频率间距大,稳定时间将变长。在这种情况下,有源积分电路需要高控制电流,以迫使电容C13的电压值偏离稳定状态值VDD/2。
因为上述的有源滤波器的缺陷,也就是,它们的复杂性,难于优化和基准频率信号的少量衰减,人们对无源滤波器仍存在一些兴趣。当开发了第二代恒流输出的充电泵,也就是,在充电泵中的输出电流与输出电压无关,只要调谐电压不需超过0-工作电压Vdd,又可能根据图2使用无源滤波器了。因为充电泵的电流源不是理想状态下的,实际上调谐电压在1V,...,Vdd-1V之间变化。当使用这样的充电泵时,图2电路中电阻R1值为0。该锁相环路PLL的恒流输出充电泵使用现有技术的无源积分电路,当振荡器的控制电压区不需要很大时,该锁相环路运转得很好。也有扩展了调谐区的充电泵,其输出级的电源电压甚至比正向逻辑电源电压还要高。然而,在使用无源滤波器的情况下,没有方法可以获取高于6V的电源电压。本领域的技术人员所采用的最通常的解决方案是放弃无源滤波器,按照图3或4使用所知的有源滤波器。
发明内容
本发明公开了一种锁相环路,它的环路滤波器使用了一种消除了现有技术中的有源滤波器的缺陷的充电泵,并且该锁相环路允许大的VCO调谐电压区域。
根据本发明,提供一种锁相环路,包括一个由电压控制的振荡器,一种相位检波器,其第一输入用以接收基准信号,其第二输入用以接收从压控振荡器输出端获取的振荡器信号,并且相位检波器响应输入信号差产生U(上行)和D(下行)脉冲,一充电泵,将传导的U和D脉冲转换成输出端的双极电流脉冲,充电泵的电流实际上取决于输出电流,将充电泵提供的脉冲转换成压控振荡器调谐电压的积分装置,其特征在于,积分装置包括:一个无源积分器,用以传导充电泵提供的脉冲以形成一个合成电压;一个运算放大器,所述合成电压向其同相输入端传导,其输出电压是电压操作振荡器的调谐电压,通过它无源积分器保护运算放大器免受电流脉冲;和移位合成电压的电压值的装置。
本发明基于以下事实:在现有技术的有源滤波器中,一个无源积分电路连接倒相运算放大器的输入端和输出端,也就是,进入反馈通路,反馈通路使充电泵产生的快速脉冲可以直接接入到放大器的输出端。根据本发明,无源积分电路放置于同相运算放大器之前,它将充电泵的脉冲短路到地,在运算放大器之前不再需要附加的低通滤波器。这样,无源积分电路可以包括更多的低通滤波器,当需要时,置于运算放大器之后的滤波器可以包括更多的低通滤波器,而环路的稳定时间仍保持很短。因为运算放大器是同相的,在相同的放大因子下,它比倒相放大器产生更少的噪音。该电路的复杂性也比现有技术的电路要小,在环路稳定时间、振荡器调谐电压纯度之间均衡时,更容易达成折衷。
附图说明
在后续说明中,根据本发明的一个优选实施例,参照相关图形对本发明进行更详细的描述,其中
图1示出了锁相环路的框图,
图2示出了一种众所周知的无源环路滤波器,
图3和图4  示出了众所周知的有源环路滤波器电路,
图5示出了根据本发明的环路滤波器电路的框图,和
图6是图5中滤波器的一种电路解决方案。
具体实施方式
如图5所示,恒流充电泵3所产生的脉冲被导向众所周知的无源积分电路51,例如,如图2所示,图5中的所述积分电路包括电容C24,C34和电阻R24,它所提供的输出电压在同相运算放大器52中被放大。必须注意到,无源积分电路用以防止充电泵3的脉冲进入运算放大器52。这样就不需要一个附加的低通滤波。当无源滤波器52用于保护作用时,与现有技术滤波器比较,其脉冲衰减更好,组件数量可以减少,均衡也更简单。通过放大器52向任一输入极电压增加DC电压V0,DC电平移位也可以实现。通过这种方法,VCO可以很容易地获取所需的最高电压超过6V的调谐电压区域。图5中通过加法器54示出了DC电平移位。在需要时,可以使用滤波器53对放大器2的输出信号进行滤波。
各组件的均衡方式实际上与无源积分电路相同,但是相对简单,因为放大器52隔开了积分电路和可选的低通滤波器。
图6示出了本发明滤波器的一种电路电平解决方案。通过一个偏置电阻R65向放大器62倒相输入端提供直流电压V0,导致了该放大器输出电压的DC电平移位。实际上,电压V0是该设备的工作电压之一,可能已经过滤波。在包括电阻R5的放大器反馈通路中的电容Comp是个小电容,用以补偿放大器输入端和地之间的寄生电容Cpar。过补偿会使放大器变成一种低通滤波器。这种特性有利于衰减输出电压Vt,也就是VCO调谐电压,的高频噪音。二极管D1用于在充电泵输出为零的异常情况下,防止运算放大器的输出过慢。图6中的电路还包括电阻R45。
可选用的低通滤波器63可以简单地通过一个RC滤波器R75,C75来实现。
图5中的电路可以以下述方式均衡:首先选择放大器52的增益。它可能等于所需的VCO调谐电压区域除以充电泵3允许输出电压的可用电压区域。该增益不能太大以免增加噪音。然后,计算将充电泵的最小输出电压移位到最小所需VCO调谐电压Vtmin所需的电平移位。积分电路61的时间常量的均衡方式通常与无源积分电路相同,但不是实际的VCO调谐敏感度,而是它的值乘以放大器62的增益,其中,所述积分电路61包括电容C25,C35和电阻R25。还可以保证调谐电压Vt下运算放大器的噪音效果足够低。如果不是这样,可以通过,例如,在滤波器63上增加低通滤波来减少噪音效果和降低电容C35。
本发明的一个优点在于运算放大器是同相的。一些商用集成PLL电路无法改变相位检波器的极性,而这种极性改变正是使用倒相有源滤波器所需要的。这样,本发明的滤波器也可以用于这些IC电路。
上述解释和相关的示图仅用于说明本发明。在不偏离后附权利要求书所公开的本发明的范围和精神的前提下,本发明的许多不同变化和改动对本领域的技术人员是显然的。这样,使用负调谐电压的VCO电路可以使用本发明。

Claims (4)

1.一种锁相环路,包括
一个压控振荡器,
一种相位检波器,其第一输入用以接收基准信号,其第二输入用以接收从压控振荡器输出端获取的振荡器信号(fvco),并且相位检波器响应输入信号差产生U(上行)和D(下行)脉冲,
一充电泵,将传导的U和D脉冲转换成输出端的双极电流脉冲,充电泵的电流实际上取决于输出电流,
将充电泵提供的脉冲转换成压控振荡器调谐电压(Vt)的积分装置,
其特征在于,积分装置包括:一个无源积分器(51),用以传导充电泵提供的脉冲以形成一个合成电压;一个运算放大器(52),所述合成电压向其同相输入端传导,其输出电压是压控振荡器的调谐电压(Vt),通过无源积分器(51)保护运算放大器(52)免受电流脉冲;和移位合成电压的电压值的装置。
2.根据权利要求1的锁相环路,其特征在于,移位合成电压的电压值的装置包括转换运算放大器(52)倒相输入端的DC电平的装置(R65)。
3.根据权利要求1的锁相环路,其特征在于,运算放大器(52)的输出端连接低通滤波器,以进一步进行所述运算放大器的输出电压的滤波。
4.根据权利要求1-3中任一项的锁相环路,其特征在于,从压控振荡器输出端获取的振荡器信号(fvco)在分频器中分频。
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WO (1) WO1996031951A2 (zh)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1633028B (zh) * 2005-01-25 2010-04-28 威盛电子股份有限公司 锁相回路和其应用的回路滤波器

Families Citing this family (20)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6642758B1 (en) 1998-11-03 2003-11-04 Altera Corporation Voltage, temperature, and process independent programmable phase shift for PLL
US6836164B1 (en) * 1998-11-03 2004-12-28 Altera Corporation Programmable phase shift circuitry
US7109765B1 (en) 1998-11-03 2006-09-19 Altera Corporation Programmable phase shift circuitry
US6650720B1 (en) * 1998-12-22 2003-11-18 Xilinx, Inc. Phase lock loop and transconductance circuit for clock recovery
US6606364B1 (en) * 1999-03-04 2003-08-12 Harris Corporation Multiple data rate bit synchronizer having phase/frequency detector gain constant proportional to PLL clock divider ratio
US6526113B1 (en) 1999-08-11 2003-02-25 Broadcom Corporation GM cell based control loops
US6389092B1 (en) * 1999-08-11 2002-05-14 Newport Communications, Inc. Stable phase locked loop having separated pole
US6993106B1 (en) 1999-08-11 2006-01-31 Broadcom Corporation Fast acquisition phase locked loop using a current DAC
US6826246B1 (en) * 1999-10-15 2004-11-30 Agere Systems, Inc. Phase locked loop with control voltage centering
US6522204B1 (en) * 2000-11-28 2003-02-18 Texas Instruments Incorporated Phase-locked loop for ADSL frequency locking applications
WO2002076009A1 (en) * 2001-03-20 2002-09-26 Gct Semiconductor, Inc. Fractional-n frequency synthesizer with fractional compensation method
US6429734B1 (en) 2001-12-19 2002-08-06 Neoaxiom Corporation Differential active loop filter for phase locked loop circuits
US6677789B1 (en) 2002-09-10 2004-01-13 Nokia Corporation Rail-to-rail linear charge pump
US6806751B2 (en) * 2002-09-12 2004-10-19 Foundry Networks, Inc. Loop filter for a phase-locked loop and method for switching
JP2009510805A (ja) 2005-06-21 2009-03-12 エヌエックスピー ビー ヴィ 帯域幅切替型フィードバックループ内にローパスフィルタを用いた位相ロックループシステム
US7345550B2 (en) * 2005-12-05 2008-03-18 Sirific Wireless Corporation Type II phase locked loop using dual path and dual varactors to reduce loop filter components
JP4598691B2 (ja) * 2006-02-22 2010-12-15 富士通セミコンダクター株式会社 Pll回路及び半導体装置
CN101651456B (zh) * 2008-08-12 2012-03-21 博通集成电路(上海)有限公司 时钟信号恢复的电路
US8552772B2 (en) 2011-01-06 2013-10-08 Asahi Kasei Microdevices Corporation Loop filter buffer with level shifter
US8558592B2 (en) * 2011-02-03 2013-10-15 Texas Instruments Incorporated Charge pump and active filter for a feedback circuit

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4970472A (en) * 1989-09-01 1990-11-13 Delco Electronics Corporation Compensated phase locked loop circuit
CN2125147U (zh) * 1992-03-28 1992-12-16 姚豪杰 静止式电能表
US5382923A (en) * 1992-06-12 1995-01-17 Shinko Electric Industries Co., Ltd. Charge-pump circuit for use in phase locked loop
EP0642227A1 (en) * 1993-09-07 1995-03-08 Nec Corporation Charge-pump phase-lock loop circuit

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2788797B2 (ja) * 1991-06-13 1998-08-20 日本電気株式会社 位相同期ループ回路
US5121085A (en) * 1991-06-28 1992-06-09 Digital Equipment Corporation Dual-charge-pump bandwidth-switched phase-locked loop
US5414741A (en) * 1993-10-14 1995-05-09 Litton Systems, Inc. Low phase noise oscillator frequency control apparatus and method

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4970472A (en) * 1989-09-01 1990-11-13 Delco Electronics Corporation Compensated phase locked loop circuit
CN2125147U (zh) * 1992-03-28 1992-12-16 姚豪杰 静止式电能表
US5382923A (en) * 1992-06-12 1995-01-17 Shinko Electric Industries Co., Ltd. Charge-pump circuit for use in phase locked loop
EP0642227A1 (en) * 1993-09-07 1995-03-08 Nec Corporation Charge-pump phase-lock loop circuit

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1633028B (zh) * 2005-01-25 2010-04-28 威盛电子股份有限公司 锁相回路和其应用的回路滤波器

Also Published As

Publication number Publication date
CN1149944A (zh) 1997-05-14
EP0764367B1 (en) 2000-08-02
WO1996031951A3 (en) 1996-11-07
FI951604A0 (fi) 1995-04-04
JPH10501671A (ja) 1998-02-10
DE69609578T2 (de) 2001-04-05
US5783971A (en) 1998-07-21
WO1996031951A2 (en) 1996-10-10
EP0764367A2 (en) 1997-03-26
NO965166D0 (no) 1996-12-03
AU4881896A (en) 1996-10-23
NO965166L (no) 1997-02-03
ATE195205T1 (de) 2000-08-15
DE69609578D1 (de) 2000-09-07
AU706217B2 (en) 1999-06-10
FI97579B (fi) 1996-09-30
FI97579C (fi) 1997-01-10

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