CN111312826A - 一种显示面板及其制作方法、显示模组及电子装置 - Google Patents

一种显示面板及其制作方法、显示模组及电子装置 Download PDF

Info

Publication number
CN111312826A
CN111312826A CN202010142740.4A CN202010142740A CN111312826A CN 111312826 A CN111312826 A CN 111312826A CN 202010142740 A CN202010142740 A CN 202010142740A CN 111312826 A CN111312826 A CN 111312826A
Authority
CN
China
Prior art keywords
layer
oxide semiconductor
metal oxide
buffer
semiconductor layer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
CN202010142740.4A
Other languages
English (en)
Other versions
CN111312826B (zh
Inventor
刘方梅
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Shenzhen China Star Optoelectronics Semiconductor Display Technology Co Ltd
Original Assignee
Shenzhen China Star Optoelectronics Semiconductor Display Technology Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Shenzhen China Star Optoelectronics Semiconductor Display Technology Co Ltd filed Critical Shenzhen China Star Optoelectronics Semiconductor Display Technology Co Ltd
Priority to CN202010142740.4A priority Critical patent/CN111312826B/zh
Publication of CN111312826A publication Critical patent/CN111312826A/zh
Application granted granted Critical
Publication of CN111312826B publication Critical patent/CN111312826B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/786Thin film transistors, i.e. transistors with a channel being at least partly a thin film
    • H01L29/7869Thin film transistors, i.e. transistors with a channel being at least partly a thin film having a semiconductor body comprising an oxide semiconductor material, e.g. zinc oxide, copper aluminium oxide, cadmium stannate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/24Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only semiconductor materials not provided for in groups H01L29/16, H01L29/18, H01L29/20, H01L29/22
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/30Semiconductor bodies ; Multistep manufacturing processes therefor characterised by physical imperfections; having polished or roughened surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/66007Multistep manufacturing processes
    • H01L29/66969Multistep manufacturing processes of devices having semiconductor bodies not comprising group 14 or group 13/15 materials
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10KORGANIC ELECTRIC SOLID-STATE DEVICES
    • H10K59/00Integrated devices, or assemblies of multiple devices, comprising at least one organic light-emitting element covered by group H10K50/00
    • H10K59/10OLED displays
    • H10K59/12Active-matrix OLED [AMOLED] displays
    • H10K59/1201Manufacture or treatment
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10KORGANIC ELECTRIC SOLID-STATE DEVICES
    • H10K59/00Integrated devices, or assemblies of multiple devices, comprising at least one organic light-emitting element covered by group H10K50/00
    • H10K59/10OLED displays
    • H10K59/12Active-matrix OLED [AMOLED] displays
    • H10K59/121Active-matrix OLED [AMOLED] displays characterised by the geometry or disposition of pixel elements
    • H10K59/1213Active-matrix OLED [AMOLED] displays characterised by the geometry or disposition of pixel elements the pixel elements being TFTs

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Ceramic Engineering (AREA)
  • Computer Hardware Design (AREA)
  • Manufacturing & Machinery (AREA)
  • Geometry (AREA)
  • Thin Film Transistor (AREA)
  • Devices For Indicating Variable Information By Combining Individual Elements (AREA)
  • Electroluminescent Light Sources (AREA)

Abstract

本发明提供一种显示面板及其制作方法、显示模组及电子装置,该显示面板包括:衬底基板;缓冲层,所述缓冲层的材料包括第一元素;金属氧化物半导体层,设于所述缓冲层上;所述金属氧化物半导体层的材料包括第二元素;所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间的界面满足预设条件。本发明的显示面板及其制作方法、显示模组及电子装置,能够提高薄膜晶体管的可靠性。

Description

一种显示面板及其制作方法、显示模组及电子装置
【技术领域】
本发明涉及显示技术领域,特别是涉及一种显示面板及其制作方法、显示模组及电子装置。
【背景技术】
由于金属氧化物薄膜晶体管具有高迁移率、稳定性好、制作工艺简单等优点,成为研究的热点。
顶栅结构的金属氧化物薄膜晶体管的结构包括缓冲层和金属氧化物半导体层,这两个膜层之间的界面影响薄膜晶体管的可靠性,然而目前的缓冲层和金属氧化物半导体层之间的界面容易出现缺陷,从而降低了薄膜晶体管的可靠性。
因此,有必要提供一种显示面板及其制作方法、显示模组及电子装置,以解决现有技术所存在的问题。
【发明内容】
本发明的目的在于提供一种显示面板及其制作方法、显示模组及电子装置,能够提高薄膜晶体管的可靠性。
为解决上述技术问题,本发明提供一种显示面板,包括:
衬底基板;
缓冲层,所述缓冲层的材料包括第一元素;
金属氧化物半导体层,设于所述缓冲层上;所述金属氧化物半导体层的材料包括第二元素;所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间的界面满足预设条件;
第一金属层,设于所述金属氧化物半导体层上;所述第一金属层包括栅极;
第二金属层,设于所述栅极上,所述第二金属层包括源极和漏极。
在本发明的显示面板中,所述第一元素包括N;所述第二元素包括Ga。
在本发明的显示面板中,所述缓冲层的材料包括:SION;
所述金属氧化物半导体层的材料包括IGZO、IGZTO以及Ga2O3中的至少一种。
在本发明的显示面板中,所述缓冲层包括第一缓冲子层和第二缓冲子层;所述第二缓冲子层靠近所述金属氧化物半导体层,所述第二缓冲子层的材料包括SION。
在本发明的显示面板中,所述第一缓冲子层的材料包括SiO2和SiNx中的至少一种。
在本发明的显示面板中,所述缓冲层的厚度范围为
Figure BDA0002399655080000031
在本发明的显示面板中,所述金属氧化物半导体层的厚度范围为
Figure BDA0002399655080000032
本发明还提供一种显示模组,其包括上述显示面板。
本发明还提供一种电子装置,其包括上述显示模组。
本发明还提供一种显示面板的制作方法,其包括:
在衬底基板上制作缓冲层,所述缓冲层的材料包括第一元素;
在所述缓冲层上制作金属氧化物半导体层;所述金属氧化物半导体层的材料包括第二元素;所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间的界面满足预设条件;
在所述金属氧化物半导体层上制作第一金属层,对所述第一金属层进行图案化处理形成栅极;
在所述第一金属层上制作第二金属层,对所述第二金属层进行图案化处理形成源极和漏极。
本发明的显示面板及其制作方法、显示模组及电子装置,包括衬底基板;缓冲层,所述缓冲层的材料包括第一元素;金属氧化物半导体层,设于所述缓冲层上;所述金属氧化物半导体层的材料包括第二元素;所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间界面满足预设条件;第一金属层,设于所述金属氧化物半导体层上;所述第一金属层包括栅极;第二金属层,设于所述栅极上,所述第二金属层包括源极和漏极,由于所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间的界面满足预设条件,从而减小缓冲层和所述金属氧化物半导体层之间的界面缺陷,提高了薄膜晶体管的可靠性。
【附图说明】
图1为本发明一实施例的显示面板的剖面示意图;
图2为本发明另一实施例的显示面板的剖面示意图。
【具体实施方式】
以下各实施例的说明是参考附加的图式,用以例示本发明可用以实施的特定实施例。本发明所提到的方向用语,例如「上」、「下」、「前」、「后」、「左」、「右」、「内」、「外」、「侧面」等,仅是参考附加图式的方向。因此,使用的方向用语是用以说明及理解本发明,而非用以限制本发明。在图中,结构相似的单元是以相同标号表示。
请参照图1,图1本发明一实施例的显示面板的剖面示意图。
如图1所示,本实施例的显示面板包括衬底基板10、缓冲层12、金属氧化物半导体层13、第一金属层15、第二金属层17、有机发光显示层,此外还可包括遮光层11、第一绝缘层14、第二绝缘层16、第三绝缘层18以及平坦层19。
其中衬底基板10可为玻璃基板。
遮光层11设于所述衬底基板10上,在一实施方式中,所述遮光层11的材料包括Mo,其中为了进一步提高遮光效果,遮光层11的厚度范围可为
Figure BDA0002399655080000052
缓冲层12设于所述遮光层11上。所述缓冲层12的材料包括第一元素;在一实施方式中,为了进一步减少缓冲层12与半导体层之间的界面缺陷,所述第一元素包括N。在一实施方式中,所述缓冲层12的厚度范围为
Figure BDA0002399655080000051
金属氧化物半导体层13设于所述缓冲层12上。所述金属氧化物半导体层13的材料包括第二元素;所述第一元素可与所述第二元素结合,以使所述缓冲层12和所述金属氧化物半导体层13之间的界面满足预设条件;也即使得界面缺陷满足制程需求,在一实施方式中,了进一步减少缓冲层12与金属氧化物半导体层13之间的界面缺陷,所述第二元素包括Ga。由于N与Ga结合,调补氧空缺,且Ga-N健比Ga-O更稳定,有利于优化IGZO/buffer界面,减少缺陷,提高器件的可靠性。其中所述金属氧化物半导体层13的材料包括IGZO、IGZTO以及Ga2O3中的至少一种。所述金属氧化物半导体层13的厚度范围为
Figure BDA0002399655080000061
所述遮光层11覆盖所述金属氧化物半导体层13。所述金属氧化物半导体层13包括沟道区域(图中未标出)。
第一绝缘层14设于所述半导体层上,所述第一绝缘层14的材料包括SiNx和SiO2中的至少一种。所述第一绝缘层14的厚度范围为
Figure BDA0002399655080000062
所述第一绝缘层14的位置与沟道区域的位置对应。
第一金属层15设于所述第一绝缘层14上;所述第一金属层15包括栅极151。第一金属层15的材料包括Mo、Al、Cu、Ti中的至少一种,第一金属层15的厚度范围为
Figure BDA0002399655080000063
所述栅极151与所述第一绝缘层14的位置对应。
第二绝缘层16设于所述第一金属层15上,所述第二绝缘层16的材料包括SiNx和SiO2中的至少一种。所述第二绝缘层16的厚度范围为
Figure BDA0002399655080000064
第二金属层17设于所述第二绝缘层16上;所述第二金属层17包括源极171和漏极172。第二金属层17的材料包括Mo、Al、Cu、Ti中的至少一种,第二金属层17的厚度范围为
Figure BDA0002399655080000065
在一实施方式中,漏极172与遮光层11连接。
第三绝缘层18设于所述第二金属层17上,所述第三绝缘层18的材料包括SiNx和SiO2中的至少一种。第三绝缘层18的厚度范围为
Figure BDA0002399655080000071
平坦层19设于所述第三绝缘层18上,所述平坦层19上设置有第一连接孔(图中未标出),所述第一连接孔贯穿所述平坦层19和所述第三绝缘层18。平坦层19的厚度范围为
Figure BDA0002399655080000072
有机发光显示层包括阳极20、像素定义层21、发光层以及阴极(图中未示出);阳极的材料为透明导电材料,比如为氧化铟锡。阳极20通过第一连接孔与所述漏极172连接。
阳极20可以为ITO/Ag/ITO的叠层结构。像素定义层21设于所述阳极上,所述像素定义层21包括开口区域。像素定义层21的厚度范围可为
Figure BDA0002399655080000073
发光层位于所述开口区域内;阴极设于所述发光层上。其中所述阴极的材料可为是镁银合金(Mg/Ag),所述阴极的厚度不限。
此外,该显示面板还可包括封装层。
在一实施方式中,上述显示面板的制作方法包括:
S101、在衬底基板上制作缓冲层,所述缓冲层的材料包括第一元素;
例如,在一实施方式中,可在衬底基板10上依次制作遮光层11、缓冲层12以及金属氧化物半导体层13;
比如,对玻璃基板进行清洗和预烘烤。之后在其上沉积遮光材料,形成遮光层11。在遮光层11上依次沉积缓冲层12的材料,形成缓冲层12。所述缓冲层12的具体材料可参见上文。
S102、在所述缓冲层上制作金属氧化物半导体层;所述金属氧化物半导体层的材料包括第二元素;
其中所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间的界面满足预设条件;
例如,可在缓冲层12上沉积金属氧化物材料,用黄光和蚀刻定义出图形,作为金属氧化物半导体层13。其中金属氧化物半导体层13的材料具体参见上文。
S103、在所述金属氧化物半导体层上制作第一金属层,对所述第一金属层进行图案化处理形成栅极;
例如,在一实施方式中,可在金属氧化物半导体层13上上形成第一金属层15,对第一金属层15进行图案化处理形成栅极151。
S104、在所述第一金属层上制作第二金属层,对所述第二金属层进行图案化处理形成源极和漏极。
例如,在一实施方式中,在所述金属氧化物半导体层13和栅极151上依次制作第二绝缘层16和第二金属层17,对第二金属层17进行图案化处理形成源极171和漏极172。
第二绝缘层16和第二金属层17以及钝化层均可通过沉积工艺制作得到。
上述方法还可包括:
S105、在第二金属层17上依次制作第三绝缘层18和平坦层19。
第三绝缘层18和平坦层19均可通过沉积工艺制作得到,其中第三绝缘层18和平坦层19制作有过孔,以形成第一连接孔。
S106、在平坦层19上制作有机发光显示层。
在平坦层19上沉积导电材料,并利用黄光工艺定义出图形,形成阳极20。
接着涂布像素定义层材料,对其进行图案化处理形成开口区域,之后在所述像素定义层的开口区域内蒸镀发光材料,并在发光层上蒸镀阴极材料。
在另一实施方式中,上述S103、在所述金属氧化物半导体层上制作第一金属层,对所述第一金属层进行图案化处理形成栅极的步骤可包括:
S201、在所述金属氧化物半导体层13上制作第一绝缘层14。
S202、在所述第一绝缘层14上形成第一金属层15,对第一金属层15进行图案化处理形成栅极151。
其中,在步骤S202以及步骤S105之前,所述方法还可包括:
S203、采用所述栅极作为遮挡体对所述第一绝缘层进行图案化处理,以将其上未覆盖栅极的第一绝缘层去除。
例如,利用栅极151的图案为自对准图案,蚀刻第一绝缘层14,将与栅极151位置对应的第一绝缘层保留,而将其余部分去除,得到所需的图案。
S204、采用所述栅极作为遮挡体对所述金属氧化物半导体层进行导体化处理,以使与所述栅极位置对应的金属氧化物半导体层形成沟道。
例如,对所述金属氧化物半导体层13进行等离子体处理,使得上方没有第一绝缘层14和栅极151保护的部分被处理后电阻明显降低,形成N+导体层,而位于栅极151正下方的部分没有被处理到,保持半导体特性,作为薄膜晶体管的导电沟道。
实验发现,对于金属氧化物半导体层13和第一绝缘层14之间的界面可采用在第一绝缘层14进行沉积之前采用一氧化二氮N2O对金属氧化物半导体层13进行等离子体处理(plasama),使得N和O调补金属氧化物半导体层13中的缺陷,改善界面;对于缓冲层12和金属氧化物半导体层13之间的界面,也采用N和O调补缺陷,与上述方法相似,可以预测达到同样的效果。
请参照图2,图2本发明另一实施例的显示面板的剖面示意图。
在另一实施例中,如图2所示,所述缓冲层12包括第一缓冲子层121和第二缓冲子层122;所述第二缓冲子层122靠近所述金属氧化物半导体层13,所述第二缓冲子层122的材料包括SION。所述第一缓冲子层121的材料包括SiO2和SiNx中的至少一种。
所述第一元素可与所述第二元素结合,以使所述缓冲层12和所述金属氧化物半导体层13之间的界面满足预设条件;也即使得界面缺陷满足制程需求,在一实施方式中,为了进一步减少缓冲层12与半导体层之间的界面缺陷,所述第二元素包括Ga。由于N与Ga结合,调补氧空缺,且Ga-N健比Ga-O更稳定,有利于优化IGZO/buffer界面,减少缺陷,提高器件可靠性和可靠性。
本实施例的显示面板的制作方法与上一实施例的区别在于:步骤S101不同,具体替换为:
S201、在衬底基板上依次制作第一缓冲子层121和第二缓冲子层122,所述第二缓冲子层122的材料包括第一元素。具体制程方法与上一实施例的制程方法相同,在此不再赘述。
本发明还提供一种显示模组,其包括上述任意一种显示面板。该显示模组还可包括触控层。
本发明还提供一种电子装置,其包括上述任意一种显示模组。该电子装置可以为手机、平板电脑、电脑等设备。
本发明的显示面板及其制作方法、显示模组及电子装置,包括衬底基板;缓冲层,所述缓冲层的材料包括第一元素;金属氧化物半导体层,设于所述缓冲层上;所述金属氧化物半导体层的材料包括第二元素;所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间界面满足预设条件;第一金属层,设于所述金属氧化物半导体层上;所述第一金属层包括栅极;第二金属层,设于所述栅极上,所述第二金属层包括源极和漏极,由于所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间界面满足预设条件,从而减小缓冲层和所述金属氧化物半导体层之间的界面缺陷,提高了薄膜晶体管的可靠性。
综上所述,虽然本发明已以优选实施例揭露如上,但上述优选实施例并非用以限制本发明,本领域的普通技术人员,在不脱离本发明的精神和范围内,均可作各种更动与润饰,因此本发明的保护范围以权利要求界定的范围为准。

Claims (10)

1.一种显示面板,其特征在于,包括:
衬底基板;
缓冲层,所述缓冲层的材料包括第一元素;
金属氧化物半导体层,设于所述缓冲层上;所述金属氧化物半导体层的材料包括第二元素;所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间的界面满足预设条件;
第一金属层,设于所述金属氧化物半导体层上;所述第一金属层包括栅极;
第二金属层,设于所述栅极上,所述第二金属层包括源极和漏极。
2.根据权利要求1所述的显示面板,其特征在于,
所述第一元素包括N;所述第二元素包括Ga。
3.根据权利要求2所述的显示面板,其特征在于,
所述缓冲层的材料包括:SION;
所述金属氧化物半导体层的材料包括IGZO、IGZTO以及Ga2O3中的至少一种。
4.根据权利要求3所述的显示面板,其特征在于,
所述缓冲层包括第一缓冲子层和第二缓冲子层;所述第二缓冲子层靠近所述金属氧化物半导体层,所述第二缓冲子层的材料包括SION。
5.根据权利要求4所述的显示面板,其特征在于,
所述第一缓冲子层的材料包括SiO2和SiNx中的至少一种。
6.根据权利要求1所述的显示面板,其特征在于,
所述缓冲层的厚度范围为
Figure FDA0002399655070000021
7.根据权利要求1所述的显示面板,其特征在于,
所述金属氧化物半导体层的厚度范围为
Figure FDA0002399655070000022
8.一种显示模组,其特征在于,包括如权利要求1至7中任一项所述的显示面板。
9.一种电子装置,其特征在于,包括如权利要求8所述的显示模组。
10.一种显示面板的制作方法,其特征在于,所述方法包括:
在衬底基板上制作缓冲层,所述缓冲层的材料包括第一元素;
在所述缓冲层上制作金属氧化物半导体层;所述金属氧化物半导体层的材料包括第二元素;所述第一元素可与所述第二元素结合,以使所述缓冲层和所述金属氧化物半导体层之间的界面满足预设条件;
在所述金属氧化物半导体层上制作第一金属层,对所述第一金属层进行图案化处理形成栅极;
在所述第一金属层上制作第二金属层,对所述第二金属层进行图案化处理形成源极和漏极。
CN202010142740.4A 2020-03-04 2020-03-04 一种显示面板及其制作方法、显示模组及电子装置 Active CN111312826B (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN202010142740.4A CN111312826B (zh) 2020-03-04 2020-03-04 一种显示面板及其制作方法、显示模组及电子装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN202010142740.4A CN111312826B (zh) 2020-03-04 2020-03-04 一种显示面板及其制作方法、显示模组及电子装置

Publications (2)

Publication Number Publication Date
CN111312826A true CN111312826A (zh) 2020-06-19
CN111312826B CN111312826B (zh) 2024-01-19

Family

ID=71147275

Family Applications (1)

Application Number Title Priority Date Filing Date
CN202010142740.4A Active CN111312826B (zh) 2020-03-04 2020-03-04 一种显示面板及其制作方法、显示模组及电子装置

Country Status (1)

Country Link
CN (1) CN111312826B (zh)

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20120276694A1 (en) * 2011-04-27 2012-11-01 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method of semiconductor device
CN103700710A (zh) * 2013-12-30 2014-04-02 Tcl集团股份有限公司 Igzo薄膜晶体管及其制备方法
CN106558593A (zh) * 2015-09-18 2017-04-05 鸿富锦精密工业(深圳)有限公司 阵列基板、显示面板、显示装置及阵列基板的制备方法
CN106935656A (zh) * 2012-04-06 2017-07-07 株式会社半导体能源研究所 绝缘膜、半导体装置的制造方法以及半导体装置
CN110729357A (zh) * 2019-10-22 2020-01-24 深圳市华星光电半导体显示技术有限公司 薄膜晶体管及其制造方法

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20120276694A1 (en) * 2011-04-27 2012-11-01 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method of semiconductor device
CN106935656A (zh) * 2012-04-06 2017-07-07 株式会社半导体能源研究所 绝缘膜、半导体装置的制造方法以及半导体装置
CN103700710A (zh) * 2013-12-30 2014-04-02 Tcl集团股份有限公司 Igzo薄膜晶体管及其制备方法
CN106558593A (zh) * 2015-09-18 2017-04-05 鸿富锦精密工业(深圳)有限公司 阵列基板、显示面板、显示装置及阵列基板的制备方法
CN110729357A (zh) * 2019-10-22 2020-01-24 深圳市华星光电半导体显示技术有限公司 薄膜晶体管及其制造方法

Also Published As

Publication number Publication date
CN111312826B (zh) 2024-01-19

Similar Documents

Publication Publication Date Title
CN107689345B (zh) Tft基板及其制作方法与oled面板及其制作方法
CN107680993B (zh) Oled面板及其制作方法
US11610922B2 (en) Array substrate and display panel design improving aperture ratio
WO2019071725A1 (zh) 顶栅自对准金属氧化物半导体tft及其制作方法
WO2016176886A1 (zh) 柔性oled及其制作方法
JP2007157916A (ja) Tft基板及びtft基板の製造方法
US11569472B2 (en) Electroluminescent display substrate, manufacturing method thereof and electroluminescent display apparatus
CN109638078B (zh) Tft的制备方法、tft、oled背板和显示装置
CN104681629A (zh) 薄膜晶体管、阵列基板及其各自的制备方法、显示装置
CN113192980B (zh) 一种阵列基板结构、显示装置及阵列基板结构的制备方法
CN110993644A (zh) Oled显示面板及制备方法
CN111244110B (zh) 一种显示面板以及电子装置
US10361261B2 (en) Manufacturing method of TFT substrate, TFT substrate, and OLED display panel
CN113629073B (zh) Tft背板与显示面板
CN111276527A (zh) 一种显示面板及其制作方法
CN114203778A (zh) 有源矩阵oled显示面板及其制备方法
US20230148287A1 (en) Displaying Substrate, Manufacturing Method Thereof, and Display Panel
CN112635534A (zh) 显示面板、显示装置和显示面板的制作方法
CN111312732B (zh) 一种显示面板及其制作方法、显示模组及电子装置
WO2020206719A1 (zh) 显示面板及其制备方法
CN111312826B (zh) 一种显示面板及其制作方法、显示模组及电子装置
CN115274693A (zh) 显示面板及其制作方法、移动终端
CN111668268A (zh) 一种oled显示装置及制作方法
US12022686B2 (en) Manufacturing method of OLED panel and OLED panel
KR102617444B1 (ko) 박막 트랜지스터 기판

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant