CN111221675A - 用于ram错误检测逻辑的自诊断的方法和装置 - Google Patents

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Abstract

本公开涉及用于RAM错误检测逻辑的自诊断的方法和装置。用于动力总成控制器的RAM错误检测逻辑的自诊断的方法包括：对于应用了多内核型微控制器单元(MCU)的动力总成控制器的RAM错误检测逻辑的自诊断，通过多个内核的第一内核闲置第二内核的操作并且对与结合第二内核操作的RAM相对应的纠错码(ECC)模块执行测试，并且通过第二内核闲置未被执行测试的多个内核当中的一个内核的操作，并且对与结合相应的内核操作的RAM对应的ECC模块执行测试。

Description

用于RAM错误检测逻辑的自诊断的方法和装置
相关申请的交叉引用
本申请要求于2018年11月26日向韩国知识产权局提交的韩国专利申请No.10-2018-0147439的优先权，将其全部内容通过引用结合于此。
技术领域
本公开的实施方式涉及一种用于动力总成控制器的随机存取存储器(RAM)错误检测逻辑的自诊断的方法和装置，且更具体地，涉及一种动力总成控制器的RAM错误检测逻辑的自诊断的方法和装置，其可以诊断动力总成控制器(或者动力总成ECU系统)的RAM错误检测逻辑(或者纠错码(ECC)模块)中是否出现错误。
背景技术
近来，随着对车辆进行电子控制，车辆的功能安全性变得重要。
具体地，其中执行输入、计算与输出的微控制器单元(MCU)的存储器错误检测(或者感测)功能相当于防止控制故障的非常重要的功能。
因此，在常规技术中，为了检测存储器(即，RAM)中的错误，当MCU启用纠错码(ECC)模块时，ECC模块以检测存储器(即，RAM)中的错误的方式运行。
换言之，在常规技术中，ECC模块(或者RAM错误检测逻辑)的自诊断是不可能的，并且存储器(即，RAM)测试中出现的错误类型也无法被区分。即，仅基于ECC模块(或者RAM错误检测逻辑)的信息能够获知存储器是否出现错误。
因此，当ECC模块(或者RAM错误检测逻辑)正常运行时没有问题，但有一个问题是，不能检测ECC模块本身是否执行误操作。因此，需要一种能够验证ECC模块中是否出现错误的方法。
本公开的背景技术在题为“STORAGE DEVICE AND DATA ENCODING AND DECODINGMETHODS THEREOF”的韩国专利申请公开No.10-2015-0073717(2015年7月1号)中公开。
发明内容
各种实施方式涉及提供一种动力总成控制器的RAM错误检测逻辑的自诊断的方法和装置，其可以诊断动力总成控制器(或者动力总成ECU系统)的RAM错误检测逻辑(或ECC模块)中是否出现错误。
在实施方式中，一种用于动力总成控制器的RAM错误检测逻辑的自诊断的方法包括：对于应用多内核型微控制器单元(MCU)的动力总成控制器的RAM错误检测逻辑的自诊断，通过多个内核的第一内核闲置第二内核的操作并且对与结合第二内核操作的RAM对应的纠错码(ECC)模块执行测试；并且通过第二内核闲置未被执行测试的内核中的一个内核的操作，并且对与结合相应的内核操作的RAM对应的ECC模块执行测试。
在本公开中，方法还包括通过多个内核中的第N内核闲置还未被测试的多个内核中的一个内核的操作，并且当完成第N内核上的测试时，对与结合相应的内核操作的RAM对应的ECC模块执行测试。
在本公开中，测试是对用于检测指定的具体RAM的错误的ECC模块的测试。
在本公开中，方法还包括执行测试的初始化。初始化包括用于防止执行测试的测试模式中的测试操作影响MCU的动力总成控制的配置和用于闲置用于配置多内核系统中的测试环境的内核和ECC模块的配置。
在本公开中，当执行测试时，执行测试的每个内核无法对与结合每个相应的内核操作的RAM对应的ECC模块执行测试并且对与结合另一内核操作的RAM对应的ECC模块执行测试。
在本公开中，用于执行测试的每个内核首先在执行测试之前闲置结合待被每个相应的内核测试的RAM操作的相应内核的操作，并且当测试完成时再次运行相应的内核。
在本公开中，当对每个ECC模块执行测试时，通过每个内核执行的测试包括：通过用于对指定值执行OR输入使得在ECC比较器的测试位输入端口出现错误的任务1，来检查错误检测功能是否正确运行；通过用于经所述ECC比较器的输入端口实际输入的一位输入数据被翻转并且输入的可校正错误测试的任务2，检查错误检测功能是否正确运行；以及通过用于所述经ECC比较器的输入端口实际输入的两位输入数据被翻转并且输入的不可校正错误测试的任务3，检查错误检测功能是否正确运行。
在本公开中，方法还包括在ECC模块的测试中，当内核对ECC模块的测试完成时，设置每个预先指定的标记为1。
在本公开中，方法还包括当对结合多个内核中的内核操作的RAM对应的ECC模块的所有测试完成时输出测试结果，并且释放为该测试配置的初始化。
在本公开中，RAM错误检测逻辑是ECC模块。
在实施方式中，一种用于动力总成控制器的随机存取存储器(RAM)错误检测逻辑的自诊断的装置包括含有作为RAM错误检测逻辑的纠错码(ECC)模块的动力总成控制器，其中，多内核型微控制器单元(MCU)已应用于动力总成控制器，控制器被配置为对与结合多个内核的每一个内核操作的RAM对应的ECC模块执行测试，以及存储器被配置为存储用于RAM错误检测逻辑的自诊断的程序或算法。
在本公开中，控制器是微控制器单元(MCU)的多个内核中的任一个内核。
在本公开中，多个内核中的第一内核，作为控制器，闲置第二内核的操作并且对与结合第二内核操作的RAM对应的ECC模块执行测试。第二内核，作为控制器，闲置未被测试的多个内核当中的一个内核的操作，并且对与结合相应的内核操作的RAM对应的ECC模块执行测试。
在本公开中，当完成多个内核的第N内核上的测试时，第N内核，作为控制器，闲置未被测试的多个内核中的一个内核的操作，并且对与结合相应的内核操作的RAM对应的ECC模块执行测试。
在本公开中，测试是对用于检测多个内核的每一个内核中指定的具体的RAM的错误的ECC模块的测试。
在本公开中，用于执行测试的每个内核，作为控制器，首先在执行测试之前闲置结合待被每个相应的内核测试的RAM操作的相应内核的操作，并且当测试完成时再次运行相应的内核。
在本公开中，当对每个ECC模块执行测试时，用于执行测试的每个内核，作为控制器，通过用于对指定值执行OR输入使得在ECC比较器的测试位输入端口出现错误的任务1，来检查错误检测功能是否正确运行；通过用于经所述ECC比较器的输入端口实际输入的一位输入数据被翻转并且输入的可校正错误测试的任务2，检查错误检测功能是否正确运行；以及通过用于所述经ECC比较器的输入端口实际输入的两位输入数据被翻转并且输入的不可校正错误测试的任务3，检查错误检测功能是否正确运行。
在本公开中，当对ECC模块执行测试时，在每个内核对每个ECC模块的每个测试完成时，用于执行测试的每个内核，作为控制器，设置每个预先指定的标记为1。
在本公开中，当对结合多个内核的内核操作的RAM对应的ECC模块的所有测试完成时，用于执行测试的每个内核，作为控制器，输出测试结果，并且释放为该测试配置的初始化。
附图说明
图1是示出了根据本公开的实施方式的动力总成控制器的RAM错误检测逻辑的自诊断的装置的示意性配置的示例性图。
图2是用于描述根据本公开的实施方式的动力总成控制器的RAM错误检测逻辑的自诊断的方法的流程图。
图3是用于描述图2中的RAM测试的三种类型的测试任务的流程图。
具体实施方式
正如相应领域的传统，一些示例性实施方式可以在附图中以功能块、单元和/或模块示出。本领域技术人员将理解这些块、单元和/或模块通过诸如逻辑电路等电子(或者光学)电路、分立组件、处理器、硬连线电路、存储元件、布线连接等物理地实现。在块、单元和/或模块被处理器或者类似硬件实现时，可以使用软件(例如，代码)对其进行编程和控制以执行本文论述的各种功能。可替换地，可以通过专用硬件或作为执行一些功能的专用硬件与执行其它功能的处理器(例如，一个或多个编程的处理器和相关联的电路)的组合来实现每个块、单元和/或模块。在不偏离本发明构思的范围的情况下，一些示例性实施方式中的每个块、单元和/或模块可以物理地分离成两个或多个交互和分立的块、单元和/或模块。此外，在不偏离本发明构思的范围的情况下，一些示例性实施方式中的块、单元和/或模块可以物理地组合成更复杂的块、单元和/或模块。
在下文中，将参考附图，通过实施方式的各种实例，描述动力总成控制器的RAM错误检测逻辑的自诊断的方法和装置。
在该过程中，为了清楚描述和方便起见，附图中示出的元件的线宽或者尺寸可以放大。下文将描述的术语通过考虑它们在本公开中的功能而被定义，并且可以根据操作员的意图或者实践而不同。因此，这些术语应当基于本说明书的总体内容解释。
图1是示出了根据本公开的实施方式的用于动力总成控制器的RAM错误检测逻辑的自诊断的装置的示意性配置的示例性图。
如图1所示，在根据本实施方式的用于动力总成控制器的RAM错误检测逻辑的自诊断的装置中，用作动力总成控制器的微控制器单元(MCU)100包括：多个Core111、121及131(例如，Core0、Core 1及Core2)，分别与多个Core111、121及131结合操作的存储器112、122及132(例如，RAM0、RAM1、RAM2)及纠错码(ECC)模块140。
此外，虽然附图中未示出，但根据本实施方式的用于动力总成控制器的RAM错误检测逻辑的自诊断的装置包括用于存储用于RAM错误检测逻辑的自诊断的程序(或算法)的存储器(未示出)。
此外，虽然附图中未示出，但根据本实施方式的用于动力总成控制器的RAM错误检测逻辑的自诊断的装置包括用于基于存储器(未示出)中存储的用于RAM错误检测逻辑的自诊断的程序(或算法)而统一执行RAM错误检测逻辑的自诊断的控制器(未示出)。
在该情况下，控制器(或者测试处理器)(未示出)可包括MCU 100的多个Core111、121及131(例如，Core0、Core 1及Core2)中的任一个或者另一内核(未示出)。
ECC模块140其中包括至少一个ECC比较器。在本实施方式中，控制器(未示出)基于存储器(未示出)中存储的用于RAM错误检测逻辑(即，ECC模块)的自诊断的程序(或算法)选择测试模式或者动力总成控制模式。因此，测试模式中的测试操作不影响动力总成控制。
仅供参考，在多内核系统中，需要在结合相应的RAM来操作的内核已停止(或者空闲)的状态下进行存储器(或者RAM)测试(即，对用于检测具体RAM的错误的ECC模块的测试)。
因此，对于RAM测试(即，对检测具体RAM的错误的ECC模块的测试)，当测试在控制器停止(或者闲置)与相应的RAM结合而操作的相应的内核(例如，Core0至Core2中的一个)之后完成时，控制器(或者测试处理器)(未示出)再次运行停止的(或者空闲的)内核(例如，Core0至Core2中的一个)。
在该情况下，在本实施方式中，RAM测试(即，对检测具体RAM的错误的ECC模块的测试)包括主要执行三种类型的测试任务(参考图3)。即，主要对用于检测与MCU中包括的多个存储器(例如，RAM0至RAM2)中的任一个对应的错误的RAM错误检测逻辑(即，ECC模块)执行三种类型的测试任务(参考图3)。
将参考图3更具体地描述用于RAM测试的三种类型的测试任务(即，对用于检测具体RAM的错误的ECC模块的测试)。
在本实施方式中，已图示用于具有三个内核的多内核系统中的RAM错误检测逻辑的自诊断的方法，但是该方法还可以应用于具有四个或更多内核的多内核系统。
图2是根据本公开的实施方式的用于描述动力总成控制器的RAM错误检测逻辑的自诊断的方法的流程图。图3是用于描述图2中的RAM测试的三种类型的测试任务的流程图。
下文参考图2和图3描述根据本实施方式的用于动力总成控制器的RAM错误检测逻辑的自诊断的方法。
参考图2，当开始RAM测试模式时，控制器(未示出)基于预先指定的配置执行RAM测试(即，对用于检测具体RAM的错误的ECC模块的测试)的初始化(S110)。
例如，初始化包括用于防止RAM测试模式下的测试操作影响动力总成控制的配置(例如，中断或者自陷备用(trap backup))和用于内核(例如，内核空闲)和用于配置多内核系统中的测试环境的ECC模块的配置。
当完成如上所述RAM测试(即，对用于检测具体RAM的错误的ECC模块的测试)的初始化时，通过多个内核的第一内核(Core0)111执行RAM(例如，RAM1)测试(S120)。
在该情况下，第一内核(Core0)111不能对结合第一内核111操作的RAM(即，RAM0)执行RAM测试，但是可对结合其他内核(例如，Core1或Core2)操作的RAM(例如，RAM1或者RAM2)执行RAM测试。此外，第一内核(Core0)111需要停止(或者闲置)结合将被执行RAM测试的RAM而操作的相应的内核(例如，Core1至Core2中的一个)。理由在于如果相应的内核未停止(或者空闲)，结合该内核进行操作的RAM将继续操作。
通过图3中示出的三种类型的测试任务S210、S220及S230，执行通过第一内核(Core0)111执行RAM(例如，RAM1)测试的方法。
参考图3，通过用于对指定值(例如，1)执行OR输入(在该情况下，通过ECC比较器的测试位输入端口输入的所有的输入数据是标准数据)使得在测试位输入端口出现错误的任务1，第一内核(Core0)111检查错误检测功能是否正确运行(S210)。
此外，通过用于经ECC比较器的输入端口实际输入的一位输入数据被翻转并且输入的可校正错误测试的任务2，第一内核(Core0)111检查错误检测功能是否正确运行(S220)。
此外，通过用于经ECC比较器的输入端口实际输入的两位输入数据被翻转并且输入的不可校正错误测试的任务3，第一内核(Core0)111检查错误检测功能是否正确运行(S230)。
通过测试任务1、2及3确定RAM测试中出现的ECC模块的错误类型(S210至S230)。
参考回至图2，当第一内核(Core0)111的RAM(例如，RAM1)测试完成时(S130中的是(Y))，第一内核(Core0)111将标记0(flag0)设置为1(即，设置Flag_0＝1)(S140)。如果标记0被设为1(即，设置Flag_0＝1)，这是指第一内核(Core0)111的RAM(例如，RAM1)测试已完成。
当如上所述第一内核(Core0)111的RAM(例如，RAM1)测试完成时，执行通过第二内核(Core1)121进行的RAM(例如，RAM2)测试(S150)。
在执行第二内核(Core1)121的RAM(例如，RAM2)测试时，第二内核(Core1)121停止(或者闲置)结合RAM(例如，RAM2)，即，RAM测试目标而操作的第三内核(Core2)131(S151)。
此外，通过第二内核(Core1)121执行RAM(例如，RAM2)测试(S152)。通过图3中示出的三种类型的测试任务S210、S220及S230执行通过第二内核(Core1)121执行RAM(例如，RAM2)测试的方法。因为图3中示出的三种类型的测试任务S210、S220及S230与上述那些相同，在下文中省去其描述。
此外，当通过第二内核(Core1)121进行的RAM(例如，RAM2)完成时(S153中的是(Y))，第二内核(Core1)121再次运行第三内核(Core2)121并且设置标记1为1(即，设置Flag_1＝1)(S155)。如果标记1被设为1(即，设置Flag_1＝1)，这是指通过第二内核(Core1)121进行的RAM(例如，RAM2)测试已完成。
当如上所述第二内核(Core1)121的RAM(例如，RAM2)测试完成时(S160中的是(Y))，执行通过第三内核(Core2)131进行的RAM(例如，RAM0)测试(S170)。
当执行通过第三内核(Core2)131进行的RAM(例如，RAM0)测试时，第三内核(Core2)131停止(或者闲置)结合RAM(例如，RAM0)，即，RAM测试目标而操作的第一内核(Core0)111(S171)。
此外，通过第三内核(Core2)131执行RAM(例如，RAM0)测试(S172)。通过图3中示出的三种类型的测试任务S210、S220及S230执行通过第三内核(Core2)131执行RAM(例如，RAM0)测试的方法。因为图3中示出的三种类型的测试任务S210、S220、及S230与上述那些相同，在下文中省去其描述。
此外，当通过第三内核(Core2)131进行的RAM(例如，RAM0)测试完成时(S173中的是(Y))，第三内核(Core2)131再次运行第一内核(Core0)111(S174)并且设置标记2为1(即，设置Flag_2＝1)(S175)。如果标记2被设为1(即，设置Flag_2＝1)，这是指第三内核(Core2)131的RAM(例如，RAM0)测试已完成。
当如上所述通过第三内核(Core2)131进行的RAM(例如，RAM0)测试完成时(S180中的是(Y))，即，当对与多内核系统的所有RAM对应的ECC模块的RAM测试完成时，输出RAM测试结果(S190)。释放被配置成RAM测试的初始化(S200)。
如上所述，在本实施方式中，在多内核系统中，第一内核停止(或者闲置)下一个内核(即，第二内核)的操作并且执行对与结合内核(即，第二内核)而操作的RAM相对应的ECC模块的测试。下一个内核(即，第二内核)停止(或者闲置)该下一个内核之后的内核(即，第三内核)的操作，并且对与结合该内核(即，第三内核)而操作的RAM对应的ECC模块执行测试。最后的内核(即，第N内核)停止(或者闲置)第一内核的操作，并且对与结合内核(即，第一内核)操作的RAM对应的ECC模块执行测试。
在实施方式中，将多个内核的每一个内核示出为好像其仅基于指定顺序对结合另一内核操作的RAM执行测试。然而，RAM测试不是通过向内核分配顺序执行的。应注意，属于多内核的并且已在其上完成测试的任一个内核可对与结合除了相应内核之外的所有其他(或者多个)内核进行操作的RAM相对应的ECC模块执行测试。
如上所述，在本实施方式中，可以检查动力总成控制器(或者动力总成ECU系统)的RAM错误检测逻辑(或者ECC模块)中是否出现错误。
已基于附图中示出的实施方式描述了本公开，但是实施方式仅是说明性的。本公开所属技术领域的普通技术人员将理解可根据实施方式做出各种变型及其他等效实施方式。因此，本公开的技术保护范围应当通过以下权利要求确定。此外，本说明书中描述的实现方式可以实现为例如方法或者处理、装置、软件程序、数据流或者信号。虽然仅在一种形式的实现方式的背景下对本公开进行了论述(例如，仅作为方法论述)，具有所论述特性的实现方式还可以以另一形式(例如，装置或者程序)实现。该装置可以实现为适当的硬件、软件、或者固件。该方法可以在诸如通常称作处理设备(包括例如，计算机、微处理器、集成电路或者可编程逻辑设备)的处理器的装置中实现。处理器包括通信设备，诸如计算机、蜂窝电话、移动电话/个人数字助理(“PDA”)和促进终端用户之间信息通信的其他设备。
根据本公开的一方面，本公开可以诊断动力总成控制器(或者动力总成ECU系统)的RAM错误检测逻辑(或者ECC模块)中是否出现错误。
尽管已经为了说明的目的描述了本发明的优选的实施方式，但本领域技术人员将理解，在不背离在所附权利要求中所限定的本公开的范围和精神的情况下，可以进行各种修改、增加和替换。因此，本公开的真正的技术范围应由以下权利要求来限定。

Claims (19)

1.一种用于动力总成控制器的随机存取存储器RAM错误检测逻辑的自诊断的方法，所述方法包括：
对于应用了多内核型微控制器单元MCU的动力总成控制器的RAM错误检测逻辑的自诊断：
通过多个内核中的第一内核闲置第二内核的操作，并且对与结合所述第二内核进行操作的RAM相对应的纠错码ECC模块执行测试；以及
通过所述第二内核闲置未被执行测试的多个内核当中的一个内核的操作，并且对与结合相应的内核进行操作的RAM相对应的ECC模块执行测试。
2.根据权利要求1所述的方法，还包括：
当完成所述多个内核中的第N内核上的测试时，通过所述第N内核闲置未被执行测试的多个内核中的一个内核的操作，并且对与结合相应的内核进行操作的RAM相对应的ECC模块执行测试。
3.根据权利要求1所述的方法，其中，所述测试是对用于检测指定的具体RAM的错误的ECC模块的测试。
4.根据权利要求1所述的方法，还包括执行用于所述测试的初始化，
其中，所述初始化包括：用于防止在执行所述测试的测试模式中的测试操作影响所述MCU的动力总成控制的配置以及用于配置多内核系统中的测试环境的内核和ECC模块的闲置的配置。
5.根据权利要求1所述的方法，其中，当执行所述测试时，执行所述测试的每个内核不能对与结合每个相应的内核进行操作的RAM相对应的ECC模块执行测试，并且对与结合其他内核进行操作的RAM相对应的ECC模块执行测试。
6.根据权利要求5所述的方法，其中，用于执行所述测试的每个内核首先在执行所述测试之前，闲置与将被每个相应的内核执行所述测试的RAM相结合而操作的相应的内核的操作，并且当完成所述测试时再次运行所述相应的内核。
7.根据权利要求1所述的方法，其中，当对每个ECC模块执行所述测试时，每个内核执行的所述测试包括：
通过用于对指定值执行OR输入使得在ECC比较器的测试位输入端口出现错误的任务1，来检查错误检测功能是否正确运行；
通过用于经所述ECC比较器的输入端口实际输入的一位输入数据被翻转并且输入的可校正错误测试的任务2，检查错误检测功能是否正确运行；以及
通过用于经所述ECC比较器的输入端口实际输入的两位输入数据被翻转并且输入的不可校正错误测试的任务3，检查错误检测功能是否正确运行。
8.根据权利要求1所述的方法，还包括：在对所述ECC模块的测试中，当所述内核对所述ECC模块的测试完成时，将每个预先指定的标记设置为1。
9.根据权利要求1所述的方法，还包括：
当完成对与结合所述多个内核中的内核进行操作的RAM相对应的ECC模块的所有测试时，输出测试结果，以及
释放被配置用于所述测试的初始化。
10.根据权利要求1所述的方法，其中，所述RAM错误检测逻辑是ECC模块。
11.一种用于动力总成控制器的随机存取存储器RAM错误检测逻辑的自诊断的装置，所述装置包括：
动力总成控制器，包括作为RAM错误检测逻辑的纠错码ECC模块，其中，多内核型微控制器单元MCU已应用于所述动力总成控制器；
控制器，被配置为对与结合多个内核中的每一个内核进行操作的RAM相对应的ECC模块执行测试；以及
存储器，被配置为存储用于所述RAM错误检测逻辑的自诊断的程序或算法。
12.根据权利要求11所述的装置，其中，所述控制器是所述微控制器单元MCU的所述多个内核中的任一个内核。
13.根据权利要求11所述的装置，其中：
所述多个内核中的第一内核，作为所述控制器，闲置第二内核的操作并且对与结合所述第二内核进行操作的RAM相对应的ECC模块执行测试；以及
所述第二内核，作为所述控制器，闲置未被执行测试的多个内核当中的一个内核的操作，并且对与结合相应的内核进行操作的RAM相对应的ECC模块执行测试。
14.根据权利要求11所述的装置，其中，当完成所述多个内核中的第N内核上的测试时，所述第N内核，作为所述控制器，闲置未被执行测试的多个内核中的一个内核的操作，并且对与结合相应的内核进行操作的RAM相对应的ECC模块执行测试。
15.根据权利要求11所述的装置，其中，所述测试是对用于检测所述多个内核的每一个内核中指定的具体RAM的错误的ECC模块的测试。
16.根据权利要求11所述的装置，其中，用于执行所述测试的每个内核，作为所述控制器，首先在执行所述测试之前闲置与将被每个相应的内核执行测试的RAM结合而操作的相应的内核的操作，并且当完成所述测试时再次运行所述相应的内核。
17.根据权利要求11所述的装置，其中，当对每个ECC模块执行所述测试时，用于执行所述测试的每个内核，作为所述控制器：
通过用于对指定值执行OR输入使得在ECC比较器的测试位输入端口出现错误的任务1，来检查错误检测功能是否正确运行；
通过用于经所述ECC比较器的输入端口实际输入的一位输入数据被翻转并且输入的可校正错误测试的任务2，检查错误检测功能是否正确运行；以及
通过用于经所述ECC比较器的输入端口实际输入的两位输入数据被翻转并且输入的不可校正错误测试的任务3，检查错误检测功能是否正确运行。
18.根据权利要求11所述的装置，其中，当对所述ECC模块执行所述测试时，用于执行所述测试的每个内核作为所述控制器，在完成每个内核对每个ECC模块的每个测试时，将每个预先指定的标记设定为1。
19.根据权利要求11所述的装置，其中，用于执行所述测试的每个内核作为所述控制器：
当完成对与结合所述多个内核中的内核进行操作的RAM相对应的ECC模块的所有测试时，输出测试结果，以及
释放被配置用于所述测试的初始化。
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