CN111028759A - 显示面板和显示装置 - Google Patents
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Abstract
本发明公开了一种显示面板和显示装置,涉及显示技术领域,包括:显示区和围绕显示区的非显示区,显示区包括多条数据线,非显示区包括多条时钟信号线、多条第一连接线、多个多路选通模块和驱动芯片;驱动芯片包括多个数据信号引脚和多个时钟信号引脚;多路选通模块的输出端与多条数据线电连接,多路选通模块的第一输入端与一条第一连接线电连接,多路选通模块的第二输入端与多条时钟信号线电连接;每条第一连接线与一个数据信号引脚电连接,每条时钟信号线与至少两个时钟信号引脚电连接。本发明在减小非显示区的面积的同时增加显示面板中像素的充电时间,从而提高显示面板的显示效果。
Description
技术领域
本发明涉及显示技术领域,更具体地,涉及一种显示面板和显示装置。
背景技术
在生产和生活中,人们需要越来越多地利用丰富的视觉信息,因而显示技术在当今人类社会中扮演着非常重要的角色。
通常情况下,显示面板中的每个像素包括三个子像素(例如,R、G、B),每个子像素均由一条扫描线和一条数据线进行控制。因此,一个分辨率为M×N的显示面板,就需要配置M条扫描线和3N条数据线。一方面,随着科学技术的发展,显示面板正朝向越大和越小两个方向发展,而对于小尺寸的显示面板来说,由于受到空间的限制,通常在这类显示面板中只能配置一个驱动芯片。而另一方面,随着显示面板分辨率的提高,显示面板中所包含的子像素的数量也越来越多。因此,在空间有限的情况下,通常采用多路分用(DEMUX)电路来减少驱动芯片的输出管脚数。DEMUX电路包括多个多路分用开关,通过对驱动芯片的至少一个输出通道的数据电压进行时分,然后将数据电压提供给多个数据线(实现对所连接子像素的充电)。通过响应于多路分用控制信号驱动的多路分用开关的切换操作来执行多路分用切换电路的时分操作。
然而,现有技术的显示面板中,采用DEMUX电路后,在子像素的实际充电过程中,对驱动芯片的输出通道的数据电压进行时分所用的时间会影响数据线对子像素进行充电的时间,子像素充电时间不足会影响显示面板的显示效果。
发明内容
有鉴于此,本发明提供了一种显示面板和显示装置,在减小非显示区的面积的同时增加显示面板中像素的充电时间,从而提高显示面板的显示效果。
第一方面,本发明提供一种显示面板,包括:显示区和围绕显示区的非显示区,显示区包括多条数据线,非显示区包括多条时钟信号线、多条第一连接线、多个多路选通模块和驱动芯片;驱动芯片包括多个数据信号引脚和多个时钟信号引脚;多路选通模块的输出端与多条数据线电连接,多路选通模块的第一输入端与一条第一连接线电连接,多路选通模块的第二输入端与多条时钟信号线电连接;每条第一连接线与一个数据信号引脚电连接,每条时钟信号线与至少两个时钟信号引脚电连接。
第二方面,本发明提供一种显示装置,包括本发明提供的显示面板。
与现有技术相比,本发明提供的显示面板和显示装置,至少实现了如下的有益效果:
本发明提供的显示面板包括显示区和围绕显示区的非显示区,显示区设置有多条数据线,非显示区设置有多条时钟信号线、多条第一连接线、多个多路选通模块和驱动芯片,多路选通模块的输出端与多条数据线电连接,多路选通模块的第一输入端与一条第一连接线电连接,每条第一连接线与一个数据信号引脚电连接,驱动芯片中数据信号引脚输出的数据信号传输至第一连接线,多路选通模块通过一条第一连接线给多条数据线提供数据信号,有利于减小非显示区的面积,利于实现显示面板的窄边框化。多路选通模块的第二输入端与多条时钟信号线电连接,通过不同时钟信号线传输的时钟控制信号不同,控制多路选通模块在不同时刻将数据信号提供给不同的数据线,实现分时驱动。每条时钟信号线与至少两个时钟信号引脚电连接,有效减小驱动芯片给每条时钟信号线传输驱动信号时的电阻,从而减小每条时钟信号线的电压信号上升和电压信号下降的时间,每条时钟信号线的驱动时间是相同的,从而有效提高每条时钟信号线维持为稳定的驱动电压的时间增长,有效提高每条数据线对子像素进行充电的时间,从而提高显示面板的显示效果。
当然,实施本发明的任一产品不必特定需要同时达到以上所述的所有技术效果。
通过以下参照附图对本发明的示例性实施例的详细描述,本发明的其它特征及其优点将会变得清楚。
附图说明
被结合在说明书中并构成说明书的一部分的附图示出了本发明的实施例,并且连同其说明一起用于解释本发明的原理。
图1是本发明提供的一种显示面板的平面结构示意图;
图2是图1所述的显示面板的A部放大示意图;
图3是本发明提供的时钟信号线的一种驱动时序图;
图4是本发明提供的一种多路选通模块的等效电路图;
图5是本发明提供的另一种多路选通模块的等效电路图;
图6是本发明提供的另一种显示面板的局部结构示意图;
图7是本发明提供的又一种多路选通模块的等效电路图;
图8是本发明提供的一种显示装置的平面结构示意图。
具体实施方式
现在将参照附图来详细描述本发明的各种示例性实施例。应注意到:除非另外具体说明,否则在这些实施例中阐述的部件和步骤的相对布置、数字表达式和数值不限制本发明的范围。
以下对至少一个示例性实施例的描述实际上仅仅是说明性的,决不作为对本发明及其应用或使用的任何限制。
对于相关领域普通技术人员已知的技术、方法和设备可能不作详细讨论,但在适当情况下,所述技术、方法和设备应当被视为说明书的一部分。
在这里示出和讨论的所有例子中,任何具体值应被解释为仅仅是示例性的,而不是作为限制。因此,示例性实施例的其它例子可以具有不同的值。
应注意到:相似的标号和字母在下面的附图中表示类似项,因此,一旦某一项在一个附图中被定义,则在随后的附图中不需要对其进行进一步讨论。
图1是本发明提供的一种显示面板的平面结构示意图,图2是图1所述的显示面板的A部放大示意图,参考图1和图2,本实施例提供一种显示面板,包括:显示区AA和围绕显示区AA的非显示区NA,显示区AA包括多条数据线S,非显示区NA包括多条时钟信号线40、多条第一连接线10、多个多路选通模块20和驱动芯片30;
驱动芯片30包括多个数据信号引脚31和多个时钟信号引脚32;
多路选通模块20的输出端与多条数据线S电连接,多路选通模块20的第一输入端与一条第一连接线10电连接,多路选通模块20的第二输入端与多条时钟信号线40电连接;
每条第一连接线10与一个数据信号引脚31电连接,每条时钟信号线40与至少两个时钟信号引脚32电连接。
具体的,继续参考图1和图2,本实施例提供的显示面板包括显示区AA和围绕显示区AA的非显示区NA,显示区AA具有显示功能,非显示区NA用于放置电路等,不用于显示。显示区AA设置有多条数据线S,非显示区NA设置有多条时钟信号线40、多条第一连接线10、多个多路选通模块20和驱动芯片30,多路选通模块20的输出端与多条数据线S电连接,多路选通模块20的第一输入端与一条第一连接线10电连接,每条第一连接线10与一个数据信号引脚31电连接,驱动芯片30中数据信号引脚31输出的数据信号传输至第一连接线10,多路选通模块20通过一条第一连接线10给多条数据线S提供数据信号,有利于减小非显示区NA的面积,利于实现显示面板的窄边框化。
多路选通模块20的第二输入端与多条时钟信号线40电连接,通过不同时钟信号线40传输的时钟控制信号不同,控制多路选通模块20在不同时刻将数据信号提供给不同的数据线S,实现分时驱动。参考图3,图3是本发明提供的时钟信号线的一种驱动时序图,每条时钟信号线40的驱动时间包括t1、t2和t3,在t1时刻,时钟信号线40的电压信号上升,在t2时刻,时钟信号线40的信号维持为稳定的高电压信号,在t1时刻,时钟信号线40的电压信号下降,在t2时刻,时钟信号线40控制第一连接线10提供数据信号给与其对应的数据线S,t2时间的长短会影响数据线S对子像素进行充电的时间。每条时钟信号线40与至少两个时钟信号引脚32电连接,有效减小驱动芯片30给每条时钟信号线40传输驱动信号时的电阻,从而减小每条时钟信号线40的电压信号上升和电压信号下降的时间,每条时钟信号线40的驱动时间是相同的,从而有效提高每条时钟信号线40维持为稳定的驱动电压的时间增长,有效提高每条数据线S对子像素进行充电的时间,从而提高显示面板的显示效果。
图4是本发明提供的一种多路选通模块的等效电路图,参考图4,可选的,其中,多路选通模块20包括多个开关晶体管K,同一多路选通模块20中的各开关晶体管K的第一端与同一条第一连接线10电连接,同一多路选通模块20中的各开关晶体管K的第二端与不同条数据线S电连接,同一多路选通模块20中的各开关晶体管K的控制端与不同条时钟信号线40电连接。
具体的,继续参考图4,多路选通模块20包括多个开关晶体管K,同一多路选通模块20中的各开关晶体管K的控制端与不同条时钟信号线40电连接,以使同一多路选通模块20中各开关晶体管K的第一端和第二端导通的时间不同,同一多路选通模块20中的各开关晶体管K的第一端与同一条第一连接线10电连接,同一多路选通模块20中的各开关晶体管K的第二端与不同条数据线S电连接,驱动芯片30中数据信号引脚31输出的数据信号通过第一端和第二端导通的开关晶体管K传输至与该开关晶体管K电连接的数据线S,并通过数据线S对与该数据线S电连接的子像素进行充电。
继续参考图4,可选的,其中,开关晶体管K均为NMOS薄膜晶体管。
具体的,选通模块20中的各开关晶体管K均为NMOS薄膜晶体管,当与其电连接的时钟信号线40通高电压信号时,开关晶体管K的第一端和第二端导通。可以理解的是,图4中示例性的示出了开关晶体管K均为NMOS薄膜晶体管,在本发明其他实施例中,开关晶体管K还可以为PMOS薄膜晶体管,本发明在此不再进行赘述。
继续参考图4,可选的,其中,多路选通模块20包括N个开关晶体管K,多路选通模块20的输出端与N条数据线S电连接,时钟信号线40的数量为N条;其中,
N≥2、且N为正整数。
具体的,其中,多路选通模块20包括N个开关晶体管K,多路选通模块20的输出端与N条数据线S电连接,时钟信号线40的数量为N条,即多路选通模块20中开关晶体管K的数量、与其电连接的数据线S的数量、与其电连接的时钟信号线40的数量均相同,且数量大于等于2,且同一多路选通模块20中的各开关晶体管K的第二端与不同条数据线S电连接,同一多路选通模块20中的各开关晶体管K的控制端与不同条时钟信号线40电连接。
可选的,显示面板中时钟信号线40的总数量为N条,每条时钟信号线40与各多路选通模块20中的一个开关晶体管K的控制端电连接,有效减少显示面板中时钟信号线40的数量,进一步减小显示面板中非显示区的面积,有利于实现显示面板的窄边框化。
示例性的,参考图5,图5是本发明提供的另一种多路选通模块的等效电路图,可选的,其中,N=6。
具体的,多路选通模块20中开关晶体管K的数量、与其电连接的数据线S的数量、与其电连接的时钟信号线40的数量均为6,每条第一连接线10与一个数据信号引脚31电连接,驱动芯片30中数据信号引脚31输出的数据信号传输至第一连接线10,多路选通模块20通过一条第一连接线10分时给6条数据线S提供数据信号,有利于减小非显示区NA的面积,利于实现显示面板的窄边框化。
需要说明的是,图5中示例性的示出了多路选通模块20中开关晶体管K的数量、与其电连接的数据线S的数量、与其电连接的时钟信号线40的数量均为6,在本发明其他实施例中多路选通模块20中开关晶体管K的数量、与其电连接的数据线S的数量、与其电连接的时钟信号线40的数量还可以为其他数值,本发明在此不再一一赘述。
继续参考图5,可选的,其中,每条时钟信号线40与两个时钟信号引脚32电连接。
具体的,每条时钟信号线40与两个时钟信号引脚32电连接,驱动芯片30给每条时钟信号线40传输驱动信号时时钟信号引脚32的电阻为两个时钟信号引脚32并联形成的电阻,有效减小驱动芯片30给每条时钟信号线40传输驱动信号时的电阻,从而减小每条时钟信号线40的电压信号上升和电压信号下降的时间,每条时钟信号线40的驱动时间是相同的,从而有效提高每条时钟信号线40的维持为稳定的驱动电压的时间增长,有效提高每条数据线S对子像素进行充电的时间,从而提高显示面板的显示效果。
需要说明的是,本实施例中示例性的示出了每条时钟信号线40与两个时钟信号引脚32电连接,在本发明其他实施例中,每条时钟信号线40还可以与其他数值的时钟信号引脚32电连接,只需满足与每条时钟信号线40电连接的时钟信号引脚32的数量为大于等于2的正整数即可,本发明在此不再进行赘述。
图6是本发明提供的另一种显示面板的局部结构示意图,参考图6,可选的,其中,显示区AA还包括呈阵列排布的多个子像素P,沿第一方向X排列的子像素P与同一条数据线S电连接。
具体的,继续参考图6,显示区AA还包括呈阵列排布的多个子像素P,沿第一方向X排列的子像素P与同一条数据线S电连接,沿第二方向Y排列的子像素P与同一条扫描线G电连接,第一方向X和第二方向Y相交,数据线S沿第一方向X延伸,沿第二方向Y排列,扫描线G沿第二方向Y延伸,沿第一方向X排列,数据线S和扫描线G交叉限定一个子像素P,驱动芯片30中数据信号引脚31输出的数据信号传输至第一连接线10,多路选通模块20通过一条第一连接线10分时分别给多条数据线S提供数据信号,从而对与数据线S电连接的子像素P进行充电。
可选的,其中,三个不同发光颜色的子像素可以构成一个像素单元,示例性的,该三个不同发光颜色的子像素可以为红色子像素、蓝色子像素以及绿色子像素。
图7是本发明提供的又一种多路选通模块的等效电路图,参考图7,可选的,其中,在第二方向Y上,任意两条相邻的数据线S均与不同多路选通模块20的输出端电连接,其中,第一方向X和第二方向Y相交。
具体的,继续参考图7,在第二方向Y上,任意两条相邻的数据线S均与不同多路选通模块20的输出端电连接,驱动芯片30中任意相邻两个数据信号引脚31可以输出极性相反的数据信号,从而在第二方向Y上,任意两条相邻的数据线S上的数据信号的极性相反,有效避免显示面板中液晶分子的极性遭到破坏,有效提高显示面板的显示效果。
继续参考图7,可选的,其中,在第二方向Y上,以两个多路选通模块20为一组,同一组中分别与两个多路选通模块20的输出端电连接的数据线S一一间隔设置。
具体的,在第二方向Y上,以两个多路选通模块20为一组,同一组中分别与两个多路选通模块20的输出端电连接的数据线S一一间隔设置,从而实现在第二方向Y上,任意两条相邻的数据线S均与不同多路选通模块20的输出端电连接,且采用该设置方式有效减小显示面板中多路选通模块20和数据线S的设置难度,减小生产成本。
需要说明的是,本实施例示例性的示出了在第二方向Y上,以两个多路选通模块20为一组,同一组中分别与两个多路选通模块20的输出端电连接的数据线S一一间隔设置,在本发明其他实施例中,在第二方向Y上,以其他数量的多路选通模块20为一组,只需满足任意两条相邻的数据线S均与不同多路选通模块20的输出端电连接即可,本发明在此不再一一赘述。
本实施例提供一种显示装置,包括如上所述的显示面板。
请参考图8,图8是本发明提供的一种显示装置的平面结构示意图。图8提供的显示装置1000包括显示面板100,其中,显示面板为本发明上述任一实施例提供的显示面板100。图8实施例仅以手机为例,对显示装置1000进行说明,可以理解的是,本发明实施例提供的显示装置,可以是电脑、电视、车载显示装置等其他具有显示功能的显示装置,本发明对此不作具体限制。本发明实施例提供的显示装置,具有本发明实施例提供的显示面板的有益效果,具体可以参考上述各实施例对于显示面板的具体说明,本实施例在此不再赘述。
通过上述实施例可知,本发明提供的显示面板和显示装置,至少实现了如下的有益效果:
本发明提供的显示面板包括显示区和围绕显示区的非显示区,显示区设置有多条数据线,非显示区设置有多条时钟信号线、多条第一连接线、多个多路选通模块和驱动芯片,多路选通模块的输出端与多条数据线电连接,多路选通模块的第一输入端与一条第一连接线电连接,每条第一连接线与一个数据信号引脚电连接,驱动芯片中数据信号引脚输出的数据信号传输至第一连接线,多路选通模块通过一条第一连接线给多条数据线提供数据信号,有利于减小非显示区的面积,利于实现显示面板的窄边框化。多路选通模块的第二输入端与多条时钟信号线电连接,通过不同时钟信号线传输的时钟控制信号不同,控制多路选通模块在不同时刻将数据信号提供给不同的数据线,实现分时驱动。每条时钟信号线与至少两个时钟信号引脚电连接,有效减小驱动芯片给每条时钟信号线传输驱动信号时的电阻,从而减小每条时钟信号线的电压信号上升和电压信号下降的时间,每条时钟信号线的驱动时间是相同的,从而有效提高每条时钟信号线维持为稳定的驱动电压的时间增长,有效提高每条数据线对子像素进行充电的时间,从而提高显示面板的显示效果。
虽然已经通过例子对本发明的一些特定实施例进行了详细说明,但是本领域的技术人员应该理解,以上例子仅是为了进行说明,而不是为了限制本发明的范围。本领域的技术人员应该理解,可在不脱离本发明的范围和精神的情况下,对以上实施例进行修改。本发明的范围由所附权利要求来限定。
Claims (10)
1.一种显示面板,其特征在于,包括:显示区和围绕所述显示区的非显示区,所述显示区包括多条数据线,所述非显示区包括多条时钟信号线、多条第一连接线、多个多路选通模块和驱动芯片;
所述驱动芯片包括多个数据信号引脚和多个时钟信号引脚;
所述多路选通模块的输出端与多条所述数据线电连接,所述多路选通模块的第一输入端与一条所述第一连接线电连接,所述多路选通模块的第二输入端与多条所述时钟信号线电连接;
每条所述第一连接线与一个所述数据信号引脚电连接,每条所述时钟信号线与至少两个所述时钟信号引脚电连接。
2.根据权利要求1所述的显示面板,其特征在于,
所述多路选通模块包括多个开关晶体管,同一所述多路选通模块中的各所述开关晶体管的第一端与同一条所述第一连接线电连接,同一所述多路选通模块中的各所述开关晶体管的第二端与不同条所述数据线电连接,同一所述多路选通模块中的各所述开关晶体管的控制端与不同条所述时钟信号线电连接。
3.根据权利要求2所述的显示面板,其特征在于,
所述多路选通模块包括N个开关晶体管,所述多路选通模块的输出端与N条所述数据线电连接,所述时钟信号线的数量为N条;其中,
N≥2、且N为正整数。
4.根据权利要求3所述的显示面板,其特征在于,
N=6。
5.根据权利要求1所述的显示面板,其特征在于,
每条所述时钟信号线与两个所述时钟信号引脚电连接。
6.根据权利要求1所述的显示面板,其特征在于,
所述显示区还包括呈阵列排布的多个子像素,沿第一方向排列的所述子像素与同一条所述数据线电连接。
7.根据权利要求6所述的显示面板,其特征在于,
在第二方向上,任意两条相邻的所述数据线均与不同所述多路选通模块的输出端电连接,其中,所述第一方向和所述第二方向相交。
8.根据权利要求7所述的显示面板,其特征在于,
在所述第二方向上,以两个所述多路选通模块为一组,同一组中分别与两个所述多路选通模块的输出端电连接的所述数据线一一间隔设置。
9.根据权利要求2所述的显示面板,其特征在于,
所述开关晶体管均为NMOS薄膜晶体管。
10.一种显示装置,其特征在于,包括权利要求1-9任一项所述的显示面板。
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