CN110277064A - 显示面板和显示装置 - Google Patents

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Abstract

本发明实施例提供了一种显示面板和显示装置，该显示面板的多路分配器电路的多个晶体管中包括至少一个第一晶体管，该第一晶体管的控制端与至少两条时钟控制信号线电连接，能够降低时钟控制信号在时钟控制信号线上传输的损耗，缩短第一晶体管的打开时间，以在数据信号引脚输出的数据信号通过该第一晶体管传输至与该第一晶体管电连接的数据信号线，并由该数据信号线传输至与该数据信号线电连接的子像素时，有利于数据信号对该子像素的充电，从而能够提高显示面板的显示效果。

Description

显示面板和显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种显示面板和显示装置。
背景技术
有源矩阵显示装置中具有多个像素，其中同一行的像素可共用一条扫描信号线，同一列的像素可共用一条数据信号线，且每一像素均设置有薄膜晶体管(Thin FilmTransistor，TFT)。
有源矩阵显示装置的驱动时，驱动芯片通过扫描信号线向各行像素依次输入扫描信号，控制相应行像素的TFT打开，并通过数据信号线和打开的TFT向该行像素输入相应的数据电压信号，以使相应的像素能够显示发光。随着显示技术的发展，对显示装置的显示效果的要求越来越高，显示装置中像素数量越来越多，数据信号线的数量越来越多，驱动芯片中设置数据电压输出引脚越来越多，致使驱动芯片占用的边框面积越来越大。为减小驱动芯片占用的边框面积，现有技术通过在显示装置中设置多路分配器，通过分时驱动的方法，实现驱动芯片的一个数据电压输出引脚能够分别向同一行的多个像素提供数据电压信号。
但是，由于多路分配器设置有多个晶体管作为开关单元，通过时钟控制信号控制晶体管的通断实现分时驱动，而晶体管的开通需达到该晶体管的阈值电压。现有的分时驱动方式，无法满足更快速度打开多路分配器晶体管的要求，从而影响显示装置的显示效果。
发明内容
本发明实施例提供一种显示面板和显示装置，以使显示装置中多路分配器的晶体管能够快速打开或关闭，增加显示装置中像素充电时间或显示面板的刷新频率，从而提高显示装置的显示效果。
第一方面，本发明实施例提供了一种显示面板，包括：显示区和围绕所述显示区的非显示区；所述显示区设置有多条数据信号线；所述非显示区设置有多个多路分配器电路；
每个所述多路分配器电路包括多个晶体管；同一所述多路分配器电路中的各个所述晶体管的输入端均与一个数据信号引脚电连接；同一所述多路分配器电路中的各所述晶体管的控制端与不同时钟控制信号线电连接；同一所述多路分配器电路中的各所述晶体管的输出端与不同数据信号线电连接；
其中，所述多路分配器电路中的多个晶体管中包括至少一个第一晶体管，所述第一晶体管的控制端与至少两条时钟控制信号线电连接。
第二方面，基于同一发明构思，本发明实施例提供了一种显示装置，包括：上述显示面板。
本发明实施例提供一种显示面板和显示装置，通过在显示面板中设置多个多路分配器电路，一个多路分配器电路包括多个晶体管；其中，同一多路分配器电路的不同晶体管的输入端连接同一数据信号引脚，且同一多路分配器电路的不同晶体管的输出端连接不同的数据信号线，以使同一多路分配器电路的所有晶体管均能够接收一个数据信号引脚输出的数据信号，并传输至不同的数据信号线；同时，同一多路分配器电路中不同晶体管的控制端连接不同的时钟控制信号线，以使不同时钟控制线传输的时钟控制信号控制不同晶体管在不同的时刻导通，实现多路分配器电路的分时控制功能。本发明实施例中多路分配器电路的多个晶体管中包括至少一个第一晶体管，该第一晶体管的控制端与至少两条时钟控制信号线电连接，一方面，两条时钟控制信号线相较于一条时钟控制信号线，能够降低时钟控制信号在时钟控制信号线上传输的损耗，以在数据信号引脚输出的数据信号通过该第一晶体管传输至与该第一晶体管电连接的数据信号线，并由该数据信号线传输至与该数据信号线电连接的子像素时，有利于数据信号对该子像素的充电，从而能够提高显示面板的显示效果；另一方面，与一个第一晶体管的控制端电连接的两个时钟控制信号线可传输相同的时钟控制信号，两个叠加的时钟控制信号能够缩短第一晶体管的打开时间，从而增加与该第一晶体管对应的数据信号线电连接的子像素的充电电量，或者能够提高显示面板的画面刷新频率，提高显示面板的显示效果。同时，与一个第一晶体管的控制端电连接的两个时钟控制信号线可传输不同的时钟控制信号，该不同的时钟控制信号能够控制第一晶体管在不同的时刻打开，以满足显示面板的特殊显示要求。
附图说明
图1为一种现有技术的多路分配器电路的结构示意图；
图2是本发明实施例提供的一种显示面板的俯视结构示意图；
图3是本发明实施例提供的一种多路分配器电路的结构示意图；
图4是与图3对应的一种多路分配器电路的等效电路图；
图5是与图3对应的一种多路分配器电路的驱动时序图；
图6是图3沿A-A'截面的一种剖面结构示意图；
图7是本发明实施例提供的又一种多路分配器电路的结构示意图；
图8是本发明实施例提供的又一种多路分配器电路的结构示意图；
图9是本发明实施例提供的又一种多路分配器电路的结构示意图；
图10为一种现有技术的多路分配器电路的结构示意图；
图11是本发明实施例提供的又一种多路分配器电路的结构示意图；
图12是本发明实施例提供的又一种多路分配器电路的结构示意图；
图13是本发明实施例提供的一种显示装置的结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
图1为一种现有技术的多路分配器电路的结构示意图。如图1，多路分配器电路包括三个晶体管T01、T02和T03，该三个晶体管T01、T02和T03的输入端与同一数据信号引脚Vn电连接，该三个晶体管T01、T02和T03的输出端分别与不同的数据信号线DataR、DataG和DataB电连接，且该三个晶体管T01、T02和T03的控制电极g01、g02和g03分别与不同的时钟控制信号线电连接，且一个晶体管的控制端连接一条时钟控制信号。例如，通过一条时钟控制信号线传输时钟信号引脚ckh1输出的时钟控制信号，并控制晶体管T01导通，数据信号引脚Vn输出的数据信号能够通过导通的晶体管T01传输至与该晶体管T01电连接的数据信号线DataB，以对与该数据信号线DataB电连接的子像素进行充电。相应的，时钟信号引脚ckh2和ckh3输出的时钟控制信号分别通过一条时钟控制信号线传输至晶体管T02和T03，以在各自控制相应晶体管T02和T03导通时，数据信号引脚Vn输出的数据信号能够分别通过导通的晶体管T02和T03传输至与晶体管T02电连接的数据信号线DataG和与晶体管T03电连接的数据信号线DataR，以分别对与数据信号线DataG电连接的子像素和与数据信号线DataR电连接的子像素进行充电。
通常不同时钟控制信号线传输的时钟控制信号不同，控制多路分配器电路中不同的晶体管在不同的时刻导通，实现分时驱动，以使数据信号引脚Vn输出不同的数据信号对不同的子像素进行充电，从而使显示面板能够显示出相应的画面。由于晶体管的尺寸越大，其传输信号的能力越强，因此为确保数据信号引脚Vn输出的数据信号在通过导通的晶体管后能够满足对相应的子像素的充电要求，多路分配器电路中晶体管尺寸应满足数据信号的传输要求。
但是，当多路分配器电路中晶体管沿Y方向延伸并沿X方向排列时，将多路分配器电路中晶体管的尺寸做大后，在Y方向上多路分配器电路的长度较大，不利于显示面板的窄边框。同时，时钟控制信号在始终控制信号线上传输过程中具有较大的损耗，将影响多路分配器电路中晶体管的对数据信号的传输，从而影响子像素的充电电量，甚至使得显示面板无法正常显示。
为解决上述问题，本发明实施例提供了一种显示面板，该显示面板包括：显示区和围绕显示区的非显示区；该显示区设置有多条数据信号线；该非显示区设置有多个多路分配器电路；
每个多路分配器电路包括多个晶体管；同一多路分配器电路中的各个晶体管的输入端均与一个数据信号引脚电连接；同一多路分配器电路中的各晶体管的控制端与不同时钟控制信号线电连接；同一多路分配器电路中的各晶体管的输出端与不同数据信号线电连接；
其中，多路分配器电路中的晶体管中包括至少一个第一晶体管，该第一晶体管的控制端与至少两条时钟控制信号线电连接。
采用上述技术方案，通过使多路分配器电路的多个晶体管中的至少一个第一晶体管的控制端与至少两条时钟控制信号线电连接，一方面，两条时钟控制信号线相较于一条时钟控制信号线，能够降低时钟控制信号在时钟控制信号线上传输的损耗，以在数据信号引脚输出的数据信号通过该第一晶体管传输至与该第一晶体管电连接的数据信号线，并由该数据信号线传输至与该数据信号线电连接的子像素时，有利于数据信号对该子像素的充电，从而能够提高显示面板的显示效果；另一方面，与一个第一晶体管的控制端电连接的两个时钟控制信号线可传输相同的时钟控制信号，两个叠加的时钟控制信号能够缩短第一晶体管的打开时间，从而增加与该第一晶体管对应的数据信号线电连接的子像素的充电电量，或者能够提高显示面板的画面刷新频率，提高显示面板的显示效果。同时，与一个第一晶体管的控制端电连接的两个时钟控制信号线可传输不同的时钟控制信号，该不同的时钟控制信号能够控制第一晶体管在不同的时刻打开，以满足显示面板的特殊显示要求。
以上是本发明的核心思想，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下，所获得的所有其他实施例，都属于本发明保护的范围。
在本发明实施例中，多路分配器电路的多个晶体管中包括至少一个第一晶体管，例如可以为一个、两个或多个，且该第一晶体管的控制端与至少两个时钟控制信号线电连接，即一个第一晶体管的控制端所连接时钟控制信号的数量可以为两条或两条以上，本发明实施例对此不做具体限定。以下结合附图对本发明实施例进行示例性的说明。
图2是本发明实施例提供的一种显示面板的俯视结构示意图。如图2，显示面板100包括显示区110和围绕显示区110的非显示区120。显示面板100的显示区110设置有多条数据信号线51，该多条数据信号51可沿第一方向X排列且沿第二方向Y延伸；显示面板100的显示区110还可设置有多条沿第二方向Y排列且沿第一方向延伸的扫描信号线52(或栅极线)，且扫描信号线52与数据信号线交叉限定一个子像素。其中，三个不同发光颜色的子像素可以构成一个像素单元，该三个不同发光颜色的子像素例如可以为红色子像素、蓝色子像素以及绿色子像素。
显示面板100的非显示区120设置有多个多路分配器电路20和多条时钟控制信号线60。每个多路分配器电路20均包括多个晶体管；同一多路分配器电路20中的各个晶体管的输入端与一个数据信号引脚Vn电连接；同一多路分配器电路20中的各晶体管的控制端分别与不同的时钟控制信号线60电连接；同一多路分配器电路20中的各晶体管的输出端分别与不同的数据信号线51电连接。
此外，显示面板100的非显示区120中还可以包括扫描驱动电路30(或者栅极驱动电路)以及驱动芯片设置区。其中，扫描驱动电路30用于向显示区110的扫描信号线52提供扫描信号；驱动芯片设置区能够用于设置驱动芯片40，该驱动芯片40具有多个数据信号引脚Vn。同一多路分配器电路20中各晶体管的输入电端与驱动芯片40的一个数据引脚Vn电连接，以使驱动芯片的数据信号引脚Vn中输出的数据信号能够传输至同一多路分配器电路20的各晶体管的输入端。同时，同一多路分配器电路20的各晶体管的控制端分别与不同的时钟控制信号线60电连接，各时钟控制信号线60分别与驱动芯片40的不同时钟信号引脚CKH电连接，以能够将驱动芯片40的时钟信号引脚CKH输出的时钟控制信号传输至多路分配器电路20的晶体管的控制端。
其中，多路分配器电路20的工作原理为，驱动芯片40的时钟信号引脚CKH分别通过时钟控制信号线60向同一多路分配器电路20的不同晶体管输入不同的时钟控制信号，以使同一多路分配器20的不同晶体管的输入端与输出端导通的时间不同；此时，驱动芯片40的数据信号引脚Vn输出的数据信号通过输入端与输出端导通的晶体管传输至与该晶体管电连接的数据信号线51，并通过数据信号线51对与该数据信号线51电连接的子像素进行充电，以使该子像素能够显示发光。驱动芯片40的数据信号引脚Vn可通过串行的方式向与同一多路分配器电路20中不同晶体管的输出端电连接的不同的数据信号线51输出的数据信号。
一个多路分配器电路20中的多个晶体管中包括至少一个第一晶体管，该第一晶体管的控制端与至少两条时钟控制信号线60电连接，该两条时钟控制信号线60可传输同一时钟信号引脚CKH输出的时钟控制信号，以降低时钟控制信号在时钟控制信号线60上的损耗；或者，该第一晶体管的控制端电连接的至少两条时钟控制信号线60可传输不同时钟信号引脚CKH输出的相同的时钟控制信号，以使第一晶体管能够通过两个不同时钟信号引脚CKH输出的叠加信号，缩短第一晶体管的开通时间，从而增加与该第一晶体对应的数据信号线51电连接的子像素的充电电量，或者增加显示面板的刷新频率；或者，该第一晶体管可以包括多个控制端，每一控制端电连接不同的时钟控制信号线，且各时钟控制信号线与不同的时钟信号引脚电连接，以在显示面板具有特殊显示要求时，驱动芯片能够通过不同的时钟信号引脚输出不同的时钟控制信号，满足显示面板的特殊显示要求。
需要说明的是，图2仅是本发明实施例示例性的附图，图2中，多路分配器电路20、扫描驱动电路30以及时钟控制信号线60分别连接同一驱动芯片40的不同信号引脚；此外，多路分配器电路20、扫描驱动电路30以及时钟控制信号线60可分别连接分别与不同的驱动芯片连接；同时，本发明实施例提供的显示面板100可以为液晶显示面板、有机发光显示面板等。当本发明实施例提供的显示面板100为液晶显示面板时，显示面板100显示区110的多条数据信号线51与栅极信号线52交叉限定一个子像素，非显示区120对应设置有栅极驱动电路；本发明实施例提供的显示面板100为有机发光显示面板时，显示面板100显示区110的多条数据信号线51与扫描信号线52交叉限定一个子像素，非显示区120对应设置有扫描驱动电路30。本发明实施例显示面板100中驱动芯片的设置方式，以及显示面板的类型等不作具体限定。为便于描述，以下均以图2中示出的设置有一个驱动芯片的有机发光显示面板为例对本发明实施例的技术方案进行示例性的说明。
示例性的，图3是本发明实施例提供的一种多路分配器电路的结构示意图。结合图2和图3，当显示面板100的一个像素单元包括三个不同发光颜色的子像素时，一个多路分配器电路20中可以包括三个晶体管，每个多路分配器电路20的三个晶体管的输出端一一对应电连接同一像素单元的三个子像素的数据信号线。相应的，一个多路分配器20中包括三个第一晶体管T1，每个第一晶体管T1包括多个控制端该第一晶体管T1的不同控制端与不同的时钟控制信号线一一电连接，例如第一晶体管可以包括两个控制端，即第一控制端g11和第二控制端g12，第一控制端g11与一条时钟控制信号线61电连接，第一控制端与另一条时钟控制信号线61电连接；同时，每个第一晶体管T1还可以包括与其多个控制端一一对应的多个输入端，即当第一晶体管T1包括第一控制端g11和第二控制端g12时，第一晶体管T1对应包括第一输入端s11和第二输入端s12。同一个第一晶体管T1的第一控制端g11和第二控制端g12分别可通过第一连接线201和第二连接线202与不同的时钟控制信号线61(63或65)和62(64或66)电连接，即三个第一晶体管T1的第一控制端g11分别通过不同的第一连接线201与不同的时钟控制信号线61、63和65电连接，三个第一晶体管T1的第二控制端g12分别通过不同的第二连接线202与不同的时钟控制信号线62、64和66电连接；与不同第一晶体管T1的第一控制端g11电连接的时钟控制信号线61、63和65传输不同时钟信号引脚CKH1、CKH2和CKH3输出的时钟控制信号，与不同第一晶体管T1的第二控制端g12电连接的时钟控制信号线62、64和66传输不同时钟信号引脚CKH1'、CKH2'和CKH3'输出的时钟控制信号；三个第一晶体管T1的第一输入端s11和第二输入端s12均与同一个数据信号引脚Vn电连接，以接收该数据信号引脚Vn输出的数据信号；三个第一晶体管T1的输出端d1分别与不同数据信号线51R、51G和51B电连接，该三条数据信号线51R、51G和51B与显示区110中同一列像素单元的三个不同发光颜色的子像素电连接，即数据信号线51R可以与红色子像素对应电连接，数据信号线51G可以与绿色子像素对应电连接，以及数据信号线51B可以与蓝色子像素对应电连接。
与第一晶体管T1的两个控制端g11和g12分别电连接的两条时钟控制信号线61和62对应的时钟信号引脚CKH1和CKH1'为同一时钟信号引脚，以使两条时钟控制信号线61和62能够传输同一时钟信号引脚CKH1(CKH1')输出的时钟控制信号，相对于一条时钟控制信号线具有较大的信号传输横截面积。由电阻R＝ρl/S，其中的ρ为时钟控制信号线的电阻率，l为时钟控制信号线的长度，S为时钟控制信号线横截面积。可知，当ρ和l均不改变时，增大时钟控制信号线横截面积，即可降低时钟控制信号线的电阻，从而能够降低时钟控制信号线上传输信号的损耗。
或者，与第一晶体管T1的两个控制端g11和g12分别电连接的两条时钟控制信号线61和62对应的时钟信号引脚CKH1和CKH1'为不同的时钟信号引脚，时钟信号引脚CKH1和CKH1'输出相同的时钟控制信号，相较于同一个时钟信号引脚分别为第一晶体管T1的控制端g11和g12提供时钟控制信号，两个时钟信号引脚CKH1和CKH1'输出相同的时钟控制信号分别供给第一晶体管T1的第一控制端g11和第二控制端g12，相当于第一晶体管T1的控制端接收的时钟控制信号翻倍，有利于缩短第一晶体管T1的导通时间，能够增加与该第一晶体管T1对应的子像素的充电电量，或者增加显示面板的画面刷新频率。
图4是与图3对应的一种多路分配器电路的等效电路图，图5是与图3对应的一种多路分配器电路的驱动时序图。结合图3、图4和图5，与第一晶体管T1的两个控制端g11和g12分别电连接的两条时钟控制信号线传输不同时钟引脚输出的相同的时钟控制信号，在t1～t2时间段，时钟信号引脚CKH1和时钟信号引脚CKH1'输出的时钟控制信号分别通过时钟控制信号线61和62分别传输至第一晶体管T101的第一控制端g11和第二控制端g12，第一晶体管T101的输入端与输出端导通，数据信号引脚Vn输出的数据信号通过导通的第一晶体管T101的输入端和输出端传输至数据信号线51B，以对蓝色子像素进行充电；在t2～t3时间段，蓝色子像素充电完成，第一晶体管T101的输入端和输出端断开，同时时钟信号引脚CKH2和CKH2'输出的时钟控制信号分别通过时钟控制信号线63和64传输至第一晶体管T102的控制端，第一晶体管T102的输入端和输出端导通，数据信号引脚Vn输出的数据信号通过导通的第一晶体管T102的输入端和输出端传输至数据信号线51G，以对绿色子像素进行充电；在t3～t4时间段，绿色子像素充电完成，第一晶体管T102的输入端和输出断开，同时时钟信号引脚CKH3和CKH3'输出的时钟控制信号分别通过时钟控制信号线65和66传输至第一晶体管T103的控制端，第一晶体管T103的输入端和输出端导通，数据信号引脚Vn输出的数据信号通过导通的第一晶体管T103的输入端和输出端传输至数据信号线51R，以对红色子像素进行充电；并在t4时刻，红色子像素充电完成。多路分配器电路通过上述不同的时钟控制信号控制不同的第一晶体管的输入端和输出端的导通，从而实现分时驱动。
相较于同一个时钟信号引脚分别为第一晶体管T1的控制端g11和g12提供时钟控制信号，两个时钟信号引脚CKH1和CKH1'输出相同的时钟控制信号分别供给第一晶体管T1的第一控制端g11和第二控制端g12，相当于第一晶体管T1的控制端接收的时钟控制信号翻倍，有利于缩短第一晶体管T1的导通时间，能够增加与该第一晶体管T1对应的子像素的充电电量，或者增加显示面板的画面刷新频率，从而提高显示面板的显示效果
需要说明的是，上述对不同发光颜色的子像素进行充电的顺序，为本发明实施例示例性的描述，除此外不同发光颜色的子像素的充电顺序可根据显示面板的显示发光要求进行调整，本发明实施例对此不做具体限定。
或者，与第一晶体管T1的两个控制端g11和g12分别电连接的两条时钟控制信号线61和62对应的时钟信号引脚CKH1和CKH1'为不同的时钟信号引脚，时钟信号引脚CKH1和CKH1'输出不同的时钟控制信号，从而能够满足特殊显示面板的显示要求。
此外，多路分配器电路中第一晶体管T1的控制端与不同的时钟控制信号线电连接，从而在X方向上能够增大第一晶体管T1的控制端的尺寸，而在Y方向上减小第一晶体管T1控制端的尺寸，相较于现有技术，能够在X方向上增加第一晶体管T1的尺寸L1，而在Y方向上减小第一晶体管的尺寸W1，从而能够减小多路分配器电路在Y方向上的尺寸，减小显示面板中非显示区的面积，实现显示面板的窄边框。
可选的，继续参考图3，第一晶体管T1的控制端可以包括第一控制端g11和第二控制端g12，相应的，第一晶体管T1的输入端可以包括第一输入端s11和第二输入端s12；第一控制端g11位于第一输入端s11与第一晶体管T1的输出端d1之间；第二控制端g12位于第二输入端s12与第一晶体管T1的输出端之间。
其中，第一晶体管T1的第一输入端s11与第二输入端s12可由相应的连接线s101连接在一起后，通过一条数据信号引线211与数据信号引脚Vn电连接；也可分别引数据信号引线，并将数据信号引线汇合后与数据信号引脚Vn；本发明实施例对此不做具体限定。
多路分配器电路中包括至少一个第一晶体管T1，该第一晶体管T1的控制端可包括两个控制端g11和g12，同时该第一晶体管T1中还设置有两个输入端，即第一输入端s11和第二输入端s12，且第一控制端g11位于第一输入端s11与第一晶体管T1的输出端d1之间，第二控制端g12位于第二输入端s12与第一晶体管T1的输出端d1之间，以使第一控制端g11能够充分利用第一输入端s11与输出端d1之间的空隙，第二控制端g12能够充分利用第二输入端s12和输出端d1之间的空隙，从而能够在X方向上，尽量减小第一晶体管T1的长度，避免多路分配器电路在X方向上的尺寸增加，进一步减小显示面板的非显示区的占用面积，有利于显示面板的窄边框。
此外，当第一输入端s11与第二输入端s12通过相应的连接线s101第三连接线203连接，再与一条数据信号引线211电连接，从而能够在不增加数据信号引线211的数量的前提下，使数据信号线211传输的数据信号能够分别通过第一输入端s11、第二输入端s12传输至输出端d1，达到简化多路分配器电路结构的效果。其中，当多路分配器电路包括多个第一晶体管T1，且该多个第一晶体管T1沿第一方向X依次排列时，任意相邻的两个第一晶体管T1可共用一个第一输入端s11或(第二输入端s12)，从而能够在X方向上进一步减小多路分配器电路的尺寸，进一步减小显示面板的边框。
本发明实施例中与第一晶体管的控制端电连接的至少两条时钟控制信号线可以位于第一晶体管的同一侧，也可以位于第一晶体管的不同侧。
可选的，第一晶体管的控制端与两条时钟控制信号线电连接，分别为第一时钟控制信号线和第二时钟控制信号线；该第一时钟控制信号线位于第一晶体管临近数据信号引脚的一侧；第二时钟控制信号线位于第一晶体管远离数据信号引脚的一侧。
示例性的，继续参考图3，第一晶体管T1的两个控制端g11和g12分别与两条时钟控制信号线电连接，即第一晶体管T1的第一控制端g11与第一时钟控制信号线61(63或65)电连接，第一晶体管T2的第二控制端g12与第二时钟控制信号线62(64或66)电连接。与第一晶体管T1电连接的两条时钟控制信号线位于第一晶体管T1的不同侧，即第一时钟控制信号线61、63和65位于第一晶体管T1临近数据信号引脚Vn的一侧，第二时钟控制信号线62、64和66位于第一晶体管T1远离数据信号线的一侧，能够降低第一时钟控制信号线与第一时钟控制信号线之间的耦合。
可选的，数据信号线沿第一方向延伸，时钟控制信号线沿第二方向延伸，第一方向与第二方向相互交叉；时钟控制信号线与数据信号线相互绝缘；其中，时钟控制信号线与数据信号线交叉位置处，时钟控制信号线与数据信号线异层设置；时钟控制信号线与数据信号线未交叉的位置处，时钟控制信号线与数据信号线同层设置。
示例性的，图6是图3沿A-A'截面的一种剖面结构示意图。结合图3和图6，显示面板包括衬底基板10，位于衬底基板一侧的第一金属层，以及位于第一金属层背离衬底基板一侧的第二金属层。其中第一金属层可以包括第一晶体管T1的控制端g11和g12，第二金属层可以包括第一晶体管T1的输入端s11和s12以及输出端d1。以多路分配器电路中三个晶体管中的一个第一晶体管为例，当第一晶体管T1的控制端g11与第一时钟控制信号线61电连接，第一晶体管T1的控制端g12与第二时钟控制信号线62电连接，且第一时钟控制信号线61位于第一晶体管T1临近数据信号引脚Vn的一侧，第二时钟控制信号线62位于第一晶体管T2远离数据信号引脚Vn的一侧，以及第一时钟控制信号线61和第二时钟控制信号线62均沿第一方向X延伸，数据信号线51B、51G和51R沿第二方向Y延伸且沿第一方向X排列时，位于第一晶体管T1远离数据信号引脚Vn一侧的第二时钟控制信号线62与数据信号线51B、51G和51R具有交叉。此时，对于第二时钟控制信号线62与数据信号线51B、51G和51R未交叉的部分，第二时钟控制信号线62可与数据信号线51B、51G和51R同层设置，而第二时钟控制信号线62与数据信号线51B、51G和51R交叉的位置可将第二时钟控制信号线62做跳线，例如可跳线至第一金属层与第一晶体管T1的控制g11和g12同层设置。
此外，由于多路分配器电路中晶体管的输入端和输出端与控制端位于不同的膜层，且通常晶体管还包括有源层，因此多路分配器电路中晶体管的输入端和输出端可通过过孔与其有源层接触，为降低输入端和输出端与有源层之间的接触电阻，可设置多个接触点。以第一经过管的输出端d1为例，其与有源层之间的可通过多个接触点d1a进行接触。相应的，当其它与晶体管的输出端和输入端同层的信号线和连接线等需与晶体管的控制端同层设置的信号线连接线电连接时也可设置多个触点，降低接触电阻，在此不再一一赘述。
需要说明的是，多路分配器电路的第一晶体管控制端可在行方向向延伸，也可在列方向上延伸，当多路分配器电路的第一晶体管在列方向上延伸时，该第一晶体管的控制端同样可分别与两条时钟控制信号线电连接。
示例性的，图7是本发明实施例提供的又一种多路分配器电路的结构示意图。如图7，多路分配器电路包括三个第一晶体管T2，该三个第一晶体管的输出端d2分别与不同的数据信号线51R、51G和51B电连接，该三个第一晶体管的输入端s2与同一数据信号引脚电连接，该每个第一晶体管的控制端g2分别与两条不同时钟控制信号线71(73或75)和72(74或76)电连接。
以其中一个第一晶体管T2为例，当与第一晶体管T2的控制端g2电连接的两条时钟控制信号线71和72传输同一时钟信号引脚CKH1(CKH')输出的时钟控制信号时，即时钟信号引脚CKH1和CKH1'为同一时钟信号引脚能够降低时钟控制信号在时钟控制信号线60上的损耗；或者，当与第一晶体管T2的控制端g2电连接的至少两条时钟控制信号线71和72传输不同时钟信号引脚CKH1和CKH1'输出的相同的时钟控制信号，以使第一晶体管T2能够通过两个不同时钟信号引脚CKH1和CKH1'输出的叠加信号进行控制，缩短第一晶体管T2的开通时间，从而增加与该第一晶体管T2对应的数据信号线51B电连接的子像素的充电电量，或者增加显示面板的刷新频率；或者，该第一晶体管T2的控制端g2电连接不同的时钟控制信号线71和72，时钟控制信号线71和72分别与不同的时钟信号引脚CKH1和CKH1'电连接，以在显示面板具有特殊显示要求时，不同的时钟信号引脚CKH1和CKH1'输出不同的时钟控制信号，满足显示面板的特殊显示要求。
需要说明的是，本发明实施例中多路分配器电路中晶体管的个数为多个，即该多路分配器电路中设置的晶体管的个数可以为三个和三个以上；同时，一个多路分配器电路中包括至少一个第一晶体管，即一个多路分配器电路中可以包括一个第一晶体管，也可包括两个或两个以上的第一晶体管，并且，可以理解的是，本发明实施例提供的多路分配器电路中还可以设置其它与第一晶体管不同的第二晶体管。其中，每个第二晶体管的控制端可与一条时钟控制信号线电连接，或者每个第二晶体管的控制端也可与至少两条时钟控制信号线电连接。以下结合附图，对多路分配器电路中包括不同的晶体管进行示例性的说明。
示例性的，图8是本发明实施例提供的又一种多路分配器电路的结构示意图。结合图2和图8，当一个像素单元包括三个不同发光颜色的子像素时，多路分配器电路20中可以包括三个晶体管，每个多路分配器电路20的三个晶体管的输出电极一一对应电连接同一像素单元的三个子像素的数据信号线。多路分配器电路20可以包括一个第一晶体管T3和两个第二晶体管T4和T5，该第一晶体管T3包括两个控制端g31和g32，第二晶体管T4包括一个控制端g4，第二晶体管T5包括一个控制端g5。第一晶体管T3的两个控制端g31和g32分别与不同的时钟控制信号线81和82电连接，第二晶体管T4的控制端g4分别与不同的时钟控制信号线83和84电连接，第二晶体管T5的控制端g5分别与不同的时钟控制信号线85和86电连接。
如此，相较于现有技术，多路分配器电路20的每个晶体管的控制端均与两条时钟控制信号线电连接，当该两条时钟控制信号线传输同一时钟信号引脚输出的时钟控制信号时，能够降低时钟控制信号在时钟控制信号线60上的损耗；或者，当两条时钟控制信号线传输不同时钟信号引脚输出的相同的时钟控制信号，以使多路分配器电路20中的晶体管能够通过两个不同时钟信号引脚输出的叠加信号进行控制，缩短晶体管的开通时间，从而增加与该晶体管对应的数据信号线电连接的子像素的充电电量，或者增加显示面板的刷新频率；或者，与多路分配器电路20中一个晶体管的控制端电连接的不同时钟控制信号线分别传输不同的时钟信号引脚输出的不同时钟控制信号时，能够在显示面板具有特殊显示要求时，不同的时钟信号引脚输出不同的时钟控制信号，满足显示面板的特殊显示要求。
相应的，第一晶体管T3同样可包括沿第一方向X排列的两个输入端s41和s42，该第一晶体管T3的第一控制端g31位于第一输入端s31与输出端d3之间，该第一晶体管T3的第二控制端g32位于第二输入端s32与输出端d3之间，以使第一晶体管T3的第一控制端g41能够充分利用第一输入端s31与输出端d3之间的空隙，第二控制端g32能够充分利用第二输入端s32和输出端d3之间的空隙，从而能够在X方向上，尽量减小第一晶体管T3的长度，避免多路分配器电路在X方向上的尺寸增加，进一步减小显示面板的非显示区的占用面积，有利于显示面板的窄边框。
示例性的，图9是本发明实施例提供的又一种多路分配器电路的结构示意图。图9中与图8中相同之处均可参照对图8的描述，以下仅对图9中与图8的不同之处进行描述。图9中，多路分配器电路的一个第二晶体管T4和T5的控制端g4和g5分别与一条时钟控制信号线83和85电连接，从而在能够满足显示面板的显示要求的前提下，尽量减少信号线的数量，有利于简化电路结构以及显示面板窄边框的实现。
可选的，继续结合参考图2图8，各第一晶体管T3以及各第二晶体管T4(T5)均沿行方向X排列；且第一晶体管T3与第二晶体管T4(T5)位于不同行；其中，行方向X为垂直于数据信号线51延伸的方向X；在沿行方向X，相邻第一晶体管T3和第二晶体管T4(T5)部分重叠。
在X方向上，第二晶体管T4的输出端d4可与第一晶体管T3的第一输入端s31重叠。其中，在X方向上，该第二晶体管T4与第一晶体管T3交叠的宽度可以为L'。同时，第二晶体管T4与第二晶体管T5可共用输入电极s4，且第二晶体管T4和第二晶体管T5的输入端s4可通过连接第一输出端s31和第二输入端s32的连接线s101的延长线和数据信号引线211电连接至数据信号引脚，以能够接收数据信号引脚Vn通过数据信号引线211传输的数据信号。
通过将第一晶体管T3与其相邻的第二晶体管T4(T5)设置于不同的行，即第一晶体管T3沿X方向上可在第二晶体管T4(T5)背离显示区110的一侧，并且沿X方向，相邻的第一晶体管T3和第二晶体管T4(T5)部分重叠，即至少一条沿Y方向延伸的直线，能够同时经过第一晶体管T3和第二晶体管T4(T5)。如此，能够在X方向上，减小第一晶体管T3与第二晶体管T4和T5的尺寸之和，从而减小多路分配器电路20的尺寸，有利于窄边框的实现。
可选的，继续参考图8，沿,行方向X，第一晶体管T3的控制端的长度Lg3大于第二晶体管T4(T5)的控制端Lg4(Lg4)的长度。
示例性的，图8中，第一晶体管T3的控制端包括第一控制端g31和第二控制端g32，因此在行方向X上。该第一晶体管T3的控制端长度Lg3为第一控制端g31的长度Lg31和第二控制端g32的长度Lg32之和。而第二晶体管T4和T5分别包括一个控制端g4和g5，该第二晶体管T4的控制端g4的长度Lg4以及第二晶体管T5的控制端g5的长度Lg5均为第一晶体管T3的一半。如此，可通过增加第一晶体管T3在行方向X上的尺寸，减小第一晶体管T3在Y方向的尺寸，从而相较于图10中的现有技术，能够减小多路分配器电路在Y方向上尺寸，有利于显示面板的窄边框。
此外，除图8和图9中第一晶体管位于第二晶体管背离显示区的一侧的设置方式外，还可将第一晶体管设置与第二晶体管靠近显示区的一侧。
示例性的，图11是本发明实施例提供的又一种多路分配器电路的结构示意图。结合图2和图11，一个多路分配器电路20包括三个晶体管，即多路分配器电路20包括一个第一晶体管T6和两个第二晶体管T7和T8。其中，第一晶体管T6包括第一控制端g61和第二控制端g62，该第一控制端g61和第二控制端g62分别与不同的条时钟控制信号线93和94电连接，第一晶体管T6还包括第一输出端d61和第二输出端d62，该第一输出端d61和第二输出端d62与同一条数据信号线51G电连接；两个第二晶体管中的一个第二晶体管T7的控制电极g7同样分别与两条时钟控制信号线91和92电连接，第二晶体管T7的输出电极d7与一条数据信号线51R电连接；另一个第二晶体管T8的控制电极g8与两条时钟控制信号线95和96电连接，第二晶体管T8的输出电极d8与一条数据信号线51B电连接；且第一晶体管T6的输入电极s6以及两个第二晶体管T7和T8的输入端s7和s8通过一条数据信号引线311与数据信号引脚Vn电连接，以能够接收数据信号引脚Vn输出的数据信号。
相较于图10中的现有技术，第一晶体管T01与第二晶体管T02和T03结构相同的情况，本发明实施例同样能够在Y方向减小第一晶体管T6和第二晶体管T7以及T8的长度之和，从而能够在Y方向上减小多路分配器电路20的尺寸，有利于减少显示面板的边框。同时，相较于图11中的现有技术，在行方向上，第二晶体管T7和第二晶体管T8的输入端s7和s8分别与第一晶体管T6的第一输出端d61和第二输出端d62具有交叠，因此同样能够在X方向上减小第一晶体管T6和第二晶体管T7以及T8的长度之和，从而能够在X方向上减小多路分配器电路20的尺寸，有利于减少显示面板的边框。
此外，相较于图10中的现有技术，多路分配器电路20的每个晶体管的控制端均与两条时钟控制信号线电连接，当该两条时钟控制信号线传输同一时钟信号引脚输出的时钟控制信号时，能够降低时钟控制信号在时钟控制信号线60上的损耗；或者，当两条时钟控制信号线传输不同时钟信号引脚输出的相同的时钟控制信号，以使多路分配器电路20中的晶体管能够通过两个不同时钟信号引脚输出的叠加信号进行控制，缩短晶体管的开通时间，从而增加与该晶体管对应的数据信号线电连接的子像素的充电电量，或者增加显示面板的刷新频率；或者，与多路分配器电路20中一个晶体管的控制端电连接的不同时钟控制信号线分别传输不同的时钟信号引脚输出的不同时钟控制信号时，能够在显示面板具有特殊显示要求时，不同的时钟信号引脚输出不同的时钟控制信号，满足显示面板的特殊显示要求。
此外，示例性的，图12是本发明实施例提供的又一种多路分配器电路的结构示意图。图12中与图10中相同之处不再赘述，仅对图12中不同之处进行说明。如图12，第二晶体管T7和T8的控制端g7和g8分别与一条时钟控制信号线91和95电连接，能够在满足显示面板的显示要求的前提下，简化电路结构。
本发明实施例还提供了一种显示装置，该显示装置包括本发明实施例提供的显示面板。因此该显示装置也具有本发明实施例提供的有机发光显示面板所具有的有益效果，相同之处可参照上文理解，下文中不再赘述。
示例性的，图13是本发明实施例提供的一种显示装置的结构示意图。如图13，显示装置200可为手机、平板电脑、车载产品、智能可穿戴设备(例如，智能手表)以及本领域技术人员可知的其他类型的显示装置，本发明实施例对此不作限定。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (12)

1.一种显示面板，其特征在于，包括：显示区和围绕所述显示区的非显示区；所述显示区设置有多条数据信号线；所述非显示区设置有多个多路分配器电路；
每个所述多路分配器电路包括多个晶体管；同一所述多路分配器电路中的各个所述晶体管的输入端均与一个数据信号引脚电连接；同一所述多路分配器电路中的各所述晶体管的控制端与不同时钟控制信号线电连接；同一所述多路分配器电路中的各所述晶体管的输出端与不同数据信号线电连接；
其中，所述多路分配器电路中的多个晶体管中包括至少一个第一晶体管，所述第一晶体管的控制端与至少两条时钟控制信号线电连接。
2.根据权利要求1所述的显示面板，其特征在于，所述第一晶体管包括多个控制端，不同所述控制端与不同所述时钟控制信号线一一电连接。
3.根据权利要求2所述的显示面板，其特征在于，与所述第一晶体管的控制端电连接的多条时钟控制信号线连接不同时钟信号引脚，与所述第一晶体管的控制端电连接的多条时钟控制信号线上的时钟控制信号相同。
4.根据权利要求2所述的显示面板，其特征在于，与所述第一晶体管的控制端电连接的多条时钟控制信号线连接不同时钟信号引脚，与所述第一晶体管的控制端电连接的多条时钟控制信号线上的时钟控制信号不同。
5.根据权利要求1所述的显示面板，其特征在于，所述多路分配器电路中的多个晶体管中还包括至少一个第二晶体管；所述第二晶体管的控制端与一条时钟控制信号线电连接。
6.根据权利要求5所述的显示面板，其特征在于，各所述第一晶体管以及各所述第二晶体管均沿行方向排列；且所述第一晶体管与所述第二晶体管位于不同行；所述行方向为垂直于所述数据信号线延伸的方向；
沿所述行方向，相邻所述第一晶体管和所述第二晶体管部分重叠。
7.根据权利要求6所述的显示面板，其特征在于，沿所述行方向，所述第一晶体管的控制端的长度大于所述第二晶体管的控制端的长度。
8.根据权利要求1所述的显示面板，其特征在于，所述多路分配器电路包括三个晶体管；
所述显示区还设置有多条扫描信号线；多条所述扫描信号线与多条数据信号线交叉限定多个子像素；三个不同发光颜色的所述子像素组成一像素单元；每个所述子像素一一对应电连接所述数据信号线；
每个所述多路分配器电路的三个晶体管的输出端一一对应电连接同一所述像素单元的三个所述子像素的数据信号线。
9.根据权利要求1所述的显示面板，其特征在于，所述第一晶体管的控制端与两条时钟控制信号线电连接，分别为第一时钟控制信号线和第二时钟控制信号线；
所述第一时钟控制信号线位于所述第一晶体管临近所述数据信号引脚的一侧；所述第二时钟控制信号线位于所述第一晶体管远离所述数据信号引脚的一侧。
10.根据权利要求1所述的显示面板，其特征在于，所述数据信号线沿第一方向延伸，所述时钟控制信号线沿第二方向延伸，所述第一方向与所述第二方向相互交叉；所述时钟控制信号线与所述数据信号线相互绝缘；
其中，所述时钟控制信号线与所述数据信号线交叉位置处，所述时钟控制信号线与所述数据信号线异层设置；所述时钟控制信号线与所述数据信号线未交叉的位置处，所述时钟控制信号线与所述数据信号线同层设置。
11.根据权利要求1所述的显示面板，其特征在于，所述第一晶体管的输入端包括第一输入端和第二输入端；所述第一晶体管的控制端包括第一控制端和第二控制端；
所述第一控制端位于所述第一输入端与所述第一晶体管的输出端之间；所述第二控制端位于所述第二输入端与所述第一晶体管的输出端之间。
12.一种显示装置，其特征在于，包括：权利要求1～11任一项所述的显示面板。
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