CN110709988B - Led发光图像显示装置 - Google Patents

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Abstract

本发明涉及一种发光显示装置，包括：包括电连接元件的转印基板；以及多个半导体芯片(310)，其连接到基板上并与基板的电连接元件连接以对其进行控制，每个芯片包括：多个LED(120r，120g，120b)；连接到基板的第一端子(Vdata)，该端子用于为芯片的每个LED接收用于LED的单独的调整信号(Vdatar，Vdatag，Vdatab)，用于芯片的各个LED的单独的调整信号在第一端子上(Vdata)上在时间上复用；以及控制电路，其被设计为对在第一端子上接收到的信号进行解复用，并且向芯片的每个LED施加偏置信号，该偏置信号依赖于在第一端子(Vdata)上接收到的用于LED的单独的调整信号。

Description

LED发光图像显示装置
本专利申请要求法国专利申请FR17/52953的优先权，其通过引用并入本文。
技术领域
本申请涉及包括发光二极管(LED)的发光图像显示装置(例如用于电视、计算机、智能电话、平板电脑等的屏幕)的形成。
背景技术
在2015年11月26日提交的法国专利申请Nr.1561421中已经提供了一种图像显示装置，该图像显示装置包括以阵列形式布置在相同转印基板(transfer substrate)上的多个基本电子芯片。所述芯片被组装以固定到转印基板，并连接到转印基板的电子连接元件以控制所述电子连接元件。每个芯片包括LED和LED控制电路的堆叠，并且对应于装置的像素。
希望能够至少部分地改善该类型图像显示装置的某些方面。
发明内容
因此，实施例提供了一种发光显示装置，包括：
转印基板，其包括电连接元件；以及
多个半导体芯片，其固定到基板并连接到所述基板的所述电连接元件以对其进行控制，每个芯片包括：
-多个LED；
-到基板的第一连接端子，其用于为所述芯片的每个LED接收用于设置LED的单独的信号，用于设置所述芯片的不同LED的单独的信号在第一端子上在时间上复用；以及
-控制电路，其能够对在所述第一端子上接收的信号进行解复用并且能够将偏置信号施加到所述芯片的每个LED，所述偏置信号是在所述第一端子上接收的单独的LED设置信号的函数。
根据一个实施例，每个基本芯片包括多个像素，每个像素包括多个子像素，每个子像素包括单个LED，并且同一像素的不同子像素的LED被设置为在不同的波长范围内发射。
根据一个实施例，每个基本芯片包括多个像素，每个像素包括单个LED，不同像素的LED被设置为在相同波长范围内发射。
根据一个实施例，每个基本芯片包括单个像素，该单个像素包括多个子像素，每个子像素包括单个LED，所述像素的不同子像素的LED被设置为在不同的波长范围内发射。
根据一个实施例，在每个基本芯片中，在所述芯片的第一端子上在时间上复用的单独的设置信号是模拟信号。
根据一个实施例，每个芯片还包括到所述基板的第二连接端子，其用于接收由芯片控制电路使用的同步信号以对在所述第一端子上接收的信号的解复用进行同步。
根据一个实施例，在每个基本芯片中，对于所述芯片的每个LED，所述控制电路包括用于控制LED的基本电路，该基本电路包括：
第一MOS晶体管，其将所述芯片的所述第一端子耦合到所述基本控制电路的中间节点；
第二MOS晶体管，其将所述芯片的第一电源端子耦合到LED的阳极电极或阴极电极，所述第二MOS晶体管的栅极耦合到所述基本控制电路的所述中间节点；以及
电容元件，其将所述基本控制电路的所述中间节点耦合到所述芯片的所述第一电源端子或所述芯片的第二电源端子。
根据一个实施例，每个基本芯片包括内部选择电路，其能够接收施加到所述芯片的第二端子的同步信号，并且能够在所述芯片的每个第一晶体管的栅极上提供用于控制晶体管到断开状态或导通状态的单独的信号。
根据一个实施例，在每个基本芯片中，在所述芯片的第一端子上在时间上复用的单独的设置信号是数字信号。
根据一个实施例，每个芯片还包括到所述基板的第二连接端子，其用于接收叠加到同步信号上的时钟信号，所述时钟信号和同步信号被所述控制电路用来对在所述第一端子上接收的信号的解复用进行同步。
根据一个实施例，在每个基本芯片中，芯片控制电路包括用于所述芯片的每个LED的特定的数模转换器。
根据一个实施例，在所述装置的每个基本芯片中，所述芯片的LED形成在基于III-V半导体的第一基板中，并且其中所述芯片控制电路形成在基于硅的第二基板中，所述第二基板与所述第一基板相邻并电连接到所述第一基板。
附图说明
在结合附图对特定实施例的以下非限制性描述中，将详细讨论前述和其他特征和优点，其中：
图1是图像显示装置的一个示例的基本芯片的电路的电路图；
图2是图像显示装置的另一示例的基本芯片的电路的电路图；
图3是根据一个实施例的图像显示装置的一个示例的基本芯片的电路的简化电路图；
图4是示出了图3的基本芯片的操作模式的一个示例的时序图；
图5是根据一个实施例的图像显示装置的另一示例的基本芯片的电路的简化电路图；
图6是根据一个实施例的图像显示装置的另一示例的基本芯片的电路的简化电路图；
图7和图8是示出了图6的基本芯片的操作模式的一个示例的时序图；
图9A、9B、9C分别是根据一个实施例的图像显示装置的基本芯片的一个示例的简化的俯视图、截面图和仰视图；以及
图10是根据一个实施例的图像显示装置的转印基板的一个示例的俯视图。
具体实施方式
在各个附图中，相同的元件已经用相同的附图标记表示，并且各个附图未按比例绘制。为了清楚起见，仅示出并详细描述了对于理解所描述的实施例有用的那些步骤和元件。特别地，没有详细描述所描述的显示装置的基本芯片的制造，基于本公开的教导，这种芯片的制造在本领域技术人员的能力范围内。作为示例，可以根据与上述法国专利申请Nr.1561421中描述的方法相同或相似的方法来制造各自包括一个或多个LED和基于晶体管的控制电路的所描述的显示装置的基本芯片，所述申请经法律授权通过引用并入本文。在下面的描述中，当提及限定绝对位置的术语时，诸如术语“前”、“后”、“顶部”、“底部”、“左”、“右”等，或相对位置的术语，例如术语“在……之上”、“在……之下”、“高于”、“低于”等，或限定方向的术语，例如术语“水平”、“垂直”等，其指的是附图的方向。应当理解，实际上所描述的装置可以不同地定向。除非另有说明，否则表述“近似”、“基本上”和“大约”是指在10％以内，优选地在5％以内，或者与角度值或角度方向有关，在10度以内，优选地在5度以内。
图1是上述法国专利申请Nr.1561421中所述类型的图像显示装置的基本芯片110的电路的电路图。
芯片110包括LED 120，优选地是无机LED，例如，基于氮化镓或能够形成LED的任何其他III-V半导体。芯片110还包括用于控制LED 120的有源电路130(例如，基于晶体管的电路)，其能够控制LED的发光。
作为示例，首先分别在用于电路130的硅基板的内部和顶部以及在用于LED120的例如由蓝宝石制成的合适的生长基板上分别单独形成控制电路130和LED 120。LED 120被形成为在其与生长基板相对的表面一侧具有电阳极和阴极触点。控制电路130在硅基板的第一表面的一侧上包括用于与LED的阳极和阴极触点相接触的电连接区域，并且在硅基板的与第一表面相对的第二表面一侧上包括连接到用于芯片控制的外部装置的端子。然后通过将与生长基板相对的LED的表面接合到电路130的第一表面来固定电路130和LED 120。然后将包括电路130和LED 120的芯片转印到转印基板(例如无源转印基板)上，其包括用于电源和芯片控制的电连接元件。在转印期间，将芯片布置成使得芯片的电路130的第二表面面对转印基板，以在芯片外部的连接端子与转印基板的电连接区域之间形成直接电连接。可以在芯片接合到转印基板之前或之后进一步去除生长基板。
在该示例中，芯片110包括到外部Vp、Vn、Vsel和Vdata的四个连接端子。为了简化，在本公开中，以与实际端子相同的附图标记来指示施加到芯片连接端子的电信号。端子Vp和Vn用于分别接收芯片的低电源电位Vp(例如，地)和高电源电位Vn(即，大于低电源电位)。端子Vsel和Vdata用于接收芯片控制信号。更特别地，信号Vsel是芯片选择信号，并且信号Vdata是用于设置芯片的亮度水平的信号。
在图1的示例中，芯片控制电路130包括两个晶体管131和133以及一个电容元件135，例如电容器。在该示例中，晶体管131和133是MOS晶体管。更特别地，晶体管131是N沟道MOS晶体管，并且晶体管133是P沟道MOS晶体管。晶体管131具有连接到端子Vdata的第一导电节点(在本示例中为源极或漏极)、连接到芯片的中间节点a1的第二导电节点(在本示例中为漏极或源极)、以及连接到端子Vsel的控制节点(在本示例中为栅极)。电容元件135具有连接到节点a1的第一电极和连接到端子Vp的第二电极。晶体管133具有连接到端子Vp的第一导电节点、连接到LED 120的阳极的第二导电节点以及连接到节点a1的控制节点。LED120的阴极连接到端子Vn。
在基本芯片110中，以开关模式(导通或断开)使用晶体管131以允许或不允许更新LED亮度设置。晶体管133以线性模式操作以控制注入LED的电流的强度。
基本芯片110在像素亮度水平的更新阶段期间的操作如下。通过将适合的控制信号施加到端子Vsel，使晶体管131导通(使其导电)。电容元件135然后充电到电压电平，该电压电平是施加到芯片的端子Vdata的设置信号的函数。调节信号Vdata的电平设置节点a1的电位，并因此设置由晶体管133注入LED的电流的强度，并因此设置LED发射的光强度。然后可以断开晶体管131。节点a1然后保持在基本上等于电位Vdata的电位。因此，在晶体管131断开之后，注入到LED中的电流基本上保持恒定，直到节点a1的电位下一次更新为止。
在实践中，显示装置可以包括根据行和列的阵列中的布局组装在相同转印基板上的多个相同或相似的基本芯片110，所述芯片被连接到基板的电连接元件以控制电连接元件，并且每个芯片与显示装置的像素相对应。
作为示例，显示装置的像素是可逐行地同时控制的。换句话说，对于阵列的每一行，该行的芯片的控制端子Vsel连接到用于控制转印基板的行的相同导电轨道，不同行的芯片的控制端子Vsel连接到用于控制转印基板的行的不同导电轨道。此外，对于阵列的每一列，该列中的芯片的控制端子Vdata连接到用于控制转印基板的列的相同导电轨道，不同列的芯片的控制端子Vdata连接到用于控制转印基板的列的不同导电轨道。因此，在图像显示期间，可以逐行同时刷新装置的像素。
为了形成彩色图像显示装置，可能的是，为该装置的每个像素提供多个能够在不同波长范围内发射的相邻基本芯片，例如三个能够分别发射红光、绿光和蓝光的基本芯片。然后，每个基本芯片对应于装置的子像素。不同颜色的基本芯片可以包括能够在不同波长范围内发射的具有不同性质的LED、或者是顶部具有滤光器或具有不同性质的光致发光转换元件的相同性质的LED。
然后出现的问题在于应当被提供在转印基板上以使得能够独立地控制装置的每个子像素的电连接元件的数量和密度。
为了限制转印基板的电连接元件的数量，可能的是将装置的同一像素的不同子像素集成在相同基本芯片上。
图2是显示装置的基本芯片210的电路图，其中每个基本芯片对应于装置的像素并且集成了分别能够发射红光、绿光和蓝光的三个子像素SPr、SPg和SPb。
芯片210的每个子像素SPr、SPg和SPb基本上包括与图1的芯片110相同的电路元件，即，LED 120r，相应地120g，相应地120b；选择晶体管131r，相应地131g，相应地131b；电流调节晶体管133r，相应地133g，相应地133b；以及电容元件135r，相应地135g，相应地135b。
在该示例中，芯片包括到外部的六个连接端子Vp、Vn、Vsel、Vdatar、Vdatag和Vdatab。端子Vp和Vn用于分别接收芯片的低电源电位Vp和高电源电位V Vn。端子Vsel、Vdatar、Vdatag和Vdatab用于接收芯片控制信号。更特别地，信号Vsel是芯片选择信号，信号Vdatar、Vdatag和Vdatab是用于分别设置LED 120r、120g和120b的亮度水平的信号。
晶体管131r、131g和131b中每个的控制节点连接到端子Vsel。晶体管131r具有连接到端子Vdatar的第一导电节点和连接到芯片的中间节点a1r的第二导电节点，晶体管131g具有连接到端子Vdatag的第一导电节点和连接到芯片的中间节点a1g的第二导电节点，并且晶体管131b具有连接到端子Vdatab的第一导电节点和连接到芯片的中间节点alb的第二导电节点。电容元件135r具有连接到节点a1r的第一电极，和连接到端子Vp的第二电极，电容元件135g具有连接到节点a1g的第一电极，和连接到端子Vp的第二电极，并且电容元件135b具有连接到节点a1b的第一电极，和连接到端子Vp的第二电极。晶体管133r具有连接到端子Vp的第一导电节点，连接到LED 120r的阳极的第二导电节点和连接到节点a1r的控制节点，晶体管133g具有连接到端子Vp的第一导电节点，连接到LED 120g的阳极的第二导电节点，和连接到节点a1g的控制节点，并且晶体管133b具有连接到端子Vp的第一导电节点，连接到LED120b的阳极的第二导电节点，和连接到节点a1b的控制节点。LED 120r、120g、120b中的每个的阴极连接到端子Vn。
LED 120r、120g和120b例如是能够发射不同波长范围的光的不同性质的LED。作为变体，LED 120r、120g和120b具有相同的性质并且在相同的波长范围内发射，但是在LED120r、120g和120b上面装有具有不同性质的滤光器或光致发光转换元件，从而使得像素SPr、SPg和SPb以不同的波长范围发射。
基本芯片210的操作例如类似于关于图1所描述的操作，不同之处在于，在图2的示例中，通过在端子Vsel上施加适合的控制信号来选择基本芯片210，分别根据施加到端子Vdatar、Vdatag和Vdatab的电位同时更新节点a1r、a1g和a1b的电位，这导致同时更新LED120r、120g和120b的各个亮度设置。
图2的显示装置的缺点是要提供在转印基板上以能够分别控制装置的每个像素的电连接元件的数量仍然相对较高，特别是由于亮度设置信号Vdatar、Vdatag和Vdatab由转印基板的不同导电轨道支持。
根据实施例的一个方面，提供了形成一种显示装置，其中每个基本芯片集成了多个可单独控制的子像素，但是其中在每个基本芯片中，提供了到外部的单个连接端子以用于接收用于设置不同芯片子像素的亮度的单独的信号，所述用于设置子像素的亮度的信号在该连接端子上在时间上复用。
图3是根据实施例的图像显示装置的示例的基本芯片310的电路的简化电路图。
如在图2的示例中，每个基本芯片310对应于装置的像素，并且集成了能够分别发射红光、绿光和蓝光的三个子像素SPr、SPg和SPb。
芯片310的每个子像素SPr、SPg和SPb基本上包括与图2的示例中相同的电路元件，即，LED 120r，相应地120g，相应地120b；选择晶体管131r，相应地131g，相应地131b；电流调节晶体管133r，相应地133g，相应地133b；以及电容元件135r，相应地135g，相应地135b。在所示的示例中，晶体管131r、131g、131b、133r、133g、133b是N沟道MOS晶体管。
在该示例中，芯片包括到外部的四个连接端子Vp、Vn、Vsel和Vdata。端子Vp和Vn用于分别接收芯片的低电源电位Vp和高电源电位Vn。端子Vsel和Vdata用于接收芯片控制信号。更特别地，端子Vsel用于接收芯片选择信号，并且端子Vdata用于接收用于设置LED120r、120g、120b的亮度水平的在时间上复用的单独的信号。
芯片310还包括内部选择电路312，内部选择电路312接收信号Vsel并传递分别施加到晶体管131r、131g和131b的栅极的选择信号Lr、Lg和Lb。更特别地，在所示示例中，电路312包括分别连接到晶体管131r、131g和131b的栅极的三个输出节点Lr、Lg和Lb。电路312进一步耦合到芯片的端子Vp和Vn以用于其供电。
晶体管131r具有连接到端子Vdata的第一导电节点和连接到芯片的中间节点a1r的第二导电节点，晶体管131g具有连接到端子Vdata的第一导电节点和连接到中间节点a1g的第二导电节点，并且晶体管131b具有连接到端子Vdata的第一导电节点和连接到芯片的中间节点alb的第二导电节点。电容元件135r具有连接到节点a1r的第一电极，和连接到端子Vn的第二电极，电容元件135g连接到节点a1g的第一电极，和连接到端子Vn的第二电极，并且电容元件135b具有连接到节点a1b的第一电极，和连接到端子Vn的第二电极。晶体管133r具有连接到端子Vp的第一导电节点，连接到LED 120r的阳极的第二导电节点，以及连接到节点a1r的控制节点，晶体管133g具有连接到端子Vp的第一导电节点，连接到LED 120g的阳极的第二导电节点，以及连接到节点a1g的控制节点，并且晶体管133b具有连接到端子Vp的第一导电节点，连接到LED 120b的阳极的第二导电节点，以及连接到节点a1b的控制节点。LED120r、120g、120b中的每个的阴极连接到端子Vn。
图4是示出图3的基本芯片310的操作模式的示例的时序图。更特别地，图4示出了在芯片的子像素SPr、SPg和SPb的单独的亮度水平的更新阶段期间芯片310的信号Vdata、Vsel、Lr、Lg和Lb随时间的变化。
为了控制芯片的子像素SPr、SPg和SPb的单独的亮度水平的更新，将脉冲串施加到芯片的端子Vsel。更特别地，在该示例中，脉冲串包括例如在时间上规则间隔的nbSP+1个脉冲，其中nbSP是芯片的子像素的数量(在本示例中，nbSP＝3)。脉冲串的第一脉冲的上升沿标记像素更新阶段的开始，而脉冲串的最后脉冲的上升沿标记像素更新阶段的结束。
在像素更新阶段开始的时间t0(对应于信号Vsel的第一脉冲的上升沿)处，内部选择电路312命令子像素SPr的选择晶体管131r导通，并且命令子像素SPg和SPb的选择晶体管131g和131b保持在断开状态。为此目的，在该示例中，在时间t0处，信号Lr被设置为高状态，并且信号Lg和Lb被设置为低状态。
在时间t0和对应于信号Vsel的第二脉冲的上升沿的时间t1之间，像素SPr的电容器135r充电到电压电平，该电压电平是在时间t0和t1之间施加到端子Vdata的电位的函数，而电容器135g和135b的电压电平保持基本不变。
在时间t1处，内部选择电路312命令子像素SPr的选择晶体管131r断开，命令子像素SPg的选择晶体管131g导通，并且命令保持子像素SPb的选择晶体管131b保持在断开状态。为此目的，在该示例中，在时间t1处，信号Lr被设置为低状态，信号Lg被设置为高状态，并且信号Lb被保持在低状态。
在时间t1和对应于信号Vsel的第三脉冲的上升沿的时间t2之间，像素SPg的电容器135g充电到电压电平，该电压电平是在时间t1和t2之间施加到端子Vdata的电位的函数，而电容器135r和135b的电压电平基本上保持不变。
在时间t2处，内部选择电路312控制子像素SPg的选择晶体管131g断开，控制子像素SPb的选择晶体管131b导通，并且控制子像素SPr的选择晶体管131r保持在断开状态。为此目的，在本示例中，在时间t2处，信号Lg被设置为低状态，信号Lb被设置为高状态，并且信号Lr保持在低状态。
在时间t2和对应于信号Vsel的第三脉冲的上升沿的时间t3之间，像素SPb的电容器135b充电到电压电平，该电压电平是在时间t2和t3之间施加到端子Vdata的电位的函数，而电容器135r和135g的电压电平保持基本不变。
时间t3标记像素更新阶段的结束。从时间t3开始，LED 120r、120g和120b的亮度水平基本上保持不变，直到像素的下一次更新为止。
如从图4中可以看出的，在该示例中，信号Vdata的电平在时间t0和t3之间在信号Vsel的每个新的上升沿处分阶段变化。信号Vdata在时间t0和t1之间的部分对应于用于设置子像素SPr的LED 120r的单独的信号，信号Vdata在时间t1和t2之间的部分对应于用于设置子像素SPg的LED 120g的单独的信号，在时刻t2和t3之间的信号Vdata的部分对应于用于设置子像素SPg的LED 120g的单独的信号。单独的设置信号Vdatar、Vdatag和Vdatab因此在端子Vdata上在时间上复用。包括芯片的内部选择电路312、晶体管131r、131g、131b、133r、133g、133b和电容器135r、135g和135b的组件形成控制电路，该控制电路能够对端子Vdata上接收的单独的设置信号进行解复用，并且能够将偏置信号(在本示例中为电流)施加到芯片的每个LED，该偏置信号是单独的LED设置信号的函数。
应当注意，没有详细描述能够实现关于图4描述的操作的芯片的内部选择电路312的形成，这种电路的形成基于本公开的功能指示在本领域技术人员的能力范围内。作为示例，电路312可以包括与解码门和复位机制相关联的两级脉冲计数器，所述复位机制例如由封装检测器类型的组件将信号Vsel接收作为输入而获得。
与关于图1所描述的类似，图3的显示装置的基本芯片310可以以行和列的阵列布置并且以行和列互连，以允许逐行同时控制装置像素。
关于图3描述的实施例的优点在于，每个基本芯片310包括单个端子Vdata，以接收用于设置所有芯片子像素的单独的信号。因此，在图3的示例中，每个基本芯片310仅包括到外部的四个连接端子，即，不超过关于图1描述的类型的基本芯片(包括单个LED)中的端子。与图2的示例相比，这尤其使得能够减少要在转印基板上提供的电连接元件的数量。实际上，在图3的实施例中，用于设置相同芯片310的不同子像素的亮度的单独的信号Vdatar、Vdatag和Vdatab由转印基板的相同导电轨道支持。
应当注意，所描述的实施例不限于关于图3所描述的特定示例，其中每个基本芯片包括被划分为能够在三个不同波长范围内发射的三个子像素的单个像素。作为变型，每个基本芯片可以包括单个像素，该单独的像素被分成不同于三个的多个子像素。在另一变型中，每个电子芯片可以包括被划分为或不划分为不同颜色的子像素的多个像素。
特别地，如将在下文中进一步详细解释的，所描述的实施例特别适于形成所谓的多视图显示装置，即，要显示的图像被划分为宏像素，每个宏像素包括多个与希望被复制的场景的不同视图相对应的多个像素。作为示例，相同宏像素的不同像素分别对应于在不同的视角下拍摄的相同场景的不同图像的同一像素。例如，多视图显示装置可以用于希望给用户以三维视图印象的应用中。
图5是根据一个实施例的多视图图像显示装置的一个示例的基本芯片510的电路的简化电路图。
在该示例中，每个基本芯片510对应于装置的宏像素，包括用于分别显示n个不同图像的相同点(例如，对应于相同场景的n个不同视图)的n个像素P1、P2，...，Pn，其中n是大于1的整数，例如，在2至50的范围内。在本示例中，宏像素的每个像素Pi(i是从1至n的整数)包括能够在不同波长范围内发射以允许显示彩色图像的多个子像素。更特别地，在示出的示例中，每个像素Pi包括能够分别发射红光、绿光和蓝光的三个子像素SPr、SPg和SPb。如在图3的示例中，图5的芯片510包括到外部的四个连接端子Vp、Vn、Vsel和Vdata。芯片510的每个子像素SPr、SPg、SPb包括与图3的示例中的基本上相同的电路元件，并且基本上以相同的方式布置。在图5的示例中，芯片510的所有像素P1、P2，…Pn的选择晶体管131r、131g、131b(即，n*3个选择晶体管)的第一导电节点连接到芯片的相同端子Vdata。
芯片510还包括类似于图3的电路312的内部选择电路512，该内部选择电路512接收信号Vsel并为每个像素Pi传送分别施加到像素Pi的晶体管131r、131g和131b的栅极的选择信号LrPi、LgPi和LbPi。换句话说，电路512包括分别与芯片的n个像素Pi的选择晶体管131r、131g和131b的栅极连接的n*3个输出节点LrP1、LgP1、LbP1、LrP2、LgP2、LbP2，...LrPn、LgPn、LbPn。电路512进一步耦合到芯片的端子Vp和Vn以用于其供电。
图5的基本芯片510的操作类似于以上已经关于图3和图4描述的操作。更特别地，在图5的示例中，在更新像素的n*3个子像素的阶段期间，用于设置芯片的n*3个LED的n*3个单独的信号在芯片的端子Vdata上在时间上复用。选择信号Vsel例如包括(n*3)+1个脉冲的串，以在芯片内部同步对信号Vdata的解复用。
类似于先前已经描述的，图5的显示装置的基本芯片510可以以行和列的阵列布置，并且以行和列互连，以允许逐行同时控制装置的宏像素。
应当注意的是，当在装置的每个基本芯片中要单独控制的LED的数量很高时，以串行数字数据的形式在芯片的连接端子Vdata上传输用于设置芯片的不同LED的单独的信号可能是有利的，特别是能够更快地执行设置信号的传输。
图6是根据一个实施例的多视图图像显示装置的示例的基本芯片610的电路的简化电路图。图6的芯片610与图5的芯片510的主要区别在于，在芯片610中，以串行数字数据的形式在芯片的连接端子Vdata上接收用于设置芯片的不同LED的单独的信号。
如在图5的示例中，图6的基本芯片610对应于显示装置的宏像素，其包括n个像素P1、P2，...，Pn，每个像素包括三个子像素SPr、SPg和SPb，每个子像素SPr、SPg和SPb包括可单独设置的LED。在该示例中，每个子像素SPr包括被设置为发射红光的LED 120r，每个子像素SPg包括被设置为发射绿光的LED 120g，并且每个子像素SPb包括被设置为发射蓝光的LED120b。在该示例中，芯片的所有LED的阴极区域均连接至芯片的低电源电位Vn。
在图6的示例中，芯片610还包括控制电路620，该控制电路620连接至到芯片的外部的连接端子Vsel、Vdata、Vp和Vn。电路620能够解码由芯片在其端子Vdata上接收的串行数字信号，并且能够将偏置信号施加到芯片的每个LED，所述偏置信号是在端子Vdata上以数字形式接收的单独的LED设置信号的函数。为此，电路620包括分别耦合到芯片的n*3个LED的阳极接触区域的n*3个输出节点或偏置信号供应节点。更特别地，对于芯片的每个像素Pi，电路620包括耦合到像素Pi的LED 120r的阳极的输出节点outrPi，耦合到像素Pi的LED120g的阳极的输出节点outgPi，耦合到像素Pi的LED 120b的阳极的输出节点outbPi。电路620例如能够经由其连接到芯片的LED的阳极的输出节点向芯片的每个LED提供偏置电流，该偏置电流是在芯片的端子Vdata上接收的单独的LED设置信号的函数。在图6的示例中，控制电路620代替由图5的示例中的内部选择电路512、晶体管131r、131g、131b、133r、133g、133b和电容器135r、135g和135b形成的控制电路。
图7和图8是示出图6的基本芯片610的操作模式的一个示例的时序图。更特别地，图7部分地示出了芯片610的子像素的单独的亮度水平的更新阶段期间施加到芯片的端子Vsel的信号。图8示出了电路620从信号Vsel生成的芯片内部信号CLK和SYNC的变化。图8还示出了在芯片子像素的单独的亮度水平的更新阶段期间施加到芯片的信号Vdata的变化。
在该示例中，信号Vsel是具有三个电平的信号：低电平(0)，高于低电平的中间电平THCLK和高于中间电平的高电平THSYNC。在芯片子像素的单独的亮度水平的更新阶段期间传输到芯片610的信号Vsel对应于周期性时钟信号CLK和同步信号SYNC的叠加，所述周期时钟信号CLK对应于中间电平THCLK的一系列规则间隔开的脉冲，所述同步信号SYNC对应于一系列高电平THSYNC的脉冲。
控制电路620包括信号CLK和SYNC的分离的阶段(未详细说明)，在输入节点上接收信号Vsel，并且在两个不同的输出节点上传送分别与信号CLK和信号SYNC相对应的两个二进制信号。作为示例，信号CLK和SYNC的分离是通过两个比较器将信号Vsel分别与阈值THCLK和阈值THSYNC进行比较的方式来实现的，比较器分别输出信号CLK和信号SYNC。
信号CLK是时钟信号，其使得能够对在端子Vdata上传输的串行数字信号的解码操作进行评级，并且信号SYNC是同步信号，其使得能够指示控制电路620其将接收要在芯片的端子Vdata上解码的数据。
在图8的示例中，考虑了对应于n＝5的宏像素的芯片610，每个像素包括nbsP＝3个子像素，即，要更新15个LED。此外，在该示例中，考虑用于设置芯片610的每个LED的单独的信号被编码为n比特＝4比特。实际上，每个单独的LED设置信号被编码的比特的数量n比特可以不同于4，例如，可以在4到16位的范围内。
在本示例中，宏像素更新序列开始于将信号SYNC的双脉冲施加到端子Vsel。
在接收到信号SYNC的这个双脉冲后，电路620被告知串行宏像素更新二进制数据将在其端子Vdata上被传送。例如，在该步骤中复位由时钟信号CLK额定的电路620内部的计数器。
在信号SYNC的双脉冲之后，将n*n比特＝5*4＝20个数据比特的串经由端子Vdata传送到电路620，所述20个数据比特的串对应于用于设置宏像素的第一颜色的n个子像素(例如，宏像素的n个子像素Spr)的单独的信号。
然后将信号SYNC的简单脉冲施加到端子Vsel。因此，电路620被告知将经由端子Vdata向电路620传送n*n比特个数据比特的第二串，所述n*n比特个数据比特的第二串对应于用于设置宏像素的第二颜色的n个子像素(例如，宏像素的n个子像素SPg)的单独的信号。
在n*n比特的第二串的传输之后，信号SYNC的新的简单脉冲被施加到端子Vsel，以告知电路620n*n比特个数据比特的第三串将经由端子Vdata被传送到电路620，所述n*n比特个数据比特的第三串对应于用于设置宏像素的第三颜色的n个子像素(例如，宏像素的n个子像素SPb)的单独的信号。
应当注意，将数据传送到电路620的顺序并不重要，只要电路620知道该顺序并适应即可。
此外，尽管已经示出了通过单个SYNC的脉冲来分离用于设置不同的宏像素颜色的信号的传输的实施示例，但是所描述的实施例不限于该特定情况。作为变型，信号SYNC可以在更新阶段开始时包括单个简单脉冲，然后以n*nbSP*n比特个比特(即在所考虑的示例中为60比特)的不间断串的形式来传送数据。
对于每个单独的宏像素LED设置信号，可以对在端子Vdata上接收到的单独的设置信号实施数模转换。然后将作为接收到的设置信号的函数的偏置信号(电流或电压)施加到LED。作为示例，对于芯片610的每个LED，电路620包括数模转换器，即，总共n*nbSP个数模转换器。与LED相关联的数模转换器的模拟输出信号例如被直接施加至LED的阳极。作为变型，数模转换器的输出信号用于设置将电流注入到LED中的可控电流源。
类似于先前已经描述的，图6的显示装置的基本芯片610可以以行和列的阵列布置，并且以行和列互连，以允许逐行同时控制装置的宏像素。
应当注意，图5和图6的示例可以适用于装置的每个基本芯片510或610的像素P1，P2，…，Pn是关于图1描述的类型的单色像素的情况，即，不被划分为能够在不同波长范围内发射的子像素。
此外，图6的变型(设置信号的数字传输)可以适合于如图3的示例中基本芯片610包括被划分为多个能够在不同波长范围内发射的子像素的单个像素的情况。
图9A、9B和9C是上述类型的图像显示装置的基本芯片的简化视图。在该示例中，芯片包括6个像素P1、P2、P3、P4、P5和P6，每个像素包括能够在三个不同波长范围内发射的三个子像素SPr、SPg和SPb。
图9A是芯片的俯视图，图9B是芯片沿图9A的平面9B-9B的截面图，图9C是芯片的仰视图。
如图9B所示，芯片包括例如基于III-V半导体的第一基板901和第二基板903。第一基板901具有形成在其中的芯片的LED 120r、120g、120b，并且与基板901相邻并电连接到基板901。第二基板903例如由硅制成，并具有形成在其中的芯片控制电路。
如图9C所示，芯片在基板903的与基板901相对的表面的一侧上包括电连接区域905，该电连接区域905包括到芯片的外部的四个连接端子Vp，Vn，Vsel和Vdata。
应当注意，在所示的示例中，如图9A所示，芯片的像素P1、P2，...，Pn排列成线性阵列，并沿x轴对准。根据行和列中的阵列布局将基本芯片组装在装置的转印基板上，从而使得每个芯片的x轴基本平行于阵列行。实际上，在多视图显示装置中，当观察者的眼睛沿平行于阵列行的轴的方向(通常为水平方向)移动时，而不是当它沿平行于列的轴的方向(通常是垂直方向)移动时，用户通常希望能够感知场景的不同视图。在实践中，每个宏像素顶上有一个或多个透镜(未示出)，该透镜能够沿着x轴执行与宏像素的不同像素相对应的光束的角度分离。
在示出的示例中，在每个像素Pi中，像素的子像素SPr、SPg、SPb被布置成条状，沿着基本正交于x轴并且基本平行于宏像素阵列的列的y轴对准。这种配置的优点在于，由于存在沿宏像素上方的x轴的角度分离的一个或多个透镜，因此使得能够避免同一像素的不同颜色的角度分离。
图10是用于上面关于图3至图8描述的类型的显示装置的基本芯片的转印基板的示例的简化的局部俯视图。在图10中，仅示出了对应于显示装置的三行和两列的子阵列的一部分转印基板。
转印基板例如包括由绝缘材料制成(例如由玻璃或塑料制成)的支撑板或片1010。转印基板还包括电连接元件，并且特别是通过在支撑板1010的上表面上印刷而形成的导电迹线和导电区域。电连接元件是通过在导电板1010的上表面上印刷一系列导电和绝缘层而形成的。电连接元件例如通过喷墨印刷型、丝网漏印、轮转凹版印刷的印刷方法或通过任何其他适合的方法形成。
图10的转印基板是无源基板，即，其仅包括电连接元件。能够经由转印基板的电连接元件来供电和控制装置的基本芯片的显示装置的有源控制电路例如连接至在转印基板的外围处的转印基板的电连接元件。
在所示的示例中，转印基板的制造包括以下三个印刷连续步骤。
在第一印刷步骤期间，在支撑板1010的上表面上印刷与显示装置的行的方向基本平行的多个导电迹线。更特别地，在本示例中，在第一印刷步骤中，对于显示装置的每一行，印刷了基本上沿着显示装置的行的整个长度延伸的两个导电迹线L1和L2。迹线L1用于传递装置的不同像素或宏像素行的控制信号Vsel。轨线L2用于分配装置的低电源电位Vn。在第一印刷步骤期间印刷的导电元件限定了转印基板的第一导电层M1。
在第二印刷步骤期间，导电迹线L1和L2的某些部分被绝缘材料1012覆盖，以允许随后印刷延伸到迹线L1和L2上方的导电迹线，而不会引起与迹线L1和L2的短路。
在第三印刷步骤期间，在支撑板1010的上表面上印刷与显示装置的列的方向基本平行的多个导电迹线。更特别地，在本示例中，在第三印刷步骤中，对于显示装置的每一列，印刷基本上沿着显示装置的列的整个高度延伸的两个导电迹线C1和C2。迹线C1用于传递信号Vdata，其用于控制装置的不同像素或宏像素列。迹线C2用于分配装置的高电源电位Vp。导电迹线C1和C2通过在先前步骤中形成的绝缘区域1012与导电迹线L1和L2绝缘。在第三印刷步骤中，对于装置的每个像素或宏像素，进一步印刷分别用于接收包括像素和宏像素的芯片的连接端子Vsel、Vp、Vn和Vdata的四个导电迹线P1、P2、P3和P4。区域P1连接到与包含像素或宏像素的行相关联的导电迹线L1。为此，区域P1在未覆盖绝缘材料1012的迹线L1的区域中在迹线L1的上表面的顶部延伸并与迹线L1的上表面接触。区域P2连接到与包含像素或宏像素的列相关联的导电迹线C2。为此，区域P2与导电轨迹C2相邻。区域P3连接到与包含像素或宏像素的行相关联的导电迹线L2。为此，区域P3在未覆盖绝缘材料1012的迹线L2的区域中在迹线L2的上表面的顶部延伸并与迹线L2的上表面接触。区域P4连接到与包含像素或宏像素的列相关联的导电迹线C1。为此，区域P4与导电轨迹C1相邻接。在第三步骤期间印刷的导电迹线和区域限定了转印基板的第二导电层M2。在第三印刷步骤期间，可以在第二导电层M2中进一步印刷用于芯片转印的对准图案。
关于图10描述的转印基板的优点在于，在相同印刷步骤期间，到显示装置的基本芯片的转印基板的所有导电连接区域(区域P1、P2、P3和P4)形成在相同导电层上。结果，与装置的同一像素或宏像素相关联的区域P1、P2、P3和P4可以形成为彼此非常接近，例如，两个两个相距小于20μm，优选地两个两个相距小于10μm，优选地两乘以小于5μm，如果导电区域P1和P3在第一印刷步骤期间形成并且如果导电区域P2和P4在第三印刷步骤期间形成，则这很难或甚至不可能获得。实际上，在相同印刷步骤中，导电图案的印刷分辨率相对较高，而在不同的印刷步骤期间形成的导电图案之间可能存在相对于显著的未对准。
因此，图10的实施例使得在到基本芯片的基板的连接区域中被区域P1、P2、P3、P4占据的导电表面能够最大，这使得能够简化尤其是通过放松芯片相对于转印基板的对准约束将基本芯片组装在转印基板上的后续步骤。
应当注意，关于图10描述的转印基板不仅可以用在关于图3至图8描述的类型的显示装置(其中装置的每个基本芯片包括多个可单独设置的LED)中，也可以用在关于图1描述的类型的显示装置(其中装置的每个基本芯片包括单个LED)中。
此外，尽管仅有显示装置的每个电子芯片包括到外部的四个连接端子的实施例，但是关于图10描述的转印基板可以适用于其中每个基本芯片包括到外部的不同于四个的多个连接端子的显示装置。因此，根据图10的实施例的更一般的定义，提供了通过在至少两个连续的导电层上印刷来形成转印基板的电连接元件，并且在最后的印刷导电层中形成到显示装置的基本芯片的转印基板的所有导电连接区域，可以理解的是，对于每个基本芯片，到芯片的转印基板的导电连接区域的数量大于或等于2，并且优选地大于或等于3。
已经描述了特定实施例。本领域技术人员将想到各种改变、修改和改进。特别地，所描述的实施例不限于在本说明书中作为示例提及的材料和/或尺寸的示例。

Claims (6)

1.一种发光显示装置，包括：
转印基板(1010)，其包括电连接元件(L1，L2，C1，C2，P1，P2，P3，P4)；以及
多个半导体芯片(310，510，610)，其固定到基板并连接到所述基板的所述电连接元件以对其进行控制，每个芯片包括：
-多个LED(120；120r，120g，120b)；
-到所述基板的第一连接端子(Vdata)，其用于为所述芯片的每个LED接收用于设置LED的单独的信号(Vdatar，Vdatag，Vdatab)，用于设置所述芯片的不同LED的单独的信号在第一端子(Vdata)上在时间上复用；以及
-控制电路，其能够对在所述第一端子上接收的信号进行解复用并且能够将偏置信号施加到所述芯片的每个LED，所述偏置信号是在所述第一端子(Vdata)上接收的单独的LED设置信号的函数，
其中，在每个基本芯片(610)中，在所述芯片的所述第一端子(Vdata)上在时间上复用的单独的设置信号是数字信号；并且
其中，每个芯片还包括到所述基板的第二连接端子(Vsel)，其用于接收叠加到同步信号(SYNC)上的时钟信号(CLK)，所述时钟信号和所述同步信号被所述控制电路用来对在所述第一端子(Vdata)上接收的信号的解复用进行同步。
2.根据权利要求1所述的装置，其中每个基本芯片(510，610)包括多个像素(P1，…Pn)，每个像素包括多个子像素(SPr，SPg，SPb)，每个子像素包括单个LED，并且同一像素的不同子像素的LED被设置为在不同的波长范围内发射。
3.根据权利要求1所述的装置，其中每个基本芯片包括多个像素(P1，…Pn)，每个像素包括单个LED，不同像素的LED被设置为在相同波长范围内发射。
4.根据权利要求1所述的装置，其中每个基本芯片(310)包括单个像素，所述单个像素包括多个子像素(SPr，SPg，SPb)，每个子像素包括单个LED，所述像素的不同子像素的LED被设置为在不同的波长范围内发射。
5.根据权利要求1至4中任一项所述的装置，其中，在每个基本芯片(610)中，芯片控制电路(620)包括用于所述芯片的每个LED的特定的数模转换器。
6.根据权利要求1至4中任一项所述的装置，其中，在所述装置的每个基本芯片(310，510，610)中，所述芯片的LED形成在基于III-V半导体的第一基板(901)中，并且其中所述芯片控制电路形成在基于硅的第二基板(903)中，所述第二基板与所述第一基板相邻并电连接到所述第一基板。
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