CN110599969B - 显示装置 - Google Patents

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Abstract

本发明涉及电源电路和显示装置。电源电路具备：升压电路，其将所提供的第1电源电压升压到在显示装置的驱动电路中使用的第2电源电压；电容器，其设置在用于输出第2电源电压的电源配线与接地之间；逻辑电路，其在第1电源电压和所提供的第1控制信号为高电平时，输出高电平的信号；延迟电路，其将使逻辑电路的输出信号延迟而得到的信号作为用于驱动电路的动作控制的第2控制信号输出；以及电阻，其设置在延迟电路的输入端子与接地之间。电源电路也可以在电源配线上具备第1二极管，还可以具备第2二极管，第2二极管的阳极端子连接到第2控制信号的输出端子，阴极端子连接到延迟电路的输入端子。

Description

显示装置
技术领域
本发明涉及显示装置，特别涉及显示装置的电源电路。
背景技术
近年来，使用IGZO(Indium Gallium Zinc Oxide：铟-镓-锌氧化物)等氧化物半导体形成包含于液晶面板等的薄膜晶体管的技术已被实际应用。使用了IGZO的液晶面板(以下称为IGZO液晶面板) 具有高的电荷保持能力。因此，根据具有IGZO液晶面板的液晶显示装置，能够在持续显示同一画面时减少画面的更新，降低功耗。
在具有IGZO液晶面板的液晶显示装置中，在电源断开时，需要抽出液晶面板中保持的电荷。更详细地，在停止液晶面板的驱动之后，需要抽出蓄积在像素、扫描线驱动电路中的电荷。以下将该操作称为“放电”。当进行放电时，使用的是用于扫描线的驱动的高电压(例如，+21～-7V)。
关于液晶显示装置的电源电路，以往已知各种电路。例如，在日本特开2013-97071号公报中记载了图10所示的电源电路。图10所示的电源电路90具备模拟电源91、输出比模拟电源91低的电压的数字电源92、降压电路93、第1开关部94以及第2开关部95。第2开关部95 在输入电压或者数字电源92的输出电压变为规定以下时断开。第1开关部94在第2开关部95断开时接通。
在具有IGZO液晶面板的液晶显示装置中，在电源断开时，以控制信号的下降为触发而生成高电压，使用高电压进行放电。但是，在车载用的液晶显示装置中，由于从控制信号的下降到电源电压的下降为止的时间较短，因此有时不能正确地进行放电。
例如，存在与车载用电池的连接断开而突然丧失电源的情况。在这种情况下，控制信号和电源电压基本上在相同的时期开始降低，因此，在进行放电时，电源电压已经变低。因此，无法生成用于放电的高电压，无法从像素、扫描线驱动电路中充分地抽出电荷。在控制信号下降之前电源电压已降低的情况和在控制信号下降之前电源电压已达到接地电平的情况也成为同样的状况。因此，在具有IGZO 液晶面板的车载用的液晶显示装置中，有时会产生由于放电不足而导致的显示异常(残影等)。
发明内容
因此，作为技术问题提出的是，提供在电源断开时能可靠地进行放电的显示装置的电源电路。
(1)本发明的若干实施方式的电源电路具备：
升压电路，其将所提供的第1电源电压升压到在显示装置的驱动电路中使用的第2电源电压；
电容器，其设置在用于输出上述第2电源电压的电源配线与接地之间；
逻辑电路，其在上述第1电源电压和所提供的第1控制信号为高电平时，输出高电平的信号；
延迟电路，其将使上述逻辑电路的输出信号延迟而得到的信号作为用于上述驱动电路的动作控制的第2控制信号输出；以及
电阻，其设置在上述延迟电路的输入端子与接地之间。
根据这种电源电路，当在电源断开时第1控制信号的电平发生了降低的情况下，由于电阻的作用，延迟电路的输入端子的电压短时间降低，第2控制信号在短时间内变为接地电平。另外，在电源断开时第1电源电压降低之后，第2电源电压由于电容器的作用而在一段时间内得以保持，因此，能够在此期间生成放电脉冲而进行放电。另外，第2控制信号上升为高电平是在第2电源电压达到规定的电平之后。因此，能够在电源接通时正确地生成控制信号，在电源断开时可靠地进行放电。
(2)本发明的若干实施方式的电源电路具有上述(1)的构成，在上述电源配线上还具备第1二极管。
(3)本发明的若干实施方式的电源电路具有上述(1)或者(2) 的构成，
还具备第2二极管，上述第2二极管的阳极端子连接到上述第2控制信号的输出端子，阴极端子连接到上述延迟电路的输入端子。
(4)本发明的若干实施方式的电源电路具有上述(1)～(3) 中的任意一个构成，
在上述延迟电路的后级还具备复位IC。
(5)本发明的若干实施方式的电源电路具有上述(1)～(4) 中的任意一个构成，
上述逻辑电路包含开关，上述开关的一个端子被提供上述第1电源电压和上述第1控制信号中的一方，另一个端子连接到上述延迟电路的输入端子，控制端子被提供上述第1电源电压和上述第1控制信号中的另一方。
(6)本发明的若干实施方式的电源电路具有上述(5)的构成，
上述开关是双极晶体管，上述双极晶体管的一个导通端子被提供上述第1电源电压和上述第1控制信号中的一方，另一个导通端子连接到上述延迟电路的输入端子，控制端子被提供上述第1电源电压和上述第1控制信号中的另一方。
(7)本发明的若干实施方式的电源电路具有上述(5)的构成，
上述开关是MOS晶体管，上述MOS晶体管的一个导通端子被提供上述第1电源电压和上述第1控制信号中的一方，另一个导通端子连接到上述延迟电路的输入端子，控制端子被提供上述第1电源电压和上述第1控制信号中的另一方。
(8)本发明的若干实施方式的电源电路具有上述(1)～(4) 中的任意一个构成，
上述逻辑电路包含AND电路，上述AND电路求出上述第1电源电压与上述第1控制信号的逻辑积并将其提供到上述延迟电路的输入端子。
(9)本发明的若干实施方式的电源电路具有上述(1)～(4) 中的任意一个构成，
上述逻辑电路包含：
AND电路，其求出上述第1电源电压与上述第1控制信号的逻辑积；以及
开关，其一个端子被提供上述第1电源电压和上述第1控制信号中的任意一方，另一个端子连接到上述延迟电路的输入端子，控制端子被提供上述逻辑积。
(10)本发明的若干实施方式的电源电路具有上述(1)～(4) 中的任意一个构成，
上述延迟电路包含：
电阻，其设置在将输入端子与输出端子相连的信号配线上；以及
电容器，其设置在上述信号配线与接地之间。
(11)本发明的若干实施方式的电源电路具有上述(1)～(4) 中的任意一个构成，
上述延迟电路包含使输入信号延迟输出的复位IC。
(12)本发明的若干实施方式的显示装置具备：
显示面板，其包含多个扫描线和多个像素；
扫描线驱动电路，其驱动上述扫描线；
具有上述(1)～(11)中的任意一个构成的电源电路；以及
信号生成电路，其在上述第2控制信号表示动作停止时，基于上述第2电源电压对上述扫描线驱动电路输出具有放电脉冲的放电信号。
(13)本发明的若干实施方式的显示装置具有上述(12)的构成，
上述显示面板是液晶面板。
(14)本发明的若干实施方式的显示装置具有上述(13)的构成，
上述液晶面板中包含的薄膜晶体管使用氧化物半导体形成。
(15)本发明的若干实施方式的显示装置具有上述(14)的构成，
上述氧化物半导体是铟镓锌氧化物。
本发明的上述内容以及其它目的、特征、方式以及效果会参照附图由以下的详细说明进一步明确。
附图说明
图1是示出实施方式的电源电路的构成的框图。
图2是示出现有的电源电路的构成的框图。
图3是示出电源电路的电源序列的信号波形图。
图4是现有的电源电路的信号波形图。
图5是图1所示的电源电路的电源接通时的信号波形图。
图6是图1所示的电源电路的电源断开时的信号波形图。
图7是是示出图1所示的电源电路的具体例的图。
图8是示出图1所示的电源电路的具体例的图。
图9是示出变形例的电源电路的逻辑电路的构成的图。
图10是示出现有的电源电路的构成的框图。
具体实施方式
图1是示出实施方式的电源电路的构成的框图。图1所示的电源电路10具备升压电路11、二极管12、16、电容器13、逻辑电路14、延迟电路15以及电阻17。
电源电路10设置于包含液晶面板1的液晶显示装置。液晶面板1 是包含使用IGZO形成的薄膜晶体管的IGZO液晶面板。在液晶面板1 的像素区域中形成有多个扫描线2、多个数据线(未图示)以及多个像素3。在像素区域的内部或者周边部形成有扫描线驱动电路4。将扫描线驱动电路4配置在像素区域的内部的液晶面板被称为IPGDM (In Pixel GateDriver Monolithic；像素内栅极驱动器单片)构成的液晶面板。在液晶面板1的外部设置有信号生成电路5。
从外部向电源电路10提供电源电压VCC和控制信号PON。电源电压VCC是包括例如3.3V和接地电平(GND)的电压的低电压系的电压。升压电路11是DC/DC转换器等，使电源电压VCC升压到在扫描线驱动电路4中使用的电源电压VGH/VGL。电源电压VGH/VGL是包括例如+21V和-7V的电压的高电压系的电压。电源电压VGH/VGL 经由二极管12被供应到信号生成电路5。逻辑电路14在电源电压VCC 和控制信号PON为高电平时，输出高电平的信号。逻辑电路14的输出信号输入到延迟电路15。延迟电路15将使逻辑电路14的输出信号延迟规定的时间(以下称为Td)而得到的信号作为控制信号RESET 输出。控制信号RESET供应到信号生成电路5，用于扫描线驱动电路 4的动作控制。
信号生成电路5基于电源电压VGH/VGL和控制信号RESET，生成针对扫描线驱动电路4的控制信号。在信号生成电路5所生成的控制信号中包含起始脉冲、时钟信号以及放电信号DIS等。控制信号 RESET表示信号生成电路5的动作开始和动作停止。当控制信号RESET表示动作停止时，信号生成电路5对扫描线驱动电路4输出具有放电脉冲的放电信号DIS。
连接升压电路11与信号生成电路5的电源配线W1是用于输出电源电压VGH/VGL的电源配线。在电源配线W1上设置有二极管12。二极管12的阳极端子连接到升压电路11的输出端子，二极管12的阴极端子连接到电源电路10的输出端子。二极管12在电源断开时使电源电路10的输出电压晚于升压电路11的输出电压发生变化。在电源配线W1与接地(Ground)之间设置有电容器13。电容器13使用具有大的静电电容的电容器。电容器13保持电源电压VGH/VGL。
逻辑电路14包含开关18。开关18的一个端子(在图1中为上侧的端子)被提供电源电压VCC。开关18的另一个端子连接到延迟电路 15的输入端子。开关18的控制端子被提供控制信号PON。开关18在控制信号PON为高电平时接通，在除此以外的时间断开。控制信号PON为高电平时，电源电压VCC经由开关18输入到延迟电路15。这样，逻辑电路14在电源电压VCC和控制信号PON为高电平时，输出高电平的信号。
延迟电路15将使逻辑电路14的输出信号延迟时间Td而得到的信号作为控制信号RESET输出。二极管16连接到延迟电路15的两端。更详细地，二极管16的阳极端子连接到延迟电路15的输出端子，二极管16的阴极端子连接到延迟电路15的输入端子。二极管16使不经由延迟电路15的电流从延迟电路15的输出端子流向输入端子。在延迟电路15的输入端子与接地之间设置有电阻17。电阻17在控制信号 PON的电压发生了降低时，使延迟电路15的输入端子的电压在短时间内降低。
如果从电源电路10中除去二极管12、16、电容器13、逻辑电路 14、延迟电路15以及电阻17，将从外部供应的控制信号RESET原样供应到信号生成电路5，则会得到图2所示的电源电路90。现有的一般的电源电路具有如图2所示的构成。本实施方式的电源电路10在现有的电源电路90中追加了二极管12、16、电容器13、逻辑电路14、延迟电路15以及电阻17。
图3是示出电源电路10、90的电源序列的信号波形图。在图3中记载了电源电压VCC和控制信号RESET应遵守的电源序列。在电源接通时，首先电源电压VCC上升为高电平(例如，3.3V)。这以后，升压电路11将电源电压VCC升压到电源电压VGH/VGL。电源电压 VGH/VGL达到规定电平(例如，+21V和-7V)之后，控制信号RESET 上升为高电平。从电源电压VCC的上升到控制信号RESET的上升为止的期间是用于生成电源电压VGH/VGL的准备期间。信号生成电路5 在控制信号RESET上升后，基于电源电压VGH/VGL对扫描线驱动电路4输出控制信号。电源接通后，放电信号DIS的电压变为电源电压 VGL(此处为-7V)。
在电源断开时，首先控制信号RESET下降到低电平(接地电平)。当信号生成电路5检测出控制信号RESET的下降时，停止放电信号 DIS以外的控制信号的输出，输出具有放电脉冲的放电信号DIS。此时，放电信号DIS的电压仅在规定时间Tp为电源电压VGH(此处为 +21V)。放电脉冲是为了从包含于液晶面板1的像素3和扫描线驱动电路4中抽出电荷而使用的。在进行了放电之后，升压电路11停止动作，电源电压VGH/VGL变为接地电平。之后，电源电压VCC下降到接地电平。
在图3所示的电源序列中，为了在电源断开时正确地进行放电，需要使控制信号RESET在短时间内下降以及需要在控制信号RESET 下降后直到放电结束为止保持电源电压VGH/VGL。
但是，在车载用的液晶显示装置中，有时由于发动机的动作、负载的突然变动等而无法稳定地对电源电路供应电压。因此，在电源断开时，无法遵守图3所示的电源序列，有时电源电压VCC在控制信号RESET之前下降，有时两者基本上同时下降。
图4是现有的电源电路90的信号波形图。在图4中，虚线表示不存在放电脉冲。在现有的电源电路90中，在电源电压VCC在控制信号RESET之前下降的情况下(图4的(a))或者在两者基本上同时下降的情况下(图4的(b))，当进行放电时，电源电压VCC已经变低，电源电压VGH/VGL也已经变低。因此，无法输出具有放电脉冲的放电信号DIS，无法正确地进行放电。
另外，在电源接通时，需要用于生成电源电压VGH/VGL的准备期间。但是，在电源接通时，无法遵守图3所示的电源序列，有时控制信号RESET在电源电压VCC之前上升，有时两者基本上同时上升。在现有的电源电路90中，在这种情况下，不能正确地对扫描线驱动电路4输出控制信号。因此，在具备现有的电源电路90的车载用的液晶显示装置中，可能产生显示异常，在最坏的情况下，液晶面板有时会被损坏。
为了解决这些问题，本实施方式的电源电路10具备二极管12、 16、电容器13、逻辑电路14、延迟电路15以及电阻17。根据电源电路10，如以下所示，能够遵守图3所示的电源序列，在电源断开时可靠地进行放电。
图5是电源电路10的电源接通时的信号波形图。开关18在电源电压VCC和控制信号PON为高电平时接通。因此，在电源接通时控制信号RESET只限于在电源电压VCC变为高电平之后成为高电平。另外，控制信号RESET是使控制信号PON延迟时间Td后的信号。因此，即使在电源电压VCC和控制信号PON基本上同时上升的情况下，从控制信号PON的上升到控制信号RESET的上升为止也需要比时间Td 更长的时间。如果将时间Td设定为具有某种程度以上的长度，则电源电压VGH/VGL会在时间Td的期间达到规定的电平。在这种情况下，控制信号RESET上升为高电平只限于在电源电压VGH/VGL达到规定的电平之后。因此，根据电源电路10，能够在电源接通时遵守图3所示的电源序列。
图6是电源电路10的电源断开时的信号波形图。如上所述，二极管16使不经由延迟电路15的电流从延迟电路15的输出端子流向输入端子。电阻17在控制信号PON的电压发生了降低时，使延迟电路15 的输入端子的电压在短时间内降低。因此，在控制信号PON下降到低电平时，控制信号RESET在短时间内下降到低电平。另外，在用于输出电源电压VGH/VGL的电源配线W1上设置有二极管12和电容器13。因此，在电源电压VCC下降后，电源电路10的输出电压晚于升压电路11的输出电压而发生变化，从电源电路10输出的电源电压 VGH在一段时间内，被维持为包含在像素3和扫描线驱动电路4中的薄膜晶体管接通的电平(薄膜晶体管的阈值电压Vth以上的电平)。在此期间，能够通过信号生成电路5输出具有放电脉冲的放电信号 DIS，从而进行放电。
当在控制信号PON下降到接地电平之前电源电压VCC下降到接地电平的情况下，在电源电压VCC发生了下降时，逻辑电路14的输出信号下降到低电平。此时，控制信号RESET在短时间内下降到低电平。在这种情况下，在电源电压VGH维持为高电平的期间，也能够通过信号生成电路5输出具有放电脉冲的放电信号DIS，从而进行放电。因此，根据电源电路10，能够在电源断开时也遵守图3所示的电源序列。
图7和图8是示出电源电路10的具体例的电路图。在图7所示的电源电路20中，逻辑电路14包括NPN型的晶体管21和电阻22、23。晶体管21的集电极端子被提供电源电压VCC。晶体管21的发射极端子连接到延迟电路15的输入端子。晶体管21的基极端子经由电阻22被提供控制信号PON。电阻23设置在晶体管21的基极端子与集电极端子之间。晶体管21作为开关18发挥功能。延迟电路15包含电阻24和电容器25。电阻24设置在连接延迟电路15的输入端子与输出端子的信号配线上。电容器25设置在该信号配线与接地之间。延迟电路15 中的延迟时间Td由电阻24的电阻值与电容器25的静电电容的积决定。
在图8所示的电源电路30中，逻辑电路14包括N沟道型的 MOSFET31。MOSFET31的漏极端子被提供电源电压VCC。 MOSFET31的源极端子连接到延迟电路15的输入端子。MOSFET31的栅极端子被提供控制信号PON。MOSFET31作为开关18发挥功能。电源电路30在延迟电路15的后级具备复位IC32。在由电阻24和电容器 25构成延迟电路15的情况下，延迟电路15中的延迟时间Td容易产生偏差。通过设置复位IC32，即使在延迟时间Td产生偏差的情况下，也能够准确地控制控制信号PON与控制信号RESET之间的延迟时间。
关于本实施方式的电源电路10，能够构成各种变形例。例如，也可以由根据电信号而接通/断开的模拟开关来构成逻辑电路14。另外也可以是，电源电路在升压电路11的后级不具备二极管12，升压电路11中包含的二极管作为二极管12发挥功能。另外，也可以由具有使输入信号延迟输出的功能的复位IC构成延迟电路15。另外，当复位IC32具有在输入电压发生了降低时使输出电压瞬间降低的功能的情况下，图8所示的电源电路30也可以不具备二极管16。
另外，变形例的电源电路也可以代替逻辑电路14而具备图9的 (a)～(d)所示的逻辑电路41～44中的任意一个。逻辑电路41～ 44与逻辑电路14同样地，在电源电压VCC和控制信号PON为高电平时，输出高电平的信号。
图9的(a)所示的逻辑电路41包含开关18。开关18的一个端子 (在图9的(a)中为左侧的端子)被提供控制信号PON，开关18的控制端子被提供电源电压VCC。与此相对应地，在图7所示的电源电路 20中，也可以向晶体管21的集电极端子提供控制信号PON，向晶体管21的栅极端子提供电源电压VCC。在图8所示的电源电路30中，也可以向MOSFET31的漏极端子提供控制信号PON，向MOSFET31的栅极端子提供电源电压VCC。
图9的(b)所示的逻辑电路42包含AND(与)电路19。电源电压VCC输入到AND电路19的一个输入端子，控制信号PON输入到 AND电路19的另一个输入端子。AND电路19的输出端子连接到延迟电路15的输入端子。AND电路19求出电源电压VCC与控制信号PON 的逻辑积，并将其提供到延迟电路15的输入端子。
图9的(c)所示的逻辑电路43包含开关18和AND电路19。AND 电路19求出电源电压VCC与控制信号PON的逻辑积S。开关18的一个端子(在图9的(c)中为下侧的端子)被提供控制信号PON。开关18 的另一个端子连接到延迟电路15的输入端子。开关18的控制端子被提供逻辑积S。开关18在逻辑积S为高电平时接通，在除此以外的时间断开。在逻辑积S为高电平时，控制信号PON经由开关18输入到延迟电路15。
图9的(d)所示的逻辑电路44包含开关18和AND电路19。AND 电路19求出电源电压VCC与控制信号PON的逻辑积S。开关18的一个端子(在图9的(d)中为上侧的端子)被提供电源电压VCC。开关 18的另一个端子连接到延迟电路15的输入端子。开关18的控制端子被提供逻辑积S。开关18在逻辑积S为高电平时接通，在除此以外的时间断开。在逻辑积S为高电平时，电源电压VCC经由开关18输入到延迟电路15。
另外，至此说明了液晶显示装置的电源电路，但电源电路也可以设置于液晶显示装置以外的显示装置。另外，也可以将以上所述的电源电路的特征在不违反其性质的情况下任意地组合，来构成变形例的电源电路。
如以上所示，本实施方式及其变形例的电源电路具备：升压电路11，其将所提供的第1电源电压VCC升压到在显示装置(液晶显示装置)的驱动电路(扫描线驱动电路4)中使用的第2电源电压VGH/VGL；电容器13，其设置在用于输出第2电源电压的电源配线 W1与接地之间；逻辑电路，其在第1电源电压和所提供的第1控制信号(控制信号PON)为高电平时，输出高电平的信号；延迟电路15，其将使逻辑电路的输出信号延迟而得到的信号作为用于驱动电路的动作控制的第2控制信号(控制信号RESET)输出；以及电阻17，其设置在延迟电路15的输入端子与接地之间。
根据这种电源电路，当在电源断开时第1控制信号的电平发生了降低的情况下，由于电阻的作用，延迟电路的输入端子的电压短时间降低，第2控制信号在短时间内变为接地电平。另外，在电源断开时第1电源电压降低之后，第2电源电压由于电容器的作用而在一段时间内得以保持，因此，能够在此期间生成放电脉冲而进行放电。另外，第2控制信号上升为高电平是在第2电源电压达到规定的电平之后。因此，能够在电源接通时正确地生成控制信号，在电源断开时可靠地进行放电。
电源电路也可以在电源配线W1上具备第1二极管(二极管12)。从而，在电源断开时能够使电源电路的输出电压晚于升压电路11的输出电压发生变化。另外，电源电路也可以具备第2二极管(二极管 16)，上述第2二极管的阳极端子连接到第2控制信号的输出端子，阴极端子连接到延迟电路15的输入端子。从而，当第1控制信号的电平在电源断开时发生了降低的情况下，电流流到第2二极管，延迟电路 15的输入端子的电压短时间降低，第2控制信号在短时间内变为接地电平。另外，电源电路30也可以在延迟电路15的后级具备复位IC32。从而，即使在延迟电路15中的延迟时间Td产生偏差的情况下，也能够准确地控制第1控制信号与第2控制信号之间的延迟时间。
逻辑电路14、41也可以包含开关18，上述开关18的一个端子被提供第1电源电压和第1控制信号中的一方，另一个端子连接到延迟电路15的输入端子，控制端子被提供第1电源电压和第1控制信号中的另一方。开关18也可以是双极晶体管(晶体管21)，上述双极晶体管的一个导通端子(发射极端子)被提供第1电源电压，另一个导通端子(集电极端子)连接到延迟电路15的输入端子，控制端子(栅极端子)被提供第1控制信号(图7)。开关18还可以是MOS晶体管 (MOSFET31)，上述MOS晶体管的一个导通端子(漏极端子)被提供第1电源电压，另一个导通端子(源极端子)连接到延迟电路15的输入端子，控制端子(栅极端子)被提供第1控制信号(图8)。逻辑电路42也可以包含求出第1电源电压与第1控制信号的逻辑积的AND 电路19。逻辑电路43、44还可以包含AND电路19和开关18，上述AND 电路19求出第1控制信号与第1电源电压的逻辑积，上述开关18的一个端子被提供第1控制信号和第1电源电压中的任意一方，另一个端子连接到延迟电路15的输入端子，控制端子被提供逻辑积。延迟电路15也可以包含设置在将连接输入端子与输出端子相连的信号配线上的电阻24和设置在信号配线与接地之间的电容器25。延迟电路15 还可以包含使输入信号延迟输出的复位IC。
本实施方式的显示装置(液晶显示装置)具备：显示面板(液晶面板1)，其包含多个扫描线2和多个像素3；扫描线驱动电路4，其驱动扫描线2；上述的电源电路；以及信号生成电路5，其在第2控制信号表示动作停止时，基于第2电源电压输出具有放电脉冲的放电信号DIS。液晶面板1中包含的薄膜晶体管也可以使用氧化物半导体形成，氧化物半导体也可以是铟镓锌氧化物。关于这些显示装置，能够在电源断开时可靠地进行放电，防止显示不良。
以上虽然详细地说明了本发明，但以上的说明在所有方面只是例示，而不是限制性的内容。能理解的是，在不脱离本发明的范围的情况下，能想出许多的其它变更、变形。

Claims (12)

1.一种显示装置，其特征在于，具备：
显示面板，其包含多个扫描线和多个像素；
扫描线驱动电路，其驱动上述扫描线；
电源电路；以及
信号生成电路，
上述电源电路具备：
升压电路，其将所提供的第1电源电压升压到在上述扫描线驱动电路中使用的第2电源电压；
电容器，其设置在用于输出上述第2电源电压的电源配线与接地之间；
第1二极管，其设置于上述电源配线中的从上述升压电路到上述电容器与上述电源配线的接触点为止的配线上；
逻辑电路，其在上述第1电源电压和所提供的第1控制信号为高电平时，输出高电平的信号；
延迟电路，其将使上述逻辑电路的输出信号延迟而得到的信号作为用于上述扫描线驱动电路的动作控制的第2控制信号输出；
电阻，其设置在上述延迟电路的输入端子与接地之间；以及
第2二极管，其阳极端子连接到上述第2控制信号的输出端子，阴极端子连接到上述延迟电路的输入端子，
当上述第2控制信号下降时，上述信号生成电路基于上述第2电源电压向上述扫描线驱动电路输出具有放电脉冲的放电信号。
2.根据权利要求1所述的显示装置，
上述电源电路在上述延迟电路的后级还具备复位IC。
3.根据权利要求1所述的显示装置，其特征在于，
上述逻辑电路包含开关，上述开关的一个端子被提供上述第1电源电压和上述第1控制信号中的一方，另一个端子连接到上述延迟电路的输入端子，控制端子被提供上述第1电源电压和上述第1控制信号中的另一方。
4.根据权利要求3所述的显示装置，其特征在于，
上述开关是双极晶体管，上述双极晶体管的一个导通端子被提供上述第1电源电压和上述第1控制信号中的一方，另一个导通端子连接到上述延迟电路的输入端子，控制端子被提供上述第1电源电压和上述第1控制信号中的另一方。
5.根据权利要求3所述的显示装置，其特征在于，
上述开关是MOS晶体管，上述MOS晶体管的一个导通端子被提供上述第1电源电压和上述第1控制信号中的一方，另一个导通端子连接到上述延迟电路的输入端子，控制端子被提供上述第1电源电压和上述第1控制信号中的另一方。
6.根据权利要求1所述的显示装置，其特征在于，
上述逻辑电路包含AND电路，上述AND电路求出上述第1电源电压与上述第1控制信号的逻辑积并将其提供到上述延迟电路的输入端子。
7.根据权利要求1所述的显示装置，其特征在于，
上述逻辑电路包含：
AND电路，其求出上述第1电源电压与上述第1控制信号的逻辑积；以及
开关，其一个端子被提供上述第1电源电压和上述第1控制信号中的任意一方，另一个端子连接到上述延迟电路的输入端子，控制端子被提供上述逻辑积。
8.根据权利要求1所述的显示装置，其特征在于，
上述延迟电路包含：
电阻，其设置在将输入端子与输出端子相连的信号配线上；以及
电容器，其设置在上述信号配线与接地之间。
9.根据权利要求1所述的显示装置，其特征在于，
上述延迟电路包含使输入信号延迟输出的复位IC。
10.根据权利要求1所述的显示装置，其特征在于，
上述显示面板是液晶面板。
11.根据权利要求10所述的显示装置，其特征在于，
上述液晶面板中包含的薄膜晶体管使用氧化物半导体形成。
12.根据权利要求11所述的显示装置，其特征在于，
上述氧化物半导体是铟镓锌氧化物。
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