CN110581966A - 具有镜像对称像素列的图像传感器 - Google Patents
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Abstract
本公开提供一种图像传感器。所述图像传感器包含：第一像素列，其包含：第一像素单元；第二像素单元，其垂直地邻接于所述第一像素单元；第一列位线，其耦合到所述第一像素单元，其中由所述第一像素单元获取的图像数据通过所述第一列位线读出；及第二列位线，其耦合到所述第二像素单元，其中由所述第二像素单元获取的图像数据通过所述第二列位线读出；及第二像素列，其水平地邻接于所述第一像素列，其中所述第一像素列及所述第二像素列关于所述像素单元与所述列位线之间的连接镜像对称。
Description
技术领域
本公开大体上涉及图像传感器，且尤其(但非排它地)涉及具有关于像素单元与列位线之间的连接镜像对称的像素列的图像传感器。
背景技术
当今，有源像素图像传感器通常构建在p型或n型硅衬底上。有源像素传感器为具有例如放大器的有源电路元件的传感器，所述有源电路元件在每一像素中或与每一像素相关联。互补金属氧化硅(complementary metal oxide silicon；CMOS)晶体管为其中由相反掺杂剂(一个p型且一个n型)构成的两个晶体管以互补方式布线在一起的晶体管。
一些CMOS图像传感器具有每列多个位线以便同时输出多个信号。这类布置遭受由多个位线之间的电容耦合造成的像素间串扰。此前，每列的位线的数目并不多，因此位线之间的空间相对较大且耦合效应可忽略。但目前，一些CMOS图像传感器具有更多位线，导致更严重电容耦合效应及像素间串扰。因此，在所属领域内需要提供具有减少的串扰同时维持现有CMOS图像传感器的全部当前优势及发展水平的CMOS图像传感器。
发明内容
根据本公开的一方面，公开一种成像传感器。所述图像传感器包含：第一像素单元；第二像素单元，其垂直地邻接于所述第一像素单元；第三像素单元，其水平地邻接于所述第二像素单元；第四像素单元，其水平地邻接于所述第一像素单元且垂直地邻接于所述第三像素单元，其中所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元经布置成像素单元的2×2阵列；第一列位线，其耦合到所述第一像素单元，其中由所述第一像素单元获取的图像数据通过所述第一列位线读出；第二列位线，其耦合到所述第二像素单元，其中由所述第二像素单元获取的图像数据通过所述第二列位线读出；第三列位线，其耦合到所述第三像素单元，其中由所述第三像素单元获取的图像数据通过所述第三列位线读出，且其中所述第二列位线在所述第一列位线与所述第三列位线之间；及第四列位线，其耦合到所述第四像素单元，其中由所述第四像素单元获取的图像数据通过所述第四列位线读出，且其中所述第三列位线在所述第二列位线与所述第四列位线之间。
根据本公开的另一方面，公开一种成像传感器。所述图像传感器包含：第一像素列，其包含：第一像素单元；第二像素单元，其垂直地邻接于所述第一像素单元；第一列位线，其耦合到所述第一像素单元，其中由所述第一像素单元获取的图像数据通过所述第一列位线读出；第二列位线，其耦合到所述第二像素单元，其中由所述第二像素单元获取的图像数据通过所述第二列位线读出；及第二像素列，其水平地邻接于所述第一像素列，其中所述第一像素列及所述第二像素列关于所述像素单元与所述列位线之间的连接镜像对称。
根据本公开的另一方面，第一像素列包含：第一像素单元、第二像素单元、第三像素单元及第四像素单元，其以此次序布置：所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元；第一列位线，其耦合到所述第一像素单元及所述第二像素单元，其中由所述第一像素单元获取的图像数据或由所述第二像素单元获取的图像数据通过所述第一列位线选择性地读出；第二列位线，其耦合到所述第三像素单元及所述第四像素单元，其中由所述第三像素单元获取的图像数据或由所述第四像素单元获取的图像数据通过所述第二列位线选择性地读出；及第二像素列，其水平地邻接于所述第一像素列，其中所述第一像素列及所述第二像素列关于所述像素单元与所述列位线之间的连接镜像对称。
附图说明
图1为展示根据本公开的一些实施例的图像传感器的框图。
图2为展示根据本公开的一些实施例的位线的像素阵列及相关联配置的框图。
图3为展示根据本公开的一些实施例的图2的像素阵列的细节的框图。
图4为展示根据本公开的一些实施例的位线的像素阵列及相关联配置的框图。
图5为展示根据本公开的一些实施例的图4的像素阵列的细节的框图。
贯穿图式及实施方式使用共同参考编号以指示相同或相似组件。结合随附图式，从以下实施方式，可最好地理解本公开。
具体实施方式
以下公开内容提供用于实施本公开的不同特征的许多不同实施例或实例。下文描述组件及布置的特定实例以简化本公开。当然，这些组件及布置仅为实例且不打算为限制性的。举例来说，在以下描述中，第一特征在第二特征上方或上的形成可包含第一特征及第二特征直接接触地形成的实施例，且还可包含额外特征可在第一特征与第二特征之间形成，使得第一特征及第二特征可不直接接触的实施例。另外，本公开可在各种实例中重复参考标号及/或字母。此重复是出于简单性以及清晰性的目的，且本身并不指示所论述各种实施例及/或配置之间的关系。
此外，为了易于描述，空间相对术语，例如“下方”、“在...下方”、“低于”、“高于”、“在...上方”等等在本文中可用于描述如图式中所说明的一个元件或特征与另一元件或特征的关系。除图式中所描绘的定向以外，空间相对术语打算涵盖装置在使用或操作中的不同定向。设备可以其它方式定向(旋转90度或处于其它定向)且本文中所使用的空间相对描述词可同样相应地进行解译。
尽管阐述本公开的广泛范围的数值范围及参数为近似值，但应尽可能精确地报导特定实例中所阐述的数值。然而，任何数值均固有地含有由相应测试测量值中发现的标准差必然引起的某些误差。另外，如本文所使用，术语“约”通常意指给定值或范围的10％、5％、1％或0.5％以内。替代地，当由所属领域的一般技术人员考虑时，术语“约”可意指在平均值的可接受标准误差内。除在操作/实施例中以外，或除非以其它方式明确指定，否则数值范围、量、值及百分比(例如，本文中所公开的材料数量、持续时间、温度、操作条件、量的比率等的那些)中的所有应理解为在所有情况下由术语“约”修饰。因此，除非有相反指示，否则本公开及附加权利要求书中所阐述的数值参数为可按需要变化的近似值。至少，应根据所报导的有效数字的数字且通过应用一般舍入技术理解各数值参数。范围可在本文中表达为从一个端点到另一端点或在两个端点之间。除非另外指定，否则本文中所公开的所有范围包含端点。
图1为展示根据本公开的一些实施例的图像传感器100的框图。图像传感器100包含有源区域(即，像素阵列105)、读出电路110、功能逻辑115，及控制电路120。作为一非限制性实例，像素阵列105可为背侧或前侧照明成像像素或像素单元(例如，像素单元P1到Pn)的二维阵列。在一个实施例中，像素阵列105的每一像素单元为有源像素传感器(“APS”)，例如CMOS成像像素。如所说明，像素阵列105的每一像素单元经布置成行(例如，行R1到Ry)及列(例如，列C1到Cx)以获取人员、地点或对象的图像数据，像素单元接着可用于显现人员、地点或对象的图像。
在像素阵列105的每一像素单元已获取其图像数据或图像电荷，所述图像数据通过位线由读出电路110读出且传送到功能逻辑115。读出电路110可包含放大电路、模拟/数字转换电路，或其它。功能逻辑115可仅存储图像数据或甚到通过应用后图像处理方法(例如，裁剪、旋转、去除红眼、调节亮度、调节对比度等)来操纵图像数据。在一个实施例中，读出电路110可沿读出列线(所说明)一次读出一或多行图像数据或可使用各种其它技术(未说明)读出图像数据，例如串行读出或所有像素单元同时全部并行读出。
控制电路120耦合到像素阵列105以控制像素阵列105的操作特性。作为一非限制性实例，控制电路120可产生快门信号以用于控制图像获取。
图2为展示根据本公开的一些实施例的位线的像素阵列105及相关联配置的框图。如图2中所示，像素阵列105包含沿X轴及Y轴在整个像素阵列105中延伸的多个像素子阵列201。换句话说，像素子阵列201为用以构造像素阵列105的重复单元。像素阵列中的像素子阵列201的数目取决于像素阵列105的大小且并非对本公开的限制。
像素子阵列201中的每一者包含多个成像像素或像素单元。根据本公开的一示范性实施例，像素子阵列201中的每一者包含关于其中的像素单元与列位线BL1到BL8之间的连接、关于两列像素单元之间的接口镜像对称的两列像素单元。两列像素单元可水平且直接地彼此邻接而无需由其它像素单元分隔开。作为一非限制性实例，像素单元的每一列包含4行，即，4个像素单元。像素单元的左侧列包含如图2中所说明从上到下依序且垂直地布置的像素单元P11、P12、P13及P14。像素单元的右侧列包含如图2中所说明从上到下依序且垂直地布置的像素单元P21、P22、P23及P24。由像素子阵列201中的每一者的4行获取的图像数据通过位线BL1到BL8同时读出。
此外，像素单元P11、P12、P13、P14、P24、P23、P22及P21经布置成像素单元的4×2阵列。位线BL1到BL8分别耦合到像素单元P11、P12、P13、P14、P24、P23、P22及P21以使得由像素单元P11、P12、P13、P14、P24、P23、P22及P21获取的图像数据分别通过位线BL1到BL8读出。位线BL1到BL8如图2中所示从左到右依序布置。如上文所提及，两列像素单元关于其中的像素单元与列位线BL1到BL8之间的连接镜像对称。具体地说，像素单元P11、P12、P22及P21可共同视为关于其中的像素单元与列位线BL1、BL2、BL7及BL8之间的连接镜像对称的像素单元的2×2阵列；像素单元P12、P13、P23及P22可共同视为关于其中的像素单元与列位线BL2、BL3、BL6及BL7之间的连接镜像对称的像素单元的2×2阵列；像素单元P13、P14、P24及P23可共同视为关于其中的像素单元与列位线BL3、BL4、BL5及BL6之间的连接镜像对称的像素单元的2×2阵列。
像素间串扰由列位线之间的电容耦合造成。列位线的数目及密度可由于例如像素级混合接合的先进工艺增加。然而，串扰问题变得越来越严重。通常，彼此更接近的像素单元的值在图像内类似。换句话说，像素单元越接近彼此，像素单元的值将越不大可能突然改变。镜像对称布置防止彼此直接邻接的列位线耦合到彼此并不直接邻接的像素单元。以此方式，在一般情况下像素间串扰可减轻，这是因为彼此直接邻接的像素单元的值通常极类似于彼此。如图2中所说明，水平地耦合到列位线且彼此直接邻接的像素单元也垂直地或水平地彼此直接邻接。
每个像素子阵列201的像素单元的数目不限于8(即，4×2)。随着混合接合堆叠技术发展，更多模拟到数字转换器(ADC)被允许放置在像素阵列下，且每个像素列的位线的数目增加，例如，针对小像素单元为8或16个，且针对较大像素单元为32个或更多。镜像对称布置可应用于具有不同大小及不同数目个列位线的像素子阵列。
像素阵列105可为单色或彩色。图3为展示根据本公开的一些实施例的图2的像素阵列105的细节的框图。如图3中所示，像素单元P11、P12、P13、P14、P21、P22、P23及P24中的每一者可为具有对应于不同颜色的光电二极管的共享像素。具体地说，共享像素可为具有根据拜耳(Bayer)彩色滤光器阵列(color filter array；CFA)图案布置的四个光电二极管的四元共享(以2×2为基础的)像素。当操作时，像素单元P11、P12、P13、P14、P21、P22、P23及P24经配置以使得其中的四个光电二极管中的一者同时读出。举例来说，像素单元P11、P12、P13、P14、P21、P22、P23及P24的左上方绿色(G)像素首先通过位线BL1到BL8同时读出，且接着右上方红色(R)像素通过位线BL1到BL8同时读出。此后，左下方蓝色(B)像素通过位线BL1到BL8同时读出，且接着右下方绿色(G)像素通过位线BL1到BL8同时读出。
应了解，在如图3中所示的像素阵列105中使用的特定CFA图案及像素共享布置仅为示范性的，且可使用大量其它类型的CFA图案及共享布置。
图4为展示根据本公开的一些实施例的位线的像素阵列105及相关联配置的框图。如图4中所示，像素阵列105包含沿X轴及Y轴在整个像素阵列105中延伸的多个像素子阵列401。换句话说，像素子阵列401为用以构造像素阵列105的重复单元。像素阵列中的像素子阵列401的数目取决于像素阵列105的大小且并非对本公开的限制。
像素子阵列401中的每一者包含多个成像像素或像素单元。根据本公开的一示范性实施例，像素子阵列401中的每一者包含关于其中的像素单元与列位线BL1到BL8之间的连接、关于两列像素单元之间的接口镜像对称的两列像素单元。两列像素单元可水平且直接地彼此邻接而无需由其它像素单元分隔开。作为一非限制性实例，像素单元的每一列包含8行，即，8个像素单元。像素单元的左侧列包含如图4中所说明从上到下依序且垂直地布置的像素单元P31、P32、P33、P34、P35、P36、P37及P38。像素单元的右侧列包含如图4中所说明从上到下依序且垂直地布置的像素单元P41、P42、P43、P44、P45、P46、P47及P48。
由左侧列的8行中的4者获取及由右侧列的8行中的4者获取的图像数据通过位线BL1到BL8同时读出。此外，像素单元P31、P32、P33、P34、P35、P36、P37、P38、P41、P42、P43、P44、P45、P46、P47及P48经布置成像素单元的8×2阵列。位线BL1耦合到像素单元P31及P32以使得由像素单元P31或P32获取的图像数据通过位线BL1读出。位线BL2耦合到像素单元P33及P34以使得由像素单元P33及P34获取的图像数据通过位线BL2读出。位线BL3耦合到像素单元P35及P36以使得由像素单元P35及P36获取的图像数据通过位线BL3读出。位线BL4耦合到像素单元P37及P38以使得由像素单元P37及P38获取的图像数据通过位线BL4读出。位线BL5耦合到像素单元P41及P42以使得由像素单元P41或P42获取的图像数据通过位线BL5读出。位线BL6耦合到像素单元P43及P44以使得由像素单元P43及P44获取的图像数据通过位线BL6读出。位线BL7耦合到像素单元P45及P46以使得由像素单元P45或P46获取的图像数据通过位线BL7读出。位线BL8耦合到像素单元P47及P48以使得由像素单元P47或P48获取的图像数据通过位线BL8读出。
在一些实施例中，由像素单元P31、P33、P35、P37、P48、P46、P44及P42获取的图像数据通过位线BL1到BL8同时读出，且此后，由像素单元P32、P34、P36、P38、P47、P45、P43及P41获取的图像数据通过位线BL1到BL8同时读出。然而，这并非对本公开的限制。在一些实施例中，由像素单元P32、P34、P36、P38、P47、P45、P43及P41获取的图像数据通过位线BL1到BL8同时读出，且此后，由像素单元P31、P33、P35、P37、P48、P46、P44及P42获取的图像数据通过位线BL1到BL8同时读出。在一些实施例中，由像素单元P31、P33、P35、P37、P47、P45、P43及P41获取的图像数据通过位线BL1到BL8同时读出，且此后，由像素单元P32、P34、P36、P38、P48、P46、P44及P42获取的图像数据通过位线BL1到BL8同时读出。在一些实施例中，由像素单元P32、P34、P36、P38、P48、P46、P44及P42获取的图像数据通过位线BL1到BL8同时读出，且此后，由像素单元P31、P33、P35、P37、P47、P45、P43及P41获取的图像数据通过位线BL1到BL8同时读出。
位线BL1到BL8如图4中所示从左到右依序布置。如上文所提及，两列像素单元关于其中的像素单元与列位线BL1到BL8之间的连接镜像对称。具体地说，像素单元P31、P32、P42及P41可共同视为关于其中的像素单元与列位线BL1及BL8之间的连接镜像对称的像素单元的2×2阵列；像素单元P32、P33、P43及P42可共同视为关于其中的像素单元与列位线BL1、BL2、BL7及BL8之间的连接镜像对称的像素单元的2×2阵列；像素单元P33、P34、P44及P43可共同视为关于其中的像素单元与列位线BL2及BL7之间的连接镜像对称的像素单元的2×2阵列；像素单元P34、P35、P45及P44可共同视为关于其中的像素单元与列位线BL2、BL3、BL6及BL7之间的连接镜像对称的像素单元的2×2阵列；像素单元P35、P36、P46及P45可共同视为关于其中的像素单元与列位线BL3及BL6之间的连接镜像对称的像素单元的2×2阵列；像素单元P36、P37、P47及P46可共同视为关于其中的像素单元与列位线BL3、BL4、BL5及BL6之间的连接镜像对称的像素单元的2×2阵列；像素单元P37、P38、P48及P47可共同视为关于其中的像素单元与列位线BL4及BL5之间的连接镜像对称的像素单元的2×2阵列。
图4的镜像对称布置使得耦合到列位线的彼此直接邻接的像素单元尽可能地更接近彼此。以此方式，在一般情况下像素间串扰可减轻，这是因为彼此接近的像素单元的值通常类似于彼此。如图4中所说明，水平地耦合到列位线且彼此直接邻接的像素单元最多由一个像素单元分隔开。
每个像素子阵列401的像素单元的数目不限于16(即，4×2)。随着混合接合堆叠技术发展，更多模拟到数字转换器(ADC)被允许放置在像素阵列下，且每个像素列的位线的数目增加，例如，针对小像素单元为16或32个，且针对较大像素单元为64个或更多。镜像对称布置可应用于具有不同大小及不同数目个列位线的像素子阵列。
像素阵列105可为单色或彩色。图5为展示根据本公开的一些实施例的图4的像素阵列105的细节的框图。如图5中所示，像素单元P31、P32、P33、P34、P35、P36、P37、P38、P41、P42、P43、P44、P45、P46、P47及P48中的每一者可为单色像素单元。作为一非限制性实例，像素单元P31、P32、P33、P34、P35、P36、P37、P38、P41、P42、P43、P44、P45、P46、P47及P48基于拜耳CFA图案布置。举例来说，像素单元P31、P33、P35、P37、P42、P44、P46及P48为绿色(G)像素；像素单元P32、P34、P36及P38为蓝色(B)像素；且像素单元P41、P43、P45及P47为红色(R)像素。
根据一些实施例，绿色(G)像素P31、P33、P35、P37、P42、P44、P46及P48首先通过位线BL1到BL8同时读出，且接着蓝色(B)像素P32、P34、P36及P38以及红色(R)像素P41、P43、P45及P47通过位线BL1到BL8同时读出。然而，这并非对本公开的限制。在一些实施例中，蓝色(B)像素P32、P34、P36及P38以及红色(R)像素P41、P43、P45及P47首先通过位线BL1到BL8同时读出，且接着绿色(G)像素P31、P33、P35、P37、P42、P44、P46及P48通过位线BL1到BL8同时读出。
应了解，如图5中所示的像素阵列105中所使用的特定CFA图案仅为示范性的，且可使用大量其它类型的CFA图案。
根据本公开的一些实施例，公开一种成像传感器。所述图像传感器包含：第一像素单元；第二像素单元，其垂直地邻接于所述第一像素单元；第三像素单元，其水平地邻接于所述第二像素单元；第四像素单元，其水平地邻接于所述第一像素单元且垂直地邻接于所述第三像素单元，其中所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元经布置成像素单元的2×2阵列；第一列位线，其耦合到所述第一像素单元，其中由所述第一像素单元获取的图像数据通过所述第一列位线读出；第二列位线，其耦合到所述第二像素单元，其中由所述第二像素单元获取的图像数据通过所述第二列位线读出；第三列位线，其耦合到所述第三像素单元，其中由所述第三像素单元获取的图像数据通过所述第三列位线读出，且其中所述第二列位线在所述第一列位线与所述第三列位线之间；及第四列位线，其耦合到所述第四像素单元，其中由所述第四像素单元获取的图像数据通过所述第四列位线读出，且其中所述第三列位线在所述第二列位线与所述第四列位线之间。
根据本公开的一些实施例，公开一种成像传感器。所述图像传感器包含：第一像素列，其包含：第一像素单元；第二像素单元，其垂直地邻接于所述第一像素单元；第一列位线，其耦合到所述第一像素单元，其中由所述第一像素单元获取的图像数据通过所述第一列位线读出；及第二列位线，其耦合到所述第二像素单元，其中由所述第二像素单元获取的图像数据通过所述第二列位线读出；及第二像素列，其水平地邻接于所述第一像素列，其中所述第一像素列及所述第二像素列关于所述像素单元与所述列位线之间的连接镜像对称。
根据本公开的一些实施例，第一像素列，其包含：第一像素单元、第二像素单元、第三像素单元及第四像素单元，其以此次序布置：所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元；第一列位线，其耦合到所述第一像素单元及所述第二像素单元，其中由所述第一像素单元获取的图像数据或由所述第二像素单元获取的图像数据通过所述第一列位线选择性地读出；第二列位线，其耦合到所述第三像素单元及所述第四像素单元，其中由所述第三像素单元获取的图像数据或由所述第四像素单元获取的图像数据通过所述第二列位线选择性地读出；及第二像素列，其水平地邻接于所述第一像素列，其中所述第一像素列及所述第二像素列关于所述像素单元与所述列位线之间的连接镜像对称。
前文概述若干实施例的特征以使得所属领域的技术人员可更优选地理解本公开的方面。所属领域的技术人员应理解，其可易于使用本公开作为设计或修改用于实现本文中所引入的实施例的相同目的及/或达成相同优点的其它方法及结构的基础。所属领域的技术人员还应认识到，这类等效构造并不脱离本公开的精神及范围，且所属领域的技术人员可在不脱离本公开的精神及范围的情况下在本文中进行改变、替代及更改。
Claims (20)
1.一种图像传感器，其包括：
第一像素单元；
第二像素单元，其垂直地邻接于所述第一像素单元；
第三像素单元，其水平地邻接于所述第二像素单元；
第四像素单元，其水平地邻接于所述第一像素单元且垂直地邻接于所述第三像素单元，其中所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元经布置成像素单元的2×2阵列；
第一列位线，其耦合到所述第一像素单元，其中由所述第一像素单元获取的图像数据通过所述第一列位线读出；
第二列位线，其耦合到所述第二像素单元，其中由所述第二像素单元获取的图像数据通过所述第二列位线读出；
第三列位线，其耦合到所述第三像素单元，其中由所述第三像素单元获取的图像数据通过所述第三列位线读出，且其中所述第二列位线在所述第一列位线与所述第三列位线之间；及
第四列位线，其耦合到所述第四像素单元，其中由所述第四像素单元获取的图像数据通过所述第四列位线读出，且其中所述第三列位线在所述第二列位线与所述第四列位线之间。
2.根据权利要求1所述的图像传感器，其中所述第一列位线、所述第二列位线、所述第三列位线及所述第四列位线经配置以使得由所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元获取的所述图像数据同时读出。
3.根据权利要求1所述的图像传感器，其中所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元中的每一者包含以2×2为基础的共享像素。
4.根据权利要求3所述的图像传感器，其中所述以2×2为基础的共享像素中的每一者包含4个光电二极管及共享浮动扩散区。
5.根据权利要求4所述的图像传感器，其中所述第一列位线、所述第二列位线、所述第三列位线及所述第四列位线经配置以使得由所述以2×2为基础的共享像素中的每一者的所述光电二极管中的一者获取的所述图像数据同时读出。
6.根据权利要求4所述的图像传感器，其中所述以2×2为基础的共享像素中的每一者包含以拜耳图案布置的所述4个光电二极管。
7.根据权利要求6所述的图像传感器，其中所述第一列位线、所述第二列位线、所述第三列位线及所述第四列位线经配置以使得由所述以2×2为基础的共享像素中的每一者的所述光电二极管的相同颜色获取的所述图像数据同时读出。
8.一种图像传感器，其包括：
第一像素列，其包含：
第一像素单元；
第二像素单元，其垂直地邻接于所述第一像素单元；
第一列位线，其耦合到所述第一像素单元，其中由所述第一像素单元获取的图像数据通过所述第一列位线读出；及
第二列位线，其耦合到所述第二像素单元，其中由所述第二像素单元获取的图像数据通过所述第二列位线读出；及
第二像素列，其水平地邻接于所述第一像素列，其中所述第一像素列及所述第二像素列关于所述像素单元与所述列位线之间的连接镜像对称。
9.根据权利要求8所述的图像传感器，其中所述第一像素列及所述第二像素列关于所述第一像素列与所述第二像素列之间的接口镜像对称。
10.根据权利要求8所述的图像传感器，其中所述第一列位线、所述第二列位线、所述第三列位线及所述第四列位线经配置以使得由所述第一像素列及所述第二像素列获取的所述图像数据同时读出。
11.根据权利要求8所述的图像传感器，其中所述第一像素单元及所述第二像素单元中的每一者包含以2×2为基础的共享像素。
12.根据权利要求11所述的图像传感器，其中所述以2×2为基础的共享像素中的每一者包含1个红色R像素、1个蓝色B像素，及2个绿色G像素。
13.根据权利要求8所述的图像传感器，其中所述第一像素列进一步包含：
第三像素单元，其垂直地邻接于所述第一像素单元；
第四像素单元，其垂直地邻接于所述第三像素单元，其中所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元以所述第四像素单元、所述第三像素单元、所述第一像素单元及所述第二像素单元的次序布置；
第三列位线，其耦合到所述第三像素单元，其中由所述第三像素单元获取的图像数据通过所述第三列位线读出；及
第四列位线，其耦合到所述第四像素单元，其中由所述第四像素单元获取的图像数据通过所述第四列位线读出。
14.根据权利要求13所述的图像传感器，其中所述第一列位线、所述第二列位线、所述第三列位线及所述第四列位线以所述第四列位线、所述第三列位线、所述第一列位线及所述第二列位线的次序布置。
15.一种图像传感器，其包括：
第一像素列，其包含：
第一像素单元、第二像素单元、第三像素单元及第四像素单元，其以所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元的次序布置；
第一列位线，其耦合到所述第一像素单元及所述第二像素单元，其中由所述第一像素单元获取的图像数据或由所述第二像素单元获取的图像数据通过所述第一列位线选择性地读出；及
第二列位线，其耦合到所述第三像素单元及所述第四像素单元，其中由所述第三像素单元获取的图像数据或由所述第四像素单元获取的图像数据通过所述第二列位线选择性地读出；及
第二像素列，其水平地邻接于所述第一像素列，其中所述第一像素列及所述第二像素列关于所述像素单元与所述列位线之间的连接镜像对称。
16.根据权利要求15所述的图像传感器，其中所述第一像素列及所述第二像素列关于所述第一像素列与所述第二像素列之间的接口镜像对称。
17.根据权利要求15所述的图像传感器，其中所述第一像素单元、所述第二像素单元、所述第三像素单元及所述第四像素单元为单色像素单元。
18.根据权利要求17所述的图像传感器，其中所述第一像素单元及所述第三像素单元为第一颜色的单色像素单元，且所述第二像素单元及所述第四像素单元为不同于所述第一颜色的第二颜色的单色像素单元。
19.根据权利要求15所述的图像传感器，其中所述第一列位线及所述第二列位线经配置以选择性地使得：
由所述第一像素单元及所述第三像素单元获取的所述图像数据同时读出，或
由所述第二像素单元及所述第四像素单元获取的所述图像数据同时读出。
20.根据权利要求15所述的图像传感器，其中所述第二像素列包含：
第五像素单元、第六像素单元、第七像素单元及第八像素单元，其以所述第五像素单元、所述第六像素单元、所述第七像素单元及所述第八像素单元的次序布置；
第三列位线，其耦合到所述第五像素单元及所述第六像素单元，其中由所述第五像素单元获取的图像数据或由所述第六像素单元获取的图像数据通过所述第三列位线选择性地读出；及
第四列位线，其耦合到所述第七像素单元及所述第八像素单元，其中由所述第七像素单元获取的图像数据或由所述第八像素单元获取的图像数据通过所述第四列位线选择性地读出。
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