CN110491337A - 像素电路及其驱动方法、显示面板以及电子设备 - Google Patents

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Abstract

本发明公开了一种像素电路及其驱动方法、显示面板以及电子设备，像素电路包括：第一驱动线、第二驱动线、数据线和感测线；第一像素子电路，第一像素子电路位于像素阵列的奇数行，第一像素子电路包括第一写入单元、第一感测单元和第一驱动单元；第二像素子电路，第二像素子电路位于像素阵列的偶数行，第二像素子电路包括第二写入单元、第二感测单元和第二驱动单元；其中，第一写入单元与第二感测单元连接第一驱动线，以在第一驱动线的控制下同时开启或关闭，第二写入单元与第一感测单元连接第二驱动线，以在第二驱动线的控制下同时开启或关闭。由此，每个像素子电路需要一条栅极驱动线，可减少栅极驱动电路输出端的个数，进而减小显示面板的边框。

Description

像素电路及其驱动方法、显示面板以及电子设备
技术领域
本发明涉及显示技术领域，特别涉及一种像素电路、一种显示面板、一种电子设备以及一种像素电路的驱动方法。
背景技术
在显示领域特别是OLED(Organic Light-Emitting Diode，有机发光二极管)显示中，GOA(Gate Driver On Array，阵列基板行驱动)电路是减少panel不良和降低成本的有效手段。
相关技术中，OLED像素多以3T1C结构为主，每个像素需要两条栅极驱动线，如图1所示，对应的GOA电路需要有两个输出端OUTA’和OUTB’，结构比较复杂。
发明内容
本发明旨在至少在一定程度上解决相关技术中的技术问题之一。为此，本发明的第一个目的在于提出一种像素电路，以减少栅极驱动电路输出端的个数，减小显示面板的边框。
本发明的第二个目的在于提出一种显示面板。
本发明的第三个目的在于提出一种电子设备。
本发明的第四个目的在于提出一种像素电路的驱动方法。
为达上述目的，本发明第一方面实施例提出一种像素电路，包括第一驱动线、第二驱动线、数据线和感测线；第一像素子电路，所述第一像素子电路位于像素阵列的奇数行，所述第一像素子电路包括第一写入单元、第一感测单元和第一驱动单元，所述第一写入单元与所述数据线相连，所述第一感测单元与所述感测线相连，所述第一驱动单元与第一发光单元相连以驱动所述第一发光单元发光，其中，所述像素阵列以所述像素电路为单位构造；第二像素子电路，所述第二像素子电路位于所述像素阵列的偶数行，所述第二像素子电路包括第二写入单元、第二感测单元和第二驱动单元，所述第二写入单元与所述数据线相连，所述第二感测单元与所述感测线相连，所述第二驱动单元与第二发光单元相连以驱动所述第二发光单元发光；其中，所述第一写入单元与所述第二感测单元连接所述第一驱动线，以在所述第一驱动线的控制下同时开启或关闭，所述第二写入单元与所述第一感测单元连接所述第二驱动线，以在所述第二驱动线的控制下同时开启或关闭。
根据本发明实施例提出的像素电路，包括第一驱动线、第二驱动线、数据线、感测线、第一像素子电路和第二像素子电路，第一像素子电路位于像素阵列的奇数行，第一像素子电路包括第一写入单元、第一感测单元和第一驱动单元，第一写入单元与数据线相连，第一感测单元与感测线相连，第一驱动单元与第一发光单元相连以驱动第一发光单元发光，，其中，像素阵列以像素电路为单位构造，第二像素子电路位于像素阵列的偶数行，第二像素子电路包括第二写入单元、第二感测单元和第二驱动单元，第二写入单元与数据线相连，第二感测单元与感测线相连，第二驱动单元与第二发光单元相连以驱动第二发光单元发光，其中，第一写入单元与第二感测单元连接第一驱动线，以在第一驱动线的控制下同时开启或关闭，第二写入单元与第一感测单元连接第二驱动线，以在第二驱动线的控制下同时开启或关闭。由此，本发明实施例的像素电路，通过将第一像素子电路中的第一写入单元与第二像素子电路中的第二感测单元连接在一条驱动线上，第二像素子电路中的第二写入单元与第一像素子电路中的第一感测单元连接在另一条驱动线上，使得每个像素子电路需要一条栅极驱动线，从而，可减少栅极驱动电路输出端的个数，进而减小显示面板的边框。
另外，根据本发明上述实施例的像素电路还可以具有如下附加的技术特征：
根据本发明的一个实施例，所述第一写入单元的第一端与所述数据线相连，所述第一写入单元的控制端与所述第一驱动线相连，所述第一感测单元的第一端与所述感测线相连，所述第一感测单元的控制端与所述第二驱动线相连，所述第一驱动单元的控制端与所述第一写入单元的第二端相连，所述第一驱动单元的第一端与第一电源相连，所述第一驱动单元的第二端与所述第一感测单元的第二端相连，所述第一驱动单元的第二端还与所述第一发光单元相连；所述第二写入单元的第一端与所述数据线相连，所述第二写入单元的控制端与所述第二驱动线相连，所述第二感测单元的第一端与所述感测线相连，所述第二感测单元的控制端与所述第一驱动线相连，所述第二驱动单元的控制端与所述第二写入单元的第二端相连，所述第二驱动单元的第一端与所述第一电源相连，所述第二驱动单元的第二端与所述第二感测单元的第二端相连，所述第二驱动单元的第二端还与所述第二发光单元相连。
根据本发明的一个实施例，所述第一写入单元包括第一写入晶体管，所述第一写入晶体管的第一端与所述数据线相连，所述第一写入晶体管的控制端与所述第一驱动线相连，所述第一写入晶体管的第二端与所述第一驱动单元的控制端相连；所述第二写入单元包括第二写入晶体管，所述第二写入晶体管的第一端与所述数据线相连，所述第二写入晶体管的控制端与所述第二驱动线相连，所述第二写入晶体管的第二端与所述第二驱动单元的控制端相连。
根据本发明的一个实施例，所述第一感测单元包括第一感测晶体管，所述第一感测晶体管的第一端与所述第一驱动单元的第二端相连，所述第一感测晶体管的第二端与所述感测线相连，所述第一感测晶体管的控制端与所述第二驱动线相连；所述第二感测单元包括第二感测晶体管，所述第二感测晶体管的第一端与所述第二驱动单元的第二端相连，所述第二感测晶体管的第二端与所述感测线相连，所述第二感测晶体管的控制端与所述第一驱动线相连。
根据本发明的一个实施例，所述第一驱动单元包括第一驱动晶体管和第一存储电容，所述第一驱动晶体管的第一端与第一电源相连，所述第一驱动晶体管的第二端与所述第一发光单元的一端相连，所述第一发光单元的另一端与第二电源相连，所述第一驱动晶体管的控制端与所述第一写入单元相连，所述第一存储电容的一端与所述第一驱动晶体管的控制端相连，所述第一存储电容的另一端与所述第一驱动晶体管的第二端相连；所述第二驱动单元包括第二驱动晶体管和第二存储电容，所述第二驱动晶体管的第一端与所述第一电源相连，所述第二驱动晶体管的第二端与所述第二发光单元的一端相连，所述第二发光单元的另一端与所述第二电源相连，所述第二驱动晶体管的控制端与所述第二写入单元相连，所述第二存储电容的一端与所述第二驱动晶体管的控制端相连，所述第二存储电容的另一端与所述第二驱动晶体管的第二端相连。
根据本发明的一个实施例，所述第一驱动线和所述第二驱动线分别与栅极驱动电路中相邻两行的栅极驱动单元的输出端相连。
为达上述目的，本发明第二方面实施例提出一种显示面板，包括像素阵列，其中，所述像素阵列以如本发明第一方面实施例所述的像素电路为单位构造。
根据本发明实施例提出的显示面板，通过设置的像素阵列，将第一像素子电路中的第一写入单元与第二像素子电路中的第二感测单元连接在一条驱动线上，第二像素子电路中的第二写入单元与第一像素子电路中的第一感测单元连接在另一条驱动线上，使得每个像素子电路需要一条栅极驱动线，从而，可减少栅极驱动电路输出端的个数，进而减小显示面板的边框。
另外，根据本发明上述实施例的显示面板还可以具有如下附加的技术特征：
根据本发明的一个实施例，所述像素电路中的第一像素子电路位于所述像素阵列的奇数行，所述像素电路中的第二像素子电路位于所述像素阵列的偶数行。
为达上述目的，本发明第三方面实施例提出一种电子设备，包括本发明第二方面实施例所述的显示面板。
根据本发明实施例提出的电子设备，通过设置的显示面板，将第一像素子电路中的第一写入单元与第二像素子电路中的第二感测单元连接在一条驱动线上，第二像素子电路中的第二写入单元与第一像素子电路中的第一感测单元连接在另一条驱动线上，使得每个像素子电路需要一条栅极驱动线，从而，可减少栅极驱动电路输出端的个数，进而减小显示面板的边框。
为达上述目的，本发明第四方面实施例提出一种像素电路的驱动方法，用于驱动如本发明第一方面实施例所述的像素电路，所述像素电路的工作模式包括显示模式，所述方法包括以下步骤：在所述显示模式的第一阶段，所述第一驱动线输出第一开启信号，所述第一写入单元在所述第一驱动线的控制下开启，以对所述第一驱动单元的控制端进行预充电；在所述显示模式的第二阶段，所述第一驱动线输出所述第一开启信号，所述第二驱动线输出第二开启信号，所述第一写入单元在所述第一驱动线的控制下开启，以将所述数据线的第一数据电压写入所述第一驱动单元的控制端，所述第二写入单元在所述第二驱动线的控制下开启，以对所述第二驱动单元的控制端进行预充电；在所述显示模式的第三阶段，所述第一驱动线输出第一关闭信号，所述第二驱动线输出所述第二开启信号，所述第一写入单元在所述第一驱动线的控制下关闭，以维持所述第一驱动单元的控制端的电位，且所述第二写入单元在所述第二驱动线的控制下开启，以将所述数据线的第二数据电压写入所述第二驱动单元的控制端；在所述显示模式的第四阶段，所述第一驱动线输出所述第一关闭信号，所述第二驱动线输出第二关闭信号，所述第一写入单元在所述第一驱动线的控制下关闭，且所述第一感测单元在所述第二驱动线的控制下关闭，以使所述第一驱动单元驱动所述第一发光单元发光，所述第二写入单元在所述第二驱动线的控制下关闭，且所述第二感测单元在所述第一驱动线的控制下关闭，以使所述第二驱动单元驱动所述第二发光单元发光。
根据本发明实施例提出的像素电路的驱动方法，在显示模式的第一阶段，第一驱动线输出第一开启信号，第一写入单元在第一驱动线的控制下开启，以对第一驱动单元的控制端进行预充电；在显示模式的第二阶段，第一驱动线输出第一开启信号，第二驱动线输出第二开启信号，第一写入单元在第一驱动线的控制下开启，以将数据线的第一数据电压写入第一驱动单元的控制端，第二写入单元在第二驱动线的控制下开启，以对第二驱动单元的控制端进行预充电；在显示模式的第三阶段，第一驱动线输出第一关闭信号，第二驱动线输出第二开启信号，第一写入单元在第一驱动线的控制下关闭，以维持第一驱动单元的控制端的电位，且第二写入单元在第二驱动线的控制下开启，以将数据线的第二数据电压写入第二驱动单元的控制端；在显示模式的第四阶段，第一驱动线输出第一关闭信号，第二驱动线输出第二关闭信号，第一写入单元在第一驱动线的控制下关闭，且第一感测单元在第二驱动线的控制下关闭，以使第一驱动单元驱动第一发光单元发光，第二写入单元在第二驱动线的控制下关闭，且第二感测单元在第一驱动线的控制下关闭，以使第二驱动单元驱动第二发光单元发光。由此，本发明实施例的像素电路的驱动方法，将第一像素子电路中的第一写入单元与第二像素子电路中的第二感测单元连接在一条驱动线上，将第二像素子电路中的第二写入单元与第一像素子电路中的第一感测单元连接在另一条驱动线上，使得每个像素子电路需要一条栅极驱动线，从而，可减少栅极驱动电路输出端的个数，进而减小显示面板的边框。
另外，根据本发明上述实施例的像素电路的驱动方法还可以具有如下附加的技术特征：
根据本发明的一个实施例，所述像素电路的工作模式包括感测模式，其中，在所述感测模式的数据写回阶段，所述第一驱动线输出所述第一开启信号，所述第二驱动线输出第二开启信号，所述第一写入单元和所述第二感测电路在所述第一驱动线的控制下开启，所述第一感测单元和所述第二写入单元在所述第二驱动线的控制下开启，所述数据线输出的数据电压同时写入所述第一驱动单元的控制端和所述第二驱动单元控制端，且所述感测线输出的参考电压同时写入第一节点和第二节点，其中，所述第一驱动单元和所述第一发光单元与所述第一节点相连，所述第二驱动单元和所述第二发光单元与所述第二节点相连。
根据本发明的一个实施例，在所述感测模式的数据写回阶段之前，还包括第一数据写入阶段、第一充电阶段、第一采样阶段、第二数据写入阶段、第二充电阶段和第二采样阶段，其中，所述方法还包括：在所述第一写入数据阶段，所述第一驱动线输出所述第一开启信号，所述第二驱动线输出第二开启信号，所述第一写入单元在所述第一驱动线的控制下开启，所述第一感测单元在所述第二驱动线的控制下开启，所述数据线输出的数据电压写入所述第一驱动单元的控制端，且所述感测线输出的参考电压写入所述第一节点；在所述第一充电阶段，所述第一驱动线输出所述第一关闭信号，且所述第二驱动线输出第二开启信号，所述第一写入单元在所述第一驱动线的控制下关闭，所述第一感测单元在所述第二驱动线的控制下开启，第一电源通过所述第一驱动单元对所述第一节点充电，以使所述感测线的电位随所述第一节点的电位变化；在所述第一采样阶段，所述第一驱动线输出所述第一关闭信号，且所述第二驱动线输出第二开启信号，所述第一写入单元在所述第一驱动线的控制下关闭，所述第一感测单元在所述第二驱动线的控制下开启，通过外部电路读取所述感测线的电位以感测所述第一驱动单元的阈值电压；在所述第二写入数据阶段，所述第一驱动线输出所述第一开启信号，所述第二驱动线输出第二开启信号，所述第二写入单元在所述第二驱动线的控制下开启，所述第二感测单元在所述第一驱动线的控制下开启，所述数据线输出的数据电压写入所述第二驱动单元的控制端，且所述感测线输出的参考电压写入所述第二节点；在所述第二充电阶段，所述第二驱动线输出所述第二关闭信号，且所述第一驱动线输出第一开启信号，所述第二写入单元在所述第二驱动线的控制下关闭，所述第二感测单元在所述第一驱动线的控制下开启，所述第一电源通过所述第二驱动单元对所述第二节点充电，以使所述感测线的电位随所述第二节点的电位变化；在所述第二采样阶段，所述第二驱动线输出所述第二关闭信号，且所述第一驱动线输出第一开启信号，所述第二写入电路在所述第二驱动线的控制下关闭，所述第二感测单元在所述第一驱动线的控制下开启，通过所述外部电路读取所述感测线的电位以感测所述第二驱动单元的阈值电压。
根据本发明的一个实施例，在所述显示模式的第三阶段，还根据所述第二发光单元的跨压对所述第二数据电压进行补偿。
附图说明
图1为相关技术中的像素电路对应的栅极驱动电路的电路原理图；
图2为根据本发明实施例的像素电路的方框示意图；
图3为本发明实施例的像素电路对应的栅极驱动电路的电路原理图；
图4为根据本发明一个实施例的像素电路的电路原理图；
图5为根据本发明一个实施例的像素电路的时序图；
图6为根据本发明另一个实施例的像素电路的时序图；
图7为根据本发明实施例的显示面板的方框示意图；
图8为根据本发明一个实施例的显示面板的方框示意图；
图9为根据本发明实施例的像素电路的驱动方法的流程示意图；
图10为根据本发明一个实施例的像素电路的驱动方法的流程示意图。
具体实施方式
下面详细描述本发明的实施例，所述实施例的示例在附图中示出，其中自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。下面通过参考附图描述的实施例是示例性的，旨在用于解释本发明，而不能理解为对本发明的限制。
下面参考附图描述本发明实施例的像素电路及其驱动方法、显示面板以及电子设备。
图2为根据本发明实施例的像素电路的方框示意图。如图2所示，本发明实施例的像素电路包括：第一驱动线10、第二驱动线20、数据线30、感测线40、第一像素子电路50和第二像素子电路60。
其中，第一像素子电路50位于像素阵列100的奇数行，第一像素子电路50包括第一写入单元51、第一感测单元52和第一驱动单元53，第一写入单元51与数据线30相连，第一感测单元52与感测线40相连，第一驱动单元53与第一发光单元70相连以驱动第一发光单元70发光，其中，像素阵列100以像素电路为单位构造；第二像素子电路60位于像素阵列100的偶数行，第二像素子电路60包括第二写入单元61、第二感测单元62和第二驱动单元63，第二写入单元61与数据线30相连，第二感测单元62与感测线40相连，第二驱动单元63与第二发光单元80相连以驱动第二发光单元80发光；其中，第一写入单元51与第二感测单元62连接第一驱动线10，以在第一驱动线10的控制下同时开启或关闭，第二写入单元61与第一感测单元52连接第二驱动线20，以在第二驱动线20的控制下同时开启或关闭。
可理解，像素阵列100包括多个阵列排布的前述的像素电路。举例而言，像素阵列100具有N行M列，那么，N行M列的像素阵列包括N/2×M个图2或图4实施例的像素电路。也就是说，像素阵列100中相邻两行且处于同一列处设置一个像素电路，即在像素阵列的每一列，第2i-1行和第2i行可以由图2或图4实施例的像素电路构造，i＝1、2、…、N/2，N为偶数。此时，第一像素子电路50位于像素阵列的奇数行即第2i-1行，第二像素子电路60位于像素阵列的偶数行即第2i行。
根据本发明的一个实施例，第一驱动线10和第二驱动线分别20与栅极驱动电路中相邻两行的栅极驱动单元的输出端相连，例如，第一像素子电路50位于第一像素行，那么，第一驱动线10与栅极驱动电路的第一行栅极驱动单元的输出端相连，第二像素子电路60位于第二像素行，那么，第二驱动线20与栅极驱动电路的第二行栅极驱动单元的输出端相连。
由此，本发明实施例的像素电路是以两行作为一个基本单元，通过将第一像素子电路50中的第一写入单元51与第二像素子电路60中的第二感测单元62连接在一条驱动线上，将第二像素子电路60中的第二写入单元61与第一像素子电路50中的第一感测单元52连接在另一条驱动线上，即每个像素子电路只需要一个栅极驱动线，也就是说，本发明实施例的像素电路所对应的栅极驱动电路每行只需要一个栅极输出端，如图3示出的栅极驱动单元具有一个输出端OUTA，显然，与相关技术中的即图1所示的栅极驱动电路相比，输出端的个数减少了一个，从而可减小显示面板的边框。
下面结合图4详细描述本发明实施例的像素电路的具体电路结构。
根据图4实施例，第一写入单元51的第一端与数据线30相连，第一写入单元51的控制端与第一驱动线10相连，第一感测单元52的第一端与感测线40相连，第一感测单元52的控制端与第二驱动线20相连，第一驱动单元53的控制端与第一写入单元51的第二端相连，第一驱动单元53的第一端与第一电源ELVDD相连，第一驱动单元53的第二端与第一感测单元52的第二端相连，第一驱动单元53的第二端还与第一发光单元70相连；第二写入单元61的第一端与数据线30相连，第二写入单元61的控制端与第二驱动线20相连，第二感测单元62的第一端与感测线40相连，第二感测单元62的控制端与第一驱动线10相连，第二驱动单元63的控制端与第二写入单元61的第二端相连，第二驱动单元63的第一端与第一电源EVDD相连，第二驱动单元63的第二端与第二感测单元62的第二端相连，第二驱动单元63的第二端还与第二发光单元80相连。
具体地，根据图4实施例，第一写入单元51包括第一写入晶体管T11，第一写入晶体管T11的第一端与数据线30相连，第一写入晶体管T11的控制端与第一驱动线10相连，第一写入晶体管T11的第二端与第一驱动单元53的控制端相连；第二写入单元61包括第二写入晶体管T21，第二写入晶体管T21的第一端与数据线30相连，第二写入晶体管T21的控制端与第二驱动线20相连，第二写入晶体管T21的第二端与第二驱动单元63的控制端相连。
根据图4实施例，第一感测单元52包括第一感测晶体管T12，第一感测晶体管T12的第一端与第一驱动单元53的第二端相连，第一感测晶体管T12的第二端与感测线40相连，第一感测晶体管T12的控制端与第二驱动线20相连；第二感测单元62包括第二感测晶体管T22，第二感测晶体管T22的第一端与第二驱动单元63的第二端相连，第二感测晶体管T22的第二端与感测线40相连，第二感测晶体管T22的控制端与第一驱动线10相连。
根据图4实施例，第一驱动单元53包括第一驱动晶体管T13和第一存储电容C1，第一驱动晶体管T13的第一端与第一电源ELVDD相连，第一驱动晶体管T13的第二端与第一发光单元70的一端相连，第一发光单元70的另一端与第二电源ELVSS相连，第一驱动晶体管T13的控制端与第一写入单元51相连，第一存储电容C1的一端与第一驱动晶体管T13的控制端相连，第一存储电容C1的另一端与第一驱动晶体管T13的第二端相连；第二驱动单元63包括第二驱动晶体管T23和第二存储电容C2，第二驱动晶体管T23的第一端与第一电源ELVDD相连，第二驱动晶体管T23的第二端与第二发光单元80的一端相连，第二发光单元80的另一端与第二电源ELVSS相连，第二驱动晶体管T23的控制端与第二写入单元61相连，第二存储电容C2的一端与第二驱动晶体管T23的控制端相连，第二存储电容C2的另一端与第二驱动晶体管T23的第二端相连。
其中，第一驱动晶体管T13与第一发光单元70相连接以形成第一节点s1。
下面结合图5-6的时序图对图4实施例的像素电路的工作原理进行说明。
本发明实施例的像素电路的工作模式包括显示模式和感测模式。
需要说明的是，第一写入晶体管T11和第二感测晶体管T22必须为同类型的晶体管，第二写入晶体管T21和第一感测晶体管T12必须为同类型的晶体管。举例而言，第一写入晶体管T11和第二感测晶体管T22可为NPN型晶体管，则在第一驱动线10的输出信号为高电平时，第一写入晶体管T11和第二感测晶体管T22导通，第二写入晶体管T21和第一感测晶体管T12可为PNP型晶体管，则在第二驱动线20的输出信号为低电平时，第二写入晶体管T21和第一感测晶体管T12导通。
本发明以NPN型MOSFET或IGBT晶体管为例进行说明。
图5为工作模式为显示模式时的时序图，其中，G1为第一驱动线10的输出信号，G2为第二驱动线20的输出信号。图6为工作模式为感测模式时的时序图，其中，G1为第一驱动线10的输出信号，G2为第二驱动线20的输出信号，DATA为数据线30输出的数据电压信号，SENSE为感测线40上的电压信号。参考电压VREF为低电平电压，其中，在显示模式下，第一开关K1导通。
结合图5的实施例，在显示模式的第一阶段T1，第一驱动线10输出第一开启信号即高电平信号，第一写入晶体管T11导通，以对第一驱动晶体管T13的控制端即g1点进行预充电，也即对第一存储电容C1进行预充电。
在显示模式的第二阶段T2，第一驱动线10输出第一开启信号即高电平信号，第二驱动线20输出第二开启信号即高电平信号，第一写入晶体管T11继续导通，以将数据线30的第一数据电压写入第一驱动晶体管T13的控制端即g1点，第二写入晶体管T21在第二开启信号的控制下导通，以对第二驱动晶体管T23的控制端即g2点进行预充电，也即对第二存储电容C2进行预充电。
在显示模式的第三阶段T3，第一驱动线10输出第一关闭信号即低电平信号，第二驱动线20输出第二开启信号即高电平信号，第一写入晶体管T11在第一关闭信号的控制下关断，第一驱动晶体管T13的控制端的电位通过第一存储电容C1维持，此时，由于第一存储电容C1的存在，第一驱动晶体管T13的控制端与第二端之间的电压Vgs保持不变，但由于第一感测晶体管T12在第二开启信号的控制下导通，感测线40将低电平信号提供至第一节点s1，第一发光单元70未发光。同时，第二感测晶体管T22在第一关闭信号的控制下关断，第二写入晶体管T21在第二开启信号的控制下导通，以将数据线30的第二数据电压(获取补偿数据后则写入补偿后的第二数据电压)写入第二驱动晶体管T23的控制端即g2点。另外，在此阶段还可以根据第二发光单元80的跨压对第二数据电压进行补偿。
在显示模式的第四阶段T4，第一驱动线10输出第一关闭信号即低电平信号，第二驱动线20输出第二关闭信号即低电平信号，第一写入晶体管T11在第一关闭信号的控制下关断，且第一感测晶体管T12在第二关闭信号的控制下关断，此时，第一驱动晶体管T13的控制端的电位通过第一存储电容C1维持在高电位，第一驱动晶体管T13导通，第一节点s1处的电压抬升，由于第一存储电容C1的作用，第一驱动晶体管T13的控制端即g1点处的电压也自举抬升，第一驱动晶体管T13驱动第一发光单元70发光。并且，第二写入晶体管T21在第二关闭信号的控制下关断，且第二感测晶体管T22在第一关闭信号的控制下关断，此时，第二驱动晶体管T23的控制端的电位通过第二存储电容C2维持在高电位，第二驱动晶体管T23导通，第二节点s2处的电压抬升，由于第二存储电容C2的作用，第二驱动晶体管T23的控制端即g2点处的电压也自举抬升，第二驱动晶体管T23驱动第二发光单元80发光。
结合图6的实施例，在感测模式的第一数据写入阶段T1’，第一驱动线10输出第一开启信号即高电平信号，第二驱动线20输出第二开启信号即高电平信号，第一写入晶体管T11在第一开启信号的控制下导通，第一感测晶体管T12在第二开启信号的控制下导通，数据线30输出的数据电压Vdata即高电平电压写入第一驱动晶体管T13的控制端即g1点，且感测线40输出的参考电压VREF即低电平电压写入第一节点s1，具体地，如图4所示，可通过控制外部电路90中的第一开关K1闭合，将参考电压VREF写入感测线40，从而通过导通的第一感测晶体管T12将感测线40输出的参考电压VREF即低电平电压写入第一节点s1。
其中，在本发明的一些实施例中，外部电路90可以设置在驱动芯片中，以提高电路的集成度，在本发明的其他一些实施例中，外部电路90也可以设置在显示面板上。
在感测模式的第一充电阶段T2’，第一驱动线10输出第一关闭信号即低电平信号，且第二驱动线20输出第二开启信号即高电平信号，第一写入晶体管T11在第一关闭信号的控制下关断，第一感测晶体管T12在第二开启信号的控制下导通，第一驱动晶体管T13的控制端即g1点的电位通过第一存储电容C1保持在高电位，第一驱动晶体管T13导通，流过第一驱动晶体管T13的电流对第一节点s1也即第一存储电容C1充电，以使感测线40的电位随第一节点s1的电位变化。
在感测模式的第一采样阶段T3’，第一驱动线10输出第一关闭信号即低电平信号，且第二驱动线20输出第二开启信号即高电平信号，第一写入晶体管T11在第一关闭信号的控制下关断，此时，第一节点s1的电位为Vdata-Vth，其中Vth为第一驱动晶体管T13的阈值电压，第一感测晶体管T12在第二开启信号的控制下导通，从而通过外部电路90可读取感测线40的电位，进而感测第一驱动晶体管T13的阈值电压，具体地，如图2所示，可控制外部电路90中的第二开关K2闭合，从而采样保持器S/H可通过导通的第一感测晶体管T12对第一节点s1处的电压进行采样并且保持，进而模数转换器ADC根据采样保持器S/H的输出信号感测第一驱动晶体管T13的阈值电压。
在感测模式的第二数据写入阶段T11’，第一驱动线10输出第一开启信号即高电平信号，第二驱动线20输出第二开启信号即高电平信号，第二写入晶体管T21在第二开启信号的控制下导通，第二感测晶体管T22在第一开启信号的控制下导通，数据线30输出的数据电压Vdata即高电平电压写入第二驱动晶体管T23的控制端即g2点，且感测线40输出的参考电压VREF即低电平电压写入第二节点s2，具体地，如图4所示，可通过控制外部电路90中的第一开关K1闭合，将参考电压VREF写入感测线40，从而通过导通的第二感测晶体管T22将感测线40输出的参考电压VREF即低电平电压写入第二节点s2。
在感测模式的第二充电阶段T22’，第二驱动线20输出第二关闭信号即低电平信号，且第一驱动线10输出第一开启信号即高电平信号，第二写入晶体管T21在第二关闭信号的控制下关断，第二感测晶体管T22在第一开启信号的控制下导通，第二驱动晶体管T23的控制端即g2点的电位通过第二存储电容C2保持在高电位，第二驱动晶体管T23导通，流过第二驱动晶体管T23的电流对第二节点s2也即第二存储电容C2充电，以使感测线40的电位随第二节点s2的电位变化。
在感测模式的第二采样阶段T33’，第二驱动线20输出第二关闭信号即低电平信号，且第一驱动线10输出第一开启信号即高电平信号，第二写入晶体管T21在第二关闭信号的控制下关断，此时，第二节点s2的电位为Vdata-Vth’，其中Vth’为第二驱动晶体管T23的阈值电压，第二感测晶体管T22在第一开启信号的控制下导通，从而通过外部电路90可读取感测线40的电位，进而感测第二驱动晶体管T23的阈值电压，具体地，如图2所示，可控制外部电路90中的第二开关K2闭合，从而采样保持器S/H可通过导通的第二感测晶体管T22对第二节点s2处的电压进行采样并且保持，进而模数转换器ADC根据采样保持器S/H的输出信号感测第二驱动晶体管T23的阈值电压。
如图6所示，在感测模式的数据写回阶段T4’，第一驱动线10输出第一开启信号即高电平信号，第二驱动线20输出第二开启信号即高电平信号，第一写入晶体管T11和第二感测晶体管T22在第一开启信号的控制下导通，第一感测晶体管T12和第二写入晶体管T21在第二开启信号的控制下导通，数据线30输出的数据电压即高电平电压同时写入第一驱动晶体管T13的控制端即g1点和第二驱动晶体管T23的控制端即g2点，且感测线40输出的参考电压VREF即低电平电压同时写入第一节点s1和第二节点s2，具体地，如图4所示，可通过控制外部电路90中的第一开关K1闭合，将参考电压VREF写入感测线40，从而通过导通的第一感测晶体管T12和第二感测晶体管T22将感测线40输出的参考电压VREF即低电平电压写入第一节点s1和第二节点s2，其中，第一驱动晶体管T13的第二端和第一发光单元70的一端与第一节点s1相连，第二驱动晶体管T23的第二端和第二发光单元80的一端与第二节点s2相连。
可理解，在感测模式的数据写回阶段，第一像素子电路50和第二像素子电路60同时进行数据写回，也就是说，第一像素子电路50中的第一写入晶体管T11和第二像素子电路60中的第二感测晶体管T22同时打开，第二像素子电路60中的第二写入晶体管T21和第一像素子电路50中的第一感测晶体管T12同时打开，并且，第一写入晶体管T11和第二写入晶体管T21同时打开，以分别向第一驱动晶体管T13的控制端和第二驱动晶体管T23的控制端写入相同的数据电压，第一感测晶体管T12和第二感测晶体管T22同时打开，以分别向第一节点s1和第二节点s2写入相同的参考电压。
综上，根据本发明实施例提出的像素电路，包括第一驱动线、第二驱动线、数据线、感测线、第一像素子电路和第二像素子电路，第一像素子电路包括第一写入单元、第一感测单元和第一驱动单元，第一写入单元与数据线相连，第一感测单元与感测线相连，第一驱动单元与第一发光单元相连以驱动第一发光单元发光，第二像素子电路包括第二写入单元、第二感测单元和第二驱动单元，第二写入单元与数据线相连，第二感测单元与感测线相连，第二驱动单元与第二发光单元相连以驱动第二发光单元发光，其中，第一写入单元与第二感测单元连接第一驱动线，以在第一驱动线的控制下同时开启或关闭，第二写入单元与第一感测单元连接第二驱动线，以在第二驱动线的控制下同时开启或关闭。由此，本发明实施例的像素电路，通过将第一像素子电路中的第一写入单元与第二像素子电路中的第二感测单元连接在一条驱动线上，第二像素子电路中的第二写入单元与第一像素子电路中的第一感测单元连接在另一条驱动线上，使得每个像素子电路需要一条栅极驱动线，从而，可减少栅极驱动电路输出端的个数，进而减小显示面板的边框。
基于上述实施例的像素电路，本发明实施例还提出一种显示面板。图7为根据本发明实施例的显示面板的方框示意图，如图7所示，本发明实施例的显示面板1包括像素阵列100，其中，像素阵列100以前述的像素电路为单位构造。
可理解，像素阵列100包括多个阵列排布的前述的像素电路。举例而言，像素阵列100具有N行M列，那么，N行M列的像素阵列包括N/2×M个图2或图4实施例的像素电路。也就是说，像素阵列100中相邻两行且处于同一列处设置一个像素电路，即在像素阵列的每一列，第2i-1行和第2i行可以由图2或图4实施例的像素电路构造，i＝1、2、…、N/2，N为偶数。
具体地，根据本发明的一个实施例，如图8所示，像素电路中的第一像素子电路50位于像素阵列的奇数行，像素电路中的第二像素子电路60位于像素阵列的偶数行。
根据本发明实施例提出的显示面板，通过设置的像素阵列，将第一像素子电路中的第一写入单元与第二像素子电路中的第二感测单元连接在一条驱动线上，第二像素子电路中的第二写入单元与第一像素子电路中的第一感测单元连接在另一条驱动线上，使得每个像素子电路需要一条栅极驱动线，从而，可减少栅极驱动电路输出端的个数，进而减小显示面板的边框。
基于上述实施例的显示面板，本发明实施例还提出一种电子设备，包括前述的显示面板。
根据本发明实施例提出的电子设备，通过设置的显示面板，将第一像素子电路中的第一写入单元与第二像素子电路中的第二感测单元连接在一条驱动线上，第二像素子电路中的第二写入单元与第一像素子电路中的第一感测单元连接在另一条驱动线上，使得每个像素子电路需要一条栅极驱动线，从而，可减少栅极驱动电路输出端的个数，进而减小显示面板的边框。
基于上述实施例的像素电路，本发明实施例还提出一种像素电路的驱动方法，用于驱动前述的像素电路，像素电路的工作模式包括显示模式。图9为根据本发明实施例的像素电路的驱动方法的流程示意图，如图9所示，本发明实施例的像素电路的驱动方法包括以下步骤：
S1，在显示模式的第一阶段，第一驱动线输出第一开启信号，第一写入单元在第一驱动线的控制下开启，以对第一驱动单元的控制端进行预充电。
S2，在显示模式的第二阶段，第一驱动线输出第一开启信号，第二驱动线输出第二开启信号，第一写入单元在第一驱动线的控制下开启，以将数据线的第一数据电压写入第一驱动单元的控制端，第二写入单元在第二驱动线的控制下开启，以对第二驱动单元的控制端进行预充电。
S3，在显示模式的第三阶段，第一驱动线输出第一关闭信号，第二驱动线输出第二开启信号，第一写入单元在第一驱动线的控制下关闭，以维持第一驱动单元的控制端的电位，且第二写入单元在第二驱动线的控制下开启，以将数据线的第二数据电压写入第二驱动单元的控制端。
根据本发明的一个实施例，在显示模式的第三阶段，还根据第二发光单元的跨压对第二数据电压进行补偿。
S4，在显示模式的第四阶段，第一驱动线输出第一关闭信号，第二驱动线输出第二关闭信号，第一写入单元在第一驱动线的控制下关闭，且第一感测单元在第二驱动线的控制下关闭，以使第一驱动单元驱动第一发光单元发光，第二写入单元在第二驱动线的控制下关闭，且第二感测单元在第一驱动线的控制下关闭，以使第二驱动单元驱动第二发光单元发光。
根据本发明的一个实施例，像素电路的工作模式包括感测模式，其中，在感测模式的数据写回阶段，第一驱动线输出第一开启信号，第二驱动线输出第二开启信号，第一写入单元和第二感测单元在第一驱动线的控制下开启，第一感测单元和第二写入单元在第二驱动线的控制下开启，数据线输出的数据电压同时写入第一驱动单元的控制端和第二驱动单元控制端，且感测线输出的参考电压同时写入第一节点和第二节点，其中，第一驱动单元和第一发光单元与第一节点相连，第二驱动单元和第二发光单元与第二节点相连。
进一步地，根据本发明的一个实施例，如图10所示，在感测模式的数据写回阶段之前，还包括第一数据写入阶段、第一充电阶段、第一采样阶段、第二数据写入阶段、第二充电阶段和第二采样阶段，其中，方法还包括以下步骤：
S10，在第一数据写入阶段，第一驱动线输出第一开启信号，第二驱动线输出第二开启信号，第一写入单元在第一驱动线的控制下开启，第一感测单元在第二驱动线的控制下开启，数据线输出的数据电压写入第一驱动单元的控制端，且感测线输出的参考电压写入第一节点。
S11，在第一充电阶段，第一驱动线输出第一关闭信号，且第二驱动线输出第二开启信号，第一写入单元在第一驱动线的控制下关闭，第一感测单元在第二驱动线的控制下开启，第一电源通过第一驱动单元对第一节点充电，以使感测线的电位随第一节点的电位变化。
S12，在第一采样阶段，第一驱动线输出第一关闭信号，且第二驱动线输出第二开启信号，第一写入单元在第一驱动线的控制下关闭，第一感测单元在第二驱动线的控制下开启，通过外部电路读取感测线的电位以感测第一驱动单元的阈值电压。
S13，在第二数据写入阶段，第一驱动线输出第一开启信号，第二驱动线输出第二开启信号，第二写入单元在第二驱动线的控制下开启，第二感测单元在第一驱动线的控制下开启，数据线输出的数据电压写入第二驱动单元的控制端，且感测线输出的参考电压写入第二节点。
S14，在第二充电阶段，第二驱动线输出第二关闭信号，且第一驱动线输出第一开启信号，第二写入单元在第二驱动线的控制下关闭，第二感测单元在第一驱动线的控制下开启，第一电源通过第二驱动单元对第二节点充电，以使感测线的电位随第二节点的电位变化。
S15，在第二采样阶段，第二驱动线输出第二关闭信号，且第一驱动线输出第一开启信号，第二写入电路在第二驱动线的控制下关闭，第二感测单元在第一驱动线的控制下开启，通过外部电路读取感测线的电位以感测第二驱动单元的阈值电压。
需要说明的是，前述对像素电路实施例的解释说明也适用于本发明实施例的像素电路的驱动方法，此处不再赘述。
综上，根据本发明实施例提出的像素电路的驱动方法，在显示模式的第一阶段，第一驱动线输出第一开启信号，第一写入单元在第一驱动线的控制下开启，以对第一驱动单元的控制端进行预充电；在显示模式的第二阶段，第一驱动线输出第一开启信号，第二驱动线输出第二开启信号，第一写入单元在第一驱动线的控制下开启，以将数据线的第一数据电压写入第一驱动单元的控制端，第二写入单元在第二驱动线的控制下开启，以对第二驱动单元的控制端进行预充电；在显示模式的第三阶段，第一驱动线输出第一关闭信号，第二驱动线输出第二开启信号，第一写入单元在第一驱动线的控制下关闭，以维持第一驱动单元的控制端的电位，且第二写入单元在第二驱动线的控制下开启，以将数据线的第二数据电压写入第二驱动单元的控制端；在显示模式的第四阶段，第一驱动线输出第一关闭信号，第二驱动线输出第二关闭信号，第一写入单元在第一驱动线的控制下关闭，且第一感测单元在第二驱动线的控制下关闭，以使第一驱动单元驱动第一发光单元发光，第二写入单元在第二驱动线的控制下关闭，且第二感测单元在第一驱动线的控制下关闭，以使第二驱动单元驱动第二发光单元发光。由此，本发明实施例的像素电路的驱动方法，将第一像素子电路中的第一写入单元与第二像素子电路中的第二感测单元连接在一条驱动线上，第二像素子电路中的第二写入单元与第一像素子电路中的第一感测单元连接在另一条驱动线上，使得每个像素子电路需要一条栅极驱动线，从而，可减少栅极驱动电路输出端的个数，进而减小显示面板的边框。
在本发明的描述中，需要理解的是，术语“中心”、“纵向”、“横向”、“长度”、“宽度”、“厚度”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”“内”、“外”、“顺时针”、“逆时针”、“轴向”、“径向”、“周向”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本发明和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本发明的限制。
此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括至少一个该特征。在本发明的描述中，“多个”的含义是至少两个，例如两个，三个等，除非另有明确具体的限定。
在本发明中，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”、“固定”等术语应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或成一体；可以是机械连接，也可以是电连接；可以是直接相连，也可以通过中间媒介间接相连，可以是两个元件内部的连通或两个元件的相互作用关系，除非另有明确的限定。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本发明中的具体含义。
在本发明中，除非另有明确的规定和限定，第一特征在第二特征“上”或“下”可以是第一和第二特征直接接触，或第一和第二特征通过中间媒介间接接触。而且，第一特征在第二特征“之上”、“上方”和“上面”可是第一特征在第二特征正上方或斜上方，或仅仅表示第一特征水平高度高于第二特征。第一特征在第二特征“之下”、“下方”和“下面”可以是第一特征在第二特征正下方或斜下方，或仅仅表示第一特征水平高度小于第二特征。
在本说明书的描述中，参考术语“一个实施例”、“一些实施例”、“示例”、“具体示例”、或“一些示例”等的描述意指结合该实施例或示例描述的具体特征、结构、材料或者特点包含于本发明的至少一个实施例或示例中。在本说明书中，对上述术语的示意性表述不必须针对的是相同的实施例或示例。而且，描述的具体特征、结构、材料或者特点可以在任一个或多个实施例或示例中以合适的方式结合。此外，在不相互矛盾的情况下，本领域的技术人员可以将本说明书中描述的不同实施例或示例以及不同实施例或示例的特征进行结合和组合。
尽管上面已经示出和描述了本发明的实施例，可以理解的是，上述实施例是示例性的，不能理解为对本发明的限制，本领域的普通技术人员在本发明的范围内可以对上述实施例进行变化、修改、替换和变型。

Claims (13)

1.一种像素电路，其特征在于，包括：
第一驱动线、第二驱动线、数据线和感测线；
第一像素子电路，所述第一像素子电路位于像素阵列的奇数行，所述第一像素子电路包括第一写入单元、第一感测单元和第一驱动单元，所述第一写入单元与所述数据线相连，所述第一感测单元与所述感测线相连，所述第一驱动单元与第一发光单元相连以驱动所述第一发光单元发光，其中，所述像素阵列以所述像素电路为单位构造；
第二像素子电路，所述第二像素子电路位于所述像素阵列的偶数行，所述第二像素子电路包括第二写入单元、第二感测单元和第二驱动单元，所述第二写入单元与所述数据线相连，所述第二感测单元与所述感测线相连，所述第二驱动单元与第二发光单元相连以驱动所述第二发光单元发光；
其中，所述第一写入单元与所述第二感测单元连接所述第一驱动线，以在所述第一驱动线的控制下同时开启或关闭，所述第二写入单元与所述第一感测单元连接所述第二驱动线，以在所述第二驱动线的控制下同时开启或关闭。
2.根据权利要求1所述的像素电路，其特征在于，
所述第一写入单元的第一端与所述数据线相连，所述第一写入单元的控制端与所述第一驱动线相连，所述第一感测单元的第一端与所述感测线相连，所述第一感测单元的控制端与所述第二驱动线相连，所述第一驱动单元的控制端与所述第一写入单元的第二端相连，所述第一驱动单元的第一端与第一电源相连，所述第一驱动单元的第二端与所述第一感测单元的第二端相连，所述第一驱动单元的第二端还与所述第一发光单元相连；
所述第二写入单元的第一端与所述数据线相连，所述第二写入单元的控制端与所述第二驱动线相连，所述第二感测单元的第一端与所述感测线相连，所述第二感测单元的控制端与所述第一驱动线相连，所述第二驱动单元的控制端与所述第二写入单元的第二端相连，所述第二驱动单元的第一端与所述第一电源相连，所述第二驱动单元的第二端与所述第二感测单元的第二端相连，所述第二驱动单元的第二端还与所述第二发光单元相连。
3.根据权利要求2所述的像素电路，其特征在于，
所述第一写入单元包括第一写入晶体管，所述第一写入晶体管的第一端与所述数据线相连，所述第一写入晶体管的控制端与所述第一驱动线相连，所述第一写入晶体管的第二端与所述第一驱动单元的控制端相连；
所述第二写入单元包括第二写入晶体管，所述第二写入晶体管的第一端与所述数据线相连，所述第二写入晶体管的控制端与所述第二驱动线相连，所述第二写入晶体管的第二端与所述第二驱动单元的控制端相连。
4.根据权利要求2所述的像素电路，其特征在于，
所述第一感测单元包括第一感测晶体管，所述第一感测晶体管的第一端与所述第一驱动单元的第二端相连，所述第一感测晶体管的第二端与所述感测线相连，所述第一感测晶体管的控制端与所述第二驱动线相连；
所述第二感测单元包括第二感测晶体管，所述第二感测晶体管的第一端与所述第二驱动单元的第二端相连，所述第二感测晶体管的第二端与所述感测线相连，所述第二感测晶体管的控制端与所述第一驱动线相连。
5.根据权利要求2所述的像素电路，其特征在于，
所述第一驱动单元包括第一驱动晶体管和第一存储电容，所述第一驱动晶体管的第一端与第一电源相连，所述第一驱动晶体管的第二端与所述第一发光单元的一端相连，所述第一发光单元的另一端与第二电源相连，所述第一驱动晶体管的控制端与所述第一写入单元相连，所述第一存储电容的一端与所述第一驱动晶体管的控制端相连，所述第一存储电容的另一端与所述第一驱动晶体管的第二端相连；
所述第二驱动单元包括第二驱动晶体管和第二存储电容，所述第二驱动晶体管的第一端与所述第一电源相连，所述第二驱动晶体管的第二端与所述第二发光单元的一端相连，所述第二发光单元的另一端与所述第二电源相连，所述第二驱动晶体管的控制端与所述第二写入单元相连，所述第二存储电容的一端与所述第二驱动晶体管的控制端相连，所述第二存储电容的另一端与所述第二驱动晶体管的第二端相连。
6.根据权利要求1-5中任一项所述的像素电路，其特征在于，所述第一驱动线和所述第二驱动线分别与栅极驱动电路中相邻两行的栅极驱动单元的输出端相连。
7.一种显示面板，其特征在于，包括像素阵列，其中，所述像素阵列以如权利要求1-6中任一项所述的像素电路为单位构造。
8.根据权利要求7所述的显示面板，其特征在于，所述像素电路中的第一像素子电路位于所述像素阵列的奇数行，所述像素电路中的第二像素子电路位于所述像素阵列的偶数行。
9.一种电子设备，其特征在于，包括根据权利要求7或8所述的显示面板。
10.一种像素电路的驱动方法，其特征在于，用于驱动如权利要求1-6中任一项所述的像素电路，所述像素电路的工作模式包括显示模式，所述方法包括以下步骤：
在所述显示模式的第一阶段，所述第一驱动线输出第一开启信号，所述第一写入单元在所述第一驱动线的控制下开启，以对所述第一驱动单元的控制端进行预充电；
在所述显示模式的第二阶段，所述第一驱动线输出所述第一开启信号，所述第二驱动线输出第二开启信号，所述第一写入单元在所述第一驱动线的控制下开启，以将所述数据线的第一数据电压写入所述第一驱动单元的控制端，所述第二写入单元在所述第二驱动线的控制下开启，以对所述第二驱动单元的控制端进行预充电；
在所述显示模式的第三阶段，所述第一驱动线输出第一关闭信号，所述第二驱动线输出所述第二开启信号，所述第一写入单元在所述第一驱动线的控制下关闭，以维持所述第一驱动单元的控制端的电位，且所述第二写入单元在所述第二驱动线的控制下开启，以将所述数据线的第二数据电压写入所述第二驱动单元的控制端；
在所述显示模式的第四阶段，所述第一驱动线输出所述第一关闭信号，所述第二驱动线输出第二关闭信号，所述第一写入单元在所述第一驱动线的控制下关闭，且所述第一感测单元在所述第二驱动线的控制下关闭，以使所述第一驱动单元驱动所述第一发光单元发光，所述第二写入单元在所述第二驱动线的控制下关闭，且所述第二感测单元在所述第一驱动线的控制下关闭，以使所述第二驱动单元驱动所述第二发光单元发光。
11.根据权利要求10所述的像素电路的驱动方法，其特征在于，所述像素电路的工作模式包括感测模式，其中，
在所述感测模式的数据写回阶段，所述第一驱动线输出所述第一开启信号，所述第二驱动线输出第二开启信号，所述第一写入单元和所述第二感测单元在所述第一驱动线的控制下开启，所述第一感测单元和所述第二写入单元在所述第二驱动线的控制下开启，所述数据线输出的数据电压同时写入所述第一驱动单元的控制端和所述第二驱动单元控制端，且所述感测线输出的参考电压同时写入第一节点和第二节点，其中，所述第一驱动单元和所述第一发光单元与所述第一节点相连，所述第二驱动单元和所述第二发光单元与所述第二节点相连。
12.根据权利要求11所述的像素电路的驱动方法，其特征在于，在所述感测模式的数据写回阶段之前，还包括第一数据写入阶段、第一充电阶段、第一采样阶段、第二数据写入阶段、第二充电阶段和第二采样阶段，其中，所述方法还包括：
在所述第一数据写入阶段，所述第一驱动线输出所述第一开启信号，所述第二驱动线输出第二开启信号，所述第一写入单元在所述第一驱动线的控制下开启，所述第一感测单元在所述第二驱动线的控制下开启，所述数据线输出的数据电压写入所述第一驱动单元的控制端，且所述感测线输出的参考电压写入所述第一节点；
在所述第一充电阶段，所述第一驱动线输出所述第一关闭信号，且所述第二驱动线输出第二开启信号，所述第一写入单元在所述第一驱动线的控制下关闭，所述第一感测单元在所述第二驱动线的控制下开启，第一电源通过所述第一驱动单元对所述第一节点充电，以使所述感测线的电位随所述第一节点的电位变化；
在所述第一采样阶段，所述第一驱动线输出所述第一关闭信号，且所述第二驱动线输出第二开启信号，所述第一写入单元在所述第一驱动线的控制下关闭，所述第一感测单元在所述第二驱动线的控制下开启，通过外部电路读取所述感测线的电位以感测所述第一驱动单元的阈值电压；
在所述第二数据写入阶段，所述第一驱动线输出所述第一开启信号，所述第二驱动线输出第二开启信号，所述第二写入单元在所述第二驱动线的控制下开启，所述第二感测单元在所述第一驱动线的控制下开启，所述数据线输出的数据电压写入所述第二驱动单元的控制端，且所述感测线输出的参考电压写入所述第二节点；
在所述第二充电阶段，所述第二驱动线输出所述第二关闭信号，且所述第一驱动线输出第一开启信号，所述第二写入单元在所述第二驱动线的控制下关闭，所述第二感测单元在所述第一驱动线的控制下开启，所述第一电源通过所述第二驱动单元对所述第二节点充电，以使所述感测线的电位随所述第二节点的电位变化；
在所述第二采样阶段，所述第二驱动线输出所述第二关闭信号，且所述第一驱动线输出第一开启信号，所述第二写入电路在所述第二驱动线的控制下关闭，所述第二感测单元在所述第一驱动线的控制下开启，通过所述外部电路读取所述感测线的电位以感测所述第二驱动单元的阈值电压。
13.根据权利要求10所述的像素电路的驱动方法，其特征在于，在所述显示模式的第三阶段，还根据所述第二发光单元的跨压对所述第二数据电压进行补偿。
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