CN110164379B - 显示装置 - Google Patents

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Abstract

本申请提供了一种显示装置。显示装置的栅极驱动装置可包括电压发生器、栅极控制器和栅极驱动器。电压发生器可生成在栅极导通电压与栅极截止电压之间变化的栅极驱动电压。栅极控制器可基于栅极驱动电压和栅极控制信号生成栅极时钟信号。栅极驱动器可基于栅极时钟信号生成栅极信号。栅极控制信号可包括第一控制信号和时钟控制信号，第一控制信号和时钟控制信号中的每个均在高电平与低电平之间变化。当第一控制信号和时钟控制信号均以低电平提供至栅极控制器时，栅极控制器可输出具有栅极截止电压的电压电平的栅极时钟信号，从而避免在其它情况下可能出现的因电压斜升而导致的显示缺陷。

Description

显示装置
技术领域
示例性实施方式总体涉及栅极驱动装置和具有该栅极驱动装置的显示装置，并且更具体地，涉及向显示面板提供处于不同相位处的多个栅极时钟信号的栅极驱动装置。
背景技术
近年来，技术的进步使得平板显示(FPD)装置激增，以实现更高的分辨率、更好的图像质量、降低的功耗、纤薄的轮廓和降低了成本的制造进步。FPD装置的示例包括液晶显示(LCD)装置、场发射显示(FED)装置、等离子体显示面板(PDP)装置和有机发光显示(OLED)装置。
FPD装置包括显示图像的显示面板和驱动显示面板的驱动器。例如，LCD装置可包括液晶显示面板，该液晶显示面板包括形成在多个数据线和多个栅极线的交叉区域中的像素、向栅极线输出栅极信号的栅极驱动电路以及向数据线输出数据信号的数据驱动电路。
近来，为了减小显示面板的尺寸并且为了提高生产力，使用将栅极驱动电路集成在衬底上的方法。可通过在显示面板的衬底上直接形成栅极驱动电路来减少显示装置的部件的数量、体积和生产成本。
发明内容
公开了具有能够相对于传统显示装置改善显示质量的栅极驱动装置的显示装置的实施方式。
根据一方面，显示装置可包括显示面板、电压发生器、栅极控制器、栅极驱动器、数据驱动器和时序控制器，其中：显示面板包括多个栅极线、与栅极线交叉的多个数据线以及联接至栅极线和数据线的多个像素；电压发生器配置成生成在栅极导通电压与栅极截止电压之间变化的栅极驱动电压；栅极控制器配置成基于栅极驱动电压和栅极控制信号生成栅极时钟信号；栅极驱动器配置成基于栅极时钟信号生成栅极信号并将栅极信号提供至栅极线；数据驱动器配置成将数据信号提供至数据线；时序控制器配置成将栅极控制信号提供至栅极控制器，并将数据控制信号提供至数据驱动器。栅极控制信号可包括第一控制信号和时钟控制信号，第一控制信号和时钟控制信号的每个均在高电平与低电平之间变化。当第一控制信号和时钟控制信号均以低电平提供至栅极控制器时，栅极控制器可输出具有栅极截止电压的电压电平的栅极时钟信号。
在各种示例性实施方式中：
时钟控制信号可包括第一时钟控制信号和第二时钟控制信号，并且栅极控制器可基于栅极驱动电压和第一控制信号生成栅极启动信号，基于栅极驱动电压和第一时钟控制信号生成第一时钟信号和第一时钟条信号，并基于栅极驱动电压和第二时钟控制信号生成第二时钟信号和第二时钟条信号。
当第一控制信号、第一时钟控制信号和第二时钟控制信号以低电平被提供至栅极控制器时，栅极控制器可输出具有栅极截止电压的电压电平的第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号。
栅极控制器可包括第一或门和第二或门，其中，第一或门配置成执行第一时钟控制信号和第二时钟控制信号的逻辑运算；第二或门配置成执行第一控制信号和第一或门的输出信号的逻辑运算。
栅极控制器可在帧的消隐时段中输出具有栅极截止电压的电压电平的第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号。
当时序控制器在故障模式中进行操作时，栅极控制器可以以栅极截止电压的电压电平输出第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号。
栅极控制器可在帧的消隐时段中基于具有低电平的消隐信号输出具有栅极截止电压的电压电平的第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号。
栅极驱动器可基于第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号生成栅极信号。
第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号中的每个可在栅极导通电压与栅极截止电压之间摆动。
栅极控制器可在帧的消隐时段中输出具有栅极截止电压的电压电平的栅极时钟信号。
当时序控制器在故障模式中进行操作时，栅极控制器可以以栅极截止电压的电压电平输出栅极时钟信号。
根据一方面，栅极驱动装置可包括电压发生器、栅极控制器和栅极驱动器，其中：电压发生器配置成生成包括栅极导通电压和栅极截止电压的栅极驱动电压；栅极控制器配置成基于栅极驱动电压和栅极控制信号生成栅极时钟信号；栅极驱动器配置成基于栅极时钟信号生成栅极信号。栅极控制信号可包括第一控制信号和时钟控制信号。当具有低电平的第一控制信号和时钟控制信号被提供至栅极控制器时，栅极控制器输出具有栅极截止电压的电压电平的栅极时钟信号。
因此，栅极驱动装置和具有该栅极驱动装置的显示装置可包括生成栅极信号的栅极驱动器和生成控制栅极驱动器的栅极时钟信号的栅极控制器。当第一控制信号和时钟控制信号以低电平被提供至栅极控制器时，栅极控制器可以以栅极截止电压的电压电平输出栅极时钟信号，以防止因栅极导通电压和栅极截止电压的电荷共享而导致的栅极时钟信号的电压电平增加。因此，可改善显示装置的显示质量。
在另一方面，栅极控制器可包括：(i)检测电路，该检测电路配置成检测消隐时段和故障模式中的至少一个的开始并提供指示消隐时段和故障模式中的至少一个的开始的输出信号；以及(ii)栅极时钟设置电路，该栅极时钟设置电路配置成响应于通过其接收的控制信号生成多个栅极时钟信号。如果输出信号表示消隐时段或故障模式已经开始，则栅极时钟设置电路可将栅极时钟信号中的每个设置为栅极截止电压电平。
附图说明
通过以下结合附图的详细描述，将更清楚地理解说明性的非限制性示例性实施方式，其中，相同的附图标记表示相同的元件或相同的操作，在附图中：
图1是示出了根据示例性实施方式的显示装置的框图。
图2是示出了用于描述现有技术装置中包括的栅极控制器的操作的时序图。
图3是示出了包括在图1的显示装置中的栅极驱动器的示例的图。
图4A是示出了可包括在图1中所示的栅极控制器内的检测电路的示例的图。
图4B是示出了图1的栅极控制器内的示例性电路的框图。
图5A和图5B是示出了包括在图1的显示装置中的栅极控制器的操作的示例的相应时序图。
图6是示出了用于描述包括在图1的显示装置中的栅极控制器的操作的另一示例的时序图。
图7是示出了包括图1的显示装置的电子装置的框图。
图8是示出了图7的电子装置被实施为智能电话的示例性实施方式的图。
具体实施方式
在下文中，将参考附图详细解释本发明构思。
图1是示出了根据示例性实施方式的显示装置的框图。图2是示出了现有技术中的栅极控制器的操作的时序图。图3是示出了包括在图1的显示装置中的栅极驱动器的示例的图。
参照图1，显示装置100可包括显示面板110、电压发生器120、栅极控制器130、栅极驱动器140、数据驱动器150和时序控制器160。电压发生器120、栅极控制器130和栅极驱动器140一起构成根据发明构思的栅极驱动装置的示例。
显示面板110可包括多个数据线DL、多个栅极线GL和多个像素PX。栅极线GL可均在第一方向D1上延伸，并在大致垂直于第一方向D1的第二方向D2上相对于彼此布置。数据线DL可在第二方向D2上延伸并在第一方向D1上进行布置。虽然为了清楚地示出，示出了单个栅极线GL、单个数据线DL和单个像素PX，但是可存在n个栅极线GL、m个数据线DL和均电连接至栅极线GL的一个和数据线DL的一个的m×n个像素PX，其中，m和n是针对具体的显示面板配置而设定的整数。第一方向D1可与显示面板110的长边平行，并且第二方向D2可与显示面板110的短边平行。像素PX中的每个可形成在数据线DL和栅极线GL的交叉区域中。在一些示例性实施方式中，像素PX中的每个可包括电联接至栅极线GL和数据线DL的薄膜晶体管、液晶电容器和联接至薄膜晶体管的储存电容器。因此，显示面板110可以是液晶显示面板，并且显示装置100可以是液晶显示装置。在其它示例性实施方式中，像素PX中的每个可包括电联接至栅极线GL和数据线DL的薄膜晶体管、联接至薄膜晶体管的储存电容器、联接至储存电容器的驱动晶体管和联接至驱动晶体管的有机发光二极管。因此，显示面板110可以是有机发光显示面板，并且显示装置100可以是有机发光显示装置。显示面板110可包括显示区DA和非显示区NDA。多个像素PX可形成在显示区DA中。显示区DA中的像素PX可显示图像。用于生成或提供驱动像素PX的信号的电路和线可形成在非显示区NDA中。
电压发生器120可从外部装置接收直流(DC)电压VDD并且生成用于驱动显示面板110的多个电压。电压发生器120可生成提供至栅极控制器130的栅极驱动电压DVG、提供至数据驱动器150的数据驱动电压DVD以及提供至显示面板110的面板驱动电压DVP。栅极驱动电压DVG可在栅极导通电压和栅极截止电压之间摆动。栅极驱动电压DVG是生成施加至栅极线GL的栅极信号的驱动电压。电压发生器120可生成包括模拟电力电压、数字电力电压等数据驱动电压DVD，并将数据驱动电压DVD提供至数据驱动器150。模拟电力电压和/或数字电力电压可构成驱动电压以生成施加至数据线DL的数据信号DS。电压发生器120可生成包括公共电压、储存电压等面板驱动电压DVP，并将面板驱动电压DVP提供至显示面板110。公共电压可以是施加至在像素PX中包括的液晶电容器的驱动电压，并且储存电压可以是施加至像素PX中包括的储存电容器的驱动电压。公共电压和储存电压可以是相同电平的电压。
栅极控制器130可基于栅极驱动电压DVG和栅极控制信号CTLG生成栅极时钟信号CKG。栅极控制器130可从电压发生器120接收栅极驱动电压DVG，栅极驱动电压DVG在栅极导通电压与栅极截止电压之间摆动。栅极控制器130可接收栅极控制信号CTLG，栅极控制信号CTLG包括第一控制信号(即，竖直启动信号)和时钟控制信号。栅极控制器130可响应于从时序控制器160提供的第一控制信号，使用栅极导通电压和栅极截止电压生成栅极启动信号。
栅极控制器130可响应于从时序控制器160提供的时钟控制信号，使用栅极导通电压和栅极截止电压生成时钟信号和时钟条信号。栅极控制器130可从时序控制器160接收至少一个时钟控制信号。例如，栅极控制器130可从时序控制器160接收第一时钟控制信号和第二时钟控制信号。可选地，栅极控制器130可包括信号发生器，从时序控制器160接收一个时钟控制信号，并通过信号发生器生成第一时钟控制信号和第二时钟控制信号。第二时钟控制信号可以是从第一时钟控制信号延迟的信号。
栅极控制器130可响应于第一时钟控制信号使用栅极导通电压和栅极截止电压来生成第一时钟信号和第一“时钟条”信号(第一时钟信号的反相信号)。栅极控制器130可响应于第二时钟控制信号使用栅极导通电压和栅极截止电压生成第二时钟信号和第二“时钟条”信号(第二时钟信号的反相信号)。第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号中的每个可在栅极导通电压与栅极截止电压之间摆动。第一时钟信号和第二时钟信号可在相位上偏移，并且可被用于驱动显示面板不同的相应栅极线区域。由于数据信号到达显示面板的不同区域的不同的传播延迟，这允许栅极信号与数据信号更好的同步。应注意的是，在其它实施方式中，可生成更多数量的栅极时钟信号，诸如用于驱动四个相应的栅极线区域的四个栅极时钟信号(以及四个栅极时钟条信号)。
参照图2，栅极启动信号STVP可在帧的起始时序处激活，其中，帧的起始时序与该帧的活跃时段AP的起始一致。在活跃时段AP期间，当栅极线GL经由栅极时钟信号CKG被顺序地激活时，数据电压被逐行地施加至像素PX。栅极启动信号STVP是响应于第一控制信号STV而具有栅极导通电压H2的脉冲信号。栅极启动信号STVP可以在活跃时段AP的其余时段期间以及在整个帧的消隐时段BP期间具有栅极截止电压L2。这里，栅极截止电压L2可低于第一控制信号STV的低电平L1，并且栅极导通电压H2可高于第一控制信号STV的高电平H1。
第一时钟控制信号CPV1和第二时钟控制信号CPV2可在活跃时段AP期间在高电平H1与低电平L1之间摆动，并且在消隐时段BP期间具有低电平L1。在活跃时段AP期间，第一时钟信号CKV1和第一时钟条信号CKVB1可响应于第一时钟控制信号CPV1在栅极导通电压H2与栅极截止电压L2之间摆动。这里，第一时钟信号CKV1和第一时钟条信号CKVB1可具有相反的相位。在活跃时段AP期间，第二时钟信号CKV2和第二时钟条信号CKVB2可响应于第二时钟控制信号CPV2在栅极导通电压H2与栅极截止电压L2之间摆动。这里，第二时钟信号CKV2和第二时钟条信号CKVB2可具有相反的相位。
缩写词
在下文中，为了解释的简洁和清楚，可使用以下相应短语的缩写：
CKV1-“第一时钟信号CKV1”；
CKVB1-“第一时钟条信号CKVB1”；
CKV2-“第二时钟信号CKV2”；
CKVB2-“第二时钟条信号CKVB2”；
CKV信号-“第一时钟信号CKV1、第一时钟条信号CKVB1、第二时钟信号CKV2和第二时钟条信号CKVB2”；
CPV1-“第一时钟控制信号CPV1”；
CPV2-“第二时钟控制信号CPV2”；
STV-“第一控制信号STV”；
L1-“低电平L1”；
H1-“高电平H1”；
L2-“栅极截止电压L2”；
H2-“栅极导通电压H2”；
VOUT-“输出信号VOUT”；
STVP-“栅极启动信号STVP”。
仍然参照图2，CKV信号的栅极截止电压L2可低于CPV1和CPV2的低电平L1。CKV信号的栅极导通电压H2可高于CPV1和CPV2的高电平H1。
如图2中的区域“A”中所示，在消隐时段BP期间，在现有技术中，CKV信号可均具有在该时段期间连续斜升的时变电压电平。该电压变化是由于在进行消隐时段BP的时刻栅极控制器130中的栅极导通电压H2和栅极截止电压L2的电荷共享而产生的。当CKV信号的电压电平斜升超过特定水平时，栅极驱动器140可响应于该CKV信号而被无意地操作。因此，不需要的电压可能被施加至像素PX，从而导致在消隐时段BP中显示缺陷被显示在显示面板110上。
如下面详细描述的，根据发明构思的实施方式的显示装置100可通过输出包括具有栅极截止电压L2的CKV信号的栅极时钟信号CKG来防止在消隐时段BP中显示缺陷被显示在显示面板110上。即，当第一控制信号STV、第一时钟控制信号CPV1和第二时钟控制信号CPV2中的每个下降至低电平L1时，CKV信号保持成栅极截止电压L2，这种情况发生在消隐时段BP的开始时或发生在稍后讨论的“故障模式”期间。
因此，如稍后将结合图5A所见，例如，当处于低电平L1处的STV、CPV1和CPV2中的每个被提供至栅极控制器130时，栅极控制器130可输出具有栅极截止电压L2的CKV信号。栅极控制器130可具有如下面结合图4A所述的用于检测该情况的合适电路。
暂时参照图5A，在实施方式中，在帧的消隐时段BP中，处于低电平L1处的STV、CPV1和CPV2中的每个可被提供至栅极控制器130。栅极控制器130可在下一活跃时段AP开始之前的消隐时段BP期间基于具有低电平L1的STV、CPV1和CPV2生成具有栅极截止电压L2的CKV信号。
暂时参照图5B，在另一实施方式或操作条件中，当时序控制器160在因活跃时段AP中的频率变化、静电放电(ESD)等而导致的故障模式中操作时，STV、CPV1和CPV2中的每个可在低电平L1处被提供至栅极控制器130。在这种情况下，栅极控制器130可在STV、CPV1和CPV2全部上升到高电平H1之前，基于处于低电平L1处的STV、CPV1和CPV2生成具有栅极截止电压L2的CKV信号。在另一实施方式中(在图6中示出)，栅极控制器130可在消隐时段BP中基于具有低电平L1的消隐信号输出具有栅极截止电压L2的CKV信号。例如，消隐信号可从时序控制器160提供。此外，消隐信号可将CKV信号掩码为栅极截止电压L2。下面，将参照图4A至图6详细描述栅极控制器130。
栅极驱动器140可基于栅极时钟信号CKG生成栅极信号，并通过栅极线GL将栅极信号提供至像素PX。栅极驱动器140可形成在显示面板110的非显示区NDA中。栅极驱动器140可顺序输出与栅极启动信号STVP、第一时钟信号CKV1、第一时钟条信号CKVB1、第二时钟信号CKV2和第二时钟条信号CKVB2同步的多个栅极信号。
参照图3，栅极驱动器140可包括多个级，例如，第一级142、第二级144和第三级146。每个级可接收包括栅极启动信号STVP、第一时钟信号CKV1、第一时钟条信号CKVB1、第二时钟信号CKV2和第二时钟条信号CKVB2的栅极时钟信号CKG。第一级142、第二级144和第三级146中的每个可电联接至栅极线GL的一个端子。第一级142可响应于STVP、CKV1和CKV2生成提供至第一栅极线GL1的第一栅极信号GS1。第二级144可响应于从第一级142提供的进位信号、CKVB1和CKVB2生成提供至第二栅极线GL2的第二栅极信号GS2。第三级146可响应于从第二级144提供的进位信号、CKV1和CKV2生成提供至第三栅极线GL3的第三栅极信号GS3。栅极驱动器140的其它级(未示出，直到第N级，其中N是任何整数)可使用相同的方法顺序地提供栅极信号。
这里应注意的是，在图1中，电压发生器120、栅极控制器130和栅极驱动器140被示出为单独的元件。在实施方式中，电压发生器120、栅极控制器130和栅极驱动器140可被集成至公共的栅极驱动装置(例如，集成电路)。
数据驱动器150可通过数据线DL将数据信号DS提供至像素PX。数据驱动器150可基于从时序控制器160提供的数据控制信号CTLD和第二图像数据RGB2生成数据信号DS。数据控制信号CTLD可包括水平启动信号和数据时钟信号。数据驱动器150可响应于从时序控制器160提供的水平启动信号和数据时钟信号，将与第二图像数据RGB2对应的数据信号DS输出至显示面板110的数据线DL。
时序控制器160可生成控制栅极控制器130的栅极控制信号CTLG和控制数据驱动器150的数据控制信号CTLD。时序控制器160可将从外部装置提供的第一图像数据RGB1转换成第二图像数据RGB2，并生成控制第一图像数据RGB1的驱动时序的栅极控制信号CTLG和数据控制信号CTLD。时序控制器160可从外部装置接收控制信号CON，并生成包括STV、CPV1和CPV2的栅极控制信号CTLG。此外，时序控制器160可生成包括水平启动信号和数据时钟信号的数据控制信号CTLD。时序控制器160可将包括STV、CPV1和CPV2的栅极控制信号CTLG提供至栅极控制器130，并将包括水平启动信号和数据时钟信号的数据控制信号CTLD提供至数据驱动器150。
如上所述，图1的显示装置100可包括生成栅极信号的栅极驱动器140和生成控制栅极驱动器140的栅极时钟信号CKG的栅极控制器130。当具有低电平L1的第一控制信号STV、第一时钟控制信号CPV1和第二时钟控制信号CPV2被提供至栅极控制器130时，栅极控制器130可输出具有栅极截止电压L2的栅极时钟信号CKG。因此，可防止因栅极导通电压H2和栅极截止电压L2的电荷共享而导致的栅极时钟信号CKG的CKV信号的电压电平的斜升。因此，可改善显示面板110的显示质量。
图4A是示出了图1的显示装置100中的栅极控制器130内包括的检测电路400的示例的图。检测电路400可配置成基于STV、CPV1和CPV2的值输出具有逻辑电平的输出信号VOUT。当STV、CPV1和CPV2中的全部都处于逻辑低电平L1处时，检测电路400将该条件检测为消隐时段BP或故障模式的起始，并以第一逻辑电平(例如，逻辑低)输出VOUT。否则，VOUT以相反的逻辑电平输出。
检测电路400可包括第一或(OR)门132和第二或门134。第一或门132可对CPV1和CPV2执行逻辑运算。即，第一或门132可在CPV1和CPV2中的每个都是逻辑低(L1)时输出具有低电平的信号，并在CPV1和CPV2中的至少一个处于逻辑高(例如，H1)处时输出具有高电平的信号。如上文所提及的，在其它实施方式中，N个时钟信号(例如，四个时钟信号)可提供至显示面板的不同栅极线区域。在这种情况下，第一或门132可接收第一时钟控制信号至第N时钟控制信号。第一或门132可在第一时钟控制信号至第N时钟控制信号具有低电平时输出具有低电平的信号，并在第一时钟控制信号至第N时钟控制信号中的至少一个具有高电平时输出具有高电平的信号。
第二或门134可执行第一控制信号STV和第一或门132的输出信号的逻辑运算。即，第二或门134可在第一控制信号STV和第一或门132的输出信号具有低电平时输出具有低电平的信号作为输出信号VOUT，并在第一控制信号STV和第一或门132的输出信号中的至少一个具有高电平时输出具有高电平的信号作为输出信号VOUT。当第二或门134的输出信号VOUT为低电平时，栅极控制器130可以以栅极截止电压L2的电压电平输出CKV信号。
应注意的是，可使用其它逻辑门配置来实现检测电路400的输入-输出逻辑结果。例如，可用采用不同类型的逻辑门(诸如，与(AND)门、与非(NAND)门或者或非(NOR)门)的逻辑电路来替换。
图4B是示出了图1的栅极控制器130内的示例性电路的框图。栅极控制器130可包括消隐时段/故障模式起始检测电路410，消隐时段/故障模式起始检测电路410检测消隐时段BP或者故障模式中的任一个的起始，并提供具有表示消隐时段BP或者故障模式中的任一个的起始的电压电平的输出信号VOUT。消隐时段/故障模式起始检测电路410的一个示例是检测电路400。消隐时段/故障模式起始检测电路410接收STV、CPV1和CPV2作为输入。如针对检测电路400所解释的，当STV、CPV1和CPV2全部都处于低电平L1时VOUT可以是第一逻辑电平，否则，VOUT可以是第二逻辑电平。输出电压VOUT可被提供至CKV信号设置电路420，CKV信号设置电路420还接收STV、CPV1和CPV2作为输入。如果VOUT表示消隐时段BP或故障模式已经开始，则CKV信号设置电路420将CKV1、CKVB1、CKV2和CKVB2中的每个的电平设置成栅极截止电压L2。只要VOUT处于第一逻辑电平处(即，只要STV、CPV1和CPV2都处于低电平L1处)，则CKV信号设置电路420将这些电平保持在栅极截止电压L2处。如果STV、CPV1和CPV2中的任一个处于高电平H1处，则CKV信号设置电路420基于STV、CPV1和CPV2以其正常电平输出CKV信号。
图5A和图5B是用于描述栅极控制器130的相应操作的示例的时序图。在图5A和图5B的示例中，当以低电平L1将第一控制信号STV、第一时钟控制信号CPV1和第二时钟控制信号CPV2提供至栅极控制器130时，栅极控制器130可以以栅极截止电压L2输出CKV信号，即，以栅极截止电压L2输出第一时钟信号CKV1、第一时钟条信号CKVB1、第二时钟信号CKV2和第二时钟条信号CKVB2。
在图5A中，STV、CPV1、CPV2和STVP具有与上文针对图2描述的相同的波形。栅极控制器130可响应于第一控制信号STV生成具有栅极导通电压H2和栅极截止电压L2的栅极启动信号STVP，响应于CPV1生成在栅极导通电压H2与栅极截止电压L2之间摆动的CKV1和CKVB1，并响应于CPV2生成在栅极导通电压H2与栅极截止电压L2之间摆动的CKV2和CKVB2。STV、CPV1和CPV2可在帧的消隐时段BP中以低电平L1提供至栅极控制器130。在如上文针对图2描述的现有技术显示装置中，CKV信号的电压电平可能在进行提供具有低电平L1的CPV1和CPV2的时刻因栅极导通电压H2和栅极截止电压L2的电荷共享而斜升。然而，根据发明构思，如图5A中所示，栅极控制器130可在消隐时段BP期间生成具有栅极截止电压L2的CKV信号。因此，可在消隐时段BP期间防止因CKV信号的电压电平的斜升而导致的栅极驱动器的操作。此后，栅极控制器130可生成与CPV1对应的CKV1和CKVB1，并在消隐时段BP之后响应于具有高电平H1的第一控制信号STV生成与CPV2对应的CKV2和CKVB2。
参照图5B，具有高电平H1的第一控制信号STV以及在高电平H1与低电平L1之间摆动的第一时钟控制信号CPV1和第二时钟控制信号CPV2可在帧的活跃时段AP中被提供至栅极控制器130。当时序控制器160由于帧频率的变化或外部冲击(例如，静电放电)而在故障模式中操作时，具有低电平L1的第一时钟控制信号CPV1和第二时钟控制信号CPV2可被提供至栅极控制器130。在现有技术的显示装置中，CKV信号的电压电平可在进行提供具有低电平L1的第一时钟控制信号CPV1和第二时钟控制信号CPV2时刻由于栅极导通电压H2和栅极截止电压L2的电荷共享而斜升。根据发明构思，如图5B中所示，当STV、CPV1和CPV2全部以低电平L1被提供至栅极控制器130时，栅极控制器130可生成具有栅极截止电压L2的CKV信号。因此，在以低电平L1提供STV、CPV1和CPV2的故障模式期间可防止因CKV信号的电压电平的斜升而导致的栅极驱动器140的操作。此后，栅极控制器130可在提供在高电平H1与低电平L1之间摆动的CPV1和CPV2时(即，故障模式之后)生成在栅极导通电压H2与栅极截止电压L2之间摆动的CKV信号。
如上所述，根据示例性实施方式的显示装置100可在第一控制信号STV、第一时钟控制信号CPV1和第二时钟控制信号CPV2具有低电平L1时，生成具有栅极截止电压L2的第一时钟信号CKV1、第一时钟条信号CKVB1、第二时钟信号CKV2和第二时钟条信号CKVB2，从而可防止CKV信号的斜升以及因CKV信号的斜升而导致的栅极驱动器的操作。因此，显示缺陷可不被显示在显示面板上。
图6是示出了用于描述包括在图1的显示装置中的栅极控制器的操作的另一示例的时序图。
参照图6，栅极控制器130可在活跃时段AP中接收具有高电平H1的消隐信号BLANK，并在消隐时段BP中接收具有低电平L1的消隐信号BLANK。可选地，栅极控制器130可包括信号发生器并生成消隐信号BLANK。栅极控制器130可在活跃时段AP中响应于第一控制信号STV生成具有栅极导通电压H2和栅极截止电压L2的栅极启动信号STVP，响应于第一时钟控制信号CPV1生成在栅极导通电压H2与栅极截止电压L2之间摆动的第一时钟信号CKV1和第一时钟条信号CKVB1，并且响应于第二时钟控制信号CPV2生成在栅极导通电压H2与栅极截止电压L2之间摆动的第二时钟信号CKV2和第二时钟条信号CKVB2。栅极控制器130可在消隐时段BP期间接收具有低电平L1的STV、CPV1、CPV2和消隐信号BLANK。栅极控制器130可在将具有高电平H1的消隐信号BLANK提供至栅极控制器130的活跃时段AP期间响应于STV生成具有栅极导通电压H2和栅极截止电压L2的栅极启动信号STVP，响应于CPV1生成在栅极导通电压H2与栅极截止电压L2之间摆动的CKV1和CKVB1，并且响应于CPV2生成在栅极导通电压H2与栅极截止电压L2之间摆动的CKV2和CKVB2。栅极控制器130可在消隐时段BP期间响应于具有低电平L1的消隐信号BLANK生成具有栅极截止电压L2的CKV信号。例如，消隐信号BLANK可以是将CKV信号掩码成栅极截止电压L2的掩码信号。栅极控制器130可在消隐时段BP期间基于具有低电平L1的消隐信号BLANK输出具有栅极截止电压L2的CKV信号，以使得可防止栅极驱动器130的响应于电压电平斜升的CKV信号的操作。
图7是示出了包括图1的显示装置的电子装置的框图。图8是示出了图7的电子装置被实施为智能电话的示例性实施方式的图。
参照图7和图8，电子装置200可包括处理器210、存储器装置220、储存器装置230、输入/输出(I/O)装置240、电源装置250和显示装置260。这里，显示装置260可与图1的显示装置100对应。此外，电子装置200还可包括用于与视频卡、声卡、存储器卡、通用串行总线(USB)装置、其它电子装置等通信的多个端口。应注意的是，智能电话300仅是电子装置200可被使用的许多类型的电子装置的一个示例。
处理器210可执行各种运算功能。处理器210可以是微处理器、中央处理单元(CPU)等。处理器210可经由地址总线、控制总线、数据总线等联接至其它部件。此外，处理器210可联接至扩展总线，诸如，周围的部件互连(PCI)总线。存储器装置220可存储用于电子装置200的操作的数据。例如，存储器装置220可包括至少一个非易失性存储器装置和/或至少一个易失性存储器装置，其中，至少一个非易失性存储器装置诸如可擦除可编程只读存储器(EPROM)装置、电可擦除可编程只读存储器(EEPROM)装置、闪速存储器装置、相变随机存取存储器(PRAM)装置、电阻式随机存取存储器(RRAM)装置、纳米浮栅存储器(NFGM)装置、聚合物随机存取存储器(PoRAM)装置、磁性随机存取存储器(MRAM)装置、铁电随机存取存储器(FRAM)装置等，至少一个易失性存储器装置诸如动态随机存取存储器(DRAM)装置、静态随机存取存储器(SRAM)装置、移动DRAM装置等。储存器装置230可以是固态驱动(SSD)装置、硬盘驱动(HDD)装置、CD-ROM装置等。
I/O装置240可以是诸如键盘、小键盘、触摸板、触摸屏、鼠标等输入装置以及诸如打印机、扬声器等输出装置。在一些示例性实施方式中，显示装置260可包括在I/O装置240中。电源装置250可以为电子装置200的操作提供电力。显示装置260可以通过总线或其它通信链接与其它部件进行通信。
如上所述，显示装置260可包括显示面板、电压发生器、栅极控制器、栅极驱动器、数据驱动器和时序控制器。显示面板可包括多个数据线、多个栅极线和多个像素。电压发生器可接收直流电并生成操作显示面板所需要的多个电压。电压发生器可生成提供至栅极控制器的栅极驱动电压、提供至数据驱动器的数据驱动电压以及提供至显示面板的面板驱动电压。电压发生器可生成包括栅极导通电压和栅极截止电压的栅极驱动电压，并将栅极驱动电压提供至栅极控制器。电压发生器可生成包括模拟电力电压、数字电力电压等数据驱动电压，并将数据驱动电压提供至数据驱动器。栅极控制器可基于栅极驱动电压和栅极控制信号生成栅极时钟信号。栅极控制器可接收包括栅极导通电压和栅极截止电压的栅极驱动电压。栅极控制器可接收包括第一控制信号和时钟控制信号的栅极控制信号。栅极控制器可响应于从时序控制器提供的第一控制信号，使用栅极导通电压和栅极截止电压生成栅极启动信号。栅极控制器可响应于从时序控制器提供的时钟控制信号，使用栅极导通电压和栅极截止电压生成时钟信号和时钟条信号。栅极控制器可在第一控制信号、第一时钟控制信号和第二时钟控制信号以低电平被提供至栅极控制器时输出具有栅极截止电压的第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号。例如，栅极控制器可包括执行第一时钟控制信号和第二时钟控制信号的逻辑运算的第一或门以及执行第一控制信号和第一或门的输出信号的逻辑运算的第二或门。在一些示例性实施方式中，栅极控制器可在帧的消隐时段中基于具有低电平的第一控制信号、第一时钟控制信号和第二时钟控制信号生成具有栅极截止电压的第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号。在其它示例性实施方式中，当时序控制器因在帧的活跃时段中的帧频率的变化、静电放电等而导致在故障模块中进行操作时，栅极控制器可在故障模式中基于具有低电平的第一控制信号、第一时钟控制信号和第二时钟控制信号生成具有栅极截止电压的第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号。在其它示例性实施方式中，栅极控制器可在帧的消隐时段中基于具有低电平的消隐信号输出具有栅极截止电压的第一时钟信号、第一时钟条信号、第二时钟信号和第二时钟条信号。栅极驱动器可基于栅极时钟信号生成栅极信号，并将栅极信号提供至栅极线。数据驱动器可通过数据线将数据信号提供至像素。时序控制器可生成控制栅极控制器的栅极控制信号和控制数据驱动器的数据控制信号。
如上所述，图7的电子装置200可包括具有栅极控制器的显示装置260，其中，栅极控制器在提供具有低电平的第一控制信号和时钟控制信号时输出具有栅极截止电压的栅极时钟信号。因此，显示装置260可防止因栅极导通电压和栅极截止电压的电荷共享而导致的栅极时钟信号的电压电平的增加。因此，可改善包括在电子装置200中的显示装置260的显示质量。
本发明构思可被应用于显示装置和具有该显示装置的电子装置。例如，本发明构思可被应用于计算机监视器、膝上型电脑、数码相机、蜂窝电话、智能电话、智能平板、电视、个人数字助理(PDA)、便携式多媒体播放器(PMP)、MP3播放器、导航系统、游戏机、视频电话等。
上述电压发生器、时序控制器、栅极控制器、栅极驱动器和数据驱动器中的每个都包括硬件电路。正因如此，这些元件中的每个可以可选地被称为电路。这些元件中的任一个可包括存储器和至少一个处理器，该处理器从存储器读取指令以执行其相应的功能。
前述内容是示例性实施方式的说明，并且不应解释为对示例性实施方式的限制。虽然已描述了一些示例性实施方式，但是本领域技术人员将容易理解的是，在不实质上背离本发明构思的新颖教导和有益效果的情况下，可在示例性实施方式中作出许多修改。因此，所有这些修改旨在被包括在如权利要求中限定的本发明构思的范围内。

Claims (10)

1.显示装置，包括：
显示面板，所述显示面板包括多个栅极线、与所述多个栅极线交叉的多个数据线以及联接至所述多个栅极线和所述多个数据线的多个像素；
电压发生器，所述电压发生器配置成生成在栅极导通电压与栅极截止电压之间变化的栅极驱动电压；
栅极控制器，所述栅极控制器配置成基于所述栅极驱动电压和栅极控制信号生成栅极时钟信号，所述栅极时钟信号包括时钟信号和时钟条信号；
栅极驱动器，所述栅极驱动器配置成基于所述栅极时钟信号生成栅极信号，并将所述栅极信号提供至所述多个栅极线；
数据驱动器，所述数据驱动器配置成将数据信号提供至所述多个数据线；以及
时序控制器，所述时序控制器配置成将所述栅极控制信号提供至所述栅极控制器，并将数据控制信号提供至所述数据驱动器，
其中，所述栅极控制信号包括第一控制信号和时钟控制信号，所述第一控制信号和所述时钟控制信号中的每个在高电平与低电平之间变化，以及
其中，当所述第一控制信号和所述时钟控制信号均以所述低电平提供至所述栅极控制器时，所述栅极控制器在帧的消隐时段中输出具有所述栅极截止电压的电压电平的所述栅极时钟信号。
2.根据权利要求1所述的显示装置，其中，所述时钟信号包括第一时钟信号和第二时钟信号，所述时钟条信号包括第一时钟条信号和第二时钟条信号，并且所述时钟控制信号包括第一时钟控制信号和第二时钟控制信号，以及
其中，所述栅极控制器基于所述栅极驱动电压和所述第一控制信号生成栅极启动信号，基于所述栅极驱动电压和所述第一时钟控制信号生成所述第一时钟信号和所述第一时钟条信号，并基于所述栅极驱动电压和所述第二时钟控制信号生成所述第二时钟信号和所述第二时钟条信号。
3.根据权利要求2所述的显示装置，其中，在所述第一控制信号、所述第一时钟控制信号和所述第二时钟控制信号以所述低电平提供至所述栅极控制器时，所述栅极控制器以所述栅极截止电压的所述电压电平输出所述第一时钟信号、所述第一时钟条信号、所述第二时钟信号和所述第二时钟条信号。
4.根据权利要求2所述的显示装置，其中，所述栅极控制器包括：
第一或门，所述第一或门配置成执行所述第一时钟控制信号和所述第二时钟控制信号的逻辑运算；以及
第二或门，所述第二或门配置成执行所述第一控制信号和所述第一或门的输出信号的逻辑运算。
5.根据权利要求2所述的显示装置，其中，所述栅极控制器在所述帧的所述消隐时段中以所述栅极截止电压的所述电压电平输出所述第一时钟信号、所述第一时钟条信号、所述第二时钟信号和所述第二时钟条信号。
6.根据权利要求2所述的显示装置，其中，当所述时序控制器在故障模式中操作时，所述栅极控制器输出具有所述栅极截止电压的所述电压电平的所述第一时钟信号、所述第一时钟条信号、所述第二时钟信号和所述第二时钟条信号。
7.根据权利要求2所述的显示装置，其中，所述栅极控制器在所述帧的所述消隐时段中基于具有低电平的消隐信号以所述栅极截止电压的所述电压电平输出所述第一时钟信号、所述第一时钟条信号、所述第二时钟信号和所述第二时钟条信号。
8.根据权利要求2所述的显示装置，其中，所述栅极驱动器基于所述第一时钟信号、所述第一时钟条信号、所述第二时钟信号和所述第二时钟条信号生成所述栅极信号。
9.根据权利要求2所述的显示装置，其中，所述第一时钟信号、所述第一时钟条信号、所述第二时钟信号和所述第二时钟条信号中的每个在所述栅极导通电压与所述栅极截止电压之间摆动。
10.根据权利要求1所述的显示装置，其中，当所述时序控制器在故障模式中操作时，所述栅极控制器以所述栅极截止电压的所述电压电平输出所述栅极时钟信号中的每个。
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